JP6867316B2 - Optical device - Google Patents

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Description

本発明は、シリコン電子デバイスと組み合わせることが可能な光デバイスに関する。 The present invention relates to an optical device that can be combined with a silicon electronic device.

近年、光デバイス製造の効率化・低コスト化のために、成熟した半導体電子デバイス製造設備を用いて光デバイスを製造する技術が進展している。特に、シリコン光導波路と電子デバイス構造を組み合わせた光変調器が精力的に開発されている(非特許文献1)。 In recent years, in order to improve the efficiency and reduce the cost of manufacturing optical devices, the technology for manufacturing optical devices using mature semiconductor electronic device manufacturing equipment has been advanced. In particular, an optical modulator that combines a silicon optical waveguide and an electronic device structure has been energetically developed (Non-Patent Document 1).

更に、こうした半導体光デバイスと電子デバイスとを同一ウェハ上にモノリシックに集積することも実現されている。例えば、光デバイスと駆動・制御用電子回路とを、ウェハプロセスで一貫して作製、集積する技術がある(非特許文献2参照)。これにより、後工程が簡略化され、製造コストが低減できると期待されている。 Further, it is also realized that such a semiconductor optical device and an electronic device are monolithically integrated on the same wafer. For example, there is a technique for consistently manufacturing and integrating an optical device and a drive / control electronic circuit by a wafer process (see Non-Patent Document 2). This is expected to simplify the post-process and reduce the manufacturing cost.

米国特許出願公開第2012/0280345号明細書U.S. Patent Application Publication No. 2012/0280345

G. T. Reed et al., "Silicon optical modulators", Nature Photonics, vol. 4, pp. 518-526, 2010.G. T. Reed et al., "Silicon optical modulators", Nature Photonics, vol. 4, pp. 518-526, 2010. B. Analui et al., "A Fully Integrated 20-Gb/s Optoelectronic Transceiver Implemented in a Standard 0.13-m CMOS SOI Technology", IEEE Journal of Solid-State Circuits, vol. 41, no. 12, pp. 2945-2955, 2006.B. Analui et al., "A Fully Integrated 20-Gb / s Optoelectronic Transceiver Implemented in a Standard 0.13-m CMOS SOI Technology", IEEE Journal of Solid-State Circuits, vol. 41, no. 12, pp. 2945- 2955, 2006.

しかしながら、光変調など動作を実現するシリコン光デバイスは、一般的な電子デバイス構造と比較して大きいという問題があった。例えば、非特許文献1において示されているシリコン光導波路型変調器は、光位相シフタを構成するシリコン(Si)光導波路のコア幅は一般的に数百nmであり、またコア高さも数百nmである。製造プロセスの観点からすると、リソグラフィで形成するSiコア線幅は、トランジスタのゲートなどの電子デバイスのSiパタン線幅と比べて1桁大きい。また、ドライエッチングによるSiコアの形成においては、電子デバイスのSi層プロセス工程にはない加工が必要であり、電子デバイスとは大きく異なる製造設備・製造条件が必要になるという問題があった。 However, there is a problem that the silicon optical device that realizes the operation such as optical modulation is larger than the general electronic device structure. For example, in the silicon optical waveguide type modulator shown in Non-Patent Document 1, the core width of the silicon (Si) optical waveguide constituting the optical phase shifter is generally several hundred nm, and the core height is also several hundred. It is nm. From the viewpoint of the manufacturing process, the Si core line width formed by lithography is an order of magnitude larger than the Si pattern line width of electronic devices such as transistor gates. Further, in the formation of the Si core by dry etching, there is a problem that processing that is not in the Si layer process process of the electronic device is required, and manufacturing equipment and manufacturing conditions that are significantly different from those of the electronic device are required.

更に、従来のSi導波路型変調は、Si導波路への光閉じ込めのためにSiコア下部に屈折率の低いSiO2によるクラッドを数μmの厚さで配置することが一般的であり、この点においても、電子デバイスとは異なっている。このため、従来のSi導波路型変調では、製造においては数μm厚の埋め込み酸化膜(BOX)層を有するシリコンオンインシュレータ(SOI)基板を用い、厚いボックス層をクラッドとして用いている。一方で、電子デバイス製造においては、このような厚いBOX層を有するSOI基板が用いられることはなく、基板においても光変調器製造は電子デバイス製造と大きな違いがあった。 Further, in the conventional Si waveguide type modulation, a clad made of SiO 2 having a low refractive index is generally arranged in the lower part of the Si core to a thickness of several μm in order to confine the light in the Si waveguide. It is also different from electronic devices in that respect. Therefore, in the conventional Si waveguide type modulation, a silicon-on-insulator (SOI) substrate having an embedded oxide film (BOX) layer having a thickness of several μm is used in manufacturing, and a thick box layer is used as a clad. On the other hand, in the manufacture of electronic devices, an SOI substrate having such a thick BOX layer is not used, and the manufacture of an optical modulator in the substrate is also significantly different from the manufacture of an electronic device.

上述した違いは、電子デバイス製造設備を用いることで光デバイス製造を効率化・低コスト化するためには大きな障壁となっていた。 The above-mentioned difference has been a major obstacle to the efficiency and cost reduction of optical device manufacturing by using the electronic device manufacturing equipment.

本発明は、以上のような問題点を解消するためになされたものであり、電子デバイス製造設備を用いてより効率的・低コストで光デバイスが製造できるようにすることを目的とする。 The present invention has been made to solve the above problems, and an object of the present invention is to enable more efficient and low-cost manufacturing of optical devices by using electronic device manufacturing equipment.

本発明に係る光デバイスは、シリコン層の上にゲート絶縁層を介して形成されたゲート電極と、ゲート電極が形成されている領域を挟んでシリコン層に形成されたソース領域およびドレイン領域と、ソース領域の上に接続して形成された金属からなるソース電極と、ドレイン領域の上に接続して形成された金属からなるドレイン電極と、ソース領域とソース電極との間に形成された金属シリサイドからなるソースコンタクト層と、ドレイン領域とドレイン電極との間に形成された金属シリサイドからなるドレインコンタクト層とを備え、ソースコンタクト層とドレインコンタクト層とに挾まれたゲート電極の直下のシリコン層に形成されるチャネルの領域をコアとしてゲート幅方向を導波方向とするプラズモニック導波路を備える。 The optical device according to the present invention includes a gate electrode formed on a silicon layer via a gate insulating layer, a source region and a drain region formed on the silicon layer with a region on which the gate electrode is formed, and a drain region. A metal source electrode formed by connecting over the source region, a metal drain electrode formed by connecting over the drain region, and a metal VDD formed between the source region and the source electrode. The silicon layer is provided with a source contact layer made of the same material and a drain contact layer made of a metal silicide formed between the drain region and the drain electrode, and is sandwiched between the source contact layer and the drain contact layer in a silicon layer directly below the gate electrode. A plasmonic waveguide having a region of the formed channel as a core and a gate width direction as a waveguide direction is provided.

上記光デバイスにおいて、ゲート電極は、シリコンから構成され、ゲート電極の上に形成された金属シリサイドからなるゲートコンタクト層を更に備える。 In the above optical device, the gate electrode further comprises a gate contact layer made of silicon and made of a metal silicide formed on the gate electrode.

上記光デバイスにおいて、ゲート絶縁層は、窒化シリコンから構成されていてもよい。 In the above optical device, the gate insulating layer may be made of silicon nitride.

上記光デバイスにおいて、プラズモニック導波路に連続してシリコン層に形成された他のプラズモニック導波路を備える。 The optical device includes another plasmonic waveguide formed in a silicon layer continuously with the plasmonic waveguide.

上記光デバイスにおいて、シリコン層は、シリコン基板である。また、シリコン層は、SOI基板の表面シリコン層であってもよい。 In the above optical device, the silicon layer is a silicon substrate. Further, the silicon layer may be a surface silicon layer of the SOI substrate.

以上説明したように、本発明によれば、ソース領域とソース電極との間に金属シリサイドからなるソースコンタクト層を設け、ドレイン領域とドレイン電極との間に金属シリサイドからなるドレインコンタクト層を設け、ソースコンタクト層とドレインコンタクト層とに挾まれたゲート電極の直下のシリコン層に形成されるチャネルの領域をコアとするプラズモニック導波路を構成したので、電子デバイス製造設備を用いてより効率的・低コストで光デバイスが製造できるという優れた効果が得られる。 As described above, according to the present invention, a source contact layer made of metal silicide is provided between the source region and the source electrode, and a drain contact layer made of metal silicide is provided between the drain region and the drain electrode. Since a plasmonic waveguide having a channel region formed in the silicon layer directly below the gate electrode sandwiched between the source contact layer and the drain contact layer as the core is constructed, it is more efficient to use electronic device manufacturing equipment. The excellent effect of being able to manufacture optical devices at low cost can be obtained.

図1は、本発明の実施の形態1おける光デバイスの構成を示す断面図である。FIG. 1 is a cross-sectional view showing the configuration of an optical device according to the first embodiment of the present invention. 図2は、実施の形態1における光デバイスについて、2次元有限要素法によってプラズモニックモードの電界強度分布を計算した結果を示す分布図である。FIG. 2 is a distribution diagram showing the results of calculating the electric field strength distribution in the plasmonic mode for the optical device according to the first embodiment by the two-dimensional finite element method. 図3は、本発明の実施の形態2おける光デバイスの構成を示す断面図である。FIG. 3 is a cross-sectional view showing the configuration of the optical device according to the second embodiment of the present invention. 図4は、実施の形態2における光デバイスについて、2次元有限要素法によってプラズモニックモードの電界強度分布を計算した結果を示す分布図である。FIG. 4 is a distribution diagram showing the results of calculating the electric field strength distribution in the plasmonic mode for the optical device according to the second embodiment by the two-dimensional finite element method.

以下、本発明の実施の形態について説明する。 Hereinafter, embodiments of the present invention will be described.

[実施の形態1]
はじめに、本発明の実施の形態1おける光デバイスについて図1を参照して説明する。この光デバイスは、まず、シリコン層101の上にゲート絶縁層102を介して形成されたゲート電極103と、ゲート電極103が形成されている領域を挟んでシリコン層101に形成されたソース領域104およびドレイン領域105とを備える。シリコン層101は、例えば、Si基板であればよい。ゲート電極103は、例えば、ポリシリコンから構成すればよい。また、シリコン層101は、p型不純物が導入され、ソース領域104およびドレイン領域105は、n型不純物が導入されている。これらは、よく知られたnチャネルMOSFETと同様の構成である。
[Embodiment 1]
First, the optical device according to the first embodiment of the present invention will be described with reference to FIG. In this optical device, first, a gate electrode 103 formed on the silicon layer 101 via a gate insulating layer 102 and a source region 104 formed on the silicon layer 101 with a region on which the gate electrode 103 is formed are interposed. And a drain region 105. The silicon layer 101 may be, for example, a Si substrate. The gate electrode 103 may be made of polysilicon, for example. Further, p-type impurities are introduced into the silicon layer 101, and n-type impurities are introduced into the source region 104 and the drain region 105. These have the same configuration as the well-known n-channel MOSFET.

また、この光デバイスは、ソース領域104の上に接続して形成された金属からなるソース電極106と、ドレイン領域105の上に接続して形成された金属からなるドレイン電極107とを備える。 The optical device also includes a metal source electrode 106 formed by connecting over the source region 104 and a metal drain electrode 107 formed by connecting over the drain region 105.

また、この光デバイスは、層厚方向に、ソース領域104とソース電極106との間に形成された金属シリサイドからなるソースコンタクト層108と、ドレイン領域105とドレイン電極107との間に形成された金属シリサイドからなるドレインコンタクト層109とを備える。ソースコンタクト層108,ドレインコンタクト層109は、例えば、各々ソース領域104,ドレイン領域105を表面側からシリサイド化することで形成された領域である。 Further, this optical device is formed between the source contact layer 108 made of metal silicide formed between the source region 104 and the source electrode 106 in the layer thickness direction, and between the drain region 105 and the drain electrode 107. A drain contact layer 109 made of metal silicide is provided. The source contact layer 108 and the drain contact layer 109 are, for example, regions formed by silicating the source region 104 and the drain region 105 from the surface side, respectively.

ソースコンタクト層108,ドレインコンタクト層109は、例えば、ニッケルシリサイド(NiSi)、コバルトシリサイド(CoSi2)、タンタルシリサイドなどの、nチャネルMOSFETにおいて負の誘電率実部を有する材料から構成すればよい。例えば、ソース領域104,ドレイン領域105に、Ni,Co,Taなどの金属層を形成し、加熱することでSiと金属との合金を形成することで、上述した金属シリサイドによるソースコンタクト層108,ドレインコンタクト層109が形成できる。ソースコンタクト層108,ドレインコンタクト層109は、ソース領域104,ドレイン領域105との間に形成されるチャネルの領域121と、層厚方向に同じ位置(高さ)に配置される。 The source contact layer 108 and the drain contact layer 109 may be made of a material having a negative permittivity real part in the n-channel MOSFET, such as nickel silicide (NiSi), cobalt silicide (CoSi 2), and tantalum silicide. For example, by forming a metal layer such as Ni, Co, Ta in the source region 104 and the drain region 105 and forming an alloy of Si and a metal by heating, the source contact layer 108 made of the above-mentioned metal silicide is formed. The drain contact layer 109 can be formed. The source contact layer 108 and the drain contact layer 109 are arranged at the same position (height) in the layer thickness direction as the region 121 of the channel formed between the source region 104 and the drain region 105.

また、実施の形態1における光デバイスは、ソースコンタクト層108とドレインコンタクト層109とに挾まれたゲート電極103の直下のシリコン層101に形成されるチャネルの領域121をコアとしてゲート幅方向を導波方向とするプラズモニック導波路を備える。上述したように、チャネルの領域121を、所定の厚さとしたソースコンタクト層108,ドレインコンタクト層109で挾むことで、所望とする光強度分布を有するプラズモニック導波路が形成できる。 Further, the optical device according to the first embodiment guides the gate width direction with the channel region 121 formed in the silicon layer 101 directly below the gate electrode 103 sandwiched between the source contact layer 108 and the drain contact layer 109 as a core. It is equipped with a plasmonic waveguide in the wave direction. As described above, the plasmonic waveguide having a desired light intensity distribution can be formed by sandwiching the region 121 of the channel with the source contact layer 108 and the drain contact layer 109 having a predetermined thickness.

なお、実施の形態1では、ゲート電極103をポリシリコンから構成し、ゲート電極103の上に金属シリサイドからなるゲートコンタクト層110を備える。ゲートコンタクト層110も、NiSi、CoSi2、タンタルシリサイドなどの材料から構成すればよい。例えば、ゲート電極103を形成した後、ソース領域104,ドレイン領域105にとともに、これらの上にNi,Co,Taなどの金属層を形成し、加熱することでSiと金属との合金を形成することで、ソースコンタクト層108,ドレインコンタクト層109とともにゲートコンタクト層110が形成できる。 In the first embodiment, the gate electrode 103 is made of polysilicon, and the gate contact layer 110 made of metal silicide is provided on the gate electrode 103. The gate contact layer 110 may also be made of a material such as NiSi, CoSi 2, or tantalum Silicide. For example, after forming the gate electrode 103, a metal layer such as Ni, Co, Ta is formed on the source region 104 and the drain region 105, and an alloy of Si and a metal is formed by heating. As a result, the gate contact layer 110 can be formed together with the source contact layer 108 and the drain contact layer 109.

また、ゲート電極103,ゲートコンタクト層110の両脇には、サイドウオール111が形成されている。また、ゲート電極103,ゲートコンタクト層110,サイドウオール111,ソース電極106,およびドレイン電極107は、パッシベーション膜112においわれている。パッシベーション膜112には、各電極に接続するコンタクト(不図示)が形成され、パッシベーション膜112の上に形成される配線(不図示)に接続される。 Side walls 111 are formed on both sides of the gate electrode 103 and the gate contact layer 110. Further, the gate electrode 103, the gate contact layer 110, the side wall 111, the source electrode 106, and the drain electrode 107 are contained in the passivation film 112. A contact (not shown) connected to each electrode is formed on the passivation film 112, and is connected to a wiring (not shown) formed on the passivation film 112.

ここで、Siから構成するゲート電極103やゲート絶縁層102は、チャネルの領域121をコアとするプラズモニック導波路のプラズモニックモードに影響を与える。このため、ゲート電極103の上にも金属シリサイドの層を配置し、ゲート電極103やゲート絶縁層の厚さを適宜に設定することで、上述したプラズモニック導波路において、所望とするプラズモニックモードを得られるように調整できる。 Here, the gate electrode 103 and the gate insulating layer 102 made of Si affect the plasmonic mode of the plasmonic waveguide having the channel region 121 as the core. Therefore, by arranging a layer of metal silicide also on the gate electrode 103 and appropriately setting the thickness of the gate electrode 103 and the gate insulating layer, the desired plasmonic mode in the above-mentioned plasmonic waveguide can be used. Can be adjusted to obtain.

上述した実施の形態1における光デバイスは、ソース電極106とドレイン電極107との間に所定のバイアス電圧を印加した状態で、ゲート電極103にゲート電圧を印加することで、チャネルの領域121をキャリアが走行し、チャネルの領域121内ではキャリアプラズマ効果によって屈折率変化が生じる。この屈折率変化により、上述したプラズモニック導波路を、プラズモニックモードとして閉じ込められて導波する光に対して強度・位相変調が付与できる。 In the optical device according to the first embodiment described above, a predetermined bias voltage is applied between the source electrode 106 and the drain electrode 107, and a gate voltage is applied to the gate electrode 103 to carrier the channel region 121. In the region 121 of the channel, the refractive index changes due to the carrier plasma effect. By this change in the refractive index, the above-mentioned plasmonic waveguide can be confined in the plasmonic mode, and intensity / phase modulation can be applied to the light that is guided.

上述したプラズモニック導波路に連続し、シリコン層101に他のプラズモニック導波路を形成すれば、実施の形態1における光デバイスを光強度・位相シフタとして用いるマッハツェンダー干渉計による光変調器が実現できる。例えば、実施の形態1のMOSFET構造の光デバイスを、所定のゲート幅(導波長)に形成し、このゲート幅方向(導波方向)の両端から、チャネルの領域121に連続するコアからなる他のプラズモニック導波路を形成すればよい。例えば、ゲート電極やソース・ドレインとなる不純物導入領域がなく、コアの両脇に金属シリサイドが形成された他のプラズモニック導波路とすればよい。また、光デバイスのゲート幅方向(導波方向)の両端から、チャネルの領域121に連続するコアの両脇に溝を形成し、この溝に金属層を配置することで、他のプラズモニック導波路としてもよい(特許文献1参照)。他のプラズモニック導波路により、基本的なマッハツェンダー干渉計を構成し、この一方のアームに、実施の形態1における光デバイスを配置すればよい。 By forming another plasmonic waveguide continuous with the above-mentioned plasmonic waveguide and forming another plasmonic waveguide on the silicon layer 101, an optical modulator using a Mach-Zehnder interferometer using the optical device of the first embodiment as a light intensity / phase shifter is realized. it can. For example, the optical device having the MOSFET structure of the first embodiment is formed with a predetermined gate width (waveguide length), and is composed of cores continuous from both ends in the gate width direction (waveguide direction) to the channel region 121. The plasmonic waveguide may be formed. For example, another plasmonic waveguide having no impurity introduction region serving as a gate electrode or a source / drain and having metal silicides formed on both sides of the core may be used. Further, by forming grooves on both sides of the core continuous to the channel region 121 from both ends in the gate width direction (waveguide direction) of the optical device and arranging a metal layer in the grooves, other plasmonic leads can be obtained. It may be used as a waveguide (see Patent Document 1). A basic Mach-Zehnder interferometer may be constructed by another plasmonic waveguide, and the optical device according to the first embodiment may be arranged on one of the arms.

なお、上述したチャネルの領域121における導波光の強度・位相変調においては、チャネル長は短ければ短いほどキャリア走行時間が短縮されるため望ましい。一方で、シリサイド材料の誘電率によっては光が閉じ込められないため、プラズモニックモードが存在するようにチャネル長を広げるなど、適宜調整される。 In the intensity / phase modulation of the waveguide light in the region 121 of the channel described above, the shorter the channel length, the shorter the carrier travel time, which is desirable. On the other hand, since light is not trapped depending on the dielectric constant of the silicide material, the channel length is appropriately adjusted so that the plasmonic mode exists.

ところで、nチャネルMOSFETにおいては、チャネルの領域121に引っ張り歪みを与えることで、キャリアの移動度が増大して高速化に寄与することがよく知られている。移動度の向上は、キャリアプラズマ効果を増大させ高効率変調にも寄与するため、このような歪み付与は、好適である。例えば、よく知られているように、窒化シリコンを堆積することでゲート絶縁層102を形成すれば、チャネルの領域121に引っ張り歪みを与えることができる。 By the way, in an n-channel MOSFET, it is well known that by applying tensile strain to the channel region 121, the mobility of carriers increases and contributes to high speed. Since the improvement in mobility increases the carrier plasma effect and contributes to high-efficiency modulation, such distortion imparting is preferable. For example, as is well known, if the gate insulating layer 102 is formed by depositing silicon nitride, tensile strain can be applied to the region 121 of the channel.

次に、実施の形態1における光デバイスについて、2次元有限要素法によってプラズモニックモードの電界強度分布を計算した結果について、図2を用いて説明する。波長は1550nmである。ソースコンタクト層108,ドレインコンタクト層109,ゲートコンタクト層110は、CoSi2(複素屈折率:N=0.97+i7.56)とし、厚さは60nmとした。 Next, regarding the optical device according to the first embodiment, the result of calculating the electric field strength distribution in the plasmonic mode by the two-dimensional finite element method will be described with reference to FIG. The wavelength is 1550 nm. The source contact layer 108, the drain contact layer 109, and the gate contact layer 110 were made of CoSi 2 (complex refractive index: N = 0.97 + i7.56) and had a thickness of 60 nm.

ゲート電極103は、ポリシリコンから構成し、厚さ100nmとした。また、ゲート長は60nmとし、ゲート絶縁層102は、SiO2とし、厚さは2nmとした。また、ソースコンタクト層108とドレインコンタクト層109との間隔(チャネルの領域121)は、120nmとした。 The gate electrode 103 is made of polysilicon and has a thickness of 100 nm. The gate length was 60 nm, the gate insulating layer 102 was SiO 2 , and the thickness was 2 nm. The distance between the source contact layer 108 and the drain contact layer 109 (channel region 121) was set to 120 nm.

図2に示すように、ソースコンタクト層108とドレインコンタクト層109との間のチャネルの領域121に、光が閉じ込められていることが分かる。 As shown in FIG. 2, it can be seen that light is confined in the region 121 of the channel between the source contact layer 108 and the drain contact layer 109.

以上に説明したように、実施の形態1によれば、一般的なMOSFETと同様の素子寸法で光変調器が作製できる。また、実施の形態1によれば、従来技術と異なり、SiO2などから構成する下部クラッドを必要とせずに、光強度・位相シフタを構成できる。これにより、例えば、電子デバイスの製造では一般に用いられない厚い埋め込み絶縁層を備えるSOI基板を使わず、電子回路作製に広く用いられる低コストなバルクSi基板を使って光変調器が作製可能となる。このように、実施の形態1によれば、電子デバイス製造設備を用いてより効率的・低コストで光デバイスが製造できるという、優れた効果が得られる。 As described above, according to the first embodiment, the optical modulator can be manufactured with the same element dimensions as that of a general MOSFET. Further, according to the first embodiment, unlike the prior art, the light intensity / phase shifter can be configured without the need for a lower clad made of SiO 2 or the like. As a result, for example, an optical modulator can be manufactured using a low-cost bulk Si substrate widely used for manufacturing electronic circuits, without using an SOI substrate having a thick embedded insulating layer that is not generally used in manufacturing electronic devices. .. As described above, according to the first embodiment, it is possible to obtain an excellent effect that the optical device can be manufactured more efficiently and at low cost by using the electronic device manufacturing equipment.

なお、実施の形態1で示した各材料および寸法は一例である。ソースコンタクト層108とドレインコンタクト層109とに挾まれたチャネルの領域121をコアとするプラズモニック導波路において、低損失プラズモニックモードが得られ、かつ高効率に光変調が得られるように、MOSFETチャネル内部でのプラズモニックモード閉じ込めが得られるように適宜調整する。 The materials and dimensions shown in the first embodiment are examples. In a plasmonic waveguide whose core is the region 121 of the channel sandwiched between the source contact layer 108 and the drain contact layer 109, a MOSFET can be obtained so that a low-loss plasmonic mode can be obtained and optical modulation can be obtained with high efficiency. Adjust appropriately to obtain plasmonic mode confinement inside the channel.

[実施の形態2]
次に、本発明の実施の形態2おける光デバイスについて図3を参照して説明する。この光デバイスは、ゲート絶縁層102、ゲート電極103、ソース領域104、ドレイン領域105、ソース電極106、ドレイン電極107、ソースコンタクト層108、ドレインコンタクト層109、ゲートコンタクト層110、サイドウオール111、パッシベーション膜112を備える。これらの構成は、前述した実施の形態1と同様である。
[Embodiment 2]
Next, the optical device according to the second embodiment of the present invention will be described with reference to FIG. This optical device includes a gate insulating layer 102, a gate electrode 103, a source region 104, a drain region 105, a source electrode 106, a drain electrode 107, a source contact layer 108, a drain contact layer 109, a gate contact layer 110, a side wall 111, and a passivation. A film 112 is provided. These configurations are the same as those in the first embodiment described above.

実施の形態2では、上述した構成を、よく知られたSOI(Silicon on Insulator)基板の表面シリコン層であるシリコン層201およびこの上に形成している。シリコン層201は、SOI基板の埋め込み絶縁層211の上に配置されている。このSOI基板は、完全空亡型MOSFETで用いられるものであり、埋め込み絶縁層211の厚さは0.2μm程度であり、一般的なSiコアによる光導波路のクラッドには適さない。 In the second embodiment, the above-described configuration is formed on the silicon layer 201, which is a surface silicon layer of a well-known SOI (Silicon on Insulator) substrate, and on the silicon layer 201. The silicon layer 201 is arranged on the embedded insulating layer 211 of the SOI substrate. This SOI substrate is used in a completely empty MOSFET, and the thickness of the embedded insulating layer 211 is about 0.2 μm, which is not suitable for clad of an optical waveguide using a general Si core.

次に、実施の形態2における光デバイスについて、2次元有限要素法によってプラズモニックモードの電界強度分布を計算した結果について、図4を用いて説明する。波長は1550nmである。ソースコンタクト層108,ドレインコンタクト層109,ゲートコンタクト層110は、NiSi(複素屈折率:N=1.54+i4.73)とし、厚さは60nmとした。シリコン層201の厚さは80nmとした。 Next, regarding the optical device according to the second embodiment, the result of calculating the electric field strength distribution in the plasmonic mode by the two-dimensional finite element method will be described with reference to FIG. The wavelength is 1550 nm. The source contact layer 108, the drain contact layer 109, and the gate contact layer 110 were made of NiSi (complex refractive index: N = 1.54 + i4.73) and had a thickness of 60 nm. The thickness of the silicon layer 201 was set to 80 nm.

ゲート電極103は、ポリシリコンから構成し、厚さ100nmとした。また、ゲート長は60nmとし、ゲート絶縁層102は、SiO2とし、厚さは2nmとした。また、ソースコンタクト層108とドレインコンタクト層109との間隔(チャネルの領域121)は、120nmとした。 The gate electrode 103 is made of polysilicon and has a thickness of 100 nm. The gate length was 60 nm, the gate insulating layer 102 was SiO 2 , and the thickness was 2 nm. The distance between the source contact layer 108 and the drain contact layer 109 (channel region 121) was set to 120 nm.

図4に示すように、実施の形態2においても、ソースコンタクト層108とドレインコンタクト層109との間のチャネルの領域121に、光が閉じ込められていることが分かる。 As shown in FIG. 4, it can be seen that also in the second embodiment, the light is confined in the region 121 of the channel between the source contact layer 108 and the drain contact layer 109.

以上に説明したように、実施の形態2においても、一般的なMOSFETと同様の素子寸法で光変調器が作製できる。このように、実施の形態2によれば、電子デバイス製造設備を用いてより効率的・低コストで光デバイスが製造できるという、優れた効果が得られる。 As described above, also in the second embodiment, the optical modulator can be manufactured with the same element dimensions as that of a general MOSFET. As described above, according to the second embodiment, it is possible to obtain an excellent effect that the optical device can be manufactured more efficiently and at low cost by using the electronic device manufacturing equipment.

なお、実施の形態2で示した各材料および寸法も一例である。ソースコンタクト層108とドレインコンタクト層109とに挾まれたチャネルの領域121をコアとするプラズモニック導波路において、低損失プラズモニックモードが得られ、かつ高効率に光変調が得られるように、MOSFETチャネル内部でのプラズモニックモード閉じ込めが得られるように適宜調整する。 The materials and dimensions shown in the second embodiment are also examples. In a plasmonic waveguide whose core is the region 121 of the channel sandwiched between the source contact layer 108 and the drain contact layer 109, a MOSFET can be obtained so that a low-loss plasmonic mode can be obtained and optical modulation can be obtained with high efficiency. Adjust appropriately to obtain plasmonic mode confinement inside the channel.

以上に説明したように、本発明によれば、ソース領域とソース電極との間に金属シリサイドからなるソースコンタクト層を設け、ドレイン領域とドレイン電極との間に金属シリサイドからなるドレインコンタクト層を設け、ソースコンタクト層とドレインコンタクト層とに挾まれたゲート電極の直下のシリコン層に形成されるチャネルの領域をコアとするプラズモニック導波路を構成したので、電子デバイス製造設備を用いてより効率的・低コストで光デバイスが製造できるようになる。 As described above, according to the present invention, a source contact layer made of metal silicide is provided between the source region and the source electrode, and a drain contact layer made of metal silicide is provided between the drain region and the drain electrode. Since the plasmonic waveguide having the channel region formed in the silicon layer directly under the gate electrode sandwiched between the source contact layer and the drain contact layer as the core was constructed, it is more efficient to use the electronic device manufacturing equipment.・ It will be possible to manufacture optical devices at low cost.

なお、本発明は以上に説明した実施の形態に限定されるものではなく、本発明の技術的思想内で、当分野において通常の知識を有する者により、多くの変形および組み合わせが実施可能であることは明白である。 The present invention is not limited to the embodiments described above, and many modifications and combinations can be carried out by a person having ordinary knowledge in the art within the technical idea of the present invention. That is clear.

101…シリコン層、102…ゲート絶縁層、103…ゲート電極、104…ソース領域、105…ドレイン領域、106…ソース電極、107…ドレイン電極、108…ソースコンタクト層、109…ドレインコンタクト層、110…ゲートコンタクト層、111…サイドウオール、112…パッシベーション膜、121…チャネルの領域。 101 ... Silicon layer, 102 ... Gate insulating layer, 103 ... Gate electrode, 104 ... Source region, 105 ... Drain region, 106 ... Source electrode, 107 ... Drain electrode, 108 ... Source contact layer, 109 ... Drain contact layer, 110 ... Gate contact layer, 111 ... side wall, 112 ... passivation film, 121 ... channel region.

Claims (6)

シリコン層の上にゲート絶縁層を介して形成されたゲート電極と、
前記ゲート電極が形成されている領域を挟んで前記シリコン層に形成されたソース領域およびドレイン領域と、
前記ソース領域の上に接続して形成された金属からなるソース電極と、
前記ドレイン領域の上に接続して形成された金属からなるドレイン電極と、
前記ソース領域と前記ソース電極との間に形成された金属シリサイドからなるソースコンタクト層と、
前記ドレイン領域と前記ドレイン電極との間に形成された金属シリサイドからなるドレインコンタクト層と
を備え、
前記ソースコンタクト層と前記ドレインコンタクト層とに挾まれた前記ゲート電極の直下の前記シリコン層に形成されるチャネルの領域をコアとしてゲート幅方向を導波方向とするプラズモニック導波路を備える
ことを特徴とする光デバイス。
A gate electrode formed on the silicon layer via a gate insulating layer,
The source region and the drain region formed on the silicon layer with the region on which the gate electrode is formed are interposed therebetween.
A source electrode made of metal formed by connecting on the source region,
A drain electrode made of metal formed by connecting on the drain region,
A source contact layer made of a metal silicide formed between the source region and the source electrode,
A drain contact layer made of a metal silicide formed between the drain region and the drain electrode is provided.
A plasmonic waveguide having a channel region formed in the silicon layer immediately below the gate electrode sandwiched between the source contact layer and the drain contact layer as a core and a gate width direction as a waveguide direction is provided. A featured optical device.
請求項1記載の光デバイスにおいて、
前記ゲート電極は、シリコンから構成され、
前記ゲート電極の上に形成された金属シリサイドからなるゲートコンタクト層を更に備えることを特徴とする光デバイス。
In the optical device according to claim 1,
The gate electrode is made of silicon.
An optical device further comprising a gate contact layer made of a metal silicide formed on the gate electrode.
請求項1または2記載の光デバイスにおいて、
前記ゲート絶縁層は、窒化シリコンから構成されていることを特徴とする光デバイス。
In the optical device according to claim 1 or 2.
An optical device characterized in that the gate insulating layer is made of silicon nitride.
請求項1〜3のいずれか1項に記載の光デバイスにおいて、
前記プラズモニック導波路に連続して前記シリコン層に形成された他のプラズモニック導波路を備えることを特徴とする光デバイス。
In the optical device according to any one of claims 1 to 3.
An optical device comprising the plasmonic waveguide continuous with another plasmonic waveguide formed in the silicon layer.
請求項1〜4のいずれか1項に記載の光デバイスにおいて、
前記シリコン層は、シリコン基板であることを特徴とする光デバイス。
In the optical device according to any one of claims 1 to 4.
An optical device in which the silicon layer is a silicon substrate.
請求項1〜4のいずれか1項に記載の光デバイスにおいて、
前記シリコン層は、SOI基板の表面シリコン層であることを特徴とする光デバイス。
In the optical device according to any one of claims 1 to 4.
An optical device characterized in that the silicon layer is a surface silicon layer of an SOI substrate.
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