JP6099165B2 - Video signal determination apparatus, video display apparatus, video signal determination method, and video display method - Google Patents

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Description

本発明は、映像信号の特性を判定する映像信号判定装置、映像表示装置、映像信号判定方法および映像表示方法に関する。   The present invention relates to a video signal determination device, a video display device, a video signal determination method, and a video display method for determining characteristics of a video signal.

近年、映像を表示するための入力信号に含まれる水平同期周波数、垂直同期周波数、スキャンタイプ、映像ライン数、同期タイプ、垂直同期信号幅および同期極性に基づいて、当該入力信号の種類(映像信号の種類)を判定する技術が考えられている。例えば、特許文献1では、上記の情報の他、垂直同期信号の幅を検出して入力された映像信号の種類を判定する。そして、この判定結果を用いて、映像信号に応じた映像を表示する。   In recent years, based on the horizontal sync frequency, vertical sync frequency, scan type, number of video lines, sync type, vertical sync signal width and sync polarity included in the input signal for displaying video, the type of the input signal (video signal A technique for determining the type). For example, in Patent Document 1, in addition to the above information, the width of the vertical synchronization signal is detected to determine the type of the input video signal. Then, using this determination result, an image corresponding to the image signal is displayed.

図1は、特許文献1における映像表示装置を示すブロック図である。   FIG. 1 is a block diagram showing a video display device in Patent Document 1. As shown in FIG.

この映像表示装置には図1に示すように、入力端子1と、映像同期処理回路2(以下、同期処理回路2と称する)と、検出部30と、CPU4と、スケーラ(特許文献1ではスケラー、以下同様)回路5と、固定画素パネル駆動回路6(以下、駆動回路6と称する)と、固定画素パネル7(以下、パネル7と称する)とが設けられている。   As shown in FIG. 1, the video display apparatus includes an input terminal 1, a video synchronization processing circuit 2 (hereinafter referred to as a synchronization processing circuit 2), a detection unit 30, a CPU 4, and a scaler (scaler in Patent Document 1). The same applies to a circuit 5, a fixed pixel panel drive circuit 6 (hereinafter referred to as drive circuit 6), and a fixed pixel panel 7 (hereinafter referred to as panel 7).

同期処理回路2は、入力端子1に入力してきた映像信号を含むアナログ入力信号をアナログデジタル変換するAD変換部と、同期信号と映像信号とに分離する同期分離部等である。同期分離部は、入力された信号の同期タイプに応じた同期タイプ信号を生成する。また、同期処理回路2は、分離した同期信号と映像信号と同期タイプ信号とを検出部30へ出力する。また、同期処理回路2は、分離した映像信号をスケーラ回路5へ出力する。   The synchronization processing circuit 2 is an AD conversion unit that performs analog-to-digital conversion of an analog input signal including a video signal input to the input terminal 1, a synchronization separation unit that separates the synchronization signal and the video signal, and the like. The synchronization separation unit generates a synchronization type signal corresponding to the synchronization type of the input signal. In addition, the synchronization processing circuit 2 outputs the separated synchronization signal, video signal, and synchronization type signal to the detection unit 30. Further, the synchronization processing circuit 2 outputs the separated video signal to the scaler circuit 5.

検出部30は、同期処理回路2から出力されてきた同期信号と映像信号と同期タイプ信号とから、水平同期周波数、垂直同期周波数、スキャンタイプ、総ライン数、映像ライン数、同期タイプ、垂直同期信号幅および同期極性を検出する。   The detection unit 30 detects the horizontal synchronization frequency, the vertical synchronization frequency, the scan type, the total number of lines, the number of video lines, the synchronization type, and the vertical synchronization from the synchronization signal, the video signal, and the synchronization type signal output from the synchronization processing circuit 2. Detect signal width and sync polarity.

図2は、図1に示した検出部30の内部構成を示す図である。   FIG. 2 is a diagram illustrating an internal configuration of the detection unit 30 illustrated in FIG. 1.

図1に示した検出部30には図2に示すように、水平・垂直周波数検出回路31と、同期極性検出回路32と、同期タイプ検出回路33と、スキャンタイプ検出回路34と、映像ライン数検出回路35と、総ライン数検出回路36と、垂直同期信号幅検出回路3A2とが設けられている。   As shown in FIG. 2, the detection unit 30 shown in FIG. 1 includes a horizontal / vertical frequency detection circuit 31, a synchronization polarity detection circuit 32, a synchronization type detection circuit 33, a scan type detection circuit 34, and the number of video lines. A detection circuit 35, a total line number detection circuit 36, and a vertical synchronization signal width detection circuit 3A2 are provided.

CPU4は、これら検出部30の検出結果に基づいて入力映像信号の種類を判別し、当該判別した信号の種類に適した各種制御用データを映像同期処理回路2、スケーラ回路5、固定画素パネル駆動回路6にそれぞれ設定する。   The CPU 4 discriminates the type of the input video signal based on the detection result of the detection unit 30, and drives various types of control data suitable for the discriminated signal type to the video synchronization processing circuit 2, the scaler circuit 5, and the fixed pixel panel drive. Set for each circuit 6.

図3は、図1に示した映像表示装置において、映像ライン数が768ラインであり、垂直同期周波数が60Hz近傍である信号について垂直同期信号幅に基づいて、アスペクト比を判定する処理を説明するためのフローチャートである。また、図4は、入力信号がパーソナルコンピュータ等のビデオ周辺機器に関する業界標準化団体であるVESA(Video Electronics Standards Association)が規定するCVT(Coordinated Video Timings)信号である場合の垂直同期信号幅とアスペクト比との関係を示す図である。   FIG. 3 illustrates a process of determining the aspect ratio based on the vertical sync signal width for a signal having 768 video lines and a vertical sync frequency of around 60 Hz in the video display apparatus shown in FIG. It is a flowchart for. FIG. 4 shows the vertical sync signal width and aspect ratio when the input signal is a CVT (Coordinated Video Timings) signal defined by the Video Electronics Standards Association (VESA), which is an industry standardization organization for video peripherals such as personal computers. It is a figure which shows the relationship.

CPU4は、映像ライン数が768ラインであり、垂直同期周波数が60Hzである信号について、ステップ101にて、検出部30の垂直同期信号幅検出回路3A2が検出した垂直同期信号幅が何ラインであるかを判定する。   In step 101, the CPU 4 determines the number of lines of the vertical synchronization signal width detected by the vertical synchronization signal width detection circuit 3A2 in step 101 for a signal having 768 video lines and a vertical synchronization frequency of 60 Hz. Determine whether.

判定の結果、垂直同期信号幅が3、8、9、10ラインである場合、ステップ102にて、CPU4は、図4に示した関係に基づいて、アスペクト比が4:3であると判定する。また、判定の結果、垂直同期信号幅が4ラインである場合、ステップ103にて、CPU4は、図4に示した関係に基づいて、アスペクト比が4:3であると判定する。また、判定の結果、垂直同期信号幅が5ラインである場合、ステップ104にて、CPU4は、図4に示した関係に基づいて、アスペクト比が16:9であると判定する。また、判定の結果、垂直同期信号幅が6ラインである場合、ステップ105にて、CPU4は、図4に示した関係に基づいて、アスペクト比が16:10であると判定する。また、判定の結果、垂直同期信号幅が7ラインである場合、ステップ106にて、CPU4は、図4に示した関係に基づいて、アスペクト比が15:9であると判定する。   If the vertical synchronization signal width is 3, 8, 9, 10 lines as a result of the determination, in step 102, the CPU 4 determines that the aspect ratio is 4: 3 based on the relationship shown in FIG. . If the vertical synchronization signal width is 4 lines as a result of the determination, in step 103, the CPU 4 determines that the aspect ratio is 4: 3 based on the relationship shown in FIG. If the vertical synchronization signal width is 5 lines as a result of the determination, in step 104, the CPU 4 determines that the aspect ratio is 16: 9 based on the relationship shown in FIG. If the vertical synchronization signal width is 6 lines as a result of the determination, in step 105, the CPU 4 determines that the aspect ratio is 16:10 based on the relationship shown in FIG. If the vertical synchronization signal width is 7 lines as a result of the determination, in step 106, the CPU 4 determines that the aspect ratio is 15: 9 based on the relationship shown in FIG.

特開2007−96875号公報JP 2007-96875 A

図5は、映像ライン数が768ラインであり、垂直同期周波数が60Hz近傍である信号について垂直同期信号幅に基づいて行ったアスペクト比の判定結果を示す図である。図5に示すように、映像ライン数が768ラインであり、垂直周波数が60Hz近傍の信号には、CVTの他にDMT(Display Monitor Timings)およびGFT(Generalized Timing Formula)と呼ばれる他の規格の信号も存在する。   FIG. 5 is a diagram showing the determination result of the aspect ratio performed based on the vertical sync signal width for a signal having 768 video lines and a vertical sync frequency of around 60 Hz. As shown in FIG. 5, the number of video lines is 768 lines and the vertical frequency is around 60 Hz. In addition to CVT, signals of other standards called DMT (Display Monitor Timings) and GFT (Generalized Timing Formula) are used. Is also present.

図5に示すように、映像ライン数が768ラインであり、垂直同期周波数が60Hz近傍の一部の信号では信号の種類が正しく判別できないため、表示画像のアスペクト比が正しい値とはならないという問題点がある。これらの信号では、水平同期周波数が47KHz近傍、垂直同期周波数が60Hz近傍であって、水平同期周波数も垂直同期周波数も信号間の差が微小なため、周波数による信号の識別は困難である。また、同期周波数以外の判別要素を加えても、従来の映像信号判定方法では個別に識別することができない。   As shown in FIG. 5, since the number of video lines is 768 lines and the signal type cannot be determined correctly for some signals in the vicinity of 60 Hz vertical synchronization frequency, the aspect ratio of the display image does not become a correct value. There is a point. In these signals, the horizontal synchronization frequency is around 47 KHz, the vertical synchronization frequency is around 60 Hz, and the difference between the signals in both the horizontal synchronization frequency and the vertical synchronization frequency is very small. Therefore, it is difficult to identify the signals by frequency. Further, even if a determination element other than the synchronization frequency is added, the conventional video signal determination method cannot be individually identified.

本発明の目的は、上述した課題を解決する映像信号判定装置、映像表示装置、映像信号判定方法および映像表示方法を提供することである。   An object of the present invention is to provide a video signal determination device, a video display device, a video signal determination method, and a video display method that solve the above-described problems.

本発明の映像信号判定装置は、
同期信号と映像信号とを含む入力信号を入力し、前記同期信号と前記映像信号とから、映像ライン数、垂直同期周波数、垂直同期信号幅および水平同期信号幅を検出する検出部と、
前記検出部にて検出された映像ライン数、垂直同期周波数、垂直同期信号幅および水平同期信号幅に基づいて、前記映像信号のアスペクト比を判定する判定部とを有する。
The video signal determination device of the present invention is
A detection unit that inputs an input signal including a synchronization signal and a video signal, and detects the number of video lines, a vertical synchronization frequency, a vertical synchronization signal width, and a horizontal synchronization signal width from the synchronization signal and the video signal;
And a determination unit that determines the aspect ratio of the video signal based on the number of video lines, the vertical synchronization frequency, the vertical synchronization signal width, and the horizontal synchronization signal width detected by the detection unit.

また、本発明の映像表示装置は、
同期信号と映像信号とを含む入力信号を入力し、前記同期信号と前記映像信号とから、映像ライン数、垂直同期周波数、垂直同期信号幅および水平同期信号幅を検出し、該検出した映像ライン数、垂直同期周波数、垂直同期信号幅および水平同期信号幅に基づいて、前記映像信号のアスペクト比を判定する制御部と、
前記映像信号を、前記制御部にて判定されたアスペクト比を用いて処理する映像処理部と、
前記映像処理部にて処理された映像信号に基づいて映像を表示する表示部とを有する。
The video display device of the present invention is
An input signal including a synchronization signal and a video signal is input, and the number of video lines, a vertical synchronization frequency, a vertical synchronization signal width, and a horizontal synchronization signal width are detected from the synchronization signal and the video signal, and the detected video line A control unit for determining an aspect ratio of the video signal based on the number, the vertical synchronization frequency, the vertical synchronization signal width, and the horizontal synchronization signal width;
A video processing unit that processes the video signal using the aspect ratio determined by the control unit;
A display unit that displays video based on the video signal processed by the video processing unit.

また、本発明の映像信号判定方法は、
同期信号と映像信号とを含む入力信号を入力し、前記同期信号と前記映像信号とから、映像ライン数、垂直同期周波数、垂直同期信号幅および水平同期信号幅を検出するステップと、
前記検出された映像ライン数、垂直同期周波数、垂直同期信号幅および水平同期信号幅に基づいて、前記映像信号のアスペクト比を判定するステップとを行う。
The video signal determination method of the present invention includes:
Inputting an input signal including a synchronization signal and a video signal, and detecting a number of video lines, a vertical synchronization frequency, a vertical synchronization signal width and a horizontal synchronization signal width from the synchronization signal and the video signal;
Determining the aspect ratio of the video signal based on the detected number of video lines, vertical synchronization frequency, vertical synchronization signal width, and horizontal synchronization signal width.

また、本発明の映像表示方法は、
同期信号と映像信号とを含む入力信号を入力し、前記同期信号と前記映像信号とから、映像ライン数、垂直同期周波数、垂直同期信号幅および水平同期信号幅を検出するステップと、
前記検出された映像ライン数、垂直同期周波数、垂直同期信号幅および水平同期信号幅に基づいて、前記映像信号のアスペクト比を判定するステップと、
前記映像信号を、前記判定されたアスペクト比を用いて処理するステップと、
前記処理された映像信号に基づいて映像を表示するステップとを行う。
The video display method of the present invention includes:
Inputting an input signal including a synchronization signal and a video signal, and detecting a number of video lines, a vertical synchronization frequency, a vertical synchronization signal width and a horizontal synchronization signal width from the synchronization signal and the video signal;
Determining an aspect ratio of the video signal based on the detected number of video lines, vertical synchronization frequency, vertical synchronization signal width and horizontal synchronization signal width;
Processing the video signal using the determined aspect ratio;
Displaying an image based on the processed image signal.

本発明においては、映像の特性のより正確な判定をすることができる。   In the present invention, it is possible to make a more accurate determination of video characteristics.

一般的な映像表示装置を示すブロック図の一例である。It is an example of the block diagram which shows a general video display apparatus. 図1に示した検出部の内部構成を示す図である。It is a figure which shows the internal structure of the detection part shown in FIG. 図1に示した映像表示装置において、映像ライン数が768ラインであり、垂直同期周波数が60Hzである信号について垂直同期信号幅に基づいて、アスペクト比を判定する処理を説明するためのフローチャートである。2 is a flowchart for explaining processing for determining an aspect ratio based on a vertical synchronization signal width for a signal having 768 video lines and a vertical synchronization frequency of 60 Hz in the video display apparatus shown in FIG. 1. . 入力信号がCVT信号である場合の垂直同期信号幅とアスペクト比との関係を示す図である。It is a figure which shows the relationship between a vertical-synchronization signal width | variety and aspect ratio in case an input signal is a CVT signal. 映像ライン数が768ラインであり、垂直同期周波数が60Hzである信号について垂直同期信号幅に基づいて行ったアスペクト比の判定結果を示す図である。It is a figure which shows the determination result of the aspect-ratio performed based on the vertical-synchronization signal width about the signal whose number of video lines is 768 lines and whose vertical-synchronization frequency is 60 Hz. 本発明の映像表示装置の実施の一形態を示すブロック図である。It is a block diagram which shows one Embodiment of the video display apparatus of this invention. 図6に示した検出部の内部構成の一例を示す図である。It is a figure which shows an example of the internal structure of the detection part shown in FIG. 図6に示した判定部におけるアスペクト比の判定処理を説明するためのフローチャートである。7 is a flowchart for explaining an aspect ratio determination process in a determination unit shown in FIG. 6. 図6に示した判定部におけるアスペクト比の判定処理の結果を示す図である。It is a figure which shows the result of the determination process of the aspect ratio in the determination part shown in FIG. 図6に示した検出部の内部構成の一例を示す図である。It is a figure which shows an example of the internal structure of the detection part shown in FIG.

(第1の実施形態)
以下に、本発明の実施の形態について図面を参照して説明する。
(First embodiment)
Embodiments of the present invention will be described below with reference to the drawings.

図6は、本発明の映像表示装置の実施の一形態を示すブロック図である。   FIG. 6 is a block diagram showing an embodiment of the video display device of the present invention.

本形態は図6に示すように、入力端子1と、入力部200と、検出部300と、判定部400と、スケーラ回路5と、駆動回路6と、表示部7とを含む。   As shown in FIG. 6, this embodiment includes an input terminal 1, an input unit 200, a detection unit 300, a determination unit 400, a scaler circuit 5, a drive circuit 6, and a display unit 7.

なお、破線で囲んで示すように、検出部300と、判定部400とで、映像信号判定装置を構成する。また、スケーラ回路5は、映像処理部の一例である。また、検出部300と、判定部400とで制御部を構成する。   Note that the detection unit 300 and the determination unit 400 constitute a video signal determination device as indicated by being surrounded by a broken line. The scaler circuit 5 is an example of a video processing unit. The detection unit 300 and the determination unit 400 constitute a control unit.

また、図6に示した入力端子1に入力される入力信号が、アナログ信号の場合は、入力部200にて、当該アナログ信号をデジタル信号へ変換する。また、入力信号がデジタル信号の場合は、入力部2にて、シリアル−パラレル変換を行う。デジタル映像信号は、入力部200からスケーラ回路5および検出部300へ出力される。また、入力端子1に入力される入力信号が、同期信号と映像信号とが分離されているときは、同期信号は、入力部200から検出部300へ出力され、同期信号が映像信号のうち、いずれかの信号と合成されて入力されているときは、該合成された信号は、入力部200にて、同期信号と映像信号に分離され、映像信号は、スケーラ回路5および検出部300に、同期信号は検出部300に出力される。なお、検出部300へ出力される同期信号は、水平同期信号と垂直同期信号が分離されていてもよし、複合同期信号でもよい。   Further, when the input signal input to the input terminal 1 shown in FIG. 6 is an analog signal, the input unit 200 converts the analog signal into a digital signal. When the input signal is a digital signal, the input unit 2 performs serial-parallel conversion. The digital video signal is output from the input unit 200 to the scaler circuit 5 and the detection unit 300. When the input signal input to the input terminal 1 is separated from the synchronization signal and the video signal, the synchronization signal is output from the input unit 200 to the detection unit 300, and the synchronization signal is included in the video signal. When combined with any of the signals and input, the combined signal is separated into a synchronization signal and a video signal at the input unit 200, and the video signal is sent to the scaler circuit 5 and the detection unit 300. The synchronization signal is output to the detection unit 300. The synchronization signal output to the detection unit 300 may be a horizontal synchronization signal and a vertical synchronization signal separated or a composite synchronization signal.

図6に示した構成要素のうち、図1に示した構成要素と同じ符号を付与しているものは、図1を用いて説明したその構成要素の動作と同じ動作をする。   Among the components shown in FIG. 6, those given the same reference numerals as those shown in FIG. 1 perform the same operations as the components described with reference to FIG. 1.

検出部300は、入力端子1、例えば、COMPUTER(D−Sub)端子から入力されるアナログ映像信号を検出する。また、検出部300は、図1に示した検出部30の動作に加えて、同期信号から、水平同期信号幅を検出する。   The detection unit 300 detects an analog video signal input from the input terminal 1, for example, a COMPUTER (D-Sub) terminal. In addition to the operation of the detection unit 30 shown in FIG. 1, the detection unit 300 detects the horizontal synchronization signal width from the synchronization signal.

図7は、図6に示した検出部300の内部構成の一例を示す図である。   FIG. 7 is a diagram illustrating an example of an internal configuration of the detection unit 300 illustrated in FIG.

図6に示した検出部300には図7に示すように、水平・垂直周波数検出回路31と、同期極性検出回路32と、同期タイプ検出回路33と、スキャンタイプ検出回路34と、映像ライン数検出回路35と、垂直同期信号幅検出回路3A2と、総ライン数検出回路36と、水平同期信号幅検出回路38とが設けられている。   As shown in FIG. 7, the detection unit 300 shown in FIG. 6 includes a horizontal / vertical frequency detection circuit 31, a synchronization polarity detection circuit 32, a synchronization type detection circuit 33, a scan type detection circuit 34, and the number of video lines. A detection circuit 35, a vertical synchronization signal width detection circuit 3A2, a total line number detection circuit 36, and a horizontal synchronization signal width detection circuit 38 are provided.

水平・垂直周波数検出回路31は、入力映像信号とは非同期な基準クロック(たとえば100MHz)を用いて水平・垂直同期信号の周波数を検出する。同期極性検出回路32は、水平・垂直同期信号の極性をそれぞれ検出する。同期タイプ検出回路33は、水平・垂直同期信号が分離型(セパレート)か混合型(ミックス)か、または映像信号のいずれかに重畳(Sync−on−Greenまたは三値同期)されているかを検出する。スキャンタイプ検出回路34は、入力映像信号が飛越走査(インターレス)か順次走査(プログレッシブ)かを検出する。映像ライン数検出回路35は、映像信号と水平・垂直同期信号を用いて有効な映像表示ライン数を検出する。垂直同期信号幅検出回路3A2は、垂直同期信号の幅を水平同期信号によってカウントすることによって垂直同信号幅を検出する。   The horizontal / vertical frequency detection circuit 31 detects the frequency of the horizontal / vertical synchronization signal using a reference clock (for example, 100 MHz) asynchronous with the input video signal. The sync polarity detection circuit 32 detects the polarities of the horizontal and vertical sync signals. The synchronization type detection circuit 33 detects whether the horizontal / vertical synchronization signal is separated (separated), mixed (mixed), or superimposed on the video signal (Sync-on-Green or ternary synchronization). To do. The scan type detection circuit 34 detects whether the input video signal is interlaced scanning (interless) or sequential scanning (progressive). The video line number detection circuit 35 detects the number of effective video display lines using the video signal and the horizontal / vertical synchronization signal. The vertical synchronization signal width detection circuit 3A2 detects the vertical same signal width by counting the width of the vertical synchronization signal with the horizontal synchronization signal.

総ライン数検出回路36は、同期信号から、総ライン数を検出する。また、総ライン数検出回路36は、検出した総ライン数を判定部400へ出力する。   The total line number detection circuit 36 detects the total number of lines from the synchronization signal. The total line number detection circuit 36 outputs the detected total number of lines to the determination unit 400.

水平同期信号幅検出回路38は、同期信号から、所定の基準クロック(例えば、100MHz)を用いてカウントし、水平同期信号幅(パルス幅)を検出する。また、水平同期信号幅検出回路38は、検出した水平同期信号幅を判定部400へ出力する。   The horizontal synchronization signal width detection circuit 38 counts from the synchronization signal using a predetermined reference clock (for example, 100 MHz), and detects the horizontal synchronization signal width (pulse width). Further, the horizontal synchronization signal width detection circuit 38 outputs the detected horizontal synchronization signal width to the determination unit 400.

判定部400は、図1に示したCPU4の動作に加えて、検出部300にて検出された映像ライン数、垂直同期周波数、垂直同期信号幅、水平同期信号幅に基づいて、映像信号のアスペクト比を判定する判定部である。   In addition to the operation of the CPU 4 shown in FIG. 1, the determination unit 400 determines the aspect of the video signal based on the number of video lines, the vertical synchronization frequency, the vertical synchronization signal width, and the horizontal synchronization signal width detected by the detection unit 300. It is the determination part which determines ratio.

以下に、図6に示した判定部400におけるアスペクト比の判定処理について説明する。   Hereinafter, the aspect ratio determination process in the determination unit 400 illustrated in FIG. 6 will be described.

図8は、図6に示した判定部400におけるアスペクト比の判定処理を説明するためのフローチャートである。   FIG. 8 is a flowchart for explaining the aspect ratio determination processing in determination section 400 shown in FIG.

判定部400は、映像ライン数が768ラインであり、垂直同期周波数が60Hz近傍である信号について、ステップ1にて、検出部300の垂直同期信号幅検出回路3A2が検出した垂直同期信号幅が何ラインであるかを判定する。   The determination unit 400 determines the vertical synchronization signal width detected by the vertical synchronization signal width detection circuit 3A2 of the detection unit 300 in step 1 for a signal having 768 video lines and a vertical synchronization frequency in the vicinity of 60 Hz. Determine if it is a line.

ステップ1における判定の結果、垂直同期信号幅が4、8、9、10ラインである場合、ステップ2にて、判定部400は、当該映像信号に設定するアスペクト比が4:3であると判定する。また、ステップ1における判定の結果、垂直同期信号幅が5ラインである場合、ステップ3にて、判定部400は、当該映像信号に設定するアスペクト比が16:9であると判定する。また、ステップ1における判定の結果、垂直同期信号幅が7ラインである場合、ステップ4にて、判定部400は、当該映像信号に設定するアスペクト比が15:9であると判定する。   If the result of determination in step 1 is that the vertical synchronization signal width is 4, 8, 9, 10 lines, in step 2, the determination unit 400 determines that the aspect ratio set for the video signal is 4: 3. To do. If the result of determination in step 1 is that the vertical synchronization signal width is 5 lines, in step 3, the determination unit 400 determines that the aspect ratio set for the video signal is 16: 9. If the result of determination in step 1 is that the vertical synchronization signal width is 7 lines, in step 4, the determination unit 400 determines that the aspect ratio set for the video signal is 15: 9.

また、ステップ1における判定の結果、垂直同期信号幅が3ラインである場合、ステップ5にて、判定部400は、検出部300の水平同期信号幅検出回路38が検出した水平同期信号幅に基づいて判定する。   If the result of determination in step 1 is that the vertical synchronization signal width is 3 lines, in step 5, the determination unit 400 is based on the horizontal synchronization signal width detected by the horizontal synchronization signal width detection circuit 38 of the detection unit 300. Judgment.

図9は、図6に示した判定部400におけるアスペクト比の判定処理の結果を示す図である。   FIG. 9 is a diagram illustrating a result of the aspect ratio determination process in the determination unit 400 illustrated in FIG.

例えば、図9を参照すると、垂直同期信号幅が3ラインである信号は、No.2、No.8、No.9、No.14が該当する。No.2の信号は、ドットクロックClockが64.109[MHz]であり、水平同期信号幅Hwが104[Pixel]であるため、水平同期信号幅Hwは(1/64.109M)×104=1.622[uSec]となる。同様に、No.8の信号の水平同期信号幅Hwは1.673[uSec]、No.9の信号の水平同期信号幅Hwは0.778[uSec]、No.14の信号の水平同期信号幅Hwは1.697[uSec]となる。ここで、ドットクロックは、入力信号の水平同期信号の整数倍である。   For example, referring to FIG. 9, a signal having a vertical sync signal width of 3 lines is No. 2, no. 8, no. 9, no. 14 corresponds. No. The signal 2 has a dot clock Clock of 64.109 [MHz] and a horizontal synchronization signal width Hw of 104 [Pixel], so the horizontal synchronization signal width Hw is (1 / 64.109M) × 104 = 1. 622 [uSec]. Similarly, no. No. 8 has a horizontal synchronizing signal width Hw of 1.673 [uSec], no. No. 9 has a horizontal sync signal width Hw of 0.778 [uSec], no. The horizontal synchronization signal width Hw of the 14 signal is 1.697 [uSec]. Here, the dot clock is an integral multiple of the horizontal synchronizing signal of the input signal.

ステップ5における判定の結果、水平同期信号幅が1.697[uSec](ドットクロック80.136MHzのときの136ピクセルに相当する値)である場合、ステップ6にて、判定部400は、当該映像信号に設定するアスペクト比が15:9であると判定する。また、ステップ5における判定の結果、水平同期信号幅が1.673[uSec](ドットクロック85.5MHzのときの143ピクセルに相当する値)または0.778[uSec](ドットクロック72MHzのときの56ピクセルに相当する値)である場合、ステップ7にて、判定部400は、当該映像信号に設定するアスペクト比が16:9であると判定する。また、ステップ5における判定の結果、水平同期信号幅がドットクロック80.136MHzのときの136ピクセルに相当する値、ドットクロック85.5MHzのときの143ピクセルに相当する値、ドットクロック72MHzのときの56ピクセルに相当する値以外である場合、ステップ8にて、判定部400は、当該映像信号に設定するアスペクト比が4:3であると判定する。ここでは、所定の値以外である場合に設定するアスペクト比を4:3としたが、ステップ5で判定される信号グループにおいて最も一般的に用いられるアスペクト比に設定することが望ましい。   If the result of determination in step 5 is that the horizontal synchronization signal width is 1.697 [uSec] (a value corresponding to 136 pixels when the dot clock is 80.136 MHz), in step 6, the determination unit 400 determines that the video It is determined that the aspect ratio set for the signal is 15: 9. As a result of the determination in step 5, the horizontal synchronizing signal width is 1.673 [uSec] (a value corresponding to 143 pixels when the dot clock is 85.5 MHz) or 0.778 [uSec] (when the dot clock is 72 MHz). In step 7, the determination unit 400 determines that the aspect ratio set for the video signal is 16: 9. As a result of the determination in step 5, the value corresponding to 136 pixels when the horizontal synchronizing signal width is the dot clock 80.136 MHz, the value corresponding to 143 pixels when the dot clock is 85.5 MHz, and the value when the dot clock is 72 MHz. If the value is other than 56 pixels, in step 8, the determination unit 400 determines that the aspect ratio set for the video signal is 4: 3. Here, the aspect ratio set when the value is other than the predetermined value is 4: 3. However, it is desirable to set the aspect ratio that is most commonly used in the signal group determined in step 5.

また、ステップ1における判定の結果、垂直同期信号幅が6ラインである場合、ステップ9にて、判定部400は、検出部300の水平同期信号幅検出回路38が検出した水平同期信号幅に基づいて判定する。   If the result of determination in step 1 is that the vertical synchronization signal width is 6 lines, in step 9, the determination unit 400 is based on the horizontal synchronization signal width detected by the horizontal synchronization signal width detection circuit 38 of the detection unit 300. Judgment.

例えば、図9を参照すると、垂直同期信号幅が6Lineである信号は、No.4、No.5、No.10、No.11、No.15が該当する。No.4の信号は、ドットクロックClockが65[MHz]であり、水平同期信号幅Hwが136[Pixel]であるため、水平同期信号幅Hwは(1/65M)×136=2.092[uSec]となる。同様に、No.5の信号の水平同期信号幅Hwは1.310[uSec]、No.10の信号の水平同期信号幅Hwは0.489[uSec]、No.11の信号の水平同期信号幅Hwは1.579[uSec]、No.15の信号の水平同期信号幅Hwは1.383[uSec]となる。   For example, referring to FIG. 9, a signal having a vertical synchronization signal width of 6 Line is No. 4, no. 5, no. 10, no. 11, no. 15 corresponds. No. In the signal No. 4, since the dot clock Clock is 65 [MHz] and the horizontal synchronization signal width Hw is 136 [Pixel], the horizontal synchronization signal width Hw is (1 / 65M) × 136 = 2.92 [uSec]. It becomes. Similarly, no. The horizontal synchronizing signal width Hw of the signal No. 5 is 1.310 [uSec]. The horizontal synchronization signal width Hw of the signal No. 10 is 0.489 [uSec], The horizontal synchronizing signal width Hw of the signal No. 11 is 1.579 [uSec], The horizontal synchronization signal width Hw of the 15 signals is 1.383 [uSec].

ステップ9における判定の結果、水平同期信号幅が1.383[uSec](ドットクロック81MHzのときの112ピクセルに相当する値)である場合、ステップ10にて、判定部400は、当該映像信号に設定するアスペクト比が15:9であると判定する。   If the result of determination in step 9 is that the horizontal sync signal width is 1.383 [uSec] (a value corresponding to 112 pixels when the dot clock is 81 MHz), in step 10, the determination unit 400 adds the video signal to the video signal. It is determined that the aspect ratio to be set is 15: 9.

また、ステップ9における判定の結果、水平同期信号幅が1.310[uSec](ドットクロック85.5MHzのときの112ピクセルに相当する値)である場合、ステップ11にて、判定部400は、当該映像信号に設定するアスペクト比が16:9であると判定する。また、ステップ9における判定の結果、水平同期信号幅が2.092[uSec](ドットクロック65MHzのときの136ピクセルに相当する値)である場合、ステップ12にて、判定部400は、当該映像信号に設定するアスペクト比が4:3であると判定する。また、ステップ9における判定の結果、水平同期信号幅が1.383[uSec]、1.310[uSec]、2.092[uSec]以外である場合、ステップ13にて、判定部400は、当該映像信号に設定するアスペクト比が16:10であると判定する。ここでは、所定の値以外である場合に設定するアスペクト比を16:10としたが、ステップ9で判定される信号グループにおいて最も一般的に用いられるアスペクト比に設定することが望ましい。   If the result of determination in step 9 is that the horizontal synchronization signal width is 1.310 [uSec] (a value corresponding to 112 pixels when the dot clock is 85.5 MHz), the determination unit 400 in step 11 It is determined that the aspect ratio set for the video signal is 16: 9. If the result of determination in step 9 is that the horizontal synchronization signal width is 2.092 [uSec] (a value corresponding to 136 pixels when the dot clock is 65 MHz), in step 12, the determination unit 400 determines that the video It is determined that the aspect ratio set for the signal is 4: 3. If the result of determination in step 9 is that the horizontal sync signal width is other than 1.383 [uSec], 1.310 [uSec], 2.092 [uSec], the determination unit 400 It is determined that the aspect ratio set for the video signal is 16:10. Here, the aspect ratio set when the value is other than the predetermined value is 16:10. However, it is desirable to set the aspect ratio that is most commonly used in the signal group determined in step 9.

判定部400は、上述したように判定したアスペクト比をスケーラ回路5に設定する。   The determination unit 400 sets the aspect ratio determined as described above in the scaler circuit 5.

図9に示すように、図5に示した判定結果でNGとなっていた、No.4、5、8、9、14および15の信号について、より正確なアスペクト比を得ることができ、より正確な表示が可能となる。   As shown in FIG. 9, the determination result shown in FIG. For the signals 4, 5, 8, 9, 14, and 15, a more accurate aspect ratio can be obtained, and a more accurate display is possible.

このように、本実施形態では、水平同期信号幅を、アスペクト比を判定する条件に追加する。このとき、タイミング計測に用いられる、入力信号に依存せず常に一定である基準クロックを使用して、水平周波数・垂直周波数、水平同期幅等を計測する。なお、垂直同期信号幅は、走査線数(ライン)単位で計測するため、ドットクロックの周波数に依存せずに計測が可能である。   Thus, in the present embodiment, the horizontal synchronization signal width is added to the condition for determining the aspect ratio. At this time, the horizontal frequency, the vertical frequency, the horizontal synchronization width, and the like are measured using a reference clock that is always constant without depending on the input signal, which is used for timing measurement. Note that since the vertical synchronization signal width is measured in units of the number of scanning lines (lines), it can be measured without depending on the frequency of the dot clock.

例えば、垂直同期信号幅が3ラインである場合、水平同期信号幅を計測し、信号の判別を行い、その判定結果に従ってアスペクト比を設定する。図9に示したNo.8の信号の水平同期信号幅が1.673[uSec]であるのに対し、No.8の信号の水平同期信号幅は1.697[uSec]と、その差が小さい。これらの水平同期信号幅を正しく識別するためには、基準クロックとして両者の水平同期信号幅の差の逆数の2倍以上の周波数(1/(1.697−1.673)[uSec]×2=82MHz)が必要となる。そのため、この場合、基準クロックの周波数をたとえば100MHzとする。   For example, when the vertical sync signal width is 3 lines, the horizontal sync signal width is measured, the signal is discriminated, and the aspect ratio is set according to the judgment result. No. shown in FIG. No. 8 has a horizontal sync signal width of 1.673 [uSec]. The horizontal sync signal width of the signal No. 8 is 1.697 [uSec], which is a small difference. In order to correctly identify these horizontal sync signal widths, a frequency (1 / (1.697-1.673) [uSec] × 2 that is at least twice the reciprocal of the difference between the horizontal sync signal widths of the two as the reference clock. = 82 MHz) is required. Therefore, in this case, the frequency of the reference clock is set to 100 MHz, for example.

また、垂直同期信号幅が6ラインである場合も同様に、水平同期信号幅から合計5つの信号の判別が可能となる。   Similarly, when the vertical synchronizing signal width is 6 lines, a total of five signals can be discriminated from the horizontal synchronizing signal width.

(第2の実施形態)
基準クロックの周波数は、例えば、消費電力を抑えるためや、周辺機器の動作周波数の制限、コストダウンのため等の理由から、上記のような周波数(100MHz)に設定することができない場合が考えられる。このような場合は、例えば、基準クロックを50MHzとする。基準クロックを50MHzとすると、垂直同期信号幅が3ラインである場合、No.8の信号の水平同期信号幅とNo.14の信号の水平同期信号幅との差が小さく、識別が困難となるが、他の信号との識別は可能である。すなわち、各信号の水平同期信号幅は、No.2の信号は、1.622[uSec]、No.8の信号は、1.673[uSec]、No.9の信号は、0.778[uSec]、No.14の信号は、1.697[uSec]であるため、No.8の信号とNo.14の信号以外は、50MHzの基準クロックによる水平同期信号幅の検出によって識別可能である。
(Second Embodiment)
The frequency of the reference clock may not be set to the above frequency (100 MHz) for reasons such as reducing power consumption, limiting the operating frequency of peripheral devices, and reducing costs. . In such a case, for example, the reference clock is set to 50 MHz. If the reference clock is 50 MHz and the vertical synchronizing signal width is 3 lines, No. No. 8 horizontal sync signal width and No. 8 signal. The difference between the 14 signals and the horizontal sync signal width is small, making it difficult to distinguish, but distinguishing from other signals is possible. That is, the horizontal sync signal width of each signal is No. 2 signal is 1.622 [uSec], No. 2 signal. 8 signal is 1.673 [uSec], No. 8 signal. 9 is 0.778 [uSec], No. 9 signal. 14 signal is 1.697 [uSec], so no. No. 8 signal and no. The signals other than 14 can be identified by detecting the horizontal synchronizing signal width with a 50 MHz reference clock.

図10は、図6に示した検出部300の内部構成の一例を示す図である。第1の実施形態に対して、第2の実施形態における検出部300は、垂直バックポーチ検出部39をさらに備えている。   FIG. 10 is a diagram illustrating an example of an internal configuration of the detection unit 300 illustrated in FIG. In contrast to the first embodiment, the detection unit 300 in the second embodiment further includes a vertical back porch detection unit 39.

垂直バックポーチ検出回路39は、映像信号と同期信号から、垂直バックポーチの幅を検出する。なお、垂直バックポーチの幅は、水平のライン数として算出する。つまり、水平同期信号を用いてカウントする。また、垂直バックポーチ検出回路39は、検出した垂直バックポーチの幅を判定部400へ出力する。   The vertical back porch detection circuit 39 detects the width of the vertical back porch from the video signal and the synchronization signal. Note that the width of the vertical back porch is calculated as the number of horizontal lines. That is, it counts using a horizontal synchronizing signal. Further, the vertical back porch detection circuit 39 outputs the detected width of the vertical back porch to the determination unit 400.

本実施形態では、上述のように水平同期信号幅による検出が困難なNo.8の信号とNo.14の信号とを識別するために、垂直バックポーチの幅を判別材料として用いる。No.8のバックポーチの幅は24ライン、No.14のバックポーチの幅は23ラインであるため、両者を識別することが可能となる。このように、水平同期信号幅の検出と垂直バックポーチ幅の検出を併用することにより、水平同期信号幅の検出のみでは識別な困難な信号を正しく識別することができる。   In this embodiment, as described above, it is difficult to detect No. 1 which is difficult to detect based on the horizontal synchronizing signal width. No. 8 signal and no. In order to distinguish the 14 signals, the width of the vertical back porch is used as a discriminating material. No. The width of the back porch of No. 8 is 24 lines. Since the back porch 14 has a width of 23 lines, both can be identified. As described above, by using both the detection of the horizontal synchronization signal width and the detection of the vertical back porch width, it is possible to correctly identify a signal that is difficult to identify only by detecting the horizontal synchronization signal width.

また、垂直同期信号幅が6ラインである場合は、水平同期信号幅の差が最小となるその差は73[nSec]であるため、水平同期信号幅を用いて識別可能であるが、垂直バックポーチのライン数を用いても、各信号の識別が可能となる。垂直同期信号幅が6ラインである信号は、No.4、No.5、No.10、No.11、No.15の各信号であり、垂直バックポーチ幅は順に、29ライン、18ライン、13ライン、21ライン、25ラインであるため、垂直バックポーチ幅のみでこれらの信号を識別することができる。   Further, when the vertical sync signal width is 6 lines, the difference between which the horizontal sync signal width is minimized is 73 [nSec], so that it can be identified using the horizontal sync signal width. Even if the number of lines of the pouch is used, each signal can be identified. A signal whose vertical sync signal width is 6 lines is No. 4, no. 5, no. 10, no. 11, no. Since the vertical back porch width is 29 lines, 18 lines, 13 lines, 21 lines, and 25 lines in this order, these signals can be identified only by the vertical back porch width.

垂直バックポーチ幅検出回路は、たかだか5ビット幅があれば足り、簡便に構成することができる。また、カウント用クロックとして水平同期信号を使用するため、比較的低周波で駆動することができ、消費電力が少なくて済むという利点がある。   The vertical back porch width detection circuit need only be 5 bits wide and can be simply configured. In addition, since the horizontal synchronizing signal is used as the counting clock, there is an advantage that it can be driven at a relatively low frequency and power consumption can be reduced.

本実施の形態では、第1の実施形態と比較して基準クロックの周波数を低く設定することができるため、低消費電力化を図ることができる。また周辺機器として動作周波数の低い回路部品を採用することができるため、コストダウンを図ることができる。   In this embodiment, since the frequency of the reference clock can be set lower than that in the first embodiment, power consumption can be reduced. In addition, since circuit components having a low operating frequency can be employed as peripheral devices, cost reduction can be achieved.

このように、本発明によれば、VESAがDMT、CVT、GTFで規定したPCの出力映像信号のうち、映像ライン数が768ラインで垂直同期周波数が60Hz近傍の15種類の信号のアスペクト比を判定し、より正確なアスペクト比で表示をすることが可能となり、より正確な映像を表示することができる。   As described above, according to the present invention, the aspect ratios of 15 types of signals whose number of video lines is 768 lines and whose vertical synchronization frequency is around 60 Hz among the output video signals of the PC specified by VESA by DMT, CVT, and GTF. This makes it possible to display the image with a more accurate aspect ratio and to display a more accurate image.

以上、実施の形態を参照して本願発明を説明したが、本願発明は上記実施の形態に限定されるものではない。本願発明の構成や詳細には、本願発明のスコープ内で当業者が理解し得る様々な変更をすることができる。   Although the present invention has been described with reference to the embodiments, the present invention is not limited to the above embodiments. Various changes that can be understood by those skilled in the art can be made to the configuration and details of the present invention within the scope of the present invention.

Claims (9)

同期信号と映像信号とを含む入力信号を入力し、前記同期信号と前記映像信号とから、映像ライン数、垂直同期周波数、垂直同期信号幅および水平同期信号幅を検出する検出部と、
前記検出部にて検出された映像ライン数、垂直同期周波数、垂直同期信号幅および水平同期信号幅に基づいて、前記映像信号のアスペクト比を判定する判定部とを有する映像信号判定装置。
A detection unit that inputs an input signal including a synchronization signal and a video signal, and detects the number of video lines, a vertical synchronization frequency, a vertical synchronization signal width, and a horizontal synchronization signal width from the synchronization signal and the video signal;
And a determination unit that determines an aspect ratio of the video signal based on the number of video lines, the vertical synchronization frequency, the vertical synchronization signal width, and the horizontal synchronization signal width detected by the detection unit.
請求項1に記載の映像信号判定装置において、
前記検出部は、前記同期信号から、さらに垂直バックポーチの幅を検出し、
前記判定部は、前記検出部にて検出された映像ライン数、垂直同期周波数、垂直同期信号幅、水平同期信号幅および垂直バックポーチの幅に基づいて、前記映像信号のアスペクト比を判定することを特徴とする映像信号判定装置。
The video signal determination apparatus according to claim 1,
The detection unit further detects the width of the vertical back porch from the synchronization signal,
The determination unit determines an aspect ratio of the video signal based on the number of video lines detected by the detection unit, a vertical synchronization frequency, a vertical synchronization signal width, a horizontal synchronization signal width, and a vertical back porch width. A video signal determination apparatus characterized by the above.
請求項1または請求項2に記載の映像信号判定装置において、
前記判定部は、前記判定したアスペクト比を出力することを特徴とする映像信号判定装置。
In the video signal determination apparatus according to claim 1 or 2,
The determination unit outputs the determined aspect ratio.
同期信号と映像信号とを含む入力信号を入力し、前記同期信号と前記映像信号とから、映像ライン数、垂直同期周波数、垂直同期信号幅および水平同期信号幅を検出し、該検出した映像ライン数、垂直同期周波数、垂直同期信号幅および水平同期信号幅に基づいて、前記映像信号のアスペクト比を判定する制御部と、
前記映像信号を、前記制御部にて判定されたアスペクト比を用いて処理する映像処理部と、
前記映像処理部にて処理された映像信号に基づいて映像を表示する表示部とを有する映像表示装置。
An input signal including a synchronization signal and a video signal is input, and the number of video lines, a vertical synchronization frequency, a vertical synchronization signal width, and a horizontal synchronization signal width are detected from the synchronization signal and the video signal, and the detected video line A control unit for determining an aspect ratio of the video signal based on the number, the vertical synchronization frequency, the vertical synchronization signal width, and the horizontal synchronization signal width;
A video processing unit that processes the video signal using the aspect ratio determined by the control unit;
And a display unit that displays an image based on the image signal processed by the image processing unit.
請求項4に記載の映像表示装置において、
前記制御部は、前記同期信号と前記映像信号とから、さらに、垂直バックポーチの幅を検出し、前記検出した映像ライン数、垂直同期周波数、垂直同期信号幅、水平同期信号幅および垂直バックポーチの幅に基づいて、前記映像信号のアスペクト比を判定することを特徴とする映像表示装置。
The video display device according to claim 4,
The control unit further detects a width of a vertical back porch from the synchronization signal and the video signal, and detects the number of video lines, a vertical synchronization frequency, a vertical synchronization signal width, a horizontal synchronization signal width, and a vertical back porch. A video display device that determines an aspect ratio of the video signal based on the width of the video signal.
同期信号と映像信号とを含む入力信号を入力し、前記同期信号と前記映像信号とから、映像ライン数、垂直同期周波数、垂直同期信号幅および水平同期信号幅を検出するステップと、
前記検出された映像ライン数、垂直同期周波数、垂直同期信号幅および水平同期信号幅に基づいて、前記映像信号のアスペクト比を判定するステップとを行う映像信号判定方法。
Inputting an input signal including a synchronization signal and a video signal, and detecting a number of video lines, a vertical synchronization frequency, a vertical synchronization signal width and a horizontal synchronization signal width from the synchronization signal and the video signal;
And a step of determining an aspect ratio of the video signal based on the detected number of video lines, vertical synchronization frequency, vertical synchronization signal width and horizontal synchronization signal width.
請求項6に記載の映像信号判定方法において、
前記同期信号と前記映像信号とから、垂直バックポーチの幅を検出するステップと、
前記検出された映像ライン数、垂直同期周波数、垂直同期信号幅、水平同期信号幅および垂直バックポーチの幅に基づいて、前記映像信号のアスペクト比を判定するステップとを行うことを特徴とする映像信号判定方法。
The video signal determination method according to claim 6,
Detecting a width of a vertical back porch from the synchronization signal and the video signal;
Determining the aspect ratio of the video signal based on the detected number of video lines, vertical synchronization frequency, vertical synchronization signal width, horizontal synchronization signal width, and vertical back porch width. Signal judgment method.
同期信号と映像信号とを含む入力信号を入力し、前記同期信号と前記映像信号とから、映像ライン数、垂直同期周波数、垂直同期信号幅および水平同期信号幅を検出するステップと、
前記検出された映像ライン数、垂直同期周波数、垂直同期信号幅および水平同期信号幅に基づいて、前記映像信号のアスペクト比を判定するステップと、
前記映像信号を、前記判定されたアスペクト比を用いて処理するステップと、
前記処理された映像信号に基づいて映像を表示するステップとを行う映像表示方法。
Inputting an input signal including a synchronization signal and a video signal, and detecting a number of video lines, a vertical synchronization frequency, a vertical synchronization signal width and a horizontal synchronization signal width from the synchronization signal and the video signal;
Determining an aspect ratio of the video signal based on the detected number of video lines, vertical synchronization frequency, vertical synchronization signal width and horizontal synchronization signal width;
Processing the video signal using the determined aspect ratio;
And a step of displaying a video based on the processed video signal.
請求項8に記載の映像表示方法において、
前記同期信号と前記映像信号とから、垂直バックポーチの幅を検出するステップと、
前記検出された映像ライン数、垂直同期周波数、垂直同期信号幅、水平同期信号幅および垂直バックポーチの幅に基づいて、前記映像信号のアスペクト比を判定するステップとを行うことを特徴とする映像表示方法。
The video display method according to claim 8,
Detecting a width of a vertical back porch from the synchronization signal and the video signal;
Determining the aspect ratio of the video signal based on the detected number of video lines, vertical synchronization frequency, vertical synchronization signal width, horizontal synchronization signal width, and vertical back porch width. Display method.
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