JP6056249B2 - Photodetector, imaging device using the same, and method of manufacturing photodetector - Google Patents

Photodetector, imaging device using the same, and method of manufacturing photodetector Download PDF

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本発明は、光検出器とこれを用いた撮像装置、及び光検出器の製造方法に関する。   The present invention relates to a photodetector, an imaging device using the same, and a method for manufacturing the photodetector.

量子井戸型赤外線検出器(QWIP:Quantum Well Infrared Photo-detector)は、入射光を吸収した場合に流れる電流を捕えることによって光を検知するタイプの光検知器である。近年、QWIPを用いた撮像素子(FPA:Focal Plane Array)の高画質化の要求が高まっている。高画素化に伴い画素面積が小さくなるため、検出器の感度の向上が求められている。   A quantum well infrared detector (QWIP) is a type of photodetector that detects light by capturing a current that flows when incident light is absorbed. In recent years, there has been an increasing demand for higher image quality of imaging elements (FPA: Focal Plane Array) using QWIP. Since the pixel area is reduced as the number of pixels is increased, improvement in sensitivity of the detector is required.

図1に示すように、GaAs/AlGaAs系のQWIPでは、キャリアのエネルギーに対してAlGaAsがポテンシャル障壁として作用する。GaAsはポテンシャル井戸として作用し、GaAs量子井戸の内部に離散的に量子準位が形成される。この量子準位間のエネルギー差が検出可能な光の波長に相当することになる。光が入射されるとキャリアが励起され、信号電流として検出される。   As shown in FIG. 1, in GaAs / AlGaAs-based QWIP, AlGaAs acts as a potential barrier against carrier energy. GaAs acts as a potential well, and quantum levels are discretely formed inside the GaAs quantum well. This energy difference between the quantum levels corresponds to a detectable wavelength of light. When light is incident, carriers are excited and detected as a signal current.

図2は、従来のQWIP100の断面図である。QWIP100の量子井戸構造としては水平積層が一般的であり、障壁層103と量子井戸層102が基板106の表面と水平に形成されている(たとえば、特許文献1参照)。基板106上に、バッファ層108を介して、下部電極層107aが形成され、下部電極層107a上に、障壁層102と、量子井戸層103が交互に積層されて多重量子井戸105が形成される。多重量子井戸105上には、上部電極層107bが形成され、その最表面に入射赤外線を乱反射させる光結合構造104が形成されている。上部電極層107bと下部電極層107a上には電圧印加用の電極109が形成されている。   FIG. 2 is a cross-sectional view of a conventional QWIP 100. As shown in FIG. As the quantum well structure of the QWIP 100, a horizontal stack is generally used, and the barrier layer 103 and the quantum well layer 102 are formed horizontally with the surface of the substrate 106 (see, for example, Patent Document 1). A lower electrode layer 107a is formed on the substrate 106 via a buffer layer 108, and a barrier layer 102 and a quantum well layer 103 are alternately stacked on the lower electrode layer 107a to form a multiple quantum well 105. . On the multiple quantum well 105, an upper electrode layer 107b is formed, and an optical coupling structure 104 for irregularly reflecting incident infrared rays is formed on the outermost surface thereof. A voltage applying electrode 109 is formed on the upper electrode layer 107b and the lower electrode layer 107a.

赤外線は、基板に垂直に入射する。従来の赤外線検出器では、入射した赤外線は量子井戸と水平方向のみ電界成分を持つため、多重量子井戸105にて赤外線の吸収は起こらない。入射赤外線は、基板106、下部の電極層107a、多重量子井戸105、上部電極層107bを通過し、最表面の光結合構造104で乱反射される。乱反射された赤外線には量子井戸と垂直方向の電界成分が生じ、反射された赤外線が多重量子井戸105に再入射することにより、量子井戸層103で赤外線の吸収が起こる。量子井戸内のキャリアは励起され光電流として電極107a、107b間を流れる。この光電流を検出することによって赤外線を検出することができる。   Infrared rays are incident perpendicular to the substrate. In the conventional infrared detector, the incident infrared ray has an electric field component only in the horizontal direction with respect to the quantum well, so that no infrared absorption occurs in the multiple quantum well 105. Incident infrared light passes through the substrate 106, the lower electrode layer 107a, the multiple quantum well 105, and the upper electrode layer 107b, and is irregularly reflected by the outermost optical coupling structure 104. The irregularly reflected infrared rays generate an electric field component in a direction perpendicular to the quantum well, and the reflected infrared rays are incident again on the multiple quantum well 105, so that the quantum well layer 103 absorbs the infrared rays. Carriers in the quantum well are excited and flow between the electrodes 107a and 107b as photocurrent. Infrared light can be detected by detecting this photocurrent.

従来の赤外線検出器では、赤外線は受光層である多重量子井戸105へ入射するまでに電極層107a、107bを通過する。不純物がドーピングされた電極層107a、107bでは、自由キャリア吸収により赤外線の一部が吸収される(たとえば、非特許文献1参照)。その結果、多重量子井戸105に入射する赤外線強度が減少し、流れる光電流が低減する。   In the conventional infrared detector, infrared rays pass through the electrode layers 107a and 107b before entering the multiple quantum well 105, which is a light receiving layer. In the electrode layers 107a and 107b doped with impurities, part of infrared rays is absorbed by free carrier absorption (see, for example, Non-Patent Document 1). As a result, the intensity of infrared rays incident on the multiple quantum well 105 is reduced, and the flowing photocurrent is reduced.

特開2008−198849号公報JP 2008-198849 A

Physical Review, Volume 114, Number 1, pp.59-63 (1959)Physical Review, Volume 114, Number 1, pp.59-63 (1959)

本発明は、多重量子井戸へ入射する赤外線強度の低下を防止し、入射赤外線に対して流れる光電流量を従来よりも増加させて、光検出器の感度を向上することを課題とする。   It is an object of the present invention to improve the sensitivity of a photodetector by preventing a reduction in the intensity of infrared rays incident on a multiple quantum well and increasing the photoelectric flow rate flowing with respect to the incident infrared rays as compared with the prior art.

本発明の1観点によると、光検出器は、
不純物がドープされていない基板と、
前記基板に対して垂直に延びる量子井戸層と障壁層を含む量子井戸構造と、
前記基板に対して水平な方向から前記量子井戸構造を挟み込む一対の電極層と、
を有する。
According to one aspect of the invention, the photodetector is
A substrate not doped with impurities;
A quantum well structure including a quantum well layer and a barrier layer extending perpendicular to the substrate;
A pair of electrode layers sandwiching the quantum well structure from a direction horizontal to the substrate;
Have

多重量子井戸に入射する赤外線の強度低下を防止して光電流を増加させ、光検出器の感度を向上することができる。   It is possible to increase the photocurrent by preventing the intensity of infrared rays incident on the multiple quantum well from being lowered, and to improve the sensitivity of the photodetector.

量子井戸でのキャリアの励起と光電流の発生を示す模式図である。It is a schematic diagram which shows the excitation of the carrier in a quantum well, and generation | occurrence | production of a photocurrent. 従来の水平積層型の多重量子井戸構造を示す図である。It is a figure which shows the conventional horizontal lamination type multiple quantum well structure. 実施例1の光検出器の概略構成図である。1 is a schematic configuration diagram of a photodetector of Example 1. FIG. 実施例1の光検出器の製造工程図である。6 is a manufacturing process diagram of the photodetector of Example 1. FIG. 図4の工程に引き続く光検出器の製造工程図である。FIG. 5 is a manufacturing process diagram of the photodetector subsequent to the process of FIG. 4. 図5の工程に引き続く光検出器の製造工程図である。FIG. 6 is a manufacturing process diagram of the photodetector subsequent to the process of FIG. 5. 実施例2の光検出器の概略構成図である。FIG. 6 is a schematic configuration diagram of a photodetector of Example 2. 実施例2の光検出器の製造工程図である。FIG. 10 is a manufacturing process diagram of the photodetector of Example 2. 図8の工程に引き続く光検出器の製造工程図である。FIG. 9 is a manufacturing process diagram of the photodetector subsequent to the process of FIG. 8. 図9の工程に引き続く光検出器の製造工程図である。FIG. 10 is a manufacturing process diagram of the photodetector subsequent to the process of FIG. 9. 図10の工程に引き続く光検出器の製造工程図である。FIG. 11 is a manufacturing process diagram of the photodetector subsequent to the process of FIG. 10. 実施例3の撮像装置の概略構成図である。FIG. 6 is a schematic configuration diagram of an imaging apparatus according to a third embodiment. 図12の撮像装置の製造工程図である。FIG. 13 is a manufacturing process diagram of the imaging apparatus of FIG. 12. 図13の工程に引き続く撮像装置の製造工程図である。FIG. 14 is a manufacturing process diagram for an imaging device following the process in FIG. 13; 図14の工程に引き続く撮像装置の製造工程図である。FIG. 15 is a manufacturing process diagram for the imaging device, following the step in FIG. 14. 図15の工程に引き続く撮像装置の製造工程図である。FIG. 16 is a manufacturing process diagram for the imaging apparatus following the process in FIG. 15; 図16の工程に引き続く撮像装置の製造工程図である。FIG. 17 is a manufacturing process diagram for the imaging apparatus following the process in FIG. 16;

以下で、図面を参照して発明の実施形態を説明する。実施形態の光検出器とこれを用いた撮像装置は、量子井戸層と障壁層を基板の表面に対して垂直に配置した垂直型の多重量子井戸構造を採用する。電極層は、垂直配置の多重量子井戸を横方向、すなわち基板と水平な方向から挟み込む。この構成により、光検出器への入射光は不純物がドープされた電極層を通過することなく、多重量子井戸に入射することができる。また、多重量子井戸への入射時にすでに多重量子井戸と垂直な方向への電界成分を有するため、光結合構造が不要となる。   Hereinafter, embodiments of the invention will be described with reference to the drawings. The photodetector of the embodiment and the imaging device using the same employ a vertical multiple quantum well structure in which a quantum well layer and a barrier layer are arranged perpendicular to the surface of the substrate. The electrode layer sandwiches the vertically arranged multiple quantum wells from the lateral direction, that is, from the horizontal direction to the substrate. With this configuration, light incident on the photodetector can be incident on the multiple quantum well without passing through the electrode layer doped with impurities. In addition, since it already has an electric field component in a direction perpendicular to the multiple quantum well when incident on the multiple quantum well, an optical coupling structure becomes unnecessary.

図3は、実施例1の光検出器10の概略断面図である。光検出器10は特定波長の赤外光線に対して吸収ピークを有する赤外線検出器10である。   FIG. 3 is a schematic cross-sectional view of the photodetector 10 according to the first embodiment. The photodetector 10 is an infrared detector 10 having an absorption peak with respect to infrared light having a specific wavelength.

半導体基板16上にバッファ層18を介して、下部障壁層22が形成され、下部障壁層22上に、多重量子井戸15が配置されている。多重量子井戸15では、障壁層12と量子井戸層13が基板16と垂直な方向に形成されている。光電流を取り出すための電極層17a、17bは、多重量子井戸15を横方向(基板16と水平な方向)から挟み込んでいる。電極層17a、17b上にオーミック電極14a、14bがそれぞれ形成されている。多重量子井戸15上に、上部障壁層23が形成され、上部障壁層23の最表面に反射体25が形成されている。実施例1では、反射体25は、たとえば高反射率の金属反射膜25である。   A lower barrier layer 22 is formed on the semiconductor substrate 16 via a buffer layer 18, and the multiple quantum well 15 is disposed on the lower barrier layer 22. In the multiple quantum well 15, the barrier layer 12 and the quantum well layer 13 are formed in a direction perpendicular to the substrate 16. The electrode layers 17a and 17b for taking out the photocurrent sandwich the multiple quantum well 15 from the lateral direction (direction parallel to the substrate 16). Ohmic electrodes 14a and 14b are formed on the electrode layers 17a and 17b, respectively. An upper barrier layer 23 is formed on the multiple quantum well 15, and a reflector 25 is formed on the outermost surface of the upper barrier layer 23. In Example 1, the reflector 25 is, for example, a metal reflective film 25 having a high reflectance.

赤外線は、基板16に垂直に入射する。図3の構成では、障壁層12と量子井戸層13の周期的なパターンは基板16と水平な方向に繰り返されるため、入射した赤外線は多重量子井戸15と垂直方向に電界成分を有する。電極層17aと17bの間に電圧が印加された状態で赤外線検出器10に赤外線が入射すると、多重量子井戸15で赤外線の吸収が起こり、励起されたキャリアが走行して光電流が流れる。   Infrared rays are perpendicularly incident on the substrate 16. In the configuration of FIG. 3, since the periodic pattern of the barrier layer 12 and the quantum well layer 13 is repeated in the direction horizontal to the substrate 16, the incident infrared ray has an electric field component in the direction perpendicular to the multiple quantum well 15. When an infrared ray is incident on the infrared detector 10 with a voltage applied between the electrode layers 17a and 17b, the infrared absorption occurs in the multiple quantum well 15, and the excited carriers travel and a photocurrent flows.

赤外線検出器10に流れる光電流Ipは、式(1)で表わされる。   The photocurrent Ip flowing through the infrared detector 10 is expressed by the formula (1).

Figure 0006056249
ここで、eは素電荷、Φsは入射する赤外線強度、ηは量子効率、gはゲインである。式(1)からわかるように、光電流は入射する赤外線の強度と比例関係にある。
Figure 0006056249
Here, e is an elementary charge, Φs is an incident infrared ray intensity, η is a quantum efficiency, and g is a gain. As can be seen from equation (1), the photocurrent is proportional to the intensity of the incident infrared ray.

図3の構成では、赤外線が多重量子井戸15に入射するまでの経路に、不純物をドープした電極層17a、17bが位置しないため、自由キャリア吸収による赤外線の吸収を防止することができる。多重量子井戸15へ入射する赤外線の強度が、従来の水平型多重量子井戸と比較して高くなり、光電流が増加する。したがって、赤外線検出器10の感度が向上する。   In the configuration of FIG. 3, the electrode layers 17 a and 17 b doped with impurities are not located in the path until the infrared rays are incident on the multiple quantum well 15, so that absorption of infrared rays due to free carrier absorption can be prevented. The intensity of infrared light incident on the multiple quantum well 15 is higher than that of the conventional horizontal multiple quantum well, and the photocurrent is increased. Therefore, the sensitivity of the infrared detector 10 is improved.

さらに、上部障壁層23上に形成した反射膜25で赤外線が反射されるので、多重量子井戸(光吸収層)15を通過する赤外線の光路長が長くなり、さらに感度が向上する。   Further, since the infrared rays are reflected by the reflection film 25 formed on the upper barrier layer 23, the optical path length of the infrared rays passing through the multiple quantum well (light absorption layer) 15 is increased, and the sensitivity is further improved.

図3の構成は、入射赤外線が電極層を介さずに直接多重量子井戸15に入射する、光結合構造を用いなくても赤外線を検出できる、反射膜25により多重量子井戸15での赤外線の光路長を増大できる、という効果を有する。   The configuration of FIG. 3 is such that incident infrared light is directly incident on the multiple quantum well 15 without passing through an electrode layer, and infrared light can be detected without using an optical coupling structure. The effect is that the length can be increased.

図4〜図6は、図3の赤外線検出器10の製造工程図である。実施例では、赤外線検出器10を、たとえば分子線エピタキシー(MBE:Molecular Beam Epitaxy)を用いて作製する。   4 to 6 are manufacturing process diagrams of the infrared detector 10 of FIG. In the embodiment, the infrared detector 10 is manufactured by using, for example, molecular beam epitaxy (MBE).

図4(a)で、半導体基板16上にバッファ層18を形成する。半導体基板16は、例えばGaAsの微傾斜基板である。基板16の表面は、例えば(100)面から[0−11]方向に0.5°程度傾斜している。このため、半導体基板16の表面には、テラス幅「w」が約32nmの微細なステップが存在する。バッファ層18は、例えば真性GaAsで形成され、その厚さは100nm程度である。バッファ層18の表面には、基板16のステップを反映するステップが存在する。   In FIG. 4A, the buffer layer 18 is formed on the semiconductor substrate 16. The semiconductor substrate 16 is a GaAs slightly inclined substrate, for example. The surface of the substrate 16 is inclined about 0.5 ° in the [0-11] direction, for example, from the (100) plane. Therefore, a fine step having a terrace width “w” of about 32 nm exists on the surface of the semiconductor substrate 16. The buffer layer 18 is made of, for example, intrinsic GaAs and has a thickness of about 100 nm. On the surface of the buffer layer 18, there is a step reflecting the step of the substrate 16.

図4(b)で、GaAsバッファ層18上に、例えば真性Al0.14Ga0.86Asの下部障壁層22を50nm形成する。下部障壁層22の表面には、基板16のステップを反映するステップが存在する。 In FIG. 4B, a lower barrier layer 22 of, eg, intrinsic Al 0.14 Ga 0.86 As is formed to 50 nm on the GaAs buffer layer 18. On the surface of the lower barrier layer 22, there are steps that reflect the steps of the substrate 16.

次に、多重量子井戸15を基板16と垂直に形成する。垂直型の多重量子井戸15は、ステップフロー成長モードを利用し、分数層超格子構造を繰り返し作製することにより形成される。具体例として、図4(c)で、真正GaAs量子井戸層13がステップの端部から5nmの幅「w1」に相当する分だけ成長するように、GaとAsを供給する。ウェハの表面は、GaAs基板16のステップを反映するステップが存在するため、供給された原料は、ウェハ表面を十分に拡散し、ステップエッジに取り込まれる。このため、GaAs量子井戸層13が各ステップの側面に沿って形成される。GaAsの成長速度は、たとえば0.3μm/h、成膜温度は600℃である。   Next, the multiple quantum well 15 is formed perpendicular to the substrate 16. The vertical multiple quantum well 15 is formed by repeatedly producing a fractional layer superlattice structure using a step flow growth mode. As a specific example, in FIG. 4C, Ga and As are supplied so that the intrinsic GaAs quantum well layer 13 grows from the end of the step by an amount corresponding to the width “w1” of 5 nm. Since the surface of the wafer has a step reflecting the step of the GaAs substrate 16, the supplied raw material sufficiently diffuses the wafer surface and is taken into the step edge. For this reason, the GaAs quantum well layer 13 is formed along the side surface of each step. The growth rate of GaAs is, for example, 0.3 μm / h, and the film formation temperature is 600 ° C.

次いで、図5(a)で、真正AlGaAs障壁層12を形成する。例えば真正Al0.14Ga0.86As層12が、GaAs量子井戸層13の端部から27nmの幅「w2」に相当する分だけ成長するように、原料を供給する。量子井戸層13と同様に、供給された材料は、ウェハ表面を十分に拡散し、ステップエッジに取り込まれる。このため、Al0.14Ga0.86Asの障壁層12が量子井戸層13の側面に沿って形成される。 Next, in FIG. 5A, an intrinsic AlGaAs barrier layer 12 is formed. For example, the raw material is supplied so that the genuine Al 0.14 Ga 0.86 As layer 12 is grown from the end of the GaAs quantum well layer 13 by an amount corresponding to the width “w2” of 27 nm. Similar to the quantum well layer 13, the supplied material sufficiently diffuses the wafer surface and is taken into the step edge. Therefore, a barrier layer 12 of Al 0.14 Ga 0.86 As is formed along the side surface of the quantum well layer 13.

図5(b)で、ステップフロー成長モードを利用して、多重量子井戸15の厚さが2000nmになるまで、GaAsとAlGaAsの分数層超格子を繰り返し形成する。量子井戸層13と障壁層12からなる分数層超格子の1周期が、GaAs基板16の表面に存在するステップ幅「w」と同じになっており、多重量子井戸15はGaAs基板16の表面に対して、垂直に形成される。   In FIG. 5B, using the step flow growth mode, fractional layer superlattices of GaAs and AlGaAs are repeatedly formed until the thickness of the multiple quantum well 15 reaches 2000 nm. One period of the fractional layer superlattice composed of the quantum well layer 13 and the barrier layer 12 is the same as the step width “w” existing on the surface of the GaAs substrate 16, and the multiple quantum well 15 is formed on the surface of the GaAs substrate 16. On the other hand, it is formed vertically.

次に、図5(c)で、例えば真性Al0.14Ga0.86Asの上部障壁層23を50nm形成する。上部障壁層23上に高反射率の反射膜25をたとえばAuで形成する。反射膜25上に、所定の形状の開口を有するレジストマスク27を形成する。 Next, in FIG. 5C, for example, an upper barrier layer 23 of intrinsic Al 0.14 Ga 0.86 As is formed to 50 nm. A reflective film 25 having a high reflectance is formed on the upper barrier layer 23 by using, for example, Au. A resist mask 27 having an opening with a predetermined shape is formed on the reflective film 25.

図6(a)で、レジストマスク27(図5(c)参照)を用いて、反射膜25とAlGaAs障壁層23の一部をエッチングする。エッチング後、イオン注入法により、開口内に例えばSiを注入し、電子濃度が1×1018cm−3のn型電極層17a、17bを基板16と垂直な方向に形成する。その後、レジストマスク27を除去する。 In FIG. 6A, the reflective film 25 and a part of the AlGaAs barrier layer 23 are etched using the resist mask 27 (see FIG. 5C). After etching, for example, Si is implanted into the opening by ion implantation to form n-type electrode layers 17a and 17b having an electron concentration of 1 × 10 18 cm −3 in a direction perpendicular to the substrate 16. Thereafter, the resist mask 27 is removed.

次に、図6(b)で、n型電極層17a、17bの上に、例えばAuGe/Ni/Auからなるオーミック電極14a、14bを形成する。これにより、赤外線検出器10を得ることができる。   Next, in FIG. 6B, ohmic electrodes 14a and 14b made of, for example, AuGe / Ni / Au are formed on the n-type electrode layers 17a and 17b. Thereby, the infrared detector 10 can be obtained.

図3の構成および図4〜図6の製造方法によれば、感応ピーク波長が約14μmの赤外線検出器10として効果が期待できる。図2の従来の赤外線検出器100において、散乱された赤外線が多重量子井戸(受光層)105へ再入射する時点での赤外線強度Φは、式(2)で見積もることができる。   According to the configuration of FIG. 3 and the manufacturing method of FIGS. 4 to 6, an effect can be expected as the infrared detector 10 having a sensitive peak wavelength of about 14 μm. In the conventional infrared detector 100 of FIG. 2, the infrared intensity Φ at the time when the scattered infrared light re-enters the multiple quantum well (light receiving layer) 105 can be estimated by Expression (2).

Figure 0006056249
ここで、Φは検出器に入射する赤外線強度、αは電極層における赤外線の吸収係数、Lは赤外線が電極層を透過する距離である。従来の赤外線検出器100で、電極層107a、107bのキャリア濃度はn=2×1018cm−3、αは550cm−1、赤外線が透過する電極層107a、107bの厚さは約2μmとすると、散乱された赤外線が多重量子井戸(受光層)105へ入射する時点での赤外線強度Φと、検出器100に入射する赤外線強度Φの比は、
Figure 0006056249
Here, Φ 0 is the intensity of infrared rays incident on the detector, α is the absorption coefficient of infrared rays in the electrode layer, and L is the distance that infrared rays pass through the electrode layer. In the conventional infrared detector 100, the carrier concentration of the electrode layers 107a and 107b is n = 2 × 10 18 cm −3 , α is 550 cm −1 , and the thickness of the electrode layers 107a and 107b that transmits infrared rays is about 2 μm. The ratio of the infrared intensity Φ when the scattered infrared light enters the multiple quantum well (light receiving layer) 105 and the infrared intensity Φ 0 incident on the detector 100 is

Figure 0006056249
となる。
Figure 0006056249
It becomes.

これに対し、実施例1の赤外線検出器10では、入射する赤外線の強度は電極層17a、17bでの自由キャリア吸収の影響を受けないので、多重量子井戸15に入射する赤外線強度は、従来構成に比べて約10%増加する。光電流も10%増加する。   On the other hand, in the infrared detector 10 of the first embodiment, the intensity of incident infrared rays is not affected by free carrier absorption in the electrode layers 17a and 17b, so that the infrared intensity incident on the multiple quantum well 15 is the conventional configuration. About 10%. The photocurrent is also increased by 10%.

本発明は、上述した実施例に限定されない。下部障壁層22と上部障壁層23のAl組成はAlGa1−xAs(0<x≦1)の範囲で適宜選択することができる。また、量子井戸層13の形成時に、Siを同時に供給してn型GaAs量子井戸層13としてもよい。また、半導体基板16としてInP基板を用い、量子井戸層13をInGa1−xAs(0<x<1)、障壁層12をInPとしてもかまわない。各層の成膜は、分子線エピタキシーに代えて、有機金属気相成長法(MOCVD:Metal-Organic Chemical Vapor Deposition)を用いてもよい。 The present invention is not limited to the embodiments described above. The Al composition of the lower barrier layer 22 and the upper barrier layer 23 can be appropriately selected within the range of Al x Ga 1-x As (0 <x ≦ 1). Further, when the quantum well layer 13 is formed, Si may be simultaneously supplied to form the n-type GaAs quantum well layer 13. Further, an InP substrate may be used as the semiconductor substrate 16, the quantum well layer 13 may be In x Ga 1-x As (0 <x <1), and the barrier layer 12 may be InP. For the formation of each layer, metal-organic chemical vapor deposition (MOCVD) may be used instead of molecular beam epitaxy.

分数層超格子の1周期の幅(w1+w2)は、基板16のステップ幅「w」の1/n倍であってもかまわない(n=1,2,・・・)。半導体基板16の傾斜の程度は0.5°に限定されない。また、(100)面を基準としたときに[0−1−1]方向に傾斜した半導体基板であってもよい。(100)面から[110]方向に傾斜した基板であってもよい。かまわない。キャリアが電子である必要はなく、正孔をキャリアとして用いてもよい。この場合、量子井戸層13に注入する不純物としてBe等を用いることができる。   The width (w1 + w2) of one period of the fractional layer superlattice may be 1 / n times the step width “w” of the substrate 16 (n = 1, 2,...). The degree of inclination of the semiconductor substrate 16 is not limited to 0.5 °. Further, it may be a semiconductor substrate inclined in the [0-1-1] direction when the (100) plane is used as a reference. The substrate may be inclined in the [110] direction from the (100) plane. It doesn't matter. The carriers do not have to be electrons, and holes may be used as carriers. In this case, Be or the like can be used as an impurity to be injected into the quantum well layer 13.

図7は、実施例2の赤外線検出器30の概略断面図である。実施例2では、反射体として、上部障壁層23上に分布型ブラッグ反射器(DBR)39を配置する。実施例2においても、多重量子井戸35を構成する量子井戸層33と障壁層32は、基板に16対して垂直な方向に形成される。   FIG. 7 is a schematic cross-sectional view of the infrared detector 30 according to the second embodiment. In the second embodiment, a distributed Bragg reflector (DBR) 39 is disposed on the upper barrier layer 23 as a reflector. Also in the second embodiment, the quantum well layer 33 and the barrier layer 32 constituting the multiple quantum well 35 are formed in a direction perpendicular to the substrate 16.

赤外線検出器30は、半導体基板16上にバッファ層18を介して、下部障壁層22が形成され、下部障壁層22上に多重量子井戸35が配置されている。多重量子井戸35では、障壁層32と量子井戸層33が基板16と垂直な方向に形成されている。光電流を取り出すための電極層17a、17bが、多重量子井戸35を横方向(基板16と水平な方向)から挟んでいる。電極層17a、17b上にオーミック電極14a、14bがそれぞれ形成されている。多重量子井戸35上に、上部障壁層23が形成され、上部障壁層23上に、分布型ブラッグ反射器39が形成されている。   In the infrared detector 30, the lower barrier layer 22 is formed on the semiconductor substrate 16 via the buffer layer 18, and the multiple quantum well 35 is disposed on the lower barrier layer 22. In the multiple quantum well 35, the barrier layer 32 and the quantum well layer 33 are formed in a direction perpendicular to the substrate 16. Electrode layers 17a and 17b for taking out photocurrent sandwich the multiple quantum well 35 from the lateral direction (a direction parallel to the substrate 16). Ohmic electrodes 14a and 14b are formed on the electrode layers 17a and 17b, respectively. An upper barrier layer 23 is formed on the multiple quantum well 35, and a distributed Bragg reflector 39 is formed on the upper barrier layer 23.

赤外線は、基板16に垂直に入射する。図7の構成では、障壁層32と量子井戸層33の挟み込みパターンは基板16と水平な方向に繰り返され、入射する赤外線は量子井戸35と垂直方向に電界成分を有する。電極層17a、17bの間に電圧が印加された状態で赤外線検出器30に赤外線が入射すると、光結合構造がなくても多重量子井戸35にて赤外線の吸収が起こり、励起されたキャリアが走行して光電流が流れる。   Infrared rays are perpendicularly incident on the substrate 16. In the configuration of FIG. 7, the sandwiching pattern of the barrier layer 32 and the quantum well layer 33 is repeated in a direction horizontal to the substrate 16, and incident infrared rays have an electric field component in a direction perpendicular to the quantum well 35. When an infrared ray is incident on the infrared detector 30 with a voltage applied between the electrode layers 17a and 17b, infrared absorption occurs in the multiple quantum well 35 without the optical coupling structure, and the excited carriers travel. As a result, photocurrent flows.

多重量子井戸35を透過した赤外線は、分布型ブラッグ反射器39により高い反射率で反射され、多重量子井戸35へ再入射する。再入射した赤外線は多重量子井戸35と垂直方向に電界成分を持ち、多重量子井戸35にてさらなる赤外線の吸収が起こる。   Infrared light that has passed through the multiple quantum well 35 is reflected by the distributed Bragg reflector 39 with high reflectivity, and reenters the multiple quantum well 35. The re-incident infrared light has an electric field component perpendicular to the multiple quantum well 35, and further infrared absorption occurs in the multiple quantum well 35.

従来の赤外線検出器100の多重量子井戸(受光層)105での感応ピーク波長の吸収係数αが1000cm−1程度であるので、分布型ブラッグ反射器39を用いることにより多重量子井戸15の厚さを約1/2にすることができる。また、赤外線が多重量子井戸35に入射するまでの経路に電極層17a、17bがないため、電極層17a、17bで自由キャリア吸収による赤外線吸収が生じない。多重量子井戸35へ入射する赤外線強度が従来の構成と比べて増加し、光電流が増大する。その結果、赤外線検出器30の感度が向上する。 Since the absorption coefficient α of the sensitive peak wavelength in the multiple quantum well (light receiving layer) 105 of the conventional infrared detector 100 is about 1000 cm −1 , the thickness of the multiple quantum well 15 is obtained by using the distributed Bragg reflector 39. Can be halved. Further, since there is no electrode layer 17a, 17b in the path until the infrared ray enters the multiple quantum well 35, infrared absorption due to free carrier absorption does not occur in the electrode layer 17a, 17b. The infrared intensity incident on the multiple quantum well 35 increases as compared with the conventional configuration, and the photocurrent increases. As a result, the sensitivity of the infrared detector 30 is improved.

図8〜図12は、実施例2の赤外線検出器30の製造工程図である。赤外線検出器30は、例えば分子線エピタキシー(MBE:Molecular Beam Epitaxy)法を用いて作製される。図8(a)〜図8(c)の工程は、実施例1の図4(a)〜図4(c)の工程と同様である。半導体基板16として、例えばGaAsの微傾斜基板16を用いる。図8(a)に示すように、基板16の表面は、例えば(100)面から[0−11]方向に0.5°程度傾斜している。このため、半導体基板16の表面には、テラス幅「w」が約32nmの微細なステップが存在する。   8 to 12 are manufacturing process diagrams of the infrared detector 30 according to the second embodiment. The infrared detector 30 is manufactured using, for example, a molecular beam epitaxy (MBE) method. The processes of FIGS. 8A to 8C are the same as the processes of FIGS. 4A to 4C of the first embodiment. As the semiconductor substrate 16, for example, a GaAs slightly inclined substrate 16 is used. As shown in FIG. 8A, the surface of the substrate 16 is inclined about 0.5 ° in the [0-11] direction, for example, from the (100) plane. Therefore, a fine step having a terrace width “w” of about 32 nm exists on the surface of the semiconductor substrate 16.

基板16上に、バッファ層18が形成されている。バッファ層18は、例えば真性GaAs層であり、膜厚は100nm程度である。バッファ層18の表面にも、GaAs基板16のステップを反映するステップが存在する。   A buffer layer 18 is formed on the substrate 16. The buffer layer 18 is an intrinsic GaAs layer, for example, and has a thickness of about 100 nm. There are also steps on the surface of the buffer layer 18 that reflect the steps of the GaAs substrate 16.

図8(b)で、バッファ層18上に、例えば真性Al0.14Ga0.86Asの障壁層22を50nm成膜する。障壁層22の表面に、半導体基板のステップを反映するステップが存在する。 In FIG. 8B, a barrier layer 22 of, eg, intrinsic Al 0.14 Ga 0.86 As is deposited on the buffer layer 18 to a thickness of 50 nm. There is a step on the surface of the barrier layer 22 that reflects the step of the semiconductor substrate.

図8(c)で、多重量子井戸構造を基板に垂直に形成する。ステップフロー成長モードを利用し、分数層超格子構造を繰り返し作製することにより形成する。例えば、真性GaAsからなる量子井戸層33が、ステップの端部から5nmの幅「w1」に相当する分、成長するように原料を供給する。この時、ウェハ表面は、GaAs基板16のステップを反映するステップが存在するため、供給された材料は、ウェハ表面を十分に拡散し、ステップエッジに取り込まれる。これにより、GaAsからなる量子井戸層33が各ステップの側面に沿って形成される。   In FIG. 8C, a multiple quantum well structure is formed perpendicular to the substrate. The step-flow growth mode is used to form a fractional layer superlattice structure repeatedly. For example, the raw material is supplied so that the quantum well layer 33 made of intrinsic GaAs grows by an amount corresponding to the width “w1” of 5 nm from the end of the step. At this time, since the wafer surface has a step reflecting the step of the GaAs substrate 16, the supplied material is sufficiently diffused in the wafer surface and taken into the step edge. Thereby, the quantum well layer 33 made of GaAs is formed along the side surface of each step.

図9(a)で、例えば真性Al0.14Ga0.86As障壁層32を、GaAs量子井戸層33のステップ端から27nmの幅「w2」に相当する分、成長するように原料を供給する。量子井戸層33と同様に、供給された材料は、基板表面を十分に拡散し、ステップエッジに取り込まれる。このため、Al0.14Ga0.86Asからなる障壁層32が量子井戸層33の側面に沿って形成される。 In FIG. 9A, for example, an intrinsic Al 0.14 Ga 0.86 As barrier layer 32 is supplied so as to grow from the step end of the GaAs quantum well layer 33 by an amount corresponding to a width “w2” of 27 nm. To do. Similar to the quantum well layer 33, the supplied material sufficiently diffuses on the substrate surface and is taken into the step edge. Therefore, a barrier layer 32 made of Al 0.14 Ga 0.86 As is formed along the side surface of the quantum well layer 33.

図9(b)で、ステップフロー成長モードを利用して、GaAsとAlGaAsの分数層超格子の形成を、多重量子井戸35の厚さ「d」が1000nmとなるまで繰り返す。この厚さは、従来構造の多重量子井戸の厚さの約1/2である。量子井戸層33と障壁層32からなる分数層超格子の1周期(w1+w2)が、GaAs基板16の表面に存在するステップ幅「w」と同じになっており、多重量子井戸35を構成する量子井戸層33と障壁層32は、GaAs基板16の表面に対して垂直に形成される。   In FIG. 9B, using the step flow growth mode, the formation of the fractional layer superlattice of GaAs and AlGaAs is repeated until the thickness “d” of the multiple quantum well 35 reaches 1000 nm. This thickness is about ½ of the thickness of the multiple quantum well having the conventional structure. One period (w1 + w2) of the fractional layer superlattice composed of the quantum well layer 33 and the barrier layer 32 is the same as the step width “w” existing on the surface of the GaAs substrate 16, and the quantum constituting the multiple quantum well 35. The well layer 33 and the barrier layer 32 are formed perpendicular to the surface of the GaAs substrate 16.

図10(a)で、例えば真性Al0.14Ga0.86Asの上部障壁層23を50nm形成する。 In FIG. 10A, the upper barrier layer 23 of, eg, intrinsic Al 0.14 Ga 0.86 As is formed to 50 nm.

図10(b)で、分布型ブラッグ反射器39を形成する。感応波長をλとした時、例えば膜厚λ/4のAlAs層と、膜厚λ/4のGaAs層を交互に積層し、1周期の光学長がλ/2の整数倍になるようにする。分布型ブラッグ反射器39上に、所定の開口を有するレジストマスク38を形成する。   In FIG. 10B, the distributed Bragg reflector 39 is formed. When the sensitive wavelength is λ, for example, an AlAs layer having a film thickness of λ / 4 and a GaAs layer having a film thickness of λ / 4 are alternately stacked so that the optical length of one cycle is an integral multiple of λ / 2. . A resist mask 38 having a predetermined opening is formed on the distributed Bragg reflector 39.

図11(a)で、電極層17a、17bを形成する。レジストマスク38を用いて、分布型ブラッグ反射器39と上部AlGaAs障壁層23の一部をエッチングする。イオン注入法を用いて、エッチングした開口内に、例えばSiを注入し、電子濃度が1×1018cm−3のn型電極層17a、17bを、基板と垂直に形成する。その後、レジストマスク38を除去する。 In FIG. 11A, electrode layers 17a and 17b are formed. Using the resist mask 38, a part of the distributed Bragg reflector 39 and the upper AlGaAs barrier layer 23 is etched. Using ion implantation, for example, Si is implanted into the etched opening, and n-type electrode layers 17a and 17b having an electron concentration of 1 × 10 18 cm −3 are formed perpendicular to the substrate. Thereafter, the resist mask 38 is removed.

図11(b)で、n型電極層17a、17b上に、例えばAuGe/Ni/Auからなるオーミック電極14a、14bをそれぞれ形成する。これにより、赤外線検出器30を得ることができる。   In FIG. 11B, ohmic electrodes 14a and 14b made of, for example, AuGe / Ni / Au are formed on the n-type electrode layers 17a and 17b, respectively. Thereby, the infrared detector 30 can be obtained.

なお、上部障壁層23上に形成される反射体はDBRに限定されず、ブレーズ回折格子等、任意の反射格子であってもよい。   The reflector formed on the upper barrier layer 23 is not limited to DBR, and may be an arbitrary reflection grating such as a blazed diffraction grating.

実施例3では、実施例1の赤外線検出器10又は実施例2の赤外線検出器30を用いた撮像装置を提供する。   In the third embodiment, an imaging apparatus using the infrared detector 10 of the first embodiment or the infrared detector 30 of the second embodiment is provided.

図12は、一例として、実施例2の赤外線検出器30を用いた撮像装置50を示す。図12(a)は撮像装置50の概略断面図、図12(b)は斜視図である。   FIG. 12 shows an imaging apparatus 50 using the infrared detector 30 of the second embodiment as an example. 12A is a schematic cross-sectional view of the imaging device 50, and FIG. 12B is a perspective view.

半導体基板16上に、バッファ層18を介して複数の赤外線検出器30がアレイ状に配置されている。各赤外線検出器30のオーミック電極14a、14b上に形成されたバンプ電極40は、信号読出回路が形成された回路基板51に接合されている。すなわち、各赤外線検出器30は、バンプ電極40を介して信号読出回路と電気的に接続されている。図12(a)では光の入射面が下側、回路基板51が上側に描かれているが、実装では、図12(b)に示すように、複数の赤外線検出器30が配置された撮像素子アレイ45の光入射面を上側にして、回路基板51にフリップチップ接合されてもよい。   A plurality of infrared detectors 30 are arranged in an array on the semiconductor substrate 16 via the buffer layer 18. The bump electrodes 40 formed on the ohmic electrodes 14a and 14b of each infrared detector 30 are bonded to a circuit board 51 on which a signal readout circuit is formed. That is, each infrared detector 30 is electrically connected to the signal readout circuit via the bump electrode 40. In FIG. 12A, the light incident surface is drawn on the lower side, and the circuit board 51 is drawn on the upper side. However, in mounting, as shown in FIG. 12B, imaging in which a plurality of infrared detectors 30 are arranged. The element array 45 may be flip-chip bonded to the circuit board 51 with the light incident surface facing upward.

図13〜図17は、撮像装置50の製造工程図である。図13(a)で、GaAsの微傾斜基板16上に、例えば分子線エピタキシーを用いて真正GaAsバッファ層18を100nm成長する。基板16の表面は、実施例2で説明したように、例えば(100)面から[0−11]方向に0.5°程度傾斜し、テラス幅が約32nmの微細なステップ(不図示)が存在する。バッファ層18の表面にも、GaAs基板16のステップを反映するステップ(不図示)が存在する。   13 to 17 are manufacturing process diagrams of the imaging device 50. In FIG. 13A, an intrinsic GaAs buffer layer 18 is grown to 100 nm on a GaAs finely inclined substrate 16 by using, for example, molecular beam epitaxy. As described in the second embodiment, the surface of the substrate 16 is inclined by about 0.5 ° in the [0-11] direction from the (100) plane, for example, and has a fine step (not shown) having a terrace width of about 32 nm. Exists. A step (not shown) reflecting the step of the GaAs substrate 16 also exists on the surface of the buffer layer 18.

図13(b)で、バッファ層18上に、真性Al0.14Ga0.86Asの障壁層22を50nmの膜厚で形成する。障壁層22の表面にも、ウェハのステップを反映するステップ(不図示)が存在する。 In FIG. 13B, an intrinsic Al 0.14 Ga 0.86 As barrier layer 22 is formed on the buffer layer 18 to a thickness of 50 nm. There are also steps (not shown) on the surface of the barrier layer 22 that reflect the steps of the wafer.

図13(c)で、障壁層22上に多重量子井戸層46を形成する。多重量子井戸層46の量子井戸層33と障壁層32は、基板16の表面に対して垂直方向に延びる。実施例2で説明したように、ステップフロー成長モードを利用し、分数層超格子構造を繰り返し作製することにより、多重量子井戸層46の厚さが1000nmとなるように形成する。   In FIG. 13C, a multiple quantum well layer 46 is formed on the barrier layer 22. The quantum well layer 33 and the barrier layer 32 of the multiple quantum well layer 46 extend in a direction perpendicular to the surface of the substrate 16. As described in the second embodiment, the multi-quantum well layer 46 is formed to have a thickness of 1000 nm by repeatedly manufacturing the fractional layer superlattice structure using the step flow growth mode.

図14(a)で、真性Al0.14Ga0.86Asの上部障壁層23を50nm成長する。 In FIG. 14A, an upper barrier layer 23 of intrinsic Al 0.14 Ga 0.86 As is grown by 50 nm.

図14(b)で、上部障壁層23上に分布型ブラッグ反射層49を形成する。感応波長をλとした時、例えばAlAs層厚λ/4、GaAs層厚λ/4を交互に積層し、1周期の光学長がλ/2の整数倍になるようにする。分布型ブラッグ反射層49上に所定の開口57を有するレジストマスク54を形成する。   In FIG. 14B, a distributed Bragg reflection layer 49 is formed on the upper barrier layer 23. When the sensitive wavelength is λ, for example, AlAs layer thickness λ / 4 and GaAs layer thickness λ / 4 are alternately stacked so that the optical length of one cycle is an integral multiple of λ / 2. A resist mask 54 having a predetermined opening 57 is formed on the distributed Bragg reflection layer 49.

図15(a)で、レジストマスク54を用いて、分布型ブラッグ反射層49と上部AlGaAs障壁層23の一部をエッチングする。次いで、イオン注入法を用いて、エッチング開口58内に例えばSiを注入する。   In FIG. 15A, using the resist mask 54, the distributed Bragg reflection layer 49 and a part of the upper AlGaAs barrier layer 23 are etched. Next, for example, Si is implanted into the etching opening 58 by using an ion implantation method.

図15(b)で、Si注入により電子濃度1×1018cm−3のn型電極層47が形成され、n型電極層47の間に個々の多重量子井戸35が形成される。その後、レジストマスク54を剥離する。 In FIG. 15B, an n-type electrode layer 47 having an electron concentration of 1 × 10 18 cm −3 is formed by Si implantation, and individual multiple quantum wells 35 are formed between the n-type electrode layers 47. Thereafter, the resist mask 54 is peeled off.

図16(a)で、画素分離を行う。異方性のドライエッチングで、n型電極層47に格子状の分離溝55を形成し、2次元に配列した画素を形成する。この画素分離により、多重量子井戸35を側面から挟み込む一対の電極層17a、17bが形成される。   In FIG. 16A, pixel separation is performed. Lattice-like separation grooves 55 are formed in the n-type electrode layer 47 by anisotropic dry etching to form pixels arranged two-dimensionally. By this pixel separation, a pair of electrode layers 17a and 17b sandwiching the multiple quantum well 35 from the side surfaces are formed.

図16(b)で、n型電極層17a、17b上に、例えばAuGe/Ni/Auのオーミック電極14a、14bを形成する。   In FIG. 16B, AuGe / Ni / Au ohmic electrodes 14a and 14b, for example, are formed on the n-type electrode layers 17a and 17b.

図17で、オーミック電極14a、14bの上に、例えばInからなるバンプ40を形成し、回路基板51と接合する。これにより、撮像装置50を得ることができる。   In FIG. 17, bumps 40 made of, for example, In are formed on the ohmic electrodes 14 a and 14 b and bonded to the circuit board 51. Thereby, the imaging device 50 can be obtained.

実施例3の撮像装置は、基板に対して垂直に延びる量子井戸層と障壁層とが水平方向に繰り返され、この多重量子井戸を横方向(基板と水平な方向)から電極層で挟む構成の赤外線検出器を用いる。したがって、各画素で、自由キャリア吸収による光吸収を防止し、多重量子井戸に入射する光の強度を高く維持することができる。その結果、光電流を増大し、撮像装置全体としての感度を向上することができる。また、光結合構造を用いなくても、赤外線を検出することができる。さらに、実施例2の光検出器30を用いた場合は、多重量子井戸30の厚さを低減することができるので、薄型の撮像素子アレイ45(図12(b)参照)を作製することができる。   The imaging device of Example 3 has a structure in which a quantum well layer and a barrier layer extending perpendicularly to a substrate are repeated in a horizontal direction, and the multiple quantum well is sandwiched between electrode layers from a horizontal direction (a direction parallel to the substrate). An infrared detector is used. Therefore, in each pixel, light absorption due to free carrier absorption can be prevented, and the intensity of light incident on the multiple quantum well can be kept high. As a result, the photocurrent can be increased and the sensitivity of the entire imaging apparatus can be improved. Moreover, infrared rays can be detected without using an optical coupling structure. Furthermore, when the photodetector 30 according to the second embodiment is used, the thickness of the multiple quantum well 30 can be reduced, so that a thin imaging element array 45 (see FIG. 12B) can be manufactured. it can.

以上の説明に対して、以下の付記を提示する。
(付記1)
不純物がドープされていない基板と、
前記基板に対して垂直に延びる量子井戸層と障壁層とを含む量子井戸構造と、
前記基板に対して水平な方向から前記量子井戸構造を挟み込む一対の電極層と、
を有することを特徴とする光検出器。
(付記2)
前記基板は、所定の結晶面から一定の方向に階段状に傾斜した傾斜基板であることを特徴とする付記1に記載の光検出器。
(付記3)
前記量子井戸構造は、前記量子井戸層と前記障壁層とが、前記基板と水平な方向に周期的に繰り返される多重量子井戸であり、
前記多重量子井戸の周期は、前記傾斜基板のテラス幅の1/n(nは自然数)倍であることを特徴とする付記2に記載の光検出器。
(付記4)
前記量子井戸構造の上部に、前記基板に対して水平に反射体が配置されていることを特徴とする付記1〜3のいずれかに記載の光検出器。
(付記5)
前記反射体は、分布型反射器であることを特徴とする付記4に記載の光検出器。
(付記6)
前記量子井戸構造は、赤外帯域に吸収ピーク波長を有することを特徴とする付記1〜5のいずれかに記載の光検出器。
(付記7)
付記1〜6のいずれかに記載の光検出器がアレイ状に配置された撮像素子アレイと、前記撮像素子アレイに電気的に接続される回路基板と、
を有する撮像装置。
(付記8)
不純物がドープされていない基板上に、前記基板と垂直方向に伸びる量子井戸層と障壁層とが前記基板と水平な方向に周期的に繰り返される多重量子井戸層を形成し、
前記多重量子井戸層の所定の箇所に不純物を注入して、一定の周期数の多重量子井戸に隣接する一対の電極層を形成する、
工程を含むことを特徴とする光検出器の製造方法。
(付記9)
前記多重量子井戸層は、ステップフロー成長モードを利用して、分数層超格子構造を繰り返し形成することによって、前記基板と垂直方向に形成されることを特徴とする付記8に記載の光検出器の製造方法。
For the above explanation, the following notes are presented.
(Appendix 1)
A substrate not doped with impurities;
A quantum well structure including a quantum well layer and a barrier layer extending perpendicular to the substrate;
A pair of electrode layers sandwiching the quantum well structure from a direction horizontal to the substrate;
A photodetector comprising:
(Appendix 2)
2. The photodetector according to claim 1, wherein the substrate is an inclined substrate that is inclined stepwise in a predetermined direction from a predetermined crystal plane.
(Appendix 3)
The quantum well structure is a multiple quantum well in which the quantum well layer and the barrier layer are periodically repeated in a direction horizontal to the substrate,
The photodetector according to claim 2, wherein the period of the multiple quantum well is 1 / n (n is a natural number) times the terrace width of the inclined substrate.
(Appendix 4)
The photodetector according to any one of appendices 1 to 3, wherein a reflector is disposed above the quantum well structure in a horizontal direction with respect to the substrate.
(Appendix 5)
The photodetector according to appendix 4, wherein the reflector is a distributed reflector.
(Appendix 6)
The photodetector according to any one of appendices 1 to 5, wherein the quantum well structure has an absorption peak wavelength in an infrared band.
(Appendix 7)
An image sensor array in which the photodetectors according to any one of appendices 1 to 6 are arranged in an array; a circuit board electrically connected to the image sensor array;
An imaging apparatus having
(Appendix 8)
On a substrate not doped with impurities, a multi-quantum well layer is formed in which a quantum well layer and a barrier layer extending in a direction perpendicular to the substrate are periodically repeated in a direction horizontal to the substrate,
Impurities are implanted into a predetermined portion of the multiple quantum well layer to form a pair of electrode layers adjacent to the multiple quantum well having a certain number of periods.
The manufacturing method of the photodetector characterized by including a process.
(Appendix 9)
The photodetector according to claim 8, wherein the multiple quantum well layer is formed in a direction perpendicular to the substrate by repeatedly forming a fractional layer superlattice structure using a step flow growth mode. Manufacturing method.

10、30 赤外線検出器(光検出器)
16 半導体基板
18 バッファ層
12、32 障壁層
13、33 量子井戸層
15、35 多重量子井戸(量子井戸構造)
17a、17b 電極層
22 下部障壁層
23 上部障壁層
45 撮像素子アレイ
50 撮像装置
51 回路基板
10, 30 Infrared detector (light detector)
16 Semiconductor substrate 18 Buffer layer 12, 32 Barrier layer 13, 33 Quantum well layer 15, 35 Multiple quantum well (quantum well structure)
17a, 17b Electrode layer 22 Lower barrier layer 23 Upper barrier layer 45 Imaging element array 50 Imaging device 51 Circuit board

Claims (7)

不純物がドープされていない基板と、
前記基板に対して垂直に延びる量子井戸層と障壁層とを含む量子井戸構造と、
前記基板に対して水平な方向から前記量子井戸構造を挟み込む一対の電極層と、
を有することを特徴とする光検出器。
A substrate not doped with impurities;
A quantum well structure including a quantum well layer and a barrier layer extending perpendicular to the substrate;
A pair of electrode layers sandwiching the quantum well structure from a direction horizontal to the substrate;
A photodetector comprising:
前記基板は、所定の結晶面から一定の方向に階段状に傾斜した傾斜基板であることを特徴とする請求項1に記載の光検出器。   The photodetector according to claim 1, wherein the substrate is an inclined substrate that is inclined stepwise in a certain direction from a predetermined crystal plane. 前記量子井戸構造は、前記量子井戸層と前記障壁層が、前記基板と水平な方向に周期的に繰り返される多重量子井戸であり、
前記多重量子井戸の周期は、前記傾斜基板のテラス幅の1/n(nは自然数)倍であることを特徴とする請求項2に記載の光検出器。
The quantum well structure is a multiple quantum well in which the quantum well layer and the barrier layer are periodically repeated in a direction horizontal to the substrate,
The photodetector according to claim 2, wherein a period of the multiple quantum well is 1 / n (n is a natural number) times a terrace width of the inclined substrate.
前記量子井戸構造の上部に、前記基板に対して水平に反射体が配置されていることを特徴とする請求項1〜3のいずれか1項に記載の光検出器。 On top of the quantum well structure, a light detector according to any one of claims 1 to 3, characterized in that it is arranged horizontally reflector relative to the substrate. 請求項1〜4のいずれか1項に記載の光検出器がアレイ状に配置された撮像素子アレイと、
前記撮像素子アレイに電気的に接続される回路基板と、
を有する撮像装置。
An image sensor array in which the photodetectors according to any one of claims 1 to 4 are arranged in an array,
A circuit board electrically connected to the imaging element array;
An imaging apparatus having
不純物がドープされていない基板上に、前記基板と垂直方向に伸びる量子井戸層と障壁層とが前記基板と水平な方向に周期的に繰り返される多重量子井戸層を形成し、
前記多重量子井戸層の所定の箇所に不純物を注入して、一定の周期数の多重量子井戸に隣接する一対の電極層を形成する、
工程を含むことを特徴とする光検出器の製造方法。
On a substrate not doped with impurities, a multi-quantum well layer is formed in which a quantum well layer and a barrier layer extending in a direction perpendicular to the substrate are periodically repeated in a direction horizontal to the substrate,
Impurities are implanted into a predetermined portion of the multiple quantum well layer to form a pair of electrode layers adjacent to the multiple quantum well having a certain number of periods.
The manufacturing method of the photodetector characterized by including a process.
前記多重量子井戸層は、ステップフロー成長モードを利用して、分数層超格子構造を繰り返し形成することによって、前記基板と垂直方向に形成されることを特徴とする請求項6に記載の光検出器の製造方法。   The optical detection according to claim 6, wherein the multiple quantum well layer is formed in a direction perpendicular to the substrate by repeatedly forming a fractional layer superlattice structure using a step flow growth mode. Manufacturing method.
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