JP5465554B2 - Signal generator - Google Patents

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Description

本発明は、出力信号の周波数を変更可能に構成された信号生成装置に関するものである。   The present invention relates to a signal generation device configured to be able to change the frequency of an output signal.

この種の信号生成装置として、下記特許文献1に開示された信号生成装置(波形生成装置)が知られている。この信号生成装置は同特許文献1の従来の技術において開示された装置であって、この信号生成装置では、まず、波形読出用クロック信号に同期して波形データメモリから波形データを読み出し、その読み出した波形データをD/A変換回路がディジタル−アナログ変換することによりアナログ信号を生成する。次いで、アナログ信号をカットオフ周波数可変型のスムージングフィルタに入力することにより、そのアナログ信号に含まれている波形読出用クロック信号成分を除去してS/N比の良いアナログ信号を生成している。   As this type of signal generation apparatus, a signal generation apparatus (waveform generation apparatus) disclosed in Patent Document 1 below is known. This signal generator is an apparatus disclosed in the prior art of Patent Document 1. In this signal generator, first, waveform data is read from the waveform data memory in synchronization with the waveform read clock signal, and then read. The D / A conversion circuit performs digital-analog conversion on the obtained waveform data to generate an analog signal. Next, by inputting the analog signal to a variable cutoff frequency type smoothing filter, an analog signal having a good S / N ratio is generated by removing the waveform readout clock signal component contained in the analog signal. .

このようなスムージングフィルタとしては、下記特許文献1に開示されているような、複数のローパスフィルタと、複数のローパスフィルタを切り替えるためのマルチプレクサなどの電子式スイッチとを備えて構成されたフィルタが一般的に使用されている。この場合、各ローパスフィルタは、複数のRC型一次ローパスフィルタの直列接続、またはLC型二次ローパスフィルタで構成されると共にカットオフ周波数が互いに異なるようにそれぞれ規定されている。したがって、この信号生成装置によれば、電子式スイッチを切替制御することにより、D/A変換回路によって生成されたアナログ信号の周波数に応じたカットオフ周波数のローパスフィルタを選択することができるため、アナログ信号に含まれている読出用クロック信号成分や不要スプリアス成分を除去して、S/N比の良いアナログ出力信号を生成することが可能となっている。   As such a smoothing filter, a filter including a plurality of low-pass filters and an electronic switch such as a multiplexer for switching the plurality of low-pass filters as disclosed in Patent Document 1 below is generally used. Has been used. In this case, each low-pass filter is constituted by a series connection of a plurality of RC-type primary low-pass filters, or an LC-type secondary low-pass filter, and is defined so that the cut-off frequencies are different from each other. Therefore, according to this signal generation device, it is possible to select a low-pass filter having a cutoff frequency corresponding to the frequency of the analog signal generated by the D / A conversion circuit by switching the electronic switch. It is possible to generate an analog output signal having a good S / N ratio by removing a read clock signal component and unnecessary spurious components included in the analog signal.

特開2000−165199号公報(第2頁、第3図)JP 2000-165199 A (2nd page, FIG. 3)

ところが、上記の信号生成装置には、以下の解決すべき課題が存在している。すなわち、一般的に、カットオフ周波数の異なる各フィルタでは、フィルタを信号が通過する際に生じる位相遅れが相違する。このため、この信号生成装置には、複数のフィルタのうちの使用している一のフィルタを他のフィルタに切り替える際に、図6に示すように信号の位相に不連続が発生し、この位相の不連続に起因して、信号生成装置から信号の供給を受ける負荷が例えばインダクタンス成分を有するものである場合には、瞬間的に大きな逆起電力が発生したり、また信号生成装置から信号の供給を受ける負荷が例えば容量成分を有するものである場合には、瞬間的に過大な電流が流れたりすることから、信号生成装置自体や負荷に対して悪影響を与えるおそれがあるという解決すべき課題が存在している。   However, the signal generation apparatus has the following problems to be solved. That is, in general, each filter having a different cutoff frequency has a different phase delay that occurs when a signal passes through the filter. For this reason, in this signal generation device, when one of the plurality of filters used is switched to another filter, a discontinuity occurs in the signal phase as shown in FIG. For example, when the load supplied with a signal from the signal generation device has an inductance component, a large back electromotive force is generated instantaneously or the signal generation device If the load to be supplied has, for example, a capacitive component, an excessive current flows instantaneously, which may cause an adverse effect on the signal generator itself and the load. Is present.

本発明は、かかる課題に鑑みてなされたものであり、位相に不連続を生じさせずに信号を生成する信号生成装置を提供することを主目的とする。また、この信号生成装置を用いたインピーダンス測定装置を提供することを他の主目的とする。   The present invention has been made in view of such problems, and a main object of the present invention is to provide a signal generation device that generates a signal without causing discontinuity in the phase. Another main object is to provide an impedance measuring device using the signal generating device.

上記目的を達成すべく請求項1記載の信号生成装置は、通過帯域同士が部分的に重複するように規定された複数のフィルタと、設定された周波数の一の信号を生成して出力すると共に当該一の信号の位相を変更可能に構成された一のDDSと、設定された周波数の他の信号を生成して出力すると共に当該他の信号の位相を変更可能に構成された他のDDSと、前記一のDDSを前記複数のフィルタのうちから選択された一のフィルタに接続すると共に、前記他のDDSを当該一のフィルタを除く他の1つのフィルタに接続する第1切替部と、前記一のフィルタから出力される前記一の信号および前記他のフィルタから出力される前記他の信号のうちの1つを選択して出力信号として出力する第2切替部と、すべての前記DDSに対して同一の周波数を同時に設定する周波数設定制御、当該各DDSに対して前記位相を設定する位相設定制御、並びに前記第1切替部および前記第2切替部に対する切替制御を実行する処理部とを備え、前記処理部は、前記周波数設定制御を実行することによって前記複数のフィルタの前記複数の通過帯域のうちの一の通過帯域に含まれる一の周波数の前記一の信号を前記一のDDSから出力させると共に当該一の周波数の前記他の信号を前記他のDDSから出力させ、かつ前記第1切替部および前記第2切替部に対する切替制御を実行することによって当該一の信号を前記複数のフィルタのうちの前記通過帯域が前記一の通過帯域である一のフィルタを介して前記出力信号として出力させている状態において、当該一の信号に代えて前記複数の通過帯域のうちの当該一の通過帯域と部分的に重複する他の通過帯域に含まれる他の周波数の前記他の信号を当該出力信号として出力させる際に、前記第1切替部に対する切替制御を実行して前記他のDDSを前記複数のフィルタのうちの前記通過帯域が前記他の通過帯域である他のフィルタに接続すると共に、前記周波数設定制御を実行することによって前記各DDSから出力される前記一の信号および前記他の信号の周波数を前記一の通過帯域と前記他の通過帯域との重複する帯域に含まれる共通周波数に設定し、次いで、当該他のDDSに対する前記位相設定制御を実行して当該他のフィルタから出力されている前記他の信号の位相を前記一のフィルタから出力されている前記一の信号の位相に一致させた後に、前記第2切替部に対する切替制御を実行して、前記出力信号を前記一の信号から前記他の信号に切り替える。   In order to achieve the above object, the signal generation device according to claim 1 generates and outputs a plurality of filters defined so that the passbands partially overlap each other and a signal having a set frequency. One DDS configured to change the phase of the one signal, and another DDS configured to generate and output another signal of the set frequency and change the phase of the other signal Connecting the one DDS to one filter selected from the plurality of filters, and connecting the other DDS to one other filter excluding the one filter; A second switching unit that selects one of the one signal output from one filter and the other signal output from the other filter and outputs the selected signal as an output signal; and for all the DDSs Same A frequency setting control that sets the wave number at the same time, a phase setting control that sets the phase for each DDS, and a processing unit that executes a switching control for the first switching unit and the second switching unit. The unit outputs the one signal of one frequency included in one pass band of the plurality of pass bands of the plurality of filters from the one DDS by executing the frequency setting control. The other signal having one frequency is output from the other DDS, and the one signal is output from the plurality of filters by performing switching control on the first switching unit and the second switching unit. In a state where the output signal is output through one filter whose pass band is the one pass band, the plurality of pass bands are used instead of the one signal. Switching control for the first switching unit is performed when the other signal of another frequency included in another pass band partially overlapping with the one pass band is output as the output signal. The other DDS is connected to another filter whose pass band is the other pass band of the plurality of filters, and the frequency setting control is executed to output the one DDS output from each DDS. And the frequency of the other signal are set to a common frequency included in the overlapping band of the one passband and the other passband, and then the phase setting control for the other DDS is performed. After the phase of the other signal output from the other filter matches the phase of the one signal output from the one filter, the switching control for the second switching unit is performed. And the output signal is switched from the one signal to the other signal.

また、請求項2記載の信号生成装置は、通過帯域同士が部分的に重複するように規定された複数のフィルタと、前記複数のフィルタの各々に対応して配設されて、設定された周波数の信号を生成して出力すると共に当該信号の位相を変更可能に構成された複数のDDSと、前記複数のフィルタから出力される前記信号のうちの1つを選択して出力信号として出力する切替部と、すべての前記DDSに対して同一の周波数を同時に設定する周波数設定制御、当該各DDSに対して前記位相を設定する位相設定制御、並びに前記切替部に対する切替制御を実行する処理部とを備え、前記処理部は、前記周波数設定制御を実行することによって前記複数のフィルタの前記複数の通過帯域のうちの一の通過帯域に含まれる一の周波数の前記信号を前記複数のDDSから出力させると共に、前記切替制御を実行することによって前記複数のフィルタのうちの前記通過帯域が前記一の通過帯域である一のフィルタに対応して配設された前記複数のDDSのうちの一のDDSから出力されている一の前記信号を前記出力信号として出力させている状態において、当該一の信号に代えて前記複数の通過帯域のうちの当該一の通過帯域と部分的に重複する他の通過帯域に含まれている他の周波数の他の前記信号を当該出力信号として出力させる際に、前記周波数設定制御を実行することによって前記複数のDDSから出力される前記信号の周波数を前記一の通過帯域と前記他の通過帯域との重複する帯域に含まれる共通周波数に設定し、次いで、前記複数のフィルタのうちの前記通過帯域が前記他の通過帯域である他のフィルタに対応して配設された前記複数のDDSのうちの他のDDSに対する前記位相設定制御を実行して当該他のフィルタから出力されている前記他の信号の位相を前記一の信号の位相に一致させた後に、前記切替部に対する切替制御を実行して、前記出力信号を前記一の信号から前記他の信号に切り替える。   The signal generation device according to claim 2 is provided with a plurality of filters defined so that passbands partially overlap each other, and a set frequency corresponding to each of the plurality of filters. A plurality of DDSs that are configured to generate and output a signal and to change the phase of the signal, and a switch that selects and outputs one of the signals output from the plurality of filters as an output signal And a processing unit for executing frequency setting control for simultaneously setting the same frequency for all the DDS, phase setting control for setting the phase for each DDS, and switching control for the switching unit. And the processing unit executes the frequency setting control to output the signal having one frequency included in one pass band of the plurality of pass bands of the plurality of filters. A plurality of DDSs arranged in correspondence with one filter whose pass band is the one pass band by performing the switching control. In a state where one of the signals output from one of the DDSs is output as the output signal, a part of the one pass band of the plurality of pass bands is substituted for the one signal. The frequency of the signals output from the plurality of DDSs by executing the frequency setting control when outputting the other signals of other frequencies included in other overlapping passbands as the output signals. Is set to a common frequency included in the overlapping band of the one passband and the other passband, and then the passband of the plurality of filters is the other passband. The phase setting control is performed on the other DDSs of the plurality of DDSs arranged corresponding to the other filters that are bands, and the phases of the other signals output from the other filters are After matching the phase of one signal, switching control for the switching unit is executed to switch the output signal from the one signal to the other signal.

また、請求項3記載の信号生成装置は、請求項1または2記載の信号生成装置において、前記処理部は、前記他のDDSに対する前記位相設定制御を実行して前記他のフィルタから出力されている前記他の信号の位相を前記一のフィルタから出力されている前記一の信号の位相に一致させる際に、前記一のDDSと前記他のDDSの前記各位相の差が、前記共通周波数における前記一のフィルタおよび前記他のフィルタの各位相シフト量の差分と等しくなるように当該他のDDSの位相を設定する。   The signal generation device according to claim 3 is the signal generation device according to claim 1 or 2, wherein the processing unit executes the phase setting control for the other DDS and is output from the other filter. When the phase of the other signal is matched with the phase of the one signal output from the one filter, the difference between the respective phases of the one DDS and the other DDS is determined at the common frequency. The phase of the other DDS is set to be equal to the difference between the phase shift amounts of the one filter and the other filter.

また、請求項4記載の信号生成装置は、請求項1から3のいずれかに記載の信号生成装置において、前記処理部は、前記共通周波数として、前記一の通過帯域内に規定された一の使用帯域と前記他の通過帯域内に規定された他の使用帯域との重複する帯域に含まれる周波数を設定する。   According to a fourth aspect of the present invention, in the signal generating device according to any one of the first to third aspects, the processing unit is one of the ones defined in the one passband as the common frequency. A frequency included in an overlapping band between the used band and the other used band defined in the other pass band is set.

また、請求項5記載のインピーダンス測定装置は、請求項1から4のいずれかに記載の信号生成装置と、前記信号生成装置から出力される出力信号を測定対象体に印加したときに前記測定対象体に流れる電流を検出する電流検出部と、前記電流が流れているときに前記測定対象体の両端間に発生する電圧を検出する電圧検出部とを備え、前記処理部は、前記電流検出部によって検出された前記電流、および前記電圧検出部によって検出された前記電圧に基づいて前記測定対象体のインピーダンスを測定する。   An impedance measuring apparatus according to claim 5 is the measurement target when the signal generation apparatus according to any one of claims 1 to 4 and an output signal output from the signal generation apparatus are applied to the measurement target. A current detection unit that detects a current flowing through the body; and a voltage detection unit that detects a voltage generated between both ends of the measurement target body when the current is flowing, and the processing unit includes the current detection unit The impedance of the object to be measured is measured based on the current detected by, and the voltage detected by the voltage detector.

請求項1記載の信号生成装置および請求項2記載の信号生成装置では、一の信号に代えて複数の通過帯域のうちの一の通過帯域と部分的に重複する他の通過帯域に含まれる他の周波数の他の信号を出力信号として出力させる際に、他のDDSを通過帯域が他の通過帯域である他のフィルタに接続すると共に、周波数設定制御を実行することによって各DDSから出力される一の信号および他の信号の周波数を一の通過帯域と他の通過帯域との重複する帯域に含まれる共通周波数に設定し、次いで、他のDDSに対する位相設定制御を実行して他のフィルタから出力されている他の信号の位相を一のフィルタから出力されている一の信号の位相に一致させた後に、第2切替部に対する切替制御を実行して、出力信号を一の信号から他の信号に切り替える。   In the signal generation device according to claim 1 and the signal generation device according to claim 2, in place of one signal, the signal generation device is included in another pass band that partially overlaps one of the pass bands. When other signals of the same frequency are output as output signals, other DDSs are connected to other filters whose passbands are other passbands, and output from each DDS by executing frequency setting control The frequency of one signal and the other signal is set to a common frequency included in the overlapping band of the one passband and the other passband, and then the phase setting control for the other DDS is performed to After matching the phase of the other signal being output to the phase of the one signal being output from one filter, the switching control for the second switching unit is executed, and the output signal is changed from one signal to the other. Switch to signal Frogs.

したがって、これらの信号生成装置によれば、一のフィルタから出力されている一の信号および他のフィルタから出力されている他の信号の周波数が同一であって、かつ位相が一致した状態にあるため、一の信号から他の信号に切り替える際に、出力信号に生じる位相の不連続を大幅に低減させることができる。つまり、実質的に、位相に不連続を生じさせることなく一の信号から他の信号に切り替えて、出力信号を出力させることができる。   Therefore, according to these signal generation devices, the frequency of one signal output from one filter and the other signal output from another filter are the same and in phase with each other. Therefore, when switching from one signal to another, the phase discontinuity that occurs in the output signal can be greatly reduced. That is, the output signal can be output by switching from one signal to another without causing a phase discontinuity substantially.

また、請求項3記載の信号生成装置によれば、処理部が、他のDDSに対する位相設定制御を実行して他のフィルタから出力されている他の信号の位相を一のフィルタから出力されている一の信号の位相に一致させる際に、各DDSの位相の差が、共通周波数における一のフィルタおよび他のフィルタの各位相シフト量の差分と等しくなるように他のDDSの位相を設定するため、他のフィルタから出力されている他の信号の位相を一のフィルタから出力されている一の信号の位相に確実に一致させることができる。   According to the signal generation device of claim 3, the processing unit executes phase setting control for another DDS and outputs the phase of another signal output from another filter from one filter. The phase difference of each DDS is set so that the phase difference of each DDS is equal to the difference between the phase shift amounts of the one filter and the other filter at the common frequency when matching the phase of one signal. Therefore, the phase of the other signal output from the other filter can be surely matched with the phase of the one signal output from the one filter.

また、請求項4記載の信号生成装置によれば、一の通過帯域内に規定された一の使用帯域と他の通過帯域内に規定された他の使用帯域との重複する帯域に含まれる周波数を共通周波数として設定するため、この状態において、他のDDSに対する位相設定制御を実行して、この他のDDSに接続された他のフィルタから出力されている他の信号の位相を一のフィルタから出力されている一の信号の位相に一致させた後に、切替部(第2切替部)に対する切替制御を実行して、出力信号を一の信号から他の信号に切り替えることができるため、出力信号として各フィルタから出力される信号の周波数を、各フィルタにおいて不要スプリアス成分を適切に除去し得る使用帯域内に常に維持することができる結果、出力信号に含まれる不要スプリアス成分を大幅に低減することができる。   According to the signal generating device of claim 4, the frequency included in the overlapping band of the one used band defined in the one pass band and the other used band defined in the other pass band. In this state, phase setting control for another DDS is executed, and the phase of another signal output from another filter connected to this other DDS is set from one filter. Since it is possible to switch the output signal from one signal to another by executing switching control for the switching unit (second switching unit) after matching the phase of the one signal being output, the output signal As a result, it is possible to always maintain the frequency of the signal output from each filter within the use band in which the unnecessary spurious component can be appropriately removed in each filter. It is possible to significantly reduce the components.

また、請求項5記載のインピーダンス測定装置によれば、請求項1から4のいずれかに記載の信号生成装置を備え、この信号生成装置からの出力信号に基づく測定用信号を測定対象体に印加する構成を採用したことにより、測定用信号の周波数の変更時に測定用信号に位相の不連続が生じないため、測定対象体がインダクタンス成分を有するものであったとしても、瞬間的に大きな逆起電力が発生することを確実に回避することができ、また測定対象体が容量成分を有するものであったとしても、瞬間的に過大な電流が流れることを確実に回避することができる。   In addition, according to the impedance measuring device according to claim 5, the signal generating device according to any one of claims 1 to 4 is provided, and a measurement signal based on an output signal from the signal generating device is applied to the measurement object. By adopting this configuration, phase discontinuity does not occur in the measurement signal when the frequency of the measurement signal is changed, so even if the measurement object has an inductance component, a large backlash occurs instantaneously. Generation of electric power can be surely avoided, and even if the measurement object has a capacitive component, it can be reliably avoided that an excessively large current flows instantaneously.

信号生成装置2を備えたインピーダンス測定装置1の構成を示す構成図である。1 is a configuration diagram illustrating a configuration of an impedance measuring device 1 including a signal generating device 2. FIG. 図1の各フィルタの周波数特性を示す特性図である。It is a characteristic view which shows the frequency characteristic of each filter of FIG. 周波数を上昇または低下させる際のフィルタ切替処理のフローチャートである。It is a flowchart of the filter switching process at the time of raising or lowering the frequency. フィルタ切替時における切替前後のフィルタおよびDDSの種類と、切替後のDDSに設定する位相シフト量を説明するための説明図である。It is explanatory drawing for demonstrating the kind of filter and DDS before and behind switching at the time of filter switching, and the phase shift amount set to DDS after switching. 他の信号生成装置2Aの構成を示す構成図である。It is a block diagram which shows the structure of 2 A of other signal generation apparatuses. 従来の信号生成装置で発生する位相の不連続を説明するための波形図である。It is a wave form diagram for demonstrating the discontinuity of the phase which generate | occur | produces with the conventional signal generation apparatus.

以下、信号生成装置の実施の形態について、添付図面を参照して説明する。なお、一例として、信号生成装置をインピーダンス測定装置に適用した例を挙げて説明する。   Hereinafter, embodiments of a signal generation device will be described with reference to the accompanying drawings. As an example, an example in which the signal generation device is applied to an impedance measurement device will be described.

最初に、信号生成装置2の構成をインピーダンス測定装置1の構成と併せて、図面を参照して説明する。   First, the configuration of the signal generation device 2 will be described together with the configuration of the impedance measurement device 1 with reference to the drawings.

図1に示すインピーダンス測定装置1は、信号生成装置2、増幅部3、電圧検出部4、電流検出部5、処理部6、記憶部7および出力部8を備え、信号生成装置2から出力される出力信号Soを測定用信号Smに増幅すると共にプローブ9を介して測定対象体21に印加して、このときに測定対象体21の両端間に発生する電圧Vdを一対のプローブ10,11を介して検出すると共に、測定対象体21に流れる電流Idをプローブ12を介して検出して、検出された電圧Vdおよび電流Idに基づいて、測定対象体21のインピーダンスZを測定する。   1 includes a signal generation device 2, an amplification unit 3, a voltage detection unit 4, a current detection unit 5, a processing unit 6, a storage unit 7, and an output unit 8, and is output from the signal generation device 2. The output signal So is amplified to the measurement signal Sm and applied to the measurement object 21 via the probe 9, and the voltage Vd generated at both ends of the measurement object 21 at this time is applied to the pair of probes 10 and 11. And the current Id flowing through the measurement object 21 is detected via the probe 12, and the impedance Z of the measurement object 21 is measured based on the detected voltage Vd and current Id.

信号生成装置2は、基準信号生成部31、第1DDS(Direct Digital Synthesizer)32、第2DDS33、第1切替部34、複数(本例では4つ)のフィルタ35,36,37,38および第2切替部39を備え、後述する複数(フィルタの個数と同数(本例では4つ))の使用帯域(使用周波数帯域)W1,W2,W3,W4内の任意の1つの周波数の出力信号Soを生成して出力し得るように構成されている。なお、処理部6は、信号生成装置2における処理部としても機能する。   The signal generation device 2 includes a reference signal generation unit 31, a first DDS (Direct Digital Synthesizer) 32, a second DDS 33, a first switching unit 34, a plurality (four in this example) of filters 35, 36, 37, 38, and second A switching unit 39 is provided, and an output signal So having an arbitrary frequency within a plurality of use bands (use frequency bands) W1, W2, W3, and W4 (the same number as the number of filters (four in this example)) to be described later. It is configured so that it can be generated and output. The processing unit 6 also functions as a processing unit in the signal generation device 2.

基準信号生成部31は、例えば水晶発振器(図示せず)を備え、予め決められた周波数の基準信号(クロック信号)Scを生成して、各DDS32,33に出力する。また、図示はしないが、基準信号生成部31は、後述するようにCPUを含んで構成される処理部6に対しても、作動用のクロック信号を生成して出力する。   The reference signal generation unit 31 includes, for example, a crystal oscillator (not shown), generates a reference signal (clock signal) Sc having a predetermined frequency, and outputs the reference signal (clock signal) Sc to each of the DDSs 32 and 33. Although not shown, the reference signal generation unit 31 also generates and outputs an operation clock signal to the processing unit 6 including a CPU as will be described later.

第1DDS32は、基準信号Scに同期して作動して、処理部6によって設定された周波数データDfaで示される周波数faの第1信号(一例として正弦波信号)S1を生成して出力する。また、第1DDS32は、位相シフトレジスタ(不図示)を備え、処理部6によってこの位相シフトレジスタに設定された位相シフト量θaだけ位相をシフトして第1信号S1を出力する。   The first DDS 32 operates in synchronization with the reference signal Sc, and generates and outputs a first signal (for example, a sine wave signal) S1 having the frequency fa indicated by the frequency data Dfa set by the processing unit 6. Further, the first DDS 32 includes a phase shift register (not shown), and shifts the phase by the phase shift amount θa set in the phase shift register by the processing unit 6 and outputs the first signal S1.

第2DDS33も、基準信号Scに同期して作動して、処理部6によって設定された周波数データDfbで示される周波数fbの第2信号(一例として正弦波信号)S2を生成して出力する。また、第2DDS33は、位相シフトレジスタ(不図示)を備え、処理部6によってこの位相シフトレジスタに設定された位相シフト量θbだけ位相をシフトして第2信号S2を出力する。   The second DDS 33 also operates in synchronization with the reference signal Sc, and generates and outputs a second signal (for example, a sine wave signal) S2 having the frequency fb indicated by the frequency data Dfb set by the processing unit 6. The second DDS 33 includes a phase shift register (not shown), and shifts the phase by the phase shift amount θb set in the phase shift register by the processing unit 6 and outputs the second signal S2.

第1切替部34は、処理部6によって切替制御されて、2つのDDS32,33のうちの一方を複数のフィルタ35,36,37,38のうちから選択された1つのフィルタに接続すると共に、2つのDDS32,33のうちの他方を1つのフィルタ(一方のDDSと接続されたフィルタ)を除く他のフィルタ(残りのフィルタ)のうちから選択された他の1つのフィルタに接続する機能を備えている。一例として、第1切替部34は、処理部6によって切替制御される2つの切替スイッチ34a,34bを備え、切替スイッチ34aが第1DDS32と各フィルタ35,36,37,38との間に配設され、切替スイッチ34bが第2DDS33と各フィルタ35,36,37,38との間に配設されて構成されている。   The first switching unit 34 is controlled by the processing unit 6 to connect one of the two DDSs 32 and 33 to one filter selected from the plurality of filters 35, 36, 37, and 38. A function of connecting the other of the two DDSs 32 and 33 to another filter selected from the other filters (remaining filters) excluding one filter (a filter connected to one DDS) ing. As an example, the first switching unit 34 includes two switching switches 34 a and 34 b that are switched and controlled by the processing unit 6, and the switching switch 34 a is disposed between the first DDS 32 and the filters 35, 36, 37, and 38. The changeover switch 34b is arranged between the second DDS 33 and the filters 35, 36, 37, and 38.

この構成により、第1切替部34は、各切替スイッチ34a,34bが処理部6によって切替制御されることにより、第1DDS32を切替スイッチ34aを介してフィルタ35,36,37,38のうちから選択された1つのフィルタに接続することで、第1信号S1をこの選択された1つのフィルタに出力し、また第2DDS33を切替スイッチ34bを介してフィルタ35,36,37,38のうちから選択された他の1つのフィルタ(第1DDS32に接続されたフィルタ以外のフィルタ)に接続することで、第2信号S2をこの選択された他の1つのフィルタに出力する。   With this configuration, the first switching unit 34 selects the first DDS 32 from the filters 35, 36, 37, and 38 via the changeover switch 34 a when the changeover switches 34 a and 34 b are controlled by the processing unit 6. The first signal S1 is output to the selected one filter, and the second DDS 33 is selected from the filters 35, 36, 37, and 38 via the changeover switch 34b. By connecting to another filter (a filter other than the filter connected to the first DDS 32), the second signal S2 is output to the other selected filter.

フィルタ35,36,37,38は、一例として、図2の周波数特性図で示されるように、通過帯域がそれぞれ異なるローパスフィルタで構成されている。一例として、フィルタ35,36,37,38は、それぞれのカットオフ周波数fc1,fc2,fc3,fc4がfc1<fc2<fc3<fc4となるように規定されることで、フィルタ35の通過帯域よりもフィルタ36の通過帯域がより高域側に拡がり、フィルタ36の通過帯域よりもフィルタ37の通過帯域がより高域側に拡がり、フィルタ37の通過帯域よりもフィルタ38の通過帯域がより高域側に拡がるように構成されている。   As an example, the filters 35, 36, 37, and 38 are composed of low-pass filters having different pass bands as shown in the frequency characteristic diagram of FIG. 2. As an example, the filters 35, 36, 37, and 38 are defined such that the respective cutoff frequencies fc 1, fc 2, fc 3, and fc 4 satisfy fc 1 <fc 2 <fc 3 <fc 4, so that the filters 35, 36, 37, and 38 The pass band of the filter 36 is expanded to the higher frequency side, the pass band of the filter 37 is expanded to the higher frequency side than the pass band of the filter 36, and the pass band of the filter 38 is higher than the pass band of the filter 37. It is comprised so that it may spread.

この場合、図2に示すように、各使用帯域W1,W2,W3,W4は、使用帯域W1の高域側と使用帯域W2の低域側とが部分的に重複し、使用帯域W2の高域側と使用帯域W3の低域側とが部分的に重複し、使用帯域W3の高域側と使用帯域W4の低域側とが部分的に重複するように規定されることで、隣接する帯域同士が部分的に重複するように規定されている。なお、使用帯域W1,W2,W3,W4同士が重複する周波数帯域を、以下では重複帯域ともいう。   In this case, as shown in FIG. 2, in each of the use bands W1, W2, W3, and W4, the high band side of the use band W1 partially overlaps the low band side of the use band W2, and the high band of the use band W2 The band side and the low band side of the use band W3 are partially overlapped, and the high band side of the use band W3 and the low band side of the use band W4 are partially overlapped. It is defined that the bands partially overlap. A frequency band in which the use bands W1, W2, W3, and W4 overlap is also referred to as an overlap band below.

フィルタ35は、これらの使用帯域W1,W2,W3,W4のうちの使用帯域W1に対応して配設されている。具体的には、フィルタ35は、自らの通過帯域内における自らのカットオフ周波数fc1の近傍に使用帯域W1の上限周波数が位置するようにカットオフ周波数fc1が規定されることで、使用帯域W1に対応して配設されている。また、フィルタ36は、自らの通過帯域内における自らのカットオフ周波数fc2の近傍に使用帯域W2の上限周波数が位置するようにカットオフ周波数fc2が規定されることで、使用帯域W2に対応して配設されている。また、フィルタ37は、自らの通過帯域内における自らのカットオフ周波数fc3の近傍に使用帯域W3の上限周波数が位置するようにカットオフ周波数fc3が規定されることで、使用帯域W3に対応して配設されている。また、フィルタ38は、自らの通過帯域内における自らのカットオフ周波数fc4の近傍に使用帯域W4の上限周波数が位置するようにカットオフ周波数fc4が規定されることで、使用帯域W4に対応して配設されている。これにより、各フィルタ35,36,37,38は、それぞれの通過帯域に含まれる使用帯域の上限周波数がそれぞれのカットオフ周波数の近くになるように規定されることで、通過する各信号S1,S2に含まれている不要スプリアス成分を適切に除去し得るように構成されている。   The filter 35 is arranged corresponding to the use band W1 of these use bands W1, W2, W3, and W4. Specifically, the filter 35 defines the cut-off frequency fc1 so that the upper limit frequency of the use band W1 is positioned in the vicinity of the cut-off frequency fc1 within the passband of the filter 35. Correspondingly, they are arranged. In addition, the filter 36 corresponds to the use band W2 by defining the cut-off frequency fc2 so that the upper limit frequency of the use band W2 is located in the vicinity of the cut-off frequency fc2 of its own in the pass band of itself. It is arranged. In addition, the filter 37 has a cutoff frequency fc3 that is defined so that the upper limit frequency of the usage band W3 is located in the vicinity of the cutoff frequency fc3 of the filter 37 in the passband of the filter 37, so that the filter 37 corresponds to the usage band W3. It is arranged. Further, the filter 38 has a cutoff frequency fc4 defined so that the upper limit frequency of the usage band W4 is positioned in the vicinity of the cutoff frequency fc4 of the filter 38 in the passband of the filter 38, so that the filter 38 corresponds to the usage band W4. It is arranged. Thereby, each filter 35, 36, 37, 38 is defined so that the upper limit frequency of the use band included in each pass band is close to each cut-off frequency, so that each passing signal S1, An unnecessary spurious component included in S2 can be appropriately removed.

第2切替部39は、処理部6によって切替制御されることにより、2つのDDS32,33に接続された2つのフィルタから出力される第1信号S1および第2信号S2のいずれか一方を選択して出力信号Soとして出力する。具体的には、第2切替部39は、フィルタと同数(本例では4つ)であって、処理部6によってオン・オフ状態が制御されるスイッチ39a,39b,39c,39dを備え、スイッチ39aの一端がフィルタ35の出力端子に接続され、スイッチ39bの一端がフィルタ36の出力端子に接続され、スイッチ39cの一端がフィルタ37の出力端子に接続され、スイッチ39dの一端がフィルタ38の出力端子に接続され、かつスイッチ39a,39b,39c,39dの各他端が共通接続されて信号生成装置2における出力端子として構成されている。また、各スイッチ39a,39b,39c,39dの他端(信号生成装置2の出力端子)は、増幅部3の入力端子に接続されている。   The second switching unit 39 selects one of the first signal S1 and the second signal S2 output from the two filters connected to the two DDSs 32 and 33 by switching control by the processing unit 6. And output as an output signal So. Specifically, the second switching unit 39 includes switches 39a, 39b, 39c, and 39d, the number of which is the same as the number of filters (four in this example) and whose ON / OFF state is controlled by the processing unit 6. One end of 39a is connected to the output terminal of filter 35, one end of switch 39b is connected to the output terminal of filter 36, one end of switch 39c is connected to the output terminal of filter 37, and one end of switch 39d is the output of filter 38. The other ends of the switches 39a, 39b, 39c, and 39d are connected in common and configured as an output terminal in the signal generating device 2. The other end of each switch 39a, 39b, 39c, 39d (the output terminal of the signal generating device 2) is connected to the input terminal of the amplifying unit 3.

この構成により、第2切替部39は、各スイッチ39a,39b,39c,39dが処理部6によってオン・オフ状態が制御されることにより、各フィルタ35,36,37,38のうちの任意の1つ(具体的には、第1信号S1および第2信号S2をそれぞれ出力している2つのフィルタのうちの任意の1つ)を選択して、選択したフィルタから出力されている信号S1,S2の一方を出力信号Soとして出力する。   With this configuration, the second switching unit 39 is configured so that any one of the filters 35, 36, 37, and 38 is controlled by the switches 6 a, 39 b, 39 c, and 39 d being controlled by the processing unit 6. One (specifically, any one of the two filters outputting the first signal S1 and the second signal S2) is selected, and the signals S1, S1 output from the selected filter are selected. One of S2 is output as an output signal So.

増幅部3は、信号生成装置2から出力された出力信号Soを利得G(Gは適宜決定される値であり1以上でも1以下でもよい)で増幅して測定用信号Smとして出力すると共に、プローブ9を介して測定対象体21の一端に測定用信号Smを印加(供給)する。なお、利得Gが1以下でよいときには、増幅部3の配設を省略して、出力信号Soを測定用信号Smとして測定対象体21に印加することができる。電圧検出部4は、プローブ10,11を介して測定対象体21の各端部に接続される。また、電圧検出部4は、測定用信号Smの印加によって測定対象体21の両端間に発生する電圧Vdをプローブ10,11を介して検出して、電圧Vdの信号波形を示す電圧データDvを処理部6に出力する。電流検出部5は、測定対象体21の他端と基準電位(グランド)との間に配設されている。また、電流検出部5は、測定用信号Smの印加によって測定対象体21に流れる電流Idを検出して、電流Idの信号波形を示す電流データDiを処理部6に出力する。   The amplifying unit 3 amplifies the output signal So output from the signal generating device 2 with a gain G (G is a value determined as appropriate and may be 1 or more and 1 or less) and outputs the amplified signal as a measurement signal Sm. A measurement signal Sm is applied (supplied) to one end of the measurement object 21 via the probe 9. When the gain G may be 1 or less, the arrangement of the amplifier 3 can be omitted and the output signal So can be applied to the measurement object 21 as the measurement signal Sm. The voltage detection unit 4 is connected to each end of the measurement object 21 via the probes 10 and 11. Further, the voltage detection unit 4 detects the voltage Vd generated between both ends of the measurement object 21 by the application of the measurement signal Sm through the probes 10 and 11, and generates voltage data Dv indicating the signal waveform of the voltage Vd. Output to the processing unit 6. The current detection unit 5 is disposed between the other end of the measurement target body 21 and a reference potential (ground). Further, the current detection unit 5 detects the current Id flowing through the measurement object 21 by applying the measurement signal Sm, and outputs current data Di indicating the signal waveform of the current Id to the processing unit 6.

処理部6は、CPUを含んで構成されて、記憶部7に記憶されている動作プログラムに従って作動して、第1DDS32および第2DDS33に対して同一の周波数を同時に設定する周波数設定制御、第1DDS32および第2DDS33に対して位相シフト量θa,θbを個別に設定する位相設定制御、並びに第1切替部34および第2切替部39に対する切替制御を実行する。また、処理部6は、使用するフィルタ35,36,37,38をこの順で順次切り替えつつ、出力信号Soの周波数を上昇させるフィルタ切替処理(周波数上昇時のフィルタ切替処理)、および使用するフィルタ38,37,36,35をこの順で順次切り替えつつ、出力信号Soの周波数を低下させるフィルタ切替処理(周波数低下時のフィルタ切替処理)を実行する。また、処理部6は、電圧データDvと電流データDiとに基づいてインピーダンスZを測定する測定処理を実行する。   The processing unit 6 includes a CPU, operates according to an operation program stored in the storage unit 7, and sets the same frequency for the first DDS 32 and the second DDS 33 at the same time, the first DDS 32, Phase setting control for individually setting the phase shift amounts θa and θb for the second DDS 33 and switching control for the first switching unit 34 and the second switching unit 39 are executed. The processing unit 6 sequentially switches the filters 35, 36, 37, and 38 to be used in this order while increasing the frequency of the output signal So (filter switching process when the frequency is increased), and the filter to be used. While sequentially switching 38, 37, 36, and 35 in this order, a filter switching process for reducing the frequency of the output signal So (filter switching process when the frequency is lowered) is executed. In addition, the processing unit 6 performs a measurement process for measuring the impedance Z based on the voltage data Dv and the current data Di.

記憶部7は、処理部6の動作プログラムを記憶すると共に、処理部6のワークメモリとして機能する。また、記憶部7には、正弦波信号がフィルタ35を通過する際に生じる正弦波信号の周波数と位相シフト量との関係を示す位相についての周波数特性データテーブルDtp1、正弦波信号がフィルタ36を通過する際に生じる正弦波信号の周波数と位相シフト量との関係を示す位相の周波数特性データテーブルDtp2、正弦波信号がフィルタ37を通過する際に生じる正弦波信号の周波数と位相シフト量との関係を示す位相の周波数特性データテーブルDtp3、および正弦波信号がフィルタ38を通過する際に生じる正弦波信号の周波数と位相シフト量との関係を示す位相の周波数特性データテーブルDtp4が予め記憶されている。また、記憶部7には、出力信号Soの周波数を低下させる際の共通周波数f12,f23,f34が記憶されている。   The storage unit 7 stores an operation program for the processing unit 6 and functions as a work memory for the processing unit 6. The storage unit 7 also stores a frequency characteristic data table Dtp1 for the phase indicating the relationship between the frequency of the sine wave signal generated when the sine wave signal passes through the filter 35 and the phase shift amount, and the sine wave signal passes through the filter 36. Phase frequency characteristic data table Dtp2 showing the relationship between the frequency of the sine wave signal generated when passing and the phase shift amount, and the frequency and phase shift amount of the sine wave signal generated when the sine wave signal passes through the filter 37 The phase frequency characteristic data table Dtp3 indicating the relationship and the phase frequency characteristic data table Dtp4 indicating the relationship between the frequency of the sine wave signal generated when the sine wave signal passes through the filter 38 and the phase shift amount are stored in advance. Yes. The storage unit 7 stores common frequencies f12, f23, and f34 when the frequency of the output signal So is decreased.

出力部8は、一例としてLCD(Liquid Crystal Display)などの表示装置で構成されて、測定したインピーダンスZを画面に表示させる。   The output unit 8 is configured by a display device such as an LCD (Liquid Crystal Display) as an example, and displays the measured impedance Z on the screen.

次いで、インピーダンス測定装置1の動作について説明する。なお、フィルタ35,36,37,38の仕様(各周波数特性および各使用帯域W1,W2,W3,W4)が決定された時点で、例えば不図示の操作部から処理部6に対して、上記の各周波数特性データテーブルDtp1,Dtp2,Dtp3,Dtp4と共に、出力信号Soの周波数を低下させる際の共通周波数、つまり、フィルタ38からフィルタ37に切り替える際の周波数f34(使用帯域W3と使用帯域W4との重複帯域内に規定された周波数)、フィルタ37からフィルタ36に切り替える際の周波数f23(使用帯域W2と使用帯域W3との重複帯域内に規定された周波数)、フィルタ36からフィルタ35に切り替える際の周波数f12(使用帯域W1と使用帯域W2との重複帯域内に規定された周波数)が入力され、処理部6がこれらの各データを記憶部7に記憶するものとする。また、各プローブ9,10は測定対象体21の一端に、各プローブ11,12は測定対象体21の他端に予め接続されているものとする。   Next, the operation of the impedance measuring apparatus 1 will be described. When the specifications of the filters 35, 36, 37, and 38 (each frequency characteristic and each use band W1, W2, W3, and W4) are determined, for example, the operation unit (not shown) sends Together with the frequency characteristic data tables Dtp1, Dtp2, Dtp3, and Dtp4, the common frequency when the frequency of the output signal So is reduced, that is, the frequency f34 when switching from the filter 38 to the filter 37 (the used band W3 and the used band W4). When switching from the filter 37 to the filter 36, when switching from the filter 36 to the filter 35, the frequency f23 when switching from the filter 37 to the filter 36 (frequency defined within the overlapping band between the use band W2 and the use band W3). Frequency f12 (frequency defined in the overlapping band of the use band W1 and the use band W2) is input and processed 6 it is assumed that stores each of these data in the storage unit 7. Each probe 9 and 10 is connected in advance to one end of the measurement object 21 and each probe 11 and 12 is connected in advance to the other end of the measurement object 21.

また、処理部6は、第1DDS32および第2DDS33に対して、第1信号S1および第2信号S2の周波数を同一に設定した状態で同時に起動し、かつ起動後における各信号S1,S2の周波数の変更に際しても、同一の周波数に同時に切り替える周波数設定制御を実行する。このため、第1DDS32および第2DDS33は、両者に対して処理部6から特段の位相設定制御が個別に実行されていない状態では、同一の周波数で、かつ各位相シフトレジスタに設定された位相シフト量θa,θbが一致した状態(本例では共にゼロの状態)で第1信号S1および第2信号S2を出力しているものとする。   The processing unit 6 is activated simultaneously with the first DDS 32 and the second DDS 33 set with the same frequency of the first signal S1 and the second signal S2, and the frequency of each of the signals S1 and S2 after activation. Even when the change is made, frequency setting control for simultaneously switching to the same frequency is executed. For this reason, the first DDS 32 and the second DDS 33 have the same frequency and the phase shift amount set in each phase shift register in a state where special phase setting control is not separately executed from the processing unit 6 for both. It is assumed that the first signal S1 and the second signal S2 are output in a state where θa and θb coincide (both are zero in this example).

インピーダンス測定装置1の作動状態では、基準信号生成部31は基準信号Scの出力を開始している。この状態において、処理部6は、最初に、測定用信号Smの周波数をf1,f2,f3,f4というように順次上昇させつつ、各周波数f1,f2,f3,f4の測定用信号Smを測定対象体21に印加したときの測定対象体21のインピーダンスZの測定を実行する。   In the operating state of the impedance measuring apparatus 1, the reference signal generator 31 starts outputting the reference signal Sc. In this state, the processing unit 6 first measures the measurement signal Sm of each frequency f1, f2, f3, and f4 while sequentially increasing the frequency of the measurement signal Sm to f1, f2, f3, and f4. Measurement of the impedance Z of the measurement object 21 when applied to the object 21 is executed.

この測定では、処理部6は、まず、第1切替部34に対する切替制御を実行することにより、切替スイッチ34aを介してフィルタ35(この場合には、一のフィルタ)に第1DDS32(この場合には、一のDDS)を接続する。また、処理部6は、第2切替部39に対する切替制御を実行することにより(具体的には、スイッチ39aをオン状態に移行させ、他のスイッチ39b〜39dをオフ状態に移行させることにより)、第2切替部39のスイッチ39aを介してフィルタ35を増幅部3に接続する。これにより、第1DDS32から出力される第1信号S1(この場合には、一の信号)が、第1切替部34、フィルタ35および第2切替部39を介して出力信号Soとして出力可能な状態となる。   In this measurement, the processing unit 6 first executes the switching control for the first switching unit 34, thereby causing the filter 35 (in this case, one filter) to pass through the first DDS 32 (in this case) via the switch 34a. Connect one DDS). Further, the processing unit 6 performs switching control on the second switching unit 39 (specifically, by shifting the switch 39a to the on state and shifting the other switches 39b to 39d to the off state). The filter 35 is connected to the amplifying unit 3 through the switch 39a of the second switching unit 39. Thereby, the first signal S1 (in this case, one signal) output from the first DDS 32 can be output as the output signal So via the first switching unit 34, the filter 35, and the second switching unit 39. It becomes.

次いで、処理部6は、第1DDS32および第2DDS33に対して、周波数f1(同一の周波数)を示す周波数データDfa,Dfbをそれぞれ出力して設定する(周波数設定制御を実行する)。また、処理部6は、第1DDS32および第2DDS33の位相シフトレジスタの値をリセットする。具体的には、処理部6は、第1DDS32および第2DDS33に対して、位相シフト量θa,θb(共にゼロ)をそれぞれ出力して設定する(位相設定制御を実行する)。引き続いて、処理部6は、第1DDS32および第2DDS33を同時に作動させる。   Next, the processing unit 6 outputs and sets the frequency data Dfa and Dfb indicating the frequency f1 (the same frequency) for the first DDS 32 and the second DDS 33 (executes frequency setting control). Further, the processing unit 6 resets the values of the phase shift registers of the first DDS 32 and the second DDS 33. Specifically, the processing unit 6 outputs and sets the phase shift amounts θa and θb (both are zero) to the first DDS 32 and the second DDS 33 (executes phase setting control). Subsequently, the processing unit 6 operates the first DDS 32 and the second DDS 33 simultaneously.

これにより、第1DDS32(一のDDS)が、複数のフィルタ35〜38の複数の通過帯域(図2に示される4つの通過帯域)のうちのフィルタ35の通過帯域(一の通過帯域)に含まれる周波数f1(一の周波数)の第1信号S1(一の信号)の出力を開始し、第2DDS33(この場合、他のDDS)が、第1信号S1と同一の周波数f1(一の周波数)で、かつ同位相の第2信号S2(この場合、他の信号)の出力を開始する。また、第1切替部34および第2切替部39に対して上記のような切替制御が処理部6によってなされているため、第1DDS32から出力されている第1信号S1が、図2に示す通過帯域(この場合、一の通過帯域)に規定されたフィルタ35を介して第2切替部39から出力信号Soとして出力される(つまり、信号生成装置2から第1信号S1が出力信号Soとして出力される)。   Accordingly, the first DDS 32 (one DDS) is included in the pass band (one pass band) of the filter 35 among the plurality of pass bands (four pass bands shown in FIG. 2) of the plurality of filters 35 to 38. The output of the first signal S1 (one signal) of the frequency f1 (one frequency) is started, and the second DDS 33 (in this case, the other DDS) is the same frequency f1 (one frequency) as the first signal S1. And the output of the second signal S2 (in this case, another signal) having the same phase is started. Further, since the switching control as described above is performed on the first switching unit 34 and the second switching unit 39 by the processing unit 6, the first signal S1 output from the first DDS 32 passes through the passage shown in FIG. The output signal So is output from the second switching unit 39 through the filter 35 defined in the band (in this case, one pass band) (that is, the first signal S1 is output as the output signal So from the signal generator 2). )

増幅部3は、この出力信号Soを増幅して測定用信号Smとして出力し、プローブ9を介して測定対象体21に印加する。これにより、電流Idが測定対象体21に流れて、電圧Vdが測定対象体21の両端間に発生する。電圧検出部4は電圧Vdを検出して電圧データDvを処理部6に出力し、電流検出部5は電流Idを検出して電流データDiを処理部6に出力する。   The amplifying unit 3 amplifies the output signal So, outputs it as a measurement signal Sm, and applies it to the measurement object 21 via the probe 9. As a result, the current Id flows through the measurement target body 21, and the voltage Vd is generated across the measurement target body 21. The voltage detection unit 4 detects the voltage Vd and outputs voltage data Dv to the processing unit 6, and the current detection unit 5 detects the current Id and outputs current data Di to the processing unit 6.

続いて、処理部6は、インピーダンスZの測定処理を実行する。この測定処理では、処理部6は、まず、電圧データDvおよび電流データDiを入力しつつ、記憶部7に予め決められたデータ数(例えば、測定用信号Smの1周期分のデータ数)を記憶させる。次いで、処理部6は、記憶部7に記憶されている電圧データDvおよび電流データDiに基づいて、電圧データDvで示される電圧Vdおよび電流データDiで示される電流Idの各振幅(電圧Vdの電圧振幅および電流Idの電流振幅)と、電圧Vdおよび電流Id間の位相差とを算出し、算出した各振幅と位相差とに基づいて、測定対象体21のインピーダンスZを算出する。続いて、処理部6は、算出したインピーダンスZを、測定用信号Smの周波数(この例では、上昇時の周波数f1)に対応させて記憶部7に記憶させる。これにより、周波数f1の測定用信号Smを測定対象体21に印加したときのインピーダンスZの測定についても完了する。   Subsequently, the processing unit 6 performs an impedance Z measurement process. In this measurement process, the processing unit 6 first inputs the voltage data Dv and the current data Di, and stores a predetermined number of data (for example, the number of data for one cycle of the measurement signal Sm) in the storage unit 7. Remember me. Next, based on the voltage data Dv and current data Di stored in the storage unit 7, the processing unit 6 determines each amplitude (the voltage Vd) of the voltage Vd indicated by the voltage data Dv and the current Id indicated by the current data Di. The voltage amplitude and the current amplitude of the current Id) and the phase difference between the voltage Vd and the current Id are calculated, and the impedance Z of the measuring object 21 is calculated based on the calculated amplitude and phase difference. Subsequently, the processing unit 6 stores the calculated impedance Z in the storage unit 7 in association with the frequency of the measurement signal Sm (in this example, the rising frequency f1). Thus, the measurement of the impedance Z when the measurement signal Sm having the frequency f1 is applied to the measurement object 21 is also completed.

次いで、このように両DDS32,33がフィルタ35の通過帯域に含まれている周波数f1(一の周波数)の第1信号S1および第2信号S2を出力し、これらの信号S1,S2のうちの第1信号S1(この場合、一の信号)がフィルタ35を介して出力信号Soとして出力されている状態において、信号生成装置2では、処理部6は、周波数f2(この場合、他の周波数)の測定用信号Smを測定対象体21に印加したときのインピーダンスZの測定を行うため、第1信号S1(一の信号)に代えて、フィルタ35の通過帯域(この場合、一の通過帯域)と部分的に重複する他の通過帯域(この場合、フィルタ36の通過帯域)に含まれる周波数f2の第2信号S2(この場合、他の信号)を出力信号Soとして出力させる処理を開始する。   Next, both the DDSs 32 and 33 output the first signal S1 and the second signal S2 of the frequency f1 (one frequency) included in the passband of the filter 35 in this way, and among these signals S1 and S2, In the state where the first signal S1 (in this case, one signal) is being output as the output signal So through the filter 35, in the signal generating device 2, the processing unit 6 has the frequency f2 (in this case, another frequency). In order to measure the impedance Z when the measurement signal Sm is applied to the measurement object 21, the pass band of the filter 35 (in this case, one pass band) is used instead of the first signal S1 (one signal). Starts the process of outputting the second signal S2 (in this case, another signal) of the frequency f2 included in another passband that partially overlaps with the filter 36 (in this case, the passband of the filter 36) as the output signal So. .

この処理では、処理部6は、まず、第1切替部34に対する切替制御を実行して第2DDS33(この場合、他のDDS)をフィルタ36〜38のうちの通過帯域が上記のようにフィルタ35(一のフィルタ)と部分的に重複するフィルタ36(他のフィルタ)に接続する。本例では、各フィルタ35〜38は共にローパスフィルタであって、図2に示すように、カットオフ周波数がこの順に高くなるように規定されているため、カットオフ周波数の低いフィルタの通過帯域が、カットオフ周波数のより高いフィルタの通過帯域内に包含される構成となっている。したがって、最もカットオフ周波数の低いフィルタ35の通過帯域が他のすべてのフィルタ36〜38の通過帯域に包含される構成となっていることから、フィルタ35の通過帯域と通過帯域が部分的に重複するフィルタとしては、他のすべてのフィルタ36〜38が該当するが、出力信号Soとして次に出力させる第2信号S2の周波数f2が、フィルタ35の使用帯域W1に隣接するフィルタ36の使用帯域W2に含まれるものであるため、第2DDS33をこのフィルタ36に接続する。   In this process, the processing unit 6 first executes switching control on the first switching unit 34 to pass the second DDS 33 (in this case, another DDS) to the filter 35 as described above with the passband of the filters 36 to 38 as described above. It is connected to a filter 36 (other filter) partially overlapping with (one filter). In this example, each of the filters 35 to 38 is a low-pass filter, and as shown in FIG. 2, it is specified that the cutoff frequency becomes higher in this order. The filter is included in the pass band of a filter having a higher cutoff frequency. Therefore, since the pass band of the filter 35 having the lowest cutoff frequency is included in the pass bands of all the other filters 36 to 38, the pass band and the pass band of the filter 35 partially overlap. All other filters 36 to 38 are applicable to the filter to be used, but the frequency f2 of the second signal S2 to be output next as the output signal So is the use band W2 of the filter 36 adjacent to the use band W1 of the filter 35. Therefore, the second DDS 33 is connected to the filter 36.

次いで、処理部6は、図3に示すフィルタ切替処理50を実行することにより、出力信号Soとして信号生成装置2から出力される信号を、周波数f1の第1信号S1から周波数f2の第2信号S2に、実質的に位相に不連続を生じさせることなく切り替える。   Next, the processing unit 6 executes the filter switching process 50 shown in FIG. 3 to convert the signal output from the signal generation device 2 as the output signal So into the second signal from the first signal S1 having the frequency f1 to the second signal having the frequency f2. Switch to S2 without causing a discontinuity in the phase substantially.

このフィルタ切替処理50では、処理部6は、まず、周波数前変更処理51を実行する。この周波数前変更処理51では、処理部6は、両DDS32,33に対する周波数設定制御を実行することにより、第1DDS32(一のDDS)から出力される第1信号S1(一の信号)および第2DDS33(他のDDS)から出力される第2信号S2(他の信号)の各周波数を、フィルタ35の通過帯域(一の通過帯域)およびフィルタ36の通過帯域(他の通過帯域)の重複する帯域に含まれる共通周波数に設定する。本例では、上記したように各フィルタ35〜38が図2に示す周波数特性のローパスフィルタに構成されているため、第1DDS32および第2DDS33が周波数f1の第1信号S1および第2信号S2を出力している状態において、この周波数f1が、既にフィルタ35の通過帯域とフィルタ36の通過帯域との重複する帯域に含まれた状態となっており、実質的に周波数前変更処理51を実行した状態となっている。このため、処理部6は、出力信号Soの周波数を上昇させる際のフィルタ切替処理50では、この周波数前変更処理51を実行したものとして、次に処理に移行する。   In the filter switching process 50, the processing unit 6 first executes a pre-frequency change process 51. In the pre-frequency changing process 51, the processing unit 6 executes frequency setting control for both the DDSs 32 and 33, whereby the first signal S1 (one signal) and the second DDS 33 output from the first DDS 32 (one DDS). Each frequency of the second signal S2 (other signal) output from (other DDS) is a band in which the pass band (one pass band) of the filter 35 and the pass band (other pass band) of the filter 36 overlap. Set to the common frequency included in. In this example, since each of the filters 35 to 38 is configured as the low-pass filter having the frequency characteristics shown in FIG. 2 as described above, the first DDS 32 and the second DDS 33 output the first signal S1 and the second signal S2 having the frequency f1. In this state, the frequency f1 is already included in a band where the pass band of the filter 35 and the pass band of the filter 36 overlap, and the frequency pre-change process 51 is substantially executed. It has become. For this reason, in the filter switching process 50 when increasing the frequency of the output signal So, the processing unit 6 proceeds to the next process assuming that the pre-frequency change process 51 is executed.

続いて、処理部6は、位相補正処理52を実行する。この位相補正処理52では、処理部6は、第2DDS33(他のDDS)に対する位相設定制御を実行して、第2DDS33に接続されているフィルタ36(他のフィルタ)から出力されている第2信号S2(他の信号)の位相を、フィルタ35(一のフィルタ)から出力されている第1信号S1(一の信号)の位相に一致させる。   Subsequently, the processing unit 6 executes a phase correction process 52. In the phase correction process 52, the processing unit 6 executes phase setting control for the second DDS 33 (other DDS) and outputs the second signal output from the filter 36 (other filter) connected to the second DDS 33. The phase of S2 (other signal) is matched with the phase of the first signal S1 (one signal) output from the filter 35 (one filter).

具体的には、処理部6は、まず、周波数f1における各フィルタ35,36の位相シフト量b1,b2を記憶部7に記憶されている各フィルタ35,36についての周波数特性データテーブルDtp1,Dtp2を参照して特定する。次いで、処理部6は、現在、出力信号Soとしての第1信号S1を出力している第1DDS32(一のDDS)の位相シフトレジスタに設定されている現時点での位相シフト量θa(=0)、周波数f1(各フィルタ35,36での共通周波数)におけるフィルタ35(一のフィルタ)の位相シフト量b1、および周波数f1におけるフィルタ36(他のフィルタ)の位相シフト量b2に基づき、第2DDS33(他のDDS)の位相シフトレジスタに新たに位相シフト量θbを設定した場合に、第1DDS32および第2DDS33の各位相シフト量θa(=0),θbの差(θb−0)が、共通周波数f1におけるフィルタ35,36の各位相シフト量b1,b2の差分(b1−b2)と等しくなるように第2DDS33に対する位相シフト量θbを設定する。   Specifically, the processing unit 6 firstly sets the frequency characteristic data tables Dtp1 and Dtp2 for the filters 35 and 36 stored in the storage unit 7 with the phase shift amounts b1 and b2 of the filters 35 and 36 at the frequency f1. To identify. Next, the processing unit 6 currently sets the phase shift register θa (= 0) in the phase shift register of the first DDS 32 (one DDS) that is currently outputting the first signal S1 as the output signal So. Based on the phase shift amount b1 of the filter 35 (one filter) at the frequency f1 (common frequency of the filters 35 and 36) and the phase shift amount b2 of the filter 36 (another filter) at the frequency f1, the second DDS 33 ( When the phase shift amount θb is newly set in the phase shift register of the other DDS), the difference (θb−0) between the phase shift amounts θa (= 0) and θb of the first DDS 32 and the second DDS 33 is the common frequency f1. The phase shift with respect to the second DDS 33 so as to be equal to the difference (b1−b2) between the phase shift amounts b1 and b2 of the filters 35 and 36 in FIG. The amount θb is set.

この場合、θb−0=b1−b2との関係式から、処理部6は、第2DDS33の位相シフトレジスタに設定すべき位相シフト量θbを(b1−b2)と算出して、これを第2DDS33に設定する(図4参照)。これにより、第2DDS33での第2信号S2の位相シフト量θbは(b1−b2)となり、この第2信号S2はフィルタ36を通過することによってフィルタ36の位相シフト量b2だけ遅延する。このため、第1DDS32から出力されている第1信号S1の位相を基準として、フィルタ36から出力される第2信号S2の位相は、b1(=(b1−b2)+b2)だけ遅延する。一方、第1DDS32から出力されている第1信号S1の位相を基準として、フィルタ35から出力される第1信号S1の位相は、フィルタ35の位相シフト量b1(=0+b1)だけ遅延する。したがって、フィルタ35から出力されている第1信号S1の位相と、フィルタ36から出力されている第2信号S2の位相とが一致した状態となる。   In this case, from the relational expression θb−0 = b1−b2, the processing unit 6 calculates the phase shift amount θb to be set in the phase shift register of the second DDS 33 as (b1−b2), and this is calculated as the second DDS 33. (See FIG. 4). Accordingly, the phase shift amount θb of the second signal S2 in the second DDS 33 becomes (b1-b2), and the second signal S2 is delayed by the phase shift amount b2 of the filter 36 by passing through the filter 36. For this reason, the phase of the second signal S2 output from the filter 36 is delayed by b1 (= (b1−b2) + b2) with the phase of the first signal S1 output from the first DDS 32 as a reference. On the other hand, with the phase of the first signal S1 output from the first DDS 32 as a reference, the phase of the first signal S1 output from the filter 35 is delayed by the phase shift amount b1 (= 0 + b1) of the filter 35. Therefore, the phase of the first signal S1 output from the filter 35 and the phase of the second signal S2 output from the filter 36 coincide with each other.

なお、各DDS32,33では、各信号S1,S2の周波数が変更されることにより、周波数の変更の前後における各信号S1,S2の位相も変化するが、同一の周波数から他の同一の周波数に同時に変更される場合には、両DDS32,33から出力される信号S1,S2間の位相関係は変更されずに一定に保たれる。このため、位相補正処理において、切替後に使用されるDDSに対する位相シフト量の算出に際しては、それ以前に行った周波数変更の際に生じた位相シフト量を考慮する必要はない。   In each DDS 32 and 33, the phase of each signal S1 and S2 before and after the change in frequency is changed by changing the frequency of each signal S1 and S2, but from the same frequency to another same frequency When they are changed simultaneously, the phase relationship between the signals S1 and S2 output from both DDSs 32 and 33 is kept unchanged without being changed. For this reason, in the phase correction processing, when calculating the phase shift amount for the DDS used after switching, it is not necessary to consider the phase shift amount generated when the frequency is changed before that.

次いで、処理部6は、信号切替処理53を実行する。この信号切替処理53では、処理部6は、第2切替部39に対する切替制御を実行して、出力信号Soを第1信号S1から第2信号S2に切り替える。具体的には、処理部6は、第2切替部39に対して、スイッチ39aをオン状態からオフ状態に移行させると同時に、オフ状態にある残りのスイッチ39b〜39dのうちのスイッチ39bのみをオン状態に移行させる切替制御を実行する。これにより、フィルタ35から出力されている第1信号S1に代えて、フィルタ36から出力されている第2信号S2が第2切替部39を介して出力信号Soとして信号生成装置2から出力される。この場合、上記したように、各フィルタ35,36から出力されている第1信号S1および第2信号S2の周波数が同一であって、かつ位相が一致した状態にあるため、第1信号S1から第2信号S2に切り替える際に生じる位相の不連続が、理論的にはゼロに、また第2切替部39において生じる各スイッチ39a〜39dのオンからオフへ、オフからオンへの遷移時間のばらつきを考慮したとしても大幅に低減されている。つまり、第1信号S1から第2信号S2に、実質的に位相に不連続を生じさせることなく切り替えられる。   Next, the processing unit 6 executes a signal switching process 53. In the signal switching process 53, the processing unit 6 executes switching control for the second switching unit 39 to switch the output signal So from the first signal S1 to the second signal S2. Specifically, the processing unit 6 causes the second switching unit 39 to shift the switch 39a from the on state to the off state, and at the same time, switches only the switch 39b among the remaining switches 39b to 39d in the off state. The switching control for shifting to the on state is executed. Thereby, instead of the first signal S1 output from the filter 35, the second signal S2 output from the filter 36 is output from the signal generating device 2 as the output signal So via the second switching unit 39. . In this case, as described above, since the first signal S1 and the second signal S2 output from the filters 35 and 36 have the same frequency and the same phase, the first signal S1 The phase discontinuity that occurs when switching to the second signal S2 is theoretically zero, and variation in the transition time from ON to OFF of each switch 39a to 39d and OFF to ON that occurs in the second switching unit 39 Even if this is taken into consideration, the amount is greatly reduced. That is, switching from the first signal S1 to the second signal S2 is performed without causing a phase discontinuity substantially.

続いて、処理部6は、周波数変更処理54を実行する。この周波数変更処理54では、処理部6は、各DDS32,33に対して周波数設定制御を同時に実行することにより、各DDS32,33から出力される第1信号S1および第2信号S2の周波数をフィルタ36の通過帯域内に規定された使用帯域W2内における周波数f2に設定する。具体的には、処理部6は、第1DDS32および第2DDS33に対して、周波数f2を示す周波数データDfa,Dfbをそれぞれ出力して同時に設定する。これにより、第2DDS33から出力されている第2信号S2が、図2に示す通過帯域(この場合、他の通過帯域)に規定されたフィルタ36を介して第2切替部39から出力信号Soとして出力される(つまり、信号生成装置2から第2信号S2が出力信号Soとして出力される)。   Subsequently, the processing unit 6 executes a frequency change process 54. In the frequency changing process 54, the processing unit 6 simultaneously performs frequency setting control on the DDSs 32 and 33, thereby filtering the frequencies of the first signal S1 and the second signal S2 output from the DDSs 32 and 33. The frequency f2 in the use band W2 defined in the 36 passbands is set. Specifically, the processing unit 6 outputs frequency data Dfa and Dfb indicating the frequency f2 to the first DDS 32 and the second DDS 33, respectively, and sets them simultaneously. Thus, the second signal S2 output from the second DDS 33 is output as the output signal So from the second switching unit 39 via the filter 36 defined in the pass band (in this case, another pass band) shown in FIG. (That is, the second signal S2 is output as the output signal So from the signal generating device 2).

これにより、この周波数f2の出力信号Soが増幅部3において増幅されて、測定用信号Smとして測定対象体21に印加される。次いで、処理部6は、上記した周波数がf1の出力信号Soを印加したときのインピーダンスZの測定処理と同様にして、測定対象体21のインピーダンスZを算出し、算出したインピーダンスZを、測定用信号Smの周波数(この例では上昇時の周波数f2)に対応させて記憶部7に記憶させる。これにより、周波数f2の測定用信号Smを測定対象体21に印加したときのインピーダンスZの測定についても完了する。   As a result, the output signal So having the frequency f2 is amplified by the amplifying unit 3 and applied to the measurement object 21 as the measurement signal Sm. Next, the processing unit 6 calculates the impedance Z of the measurement object 21 in the same manner as the measurement process of the impedance Z when the output signal So having the frequency f1 is applied, and uses the calculated impedance Z for measurement. The signal is stored in the storage unit 7 in correspondence with the frequency of the signal Sm (in this example, the rising frequency f2). Thus, the measurement of the impedance Z when the measurement signal Sm having the frequency f2 is applied to the measurement object 21 is also completed.

次いで、このように両DDS32,33がフィルタ36の通過帯域に含まれている周波数f2(一の周波数)の第1信号S1および第2信号S2を出力し、これらの信号S1,S2のうちの第2信号S2がフィルタ36を介して出力信号Soとして出力されている状態において、信号生成装置2では、処理部6は、周波数f3の測定用信号Smを測定対象体21に印加したときのインピーダンスZの測定を行うため、第2信号S2(この場合、一の信号)に代えて、フィルタ36(一のフィルタ)の通過帯域(この場合、一の通過帯域)と部分的に重複する他の通過帯域(この場合、フィルタ37の通過帯域)に含まれる周波数f3(この場合、他の周波数)の第1信号S1(この場合、他の信号)を出力信号Soとして出力させる処理を開始する。   Next, both the DDSs 32 and 33 output the first signal S1 and the second signal S2 of the frequency f2 (one frequency) included in the pass band of the filter 36 in this way, and among these signals S1 and S2, In the state where the second signal S2 is being output as the output signal So through the filter 36, in the signal generating device 2, the processing unit 6 applies the impedance when the measurement signal Sm having the frequency f3 is applied to the measurement object 21. In order to perform the measurement of Z, instead of the second signal S2 (in this case, one signal), another signal that partially overlaps the pass band (in this case, one pass band) of the filter 36 (one filter) Processing for outputting the first signal S1 (in this case, another signal) of the frequency f3 (in this case, other frequency) included in the passband (in this case, the passband of the filter 37) as the output signal So is started. To.

この処理では、処理部6は、まず、第1切替部34に対する切替制御を実行して第1DDS32(この場合、他のDDS)をフィルタ37(他のフィルタ)に接続する。本例では、カットオフ周波数の低いフィルタ36の通過帯域が、カットオフ周波数のより高い他のフィルタ37,38の通過帯域に包含される構成となっていることから、フィルタ36の通過帯域と通過帯域が部分的に重複するこの種のフィルタとしては、2つのフィルタ37,38が該当するが、出力信号Soとして次に出力させる第1信号S1の周波数f3が、フィルタ36の使用帯域W2に隣接するフィルタ37の使用帯域W3に含まれるものであるため、第1DDS32をこのフィルタ37に接続する。   In this process, the processing unit 6 first performs switching control on the first switching unit 34 to connect the first DDS 32 (in this case, another DDS) to the filter 37 (other filter). In this example, the pass band of the filter 36 having a low cut-off frequency is included in the pass bands of the other filters 37 and 38 having a higher cut-off frequency. Two filters 37 and 38 correspond to this type of filter with a partially overlapping band, but the frequency f3 of the first signal S1 to be output next as the output signal So is adjacent to the use band W2 of the filter 36. The first DDS 32 is connected to the filter 37 because it is included in the use band W <b> 3 of the filter 37.

次いで、処理部6は、図3に示すフィルタ切替処理50を実行することにより、出力信号Soとして信号生成装置2から出力される信号を、周波数f2の第2信号S2から周波数f3の第1信号S1に、実質的に位相に不連続を生じさせることなく切り替える。   Next, the processing unit 6 executes the filter switching process 50 shown in FIG. 3 to change the signal output from the signal generation device 2 as the output signal So, from the second signal S2 having the frequency f2 to the first signal having the frequency f3. Switching to S1 is made without causing a discontinuity in the phase substantially.

このフィルタ切替処理50では、処理部6は、まず、周波数前変更処理51を実行する。この周波数前変更処理51では、処理部6は、両DDS32,33に対する周波数設定制御を実行することにより、第2DDS33(この場合、一のDDS)から出力される第2信号S2(この場合、一の信号)および第1DDS32(この場合、他のDDS)から出力される第1信号S1(この場合、他の信号)の各周波数を、フィルタ36の通過帯域(一の通過帯域)およびフィルタ37の通過帯域(他の通過帯域)の重複する帯域に含まれる共通周波数に設定する。本例では、第1DDS32および第2DDS33が周波数f2の第1信号S1および第2信号S2を出力している状態において、この周波数f2が、既にフィルタ36の通過帯域とフィルタ37の通過帯域との重複する帯域に含まれた状態となっている。このため、処理部6は、この周波数前変更処理51を実行したものとして、次に処理に移行する。   In the filter switching process 50, the processing unit 6 first executes a pre-frequency change process 51. In the pre-frequency change process 51, the processing unit 6 executes frequency setting control for both the DDSs 32 and 33, so that the second signal S2 (in this case, one DDS) output from the second DDS 33 (in this case, one DDS). ) And the first signal S1 (other signals in this case) output from the first DDS 32 (in this case, other DDS), the frequencies of the filter 36 pass band (one pass band) and the filter 37 The common frequency included in the band where the pass band (other pass band) overlaps is set. In this example, in a state where the first DDS 32 and the second DDS 33 output the first signal S1 and the second signal S2 having the frequency f2, the frequency f2 is already overlapped with the passband of the filter 36 and the passband of the filter 37. It is in a state that is included in the band. Therefore, the processing unit 6 proceeds to the next processing, assuming that the pre-frequency change processing 51 has been executed.

続いて、処理部6は、位相補正処理52を実行する。この位相補正処理52では、処理部6は、第1DDS32(他のDDS)に対する位相設定制御を実行して、第1DDS32に接続されているフィルタ37(他のフィルタ)から出力されている第1信号S1(他の信号)の位相を、フィルタ36(一のフィルタ)から出力されている第2信号S2(一の信号)の位相に一致させる。   Subsequently, the processing unit 6 executes a phase correction process 52. In the phase correction process 52, the processing unit 6 executes phase setting control for the first DDS 32 (other DDS) and outputs the first signal output from the filter 37 (other filter) connected to the first DDS 32. The phase of S1 (other signal) is matched with the phase of the second signal S2 (one signal) output from the filter 36 (one filter).

具体的には、処理部6は、まず、周波数f2における各フィルタ36,37の位相シフト量b2,b3を記憶部7に記憶されている各フィルタ36,37についての周波数特性データテーブルDtp2,Dtp3を参照して特定する。次いで、処理部6は、現在、出力信号Soとしての第2信号S2を出力している第2DDS33(一のDDS)の位相シフトレジスタに設定されている現時点での位相シフト量θb(=b1−b2)、周波数f2(各フィルタ36,37での共通周波数)におけるフィルタ36(一のフィルタ)の位相シフト量b2、および周波数f2におけるフィルタ37(他のフィルタ)の位相シフト量b3に基づき、第1DDS32(他のDDS)の位相シフトレジスタに新たに位相シフト量θaを設定した場合に、第2DDS33および第1DDS32の各位相シフト量θb,θaの差(θa−(b1−b2))が、共通周波数f2におけるフィルタ36,37の各位相シフト量b2,b3の差分(b2−b3)と等しくなるように第1DDS32に対する位相シフト量θaを設定する。   Specifically, the processing unit 6 firstly sets the phase shift amounts b2 and b3 of the filters 36 and 37 at the frequency f2 to the frequency characteristic data tables Dtp2 and Dtp3 for the filters 36 and 37 stored in the storage unit 7, respectively. To identify. Next, the processing unit 6 currently sets the phase shift amount θb (= b1−) set in the phase shift register of the second DDS 33 (one DDS) that is outputting the second signal S2 as the output signal So. b2), based on the phase shift amount b2 of the filter 36 (one filter) at the frequency f2 (common frequency of the filters 36 and 37) and the phase shift amount b3 of the filter 37 (other filter) at the frequency f2. When the phase shift amount θa is newly set in the phase shift register of 1DDS32 (other DDS), the difference (θa− (b1−b2)) between the phase shift amounts θb and θa of the second DDS 33 and the first DDS 32 is common. The first DDS 32 is set to be equal to the difference (b2−b3) between the phase shift amounts b2 and b3 of the filters 36 and 37 at the frequency f2. The phase shift amount θa to be set is set.

この場合、θa−(b1−b2)=b2−b3との関係式から、処理部6は、第1DDS32の位相シフトレジスタに設定すべき位相シフト量θaを(b1−b3)と算出して、これを第1DDS32に設定する(図4参照)。これにより、第1DDS32での第1信号S1の位相シフト量θaは(b1−b3)となり、この第1信号S1はフィルタ37を通過することによってフィルタ37の位相シフト量b3だけ遅延する。このため、第1DDS32がフィルタ35に出力していた第1信号S1の位相を基準として、フィルタ37から出力される第1信号S1の位相は、b1(=(b1−b3)+b3)だけ遅延する。一方、第2DDS33から出力されている第2信号S2の位相は、第1DDS32がフィルタ35に出力していた第1信号S1の位相を基準として、上記したようにb1だけ遅延している。したがって、フィルタ36から出力されている第2信号S2の位相と、フィルタ37から出力されている第1信号S1の位相とが一致した状態となる。   In this case, from the relational expression of θa− (b1−b2) = b2−b3, the processing unit 6 calculates the phase shift amount θa to be set in the phase shift register of the first DDS 32 as (b1−b3), This is set in the first DDS 32 (see FIG. 4). Accordingly, the phase shift amount θa of the first signal S1 in the first DDS 32 becomes (b1-b3), and the first signal S1 is delayed by the phase shift amount b3 of the filter 37 by passing through the filter 37. Therefore, the phase of the first signal S1 output from the filter 37 is delayed by b1 (= (b1−b3) + b3) with reference to the phase of the first signal S1 output from the first DDS 32 to the filter 35. . On the other hand, the phase of the second signal S2 output from the second DDS 33 is delayed by b1 as described above with reference to the phase of the first signal S1 output from the first DDS 32 to the filter 35. Therefore, the phase of the second signal S2 output from the filter 36 and the phase of the first signal S1 output from the filter 37 coincide with each other.

次いで、処理部6は、信号切替処理53を実行する。この信号切替処理53では、処理部6は、第2切替部39に対する切替制御を実行して、出力信号Soを第2信号S2から第1信号S1に切り替える。具体的には、処理部6は、第2切替部39に対して、スイッチ39bをオン状態からオフ状態に移行させると同時に、オフ状態にある残りのスイッチ39a,39c,39dのうちのスイッチ39cのみをオン状態に移行させる切替制御を実行する。これにより、フィルタ36から出力されている第2信号S2に代えて、フィルタ37から出力されている第1信号S1が第2切替部39を介して出力信号Soとして信号生成装置2から出力される。この場合、上記したように、各フィルタ36,37から出力されている第2信号S2および第1信号S1の周波数が同一であって、かつ位相が一致した状態にあるため、第2信号S2から第1信号S1に切り替える際に生じる位相の不連続が大幅に低減されている。つまり、第2信号S2から第1信号S1に、実質的に位相に不連続を生じさせることなく切り替えられる。   Next, the processing unit 6 executes a signal switching process 53. In the signal switching process 53, the processing unit 6 executes switching control for the second switching unit 39 to switch the output signal So from the second signal S2 to the first signal S1. Specifically, the processing unit 6 causes the second switching unit 39 to shift the switch 39b from the on state to the off state, and at the same time, the switch 39c among the remaining switches 39a, 39c, and 39d in the off state. The switching control for shifting only to the ON state is executed. As a result, instead of the second signal S2 output from the filter 36, the first signal S1 output from the filter 37 is output from the signal generation device 2 as the output signal So via the second switching unit 39. . In this case, as described above, since the frequencies of the second signal S2 and the first signal S1 output from the filters 36 and 37 are the same and in phase, the second signal S2 The phase discontinuity that occurs when switching to the first signal S1 is greatly reduced. That is, switching from the second signal S2 to the first signal S1 is performed without causing a phase discontinuity substantially.

続いて、処理部6は、周波数変更処理54を実行する。この周波数変更処理54では、処理部6は、周波数設定制御を各DDS32,33に対して同時に実行することによって各DDS32,33から出力される第1信号S1および第2信号S2の周波数を、フィルタ37の通過帯域内に規定された使用帯域W3内における周波数f3に設定する。具体的には、処理部6は、第1DDS32および第2DDS33に対して、周波数f3を示す周波数データDfa,Dfbをそれぞれ出力して同時に設定する。これにより、第1DDS32から出力されている第1信号S1が、図2に示す通過帯域(この場合、他の通過帯域)に規定されたフィルタ37を介して第2切替部39から出力信号Soとして出力される(つまり、信号生成装置2から第1信号S1が出力信号Soとして出力される)。   Subsequently, the processing unit 6 executes a frequency change process 54. In the frequency changing process 54, the processing unit 6 performs the frequency setting control on the DDSs 32 and 33 simultaneously to filter the frequencies of the first signal S1 and the second signal S2 output from the DDSs 32 and 33. The frequency f3 in the use band W3 defined in the 37 passband is set. Specifically, the processing unit 6 outputs the frequency data Dfa and Dfb indicating the frequency f3 to the first DDS 32 and the second DDS 33, respectively, and sets them simultaneously. Thus, the first signal S1 output from the first DDS 32 is output as the output signal So from the second switching unit 39 via the filter 37 defined in the pass band (in this case, another pass band) shown in FIG. Is output (that is, the first signal S1 is output from the signal generator 2 as the output signal So).

これにより、この周波数f3の出力信号Soが増幅部3において増幅されて、測定用信号Smとして測定対象体21に印加される。次いで、処理部6は、上記した周波数がf1の出力信号Soを印加したときのインピーダンスZの測定処理と同様にして、測定対象体21のインピーダンスZを算出し、算出したインピーダンスZを、測定用信号Smの周波数(この例では上昇時の周波数f3)に対応させて記憶部7に記憶させる。これにより、周波数f3の測定用信号Smを測定対象体21に印加したときのインピーダンスZの測定についても完了する。   As a result, the output signal So having the frequency f3 is amplified by the amplifying unit 3 and applied to the measurement object 21 as the measurement signal Sm. Next, the processing unit 6 calculates the impedance Z of the measurement object 21 in the same manner as the measurement process of the impedance Z when the output signal So having the frequency f1 is applied, and uses the calculated impedance Z for measurement. The signal is stored in the storage unit 7 in correspondence with the frequency of the signal Sm (in this example, the rising frequency f3). Thus, the measurement of the impedance Z when the measurement signal Sm having the frequency f3 is applied to the measurement object 21 is also completed.

次いで、このように両DDS32,33がフィルタ37の通過帯域に含まれている周波数f3(一の周波数)の第1信号S1および第2信号S2を出力し、これらの信号S1,S2のうちの第1信号S1がフィルタ37を介して出力信号Soとして出力されている状態において、信号生成装置2では、処理部6は、周波数f4の測定用信号Smを測定対象体21に印加したときのインピーダンスZの測定を行うため、第1信号S1(この場合、一の信号)に代えて、フィルタ37の通過帯域(この場合、一の通過帯域)と部分的に重複する他の通過帯域(この場合、フィルタ38の通過帯域)に含まれる周波数f4(この場合、他の周波数)の第2信号S2(この場合、他の信号)を出力信号Soとして出力させる処理を開始する。   Next, both the DDSs 32 and 33 output the first signal S1 and the second signal S2 of the frequency f3 (one frequency) included in the pass band of the filter 37 in this way, and among these signals S1 and S2, In the state where the first signal S1 is being output as the output signal So through the filter 37, in the signal generating device 2, the processing unit 6 applies the impedance when the measurement signal Sm having the frequency f4 is applied to the measurement object 21. In order to measure Z, instead of the first signal S1 (in this case, one signal), another passband (in this case) partially overlapping with the passband of the filter 37 (in this case, one passband) , A process of outputting the second signal S2 (in this case, another signal) of the frequency f4 (in this case, other frequency) included in the pass band of the filter 38 as the output signal So is started.

この処理では、処理部6は、まず、第1切替部34に対する切替制御を実行して第2DDS33(この場合、他のDDS)を通過帯域がフィルタ37(一のフィルタ)と部分的に重複するフィルタ38(他のフィルタ)に接続する。   In this process, the processing unit 6 first executes switching control for the first switching unit 34, and the pass band of the second DDS 33 (in this case, another DDS) partially overlaps with the filter 37 (one filter). Connect to filter 38 (other filters).

次いで、処理部6は、図3に示すフィルタ切替処理50を実行することにより、出力信号Soとして信号生成装置2から出力される信号を、周波数f3の第1信号S1から周波数f4の第2信号S2に、実質的に位相に不連続を生じさせることなく切り替える。   Next, the processing unit 6 executes the filter switching process 50 shown in FIG. 3 to convert the signal output from the signal generation device 2 as the output signal So into the second signal from the first signal S1 having the frequency f3 to the second signal having the frequency f4. Switch to S2 without causing a discontinuity in the phase substantially.

このフィルタ切替処理50では、処理部6は、まず、周波数前変更処理51を実行する。この周波数前変更処理51では、処理部6は、両DDS32,33に対する周波数設定制御を実行することにより、第1DDS32(この場合、一のDDS)から出力される第1信号S1(この場合、一の信号)および第2DDS33(この場合、他のDDS)から出力される第2信号S2(この場合、他の信号)の各周波数をフィルタ37の通過帯域(一の通過帯域)とフィルタ38の通過帯域(他の通過帯域)との重複する帯域に含まれる共通周波数に設定する。本例では、第1DDS32および第2DDS33が周波数f3の第1信号S1および第2信号S2を出力している状態において、この周波数f3が、既にフィルタ37の通過帯域とフィルタ38の通過帯域との重複する帯域に含まれた状態となっている。このため、処理部6は、この周波数前変更処理51を実行したものとして、次に処理に移行する。   In the filter switching process 50, the processing unit 6 first executes a pre-frequency change process 51. In the pre-frequency change process 51, the processing unit 6 executes frequency setting control on both the DDSs 32 and 33, so that the first signal S1 (in this case, one DDS) output from the first DDS 32 (in this case, one DDS). And the second DDS 33 (in this case, the other DDS) and the second signal S2 (in this case, the other signal) output from the frequency band of the filter 37 (one pass band) and the filter 38. The common frequency included in the band overlapping with the band (other pass band) is set. In this example, in a state where the first DDS 32 and the second DDS 33 output the first signal S1 and the second signal S2 having the frequency f3, the frequency f3 has already overlapped the pass band of the filter 37 and the pass band of the filter 38. It is in a state that is included in the band. Therefore, the processing unit 6 proceeds to the next processing, assuming that the pre-frequency change processing 51 has been executed.

続いて、処理部6は、位相補正処理52を実行する。この位相補正処理52では、処理部6は、第2DDS33(他のDDS)に対する位相設定制御を実行して、第2DDS33に接続されているフィルタ38(他のフィルタ)から出力されている第2信号S2(他の信号)の位相を、フィルタ37(一のフィルタ)から出力されている第1信号S1(一の信号)の位相に一致させる。   Subsequently, the processing unit 6 executes a phase correction process 52. In the phase correction process 52, the processing unit 6 executes phase setting control for the second DDS 33 (other DDS), and the second signal output from the filter 38 (other filter) connected to the second DDS 33. The phase of S2 (other signal) is matched with the phase of the first signal S1 (one signal) output from the filter 37 (one filter).

具体的には、処理部6は、まず、周波数f3における各フィルタ37,38の位相シフト量b3,b4を記憶部7に記憶されている各フィルタ37,38についての周波数特性データテーブルDtp3,Dtp4を参照して特定する。次いで、処理部6は、現在、出力信号Soとしての第1信号S1を出力している第1DDS32(一のDDS)の位相シフトレジスタに設定されている現時点での位相シフト量θa(=b1−b3)、周波数f3(各フィルタ37,38での共通周波数)におけるフィルタ37(一のフィルタ)の位相シフト量b3、および周波数f3におけるフィルタ38(他のフィルタ)の位相シフト量b4に基づき、第2DDS33(他のDDS)の位相シフトレジスタに新たに位相シフト量θbを設定した場合に、第1DDS32および第2DDS33の各位相シフト量θa,θbの差(θb−(b1−b3))が、共通周波数f3におけるフィルタ37,38の各位相シフト量b3,b4の差分(b3−b4)と等しくなるように第2DDS33に対する位相シフト量θbを設定する。   Specifically, the processing unit 6 firstly sets the phase shift amounts b3 and b4 of the filters 37 and 38 at the frequency f3 to the frequency characteristic data tables Dtp3 and Dtp4 for the filters 37 and 38 stored in the storage unit 7. To identify. Next, the processing unit 6 currently sets the phase shift amount θa (= b1−) set in the phase shift register of the first DDS 32 (one DDS) that is currently outputting the first signal S1 as the output signal So. b3), the phase shift amount b3 of the filter 37 (one filter) at the frequency f3 (the common frequency of the filters 37 and 38), and the phase shift amount b4 of the filter 38 (the other filter) at the frequency f3. When the phase shift amount θb is newly set in the phase shift register of 2DDS33 (other DDS), the difference (θb− (b1−b3)) between the phase shift amounts θa and θb of the first DDS32 and the second DDS33 is common. The second DDS 33 is set to be equal to the difference (b3−b4) between the phase shift amounts b3 and b4 of the filters 37 and 38 at the frequency f3. The phase shift amount θb to be set is set.

この場合、θb−(b1−b3)=b3−b4との関係式から、処理部6は、第2DDS33の位相シフトレジスタに設定すべき位相シフト量θbを(b1−b4)と算出して、これを第2DDS33に設定する(図4参照)。これにより、第2DDS33での第2信号S2の位相シフト量θbは(b1−b4)となり、この第2信号S2はフィルタ38を通過することによってフィルタ38の位相シフト量b4だけ遅延する。このため、第1DDS32がフィルタ35に出力していた第1信号S1の位相を基準として、フィルタ38から出力される第2信号S2の位相は、b1(=(b1−b4)+b4)だけ遅延する。一方、第1DDS32から出力されている第1信号S1の位相は、第1DDS32がフィルタ35に出力していた第1信号S1の位相を基準として、上記したようにb1だけ遅延している。したがって、フィルタ37から出力されている第1信号S1の位相と、フィルタ38から出力されている第2信号S2の位相とが一致した状態となる。   In this case, from the relational expression θb− (b1−b3) = b3−b4, the processing unit 6 calculates the phase shift amount θb to be set in the phase shift register of the second DDS 33 as (b1−b4), This is set in the second DDS 33 (see FIG. 4). Accordingly, the phase shift amount θb of the second signal S2 in the second DDS 33 becomes (b1-b4), and the second signal S2 is delayed by the phase shift amount b4 of the filter 38 by passing through the filter 38. Therefore, the phase of the second signal S2 output from the filter 38 is delayed by b1 (= (b1−b4) + b4) with reference to the phase of the first signal S1 output from the first DDS 32 to the filter 35. . On the other hand, the phase of the first signal S1 output from the first DDS 32 is delayed by b1 as described above with reference to the phase of the first signal S1 output from the first DDS 32 to the filter 35. Therefore, the phase of the first signal S1 output from the filter 37 and the phase of the second signal S2 output from the filter 38 coincide with each other.

次いで、処理部6は、信号切替処理53を実行する。この信号切替処理53では、処理部6は、第2切替部39に対する切替制御を実行して、出力信号Soを第1信号S1から第2信号S2に切り替える。具体的には、処理部6は、第2切替部39に対して、スイッチ39cをオン状態からオフ状態に移行させると同時に、オフ状態にある残りのスイッチ39a,39b,39dのうちのスイッチ39dのみをオン状態に移行させる切替制御を実行する。これにより、フィルタ37から出力されている第1信号S1に代えて、フィルタ38から出力されている第2信号S2が第2切替部39を介して出力信号Soとして信号生成装置2から出力される。この場合、上記したように、各フィルタ37,38から出力されている第1信号S1および第2信号S2の周波数が同一であって、かつ位相が一致した状態にあるため、第1信号S1から第2信号S2に切り替える際に生じる位相の不連続が大幅に低減されている。つまり、第1信号S1から第2信号S2に、実質的に位相に不連続を生じさせることなく切り替えられる。   Next, the processing unit 6 executes a signal switching process 53. In the signal switching process 53, the processing unit 6 executes switching control for the second switching unit 39 to switch the output signal So from the first signal S1 to the second signal S2. Specifically, the processing unit 6 causes the second switching unit 39 to switch the switch 39c from the on state to the off state, and at the same time, the switch 39d among the remaining switches 39a, 39b, and 39d in the off state. The switching control for shifting only to the ON state is executed. Thereby, instead of the first signal S1 output from the filter 37, the second signal S2 output from the filter 38 is output from the signal generation device 2 as the output signal So via the second switching unit 39. . In this case, as described above, since the first signal S1 and the second signal S2 output from the filters 37 and 38 have the same frequency and the same phase, the first signal S1 The phase discontinuity that occurs when switching to the second signal S2 is greatly reduced. That is, switching from the first signal S1 to the second signal S2 is performed without causing a phase discontinuity substantially.

続いて、処理部6は、周波数変更処理54を実行する。この周波数変更処理54では、処理部6は、周波数設定制御を各DDS32,33に対して同時に実行することによって各DDS32,33から出力される第1信号S1および第2信号S2の周波数を、フィルタ38の通過帯域内に規定された使用帯域W4内における周波数f4に設定する。具体的には、処理部6は、第1DDS32および第2DDS33に対して、周波数f4を示す周波数データDfa,Dfbをそれぞれ出力して同時に設定する。これにより、第2DDS33から出力されている第2信号S2が、図2に示す通過帯域(この場合、他の通過帯域)に規定されたフィルタ38を介して第2切替部39から出力信号Soとして出力される(つまり、信号生成装置2から第2信号S2が出力信号Soとして出力される)。   Subsequently, the processing unit 6 executes a frequency change process 54. In the frequency changing process 54, the processing unit 6 performs the frequency setting control on the DDSs 32 and 33 simultaneously to filter the frequencies of the first signal S1 and the second signal S2 output from the DDSs 32 and 33. The frequency f4 is set within the use band W4 defined in the 38 passbands. Specifically, the processing unit 6 outputs frequency data Dfa and Dfb indicating the frequency f4 to the first DDS 32 and the second DDS 33, respectively, and sets them simultaneously. As a result, the second signal S2 output from the second DDS 33 is output as the output signal So from the second switching unit 39 via the filter 38 defined in the pass band (in this case, another pass band) shown in FIG. (That is, the second signal S2 is output as the output signal So from the signal generating device 2).

これにより、この周波数f4の出力信号Soが増幅部3において増幅されて、測定用信号Smとして測定対象体21に印加される。次いで、処理部6は、上記した周波数がf1の出力信号Soを印加したときのインピーダンスZの測定処理と同様にして、測定対象体21のインピーダンスZを算出し、算出したインピーダンスZを、測定用信号Smの周波数(この例では周波数f4)に対応させて記憶部7に記憶させる。これにより、周波数f4の測定用信号Smを測定対象体21に印加したときのインピーダンスZの測定についても完了する。   As a result, the output signal So having the frequency f4 is amplified by the amplifying unit 3 and applied to the measurement object 21 as the measurement signal Sm. Next, the processing unit 6 calculates the impedance Z of the measurement object 21 in the same manner as the measurement process of the impedance Z when the output signal So having the frequency f1 is applied, and uses the calculated impedance Z for measurement. The signal is stored in the storage unit 7 in correspondence with the frequency of the signal Sm (frequency f4 in this example). Thereby, the measurement of the impedance Z when the measurement signal Sm having the frequency f4 is applied to the measurement object 21 is also completed.

次に、インピーダンス測定装置1では、処理部6が引き続いて、測定用信号Smの周波数を現在の周波数f4から、周波数f3,f2,f1というように順次低下させつつ、各周波数f3,f2,f1の測定用信号Smを測定対象体21に印加したときの測定対象体21のインピーダンスZの測定を実行する。   Next, in the impedance measuring apparatus 1, the processing unit 6 continues to sequentially decrease the frequency of the measurement signal Sm from the current frequency f4 to the frequencies f3, f2, and f1, and the frequencies f3, f2, and f1. The measurement signal Sm is applied to the measurement object 21, and the impedance Z of the measurement object 21 is measured.

上記のようにして、両DDS32,33がフィルタ38の通過帯域に含まれている周波数f4(一の周波数)の第1信号S1および第2信号S2を出力し、これらの信号S1,S2のうちの第2信号S2がフィルタ38を介して出力信号Soとして出力されている状態において、信号生成装置2では、処理部6は、周波数f3の測定用信号Smを測定対象体21に印加したときのインピーダンスZの測定を行うため、第2信号S2(この場合、一の信号)に代えて、フィルタ38の通過帯域(この場合、一の通過帯域)と部分的に重複する他の通過帯域(この場合、フィルタ37の通過帯域)に含まれる周波数f3(この場合、他の周波数)の第1信号S1(この場合、他の信号)を出力信号Soとして出力させる処理を開始する。   As described above, both the DDSs 32 and 33 output the first signal S1 and the second signal S2 of the frequency f4 (one frequency) included in the pass band of the filter 38, and among these signals S1 and S2 In the state where the second signal S2 is output as the output signal So through the filter 38, in the signal generating device 2, the processing unit 6 applies the measurement signal Sm having the frequency f3 to the measurement object 21. In order to measure the impedance Z, instead of the second signal S2 (in this case, one signal), another passband (in this case, partially overlapping with the passband of the filter 38 (in this case, one passband)) In this case, a process of outputting the first signal S1 (in this case, another signal) having the frequency f3 (in this case, another frequency) included in the pass band of the filter 37 as the output signal So is started.

この処理では、処理部6は、まず、第1切替部34に対する切替制御を実行して第1DDS32(この場合、他のDDS)をフィルタ35〜37のうちの通過帯域が上記のようにフィルタ38(一のフィルタ)と部分的に重複するフィルタ37(他のフィルタ)に接続する。本例では、フィルタ38の通過帯域は、他のすべてのフィルタ35〜37の通過帯域を包含する形態で、これらフィルタ35〜37と通過帯域が部分的に重複する構成となっているが、出力信号Soとして次に出力させる第1信号S1の周波数f3がフィルタ37の使用帯域W3に含まれるものであるため、第1DDS32をこのフィルタ37に接続する。   In this processing, the processing unit 6 first executes switching control for the first switching unit 34 to pass the first DDS 32 (in this case, another DDS) to the filter 38 as described above in which the pass band of the filters 35 to 37 is as described above. It is connected to a filter 37 (other filter) partially overlapping with (one filter). In this example, the pass band of the filter 38 includes the pass bands of all the other filters 35 to 37, and the filters 35 to 37 and the pass band are partially overlapped. Since the frequency f3 of the first signal S1 to be output next as the signal So is included in the use band W3 of the filter 37, the first DDS 32 is connected to the filter 37.

次いで、処理部6は、図3に示すフィルタ切替処理50を実行することにより、出力信号Soとして信号生成装置2から出力される信号を、周波数f4の第2信号S2から周波数f3の第1信号S1に、実質的に位相に不連続を生じさせることなく切り替える。   Next, the processing unit 6 executes the filter switching process 50 shown in FIG. 3 to change the signal output from the signal generation device 2 as the output signal So, from the second signal S2 having the frequency f4 to the first signal having the frequency f3. Switching to S1 is performed without causing a discontinuity in the phase substantially.

このフィルタ切替処理50では、処理部6は、まず、周波数前変更処理51を実行する。この周波数前変更処理51では、処理部6は、周波数設定制御を各DDS32,33に対して同時に実行することによって各DDS33,32から出力される第2信号S2(一の信号)および第1信号S1(他の信号)の周波数を、フィルタ38の通過帯域(一の通過帯域)とフィルタ37の通過帯域(他の通過帯域)との重複する帯域に含まれる共通周波数に設定する。   In the filter switching process 50, the processing unit 6 first executes a pre-frequency change process 51. In the pre-frequency change process 51, the processing unit 6 performs the frequency setting control on the DDSs 32 and 33 simultaneously, thereby outputting the second signal S2 (one signal) and the first signal output from the DDSs 33 and 32. The frequency of S1 (other signal) is set to a common frequency included in a band where the pass band of the filter 38 (one pass band) and the pass band of the filter 37 (other pass band) overlap.

本例では、上記したようにフィルタ38の通過帯域にフィルタ37の通過帯域が包含されるため、共通周波数はフィルタ37の通過帯域に含まれるいずれの周波数であってもよいが、本例では一例として、フィルタ38,37の各通過帯域内に規定された各使用帯域W4,W3における重複帯域に含まれる周波数f34が、フィルタ38からフィルタ37に切り替える際(周波数を低下させる際)の周波数として記憶部7に予め記憶されている。このため、処理部6は、記憶部7からこの周波数f34を読み出して、共通周波数に設定する。   In this example, since the pass band of the filter 37 is included in the pass band of the filter 38 as described above, the common frequency may be any frequency included in the pass band of the filter 37. As described above, the frequency f34 included in the overlapping band in each of the used bands W4 and W3 defined in the passbands of the filters 38 and 37 is stored as a frequency when the filter 38 is switched to the filter 37 (when the frequency is lowered). Stored in the unit 7 in advance. Therefore, the processing unit 6 reads this frequency f34 from the storage unit 7 and sets it to the common frequency.

続いて、処理部6は、位相補正処理52を実行する。この位相補正処理52では、処理部6は、第1DDS32(他のDDS)に対する位相設定制御を実行して、第1DDS32に接続されているフィルタ37(他のフィルタ)から出力されている第1信号S1(他の信号)の位相を、フィルタ38(一のフィルタ)から出力されている第2信号S2(一の信号)の位相に一致させる。   Subsequently, the processing unit 6 executes a phase correction process 52. In the phase correction process 52, the processing unit 6 executes phase setting control for the first DDS 32 (other DDS) and outputs the first signal output from the filter 37 (other filter) connected to the first DDS 32. The phase of S1 (other signal) is matched with the phase of the second signal S2 (one signal) output from the filter 38 (one filter).

具体的には、処理部6は、まず、変更後の共通周波数f34における各フィルタ37,38の位相シフト量b3,b4を記憶部7に記憶されている各フィルタ37,38についての周波数特性データテーブルDtp3,Dtp4を参照して特定する。次いで、処理部6は、現在、出力信号Soとしての第2信号S2を出力している第2DDS33(一のDDS)の位相シフトレジスタに設定されている現時点での位相シフト量θb(=b1−b4)、共通周波数f34(各フィルタ37,38での共通周波数)におけるフィルタ38(一のフィルタ)の位相シフト量b4、および共通周波数f34におけるフィルタ37(他のフィルタ)の位相シフト量b3に基づき、第1DDS32(他のDDS)の位相シフトレジスタに新たに位相シフト量θaを設定した場合に、フィルタ38とフィルタ37の各位相シフト量の差((b1−b4)−θa)が、共通周波数f34におけるフィルタ37,38の各位相シフト量b3,b4の差分(b3−b4)と等しくなるように第1DDS32に対する位相シフト量θaを設定する。   Specifically, the processing unit 6 firstly sets the phase shift amounts b3 and b4 of the filters 37 and 38 at the common frequency f34 after the change to the frequency characteristic data for the filters 37 and 38 stored in the storage unit 7. This is specified with reference to the tables Dtp3 and Dtp4. Next, the processing unit 6 currently sets the phase shift amount θb (= b1−) set in the phase shift register of the second DDS 33 (one DDS) that is outputting the second signal S2 as the output signal So. b4), based on the phase shift amount b4 of the filter 38 (one filter) at the common frequency f34 (common frequency in each of the filters 37 and 38) and the phase shift amount b3 of the filter 37 (other filter) at the common frequency f34. When the phase shift amount θa is newly set in the phase shift register of the first DDS 32 (other DDS), the difference ((b1−b4) −θa) between the phase shift amounts of the filter 38 and the filter 37 is the common frequency. The first DDS 32 is equal to the difference (b3−b4) between the phase shift amounts b3 and b4 of the filters 37 and 38 at f34. To set the phase shift amount θa.

この場合、(b1−b4)−θa=b3−b4との関係式から、処理部6は、第1DDS32の位相シフトレジスタに設定すべき位相シフト量θaを(b1−b3)と算出して、これを第1DDS32に設定する(図4参照)。これにより、第1DDS32での第1信号S1の位相シフト量θaは(b1−b3)となり、この第1信号S1はフィルタ37を通過することによってフィルタ37の位相シフト量b3だけ遅延する。このため、第1DDS32がフィルタ35に出力していた第1信号S1の位相を基準として、フィルタ37から出力される第1信号S1の位相は、b1(=(b1−b3)+b3)だけ遅延する。一方、第2DDS33から出力されている第2信号S2の位相は、第1DDS32がフィルタ35に出力していた第1信号S1の位相を基準として、上記したようにb1だけ遅延している。したがって、フィルタ38から出力されている第2信号S2の位相と、フィルタ37から出力されている第1信号S1の位相とが一致した状態となる。   In this case, from the relational expression of (b1−b4) −θa = b3−b4, the processing unit 6 calculates the phase shift amount θa to be set in the phase shift register of the first DDS 32 as (b1−b3), This is set in the first DDS 32 (see FIG. 4). Accordingly, the phase shift amount θa of the first signal S1 in the first DDS 32 becomes (b1-b3), and the first signal S1 is delayed by the phase shift amount b3 of the filter 37 by passing through the filter 37. Therefore, the phase of the first signal S1 output from the filter 37 is delayed by b1 (= (b1−b3) + b3) with reference to the phase of the first signal S1 output from the first DDS 32 to the filter 35. . On the other hand, the phase of the second signal S2 output from the second DDS 33 is delayed by b1 as described above with reference to the phase of the first signal S1 output from the first DDS 32 to the filter 35. Therefore, the phase of the second signal S2 output from the filter 38 and the phase of the first signal S1 output from the filter 37 coincide with each other.

次いで、処理部6は、信号切替処理53を実行する。この信号切替処理53では、処理部6は、第2切替部39に対する切替制御を実行して、出力信号Soを第2信号S2から第1信号S1に切り替える。具体的には、処理部6は、第2切替部39に対して、スイッチ39dをオン状態からオフ状態に移行させると同時に、オフ状態にある残りのスイッチ39a,39b,39cのうちのスイッチ39cのみをオン状態に移行させる切替制御を実行する。これにより、フィルタ38から出力されている第2信号S2に代えて、フィルタ37から出力されている第1信号S1が第2切替部39を介して出力信号Soとして信号生成装置2から出力される。この場合、上記したように、各フィルタ38,37から出力されている第2信号S2および第1信号S1の周波数が同一であって、かつ位相が一致した状態にあるため、第2信号S2から第1信号S1に切り替える際に生じる位相の不連続が大幅に低減されている。つまり、第2信号S2から第1信号S1に、実質的に位相に不連続を生じさせることなく切り替えられる。   Next, the processing unit 6 executes a signal switching process 53. In the signal switching process 53, the processing unit 6 executes switching control for the second switching unit 39 to switch the output signal So from the second signal S2 to the first signal S1. Specifically, the processing unit 6 causes the second switching unit 39 to shift the switch 39d from the on state to the off state, and at the same time, the switch 39c among the remaining switches 39a, 39b, and 39c in the off state. The switching control for shifting only to the ON state is executed. Thereby, instead of the second signal S2 output from the filter 38, the first signal S1 output from the filter 37 is output from the signal generation device 2 as the output signal So via the second switching unit 39. . In this case, as described above, since the frequencies of the second signal S2 and the first signal S1 output from the filters 38 and 37 are the same and in phase, the second signal S2 The phase discontinuity that occurs when switching to the first signal S1 is greatly reduced. That is, switching from the second signal S2 to the first signal S1 is performed without causing a phase discontinuity substantially.

続いて、処理部6は、周波数変更処理54を実行する。この周波数変更処理54では、処理部6は、周波数設定制御を各DDS32,33に対して同時に実行することによって各DDS32,33から出力される第1信号S1および第2信号S2の周波数を、フィルタ37の通過帯域内に規定された使用帯域W3内における周波数f3に設定する。具体的には、処理部6は、第1DDS32および第2DDS33に対して、周波数f3を示す周波数データDfa,Dfbをそれぞれ出力して同時に設定する。これにより、第1DDS32から出力されている第1信号S1が、図2に示す通過帯域(この場合、他の通過帯域)に規定されたフィルタ37を介して第2切替部39から出力信号Soとして出力される(つまり、信号生成装置2から第1信号S1が出力信号Soとして出力される)。   Subsequently, the processing unit 6 executes a frequency change process 54. In the frequency changing process 54, the processing unit 6 performs the frequency setting control on the DDSs 32 and 33 simultaneously to filter the frequencies of the first signal S1 and the second signal S2 output from the DDSs 32 and 33. The frequency f3 in the use band W3 defined in the 37 passband is set. Specifically, the processing unit 6 outputs the frequency data Dfa and Dfb indicating the frequency f3 to the first DDS 32 and the second DDS 33, respectively, and sets them simultaneously. Thus, the first signal S1 output from the first DDS 32 is output as the output signal So from the second switching unit 39 via the filter 37 defined in the pass band (in this case, another pass band) shown in FIG. Is output (that is, the first signal S1 is output from the signal generator 2 as the output signal So).

これにより、この周波数f3の出力信号Soが増幅部3において増幅されて、測定用信号Smとして測定対象体21に印加される。次いで、処理部6は、上記した周波数がf1の出力信号Soを印加したときのインピーダンスZの測定処理と同様にして、測定対象体21のインピーダンスZを算出し、算出したインピーダンスZを、測定用信号Smの周波数(この例では低下時の周波数f3)に対応させて記憶部7に記憶させる。これにより、周波数f3の測定用信号Smを測定対象体21に印加したときのインピーダンスZの測定についても完了する。   As a result, the output signal So having the frequency f3 is amplified by the amplifying unit 3 and applied to the measurement object 21 as the measurement signal Sm. Next, the processing unit 6 calculates the impedance Z of the measurement object 21 in the same manner as the measurement process of the impedance Z when the output signal So having the frequency f1 is applied, and uses the calculated impedance Z for measurement. The signal is stored in the storage unit 7 in correspondence with the frequency of the signal Sm (in this example, the frequency f3 at the time of decrease). Thus, the measurement of the impedance Z when the measurement signal Sm having the frequency f3 is applied to the measurement object 21 is also completed.

次いで、このように両DDS32,33がフィルタ37の通過帯域に含まれている周波数f3(一の周波数)の第1信号S1および第2信号S2を出力し、これらの信号S1,S2のうちの第1信号S1がフィルタ37を介して出力信号Soとして出力されている状態において、信号生成装置2では、処理部6は、周波数f2の測定用信号Smを測定対象体21に印加したときのインピーダンスZの測定を行うため、第1信号S1(この場合、一の信号)に代えて、フィルタ37の通過帯域(この場合、一の通過帯域)と部分的に重複する他の通過帯域(この場合、フィルタ36の通過帯域)に含まれる周波数f2(この場合、他の周波数)の第2信号S2(この場合、他の信号)を出力信号Soとして出力させる処理を開始する。   Next, both the DDSs 32 and 33 output the first signal S1 and the second signal S2 of the frequency f3 (one frequency) included in the pass band of the filter 37 in this way, and among these signals S1 and S2, In the state where the first signal S1 is being output as the output signal So through the filter 37, in the signal generating device 2, the processing unit 6 applies the impedance when the measurement signal Sm having the frequency f2 is applied to the measurement object 21. In order to measure Z, instead of the first signal S1 (in this case, one signal), another passband (in this case) partially overlapping with the passband of the filter 37 (in this case, one passband) , A process of outputting the second signal S2 (in this case, another signal) of the frequency f2 (in this case, another frequency) included in the pass band of the filter 36 as the output signal So is started.

この処理では、処理部6は、まず、第1切替部34に対する切替制御を実行して第2DDS33(この場合、他のDDS)をフィルタ36(他のフィルタ)に接続する。本例では、フィルタ37の通過帯域は、フィルタ35,36の通過帯域を包含する形態で、各フィルタ35,36と通過帯域が部分的に重複する構成となっているが、出力信号Soとして次に出力させる第2信号S2の周波数f2がフィルタ36の使用帯域W2に含まれるものであるため、第2DDS33をこのフィルタ36に接続する。   In this process, the processing unit 6 first executes switching control for the first switching unit 34 to connect the second DDS 33 (in this case, another DDS) to the filter 36 (another filter). In this example, the pass band of the filter 37 includes the pass bands of the filters 35 and 36, and the filters 35 and 36 partially overlap with the pass band. Since the frequency f2 of the second signal S2 to be output to is included in the use band W2 of the filter 36, the second DDS 33 is connected to the filter 36.

次いで、処理部6は、図3に示すフィルタ切替処理50を実行することにより、出力信号Soとして信号生成装置2から出力される信号を、周波数f3の第1信号S1から周波数f2の第2信号S2に、実質的に位相に不連続を生じさせることなく切り替える。   Next, the processing unit 6 executes the filter switching process 50 shown in FIG. 3 to convert the signal output from the signal generation device 2 as the output signal So into the second signal from the first signal S1 having the frequency f3 to the second signal having the frequency f2. Switch to S2 without causing a discontinuity in the phase substantially.

このフィルタ切替処理50では、処理部6は、まず、周波数前変更処理51を実行する。この周波数前変更処理51では、処理部6は、周波数設定制御を各DDS32,33に対して同時に実行することによって各DDS32,33から出力される第1信号S1(一の信号)および第2信号S2(他の信号)の周波数を、フィルタ37の通過帯域(一の通過帯域)とフィルタ36の通過帯域(他の通過帯域)との重複する帯域に含まれる共通周波数に設定する。   In the filter switching process 50, the processing unit 6 first executes a pre-frequency change process 51. In the pre-frequency change process 51, the processing unit 6 executes the frequency setting control on the DDSs 32 and 33 simultaneously, thereby outputting the first signal S1 (one signal) and the second signal output from the DDSs 32 and 33. The frequency of S2 (other signal) is set to a common frequency included in a band where the pass band of the filter 37 (one pass band) and the pass band of the filter 36 (other pass band) overlap.

本例では、上記したようにフィルタ37の通過帯域にフィルタ36の通過帯域が包含されるため、共通周波数はフィルタ36の通過帯域に含まれるいずれの周波数であってもよいが、本例では一例として、フィルタ37,36の各通過帯域内に規定された各使用帯域W3,W2における重複帯域に含まれる周波数f23が、フィルタ37からフィルタ36に切り替える際(周波数を低下させる際)の周波数として記憶部7に予め記憶されている。このため、処理部6は、記憶部7からこの周波数f23を読み出して、共通周波数に設定する。   In this example, since the pass band of the filter 36 is included in the pass band of the filter 37 as described above, the common frequency may be any frequency included in the pass band of the filter 36. As described above, the frequency f23 included in the overlapping band in each of the used bands W3 and W2 defined in the passbands of the filters 37 and 36 is stored as a frequency when the filter 37 is switched to the filter 36 (when the frequency is lowered). Stored in the unit 7 in advance. Therefore, the processing unit 6 reads this frequency f23 from the storage unit 7 and sets it to the common frequency.

続いて、処理部6は、位相補正処理52を実行する。この位相補正処理52では、処理部6は、第2DDS33(他のDDS)に対する位相設定制御を実行して、第2DDS33に接続されているフィルタ36(他のフィルタ)から出力されている第2信号S2(他の信号)の位相を、フィルタ37(一のフィルタ)から出力されている第1信号S1(一の信号)の位相に一致させる。   Subsequently, the processing unit 6 executes a phase correction process 52. In the phase correction process 52, the processing unit 6 executes phase setting control for the second DDS 33 (other DDS) and outputs the second signal output from the filter 36 (other filter) connected to the second DDS 33. The phase of S2 (other signal) is matched with the phase of the first signal S1 (one signal) output from the filter 37 (one filter).

具体的には、処理部6は、まず、変更後の共通周波数f23における各フィルタ36,37の位相シフト量b2,b3を記憶部7に記憶されている各フィルタ36,37についての周波数特性データテーブルDtp2,Dtp3を参照して特定する。次いで、処理部6は、現在、出力信号Soとしての第1信号S1を出力している第1DDS32(一のDDS)の位相シフトレジスタに設定されている現時点での位相シフト量θa(=b1−b3)、共通周波数f23(各フィルタ36,37での共通周波数)におけるフィルタ37(一のフィルタ)の位相シフト量b3、および共通周波数f23におけるフィルタ36(他のフィルタ)の位相シフト量b2に基づき、第2DDS33(他のDDS)の位相シフトレジスタに新たに位相シフト量θbを設定した場合に、フィルタ37とフィルタ36の各位相シフト量の差((b1−b3)−θb)が、共通周波数f23におけるフィルタ36,37の各位相シフト量b2,b3の差分(b2−b3)と等しくなるように第2DDS33の位相シフト量θbを設定する。   Specifically, the processing unit 6 firstly sets the phase shift amounts b2 and b3 of the filters 36 and 37 at the common frequency f23 after the change to the frequency characteristic data for the filters 36 and 37 stored in the storage unit 7. The table is specified with reference to the tables Dtp2 and Dtp3. Next, the processing unit 6 currently sets the phase shift amount θa (= b1−) set in the phase shift register of the first DDS 32 (one DDS) that is currently outputting the first signal S1 as the output signal So. b3), based on the phase shift amount b3 of the filter 37 (one filter) at the common frequency f23 (common frequency of the filters 36 and 37) and the phase shift amount b2 of the filter 36 (other filter) at the common frequency f23. When the phase shift amount θb is newly set in the phase shift register of the second DDS 33 (other DDS), the difference ((b1−b3) −θb) between the phase shift amounts of the filter 37 and the filter 36 is the common frequency. The phase shift of the second DDS 33 is made equal to the difference (b2−b3) between the phase shift amounts b2 and b3 of the filters 36 and 37 at f23. To set the bet amount θb.

この場合、(b1−b3)−θb=b2−b3との関係式から、処理部6は、第2DDS33の位相シフトレジスタに設定すべき位相シフト量θbを(b1−b2)と算出して、これを第2DDS33に設定する(図4参照)。これにより、第2DDS33での第2信号S2の位相シフト量θbは(b1−b2)となり、この第2信号S2はフィルタ36を通過することによってフィルタ36の位相シフト量b2だけ遅延する。このため、第1DDS32がフィルタ35に出力していた第1信号S1の位相を基準として、フィルタ36から出力される第2信号S2の位相は、b1(=(b1−b2)+b2)だけ遅延する。一方、第1DDS32から出力されている第1信号S1の位相は、第1DDS32がフィルタ35に出力していた第1信号S1の位相を基準として、上記したようにb1だけ遅延している。したがって、フィルタ37から出力されている第1信号S1の位相と、フィルタ36から出力されている第2信号S2の位相とが一致した状態となる。   In this case, from the relational expression of (b1-b3) -θb = b2-b3, the processing unit 6 calculates the phase shift amount θb to be set in the phase shift register of the second DDS 33 as (b1-b2), This is set in the second DDS 33 (see FIG. 4). Accordingly, the phase shift amount θb of the second signal S2 in the second DDS 33 becomes (b1-b2), and the second signal S2 is delayed by the phase shift amount b2 of the filter 36 by passing through the filter 36. Therefore, the phase of the second signal S2 output from the filter 36 is delayed by b1 (= (b1−b2) + b2) with reference to the phase of the first signal S1 output from the first DDS 32 to the filter 35. . On the other hand, the phase of the first signal S1 output from the first DDS 32 is delayed by b1 as described above with reference to the phase of the first signal S1 output from the first DDS 32 to the filter 35. Therefore, the phase of the first signal S1 output from the filter 37 and the phase of the second signal S2 output from the filter 36 coincide with each other.

次いで、処理部6は、信号切替処理53を実行する。この信号切替処理53では、処理部6は、第2切替部39に対する切替制御を実行して、出力信号Soを第1信号S1から第2信号S2に切り替える。具体的には、処理部6は、第2切替部39に対して、スイッチ39cをオン状態からオフ状態に移行させると同時に、オフ状態にある残りのスイッチ39a,39b,39dのうちのスイッチ39bのみをオン状態に移行させる切替制御を実行する。これにより、フィルタ37から出力されている第1信号S1に代えて、フィルタ36から出力されている第2信号S2が第2切替部39を介して出力信号Soとして信号生成装置2から出力される。この場合、上記したように、各フィルタ37,36から出力されている第1信号S1および第2信号S2の周波数が同一であって、かつ位相が一致した状態にあるため、第1信号S1から第2信号S2に切り替える際に生じる位相の不連続が大幅に低減されている。つまり、第1信号S1から第2信号S2に、実質的に位相に不連続を生じさせることなく切り替えられる。   Next, the processing unit 6 executes a signal switching process 53. In the signal switching process 53, the processing unit 6 executes switching control for the second switching unit 39 to switch the output signal So from the first signal S1 to the second signal S2. Specifically, the processing unit 6 causes the second switching unit 39 to shift the switch 39c from the on state to the off state, and at the same time, the switch 39b among the remaining switches 39a, 39b, and 39d in the off state. The switching control for shifting only to the ON state is executed. Thereby, instead of the first signal S1 output from the filter 37, the second signal S2 output from the filter 36 is output from the signal generation device 2 as the output signal So via the second switching unit 39. . In this case, as described above, since the frequencies of the first signal S1 and the second signal S2 output from the filters 37 and 36 are the same and in phase, the first signal S1 The phase discontinuity that occurs when switching to the second signal S2 is greatly reduced. That is, switching from the first signal S1 to the second signal S2 is performed without causing a phase discontinuity substantially.

続いて、処理部6は、周波数変更処理54を実行する。この周波数変更処理54では、処理部6は、周波数設定制御を各DDS32,33に対して同時に実行することによって各DDS32,33から出力される第1信号S1および第2信号S2の周波数を、フィルタ36の通過帯域内に規定された使用帯域W2内における周波数f2に設定する。具体的には、処理部6は、第1DDS32および第2DDS33に対して、周波数f2を示す周波数データDfa,Dfbをそれぞれ出力して同時に設定する。これにより、第2DDS33から出力されている第2信号S2が、図2に示す通過帯域(この場合、他の通過帯域)に規定されたフィルタ36を介して第2切替部39から出力信号Soとして出力される(つまり、信号生成装置2から第2信号S2が出力信号Soとして出力される)。   Subsequently, the processing unit 6 executes a frequency change process 54. In the frequency changing process 54, the processing unit 6 performs the frequency setting control on the DDSs 32 and 33 simultaneously to filter the frequencies of the first signal S1 and the second signal S2 output from the DDSs 32 and 33. The frequency f2 in the use band W2 defined in the 36 passbands is set. Specifically, the processing unit 6 outputs frequency data Dfa and Dfb indicating the frequency f2 to the first DDS 32 and the second DDS 33, respectively, and sets them simultaneously. Thus, the second signal S2 output from the second DDS 33 is output as the output signal So from the second switching unit 39 via the filter 36 defined in the pass band (in this case, another pass band) shown in FIG. (That is, the second signal S2 is output as the output signal So from the signal generating device 2).

これにより、この周波数f2の出力信号Soが増幅部3において増幅されて、測定用信号Smとして測定対象体21に印加される。次いで、処理部6は、上記した周波数がf1の出力信号Soを印加したときのインピーダンスZの測定処理と同様にして、測定対象体21のインピーダンスZを算出し、算出したインピーダンスZを、測定用信号Smの周波数(この例では低下時の周波数f2)に対応させて記憶部7に記憶させる。これにより、周波数f2の測定用信号Smを測定対象体21に印加したときのインピーダンスZの測定についても完了する。   As a result, the output signal So having the frequency f2 is amplified by the amplifying unit 3 and applied to the measurement object 21 as the measurement signal Sm. Next, the processing unit 6 calculates the impedance Z of the measurement object 21 in the same manner as the measurement process of the impedance Z when the output signal So having the frequency f1 is applied, and uses the calculated impedance Z for measurement. The signal is stored in the storage unit 7 in correspondence with the frequency of the signal Sm (in this example, the frequency f2 at the time of decrease). Thus, the measurement of the impedance Z when the measurement signal Sm having the frequency f2 is applied to the measurement object 21 is also completed.

次いで、このように両DDS32,33がフィルタ36の通過帯域に含まれている周波数f2(一の周波数)の第1信号S1および第2信号S2を出力し、これらの信号S1,S2のうちの第2信号S2がフィルタ36を介して出力信号Soとして出力されている状態において、信号生成装置2では、処理部6は、周波数f1の測定用信号Smを測定対象体21に印加したときのインピーダンスZの測定を行うため、第2信号S2(この場合、一の信号)に代えて、フィルタ36の通過帯域(この場合、一の通過帯域)と部分的に重複する他の通過帯域(この場合、フィルタ35の通過帯域)に含まれる周波数f1(この場合、他の周波数)の第1信号S1(この場合、他の信号)を出力信号Soとして出力させる処理を開始する。   Next, both the DDSs 32 and 33 output the first signal S1 and the second signal S2 of the frequency f2 (one frequency) included in the pass band of the filter 36 in this way, and among these signals S1 and S2, In the state where the second signal S2 is being output as the output signal So through the filter 36, in the signal generating device 2, the processing unit 6 has the impedance when the measurement signal Sm having the frequency f1 is applied to the measurement object 21. In order to measure Z, instead of the second signal S2 (in this case, one signal), another passband (in this case) partially overlapping with the passband of the filter 36 (in this case, one passband) The first signal S1 (in this case, another signal) having the frequency f1 (in this case, other frequency) included in the passband of the filter 35 is output as the output signal So.

この処理では、処理部6は、まず、第1切替部34に対する切替制御を実行して第1DDS32(この場合、他のDDS)をフィルタ35(他のフィルタ)に接続する。   In this process, the processing unit 6 first executes switching control for the first switching unit 34 to connect the first DDS 32 (in this case, another DDS) to the filter 35 (another filter).

次いで、処理部6は、図3に示すフィルタ切替処理50を実行することにより、出力信号Soとして信号生成装置2から出力される信号を、周波数f2の第2信号S2から周波数f1の第1信号S1に、実質的に位相に不連続を生じさせることなく切り替える。   Next, the processing unit 6 executes the filter switching process 50 shown in FIG. 3 to change the signal output from the signal generation device 2 as the output signal So, from the second signal S2 having the frequency f2 to the first signal having the frequency f1. Switching to S1 is made without causing a discontinuity in the phase substantially.

このフィルタ切替処理50では、処理部6は、まず、周波数前変更処理51を実行する。この周波数前変更処理51では、処理部6は、周波数設定制御を各DDS33,32に対して同時に実行することによって各DDS33,32から出力される第2信号S2(一の信号)および第1信号S1(他の信号)の周波数を、フィルタ36の通過帯域(一の通過帯域)とフィルタ35の通過帯域(他の通過帯域)との重複する帯域に含まれる共通周波数に設定する。   In the filter switching process 50, the processing unit 6 first executes a pre-frequency change process 51. In the pre-frequency change process 51, the processing unit 6 performs the frequency setting control on the DDSs 33 and 32 simultaneously, thereby outputting the second signal S2 (one signal) and the first signal output from the DDSs 33 and 32. The frequency of S1 (other signal) is set to a common frequency included in a band where the pass band of the filter 36 (one pass band) and the pass band of the filter 35 (other pass band) overlap.

本例では、上記したようにフィルタ36の通過帯域にフィルタ35の通過帯域が包含されるため、共通周波数はフィルタ35の通過帯域に含まれるいずれの周波数であってもよいが、本例では一例として、フィルタ36,35の各通過帯域内に規定された各使用帯域W2,W1における重複帯域に含まれる周波数f12が、フィルタ36からフィルタ35に切り替える際(周波数を低下させる際)の周波数として記憶部7に予め記憶されている。このため、処理部6は、記憶部7からこの周波数f12を読み出して、共通周波数に設定する。   In this example, since the pass band of the filter 35 is included in the pass band of the filter 36 as described above, the common frequency may be any frequency included in the pass band of the filter 35. As described above, the frequency f12 included in the overlapping band in each of the used bands W2 and W1 defined in the passbands of the filters 36 and 35 is stored as a frequency when switching from the filter 36 to the filter 35 (when reducing the frequency). Stored in the unit 7 in advance. Therefore, the processing unit 6 reads this frequency f12 from the storage unit 7 and sets it to the common frequency.

続いて、処理部6は、位相補正処理52を実行する。この位相補正処理52では、処理部6は、第1DDS32(他のDDS)に対する位相設定制御を実行して、第1DDS32に接続されているフィルタ35(他のフィルタ)から出力されている第1信号S1(他の信号)の位相を、フィルタ36(一のフィルタ)から出力されている第2信号S2(一の信号)の位相に一致させる。   Subsequently, the processing unit 6 executes a phase correction process 52. In the phase correction process 52, the processing unit 6 executes phase setting control for the first DDS 32 (other DDS), and the first signal output from the filter 35 (other filter) connected to the first DDS 32. The phase of S1 (other signal) is matched with the phase of the second signal S2 (one signal) output from the filter 36 (one filter).

具体的には、処理部6は、まず、変更後の共通周波数f12における各フィルタ35,36の位相シフト量b1,b2を記憶部7に記憶されている各フィルタ35,36についての周波数特性データテーブルDtp1,Dtp2を参照して特定する。次いで、処理部6は、現在、出力信号Soとしての第2信号S2を出力している第2DDS33(一のDDS)の位相シフトレジスタに設定されている現時点での位相シフト量θb(=b1−b2)、共通周波数f12(各フィルタ35,36での共通周波数)におけるフィルタ36(一のフィルタ)の位相シフト量b2、および共通周波数f12におけるフィルタ35(他のフィルタ)の位相シフト量b1に基づき、第1DDS32(他のDDS)の位相シフトレジスタに新たに位相シフト量θaを設定した場合に、フィルタ36とフィルタ35の各位相シフト量の差((b1−b2)−θa)が、共通周波数f12におけるフィルタ35,36の各位相シフト量b1,b2の差分(b1−b2)と等しくなるように第1DDS32の位相シフト量θaを設定する。   Specifically, the processing unit 6 firstly sets the phase shift amounts b1 and b2 of the filters 35 and 36 at the changed common frequency f12 to the frequency characteristic data for the filters 35 and 36 stored in the storage unit 7. The table is specified with reference to the tables Dtp1 and Dtp2. Next, the processing unit 6 currently sets the phase shift amount θb (= b1−) set in the phase shift register of the second DDS 33 (one DDS) that is outputting the second signal S2 as the output signal So. b2), based on the phase shift amount b2 of the filter 36 (one filter) at the common frequency f12 (common frequency in each filter 35, 36) and the phase shift amount b1 of the filter 35 (other filter) at the common frequency f12. When the phase shift amount θa is newly set in the phase shift register of the first DDS 32 (other DDS), the difference ((b1−b2) −θa) between the phase shift amounts of the filter 36 and the filter 35 is the common frequency. The phase shift of the first DDS 32 is made equal to the difference (b1-b2) between the phase shift amounts b1, b2 of the filters 35, 36 at f12. To set the bet amount θa.

この場合、(b1−b2)−θa=b1−b2との関係式から、処理部6は、第1DDS32の位相シフトレジスタに設定すべき位相シフト量θaを数値「0」と算出して、これを第1DDS32に設定する(図4参照)。これにより、第1DDS32での第1信号S1の位相シフト量θaはゼロとなり、この第1信号S1はフィルタ35を通過することによってフィルタ35の位相シフト量b1だけ遅延する。このため、第1DDS32がフィルタ35に出力していた第1信号S1の位相を基準として、フィルタ35から出力される第1信号S1の位相は、b1(=0+b1)だけ遅延する。一方、第2DDS33から出力されている第2信号S2の位相は、第1DDS32がフィルタ35に出力していた第1信号S1の位相を基準として、上記したようにb1だけ遅延している。したがって、フィルタ36から出力されている第2信号S2の位相と、フィルタ35から出力されている第1信号S1の位相とが一致した状態となる。   In this case, from the relational expression of (b1-b2) -θa = b1-b2, the processing unit 6 calculates the phase shift amount θa to be set in the phase shift register of the first DDS 32 as a numerical value “0”. Is set in the first DDS 32 (see FIG. 4). Accordingly, the phase shift amount θa of the first signal S1 in the first DDS 32 becomes zero, and the first signal S1 is delayed by the phase shift amount b1 of the filter 35 by passing through the filter 35. Therefore, the phase of the first signal S1 output from the filter 35 is delayed by b1 (= 0 + b1) with reference to the phase of the first signal S1 output from the first DDS 32 to the filter 35. On the other hand, the phase of the second signal S2 output from the second DDS 33 is delayed by b1 as described above with reference to the phase of the first signal S1 output from the first DDS 32 to the filter 35. Therefore, the phase of the second signal S2 output from the filter 36 and the phase of the first signal S1 output from the filter 35 coincide with each other.

次いで、処理部6は、信号切替処理53を実行する。この信号切替処理53では、処理部6は、第2切替部39に対する切替制御を実行して、出力信号Soを第2信号S2から第1信号S1に切り替える。具体的には、処理部6は、第2切替部39に対して、スイッチ39bをオン状態からオフ状態に移行させると同時に、オフ状態にある残りのスイッチ39a,39c,39dのうちのスイッチ39aのみをオン状態に移行させる切替制御を実行する。これにより、フィルタ36から出力されている第2信号S2に代えて、フィルタ35から出力されている第1信号S1が第2切替部39を介して出力信号Soとして信号生成装置2から出力される。この場合、上記したように、各フィルタ36,35から出力されている第2信号S2および第1信号S1の周波数が同一であって、かつ位相が一致した状態にあるため、第2信号S2から第1信号S1に切り替える際に生じる位相の不連続が大幅に低減されている。つまり、第2信号S2から第1信号S1に、実質的に位相に不連続を生じさせることなく切り替えられる。   Next, the processing unit 6 executes a signal switching process 53. In the signal switching process 53, the processing unit 6 executes switching control for the second switching unit 39 to switch the output signal So from the second signal S2 to the first signal S1. Specifically, the processing unit 6 causes the second switching unit 39 to shift the switch 39b from the on state to the off state, and at the same time, the switch 39a among the remaining switches 39a, 39c, and 39d in the off state. The switching control for shifting only to the ON state is executed. As a result, instead of the second signal S2 output from the filter 36, the first signal S1 output from the filter 35 is output from the signal generating device 2 as the output signal So via the second switching unit 39. . In this case, as described above, since the frequencies of the second signal S2 and the first signal S1 output from the filters 36 and 35 are the same and in phase, the second signal S2 The phase discontinuity that occurs when switching to the first signal S1 is greatly reduced. That is, switching from the second signal S2 to the first signal S1 is performed without causing a phase discontinuity substantially.

続いて、処理部6は、周波数変更処理54を実行する。この周波数変更処理54では、処理部6は、周波数設定制御を各DDS32,33に対して同時に実行することによって各DDS32,33から出力される第1信号S1および第2信号S2の周波数を、フィルタ35の通過帯域内に規定された使用帯域W1内における周波数f1に設定する。具体的には、処理部6は、第1DDS32および第2DDS33に対して、周波数f1を示す周波数データDfa,Dfbをそれぞれ出力して同時に設定する。これにより、第1DDS32から出力されている第1信号S1が、図2に示す通過帯域(この場合、他の通過帯域)に規定されたフィルタ35を介して第2切替部39から出力信号Soとして出力される(つまり、信号生成装置2から第1信号S1が出力信号Soとして出力される)。   Subsequently, the processing unit 6 executes a frequency change process 54. In the frequency changing process 54, the processing unit 6 performs the frequency setting control on the DDSs 32 and 33 simultaneously to filter the frequencies of the first signal S1 and the second signal S2 output from the DDSs 32 and 33. The frequency f1 in the use band W1 defined in the 35 passbands is set. Specifically, the processing unit 6 outputs the frequency data Dfa and Dfb indicating the frequency f1 to the first DDS 32 and the second DDS 33, respectively, and sets them simultaneously. Thereby, the first signal S1 output from the first DDS 32 is output as the output signal So from the second switching unit 39 via the filter 35 defined in the pass band (in this case, another pass band) shown in FIG. Is output (that is, the first signal S1 is output from the signal generator 2 as the output signal So).

これにより、この周波数f1の出力信号Soが増幅部3において増幅されて、測定用信号Smとして測定対象体21に印加される。次いで、処理部6は、上記した周波数がf1の出力信号Soを印加したときの最初のインピーダンスZの測定処理と同様にして、測定対象体21のインピーダンスZを算出し、算出したインピーダンスZを、測定用信号Smの周波数(この例では低下時の周波数f1)に対応させて記憶部7に記憶させる。これにより、周波数f1の測定用信号Smを測定対象体21に印加したときのインピーダンスZの測定についても完了する。   As a result, the output signal So having the frequency f1 is amplified by the amplifying unit 3 and applied to the measurement object 21 as the measurement signal Sm. Next, the processing unit 6 calculates the impedance Z of the measurement object 21 in the same manner as the first measurement process of the impedance Z when the output signal So having the frequency f1 is applied, and calculates the calculated impedance Z as The signal is stored in the storage unit 7 in correspondence with the frequency of the measurement signal Sm (in this example, the frequency f1 at the time of decrease). Thus, the measurement of the impedance Z when the measurement signal Sm having the frequency f1 is applied to the measurement object 21 is also completed.

最後に、処理部6は、周波数を上昇させた際の各周波数f1,f2,f3,f4での各インピーダンスZと、周波数を低下させた際の各周波数f3,f2,f1での各インピーダンスZとを記憶部7から読み出して、出力部8に表示させる。これにより、インピーダンス測定装置1による測定対象体21のインピーダンスZの測定が完了する。   Finally, the processing unit 6 performs impedances Z at the frequencies f1, f2, f3, and f4 when the frequency is increased, and impedances Z at the frequencies f3, f2, and f1 when the frequency is decreased. Are read from the storage unit 7 and displayed on the output unit 8. Thereby, the measurement of the impedance Z of the measuring object 21 by the impedance measuring apparatus 1 is completed.

このように、この信号生成装置2では、第1DDS32および第2DDS33に対して周波数設定制御を実行することによって各フィルタ35〜38の複数の通過帯域のうちの一の通過帯域に含まれる一の周波数の一の信号(第1信号S1および第2信号S2のうちの一方の信号)を一のDDS(第1DDS32および第2DDS33のうちの一方)から出力させると共に一の周波数の他の信号(第1信号S1および第2信号S2のうちの他方の信号)を他のDDS(第1DDS32および第2DDS33のうちの他方)から出力させ、かつ第1切替部34および第2切替部39に対する切替制御を実行することによって一の信号をフィルタ35〜38のうちの通過帯域が上記の通過帯域である一のフィルタを介して出力信号Soとして出力させている状態において、一の信号に代えて複数の通過帯域のうちの一の通過帯域と部分的に重複する他の通過帯域に含まれる他の周波数の他の信号を出力信号Soとして出力させる際に、処理部6が、第1切替部34に対する切替制御を実行して他のDDSをフィルタ35〜38のうちの通過帯域が他の通過帯域である他のフィルタに接続すると共に、周波数設定制御を実行することによって両DDS32,33から出力される一の信号および他の信号の周波数を一の通過帯域と他の通過帯域との重複する帯域に含まれる共通周波数に設定し、次いで、他のDDSに対する位相設定制御を実行して他のフィルタから出力されている他の信号の位相を一のフィルタから出力されている一の信号の位相に一致させた後に、第2切替部39に対する切替制御を実行して、出力信号Soを一の信号から他の信号に切り替える。   As described above, in the signal generation device 2, one frequency included in one pass band of the plurality of pass bands of the filters 35 to 38 by performing frequency setting control on the first DDS 32 and the second DDS 33. One signal (one of the first signal S1 and the second signal S2) is output from one DDS (one of the first DDS32 and the second DDS33) and another signal of the same frequency (first The other signal of the signal S1 and the second signal S2) is output from the other DDS (the other of the first DDS 32 and the second DDS 33), and the switching control for the first switching unit 34 and the second switching unit 39 is executed. As a result, one signal is output as an output signal So through one filter whose pass band is the above-described pass band among the filters 35 to 38. In this state, instead of one signal, another signal of another frequency included in another pass band partially overlapping with one of the plurality of pass bands is output as the output signal So. In this case, the processing unit 6 executes switching control for the first switching unit 34 to connect another DDS to another filter whose pass band is the other pass band among the filters 35 to 38, and to set the frequency. By executing the control, the frequency of one signal and the other signal output from both DDSs 32 and 33 is set to a common frequency included in a band where one passband and another passband overlap, and then the other The phase setting control for the DDS is executed so that the phase of the other signal output from the other filter matches the phase of the one signal output from the one filter, and then the second switching unit 39 Run the switching control switches the output signal So from one signal to another signal.

したがって、この信号生成装置2によれば、一のフィルタから出力されている一の信号(第1信号S1および第2信号S2の一方)および他のフィルタから出力されている他の信号(第1信号S1および第2信号S2の他方)の周波数が同一であって、かつ位相が一致した状態にあるため、一の信号から他の信号に切り替える際に、出力信号Soに生じる位相の不連続を大幅に低減させることができる。つまり、実質的に、位相に不連続を生じさせることなく一の信号から他の信号に切り替えて、出力信号Soを生成して出力させることができる。これにより、この信号生成装置2を備え、信号生成装置2からの出力信号Soに基づく測定用信号Smを測定対象体21に印加する(測定用信号Smを供給する)インピーダンス測定装置1においても、測定用信号Smの周波数の変更時に測定用信号Smに位相の不連続が生じないため、測定対象体21がインダクタンス成分を有するものであったとしても、瞬間的に大きな逆起電力が発生することを確実に回避することができ、また測定対象体21が容量成分を有するものであったとしても、瞬間的に過大な電流が流れることを確実に回避することができる。   Therefore, according to this signal generation device 2, one signal (one of the first signal S1 and the second signal S2) output from one filter and the other signal (first signal) output from another filter. Since the frequency of the other of the signal S1 and the second signal S2 is the same and the phase is in agreement, the phase discontinuity that occurs in the output signal So when switching from one signal to another is eliminated. It can be greatly reduced. That is, the output signal So can be generated and output by substantially switching from one signal to another without causing discontinuity in the phase. Thereby, also in the impedance measuring apparatus 1 provided with the signal generating apparatus 2 and applying the measurement signal Sm based on the output signal So from the signal generating apparatus 2 to the measurement object 21 (supplying the measurement signal Sm), Since there is no phase discontinuity in the measurement signal Sm when the frequency of the measurement signal Sm is changed, a large back electromotive force is instantaneously generated even if the measurement object 21 has an inductance component. Can be reliably avoided, and even if the measurement object 21 has a capacitive component, it can be reliably avoided that an excessive current flows instantaneously.

また、この信号生成装置2によれば、処理部6が、他のDDSに対する位相設定制御を実行して他のフィルタから出力されている他の信号の位相を一のフィルタから出力されている一の信号の位相に一致させる際に、両DDS32,33の各位相の差(位相シフト量θa,θb)が、共通周波数における一のフィルタおよび他のフィルタの各位相シフト量の差分と等しくなるように他のDDSの位相を設定することにより、他のフィルタから出力されている他の信号の位相を一のフィルタから出力されている一の信号の位相に確実に一致させることができる。   Further, according to this signal generation device 2, the processing unit 6 executes phase setting control for another DDS and outputs the phase of another signal output from another filter from one filter. In order to match the phase of the two signals, the difference in phase between the DDSs 32 and 33 (phase shift amounts θa and θb) is made equal to the difference between the phase shift amounts of one filter and other filters at the common frequency. By setting the phase of the other DDS to, the phase of the other signal output from the other filter can be surely matched with the phase of the one signal output from the one filter.

なお、2つの第1DDS32および第2DDS33を第1切替部34を介してフィルタ35,36,37,38に選択的に切り替えながら接続する構成を採用して、DDSの数を最小限の2つにすることで、信号生成装置2自体、ひいてはインピーダンス測定装置1の構成を簡略化する例について上記したが、図5に示す信号生成装置2Aのように、フィルタ35,36,37,38毎に、第1DDS32、第2DDS33、第3DDS41および第4DDS42を配設する構成を採用することもできる。この構成によれば、DDSの数は増加するものの、第1切替部34の配設を省くことができる(つまり、第1切替部34に対する切替制御を省くことができる)ため、処理部6が実行する制御を軽減することができる。以下、信号生成装置2Aの構成と動作について説明する。なお、信号生成装置2と同一の構成については同一の符号を付して重複する説明を省略する。   Note that a configuration in which the two first DDSs 32 and the second DDS 33 are selectively switched and connected to the filters 35, 36, 37, and 38 via the first switching unit 34 is adopted, so that the number of DDSs is minimized to two. As described above, the example of simplifying the configuration of the signal generation device 2 itself and consequently the impedance measurement device 1 has been described above. However, like the signal generation device 2A illustrated in FIG. 5, for each of the filters 35, 36, 37, and 38, A configuration in which the first DDS 32, the second DDS 33, the third DDS 41, and the fourth DDS 42 are disposed may be employed. According to this configuration, although the number of DDSs increases, the arrangement of the first switching unit 34 can be omitted (that is, the switching control for the first switching unit 34 can be omitted). The control to be executed can be reduced. Hereinafter, the configuration and operation of the signal generation device 2A will be described. In addition, about the structure same as the signal generator 2, the same code | symbol is attached | subjected and the overlapping description is abbreviate | omitted.

この信号生成装置2Aは、図5に示すように、基準信号生成部31、第1DDS32、第2DDS33、、第3DDS41、第4DDS42、複数(本例では4つ)のフィルタ35,36,37,38、第2切替部39および処理部6を備え、信号生成装置2と同様にして、使用帯域W1,W2,W3,W4内の任意の1つの周波数の出力信号Soを生成して出力し得るように構成されている。   As shown in FIG. 5, the signal generation device 2A includes a reference signal generation unit 31, a first DDS 32, a second DDS 33, a third DDS 41, a fourth DDS 42, and a plurality (four in this example) of filters 35, 36, 37, and 38. The second switching unit 39 and the processing unit 6 are provided, and the output signal So of any one frequency in the use bands W1, W2, W3, and W4 can be generated and output in the same manner as the signal generation device 2. It is configured.

基準信号生成部31は、基準信号Scを生成して、各DDS32,33,41,42に出力する。第1DDS32はフィルタ35に直接接続され、第2DDS33はフィルタ36に直接接続され、第3DDS41はフィルタ37に直接接続され、第4DDS42はフィルタ38に直接接続されている。   The reference signal generator 31 generates a reference signal Sc and outputs it to each DDS 32, 33, 41, 42. The first DDS 32 is directly connected to the filter 35, the second DDS 33 is directly connected to the filter 36, the third DDS 41 is directly connected to the filter 37, and the fourth DDS 42 is directly connected to the filter 38.

また、第3DDS41は、上記した信号生成装置2の第1DDS32および第2DDS33と同様にして、基準信号Scに同期して作動して、処理部6によって設定された周波数データDfcで示される周波数fcの第3信号(一例として正弦波信号)S3を生成して出力すると共に、位相シフトレジスタ(不図示)を備え、処理部6によってこの位相シフトレジスタに設定された位相シフト量θcだけ第3信号S3の位相をシフトさせる。第4DDS42も、上記の第1DDS32および第2DDS33と同様にして、基準信号Scに同期して作動して、処理部6によって設定された周波数データDfdで示される周波数fdの第4信号(一例として正弦波信号)S4を生成して出力すると共に、位相シフトレジスタ(不図示)を備え、処理部6によってこの位相シフトレジスタに設定された位相シフト量θdだけ第4信号S4の位相をシフトさせる。   Similarly to the first DDS 32 and the second DDS 33 of the signal generation device 2 described above, the third DDS 41 operates in synchronization with the reference signal Sc, and has the frequency fc indicated by the frequency data Dfc set by the processing unit 6. A third signal (as an example, a sine wave signal) S3 is generated and output, and also includes a phase shift register (not shown), and the third signal S3 by the phase shift amount θc set in the phase shift register by the processing unit 6 Shift the phase of. Similarly to the first DDS 32 and the second DDS 33 described above, the fourth DDS 42 operates in synchronization with the reference signal Sc, and a fourth signal (for example, a sine as a frequency fd indicated by the frequency data Dfd set by the processing unit 6. (Wave signal) S4 is generated and output, and a phase shift register (not shown) is provided, and the phase of the fourth signal S4 is shifted by the processing unit 6 by the phase shift amount θd set in the phase shift register.

また、各DDS32,33,41,42は、処理部6による周波数設定制御が同時になされることにより、同一の周波数が同時に設定される。なお、各位相シフト量θa,θb,θc,θdについては、処理部6による位相設定制御により、個別に設定される。   In addition, the same frequency is simultaneously set in each DDS 32, 33, 41, and 42 by performing frequency setting control by the processing unit 6 at the same time. The phase shift amounts θa, θb, θc, and θd are individually set by phase setting control by the processing unit 6.

この構成により、第2切替部39は、各スイッチ39a,39b,39c,39dが処理部6によってオン・オフ状態が制御されることにより、各フィルタ35,36,37,38のうちの任意の1つを選択して、選択されたフィルタに接続されているDDSから出力されている信号S1,S2,S3,S4のうちの1つの信号を出力信号Soとして出力する。   With this configuration, the second switching unit 39 is configured so that any one of the filters 35, 36, 37, and 38 is controlled by the switches 6 a, 39 b, 39 c, and 39 d being controlled by the processing unit 6. One is selected, and one of the signals S1, S2, S3, and S4 output from the DDS connected to the selected filter is output as the output signal So.

この信号生成装置2Aでは、処理部6による周波数設定制御が各DDS32,33,41,42に対して実行されて、各フィルタ35〜38の各通過帯域のうちの一の通過帯域に含まれる一の周波数の信号S1〜S4を各DDS32,33,41,42から出力させると共に、処理部6による切替制御が第2切替部39に対して実行されて、各フィルタ35〜38のうちの通過帯域が上記の一の通過帯域である一のフィルタに対応して配設された一のDDSから出力されている一の信号を出力信号Soとして出力させている状態において、この一の信号に代えて各通過帯域のうちの一の通過帯域と部分的に重複する他の通過帯域に含まれている他の周波数の他の信号を出力信号Soとして出力させる際に、処理部6が、周波数設定制御を各DDS32,33,41,42に対して実行することによって各DDS32,33,41,42から出力される各信号S1〜S4の周波数を一の通過帯域と他の通過帯域との重複する帯域に含まれる共通周波数に設定し、次いで、各フィルタ35〜38のうちの通過帯域が他の通過帯域である他のフィルタに対応して配設された他のDDSに対する位相設定制御を実行して他のフィルタから出力されている他の信号の位相を一の信号の位相に一致させた後に、第2切替部39に対する切替制御を実行して、出力信号Soを一の信号から他の信号に切り替える。   In this signal generation device 2A, the frequency setting control by the processing unit 6 is executed for each of the DDSs 32, 33, 41, and 42, and is included in one of the pass bands of the filters 35 to 38. Are output from the DDSs 32, 33, 41, and 42, and the switching control by the processing unit 6 is executed on the second switching unit 39, so that the passbands of the filters 35 to 38 are obtained. In the state where one signal output from one DDS arranged corresponding to one filter having the one pass band is output as the output signal So, instead of this one signal When outputting other signals of other frequencies included in other passbands partially overlapping with one of the passbands as the output signal So, the processing unit 6 performs frequency setting control. Each D The frequency of each signal S1 to S4 output from each DDS 32, 33, 41, 42 by executing for S32, 33, 41, 42 is included in the band where one pass band and another pass band overlap. The common frequency is set, and then the phase setting control for the other DDS arranged corresponding to the other filter whose pass band is the other pass band among the filters 35 to 38 is executed. After the phase of the other signal output from the filter is matched with the phase of the one signal, the switching control for the second switching unit 39 is executed to switch the output signal So from the one signal to the other signal.

一例として、フィルタ35,36,37,38をこの順に切り替えつつ、出力信号Soの周波数を上昇させる場合を例に挙げて説明する。最初に、第1DDS32(この場合、一のDDS)とフィルタ35(この場合、一のフィルタ)との組から出力される第1信号S1(この場合、一の信号)に代えて、第2DDS33(この場合、他のDDS)とフィルタ36(この場合、他のフィルタ)との組から出力される第2信号S2(この場合、他の信号)を出力信号Soとして出力するときには、各DDS32,33,41,42に対して周波数設定制御を同時に実行することによって各DDS32,33,41,42から出力される各信号S1〜S4の周波数を各フィルタ35,36の通過帯域の重複する帯域に含まれる共通周波数に設定し、次いで、第2DDS33に対する位相シフト量θbとして(b1−b2)を設定して両信号S1,S2の位相を一致させた後に、第1信号S1から第2信号S2に切り替える。   As an example, a case where the frequency of the output signal So is increased while switching the filters 35, 36, 37, and 38 in this order will be described as an example. First, instead of the first signal S1 (in this case, one signal) output from the set of the first DDS 32 (in this case, one DDS) and the filter 35 (in this case, one filter), the second DDS 33 ( In this case, when the second signal S2 (in this case, another signal) output from the set of the other DDS) and the filter 36 (in this case, another filter) is output as the output signal So, each DDS 32, 33 , 41, and 42, the frequencies of the signals S1 to S4 output from the DDSs 32, 33, 41, and 42 are included in the overlapping bands of the passbands of the filters 35 and 36 by simultaneously executing the frequency setting control. Is set to a common frequency, and (b1-b2) is set as the phase shift amount θb with respect to the second DDS 33 so that the phases of both signals S1 and S2 coincide with each other. Switching from S1 to the second signal S2.

また、第2DDS33(この場合、一のDDS)とフィルタ36(この場合、一のフィルタ)との組から出力される第2信号S2(この場合、一の信号)に代えて、第3DDS41(この場合、他のDDS)とフィルタ37(この場合、他のフィルタ)との組から出力される第3信号S3(この場合、他の信号)を出力信号Soとして出力するときには、各DDS32,33,41,42に対して周波数設定制御を同時に実行することによって各DDS32,33,41,42から出力される各信号S1〜S4の周波数を各フィルタ36,37の通過帯域の重複する帯域に含まれる共通周波数に設定し、次いで、第3DDS41に対する位相シフト量θcとして(b1−b3)を設定して両信号S2,S3の位相を一致させた後に、第2信号S2から第3信号S3に切り替える。   Further, instead of the second signal S2 (in this case, one signal) output from the set of the second DDS 33 (in this case, one DDS) and the filter 36 (in this case, one filter), a third DDS 41 (in this case) In this case, when the third signal S3 (in this case, another signal) output from the set of the other DDS) and the filter 37 (in this case, another filter) is output as the output signal So, each DDS 32, 33, By simultaneously performing frequency setting control on the terminals 41 and 42, the frequencies of the signals S1 to S4 output from the DDSs 32, 33, 41, and 42 are included in the overlapping bands of the pass bands of the filters 36 and 37. After setting the common frequency, and then setting (b1-b3) as the phase shift amount θc with respect to the third DDS 41 to match the phases of both signals S2, S3, the second signal Switching from 2 to the third signal S3.

また、第3DDS41(この場合、一のDDS)とフィルタ37(この場合、一のフィルタ)との組から出力される第3信号S3(この場合、一の信号)に代えて、第4DDS42(この場合、他のDDS)とフィルタ38(この場合、他のフィルタ)との組から出力される第4信号S4(この場合、他の信号)を出力信号Soとして出力するときには、各DDS32,33,41,42に対して周波数設定制御を同時に実行することによって各DDS32,33,41,42から出力される各信号S1〜S4の周波数を各フィルタ37,38の通過帯域の重複する帯域に含まれる共通周波数に設定し、次いで、第4DDS42に対する位相シフト量θdとして(b1−b4)を設定して両信号S3,S4の位相を一致させた後に、第3信号S3から第4信号S4に切り替える。なお、フィルタ38,37,36,35をこの順に切り替えつつ、出力信号Soの周波数を低下させる場合については、具体例を挙げての説明を省略するが、上記した周波数の上昇の手順と逆の手順を実行すればよい。   Further, instead of the third signal S3 (in this case, one signal) output from the set of the third DDS 41 (in this case, one DDS) and the filter 37 (in this case, one filter), a fourth DDS 42 (in this case) In this case, when the fourth signal S4 (in this case, another signal) output from the set of the other DDS) and the filter 38 (in this case, another filter) is output as the output signal So, each DDS 32, 33, By simultaneously performing frequency setting control for 41 and 42, the frequencies of the signals S1 to S4 output from the DDSs 32, 33, 41, and 42 are included in the overlapping bands of the pass bands of the filters 37 and 38, respectively. After setting the common frequency, and then setting (b1-b4) as the phase shift amount θd with respect to the fourth DDS 42 to match the phases of both signals S3, S4, the third signal Switching from 3 to the fourth signal S4. In addition, about the case where the frequency of the output signal So is lowered while switching the filters 38, 37, 36, and 35 in this order, the description with a specific example is omitted, but it is the reverse of the procedure for raising the frequency described above. Just follow the steps.

これにより、この信号生成装置2Aによれば、一のフィルタと他のフィルタから出力されている各信号相互間の位相が一致させられているため、出力信号Soとして出力する信号を一の信号から他の信号に切り替える際に、出力信号Soに生じる位相の不連続を大幅に低減させることができる。つまり、実質的に、位相に不連続を生じさせることなく一の信号から他の信号に切り替えて、出力信号Soを生成して出力させることができる。したがって、この信号生成装置2Aを備え、信号生成装置2Aからの出力信号Soに基づく測定用信号を測定対象体21に印加する(測定用信号を供給する)インピーダンス測定装置においても、測定用信号Smの周波数の変更時に測定用信号Smに位相の不連続が生じないため、測定対象体21がインダクタンス成分を有するものであったとしても、瞬間的に大きな逆起電力が発生することを確実に回避することができ、また測定対象体21が容量成分を有するものであったとしても、瞬間的に過大な電流が流れることを確実に回避することができる。   Thereby, according to this signal generation device 2A, since the phases of the signals output from the one filter and the other filters are matched, the signal output as the output signal So is changed from the one signal. When switching to another signal, the phase discontinuity that occurs in the output signal So can be greatly reduced. That is, the output signal So can be generated and output by substantially switching from one signal to another without causing discontinuity in the phase. Therefore, the measurement signal Sm is also provided in the impedance measurement apparatus that includes the signal generation device 2A and applies a measurement signal based on the output signal So from the signal generation device 2A to the measurement object 21 (supplying the measurement signal). Since there is no phase discontinuity in the measurement signal Sm when the frequency of the signal is changed, even if the measurement object 21 has an inductance component, it is reliably avoided that a large back electromotive force is generated instantaneously. Even if the measurement object 21 has a capacitive component, it is possible to reliably avoid an excessively large current from flowing instantaneously.

また、上記した信号生成装置2,2Aでは、各フィルタ35,36,37,38として、低域通過型フィルタを使用しているが、使用帯域W1,W2,W3,W4を通過帯域に含む帯域通過型フィルタ(バンドパスフィルタ)を使用することもできる。また、信号生成装置2,2Aをインピーダンス測定装置1に使用した例について上記したが、信号生成装置2,2Aを単独で使用してもよいし、インピーダンス測定装置1以外の各種計測装置や電子機器に使用してもよいのは勿論である。   Further, in the signal generation devices 2 and 2A described above, low-pass filters are used as the filters 35, 36, 37, and 38, but the bands that include the use bands W1, W2, W3, and W4 in the pass bands. A pass-type filter (bandpass filter) can also be used. In addition, the example in which the signal generation devices 2 and 2A are used for the impedance measurement device 1 has been described above. However, the signal generation devices 2 and 2A may be used alone, or various measurement devices and electronic devices other than the impedance measurement device 1 may be used. Of course, it may be used.

また、信号生成装置2,2Aでは、出力信号Soの周波数を上昇させる場合において、一のDDSに接続された一のフィルタから出力される一の周波数の一の信号に代えて、他のDDSが出力する他の周波数の他の信号を出力信号Soとして出力させる際に、各DDSから出力される信号の周波数を、一の周波数が含まれる一の通過帯域と他の周波数が含まれる他の通過帯域との重複する帯域に含まれる共通周波数に設定し、この状態において、他のDDSに対する位相設定制御を実行して、この他のDDSに接続された他のフィルタから出力されている他の信号の位相を一のフィルタから出力されている一の信号の位相に一致させた後に、第2切替部39に対する切替制御を実行して、出力信号Soを一の信号から他の信号に切り替える構成を採用しているが、出力信号Soの周波数を上昇させる場合においても周波数を低下させる場合と同様にして、一の通過帯域内に規定された一の使用帯域と他の通過帯域内に規定された他の使用帯域との重複する帯域に含まれる周波数を共通周波数として設定し、この状態において、他のDDSに対する位相設定制御を実行して、この他のDDSに接続された他のフィルタから出力されている他の信号の位相を一のフィルタから出力されている一の信号の位相に一致させた後に、第2切替部39に対する切替制御を実行して、出力信号Soを一の信号から他の信号に切り替える構成を採用することもできる。   In the signal generation devices 2 and 2A, when the frequency of the output signal So is increased, instead of one signal of one frequency output from one filter connected to one DDS, another DDS When outputting other signals of other frequencies to be output as the output signal So, the frequency of the signal output from each DDS is changed to one pass band including one frequency and another pass including another frequency. Other signals output from other filters connected to the other DDS by setting the common frequency included in the band overlapping with the band and executing phase setting control for the other DDS in this state After making the phase of the first signal coincide with the phase of one signal output from one filter, the second switching unit 39 is controlled to switch the output signal So from one signal to another signal. However, when the frequency of the output signal So is increased, it is specified in one passband and in the other passband in the same manner as when the frequency is decreased. A frequency included in a band overlapping with another used band is set as a common frequency, and in this state, phase setting control for another DDS is executed and output from another filter connected to the other DDS After the phase of the other signal being matched with the phase of the one signal being output from the one filter, the switching control for the second switching unit 39 is executed, and the output signal So is changed from the one signal to the other. It is also possible to adopt a configuration for switching to the above signal.

この構成によれば、出力信号Soとして各フィルタ35,36,37,38から出力される信号の周波数を、各フィルタ35,36,37,38において不要スプリアス成分を適切に除去し得る使用帯域W1,W2,W3,W4内に常に維持することができる結果、出力信号Soに含まれる不要スプリアス成分を大幅に低減することができる。   According to this configuration, the frequency band of the signal output from each of the filters 35, 36, 37, and 38 as the output signal So, and the use band W1 that can appropriately remove unnecessary spurious components in each of the filters 35, 36, 37, and 38. , W2, W3, and W4, the unnecessary spurious components included in the output signal So can be greatly reduced.

1 インピーダンス測定装置
2,2A 信号生成装置
6 処理部
32 第1DDS
33 第2DDS
34 第1切替部
35,36,37,38 フィルタ
39 第2切替部
W1,W2,W3,W4 使用帯域
DESCRIPTION OF SYMBOLS 1 Impedance measurement apparatus 2,2A Signal generation apparatus 6 Processing part 32 1st DDS
33 Second DDS
34 First switching unit 35, 36, 37, 38 Filter 39 Second switching unit W1, W2, W3, W4 Bandwidth used

Claims (5)

通過帯域同士が部分的に重複するように規定された複数のフィルタと、
設定された周波数の一の信号を生成して出力すると共に当該一の信号の位相を変更可能に構成された一のDDSと、
設定された周波数の他の信号を生成して出力すると共に当該他の信号の位相を変更可能に構成された他のDDSと、
前記一のDDSを前記複数のフィルタのうちから選択された一のフィルタに接続すると共に、前記他のDDSを当該一のフィルタを除く他の1つのフィルタに接続する第1切替部と、
前記一のフィルタから出力される前記一の信号および前記他のフィルタから出力される前記他の信号のうちの1つを選択して出力信号として出力する第2切替部と、
すべての前記DDSに対して同一の周波数を同時に設定する周波数設定制御、当該各DDSに対して前記位相を設定する位相設定制御、並びに前記第1切替部および前記第2切替部に対する切替制御を実行する処理部とを備え、
前記処理部は、前記周波数設定制御を実行することによって前記複数のフィルタの前記複数の通過帯域のうちの一の通過帯域に含まれる一の周波数の前記一の信号を前記一のDDSから出力させると共に当該一の周波数の前記他の信号を前記他のDDSから出力させ、かつ前記第1切替部および前記第2切替部に対する切替制御を実行することによって当該一の信号を前記複数のフィルタのうちの前記通過帯域が前記一の通過帯域である一のフィルタを介して前記出力信号として出力させている状態において、当該一の信号に代えて前記複数の通過帯域のうちの当該一の通過帯域と部分的に重複する他の通過帯域に含まれる他の周波数の前記他の信号を当該出力信号として出力させる際に、
前記第1切替部に対する切替制御を実行して前記他のDDSを前記複数のフィルタのうちの前記通過帯域が前記他の通過帯域である他のフィルタに接続すると共に、前記周波数設定制御を実行することによって前記各DDSから出力される前記一の信号および前記他の信号の周波数を前記一の通過帯域と前記他の通過帯域との重複する帯域に含まれる共通周波数に設定し、次いで、当該他のDDSに対する前記位相設定制御を実行して当該他のフィルタから出力されている前記他の信号の位相を前記一のフィルタから出力されている前記一の信号の位相に一致させた後に、前記第2切替部に対する切替制御を実行して、前記出力信号を前記一の信号から前記他の信号に切り替える信号生成装置。
A plurality of filters defined such that the passbands partially overlap,
One DDS configured to generate and output one signal of a set frequency and change the phase of the one signal;
Another DDS configured to generate and output another signal of a set frequency and change the phase of the other signal;
A first switching unit that connects the one DDS to one filter selected from the plurality of filters, and connects the other DDS to another filter other than the one filter;
A second switching unit that selects and outputs one of the one signal output from the one filter and the other signal output from the other filter as an output signal;
Executes frequency setting control for simultaneously setting the same frequency for all the DDS, phase setting control for setting the phase for each DDS, and switching control for the first switching unit and the second switching unit And a processing unit to
The processing unit outputs the one signal of one frequency included in one pass band of the plurality of pass bands of the plurality of filters from the one DDS by executing the frequency setting control. And outputting the other signal of the one frequency from the other DDS, and executing the switching control on the first switching unit and the second switching unit, and thereby changing the one signal out of the plurality of filters. In the state where the output signal is output as the output signal through one filter whose one passband is the one passband, the one passband of the plurality of passbands instead of the one signal When outputting the other signals of other frequencies included in other partially overlapping passbands as the output signals,
Execute switching control for the first switching unit to connect the other DDS to another filter whose pass band is the other pass band among the plurality of filters, and to execute the frequency setting control Accordingly, the frequency of the one signal and the other signal output from each DDS is set to a common frequency included in the overlapping band of the one pass band and the other pass band, and then the other After the phase setting control for the DDS is executed and the phase of the other signal output from the other filter is matched with the phase of the one signal output from the one filter, 2. A signal generation device that executes switching control for the switching unit and switches the output signal from the one signal to the other signal.
通過帯域同士が部分的に重複するように規定された複数のフィルタと、
前記複数のフィルタの各々に対応して配設されて、設定された周波数の信号を生成して出力すると共に当該信号の位相を変更可能に構成された複数のDDSと、
前記複数のフィルタから出力される前記信号のうちの1つを選択して出力信号として出力する切替部と、
すべての前記DDSに対して同一の周波数を同時に設定する周波数設定制御、当該各DDSに対して前記位相を設定する位相設定制御、並びに前記切替部に対する切替制御を実行する処理部とを備え、
前記処理部は、前記周波数設定制御を実行することによって前記複数のフィルタの前記複数の通過帯域のうちの一の通過帯域に含まれる一の周波数の前記信号を前記複数のDDSから出力させると共に、前記切替制御を実行することによって前記複数のフィルタのうちの前記通過帯域が前記一の通過帯域である一のフィルタに対応して配設された前記複数のDDSのうちの一のDDSから出力されている一の前記信号を前記出力信号として出力させている状態において、当該一の信号に代えて前記複数の通過帯域のうちの当該一の通過帯域と部分的に重複する他の通過帯域に含まれている他の周波数の他の前記信号を当該出力信号として出力させる際に、
前記周波数設定制御を実行することによって前記複数のDDSから出力される前記信号の周波数を前記一の通過帯域と前記他の通過帯域との重複する帯域に含まれる共通周波数に設定し、次いで、前記複数のフィルタのうちの前記通過帯域が前記他の通過帯域である他のフィルタに対応して配設された前記複数のDDSのうちの他のDDSに対する前記位相設定制御を実行して当該他のフィルタから出力されている前記他の信号の位相を前記一の信号の位相に一致させた後に、前記切替部に対する切替制御を実行して、前記出力信号を前記一の信号から前記他の信号に切り替える信号生成装置。
A plurality of filters defined such that the passbands partially overlap,
A plurality of DDSs arranged corresponding to each of the plurality of filters, configured to generate and output a signal of a set frequency and change the phase of the signal;
A switching unit that selects and outputs one of the signals output from the plurality of filters as an output signal;
A frequency setting control for simultaneously setting the same frequency for all the DDS, a phase setting control for setting the phase for each DDS, and a processing unit for executing a switching control for the switching unit,
The processing unit outputs the signal of one frequency included in one passband of the plurality of passbands of the plurality of filters from the plurality of DDS by executing the frequency setting control, By executing the switching control, the passband of the plurality of filters is output from one DDS of the plurality of DDS arranged corresponding to one filter that is the one passband. In the state where the one signal is output as the output signal, it is included in another pass band that partially overlaps the one pass band of the plurality of pass bands instead of the one signal. When outputting the other signals having other frequencies as the output signal,
By executing the frequency setting control, the frequency of the signal output from the plurality of DDSs is set to a common frequency included in a band where the one pass band and the other pass band overlap, and then The phase setting control is performed on the other DDSs of the plurality of DDSs arranged corresponding to the other filters in which the pass band of the plurality of filters is the other pass band. After matching the phase of the other signal output from the filter with the phase of the one signal, switching control is performed on the switching unit, and the output signal is changed from the one signal to the other signal. Switching signal generator.
前記処理部は、前記他のDDSに対する前記位相設定制御を実行して前記他のフィルタから出力されている前記他の信号の位相を前記一のフィルタから出力されている前記一の信号の位相に一致させる際に、前記一のDDSと前記他のDDSの前記各位相の差が、前記共通周波数における前記一のフィルタおよび前記他のフィルタの各位相シフト量の差分と等しくなるように当該他のDDSの位相を設定する請求項1または2記載の信号生成装置。   The processing unit executes the phase setting control for the other DDS and changes the phase of the other signal output from the other filter to the phase of the one signal output from the one filter. When matching, the difference between the phases of the one DDS and the other DDS is equal to the difference between the phase shift amounts of the one filter and the other filter at the common frequency. The signal generation device according to claim 1, wherein the phase of the DDS is set. 前記処理部は、前記共通周波数として、前記一の通過帯域内に規定された一の使用帯域と前記他の通過帯域内に規定された他の使用帯域との重複する帯域に含まれる周波数を設定する請求項1から3のいずれかに記載の信号生成装置。   The processing unit sets, as the common frequency, a frequency included in a band that overlaps one use band defined in the one pass band and another use band defined in the other pass band. The signal generation device according to claim 1. 請求項1から4のいずれかに記載の信号生成装置と、
前記信号生成装置から出力される出力信号を測定対象体に印加したときに前記測定対象体に流れる電流を検出する電流検出部と、
前記電流が流れているときに前記測定対象体の両端間に発生する電圧を検出する電圧検出部とを備え、
前記処理部は、前記電流検出部によって検出された前記電流、および前記電圧検出部によって検出された前記電圧に基づいて前記測定対象体のインピーダンスを測定するインピーダンス測定装置。
A signal generation device according to any one of claims 1 to 4,
A current detector that detects a current flowing through the measurement object when an output signal output from the signal generator is applied to the measurement object;
A voltage detection unit that detects a voltage generated between both ends of the measurement object when the current is flowing;
The said process part is an impedance measurement apparatus which measures the impedance of the said measuring object based on the said current detected by the said current detection part, and the said voltage detected by the said voltage detection part.
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