JP5393893B2 - 複数のマイクロプロセッサを有するストレージシステム、及び、そのストレージシステムにおける処理分担方法 - Google Patents
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Description
l:ホストI/F(ポート)の搭載数、
L:ホストI/F(ポート)の搭載可能な最大数、
m:HDD170の搭載数、M:HDD170の搭載可能な最大数、
n:MP121の搭載数、
a:RAIDレベル1に対応したRAIDグループ(又はHDD170)の数、
b:RAIDレベル5に対応したRAIDグループ(又はHDD170)の数、
c:RAIDレベル6に対応したRAIDグループ(又はHDD170)の数、
p:非同期ローカルコピーに対応したHDD170(又は、ボリュームペア及び/又は論理ボリューム)の数、
q:キャッシュ常駐機能に対応したHDD170(又は、ボリュームペア及び/又は論理ボリューム)の数、
floor(x):x以下最大の整数を表す関数;
ceil(x):x以上最小の整数を表す関数。
Claims (8)
- 複数の論理ボリュームを提供可能な複数のストレージデバイスと、
前記複数の論理ボリュームのうちいずれかを指定した入出力要求を外部デバイスから受け付けて処理するコントローラと、
を備え、
前記コントローラは、
前記外部デバイスと通信するための第1インタフェースと、
前記各ストレージデバイスと通信するための第2インタフェースと、
前記第1インタフェース及び前記第2インタフェースにそれぞれ接続されるメモリと、
前記各第1インタフェースと前記各第2インタフェース及び前記メモリにそれぞれ接続される、複数のマイクロプロセッサとを含んでおり、
前記各マイクロプロセッサは、前記外部デバイスからの前記入出力要求が実行契機となる同期処理と、前記同期処理以外の非同期処理とを実行することができ、
前記各マイクロプロセッサは、予め設定される上限値まで前記同期処理を実行することができ、かつ、前記同期処理を実行していない場合に前記非同期処理を実行することができ、
前記各マイクロプロセッサにより使用されるメモリ領域には、所定の複数のモード毎に第1上限値と第2上限値とを対応付けて管理する上限値管理情報が記憶されており、
前記第1上限値は、前記同期処理のうち前記第1インタフェースに関する同期処理を実行できる回数の上限値を示し、
前記第2上限値は、前記同期処置及び前記非同期処理のうち前記第2インタフェースに関する同期処理及び非同期処理を実行できる回数の上限値を示し、
前記複数モードに含まれる第1モードでは、前記第1上限値の方が前記第2上限値よりも大きくなるように設定されており、
前記複数モードに含まれる第2モードでは、前記第2上限値の方が前記第1上限値よりも大きくなるように設定されており、
前記複数モードに含まれる第3モードでは、前記第1上限値と前記第2上限値とが同一に設定されており、
前記各マイクロプロセッサ毎にそれぞれ前記第1モードまたは前記第2モードまたは前記第3モードのいずれか一つのモードが設定されており、
前記各マイクロプロセッサの使用率と、前記メモリにのみ記憶されており前記ストレージデバイスに書き込まれていない未書込みデータの量とに基づいて、前記第1モードまたは前記第2モードまたは前記第3モードのうちのいずれのモードを前記各マイクロプロセッサに設定するか否かが、所定の周期で決定されるようになっており、
前記使用率が所定の使用率未満の場合は、前記第1モードが設定され、
前記使用率が前記所定の使用率以上であって、かつ、前記未書込みデータの量が所定のデータ量以上の場合は、前記第2モードが設定され、
前記使用率が前記所定の使用率以上であって、かつ、前記未書込みデータの量が前記所定のデータ量未満の場合は、前記第3モードが設定される、
ストレージシステム。
- 複数の論理ボリュームを提供可能な複数のストレージデバイスと、
前記複数の論理ボリュームのうちいずれかを指定した入出力要求を外部デバイスから受け付けて処理するコントローラと、
を備え、
前記コントローラは、
前記外部デバイスと通信するための第1インタフェースと、
前記各ストレージデバイスと通信するための第2インタフェースと、
前記第1インタフェース及び前記第2インタフェースにそれぞれ接続されるメモリと、
前記各第1インタフェースと前記各第2インタフェース及び前記メモリにそれぞれ接続される、複数のマイクロプロセッサとを含んでおり、
前記各マイクロプロセッサは、前記外部デバイスからの前記入出力要求が実行契機となる同期処理と、前記同期処理以外の非同期処理とを実行することができ、
前記各マイクロプロセッサは、予め設定される上限値まで前記同期処理を実行することができ、かつ、前記同期処理を実行していない場合に前記非同期処理を実行することができ、
前記上限値は、複数モードの中から選択される一つのモードに従って、設定されるストレージシステム。
- 前記各マイクロプロセッサには、所定の周期で、複数モードの中からいずれか一つのモードが設定されるようになっており、
前記複数モードには、前記同期処理を実行可能な回数が前記非同期処理を実行可能な回数よりも大きく設定されている同期処理優先モードと、前記同期処理を実行可能な回数が前記非同期処理を実行可能な回数よりも小さく設定されている非同期処理優先モードと、が含まれており、
前記各マイクロプロセッサは、前記複数モードの中から設定されるいずれか一つのモードに従って、前記同期処理と前記非同期処理とを実行する、
請求項2に記載のストレージシステム。
- 前記各マイクロプロセッサには、前記各マイクロプロセッサの使用率と、前記メモリにのみ記憶されており前記ストレージデバイスに書き込まれていない未書込みデータの量とに基づいて、前記複数モードの中からいずれか一つのモードが前記所定の周期で設定される、
請求項3に記載のストレージシステム。
- 前記各マイクロプロセッサの中には、前記同期処理だけを実行する同期処理担当モードに設定されるマイクロプロセッサと、前記非同期処理だけを実行する非同期処理担当モードに設定されるマイクロプロセッサとが、さらに含まれている、
請求項3に記載のストレージシステム。
- 複数の論理ボリュームを提供可能な複数のストレージデバイスと、
前記複数の論理ボリュームのうちいずれかを指定した入出力要求を外部デバイスから受け付けて処理するコントローラと、
を備え、
前記コントローラは、
前記外部デバイスと通信するための第1インタフェースと、
前記各ストレージデバイスと通信するための第2インタフェースと、
前記第1インタフェース及び前記第2インタフェースにそれぞれ接続されるメモリと、
前記各第1インタフェースと前記各第2インタフェース及び前記メモリにそれぞれ接続される、複数のマイクロプロセッサとを含んでおり、
前記各マイクロプロセッサは、前記外部デバイスからの前記入出力要求が実行契機となる同期処理と、前記同期処理以外の非同期処理とを実行することができ、
前記各マイクロプロセッサは、予め設定される上限値まで前記同期処理を実行することができ、かつ、前記同期処理を実行していない場合に前記非同期処理を実行することができ、
前記各マイクロプロセッサにより使用されるメモリ領域には、所定の複数のモード毎に第1上限値と第2上限値とを対応付けて管理する上限値管理情報が記憶されており、
前記第1上限値は、前記同期処理のうち前記第1インタフェースに関する同期処理を実行できる回数の上限値を示し、
前記第2上限値は、前記同期処置及び前記非同期処理のうち前記第2インタフェースに関する同期処理及び非同期処理を実行できる回数の上限値を示し、
前記複数モードに含まれる第1モードでは、前記第1上限値の方が前記第2上限値よりも大きくなるように設定されており、
前記複数モードに含まれる第2モードでは、前記第2上限値の方が前記第1上限値よりも大きくなるように設定されており、
前記複数モードに含まれる第3モードでは、前記第1上限値と前記第2上限値とが同一に設定されており、
前記各マイクロプロセッサ毎にそれぞれ前記第1モードまたは前記第2モードまたは前記第3モードのいずれか一つのモードが設定されている、
ストレージシステム。
- 前記複数モードには、前記第1インタフェースに関する前記同期処理だけを実行する第4モードと、前記第2インタフェースに関する前記同期処理及び前記非同期処理だけを実行する第5モードとがさらに含まれており、
前記各マイクロプロセッサ毎にそれぞれ前記第1モードまたは前記第2モードまたは前記第3モードまたは前記第4モードまたは前記第5モードのいずれか一つのモードが所定周期で設定される、
請求項6に記載のストレージシステム。
- 前記第5モードでは、前記第2インタフェースに関する前記同期処理または前記非同期処理を、前記各マイクロプロセッサのうちの複数のマイクロプロセッサで分担して実行する、
請求項7に記載のストレージシステム。
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