JP5233882B2 - チョッパアンプ - Google Patents
チョッパアンプ Download PDFInfo
- Publication number
- JP5233882B2 JP5233882B2 JP2009163584A JP2009163584A JP5233882B2 JP 5233882 B2 JP5233882 B2 JP 5233882B2 JP 2009163584 A JP2009163584 A JP 2009163584A JP 2009163584 A JP2009163584 A JP 2009163584A JP 5233882 B2 JP5233882 B2 JP 5233882B2
- Authority
- JP
- Japan
- Prior art keywords
- signal
- frequency
- pseudo
- chopper
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
Images
Landscapes
- Amplifiers (AREA)
Description
入力信号にチョッピング信号を乗算する第1のチョッパ回路と,
前記第1のチョッパ回路の出力を増幅するオペアンプと,
前記オペアンプの出力に前記チョッピング信号を乗算し出力信号を出力する第2のチョッパ回路と,
パルス幅がランダムに変化する擬似ランダム信号を生成する擬似ランダム信号生成回路と,
前記擬似ランダム信号の周波数スペクトラムがヌルになる第2の周波数(f2),または当該第2の周波数(f2)と前記入力信号の周波数(fin)との和周波数(f2+fin)のいずれかである第1の周波数(f1)を有する第1の信号を前記擬似ランダム信号に乗算し,前記チョッピング信号を出力する乗算器とを有するチョッパアンプ。
付記1において,
前記第1の信号は前記第1の周波数を有する第1のクロック信号(CLK1)であり,
前記乗算器は,前記擬似ランダム信号と前記第1のクロック信号とを入力しそれらの排他的論理和信号を前記チョッピング信号として出力する排他的論理和回路であるチョッパアンプ。
付記2において,
前記擬似ランダム信号生成回路は,第2のクロック(CLK2)に基づいて前記擬似ランダム信号を生成する擬似乱数ビットシーケンス発生器またはデルタシグマ変調器であり,
前記第1のクロック信号の周波数(f1)は前記第2のクロック(CLK2)の周波数の自然数倍であるチョッパアンプ。
付記2において,
前記擬似ランダム信号生成回路は,第2のクロック(CLK2)に基づいて前記擬似ランダム信号を生成する擬似乱数ビットシーケンス発生器またはデルタシグマ変調器であり,
前記第1のクロック信号の周波数(f1)は前記第2のクロック(CLK2)の周波数の自然数倍と前記入力信号の周波数との和であるチョッパアンプ。
付記1において,
さらに,前記第2のチョッパ回路が出力する前記出力信号の直流成分を測定する直流成分測定ユニットと,
前記直流成分測定ユニットが測定した前記直流成分をゼロにするように前記擬似ランダム信号生成回路に制御信号を供給する制御ユニットとを有し,
前記擬似ランダム信号生成回路は,前記制御信号に応じて前記擬似ランダム信号の直流成分を変更するチョッパアンプ。
付記5において,
前記擬似ランダム信号生成回路は,クロックに同期して入力信号を量子化し量子化の誤差を前記入力信号に加算または減算して更に量子化するデルタシグマ変調器であり,前記制御信号は前記デルタシグマ変調器の入力信号として入力されるチョッパアンプ。
入力信号にチョッピング信号を乗算する第1のチョッパ回路と,
前記第1のチョッパ回路の出力を増幅するオペアンプと,
前記オペアンプの出力に前記チョッピング信号を乗算し出力信号を出力する第2のチョッパ回路と,
パルス幅がランダムに変化する擬似ランダム信号を生成する擬似ランダム信号生成回路とを有し,
前記擬似ランダム信号が前記チョッピング信号として前記第1,第2のチョッパ回路に供給され,
さらに,前記第2のチョッパ回路が出力する前記出力信号の直流成分を測定する直流成分測定ユニットと,
前記直流成分測定ユニットが測定した前記直流成分をゼロにするように前記擬似ランダム信号生成回路に制御信号を供給する制御ユニットとを有し,
前記擬似ランダム信号生成回路は,前記制御信号に応じて前記擬似ランダム信号の直流成分を変更するチョッパアンプ。
付記7において,
前記擬似ランダム信号生成回路は,クロックに同期して入力信号を量子化し量子化の誤差を前記入力信号に加算または減算して更に量子化するデルタシグマ変調器であり,前記制御信号は前記デルタシグマ変調器の入力信号として入力されるチョッパアンプ。
AMP:オペアンプ 20:ランダムチョッピング信号生成回路
22:擬似ランダム信号生成回路 23:擬似ランダム信号
24:乗算器 CLK1:第1の信号
CLK2:擬似ランダム信号生成回路のクロック信号
f1:CLK1の周波数 f2:CLK2の周波数
Vin:入力信号 fin:入力信号の周波数
Vout:出力信号 CONT:制御信号,制御ビット
Claims (5)
- 入力信号にチョッピング信号を乗算する第1のチョッパ回路と,
前記第1のチョッパ回路の出力を増幅するオペアンプと,
前記オペアンプの出力に前記チョッピング信号を乗算し出力信号を出力する第2のチョッパ回路と,
パルス幅がランダムに変化する擬似ランダム信号を生成する擬似ランダム信号生成回路と,
前記擬似ランダム信号の周波数スペクトラムがヌルになる第2の周波数,または当該第2の周波数と前記入力信号の周波数との和周波数のいずれかである第1の周波数を有する第1の信号を前記擬似ランダム信号に乗算し,前記チョッピング信号を出力する乗算器とを有するチョッパアンプ。 - 請求項1において,
前記第1の信号は前記第1の周波数を有する第1のクロック信号であり,
前記乗算器は,前記擬似ランダム信号と前記第1のクロック信号とを入力しそれらの排他的論理和信号を前記チョッピング信号として出力する排他的論理和回路であるチョッパアンプ。 - 請求項1において,
さらに,前記第2のチョッパ回路が出力する前記出力信号の直流成分を測定する直流成分測定ユニットと,
前記直流成分測定ユニットが測定した前記直流成分をゼロにするように前記擬似ランダム信号生成回路に制御信号を供給する制御ユニットとを有し,
前記擬似ランダム信号生成回路は,前記制御信号に応じて前記擬似ランダム信号の直流成分を変更するチョッパアンプ。 - 請求項3において,
前記擬似ランダム信号生成回路は,クロックに同期して入力信号を量子化し量子化の誤差を前記入力信号に加算または減算して更に量子化するデルタシグマ変調器であり,前記制御信号は前記デルタシグマ変調器の入力信号として入力されるチョッパアンプ。 - 入力信号にチョッピング信号を乗算する第1のチョッパ回路と,
前記第1のチョッパ回路の出力を増幅するオペアンプと,
前記オペアンプの出力に前記チョッピング信号を乗算し出力信号を出力する第2のチョッパ回路と,
パルス幅がランダムに変化する擬似ランダム信号を生成する擬似ランダム信号生成回路とを有し,
前記擬似ランダム信号が前記チョッピング信号として前記第1,第2のチョッパ回路に供給され,
さらに,前記第2のチョッパ回路が出力する前記出力信号の直流成分を測定する直流成分測定ユニットと,
前記直流成分測定ユニットが測定した前記直流成分をゼロにするように前記擬似ランダム信号生成回路に制御信号を供給する制御ユニットとを有し,
前記擬似ランダム信号生成回路は,前記制御信号に応じて前記擬似ランダム信号の直流成分を変更するチョッパアンプ。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2009163584A JP5233882B2 (ja) | 2009-07-10 | 2009-07-10 | チョッパアンプ |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2009163584A JP5233882B2 (ja) | 2009-07-10 | 2009-07-10 | チョッパアンプ |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2011019156A JP2011019156A (ja) | 2011-01-27 |
JP5233882B2 true JP5233882B2 (ja) | 2013-07-10 |
Family
ID=43596597
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2009163584A Expired - Fee Related JP5233882B2 (ja) | 2009-07-10 | 2009-07-10 | チョッパアンプ |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP5233882B2 (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US11730425B2 (en) | 2019-09-20 | 2023-08-22 | Samsung Electronics Co., Ltd. | Signal measurement apparatus and signal measurement method |
Families Citing this family (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR102255204B1 (ko) * | 2013-08-28 | 2021-05-24 | 삼성전자주식회사 | 재구성 가능한 측정 장치 및 그 장치를 제어하는 방법 |
JP6194004B2 (ja) | 2013-09-13 | 2017-09-06 | アルプス電気株式会社 | 増幅回路 |
EP3232922B1 (en) * | 2014-12-19 | 2022-02-09 | T&W Engineering A/S | An active electrode having a closed-loop unit-gain amplifier with chopper modulation |
EP3790191B1 (en) * | 2016-04-22 | 2022-05-04 | Goodix Technology (HK) Company Limited | Amplifiers |
JP7234655B2 (ja) * | 2019-01-29 | 2023-03-08 | セイコーエプソン株式会社 | 物理量検出回路、物理量センサー、電子機器、移動体及び物理量検出回路の動作方法 |
KR102597802B1 (ko) * | 2021-06-11 | 2023-11-02 | 강원대학교산학협력단 | 시분할 다채널 아날로그 행렬 연산기, 이의 동작 방법, 및 이를 포함하는 장치 |
CN114217210B (zh) * | 2021-12-15 | 2023-06-20 | 广州德芯半导体科技有限公司 | 一种生物微弱小信号的放大调理芯片系统 |
Family Cites Families (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5115202A (en) * | 1991-04-10 | 1992-05-19 | Analog Devices, Inc. | Chopper-stabilized amplifier with spread-spectrum clocking |
US7262654B2 (en) * | 2005-01-14 | 2007-08-28 | Cirrus Logic, Inc. | Circuits and methods for minimizing chopping artifacts at the output of a chopper-stabilized operational amplifier |
-
2009
- 2009-07-10 JP JP2009163584A patent/JP5233882B2/ja not_active Expired - Fee Related
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US11730425B2 (en) | 2019-09-20 | 2023-08-22 | Samsung Electronics Co., Ltd. | Signal measurement apparatus and signal measurement method |
Also Published As
Publication number | Publication date |
---|---|
JP2011019156A (ja) | 2011-01-27 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP5233882B2 (ja) | チョッパアンプ | |
Drost et al. | Analog filter design using ring oscillator integrators | |
US9667194B2 (en) | Differential switched capacitor circuits having voltage amplifiers, and associated methods | |
US9537497B2 (en) | Continuous time delta sigma modulator, analog to digital converter and associated compensation method | |
Drost et al. | A 0.55 v 61db-snr 67db-sfdr 7mhz 4 th-order butterworth filter using ring-oscillator-based integrators in 90nm cmos | |
US8681029B1 (en) | Chopper-stabilization method and apparatus for sigma delta modulators | |
Kim et al. | Time-domain operational amplifier with voltage-controlled oscillator and its application to active-RC analog filter | |
JP2009260605A (ja) | Δς変調器及びδς型ad変換器 | |
US20220368292A1 (en) | Ampilfier with vco-based adc | |
JP2016171538A (ja) | 増幅回路 | |
KR101960180B1 (ko) | 연산 증폭기 이득 보상 기능을 가지는 이산-시간 적분기 회로 | |
WO2015174166A1 (ja) | 増幅回路、アナログ/ディジタル変換回路および電圧/時間変換器 | |
US8466822B2 (en) | Analog-to-digital conversion apparatus and signal processing system | |
US8314657B2 (en) | D-class amplifier | |
US8248158B2 (en) | Chopper stabilized amplifier | |
US9787284B2 (en) | Waveform shaping filter and radiation detection device | |
Payandehnia et al. | High‐linearity SAR‐VCO MASH ΔΣ ADC with second‐order noise shaping | |
US9374104B2 (en) | Sample hold circuit, A/D converter, calibration method of the sample hold circuit, and circuit | |
Leene et al. | A compact recording array for neural interfaces | |
JP6164208B2 (ja) | 送信機および送信方法 | |
Chang et al. | Wide dynamic-range sigma–delta modulator with adaptive feed-forward coefficients | |
Bakkaloglu et al. | Design of power, dynamic range, bandwidth and noise scalable ADCs | |
US20100327973A1 (en) | Amplifier circuit comprising charge pump and low-pass filter | |
Musah et al. | Correlated level shifting integrator with reduced sensitivity to amplifier gain | |
JP6371646B2 (ja) | 帰還型パルス幅変調器 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20120405 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20130213 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20130226 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20130311 |
|
R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20160405 Year of fee payment: 3 |
|
LAPS | Cancellation because of no payment of annual fees |