JP4945809B2 - 多段型メモリ装置、メモリ装置、記憶方法及び記憶処理用プログラム - Google Patents

Description

本発明は、多段型メモリ装置、メモリ装置、記憶方法及び記憶処理用プログラムに関する。

従来、データ持ち運び用のメモリ装置として、ＵＳＢメモリやメモリカードなどが広く普及している。
ＵＳＢメモリ（ユーエスビーメモリ）は、Ｕｎｉｂｅｒｓａｌ Ｓｅｒｉａｌ Ｂｕｓ（ＵＳＢ）を用いてデータの読み書きを行う補助記憶装置のうち、ＵＳＢコネクタがケーブルを介さず直接本体についているタイプのものである。また、メモリカードは、薄型でカードのような外見の補助記憶装置であり、フラッシュメモリや超小型のハードディスクを内蔵し、インターフェースなどを備えている。
次に、一般的なメモリ装置について、図面を参照して説明する。

（従来例）
図６は、従来例にかかるメモリ装置の概略ブロック図を示している。
図６において、メモリ装置１０１は、主コネクタ２、インターフェース３、暗号部１０７及び記憶部１０５などを備えている。
また、このメモリ装置１０１は、コンピュータ９と接続され、コンピュータ９から出力された情報を記憶する。

主コネクタ２は、情報を入出力するコンピュータ９と接続するための接続手段である。なお、主コネクタ２が接続される機器は、コンピュータ９に限定されるものではなく、たとえば、主コネクタ２は、情報を出力する電気機器又は情報処理装置と接続されてもよい。
また、インターフェース３は、主コネクタ２及び暗号部１０７と接続されている。

暗号部１０７は、コンピュータ９から入力した情報に対して所定の暗号処理を行う。すなわち、暗号部１０７は、コンピュータ９から入力した情報を暗号化し、記憶部１０５に記憶させたり、あるいは、記憶部１０５から入力した情報を復号化し、コンピュータ９に出力する。また、暗号部１０７は、パスワードロック処理の施された情報に対しては、パスワード情報をも記憶し、そのパスワードが入力された場合のみ、記憶していた情報を出力する。なお、このようなパスワードロック処理も、上記の所定の暗号処理に含まれるものとする。
また、記憶部１０５は、一般的に、フラッシュメモリである。

ところで、上記構成のメモリ装置１０１は、記憶している情報に対して、暗号化やパスワードロック等の処理が施されているとしても、情報の全てが一つの記憶部１０５内に納められている。そのため、盗まれたり紛失した場合、メモリ装置１０１を入手した悪意のある第三者に解読されて、情報漏洩する危険が常に存在していた。
このような危険性を回避するために、様々な技術が開発されている。

例えば、特許文献１には、データ入力手段と、入力されたデータを複数のデータに分割するデータ分割手段と、分割された複数のデータを、可搬性記憶媒体を含む複数の記憶媒体に分離して記録するデータ記録手段と、を備えていることを特徴とするデータ処理装置の技術が開示されている。

また、特許文献２には、所定の位置に配置された、鍵データが記憶された記憶装置と通信を行い、当該鍵データを読み出す記憶装置インターフェイス手段と、送信対象のデータファイルを分割し複数の分割データファイルを生成するファイル分割手段と、生成された複数の分割データファイルに対して、鍵データを用いて選択的に暗号化する暗号化手段と、選択的に暗号化された複数の分割データファイルを送信する送信手段とを有するデータ送信装置の技術が開示されている。

さらに、特許文献３には、分割数を含むバックアップコマンドを受けつけた場合に、秘密鍵を所定の分割数で分割しさらに適当な方式により暗号化して分割暗号化データを作成して、パソコン側に返答する機能、および復元コマンドとともに一揃いの分割暗号化データを与えられた場合に、元の秘密鍵を復元する機能を備えたＩＣカードの技術が開示されている。

特開２００１−０２７９６９号公報 特開２００２−３４４４４２号公報 特開２００４−０２３１３８号公報

しかしながら、特許文献１の技術は、分割された複数のデータを、可搬性記憶媒体を含む複数の記憶媒体に分離して記録しているものの、たとえば、一つの記憶媒体が盗まれたり紛失した場合、その一つの記憶媒体に記録されていたデータが復元され、情報が漏洩するといった問題があった。

また、特許文献２の技術は、生成された複数の分割データファイルに対して、鍵データを用いて選択的に暗号化しているものの、暗号が解読されると、解読された分割データファイルの情報が漏洩するといった問題があった。

さらに、特許文献３の技術は、秘密鍵を分割し暗号化しさらに分散して記録させているものの、たとえば、盗まれたり紛失した一つのＩＣカードから、一つの分割されたデータが復元される危険性があるといった問題があった。

また、メモリ装置においては、通常、単純で簡単な操作によって使用可能であることも要望されている。さらに、秘密にする必要のない情報に対しては、通常の操作を行うことができ、かつ、秘密にしたい情報に対しては、単純で簡単な操作によって、情報漏洩の阻止性能を高めることができるといった、使い勝手を向上させることも要望されている。

本発明は、以上のような問題を解決するために提案されたものであり、情報漏洩の阻止性能を高めることができ、かつ、使い勝手を向上させることの可能な多段型メモリ装置、メモリ装置、記憶方法及び記憶処理用プログラムの提供を目的とする。

上記目的を達成するため、本発明の多段型メモリ装置は、情報を出力する電気機器又は情報処理装置と接続するための接続手段、接続手段と接続されたインターフェース、インターフェースと接続され、入力した情報を分解し、また、分解された情報を結合する分解・結合部、分解・結合部と接続され、分解された情報の一部を記憶する主記憶部、及び、分解・結合部と接続され、分解された情報の残部を出力する一又は二以上の補助接続手段を有する主記憶装置と、補助接続手段と接続される補助記憶装置用接続手段、及び、補助記憶装置用接続手段と接続され、分解された情報の残部を記憶する補助記憶部を有し、主記憶装置に対して取り外し可能に接続される一又は二以上の補助記憶装置とを備えた構成としてある。

また、本発明のメモリ装置は、情報を出力する電気機器又は情報処理装置と接続するための接続手段と、接続手段と接続されたインターフェースと、インターフェースと接続され、入力した情報を分解し、また、分解された情報を結合する分解・結合部と、分解・結合部と接続され、分解された情報の一部を記憶する主記憶部と、分解・結合部と接続され、分解された情報の残部を記憶する外部の記憶部と接続するための一又は二以上の補助接続手段とを備えた構成としてある。

また、本発明の記憶方法は、主記憶装置と、この主記憶装置に対して取り外し可能に接続される一又は二以上の補助記憶装置とを用いて、電気機器又は情報処理装置からの情報を記憶する記憶方法であって、主記憶装置の分解・結合部が、入力した情報を分解し、主記憶装置の主記憶部が、分解された情報の一部を記憶し、補助記憶装置の補助記憶部が、分解された情報の残部を記憶し、また、分解・結合部が、分解され記憶された情報の一部と分解され記憶された情報の残部とを結合する方法としてある。

また、本発明の記憶方法は、メモリ装置と、このメモリ装置に対して取り外し可能に接続される一又は二以上の外部の記憶部とを用いて、電気機器又は情報処理装置からの情報を記憶する記憶方法であって、メモリ装置の分解・結合部が、入力した情報を分解し、メモリ装置の主記憶部が、分解された情報の一部を記憶し、外部の記憶部が、分解された情報の残部を記憶し、また、分解・結合部が、分解され記憶された情報の一部と分解され記憶された情報の残部とを結合する方法としてある。

また、本発明の記憶処理用プログラムは、電気機器又は情報処理装置から入力した情報を分解する処理、及び、分解された情報を結合させる処理を、主記憶装置の分解・結合部に実行させる記憶処理用プログラムであって、入力した情報を分解する処理と、分解された情報の一部を主記憶装置の主記憶部に記憶させる処理と、分解された情報の残部を、主記憶装置に対して取り外し可能に接続される一又は二以上の補助記憶装置の補助記憶部に、記憶させる処理と、分解され記憶された情報の一部と分解され記憶された情報の残部とを結合させる処理とを主記憶装置の分解・結合部に実行させる構成としてある。

また、本発明の記憶処理用プログラムは、電気機器又は情報処理装置から入力した情報を分解する処理、及び、分解された情報を結合させる処理を、メモリ装置の分解・結合部に実行させる記憶処理用プログラムであって、入力した情報を分解する処理と、分解された情報の一部をメモリ装置の主記憶部に記憶させる処理と、分解された情報の残部を、メモリ装置に対して取り外し可能に接続される一又は二以上の外部の記憶部に、記憶させる処理と、分解され記憶された情報の一部と分解され記憶された情報の残部とを結合させる処理とをメモリ装置の分解・結合部に実行させる構成としてある。

本発明の多段型メモリ装置、メモリ装置、記憶方法及び記憶処理用プログラムによれば、情報漏洩の阻止性能を高めることができ、かつ、使い勝手を向上させることができる。

［多段型メモリ装置、記憶方法及び記憶処理用プログラムの第一実施形態］
図１は、本発明の第一実施形態にかかる多段型メモリ装置の概略ブロック図を示している。
図１において、本実施形態の多段型メモリ装置１は、コンピュータ９と接続される主記憶装置１０と、この主記憶装置１０に対して取り外し可能に接続される補助記憶装置１１とを備えている。この多段型メモリ装置１は、コンピュータ９と接続され、コンピュータ９から出力された情報（データ）を記憶する。

主記憶装置１０は、主コネクタ２、インターフェース３、分解・結合部４、記憶部５及び補助コネクタ６などを有している。
主コネクタ２は、情報を入出力するコンピュータ９と接続するための接続手段である。なお、主コネクタ２が接続される機器は、コンピュータ９に限定されるものではなく、たとえば、主コネクタ２は、情報を出力する電気機器又は情報処理装置と接続されてもよい。
また、インターフェース３は、主コネクタ２及び分解・結合部４と接続されている。

分解・結合部４は、インターフェース３から入力した情報を分解する。すなわち、本実施形態の分解・結合部４は、インターフェース３から入力した情報を、奇数ビットからなる情報と偶数ビットからなる情報とに分解する。たとえば、インターフェース３から入力した情報が、「０１０１０１００１１・・・」であるとき、奇数ビットからなる情報は「００００１・・・」であり、偶数ビットからなる情報は「１１１０１・・・」となる。なお、分解の方式は、上述した奇数ビットからなる情報と偶数ビットからなる情報とに分解する方式に限定されるものではなく、様々な方式を用いることができる。

また、分解・結合部４は、分解した情報の一部、すなわち、奇数ビットからなる情報を記憶部５に記憶させ、また、分解した情報の残部、すなわち、偶数ビットからなる情報を補助記憶部１５に記憶させる。なお、本実施形態では、上記の構成としてあるが、これに限定されるものではなく、たとえば、偶数ビットからなる情報を記憶部５に記憶させ、また、分解した情報の残部、すなわち、奇数ビットからなる情報を補助記憶部１５に記憶させる構成としてもよい。

さらに、分解・結合部４は、記憶部５から入力した奇数ビットからなる情報と、補助記憶部１５から入力した偶数ビットからなる情報とを結合させることができる。たとえば、奇数ビットからなる情報が「００００１・・・」であり、偶数ビットからなる情報が「１１１０１・・・」であるとき、結合した情報として、「０１０１０１００１１・・・」を得ることができる。

また、補助記憶部１５に記憶した情報は、補助記憶装置１１が主記憶装置１０に接続されたときに限り、読み出すことができる構成としてある。したがって、秘密鍵としての機能を有する分解・結合部４は、主記憶装置１０にのみ設けられている。すなわち、補助記憶装置１１は、秘密鍵自体を持っていないので、補助記憶装置１１に対するセキュリティー性を向上させることができる。

記憶部５は、一般的に、フラッシュメモリである。この記憶部５は、分解・結合部４と接続されており、インターフェース３によって分解された情報の一部、すなわち、本実施形態では、奇数ビットからなる情報を記憶する。
また、補助コネクタ６は、分解・結合部４と接続されており、分解された情報の残部、すなわち、本実施形態では、偶数ビットからなる情報を出力するための補助接続手段である。

補助記憶装置１１は、補助コネクタ１６及び補助記憶部１５などを有している。
補助コネクタ１６は、補助コネクタ６と接続される補助記憶装置用接続手段である。このようにすると、補助記憶装置１１を容易に主記憶装置１０と接続させることができ、また、補助記憶装置１１を容易に主記憶装置１０から取り外すことができる。
また、補助記憶部１５は、一般的に、フラッシュメモリである。この補助記憶部１５は、補助コネクタ１６と接続されており、インターフェース３によって分解された情報の残部、すなわち、本実施形態では、偶数ビットからなる情報を記憶する。

次に、上記構成の多段型メモリ装置１の動作（記憶方法など）について、図面を参照して説明する。
図２は、本発明の第一実施形態にかかる記憶方法を説明するための概略フローチャート図を示している。
図２において、コンピュータ９からの情報を記憶する多段型メモリ装置１は、まず、補助記憶装置１１の補助コネクタ１６が主記憶装置１０の補助コネクタ６に接続され、主記憶装置１０の主コネクタ２がコンピュータ９のコネクタ（図示せず）に接続される（ステップＳ１）。
ここで、補助記憶装置１１は、容易に主記憶装置１０と接続されるので、取扱い性を向上させることができる。

次に、コンピュータ９が情報を出力すると、主記憶装置１０は、主コネクタ２及びインターフェース３を介して、分解・結合部４が出力された情報を入力する。続いて、分解・結合部４は、上述した分解の方式により、入力した情報を分解する（ステップＳ２）。
すなわち、本実施形態では、インターフェース３から入力した情報を、奇数ビットからなる情報と偶数ビットからなる情報とに分解する。たとえば、上述したように、インターフェース３から入力した情報が、「０１０１０１００１１・・・」であるとき、奇数ビットからなる情報は「００００１・・・」であり、偶数ビットからなる情報は「１１１０１・・・」となる。

次に、主記憶装置１０の記憶部５が、分解した情報の一部、すなわち、奇数ビットからなる情報を記憶し、また、補助記憶装置１１の補助記憶部１５が、分解した情報の残部、すなわち、偶数ビットからなる情報を記憶する（ステップＳ３）。

次に、主記憶装置１０をコンピュータ９から取り外し、また、補助記憶装置１１を主記憶装置１０から取り外し、それぞれ別の場所に保管する。あるいは、多段型メモリ装置１を別の場所に移動させる際は、補助記憶装置１１と主記憶装置１０とを、それぞれ別の移動手段によって移動させる（ステップＳ４）。
ここで、補助記憶装置１１は、容易に主記憶装置１０から取り外すことができるので、取扱い性を向上させることができる。

このようにすると、補助記憶装置１１及び主記憶装置１０の一方のみが、盗まれたり紛失しても、その一方のみ、すなわち、補助記憶装置１１又は主記憶装置１０には、意味をなさないデータしか記憶されていないので、このデータが解読され悪意のある第三者に気密が漏洩するといった可能性を完全に排除することができる。
また、保管中の、あるいは、移動中の補助記憶装置１１と主記憶装置１０とが、ほぼ同時に盗まれたり紛失する確率は、一つ（たとえば、補助記憶装置１１だけ）が盗まれたり紛失する確率より低くなるので、情報漏洩の危険性を低減することができる。
さらに、仮に、補助記憶装置１１及び主記憶装置１０の一方のみが、盗まれたり紛失しても、もう一方を物理的又は電気的に破壊することにより、情報漏洩を完全に阻止することができる。

次に、多段型メモリ装置１に記憶した情報をコンピュータ９に出力するとき、まず、補助記憶装置１１の補助コネクタ１６が主記憶装置１０の補助コネクタ６に接続され、主記憶装置１０の主コネクタ２がコンピュータ９のコネクタ（図示せず）に接続される（ステップＳ５）。

次に、分解・結合部４は、分解され記憶部５に記憶された情報の一部、すなわち、奇数ビットからなる情報を入力し、また、分解され補助記憶部１５に記憶された情報の残部、すなわち、偶数ビットからなる情報を入力し、これらを結合させる（ステップＳ６）。たとえば、上述したように、記憶部５に記憶された奇数ビットからなる情報「００００１・・・」と、補助記憶部１５に記憶された偶数ビットからなる情報「１１１０１・・・」とを入力し、これらを結合し、結合された情報「０１０１０１００１１・・・」を得る。
続いて、多段型メモリ装置１は、結合された情報をコンピュータ９に出力する（ステップＳ７）。

次に、記憶処理用プログラムについて説明する。
上記の実施形態において、多段型メモリ装置１の分解・結合部４は、たとえば、図示してないが、演算処理装置や記憶手段（例えば、ＲＯＭなど）などを有しており、記憶処理機能（記憶方法を実行するための機能）は、前記の記憶手段に記憶された記憶処理用プログラムにより実現される。

本実施形態の記憶処理用プログラムは、前記の演算処理装置（ＣＰＵなど）に読み込まれることにより、分解・結合部４の構成各部に指令を送り、所定の処理、たとえば、入力した情報を分解する処理、分解された情報の一部を主記憶装置１０の記憶部５に記憶させる処理、分解された情報の残部を補助記憶装置１１の補助記憶部１５に記憶させる処理、分解され記憶された情報の一部と分解され記憶された情報の残部とを結合させる処理などを行わせる。
これによって、記憶処理機能は、ソフトウエアである記憶処理用プログラムとハードウエア資源である多段型メモリ装置１の各構成手段とが協働することにより実現される。

なお、一般的に、記憶処理機能を実現するための記憶処理用プログラムは、コンピュータのＲＯＭやハードディスクなどに記憶される他、コンピュータ読み取り可能な記録媒体、たとえば、外部記憶装置及び可搬記録媒体等に格納することができる。そして、記録媒体に記録されたプログラムは、分解・結合部４にロードされて、演算処理装置などにより実行される。この実行により、上述した実施形態の多段型メモリ装置１の機能が実現される。
さらに、コンピュータを用いて記憶処理用プログラムをロードする場合、他のコンピュータで保有された記憶処理用プログラムを、通信回線を利用して自己の有するＲＡＭや外部記憶装置にダウンロードすることもできる。このダウンロードされた記憶処理用プログラムも、演算処理装置などにより実行され、上記実施形態の多段型メモリ装置１の記憶処理機能を実現する。

以上説明したように、本実施形態の多段型メモリ装置１、記憶方法及び記憶処理用プログラムによれば、補助記憶装置１１及び主記憶装置１０の一方のみが、盗まれたり紛失しても、悪意のある第三者に気密が漏洩するといった可能性を完全に排除することができる。
また、保管中の、あるいは、移動中の補助記憶装置１１と主記憶装置１０とが、ほぼ同時に盗まれたり紛失する確率は、一つ（たとえば、補助記憶装置１１だけ）が盗まれたり紛失する確率より低くなるので、情報漏洩の危険性を低減することができる。
さらに、仮に、補助記憶装置１１及び主記憶装置１０の一方のみが、盗まれたり紛失しても、もう一方を物理的又は電気的に破壊することにより、情報漏洩を完全に阻止することができる。
また、補助記憶装置１１と主記憶装置１０との接続や切り離しを容易に行うことができるので、単純で簡単な操作による多段型メモリ装置１を提供することができる。

また、本実施形態の多段型メモリ装置１、記憶方法及び記憶処理用プログラムは、様々な応用例を有している。
次に、上記応用例について、図面を参照して説明する。

＜第一応用例＞
図３は、本発明の第一実施形態の応用例にかかる多段型メモリ装置の概略ブロック図を示している。
図３において、本応用例の多段型メモリ装置１´は、第一実施形態の多段型メモリ装置１と比べると、二つの補助記憶装置１１、１１´を備えている点などが相違する。なお、多段型メモリ装置１´の他の構成は、多段型メモリ装置１とほぼ同様としてある。
したがって、図３において、図１と同様の構成部分については同一の符号を付して、その詳細な説明を省略する。

主記憶装置１０´は、二つの補助コネクタ６、６´を有しており、補助コネクタ６、６´は、並列に分解・結合部４´と接続されている。
また、主記憶装置１０´の分解・結合部４´は、インターフェース３から入力した情報を分解する。すなわち、本応用例の分解・結合部４´は、インターフェース３から入力した情報を、（３ｍ＋１）番目のビットからなる情報と、（３ｍ＋２）番目のビットからなる情報と、（３ｍ）番目のビットからなる情報とに分解する（ｍは、０以上の整数）。たとえば、インターフェース３から入力した情報が、「０１００１０１１１００１・・・」であるとき、（３ｍ＋１）番目のビットからなる情報は「００１０・・・」であり、（３ｍ＋２）番目のビットからなる情報は「１１１０・・・」であり、（３ｍ）番目のビットからなる情報は「００１１・・・」となる。なお、分解の方式は、上述した方式に限定されるものではなく、様々な方式を用いることができる。

また、分解・結合部４´は、分解した情報の一部、すなわち、（３ｍ＋１）番目のビットからなる情報を記憶部５に記憶させ、分解した情報の残部、すなわち、（３ｍ＋２）番目のビットからなる情報を補助記憶部１５に記憶させ、かつ、（３ｍ）番目のビットからなる情報を補助記憶部１５´に記憶させる。

さらに、分解・結合部４´は、記憶部５から入力した（３ｍ＋１）番目のビットからなる情報と、補助記憶部１５から入力した（３ｍ＋２）番目のビットからなる情報と、補助記憶部１５´から入力した（３ｍ）番目のビットからなる情報とを結合させることができる。たとえば、（３ｍ＋１）番目のビットからなる情報が「００１０・・・」であり、（３ｍ＋２）番目のビットからなる情報が「１１１０・・・」であり、（３ｍ）番目のビットからなる情報が「００１１・・・」であるとき、結合した情報として、「０１００１０１１１００１・・・」を得ることができる。

また、補助記憶装置１１´は、補助記憶装置１１とほぼ同様な構造としてあり、補助コネクタ１６´及び補助記憶部１５´などを備えている。

このように、本応用例の多段型メモリ装置１´によれば、第一実施形態の多段型メモリ装置１とほぼ同様に、補助記憶装置１１、１１´及び主記憶装置１０´の二つまでが、盗まれたり紛失しても、悪意のある第三者に気密が漏洩するといった可能性を完全に排除することができる。
また、保管中の、あるいは、移動中の補助記憶装置１１、１１´及び主記憶装置１０´が、ほぼ同時に盗まれたり紛失する確率は、一つ（たとえば、補助記憶装置１１だけ）又は二つ（たとえば、補助記憶装置１１と多段型メモリ装置１）が盗まれたり紛失する確率より低くなるので、情報漏洩の危険性を低減することができる。
さらに、仮に、補助記憶装置１１、１１´及び主記憶装置１０´の二つまでが、盗まれたり紛失しても、残りの一つを物理的又は電気的に破壊することにより、情報漏洩を完全に阻止することができる。

＜第二応用例＞
図示してないが、本応用例の多段多段型メモリ装置は、第一実施形態の多段型メモリ装置１と比べると、補助記憶装置１１が主記憶装置１０と接続されていないとき、分解・結合部４が所定の暗号処理を行う（すなわち、上述した暗号部１０７として機能する）点などが相違する。
このようにすると、本応用例の多段型メモリ装置は、補助記憶装置１１が主記憶装置１０に接続されていないとき、上述したメモリ装置１０１とほぼ同様に使用することができ、使い勝手を向上させることができるとともに、付加価値を高めることができる。

また、本応用例の多段型メモリ装置は、主記憶装置１０だけをコンピュータ９に接続し、メモリ装置１０１とほぼ同様に使用しているとき、分解され記憶部５に記憶された情報の一部を、コンピュータ９に対して秘密にする構成としてもよい。このようにすると、秘密にしたい情報の存在（情報の一部が記憶部５に記憶されていること）をも秘密にすることができ、セキュリティー性を向上させることができる。
なお、補助記憶装置１１が主記憶装置１０に接続されると、上記の状態が解除され、コンピュータ９は、秘密にしたい情報の存在（たとえば、情報が記憶部５及び補助記憶部１５に記憶されていること）を検出することができる。
また、本応用例の多段型メモリ装置の他の構成や動作は、多段型メモリ装置１とほぼ同様としてある。

このように、本応用例の多段型メモリ装置によれば、第一実施形態の多段型メモリ装置１とほぼ同様の効果を奏することができ、さらに、補助記憶装置１１が主記憶装置１０に接続されていないとき、上述したメモリ装置１０１とほぼ同様に使用することができる。
すなわち、補助記憶装置１１が接続されていない状態では、主記憶装置１０は、メモリ装置１０１とほぼ同様に使用することができ、秘密にしたい情報を記憶するとき、ユーザは、補助記憶装置１１を主記憶装置１０に接続する。この接続により、秘密にしたい情報を多段型メモリ装置１に容易に記憶させることができ、記憶した後は、補助記憶装置１１を主記憶装置１０から取り外し、主記憶装置１０をメモリ装置１０１とほぼ同様に使用することができる。これにより、本応用例の多段型メモリ装置の付加価値を向上させることができる。

［メモリ装置、記憶方法及び記憶処理用プログラムの第二実施形態］
図４は、本発明の第二実施形態にかかるメモリ装置の概略ブロック図を示している。
図４において、本実施形態のメモリ装置１ａは、第一実施形態の多段型メモリ装置１と比べると、分解・結合部４が、分解した情報の残部を、補助記憶装置１１の補助記憶部１５の代わりに、携帯端末１１ａの記憶部１５ａに記憶させる点などが相違する。なお、メモリ装置１ａの他の構成は、多段型メモリ装置１とほぼ同様としてある。
したがって、図４において、図１と同様の構成部分については同一の符号を付して、その詳細な説明を省略する。

本実施形態では、分解された情報の残部を記憶する外部の記憶部を、携帯端末１１ａの記憶部１５ａとしてある。この携帯端末１１ａは、記憶部１５ａや、記憶部１５ａと接続されたコネクタ１６ａなどを有しており、コネクタ１６ａと補助コネクタ６とは、接続ケーブル１７を介して容易に接続される。
ここで、携帯端末１１ａは、通常、携帯電話などが用いられるが、これに限定されるものではなく、たとえば、記憶部を有する様々な電気機器や情報処理装置を用いることができる。
なお、その他の構成や動作は、上述した第一実施形態とほぼ同様としてある。

以上説明したように、本実施形態のメモリ装置１ａ、記憶方法及び記憶処理用プログラムによれば、第一実施形態とほぼ同様の効果を奏することができ、さらに、通常、ユーザが大切に使用している携帯電話などの携帯端末１１ａを補助記憶装置１１として利用することができるので、メモリ装置１ａの使い勝手を大幅に向上させることができる。

また、本実施形態のメモリ装置１ａ、記憶方法及び記憶処理用プログラムは、様々な応用例を有している。
次に、上記応用例について、図面を参照して説明する。

＜第三応用例＞
図５は、本発明の第二実施形態の応用例にかかるメモリ装置の概略ブロック図を示している。
図５において、本応用例のメモリ装置１ａ´は、第一応用例の多段型メモリ装置１´と比べると、分解・結合部４´が、分解した情報の残部（残部の一部）を、補助記憶装置１１の補助記憶部１５の代わりに、携帯端末１１ａの記憶部１５ａに記憶させる点などが相違する。なお、メモリ装置１ａ´の他の構成は、多段型メモリ装置１´とほぼ同様としてある。
したがって、図５において、図３と同様の構成部分については同一の符号を付して、その詳細な説明を省略する。

主記憶装置１０´の分解・結合部４´は、上述したように、インターフェース３から入力した情報を分解する。すなわち、本応用例の分解・結合部４´は、インターフェース３から入力した情報を、（３ｍ＋１）番目のビットからなる情報と、（３ｍ＋２）番目のビットからなる情報と、（３ｍ）番目のビットからなる情報とに分解する（ｍは、０以上の整数）。
また、分解・結合部４´は、分解した情報の一部、すなわち、（３ｍ＋１）番目のビットからなる情報を記憶部５に記憶させ、分解した情報の残部、すなわち、（３ｍ＋２）番目のビットからなる情報を携帯端末１１ａの記憶部１５ａに記憶させ、かつ、（３ｍ）番目のビットからなる情報を補助記憶部１５´に記憶させる。
さらに、分解・結合部４´は、記憶部５から入力した（３ｍ＋１）番目のビットからなる情報と、記憶部１５ａから入力した（３ｍ＋２）番目のビットからなる情報と、補助記憶部１５´から入力した（３ｍ）番目のビットからなる情報とを結合させることができる。
なお、その他の構成や動作は、上述した第一応用例とほぼ同様としてある。

このように、本応用例のメモリ装置１ａ´、記憶方法及び記憶処理用プログラムによれば、第一応用例とほぼ同様の効果を奏することができ、さらに、通常、ユーザが大切に使用している携帯電話などの携帯端末１１ａを補助記憶装置１１として利用することができるので、メモリ装置１ａ´の使い勝手を大幅に向上させることができる。

＜第四応用例＞
図示してないが、本応用例のメモリ装置は、第二実施形態のメモリ装置１ａと比べると、携帯端末１１ａがメモリ装置１ａと接続されていないとき、分解・結合部４が所定の暗号処理を行う（すなわち、上述した暗号部１０７として機能する）点などが相違する。

また、本応用例のメモリ装置は、携帯端末１１ａをメモリ装置１ａに接続せず、メモリ装置１ａだけをコンピュータ９に接続し、メモリ装置１０１とほぼ同様に使用しているとき、分解され記憶部５に記憶された情報の一部を、コンピュータ９に対して秘密にする構成としてもよい。このようにすると、秘密にしたい情報の存在（情報の一部が記憶部５に記憶されていること）をも秘密にすることができ、セキュリティー性を向上させることができる。
なお、携帯端末１１ａがメモリ装置に接続されると、上記の状態が解除され、コンピュータ９は、秘密にしたい情報の存在（たとえば、情報が記憶部５及び記憶部１５ａに記憶されていること）を検出することができる。
また、本応用例のメモリ装置の他の構成や動作は、メモリ装置１ａとほぼ同様としてある。

このように、本応用例のメモリ装置によれば、第二実施形態のメモリ装置１ａとほぼ同様の効果を奏することができ、さらに、携帯端末１１ａがメモリ装置に接続されていないとき、上述したメモリ装置１０１とほぼ同様に使用することができる。
すなわち、携帯端末１１ａが接続されていない状態では、メモリ装置は、メモリ装置１０１とほぼ同様に使用することができ、秘密にしたい情報を記憶するとき、ユーザは、携帯端末１１ａをメモリ装置に接続する。この接続により、秘密にしたい情報をメモリ装置及び記憶部１５ａに容易に記憶させることができ、記憶した後は、携帯端末１１ａをメモリ装置から取り外し、メモリ装置をメモリ装置１０１とほぼ同様にして使用することができる。これにより、本応用例のメモリ装置の付加価値を向上させることができる。

以上、本発明の多段型メモリ装置、メモリ装置、記憶方法及び記憶処理用プログラムについて、好ましい実施形態や応用例を示して説明したが、本発明に係る多段型メモリ装置、メモリ装置、記憶方法及び記憶処理用プログラムは、上述した実施形態や応用例にのみ限定されるものではなく、本発明の範囲で種々の変更実施が可能であることは言うまでもない。
例えば、第一応用例の多段型メモリ装置１´は、二つの補助記憶装置１１、１１´を並列に接続する構成としてあるが、この構成に限定されるものではなく、たとえば、二つの補助記憶装置１１、１１´を直列に接続する構成としてもよい。このようにしても、多段型メモリ装置１´とほぼ同様の効果を得ることができる。

図１は、本発明の第一実施形態にかかる多段型メモリ装置の概略ブロック図を示している。 図２は、本発明の第一実施形態にかかる記憶方法を説明するための概略フローチャート図を示している。 図３は、本発明の第一実施形態の応用例にかかる多段型メモリ装置の概略ブロック図を示している。 図４は、本発明の第二実施形態にかかるメモリ装置の概略ブロック図を示している。 図５は、本発明の第二実施形態の応用例にかかるメモリ装置の概略ブロック図を示している。 図６は、従来例にかかるメモリ装置の概略ブロック図を示している。

符号の説明

１、１´ 多段型メモリ装置、
１ａ、１ａ´ メモリ装置
２ 主コネクタ
３ インターフェース
４、４´ 分解・結合部
５ 記憶部
６、６´ 補助コネクタ
９ コンピュータ
１０、１０´ 主記憶装置
１１、１１´ 補助記憶装置
１１ａ 携帯端末
１５、１５´ 補助記憶部
１５ａ 記憶部
１６、１６´ 補助コネクタ
１６ａ コネクタ
１７ 接続ケーブル
１０１ メモリ装置
１０５ 記憶部
１０７ 暗号部

Claims (13)

1. 情報を出力する電気機器又は情報処理装置と接続するための接続手段、
   前記接続手段と接続されたインターフェース、
   前記インターフェースと接続され、入力した情報を分解し、また、分解された情報を結合する分解・結合部、
   前記分解・結合部と接続され、前記分解された情報の一部を記憶する主記憶部、及び、
   前記分解・結合部と接続され、前記分解された情報の残部を出力する一又は二以上の補助接続手段
   を有する主記憶装置と、
   前記補助接続手段と接続される補助記憶装置用接続手段、及び、
   前記補助記憶装置用接続手段と接続され、前記分解された情報の残部を記憶する補助記憶部
   を有し、前記主記憶装置に対して取り外し可能に接続される一又は二以上の補助記憶装置と
   を備え、
   前記補助記憶装置が前記主記憶装置と接続されていないとき、前記分解・結合部が、前記入力した情報に対して所定の暗号処理を行うことを特徴とする多段型メモリ装置。
2. 前記分解・結合部が、前記入力した情報の奇数ビットを前記主記憶部に記憶させ、前記入力した情報の偶数ビットを前記補助記憶部に記憶させる、あるいは、前記入力した情報の偶数ビットを前記主記憶部に記憶させ、前記入力した情報の奇数ビットを前記補助記憶部に記憶させることを特徴とする請求項１に記載の多段型メモリ装置。
3. 情報を出力する電気機器又は情報処理装置と接続するための接続手段と、
   前記接続手段と接続されたインターフェースと、
   前記インターフェースと接続され、入力した情報を分解し、また、分解された情報を結合する分解・結合部と、
   前記分解・結合部と接続され、前記分解された情報の一部を記憶する主記憶部と、
   前記分解・結合部と接続され、前記分解された情報の残部を記憶する外部の記憶部と接続するための一又は二以上の補助接続手段と
   を備え、
   前記外部の記憶部が前記補助接続手段と接続されていないとき、前記分解・結合部が、前記入力した情報に対して所定の暗号処理を行うことを特徴とするメモリ装置。
4. 前記分解・結合部が、前記入力した情報の奇数ビットを前記主記憶部に記憶させ、前記入力した情報の偶数ビットを前記補助記憶部に記憶させる、あるいは、前記入力した情報の偶数ビットを前記主記憶部に記憶させ、前記入力した情報の奇数ビットを前記補助記憶部に記憶させることを特徴とする請求項３に記載のメモリ装置。
5. 前記外部の記憶部が、携帯端末に設けられた記憶部であることを特徴とする請求項３又は４に記載のメモリ装置。
6. 主記憶装置と、この主記憶装置に対して取り外し可能に接続される一又は二以上の補助記憶装置とを用いて、電気機器又は情報処理装置からの情報を記憶する記憶方法であって、
   前記主記憶装置の分解・結合部が、入力した前記情報を分解し、
   前記主記憶装置の主記憶部が、前記分解された情報の一部を記憶し、
   前記補助記憶装置の補助記憶部が、前記分解された情報の残部を記憶し、
   また、前記分解・結合部が、前記分解され記憶された情報の一部と前記分解され記憶された情報の残部とを結合し、
   前記補助記憶装置が前記主記憶装置と接続されていないとき、前記分解・結合部が、前記入力した情報に対して所定の暗号処理を行うことを特徴とする記憶方法。
7. 前記分解・結合部が、前記入力した情報の奇数ビットを前記主記憶部に記憶させ、前記入力した情報の偶数ビットを前記補助記憶部に記憶させる、あるいは、前記入力した情報の偶数ビットを前記主記憶部に記憶させ、前記入力した情報の奇数ビットを前記補助記憶部に記憶させることを特徴とする請求項６に記載の記憶方法。
8. メモリ装置と、このメモリ装置に対して取り外し可能に接続される一又は二以上の外部の記憶部とを用いて、電気機器又は情報処理装置からの情報を記憶する記憶方法であって、
   前記メモリ装置の分解・結合部が、入力した前記情報を分解し、
   前記メモリ装置の主記憶部が、前記分解された情報の一部を記憶し、
   前記外部の記憶部が、前記分解された情報の残部を記憶し、
   また、前記分解・結合部が、前記分解され記憶された情報の一部と前記分解され記憶された情報の残部とを結合し、
   前記外部の記憶部が前記補助接続手段と接続されていないとき、前記分解・結合部が、前記入力した情報に対して所定の暗号処理を行うことを特徴とする記憶方法。
9. 前記分解・結合部が、前記入力した情報の奇数ビットを前記主記憶部に記憶させ、前記入力した情報の偶数ビットを前記補助記憶部に記憶させる、あるいは、前記入力した情報の偶数ビットを前記主記憶部に記憶させ、前記入力した情報の奇数ビットを前記補助記憶部に記憶させることを特徴とする請求項８に記載の記憶方法。
10. 電気機器又は情報処理装置から入力した情報を分解する処理、及び、分解された前記情報を結合させる処理を、主記憶装置の分解・結合部に実行させる記憶処理用プログラムであって、
    入力した前記情報を分解する処理と、
    前記分解された情報の一部を前記主記憶装置の主記憶部に記憶させる処理と、
    前記分解された情報の残部を、前記主記憶装置に対して取り外し可能に接続される一又は二以上の補助記憶装置の補助記憶部に、記憶させる処理と、
    前記分解され記憶された情報の一部と前記分解され記憶された情報の残部とを結合させる処理と、
    前記補助記憶装置が前記主記憶装置と接続されていないとき、前記入力した情報に対して所定の暗号処理を行う処理と
    を前記主記憶装置の前記分解・結合部に実行させる
    ことを特徴とする記憶処理用プログラム。
11. 前記分解・結合部が、前記入力した情報の奇数ビットを前記主記憶部に記憶させ、前記入力した情報の偶数ビットを前記補助記憶部に記憶させる、あるいは、前記入力した情報の偶数ビットを前記主記憶部に記憶させ、前記入力した情報の奇数ビットを前記補助記憶部に記憶させることを特徴とする請求項１０に記載の記憶処理用プログラム。
12. 電気機器又は情報処理装置から入力した情報を分解する処理、及び、分解された前記情報を結合させる処理を、メモリ装置の分解・結合部に実行させる記憶処理用プログラムであって、
    入力した前記情報を分解する処理と、
    前記分解された情報の一部を前記メモリ装置の主記憶部に記憶させる処理と、
    前記分解された情報の残部を、前記メモリ装置に対して取り外し可能に接続される一又は二以上の外部の記憶部に、記憶させる処理と、
    前記分解され記憶された情報の一部と前記分解され記憶された情報の残部とを結合させる処理と、
    前記外部の記憶部が前記補助接続手段と接続されていないとき、前記入力した情報に対して所定の暗号処理を行う処理と
    を前記メモリ装置の前記分解・結合部に実行させる
    ことを特徴とする記憶処理用プログラム。
13. 前記分解・結合部が、前記入力した情報の奇数ビットを前記主記憶部に記憶させ、前記入力した情報の偶数ビットを前記補助記憶部に記憶させる、あるいは、前記入力した情報の偶数ビットを前記主記憶部に記憶させ、前記入力した情報の奇数ビットを前記補助記憶部に記憶させることを特徴とする請求項１２に記載の記憶処理用プログラム。
    

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