JP4858162B2 - Signal processing apparatus, signal processing method, and program - Google Patents

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Description

本発明は、信号処理装置および信号処理方法、並びにプログラムに関し、特に、信号に歪が生じる伝送経路を介して行われる通信の品質を向上させることができるようにした信号処理装置および信号処理方法、並びにプログラムに関する。   The present invention relates to a signal processing device, a signal processing method, and a program, and in particular, a signal processing device and a signal processing method capable of improving the quality of communication performed via a transmission path in which a signal is distorted, And the program.

従来、例えば、テレビジョン放送信号を受信するチューナや、DVD(Digital Versatile Disc)プレーヤなどの外部機器から画像の信号が供給され、その信号に信号処理を施して、CRT(Cathode Ray Tube)やLCD(Liquid Crystal Display)などの表示装置に画像の信号を供給する信号処理装置がある。   Conventionally, for example, an image signal is supplied from an external device such as a tuner that receives a television broadcast signal or a DVD (Digital Versatile Disc) player, and the signal is subjected to signal processing, and then a CRT (Cathode Ray Tube) or LCD There is a signal processing device that supplies an image signal to a display device such as (Liquid Crystal Display).

このような信号処理装置では、外部機器から供給された画像の信号からノイズを除去するノイズ除去処理や、外部機器からの画像よりも表示装置に表示される画像が高画質となるように画像の信号を変換する画像変換処理、表示装置に表示される画像の明るさやコントラストを調整する画像調整処理などの信号処理が行われる。   In such a signal processing device, a noise removal process for removing noise from an image signal supplied from an external device, or an image displayed on a display device with higher image quality than an image from the external device. Signal processing such as image conversion processing for converting a signal and image adjustment processing for adjusting the brightness and contrast of an image displayed on the display device is performed.

図1は、従来の信号処理装置の構成例を示すブロック図である。   FIG. 1 is a block diagram illustrating a configuration example of a conventional signal processing apparatus.

図1において、信号処理装置11は、筐体12、コネクタ131乃至134、入力セレクタ14、信号ルータ15、コネクタ161乃至164、コネクタ171乃至173、機能ブロック181乃至183、コネクタ19、リモートコマンダ20、操作部21、システム制御ブロック22、および制御バス23から構成される。 In FIG. 1, the signal processing apparatus 11 includes a housing 12, connectors 13 1 to 13 4 , an input selector 14, a signal router 15, connectors 16 1 to 16 4 , connectors 17 1 to 17 3 , and functional blocks 18 1 to 18 3. , Connector 19, remote commander 20, operation unit 21, system control block 22, and control bus 23.

信号処理装置11では、コネクタ131乃至134が、信号ケーブルを介して入力セレクタ14に接続されており、入力セレクタ14が、信号ケーブルを介して信号ルータ15に接続されている。また、信号ルータ15は、信号ケーブルを介してコネクタ161乃至164とコネクタ19に接続されており、信号ルータ15は、コネクタ161乃至163およびコネクタ171乃至173を介して、機能ブロック181乃至183に接続されている。また、入力セレクタ14、信号ルータ15、コネクタ161乃至164、およびシステム制御ブロック22は、制御バス23を介して、互いに接続されている。 In the signal processing device 11, the connectors 13 1 to 13 4 are connected to the input selector 14 via a signal cable, and the input selector 14 is connected to the signal router 15 via the signal cable. The signal router 15 is connected to the connectors 16 1 to 16 4 and the connector 19 via signal cables, and the signal router 15 functions via the connectors 16 1 to 16 3 and the connectors 17 1 to 17 3. Connected to blocks 18 1 to 18 3 . The input selector 14, the signal router 15, the connectors 16 1 to 16 4 , and the system control block 22 are connected to each other via a control bus 23.

筐体12は、例えば、直方体形状の箱であり、筐体12には、コネクタ131乃至134、コネクタ19、および操作部21が外装され、筐体12の内部には、入力セレクタ14、信号ルータ15、コネクタ161乃至164、コネクタ171乃至173、機能ブロック181乃至183、システム制御ブロック22、および制御バス23が収納される。 The housing 12 is, for example, a rectangular parallelepiped box. The housing 12 is provided with connectors 13 1 to 13 4 , a connector 19, and an operation unit 21. The housing 12 includes an input selector 14, The signal router 15, the connectors 16 1 to 16 4 , the connectors 17 1 to 17 3 , the functional blocks 18 1 to 18 3 , the system control block 22 and the control bus 23 are accommodated.

コネクタ131乃至134は、信号処理装置11と、信号処理装置11に画像の信号を供給するチューナやDVDプレーヤなどの外部機器(図示せず)とを接続するケーブルが接続される接続部である。 The connectors 13 1 to 13 4 are connection portions to which cables for connecting the signal processing device 11 and an external device (not shown) such as a tuner or a DVD player that supplies image signals to the signal processing device 11 are connected. is there.

入力セレクタ14には、コネクタ131乃至134を介して、外部機器から画像の信号が供給され、入力セレクタ14は、システム制御ブロック22の制御に従って、コネクタ131乃至134のうちの、いずれか1つに接続された外部機器から供給される画像の信号を信号ルータ15に供給する。 The input selector 14 is supplied with an image signal from an external device via the connectors 13 1 to 13 4 , and the input selector 14 can select any of the connectors 13 1 to 13 4 according to the control of the system control block 22. An image signal supplied from an external device connected to the signal router 15 is supplied to the signal router 15.

信号ルータ15は、システム制御ブロック22の制御に従い、入力セレクタ14から供給された信号を、コネクタ161乃至163およびコネクタ171乃至173を介して、機能ブロック181乃至183に供給する。また、信号ルータ15には、信号処理が施された信号が機能ブロック181乃至183から供給され、信号ルータ15は、信号処理が施された信号を、コネクタ19を介して、コネクタ19に接続されている表示装置(図示せず)に供給する。 The signal router 15 supplies the signal supplied from the input selector 14 to the functional blocks 18 1 to 18 3 via the connectors 16 1 to 16 3 and the connectors 17 1 to 17 3 according to the control of the system control block 22. . Further, the signal router 15 is supplied with the signal processed signal from the function blocks 18 1 to 18 3 , and the signal router 15 sends the signal processed signal to the connector 19 via the connector 19. Supply to a connected display device (not shown).

コネクタ161乃至163とコネクタ171乃至173とは、互いに着脱可能であり、信号ルータ15または制御バス23と、機能ブロック181乃至183とを接続する。また、コネクタ164には、信号処理装置11に追加される新たな機能ブロックなどを接続することができる。 The connectors 16 1 to 16 3 and the connectors 17 1 to 17 3 are detachable from each other, and connect the signal router 15 or the control bus 23 and the functional blocks 18 1 to 18 3 . Further, a new functional block or the like added to the signal processing device 11 can be connected to the connector 16 4 .

機能ブロック181乃至183は、ノイズ除去処理、画像変換処理、または画像調整処理などの信号処理を施す信号処理回路をそれぞれ有している。機能ブロック181乃至183は、信号ルータ15から供給される信号に対して信号処理を施し、信号処理が施された信号を、信号ルータ15に供給する。 Each of the functional blocks 18 1 to 18 3 has a signal processing circuit that performs signal processing such as noise removal processing, image conversion processing, or image adjustment processing. The functional blocks 18 1 to 18 3 perform signal processing on the signal supplied from the signal router 15 and supply the signal subjected to signal processing to the signal router 15.

コネクタ19は、信号処理装置11と、信号処理装置11から出力される画像を表示する表示装置とを接続するケーブルが接続される接続部である。   The connector 19 is a connection unit to which a cable that connects the signal processing device 11 and a display device that displays an image output from the signal processing device 11 is connected.

リモートコマンダ20は、ユーザにより操作される複数のボタンなどを備えており、ユーザにより操作され、ユーザの操作に応じた操作信号を、赤外線などを利用して、システム制御ブロック22に供給する。   The remote commander 20 includes a plurality of buttons operated by the user, and is operated by the user, and supplies an operation signal corresponding to the user's operation to the system control block 22 using infrared rays or the like.

操作部21は、リモートコマンダ20と同様に、ユーザにより操作される複数のボタンなどを備えており、ユーザにより操作され、ユーザの操作に応じた操作信号を、システム制御ブロック22に供給する。   Similar to the remote commander 20, the operation unit 21 includes a plurality of buttons operated by the user, and is operated by the user, and supplies an operation signal corresponding to the user operation to the system control block 22.

システム制御ブロック22は、ユーザの操作に応じた操作信号が、リモートコマンダ20または操作部21から供給されると、その操作信号に応じた処理が行われるように、制御バス23を介して、入力セレクタ14、信号ルータ15、または機能ブロック181乃至183を制御する。 When an operation signal corresponding to a user operation is supplied from the remote commander 20 or the operation unit 21, the system control block 22 is input via the control bus 23 so that processing according to the operation signal is performed. The selector 14, the signal router 15, or the function blocks 18 1 to 18 3 are controlled.

以上のように構成される信号処理装置11では、コネクタ131乃至134および入力セレクタ14を介して信号ルータ15に画像の信号が供給され、信号ルータ15と機能ブロック181乃至183との間で、信号ケーブルを介して、画像の信号が伝送される。 In the signal processing apparatus 11 configured as described above, an image signal is supplied to the signal router 15 via the connectors 13 1 to 13 4 and the input selector 14, and the signal router 15 and the functional blocks 18 1 to 18 3 are connected. In between, an image signal is transmitted via a signal cable.

ところで、近年、画像の高精細化に伴い、信号処理装置11が信号処理を施す画像の信号のデータ量が、大きくなる傾向がある。データ量の大きな画像の信号を遅延なく処理するためには、例えば、信号ルータ15と機能ブロック181乃至183との間で、信号ケーブルを介して、画像の信号を高速で伝送する必要がある。しかしながら、信号が高速で伝送されると、信号ケーブルの周波数特性や、クロストーク、パラレルな信号ケーブルにおいて生じるタイミングのずれ(スキュー)などの影響により、信号の伝送に問題が発生する。 By the way, in recent years, the data amount of an image signal subjected to signal processing by the signal processing device 11 tends to increase as the image becomes higher in definition. In order to process an image signal having a large amount of data without delay, for example, it is necessary to transmit the image signal at a high speed via a signal cable between the signal router 15 and the functional blocks 18 1 to 18 3. is there. However, when a signal is transmitted at a high speed, a problem occurs in signal transmission due to the influence of the frequency characteristics of the signal cable, crosstalk, timing shift (skew) that occurs in the parallel signal cable, and the like.

ここで、特許文献1には、筐体に内蔵される基板どうしが、電磁波を用いた無線通信により信号を伝送し、信号処理を行う信号処理装置が開示されている。   Here, Patent Document 1 discloses a signal processing device that performs signal processing by transmitting signals by wireless communication using electromagnetic waves between substrates built in a housing.

このように、例えば、信号ルータ15と機能ブロック181乃至183とが、電磁波を用いた無線通信により信号を伝送することで、信号ケーブルを介して信号を高速で伝送することにより発生する問題を回避することができる。 Thus, for example, the problem that occurs when the signal router 15 and the functional blocks 18 1 to 18 3 transmit a signal by radio communication using electromagnetic waves, thereby transmitting the signal at high speed via the signal cable. Can be avoided.

しかしながら、信号ルータ15と機能ブロック181乃至183とが、信号処理装置11の筐体12の内部で、電磁波を用いた無線通信により信号を伝送すると、筐体12の壁面で電磁波が反射したり、筐体12に内蔵される基板で電磁波が回折したりすることにより、経路距離の異なる複数の伝送経路(マルチパス)が発生する。そして、マルチパスを介して信号が伝送されると、信号を受信する受信側に到達する信号の位相がずれてしまい、信号が干渉してしまう。 However, when the signal router 15 and the functional blocks 18 1 to 18 3 transmit signals by radio communication using electromagnetic waves inside the casing 12 of the signal processing device 11, the electromagnetic waves are reflected by the wall surface of the casing 12. In addition, electromagnetic waves are diffracted by a substrate built in the housing 12, and a plurality of transmission paths (multipaths) having different path distances are generated. When a signal is transmitted via multipath, the phase of the signal reaching the receiving side that receives the signal is shifted, and the signal interferes.

このように、筐体12の内部における無線通信においては、即ち、信号の干渉によって信号の波形に歪が生じる伝送経路を介して行われる通信においては、受信側の基板は、信号を正常に復調することができなくなり、その結果、通信の品質が低下する。   As described above, in the wireless communication inside the housing 12, that is, in the communication performed through the transmission path in which the signal waveform is distorted due to the interference of the signal, the reception-side board normally demodulates the signal. As a result, the quality of communication deteriorates.

ところで、筐体の内部における無線通信以外に、例えば、携帯電話機による移動体通信において、ビルなどの建設物により電磁波が反射することによって生じるマルチパスによっても、信号の位相がずれることにより干渉が発生し、通信の品質が低下する。また、このような無線通信以外にも、例えば、ケーブルを介して信号を伝送するにあたり、ケーブルの端部で信号が反射し、伝送すべき信号と反射した信号とによっても干渉が発生し、通信の品質が低下する。   By the way, in addition to wireless communication inside the housing, interference occurs due to the signal phase being shifted due to multipath caused by reflection of electromagnetic waves by a building or other building structure in mobile communication using a mobile phone, for example. As a result, communication quality deteriorates. In addition to such wireless communication, for example, when a signal is transmitted through a cable, the signal is reflected at the end of the cable, and interference occurs between the signal to be transmitted and the reflected signal. The quality of

従来、一般的な無線通信の信号処理によるマルチパス対策として、変調方式としてOFDM(Orthogonal Frequency Division Multiplexing:直交周波数分割多重方式)を用いる方法や、スペクトラム拡散 (Spread Spectrum)とレイク受信を用いる方法、マルチアンテナを用いる方法、波形等化器を用いる方法などがある。   Conventionally, as a multipath countermeasure by signal processing of general wireless communication, a method using OFDM (Orthogonal Frequency Division Multiplexing) as a modulation method, a method using spread spectrum and rake reception, There are a method using a multi-antenna and a method using a waveform equalizer.

しかしながら、画像の信号、特に、非圧縮の画像の信号のように、高速に伝送する必要がある信号に対する信号処理においては、信号処理において生じる遅延を短くすること、および遅延を一定にすることが必要であるが、これらのマルチパス対策を用いたとしても、信号処理において生じる遅延を短くすること、および遅延を一定にすることは困難であった。   However, in signal processing for a signal that needs to be transmitted at a high speed, such as an image signal, particularly an uncompressed image signal, the delay generated in the signal processing can be shortened and the delay can be made constant. Although necessary, even if these multipath countermeasures are used, it is difficult to shorten the delay caused in signal processing and to make the delay constant.

また、OFDMを変調方式に採用した場合には、変調および復調において用いられるFFT(Fast Fourier Transform)の処理を実行するデバイスに大きな負荷がかかり、それらのデバイスの発熱量が多くなったり、コストが高くなる懸念がある。また、スペクトラム拡散を用いた場合には、高速な通信を実現するために、送信信号よりも高速な信号処理が必要となるが、そのような高速な信号処理を行うことは難しく、高速な通信を実現することが困難であった。   In addition, when OFDM is used as a modulation method, a large load is applied to devices that perform FFT (Fast Fourier Transform) processing used in modulation and demodulation, and the amount of heat generated by these devices increases, resulting in cost reduction. There is a concern of becoming higher. In addition, when using spread spectrum, high-speed signal processing is required to achieve high-speed communication, but it is difficult to perform such high-speed signal processing. It was difficult to realize.

また、マルチアンテナや波形等化器を用いた場合には、パケットにUW(Unique Word)を挿入することが必要になったり、伝送特性の変化を予測する精度を向上させるために大規模な予測回路が必要になったりする。   Also, when multiple antennas or waveform equalizers are used, it is necessary to insert UW (Unique Word) into the packet or large-scale prediction to improve the accuracy of predicting changes in transmission characteristics I need a circuit.

特開2003−179821号公報JP 2003-179821 A

上述したように、従来の信号処理装置の筐体内における無線通信では、信号の干渉により歪が生じ、通信の品質が低下していた。   As described above, in wireless communication within a casing of a conventional signal processing device, distortion occurs due to signal interference, and communication quality is degraded.

本発明は、このような状況に鑑みてなされたものであり、信号に歪が生じる伝送経路を介して行われる通信の品質を向上させることができるようにするものである。   The present invention has been made in view of such a situation, and is intended to improve the quality of communication performed via a transmission path in which a signal is distorted.

本発明の一側面の信号処理装置は、特定のシンボルの前に送信されたシンボルの値に応じて、前記特定のシンボルの信号値が表す波形に、定常的な歪が生じる伝送経路を介して伝送される信号を処理する信号処理装置であって、前記伝送経路を介して伝送されてきた信号から、前記特定のシンボルの信号値を取得する取得手段と、前記特定のシンボルの前に送信されたシンボルの値に応じて生じる、前記特定のシンボルの信号値が表す波形の歪の特性に基づいて、前記特定のシンボルの信号値が表す波形に生じると予測される歪を、前記取得手段が取得した前記特定のシンボルの信号値が表す波形から分離することにより得られる分離波形を算出する分離手段と、前記分離手段が算出した前記分離波形に基づいて、前記特定のシンボルの値を決定する決定手段と、あらかじめ設定された所定の値を取る複数の前記シンボルからなるテスト信号を受信する受信手段と、前記受信手段が受信した前記テスト信号の特定のシンボルの信号値と、前記テスト信号の複数のシンボルの値とに基づいて、前記歪の特性を求める特性取得手段とを備える。 In the signal processing device according to one aspect of the present invention, the waveform represented by the signal value of the specific symbol is transmitted via a transmission path in which steady distortion occurs in the waveform represented by the signal value of the specific symbol according to the value of the symbol transmitted before the specific symbol A signal processing apparatus for processing a signal to be transmitted, an acquisition means for acquiring a signal value of the specific symbol from a signal transmitted through the transmission path, and transmitted before the specific symbol The acquisition means calculates distortion predicted to occur in the waveform represented by the signal value of the specific symbol based on characteristics of the distortion of the waveform represented by the signal value of the specific symbol, which occurs according to the value of the specific symbol. Separating means for calculating a separated waveform obtained by separating from the waveform represented by the acquired signal value of the specific symbol, and based on the separated waveform calculated by the separating means, the value of the specific symbol is A determining means for constant for a receiving means for receiving a test signal comprising a plurality of said symbols take preset predetermined value, the signal value of the specific symbol of the test signal received by the receiving unit, the test Characteristic acquisition means for determining the characteristic of the distortion based on the values of a plurality of symbols of the signal .

また、本発明の一側面の信号処理装置では、前記決定手段は、前記特定のシンボルが取り得る値ごとに、前記特定のシンボルの値に応じた前記特定のシンボルの信号値が表す波形の特性に基づいて予測される前記特定のシンボルの信号値を、前記分離手段が算出した前記分離波形の信号値から減算し、前記特定のシンボルが取り得る値ごとの比較値を算出する比較値算出手段と、前記特定のシンボルが取り得る値ごとの前記比較値を比較し、前記比較値の絶対値が最も小さな値となるときの算出に用いられた前記特定のシンボルの値を、前記伝送経路を介して伝送されてきた信号の特定のシンボルの値とする比較手段とを有することができる。 Further, in the signal processing device according to one aspect of the present invention, the determination unit has a waveform characteristic represented by the signal value of the specific symbol corresponding to the value of the specific symbol for each value that the specific symbol can take. The comparison value calculation means for subtracting the signal value of the specific symbol predicted based on the signal from the signal value of the separation waveform calculated by the separation means, and calculating a comparison value for each value that the specific symbol can take And the comparison value for each value that the specific symbol can take, and the value of the specific symbol used for the calculation when the absolute value of the comparison value is the smallest value is And means for comparing with the value of a specific symbol of the signal transmitted through the network.

本発明の一側面の信号処理方法またはプログラムは、特定のシンボルの前に送信されたシンボルの値に応じて、前記特定のシンボルの信号値が表す波形に、定常的な歪が生じる伝送経路を介して伝送される信号を処理する信号処理方法、または特定のシンボルの前に送信されたシンボルの値に応じて、前記特定のシンボルの信号値が表す波形に、定常的な歪が生じる伝送経路を介して伝送される信号を処理する信号処理をコンピュータに実行させるプログラムであって、前記伝送経路を介して伝送されてきた信号から、前記特定のシンボルの信号値を取得し、前記特定のシンボルの前に送信されたシンボルの値に応じて生じる、前記特定のシンボルの信号値が表す波形の歪の特性に基づいて、前記特定のシンボルの信号値が表す波形に生じると予測される歪を、前記伝送経路を介して伝送されてきた信号から取得された前記特定のシンボルの信号値が表す波形から分離することにより得られる分離波形を算出し、前記分離波形に基づいて、前記特定のシンボルの値を決定し、あらかじめ設定された所定の値を取る複数の前記シンボルからなるテスト信号を受信し、受信した前記テスト信号の特定のシンボルの信号値と、前記テスト信号の複数のシンボルの値とに基づいて、前記歪の特性を求めるステップを含む。 A signal processing method or program according to an aspect of the present invention provides a transmission path in which steady distortion occurs in a waveform represented by a signal value of a specific symbol in accordance with the value of the symbol transmitted before the specific symbol. A signal processing method for processing a signal transmitted via the transmission path, or a transmission path in which steady distortion occurs in the waveform represented by the signal value of the specific symbol according to the value of the symbol transmitted before the specific symbol A program for causing a computer to perform signal processing for processing a signal transmitted via a signal, wherein a signal value of the specific symbol is obtained from a signal transmitted via the transmission path, and the specific symbol is obtained. Occurs in the waveform represented by the signal value of the specific symbol based on the distortion characteristics of the waveform represented by the signal value of the specific symbol, which occurs according to the value of the symbol transmitted before A separation waveform obtained by separating predicted distortion from a waveform represented by a signal value of the specific symbol acquired from a signal transmitted through the transmission path is calculated, and based on the separation waveform Determining a value of the specific symbol , receiving a test signal composed of a plurality of the symbols having a predetermined value set in advance, a signal value of the specific symbol of the received test signal, and the test signal Determining distortion characteristics based on a plurality of symbol values .

本発明の一側面においては、伝送経路を介して伝送されてきた信号から、特定のシンボルの信号値が取得され、特定のシンボルの前に送信されたシンボルの値に応じて生じる、特定のシンボルの信号値が表す波形の歪の特性に基づいて、特定のシンボルの信号値が表す波形に生じると予測される歪を、伝送経路を介して伝送されてきた信号から取得された特定のシンボルの信号値が表す波形から分離することにより得られる分離波形が算出される。そして、分離波形に基づいて、特定のシンボルの値が決定され、あらかじめ設定された所定の値を取る複数のシンボルからなるテスト信号が受信され、そのテスト信号の特定のシンボルの信号値と、テスト信号の複数のシンボルの値とに基づいて、歪の特性が求められる。 In one aspect of the present invention, a signal value of a specific symbol is acquired from a signal transmitted through a transmission path, and a specific symbol is generated according to the value of the symbol transmitted before the specific symbol. The distortion predicted to occur in the waveform represented by the signal value of the specific symbol based on the distortion characteristics of the waveform represented by the signal value of the signal of the specific symbol obtained from the signal transmitted through the transmission path A separated waveform obtained by separating from the waveform represented by the signal value is calculated. Then, based on the separated waveform, a value of a specific symbol is determined , a test signal composed of a plurality of symbols having a predetermined value set in advance is received, a signal value of the specific symbol of the test signal, and a test Based on the values of a plurality of symbols of the signal, distortion characteristics are obtained.

本発明の一側面によれば、信号に歪が生じる伝送経路を介して行われる通信の品質を向上させることができる。   According to one aspect of the present invention, it is possible to improve the quality of communication performed via a transmission path in which a signal is distorted.

以下に本発明の実施の形態を説明する Embodiments of the present invention will be described below .

以下、本発明を適用した具体的な実施の形態について、図面を参照しながら詳細に説明する。   Hereinafter, specific embodiments to which the present invention is applied will be described in detail with reference to the drawings.

図2は、本発明を適用した信号処理装置の一実施の形態の構成例を示す斜視図である。   FIG. 2 is a perspective view showing a configuration example of an embodiment of a signal processing device to which the present invention is applied.

図2において、信号処理装置31は、筐体32、電源モジュール33、プラットフォーム基板34、入力基板35、信号処理基板361乃至363、および出力基板37から構成される。 In FIG. 2, the signal processing device 31 includes a housing 32, a power supply module 33, a platform board 34, an input board 35, signal processing boards 36 1 to 36 3 , and an output board 37.

筐体32は、直方体形状の箱であり、その内部に、電源モジュール33、プラットフォーム基板34、入力基板35、信号処理基板361乃至363、および出力基板37が収納される。 The housing 32 is a rectangular parallelepiped box, and the power supply module 33, the platform substrate 34, the input substrate 35, the signal processing substrates 36 1 to 36 3 , and the output substrate 37 are accommodated therein.

電源モジュール33は、プラットフォーム基板34、入力基板35、信号処理基板361乃至363、および出力基板37に、駆動に必要な電力を供給する。 The power supply module 33 supplies power required for driving to the platform board 34, the input board 35, the signal processing boards 36 1 to 36 3 , and the output board 37.

プラットフォーム基板34には、信号処理基板361乃至363が装着され、プラットフォーム基板34を介して、例えば、電源モジュール33から信号処理基板361乃至363に電力が供給される。 Signal processing boards 36 1 to 36 3 are mounted on the platform board 34, and power is supplied from the power module 33 to the signal processing boards 36 1 to 36 3 via the platform board 34, for example.

入力基板35は、筐体32に外装されているコネクタ(例えば、後述する図3のコネクタ431乃至434)に接続されており、入力基板35には、このコネクタを介して接続される外部機器(図示せず)から画像の信号が供給される。また、入力基板35は、電磁波を用いた無線通信を行うためのアンテナ35aを備えており、外部機器から供給された画像の信号を、アンテナ35aを介して、信号処理基板361乃至363に供給する。 The input board 35 is connected to a connector (for example, connectors 43 1 to 43 4 in FIG. 3 to be described later) that is externally mounted on the housing 32, and the input board 35 is connected to the outside via this connector. An image signal is supplied from a device (not shown). Also, the input board 35 has an antenna 35a for wireless communication using electromagnetic waves, the signal of the image supplied from the external device, via the antenna 35a, the signal processing substrate 36 to 363 Supply.

信号処理基板361乃至363は、電磁波を用いた無線通信を行うためのアンテナ36a1乃至36a3を備えており、信号処理基板361乃至363には、アンテナ36a1乃至36a3を介して、入力基板35から画像の信号が供給される。信号処理基板361乃至363は、入力基板35からの画像の信号に対し、ノイズ除去処理、画像変換処理、または画像調整処理などの信号処理をそれぞれ施し、信号処理を施した画像の信号を、アンテナ36a1乃至36a3を介して、出力基板37に供給する。 The signal processing boards 36 1 to 36 3 are provided with antennas 36a 1 to 36a 3 for performing wireless communication using electromagnetic waves, and the signal processing boards 36 1 to 36 3 are connected via the antennas 36a 1 to 36a 3 . Thus, an image signal is supplied from the input board 35. The signal processing boards 36 1 to 36 3 perform signal processing such as noise removal processing, image conversion processing, or image adjustment processing on the image signal from the input board 35, respectively, and the image processing signal is processed. Then, it is supplied to the output board 37 via the antennas 36a 1 to 36a 3 .

出力基板37は、電磁波を用いた無線通信を行うためのアンテナ37aを備えるとともに、筐体32に外装されているコネクタ(例えば、後述する図3のコネクタ47)に接続されている。出力基板37は、アンテナ37aを介して、信号処理基板361乃至363から供給される画像の信号を、筐体32に外装されているコネクタに接続されている表示装置(図示せず)に供給する。 The output board 37 includes an antenna 37a for performing wireless communication using electromagnetic waves, and is connected to a connector (for example, a connector 47 in FIG. 3 described later) that is externally mounted on the housing 32. The output board 37 sends image signals supplied from the signal processing boards 36 1 to 36 3 via the antenna 37 a to a display device (not shown) connected to a connector mounted on the housing 32. Supply.

次に、図3は、図2の信号処理装置31の構成例を示すブロック図である。   Next, FIG. 3 is a block diagram illustrating a configuration example of the signal processing device 31 of FIG.

図3において、信号処理装置31は、筐体42、コネクタ431乃至434、入力セレクタ44、信号ルータ45、機能ブロック461乃至463、コネクタ47、リモートコマンダ48、操作部49、およびシステム制御ブロック50から構成される。 In FIG. 3, a signal processing device 31 includes a housing 42, connectors 43 1 to 43 4 , an input selector 44, a signal router 45, functional blocks 46 1 to 46 3 , a connector 47, a remote commander 48, an operation unit 49, and a system. The control block 50 is configured.

信号処理装置31では、コネクタ431乃至434が、信号ケーブルを介して入力セレクタ44に接続されており、入力セレクタ44が、信号ケーブルを介して信号ルータ45に接続されており、信号ルータ45が、信号ケーブルを介してコネクタ47に接続されている。 In the signal processing device 31, the connectors 43 1 to 43 4 are connected to the input selector 44 via a signal cable, and the input selector 44 is connected to the signal router 45 via the signal cable. Is connected to the connector 47 via a signal cable.

筐体42は、図2の筐体32に対応し、筐体42には、コネクタ431乃至434、コネクタ47、および操作部49が外装され、筐体42の内部には、入力セレクタ44、信号ルータ45、機能ブロック461乃至463、およびシステム制御ブロック50が収納される。 The housing 42 corresponds to the housing 32 of FIG. 2, and the connectors 42 1 to 43 4 , the connector 47, and the operation unit 49 are externally mounted on the housing 42, and the input selector 44 is provided inside the housing 42. The signal router 45, functional blocks 46 1 to 46 3 , and the system control block 50 are accommodated.

コネクタ431乃至434は、信号処理装置31と、信号処理装置31に画像の信号を供給するチューナやDVDプレーヤなどの外部機器(図示せず)とを接続するケーブルが接続される接続部である。 The connectors 43 1 to 43 4 are connection portions to which cables for connecting the signal processing device 31 and an external device (not shown) such as a tuner or a DVD player that supplies image signals to the signal processing device 31 are connected. is there.

入力セレクタ44は、例えば、図2の入力基板35に設けられており、システム制御ブロック50と通信を行うためのアンテナ44aを備える。入力セレクタ44には、コネクタ431乃至434を介して、外部機器から画像の信号が供給され、入力セレクタ44は、システム制御ブロック50の制御に従って、コネクタ431乃至434のうちの、いずれか1つに接続された外部機器から供給される画像の信号を信号ルータ45に供給する。 The input selector 44 is provided, for example, on the input board 35 of FIG. 2 and includes an antenna 44 a for communicating with the system control block 50. The input selector 44 is supplied with an image signal from an external device via the connectors 43 1 to 43 4 , and the input selector 44 can select any of the connectors 43 1 to 43 4 according to the control of the system control block 50. The signal router 45 is supplied with an image signal supplied from an external device connected thereto.

信号ルータ45は、例えば、図2の出力基板37に設けられており、システム制御ブロック50や、機能ブロック461乃至463などと通信を行うためのアンテナ45aを備える。信号ルータ45は、システム制御ブロック50の制御に従い、入力セレクタ44から供給される画像の信号を、アンテナ45aを介して、電磁波を用いた無線通信により、機能ブロック461乃至463に送信する。 The signal router 45 includes, for example, is provided on the output board 37 in FIG. 2, and the system control block 50, an antenna 45a for communicating with the functional blocks 46 1 to 46 3. Signal router 45 under the control of the system control block 50, a signal of the image supplied from the input selector 44 via the antenna 45a, by wireless communication using an electromagnetic wave, and transmits to the functional blocks 46 1 to 46 3.

また、信号ルータ45は、アンテナ45aを介して、電磁波を用いた無線通信により、機能ブロック461乃至463から送信されてくる画像の信号を受信し、機能ブロック461乃至463からの画像の信号を、コネクタ47を介して、コネクタ47に接続されている表示装置(図示せず)に供給する。 Further, the signal router 45 receives image signals transmitted from the function blocks 46 1 to 46 3 through the antenna 45a by wireless communication using electromagnetic waves, and receives images from the function blocks 46 1 to 46 3. Is supplied to a display device (not shown) connected to the connector 47 through the connector 47.

機能ブロック461乃至463は、例えば、図2の信号処理基板361乃至363にそれぞれ設けられており、アンテナ46a1乃至46a3を備える。 The functional blocks 46 1 to 46 3 are provided, for example, on the signal processing boards 36 1 to 36 3 in FIG. 2, respectively, and include antennas 46a 1 to 46a 3 .

機能ブロック461乃至463は、アンテナ46a1乃至46a3を介して、電磁波を用いた無線通信により、信号ルータ45から送信されてくる画像の信号を受信し、その画像の信号に対し、ノイズ除去処理、画像変換処理、または画像調整処理などの信号処理をそれぞれ施す。そして、機能ブロック461乃至463は、信号処理を施した画像の信号を、アンテナ46a1乃至46a3を介して、電磁波を用いた無線通信により、信号ルータ45に送信する。また、機能ブロック461乃至463どうしも、それぞれが備えるアンテナ46a1乃至46a3を介して、互いに信号の送受信を行う。 The functional blocks 46 1 to 46 3 receive image signals transmitted from the signal router 45 through wireless communication using electromagnetic waves via the antennas 46a 1 to 46a 3, and perform noise on the image signals. Signal processing such as removal processing, image conversion processing, or image adjustment processing is performed. Then, the functional blocks 46 1 to 46 3 transmit the signal of the image subjected to signal processing to the signal router 45 by wireless communication using electromagnetic waves via the antennas 46a 1 to 46a 3 . In addition, the functional blocks 46 1 to 46 3 transmit and receive signals to and from each other via the antennas 46a 1 to 46a 3 included therein.

なお、機能ブロック461乃至463のそれぞれを個々に区別する必要がない場合、以下、適宜、機能ブロック461乃至463を機能ブロック46と称する。同様に、機能ブロック461乃至463それぞれに設けられたアンテナ46a1乃至46a3も、アンテナ46aと称する。 When there is no need to individually distinguish each of the functional blocks 46 1 through 46 3, below, as appropriate, the functional blocks 46 1 through 46 3 is referred to as a functional block 46. Similarly, the antennas 46a 1 to 46a 3 provided in the functional blocks 46 1 to 46 3 are also referred to as antennas 46a.

コネクタ47は、図1のコネクタ19と同様に、信号処理装置31と、信号処理装置31から出力される画像を表示する表示装置とを接続するケーブルが接続される接続部である。   The connector 47 is a connection portion to which a cable for connecting the signal processing device 31 and a display device that displays an image output from the signal processing device 31 is connected, like the connector 19 of FIG.

リモートコマンダ48または操作部49は、図1のリモートコマンダ20または操作部21と同様に、ユーザにより操作され、ユーザの操作に応じた操作信号を、システム制御ブロック50に供給する。   The remote commander 48 or the operation unit 49 is operated by the user and supplies an operation signal corresponding to the user's operation to the system control block 50, similarly to the remote commander 20 or the operation unit 21 of FIG.

システム制御ブロック50は、例えば、図2のプラットフォーム基板34に設けられており、アンテナ50aを備えている。システム制御ブロック50は、ユーザの操作に応じた操作信号が、リモートコマンダ48または操作部49から供給されると、その操作信号に応じた処理が行われるように、アンテナ50aを介して、電磁波を用いた無線通信により、入力セレクタ44、信号ルータ45、または機能ブロック46を制御する。   The system control block 50 is provided, for example, on the platform board 34 in FIG. 2 and includes an antenna 50a. When an operation signal corresponding to a user operation is supplied from the remote commander 48 or the operation unit 49, the system control block 50 transmits an electromagnetic wave via the antenna 50a so that processing according to the operation signal is performed. The input selector 44, the signal router 45, or the functional block 46 is controlled by the used wireless communication.

以上のように信号処理装置31は構成され、信号処理装置31の筐体42の内部で、信号ルータ45と機能ブロック46とが、電磁波を用いた無線通信により、画像の信号を送受信する。   As described above, the signal processing device 31 is configured, and the signal router 45 and the functional block 46 transmit and receive image signals by wireless communication using electromagnetic waves inside the housing 42 of the signal processing device 31.

このような筐体42の内部で無線通信が行われると、例えば、信号ルータ45のアンテナ45aから出力された電磁波は、筐体42の壁面などで反射することによりマルチパスを介して伝送され、機能ブロック46に到達する電磁波(信号)の位相がずれてしまう。この位相のずれにより、機能ブロック46が受信する信号が互いに干渉し、信号の波形に歪が生じてしまい、例えば、信号のシンボルが誤って判定されることがある。   When wireless communication is performed inside such a casing 42, for example, electromagnetic waves output from the antenna 45a of the signal router 45 are transmitted via a multipath by being reflected by the wall surface of the casing 42, and the like. The phase of the electromagnetic wave (signal) reaching the functional block 46 is shifted. Due to this phase shift, the signals received by the functional block 46 interfere with each other, and the waveform of the signal is distorted. For example, the symbol of the signal may be erroneously determined.

次に、図4を参照し、筐体42の内部における無線通信により伝送された信号の波形に生じる歪について説明する。   Next, with reference to FIG. 4, distortion that occurs in the waveform of a signal transmitted by wireless communication inside the housing 42 will be described.

ここで、無線通信において、変調方式によっては、信号が表す1シンボルにより、複数のビットを伝送することができるが、以下では、例えば、BPSK(binary phase shift keying)のように、1シンボルにより1ビット(0または1のいずれか一方)が伝送される例について説明する。また、信号ルータ45と機能ブロック46との間、または機能ブロック46どうしの間で信号の送受信が行われるが、信号ルータ45から機能ブロック46に信号が送信される例について説明する。   Here, in wireless communication, depending on the modulation method, a plurality of bits can be transmitted by one symbol represented by a signal, but in the following, for example, 1 symbol is used for one symbol as in BPSK (binary phase shift keying). An example in which a bit (either 0 or 1) is transmitted will be described. An example in which a signal is transmitted / received between the signal router 45 and the functional block 46 or between the functional blocks 46 will be described.

図4の下側には、信号ルータ45から機能ブロック46に送信される信号の一部が示されている。即ち、図4の下側には、信号ルータ45から送信される信号の特定のビット(以下、適宜、現在のビットという)の4ビット前に送信されたビットから、現在のビットまでの5ビットの信号が示されており、現在のビットの4ビット前に送信されたビットから現在のビットまでの各ビットを「4ビット前、3ビット前、2ビット前、1ビット前、現在のビット」と表すとすると、「0,1,0,1,1」の5ビットの信号が示されている。   A part of the signal transmitted from the signal router 45 to the functional block 46 is shown on the lower side of FIG. That is, on the lower side of FIG. 4, 5 bits from a bit transmitted 4 bits before a specific bit of the signal transmitted from the signal router 45 (hereinafter, appropriately referred to as the current bit) to the current bit are displayed. Each bit from the bit transmitted 4 bits before the current bit to the current bit is expressed as “4 bits before, 3 bits before, 2 bits before, 1 bit before, current bit”. In other words, a 5-bit signal of “0,1,0,1,1” is shown.

また、図4の上側には、機能ブロック46が受信した信号の波形が示されている。図4において、横軸は時間を表し、縦軸は信号の信号値を表す。また、図4において、細い線は、機能ブロック46が複数回受信した信号そのものの波形(DATA)を表し、太い線は、複数の信号の波形を平均した波形(AVG)を表す。   Further, the waveform of the signal received by the functional block 46 is shown on the upper side of FIG. In FIG. 4, the horizontal axis represents time, and the vertical axis represents the signal value of the signal. In FIG. 4, the thin line represents the waveform (DATA) of the signal itself received by the functional block 46 a plurality of times, and the thick line represents the waveform (AVG) obtained by averaging the waveforms of the plurality of signals.

図4の右上には、無線通信により機能ブロック46が受信した信号の波形であって、現在のビットに対応する信号の波形が示されている。図4の左上には、例えば、信号ルータ45と機能ブロック46とが信号ケーブルを介して接続されていたとしたときに、信号ケーブルを介して機能ブロック46が受信した信号の波形であって、現在のビットに対応する信号の波形が示されている。   In the upper right of FIG. 4, the waveform of the signal received by the functional block 46 by wireless communication and corresponding to the current bit is shown. In the upper left of FIG. 4, for example, when the signal router 45 and the functional block 46 are connected via a signal cable, the waveform of the signal received by the functional block 46 via the signal cable, A waveform of a signal corresponding to each bit is shown.

信号ケーブルを介して信号が伝送される場合には、図4の左上に示されているように、現在のビット「1」の信号値の平均値は約0.3となり、平均値の波形は直線的な形状である。   When the signal is transmitted through the signal cable, as shown in the upper left of FIG. 4, the average value of the signal value of the current bit “1” is about 0.3, and the waveform of the average value is linear. Shape.

これに対し、無線通信により信号が伝送される場合には、筐体42の内部のように閉じられた系においては、電磁波の発散が少ないので、電磁波の減衰は小さく、現在のビットの数ビット前のビット、例えば、4ビット前から1ビット前までの各ビットが、筐体41の壁面で反射したり、各基板で反射や回折したりすることで遅延して伝送される。このように、4ビット前から1ビット前までの各ビットが遅延して伝送され、現在のビットに重畳されることにより、現在のビットの信号値が変化する。   On the other hand, when a signal is transmitted by wireless communication, in a closed system such as the inside of the casing 42, since the divergence of the electromagnetic wave is small, the attenuation of the electromagnetic wave is small and the current bit is several bits. The previous bit, for example, each bit from the previous 4 bits to the previous 1 bit, is reflected by the wall surface of the casing 41 or reflected or diffracted by each substrate, and is transmitted with a delay. Thus, each bit from 4 bits before to 1 bit before is transmitted with a delay, and is superimposed on the current bit, whereby the signal value of the current bit changes.

従って、図4の右上に示されているように、機能ブロック46が受信した信号であって、現在のビットに対応する信号の信号値により表される波形(以下、適宜、現在のビットの波形という)に歪が生じてしまう。特に、現在のビットが1であるにもかかわらず、ビットの値の判定に用いられる閾値(即ち、0)以下の信号値もあり、これにより、現在のビットが0であると、間違って判定される可能性がある。   Therefore, as shown in the upper right of FIG. 4, the waveform received by the functional block 46 and represented by the signal value of the signal corresponding to the current bit (hereinafter, the waveform of the current bit as appropriate). Distortion) occurs. In particular, there are signal values that are less than or equal to the threshold (ie, 0) used to determine the value of the bit, even though the current bit is 1, thereby erroneously determining that the current bit is 0. There is a possibility that.

しかしながら、図4の右上に示されているように、歪が生じた波形の分散は、ある一定の大きさに収まっており、波形に生じる歪は、定常的な特性を有している。   However, as shown in the upper right of FIG. 4, the dispersion of the waveform in which the distortion has occurred is within a certain level, and the distortion in the waveform has a steady characteristic.

即ち、図2に示すように、信号処理装置31の筐体32の内部では、電源モジュール33、プラットフォーム基板34、入力基板35、信号処理基板361乃至363、および出力基板37は、それぞれ固定されているので、筐体32の壁面や各基板などでは、常に、電磁波が同様に反射しており、それらの電磁波の干渉、即ち、マルチパスによる影響は、定常的なものであるといえる。これにより、現在のビットの波形に生じる歪が定常的なものとなる。 That is, as shown in FIG. 2, the power supply module 33, the platform board 34, the input board 35, the signal processing boards 36 1 to 36 3 , and the output board 37 are fixed inside the housing 32 of the signal processing device 31. Therefore, the electromagnetic waves are always reflected in the same manner on the wall surface of the housing 32, each substrate, and the like, and it can be said that the interference of these electromagnetic waves, that is, the influence due to multipath is stationary. Thereby, the distortion generated in the waveform of the current bit becomes steady.

即ち、例えば、現在のビットの4ビット前に送信されたビットから現在のビットまでの各ビットが、図4の下側に示すように「0,1,0,1,1」であれば、筐体42の内部における無線通信により現在のビットの波形に生じる歪は、定常的に、図4の右上に示すようなものとなる。   That is, for example, if each bit from the bit transmitted 4 bits before the current bit to the current bit is “0,1,0,1,1” as shown in the lower side of FIG. The distortion generated in the waveform of the current bit by wireless communication inside the housing 42 is constantly as shown in the upper right of FIG.

従って、例えば、現在のビットの前に送信された複数のビットが、マルチパスを介して遅延して伝送される影響により、定常的な歪が生じた現在のビットの波形の特性(以下、適宜、遅延プロファイルという)が、機能ブロック46に予め記憶されていれば、機能ブロック46は、遅延プロファイルと、信号ルータ45から送信されてきた信号の現在のビットの波形とに基づいて、信号ルータ45から送信されてきた信号のビットを正確に決定することができる。   Therefore, for example, the characteristics of the waveform of the current bit in which steady distortion has occurred due to the influence that a plurality of bits transmitted before the current bit are delayed and transmitted through multipath (hereinafter referred to as appropriate) (The delay profile) is stored in advance in the function block 46, the function block 46 determines whether the signal router 45 is based on the delay profile and the waveform of the current bit of the signal transmitted from the signal router 45. The bit of the signal transmitted from can be determined accurately.

このような遅延プロファイルは、例えば、信号処理装置31において、画像の信号の送受信を無線通信により行う前に、信号ルータ45と機能ブロック46とが、予め所定の値が設定された複数のビットの組み合わせからなる信号(以下、適宜、テストパターン信号という)を、複数回、送受信することで、取得することができる。   Such a delay profile is obtained by, for example, the signal router 45 and the function block 46 having a plurality of bits with predetermined values set in advance before the signal processing device 31 transmits and receives an image signal by wireless communication. A signal composed of a combination (hereinafter, appropriately referred to as a test pattern signal) can be acquired by transmitting and receiving a plurality of times.

ここで、例えば、テストパターン信号が、7ビットの信号である場合には、各ビットが「0」または「1」であるときの128(2の7乗)通りの信号を、テストパターン信号(例えば、後述する図14のテストパターン信号)として用いてもよいが、例えば、いずれか1つのビットが「1」である7通りの信号を、テストパターン信号として用いるだけでもよい。   Here, for example, when the test pattern signal is a 7-bit signal, 128 (2 to the 7th power) signals when each bit is “0” or “1” are used as the test pattern signal ( For example, although it may be used as a test pattern signal in FIG. 14 described later, for example, seven kinds of signals in which any one bit is “1” may be used as the test pattern signal.

即ち、具体的には、テストパターン信号が、7ビットの信号である場合には、「0,0,0,0,0,0,1」、「0,0,0,0,0,1,0」、「0,0,0,0,1,0,0」、「0,0,0,1,0,0,0」、「0,0,1,0,0,0,0」、「0,1,0,0,0,0,0」、「1,0,0,0,0,0,0,0」の7通りの信号をテストパターン信号として用いることができる。そして、後述するように、このような7つのテストパターン信号を用いて取得された7つの遅延プロファイルと、現在のビットの前に送信された複数のビットとの演算(例えば、後述する式(1)の演算)により、現在のビットの波形に生じると予測される歪が除去され、歪が除去された波形に基づいて、現在のビットが「1」または「0」のうちのいずれであるかが判定される。   Specifically, when the test pattern signal is a 7-bit signal, “0,0,0,0,0,0,1”, “0,0,0,0,0,1” , 0 "," 0,0,0,0,1,0,0 "," 0,0,0,1,0,0,0 "," 0,0,1,0,0,0,0 " , “0,1,0,0,0,0,0” and “1,0,0,0,0,0,0,0” can be used as test pattern signals. Then, as will be described later, the calculation of the seven delay profiles acquired by using such seven test pattern signals and a plurality of bits transmitted before the current bit (for example, Expression (1) described later) )), The distortion predicted to occur in the waveform of the current bit is removed, and whether the current bit is “1” or “0” based on the waveform from which the distortion has been removed. Is determined.

次に、図5は、図3の信号ルータ45および機能ブロック46の構成例を示すブロック図である。図5には、信号ルータ45が、機能ブロック46にテストパターン信号を送信し、機能ブロック46が、遅延プロファイルを取得する処理に必要なブロックが示されている。   Next, FIG. 5 is a block diagram showing a configuration example of the signal router 45 and the functional block 46 of FIG. FIG. 5 shows blocks necessary for processing in which the signal router 45 transmits a test pattern signal to the function block 46 and the function block 46 obtains a delay profile.

図5において、信号ルータ45は、アンテナ45a、送信側制御部61、テストパターン生成部62、および無線送信部63から構成され、機能ブロック46は、アンテナ46a、受信側制御部71、テストパターン生成部72、無線受信部73、統計処理部74、および遅延プロファイル蓄積部75から構成される。   In FIG. 5, the signal router 45 includes an antenna 45a, a transmission side control unit 61, a test pattern generation unit 62, and a wireless transmission unit 63. The functional block 46 includes an antenna 46a, a reception side control unit 71, and a test pattern generation. Unit 72, wireless reception unit 73, statistical processing unit 74, and delay profile storage unit 75.

送信側制御部61は、テストパターン生成部62を制御し、テストパターン信号を生成させ、無線送信部63を制御し、テストパターン生成部62により生成されたテストパターン信号を機能ブロック46に送信させる。例えば、テストパターン信号が、7ビットの信号である場合には、送信側制御部61は、上述したような7つのテストパターン信号をテストパターン生成部62に生成させる。   The transmission-side control unit 61 controls the test pattern generation unit 62 to generate a test pattern signal, controls the wireless transmission unit 63, and transmits the test pattern signal generated by the test pattern generation unit 62 to the functional block 46. . For example, when the test pattern signal is a 7-bit signal, the transmission-side control unit 61 causes the test pattern generation unit 62 to generate the seven test pattern signals as described above.

なお、送信側制御部61には、テストパターン信号のビットが取る値の組み合わせや、それらのテストパターン信号を送信する順番、同一のテストパターン信号を繰り返して送信させる所定の回数などが、予め設定されている。   The transmission-side control unit 61 sets in advance a combination of values taken by the bits of the test pattern signal, the order in which the test pattern signals are transmitted, a predetermined number of times to repeatedly transmit the same test pattern signal, and the like. Has been.

また、送信側制御部61は、テストパターン信号の送信を開始する前に、どのようなビットの組み合わせからなるテストパターン信号を送信して遅延プロファイルを取得するかなどを指定し、遅延プロファイルを取得する処理の開始を指示する制御信号(コマンド)を無線送信部63に供給し、この制御信号を機能ブロック46に送信させる。   In addition, the transmission side control unit 61 specifies what bit combination is used to acquire a delay profile by transmitting a test pattern signal before starting transmission of the test pattern signal, and acquires the delay profile. A control signal (command) instructing the start of processing to be performed is supplied to the wireless transmission unit 63, and this control signal is transmitted to the functional block 46.

ここで、例えば、画像の信号のように、高速で伝送される信号の送受信が行われる場合には、1ビットあたりの時間的な長さが短くなり、マルチパスの影響により信号に生じる歪の影響が大きく、信号が表すビットの判定に与える影響も大きくなる。これに対し、例えば、処理の開始を指示する制御信号のように、ある程度の低速で伝送される信号の送受信が行われる場合には、1ビットあたりの時間的な長さを短くする必要がなく、1ビットあたりの時間的な長さを長くすることができる。これにより、この場合には、マルチパスの影響により信号に生じる歪の影響は小さく、信号が表すビットの判定に与える影響も小さくなる。従って、送信側制御部61が無線通信により制御信号を送信しても、歪の影響は小さく、機能ブロック46は、制御信号を正常に受信することができる。   Here, for example, when transmitting and receiving a signal transmitted at high speed, such as an image signal, the time length per bit is shortened, and distortion caused in the signal due to the influence of multipath is reduced. The influence is large, and the influence on the determination of the bit represented by the signal is also large. On the other hand, for example, when a signal transmitted at a certain low speed is transmitted / received, such as a control signal instructing the start of processing, it is not necessary to shorten the time length per bit. The time length per bit can be increased. Thereby, in this case, the influence of distortion generated on the signal due to the influence of multipath is small, and the influence on the determination of the bit represented by the signal is also small. Therefore, even if the transmission-side control unit 61 transmits a control signal by wireless communication, the influence of distortion is small, and the functional block 46 can receive the control signal normally.

なお、例えば、送信側制御部61と受信側制御部71とが図示しない制御バスで接続されていて、その制御バスを介して、送信側制御部61が制御信号を受信側制御部71に送信してもよい。   For example, the transmission side control unit 61 and the reception side control unit 71 are connected by a control bus (not shown), and the transmission side control unit 61 transmits a control signal to the reception side control unit 71 via the control bus. May be.

テストパターン生成部62は、送信側制御部61の制御に応じて、テストパターン信号を生成し、無線送信部63に供給する。   The test pattern generation unit 62 generates a test pattern signal under the control of the transmission side control unit 61 and supplies the test pattern signal to the wireless transmission unit 63.

無線送信部63は、送信側制御部61から供給された制御信号、またはテストパターン生成部62から供給されたテストパターン信号を、アンテナ45aを介して、機能ブロック46に送信する。   The wireless transmission unit 63 transmits the control signal supplied from the transmission side control unit 61 or the test pattern signal supplied from the test pattern generation unit 62 to the functional block 46 via the antenna 45a.

受信側制御部71には、送信側制御部61と同様に、テストパターン信号のビットが取る値の組み合わせや、それらのテストパターン信号を送信する順番、同一のテストパターン信号を繰り返して送信させる所定の回数などが、予め設定されている。そして、受信側制御部71は、信号ルータ45から送信されてきた遅延プロファイルを取得する処理の開始を指示する制御信号が、無線受信部73から供給されると、その制御信号で指定されたテストパターン信号を生成するように、上述の設定に従って、テストパターン生成部72を制御し、テストパターン信号を生成させる。   Similar to the transmission side control unit 61, the reception side control unit 71 is configured to repeatedly transmit the same combination of values taken by the bits of the test pattern signal, the order in which those test pattern signals are transmitted, and the same test pattern signal. The number of times is set in advance. When the control signal instructing the start of the process of acquiring the delay profile transmitted from the signal router 45 is supplied from the wireless receiving unit 73, the receiving side control unit 71 receives the test specified by the control signal. In order to generate a pattern signal, the test pattern generation unit 72 is controlled according to the above-described setting to generate a test pattern signal.

テストパターン生成部72は、受信側制御部71の制御に応じて、テストパターン信号を生成し、統計処理部74に供給する。   The test pattern generation unit 72 generates a test pattern signal under the control of the reception side control unit 71 and supplies the test pattern signal to the statistical processing unit 74.

無線受信部73は、アンテナ46aを介して、信号ルータ45から送信されてくる制御信号またはテストパターン信号を受信する。無線受信部73は、信号ルータ45から送信されてきた制御信号を受信側制御部71に供給する。また、無線受信部73は、信号ルータ45から送信されてきたテストパターン信号から、現在のビットの信号値を取り出して、統計処理部74に供給する。   The wireless reception unit 73 receives a control signal or a test pattern signal transmitted from the signal router 45 via the antenna 46a. The wireless reception unit 73 supplies the control signal transmitted from the signal router 45 to the reception side control unit 71. Further, the wireless reception unit 73 extracts the signal value of the current bit from the test pattern signal transmitted from the signal router 45 and supplies the signal value to the statistical processing unit 74.

統計処理部74には、無線受信部73から、信号ルータ45から送信されてくるテストパターン信号の現在のビットの信号値が供給され、統計処理部74は、現在のビットの信号値に基づいて、遅延プロファイルを取得する。   The statistical processing unit 74 is supplied with the signal value of the current bit of the test pattern signal transmitted from the signal router 45 from the wireless reception unit 73, and the statistical processing unit 74 is based on the signal value of the current bit. Get the delay profile.

即ち、例えば、過去に遅延プロファイルを取得する処理が行われ、遅延プロファイル蓄積部75に、既に取得された遅延プロファイルが蓄積されていれば、統計処理部74は、テストパターン生成部72から供給されたテストパターン信号に対応する遅延プロファイルを遅延プロファイル蓄積部75から読み出す。そして、統計処理部74は、無線受信部73から供給された現在のビットの信号値と、遅延プロファイル蓄積部75から読み出した遅延プロファイルとに対して統計的な処理を行い、例えば、現在のビットの信号値と遅延プロファイルとの平均値を演算する処理を行い、その演算の結果得られた値を、新たな遅延プロファイルとして取得する。   That is, for example, if a delay profile acquisition process has been performed in the past and the delay profile storage unit 75 has already acquired the delay profile, the statistical processing unit 74 is supplied from the test pattern generation unit 72. The delay profile corresponding to the test pattern signal is read from the delay profile storage unit 75. The statistical processing unit 74 performs statistical processing on the signal value of the current bit supplied from the wireless reception unit 73 and the delay profile read from the delay profile storage unit 75, for example, the current bit The average value of the signal value and the delay profile is calculated, and the value obtained as a result of the calculation is acquired as a new delay profile.

また、統計処理部74は、遅延プロファイル蓄積部75に、既に取得された遅延プロファイルが蓄積されていなければ、無線受信部73から供給された現在のビットの信号値を、遅延プロファイルとして取得する。   If the delay profile accumulation unit 75 does not accumulate the acquired delay profile, the statistical processing unit 74 acquires the signal value of the current bit supplied from the wireless reception unit 73 as the delay profile.

そして、統計処理部74は、自身が取得した遅延プロファイルと、テストパターン生成部72から供給されたテストパターン信号とを対応付けて、統計処理部74に供給する。   Then, the statistical processing unit 74 associates the delay profile acquired by the statistical processing unit 74 with the test pattern signal supplied from the test pattern generation unit 72 and supplies the correlated result to the statistical processing unit 74.

なお、送信側制御部61がテストパターン生成部62に生成させるテストパターン信号と、受信側制御部71がテストパターン生成部72に生成させるテストパターン信号とは、同一の設定に従って生成されるので、統計処理部74が遅延プロファイルの取得に用いたテストパターン信号のビットが取る値と、テストパターン生成部72から統計処理部74に供給されたテストパターン信号のビットが取る値とは、同一である。   Note that the test pattern signal generated by the transmission side control unit 61 in the test pattern generation unit 62 and the test pattern signal generated by the reception side control unit 71 in the test pattern generation unit 72 are generated according to the same setting. The value taken by the bit of the test pattern signal used by the statistical processing unit 74 to acquire the delay profile is the same as the value taken by the bit of the test pattern signal supplied from the test pattern generation unit 72 to the statistical processing unit 74. .

そして、統計処理部74は、信号ルータ45から送信されてくる全てのテストパターン信号に対して、上述の処理と同様の処理を行い、全てのテストパターン信号に応じた遅延プロファイルを取得する。   Then, the statistical processing unit 74 performs the same process as described above on all test pattern signals transmitted from the signal router 45, and acquires delay profiles corresponding to all the test pattern signals.

このようにして、統計処理部74は、テストパターン信号が筐体42の内部における無線通信により伝送されたときに、現在のビットの前のビットがマルチパスを介して遅延して伝送される影響により生じる、テストパターン信号の現在のビットの波形の歪の特性、即ち、遅延プロファイルを取得する。   In this way, the statistical processing unit 74 has an effect that when the test pattern signal is transmitted by wireless communication inside the housing 42, the bit before the current bit is transmitted with a delay through the multipath. The characteristic of the distortion of the waveform of the current bit of the test pattern signal, that is, the delay profile is obtained.

遅延プロファイル蓄積部75は、統計処理部74から供給された遅延プロファイルとテストパターン信号とを対応付けて蓄積(記憶)する。   The delay profile storage unit 75 stores (stores) the delay profile supplied from the statistical processing unit 74 in association with the test pattern signal.

次に、図6は、図5の信号ルータ45がテストパターン信号を送信し、機能ブロック46が遅延プロファイルを取得する処理を説明するフローチャートである。   Next, FIG. 6 is a flowchart for explaining processing in which the signal router 45 of FIG. 5 transmits a test pattern signal and the functional block 46 acquires a delay profile.

例えば、図3の信号処理装置31の初期化時に、遅延プロファイルを取得する処理を行うように、信号処理装置31が設定されているとする。   For example, it is assumed that the signal processing device 31 is set so as to perform processing for obtaining a delay profile when the signal processing device 31 in FIG. 3 is initialized.

ユーザが、信号処理装置31に基板などを追加し、初期化を行うように信号処理装置31を操作した後に、信号処理装置31が再起動すると処理が開始され、ステップS11において、信号ルータ45の送信側制御部61は、遅延プロファイルを取得する処理の開始を指示する制御信号(コマンド)を無線送信部63に供給し、無線送信部63は、その制御信号を機能ブロック46に送信する。   After the user adds a board or the like to the signal processing device 31 and operates the signal processing device 31 to perform initialization, the processing is started when the signal processing device 31 is restarted. In step S11, the signal router 45 The transmission-side control unit 61 supplies a control signal (command) instructing the start of processing for acquiring a delay profile to the wireless transmission unit 63, and the wireless transmission unit 63 transmits the control signal to the functional block 46.

ステップS11の処理後、処理はステップS12に進み、送信側制御部61は、テストパターン生成部62を制御し、例えば、1番目に送信するように設定されているテストパターン信号を生成させる。テストパターン生成部62は、送信側制御部61の制御に従い、テストパターン信号を生成して無線送信部63に供給し、処理はステップS13に進む。   After the process of step S11, the process proceeds to step S12, and the transmission side control unit 61 controls the test pattern generation unit 62 to generate, for example, a test pattern signal that is set to be transmitted first. The test pattern generation unit 62 generates a test pattern signal according to the control of the transmission side control unit 61 and supplies the test pattern signal to the wireless transmission unit 63, and the process proceeds to step S13.

ステップS13において、無線送信部63は、ステップS12でテストパターン生成部62から供給されたテストパターン信号を機能ブロック46に送信し、処理はステップS14に進む。   In step S13, the wireless transmission unit 63 transmits the test pattern signal supplied from the test pattern generation unit 62 in step S12 to the functional block 46, and the process proceeds to step S14.

ステップS14において、送信側制御部61は、機能ブロック46に送信すべき全てのテストパターン信号が無線送信部63により送信されたか否かを判定する。即ち、例えば、テストパターン信号が7ビットの信号である場合、送信側制御部61は、例えば、テストパターン信号が、7ビットの信号である場合、送信側制御部61は、上述したような7つのテストパターン信号が機能ブロック46に送信されたか否かを判定する。   In step S <b> 14, the transmission-side control unit 61 determines whether all the test pattern signals to be transmitted to the functional block 46 have been transmitted by the wireless transmission unit 63. That is, for example, when the test pattern signal is a 7-bit signal, the transmission-side control unit 61, for example, when the test pattern signal is a 7-bit signal, the transmission-side control unit 61 It is determined whether two test pattern signals have been transmitted to the functional block 46.

ステップS14において、送信側制御部61が、機能ブロック46に送信すべき全てのテストパターン信号が無線送信部63により送信されていないと判定した場合、ステップS12に戻り、送信側制御部61は、直前のステップS13で無線送信部63により送信されたテストパターン信号の次に送信すべきテストパターン信号をテストパターン生成部62に生成させ、以下、同様の処理が繰り返される。   In step S14, when the transmission side control unit 61 determines that all the test pattern signals to be transmitted to the functional block 46 are not transmitted by the wireless transmission unit 63, the process returns to step S12, and the transmission side control unit 61 The test pattern generation unit 62 generates a test pattern signal to be transmitted next to the test pattern signal transmitted by the wireless transmission unit 63 in the immediately preceding step S13, and thereafter the same processing is repeated.

一方、ステップS14において、送信側制御部61が、機能ブロック46に送信すべき全てのテストパターン信号が無線送信部63により送信されたと判定した場合、信号ルータ45での処理は終了する。   On the other hand, when the transmission side control unit 61 determines in step S14 that all the test pattern signals to be transmitted to the functional block 46 have been transmitted by the wireless transmission unit 63, the processing in the signal router 45 ends.

一方、機能ブロック46は、遅延プロファイルを取得する処理の開始を指示する制御信号が、信号ルータ45から送信されてくるまで処理を待機しており、上述のステップS11で、信号ルータ45が、遅延プロファイルを取得する処理の開始を指示する制御信号を送信すると、ステップS21において、無線受信部73は、その制御信号を受信して受信側制御部71に供給する。   On the other hand, the functional block 46 waits for processing until a control signal instructing the start of processing for acquiring a delay profile is transmitted from the signal router 45. In step S11, the signal router 45 When the control signal instructing the start of the process of acquiring the profile is transmitted, the wireless reception unit 73 receives the control signal and supplies it to the reception-side control unit 71 in step S21.

ステップS21の処理後、処理はステップS22に進み、受信側制御部71は、テストパターン生成部72を制御し、例えば、信号ルータ45から1番目に送信されてくることが設定されているテストパターン信号を生成させる。テストパターン生成部72は、送信側制御部71の制御に従い、テストパターン信号を生成して統計処理部74に供給し、処理はステップS23に進む。   After the process of step S21, the process proceeds to step S22, and the reception-side control unit 71 controls the test pattern generation unit 72, for example, the test pattern that is set to be transmitted first from the signal router 45 Generate a signal. The test pattern generation unit 72 generates a test pattern signal according to the control of the transmission side control unit 71 and supplies the test pattern signal to the statistical processing unit 74, and the process proceeds to step S23.

ステップS23において、無線受信部73は、信号ルータ45からテストパターン信号が送信されてくるまで待機し、上述のステップS13で信号ルータ45がテストパターン信号を送信すると、そのテストパターン信号を受信する。そして、無線受信部73は、信号ルータ45から送信されてきたテストパターン信号から、現在のビットの信号値を取り出して、統計処理部74に供給し、処理はステップS24に進む。   In step S23, the wireless reception unit 73 stands by until a test pattern signal is transmitted from the signal router 45. When the signal router 45 transmits a test pattern signal in step S13 described above, the wireless reception unit 73 receives the test pattern signal. Then, the wireless reception unit 73 extracts the signal value of the current bit from the test pattern signal transmitted from the signal router 45, supplies the signal value to the statistical processing unit 74, and the process proceeds to step S24.

ステップS24において、統計処理部74は、既に取得され遅延プロファイル蓄積部75に蓄積されている遅延プロファイルであって、ステップS22でテストパターン生成部72から供給されたテストパターン信号に対応付けられている遅延プロファイルを、遅延プロファイル蓄積部75から読み出し、処理はステップS25に進む。なお、遅延プロファイル蓄積部75に遅延プロファイルが蓄積されていない場合、ステップS24をスキップして処理はステップS25に進む。   In step S24, the statistical processing unit 74 is a delay profile already acquired and stored in the delay profile storage unit 75, and is associated with the test pattern signal supplied from the test pattern generation unit 72 in step S22. The delay profile is read from the delay profile accumulation unit 75, and the process proceeds to step S25. If no delay profile is stored in the delay profile storage unit 75, the process skips step S24 and proceeds to step S25.

ステップS25において、統計処理部74は、ステップS23で無線受信部73から供給された現在のビットの信号値と、ステップS24で遅延プロファイル蓄積部75から読み出した遅延プロファイルとに対して統計的な処理を施し、例えば、現在のビットの信号値と遅延プロファイルとの平均値を算出し、その結果得られた値を、遅延プロファイルとして新たに取得する。なお、ステップS24をスキップして処理がステップS25に進んだ場合、統計処理部74は、ステップS23で無線受信部73から供給された現在のビットの信号値を、遅延プロファイルとして取得する。   In step S25, the statistical processing unit 74 performs statistical processing on the signal value of the current bit supplied from the wireless reception unit 73 in step S23 and the delay profile read from the delay profile storage unit 75 in step S24. For example, the average value of the signal value of the current bit and the delay profile is calculated, and the value obtained as a result is newly acquired as a delay profile. If step S24 is skipped and the process proceeds to step S25, the statistical processing unit 74 acquires the signal value of the current bit supplied from the wireless reception unit 73 in step S23 as a delay profile.

ステップS25の処理後、処理はステップS26に進み、統計処理部74は、ステップS25で取得した遅延プロファイルを新たに遅延プロファイル蓄積部75に蓄積し、処理はステップS27に進む。   After the process of step S25, the process proceeds to step S26. The statistical processing unit 74 newly accumulates the delay profile acquired in step S25 in the delay profile accumulation unit 75, and the process proceeds to step S27.

ステップS27において、受信側制御部71は、全てのパターンのテストパターン信号が信号ルータ45から送信されてきたか否かを判定する。   In step S <b> 27, the reception side control unit 71 determines whether or not test pattern signals of all patterns have been transmitted from the signal router 45.

ステップS27において、受信側制御部71が、全てのパターンのテストパターン信号が信号ルータ45から送信されてきていないと判定した場合、ステップS22に戻り、受信側制御部71は、直前のステップS23で無線受信部73が受信したテストパターン信号の次に信号ルータ45から送信されてくることが設定されているテストパターン信号をテストパターン生成部72に生成させ、以下、同様の処理が繰り返される。   In step S27, when the receiving side control unit 71 determines that the test pattern signals of all patterns have not been transmitted from the signal router 45, the process returns to step S22, and the receiving side control unit 71 returns to step S23 immediately before. The test pattern generation unit 72 generates a test pattern signal set to be transmitted from the signal router 45 next to the test pattern signal received by the wireless reception unit 73. Thereafter, the same processing is repeated.

一方、ステップS27において、受信側制御部71が、全てのパターンのテストパターン信号が信号ルータ45から送信されてきたと判定した場合、処理は終了する。   On the other hand, when the reception side control unit 71 determines in step S27 that the test pattern signals of all patterns have been transmitted from the signal router 45, the process ends.

以上のように、信号ルータ45は、テストパターン信号を送信し、機能ブロック46は、信号ルータ45から送信されてくるテストパターン信号に応じた遅延プロファイルを取得することができる。また、遅延プロファイルは、筐体42の内部における無線通信の定常性を利用したものであるので、機能ブロック46は、初期化時などに遅延プロファイルを取得する処理を行うだけで、高品質でロバストな値を取得することができる。   As described above, the signal router 45 transmits a test pattern signal, and the functional block 46 can acquire a delay profile corresponding to the test pattern signal transmitted from the signal router 45. In addition, since the delay profile uses the continuity of wireless communication inside the housing 42, the functional block 46 can perform high-quality and robust processing only by acquiring the delay profile at the time of initialization or the like. Value can be obtained.

次に、図7は、図5の機能ブロック46により取得される遅延プロファイルの例を示す図である。   Next, FIG. 7 is a diagram illustrating an example of a delay profile acquired by the function block 46 of FIG.

図7の横軸は、遅延プロファイルの位相を表し、図7の縦軸は、遅延プロファイルの信号値を表す。図7には、7ビットのテストパターン信号に基づいて取得された遅延プロファイルL1乃至L7が示されている。また、遅延プロファイルL1乃至L7は、テストパターン信号の現在のビットの信号値を、13点のサンプリングポイントでサンプリングすることにより、取得されたものである。   The horizontal axis in FIG. 7 represents the phase of the delay profile, and the vertical axis in FIG. 7 represents the signal value of the delay profile. FIG. 7 shows delay profiles L1 to L7 acquired based on a 7-bit test pattern signal. The delay profiles L1 to L7 are acquired by sampling the signal value of the current bit of the test pattern signal at 13 sampling points.

即ち、テストパターン信号のビットを、「6ビット前、5ビット前、4ビット前、3ビット前、2ビット前、1ビット前、現在のビット」と表すとすると、図7には、テストパターン信号「1,0,0,0,0,0,0」に基づいて取得された遅延プロファイルL1、テストパターン信号「0,1,0,0,0,0,0」に基づいて取得された遅延プロファイルL2、テストパターン信号「0,0,1,0,0,0,0」に基づいて取得された遅延プロファイルL3、テストパターン信号「0,0,0,1,0,0,0」に基づいて取得された遅延プロファイルL4、テストパターン信号「0,0,0,0,1,0,0」に基づいて取得された遅延プロファイルL5、テストパターン信号「0,0,0,0,0,1,0」に基づいて取得された遅延プロファイルL6、テストパターン信号「0,0,0,0,0,0,1」に基づいて取得された遅延プロファイルL7が示されている。   That is, if the bits of the test pattern signal are expressed as “6 bits before, 5 bits before, 4 bits before, 3 bits before, 2 bits before, 1 bit before, current bits”, FIG. Delay profile L1 acquired based on signal “1,0,0,0,0,0,0”, acquired based on test pattern signal “0,1,0,0,0,0,0” Delay profile L2, delay pattern L3 acquired based on test pattern signal “0,0,1,0,0,0,0”, test pattern signal “0,0,0,1,0,0,0” The delay profile L4 acquired based on the test pattern signal “0,0,0,0,1,0,0”, the delay profile L5 acquired based on the test pattern signal “0,0,0,0, The delay profile L6 acquired based on “0,1,0” and the delay profile L7 acquired based on the test pattern signal “0,0,0,0,0,0,1” are shown. Yes.

機能ブロック46は、このような遅延プロファイルを用い、信号ルータ45から送信されて、機能ブロック46が受信した信号(以下、適宜、受信信号という)のビットを決定する。   The function block 46 uses such a delay profile to determine bits of a signal (hereinafter, appropriately referred to as a received signal) transmitted from the signal router 45 and received by the function block 46.

即ち、機能ブロック46は、遅延プロファイルの信号値と、現在のビットの前に送信されたビットの値とに基づいて、現在のビットの前に送信されたビットの値に応じて、現在のビットの波形に生じる歪を予測する。そして、機能ブロック46は、現在のビットの波形に生じると予測した歪(以下、適宜、予測歪という)を、受信信号の現在のビットの波形から分離し、その結果得られる波形(以下、適宜、分離波形という)に基づいて、受信信号の現在のビットを決定する。   That is, the function block 46 determines the current bit according to the value of the bit transmitted before the current bit based on the signal value of the delay profile and the value of the bit transmitted before the current bit. Predict the distortion that occurs in the waveform. Then, the functional block 46 separates the distortion predicted to occur in the current bit waveform (hereinafter referred to as “predictive distortion”) from the current bit waveform of the received signal, and the resulting waveform (hereinafter referred to as “appropriate distortion” as appropriate). The current bit of the received signal is determined based on the separated waveform).

例えば、現在のビットのnビット前から1ビット前までに送信されたビットの値により、現在のビットに生じると予測される予測歪の位相kでの信号値yk’は、現在のビットのnビット前に送信されたビットをxnとし、現在のビットのnビット前に送信されたビットが「1」であるテストパターン信号に基づいて求められた遅延プロファイルの位相kでの信号値をan,kとすると、次の式(1)を演算することにより求められる。 For example, the signal value y k ′ at the phase k of the predicted distortion predicted to occur in the current bit due to the value of the bit transmitted n bits before and 1 bit before the current bit is The signal value at the phase k of the delay profile obtained based on the test pattern signal in which the bit transmitted n bits before is x n and the bit transmitted n bits before the current bit is “1”. If it is an, k , it calculates | requires by calculating the following formula | equation (1).

Figure 0004858162
・・・(1)
Figure 0004858162
... (1)

また、予測歪の位相0乃至k(例えば、図7の例では、位相0乃至12)での信号値y0’乃至yk’は、次式で表される。 Further, signal values y 0 ′ to y k ′ at phases 0 to k of the predicted distortion (for example, phases 0 to 12 in the example of FIG. 7) are expressed by the following equations.

Figure 0004858162
・・・(2)
Figure 0004858162
... (2)

ここで、現在のビットのnビット前に送信されたビットが「1」であるとき、ビットxn=+1であり、一方、現在のビットのnビット前に送信されたビットが「0」であるとき、ビットxn=−1である。また、式(2)における遅延プロファイルの位相kでの信号値をan,kからなる行列を、例えば、受信振幅値予測係数という。 Here, when the bit transmitted n bits before the current bit is “1”, the bit x n = + 1, while the bit transmitted n bits before the current bit is “0”. At some point, bit x n = -1. In addition, a matrix composed of an n, k for the signal value at the phase k of the delay profile in Equation (2) is referred to as a reception amplitude value prediction coefficient, for example.

そして、受信信号の現在のビットの波形から予測歪を分離した分離波形の位相kでの信号値Skは、受信信号の現在のビットの位相kでの信号値ykから、予測歪の位相kでの信号値yk’を減算することにより求められる。即ち、分離波形の信号値Skは、式(3)で表される。 Then, the signal value S k at the phase k of the separated waveform obtained by separating the predicted distortion from the current bit waveform of the received signal is the phase of the predicted distortion from the signal value y k at the current bit phase k of the received signal. It is obtained by subtracting the signal value y k ′ at k . That is, the signal value S k of the separated waveform is expressed by Expression (3).

Figure 0004858162
・・・(3)
Figure 0004858162
... (3)

ここで、受信信号の現在のビットの波形は、現在のビットの値に応じた波形に、現在のビットの前に送信されたビットの影響により歪が生じた波形となっているので、受信信号の現在のビットの波形から予測歪を分離することにより、分離波形は、現在のビットの値に応じた形状となる。   Here, the waveform of the current bit of the received signal is a waveform that is distorted due to the influence of the bit transmitted before the current bit in the waveform according to the value of the current bit. By separating the predicted distortion from the current bit waveform, the separated waveform has a shape corresponding to the current bit value.

即ち、分離波形の信号値Skは、受信信号の現在のビットが「1」である場合には、現在のビットが「1」であるテストパターン信号に基づいて求められた遅延プロファイルの位相kでの信号値a0,kとほぼ同じ値となる。また、受信信号の現在のビットが「0」である場合には、現在のビットが「0」であるテストパターン信号に基づいて求められた遅延プロファイルの位相kでの信号値a0,kとほぼ同じ値となる。なお、受信信号は、伝播経路中の熱雑音などの雑音の影響を受けるため、分離波形の信号値Skは、信号値a0,kと同一とはならない。 That is, when the current bit of the received signal is “1”, the signal value S k of the separated waveform is the phase k of the delay profile obtained based on the test pattern signal whose current bit is “1”. Is substantially the same as the signal value a 0, k at. Further, when the current bit of the received signal is “0”, the signal value a 0, k at the phase k of the delay profile obtained based on the test pattern signal whose current bit is “0” Almost the same value. Since the received signal is affected by noise such as thermal noise in the propagation path, the signal value S k of the separated waveform is not the same as the signal value a 0, k .

従って、受信信号の現在のビットが「1」である場合には、現在のビットが「1」であるテストパターン信号に基づいて求められた遅延プロファイルの位相kでの信号値a0,kを、分離波形の信号値Skから減算すると、その演算により得られる値(以下、適宜、比較値B1という)は、ほぼ0となる。比較値B1は、次の式(4)により表される。 Therefore, when the current bit of the received signal is “1”, the signal value a 0, k at the phase k of the delay profile obtained based on the test pattern signal whose current bit is “1” is obtained. When the signal is subtracted from the signal value S k of the separated waveform, the value obtained by the calculation (hereinafter referred to as the comparison value B 1 as appropriate) becomes almost zero. The comparison value B 1 is expressed by the following equation (4).

Figure 0004858162
・・・(4)
Figure 0004858162
... (4)

また、現在のビットが「0」であるテストパターン信号に基づいて求められた遅延プロファイルは、現在のビットが「1」であるテストパターン信号に基づいて求められた遅延プロファイルを反転させることにより得られる。従って、現在のビットが「0」であるテストパターン信号に基づいて求められた遅延プロファイルの位相kでの信号値a0,kを、分離波形の信号値Skから減算することにより得られる値(以下、適宜、比較値B0という)は、現在のビットが「1」であるテストパターン信号に基づいて求められた遅延プロファイルの位相kでの信号値a0,kを、分離波形の信号値Skに加算することにより求めることができる。そして、受信信号の現在のビットが「0」である場合には、比較値B0は、ほぼ0となる。比較値B0は、次の式(5)により表される。 The delay profile obtained based on the test pattern signal whose current bit is “0” is obtained by inverting the delay profile obtained based on the test pattern signal whose current bit is “1”. It is done. Therefore, a value obtained by subtracting the signal value a 0, k at the phase k of the delay profile obtained based on the test pattern signal whose current bit is “0” from the signal value S k of the separated waveform. (Hereinafter, referred to as a comparison value B 0 as appropriate) is a signal having a separated waveform obtained from the signal value a 0, k at the phase k of the delay profile obtained based on the test pattern signal whose current bit is “1”. It can be obtained by adding to the value S k . When the current bit of the received signal is “0”, the comparison value B 0 is almost zero. The comparison value B 0 is expressed by the following equation (5).

Figure 0004858162
・・・(5)
Figure 0004858162
... (5)

従って、機能ブロック46は、比較値B1および比較値B0を算出し、比較値B1と比較値B0とを比較して、その結果、比較値B0よりも比較値B1が0に近ければ、現在のビットは「1」であると決定し、一方、比較値B1よりも比較値B0が0に近ければ、現在のビットは「0」であると決定することができる。 Thus, the functional block 46 calculates a comparison value B 1 and comparison value B 0, by comparing the comparison value B 0 with the comparison value B 1, as a result, the comparison value B 1 than the comparison value B 0 0 If the comparison value B 0 is closer to 0 than the comparison value B 1 , the current bit can be determined to be “0”. .

次に、図8は、図3の機能ブロック46の構成例を示すブロック図である。図8では、機能ブロック46が、信号ルータ45から送信されてくる信号を受信し、その信号の現在のビットを決定する処理に必要なブロックが示されている。   Next, FIG. 8 is a block diagram showing a configuration example of the functional block 46 of FIG. FIG. 8 shows blocks necessary for processing in which the functional block 46 receives a signal transmitted from the signal router 45 and determines the current bit of the signal.

図8において、機能ブロック46は、アンテナ46a、受信部81、A/D(Digital/Analog)コンバータ82、クラスレジスタ83、波形分離部84、比較値算出部85および86、並びに比較部87から構成される。   In FIG. 8, the functional block 46 includes an antenna 46 a, a reception unit 81, an A / D (Digital / Analog) converter 82, a class register 83, a waveform separation unit 84, comparison value calculation units 85 and 86, and a comparison unit 87. Is done.

受信部81には、アンテナ46aが接続されており、アンテナ46aは、信号ルータ45から送信されてくるRF信号を受信し、受信部81に供給する。受信部81は、アンテナ46aから供給されたRF信号に、所定の周波数の信号を掛け合わせて、RF信号をベースバンド信号に変換する。そして、受信部81は、アンテナ46aが受信したRF信号をベースバンド信号に変換した信号、即ち、受信信号をA/Dコンバータ82に供給する。   An antenna 46 a is connected to the receiving unit 81, and the antenna 46 a receives an RF signal transmitted from the signal router 45 and supplies it to the receiving unit 81. The receiving unit 81 multiplies the RF signal supplied from the antenna 46a by a signal having a predetermined frequency, and converts the RF signal into a baseband signal. Then, the reception unit 81 supplies a signal obtained by converting the RF signal received by the antenna 46 a into a baseband signal, that is, a reception signal, to the A / D converter 82.

A/Dコンバータ82は、受信部81から供給された受信信号をA/D変換する。A/Dコンバータ82は、受信部81から供給された受信信号をA/D変換した結果得られた値を、受信信号の信号値として取得し、波形分離部84に供給する。ここで、A/Dコンバータ82は、受信信号の1つのビットの信号値を、ビットの周波数よりも高い周波数でサンプリング(オーバーサンプリング)して量子化を行い、即ち、複数のサンプリング点で信号値を取得し、受信信号を波形として取得する。   The A / D converter 82 A / D converts the received signal supplied from the receiving unit 81. The A / D converter 82 acquires a value obtained as a result of A / D conversion of the reception signal supplied from the reception unit 81 as a signal value of the reception signal, and supplies the signal value to the waveform separation unit 84. Here, the A / D converter 82 performs quantization by sampling (oversampling) the signal value of one bit of the received signal at a frequency higher than the bit frequency, that is, the signal value at a plurality of sampling points. And the received signal is acquired as a waveform.

クラスレジスタ83には、比較部87から出力されるビットの値が供給される。クラスレジスタ83は、現在のビットのnビット前から1ビット前までのビットの値を記憶し、適宜、波形分離部84に供給する。また、クラスレジスタ83は、比較値算出部85および86が比較値を算出するのに用いる現在のビットを記憶しており、比較値算出部85に、現在のビットとして「1」を供給し、比較値算出部86に、現在のビットとして「0」を供給する。   The bit value output from the comparison unit 87 is supplied to the class register 83. The class register 83 stores bit values from n bits before the current bit to 1 bit before, and supplies the values to the waveform separation unit 84 as appropriate. The class register 83 stores the current bit used by the comparison value calculation units 85 and 86 to calculate the comparison value, and supplies “1” as the current bit to the comparison value calculation unit 85. The comparison value calculation unit 86 is supplied with “0” as the current bit.

波形分離部84には、A/Dコンバータ82から、受信信号の現在のビットの信号値が供給されるとともに、クラスレジスタ83から、現在のビットのnビット前から1ビット前までのビットの値が供給される。また、波形分離部84は、図5の遅延プロファイル蓄積部75に蓄積されている遅延プロファイルを読み出す。   The waveform separation unit 84 is supplied with the signal value of the current bit of the received signal from the A / D converter 82, and from the class register 83 with the bit value from n bits before to 1 bit before the current bit. Is supplied. Further, the waveform separation unit 84 reads the delay profile stored in the delay profile storage unit 75 of FIG.

そして、波形分離部84は、遅延プロファイル蓄積部75から読み出した遅延プロファイルと、クラスレジスタ83から供給されたビットの値とを用いて、上述した式(1)を演算し、現在のビットのnビット前から1ビット前までに送信されたビットの値により現在のビットに生じると予測される予測歪を算出する。さらに、波形分離部84は、上述した式(3)を演算し、A/Dコンバータ82から供給された受信信号の現在のビットの信号値から予測歪の値を減算した値である分離波形の信号値を算出する。波形分離部84は、分離波形の信号値を、比較値算出部85および86に供給する。   Then, the waveform separation unit 84 uses the delay profile read from the delay profile accumulation unit 75 and the value of the bit supplied from the class register 83 to calculate the above-described equation (1), and the current bit n Predictive distortion that is predicted to occur in the current bit is calculated based on the value of the bit transmitted from the previous bit to the previous bit. Further, the waveform separation unit 84 calculates the above-described equation (3), and obtains a separated waveform that is a value obtained by subtracting the predicted distortion value from the current bit signal value of the received signal supplied from the A / D converter 82. Calculate the signal value. The waveform separator 84 supplies the signal value of the separated waveform to the comparison value calculators 85 and 86.

比較値算出部85には、クラスレジスタ83から現在のビット「1」が供給されるとともに、波形分離部84から分離波形の信号値が供給され、比較値算出部85は、波形分離部84から供給された分離波形の信号値から、現在のビットが「1」であるテストパターン信号に基づいて求められた遅延プロファイルの信号値を減算した値である比較値B1を算出し、比較部87に供給する。 The comparison value calculation unit 85 is supplied with the current bit “1” from the class register 83 and the signal value of the separated waveform from the waveform separation unit 84, and the comparison value calculation unit 85 is supplied from the waveform separation unit 84. A comparison value B 1 that is a value obtained by subtracting the signal value of the delay profile obtained based on the test pattern signal whose current bit is “1” from the signal value of the supplied separated waveform is calculated, and the comparison unit 87. To supply.

比較値算出部86には、クラスレジスタ83から現在のビット「0」が供給されるとともに、波形分離部84から分離波形の信号値が供給され、比較値算出部86は、分離波形の信号値から、現在のビットが「0」であるテストパターン信号に基づいて求められた遅延プロファイルの信号値を減算した値、即ち、分離波形の信号値に、現在のビットが「1」であるテストパターン信号に基づいて求められた遅延プロファイルの信号値を加算した値である比較値B0を算出し、比較部87に供給する。 The comparison value calculation unit 86 is supplied with the current bit “0” from the class register 83 and the signal value of the separation waveform from the waveform separation unit 84, and the comparison value calculation unit 86 receives the signal value of the separation waveform. From the value obtained by subtracting the signal value of the delay profile obtained based on the test pattern signal whose current bit is “0”, that is, the signal value of the separated waveform, the test pattern whose current bit is “1” A comparison value B 0 , which is a value obtained by adding the signal values of the delay profile obtained based on the signal, is calculated and supplied to the comparison unit 87.

比較部87は、比較値算出部85から供給された比較値B1と、比較値算出部86から供給された比較値B0とを比較し、その比較結果に基づいて、現在のビットを決定する。例えば、比較部87は、比較値B1の絶対値が比較値B0の絶対値よりも大である場合、現在のビットは「1」であると決定する。一方、比較部87は、比較値B0の絶対値が比較値B1の絶対値以下である場合、現在のビットは「0」であると決定する。そして、比較部87は、現在のビットの値として「1」または「0」を出力する。 The comparison unit 87 compares the comparison value B 1 supplied from the comparison value calculation unit 85 with the comparison value B 0 supplied from the comparison value calculation unit 86, and determines the current bit based on the comparison result. To do. For example, comparison unit 87, when the absolute value of the comparison value B 1 is is larger than the absolute value of the comparison value B 0, the current bit is determined to be "1". On the other hand, when the absolute value of the comparison value B 0 is equal to or less than the absolute value of the comparison value B 1 , the comparison unit 87 determines that the current bit is “0”. Then, the comparison unit 87 outputs “1” or “0” as the value of the current bit.

ここで、図9には、A/Dコンバータ82から出力される受信信号、波形分離部84から出力される分離波形、および比較値算出部85から出力される比較値が表す波形の例が示されている。   Here, FIG. 9 shows an example of a waveform represented by the received signal output from the A / D converter 82, the separated waveform output from the waveform separator 84, and the comparison value output from the comparison value calculator 85. Has been.

図9の上側には、現在のビットの2ビット前までのビットの値が「0」であり、現在のビットの1ビット前のビットの値が「1」であり、現在のビットの値が「1」である場合の受信信号が示されている。   In the upper side of FIG. 9, the value of the bit up to 2 bits before the current bit is “0”, the value of the bit 1 bit before the current bit is “1”, and the value of the current bit is The received signal in the case of “1” is shown.

図9の中央には、現在のビットの2ビット前までに送信されたビットの値「0」、および現在のビットの1ビット前に送信されたビットの値「1」により、現在のビットに生じると予測される予測歪を、受信波形から分離した分離波形が示されている。   In the middle of FIG. 9, the value “0” of the bit transmitted up to 2 bits before the current bit and the value “1” of the bit transmitted 1 bit before the current bit indicate the current bit. A separated waveform obtained by separating the predicted distortion that is predicted to occur from the received waveform is shown.

図9の下側には、現在のビットが「1」であるテストパターン信号に基づいて求められた遅延プロファイルを、分離波形から減算した比較値が表す波形が示されている。受信信号の現在のビットの値は「1」であるので、比較値は、ほぼ0となっている。   The lower side of FIG. 9 shows a waveform represented by a comparison value obtained by subtracting the delay profile obtained based on the test pattern signal whose current bit is “1” from the separated waveform. Since the value of the current bit of the received signal is “1”, the comparison value is almost zero.

次に、図10は、図8の波形分離部84の構成例を示すブロック図である。   Next, FIG. 10 is a block diagram illustrating a configuration example of the waveform separation unit 84 of FIG.

図10において、波形分離部84は、遅延プロファイル供給部91、n個の掛け算器921乃至92n、足し算器93、および引き算器94から構成される。 In FIG. 10, the waveform separation unit 84 includes a delay profile supply unit 91, n multipliers 92 1 to 92 n , an adder 93, and a subtractor 94.

遅延プロファイル供給部91は、図5の遅延プロファイル蓄積部75に蓄積されている遅延プロファイルの位相kでの信号値a1,k乃至an,kを読み出し、掛け算器921乃至92nにそれぞれ供給する。例えば、i番目の掛け算器を掛け算器92iとすると、遅延プロファイル供給部91は、信号値ai,kを掛け算器92iに供給する。 Delay profile supply unit 91 reads the signal values a 1, k to a n, k in the phase k of the delay profile stored in the delay profile storage unit 75 of FIG. 5, multipliers 92 1 to respectively 92 n Supply. For example, when the i-th multiplier is a multiplier 92 i , the delay profile supply unit 91 supplies the signal value a i, k to the multiplier 92 i .

掛け算器921乃至92nには、図8のクラスレジスタ83から、現在のビットの1ビット前からnビット前までのビットx1乃至xnがそれぞれ供給される。例えば、掛け算器92iには、クラスレジスタ83からiビット前のビットの値が供給され、掛け算器92iは、クラスレジスタ83から供給されたビットxiと、遅延プロファイル供給部91から供給された信号値ai,kとを掛け合わせ、その結果得られる値(ai,k・xi)を、足し算器93に供給する。 The multipliers 92 1 to 92 n are supplied with bits x 1 to x n from one bit before the current bit to n bits before the current bit from the class register 83 of FIG. For example, the multiplier 92 i is supplied with the value of the bit i bits before from the class register 83, and the multiplier 92 i is supplied from the bit x i supplied from the class register 83 and the delay profile supply unit 91. The signal value a i, k is multiplied and the resulting value (a i, k · x i ) is supplied to the adder 93.

足し算器93は、掛け算器921乃至92nのそれぞれから供給された値を足し合わせ、現在のビットに生じると予測される予測歪の位相kでの信号値yk’を算出し、引き算器94に供給する。 The adder 93 adds the values supplied from the multipliers 92 1 to 92 n to calculate the signal value y k ′ at the phase k of the predicted distortion predicted to occur in the current bit, and the subtractor 94.

引き算器94には、図8のA/Dコンバータ82から受信信号の信号値ykが供給される。引き算器94は、A/Dコンバータ82から供給された受信信号の信号値ykから、足し算器93から供給された予測歪の位相kでの信号値yk’を減算し、その結果得られる分離波形の信号値Skを出力する。 The subtracter 94 is supplied with the signal value y k of the received signal from the A / D converter 82 of FIG. The subtractor 94 subtracts the signal value y k ′ at the phase k of the predicted distortion supplied from the adder 93 from the signal value y k of the received signal supplied from the A / D converter 82, and is obtained as a result. The separated waveform signal value S k is output.

次に、図11は、図8の比較値算出部85の構成例を示すブロック図である。   Next, FIG. 11 is a block diagram illustrating a configuration example of the comparison value calculation unit 85 of FIG.

図11において、比較値算出部85は、遅延プロファイル供給部101、掛け算器102、および引き算器103から構成される。   In FIG. 11, the comparison value calculation unit 85 includes a delay profile supply unit 101, a multiplier 102, and a subtractor 103.

遅延プロファイル供給部101は、図5の遅延プロファイル蓄積部75に蓄積されている遅延プロファイルの位相kでの信号値a0,kを読み出し、掛け算器102に供給する。 The delay profile supply unit 101 reads out the signal value a 0, k at the phase k of the delay profile stored in the delay profile storage unit 75 of FIG. 5 and supplies it to the multiplier 102.

掛け算器102には、図8のクラスレジスタ83から現在のビットとして「1」(即ち、現在のビットx0=+1)が供給され、掛け算器102は、遅延プロファイル供給部101から供給された信号値a0,kと、クラスレジスタ83から供給されたビットx0とを掛け合わせ、その結果得られる値(+1×a0,k)を、引き算器103に供給する。 The multiplier 102 is supplied with “1” (that is, the current bit x 0 = + 1) as the current bit from the class register 83 in FIG. 8, and the multiplier 102 receives the signal supplied from the delay profile supply unit 101. The value a 0, k is multiplied by the bit x 0 supplied from the class register 83 and the resulting value (+ 1 × a 0, k ) is supplied to the subtractor 103.

引き算器103には、図8の波形分離部84から分離波形の信号値Skが供給され、引き算器103は、波形分離部84から供給された分離波形の信号値Skから、掛け算器102から供給された値を減算し、その結果得られる比較値B1を出力する。 The subtractor 103 is supplied with the signal value S k of the separated waveform from the waveform separation unit 84 of FIG. 8, and the subtracter 103 uses the multiplier 102 to calculate the signal value S k of the separated waveform supplied from the waveform separation unit 84. The value supplied from is subtracted, and the comparison value B 1 obtained as a result is output.

なお、比較値算出部86も比較値算出部85と同様に構成されており、比較値算出部86には、クラスレジスタ83から現在のビットとして「0」(即ち、現在のビットx0=−1)が供給され、掛け算器102は、遅延プロファイル供給部101から供給された信号値a0,kと、クラスレジスタ83から供給されたビットx0とを掛け合わせ、その結果得られる値(−1×a0,k)を、引き算器103に供給する。従って、引き算器103は、波形分離部84から供給された分離波形の信号値Skに信号値a0,kを加算し、その結果得られる比較値B0を出力する。 The comparison value calculation unit 86 is configured in the same manner as the comparison value calculation unit 85, and the comparison value calculation unit 86 receives “0” (that is, the current bit x 0 = −) from the class register 83 as the current bit. 1), the multiplier 102 multiplies the signal value a 0, k supplied from the delay profile supply unit 101 by the bit x 0 supplied from the class register 83, and obtains a value (− 1 × a 0, k ) is supplied to the subtractor 103. Accordingly, the subtractor 103 adds the signal value a 0, k to the signal value S k of the separated waveform supplied from the waveform separating unit 84, and outputs the comparison value B 0 obtained as a result.

次に、図12は、図8の機能ブロック46が信号の現在のビットを判定する処理を説明するフローチャートである。   Next, FIG. 12 is a flowchart for explaining processing in which the functional block 46 of FIG. 8 determines the current bit of the signal.

アンテナ46aが、信号ルータ45から送信されてくるRF信号を受信して受信部81に供給すると、ステップS31において、受信部81は、アンテナ46aが受信したRF信号をベースバンド信号に変換する。受信部81は、RF信号をベースバンド信号に変換した信号、即ち、受信信号をA/Dコンバータ82に供給する。   When the antenna 46a receives the RF signal transmitted from the signal router 45 and supplies it to the reception unit 81, the reception unit 81 converts the RF signal received by the antenna 46a into a baseband signal in step S31. The receiving unit 81 supplies a signal obtained by converting an RF signal to a baseband signal, that is, a received signal to the A / D converter 82.

ステップS31の処理後、処理はステップS32に進み、A/Dコンバータ82は、受信部81から供給された受信信号をA/D変換し、受信信号の信号値を取得する。A/Dコンバータ82は、受信信号の信号値を波形分離部84に供給し、処理はステップS33に進む。   After the process of step S31, the process proceeds to step S32, and the A / D converter 82 A / D-converts the reception signal supplied from the reception unit 81 and acquires the signal value of the reception signal. The A / D converter 82 supplies the signal value of the received signal to the waveform separation unit 84, and the process proceeds to step S33.

ステップS33において、クラスレジスタ83は、現在のビットのnビット前から1ビット前までのビットの値を波形分離部84に供給する。波形分離部84は、図5の遅延プロファイル蓄積部75に蓄積されている遅延プロファイルと、クラスレジスタ83から供給されたビットの値とを用いて、予測歪を算出する。そして、波形分離部84は、ステップS32でA/Dコンバータ82から供給された受信信号から予測歪を分離することにより得られる分離波形の信号値を算出し、比較値算出部85および86に供給する。   In step S <b> 33, the class register 83 supplies the waveform separation unit 84 with the bit values from n bits to 1 bit before the current bit. The waveform separation unit 84 calculates the predicted distortion using the delay profile stored in the delay profile storage unit 75 of FIG. 5 and the bit value supplied from the class register 83. Then, the waveform separation unit 84 calculates a signal value of the separated waveform obtained by separating the predicted distortion from the reception signal supplied from the A / D converter 82 in step S32 and supplies the signal value to the comparison value calculation units 85 and 86. To do.

ステップS33の処理後、処理はステップS34に進み、比較値算出部85は、波形分離部84から供給された分離波形の信号値から、現在のビットが「1」であるテストパターン信号に基づいて求められた遅延プロファイルの信号値を減算して比較値B1を算出する。比較値算出部85は、比較値B1を比較部87に供給し、処理はステップS35に進む。 After the process of step S33, the process proceeds to step S34, and the comparison value calculation unit 85 determines from the signal value of the separated waveform supplied from the waveform separation unit 84 based on the test pattern signal whose current bit is “1”. The comparison value B 1 is calculated by subtracting the signal value of the obtained delay profile. The comparison value calculation unit 85 supplies the comparison value B 1 to the comparison unit 87, and the process proceeds to step S35.

ステップS35において、比較値算出部86は、波形分離部84から供給された分離波形の信号値に、現在のビットが「1」であるテストパターン信号に基づいて求められた遅延プロファイルの信号値を加算して比較値B0を算出して、比較部87に供給する。 In step S35, the comparison value calculation unit 86 adds the signal value of the delay profile obtained based on the test pattern signal whose current bit is “1” to the signal value of the separated waveform supplied from the waveform separation unit 84. A comparison value B 0 is calculated by addition and supplied to the comparison unit 87.

ステップS35の処理後、ステップS36に進み、比較部87は、比較値算出部85から供給された比較値B1を2乗した値と、比較値算出部86から供給された比較値B0を2乗した値とを比較し、比較値B0を2乗した値が、比較値B1を2乗した値以下であるか否かを判定する。 After the processing in step S35, the process proceeds to step S36, comparison unit 87 compares the value of the comparison value B 1 supplied squared from the comparison value calculator 85, the comparison value B 0 supplied from the comparison value calculator 86 The squared value is compared, and it is determined whether or not the value obtained by squaring the comparison value B 0 is equal to or less than the value obtained by squaring the comparison value B 1 .

ステップS36において、比較部87が、比較値B0を2乗した値は、比較値B1を2乗した値以下であると判定した場合、ステップS37に進み、比較部87は、現在のビットは「0」であると決定する。 In step S36, when the comparison unit 87, the squared value of the comparison value B 0 is it is determined that the comparison value B 1 is less than the square value, the process proceeds to step S37, comparison unit 87, the current bit Is determined to be “0”.

一方、ステップS36において、比較部87が、比較値B0を2乗した値は、比較値B1を2乗した値以下でない(大である)と判定した場合、ステップS38に進み、比較部87は、現在のビットは「1」であると決定する。 On the other hand, in step S36, comparison unit 87, a value obtained by squaring the comparison value B 0, when it is determined the comparison value B 1 not less squared value as (a large), the process proceeds to step S38, the comparing unit 87 determines that the current bit is “1”.

ステップS37またはS38の処理後、ステップS33に戻り、A/Dコンバータ82から現在のビットの次に供給されるビットを、新たに、現在のビットとして、以下、同様の処理が繰り返される。   After the process of step S37 or S38, the process returns to step S33, and the same process is repeated hereinafter with the bit supplied next from the current bit from the A / D converter 82 as a new current bit.

以上のように、機能ブロック46は、受信信号から予測歪などが分離された比較値B1と比較値B0とを比較した結果に基づいて、現在のビットを決定するので、現在のビットの信号値が表す波形に生じる歪の影響を受けずに、現在のビットを正確に決定することができる。これにより、通信の品質を向上させることができる。 As described above, the functional block 46 determines the current bit based on the result of comparing the comparison value B 1 obtained by separating the prediction distortion and the like from the received signal and the comparison value B 0 . The current bit can be accurately determined without being affected by the distortion generated in the waveform represented by the signal value. Thereby, the quality of communication can be improved.

また、例えば、従来の無線通信では、送信側が、信号をブロック化し、それぞれのブロックに誤り訂正符号を付加して送信し、受信側が、そのブロックを受信して展開し、誤り訂正符号を用いて信号に発生した誤りを訂正する処理を行う必要があった。これに対し、信号処理装置31では、遅延プロファイルを用いて、ビットを正確に決定することができるので、信号ルータ45は、信号のビットを順次送信するだけでよく、機能ブロック46は、信号ルータ45からの信号を受信して、その信号のビットを順次決定するだけでよい。従って、従来の無線通信より遅延を短くし、遅延を一定にすること、即ち、リアルタイム性を容易に確保することができる。また、誤りを訂正する処理を行わなくてもよいので、装置をシンプルに構成することができる。   Also, for example, in conventional wireless communication, the transmitting side blocks a signal, adds an error correction code to each block and transmits the block, and the receiving side receives and expands the block, and uses the error correction code. It was necessary to perform processing to correct an error that occurred in the signal. On the other hand, since the signal processing device 31 can accurately determine the bits using the delay profile, the signal router 45 only needs to transmit the bits of the signal sequentially. It is only necessary to receive the signal from 45 and sequentially determine the bits of the signal. Therefore, the delay can be made shorter than that of the conventional wireless communication and the delay can be made constant, that is, the real-time property can be easily ensured. Further, since it is not necessary to perform an error correction process, the apparatus can be configured simply.

さらに、従来の無線通信では、マルチパス対策として、例えば、パケットにUWを挿入する必要があったが、遅延プロファイルに基づいて、通信の品質を向上させることができるので、UWを挿入する必要がなく、パケットのオーバーヘッドを減らすことができ、高速な通信を行うことができる。   Furthermore, in conventional wireless communication, for example, UW needs to be inserted into a packet as a countermeasure against multipath. However, since communication quality can be improved based on a delay profile, it is necessary to insert UW. Thus, packet overhead can be reduced and high-speed communication can be performed.

また、信号処理装置31は、信号ケーブルを介して信号を送信する従来の信号処理装置と同様に、信号のビットが順次送信されるように構成されているので、信号ケーブルを介して信号を送信する従来の信号処理装置の基板間ハーネスや基板コネクタに代替して、信号処理装置31で行われる無線通信のシステムを、容易に、かつ、安価に導入することができる。また、信号処理装置31を製造する製造工程においても、従来の信号処理装置で必要であったハーネス接続工程などを、省くことができる。   Further, the signal processing device 31 is configured so that the bits of the signal are sequentially transmitted in the same manner as the conventional signal processing device that transmits the signal via the signal cable, so that the signal is transmitted via the signal cable. Instead of the inter-board harness and the board connector of the conventional signal processing apparatus, a wireless communication system performed by the signal processing apparatus 31 can be easily and inexpensively introduced. Also, in the manufacturing process for manufacturing the signal processing device 31, the harness connection step and the like necessary for the conventional signal processing device can be omitted.

なお、本実施の形態では、信号ルータ45から機能ブロック46に信号を送信する場合について説明したが、機能ブロック46から信号ルータ45に信号を送信したり、機能ブロック46どうしの間で信号の送受信をしたりする場合においても、信号ルータ45から機能ブロック46に信号を送信する場合と同様の処理により、現在のビットを正確に決定することができる。   In the present embodiment, a case where a signal is transmitted from the signal router 45 to the functional block 46 has been described. However, a signal is transmitted from the functional block 46 to the signal router 45, and transmission / reception of signals between the functional blocks 46 is performed. Even in the case of performing the processing, the current bit can be accurately determined by the same processing as when the signal is transmitted from the signal router 45 to the functional block 46.

また、本実施の形態では、波形分離部84から出力された分離波形の信号値から、現在のビットが「1」または「0」であるとしたときの比較値を算出し、これらの比較値に基づいて、現在のビットを決定したが、例えば、波形分離部84から出力された分離波形の信号値が、所定の閾値以上であるか否かを判定し、その判定結果に基づいて、現在のビットを決定することができる。   In the present embodiment, the comparison value when the current bit is “1” or “0” is calculated from the signal value of the separated waveform output from the waveform separation unit 84, and these comparison values are calculated. Based on the current bit, for example, it is determined whether or not the signal value of the separated waveform output from the waveform separation unit 84 is equal to or greater than a predetermined threshold, and based on the determination result, Bits can be determined.

即ち、図13は、機能ブロックの他の構成例を示すブロック図である。   That is, FIG. 13 is a block diagram showing another configuration example of the functional block.

図13において、機能ブロック46’は、アンテナ46a、受信部81、A/Dコンバータ82、クラスレジスタ83、波形分離部84、および判定部110から構成される。なお、図13では、図8の機能ブロック46と対応する部分については、同一の符号を付してあり、以下では、その説明は、適宜省略する。   In FIG. 13, the functional block 46 ′ includes an antenna 46 a, a reception unit 81, an A / D converter 82, a class register 83, a waveform separation unit 84, and a determination unit 110. In FIG. 13, portions corresponding to the functional block 46 of FIG. 8 are denoted with the same reference numerals, and description thereof will be omitted below as appropriate.

即ち、図13の機能ブロック46’は、アンテナ46a、受信部81、A/Dコンバータ82、クラスレジスタ83、波形分離部84を備える点で、図8の機能ブロック46と共通する。但し、機能ブロック46’は、判定部110を備える点で、機能ブロック46と異なっている。   That is, the functional block 46 ′ in FIG. 13 is common to the functional block 46 in FIG. 8 in that it includes an antenna 46 a, a receiving unit 81, an A / D converter 82, a class register 83, and a waveform separating unit 84. However, the functional block 46 ′ is different from the functional block 46 in that the determination unit 110 is provided.

判定部110には、波形分離部84から分離波形の信号値が供給され、判定部110は、例えば、分離波形の信号値が所定の閾値(例えば、0)以上であるか否かを判定し、判定結果に基づいて、現在のビットの値を決定して出力する。例えば、判定部110は、波形分離部84から供給される分離波形の信号値が所定の閾値以上であると判定した場合、現在のビットの値は「1」であると決定する。一方、判定部110は、波形分離部84から供給される分離波形の信号値が所定の閾値以上でない(未満である)と判定した場合、現在のビットの値は「0」であると決定する。   The determination unit 110 is supplied with the signal value of the separated waveform from the waveform separation unit 84, and the determination unit 110 determines, for example, whether or not the signal value of the separation waveform is equal to or greater than a predetermined threshold (for example, 0). The current bit value is determined and output based on the determination result. For example, when the determination unit 110 determines that the signal value of the separated waveform supplied from the waveform separation unit 84 is greater than or equal to a predetermined threshold, the determination unit 110 determines that the current bit value is “1”. On the other hand, when the determination unit 110 determines that the signal value of the separated waveform supplied from the waveform separation unit 84 is not equal to or greater than (less than) a predetermined threshold, the current bit value is determined to be “0”. .

このように構成された機能ブロック46’は、現在のビットが「1」または「0」であるとして比較値を算出する図8の機能ブロック46よりも、少ない処理で現在のビットを決定することができる。従って、機能ブロック46’は、機能ブロック46よりも、処理による遅延を少なくすることができる。   The functional block 46 ′ thus configured determines the current bit with less processing than the functional block 46 of FIG. 8 that calculates the comparison value on the assumption that the current bit is “1” or “0”. Can do. Therefore, the functional block 46 ′ can reduce the delay caused by the processing as compared with the functional block 46.

なお、機能ブロック46および46’では、A/Dコンバータ82によりA/D変換された受信信号に対する処理が行われているが、A/D変換を行わずに、アナログ回路を利用して、受信信号から予測歪を分離する処理や、現在のビットを決定する処理を行うことができる。   In the functional blocks 46 and 46 ', processing is performed on the reception signal that has been A / D converted by the A / D converter 82, but reception is performed using an analog circuit without performing A / D conversion. Processing for separating the prediction distortion from the signal and processing for determining the current bit can be performed.

また、上述の説明では、テストパターン信号が、7ビットの信号である場合に、7通りの信号をテストパターン信号として用いるとしたが、テストパターン信号としては、図14に示すように、各ビットが「0」または「1」であるときの128(2の7乗)通りの信号を用いることができる。   In the above description, when the test pattern signal is a 7-bit signal, seven types of signals are used as the test pattern signal. However, as shown in FIG. It is possible to use 128 (2 to the 7th power) kinds of signals when “1” is “0” or “1”.

図14には、各ビットが「0」または「1」であるときの128つのテストパターン信号と、それらのテストパターン信号に基づいて取得される遅延プロファイルとの例が示されている。   FIG. 14 shows an example of 128 test pattern signals when each bit is “0” or “1”, and delay profiles acquired based on these test pattern signals.

このように、各ビットが「0」または「1」であるときのテストパターン信号に対応した遅延プロファイルを予め取得することにより、例えば、上述の式(1)の演算を行うことなく、実際に受信した信号と同一のビットの並びからなるテストパターン信号に対応した遅延プロファイルを予測歪として用いることができ、これにより、現在のビットを迅速に決定することができる。   In this way, by acquiring in advance the delay profile corresponding to the test pattern signal when each bit is “0” or “1”, for example, without actually performing the calculation of the above-described equation (1), A delay profile corresponding to a test pattern signal composed of the same sequence of bits as the received signal can be used as a predicted distortion, whereby the current bit can be determined quickly.

上述した一連の処理は、ハードウエアにより実行させることもできるし、ソフトウエアにより実行させることもできる。一連の処理をソフトウエアにより実行させる場合には、そのソフトウエアを構成するプログラムが、専用のハードウエアに組み込まれているコンピュータ、または、各種のプログラムをインストールすることで、各種の機能を実行することが可能な、例えば汎用のパーソナルコンピュータなどに、プログラム記録媒体からインストールされる。   The series of processes described above can be executed by hardware or can be executed by software. When a series of processing is executed by software, a program constituting the software executes various functions by installing a computer incorporated in dedicated hardware or various programs. For example, it is installed from a program recording medium in a general-purpose personal computer or the like.

図15は、上述した一連の処理をプログラムにより実行するパーソナルコンピュータの構成の例を示すブロック図である。CPU(Central Processing Unit)201は、ROM(Read Only Memory)202、または記憶部208に記憶されているプログラムに従って各種の処理を実行する。RAM(Random Access Memory)203には、CPU201が実行するプログラムやデータなどが適宜記憶される。これらのCPU201、ROM202、およびRAM203は、バス204により相互に接続されている。   FIG. 15 is a block diagram showing an example of the configuration of a personal computer that executes the above-described series of processing by a program. A CPU (Central Processing Unit) 201 executes various processes according to a program stored in a ROM (Read Only Memory) 202 or a storage unit 208. A RAM (Random Access Memory) 203 appropriately stores programs executed by the CPU 201 and data. The CPU 201, ROM 202, and RAM 203 are connected to each other via a bus 204.

CPU201にはまた、バス204を介して入出力インタフェース205が接続されている。入出力インタフェース205には、キーボード、マウス、マイクロホンなどよりなる入力部206、ディスプレイ、スピーカなどよりなる出力部207が接続されている。CPU201は、入力部206から入力される指令に対応して各種の処理を実行する。そして、CPU201は、処理の結果を出力部207に出力する。   An input / output interface 205 is also connected to the CPU 201 via the bus 204. Connected to the input / output interface 205 are an input unit 206 made up of a keyboard, mouse, microphone, and the like, and an output unit 207 made up of a display, a speaker, and the like. The CPU 201 executes various processes in response to commands input from the input unit 206. Then, the CPU 201 outputs the processing result to the output unit 207.

入出力インタフェース205に接続されている記憶部208は、例えばハードディスクからなり、CPU201が実行するプログラムや各種のデータを記憶する。通信部209は、インターネットやローカルエリアネットワークなどのネットワークを介して外部の装置と通信する。   A storage unit 208 connected to the input / output interface 205 includes, for example, a hard disk, and stores programs executed by the CPU 201 and various data. The communication unit 209 communicates with an external device via a network such as the Internet or a local area network.

また、通信部209を介してプログラムを取得し、記憶部208に記憶してもよい。   Further, a program may be acquired via the communication unit 209 and stored in the storage unit 208.

入出力インタフェース205に接続されているドライブ210は、磁気ディスク、光ディスク、光磁気ディスク、或いは半導体メモリなどのリムーバブルメディア211が装着されたとき、それらを駆動し、そこに記録されているプログラムやデータなどを取得する。取得されたプログラムやデータは、必要に応じて記憶部208に転送され、記憶される。   The drive 210 connected to the input / output interface 205 drives a removable medium 211 such as a magnetic disk, an optical disk, a magneto-optical disk, or a semiconductor memory, and drives the programs and data recorded therein. Get etc. The acquired program and data are transferred to and stored in the storage unit 208 as necessary.

コンピュータにインストールされ、コンピュータによって実行可能な状態とされるプログラムを格納するプログラム記録媒体は、図15に示すように、磁気ディスク(フレキシブルディスクを含む)、光ディスク(CD-ROM(Compact Disc-Read Only Memory),DVD(Digital Versatile Disc)を含む)、光磁気ディスク、もしくは半導体メモリなどよりなるパッケージメディアであるリムーバブルメディア211、または、プログラムが一時的もしくは永続的に格納されるROM202や、記憶部208を構成するハードディスクなどにより構成される。プログラム記録媒体へのプログラムの格納は、必要に応じてルータ、モデムなどのインタフェースである通信部209を介して、ローカルエリアネットワーク、インターネット、デジタル衛星放送といった、有線または無線の通信媒体を利用して行われる。   As shown in FIG. 15, a program recording medium for storing a program that is installed in a computer and is ready to be executed by the computer includes a magnetic disk (including a flexible disk), an optical disk (CD-ROM (Compact Disc-Read Only). Memory, DVD (Digital Versatile Disc), a magneto-optical disk, a removable medium 211 that is a package medium composed of a semiconductor memory, or the like, a ROM 202 in which a program is temporarily or permanently stored, or a storage unit 208 It is comprised by the hard disk etc. which comprise. The program is stored in the program recording medium using a wired or wireless communication medium such as a local area network, the Internet, or digital satellite broadcasting via a communication unit 209 that is an interface such as a router or a modem as necessary. Done.

なお、本発明は、1シンボルにより1ビットが伝送される変調方式を用いる装置の他、例えば、QPSK(quadrature phase shift keying)や、8PSK(quadrature phase shift keying)のように、1シンボルにより複数のビットが伝送される変調方式を用いる装置にも適用することができる。   In the present invention, in addition to a device using a modulation scheme in which one bit is transmitted by one symbol, for example, a plurality of one symbol such as QPSK (quadrature phase shift keying) or 8PSK (quadrature phase shift keying). The present invention can also be applied to an apparatus using a modulation scheme in which bits are transmitted.

また、本発明は、信号処理装置などの筐体の内部における無線通信だけではなく、遅延プロファイルが一定な環境であれば、屋外での無線通信にも適用することができる。また、ケーブルを介して信号を伝送するにあたり、ケーブルの端部で信号が反射し、伝送すべき信号と反射した信号とによって発生する干渉も定常的なものであるので、このようなケーブルを介して通信に、本発明を適用することで、通信の品質を向上させることができる。   Further, the present invention can be applied not only to wireless communication inside a housing such as a signal processing device but also to outdoor wireless communication in an environment where the delay profile is constant. In addition, when transmitting a signal via a cable, the signal is reflected at the end of the cable, and interference caused by the signal to be transmitted and the reflected signal is also steady. Thus, the communication quality can be improved by applying the present invention to communication.

また、例えば、磁界を利用した近接通信では、通信距離が限定されてしまうため、通信に用いるアンテナの配置などに制限があるが、信号処理装置31は、アンテナの配置が限定されることなく、高品質な通信を行うことができる。   Further, for example, in proximity communication using a magnetic field, the communication distance is limited, and thus there is a limitation on the arrangement of antennas used for communication, but the signal processing device 31 is not limited in the arrangement of antennas. High quality communication can be performed.

なお、上述のフローチャートを参照して説明した各処理は、必ずしもフローチャートとして記載された順序に沿って時系列に処理する必要はなく、並列的あるいは個別に実行される処理(例えば、並列処理あるいはオブジェクトによる処理)も含むものである。   Note that the processes described with reference to the flowcharts described above do not necessarily have to be processed in chronological order in the order described in the flowcharts, but are performed in parallel or individually (for example, parallel processes or objects Processing).

また、本発明の実施の形態は、上述した実施の形態に限定されるものではなく、本発明の要旨を逸脱しない範囲において種々の変更が可能である。   The embodiments of the present invention are not limited to the above-described embodiments, and various modifications can be made without departing from the scope of the present invention.

従来の信号処理装置の構成例を示すブロック図である。It is a block diagram which shows the structural example of the conventional signal processing apparatus. 本発明を適用した信号処理装置の一実施の形態の構成例を示す斜視図である。It is a perspective view which shows the structural example of one Embodiment of the signal processing apparatus to which this invention is applied. 信号処理装置31の構成例を示すブロック図である。3 is a block diagram illustrating a configuration example of a signal processing device 31. FIG. 信号ルータ45から機能ブロック46に送信されるビットの信号値により表される波形に生じる歪について説明する図である。It is a figure explaining the distortion which arises in the waveform represented by the signal value of the bit transmitted from the signal router 45 to the functional block 46. FIG. 信号ルータ45および機能ブロック46の構成例を示すブロック図である。3 is a block diagram illustrating a configuration example of a signal router 45 and a function block 46. FIG. 信号ルータ45がテストパターン信号を送信し、機能ブロック46が遅延プロファイルを取得する処理を説明するフローチャートである。It is a flowchart explaining the process which the signal router 45 transmits a test pattern signal and the functional block 46 acquires a delay profile. 機能ブロック46により取得される遅延プロファイルの例を示す図である。6 is a diagram illustrating an example of a delay profile acquired by a function block 46. FIG. 機能ブロック46の構成例を示すブロック図である。3 is a block diagram illustrating a configuration example of a functional block 46. FIG. 受信信号、分離波形、および比較値が表す波形の例を示す図である。It is a figure which shows the example of the waveform which a received signal, a separated waveform, and a comparison value represent. 波形分離部84の構成例を示すブロック図である。4 is a block diagram illustrating a configuration example of a waveform separation unit 84. FIG. 比較値算出部85の構成例を示すブロック図である。7 is a block diagram illustrating a configuration example of a comparison value calculation unit 85. FIG. 機能ブロック46が信号の現在のビットを判定する処理を説明するフローチャートである。It is a flowchart explaining the process which the functional block 46 determines the present bit of a signal. 機能ブロックの他の構成例を示すブロック図である。It is a block diagram which shows the other structural example of a functional block. テストパターン信号と遅延プロファイルとの例を示す図である。It is a figure which shows the example of a test pattern signal and a delay profile. パーソナルコンピュータの構成の例を示すブロック図である。And FIG. 11 is a block diagram illustrating an example of a configuration of a personal computer.

符号の説明Explanation of symbols

31 信号処理装置, 32 筐体, 33 電源モジュール, 34 プラットフォーム基板, 35 入力基板, 35a アンテナ, 361乃至363 信号処理基板, 36a1乃至36a3 アンテナ, 37 出力基板, 37a アンテナ, 431乃至434 コネクタ, 44 入力セレクタ, 45 信号ルータ, 45a アンテナ, 461乃至463 機能ブロック, 36a1乃至36a3 アンテナ, 47 コネクタ, 48 リモートコマンダ, 49 操作部, 50 システム制御ブロック, 50a アンテナ, 61 送信側制御部, 62 テストパターン生成部, 63 無線送信部, 71 受信側制御部, 72 テストパターン生成部, 73 無線受信部, 74 統計処理部, 75 遅延プロファイル蓄積部, 81 受信部, 82 A/Dコンバータ, 83 クラスレジスタ, 84 波形分離部, 85および86 比較値算出部, 87 比較部, 91 遅延プロファイル供給部, 921乃至92n 掛け算器, 93 足し算器, 94 引き算器, 101 遅延プロファイル供給部, 102 掛け算器, 103 引き算器, 110 判定部 31 signal processor, 32 a housing, 33 power supply, 34 the platform substrate, 35 an input substrate, 35a antenna, 36 to 363 signal processing board, 36a 1 to 36a 3 antennas, 37 output board, 37a antenna, 43 1 43 4 connector, 44 input selector, 45 signal router, 45a antenna, 46 1 to 46 3 function block, 36a 1 to 36a 3 antenna, 47 connector, 48 remote commander, 49 operation unit, 50 system control block, 50a antenna, 61 Transmission side control unit, 62 Test pattern generation unit, 63 Wireless transmission unit, 71 Reception side control unit, 72 Test pattern generation unit, 73 Wireless reception unit, 74 Statistical processing unit, 75 Delay profile storage unit, 81 Reception unit, 82 A / D converter, 83 class register, 84 waveform separation unit, 85 and 86 comparison value calculation unit, 87 comparison unit, 91 delay profile supply unit, 92 1 to 92 n multiplier, 93 adder, 94 subtractor, 101 delay profile supply unit, 102 multiplier, 103 Subtractor, 110 judgment unit

Claims (5)

特定のシンボルの前に送信されたシンボルの値に応じて、前記特定のシンボルの信号値が表す波形に、定常的な歪が生じる伝送経路を介して伝送される信号を処理する信号処理装置において、
前記伝送経路を介して伝送されてきた信号から、前記特定のシンボルの信号値を取得する取得手段と、
前記特定のシンボルの前に送信されたシンボルの値に応じて生じる、前記特定のシンボルの信号値が表す波形の歪の特性に基づいて、前記特定のシンボルの信号値が表す波形に生じると予測される歪を、前記取得手段が取得した前記特定のシンボルの信号値が表す波形から分離することにより得られる分離波形を算出する分離手段と、
前記分離手段が算出した前記分離波形に基づいて、前記特定のシンボルの値を決定する決定手段と、
あらかじめ設定された所定の値を取る複数の前記シンボルからなるテスト信号を受信する受信手段と、
前記受信手段が受信した前記テスト信号の特定のシンボルの信号値と、前記テスト信号の複数のシンボルの値とに基づいて、前記歪の特性を求める特性取得手段と
を備える信号処理装置。
In a signal processing device that processes a signal transmitted through a transmission path in which steady distortion occurs in a waveform represented by a signal value of the specific symbol according to a value of a symbol transmitted before the specific symbol ,
Obtaining means for obtaining a signal value of the specific symbol from a signal transmitted through the transmission path;
Predicted to occur in the waveform represented by the signal value of the specific symbol based on the distortion characteristics of the waveform represented by the signal value of the specific symbol that occur according to the value of the symbol transmitted before the specific symbol Separating means for calculating a separated waveform obtained by separating the distortion to be obtained from the waveform represented by the signal value of the specific symbol obtained by the obtaining means;
Determining means for determining a value of the specific symbol based on the separated waveform calculated by the separating means;
Receiving means for receiving a test signal composed of a plurality of the symbols having a predetermined value set in advance;
A signal processing apparatus comprising: characteristic acquisition means for obtaining characteristics of the distortion based on a signal value of a specific symbol of the test signal received by the reception means and values of a plurality of symbols of the test signal.
前記決定手段は、
前記特定のシンボルが取り得る値ごとに、前記特定のシンボルの値に応じた前記特定のシンボルの信号値が表す波形の特性に基づいて予測される前記特定のシンボルの信号値を、前記分離手段が算出した前記分離波形の信号値から減算し、前記特定のシンボルが取り得る値ごとの比較値を算出する比較値算出手段と、
前記特定のシンボルが取り得る値ごとの前記比較値を比較し、前記比較値の絶対値が最も小さな値となるときの算出に用いられた前記特定のシンボルの値を、前記伝送経路を介して伝送されてきた信号の特定のシンボルの値とする比較手段と
を有する
請求項1に記載の信号処理装置。
The determining means includes
For each value that can be taken by the specific symbol, a signal value of the specific symbol predicted based on a waveform characteristic represented by a signal value of the specific symbol corresponding to the value of the specific symbol Subtraction from the signal value of the separated waveform calculated by, and a comparison value calculation means for calculating a comparison value for each value that the specific symbol can take,
The comparison value for each value that the specific symbol can take is compared, and the value of the specific symbol used for calculation when the absolute value of the comparison value is the smallest value is obtained via the transmission path. The signal processing apparatus according to claim 1, further comprising a comparison unit configured to set a value of a specific symbol of the transmitted signal.
前記特定のシンボルが取り得る値が、第1の値と第2の値とである場合、
前記決定手段は、所定の閾値と、前記分離手段が算出した前記分離波形の信号値とを比較した結果に基づいて、前記特定のシンボルの値が前記第1の値または前記第2の値のうちのいずれであるかを決定する
請求項1に記載の信号処理装置。
When possible values of the specific symbol are a first value and a second value,
The determining means determines whether the value of the specific symbol is the first value or the second value based on a result of comparing a predetermined threshold value with the signal value of the separated waveform calculated by the separating means. The signal processing device according to claim 1, wherein the signal processing device is determined.
特定のシンボルの前に送信されたシンボルの値に応じて、前記特定のシンボルの信号値が表す波形に、定常的な歪が生じる伝送経路を介して伝送される信号を処理する信号処理方法において、
前記伝送経路を介して伝送されてきた信号から、前記特定のシンボルの信号値を取得し、
前記特定のシンボルの前に送信されたシンボルの値に応じて生じる、前記特定のシンボルの信号値が表す波形の歪の特性に基づいて、前記特定のシンボルの信号値が表す波形に生じると予測される歪を、前記伝送経路を介して伝送されてきた信号から取得された前記特定のシンボルの信号値が表す波形から分離することにより得られる分離波形を算出し、
前記分離波形に基づいて、前記特定のシンボルの値を決定し、
あらかじめ設定された所定の値を取る複数の前記シンボルからなるテスト信号を受信し、
受信した前記テスト信号の特定のシンボルの信号値と、前記テスト信号の複数のシンボルの値とに基づいて、前記歪の特性を求める
ステップを含む信号処理方法。
In a signal processing method for processing a signal transmitted through a transmission path in which steady distortion occurs in a waveform represented by a signal value of the specific symbol according to a value of a symbol transmitted before the specific symbol ,
Obtaining a signal value of the specific symbol from a signal transmitted through the transmission path;
Predicted to occur in the waveform represented by the signal value of the specific symbol based on the distortion characteristics of the waveform represented by the signal value of the specific symbol that occur according to the value of the symbol transmitted before the specific symbol A separated waveform obtained by separating the distortion to be obtained from the waveform represented by the signal value of the specific symbol acquired from the signal transmitted through the transmission path,
Determining a value of the particular symbol based on the separated waveform;
Receiving a test signal composed of a plurality of the symbols having a predetermined value set in advance;
A signal processing method including a step of obtaining the distortion characteristic based on a signal value of a specific symbol of the received test signal and values of a plurality of symbols of the test signal.
特定のシンボルの前に送信されたシンボルの値に応じて、前記特定のシンボルの信号値が表す波形に、定常的な歪が生じる伝送経路を介して伝送される信号を処理する信号処理をコンピュータに実行させるプログラムにおいて、
前記伝送経路を介して伝送されてきた信号から、前記特定のシンボルの信号値を取得し、
前記特定のシンボルの前に送信されたシンボルの値に応じて生じる、前記特定のシンボルの信号値が表す波形の歪の特性に基づいて、前記特定のシンボルの信号値が表す波形に生じると予測される歪を、前記伝送経路を介して伝送されてきた信号から取得された前記特定のシンボルの信号値が表す波形から分離することにより得られる分離波形を算出し、
前記分離波形に基づいて、前記特定のシンボルの値を決定し、
あらかじめ設定された所定の値を取る複数の前記シンボルからなるテスト信号を受信し、
受信した前記テスト信号の特定のシンボルの信号値と、前記テスト信号の複数のシンボルの値とに基づいて、前記歪の特性を求める
ステップを含むプログラム。
A computer performs signal processing for processing a signal transmitted through a transmission path in which steady distortion occurs in the waveform represented by the signal value of the specific symbol in accordance with the value of the symbol transmitted before the specific symbol. In the program to be executed
Obtaining a signal value of the specific symbol from a signal transmitted through the transmission path;
Predicted to occur in the waveform represented by the signal value of the specific symbol based on the distortion characteristics of the waveform represented by the signal value of the specific symbol that occur according to the value of the symbol transmitted before the specific symbol A separated waveform obtained by separating the distortion to be obtained from the waveform represented by the signal value of the specific symbol acquired from the signal transmitted through the transmission path,
Determining a value of the particular symbol based on the separated waveform;
Receiving a test signal composed of a plurality of the symbols having a predetermined value set in advance;
A program comprising a step of obtaining the distortion characteristics based on a signal value of a specific symbol of the received test signal and values of a plurality of symbols of the test signal.
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