JP4719656B2 - ネットワーク上におけるプロセッサ制御技術 - Google Patents
ネットワーク上におけるプロセッサ制御技術 Download PDFInfo
- Publication number
- JP4719656B2 JP4719656B2 JP2006262024A JP2006262024A JP4719656B2 JP 4719656 B2 JP4719656 B2 JP 4719656B2 JP 2006262024 A JP2006262024 A JP 2006262024A JP 2006262024 A JP2006262024 A JP 2006262024A JP 4719656 B2 JP4719656 B2 JP 4719656B2
- Authority
- JP
- Japan
- Prior art keywords
- processor
- host
- local storage
- data
- encrypted content
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
Images
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L63/00—Network architectures or network communication protocols for network security
- H04L63/04—Network architectures or network communication protocols for network security for providing a confidential data exchange among entities communicating through data packet networks
- H04L63/0428—Network architectures or network communication protocols for network security for providing a confidential data exchange among entities communicating through data packet networks wherein the data content is protected, e.g. by encrypting or encapsulating the payload
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L67/00—Network arrangements or protocols for supporting network services or applications
- H04L67/34—Network arrangements or protocols for supporting network services or applications involving the movement of software or configuration parameters
Description
このCELLプロセッサは、PPU(Power Processor Unit)と、メインメモリと、1以上のSPE(Synergistic processing engine)を備える。
各SPEは、SPU(Synergistic Processing Unit)と、ローカルストレージと、MFC(Memory Flow Controller)を備える。
この方法は、クライアントデバイスから送信された保護ファイルイメージを、ホストデバイスのCELLプロセッサであるホストCELLプロセッサにて受信するステップを含む。保護ファイルイメージは、暗号化されたSPUイメージを含む。
以下の記述においては、例示のために多くの特定的な詳細を含むけれども、本発明の範囲内において、以下の詳細について多くの変形や変更が可能であることは、当業者には理解されるところである。したがって、下記に示す本発明の実施例は、請求項に記載の発明の一般性を失わせるものでも制約を設けるものでもない。
Claims (19)
- ホストプロセッサをセキュアに動作させるための方法であって、
ホストプロセッサは、
第1プロセッサユニットと、
メインメモリと、
1以上の第2プロセッサエレメントと、
を備えており、
各第2プロセッサエレメントは、
第2プロセッサユニットと、
ローカルストレージと、
MFC(Memory Flow Controller)と、
を備えており、
本方法は、
(a)前記ホストプロセッサが、クライアントデバイスから送信された保護ファイルを、ホストプロセッサにて受信するステップを備え、
前記保護ファイルは、クライアントデバイスの第2プロセッサエレメントのローカルストレージの暗号化されたコンテンツを含み、
本方法はさらに、
(b)前記ホストプロセッサが、ホストプロセッサの一以上の第2プロセッサエレメントを前記保護ファイルに割り当てるステップと、
(c)前記ホストプロセッサが、前記一以上の割り当てられた第2プロセッサエレメントのローカルストレージを、ウィンドウ部分を除き、外部からのアクセスから保護するステップを備え、
前記ウィンドウは、該ウィンドウを介して非保護転送に適合するコードやデータを、前記保護ファイルに割り当てられた一以上の第2プロセッサエレメントのうちの特定の割り当てられた第2プロセッサエレメントの内外へ転送するためのウィンドウであり、
本方法はさらに、
(d)前記ホストプロセッサが、前記一以上の割り当てられた第2プロセッサエレメントのローカルストレージに、認定コードをロードするステップと、
(e)前記ホストプロセッサが、前記暗号化されたコンテンツを、前記特定の割り当てられた第2プロセッサエレメントのローカルストレージにロードするステップとを備え、
前記暗号化されたコンテンツは、前記特定の割り当てられた第2プロセッサエレメントのウィンドウ部分にロードされ、
本方法はさらに、
(f)前記ホストプロセッサが、前記特定の割り当てられた第2プロセッサエレメントにおいて、前記暗号化されたコンテンツを認証コードを用いて復号することにより得られたコードを実行し、または、前記ホストプロセッサが、前記特定の割り当てられた第2プロセッサエレメントにおいて、前記暗号化されたコンテンツを認証コードを用いて復号することにより得られたデータを処理するステップを備えることを特徴とする方法。 - 前記認証コードは、復号・暗号・ロード用コードを含むことを特徴とする請求項1に記載の方法。
- 復号・暗号・ロード用コードは、非保護転送に適合するコードおよび/またはデータだけを対象として、読み出しおよび/または書き込みを実行するように設定されていることを特徴とする請求項2に記載の方法。
- 前記保護ファイルは、更に、暗号化された共有初期化データを含むことを特徴とする請求項1に記載の方法。
- 前記保護ファイルは、クライアントプロセッサの2以上の第2プロセッサエレメントから得られた暗号化されたコードおよび/またはデータを含むことを特徴とする請求項1に記載の方法。
- 前記ホストプロセッサが、前記暗号化されたコンテンツのために、ホストプロセッサのメインメモリであるホストメモリ上に領域を確保するステップ、を更に含むことを特徴とする請求項1に記載の方法。
- 前記ホストプロセッサが、暗号化されたコンテンツをホストのメインメモリに確保された領域にロードするステップ、を更に含むことを特徴とする請求項1に記載の方法。
- 前記ホストプロセッサが、非初期化データとメッセージボックスのために、ホストプロセッサのメインメモリであるホストメモリ上に領域を確保するステップ、を更に含むことを特徴とする請求項1に記載の方法。
- 前記ホストプロセッサが、ホストプロセッサの第2プロセッサユニットに、暗号化されたファイルデータをロードするステップ、を更に含むことを特徴とする請求項1に記載の方法。
- 保護ファイルを受信する前に、前記ホストプロセッサが、該ホストプロセッサが保護ファイルを実行できるかを認証するステップ、を更に含むことを特徴とする請求項1に記載の方法。
- 前記ホストプロセッサが、クライアントデバイスから送信された保護ファイルの実行要求をホストプロセッサにて受信するステップ、を更に含むことを特徴とする請求項1に記載の方法。
- 前記ホストプロセッサが、ホストプロセッサについて、クライアントデバイスから受信した情報に基づいて保護ファイルを受け入れるか否かを判定するステップ、を更に含むことを特徴とする請求項11に記載の方法。
- 第1プロセッサユニットと、
2以上の第2プロセッサエレメントと、
第1プロセッサユニットおよび第2プロセッサエレメントと接続されるメインメモリと、を備えるプロセッサのための保護ファイルを示すデータを保持する記録媒体であって、
各第2プロセッサエレメントは、
第2プロセッサユニットと、
ローカルストレージと、を備え、
保護ファイルは、クライアントデバイスの2以上の第2プロセッサエレメントのローカルストレージの暗号化されたコンテンツ、または、クライアントデバイスの一以上の第2プロセッサエレメントのローカルストレージの暗号化されたコンテンツと複数の第2プロセッサエレメントについての暗号化された動作関連情報を含むことを特徴とするプロセッサにて読み取り可能な記録媒体。 - 第1プロセッサユニットと、
2以上の第2プロセッサエレメントと、
第1プロセッサユニットおよび第2プロセッサエレメントと接続されるメインメモリと、を備えるプロセッサであって、
各第2プロセッサエレメントは、第2プロセッサユニットと、ローカルストレージとを備え、
本プロセッサは、保護ファイルを示すデータをメインメモリまたはローカルストレージに保持し、
保護ファイルは、クライアントデバイスの2以上の第2プロセッサエレメントのローカルストレージの暗号化されたコンテンツ、または、クライアントデバイスの一以上の第2プロセッサエレメントのローカルストレージの暗号化されたコンテンツと複数の第2プロセッサエレメントについての暗号化された動作関連情報を含むことを特徴とするプロセッサ。 - 少なくとも1以上の第2プロセッサエレメントが、保護モードで動作するように設定されたセキュア第2プロセッサエレメントであることを特徴とする請求項14に記載のプロセッサ。
- セキュア第2プロセッサエレメントのローカルストレージは、暗号化コードおよび/またはデータを保護部分の内外に転送するためのウィンドウを除き、第1プロセッサユニットや他の第2プロセッサエレメント、前記プロセッサの他プロセッサからアクセス不可能な保護部分を含むことを特徴とする請求項15に記載のプロセッサ。
- セキュア第2プロセッサエレメントのローカルストレージは、更に、認定コードを含むことを特徴とする請求項16に記載のプロセッサ。
- 認定コードは、暗号化されるか、真性証明されるか、電子署名されたコードであることを特徴とする請求項17に記載のプロセッサ。
- 請求項14に記載のプロセッサであって、第1プロセッサユニットと、第2プロセッサエレメントと、メインメモリとは、
(a)クライアントデバイスから送信された保護ファイルを受信し、
(b)プロセッサの一以上の第2プロセッサエレメントを前記保護ファイルに割り当て、
(c)割り当てられた前記第2プロセッサエレメントのローカルストレージを、ウィンドウ部分を除き、外部からのアクセスから保護し、
前記ウィンドウは、該ウィンドウを介して、非保護転送に適合するコードやデータを、前記保護ファイルに割り当てられた一以上の第2プロセッサエレメントのうちの特定の第2プロセッサエレメントの内外へ転送するためのウィンドウであり、
(d)前記一以上の割り当てられた第2プロセッサエレメントのローカルストレージに、認定コードをロードし、
(e)前記暗号化されたコンテンツを、前記特定の第2プロセッサエレメントのローカルストレージにロードし、前記暗号化されたコンテンツは、前記特定の第2プロセッサエレメントのウィンドウ部分にロードされ、
(f)前記暗号化されたコンテンツを認証コードを用いて復号し、
(g)前記特定の第2プロセッサエレメントにおいて、暗号化されたコンテンツを復号することにより得られたコードを実行し、または、前記特定の第2プロセッサエレメントにおいて、前記暗号化されたコンテンツを復号することにより得られたデータを処理するように構成されていることを特徴とするプロセッサ。
Applications Claiming Priority (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US11/238,086 US8316220B2 (en) | 2005-09-27 | 2005-09-27 | Operating processors over a network |
US11/238,086 | 2005-09-27 | ||
US11/257,761 US7734827B2 (en) | 2005-09-27 | 2005-10-24 | Operation of cell processors |
US11/257,761 | 2005-10-24 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2007095066A JP2007095066A (ja) | 2007-04-12 |
JP4719656B2 true JP4719656B2 (ja) | 2011-07-06 |
Family
ID=37696438
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2006262024A Expired - Fee Related JP4719656B2 (ja) | 2005-09-27 | 2006-09-27 | ネットワーク上におけるプロセッサ制御技術 |
Country Status (3)
Country | Link |
---|---|
US (2) | US7734827B2 (ja) |
EP (1) | EP1768033A1 (ja) |
JP (1) | JP4719656B2 (ja) |
Families Citing this family (20)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2006027639A1 (en) * | 2004-09-09 | 2006-03-16 | Pirelli Tyre S.P.A. | Method for allowing a control of a vehicle provided with at least two wheels in case of puncture of a tyre |
US8037474B2 (en) * | 2005-09-27 | 2011-10-11 | Sony Computer Entertainment Inc. | Task manager with stored task definition having pointer to a memory address containing required code data related to the task for execution |
US7522168B2 (en) * | 2005-09-27 | 2009-04-21 | Sony Computer Entertainment Inc. | Cell processor task and data management |
US8316220B2 (en) * | 2005-09-27 | 2012-11-20 | Sony Computer Entertainment Inc. | Operating processors over a network |
US8141076B2 (en) * | 2005-09-27 | 2012-03-20 | Sony Computer Entertainment Inc. | Cell processor methods and apparatus |
US7506123B1 (en) * | 2005-09-27 | 2009-03-17 | Sony Computer Entertainment Inc. | Method and system for performing memory copy function on a cell processor |
US7734827B2 (en) * | 2005-09-27 | 2010-06-08 | Sony Computer Entertainment, Inc. | Operation of cell processors |
US8595747B2 (en) * | 2005-12-29 | 2013-11-26 | Sony Computer Entertainment Inc. | Efficient task scheduling by assigning fixed registers to scheduler |
US7647483B2 (en) * | 2007-02-20 | 2010-01-12 | Sony Computer Entertainment Inc. | Multi-threaded parallel processor methods and apparatus |
GB0703974D0 (en) * | 2007-03-01 | 2007-04-11 | Sony Comp Entertainment Europe | Entertainment device |
US8589943B2 (en) * | 2007-08-15 | 2013-11-19 | Sony Computer Entertainment Inc. | Multi-threaded processing with reduced context switching |
CN101398803B (zh) * | 2007-09-28 | 2011-04-06 | 国际商业机器公司 | 管理数据移动的方法和使用该方法的细胞宽带引擎处理器 |
US8429349B2 (en) * | 2008-09-18 | 2013-04-23 | International Business Machines Corporation | Techniques for cache injection in a processor system with replacement policy position modification |
US8443146B2 (en) * | 2008-09-18 | 2013-05-14 | International Business Machines Corporation | Techniques for cache injection in a processor system responsive to a specific instruction sequence |
US8904064B2 (en) * | 2008-10-24 | 2014-12-02 | International Business Machines Corporation | Managing an out-of-order asynchronous heterogeneous remote direct memory access (RDMA) message queue |
US7870308B2 (en) * | 2008-12-23 | 2011-01-11 | International Business Machines Corporation | Programmable direct memory access engine |
US7870309B2 (en) | 2008-12-23 | 2011-01-11 | International Business Machines Corporation | Multithreaded programmable direct memory access engine |
US9336145B2 (en) * | 2009-04-09 | 2016-05-10 | International Business Machines Corporation | Techniques for cache injection in a processor system based on a shared state |
US8990582B2 (en) * | 2010-05-27 | 2015-03-24 | Cisco Technology, Inc. | Virtual machine memory compartmentalization in multi-core architectures |
EP3040896A1 (en) * | 2014-12-30 | 2016-07-06 | Gemalto Sa | Secure element |
Citations (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH09179834A (ja) * | 1995-12-25 | 1997-07-11 | Hitachi Ltd | 並列システムにおけるプロセスのスケジューリング方法 |
JP2001005679A (ja) * | 1999-06-24 | 2001-01-12 | Hitachi Ltd | 電子計算機における処理の中断/再開方法 |
JP2002007364A (ja) * | 2000-06-22 | 2002-01-11 | Fujitsu Ltd | 並列計算機システムのジョブスケジューリングを行うスケジューリング装置 |
JP2002207713A (ja) * | 2001-01-11 | 2002-07-26 | Matsushita Electric Ind Co Ltd | Cpu間データ通信方法および装置 |
WO2004015553A1 (en) * | 2002-08-13 | 2004-02-19 | Nokia Corporation | Computer architecture for executing a program in a secure of insecure mode |
JP2004246702A (ja) * | 2003-02-14 | 2004-09-02 | Toshiba Corp | 計算機システム、計算機装置、計算機システムにおけるデータアクセス方法及びプログラム |
JP2004320174A (ja) * | 2003-04-11 | 2004-11-11 | Matsushita Electric Ind Co Ltd | 認証システム、認証装置、認証方法 |
JP2005235229A (ja) * | 2004-02-20 | 2005-09-02 | Sony Computer Entertainment Inc | マルチプロセッサシステムにおけるプロセッサタスクの移動方法および装置 |
JP2005535953A (ja) * | 2002-08-13 | 2005-11-24 | ノキア コーポレイション | セキュアモードまたは非セキュアモードでプログラムを実行するコンピュータアーキテクチャ |
Family Cites Families (61)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3496551A (en) * | 1967-07-13 | 1970-02-17 | Ibm | Task selection in a multi-processor computing system |
US3596257A (en) | 1969-09-17 | 1971-07-27 | Burroughs Corp | Method and apparatus for allocating small memory spaces to a computer program |
US5047923A (en) | 1987-08-21 | 1991-09-10 | Siemens Aktiengesellschaft | Modularly structured digital communication system for interconnecting terminal equipment and public networks |
JPH01258135A (ja) | 1988-04-08 | 1989-10-16 | Nec Corp | トランザクション実行制御方式 |
US5185694A (en) | 1989-06-26 | 1993-02-09 | Motorola, Inc. | Data processing system utilizes block move instruction for burst transferring blocks of data entries where width of data blocks varies |
US5136712A (en) | 1989-06-29 | 1992-08-04 | Digital Equipment Corporation | Temporary object handling system and method in an object based computer operating system |
EP0416767A3 (en) | 1989-09-08 | 1992-04-29 | Digital Equipment Corporation | Position independent code location system |
US5452452A (en) * | 1990-06-11 | 1995-09-19 | Cray Research, Inc. | System having integrated dispatcher for self scheduling processors to execute multiple types of processes |
US5764017A (en) * | 1996-04-16 | 1998-06-09 | Iomega Corporation | Servo loop compensation technique exhibiting improved bandwith |
JP2809962B2 (ja) * | 1993-03-02 | 1998-10-15 | 株式会社東芝 | 資源管理方式 |
US5528513A (en) | 1993-11-04 | 1996-06-18 | Digital Equipment Corp. | Scheduling and admission control policy for a continuous media server |
US5745778A (en) * | 1994-01-26 | 1998-04-28 | Data General Corporation | Apparatus and method for improved CPU affinity in a multiprocessor system |
US5794017A (en) * | 1995-02-06 | 1998-08-11 | International Business Machines Corporation | Method and system of updating graphics memory in a graphics display system through multiple address transferring of pixel data |
US6728959B1 (en) * | 1995-08-08 | 2004-04-27 | Novell, Inc. | Method and apparatus for strong affinity multiprocessor scheduling |
US5832262A (en) * | 1995-09-14 | 1998-11-03 | Lockheed Martin Corporation | Realtime hardware scheduler utilizing processor message passing and queue management cells |
US6341324B1 (en) * | 1995-10-06 | 2002-01-22 | Lsi Logic Corporation | Exception processing in superscalar microprocessor |
US5978843A (en) | 1995-12-06 | 1999-11-02 | Industrial Technology Research Institute | Scalable architecture for media-on-demand servers |
EP0888585A1 (en) | 1996-03-19 | 1999-01-07 | Massachusetts Institute Of Technology | Computer system and computer implemented process for representing software system descriptions and for generating executable computer programs and computer system configurations from software system descriptions |
US5826081A (en) | 1996-05-06 | 1998-10-20 | Sun Microsystems, Inc. | Real time thread dispatcher for multiprocessor applications |
US6144986A (en) | 1997-03-27 | 2000-11-07 | Cybersales, Inc. | System for sorting in a multiprocessor environment |
US6003112A (en) | 1997-06-30 | 1999-12-14 | Intel Corporation | Memory controller and method for clearing or copying memory utilizing register files to store address information |
US6378072B1 (en) * | 1998-02-03 | 2002-04-23 | Compaq Computer Corporation | Cryptographic system |
US6295598B1 (en) | 1998-06-30 | 2001-09-25 | Src Computers, Inc. | Split directory-based cache coherency technique for a multi-processor computer system |
US6289369B1 (en) * | 1998-08-25 | 2001-09-11 | International Business Machines Corporation | Affinity, locality, and load balancing in scheduling user program-level threads for execution by a computer system |
US6463457B1 (en) * | 1999-08-26 | 2002-10-08 | Parabon Computation, Inc. | System and method for the establishment and the utilization of networked idle computational processing power |
US6665699B1 (en) * | 1999-09-23 | 2003-12-16 | Bull Hn Information Systems Inc. | Method and data processing system providing processor affinity dispatching |
DE60033615T2 (de) | 1999-10-21 | 2007-10-31 | International Business Machines Corp. | Verfahren und System, um das Verteilen von IP-Datagrammen auf mehrere Server gemäß einer definierten Strategie zu erzwingen |
GB2394336B (en) | 1999-11-19 | 2004-09-08 | Gen Dynamics Decisions Systems | Method of allocating memory |
US7058750B1 (en) | 2000-05-10 | 2006-06-06 | Intel Corporation | Scalable distributed memory and I/O multiprocessor system |
US6981260B2 (en) | 2000-05-25 | 2005-12-27 | International Business Machines Corporation | Apparatus for minimizing lock contention in a multiple processor system with multiple run queues when determining the threads priorities |
US7565651B1 (en) | 2000-05-25 | 2009-07-21 | Oracle International Corporation | Parallel task scheduling system for computers |
US20030154284A1 (en) * | 2000-05-31 | 2003-08-14 | James Bernardin | Distributed data propagator |
US6986052B1 (en) | 2000-06-30 | 2006-01-10 | Intel Corporation | Method and apparatus for secure execution using a secure memory partition |
US6502170B2 (en) | 2000-12-15 | 2002-12-31 | Intel Corporation | Memory-to-memory compare/exchange instructions to support non-blocking synchronization schemes |
US7233998B2 (en) * | 2001-03-22 | 2007-06-19 | Sony Computer Entertainment Inc. | Computer architecture and software cells for broadband networks |
US6526491B2 (en) | 2001-03-22 | 2003-02-25 | Sony Corporation Entertainment Inc. | Memory protection system and method for computer architecture for broadband networks |
US6785756B2 (en) | 2001-05-10 | 2004-08-31 | Oracle International Corporation | Methods and systems for multi-policy resource scheduling |
US6738378B2 (en) | 2001-08-22 | 2004-05-18 | Pluris, Inc. | Method and apparatus for intelligent sorting and process determination of data packets destined to a central processing unit of a router or server on a data packet network |
US7127477B2 (en) * | 2001-11-06 | 2006-10-24 | Everyware Solutions Inc. | Method and system for access to automatically synchronized remote files |
US7089547B2 (en) * | 2002-09-13 | 2006-08-08 | International Business Machines Corporation | Firmware updating |
US7039736B2 (en) | 2003-01-15 | 2006-05-02 | Hewlett-Packard Development Company, L.P. | Systems and methods for accessing bus-mastered system resources |
JP2004287801A (ja) | 2003-03-20 | 2004-10-14 | Sony Computer Entertainment Inc | 情報処理システム、情報処理装置、分散情報処理方法及びコンピュータプログラム |
US7236738B2 (en) * | 2003-08-01 | 2007-06-26 | Pathfire, Inc. | Multicast control systems and methods for dynamic, adaptive time, bandwidth,frequency, and satellite allocations |
US7516456B2 (en) | 2003-09-25 | 2009-04-07 | International Business Machines Corporation | Asymmetric heterogeneous multi-threaded operating system |
US7236998B2 (en) * | 2003-09-25 | 2007-06-26 | International Business Machines Corporation | System and method for solving a large system of dense linear equations |
US7523157B2 (en) * | 2003-09-25 | 2009-04-21 | International Business Machines Corporation | Managing a plurality of processors as devices |
US7478390B2 (en) | 2003-09-25 | 2009-01-13 | International Business Machines Corporation | Task queue management of virtual devices using a plurality of processors |
US7321958B2 (en) * | 2003-10-30 | 2008-01-22 | International Business Machines Corporation | System and method for sharing memory by heterogeneous processors |
US8028292B2 (en) | 2004-02-20 | 2011-09-27 | Sony Computer Entertainment Inc. | Processor task migration over a network in a multi-processor system |
US7614053B2 (en) | 2004-02-20 | 2009-11-03 | Sony Computer Entertainment Inc. | Methods and apparatus for task management in a multi-processor system |
DE102004009497B3 (de) * | 2004-02-27 | 2005-06-30 | Infineon Technologies Ag | Chipintegriertes Mehrprozessorsystem und Verfahren zur Kommunikation zwischen mehreren Prozessoren eines chipintegrierten Mehrprozessorsystems |
US7298377B2 (en) * | 2004-06-24 | 2007-11-20 | International Business Machines Corporation | System and method for cache optimized data formatting |
US7304646B2 (en) * | 2004-08-19 | 2007-12-04 | Sony Computer Entertainment Inc. | Image data structure for direct memory access |
US7522168B2 (en) | 2005-09-27 | 2009-04-21 | Sony Computer Entertainment Inc. | Cell processor task and data management |
US8037474B2 (en) | 2005-09-27 | 2011-10-11 | Sony Computer Entertainment Inc. | Task manager with stored task definition having pointer to a memory address containing required code data related to the task for execution |
US8316220B2 (en) | 2005-09-27 | 2012-11-20 | Sony Computer Entertainment Inc. | Operating processors over a network |
US7975269B2 (en) | 2005-09-27 | 2011-07-05 | Sony Computer Entertainment Inc. | Parallel processor methods and apparatus |
US7734827B2 (en) | 2005-09-27 | 2010-06-08 | Sony Computer Entertainment, Inc. | Operation of cell processors |
US7506123B1 (en) | 2005-09-27 | 2009-03-17 | Sony Computer Entertainment Inc. | Method and system for performing memory copy function on a cell processor |
US8141076B2 (en) | 2005-09-27 | 2012-03-20 | Sony Computer Entertainment Inc. | Cell processor methods and apparatus |
US7512745B2 (en) * | 2006-04-28 | 2009-03-31 | International Business Machines Corporation | Method for garbage collection in heterogeneous multiprocessor systems |
-
2005
- 2005-10-24 US US11/257,761 patent/US7734827B2/en active Active
-
2006
- 2006-09-22 EP EP06254904A patent/EP1768033A1/en not_active Withdrawn
- 2006-09-27 JP JP2006262024A patent/JP4719656B2/ja not_active Expired - Fee Related
-
2010
- 2010-05-25 US US12/787,344 patent/US8135867B2/en not_active Expired - Fee Related
Patent Citations (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH09179834A (ja) * | 1995-12-25 | 1997-07-11 | Hitachi Ltd | 並列システムにおけるプロセスのスケジューリング方法 |
JP2001005679A (ja) * | 1999-06-24 | 2001-01-12 | Hitachi Ltd | 電子計算機における処理の中断/再開方法 |
JP2002007364A (ja) * | 2000-06-22 | 2002-01-11 | Fujitsu Ltd | 並列計算機システムのジョブスケジューリングを行うスケジューリング装置 |
JP2002207713A (ja) * | 2001-01-11 | 2002-07-26 | Matsushita Electric Ind Co Ltd | Cpu間データ通信方法および装置 |
WO2004015553A1 (en) * | 2002-08-13 | 2004-02-19 | Nokia Corporation | Computer architecture for executing a program in a secure of insecure mode |
JP2005535953A (ja) * | 2002-08-13 | 2005-11-24 | ノキア コーポレイション | セキュアモードまたは非セキュアモードでプログラムを実行するコンピュータアーキテクチャ |
JP2004246702A (ja) * | 2003-02-14 | 2004-09-02 | Toshiba Corp | 計算機システム、計算機装置、計算機システムにおけるデータアクセス方法及びプログラム |
JP2004320174A (ja) * | 2003-04-11 | 2004-11-11 | Matsushita Electric Ind Co Ltd | 認証システム、認証装置、認証方法 |
JP2005235229A (ja) * | 2004-02-20 | 2005-09-02 | Sony Computer Entertainment Inc | マルチプロセッサシステムにおけるプロセッサタスクの移動方法および装置 |
Also Published As
Publication number | Publication date |
---|---|
EP1768033A1 (en) | 2007-03-28 |
US20070083755A1 (en) | 2007-04-12 |
JP2007095066A (ja) | 2007-04-12 |
US20100235651A1 (en) | 2010-09-16 |
US8135867B2 (en) | 2012-03-13 |
US7734827B2 (en) | 2010-06-08 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP4719656B2 (ja) | ネットワーク上におけるプロセッサ制御技術 | |
US11088846B2 (en) | Key rotating trees with split counters for efficient hardware replay protection | |
JP4719655B2 (ja) | ネットワーク上におけるプロセッサ制御技術 | |
KR100924043B1 (ko) | 보안 데이터 프로세싱 및 전송을 위한 방법들 및 장치들 | |
JP4226816B2 (ja) | マイクロプロセッサ | |
US7475257B2 (en) | System and method for selecting and using a signal processor in a multiprocessor system to operate as a security for encryption/decryption of data | |
US8356361B2 (en) | Secure co-processing memory controller integrated into an embedded memory subsystem | |
US7478235B2 (en) | Methods and systems for protecting data in USB systems | |
US20080104673A1 (en) | Architecture for virtual security module | |
JP6682752B2 (ja) | セキュアエンクレーブを用いてデータ暗号化を強化するための技術 | |
US20230129610A1 (en) | Multiple physical request interfaces for security processors | |
JP4643702B2 (ja) | マイクロプロセッサ | |
US8695102B2 (en) | Controlling execution of executables between partitions in a multi-partitioned data processing system | |
JP4375980B2 (ja) | マルチタスク実行システム及びマルチタスク実行方法 | |
KR20090059602A (ko) | 세션 메모리 버스를 구비한 암호화 장치 | |
US20240070091A1 (en) | Isolation of memory regions in trusted domain | |
US20220245252A1 (en) | Seamless firmware update mechanism | |
US20070168299A1 (en) | Method and system for protection and security of IO devices using credentials | |
CN117546165A (zh) | 安全加密的通信机制 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20090722 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20100816 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20100824 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20101025 |
|
A711 | Notification of change in applicant |
Free format text: JAPANESE INTERMEDIATE CODE: A712 Effective date: 20101126 |
|
RD02 | Notification of acceptance of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7422 Effective date: 20101220 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20110118 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20110311 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20110329 |
|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20110404 |
|
R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20140408 Year of fee payment: 3 |
|
LAPS | Cancellation because of no payment of annual fees |