JP4296209B2 - 回路内プログラミング構造を埋め込んだプロセッサ - Google Patents
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1.デバイスは回路内プログラミング要求を受け取る。
2.イニシエータが確認される。
3.デバイスは識別子を要求のイニシエータに戻す。
4.パーティがうまく確認されると、情報交換が進行する。
5.回路内プログラミングを始めるため、プログラムの実行がチップの不揮発性メモリの回路内プログラムルーチンにジャンプする。
6.回路内プログラミングルーチンがそれ自身又は少なくともICPの核をチップのメモリの別のバンクに複製する。
7.回路内プログラミングソフトウェアはそれ自身を不能にし、複製されたICPシーケンスを起動する。
8.複製されたICPシーケンスは新しい回路内プログラミングソフトウェアを元のICPの位置にダウンロードする。
9.複製されたICPシーケンスはそれ自身を不能にし、元のフラッシュアレイの新しいICPソフトウェアで起動する。
10.正常のプログラムの実行がその後再開される。
不揮発性メモリセルの第1及び第2のメモリアレイは集積回路上に提供されている。第1メモリアレイは不揮発性セルの特定のブロックに回路内プログラミング命令セットを記憶する。外部ポートは集積回路上に提供され、それによりデータが外部の情報源から受け取られる。制御論理回路はICPコードにプロセツサと核を含み、回路内プログラミング更新指令に応答して、第1メモリアレイから回路内プログラミング命令セットのコピーを第2メモリアレイに書き込むと共に第2メモリから回路内プログラミング命令セットを第1メモリアレイの不揮発性メモリセルを外部ポートから受け取ったデータでプログラムさせる。集積回路のデータ経路は回路内プログラミング命令セットから独立して第1メモリアレイをプログラムすると共に確認するために提供される。別の実施例では、外部ポートはシリアルポートとパラレルポートを含んでいる。更なる別の実施例では、デバイス上の複数の外部ポートと、回路内プログラミングシーケンスが回路内プログラミングソフトウェア自体により指定されている間の使用のために選択されたものがある。
1.第1の消去可能でプログラム可能な読み出し専用メモリアレイと第2の消去可能でプログラム可能な読み出し専用メモリアレイを集積回路上に提供すること、
2.第1アレイに回路内プログラミング命令セットを記憶すること、
3.集積回路の外部のイニシエータから回路内プログラム指令を受け取ること、
4.回路内プログラム指令に応じて、第1アレイから回路内プログラミング命令セットを第2アレイにコピーし、第2アレイから回路内プログラミング命令セツトをプロセッサで実行すること、
5.回路内プログラミング命令セットの制御下で、少なくとも第1アレイの選択した部分を外部の情報源からのデータでプログラムすること、及び
6.第1アレイのその部分をプログラムした後、第1アレイから回路内プログラミング命令セットをプロセッサで実行すること、を含んでいる。
第1段階はイニシエータを含み、集積回路上のI/Oポートを介してICP修正要求を送る(ブロック201)。マイクロコントローラはイニシエータの識別子を検査し、その要求を実行する(ブロック202)。識別子検査が失敗した場合、アルゴリズムは失敗の限界数が起きたかどうかを決定する(ブロック203)。テストが何回も失敗した場合、その後マイクロコントローラはイニシエータに認識の失敗応答を発行し(ブロック204)、図2Cの点Cに分岐する。ブロック202のテストが何回も失敗しなかった場合、その後マイクロコントローラはイニシエータにイニシエータの識別子の要求を発行し(ブロック205)、ブロック201に分岐する。ブロック202のイニシエータの識別子テストが合格した場合、マイクロコントローラのイニシエータは更新を確認する改訂番号を発行する(ブロック206)。次に、マイクロコントローラは次の段階でICP修正要求を認識し確認する(ブロック207)。例えば、1つの実施例では、マイクロコントローラはICP認識指令を発行し、ICPイニシエータに戻す。イニシエータは肯定応答で応答し、ICP通信路を開放する。
11 マイクロプロセッサ11
12 シリアルポート
13 パラレルポート
14 割り込みピン
15 シングルピン
16 不揮発性メモリの第1アレイ
17 不揮発メモリの第2アレイ
20 プログラミング正常経路
21 正常確認経路
24 読み出しポート
25 読み出しポート
26 コード入力多重装置
28 命令入力
27 確認多重装置
29 読み出し入力29
30 消去/プログラムセレクタ
31 線
32 線
35 線
36 消去/プログラムポート
38 線
40 回路内プログラミング命令セット
400 集積回路
401 プリント回路板
402 集積回路
403 集積回路
404 集積回路
405 集積回路
406 通信路
407 ICPイニシエータ(ワークステーション、パーソナルコンピュータ)
408 通信路
409 大規模記憶装置
Claims (1)
- プロセッサによる実行のための命令を記憶し、フローティングゲートメモリセルを含む不揮発性メモリセルを含み、第1メモリアレイをプログラミングするためのプログラミング命令セットを含む第1メモリアレイと、
前記プロセッサによる実行のための命令を記憶する不揮発性メモリセルを含む第2メモリアレイと、
データが外部の情報源から受け取られる外部ポートと、
回路内プログラムのプログラミング指令に応答し、第1メモリアレイからプログラミング命令セットのコピーを第2メモリアレイに書き込むと共に、前記第1メモリアレイに記憶された前記プログラミング命令セットを少なくともプログラミングし、その後制御論理回路が前記第1メモリアレイに記憶された前記プログラミングされたプログラミング命令セットを前記プロセッサが実行することができるように、前記プロセッサに第2メモリアレイから前記プログラミング命令セットを実行させて前記外部ポートからのデータで前記第1メモリアレイの不揮発性メモリセルをプログラミングさせる制御論理回路とを含む、
ことを特徴とする命令のプログラムを実行するプロセッサを有する集積回路の回路内プログラミング用装置。
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JP2007206979A JP4296209B2 (ja) | 2007-08-08 | 2007-08-08 | 回路内プログラミング構造を埋め込んだプロセッサ |
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JP52040298A Division JP4291881B2 (ja) | 1996-10-28 | 1996-10-28 | 回路内プログラミング構造を埋め込んだプロセッサ |
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Family Applications (1)
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