JP4251551B2 - Inspection ROM system - Google Patents
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Description
本発明は、プリント回路基板や周辺装置(以下、ターゲットPCB、単にターゲットと記す)を検査するための検査ROMシステムに関し、特に処理動作や実行手順の変更を、ソフトウェアコードを変更することなく実現する検査ROMシステムに関する。 The present invention relates to an inspection ROM system for inspecting a printed circuit board and peripheral devices (hereinafter referred to as a target PCB, simply referred to as a target), and in particular, changes in processing operation and execution procedure are realized without changing software code. about the inspection ROM system.
従来、ターゲットPCBを検査するためのシステムは、ホスト側の制御PC部と、プログラマブル検査回路部と、ターゲットPCBとのインタフェース部(フィクスチャー)とで構成されている。制御PC部は、テスト条件の設定、検査状況のモニタリング、結果の表示、および検査回路への必要データのダウンロードなどの役割を持ち、プログラマブル検査回路部は、検査モジュール(PLD)を用いることで、ターゲットPCB毎に一部の検査回路の変更で対応可能にしており、また大容量メモリを用いることで、フルカラーのデータ検証も可能にしている。インタフェース部は、ターゲットPCB毎に作成しており、バッファ程度の回路により小型化を可能にしている。
一方、検査ROMは、個別ブロックの検査プログラムを自己診断部としてROMに格納し、制御PC部およびプログラマブル検査回路部との連携により検査を実行している。
Conventionally, a system for inspecting a target PCB includes a control PC unit on the host side, a programmable inspection circuit unit, and an interface unit (fixture) with the target PCB. The control PC unit has roles such as setting test conditions, monitoring the inspection status, displaying results, and downloading necessary data to the inspection circuit, and the programmable inspection circuit unit uses the inspection module (PLD), It is possible to respond by changing some inspection circuits for each target PCB, and full-color data verification is also possible by using a large-capacity memory. The interface unit is created for each target PCB and can be miniaturized by a circuit of a buffer level.
On the other hand, the inspection ROM stores an individual block inspection program in the ROM as a self-diagnosis unit, and executes the inspection in cooperation with the control PC unit and the programmable inspection circuit unit.
この検査ROMは、ターゲットPCBを制御するファームウェア(制御プログラム)であって、機種毎に開発が必要であり、そのため開発工数およびそのための費用がかかっていた。さらに、被検査用PCBとの高機能の検査を実施するためには、検査側に検査プログラムが必要、かつPCB毎に検査プログラムが必要であって、そのために開発費がかかっていた。 This inspection ROM is firmware (control program) for controlling the target PCB, and needs to be developed for each model. Therefore, the development man-hours and the costs for the development are required. Furthermore, in order to perform a high-function inspection with the PCB to be inspected, an inspection program is required on the inspection side, and an inspection program is required for each PCB, which requires development costs.
前述のように、ターゲットPCBに対する従来の汎用検査システムでは、ターゲットPCBに搭載されたターゲット自身を制御する検査ROMを、ターゲット毎に内容をプログラミングによって作り変え、そのプログラムをROMに書き込む作業が必要であった。
まず、汎用検査システムにおいて、検査対象のターゲット検査ROMは、その特性から容易に内部処理の変更ができなかった。また、検査ROMに搭載されるプログラムは、予めプログラミングされた内容によってのみ動作し、ターゲットPCBを処理している。ターゲットの処理を制御コマンドによる動作の集合とみなし、外部であるホストPC部から制御コマンドを転送して、ターゲットPCBを自由に処理させられるようにしたい。
As described above, in the conventional general-purpose inspection system for the target PCB, it is necessary to change the content of the inspection ROM for controlling the target mounted on the target PCB by programming for each target and write the program in the ROM. there were.
First, in the general-purpose inspection system, the target inspection ROM to be inspected cannot easily change the internal processing due to its characteristics. Further, the program installed in the inspection ROM operates only according to preprogrammed contents and processes the target PCB. The target processing is regarded as a set of operations by the control command, and the control command is transferred from the external host PC unit so that the target PCB can be processed freely.
(目的)
本発明の目的は、上記のような従来の課題を解決し、検査ROMに対して、デバッグを含むプログラミングの工数削減と、不具合等によるプログラム変更の柔軟性、および、治具ROM内容設計に関する設計者スキルの難易度の低下を行うことが可能な検査ROMシステムを提供することにある。
(the purpose)
The object of the present invention is to solve the above-mentioned conventional problems, reduce the number of programming steps including debugging, and change the program due to defects, etc., and design related to jig ROM content design It is to provide an inspection ROM system capable of reducing the difficulty level of a person skilled in the art.
本発明の検査ROMシステムは、検査ROMがホストPC部とターゲットPCB間の通信でハンドシェークを行い、ターゲットPCBの検査を行う検査システムにおいて、ホストPC部との通信を行う通信インタフェース部と、ホストPC部からロードされたテストブロックをターゲットPCBの記憶媒体(RAM等)に格納する記憶部と、ホストPC部からロードされたテストブロックNO.を記憶するテストブロックNO.記憶部と、テストブロックの各データの解釈(インタープリタ)を行うコマンド解釈部と、指定されたテストブロックがあるか否かを検索する検索部とを有し、該検査ROMは、ホストPC部が要求したテストブロックNO.と一致するテストブロックNO.が上記テストブロックNO.記憶部内に既にあればターゲットの記憶媒体に格納されたデータで実行し、なければ、当該テストブロックNO.のテストブロックの要求をホストPC部に送り、当該テストブロックを取得して、検査を実行することを特徴としている。 The inspection ROM system of the present invention includes a communication interface unit that communicates with the host PC unit in the inspection system in which the inspection ROM performs handshaking by communication between the host PC unit and the target PCB, and inspects the target PCB. A storage unit for storing the test block loaded from the storage unit in a storage medium (such as RAM) of the target PCB, and a test block No. 2 loaded from the host PC unit. Test block NO. A storage unit, a command interpretation unit that interprets (interpreters) each data of the test block, and a search unit that searches whether or not there is a designated test block. Requested test block No. Test block NO. Is the above test block NO. If it is already in the storage unit, it is executed with the data stored in the target storage medium. The test block request is sent to the host PC unit, the test block is acquired, and the inspection is executed.
本発明によれば、以下のような効果を奏する。
テストブロックをターゲットの記憶媒体に格納しておき、ホストPC部が要求したテストブロックNO.と一致するテストブロックがないときのみ、ホストPC部側に要求するので、無駄なロード時間を省くことができる。
The present invention has the following effects.
The test block is stored in the target storage medium, and the test block NO. Since there is a request to the host PC unit only when there is no test block that matches, useless load time can be saved .
(第1の実施例)
図1は本発明の第1の実施例に係る検査ROMシステムの構成図、図2は同じく第1の実施例に係る記憶部内のデータ格納図、および、図4は同じく第1の実施例に係る検査システムのブロック図である。
図1に示すように、本実施例の検査システムでは、ホストPC部11と、プログラマブル検査回路部12と、ターゲットPCB13と、ターゲットPCB13とのインタフェース部である検査ROM(ICカードまたはSDカード等)14とから構成されている。
ここで、11aはパソコン(PC部)の表示部であり、ホストPC部11とターゲットPCB13とを直接接続する線路は通信インタフェースである。なお、15は、第5の実施例で用いられる記憶媒体(ICカードまたはSDカード等)であって、第1の実施例では使用しない。ホストPC部11とプログラマブル検査回路部12とで、検査機を構成している。
(First embodiment)
FIG. 1 is a block diagram of an inspection ROM system according to the first embodiment of the present invention, FIG. 2 is a data storage diagram in the storage unit according to the first embodiment, and FIG. 4 is also according to the first embodiment. It is a block diagram of the inspection system which concerns.
As shown in FIG. 1, in the inspection system of the present embodiment, an inspection ROM (such as an IC card or an SD card) that is an interface unit between the
Here, 11a is a display unit of a personal computer (PC unit), and a line directly connecting the
従来の技術では、前述のように、ターゲットPCBに搭載されたターゲット自身を制御する治具ROM14を、ターゲット毎に内容をプログラミングによって作り変え、そのプログラムをROMに書き込む作業が必要であった。
そのため、既に提案されている技術では、ターゲット毎にプログラミングすることなく、ホストPC部11内の編集部でテストのためのコマンドを編集して、ターゲットPCB13側のROM14にロードすることが行われる。
しかし、上述のように、テスト項目毎にテストブロックをターゲットPCB側のROM14にロードする方法は、極めて時間がかかるとともに、通信回数も増大し、しかも、ある処理に関して同一のテストブロックを使用する場合もあるにもかかわらず、重複してテストブロックをロードする必要があるので、通信時間と転送方法に無駄があった。
In the prior art, as described above, the
For this reason, in the already proposed technology, a test command is edited by the editing unit in the
However, as described above, the method of loading the test block into the
本実施例では、図2に示すように、予めホストPC部11から編集されたテストブロックを検査ROM14内の記憶部にロードしておく。例えば、図2に示すように、最上部の記憶エリアにROMコード21を、下方の記憶エリアにデータブロックa・・・データブロックnを格納しておく。そして、ホストPC部11からテスト要求があったときには、そのテストに必要なテストブロックNO.(例えば、データブロックNO.a,NO.b,NO.c,・・・・NO.n)のうち、NO.cのみが存在しないことを検出したならば、検査ROM14からホストPC部11に対して存在しないデータブロックNO.を通知してデータブロックの転送を要求する。すなわち、本実施例では、テストブロックNO.記憶部を検索することにより、必要なブロックのうち存在しないブロックを検出し、それだけをホストPC部に要求する。
これにより、無駄なロード時間を省くことができる。
In this embodiment, as shown in FIG. 2, a test block edited in advance from the
Thereby, useless load time can be saved.
図4に示すように、本実施例の検査システムでは、ホストPC部11に、通信部41、記憶部42、編集部43を設けるとともに、治具ROM14内に、通信部44、記憶部46、テストブロックNO.記憶部47、コマンド解釈部48、検索部47およびコマンド処理部45が設けられる。ホストPC部11とターゲットPCB13間の通信インタフェースを介してハンドシェークが行われ、ターゲットPCB13の検査が行われる。ホストPC部11からロードされたテストブロックは、ターゲットPCB13側の記憶媒体(RAM等)14に格納される。図4では、治具ROM14内の記憶部51のデータエリアに格納される。また、ホストPC部11からロードされたテストブロックNO.は、治具ROM14内のテストブロックNO.記憶部47に格納される。
ホストPC部11から指定されたテストブロックNO.を上記テストブロックNO.記憶部47内から検索部49が検索することで、必要なデータブロックの存在または不存在を判定する
As shown in FIG. 4, in the inspection system of the present embodiment, the
The test block No. specified from the
ホストPC部11が要求したテストブロックNO.と一致するテストブロックNO.が既に存在すれば、ターゲットPCB13側のコマンド解釈部48がテストブロックの各データの解釈(インタープリット)を行い、コマンド処理部45がそのテストブロックを実行する。
一方、ホストPC部11が要求したテストブロックNO.と一致するテストブロックがテストブロックNO.記憶部47にない場合には、通信部44はテストブロックの要求をホストPC部11に送り、当該テストブロックをホストPC部11内の編集部43に作成してもらい、そのテストブロックを取得した後、検査ROM内のコマンド解釈部48でコマンドの解釈を行い、コマンド処理部45によりテストを実行する。
Test block No. requested by the
On the other hand, the test block NO. The test block that matches the test block NO. If it is not in the
(第2の実施例)
図5は、本発明の第2の実施例に係る検査システムのブロック図である。なお、検査システムの全体図および記憶部内のデータ構成は、第1の実施例(図1、図2)と同じである。
既に提案されている技術では、ターゲット毎にプログラミングすることなく、ホストPC部11内の編集部でテストのためのコマンドを編集して、ターゲットPCB13側のROM14Aにロードすることが行われる。この場合には、検査実施の度に、ホストPC部11からテストブロックのデータを送り込む必要があるため、その転送分だけは検査時間としてのロスが発生している。
本実施例では、このようなロスの発生を回避するものであって、予めROM14Aに必要なテストブロックを蓄積しておく。ホストPC部11からテストデータを被検査機毎にロードすることなく、ROM14Aでは、ホストPC部11からの通信コマンドでテストブロックを識別し、書き込まれたテストブロックデータエリアから指定されたブロックのデータを順次取り込むことで、被検査機毎にホストPC部11との通信インタフェースによるデータ転送の時間を省く。
(Second embodiment)
FIG. 5 is a block diagram of an inspection system according to the second embodiment of the present invention. The overall view of the inspection system and the data structure in the storage unit are the same as those in the first embodiment (FIGS. 1 and 2).
In the technology already proposed, a test command is edited by the editing unit in the
In this embodiment, such a loss is avoided, and necessary test blocks are stored in the
図5に示すように、検査ROM14A内には、第1の実施例で必要な通信部44、コマンド処理部45、記憶部46、テストブロックNO.記憶部47、コマンド解釈部48、および検索部49の他に、プリフェッチ部50が新たに設けられる。
プリフェッチ部50は、コマンド解釈部48がホストPC部11からの通信コマンドでテストブロックを識別したならば、それを基に記憶部46に書き込まれたテストブロックデータエリアから指定されたブロックのデータを順次取り込む。
本実施例によれば、ホストPC部11からテストデータを被検被機毎にロードすることなく、1被検査機の検査ができるため、被検査機毎にホストPC部11との通信インタフェースによるデータ転送の時間を省くことができる。その結果、検査時間の短縮、すなわち、製造コストの軽減が可能となる。
As shown in FIG. 5, in the
When the
According to the present embodiment, since one test apparatus can be inspected without loading the test data from the
図5により動作を説明する。デバッグ、調整終了などの確立されたテストブロックデータを、予め検査ROM14のデータエリア(記憶部46)に書き込んでおく。
ホストPC部11の通信部41と検査ROM14内の通信部44との間では、通信インタフェースで接続されており、ホストPC部11からの通信コマンドでテストブロックNO.などの識別情報が送られると、検査ROM14内のコマンド解釈部48はテストブロックを識別し、識別結果をプリフェッチ部50に通知する。プリフェッチ部50は、記憶部46の書き込まれたテストブロックデータエリアから指定されたブロックのデータを順次読み出し、取り込む。コマンド解釈部48は、そのデータを解釈して、コマンド処理部45に通知すると、コマンド処理部45はテストコマンドを順次実行して、テストブロックの実行を終了する。
The operation will be described with reference to FIG. Established test block data, such as debugging and adjustment completion, is written in advance in the data area (storage unit 46) of the
The
(第3の実施例)
図3は、本発明の第3の実施例に係る治具ROM内のプログラム構造図、図6は同じく第3の実施例に係るターゲットPCBと検査ROM内の機能ブロック図である。
従来の技術では、ユニット単体での検査において、一部のインタフェースを接続して検査を行うため、製品として組み込まれた時に動作できる製品ファームをそのまま使用することができず、必然的に処理を限定した検査ROMを必要としていた。従って、機種が発生する度に、その検査ROM自体の開発が必要となり、開発工数おな開発費が発生していた。
そこで、本実施例では、ホストPC部11から送られたテストブロックデータを製品ファームに埋め込むことができるようにして、ターゲットPCB13の製品ファームと通信インタフェースを介してハンドシェークをとり、検査に必要なテストブロックをターゲットPCB13に送信することで、製品ファーム内のメモリに格納する。
これにより、検査用の制御開発は、その機種に応じた設定情報であるテストブロックを作成するだけで、検査を実現することができるため、検査用のROM開発およびターゲットPCB側には検査用ROMのインタフェースを持つことが不要となり、検査開発の工数軽減、および、ターゲットPCBの部品(回路)のコスト軽減を図ることが可能となる。
(Third embodiment)
FIG. 3 is a program structure diagram in the jig ROM according to the third embodiment of the present invention, and FIG. 6 is a functional block diagram in the target PCB and the inspection ROM according to the third embodiment.
In the conventional technology, in the inspection of a single unit, since a part of the interface is connected and the inspection is performed, it is not possible to use a product farm that can operate when incorporated as a product, and processing is necessarily limited. Needed an inspection ROM. Therefore, every time a model is generated, it is necessary to develop the inspection ROM itself, and a development cost corresponding to the development man-hour is generated.
Therefore, in this embodiment, the test block data sent from the
As a result, the control development for the inspection can realize the inspection simply by creating the test block which is the setting information corresponding to the model. Therefore, the development of the inspection ROM and the inspection ROM on the target PCB side are possible. Therefore, it is possible to reduce the number of inspection and development processes and the cost of parts (circuits) of the target PCB.
図3は、検査ROM14内の製品ソフトウェアの構造図であって、従来はターゲットPCB内には、製品ソフト(アプリケーション)32とファームウェア33とそれらにより制御されるハードウェア(H/W)34のみが配置されていたが、本実施例では、検査用部31をこの中に埋め込む。検査用部31には、ホストPC部11から送られたテストブロックが格納されるとともに、予め基本動作テスト用ソフトも格納されている。
図6に示すように、本実施例のターゲットPCB13と検査ROM14の構成を示しており、ターゲットPCB13には、ホストPC部11と通信を行う通信部44Bと、その通信部44BとホストPC部11の通信部41との間で通信インタフェースが接続されていることを検知する通信検知部51と、通信インタフェースが接続されていれば、通信部44Bを起動させるように状態を切り替える切替部52と、製品ファーム記憶部53とが設けられる。製品ファーム記憶部53には、ホストPC部11から送られたテストブロックデータと、予め記憶されている基本動作テスト用ソフトとを記憶するエリア53Aと、製品アプリケーションを記憶するエリア53Bと、製品ファームウェアを記憶するエリア53Cが設けられる。ホストPC部11からの通信インタフェースは、ターゲットPCB13あるいは検査ROM14の一方に接続されており、通信検知部51により、ホストPC部11との通信インタフェースがターゲットPCB13側に接続されていることを検知したならば、切替部52によりターゲットPCB13側に切り替える。この時点以降は、通信部44Bが動作可能となる。
FIG. 3 is a structural diagram of the product software in the
As shown in FIG. 6, the configuration of the
(第4の実施例)
以下、本発明の第4の実施例を説明する。図6は、本実施例にも適用される。
前述の第3の実施例では、テストブロックデータを検査する度に毎回、ホストPC部11からターゲットPCB13内の製品ファーム記憶部53にロードしている。この場合には、ターゲットPCB毎にホストPC部11との通信インタフェースによるデータ転送に時間がかかり、検査時間もそれだけ長くなる。
本実施例では、テストブロックデータを検査する度にロードすることなく、テストブロックのみを予め検査ROM用記憶媒体(ICカード、SDカード等)に格納しておくことで、製品ファームがホストPC部11から指定されたテストブロックを製品ファーム記憶部53から呼び出すことにより、テストを実行する。なお、呼び出すソフトは、予め製品ファーム記憶部53に記憶されている基本動作テスト用ソフトである。
このように、本実施例では、ホストPC部11からテストデータをターゲットPCB13毎にロードすることなく、1ターゲットの検査ができるので、ターゲットPCB毎にホストPC部11との通信インタフェースによるデータ転送の時間を省くことができ、検査時間の短縮、つまり製造コストの軽減につながる。
(Fourth embodiment)
The fourth embodiment of the present invention will be described below. FIG. 6 also applies to this embodiment.
In the third embodiment described above, every time the test block data is inspected, it is loaded from the
In this embodiment, the test firmware is not loaded every time the test block data is inspected, but only the test block is stored in advance in the storage medium for inspection ROM (IC card, SD card, etc.), so that the product firmware can be stored in the host PC unit. The test is executed by calling the test block designated from 11 from the product
As described above, in this embodiment, since one target can be inspected without loading the test data from the
本実施例のROM検査方法は、デバッグまたは調整が終了し、確立されたテストブロックのデータを予めターゲットPCB13内の製品ファーム用記憶部53に書き込んでおく方法であって、図6に示すように、ホストPC部11との間の通信インタフェースが接続されていることを通信検知部51が検知したとき、通信部44Bが動作するように切替え、通信部44BがホストPC部11と通信することにより、製品ファーム用記憶部53に記憶されている基本動作テスト用ソフトが、ホストPC部11から指示されたテストブロックNO.のブロックデータを製品ファーム用記憶部46Bの検査用エリア53Aから検索し、取り出されたテストブロックデータを解釈し、ターゲットPCB13のテストを実行する。
The ROM inspection method according to the present embodiment is a method in which debugging or adjustment is completed and data of an established test block is written in advance in the product
(第5の実施例)
図1は、本発明の第5の実施例に係るROM検査方法の説明図である。
図1における15は、本実施例に必要な部品である拡張メモリインタフェースに接続されたICカードまたはSDカードなどの治具である。
前述の第3の実施例では、テストブロックデータを検査する度に毎回、ホストPC部11からターゲットPCB13内の製品ファーム記憶部53にロードしている。この方法では、ターゲットPCB毎にホストPC部11との通信インタフェースによるデータ転送の時間がかかる。
本実施例では、第4の実施例とは異なる方法でテータ転送時間がかからないようにした。
本実施例は、ターゲットPCB13をテストするテストブロックを格納できる拡張メモリインタフェースを設け、検査機側、すなわち図1ではPC部11にそのインタフェースに拡張メモリエリアを有する治具(ICカード、SDカードなど)15を接続することで、テストブロックの実行がホストPC部11のみで設定および実行を行うことが可能になる。
(Fifth embodiment)
FIG. 1 is an explanatory diagram of a ROM inspection method according to a fifth embodiment of the present invention.
In the third embodiment described above, every time the test block data is inspected, it is loaded from the
In this embodiment, the data transfer time is not increased by a method different from that of the fourth embodiment.
In this embodiment, an extended memory interface capable of storing a test block for testing the
すなわち、ホストPC部11に拡張メモリインタフェースを取り付け、そこに治具(ICカード、SDカードなど)15を接続する。この治具(ICカードなど)15に、図5の記憶部46内のテストブロックが全て記憶されている場合には、それ以外の制御部をホストPC部11内の制御部を利用することにより、通信インタフェースを介してホストPC部11から直接ターゲットPCB13をテストすることができる。
また、図6の製品ファーム記憶部53の基本動作テスト用ソフトとテストブロックが両方とも記憶されている場合には、基本動作テスト用ソフトが指定されたテストブロックを呼び出し、コマンド解釈して、通信インタフェースを介してターゲットPCB13にコマンドを送出することで、テストを実行することができる。
なお、検査機を構成するプログラマブル検査回路部12に、拡張メモリインタフェースを取り付け、そこに治具15を接続しても、同じようにしてターゲットPCBのテストを実行することができる。
これにより、図1に示す検査ROM14は不要となり、拡張メモリの治具15のみでターゲットPCB13のテストが可能となる。
That is, an extended memory interface is attached to the
If both the basic operation test software and the test block in the product
Even if an extended memory interface is attached to the programmable
As a result, the
11…ホストPC部、11a…ホストPC部の表示部、
12…プログラマブル検査回路部、13…ターゲットPCB、14…検査ROM、
15…拡張メモリ用治具、21…ROMコード、22,23…データブロックa〜n、
31…検査用部、32…製品ソフト(アプリケーション)、33…ファームウェア、
34…ハードウェア(H/W)、14A…第2の実施例の検査ROM、
41…ホストPC部内の通信部、42…ホストPC部内の記憶部、
43…ホストPC内の編集部、44…検査ROM内の通信部、
45…検査ROM内のコマンド処理部、46…検査ROM内の記憶部、
47…検査ROM内のテストブロックNO.記憶部、
44B…ターゲットPCB内の通信部、48…検査ROM内のコマンド解釈部、
49…検査ROM内の検索部、50…検査ROM内のプリフェッチ部、
51…ターゲットPCB内の通信検知部、52…ターゲットPCB内の切替部、
53…製品ファーム記憶部、
53A…基本動作テスト用ソフトおよびテストブロックエリア、
53B…製品アプリケーションエリア、53C…ファームウェアエリア。
11: Host PC section, 11a: Display section of host PC section,
12 ... Programmable inspection circuit unit, 13 ... Target PCB, 14 ... Inspection ROM,
15 ... Expansion memory jig, 21 ... ROM code, 22, 23 ... Data blocks a to n,
31 ... inspection unit, 32 ... product software (application), 33 ... firmware,
34: Hardware (H / W), 14A: Inspection ROM of the second embodiment,
41 ... Communication unit in the host PC unit, 42 ... Storage unit in the host PC unit,
43 ... Editing unit in the host PC, 44 ... Communication unit in the inspection ROM,
45 ... Command processing unit in the inspection ROM, 46 ... Storage unit in the inspection ROM,
47 ... Test block No. in the inspection ROM Storage unit,
44B ... Communication unit in the target PCB, 48 ... Command interpretation unit in the inspection ROM,
49 ... Search unit in inspection ROM, 50 ... Prefetch unit in inspection ROM,
51 ... Communication detection unit in the target PCB, 52 ... Switching unit in the target PCB,
53. Product firmware storage unit,
53A: Basic operation test software and test block area,
53B: Product application area, 53C: Firmware area.
Claims (1)
該検査ROMに、ホストPC部との通信を行う通信インタフェース手段と、該ホストPC部からロードされたテストブロックを格納する記憶手段と、該ホストPC部からロードされたテストブロックNO.を記憶するテストブロックNO.記憶手段と、該テストブロックの各データの解釈を行うコマンド解釈手段と、指定された該テストブロックがあるか否かを検索する検索手段と、コマンド処理を実行するコマンド処理手段とを備え、
該検索手段は、該ホストPC部が要求したテストブロックNO.と一致するテストブロックNO.が上記テストブロックNO.記憶手段内に既にあれば、
該コマンド解釈手段は、該テストブロック記憶手段に格納されたテストブロックを読み出して、該テストブロックを解釈し、
該コマンド処理手段は、被検査用のターゲットPCBに対してテストを実行し、
該通信インタフェース手段は、要求されたテストブロックNO.が該記憶手段内になければ、当該テストブロックNO.のテストブロックの要求をホストPC部に送り、当該テストブロックを取得して、該コマンド解釈手段および実行手段に該テストブロックを渡して、検査を実行することを特徴とする検査ROMシステム。 In the inspection system that performs handshaking by communication between the host PC unit and the inspection ROM on the target PCB side and inspects the target PCB,
A communication interface means for communicating with the host PC section, a storage means for storing a test block loaded from the host PC section, and a test block NO. Test block NO. Storage means, command interpretation means for interpreting each data of the test block, search means for searching whether there is the specified test block, command processing means for executing command processing,
The search means includes a test block No. requested by the host PC unit. Test block NO. Is the above test block NO. If already in storage,
The command interpretation means reads the test block stored in the test block storage means, interprets the test block,
The command processing means executes a test on the target PCB to be inspected,
The communication interface means sends the requested test block NO. Is not in the storage means, the test block NO. A test ROM system characterized in that a test block request is sent to a host PC unit, the test block is acquired, the test block is passed to the command interpretation means and execution means, and the test is executed.
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