JP3398707B2 - データ伝送方法及びデータ伝送装置 - Google Patents
データ伝送方法及びデータ伝送装置Info
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- H04J—MULTIPLEX COMMUNICATION
- H04J3/00—Time-division multiplex systems
- H04J3/16—Time-division multiplex systems in which the time allocation to individual channels within a transmission cycle is variable, e.g. to accommodate varying complexity of signals, to vary number of channels transmitted
- H04J3/1605—Fixed allocated frame structures
- H04J3/1611—Synchronous digital hierarchy [SDH] or SONET
- H04J3/1617—Synchronous digital hierarchy [SDH] or SONET carrying packets or ATM cells
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- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Time-Division Multiplex Systems (AREA)
- Data Exchanges In Wide-Area Networks (AREA)
- Communication Control (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
Description
【０００１】
【発明の属する技術分野】本発明はデータ伝送方法及び
データ伝送装置に関し、特にＳＯＮＥＴ（Ｓｙｎｃｈｒ
ｏｎｏｕｓ Ｏｐｔｉｃａｌ Ｎｅｔｗｏｒｋ：同期光
ネットワーク）やＳＤＨ（Ｓｙｎｃｈｒｏｎｏｕｓ Ｄ
ｉｇｉｔａｌ Ｈｉｅｒａｒｃｈｙ：同期ディジタルハ
イアラーキ）システムにおけるデータ伝送方法及びデー
タ伝送装置に関する。
データ伝送装置に関し、特にＳＯＮＥＴ（Ｓｙｎｃｈｒ
ｏｎｏｕｓ Ｏｐｔｉｃａｌ Ｎｅｔｗｏｒｋ：同期光
ネットワーク）やＳＤＨ（Ｓｙｎｃｈｒｏｎｏｕｓ Ｄ
ｉｇｉｔａｌ Ｈｉｅｒａｒｃｈｙ：同期ディジタルハ
イアラーキ）システムにおけるデータ伝送方法及びデー
タ伝送装置に関する。
【０００２】
【従来の技術】ＳＤＨはＩＴＵ−Ｔ勧告Ｇ．７０７〜
Ｇ．７０９に規定され、また、ＳＯＮＥＴはＡＮＳＩに
て規定されている、一般的なディジタルデータ伝送方式
である。ＳＯＮＥＴ又はＳＤＨ（以下ＳＯＮＥＴ／ＳＤ
Ｈ）は、データフレームがオーバヘッド領域とペイロー
ド領域とで構成される。ペイロード領域に収容されるペ
イロードの先頭の相対位置を示すポインタをオーバヘッ
ド領域の所定位置に含むことにより、ペイロード領域の
任意の位置を先頭としてペイロードを収容できる。
Ｇ．７０９に規定され、また、ＳＯＮＥＴはＡＮＳＩに
て規定されている、一般的なディジタルデータ伝送方式
である。ＳＯＮＥＴ又はＳＤＨ（以下ＳＯＮＥＴ／ＳＤ
Ｈ）は、データフレームがオーバヘッド領域とペイロー
ド領域とで構成される。ペイロード領域に収容されるペ
イロードの先頭の相対位置を示すポインタをオーバヘッ
ド領域の所定位置に含むことにより、ペイロード領域の
任意の位置を先頭としてペイロードを収容できる。
【０００３】従来の第１のデータ伝送装置である、一般
的なＳＯＮＥＴ／ＳＤＨフレーム構造体は、ペイロード
領域にＡＴＭ（Ａｓｙｎｃｈｒｏｎｏｕｓ Ｔｒａｎｓ
ｆｅｒ Ｍｏｄｅ：非同期転送モード）セルをマッピン
グしていた。ＡＴＭセルは、セルヘッダ５バイト＋デー
タ長４８バイトから成る固定長セルである。従って、転
送データに対するオーバヘッドが一定である。
的なＳＯＮＥＴ／ＳＤＨフレーム構造体は、ペイロード
領域にＡＴＭ（Ａｓｙｎｃｈｒｏｎｏｕｓ Ｔｒａｎｓ
ｆｅｒ Ｍｏｄｅ：非同期転送モード）セルをマッピン
グしていた。ＡＴＭセルは、セルヘッダ５バイト＋デー
タ長４８バイトから成る固定長セルである。従って、転
送データに対するオーバヘッドが一定である。
【０００４】この種のディジタル通信システムにおいて
は、近年の転送速度の６２２Ｍｂｐｓ，２．４Ｇｂｐｓ
及び１０Ｇｂｐｓ等への高速化に対応して、転送データ
に対するオーバヘッドを小さくして有効帯域を広げフレ
キシブルな転送を可能とすることが要求されている。
は、近年の転送速度の６２２Ｍｂｐｓ，２．４Ｇｂｐｓ
及び１０Ｇｂｐｓ等への高速化に対応して、転送データ
に対するオーバヘッドを小さくして有効帯域を広げフレ
キシブルな転送を可能とすることが要求されている。
【０００５】このための実現手段として、現在、ＩＥＴ
Ｆ（Ｉｎｔｅｒｎｅｔ ｅｎｇｉｎｅｅｒｉｎｇ Ｔａ
ｓｋ Ｆｏｒｃｅ）からＰＯＳ（Ｐｏｉｎｔ ｔｏ Ｐ
ｏｉｎｔ Ｐｒｏｔｏｃａｌ（ＰＰＰ） Ｏｖｅｒ Ｓ
ＯＮＥＴ／ＳＤＨ（ポイント・ツー・ポイント・プロト
コル（ＰＰＰ）オーバＳＯＮＥＴ／ＳＤＨ）という新た
なプロトコルが提案されている（ＩＥＴＦ Ｎｅｔｗｏ
ｒｋｉｎｇ Ｇｒｏｕｐ−ＲＦＣ−１６１９“Ｐｏｉｎ
ｔ ｔｏ Ｐｏｉｎｔ Ｐｒｏｔｏｃｏｌ（ＰＰＰ）ｏ
ｖｅｒ ＳＯＮＥＴ／ＳＤＨ Ｓｐｅｃｉｆｉｃａｔｉ
ｏｎ”（文献１）、ＩＥＴＦ Ｎｅｔｗｏｒｋｉｎｇ
Ｇｒｏｕｐ−ＲＦＣ−１６６１“Ｐｏｉｎｔ ｔｏ Ｐ
ｏｉｎｔ Ｐｒｏｔｏｃｏｌ（ＰＰＰ）”（文献２）、
及びＩＥＴＦ Ｎｅｔｗｏｒｋｉｎｇ Ｇｒｏｕｐ−Ｒ
ＦＣ−１６６２“ＰＰＰ ｉｎＨＤＬＣ ｌｉｋｅ ｆ
ｒａｍｉｎｇ”（文献３）。
Ｆ（Ｉｎｔｅｒｎｅｔ ｅｎｇｉｎｅｅｒｉｎｇ Ｔａ
ｓｋ Ｆｏｒｃｅ）からＰＯＳ（Ｐｏｉｎｔ ｔｏ Ｐ
ｏｉｎｔ Ｐｒｏｔｏｃａｌ（ＰＰＰ） Ｏｖｅｒ Ｓ
ＯＮＥＴ／ＳＤＨ（ポイント・ツー・ポイント・プロト
コル（ＰＰＰ）オーバＳＯＮＥＴ／ＳＤＨ）という新た
なプロトコルが提案されている（ＩＥＴＦ Ｎｅｔｗｏ
ｒｋｉｎｇ Ｇｒｏｕｐ−ＲＦＣ−１６１９“Ｐｏｉｎ
ｔ ｔｏ Ｐｏｉｎｔ Ｐｒｏｔｏｃｏｌ（ＰＰＰ）ｏ
ｖｅｒ ＳＯＮＥＴ／ＳＤＨ Ｓｐｅｃｉｆｉｃａｔｉ
ｏｎ”（文献１）、ＩＥＴＦ Ｎｅｔｗｏｒｋｉｎｇ
Ｇｒｏｕｐ−ＲＦＣ−１６６１“Ｐｏｉｎｔ ｔｏ Ｐ
ｏｉｎｔ Ｐｒｏｔｏｃｏｌ（ＰＰＰ）”（文献２）、
及びＩＥＴＦ Ｎｅｔｗｏｒｋｉｎｇ Ｇｒｏｕｐ−Ｒ
ＦＣ−１６６２“ＰＰＰ ｉｎＨＤＬＣ ｌｉｋｅ ｆ
ｒａｍｉｎｇ”（文献３）。
【０００６】従来の第２のデータ伝送方法であるＰＯＳ
のＳＯＮＥＴ／ＳＤＨフレームフォーマットの一例を示
す図５を参照すると、ＰＯＳのＳＯＮＥＴ／ＳＤＨフレ
ーム構造体は、ＳＯＨ（セクションオーバヘッド）３６
バイト、ＰＯＨ（パスオーバヘッド）１バイト、固定ス
タッフ３バイトの後のペイロードキャパシテイ（以下ペ
イロード領域）１０４０バイトの計１０８０バイト９行
から構成される。このペイロード領域にＨＤＬＣ（Ｈｉ
ｇｈ Ｌｅｖｅｌ Ｄａｔａ Ｌｉｎｃ Ｃｏｎｔｒｏ
ｌ Ｐｒｏｃｅｄｕｒｅ：ハイレベルデータリンク制御
手順）フレーム形式の可変長データをマッピングする。
のＳＯＮＥＴ／ＳＤＨフレームフォーマットの一例を示
す図５を参照すると、ＰＯＳのＳＯＮＥＴ／ＳＤＨフレ
ーム構造体は、ＳＯＨ（セクションオーバヘッド）３６
バイト、ＰＯＨ（パスオーバヘッド）１バイト、固定ス
タッフ３バイトの後のペイロードキャパシテイ（以下ペ
イロード領域）１０４０バイトの計１０８０バイト９行
から構成される。このペイロード領域にＨＤＬＣ（Ｈｉ
ｇｈ Ｌｅｖｅｌ Ｄａｔａ Ｌｉｎｃ Ｃｏｎｔｒｏ
ｌ Ｐｒｏｃｅｄｕｒｅ：ハイレベルデータリンク制御
手順）フレーム形式の可変長データをマッピングする。
【０００７】後述する物理（ＰＨＹ）レイアデバイス
は、回線からの受信データより、ＨＤＬＣフレームデー
タを抽出し上位レイアデバイスに抽出したＨＤＬＣデー
タをパケット単位で送出する。また、上位レイアデバイ
スからのＨＤＬＣデータをＳＯＮＥＴ／ＳＤＨフレーム
上にマッピングして回線側に送出している。
は、回線からの受信データより、ＨＤＬＣフレームデー
タを抽出し上位レイアデバイスに抽出したＨＤＬＣデー
タをパケット単位で送出する。また、上位レイアデバイ
スからのＨＤＬＣデータをＳＯＮＥＴ／ＳＤＨフレーム
上にマッピングして回線側に送出している。
【０００８】ＰＯＳにおいては、転送データ長が任意で
あるＨＤＬＣフレームデータをＳＯＮＥＴ／ＳＤＨフレ
ームにマッピングすることにより、従来の第１のデータ
伝送装置のＳＯＮＥＴ／ＳＤＨフレームにおけるＡＴＭ
セル（セルヘッダ５バイト＋データ長４８バイト）に比
べ有効帯域を広げることが可能となっている。
あるＨＤＬＣフレームデータをＳＯＮＥＴ／ＳＤＨフレ
ームにマッピングすることにより、従来の第１のデータ
伝送装置のＳＯＮＥＴ／ＳＤＨフレームにおけるＡＴＭ
セル（セルヘッダ５バイト＋データ長４８バイト）に比
べ有効帯域を広げることが可能となっている。
【０００９】ＨＤＬＣフレームデータは、アドレスＡ１
バイト、制御部１バイト、可変長のデータ部Ｄ及びＦＣ
Ｓ（フレームチエックシーケンス）部ＦＣＳ２／４バイ
トとから成る。
バイト、制御部１バイト、可変長のデータ部Ｄ及びＦＣ
Ｓ（フレームチエックシーケンス）部ＦＣＳ２／４バイ
トとから成る。
【００１０】しかし、ＨＤＬＣフレームデータにおいて
は、データ７Ｄｈ，７Ｅｈをアボ−トコードとして、ま
たデータ７Ｅｈをフラグシーケンスコードとしてそれぞ
れ処理するため、フレームデータ中の７Ｄｈ，７Ｅｈを
制御コードであるアボートコード／フラグシーケンスコ
ードと区別する必要がある。このため、ため、図６に示
すスタッフ処理を行っている。
は、データ７Ｄｈ，７Ｅｈをアボ−トコードとして、ま
たデータ７Ｅｈをフラグシーケンスコードとしてそれぞ
れ処理するため、フレームデータ中の７Ｄｈ，７Ｅｈを
制御コードであるアボートコード／フラグシーケンスコ
ードと区別する必要がある。このため、ため、図６に示
すスタッフ処理を行っている。
【００１１】スタッフ処理とは、転送対象のフレームデ
ータ中に７Ｄｈ、又は、７Ｅｈのコードが含まれる場合
には、スタッフバイト７Ｄｈを挿入し、その後、データ
７Ｄｈ，７Ｅｈに２０ｈを排他的論理和（ＥＸＯＲ）し
て転送する処理である。
ータ中に７Ｄｈ、又は、７Ｅｈのコードが含まれる場合
には、スタッフバイト７Ｄｈを挿入し、その後、データ
７Ｄｈ，７Ｅｈに２０ｈを排他的論理和（ＥＸＯＲ）し
て転送する処理である。
【００１２】従って、転送データの内容によっては、オ
ーバヘッドが増え有効帯域を低減してしまう。
ーバヘッドが増え有効帯域を低減してしまう。
【００１３】また、ＡＴＭセルのようにセル単位のデー
タ管理ができないためバイト単位の管理が別途必要とな
るという２つの問題点がある。
タ管理ができないためバイト単位の管理が別途必要とな
るという２つの問題点がある。
【００１４】ここで、具体的な動作の例として１５００
バイトのデータを転送する場合について従来技術と対比
して説明すると、まず、ＡＴＭセルを用いる従来の第１
のデータ伝送方法では、ＡＴＭセルのセル長は５３バイ
トであり、１セル当たり４８バイトのデータを転送でき
るので、１５００／４８＝３１＋１２／５３より、３２
セルの転送が必要になる。従って、 転送データの内容
とは無関係に転送バイト数は３２×５３＝１６９６バイ
トとなる。
バイトのデータを転送する場合について従来技術と対比
して説明すると、まず、ＡＴＭセルを用いる従来の第１
のデータ伝送方法では、ＡＴＭセルのセル長は５３バイ
トであり、１セル当たり４８バイトのデータを転送でき
るので、１５００／４８＝３１＋１２／５３より、３２
セルの転送が必要になる。従って、 転送データの内容
とは無関係に転送バイト数は３２×５３＝１６９６バイ
トとなる。
【００１５】次に、ＨＤＬＣフレームを用いる従来の第
２のデータ伝送方法において、１５００バイトの全てに
７Ｄｈ、もしくは７Ｅｈが含まれない場合は、１５００
＋６（オーバヘッド分）＝１５０６バイトの転送でよ
い。しかし、転送データが１５００バイトの７Ｄｈ、も
しくは７Ｅｈであり、ＦＣＳ部が４バイトのデータを転
送する場合、１５００バイト全てスタッフ処理される。
その結果、１５００×２＋６（オーバヘッド分）＝３０
０６バイトの転送が必要となる。
２のデータ伝送方法において、１５００バイトの全てに
７Ｄｈ、もしくは７Ｅｈが含まれない場合は、１５００
＋６（オーバヘッド分）＝１５０６バイトの転送でよ
い。しかし、転送データが１５００バイトの７Ｄｈ、も
しくは７Ｅｈであり、ＦＣＳ部が４バイトのデータを転
送する場合、１５００バイト全てスタッフ処理される。
その結果、１５００×２＋６（オーバヘッド分）＝３０
０６バイトの転送が必要となる。
【００１６】
【発明が解決しようとする課題】上述した従来の第１の
データ伝送方法及びデータ伝送装置は、ペイロード領域
に固定長のＡＴＭセルをマッピングするのでオーバヘッ
ドが一定であり、転送速度の高速化への対応が困難であ
るという欠点があった。
データ伝送方法及びデータ伝送装置は、ペイロード領域
に固定長のＡＴＭセルをマッピングするのでオーバヘッ
ドが一定であり、転送速度の高速化への対応が困難であ
るという欠点があった。
【００１７】可変長のフレームデータを用いるて転送デ
ータに対するオーバヘッドを小さくして有効帯域を広げ
フレキシブルな転送を可能とすることにより上記欠点の
解消を図った従来の第２のデータ伝送方法及びデータ伝
送装置は、転送データの特定のコードが制御コードであ
るアボートコード／フラグシーケンスコードと同一であ
り、両者を区別するため、上記コードをスタッフ処理す
る必要があり、この処理の結果、転送データの内容によ
ってはオーバヘッドが増加し有効帯域を低減してしまう
という欠点があった。
ータに対するオーバヘッドを小さくして有効帯域を広げ
フレキシブルな転送を可能とすることにより上記欠点の
解消を図った従来の第２のデータ伝送方法及びデータ伝
送装置は、転送データの特定のコードが制御コードであ
るアボートコード／フラグシーケンスコードと同一であ
り、両者を区別するため、上記コードをスタッフ処理す
る必要があり、この処理の結果、転送データの内容によ
ってはオーバヘッドが増加し有効帯域を低減してしまう
という欠点があった。
【００１８】また、ＡＴＭセルのようにセル単位のデ−
タ管理ができないためバイト単位の管理が別途必要とな
るという欠点があった。
タ管理ができないためバイト単位の管理が別途必要とな
るという欠点があった。
【００１９】本発明の目的は、上記欠点を解決し、転送
データの内容に依存せずに確実に有効帯域を拡大できる
とともに、別途のバイト単位の管理を不要とするデータ
伝送方法及びデータ伝送装置を提供することにある。
データの内容に依存せずに確実に有効帯域を拡大できる
とともに、別途のバイト単位の管理を不要とするデータ
伝送方法及びデータ伝送装置を提供することにある。
【００２０】
【課題を解決するための手段】本発明のデータ伝送方法
は、オーバヘッド領域とペイロード領域とを含み該ペイ
ロード領域の任意の位置にペイロードを収容できるデー
タフレームを用いるデータ伝送方法において、前記デー
タフレーム上にマッピングするデータフォーマットとし
て、前記データフレームが前記オーバヘッド領域とペイ
ロード領域とを含むセル長が一定の長さの既存の様式の
第１のデータフレームセルのセル長のｎ（正の整数）倍
であり、かつセル長を示すデータ長表示部を前記オーバ
ヘッド領域の情報であるオーバヘッド情報として含む可
変長の第２のデータフレームセルを有することを特徴と
するものである。
は、オーバヘッド領域とペイロード領域とを含み該ペイ
ロード領域の任意の位置にペイロードを収容できるデー
タフレームを用いるデータ伝送方法において、前記デー
タフレーム上にマッピングするデータフォーマットとし
て、前記データフレームが前記オーバヘッド領域とペイ
ロード領域とを含むセル長が一定の長さの既存の様式の
第１のデータフレームセルのセル長のｎ（正の整数）倍
であり、かつセル長を示すデータ長表示部を前記オーバ
ヘッド領域の情報であるオーバヘッド情報として含む可
変長の第２のデータフレームセルを有することを特徴と
するものである。
【００２１】また、前記データフレームが、ＳＯＮＥＴ
（同期光ネットワーク）／ＳＤＨ（同期ディジタルハイ
アラーキ）システムのデータフレームであり、前記第１
のデータフレームセルが、前記ＳＯＮＥＴ（／ＳＤＨシ
ステムのデータフレームセルであるセル長５３バイトの
ＡＴＭ（非同期転送モード）セルであることを特徴とし
ても良い。
（同期光ネットワーク）／ＳＤＨ（同期ディジタルハイ
アラーキ）システムのデータフレームであり、前記第１
のデータフレームセルが、前記ＳＯＮＥＴ（／ＳＤＨシ
ステムのデータフレームセルであるセル長５３バイトの
ＡＴＭ（非同期転送モード）セルであることを特徴とし
ても良い。
【００２２】また、前記第２のデータフレームセルのセ
ル長が前記第１のデータフレームセルのセル長の１（ｎ
＝１）倍の場合は、前記第１のデータフレームセルを用
いるデータ伝送システムをそのまま使用できるバックコ
ンパチビリティを有することを特徴としても良い。
ル長が前記第１のデータフレームセルのセル長の１（ｎ
＝１）倍の場合は、前記第１のデータフレームセルを用
いるデータ伝送システムをそのまま使用できるバックコ
ンパチビリティを有することを特徴としても良い。
【００２３】さらに、前記第２のデータフレームセル
が、１バイトの前記データ長表示部を含む６バイトのオ
ーバヘッド情報と、｛４７＋５３×（ｎ−１）｝バイト
のデータ部とを有することを特徴としても良い。
が、１バイトの前記データ長表示部を含む６バイトのオ
ーバヘッド情報と、｛４７＋５３×（ｎ−１）｝バイト
のデータ部とを有することを特徴としても良い。
【００２４】本発明のデータ伝送装置は、オーバヘッド
領域とペイロード領域とを含み該ペイロード領域の任意
の位置にペイロードを収容できるデータフレーム上にマ
ッピングするデータフォーマットとして、前記データフ
レームが前記オーバヘッド領域とペイロード領域とを含
むセル長が一定の長さの既存の様式の第１のデータフレ
ームセルのセル長のｎ（正の整数）倍であり、かつセル
長を示すデータ長表示部を前記オーバヘッド領域の情報
であるオーバヘッド情報として含む可変長の第２のデー
タフレームセルを生成／分解する物理レイヤデバイスを
有するデータ伝送装置において、伝送回線からの入力で
ある受信入力データにオーバヘッド処理及び受信した前
記第２のデータフレームセルの処理を含む受信処理を行
い受信処理データを出力する受信処理部と、送信データ
の供給を受けオーバヘッド処理及び送信対象の前記第２
のデータフレームセルの処理を含む送信データ処理を行
い前記伝送回線に送信出力データとして出力する送信処
理部と、前記受信処理データを受信データとして上位レ
イヤに出力し、この上位レイヤから供給を受ける前記送
信データを前記送信処理部に入力することにより前記上
位レイヤと前記受信処理部及び前記送信処理部とをイン
タフエースするインタフエース部とを備えて構成され
る。
領域とペイロード領域とを含み該ペイロード領域の任意
の位置にペイロードを収容できるデータフレーム上にマ
ッピングするデータフォーマットとして、前記データフ
レームが前記オーバヘッド領域とペイロード領域とを含
むセル長が一定の長さの既存の様式の第１のデータフレ
ームセルのセル長のｎ（正の整数）倍であり、かつセル
長を示すデータ長表示部を前記オーバヘッド領域の情報
であるオーバヘッド情報として含む可変長の第２のデー
タフレームセルを生成／分解する物理レイヤデバイスを
有するデータ伝送装置において、伝送回線からの入力で
ある受信入力データにオーバヘッド処理及び受信した前
記第２のデータフレームセルの処理を含む受信処理を行
い受信処理データを出力する受信処理部と、送信データ
の供給を受けオーバヘッド処理及び送信対象の前記第２
のデータフレームセルの処理を含む送信データ処理を行
い前記伝送回線に送信出力データとして出力する送信処
理部と、前記受信処理データを受信データとして上位レ
イヤに出力し、この上位レイヤから供給を受ける前記送
信データを前記送信処理部に入力することにより前記上
位レイヤと前記受信処理部及び前記送信処理部とをイン
タフエースするインタフエース部とを備えて構成され
る。
【００２５】また、前記受信処理部が、前記伝送回線か
らの受信入力データの入力インタフェースを行う受信回
線Ｉ／Ｆ部と、前記受信入力データのオーバヘッド処理
を行う受信セクションＯ／Ｈ処理部と受信ラインＯ／Ｈ
処理部及び受信パスＯ／Ｈ処理部と、受信した前記第２
のデータフレームセルを処理する第２の受信データフレ
ームセル処理部と、前記第１のデータフレームセルを処
理する第１の受信データフレームセル処理部とを備え、
前記送信処理部が、前記インタフエース部から供給を受
けた送信対象の前記第２のデータフレームセルを処理す
る第２の送信データフレームセル処理部と、送信対象の
前記第１のデータフレームセルを処理する第１の送信デ
ータフレームセル処理部と、送信出力データのオーバヘ
ッド処理を行う送信パスＯ／Ｈ処理部と送信ラインＯ／
Ｈ処理部及び送信セクションＯ／Ｈ処理部と、前記伝送
回線への送信出力データの出力インタフェースを行う送
信回線Ｉ／Ｆ部とを備えても良い。
らの受信入力データの入力インタフェースを行う受信回
線Ｉ／Ｆ部と、前記受信入力データのオーバヘッド処理
を行う受信セクションＯ／Ｈ処理部と受信ラインＯ／Ｈ
処理部及び受信パスＯ／Ｈ処理部と、受信した前記第２
のデータフレームセルを処理する第２の受信データフレ
ームセル処理部と、前記第１のデータフレームセルを処
理する第１の受信データフレームセル処理部とを備え、
前記送信処理部が、前記インタフエース部から供給を受
けた送信対象の前記第２のデータフレームセルを処理す
る第２の送信データフレームセル処理部と、送信対象の
前記第１のデータフレームセルを処理する第１の送信デ
ータフレームセル処理部と、送信出力データのオーバヘ
ッド処理を行う送信パスＯ／Ｈ処理部と送信ラインＯ／
Ｈ処理部及び送信セクションＯ／Ｈ処理部と、前記伝送
回線への送信出力データの出力インタフェースを行う送
信回線Ｉ／Ｆ部とを備えても良い。
【００２６】また、前記受信データフレームセル処理部
が、受信ＦＩＦＯ制御部を備え、前記第２の送信データ
フレームセル処理部が、送信ＦＩＦＯ制御部を備え、前
記受信ＦＩＦＯ制御部が、受信ＦＩＦＯのメモリ部を構
成し前記ライトデータを一時格納し対応する前記リード
データを出力する受信ＲＡＭと、前記第２の受信データ
フレームセルの前記受信ＲＡＭへ書き込み制御を行い受
信ライトアドレスの生成と受信ライトデータの整列を行
う受信ライト制御部と、前記受信ＲＡＭが書き込み可能
状態であるかを判定する受信ライト可能状態判定部と、
前記受信ＲＡＭの書込時のライトデータの容量超過であ
るオーバフローを判定するオーバフロー判定部とを有
し、受信側回線クロックで動作する回路ブロックから成
る受信側回線クロック系と、前記受信ＲＡＭのリードア
ドレスの生成及びリードデータの整列を行うリード制御
部と、前記受信ＲＡＭが読み出し可能状態であるかを判
定するリード可能状態判定部と、前記受信ＲＡＭの読出
時のリードデータ不足であるアンダフローを判定するア
ンダフロー判定部とを有し受信クロックで動作する回路
ブロックから成る受信クロック系とを備え、前記送信Ｆ
ＩＦＯ制御部が、送信ＦＩＦＯのメモリ部を構成しライ
トデータを一時格納し対応するリードデータを出力する
前記送信ＲＡＭと、送信ＲＡＭのリードアドレスの生成
及びリードデータの整列を行うリード制御部と、前記送
信ＲＡＭが読み出し可能状態であるかを判定するリード
可能状態判定部と、前記送信ＲＡＭの読出時のリードデ
ータ不足であるアンダフローを判定するアンダフロー判
定部とを有し、送信側回線クロックで動作する回路ブロ
ックから成る送信側回線クロック系と、入力された前記
第２の送信データフレームセルの前記送信ＲＡＭへの書
き込み制御とライトアドレスの生成とライトデータの整
列を行う送信ライト制御部と、前記送信ＲＡＭの書込時
のライトデータの容量超過であるオーバフローを判定す
るオーバフロー判定部と、前記送信ＲＡＭが書き込み可
能状態であるかを判定するライト可能状態判定部と、前
記第２の送信データフレームセルの書込の未完了状態を
判定するアンフィニッシュ判定部とを有し、送信クロッ
クで動作する回路ブロックから成る送信クロック系とを
備えても良い。
が、受信ＦＩＦＯ制御部を備え、前記第２の送信データ
フレームセル処理部が、送信ＦＩＦＯ制御部を備え、前
記受信ＦＩＦＯ制御部が、受信ＦＩＦＯのメモリ部を構
成し前記ライトデータを一時格納し対応する前記リード
データを出力する受信ＲＡＭと、前記第２の受信データ
フレームセルの前記受信ＲＡＭへ書き込み制御を行い受
信ライトアドレスの生成と受信ライトデータの整列を行
う受信ライト制御部と、前記受信ＲＡＭが書き込み可能
状態であるかを判定する受信ライト可能状態判定部と、
前記受信ＲＡＭの書込時のライトデータの容量超過であ
るオーバフローを判定するオーバフロー判定部とを有
し、受信側回線クロックで動作する回路ブロックから成
る受信側回線クロック系と、前記受信ＲＡＭのリードア
ドレスの生成及びリードデータの整列を行うリード制御
部と、前記受信ＲＡＭが読み出し可能状態であるかを判
定するリード可能状態判定部と、前記受信ＲＡＭの読出
時のリードデータ不足であるアンダフローを判定するア
ンダフロー判定部とを有し受信クロックで動作する回路
ブロックから成る受信クロック系とを備え、前記送信Ｆ
ＩＦＯ制御部が、送信ＦＩＦＯのメモリ部を構成しライ
トデータを一時格納し対応するリードデータを出力する
前記送信ＲＡＭと、送信ＲＡＭのリードアドレスの生成
及びリードデータの整列を行うリード制御部と、前記送
信ＲＡＭが読み出し可能状態であるかを判定するリード
可能状態判定部と、前記送信ＲＡＭの読出時のリードデ
ータ不足であるアンダフローを判定するアンダフロー判
定部とを有し、送信側回線クロックで動作する回路ブロ
ックから成る送信側回線クロック系と、入力された前記
第２の送信データフレームセルの前記送信ＲＡＭへの書
き込み制御とライトアドレスの生成とライトデータの整
列を行う送信ライト制御部と、前記送信ＲＡＭの書込時
のライトデータの容量超過であるオーバフローを判定す
るオーバフロー判定部と、前記送信ＲＡＭが書き込み可
能状態であるかを判定するライト可能状態判定部と、前
記第２の送信データフレームセルの書込の未完了状態を
判定するアンフィニッシュ判定部とを有し、送信クロッ
クで動作する回路ブロックから成る送信クロック系とを
備えても良い。
【００２７】
【発明の実施の形態】次に、本発明の実施の形態につい
て図面を参照して詳細に説明する。
て図面を参照して詳細に説明する。
【００２８】本実施の形態のデータ伝送方法及びデータ
伝送装置は、ＳＯＮＥＴ（Ｓｙｎｃｈｒｏｎｏｕｓ Ｏ
ｐｔｉｃａｌ Ｎｅｔｗｏｒｋ：同期光ネットワーク）
／ＳＤＨ（Ｓｙｎｃｈｒｏｎｏｕｓ Ｄｉｇｉｔａｌ
Ｈｉｅｒａｒｃｈｙ：同期ディジタルハイアラーキ）シ
ステムのデータフレームであるＳＯＮＥＴ／ＳＤＨフレ
ームと同様に、オーバヘッド領域とペイロード領域とを
含み該ペイロード領域の任意の位置にペイロードを収容
できるデータフレームを用いるデータ伝送方法におい
て、データフレーム上にマッピングするデータフォーマ
ットとして、データ長がＡＴＭセルのセル長である５３
バイトのｎ（任意の整数）倍で、かつ、データ長表示部
をオーバヘッド情報として有し、以下説明の便宜上「マ
ルチコネクトＡＴＭセル」と呼ぶ新たな可変長セルを有
する新たなプロトコルを用いる。これにより、従来のＡ
ＴＭセルやＨＤＬＣフレームデータと比較して転送デー
タ内容に依存せずに有効帯域を広げることを可能とす
る。
伝送装置は、ＳＯＮＥＴ（Ｓｙｎｃｈｒｏｎｏｕｓ Ｏ
ｐｔｉｃａｌ Ｎｅｔｗｏｒｋ：同期光ネットワーク）
／ＳＤＨ（Ｓｙｎｃｈｒｏｎｏｕｓ Ｄｉｇｉｔａｌ
Ｈｉｅｒａｒｃｈｙ：同期ディジタルハイアラーキ）シ
ステムのデータフレームであるＳＯＮＥＴ／ＳＤＨフレ
ームと同様に、オーバヘッド領域とペイロード領域とを
含み該ペイロード領域の任意の位置にペイロードを収容
できるデータフレームを用いるデータ伝送方法におい
て、データフレーム上にマッピングするデータフォーマ
ットとして、データ長がＡＴＭセルのセル長である５３
バイトのｎ（任意の整数）倍で、かつ、データ長表示部
をオーバヘッド情報として有し、以下説明の便宜上「マ
ルチコネクトＡＴＭセル」と呼ぶ新たな可変長セルを有
する新たなプロトコルを用いる。これにより、従来のＡ
ＴＭセルやＨＤＬＣフレームデータと比較して転送デー
タ内容に依存せずに有効帯域を広げることを可能とす
る。
【００２９】また、上記マルチコネクトＡＴＭセルのセ
ル長をｎ＝１にすると、既存のＡＴＭ−ＬＡＮをそのま
ま使用でき、バックコンパチビリティを保つことができ
る。
ル長をｎ＝１にすると、既存のＡＴＭ−ＬＡＮをそのま
ま使用でき、バックコンパチビリティを保つことができ
る。
【００３０】さらに、データ長を５３バイトの整数倍に
することにより、ＡＴＭセルと同様に送信／受信装置の
データ一次蓄積手段であるＦＩＦＯ（Ｆｉｒｓｔ−Ｉｎ
−Ｆｉｒｓｔ−Ｏｕｔ：早入早出メモリ）を制御するこ
とが出来るため、ＡＴＭセルを処理するＰＨＹレイヤデ
バイスに「マルチコネクトＡＴＭセル」を適用してもＦ
ＩＦＯ制御を共有することが可能になる。
することにより、ＡＴＭセルと同様に送信／受信装置の
データ一次蓄積手段であるＦＩＦＯ（Ｆｉｒｓｔ−Ｉｎ
−Ｆｉｒｓｔ−Ｏｕｔ：早入早出メモリ）を制御するこ
とが出来るため、ＡＴＭセルを処理するＰＨＹレイヤデ
バイスに「マルチコネクトＡＴＭセル」を適用してもＦ
ＩＦＯ制御を共有することが可能になる。
【００３１】以上３点を特徴とするものである。
【００３２】次に、本発明の第１の実施の形態をＳＯＮ
ＥＴ、ＳＴＳ１２ｃ／ＳＤＨのＳＴＭ４−ｃのフレーム
にマルチコネクトＡＴＭセルをマッピングしたフレーム
フォーマットの一例を示す図１を参照すると、この図に
示す本実施の形態のデータ伝送方法におけるＳＯＮＥＴ
／ＳＤＨフレームは、ＳＯＨ（セクションオーバヘッ
ド）３６バイト、ＰＯＨ（パスオーバヘッド）１バイ
ト、固定スタッフ３バイトの後のペイロードキャパシテ
イ（以下ペイロード領域）１０４０バイトの計１０８０
バイト９行から構成され、このペイロード領域に、５３
×ｎバイトの可変長セルであるマルチコネクトＡＴＭセ
ルをマッピングする。任意の１つのマルチコネクトＡＴ
Ｍセルの前後にはＩＤＬＥセルを挿入する。
ＥＴ、ＳＴＳ１２ｃ／ＳＤＨのＳＴＭ４−ｃのフレーム
にマルチコネクトＡＴＭセルをマッピングしたフレーム
フォーマットの一例を示す図１を参照すると、この図に
示す本実施の形態のデータ伝送方法におけるＳＯＮＥＴ
／ＳＤＨフレームは、ＳＯＨ（セクションオーバヘッ
ド）３６バイト、ＰＯＨ（パスオーバヘッド）１バイ
ト、固定スタッフ３バイトの後のペイロードキャパシテ
イ（以下ペイロード領域）１０４０バイトの計１０８０
バイト９行から構成され、このペイロード領域に、５３
×ｎバイトの可変長セルであるマルチコネクトＡＴＭセ
ルをマッピングする。任意の１つのマルチコネクトＡＴ
Ｍセルの前後にはＩＤＬＥセルを挿入する。
【００３３】図１を再度参照すると、本実施の形態のマ
ルチコネクトＡＴＭセルは、４バイトのＡＴＭセルヘッ
ダ部ＡＨ、１バイトのＨＥＣバイト部ＨＥＣ、１バイト
のデータ長表示部ＤＬの計６バイトから成る固定長のオ
ーバヘッド部と、任意長、すなわち、４７＋５３×（ｎ
−１）バイトのデータ部Ｄとから構成される。
ルチコネクトＡＴＭセルは、４バイトのＡＴＭセルヘッ
ダ部ＡＨ、１バイトのＨＥＣバイト部ＨＥＣ、１バイト
のデータ長表示部ＤＬの計６バイトから成る固定長のオ
ーバヘッド部と、任意長、すなわち、４７＋５３×（ｎ
−１）バイトのデータ部Ｄとから構成される。
【００３４】次に、図１を参照して本実施の形態の動作
について説明すると、本実施の形態のマルチコネクトＡ
ＴＭセルはデータ長表示部ＤＬを設けていることによ
り、従来の第２の技術であるＰＯＳにおけるＨＤＬＣフ
レームデータのように、制御コード（７Ｅｈ）によりパ
ケットの区切りを判断する必要がないので、オーバヘッ
ド長はデータ内容に依存せず固定長となる。
について説明すると、本実施の形態のマルチコネクトＡ
ＴＭセルはデータ長表示部ＤＬを設けていることによ
り、従来の第２の技術であるＰＯＳにおけるＨＤＬＣフ
レームデータのように、制御コード（７Ｅｈ）によりパ
ケットの区切りを判断する必要がないので、オーバヘッ
ド長はデータ内容に依存せず固定長となる。
【００３５】また、転送サイズをＡＴＭセルのセル長で
ある５３バイトの整数倍にしたことにより、ＡＴＭセル
同様に送信／受信装置のデータ一次蓄積手段であるＦＩ
ＦＯを制御することが出来る。
ある５３バイトの整数倍にしたことにより、ＡＴＭセル
同様に送信／受信装置のデータ一次蓄積手段であるＦＩ
ＦＯを制御することが出来る。
【００３６】ここで、具体的な動作の例として１５００
バイトのデータを転送する場合について従来技術と対比
して説明すると、従来の技術で説明したように、まず、
ＡＴＭセルを用いる従来の第１のデータ伝送方法では、
転送データの内容とは無関係に転送バイト数は３２×５
３＝１６９６バイトであった。
バイトのデータを転送する場合について従来技術と対比
して説明すると、従来の技術で説明したように、まず、
ＡＴＭセルを用いる従来の第１のデータ伝送方法では、
転送データの内容とは無関係に転送バイト数は３２×５
３＝１６９６バイトであった。
【００３７】次に、ＨＤＬＣフレームを用いる従来の第
２のデータ伝送方法において、１５００バイトの７Ｄ
ｈ、もしくは７Ｅｈのデータを転送する場合、１５００
×２＋６（オーバヘッド分）＝３００６バイトの転送が
必要であった。
２のデータ伝送方法において、１５００バイトの７Ｄ
ｈ、もしくは７Ｅｈのデータを転送する場合、１５００
×２＋６（オーバヘッド分）＝３００６バイトの転送が
必要であった。
【００３８】本実施の形態のマルチコネクトＡＴＭセル
場合、（１５００＋６）／５３＝２８＋２２／５３より
セル長は、ｎ＝２９となる。従って、２９×５３＝１５
３７バイトの転送でよい。以上をまとめて表１に示す。
場合、（１５００＋６）／５３＝２８＋２２／５３より
セル長は、ｎ＝２９となる。従って、２９×５３＝１５
３７バイトの転送でよい。以上をまとめて表１に示す。
【００３９】
【表１】
【００４０】このように、本実施の形態のデータ伝送方
法は、転送サイズが５３バイトの整数倍で任意であるこ
とと、データ内容に依存せずオーバヘッドは６バイトの
固定サイズであることとより、従来のＡＴＭセル、ＨＤ
ＬＣフレームデータよりも有効帯域を広げられる。従っ
て転送速度を高速化できる。
法は、転送サイズが５３バイトの整数倍で任意であるこ
とと、データ内容に依存せずオーバヘッドは６バイトの
固定サイズであることとより、従来のＡＴＭセル、ＨＤ
ＬＣフレームデータよりも有効帯域を広げられる。従っ
て転送速度を高速化できる。
【００４１】また、マルチコネクトＡＴＭセルのセル長
を、ソフト的にｎ＝１と制御すると、従来のデータ伝送
システムのインフラストラクチャとしてのＡＴＭ−ＬＡ
Ｎネットワークをそのまま使用でき、バックコンパチビ
リティを保つことができる。
を、ソフト的にｎ＝１と制御すると、従来のデータ伝送
システムのインフラストラクチャとしてのＡＴＭ−ＬＡ
Ｎネットワークをそのまま使用でき、バックコンパチビ
リティを保つことができる。
【００４２】次に、本発明の第２の実施の形態について
説明する。
説明する。
【００４３】本実施の形態のデータ伝送装置は、フレー
ムデータとして第１の実施の形態のマルチコネクトＡＴ
Ｍセルを用いるＳＯＮＥＴ／ＳＤＨフレームを生成／分
解するフレーマデバイスである物理（ＰＨＹ）レイヤデ
バイスを有する。
ムデータとして第１の実施の形態のマルチコネクトＡＴ
Ｍセルを用いるＳＯＮＥＴ／ＳＤＨフレームを生成／分
解するフレーマデバイスである物理（ＰＨＹ）レイヤデ
バイスを有する。
【００４４】本実施の形態のデータ伝送装置をブロック
で示す図２を参照すると、この図に示す本実施の形態の
データ伝送装置は、伝送回線（図示せず）からの入力で
ある受信入力データに所定の受信処理を行い受信処理デ
ータを出力する受信処理部１と、送信データの供給を受
け送信データ処理を行い伝送回線（図示せず）に送信出
力データとして出力する送信処理部２と、受信処理部１
の出力である受信処理データを受信データとして上位レ
イヤ（図示せず）に出力し、上位レイヤから供給を受け
る送信データを送信処理部２に入力することにより上位
レイヤと受信処理部１及び送信処理部２とをインタフエ
ースするインタフエース部３とを備える。
で示す図２を参照すると、この図に示す本実施の形態の
データ伝送装置は、伝送回線（図示せず）からの入力で
ある受信入力データに所定の受信処理を行い受信処理デ
ータを出力する受信処理部１と、送信データの供給を受
け送信データ処理を行い伝送回線（図示せず）に送信出
力データとして出力する送信処理部２と、受信処理部１
の出力である受信処理データを受信データとして上位レ
イヤ（図示せず）に出力し、上位レイヤから供給を受け
る送信データを送信処理部２に入力することにより上位
レイヤと受信処理部１及び送信処理部２とをインタフエ
ースするインタフエース部３とを備える。
【００４５】受信処理部１は、伝送回線からの受信入力
データＲの入力インタフェースを行う受信回線Ｉ／Ｆ部
１１と、受信入力データのオーバヘッド処理を行う受信
セクションＯ／Ｈ処理部１２と、受信ラインＯ／Ｈ処理
部１３と、受信パスＯ／Ｈ処理部１４と、受信マルチコ
ネクトＡＴＭセルを処理し受信マルチコネクトＡＴＭデ
ータＲＭを出力する受信ＭＣＡＴＭセル処理部１５と、
受信ＡＴＭセルを処理し受信ＡＴＭデータＲＡを出力す
る受信ＡＴＭセル処理部１６とを備える。
データＲの入力インタフェースを行う受信回線Ｉ／Ｆ部
１１と、受信入力データのオーバヘッド処理を行う受信
セクションＯ／Ｈ処理部１２と、受信ラインＯ／Ｈ処理
部１３と、受信パスＯ／Ｈ処理部１４と、受信マルチコ
ネクトＡＴＭセルを処理し受信マルチコネクトＡＴＭデ
ータＲＭを出力する受信ＭＣＡＴＭセル処理部１５と、
受信ＡＴＭセルを処理し受信ＡＴＭデータＲＡを出力す
る受信ＡＴＭセル処理部１６とを備える。
【００４６】送信処理部２は、インタフエース部３から
の送信マルチコネクトＡＴＭデータＴＭの供給を受け送
信マルチコネクトＡＴＭセル処理を行う送信ＭＣＡＴＭ
セル処理部２１と、送信ＡＴＭデータＴＡの供給を受け
送信ＡＴＭセル処理を行う送信ＡＴＭセル処理部２２
と、送信出力データのオーバヘッド処理を行う送信パス
Ｏ／Ｈ処理部２３と、送信ラインＯ／Ｈ処理部２４と、
送信セクションＯ／Ｈ処理部２５と、伝送回線への送信
出力データＴの出力インタフェースを行う送信回線Ｉ／
Ｆ部２６とを備える。
の送信マルチコネクトＡＴＭデータＴＭの供給を受け送
信マルチコネクトＡＴＭセル処理を行う送信ＭＣＡＴＭ
セル処理部２１と、送信ＡＴＭデータＴＡの供給を受け
送信ＡＴＭセル処理を行う送信ＡＴＭセル処理部２２
と、送信出力データのオーバヘッド処理を行う送信パス
Ｏ／Ｈ処理部２３と、送信ラインＯ／Ｈ処理部２４と、
送信セクションＯ／Ｈ処理部２５と、伝送回線への送信
出力データＴの出力インタフェースを行う送信回線Ｉ／
Ｆ部２６とを備える。
【００４７】後述するように、受信ＭＣＡＴＭセル処理
部１５及び送信ＭＣＡＴＭセル処理部２１の各々は、そ
れぞれ受信ＦＩＦＯ制御部１５１及び送信ＦＩＦＯ制御
部２１１を備える。
部１５及び送信ＭＣＡＴＭセル処理部２１の各々は、そ
れぞれ受信ＦＩＦＯ制御部１５１及び送信ＦＩＦＯ制御
部２１１を備える。
【００４８】インタフェース部３は、後述のマルチコネ
クトＡＴＭセルモードに対応する受信ＰＯＳ物理Ｉ／Ｆ
部３１及び送信ＰＯＳ物理Ｉ／Ｆ部３３と、後述のＡＴ
Ｍセルモードに対応する受信ユートピアＩ／Ｆ部３２及
び送信ユートピアＩ／Ｆ部３４とを備える。
クトＡＴＭセルモードに対応する受信ＰＯＳ物理Ｉ／Ｆ
部３１及び送信ＰＯＳ物理Ｉ／Ｆ部３３と、後述のＡＴ
Ｍセルモードに対応する受信ユートピアＩ／Ｆ部３２及
び送信ユートピアＩ／Ｆ部３４とを備える。
【００４９】上記のように、本実施の形態のデータ伝送
装置である物理レイヤデバイスは、ＡＴＭセル処理部
と、マルチコネクトＡＴＭセル処理部を共に有してお
り、外部からＡＴＭセルモードとマルチコネクトＡＴＭ
セルモードのいずれか一方のプロトコルを選択できるよ
うになっている。
装置である物理レイヤデバイスは、ＡＴＭセル処理部
と、マルチコネクトＡＴＭセル処理部を共に有してお
り、外部からＡＴＭセルモードとマルチコネクトＡＴＭ
セルモードのいずれか一方のプロトコルを選択できるよ
うになっている。
【００５０】図２を参照して本実施の形態のデータ伝送
装置の動作について説明すると、まず受信の場合、受信
処理部１は、伝送回線側からの受信入力データＲを、受
信セクションＯ／Ｈ処理部１２と受信ラインＯ／Ｈ処理
部１３と受信パスＯ／Ｈ処理部１４との各々により、受
信セクション、受信ライン、受信パスの各オーバヘッド
処理した後、上記選択に対応してＡＴＭセル処理、もし
くは、マルチコネクトＡＴＭセル処理を行う。
装置の動作について説明すると、まず受信の場合、受信
処理部１は、伝送回線側からの受信入力データＲを、受
信セクションＯ／Ｈ処理部１２と受信ラインＯ／Ｈ処理
部１３と受信パスＯ／Ｈ処理部１４との各々により、受
信セクション、受信ライン、受信パスの各オーバヘッド
処理した後、上記選択に対応してＡＴＭセル処理、もし
くは、マルチコネクトＡＴＭセル処理を行う。
【００５１】上記選択がマルチコネクトＡＴＭセルモー
ドの場合には、受信ＭＣＡＴＭセル処理部１５が、オー
バヘッド処理後の受信入力データＲＬのＳＯＮＥＴ／Ｓ
ＤＨフレームのペイロード領域からマルチコネクトＡＴ
Ｍセルを抽出し受信マルチコネクトＡＴＭデータＲＭを
インタフェース部３の受信ＰＯＳ物理Ｉ／Ｆ部３１に出
力し、受信ＰＯＳ物理Ｉ／Ｆ部３１は受信マルチコネク
トＡＴＭデータＲＭ対応の受信データＲＤを上位レイア
へ送出する。
ドの場合には、受信ＭＣＡＴＭセル処理部１５が、オー
バヘッド処理後の受信入力データＲＬのＳＯＮＥＴ／Ｓ
ＤＨフレームのペイロード領域からマルチコネクトＡＴ
Ｍセルを抽出し受信マルチコネクトＡＴＭデータＲＭを
インタフェース部３の受信ＰＯＳ物理Ｉ／Ｆ部３１に出
力し、受信ＰＯＳ物理Ｉ／Ｆ部３１は受信マルチコネク
トＡＴＭデータＲＭ対応の受信データＲＤを上位レイア
へ送出する。
【００５２】上記選択がＡＴＭセルモード場合には、受
信ＡＴＭセル処理部１６が、オーバヘッド処理後の受信
入力データＲＳのＳＯＮＥＴ／ＳＤＨフレームのペイロ
ード領域からＡＴＭセルを抽出し受信ＡＴＭデータＲＡ
をインタフェース部３のユートピアＩ／Ｆ部３２に出力
し、受信ユートピアＩ／Ｆ部３２は受信ＡＴＭデータＲ
Ｍ対応の受信データＲＤを上位レイアへ送出する。
信ＡＴＭセル処理部１６が、オーバヘッド処理後の受信
入力データＲＳのＳＯＮＥＴ／ＳＤＨフレームのペイロ
ード領域からＡＴＭセルを抽出し受信ＡＴＭデータＲＡ
をインタフェース部３のユートピアＩ／Ｆ部３２に出力
し、受信ユートピアＩ／Ｆ部３２は受信ＡＴＭデータＲ
Ｍ対応の受信データＲＤを上位レイアへ送出する。
【００５３】次に送信の場合、マルチコネクトＡＴＭセ
ルモードの場合には、インタフェース部３の送信ＰＯＳ
物理Ｉ／Ｆ部３３は上位レイアから送信データＴＤの供
給を受け、対応の送信マルチコネクトＡＴＭデータＴＭ
を、送信処理部２の送信ＭＣＡＴＭセル処理部２１に供
給する。送信ＭＣＡＴＭセル処理部２１は、送信マルチ
コネクトＡＴＭセル処理を行い送信対象のＳＯＮＥＴ／
ＳＤＨフレーム（以下送信フレーム）のペイロード領域
にマルチコネクトＡＴＭセルをマッピングした送信デー
タＴＬを出力する。送信パスＯ／Ｈ処理部２３と送信ラ
インＯ／Ｈ処理部２４と送信セクションＯ／Ｈ処理部２
５は、送信データＴＬの送信パスと送信ラインと送信セ
クションの各オーバヘッド処理し、送信回線Ｉ／Ｆ部２
６に供給する。送信回線Ｉ／Ｆ部２６は、オーバヘッド
処理後の送信フレーム対応の送信出力データＴを伝送回
線に出力する。
ルモードの場合には、インタフェース部３の送信ＰＯＳ
物理Ｉ／Ｆ部３３は上位レイアから送信データＴＤの供
給を受け、対応の送信マルチコネクトＡＴＭデータＴＭ
を、送信処理部２の送信ＭＣＡＴＭセル処理部２１に供
給する。送信ＭＣＡＴＭセル処理部２１は、送信マルチ
コネクトＡＴＭセル処理を行い送信対象のＳＯＮＥＴ／
ＳＤＨフレーム（以下送信フレーム）のペイロード領域
にマルチコネクトＡＴＭセルをマッピングした送信デー
タＴＬを出力する。送信パスＯ／Ｈ処理部２３と送信ラ
インＯ／Ｈ処理部２４と送信セクションＯ／Ｈ処理部２
５は、送信データＴＬの送信パスと送信ラインと送信セ
クションの各オーバヘッド処理し、送信回線Ｉ／Ｆ部２
６に供給する。送信回線Ｉ／Ｆ部２６は、オーバヘッド
処理後の送信フレーム対応の送信出力データＴを伝送回
線に出力する。
【００５４】ＡＴＭセルモードの場合には、インタフェ
ース部３の送信ユートピアＩ／Ｆ部３４は上位レイアか
ら送信データＴＤの供給を受け、対応の送信ＡＴＭデー
タＴＡを送信処理部２の送信ＡＴＭセル処理部２２に供
給する。送信ＡＴＭセル処理部２２は、送信ＡＴＭセル
処理を行い送信フレームのペイロード領域にＡＴＭセル
をマッピングした送信データＴＳを出力する。以下同様
に、送信パスＯ／Ｈ処理部２３と送信ラインＯ／Ｈ処理
部２４と送信セクションＯ／Ｈ処理部２５は、送信デー
タＴＳの各オーバヘッド処理し、送信回線Ｉ／Ｆ部２６
に供給する。送信回線Ｉ／Ｆ部２６は、オーバヘッド処
理後の送信フレーム対応の送信出力データＴを伝送回線
に出力する。
ース部３の送信ユートピアＩ／Ｆ部３４は上位レイアか
ら送信データＴＤの供給を受け、対応の送信ＡＴＭデー
タＴＡを送信処理部２の送信ＡＴＭセル処理部２２に供
給する。送信ＡＴＭセル処理部２２は、送信ＡＴＭセル
処理を行い送信フレームのペイロード領域にＡＴＭセル
をマッピングした送信データＴＳを出力する。以下同様
に、送信パスＯ／Ｈ処理部２３と送信ラインＯ／Ｈ処理
部２４と送信セクションＯ／Ｈ処理部２５は、送信デー
タＴＳの各オーバヘッド処理し、送信回線Ｉ／Ｆ部２６
に供給する。送信回線Ｉ／Ｆ部２６は、オーバヘッド処
理後の送信フレーム対応の送信出力データＴを伝送回線
に出力する。
【００５５】受信ＭＣＡＴＭセル処理部１５は受信ＦＩ
ＦＯ制御部１５１を備え、送信ＭＣＡＴＭセル処理部２
１は送信ＦＩＦＯ制御部２１１を備える。
ＦＯ制御部１５１を備え、送信ＭＣＡＴＭセル処理部２
１は送信ＦＩＦＯ制御部２１１を備える。
【００５６】受信ＦＩＦＯ制御部１５１の構成を受信Ｐ
ＯＳ物理Ｉ／Ｆ部３１とともにブロックで示す図３を参
照すると、この受信ＦＩＦＯ制御部１５１は、受信側回
線クロックで動作する回路ブロックから成る受信側回線
クロック系５１と、受信クロックで動作する回路ブロッ
クから成る受信クロック系５２と、受信ＦＩＦＯのメモ
リ部を構成しライトデータＤＷを一時格納し対応するリ
ードデータＤＲを出力する受信ＲＡＭ部５３と、ＲＰ非
同期乗り換え部５４と、ＷＰ非同期乗り換え部５５とを
備える。
ＯＳ物理Ｉ／Ｆ部３１とともにブロックで示す図３を参
照すると、この受信ＦＩＦＯ制御部１５１は、受信側回
線クロックで動作する回路ブロックから成る受信側回線
クロック系５１と、受信クロックで動作する回路ブロッ
クから成る受信クロック系５２と、受信ＦＩＦＯのメモ
リ部を構成しライトデータＤＷを一時格納し対応するリ
ードデータＤＲを出力する受信ＲＡＭ部５３と、ＲＰ非
同期乗り換え部５４と、ＷＰ非同期乗り換え部５５とを
備える。
【００５７】受信側回線クロック系５１は、ＳＯＮＥＴ
／ＳＤＨにマッピングされたマルチコネクトＡＴＭセル
の受信ＲＡＭ５３へ書き込み制御を行いライトアドレス
ＡＷの生成とライトデータＤＷの整列を行うライト制御
部５１１と、受信ＲＡＭ５３が書き込み可能状態である
かを判定するライト可能状態判定部５１２と、受信ＲＡ
Ｍ５３の書込時のライトデータＤＷの容量超過であるオ
ーバフロー（オーバラン）を判定するオーバフロー判定
部５１３とを備える。
／ＳＤＨにマッピングされたマルチコネクトＡＴＭセル
の受信ＲＡＭ５３へ書き込み制御を行いライトアドレス
ＡＷの生成とライトデータＤＷの整列を行うライト制御
部５１１と、受信ＲＡＭ５３が書き込み可能状態である
かを判定するライト可能状態判定部５１２と、受信ＲＡ
Ｍ５３の書込時のライトデータＤＷの容量超過であるオ
ーバフロー（オーバラン）を判定するオーバフロー判定
部５１３とを備える。
【００５８】受信クロック系５２は、リード要求信号Ｒ
Ｑにより受信ＲＡＭ５３のリードアドレスＡＲの生成及
びリードデータＤＲの整列を行うリード制御部５２１
と、受信ＲＡＭ５３が読み出し可能状態であるかを判定
するリード可能状態判定部５２２と、受信ＲＡＭ５３の
読出時のリードデータＤＲ不足であるアンダフロー（ア
ンダーラン）を判定するアンダフロー判定部５２３とを
備える。
Ｑにより受信ＲＡＭ５３のリードアドレスＡＲの生成及
びリードデータＤＲの整列を行うリード制御部５２１
と、受信ＲＡＭ５３が読み出し可能状態であるかを判定
するリード可能状態判定部５２２と、受信ＲＡＭ５３の
読出時のリードデータＤＲ不足であるアンダフロー（ア
ンダーラン）を判定するアンダフロー判定部５２３とを
備える。
【００５９】受信ＰＯＳ物理Ｉ／Ｆ部３１は、セレクシ
ョン処理部３１１と、受信データＳＯＰ処理部３１２
と、受信バリド処理部３１３とを備える。
ョン処理部３１１と、受信データＳＯＰ処理部３１２
と、受信バリド処理部３１３とを備える。
【００６０】図３を参照して受信ＦＩＦＯ制御部１５１
の動作について説明すると、受信側回線クロック系５１
のライト制御部５１１は、ライト可能状態判定部５１２
からのライト要求信号ＷＱにより、ＳＯＮＥＴ／ＳＤＨ
にマッピングされたマルチコネクトＡＴＭセルデータ
（以下受信データ）をライトデータＤＷとして出力し、
受信ＲＡＭ５３に書き込みを行う。また、書き込みが正
常に行われていることを監視するライト監視信号ＷＰを
オーバフロー判定部５１３とライト可能状態判定部５１
２に供給する。入力するライトデータＤＷのセル長が受
信ＲＡＭ５３の容量を超えることにより書込ができなく
なるオーバランが発生すると、そのことを示すライト監
視信号ＷＰによりオーバフロー判定部５１３はライト停
止要求信号ＷＨを出力し、ライト制御部５１１は、ライ
ト停止要求信号ＷＨの供給に応答して残りのライトデー
タである残余ライトデータの書き込みを停止する。ライ
トデータ書き込みの再開は、ライト監視信号ＷＰの正常
状態への復帰に応答したライト可能状態判定部５１２が
出力するライト要求信号ＷＱにより行われる。
の動作について説明すると、受信側回線クロック系５１
のライト制御部５１１は、ライト可能状態判定部５１２
からのライト要求信号ＷＱにより、ＳＯＮＥＴ／ＳＤＨ
にマッピングされたマルチコネクトＡＴＭセルデータ
（以下受信データ）をライトデータＤＷとして出力し、
受信ＲＡＭ５３に書き込みを行う。また、書き込みが正
常に行われていることを監視するライト監視信号ＷＰを
オーバフロー判定部５１３とライト可能状態判定部５１
２に供給する。入力するライトデータＤＷのセル長が受
信ＲＡＭ５３の容量を超えることにより書込ができなく
なるオーバランが発生すると、そのことを示すライト監
視信号ＷＰによりオーバフロー判定部５１３はライト停
止要求信号ＷＨを出力し、ライト制御部５１１は、ライ
ト停止要求信号ＷＨの供給に応答して残りのライトデー
タである残余ライトデータの書き込みを停止する。ライ
トデータ書き込みの再開は、ライト監視信号ＷＰの正常
状態への復帰に応答したライト可能状態判定部５１２が
出力するライト要求信号ＷＱにより行われる。
【００６１】なお、ＡＴＭセルの場合には、１セル単位
の管理のため、残余ライトデータの廃棄等の処理は必要
としない。
の管理のため、残余ライトデータの廃棄等の処理は必要
としない。
【００６２】受信クロック系５２のリード制御部５２１
は、セレクション処理部３１１からのリード要求信号Ｒ
Ｑにより受信ＲＡＭ５３のリードアドレスＡＲの生成及
びリードデータＤＲの整列を行う。また、読み出しが正
常に行われていることを監視するリード監視信号ＲＰを
アンダーフロー判定部５２３とリード可能状態判定部５
２２に供給する。受信ＲＡＭ５３に格納したリードデー
タＤＲのセル長以上のデータを読み出そうとすることに
よりリードアンダーランが発生すると、そのことを示す
リード監視信号ＲＰによりアンダーフロー判定部５２３
はリード停止要求信号ＲＨを出力リード制御部５２１に
供給し、リード制御部５２１は、リード停止要求信号Ｒ
Ｈの供給に応答して残りのリードデータである残余リー
ドデータの読み出しを停止する。データ読み出しの再開
は、リード監視信号ＲＰの正常状態への復帰に応答した
リード可能状態判定部５２２で読み出し可能状態である
かを検出した後、セレクション処理部３１１で再度同一
ポ−トをセレクトした場合に、リード要求信号ＲＱがア
クティブになることにより行われる。
は、セレクション処理部３１１からのリード要求信号Ｒ
Ｑにより受信ＲＡＭ５３のリードアドレスＡＲの生成及
びリードデータＤＲの整列を行う。また、読み出しが正
常に行われていることを監視するリード監視信号ＲＰを
アンダーフロー判定部５２３とリード可能状態判定部５
２２に供給する。受信ＲＡＭ５３に格納したリードデー
タＤＲのセル長以上のデータを読み出そうとすることに
よりリードアンダーランが発生すると、そのことを示す
リード監視信号ＲＰによりアンダーフロー判定部５２３
はリード停止要求信号ＲＨを出力リード制御部５２１に
供給し、リード制御部５２１は、リード停止要求信号Ｒ
Ｈの供給に応答して残りのリードデータである残余リー
ドデータの読み出しを停止する。データ読み出しの再開
は、リード監視信号ＲＰの正常状態への復帰に応答した
リード可能状態判定部５２２で読み出し可能状態である
かを検出した後、セレクション処理部３１１で再度同一
ポ−トをセレクトした場合に、リード要求信号ＲＱがア
クティブになることにより行われる。
【００６３】なお、ＡＴＭセルの場合には、１セル単位
の管理のため、残余リードデータ読み出し処理は必要と
しない。
の管理のため、残余リードデータ読み出し処理は必要と
しない。
【００６４】リード可能状態判定部５２２は、リード監
視信号ＲＰの値により受信ＲＡＭ５３が読み出し可能状
態に有るかを判定する。外部より設定したマルチコネク
トＡＴＭセルのセル長以上のデータが、受信ＲＡＭ５３
に格納されれば、リード監視信号ＲＰの値は正常値１と
なり、受信ＲＡＭ５３からの読み出し可能状態であると
判定しセレクション処理部３１１に通知する。
視信号ＲＰの値により受信ＲＡＭ５３が読み出し可能状
態に有るかを判定する。外部より設定したマルチコネク
トＡＴＭセルのセル長以上のデータが、受信ＲＡＭ５３
に格納されれば、リード監視信号ＲＰの値は正常値１と
なり、受信ＲＡＭ５３からの読み出し可能状態であると
判定しセレクション処理部３１１に通知する。
【００６５】ライト可能状態判定部５１２は、ライト監
視信号ＷＰの値により受信ＲＡＭ５３が書き込み可能状
態に有るかを判定する。外部より設定したマルチコネク
トＡＴＭセルのセル長以上の空き領域が受信ＲＡＭ５３
に確保されれば、ライト監視信号ＷＰの値は正常値１と
なり、受信ＲＡＭ５３への書き込み可能状態であると判
定しライト要求信号ＷＱをライト制御部５１１に出力す
る。
視信号ＷＰの値により受信ＲＡＭ５３が書き込み可能状
態に有るかを判定する。外部より設定したマルチコネク
トＡＴＭセルのセル長以上の空き領域が受信ＲＡＭ５３
に確保されれば、ライト監視信号ＷＰの値は正常値１と
なり、受信ＲＡＭ５３への書き込み可能状態であると判
定しライト要求信号ＷＱをライト制御部５１１に出力す
る。
【００６６】オーバフロー判定部５１３は、ライト監視
信号ＷＰの値により受信ＲＡＭ５３のオーバフローを検
出すると、ライト停止要求信号ＷＨをライト制御部５１
１に出力する。
信号ＷＰの値により受信ＲＡＭ５３のオーバフローを検
出すると、ライト停止要求信号ＷＨをライト制御部５１
１に出力する。
【００６７】アンダフロー判定部５２３は、リード監視
信号ＲＰの値により受信ＲＡＭ５３のアンダフローを検
出すると、リード停止要求信号ＲＨをリード制御部５２
１に出力する。
信号ＲＰの値により受信ＲＡＭ５３のアンダフローを検
出すると、リード停止要求信号ＲＨをリード制御部５２
１に出力する。
【００６８】受信ＰＯＳ物理Ｉ／Ｆ部３１は、上位レイ
アデバイスとの受信側インタフェースを処理する。受信
ＲＡＭ５３より読み出したマルチコネクトＡＴＭセルを
上位レイヤデバイスに出力するブロックである。
アデバイスとの受信側インタフェースを処理する。受信
ＲＡＭ５３より読み出したマルチコネクトＡＴＭセルを
上位レイヤデバイスに出力するブロックである。
【００６９】各Ｉ／Ｆ信号の意味を表２に示す。
【００７０】
【表２】
【００７１】送信ＦＩＦＯ制御部２１１の構成を送信Ｐ
ＯＳ物理Ｉ／Ｆ部３３とともにブロックで示す図４を参
照すると、この送信ＦＩＦＯ制御部２１１は、送信側回
線クロックで動作する回路ブロックから成る送信側回線
クロック系４１と、送信クロックで動作する回路ブロッ
クから成る送信クロック系４２と、送信ＦＩＦＯのメモ
リ部を構成しライトデータＷＤを一時格納し対応するリ
ードデータＲＤを出力する送信ＲＡＭ部４３と、ＷＰ非
同期乗り換え部４４と、ＲＰ非同期乗り換え部４５と、
アンダフロー非同期乗り換え部４６とを備える。
ＯＳ物理Ｉ／Ｆ部３３とともにブロックで示す図４を参
照すると、この送信ＦＩＦＯ制御部２１１は、送信側回
線クロックで動作する回路ブロックから成る送信側回線
クロック系４１と、送信クロックで動作する回路ブロッ
クから成る送信クロック系４２と、送信ＦＩＦＯのメモ
リ部を構成しライトデータＷＤを一時格納し対応するリ
ードデータＲＤを出力する送信ＲＡＭ部４３と、ＷＰ非
同期乗り換え部４４と、ＲＰ非同期乗り換え部４５と、
アンダフロー非同期乗り換え部４６とを備える。
【００７２】送信側回線クロック系４１は、送信ＲＡＭ
４３のリードアドレスＲＡの生成及びリードデータＲＤ
の整列を行うリード制御部４１１と、送信ＲＡＭ４３が
読み出し可能状態であるかを判定するリード可能状態判
定部４１２と、送信ＲＡＭ４３の読出時のリードデータ
不足であるアンダフロー（アンダーラン）を判定するア
ンダフロー判定部４１３とを備える。
４３のリードアドレスＲＡの生成及びリードデータＲＤ
の整列を行うリード制御部４１１と、送信ＲＡＭ４３が
読み出し可能状態であるかを判定するリード可能状態判
定部４１２と、送信ＲＡＭ４３の読出時のリードデータ
不足であるアンダフロー（アンダーラン）を判定するア
ンダフロー判定部４１３とを備える。
【００７３】送信クロック系４２は、送信ＰＯＳ物理Ｉ
／Ｆ部３３を介して入力されるマルチコネクトＡＴＭセ
ルを送信ＲＡＭ４３に書き込みライトアドレスＷＡの生
成とライトデータＷＤの整列を行うライト制御部４２１
と、送信ＲＡＭ４３の書込時のライトデータＷＤの容量
超過であるオーバフロー（オーバラン）を判定するオー
バフロー判定部４２２と、送信ＲＡＭ４３が書き込み可
能状態であるかを判定するライト可能状態判定部４２３
と、マルチコネクトＡＴＭセルの書込の未完了状態を判
定するアンフィニッシュ判定部４２４とを備える。
／Ｆ部３３を介して入力されるマルチコネクトＡＴＭセ
ルを送信ＲＡＭ４３に書き込みライトアドレスＷＡの生
成とライトデータＷＤの整列を行うライト制御部４２１
と、送信ＲＡＭ４３の書込時のライトデータＷＤの容量
超過であるオーバフロー（オーバラン）を判定するオー
バフロー判定部４２２と、送信ＲＡＭ４３が書き込み可
能状態であるかを判定するライト可能状態判定部４２３
と、マルチコネクトＡＴＭセルの書込の未完了状態を判
定するアンフィニッシュ判定部４２４とを備える。
【００７４】送信ＰＯＳ物理Ｉ／Ｆ部３３は、セレクシ
ョン処理部３３１と、送信データＳＯＰ処理部３３２
と、送信ＰＡＶ処理部３３３とを備える。
ョン処理部３３１と、送信データＳＯＰ処理部３３２
と、送信ＰＡＶ処理部３３３とを備える。
【００７５】図４を参照して送信ＦＩＦＯ制御部２１１
の動作について説明すると、送信クロック系４２のライ
ト制御部４２１は、セレクション処理部３３１からのラ
イト要求信号ＷＱにより送信ＰＯＳ物理Ｉ／Ｆ部３３を
介して入力されるマルチコネクトＡＴＭセルを送信ＲＡ
Ｍ４３に書き込み、対応するライトアドレスＷＡの生成
及びライトデータＷＤの整列を行う。入力するライトデ
ータのセル長が送信ＲＡＭ４３の容量を超えることによ
り書込ができなくなるオーバランが発生すると、上述の
受信ＦＩＦＯ制御部１のライト制御部５１１と同様に、
ライト監視信号ＷＰが異常値となる。ライト監視信号Ｗ
Ｐの異常値に応答してオーバフロー判定部４２２が出力
したライト停止要求信号ＷＨにより、ライト制御部４２
１は、送信ＲＡＭ４３にエラ−属性を書き込んだ後、残
余ライトデータの書き込みを停止する。以後、残余ライ
トデータが上位レイアデバイスより送られてきても、こ
れらを廃棄する。オーバランが解除され、新たにマルチ
コネクトＡＴＭセルの先頭が送られて来るとデータの書
き込みを再開する。
の動作について説明すると、送信クロック系４２のライ
ト制御部４２１は、セレクション処理部３３１からのラ
イト要求信号ＷＱにより送信ＰＯＳ物理Ｉ／Ｆ部３３を
介して入力されるマルチコネクトＡＴＭセルを送信ＲＡ
Ｍ４３に書き込み、対応するライトアドレスＷＡの生成
及びライトデータＷＤの整列を行う。入力するライトデ
ータのセル長が送信ＲＡＭ４３の容量を超えることによ
り書込ができなくなるオーバランが発生すると、上述の
受信ＦＩＦＯ制御部１のライト制御部５１１と同様に、
ライト監視信号ＷＰが異常値となる。ライト監視信号Ｗ
Ｐの異常値に応答してオーバフロー判定部４２２が出力
したライト停止要求信号ＷＨにより、ライト制御部４２
１は、送信ＲＡＭ４３にエラ−属性を書き込んだ後、残
余ライトデータの書き込みを停止する。以後、残余ライ
トデータが上位レイアデバイスより送られてきても、こ
れらを廃棄する。オーバランが解除され、新たにマルチ
コネクトＡＴＭセルの先頭が送られて来るとデータの書
き込みを再開する。
【００７６】アンダーランが発生した場合にも、ライト
制御部４２１は、送信ＲＡＭ４３エラ−属性を書き込ん
だ後、残余ライトデータの書き込みを停止する。以後、
残余ライトデータが上位レイアデバイスより送られてき
てもこれを廃棄する。新たにマルチコネクトＡＴＭセル
の先頭が送られて来るとデータの書き込みを再開する。
制御部４２１は、送信ＲＡＭ４３エラ−属性を書き込ん
だ後、残余ライトデータの書き込みを停止する。以後、
残余ライトデータが上位レイアデバイスより送られてき
てもこれを廃棄する。新たにマルチコネクトＡＴＭセル
の先頭が送られて来るとデータの書き込みを再開する。
【００７７】また、マルチコネクトＡＴＭセルの最終バ
イトの前に、次のマルチコネクトＡＴＭセルの先頭バイ
トを検出した場合（アンフィニッシュ）にも、送信ＲＡ
Ｍ４３にエラ−属性を書き込んだ後、残余ライトデータ
の書き込みを停止し、新たに送られてきたマルチコネク
トＡＴＭセルの書き込みを行う。
イトの前に、次のマルチコネクトＡＴＭセルの先頭バイ
トを検出した場合（アンフィニッシュ）にも、送信ＲＡ
Ｍ４３にエラ−属性を書き込んだ後、残余ライトデータ
の書き込みを停止し、新たに送られてきたマルチコネク
トＡＴＭセルの書き込みを行う。
【００７８】なお、ＡＴＭセルの場合には、１セル単位
の管理のため、残余ライトデータの廃棄処理、及びアン
フィニッシュ処理は必要としない。
の管理のため、残余ライトデータの廃棄処理、及びアン
フィニッシュ処理は必要としない。
【００７９】送信側回線クロック系４１のリード制御部
４１１は、リード可能状態判定部４１２からのリード要
求信号ＲＱにより、送信ＲＡＭ４３リードアドレスＲＡ
の生成、及びリードデータＲＤの整列を行う。また、上
述の受信ＦＩＦＯ制御部１のリード制御部５２１と同様
のリード監視信号ＲＰを生成する。送信ＲＡＭ４３に格
納したリードデータＲＤのセル長以上のデータを読み出
そうとすることによりアンダーランが発生すると、残余
リードデータの読み出しを停止する。読み出しの再開
は、リード可能状態判定部４１２からのリード要求信号
ＲＱが、再びアクティブになることにより行われる。
４１１は、リード可能状態判定部４１２からのリード要
求信号ＲＱにより、送信ＲＡＭ４３リードアドレスＲＡ
の生成、及びリードデータＲＤの整列を行う。また、上
述の受信ＦＩＦＯ制御部１のリード制御部５２１と同様
のリード監視信号ＲＰを生成する。送信ＲＡＭ４３に格
納したリードデータＲＤのセル長以上のデータを読み出
そうとすることによりアンダーランが発生すると、残余
リードデータの読み出しを停止する。読み出しの再開
は、リード可能状態判定部４１２からのリード要求信号
ＲＱが、再びアクティブになることにより行われる。
【００８０】なお、ＡＴＭセルの場合には、１セル単位
の管理のため、残余リードデータ読み出し処理は必要と
しない。
の管理のため、残余リードデータ読み出し処理は必要と
しない。
【００８１】リード可能状態判定部４１２は、リード監
視信号ＲＰの値により送信ＲＡＭ４３が読み出し可能状
態に有るかを判定する。外部より設定したマルチコネク
トセル長以上のデータが送信ＲＡＭ４３に格納されれ
ば、リード監視信号ＲＰの値は正常値となることによ
り、送信ＲＡＭ４３読み出し可能状態であると判定しリ
ード制御部４１１に通知する。
視信号ＲＰの値により送信ＲＡＭ４３が読み出し可能状
態に有るかを判定する。外部より設定したマルチコネク
トセル長以上のデータが送信ＲＡＭ４３に格納されれ
ば、リード監視信号ＲＰの値は正常値となることによ
り、送信ＲＡＭ４３読み出し可能状態であると判定しリ
ード制御部４１１に通知する。
【００８２】送信クロック系４２のライト可能状態判定
部４２３は、ライト監視信号ＷＰの値により送信ＲＡＭ
４３が書き込み可能状態に有るかを判定する。外部より
設定したマルチコネクトセル長以上の空き領域が送信Ｒ
ＡＭ４３に確保されれば、ライト監視信号ＷＰの値が正
常値になることにより送信ＲＡＭ４３が書き込み可能状
態であると判定し送信ＰＯＳ物理Ｉ／Ｆ部３３の送信Ｐ
ＡＶ処理部３３３に出力する。上位レイアデバイスは、
送信ＲＡＭ４３に空き領域が確保されていることを示す
ＴｘＰＡＶ信号をモニタして送信ポ−トをセレクトす
る。
部４２３は、ライト監視信号ＷＰの値により送信ＲＡＭ
４３が書き込み可能状態に有るかを判定する。外部より
設定したマルチコネクトセル長以上の空き領域が送信Ｒ
ＡＭ４３に確保されれば、ライト監視信号ＷＰの値が正
常値になることにより送信ＲＡＭ４３が書き込み可能状
態であると判定し送信ＰＯＳ物理Ｉ／Ｆ部３３の送信Ｐ
ＡＶ処理部３３３に出力する。上位レイアデバイスは、
送信ＲＡＭ４３に空き領域が確保されていることを示す
ＴｘＰＡＶ信号をモニタして送信ポ−トをセレクトす
る。
【００８３】オーバフロー判定部４２２は、ライト監視
信号ＷＰの値の異常により送信ＲＡＭ４３のオーバフロ
ーを検出すると、ライト停止要求信号ＷＨをライト制御
部４２１に出力する。
信号ＷＰの値の異常により送信ＲＡＭ４３のオーバフロ
ーを検出すると、ライト停止要求信号ＷＨをライト制御
部４２１に出力する。
【００８４】アンダフロー判定部４１３は、リード監視
信号ＲＰの値の異常により送信ＲＡＭ４３のアンダフロ
ーを検出すると、リード停止要求信号ＲＨをリード制御
部４１１に出力する。さらに、アンダフロー時に、残余
ライトデータ書き込みを停止させるため、アンダフロー
信号を非同期乗り換えし、アンダフロー非同期乗り換え
部４６を経由してライト停止要求ＷＨとしてライト制御
部４２１に通知する。
信号ＲＰの値の異常により送信ＲＡＭ４３のアンダフロ
ーを検出すると、リード停止要求信号ＲＨをリード制御
部４１１に出力する。さらに、アンダフロー時に、残余
ライトデータ書き込みを停止させるため、アンダフロー
信号を非同期乗り換えし、アンダフロー非同期乗り換え
部４６を経由してライト停止要求ＷＨとしてライト制御
部４２１に通知する。
【００８５】アンフィニッシュ判定部４２４は、上位レ
イアデバイスの送出するマルチコネクトＡＴＭセルの最
終バイトの前に、次のマルチコネクトＡＴＭセルの先頭
バイトを検出した場合、アンフィニッシュとして検出
し、アンフィニッシュ信号を生成し対応するライト停止
要求としてライト制御部４２１に通知する。
イアデバイスの送出するマルチコネクトＡＴＭセルの最
終バイトの前に、次のマルチコネクトＡＴＭセルの先頭
バイトを検出した場合、アンフィニッシュとして検出
し、アンフィニッシュ信号を生成し対応するライト停止
要求としてライト制御部４２１に通知する。
【００８６】送信ＰＯＳ物理Ｉ／Ｆ部３３は、上位レイ
アデバイスとの送信側インタフェ−スである。上位レイ
アの送出したマルチコネクトＡＴＭセルを受信するブロ
ックである。
アデバイスとの送信側インタフェ−スである。上位レイ
アの送出したマルチコネクトＡＴＭセルを受信するブロ
ックである。
【００８７】各Ｉ／Ｆ信号の意味を表３に示す。
【００８８】
【表３】
【００８９】以上、マルチコネクトＡＴＭセルモードの
場合の受信及び送信各ＦＩＦＯ制御部の動作に関して説
明した。
場合の受信及び送信各ＦＩＦＯ制御部の動作に関して説
明した。
【００９０】マルチコネクトＡＴＭセルモードの場合に
は、転送サイズがＡＴＭセルのサイズである５３バイト
の整数倍であることから、ＡＴＭセルモードの場合と同
様に受信及び送信各ＦＩＦＯを制御することが可能にな
り、受信及び送信各ＦＩＦＯ制御部を共有することが可
能になる。
は、転送サイズがＡＴＭセルのサイズである５３バイト
の整数倍であることから、ＡＴＭセルモードの場合と同
様に受信及び送信各ＦＩＦＯを制御することが可能にな
り、受信及び送信各ＦＩＦＯ制御部を共有することが可
能になる。
【００９１】ただし、マルチコネクトＡＴＭセルモード
の場合には、データ長が任意であるため転送途中でのエ
ラーが発生時に残余データの処理が必要となるため、そ
のための処理機能を備えている。
の場合には、データ長が任意であるため転送途中でのエ
ラーが発生時に残余データの処理が必要となるため、そ
のための処理機能を備えている。
【００９２】一方、ＡＴＭセルモードの場合には、受信
及び送信各ＦＩＦＯの空き領域及び蓄積状況をセル単位
で管理する。従って、本実施の形態の受信及び送信各Ｆ
ＩＦＯ制御部により、そのまま、処理が可能である。こ
の場合、上述した、マルチコネクトＡＴＭセルモードの
場合に必要とした、転送途中でのエラー発生時における
残余データの発生はないので、その処理は必要としな
い。
及び送信各ＦＩＦＯの空き領域及び蓄積状況をセル単位
で管理する。従って、本実施の形態の受信及び送信各Ｆ
ＩＦＯ制御部により、そのまま、処理が可能である。こ
の場合、上述した、マルチコネクトＡＴＭセルモードの
場合に必要とした、転送途中でのエラー発生時における
残余データの発生はないので、その処理は必要としな
い。
【００９３】また、ＰＯＳにおけるＨＤＬＣデータに対
応する場合には、受信及び送信各ＦＩＦＯを有効に活用
するためには各ＦＩＦＯの空き領域及び蓄積状況を１バ
イト単位、もしくは４バイト、８バイト単位で管理する
必要がある。仮に４バイト、８バイト単位、もしくはＡ
ＴＭセル同様に５３バイト単位で管理したとしても、デ
ータ長が任意であるため剰余バイトが存在するのでこの
剰余バイトも管理する必要がある。つまり、１バイト単
位のＦＩＦＯ管理が必要になる。
応する場合には、受信及び送信各ＦＩＦＯを有効に活用
するためには各ＦＩＦＯの空き領域及び蓄積状況を１バ
イト単位、もしくは４バイト、８バイト単位で管理する
必要がある。仮に４バイト、８バイト単位、もしくはＡ
ＴＭセル同様に５３バイト単位で管理したとしても、デ
ータ長が任意であるため剰余バイトが存在するのでこの
剰余バイトも管理する必要がある。つまり、１バイト単
位のＦＩＦＯ管理が必要になる。
【００９４】従って、ＨＤＬＣデータを処理する場合に
は、受信及び送信各ＦＩＦＯの蓄積、空き状況を管理す
るそれぞれのライト可能状態判定部、リード可能状態判
定部、アンダフロー判定部、オーバフロー判定部、及び
リード／ライトアドレスを管理するリード／ライト制御
部を、本実施の形態で説明したマルチコネクトＡＴＭセ
ル／ＡＴＭセルモード用とは別に設ける必要がある。
は、受信及び送信各ＦＩＦＯの蓄積、空き状況を管理す
るそれぞれのライト可能状態判定部、リード可能状態判
定部、アンダフロー判定部、オーバフロー判定部、及び
リード／ライトアドレスを管理するリード／ライト制御
部を、本実施の形態で説明したマルチコネクトＡＴＭセ
ル／ＡＴＭセルモード用とは別に設ける必要がある。
【００９５】従って、本実施の形態のデータ伝送装置
に、ＨＤＬＣデータを処理するためのＨＤＬＣデータモ
ードの処理機能を持たせる場合には、受信及び送信各Ｆ
ＩＦＯ制御部は、本実施の形態の約２倍弱の回路規模で
実現可能である。
に、ＨＤＬＣデータを処理するためのＨＤＬＣデータモ
ードの処理機能を持たせる場合には、受信及び送信各Ｆ
ＩＦＯ制御部は、本実施の形態の約２倍弱の回路規模で
実現可能である。
【００９６】
【発明の効果】以上説明したように、本発明のデータ伝
送方法及びデータ伝送装置は、データフレーム上にマッ
ピングするデータフォーマットとして、データフレーム
がオーバヘッド領域とペイロード領域とを含むセル長が
一定長（５３バイト）の第１のデータフレームセル（Ａ
ＴＭセル）のセル長のｎ（正の整数）倍であり、かつセ
ル長を示すデータ長表示部をオーバヘッド情報として含
む可変長の第２のデータフレームセル（マルチコネクト
ＡＴＭセル）を有することにより、転送データのサイズ
が５３バイトのｎ倍と任意であることと、また、データ
のコード等の内容に依存せずオーバヘッドは６バイトの
固定サイズであることとより、従来のＡＴＭセル、ＨＤ
ＬＣフレームデータよりも有効帯域を広げることがで
き、従って、転送速度を高速化できるという効果があ
る。
送方法及びデータ伝送装置は、データフレーム上にマッ
ピングするデータフォーマットとして、データフレーム
がオーバヘッド領域とペイロード領域とを含むセル長が
一定長（５３バイト）の第１のデータフレームセル（Ａ
ＴＭセル）のセル長のｎ（正の整数）倍であり、かつセ
ル長を示すデータ長表示部をオーバヘッド情報として含
む可変長の第２のデータフレームセル（マルチコネクト
ＡＴＭセル）を有することにより、転送データのサイズ
が５３バイトのｎ倍と任意であることと、また、データ
のコード等の内容に依存せずオーバヘッドは６バイトの
固定サイズであることとより、従来のＡＴＭセル、ＨＤ
ＬＣフレームデータよりも有効帯域を広げることがで
き、従って、転送速度を高速化できるという効果があ
る。
【００９７】また、マルチコネクトＡＴＭセルのセル長
を、ソフト的にｎ＝１と制御すると、従来のデータ伝送
システムのインフラストラクチャとしてのＡＴＭ−ＬＡ
Ｎネットワークをそのまま使用でき、バックコンパチビ
リティを保つことができるという効果がある。すなわ
ち、転送サイズをＡＴＭセルのセル長である５３バイト
の整数倍にしたことにより、送信／受信装置のデータ一
次蓄積手段であるＦＩＦＯをＡＴＭセルの場合と同様に
制御することが出来るので、受信／送信各ＦＩＦＯ制御
部を共用できるという効果がある。
を、ソフト的にｎ＝１と制御すると、従来のデータ伝送
システムのインフラストラクチャとしてのＡＴＭ−ＬＡ
Ｎネットワークをそのまま使用でき、バックコンパチビ
リティを保つことができるという効果がある。すなわ
ち、転送サイズをＡＴＭセルのセル長である５３バイト
の整数倍にしたことにより、送信／受信装置のデータ一
次蓄積手段であるＦＩＦＯをＡＴＭセルの場合と同様に
制御することが出来るので、受信／送信各ＦＩＦＯ制御
部を共用できるという効果がある。
【図１】本発明のデータ伝送方法の一実施の形態を示す
ＳＯＮＥＴ／ＳＤＨフレームへのマッピングと本発明を
特徴付けるマルチコネクトＡＴＭセルフォーマットを示
す説明図である。
ＳＯＮＥＴ／ＳＤＨフレームへのマッピングと本発明を
特徴付けるマルチコネクトＡＴＭセルフォーマットを示
す説明図である。
【図２】本実施の形態のデータ伝送装置の物理レイアデ
バイスの一例を示すブロック図である。
バイスの一例を示すブロック図である。
【図３】本実施の形態のデータ伝送装置の受信ＦＩＦＯ
制御部の一例を示すブロック図である。
制御部の一例を示すブロック図である。
【図４】本実施の形態のデータ伝送装置の送信ＦＩＦＯ
制御部の一例を示すブロック図である。
制御部の一例を示すブロック図である。
【図５】従来のデータ伝送方法であるＰＯＳのＳＯＮＥ
Ｔ／ＳＤＨフレームフォーマットの一例を示す説明図で
ある。
Ｔ／ＳＤＨフレームフォーマットの一例を示す説明図で
ある。
【図６】従来のデータ伝送方法におけるＨＤＬＣフレー
ムデータのスタッフ処理の例を示すタイムチャートであ
る。
ムデータのスタッフ処理の例を示すタイムチャートであ
る。
１ 受信処理部
２ 送信処理部
３ インタフエース部
１１ 受信回線Ｉ／Ｆ部
１２ 受信セクションＯ／Ｈ処理部
１３ 受信ラインＯ／Ｈ処理部
１４ 受信パスＯ／Ｈ処理部
１５ 受信ＭＣＡＴＭセル処理部
１６ 受信ＡＴＭセル処理部
２１ 送信ＭＣＡＴＭセル処理部
２２ 送信ＡＴＭセル処理部
２３ 送信パスＯ／Ｈ処理部
２４ 送信ラインＯ／Ｈ処理部
２５ 送信セクションＯ／Ｈ処理部
２６ 送信回線Ｉ／Ｆ部
３１ 受信ＰＯＳ物理Ｉ／Ｆ部
３２ 受信ユートピアＩ／Ｆ部
３３ 送信ＰＯＳ物理Ｉ／Ｆ部
３４ 送信ユートピアＩ／Ｆ部
４１ 送信側回線クロック系
４２ 送信クロック系
４３ 送信ＲＡＭ部
４６ アンダフロー非同期乗り換え部
５１ 受信側回線クロック系
５２ 受信クロック系
５３ 受信ＲＡＭ部
４５，５４ ＲＰ非同期乗り換え部
４４，５５ ＷＰ非同期乗り換え部
１５１ 受信ＦＩＦＯ制御部
２１１ 送信ＦＩＦＯ制御部
３１１，３３１ セレクション処理部
３１２ 受信データＳＯＰ処理部
３１３ 受信バリド処理部
３３２ 送信データＳＯＰ処理部
３３３ 送信ＰＡＶ処理部
４１１，５２１ リード制御部
４１２，５２２ リード可能状態判定部
４１３，５２３ アンダフロー判定部
４２１，５１１ ライト制御部
４２３，５１２ ライト可能状態判定部
４２２，５１３ オーバフロー判定部
４２４ アンフィニッシュ判定部
Ｄ データ部
ＡＨ ＡＴＭセルヘッダ部
ＨＥＣ ＨＥＣバイト部
ＤＬ データ長表示部
─────────────────────────────────────────────────────
フロントページの続き
(56)参考文献 特開 平８−107416（ＪＰ，Ａ)
特開2000−49791（ＪＰ，Ａ)
(58)調査した分野(Int.Cl.7，ＤＢ名)
H04J 3/00
Claims (8)
- 【請求項１】 オーバヘッド領域とペイロード領域とを
含み該ペイロード領域の任意の位置にペイロードを収容
できるデータフレームを用いるデータ伝送方法におい
て、 前記データフレーム上にマッピングするデータフォーマ
ットとして、前記データフレームが前記オーバヘッド領
域とペイロード領域とを含むセル長が一定の長さの既存
の様式の第１のデータフレームセルのセル長のｎ（正の
整数）倍であり、かつセル長を示すデータ長表示部を前
記オーバヘッド領域の情報であるオーバヘッド情報とし
て含む可変長の第２のデータフレームセルを有すること
を特徴とするデータ伝送方法。 - 【請求項２】 前記データフレームが、ＳＯＮＥＴ（同
期光ネットワーク）／ＳＤＨ（同期ディジタルハイアラ
ーキ）システムのデータフレームであり、前記第１のデ
ータフレームセルが、前記ＳＯＮＥＴ（／ＳＤＨシステ
ムのデータフレームセルであるセル長５３バイトのＡＴ
Ｍ（非同期転送モード）セルであることを特徴とする請
求項１記載のデータ伝送方法。 - 【請求項３】 前記第２のデータフレームセルのセル長
が前記第１のデータフレームセルのセル長の１（ｎ＝
１）倍の場合は、前記第１のデータフレームセルを用い
るデータ伝送システムをそのまま使用できるバックコン
パチビリティを有することを特徴とする請求項１記載の
データ伝送方法。 - 【請求項４】 前記第２のデータフレームセルが、１バ
イトの前記データ長表示部を含む６バイトのオーバヘッ
ド情報と、｛４７＋５３×（ｎ−１）｝バイトのデータ
部とを有することを特徴とする請求項１記載のデータ伝
送方法。 - 【請求項５】 オーバヘッド領域とペイロード領域とを
含み該ペイロード領域の任意の位置にペイロードを収容
できるデータフレーム上にマッピングするデータフォー
マットとして、前記データフレームが前記オーバヘッド
領域とペイロード領域とを含むセル長が一定の長さの既
存の様式の第１のデータフレームセルのセル長のｎ（正
の整数）倍であり、かつセル長を示すデータ長表示部を
前記オーバヘッド領域の情報であるオーバヘッド情報と
して含む可変長の第２のデータフレームセルを生成／分
解する物理レイヤデバイスを有するデータ伝送装置にお
いて、 伝送回線からの入力である受信入力データにオーバヘッ
ド処理及び受信した前記第２のデータフレームセルの処
理を含む受信処理を行い受信処理データを出力する受信
処理部と、 送信データの供給を受けオーバヘッド処理及び送信対象
の前記第２のデータフレームセルの処理を含む送信デー
タ処理を行い前記伝送回線に送信出力データとして出力
する送信処理部と、 前記受信処理データを受信データとして上位レイヤに出
力し、この上位レイヤから供給を受ける前記送信データ
を前記送信処理部に入力することにより前記上位レイヤ
と前記受信処理部及び前記送信処理部とをインタフエー
スするインタフエース部とを備えることを特徴とするデ
ータ伝送装置。 - 【請求項６】 前記受信処理部が、前記伝送回線からの
受信入力データの入力インタフェースを行う受信回線Ｉ
／Ｆ部と、 前記受信入力データのオーバヘッド処理を行う受信セク
ションＯ／Ｈ処理部と受信ラインＯ／Ｈ処理部及び受信
パスＯ／Ｈ処理部と、 受信した前記第２のデータフレームセルを処理する第２
の受信データフレームセル処理部と、 前記第１のデータフレームセルを処理する第１の受信デ
ータフレームセル処理部とを備え、 前記送信処理部が、前記インタフエース部から供給を受
けた送信対象の前記第２のデータフレームセルを処理す
る第２の送信データフレームセル処理部と、 送信対象の前記第１のデータフレームセルを処理する第
１の送信データフレームセル処理部と、 送信出力データのオーバヘッド処理を行う送信パスＯ／
Ｈ処理部と送信ラインＯ／Ｈ処理部及び送信セクション
Ｏ／Ｈ処理部と、 前記伝送回線への送信出力データの出力インタフェース
を行う送信回線Ｉ／Ｆ部とを備えることを特徴とする請
求項５記載のデータ伝送装置。 - 【請求項７】 前記受信データフレームセル処理部が、
受信ＦＩＦＯ制御部を備え、 前記第２の送信データフレームセル処理部が、送信ＦＩ
ＦＯ制御部を備えることを特徴とする請求項５記載のデ
ータ伝送装置。とを特徴とする請求項６記載のデータ伝
送装置。 - 【請求項８】 前記受信ＦＩＦＯ制御部が、受信ＦＩＦ
Ｏのメモリ部を構成し前記ライトデータを一時格納し対
応する前記リードデータを出力する受信ＲＡＭと、 前記第２の受信データフレームセルの前記受信ＲＡＭへ
書き込み制御を行い受信ライトアドレスの生成と受信ラ
イトデータの整列を行う受信ライト制御部と、前記受信
ＲＡＭが書き込み可能状態であるかを判定する受信ライ
ト可能状態判定部と、前記受信ＲＡＭの書込時のライト
データの容量超過であるオーバフローを判定するオーバ
フロー判定部とを有し、受信側回線クロックで動作する
回路ブロックから成る受信側回線クロック系と、 前記受信ＲＡＭのリードアドレスの生成及びリードデー
タの整列を行うリード制御部と、前記受信ＲＡＭが読み
出し可能状態であるかを判定するリード可能状態判定部
と、前記受信ＲＡＭの読出時のリードデータ不足である
アンダフローを判定するアンダフロー判定部とを有し受
信クロックで動作する回路ブロックから成る受信クロッ
ク系とを備え、 前記送信ＦＩＦＯ制御部が、送信ＦＩＦＯのメモリ部を
構成しライトデータを一時格納し対応するリードデータ
を出力する前記送信ＲＡＭと、 送信ＲＡＭのリードアドレスの生成及びリードデータの
整列を行うリード制御部と、前記送信ＲＡＭが読み出し
可能状態であるかを判定するリード可能状態判定部と、
前記送信ＲＡＭの読出時のリードデータ不足であるアン
ダフローを判定するアンダフロー判定部とを有し、送信
側回線クロックで動作する回路ブロックから成る送信側
回線クロック系と、入力された前記第２の送信データフ
レームセルの前記送信ＲＡＭへの書き込み制御とライト
アドレスの生成とライトデータの整列を行う送信ライト
制御部と、前記送信ＲＡＭの書込時のライトデータの容
量超過であるオーバフローを判定するオーバフロー判定
部と、前記送信ＲＡＭが書き込み可能状態であるかを判
定するライト可能状態判定部と、前記第２の送信データ
フレームセルの書込の未完了状態を判定するアンフィニ
ッシュ判定部とを有し、送信クロックで動作する回路ブ
ロックから成る送信クロック系とを備えることを特徴と
する請求項７記載のデータ伝送装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2000106089A JP3398707B2 (ja) | 2000-04-07 | 2000-04-07 | データ伝送方法及びデータ伝送装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2000106089A JP3398707B2 (ja) | 2000-04-07 | 2000-04-07 | データ伝送方法及びデータ伝送装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2001292118A JP2001292118A (ja) | 2001-10-19 |
| JP3398707B2 true JP3398707B2 (ja) | 2003-04-21 |
Family
ID=18619325
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2000106089A Expired - Fee Related JP3398707B2 (ja) | 2000-04-07 | 2000-04-07 | データ伝送方法及びデータ伝送装置 |
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| JP (1) | JP3398707B2 (ja) |
Families Citing this family (2)
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| JP2013098890A (ja) * | 2011-11-04 | 2013-05-20 | Fujitsu Ltd | 伝送装置および伝送方法 |
-
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