JP3133864B2 - Transistor amplifier - Google Patents

Transistor amplifier

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JP3133864B2
JP3133864B2 JP05137473A JP13747393A JP3133864B2 JP 3133864 B2 JP3133864 B2 JP 3133864B2 JP 05137473 A JP05137473 A JP 05137473A JP 13747393 A JP13747393 A JP 13747393A JP 3133864 B2 JP3133864 B2 JP 3133864B2
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Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【産業上の利用分野】本発明は、主としてマイクロ波帯
で用いられる、負帰還型のトランジスタ増幅器に関す
る。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a negative feedback type transistor amplifier mainly used in a microwave band.

【0002】[0002]

【従来の技術】マイクロ波帯の増幅端子としては、シリ
コン、あるいはガリウムヒ素等の半導体基板上に作製さ
れたホモ接合あるいはヘテロ接合バイポーラトランジス
タ(以下、単にトランジスタと総称する)がよく用いら
れるが、増幅器に広帯域性、あるいは安定性が要求され
る場合には、トランジスタのベースコレクタ間に抵抗性
の帰還をかけた、負帰還型増幅器の回路構成が採用され
ることが多い。
2. Description of the Related Art As an amplification terminal in a microwave band, a homojunction or heterojunction bipolar transistor (hereinafter simply referred to as a transistor) formed on a semiconductor substrate such as silicon or gallium arsenide is often used. When wide bandwidth or stability is required for an amplifier, a circuit configuration of a negative feedback amplifier in which resistive feedback is applied between a base and a collector of a transistor is often adopted.

【0003】図4は、1段の抵抗負帰還型トランジスタ
増幅器の従来の回路構成を示すものである。ここで、1
9は増幅用のトランジスタでB,C,Eはそれぞれトラ
ンジスタのベース,コレクタ,エミッタを示す。20は
負帰還抵抗(Rf)で、抵抗値が小さいほど帰還量は大
きくなる。21はベースコレクタ間の直流分離キャパシ
タ(Cf)で、通常は対象とする信号の周波数帯で十分
小さなインピーダンスになるような容量を有している。
22,22aは、ベースバイアス抵抗(Rb1,Rb
2)、23はコレクタバイアス抵抗(Rc)、50はバ
イパスキャパシタ(Cs1)、Vbbはベースバイア
ス、Vccはコレクタバイアスを示している。コレクタ
バイアス抵抗Rcの代わりにインダクタが用いられるこ
ともある。信号はベース端子24から入力され、コレク
タ端子25から出力される。本回路構成では、トランジ
スタの有する利得が高い低周波側ではコレクタからベー
スへの負帰還量が大きくなるため、増幅器としての利得
は抑制される。一方、トランジスタの利得が低下する高
周波側では、負帰還量も減少するため増幅器としての利
得抑制は少なく、結果として、増幅器の利得は広帯域で
平坦な特性になる。また、上述の帰還は信号の振幅変動
を抑制する作用も有しているため、増幅器の発振を抑制
し、増幅器を安定化する効果もある。
FIG. 4 shows a conventional circuit configuration of a one-stage resistive negative feedback transistor amplifier. Where 1
Reference numeral 9 denotes an amplifying transistor, and B, C, and E indicate a base, a collector, and an emitter of the transistor, respectively. Reference numeral 20 denotes a negative feedback resistor (Rf), and the feedback amount increases as the resistance value decreases. Reference numeral 21 denotes a DC separating capacitor (Cf) between the base and the collector, which normally has a capacitance so as to have a sufficiently small impedance in a frequency band of a target signal.
22, 22a are base bias resistors (Rb1, Rb
2) and 23 are collector bias resistors (Rc), 50 is a bypass capacitor (Cs1), Vbb is a base bias, and Vcc is a collector bias. An inductor may be used instead of the collector bias resistor Rc. The signal is input from the base terminal 24 and output from the collector terminal 25. In this circuit configuration, the amount of negative feedback from the collector to the base increases on the low-frequency side where the gain of the transistor is high, so that the gain of the amplifier is suppressed. On the other hand, on the high frequency side where the transistor gain is reduced, the amount of negative feedback is also reduced, so that the gain suppression of the amplifier is small. As a result, the gain of the amplifier has a flat characteristic over a wide band. In addition, since the above-mentioned feedback also has a function of suppressing amplitude fluctuation of a signal, it has an effect of suppressing oscillation of the amplifier and stabilizing the amplifier.

【0004】また、図5は、上記従来増幅器の後段に増
幅用トランジスタが接続されている場合を示すものであ
る。ここで、26のトランジスタ,27の負帰還抵抗
(Rf1),28の直流分離キャパシタ(Cf1),2
9,29aのベースバイアス抵抗(Rb3,Rb4),
30のコレクタバイアス抵抗(Rc1),及び51のバ
イパスキャパシタ(Cs1)によって1段目の負帰還増
幅器が構成され、2段目のトランジスタ32には35.
35aのベースバイアス抵抗(Rb5,Rb6),36
のコレクタバイアス抵抗(Rc2)が接続されている。
なお、Vbbはベースバイアス、Vccはコレクタバイ
アスを示している。31は、1段目のトランジスタのコ
レクタと2段目のトランジスタのベースとを直流的に分
離するためのキャパシタ(Cc1)である。信号は端子
37から入力され、端子38から出力される。
FIG. 5 shows a case where an amplifying transistor is connected to a stage subsequent to the conventional amplifier. Here, 26 transistors, 27 negative feedback resistance (Rf1), 28 DC separation capacitor (Cf1), 2
9, 29a base bias resistors (Rb3, Rb4),
The first stage negative feedback amplifier is constituted by the collector bias resistor (Rc1) of 30 and the bypass capacitor (Cs1) of 51.
35a base bias resistors (Rb5, Rb6), 36
Is connected to the collector bias resistor (Rc2).
Vbb indicates a base bias, and Vcc indicates a collector bias. Reference numeral 31 denotes a capacitor (Cc1) for separating the collector of the first-stage transistor and the base of the second-stage transistor in a DC manner. The signal is input from a terminal 37 and output from a terminal 38.

【0005】[0005]

【発明が解決しようとする課題】しかしながら、上記従
来例においては、以下に述べるような問題点、あるいは
改善の余地を含んでいる。
However, the above-described conventional example has the following problems or room for improvement.

【0006】まず、図4に示される従来例において、キ
ャパシタCfの容量が小さくて、対象とする周波数帯で
キャパシタCfが帰還用の抵抗Rfに対して無視し得な
いインピーダンスを有する場合には、キャパシタCfの
インピーダンスによって低周波側での負帰還が抑圧され
るため、低周波側でのトランジスタの利得抑制が不十分
となり、十分な利得平坦性が得られない。一方、キャパ
シタCfのインピーダンスが、抵抗Rfに対して十分小
さくなるようにキャパシタCfの容量を大きくするとキ
ャパシタのサイズが増大し、回路の小型化に不利とな
る。また、いくらキャパシタCfの容量を大きくして
も、トランジスタ自体の利得が周波数が高くなるほど低
下するため、本従来回路では、高周波側で利得が高くな
ような増幅器は実現できない。しかし、該増幅器がある
システムの一構成要素であるような場合、該システムの
各構成要素間を接続する配線等での高周波側での伝送損
失の増大を考慮すると、システムの全体の利得の平坦化
を図るためには、高周波側で利得が増大するような増幅
器があった方が望ましい場合が多い。
First, in the conventional example shown in FIG. 4, when the capacitance of the capacitor Cf is small and the capacitor Cf has an impedance that cannot be ignored with respect to the feedback resistor Rf in a target frequency band, Since the negative feedback on the low frequency side is suppressed by the impedance of the capacitor Cf, the suppression of the transistor gain on the low frequency side becomes insufficient and sufficient gain flatness cannot be obtained. On the other hand, if the capacitance of the capacitor Cf is increased so that the impedance of the capacitor Cf becomes sufficiently smaller than the resistance Rf, the size of the capacitor increases, which is disadvantageous for downsizing the circuit. Also, no matter how large the capacitance of the capacitor Cf, the gain of the transistor itself decreases as the frequency increases, so that an amplifier having a high gain on the high frequency side cannot be realized with the conventional circuit. However, when the amplifier is a component of a certain system, the flatness of the overall gain of the system is considered in consideration of an increase in transmission loss on the high frequency side due to wiring or the like connecting the components of the system. In many cases, it is desirable to have an amplifier that increases the gain on the high frequency side in order to achieve higher performance.

【0007】次に、図5に示される従来例では、2段目
の増幅器の出力端38から、抵抗36(Rc2),抵抗
30(Rc1),抵抗27(Rf1),キャパシタ28
(Cf1)を経由して増幅器の入力端37に至るという
バイアスラインを介した帰還ループが生じているが、各
段のトランジスタは逆相増幅器として動作するため、該
帰還ループの様に2段の増幅器を経由した帰還は正帰還
となり、回路の不安定動作、ひいては発振の原因とな
る。バイパスキャパシタ51(Cs1)の容量を十分大
きくすれば安定性は改善されるが、モノリシック化には
面積的に不利であり、また、外付けのチップコンデンサ
を用いると、低周波では大容量が得られ安定性は改善さ
れるが、コンデンサの有する寄生インダクタンスのため
に増幅すべき周波数帯での特性が劣化してしまう場合が
ある。より具体的な例として、トランジスタ26,32
として図6に示されている等価回路で置換し、Rb3=
Rb5=5kΩ,Rb4=Rb6=20kΩ,Cf1=
20pF,Rf1=1.5kΩ,Rc1=Rc2=50
Ω,Cc1=Cs1=10pFとして図5の回路の利
得、安定指数(通称、K値)を計算すると図7に示すよ
うになる。通過帯域は1GHz付近である。回路が安定動
作するためにはすべての周波数においてK値が1以上に
なることが必要であるが、20MHz付近でK値が1以
下になっており、安定性条件を満たしていない。
Next, in the conventional example shown in FIG. 5, a resistor 36 (Rc2), a resistor 30 (Rc1), a resistor 27 (Rf1) and a capacitor 28 are output from the output terminal 38 of the second stage amplifier.
Although a feedback loop via the bias line, which reaches the input terminal 37 of the amplifier via (Cf1), occurs, the transistors in each stage operate as anti-phase amplifiers. The feedback via the amplifier becomes a positive feedback and causes unstable operation of the circuit and eventually oscillation. If the capacitance of the bypass capacitor 51 (Cs1) is made sufficiently large, the stability will be improved. However, it is disadvantageous in terms of area for monolithic integration. Although the stability is improved, the characteristics in the frequency band to be amplified may be deteriorated due to the parasitic inductance of the capacitor. As a more specific example, transistors 26 and 32
And replaced with the equivalent circuit shown in FIG.
Rb5 = 5 kΩ, Rb4 = Rb6 = 20 kΩ, Cf1 =
20 pF, Rf1 = 1.5 kΩ, Rc1 = Rc2 = 50
When the gain and the stability index (commonly known as K value) of the circuit of FIG. 5 are calculated with Ω, Cc1 = Cs1 = 10 pF, the result is as shown in FIG. The pass band is around 1 GHz. In order for the circuit to operate stably, the K value needs to be 1 or more at all frequencies, but the K value is 1 or less around 20 MHz, which does not satisfy the stability condition.

【0008】本発明は上記の問題点に鑑みてなされたも
のであり、上記従来の問題点を除去した新規な抵抗負帰
還型トランジスタ増幅器を提供することを目的としてい
る。
The present invention has been made in view of the above problems, and has as its object to provide a novel resistor negative feedback transistor amplifier that eliminates the above conventional problems.

【0009】[0009]

【課題を解決するための手段】上記問題点を解決するた
めに、本発明はバイポーラトランジスタのコレクタ端子
にコレクタバイアスが印加され、上記バイポーラトラン
ジスタのベース端子にベースバイアスが印加され、上記
コレクタ端子に第1のキャパシタの一方の端子が接続さ
れ、第1のキャパシタの他方の端子の直後と上記ベース
端子との間で第2のキャパシタと抵抗とを直列接続した
帰還回路が接続され、上記ベース端子に入力された信号
を第1のキャパシタの他方の端子から出力することを特
徴とするものである。また、第1のキャパシタの容量値
の調整によって、増幅器の利得の周波数特性を可変とす
ることを特徴とするものである。
SUMMARY OF THE INVENTION In order to solve the above problems, the present invention provides a bipolar transistor in which a collector bias is applied to a collector terminal, a base bias is applied to a base terminal of the bipolar transistor, and a collector bias is applied to the collector terminal. One terminal of the first capacitor is connected, and a feedback circuit in which a second capacitor and a resistor are connected in series is connected immediately after the other terminal of the first capacitor and the base terminal. Is output from the other terminal of the first capacitor. Further, the frequency characteristic of the gain of the amplifier is made variable by adjusting the capacitance value of the first capacitor.

【0010】[0010]

【作用】本発明においては、トランジスタのコレクタに
接続されたキャパシタの他方の端子から抵抗を介してベ
ースへ帰還がかかるわけであるが、該キャパシタでの電
圧降下によって、該キャパシタがない場合に比べて帰還
量は減少する。言い換えると、トランジスタで得られた
利得の一部を該キャパシタが相殺する事になる。キャパ
シタの複素インピーダンスZはZ=−j/2πfC
(f:周波数,C:キャパシタ容量)…式(1)とな
り、該キャパシタでの電圧降下は周波数が低いほど大き
いので、従来例の場合とは違い低周波側でのトランジス
タの利得の抑制効果が大きくなり、従来例よりも利得の
平坦性の向上が図られる。また、上記従来例のように複
数段の増幅器が接続された場合において、バイアスライ
ンを介した正帰還ループが発生している場合でも、低周
波でのトランジスタの利得が抑制されているため、ルー
プ利得が低下し安定性が向上する。また、式(1)にお
いて、 │Z│>>1 となるCに対しては、該キャパシタでの信号減衰量は周
波数が高くなるに従って6dB/オクターブで減少し、 │Z│<<1 となるCに対しては、信号減衰量は0dB/オクターブ
となる。
According to the present invention, feedback is applied from the other terminal of the capacitor connected to the collector of the transistor to the base via the resistor. Therefore, the amount of feedback decreases. In other words, the capacitor cancels a part of the gain obtained by the transistor. The complex impedance Z of the capacitor is Z = -j / 2πfC
(F: frequency, C: capacitance of the capacitor) Expression (1): Since the voltage drop in the capacitor is larger as the frequency is lower, the effect of suppressing the gain of the transistor on the low frequency side is different from that of the conventional example. As a result, the flatness of the gain is improved as compared with the conventional example. Further, when a plurality of stages of amplifiers are connected as in the above-described conventional example, even if a positive feedback loop occurs via a bias line, the gain of the transistor at a low frequency is suppressed. The gain decreases and the stability improves. Also, in equation (1), for C satisfying | Z | >> 1, the signal attenuation in the capacitor decreases by 6 dB / octave as the frequency increases, and | Z | << 1 For C, the signal attenuation is 0 dB / octave.

【0011】従って、該キャパシタの容量値の調整によ
って実現し得る利得勾配の可変範囲は0dB/オクター
ブから6dB/オクターブまでとなる。トランジスタの
利得は通常6dB/オクターブで減少するが、負帰還回
路部でも利得勾配がある程度平坦化されるので、該キャ
パシタでの利得勾配補正によって、増幅器の利得が高周
波側ほど高くなるようにすることが可能である。なお、
キャパシタのインピーダンスが帰還抵抗に比べて十分小
さくなるように容量を選べば、従来例と同様に高周波側
で利得が低下する増幅器にもすることができる。
Therefore, the variable range of the gain gradient which can be realized by adjusting the capacitance value of the capacitor is from 0 dB / octave to 6 dB / octave. Normally, the gain of the transistor is reduced at 6 dB / octave. However, the gain gradient is flattened to some extent even in the negative feedback circuit portion. Is possible. In addition,
If the capacitance is selected so that the impedance of the capacitor is sufficiently smaller than the feedback resistance, it is possible to provide an amplifier in which the gain is reduced on the high frequency side as in the conventional example.

【0012】[0012]

【実施例】以下に、本発明の実施例を図面に基づき説明
する。
Embodiments of the present invention will be described below with reference to the drawings.

【0013】図1は、1段抵抗負帰還型トランジスタ増
幅器の場合の本発明の一実施例を示すものである。ここ
で、1は増幅用トランジスタ、2は負帰還抵抗(R
f)、3,52,57はキャパシタ(Cf,Cc1,C
s1)、4,4aはベースバイアス抵抗(Rb1,Rb
2)、5はコレクタバイアス抵抗(Rc)、Vbbはベ
ースバイアス、Vccはコレクタバイアスを示し、信号
はベース端子6から入力され、端子7から出力される。
本実施例において、トランジスタのコレクタに接続され
たキャパシタCc1を介してトランジスタのコレクタか
らベースへの抵抗性帰還がかかり、該キャパシタCc1
の一端から信号が出力される点が本発明の特徴とすると
ころである。本回路構成にすることにより、作用のとこ
ろで述べたごとく、キャパシタの容量を小さくすれば高
周波側で利得が増加する特性、キャパシタの容量を十分
大きくすれば、高周波側で利得が減少する特性、これら
の中間の値であれば増幅器の利得の周波数特性を平坦に
することができる。
FIG. 1 shows an embodiment of the present invention in the case of a one-stage resistive negative feedback transistor amplifier. Here, 1 is an amplifying transistor and 2 is a negative feedback resistor (R
f), 3, 52 and 57 are capacitors (Cf, Cc1, C
s1), 4, 4a are base bias resistors (Rb1, Rb
2), 5 is a collector bias resistance (Rc), Vbb is a base bias, and Vcc is a collector bias. A signal is input from the base terminal 6 and output from the terminal 7.
In this embodiment, resistive feedback from the collector to the base of the transistor is applied via the capacitor Cc1 connected to the collector of the transistor, and the capacitor Cc1
A feature of the present invention is that a signal is output from one end of the present invention. By adopting this circuit configuration, as described in the section of the operation, if the capacitance of the capacitor is reduced, the gain increases on the high frequency side, and if the capacitance of the capacitor is sufficiently increased, the gain decreases on the high frequency side. If the value is intermediate, the frequency characteristic of the gain of the amplifier can be flattened.

【0014】次に、上記増幅器の後段に増幅用トランジ
スタを接続した場合の本発明の他の実施例について説明
する。
Next, another embodiment of the present invention in which an amplifying transistor is connected to a stage subsequent to the amplifier will be described.

【0015】図2は、上記実施例に示される増幅器の後
段に増幅用トランジスタが接続されている場合を示すも
のである。ここで、8のトランジスタ、9の負帰還抵抗
(Rf1)、53の直流分離キャパシタ(Cf1)、1
1,11aのベースバイアス抵抗(Rb3.Rb4)、
12のコレクタバイアス抵抗(Rc1)、及び55のバ
イパスキャパシタ(Cs1)によって1段目の負帰還増
幅器が構成され、2段目のトランジスタ13には56,
56aのベースバイアス抵抗(Rb5,Rb6)、16
のコレクタバイアス抵抗(Rc2)が接続されている。
信号は端子17から入力され、端子18から出力され
る。本実施例では作用のところで述べたように、キャパ
シタCc1によって、バイアスラインを介した正帰還ル
ープの低周波側での利得低減ができるので回路の安定動
作が可能となる。
FIG. 2 shows a case where an amplifying transistor is connected to the subsequent stage of the amplifier shown in the above embodiment. Here, 8 transistors, 9 negative feedback resistors (Rf1), 53 DC separation capacitors (Cf1), 1
1, 11a base bias resistors (Rb3.Rb4),
The first stage negative feedback amplifier is constituted by the collector bias resistor (Rc1) of 12 and the bypass capacitor (Cs1) of 55, and 56,
56a base bias resistors (Rb5, Rb6), 16
Is connected to the collector bias resistor (Rc2).
The signal is input from the terminal 17 and output from the terminal 18. In the present embodiment, as described in the section of the operation, the gain can be reduced on the low frequency side of the positive feedback loop via the bias line by the capacitor Cc1, so that the circuit can operate stably.

【0016】より具体的な例として、トランジスタ8,
13を従来例と同じく図6に示されている等価回路で置
換し、他の回路素子もRb3=Rb5=5kΩ,Rb4
=Rb6=20kΩ,Cf1=20pF,Rf1=1.
5kΩ,Rc1=Rc2=50Ω,Cc1=Cs1=1
0pFと従来例と同一にして図2の回路の利得、安定指
数(通称、K値)を計算すると図3に示すようになる。
従来例の特性を示す図7と比較すると1GHz付近の通
過帯域での特性はほとんど同じであるが、従来例ではK
値<1となっていた20MHz付近でも、本実施例では
K値>1となっており、回路が安定化されていることが
わかる。
As a more specific example, the transistor 8,
13 is replaced by the equivalent circuit shown in FIG. 6 similarly to the conventional example, and other circuit elements are also Rb3 = Rb5 = 5 kΩ, Rb4
= Rb6 = 20 kΩ, Cf1 = 20 pF, Rf1 = 1.
5 kΩ, Rc1 = Rc2 = 50Ω, Cc1 = Cs1 = 1
When the gain and stability index (commonly referred to as K value) of the circuit of FIG. 2 are calculated in the same manner as the conventional example with 0 pF, the result is as shown in FIG.
Compared with FIG. 7 showing the characteristics of the conventional example, the characteristics in the pass band around 1 GHz are almost the same,
Even in the vicinity of 20 MHz where the value <1, the present example has a K value> 1, which indicates that the circuit is stabilized.

【0017】なお、本発明は、上記実施例に限定され
ず、請求の範囲にて種々の変更が可能である。
The present invention is not limited to the above embodiment, and various modifications can be made within the scope of the claims.

【0018】[0018]

【発明の効果】以上のように本発明によれば、電源等に
よる不要な帰還に起因する発振を抑制し、利得の周波数
特性の可変範囲が広く、かつ回路の安定動作を可能とす
る負帰還型トランジスタ増幅器を提供することができ
る。
As described above, according to the present invention, negative feedback that suppresses oscillation caused by unnecessary feedback from a power supply or the like, widens the variable range of gain frequency characteristics, and enables stable operation of a circuit. Type transistor amplifier can be provided.

【図面の簡単な説明】[Brief description of the drawings]

【図1】本発明の一実施例に係る回路構成を示す図であ
る。
FIG. 1 is a diagram showing a circuit configuration according to an embodiment of the present invention.

【図2】本発明の他の実施例に係る回路構成を示す図で
ある。
FIG. 2 is a diagram showing a circuit configuration according to another embodiment of the present invention.

【図3】本発明の実施例に係る利得と安定指数の周波数
依存性を示す図である。
FIG. 3 is a diagram illustrating frequency dependence of gain and stability index according to an embodiment of the present invention.

【図4】従来のトランジスタ増幅器の回路構成を示す図
である。
FIG. 4 is a diagram showing a circuit configuration of a conventional transistor amplifier.

【図5】従来の他のトランジスタ増幅器の回路構成を示
す図である。
FIG. 5 is a diagram showing a circuit configuration of another conventional transistor amplifier.

【図6】増幅器を構成するトランジスタの等価回路を示
す図である。
FIG. 6 is a diagram showing an equivalent circuit of a transistor included in the amplifier.

【図7】従来のトランジスタ増幅器の利得と安定指数の
周波数依存性を示す図である。
FIG. 7 is a diagram showing the frequency dependence of the gain and stability index of a conventional transistor amplifier.

【符号の説明】[Explanation of symbols]

1,8,13,19,26,32 トランジスタ 2,9,20,27 負帰還抵抗 3,10,21,28,31,50,51,52,5
3,55,57 キャパシタ 4,4a,11,11a,22,22a,29,29
a,35,35a,56,56a ベースバイアス抵抗 5,12,16,23,30,36 コレクタバイアス
抵抗 6,17,24,37 信号入力端子 7,18,25,38 信号出力端子
1, 8, 13, 19, 26, 32 Transistor 2, 9, 20, 27 Negative feedback resistor 3, 10, 21, 28, 31, 50, 51, 52, 5
3,55,57 Capacitors 4,4a, 11,11a, 22,22a, 29,29
a, 35, 35a, 56, 56a Base bias resistor 5, 12, 16, 23, 30, 36 Collector bias resistor 6, 17, 24, 37 Signal input terminal 7, 18, 25, 38 Signal output terminal

Claims (2)

(57)【特許請求の範囲】(57) [Claims] 【請求項1】 バイポーラトランジスタのコレクタ端子
にコレクタバイアスが印加され、上記バイポーラトラン
ジスタのベース端子にベースバイアスが印加され、上記
コレクタ端子に第1のキャパシタの一方の端子が接続さ
れ、第1のキャパシタの他方の端子の直後と上記ベース
端子との間で第2のキャパシタと抵抗とを直列接続した
帰還回路が接続され、上記ベース端子に入力された信号
を第1のキャパシタの他方の端子から出力することを特
徴とするトランジスタ増幅器。
A collector bias applied to a collector terminal of the bipolar transistor; a base bias applied to a base terminal of the bipolar transistor; one terminal of a first capacitor connected to the collector terminal; A feedback circuit in which a second capacitor and a resistor are connected in series is connected immediately after the other terminal of the first capacitor and the base terminal, and a signal input to the base terminal is output from the other terminal of the first capacitor. A transistor amplifier.
【請求項2】 第1のキャパシタの容量値の調整によっ
て、増幅器の利得の周波数特性を可変とすることを特徴
とする請求項1に記載のトランジスタ増幅器。
2. The transistor amplifier according to claim 1, wherein the frequency characteristic of the gain of the amplifier is made variable by adjusting the capacitance value of the first capacitor.
JP05137473A 1993-06-08 1993-06-08 Transistor amplifier Expired - Fee Related JP3133864B2 (en)

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