JP3112230B2 - Waveform analyzer - Google Patents
Waveform analyzerInfo
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- JP3112230B2 JP3112230B2 JP06163731A JP16373194A JP3112230B2 JP 3112230 B2 JP3112230 B2 JP 3112230B2 JP 06163731 A JP06163731 A JP 06163731A JP 16373194 A JP16373194 A JP 16373194A JP 3112230 B2 JP3112230 B2 JP 3112230B2
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- data
- waveform
- memory
- display
- control circuit
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- Expired - Lifetime
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- Recording Measured Values (AREA)
- Controls And Circuits For Display Device (AREA)
Description
【0001】[0001]
【産業上の利用分野】本発明は、波形解析装置に関し、
詳しくは多チャンネルの波形データを扱う装置の波形表
示方式の改善に関するものである。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a waveform analyzer.
More specifically, the present invention relates to an improvement in a waveform display method of a device that handles multi-channel waveform data.
【0002】[0002]
【従来の技術】従来より、多チャンネルの波形解析装置
においては1画面上に複数の波形を同時表示させる場合
があるが、その際の波形表示方式は、オペレータの判断
により図6に示すような数種類のフォーマットから所望
のフォーマットを選択することにより表示する方式であ
った。図6(a)は1画面に1個のスケールで1波形表
示する場合、同図(b)は2個のスケールで各1波形ず
つ表示する場合、同図(c)は4個のスケールで4波形
表示ずる場合、同図(d)は8個のスケールで8波形表
示する場合の表示形式をそれぞれ示す。2. Description of the Related Art Conventionally, in a multi-channel waveform analyzer, a plurality of waveforms may be simultaneously displayed on one screen. In this case, the waveform display method is as shown in FIG. This is a method of displaying by selecting a desired format from several types of formats. 6A shows a case where one waveform is displayed on one screen on one scale, FIG. 6B shows a case where one waveform is displayed on two scales, and FIG. 6C shows four waveforms on one scale. In the case where four waveforms are displayed, FIG. 4D shows a display format when eight waveforms are displayed on eight scales.
【0003】[0003]
【発明が解決しようとする課題】しかしながら、このよ
うな表示方式では、多チャンネルになればなるほど横方
向のスケール値が多種多様になる可能性が高く、スケー
ル上に正しく波形表示させることが困難になるという欠
点があった。However, in such a display system, it is highly possible that the more channels are used, the more likely the horizontal scale value will be diversified, making it difficult to display a waveform on the scale correctly. There was a disadvantage of becoming.
【0004】本発明の目的は、多チャンネルであるがゆ
えに多種多様になる波形表示データを自動的に分類し、
しかも表示本数に見合った最適なフォーマットで表示す
ることのできる表示機能を持ち、波形表示のための煩雑
な設定が不要な多チャンネルの波形解析装置を実現しよ
うとするものである。[0004] It is an object of the present invention to automatically classify various kinds of waveform display data because of multi-channels,
Moreover, it is an object of the present invention to provide a multi-channel waveform analyzer having a display function capable of displaying in an optimal format corresponding to the number of displays, and requiring no complicated setting for waveform display.
【0005】[0005]
【課題を解決するための手段】このような目的を達成す
るために本発明では、複数チャンネルのアナログ入力信
号を個別にデジタル信号に変換する複数のアナログ・デ
ジタル変換器と、前記アナログ・デジタル変換器に対し
て個別にサンプルレートとデータ長を制御することので
きるアクイジション制御回路と、前記デジタル変換され
た各チャンネルのデータを記憶するメモリと、スケール
および波形を描画するための表示器と、前記アクイジシ
ョン制御回路に対して各チャンネルごとのサンプルレー
トとデータ長を指定すると共にそのサンプルレートとデ
ータ長を含む設定情報をメモリに記憶し、前記メモリに
記憶された入力信号のデータと前記設定情報を読み込み
データの個数と各データの測定時間から最適な表示形式
を決定し、スケールおよび波形データを前記表示器に描
画する手段を具備したことを特徴とする。According to the present invention, a plurality of analog-to-digital converters for individually converting a plurality of channels of analog input signals into digital signals are provided. An acquisition control circuit capable of individually controlling a sample rate and a data length for a device, a memory for storing the digitally converted data of each channel, a display for drawing a scale and a waveform, and A sample rate and a data length for each channel are designated for the acquisition control circuit, and setting information including the sample rate and the data length is stored in a memory, and the data of the input signal and the setting information stored in the memory are stored. Determine the optimal display format from the number of read data and the measurement time of each data, and And waveform data, characterized by comprising means for rendering on the display device.
【0006】[0006]
【作用】CPUからアクイジション制御回路に各チャン
ネルのサンプルレートと測定データ長を指定する。アク
イジション制御回路はこの指定に基づきAD変換器によ
りデジタル変換された入力信号をメモリを格納する。C
PUはメモリから波形データと設定情報を読み込み、波
形データ数と各波形データの測定時間を算出し、最適な
表示形式を自動選択する。その後選択した表示形式に基
づいてスケールおよび波形データを表示器に描画する。The sampling rate and measured data length of each channel are designated from the CPU to the acquisition control circuit. The acquisition control circuit stores the input signal digitally converted by the AD converter based on the designation in a memory. C
The PU reads the waveform data and setting information from the memory, calculates the number of waveform data and the measurement time of each waveform data, and automatically selects an optimal display format. Thereafter, the scale and the waveform data are drawn on the display based on the selected display format.
【0007】[0007]
【実施例】以下図面を用いて本発明を詳しく説明する。
図1は本発明に係る波形解析装置の一実施例を示す構成
図である。図において、11 〜1n はアナログ入力信
号、21 〜2n はアナログ入力信号をデジタル信号に変
換するアナログ・デジタル変換器(以下アナログ・デジ
タル変換をAD変換と略す)、3はサンプルレートとデ
ータ長を制御できるアクイジション制御回路、4はデジ
タル変換された各入力信号を記憶するメモリ、5は中央
処理装置(以下CPUという)、6はプログラムが格納
されたリード・オンリー・メモリ(ROM)、7は内部
メモリ(通常ランダム・アクセス・メモリ(RAM)が
用いられる)、8は表示器である。BRIEF DESCRIPTION OF THE DRAWINGS FIG.
FIG. 1 is a configuration diagram showing one embodiment of a waveform analyzer according to the present invention. In the figure, 1 1 to 1 n are analog input signals, 2 1 to 2 n are analog / digital converters for converting analog input signals into digital signals (hereinafter, analog / digital conversion is abbreviated as AD conversion), and 3 is a sample rate. And an acquisition control circuit capable of controlling the data length, 4 is a memory for storing digitally converted input signals, 5 is a central processing unit (hereinafter referred to as CPU), 6 is a read-only memory (ROM) storing a program. , 7 is an internal memory (normally a random access memory (RAM) is used), and 8 is a display.
【0008】AD変換器21 〜2n はアクイジション制
御回路3からのサンプルレートの指定に従ってアナログ
入力信号をAD変換する。各チャンネルごとの変換デー
タはメモリ4に格納される。CPU5は、アクイジショ
ン制御回路3に対して各チャンネルごとのサンプルレー
トおよびサンプルデータ数(これを設定情報という)を
それぞれ指定する機能、メモリ4に格納されたデータを
読み込み、ROMに格納されている制御プログラムを実
行して表示器8にスケールと波形を描画する機能、メモ
リ4から読み込んだデータを必要に応じて算術加工(例
えば四則演算、高速フーリエ変換演算、データ間の演算
等)しスケールと波形を表示器8に描画する機能等を有
する。なお、上記設定情報はデータの測定開始前にメモ
リ4あるいはRAM7(本実施例ではメモリ4に格納さ
れる場合を例にとる)に格納される。その設定は図示し
ない入力回路からCPU7に入力され、メモリ4に書き
込まれる。RAM7は一時的にデータやコマンドの保存
に利用されるメモリである。[0008] AD converter 2 1 to 2 n is the analog input signal to the AD conversion according to the specified sample rate from the acquisition control circuit 3. The conversion data for each channel is stored in the memory 4. The CPU 5 functions to specify the sample rate and the number of sample data for each channel to the acquisition control circuit 3 (this is referred to as setting information). The CPU 5 reads the data stored in the memory 4 and controls the data stored in the ROM. A function of executing a program to draw a scale and a waveform on the display 8, and performing arithmetic processing (for example, arithmetic operations, fast Fourier transform operations, operations between data, and the like) on the data read from the memory 4 as needed, and performing scale and waveform operations. Is drawn on the display 8. The setting information is stored in the memory 4 or the RAM 7 (in this embodiment, the case where the setting information is stored in the memory 4) before the start of data measurement. The setting is input to the CPU 7 from an input circuit (not shown) and is written to the memory 4. The RAM 7 is a memory used for temporarily storing data and commands.
【0009】このような構成における動作を次に説明す
る。アクイジション制御回路3はCPU5からサンプル
レートとデータ個数が指定され、これに基づいてAD変
換器を制御して入力データをサンプルすると共にメモリ
4に格納するデータの個数も制御する。メモリ4に格納
されるチャンネルごとのデータ個数とその測定時間の情
報はRAMに記憶される。The operation in such a configuration will be described below. The acquisition control circuit 3 is designated by the CPU 5 with a sample rate and the number of data. Based on the sample rate and the number of data, the acquisition control circuit 3 samples the input data and controls the number of data to be stored in the memory 4. Information on the number of data for each channel stored in the memory 4 and the measurement time is stored in the RAM.
【0010】次にCPU5はメモリ4に格納されている
入力信号の波形データを読み出し、ROMに書かれてい
る制御プログラムによって表示器8にスケールと波形を
描画する。また、読み込んだ波形データに対して必要に
応じて算術加工を施し、加工されたデータについてのス
ケールで波形を描画することもできる。CPUは、波形
描画の波形データをメモリ4から読み出す時、アクイジ
ション制御回路3に対して指定した設定情報(サンプル
レートとデータ数)もRAM6あるいはメモリ4から読
み込む。Next, the CPU 5 reads the waveform data of the input signal stored in the memory 4 and draws a scale and a waveform on the display 8 by a control program written in the ROM. Further, arithmetic processing may be performed on the read waveform data as needed, and a waveform may be drawn on the scale of the processed data. When reading the waveform data of the waveform drawing from the memory 4, the CPU also reads, from the RAM 6 or the memory 4, the setting information (the sample rate and the number of data) specified for the acquisition control circuit 3.
【0011】アクイジション制御回路3は1チャンネル
ごとにサンプルレートとデータ数の設定情報をそれぞれ
設定することができるが、複数チャンネルを単位として
共通設定するグループ設定とすることもできる。いずれ
にしても、メモリに格納されているデータの測定開始か
ら終了までの時間は各チャンネルごとあるいはグループ
ごとに異なる場合がある。例えば、入力11 のデータは
m秒間サンプルされ(このデータをデータaとする)、
入力12はn秒間(n<m)サンプルされ(このデータ
をデータbとする)た場合、データaのスケールに描画
した場合は図2の(a)のように表示され、データbの
スケールに描画した場合は図2の(b)のように表示さ
れる。図2の(a)の場合はデータa、データb共に見
えるが、図2(b)の場合はデータaが一部しか見えな
くなってしまう。このような場合、図3に示すように表
示の種類を変えて描画すると見やすくなる。多チャンネ
ルの場合、表示の種類の選択・切り換えを手動で行うの
はすべてのデータ測定時間を知った上で行う必要があ
り、操作も煩雑である。Although the acquisition control circuit 3 can set the setting information of the sample rate and the number of data for each channel, the acquisition control circuit 3 can also be set as a group for commonly setting a plurality of channels. In any case, the time from the start to the end of the measurement of the data stored in the memory may be different for each channel or each group. For example, data of the input 1 1 is m seconds samples (for this data with data a),
Input 1 2 is n seconds (n <m) sample if (this data and data b) were, if drawn to scale data a is displayed as in FIG. 2 (a), the scale of the data b Is drawn as shown in FIG. 2B. In the case of FIG. 2A, both the data a and the data b are visible, but in the case of FIG. 2B, the data a is only partially visible. In such a case, it is easier to see by drawing with different display types as shown in FIG. In the case of multi-channel, it is necessary to manually select and switch the display type after knowing all data measurement times, and the operation is complicated.
【0012】本発明では次のような動作によりこれを自
動的に行う。CPU5は波形解析装置で表示可能な表示
形式(例えば、図6に示すようなSINGLE,DUA
L,QUAD,OCTAL等の表示形式)と表示する波
形の本数から最適なものを選出する。またCPU5はメ
モリ4に格納されているデータと設定情報から、データ
の個数、各データの測定時間の情報を作成し、この情報
と表示形式とを組み合わせて表示する。例えば、測定時
間が2種類(m秒とn秒)のデータがそれぞれ8個ずつ
合計16個(16チャンネル分)あった場合、図3に示
すように4組のグラフ(1組当たり4個の波形が表示さ
れる)でなる表示形式となる。また同様にデータが32
個(32チャンネル分)あった場合は図4に示すような
表示形式となる。In the present invention, this is automatically performed by the following operation. The CPU 5 displays a display format (for example, SINGLE, DUA as shown in FIG.
L, QUAD, OCTAL, etc.) and the number of waveforms to be displayed. Further, the CPU 5 creates information on the number of data and the measurement time of each data from the data and the setting information stored in the memory 4, and displays this information in combination with the display format. For example, when there are a total of 16 (for 16 channels) data of two types (m seconds and n seconds) of two types of measurement time, as shown in FIG. 3, four graphs (four graphs per group) are used. (A waveform is displayed). Similarly, if the data is 32
In the case where the number is 32 (for 32 channels), the display format is as shown in FIG.
【0013】図5はメモリ4からデータを読み出し波形
描画までの動作を示すフロー図である。設定情報を読み
込んだ後、データ加工を行うものは所定のデータ加工を
施し、スケールの描画と波形の描画を行うようになって
いる。どのデータについてどのような加工を施すかは予
め設定できる。例えばその情報はRAM7に記憶され、
CPU5により適宜参照できるようになっている。FIG. 5 is a flowchart showing an operation from reading data from the memory 4 to drawing a waveform. After reading the setting information, the data processing unit performs a predetermined data processing to draw a scale and a waveform. Which processing is to be performed on which data can be set in advance. For example, the information is stored in the RAM 7,
It can be referred to by the CPU 5 as appropriate.
【0014】なお、データ加工でFFT演算を行った場
合には、横軸が周波数軸となる。この場合も横軸の値が
異なるデータについては表示形式の最適な組合せが自動
的に選択される。When an FFT operation is performed in data processing, the horizontal axis is the frequency axis. Also in this case, the optimum combination of display formats is automatically selected for data having different values on the horizontal axis.
【0015】[0015]
【発明の効果】以上説明したように本発明によれば、多
チャンネルのデータを表示するに際し横軸の値(スケー
ル)が異なるデータについては自動的に最適な表示形式
を選出し表示することができ、表示に関する複雑な操作
を必要とせず、マンマシンインターフェースも簡易なも
のにできるという効果がある。As described above, according to the present invention, when displaying multi-channel data, it is possible to automatically select and display the optimum display format for data having different values (scales) on the horizontal axis. There is an effect that a complicated operation for display is not required and the man-machine interface can be simplified.
【図1】本発明に係る波形解析装置の一実施例を示す構
成図。FIG. 1 is a configuration diagram showing one embodiment of a waveform analyzer according to the present invention.
【図2】スケールの異なる波形の表示例を示す図。FIG. 2 is a view showing a display example of waveforms having different scales.
【図3】スケールが4個の場合の表示形式を示す図。FIG. 3 is a diagram showing a display format when there are four scales.
【図4】スケールが8個の場合の表示形式を示す図。FIG. 4 is a diagram showing a display format when there are eight scales.
【図5】データ読み込みから波形描画までの処理フロー
を示す図。FIG. 5 is a diagram showing a processing flow from data reading to waveform drawing.
【図6】各種表示形式を示す図。FIG. 6 is a view showing various display formats.
11 〜1n 入力信号 21 〜2n AD変換器 3 アクイジション制御回路 4 メモリ 5 CPU 6 ROM 7 RAM 8 表示器1 1 to 1 n input signal 2 1 to 2 n AD converter 3 acquisition control circuit 4 memory 5 CPU 6 ROM 7 RAM 8 display
Claims (1)
にデジタル信号に変換する複数のアナログ・デジタル変
換器と、 前記アナログ・デジタル変換器に対して個別にサンプル
レートとデータ長を制御することのできるアクイジショ
ン制御回路と、 前記デジタル変換された各チャンネルのデータを記憶す
るメモリと、 スケールおよび波形を描画するための表示器と、 前記アクイジション制御回路に対して各チャンネルごと
のサンプルレートとデータ長を指定すると共にそのサン
プルレートとデータ長を含む設定情報をメモリに記憶
し、前記メモリに記憶された入力信号のデータと前記設
定情報を読み込みデータの個数と各データの測定時間か
ら最適な表示形式を決定し、スケールおよび波形データ
を前記表示器に描画する手段を具備したことを特徴とす
る波形解析装置。1. A plurality of analog-to-digital converters for individually converting a plurality of channels of analog input signals into digital signals, and a sample rate and a data length can be individually controlled for the analog-to-digital converters. An acquisition control circuit; a memory for storing the digitally converted data of each channel; a display for drawing a scale and a waveform; and a sample rate and data length for each channel for the acquisition control circuit. At the same time, the setting information including the sample rate and the data length is stored in the memory, and the input signal data and the setting information stored in the memory are read, and the optimal display format is determined from the number of data and the measurement time of each data. Means for drawing scale and waveform data on the display. And a waveform analyzer.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP06163731A JP3112230B2 (en) | 1994-07-15 | 1994-07-15 | Waveform analyzer |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP06163731A JP3112230B2 (en) | 1994-07-15 | 1994-07-15 | Waveform analyzer |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH0829455A JPH0829455A (en) | 1996-02-02 |
JP3112230B2 true JP3112230B2 (en) | 2000-11-27 |
Family
ID=15779600
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP06163731A Expired - Lifetime JP3112230B2 (en) | 1994-07-15 | 1994-07-15 | Waveform analyzer |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3112230B2 (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH1014397A (en) * | 1996-07-03 | 1998-01-20 | Daisuke Goie | Grafting for tree |
Families Citing this family (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP4103134B2 (en) | 2003-02-27 | 2008-06-18 | 横河電機株式会社 | Waveform display device and waveform display method |
JP4579661B2 (en) * | 2004-12-07 | 2010-11-10 | 日置電機株式会社 | Measurement result display device and measurement result display method |
CN103034585B (en) * | 2011-09-28 | 2017-09-05 | 泰克科技(中国)有限公司 | The collection Memory Allocation of digital storage oscilloscope |
-
1994
- 1994-07-15 JP JP06163731A patent/JP3112230B2/en not_active Expired - Lifetime
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH1014397A (en) * | 1996-07-03 | 1998-01-20 | Daisuke Goie | Grafting for tree |
Also Published As
Publication number | Publication date |
---|---|
JPH0829455A (en) | 1996-02-02 |
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