JP2972778B2 - Recording device - Google Patents

Recording device

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JP2972778B2
JP2972778B2 JP2312611A JP31261190A JP2972778B2 JP 2972778 B2 JP2972778 B2 JP 2972778B2 JP 2312611 A JP2312611 A JP 2312611A JP 31261190 A JP31261190 A JP 31261190A JP 2972778 B2 JP2972778 B2 JP 2972778B2
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Description

【発明の詳細な説明】 [発明の目的] (産業上の利用分野) 本発明は、画データに応じて画像の記録を行う、例え
ば電子写真記録装置、熱記録装置等の記録装置に関す
る。
DETAILED DESCRIPTION OF THE INVENTION [Object of the Invention] (Industrial application field) The present invention relates to a recording device such as an electrophotographic recording device and a thermal recording device for recording an image in accordance with image data.

(従来の技術) 記録装置の一種であるレーザプリンタでは、画データ
に応じてレーザダイオードによる発光/非発光を制御し
つつ、このレーザダイオードから発せられたレーザ光を
感光体面上に走査することにより露光動作を行う。
(Prior art) A laser printer, which is a type of recording device, scans a photoreceptor surface with laser light emitted from the laser diode while controlling light emission / non-light emission by a laser diode according to image data. Perform an exposure operation.

ここで画データは第9図にS1で示すように、1画素分
の走査期間T1毎に当該期間の全域にわたって「H」また
は「L」レベルとなる信号である。そして従来は、レー
ザダイオードの駆動信号は第9図にS2で示すように画デ
ータS1のタイミングをそのまま利用する。従って、レー
ザダイオードの発光/非発光の制御は、1画素分の走査
期間T1を1単位として行われ、発光時にはこのT1の期間
中全域にわたってレーザダイオードが発光する。
Here, as shown by S1 in FIG. 9, the image data is a signal which becomes “H” or “L” level over the entire area of each scanning period T1 for one pixel. Conventionally, as shown by S2 in FIG. 9, the drive signal of the laser diode uses the timing of the image data S1 as it is. Therefore, control of the light emission / non-emission of the laser diode is performed scan period T 1 of the one pixel as a unit, the laser diode emits light for a period in the entire region of the T 1 is the time of emission.

ところで、感光体は入射光量に応じてその電気抵抗値
が変化するものであり、従って光の入射時間に応じて電
荷の減衰量が変化する。そして前述したような駆動信号
S2でレーザダイオードの駆動を行った場合、第10図
(a)に示すような画素が形成される。ここで斜線で示
した円形の領域が記録される画素であり、また破線で示
した正方形の領域が1画素の領域である。
Incidentally, the electric resistance of the photoreceptor changes according to the amount of incident light, and therefore, the amount of charge decay changes according to the incident time of light. And the drive signal as described above
When the laser diode is driven in S2, a pixel as shown in FIG. 10A is formed. Here, a circular area indicated by oblique lines is a pixel to be recorded, and a square area indicated by a broken line is an area of one pixel.

このように、1画素分の走査期間T1中の全域にわたっ
てレーザダイオードが発光すると、1画素領域をすべて
覆う画素を記録することができ、この画素によれば、第
10図(b)に示すようなベタ黒画像を隙間無く記録で
き、良好なベタ黒濃度を得ることができる。しかし、例
えばベイヤータイプのディザなどを適用した画像を記録
する場合において、例えば第10図(c)示すような記録
パターンを得ようとした場合、第10図(a)に示す1画
素領域からはみ出した画素であると、良好な階調再現が
行えなくなってしまう。また、細かい文字などを記録す
るときにおいても、つぶれなどが生じる。
Thus, when the laser diode emits light over the entire duration of the scan T 1 of the one pixel, it is possible to record the pixels covering all the pixel regions, according to the pixel, the
(10) A solid black image as shown in FIG. (B) can be recorded without gaps, and a good solid black density can be obtained. However, for example, when printing an image to which a Bayer-type dither or the like is applied, if, for example, an attempt is made to obtain a recording pattern as shown in FIG. 10 (c), it will extend beyond the one pixel area shown in FIG. 10 (a). If the pixel is a defective pixel, good tone reproduction cannot be performed. Also, when recording fine characters or the like, crushing or the like occurs.

そこで、レーザダイオードの駆動信号を、第9図にS3
で示すように信号が「H」レベルとなる期間を1画素分
の走査期間T1よりも短い期間T2とすることが考えられ
る。このようにすると、例えば第11図(a)に示すよう
に1画素領域内に収まる画素となり、ベイヤータイプの
ディザなどを適用した画像を記録する場合には第11図
(b)に示すような記録パターンを得られ、良好な中間
調再現が行える。しかし、この場合には、ベタ黒画像の
記録を行うと、第11図(c)に示すように各画素の間に
隙間が生じ、十分なベタ黒濃度が得られなくなってしま
う。
The drive signal of the laser diode is shown in FIG.
Signal, as shown in it is considered to be a short time period T 2 than the scanning period T 1 of the one pixel period becomes "H" level. In this way, for example, as shown in FIG. 11 (a), the pixels fall within one pixel area, and when an image to which a Bayer type dither or the like is applied is recorded, as shown in FIG. 11 (b). A recording pattern can be obtained, and good halftone reproduction can be performed. However, in this case, when a solid black image is recorded, a gap is generated between pixels as shown in FIG. 11 (c), and a sufficient solid black density cannot be obtained.

以上説明した不具合は、発光ダイオード(LED)プリ
ンタ、液晶(LCD)プリンタなどの他の電子写真記録装
置、サーマルプリンタ、熱転写プリンタなどの熱記録装
置、インクジェット記録装置あるいは静電記録装置など
においても同様である。
The disadvantages described above also apply to other electrophotographic recording devices such as light emitting diode (LED) printers and liquid crystal (LCD) printers, thermal recording devices such as thermal printers and thermal transfer printers, ink jet recording devices or electrostatic recording devices. It is.

(発明が解決しようとする課題) 以上のように従来の記録装置では、離散的に配置され
た画素により形成される擬似中間調(ディザなど)画像
や文字などの画像と、集中的に配置された画素により形
成されるベタ黒画像などの画像との両方を良好に記録す
ることが困難であった。
(Problems to be Solved by the Invention) As described above, in the conventional recording apparatus, pseudo halftone (dither and the like) images formed by discretely arranged pixels and images such as characters are intensively arranged. It has been difficult to satisfactorily record both an image such as a solid black image formed by the pixels.

本発明はこのような事情を考慮してなされたものであ
り、その目的とするところは、擬似中間調画像や文字な
どの画像とベタ黒画像などの画像との両方を良好に、し
かもたとえ1枚分の画像中に両画像が混在していたとし
てもその両方を良好に記録できる記録装置を提供するこ
とにある。
The present invention has been made in view of such circumstances, and an object of the present invention is to satisfactorily reproduce both an image such as a pseudo halftone image or a character and an image such as a solid black image. An object of the present invention is to provide a recording apparatus capable of favorably recording both images even if both images are mixed in one image.

[発明の構成] (課題を解決するための手段) 本発明は、それぞれ画素の形成/非形成を示した画素
データの配列である画データに応じて、画素形成手段に
より画素を形成することによって記録を行う記録装置に
おいて、前記画データのうちの注目画素データについ
て、当該注目画素データに応じて形成される画素の大き
さを示す例えば発光時間設定信号や3ビットのデータな
どの画素サイズ設定信号を、例えば発光時間設定部や通
電時間設定部などのデータテーブルで、当該注目画素デ
ータが示す画素の縦方向に並んだ所定の画素の状態に応
じて出力し、前記画データのうちの各画素データに応じ
て画素の形成を行う際、前記画素サイズ設定手段で各画
素データについて出力された画素サイズ設定信号が示す
画素サイズの画素を形成するべく、例えば1画素の形成
を行う形成時間または1画素の形成を行う形成エネルギ
ー量を変化させるよう画素形成手段を制御するようにし
た。
[Configuration of the Invention] (Means for Solving the Problems) According to the present invention, pixels are formed by pixel forming means in accordance with image data which is an array of pixel data indicating formation / non-formation of pixels. In a recording apparatus that performs recording, a pixel size setting signal such as a light emission time setting signal or 3-bit data indicating the size of a pixel formed in accordance with the pixel data of interest with respect to the pixel data of interest in the image data For example, in a data table such as a light emission time setting unit and a conduction time setting unit, output according to the state of predetermined pixels arranged in the vertical direction of the pixel indicated by the target pixel data, and output each pixel of the image data. When forming a pixel according to data, a pixel having a pixel size indicated by a pixel size setting signal output for each pixel data by the pixel size setting means is formed. Ku, and to control the pixel-forming means so as to vary the formation energy amount for performing formation time or a pixel formation effect formation of one pixel, for example.

(作 用) このような手段を講じたことにより、画データに基づ
いて画素の配列、すなわち集中度が識別され、この識別
された画素の集中度に応じて各画素の記録に係る形成時
間または形成エネルギー量が変更設定される。
(Operation) By taking such means, the arrangement of pixels, that is, the degree of concentration is identified based on the image data, and the formation time or the recording time of each pixel is recorded in accordance with the degree of concentration of the identified pixels. The amount of formation energy is changed and set.

従って、画素の集中度に応じて各画素の大きさが可変
されることになり、必要に応じた大きさの画素が適宜記
録される。
Therefore, the size of each pixel is changed according to the degree of concentration of the pixel, and a pixel having a size as required is recorded as appropriate.

(第1の実施例) 以下、図面を参照して本発明の第1の実施例に付き説
明する。
First Embodiment Hereinafter, a first embodiment of the present invention will be described with reference to the drawings.

第1図は本発明に係る記録装置を適用して構成された
レーザプリンタの要部構成を示す図である。このレーザ
プリンタは、インタフェース部1、制御部2、画像メモ
リ3、シフトレジスタ4a,4b,4c、発光時間設定部5、レ
ーザスキャナユニット(以下、LSUと称する)6および
感光体ドラム7を具備して構成される。
FIG. 1 is a diagram showing a main configuration of a laser printer configured by applying the recording apparatus according to the present invention. This laser printer includes an interface unit 1, a control unit 2, an image memory 3, shift registers 4a, 4b, 4c, a light emission time setting unit 5, a laser scanner unit (hereinafter referred to as LSU) 6, and a photosensitive drum 7. It is composed.

インタフェース部1は、図示しない装置外部または装
置内の他の部分(例えば、本レーザプリンタはファクシ
ミリ装置の記録部に適用されるが、この場合には例えば
送受信装置に当たる)より画データを取り込む。このイ
ンタフェース部1で取り込まれた画データは制御部2を
介して画像メモリ3に格納される。画像メモリ3は、少
なくとも1ページ分の画データを記憶可能なメモリであ
る。画像メモリ3に格納された画データは、1ページ分
の画データが蓄積される毎に当該1ページ分が制御部2
によって順次読出され、シフトレジスタ4aに入力され
る。
The interface unit 1 fetches image data from the outside of the apparatus (not shown) or another part inside the apparatus (for example, the laser printer is applied to a recording unit of a facsimile apparatus, but in this case, it corresponds to a transmission / reception apparatus). The image data captured by the interface unit 1 is stored in the image memory 3 via the control unit 2. The image memory 3 is a memory capable of storing at least one page of image data. The image data stored in the image memory 3 is stored in the control unit 2 each time one page of image data is accumulated.
Are sequentially read and input to the shift register 4a.

シフトレジスタ4a〜4cは、それぞれ画データのクロッ
クを転送クロックとしてシフト動作を行う。シフトレジ
スタ4a〜4cは、それぞれ1ライン分の画データに含まれ
る画素データと同数のビット数を有している。そしてシ
フトレジスタ4a〜4cは、シフトレジスタ4aの出力がシフ
トレジスタ4bへ、またシフトレジスタ4bの出力がシフト
レジスタ4cへとそれぞれ入力されるよう直列的に接続さ
れている。従って、各シフトレジスタ4a〜4cのそれぞれ
の出力QA,QB,QCは、連続する3ラインのうちの主走査方
向(横方向)について同一位置にある画素、すなわち副
走査方向に連続する3つの画素の画素データである。
Each of the shift registers 4a to 4c performs a shift operation using the clock of the image data as a transfer clock. Each of the shift registers 4a to 4c has the same number of bits as the pixel data included in the image data for one line. The shift registers 4a to 4c are connected in series so that the output of the shift register 4a is input to the shift register 4b and the output of the shift register 4b is input to the shift register 4c. Accordingly, respective outputs Q A, Q B, Q C of each shift register 4a~4c is continuous pixels at the same position in the main scanning direction (lateral direction) of the three successive lines, i.e. in the sub scanning direction This is pixel data of three pixels.

発光時間設定部5は例えばROM(図示せず)を備えて
なり、シフトレジスタ4a〜4cのそれぞれの出力QA,QB,QC
を受けて、これらの各出力の状態から、記録しようとす
る画素(シフトレジスタ4bが出力している画素データに
対応する画素)を中心としての副走査方向に連続する3
つの画素の配列状態を識別し、その配列状態に応じた発
光時間設定信号SAをLSU6へと出力する。
The luminous time setter 5 will comprise, for example, the ROM (not shown), the respective outputs Q A of the shift register 4 a to 4 c, Q B, Q C
In response to this, from these output states, three consecutive pixels in the sub-scanning direction centering on the pixel to be recorded (the pixel corresponding to the pixel data output from the shift register 4b).
An arrangement state of the two pixels is identified, and a light emission time setting signal SA corresponding to the arrangement state is output to the LSU6.

LSU6は、レーザ光61を発するレーザダイオード62、レ
ーザダイオード62から発せられたレーザ光61を所定径の
光とするコリメータレンズ63、ポリゴンモータ64により
所定速度で等速回転し、レーザ光61を感光体ドラム7の
感光面に走査せしめるポリゴンミラー65、ポリゴンミラ
ー65で反射したレーザ光61を感光体ドラム7の感光面に
等速走査させるf−θレンズ66および、シフトレジスタ
4bから出力された画データSBに応じてレーザダイオード
62を駆動するための駆動信号SCを発生する発光駆動部67
からなる。発光駆動部67は、発光時間設定部5から出力
された発光時間設定信号SAに基づき、レーザダイオード
62の発光時間を可変制御する機能を有する。なお、感光
体ドラム7の周辺には、図示は省略しているが、帯電、
現像、転写、定着、クリーニング、除電などの電子写真
方式における露光以外のプロセスを実行する装置が配さ
れ、反転現像方式の電子写真記録装置を構成している。
The LSU 6 is rotated at a predetermined speed by a laser diode 62 that emits a laser beam 61, a collimator lens 63 that uses the laser beam 61 emitted from the laser diode 62 as light having a predetermined diameter, and a polygon motor 64 to expose the laser beam 61 to light. A polygon mirror 65 for scanning the photosensitive surface of the drum 7, an f-θ lens 66 for scanning the laser beam 61 reflected by the polygon mirror 65 on the photosensitive surface of the drum 7 at a constant speed, and a shift register
Laser diode according to image data SB output from 4b
A light emission drive section 67 that generates a drive signal SC for driving 62
Consists of The light emission drive unit 67 is configured to output a laser diode based on the light emission time setting signal SA output from the light emission time setting unit 5.
It has a function of variably controlling the light emission time of 62. In addition, although not shown in the figure around the photosensitive drum 7, charging,
An apparatus for performing processes other than exposure in the electrophotographic system such as development, transfer, fixing, cleaning, and static elimination is arranged, and constitutes an electrophotographic recording apparatus of a reversal development system.

次に以上のように構成されたレーザプリンタの動作を
説明する。まず記録動作時には、画像メモリ3に格納さ
れた画データが制御部2によって順次読出され、シフト
レスタ4aに入力される。そしてシフトレジスタ4aに入力
された画データは、シフトレジスタ4a内、シフトレジス
タ4b内およびシフトレジスタ4c内を順次転送される。こ
こで、シフトレジスタ4a〜4cは初期状態では内容がクリ
アされている。従って、シフトレジスタ4aに3ライン目
の画データの入力が開始された時点にシフトレジスタ4b
からは1ライン目の画データが出力され、発光駆動部67
への画データの入力が始まる。
Next, the operation of the laser printer configured as described above will be described. First, at the time of the recording operation, the image data stored in the image memory 3 is sequentially read by the control unit 2 and input to the shift restor 4a. The image data input to the shift register 4a is sequentially transferred in the shift register 4a, the shift register 4b, and the shift register 4c. Here, the contents of the shift registers 4a to 4c are cleared in the initial state. Accordingly, when the input of the third line of image data to the shift register 4a is started, the shift register 4b
Output the image data of the first line,
The input of image data to starts.

発光駆動部67は、シフトレジスタ4bの出力データに基
づいてレーザダイオード62の発光/非発光の制御を行う
のであるが、この状態において発光時間設定部5では次
のような処理が行なわれている。
The light emission drive section 67 controls light emission / non-light emission of the laser diode 62 based on output data of the shift register 4b. In this state, the light emission time setting section 5 performs the following processing. .

発光時間設定部5には、第2図に示すデータテーブル
が設定されている。そして発光時間設定部5は、シフト
レジスタ4a〜4cのそれぞれの出力を3ビットのデータと
して取り込み、これに対応したデータをデータテーブル
から取り出して発光時間設定信号SAとして発光駆動部67
へと与える。すなわち、シフトレジスタ4a〜4cで抽出さ
れた縦方向(副走査方向)に連続する3つの画素の状態
を識別する。そして、この識別した状態に応じてA,B,C
の3状態のうちのいずれかを選択決定し、この選択決定
した状態を示すデータを発光時間設定信号SAとして発光
駆動部67へと与える。ここでシフトレジスタ4bの出力は
発光駆動部67に画データSBとして入力されているから、
発光時間設定部5はレーザダイオード62が発光される状
態においてA,B,Cの3状態のうちのいずれかを選択決定
する。
The data table shown in FIG. 2 is set in the light emission time setting section 5. The light emission time setting section 5 takes in the respective outputs of the shift registers 4a to 4c as 3-bit data, extracts data corresponding to the data from the data table, and outputs the data as a light emission time setting signal SA as a light emission drive section 67.
Give to That is, the state of three pixels that are consecutive in the vertical direction (sub-scanning direction) extracted by the shift registers 4a to 4c are identified. Then, according to the identified state, A, B, C
One of the three states is selected and determined, and data indicating the selected state is given to the light emission drive section 67 as the light emission time setting signal SA. Here, since the output of the shift register 4b is input to the light emission drive unit 67 as the image data SB,
The light emission time setting unit 5 selects and determines one of three states A, B, and C in a state where the laser diode 62 emits light.

具体的には、シフトレジスタ4a〜4cで抽出された副走
査方向に連続する3つの画素の中央の画素が「黒」であ
るとき、当該連続する3つの画素の状態は第3図に
(a)〜(d)で示す4状態が考えられる。
Specifically, when the central pixel of three consecutive pixels in the sub-scanning direction extracted by the shift registers 4a to 4c is "black", the state of the three consecutive pixels is shown in FIG. ) To (d).

すなわち、 第3図(a)に示すように中央の画素のみが「黒」
である状態。
That is, as shown in FIG. 3A, only the center pixel is "black".
State.

第3図(b)に示すように中央の画素の他に1つ前
のラインの画素(図中では上側の画素)が「黒」である
状態。
As shown in FIG. 3 (b), in addition to the central pixel, the pixel of the immediately preceding line (upper pixel in the figure) is in a state of “black”.

第3図(c)に示すように中央の画素の他に1つ後
ろのラインの画素(図中では下側の画素)が「黒」であ
る状態。
As shown in FIG. 3 (c), in addition to the center pixel, the pixel on the next line (the lower pixel in the figure) is "black".

第3図(d)に示すようにすべての画素が「黒」で
ある状態。
A state where all the pixels are “black” as shown in FIG.

の4状態である。There are four states.

そして発光時間設定部5は、上記のケースでは状態
「A」を、上記またはのケースでは状態「B」を、
また上記のケースでは状態「C」を選択決定し、これ
を発光時間設定信号SAで発光駆動部67へ通知する。
Then, the light emission time setting unit 5 displays the state “A” in the above case, the state “B” in the above or the above case,
In the above case, the state “C” is selected and determined, and this is notified to the light emission drive unit 67 by the light emission time setting signal SA.

これに応じて発光駆動部67は、第4図に示すように、
状態「A」であるときには1画素走査期間T1中のTA期間
に、状態「B」であるときには1画素走査期間T1中のTB
期間に、そして状態「C」であるときには1画素走査期
間T1中のTC期間にそれぞれ駆動信号SCを「H」レベルと
する。ここで、TA,TB,TCは、[TA<TB<TC≦T1]なる関
係が成り立つように任意に設定されている。なお本実施
例では、TCについては[TC=T1]となっている。
In response to this, the light emission drive unit 67, as shown in FIG.
When the state is “A”, it is T A during one pixel scanning period T 1 , and when the state is “B”, it is T B during one pixel scanning period T 1
Period, and each driving signal SC T C period of one pixel scanning period T 1 when the state "C" and "H" level. Here, T A , T B , and T C are arbitrarily set such that the relationship [T A <T B <T C ≦ T 1 ] is satisfied. In the present embodiment has a [T C = T 1] for T C.

かくして、副走査方向について1画素独立の黒画素は
小さな発光時間での露光が行われ、例えば第5図(a)
に示すように1画素領域の各辺に接触しない程度の小さ
な画素が記録される。また副走査方向について2画素連
続の黒画素は中間の発光時間での露光が行われ、例えば
第5図(b)に示すように1画素領域に内接する画素が
記録される。さらに副走査方向について3画素以上連続
の黒画素は長い発光時間での露光が行われ、例えば第5
図(c)に示したような1画素領域に外接する画素が記
録される。ただし、副走査方向について3画素以上連続
の黒画素の場合、上下端に位置する画素は2画素連続の
場合と同じ大きさとなる。
Thus, a black pixel independent of one pixel in the sub-scanning direction is exposed for a short light emission time, for example, as shown in FIG.
As shown in (1), a pixel as small as not to touch each side of one pixel area is recorded. In addition, two consecutive black pixels in the sub-scanning direction are exposed at an intermediate light emission time, and for example, pixels inscribed in one pixel area are recorded as shown in FIG. 5B. Further, black pixels that are continuous in three or more pixels in the sub-scanning direction are exposed for a long light emission time, for example, the fifth pixel.
Pixels circumscribing one pixel area as shown in FIG. However, in the case of three or more continuous black pixels in the sub-scanning direction, the pixels located at the upper and lower ends have the same size as in the case of two consecutive pixels.

これにより、離散的に画素が配置された部分、すなわ
ちベイヤータイプのディザなどの擬似中間調画像や文字
などの領域では、1画素領域からはみ出さない程度の小
さな画素が形成され、良好な中間調の再現および繊細な
文字の記録が行える。また集中的に画素が配置された部
分、すなわちベタ黒画像などの領域では、1画素領域を
覆う程度の大きな画素が形成され、十分なベタ黒濃度を
得られる。
As a result, in a portion where pixels are discretely arranged, that is, in a region such as a pseudo halftone image such as a Bayer type dither or a character, small pixels that do not protrude from one pixel region are formed. And record delicate characters. In a portion where pixels are arranged intensively, that is, in a region such as a solid black image, a pixel large enough to cover one pixel region is formed, and a sufficient solid black density can be obtained.

なお、本実施例では副走査方向に連続する3つの画素
の状態を認識しているため、3画素以上連続の黒画素で
あっても両端部の1画素ずつは2画素連続の黒画素とし
て判定され、やや小さい画素(1画素領域からはみ出さ
ない画素)が記録されるものとなっている。すなわち、
ベタ黒画像は第6図に示すような状態で記録されるもの
となっているが、このように上下端の1画素ずつが1画
素領域からはみ出さない程度の小さな画素となっている
ことにより、視覚上はこのベタ黒画像部分と白地部分と
の境界がはっきりと表れ、より理想に近い記録状態が得
られる。また、本実施例によれば、発光時間設定部5を
データテーブルにより構成しているので、複雑なロジッ
クを組む必要が無く簡易な構成により実現でき、かつ仕
様変更などに伴い、注目画素の周囲画素の状態と注目画
素の画素サイズとの関係を変更する場合でも、それを比
較的容易に行うことが可能である。
In the present embodiment, the state of three consecutive pixels in the sub-scanning direction is recognized. Therefore, even if three or more consecutive black pixels are present, one pixel at each end is determined as two consecutive black pixels. Thus, slightly smaller pixels (pixels that do not protrude from one pixel area) are recorded. That is,
The solid black image is recorded in a state as shown in FIG. 6, but since each pixel at the upper and lower ends is a small pixel that does not protrude from the one pixel area, Visually, the boundary between the solid black image portion and the white background portion clearly appears, and a more ideal recording state can be obtained. Further, according to the present embodiment, since the light emission time setting unit 5 is constituted by a data table, it can be realized with a simple structure without the necessity of assembling a complicated logic. Even when the relationship between the state of the pixel and the pixel size of the pixel of interest is changed, it can be done relatively easily.

(第2の実施例) 以下、本発明の第2の実施例につき説明する。Second Embodiment Hereinafter, a second embodiment of the present invention will be described.

第7図は本発明に係る記録装置を適用して構成された
サーマルプリンタの要部構成を示す図である。このサー
マルプリンタは、ヘッドコントローラ10、イネーブル信
号発生回路20、画データ処理部30、ヘッドドライバ40お
よびサーマルヘッド50を具備して構成される。
FIG. 7 is a diagram showing a main configuration of a thermal printer configured by applying the recording apparatus according to the present invention. This thermal printer includes a head controller 10, an enable signal generation circuit 20, an image data processing unit 30, a head driver 40, and a thermal head 50.

ヘッドコントローラ10は、図示しない装置外部または
装置内の他の部分(例えば、本サーマルプリンタはファ
クシミリ装置の記録部に適用されるが、この場合には例
えば送受信装置に当たる)より出力された画データを受
け、この画データに同期して、イネーブル信号の生成に
供するタイミング信号と、ラッチ信号と、クロック信号
とを生成する。
The head controller 10 converts image data output from an external device (not shown) or another portion within the device (for example, the present thermal printer is applied to a recording unit of a facsimile apparatus, but in this case, for example, corresponds to a transmission / reception apparatus). Then, in synchronization with the image data, a timing signal, a latch signal, and a clock signal for generating an enable signal are generated.

イネーブル信号発生回路20は、ヘッドコントローラ10
で生成されたタイミング信号に基づき、後述するイネー
ブル信号を生成し、ヘッドドライバ40へと与える。
The enable signal generation circuit 20 includes the head controller 10
Based on the timing signal generated in step (1), an enable signal described later is generated and supplied to the head driver 40.

画データ処理部30は、シフトレジスタ31a,31b,31c、
通電時間設定部32、ラインメモリ33および出力制御回路
34から構成される。
The image data processing unit 30 includes shift registers 31a, 31b, 31c,
Energizing time setting section 32, line memory 33 and output control circuit
Consists of 34.

シフトレジスタ31a〜31cは、それぞれ画データのクロ
ックを転送クロックとしてシフト動作を行う。シフトレ
ジスタ31a〜31cは、それぞれ1ライン分の画データに含
まれる画素データと同数のビット数を有している。そし
てシフトレジスタ31a〜31cは、シフトレジスタ31aの出
力がシフトレジスタ31bへ、またシフトレジスタ31bの出
力がシフトレジスタ31cへとそれぞれ入力されるよう直
列的に接続されている。従って、各シフトレジスタ31a
〜31cのそれぞれの出力QA,QB,QCは、連続する3ライン
のうちの主走査方向(横方向)について同一位置にある
画素、すなわち副走査方向に連続する3つの画素の画素
データである。通電時間設定部32は例えばROMよりな
り、シフトレジスタ31a〜31cのそれぞれの出力QA,QB,QC
を受けて、この出力QA,QB,QCで示されるデータに応じた
3ビットデータを出力する。ラインメモリ33は、通電時
間設定部32で1画素に付き3ビットとされた画データを
1ライン分記憶する。出力制御回路34は、ヘッドコント
ローラ10から出力されたクロック信号およびラッチ信号
に基づいて後述する手順でラインメモリ33内のデータを
記録データとして出力させる。
The shift registers 31a to 31c each perform a shift operation using the clock of the image data as a transfer clock. Each of the shift registers 31a to 31c has the same number of bits as the pixel data included in the image data for one line. The shift registers 31a to 31c are connected in series so that the output of the shift register 31a is input to the shift register 31b and the output of the shift register 31b is input to the shift register 31c. Therefore, each shift register 31a
Each output Q A of ~31c, Q B, Q C is the pixel in the same position in the main scanning direction (lateral direction) of the three successive lines, i.e. three consecutive pixels in the sub-scanning direction pixel data It is. The energization time setting unit 32 is composed of, for example, a ROM, and outputs Q A , Q B , and Q C of the shift registers 31a to 31c, respectively.
Receiving, and outputs the 3-bit data corresponding to the output Q A, Q B, data indicated by Q C. The line memory 33 stores one line of image data that has been set to 3 bits per pixel by the energization time setting unit 32. The output control circuit 34 causes the data in the line memory 33 to be output as recording data in a procedure described later based on the clock signal and the latch signal output from the head controller 10.

ヘッドドライバ40は、シフトレジスタ41、ラッチ回路
42、アンドゲート43−1,43−2…,43−nおよびスイッ
チアンプ44−1,44−2…,44−nからなる。
The head driver 40 includes a shift register 41, a latch circuit
, 43-n and switch amplifiers 44-1, 44-2 ..., 44-n.

シフトレジスタ41は、nビットシフトレジスタ(nは
記録する画像の1ライン中の画素数)であり、ラインメ
モリ33から出力された記録データを転送・保持し、パラ
レルに出力する。ラッチ回路42は、ヘッドコントローラ
10から出力されるラッチ信号に同期してシフトレジスタ
41のnビットの出力を取り込み、保持する。ラッチ回路
42のnビットの出力は、それぞれアンドゲート43−1,43
−2…,43−nの一方の入力端に入力される。アンドゲ
ート43−1,43−2…,43−nの他方の入力端にはイネー
ブル信号発生回路20で生成されたイネーブル信号が入力
されており、このイネーブル信号が「H」レベルである
ときのみラッチ回路42の出力をスイッチアンプ44−1,44
−2…,44−nにそれぞれ与える。スイッチアンプ44−
1,44−2…,44−nはそれぞれ、サーマルヘッド50を構
成するn個の発熱抵抗体R−1,R−2…,R−nのそれぞ
れに接続されており、入力が「H」レベルであるときに
のみ+24Vの駆動電圧を対応する発熱抵抗体に印加す
る。
The shift register 41 is an n-bit shift register (n is the number of pixels in one line of an image to be recorded), transfers and holds the recording data output from the line memory 33, and outputs the data in parallel. Latch circuit 42 is a head controller
Shift register in synchronization with the latch signal output from 10
41 n-bit outputs are captured and held. Latch circuit
The 42 n-bit outputs are AND gates 43-1, 43
-2,..., 43-n. The other input terminal of each of the AND gates 43-1, 43-2,..., 43-n receives the enable signal generated by the enable signal generation circuit 20, and only when this enable signal is at "H" level. The output of the latch circuit 42 is connected to the switch amplifiers 44-1, 44.
-2,..., 44-n. Switch amplifier 44−
, 44-n are respectively connected to the n heating resistors R-1, R-2,..., Rn constituting the thermal head 50, and the input is "H". A drive voltage of +24 V is applied to the corresponding heating resistor only when the level is at the level.

次に以上のように構成されたサーマルプリンタの動作
を説明する。まず記録動作時に画データが入力される
と、ヘッドコントローラ10がこの画データを取り込み、
画データ処理部30へと与える。画データ処理部30では、
シフトレジスタ31a〜31cで副走査方向に連続する3つの
画素データが抽出され、出力される。そしてこのシフト
レジスタ31a〜31cから出力された3つの画素データに応
じた3ビットのデータが通電時間設定部32から出力され
る。つまり、任意の画素データ(以下、注目画素データ
と称する)が示す画素(注目画素)の縦方向両端に位置
する画素の状態に基づいて、注目画素データが3ビット
データに変換される。このように1画素に付き3ビット
とされた画データは、ラインメモリ33に記憶される。な
お、通電時間設定部32が出力する3ビットのデータは、
例えば次のように設定されている。
Next, the operation of the thermal printer configured as described above will be described. First, when image data is input during a recording operation, the head controller 10 captures this image data,
It is provided to the image data processing unit 30. In the image data processing unit 30,
Three pixel data continuous in the sub-scanning direction are extracted and output by the shift registers 31a to 31c. Then, 3-bit data corresponding to the three pixel data output from the shift registers 31a to 31c is output from the energization time setting unit 32. That is, the target pixel data is converted into 3-bit data based on the state of the pixels located at both ends in the vertical direction of the pixel (target pixel) indicated by arbitrary pixel data (hereinafter, referred to as target pixel data). The image data of 3 bits per pixel is stored in the line memory 33. The 3-bit data output from the energization time setting unit 32 is:
For example, it is set as follows.

第3図(a)に示すように中央の画素のみが「黒」
である状態、すなわちQA,QB,QCがそれぞれ「0」、
「1」、「0」である状態では「001」。
As shown in FIG. 3 (a), only the central pixel is "black"
State is, i.e. Q A, Q B, Q C are "0",
"001" in the state of "1" and "0".

第3図(b)に示すように中央の画素の他に1つ前
のラインの画素(図中では上側の画素)が「黒」である
状態、すなわちQA,QB,QCがそれぞれ「1」、「1」、
「0」である状態では「010」。
State (in the upper side in the drawing of the pixel) FIG. 3 (b) 1 one pixel of the previous line as the other center pixel shown in is "black", i.e. Q A, Q B, Q C, respectively "1", "1",
"010" in the state of "0".

第3図(c)に示すように中央の画素の他に1つ後
ろのラインの画素(図中では下側の画素)が「黒」であ
る状態、すなわちQA,QB,QCがそれぞれ「0」、「1」、
「1」である状態では「010」。
Figure 3 state in addition to one behind the line pixels of the center pixel as shown in (c) (the lower side of the pixel in the figure) is "black", i.e. Q A, Q B, Q C is "0", "1",
"010" when it is "1".

第3図(d)に示すようにすべての画素が「黒」で
ある状態、すなわちQA,QB,QCがそれぞれ「1」、
「1」、「1」である状態では「100。」 中央の画素が「白」である状態、すなわちQB
「0」である状態では「000」。
Figure 3 state all the pixels as shown in (d) is "black", i.e. Q A, Q B, Q C are "1",
"1", "1" in the state is "100." state central pixel is "white", i.e., in the state Q B is "0", "000".

以上の処理が行われ、ラインメモリ33に1ライン分の
画データが記憶されると、出力制御回路34は、ラインメ
モリ33に記憶された1ライン分の画データのうちの、各
画素データの第1ビット(最下位ビット)のみを順次ラ
インメモリ33から出力させる。このようにしてラインメ
モリ33から出力された記録データは、ヘッドドライバ40
へと入力される。ヘッドドライバ40では、この入力され
た記録データをシフトレジスタ41に順次取込む(第8図
中の期間イ)。
When the above processing is performed and the image data of one line is stored in the line memory 33, the output control circuit 34 outputs the image data of each pixel of the image data of one line stored in the line memory 33. Only the first bit (least significant bit) is sequentially output from the line memory 33. The print data output from the line memory 33 in this manner is stored in the head driver 40.
Is entered. The head driver 40 sequentially takes in the input recording data into the shift register 41 (period a in FIG. 8).

一方、ヘッドコントローラ10は、シフトレジスタ41へ
の第1ビットのデータの取り込みが終了したのちに、ラ
ッチ信号LAとして所定時間幅のパルスを出力する(第8
図中のロで示されるパルス)。これにより、シフトレジ
スタ41に保持されているデータがラッチ回路42に取り込
まれ、保持される。
On the other hand, the head controller 10 outputs a pulse having a predetermined time width as the latch signal LA after the fetch of the first bit data into the shift register 41 is completed (eighth pulse)
(Pulse shown by b in the figure). Thus, the data held in the shift register 41 is taken into the latch circuit 42 and held.

シフトレジスタ41に保持されているデータがラッチ回
路42に取り込まれたのち、出力制御回路34は、ラインメ
モリ33に記憶された1ライン分の画データのうちの、各
画素データの第2ビットのみを順次ラインメモリ33から
出力させる。このようにしてラインメモリ33から出力さ
れた記録データは、前述したのと同様にシフトレジスタ
41に順次取込まれる。(第8図中の期間ハ)。
After the data held in the shift register 41 is captured by the latch circuit 42, the output control circuit 34 determines only the second bit of each pixel data of the image data for one line stored in the line memory 33. Are sequentially output from the line memory 33. The recording data output from the line memory 33 in this manner is stored in the shift register in the same manner as described above.
It is taken into 41 sequentially. (Period c in FIG. 8).

ところで、イネーブル信号発生回路20では、ヘッドコ
ントローラ10から与えられるタイミング信号に基づき、
ラッチ信号LAのパルスから所定期間後にパルスを発生し
ている。ここでイネーブル信号発生回路20からは、それ
ぞれ異なるパルス幅TA,TB,TC(TA<TB<TC)を有するパ
ルスが順次、すなわちパルス幅TAのパルス→パルス幅TB
のパルス→パルス幅TCのパルス→TAのパルス…の順で出
力される。つまり、イネーブル信号発生回路20が発生す
るイネーブル信号ENは、第8図に示すような信号であ
る。
By the way, in the enable signal generation circuit 20, based on a timing signal given from the head controller 10,
A pulse is generated after a predetermined period from the pulse of the latch signal LA. Here, pulses having different pulse widths T A , T B , and T C (T A <T B <T C ) are sequentially output from the enable signal generation circuit 20, that is, a pulse having a pulse width T A → a pulse width T B.
It is the output of a pulse ... the order of the pulse → pulse width T C of the pulse → T A. That is, the enable signal EN generated by the enable signal generation circuit 20 is a signal as shown in FIG.

ここでまず、第8図にニで示すパルス幅TAのパルスが
イネーブル信号としてイネーブル信号発生回路20から出
力されると、ヘッドドライバ40のアンドゲート43−1〜
43−nがこのTAの期間だけON状態となる。このとき、ラ
ッチ回路42には1ライン分の画データのうちの、各画素
データの第1ビットが保持されているから、このデータ
がスイッチアンプ44−1〜44−nのそれぞれにTAの期間
だけ入力される。かくしてスイッチアンプ44−1〜44−
nは、1ライン分の画データのうちの、各画素データの
第1ビットに基づいて、TAの期間だけ発熱抵抗体R−1
〜R−nへの電圧印加の制御を行う。
First, when a pulse having a pulse width T A shown in FIG. 8 is output from the enable signal generation circuit 20 as an enable signal, the AND gates 43-1 to 43-1 of the head driver 40 are output.
43-n is ON only during this period of T A. At this time, among the image data of one line in the latch circuit 42, since the first bit of each pixel data is held, the T A the data to each of the switch amplifier 44-1 to 44-n Entered only for the period. Thus, the switch amplifiers 44-1 to 44-
n is one of the lines of image data, based on the first bit of each pixel data, the heating resistor for a period of T A R-1
To R-n.

こののち、シフトレジスタ41への第2ビットのデータ
の取り込みが終了し、ラッチ信号LAとして第8図にホで
示すパルスがヘッドコントローラ10から出力されると、
ラッチ回路42はシフトレジスタ41に保持されているデー
タを取り込み、保持する。続いて、シフトレジスタ41に
保持されているデータがラッチ回路42に取り込まれたの
ち、出力制御回路34は、ラインメモリ33に記憶された1
ライン分の画データのうちの、各画素データの第3ビッ
トのみを順次ラインメモリ33から出力させる。このよう
にしてラインメモリ33から出力された記録データは、前
述したのと同様にシフトレジスタ41に順次取込まれる
(第8図中の期間へ)。
After that, the fetching of the second bit data into the shift register 41 is completed, and when the pulse indicated by E in FIG. 8 is output from the head controller 10 as the latch signal LA,
The latch circuit 42 captures and holds the data held in the shift register 41. Subsequently, after the data held in the shift register 41 is taken into the latch circuit 42, the output control circuit 34
Only the third bit of each pixel data of the image data of the line is sequentially output from the line memory 33. The recording data output from the line memory 33 in this manner is sequentially taken into the shift register 41 in the same manner as described above (to the period in FIG. 8).

ラッチ信号LAとして第8図にホで示すパルスがヘッド
コントローラ10から出力されてから若干の時間の経過
後、イネーブル信号発生回路20からはイネーブル信号と
してパルス幅TBのパルス(第8図にトで示すパルス)が
出力される。これにより、アンドゲート43−1〜43−n
がこのTBの期間だけON状態となる。このとき、ラッチ回
路42には1ライン分の画データのうちの、各画素データ
の第2ビットが保持されているから、このデータがスイ
ッチアンプ44−1〜44−nのそれぞれにTBの期間だけ入
力される。かくしてスイッチアンプ44−1〜44−nは、
1ライン分の画データのうちの、各画素データの第2ビ
ットに基づいて、TBの期間だけ発熱抵抗体R−1〜R−
nへの電圧印加の制御を行う。
After a slight time pulse indicated by e in FIG. 8 as a latch signal LA from being outputted from the head controller 10, Doo pulse (FIG. 8 pulse width T B as an enable signal from the enable signal generating circuit 20 Is output. Thereby, the AND gates 43-1 to 43-n
But the ON state only during the period of the T B. At this time, among the image data of one line in the latch circuit 42, since the second bit of each pixel data is held, this data is T B to each of the switch amplifier 44-1 to 44-n Entered only for the period. Thus, the switch amplifiers 44-1 to 44-n are
Of the image data of one line, based on the second bit of each pixel data, only the heating resistor period T B R-1~R-
Control of voltage application to n.

さらに、シフトレジスタ41への第3ビットのデータの
取り込みが終了し、ラッチ信号LAとして第8図にチで示
すパルスがヘッドコントローラ10から出力されると、ラ
ッチ回路42はシフトレジスタ41に保持されているデータ
を取り込み、保持する。
Further, when the third bit of data has been fetched into the shift register 41 and the pulse shown in FIG. 8 as a latch signal LA is output from the head controller 10, the latch circuit 42 is held in the shift register 41. Capture and retain the data

ラッチ信号LAとして第8図にチで示すパルスがヘッド
コントローラ10から出力されてから若干の時間の経過
後、イネーブル信号発生回路20からはイネーブル信号と
してパルス幅TCのパルス(第8図にリで示すパルス)が
出力される。これにより、アンドゲート43−1〜43−n
がこのTCの期間だけON状態となる。このとき、ラッチ回
路42には1ライン分の画データのうちの、各画素データ
の第3ビットが保持されているから、このデータがスイ
ッチアンプ44−1〜44−nのそれぞれにTCの期間だけ入
力される。かくしてスイッチアンプ44−1〜44−nは、
1ライン分の画データのうちの、各画素データの第3ビ
ットに基づいて、TCの期間だけ発熱抵抗体R−1〜R−
nへの電圧印加の制御を行う。
After a slight time pulse indicated by switch in FIG. 8 as a latch signal LA from being outputted from the head controller 10, Li pulse (FIG. 8 pulse width T C as an enable signal from the enable signal generating circuit 20 Is output. Thereby, the AND gates 43-1 to 43-n
But the ON state only during the period of this T C. At this time, among the image data of one line in the latch circuit 42, since the third bit of each pixel data is held, from T C this data to each of the switch amplifier 44-1 to 44-n Entered only for the period. Thus, the switch amplifiers 44-1 to 44-n are
Of the image data of one line, based on the third bit of each pixel data, only the heating resistor period T C R-1~R-
Control of voltage application to n.

以降上述の処理を次ライン以降のラインの画データに
ついて繰り返し行う。
Thereafter, the above processing is repeated for the image data of the lines following the next line.

ここで、通電時間設定部32から出力される3ビットの
データは前述したように、抽出した3つの画素のうちの
中央の画素のみが「黒」である場合には「001」、中央
の画素とその上下のいずれかの画素が「黒」である場合
には「010」、全ての画素が「黒」である場合には「10
0」、そして中央の画素が「白」である場合には「000」
としてある。すなわち、抽出した3つの画素のうちの中
央の画素のみが「黒」である場合には第1ビットのみ
が、中央の画素とその上下のいずれかの画素が「黒」で
ある場合には第2ビットのみが、そして全ての画素が
「黒」である場合には第3ビットのみがそれぞれ「1」
となっている。
Here, as described above, the 3-bit data output from the energization time setting unit 32 is “001” when only the central pixel of the extracted three pixels is “black”, and And “010” when any of the pixels above and below is “black”, and “10” when all the pixels are “black”
0 ", and" 000 "if the center pixel is" white "
There is. That is, when only the central pixel among the three extracted pixels is “black”, only the first bit is included, and when the central pixel and one of its upper and lower pixels are “black”, the first bit is extracted. Only two bits, and if all pixels are "black", only the third bit is "1" respectively.
It has become.

従って、抽出した3つの画素のうちの中央の画素のみ
が「黒」である場合には、この中央の画素は発熱抵抗体
TA期間の電圧印加による発熱によって記録される。中央
の画素とその上下のいずれかの画素が「黒」である場合
には、中央の画素は発熱抵抗体のTB期間の電圧印加によ
る発熱によって記録される。また全ての画素が「黒」で
ある場合には、中央の画素は発熱抵抗体のTC期間の電圧
印加による発熱によって記録される。なお、中央の画素
が「白」である場合には得られる3ビットのデータは
「000」であるので、当然の事ながら発熱抵抗体への電
圧印加はなく、画点は形成されない。
Therefore, when only the central pixel among the three extracted pixels is “black”, the central pixel is the heating resistor
It is recorded by heat generated by voltage application T A period. If any of the pixels of the central pixel and its upper and lower is "black", the central pixels are recorded by heat generated by voltage application of T B period of the heating resistor. When all the pixels are “black”, the central pixel is recorded by the heat generated by the voltage application of the heating resistor during the TC period. When the center pixel is “white”, the obtained 3-bit data is “000”, so that no voltage is applied to the heating resistor and no pixel is formed.

かくして、副走査方向について1画素独立の黒画素は
小さな通電時間での露光が行われ、例えば第5図(a)
に示すように1画素領域の各辺に接触しない程度の小さ
な画素が記録される。また副走査方向について2画素連
続の黒画素は中間の通電時間での露光が行われ、例えば
第5図(b)に示すように1画素領域に内接する画素が
記録される。さらに副走査方向について3画素以上連続
の黒画素は長い通電時間での露光が行われ、例えば第5
図(c)に示したような1画素領域に外接する画素が記
録される。ただし、副走査方向について3画素以上連続
の黒画素の場合、上下端に位置する画素は2画素連続の
場合と同じ大きさとなる。
Thus, the black pixel independent of one pixel in the sub-scanning direction is exposed for a short energizing time, for example, as shown in FIG.
As shown in (1), a pixel as small as not to touch each side of one pixel area is recorded. In addition, two consecutive black pixels in the sub-scanning direction are exposed during an intermediate energization time, and for example, pixels inscribed in one pixel area are recorded as shown in FIG. 5B. Further, black pixels that are continuous for three or more pixels in the sub-scanning direction are exposed for a long energizing time, for example, the fifth
Pixels circumscribing one pixel area as shown in FIG. However, in the case of three or more continuous black pixels in the sub-scanning direction, the pixels located at the upper and lower ends have the same size as in the case of two consecutive pixels.

これにより、離散的に画素が配置された部分、すなわ
ちベイヤータイプのディザなどの擬似中間調画像や文字
などの領域では、1画素領域からはみ出さない程度の小
さな画素が形成され、良好な中間調の再現および繊細な
文字の記録が行える。また集中的に画素が配置された部
分、すなわちベタ黒画像などの領域では、1画素領域を
覆う程度の大きな画素が形成され、十分なベタ黒濃度を
得られる。また本実施例によれば、通電時間設定部32を
データテーブルにより構成しているので、複雑なロジッ
クを組む必要が無く簡易な構成により実現でき、かつ仕
様変更などに伴い、注目画素の周囲画素の状態と注目画
素の画素サイズとの関係を変更する場合でも、それを比
較的容易に行うことが可能である。
As a result, in a portion where pixels are discretely arranged, that is, in a region such as a pseudo halftone image such as a Bayer type dither or a character, small pixels that do not protrude from one pixel region are formed. And record delicate characters. In a portion where pixels are arranged intensively, that is, in a region such as a solid black image, a pixel large enough to cover one pixel region is formed, and a sufficient solid black density can be obtained. Further, according to the present embodiment, since the energization time setting unit 32 is configured by the data table, it is not necessary to form a complicated logic, and can be realized by a simple configuration. Even if the relationship between the state and the pixel size of the target pixel is changed, it can be performed relatively easily.

なお本発明は上記各実施例に限定されるものではな
く、次のような変更実施が可能である。
The present invention is not limited to the above embodiments, and the following modifications can be made.

上述のようにベタ黒画像の上下端の1画素ずつが小
さな画素となることが不都合である場合には、シフトレ
ジスタの数を例えば5個に増やし、発光時間設定部5,通
電時間設定部32で状態識別する範囲を広げればよい。
As described above, when it is inconvenient that each pixel at the upper and lower ends of the solid black image becomes a small pixel, the number of shift registers is increased to, for example, five, and the light emission time setting unit 5 and the conduction time setting unit 32 The range of state identification may be expanded by using.

上記各実施例では、画素の大きさを発光時間および
発熱抵抗体への電圧印加時間(発熱時間)により変化さ
せるものとしているが、発光光量および発熱抵抗体への
印加電圧値(発熱量)やその他の要素あるいはそれらの
組み合わせによっても良い。
In each of the above embodiments, the size of the pixel is changed depending on the light emission time and the voltage application time (heat generation time) to the heating resistor. Other elements or a combination thereof may be used.

上記各実施例ではレーザダイオード62の発光時間お
よび発熱抵抗体R−1〜R−nの電圧印加時間を3段階
としているが、2段階あるいは4段階以上としても良
い。
In each of the above embodiments, the light emission time of the laser diode 62 and the voltage application time of the heating resistors R-1 to R-n are three steps, but may be two steps or four or more steps.

上記各実施例では、本発明に係る記録装置をレーザ
プリンタおよびサーマルプリンタに適用しているが、例
えばインクジェットプリンタ、LEDプリンタやLCDプリン
タなどの他の電子写真記録装置よおび静電記録装置等に
も適用可能である。このとき、インクジェットプリンタ
であれば、第1の実施例と同様な手法が適し、またLED
プリンタやLCDプリンタなどの他の電子写真記録装置お
よび静電記録装置であれば、第2の実施例と同様な手法
が適する。
In each of the above embodiments, the recording apparatus according to the present invention is applied to a laser printer and a thermal printer, but may be applied to other electrophotographic recording apparatuses such as an inkjet printer, an LED printer, an LCD printer, and an electrostatic recording apparatus. Is also applicable. At this time, if it is an ink jet printer, the same method as in the first embodiment is suitable.
For other electrophotographic recording devices such as printers and LCD printers and electrostatic recording devices, the same method as in the second embodiment is suitable.

上記第1の実施例では、反転現像方式のレーザプリ
ンタを例示して説明しているが、論理を逆に考えれば容
易に正転現像方式にも適用可能である。
In the first embodiment, the laser printer of the reversal developing system is described as an example. However, if the logic is considered in reverse, the laser printer can be easily applied to the forward developing system.

このほか、本発明の要旨を逸脱しない範囲で種々の
変形実施が可能である。
In addition, various modifications can be made without departing from the spirit of the present invention.

[発明の効果] 本発明によれば、それぞれ画素の形成/非形成を示し
た画素データの配列である画データに応じて、画素形成
手段により画素を形成することによって記録を行う記録
装置において、前記画データのうちの注目画素データに
ついて、当該注目画素データに応じて形成される画素の
大きさを示す画素サイズ設定信号を、当該注目画素デー
タが示す画素の縦方向に並んだ所定の画素の状態に応じ
てデータテーブルで出力し、前記画データのうちの各画
素データに応じて画素の形成を行う際、前記画素サイズ
設定手段で各画素データについて出力された画素サイズ
設定信号が示す画素サイズの画素を形成するべく、例え
ば1画素の形成を行う形成時間または1画素の形成を行
う形成エネルギー量を変化させるよう画素形成手段を制
御するようにしたので、疑似中間調画像や文字などの画
像とベタ黒画像などの画像との両方を、たとえ1枚分の
画像中に両画像が混在していたとしても良好に記録で
き、しかも簡易、かつ柔軟に設定変更が可能な構成で実
現できる記録装置となる。
[Effects of the Invention] According to the present invention, there is provided a printing apparatus which performs printing by forming pixels by pixel forming means in accordance with image data which is an array of pixel data indicating formation / non-formation of pixels. For the pixel data of interest in the image data, a pixel size setting signal indicating the size of a pixel formed according to the pixel data of interest is output from a predetermined pixel arranged in the vertical direction of the pixel indicated by the pixel data of interest. A pixel size indicated by a pixel size setting signal output for each pixel data by the pixel size setting means when outputting a data table according to the state and forming a pixel according to each pixel data of the image data The pixel forming means is controlled so as to change, for example, a formation time for forming one pixel or a formation energy amount for forming one pixel in order to form one pixel. As a result, it is possible to record both an image such as a pseudo halftone image or a character and an image such as a solid black image satisfactorily even if both images are mixed in one image. The recording apparatus can be realized with a configuration in which the setting can be easily and flexibly changed.

【図面の簡単な説明】[Brief description of the drawings]

第1図乃至第6図は本発明の第1の実施例を説明する図
であり、第1図は本実施例に係る記録装置を適用して構
成されたレーザプリンタの要部構成を示す図、第2図は
第1図中の発光時間設定部5に設定されたデータテーブ
ルを模式的に示す図、第3図は第1図中の発光時間設定
部5での画素配列の認識を説明する図、第4図は第1図
中の各部の信号図、第5図は画素の記録例を示す図、第
6図はベタ黒画像の記録例を示す図、第7図および第8
図は本発明の第2の実施例を説明する図であり、第7図
は本実施例に係る記録装置を適用して構成されたサーマ
ルプリンタの要部構成を示す図、第8図は動作タイムチ
ャート、第9図乃至第11図はそれぞれ従来技術を説明す
る図である。 1……インタフェース部、2……制御部、3……画像メ
モリ、4a,4b,4c……シフトレジスタ、5……発光時間設
定部、6……レーザスキャナユニット(LSU)、61……
レーザ光、62……レーザダイオード、67……発光駆動
部、10……ヘッドコントローラ、20……イネーブル信号
発生回路、30……画データ処理部、31a,31b,31c……シ
フトレジスタ、32……通電時間設定部、33……ラインメ
モリ、34……出力制御回路、40……ヘッドドライバ、50
……サーマルヘッド。
FIGS. 1 to 6 are views for explaining a first embodiment of the present invention, and FIG. 1 is a view showing a main part configuration of a laser printer constituted by applying the recording apparatus according to the present embodiment. FIG. 2 is a diagram schematically showing a data table set in the light emission time setting unit 5 in FIG. 1, and FIG. 3 explains recognition of a pixel array in the light emission time setting unit 5 in FIG. 4, FIG. 4 is a signal diagram of each part in FIG. 1, FIG. 5 is a diagram showing a recording example of pixels, FIG. 6 is a diagram showing a recording example of a solid black image, FIG. 7 and FIG.
FIG. 7 is a diagram for explaining a second embodiment of the present invention. FIG. 7 is a diagram showing a main part configuration of a thermal printer configured by applying the recording apparatus according to the present embodiment, and FIG. FIGS. 9 to 11 are time charts for explaining the prior art. DESCRIPTION OF SYMBOLS 1 ... Interface part, 2 ... Control part, 3 ... Image memory, 4a, 4b, 4c ... Shift register, 5 ... Emission time setting part, 6 ... Laser scanner unit (LSU), 61 ...
Laser light, 62 laser diode, 67 light emission drive unit, 10 head controller, 20 enable signal generation circuit, 30 image data processing unit, 31a, 31b, 31c shift register, 32 ... energization time setting section, 33 ... line memory, 34 ... output control circuit, 40 ... head driver, 50
... thermal head.

フロントページの続き (72)発明者 南日 俊彦 東京都日野市旭が丘3丁目1番地の1 株式会社東芝日野工場内 (72)発明者 寺崎 政則 東京都日野市旭が丘3丁目1番地の1 株式会社東芝日野工場内 (72)発明者 村野 勝巳 東京都日野市旭が丘3丁目1番地の1 株式会社東芝日野工場内 (72)発明者 木下 晴喜 東京都日野市旭が丘3丁目1番地の1 株式会社東芝日野工場内 (72)発明者 藍原 政芳 東京都日野市旭が丘3丁目1番地の1 株式会社東芝日野工場内 (56)参考文献 特開 平2−274568(JP,A) 特開 平2−45167(JP,A) 特開 平1−227573(JP,A) 特開 平3−47763(JP,A) 特開 平1−175460(JP,A) 特開 平3−89776(JP,A) 特開 平3−243368(JP,A) (58)調査した分野(Int.Cl.6,DB名) B41J 2/52 H04N 1/23 Continued on the front page (72) Inventor Toshihiko Nannichi 3-1-1, Asahigaoka, Hino-shi, Tokyo Inside the Toshiba Hino Plant (72) Inventor Masanori Terasaki 3-1-1, Asahigaoka, Hino-shi, Tokyo Toshiba Inside the Hino Plant (72) Katsumi Murano Inventor, 3-1-1 Asahigaoka, Hino-shi, Tokyo In-house Toshiba Hino Plant (72) Inventor Haruki Kinoshita 3-1-1, Asahigaoka, Hino-shi, Tokyo Toshiba Hino Plant (72) Inventor Masayoshi Aihara 3-1-1 Asahigaoka, Hino-shi, Tokyo Toshiba Hino Factory Co., Ltd. (56) References JP-A-2-274568 (JP, A) JP-A-2-45167 (JP, A) JP-A-1-227573 (JP, A) JP-A-3-47776 (JP, A) JP-A-1-175460 (JP, A) JP-A-3-89776 (JP, A) JP-A-3 -243368 (JP, A) (58) Fields investigated (Int. Cl. 6 , DB name) B41J 2/52 H04N 1/23

Claims (3)

(57)【特許請求の範囲】(57) [Claims] 【請求項1】多数の画素を2次元的に配列してなる画像
を記録するものであり、それぞれ画素の形成/非形成を
示した画素データの配列である画データに応じて、画素
形成手段により画素を形成することによって記録を行う
記録装置において、 前記画データのうちの注目画素データについて、当該注
目画素データに応じて形成される画素の大きさを示す画
素サイズ設定信号を、当該注目画素データが示す画素の
縦方向に並んだ所定の画素の状態に応じて出力するデー
タテーブルと、 前記画データのうちの各画素データに応じて画素の形成
を行う際、前記画素サイズ設定手段で各画素データにつ
いて出力された画素サイズ設定信号が示す画素サイズの
画素を形成するよう画素形成手段を制御する画素形成制
御手段とを具備したことを特徴とする記録装置。
An image forming apparatus for recording an image in which a large number of pixels are two-dimensionally arranged, and in accordance with image data which is an array of pixel data indicating formation / non-formation of pixels. In a printing apparatus that performs printing by forming pixels according to the following, for a target pixel data of the image data, a pixel size setting signal indicating a size of a pixel formed according to the target pixel data is output to the target pixel. A data table to be output according to the state of a predetermined pixel arranged in the vertical direction of the pixel indicated by the data, and when forming a pixel according to each pixel data of the image data, each of the pixels is set by the pixel size setting unit. Pixel forming control means for controlling the pixel forming means so as to form a pixel having the pixel size indicated by the pixel size setting signal output with respect to the pixel data. Recording device.
【請求項2】画素形成制御手段は1画素の形成を行う形
成時間を変化させることにより画素のサイズを制御する
ことを特徴とする請求項(1)記載の記録装置。
2. The recording apparatus according to claim 1, wherein the pixel formation control means controls a pixel size by changing a formation time for forming one pixel.
【請求項3】画素形成制御手段は1画素の形成を行う形
成エネルギー量を変化させることにより画素のサイズを
制御することを特徴とする請求項(1)記載の記録装
置。
3. The recording apparatus according to claim 1, wherein the pixel formation control means controls the size of the pixel by changing the amount of formation energy for forming one pixel.
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