JP2837926B2 - Heating element drive circuit device - Google Patents

Heating element drive circuit device

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JP2837926B2
JP2837926B2 JP15103490A JP15103490A JP2837926B2 JP 2837926 B2 JP2837926 B2 JP 2837926B2 JP 15103490 A JP15103490 A JP 15103490A JP 15103490 A JP15103490 A JP 15103490A JP 2837926 B2 JP2837926 B2 JP 2837926B2
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茂雄 太田
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Description

【発明の詳細な説明】 (イ)産業上の利用分野 この発明は、サーマルヘッドの発熱素子駆動回路装置
(ドライバIC)に関する。
The present invention relates to a heating element driving circuit device (driver IC) for a thermal head.

(ロ)従来の技術 サーマルヘッドに搭載されるドライバICには、回路異
常の発生により、大電流が流れた場合等、回路電源電圧
が規定値以下になった際に、電圧低下を検出して出力を
強制的に中断させる機能を備えている。この機能を持た
せることにより、サーマルヘッドが異常な回路電源電圧
の低下により暴走し、破壊することを防止している。従
来のこの種の出力停止機能は、第4図に例示するよう
に、回路電源電圧VDDが5Vから規定値4V以下になると、
電圧低下期間txの如何にかかわらず出力を停止してい
た。
(B) Conventional technology The driver IC mounted on a thermal head detects a voltage drop when the circuit power supply voltage falls below a specified value, such as when a large current flows due to a circuit abnormality. It has a function to forcibly interrupt output. By providing this function, it is possible to prevent the thermal head from running away due to an abnormal drop in the circuit power supply voltage and being destroyed. As shown in FIG. 4, this type of conventional output stop function is provided when the circuit power supply voltage V DD falls from 5 V to a specified value of 4 V or less.
The How in regardless output voltage drop period t x has been stopped.

(ハ)発明が解決しようとする課題 上記した従来のドライバICでは、電圧低下期間の如何
にかかわらず、出力停止機能を働かせるので、出力停止
機能の動作点である規定値がドライバICの製品のバラツ
キに応じてバラツクため、サーマルヘッドの通常の通電
動作によって発生するVDD変動(GND変動)によってもOF
Fしてしまうことがあった。このため、通常動作程度で
発生するVDD変動(GND変動)には反応しない様にICの規
定値の上限を定めているが、ICの製造能力等を考慮した
場合、規定値とVDD変動との間に十分なマージンが取れ
ないという問題があった。
(C) Problems to be Solved by the Invention In the above-mentioned conventional driver IC, the output stop function is activated regardless of the voltage drop period. Due to the variation according to the variation, the OF is also affected by the V DD variation (GND variation) generated by the normal energizing operation of the thermal head.
There was F. Therefore, although the V DD variation (GND fluctuation) occurring usually about operation defines the upper limit of the specified value of the IC so as not to react, when considering the IC production capacity such as a specified value and V DD fluctuates There was a problem that a sufficient margin could not be obtained between them.

この発明は、上記問題点に着目してなされたものであ
って、ICのバラツキを気にすることなく、通常動作程度
の電圧低下では、出力停止機能が働かない発熱素子駆動
回路装置を提供することを目的としている。
The present invention has been made in view of the above problems, and provides a heating element drive circuit device in which an output stop function does not work at a voltage drop of about a normal operation without concern for variations in ICs. It is intended to be.

(ニ)課題を解決するための手段及び作用 この発明の発熱素子駆動回路装置は、サーマルヘッド
に搭載され、複数個の発熱素子を駆動する回路装置であ
って、供給される電源電圧が所定値以下に低下したこと
を検出する電圧低下検出手段と、電圧低下状態が所定時
間継続したことを計時するタイマ手段とを備え、発熱素
子への駆動出力を停止する基準となる所定時間を発熱素
子への平常通電時における電圧低下時間より大きく設定
し、タイマ手段により計時された電圧低下状態が前記所
定時間継続したときに、前記発熱素子への駆動出力を停
止するようにしている。
(D) Means and Action for Solving the Problems A heating element drive circuit device of the present invention is a circuit device mounted on a thermal head and driving a plurality of heating elements, wherein a supplied power supply voltage has a predetermined value. A voltage drop detecting means for detecting that the voltage has dropped below, and a timer means for measuring that the voltage drop state has continued for a predetermined time, and a predetermined time serving as a reference for stopping the drive output to the heat generating element is supplied to the heat generating element. Is set to be longer than the voltage drop time at the time of normal energization, and the drive output to the heating element is stopped when the voltage drop state measured by the timer means continues for the predetermined time.

この発熱素子駆動回路装置では、供給される電源電圧
が所定値以下に低下すると、電圧低下検出手段で、これ
が検出される。しかし、電圧低下検出で直ちに出力を停
止しない。電圧低下状態が所定時間以上継続したことが
タイマ手段で計時されて発熱素子への駆動出力が停止さ
れる。したがって、通常の発熱素子の通電で、たとえ電
源電圧が所定値以下に低下しても、継続時間が短いた
め、駆動出力が停止されることはない。
In this heating element drive circuit device, when the supplied power supply voltage drops below a predetermined value, the voltage drop detection means detects this. However, the output is not stopped immediately upon detection of the voltage drop. The timer means measures that the voltage drop state has continued for a predetermined time or more, and the drive output to the heating element is stopped. Therefore, even if the power supply voltage falls to a predetermined value or less when the normal heating element is energized, the drive output is not stopped because the duration is short.

(ホ)実施例 第1図は、この発明の一実施例を示すサーマルヘッド
のドライバICの内部回路構成を示すブロック図である。
同図において、ドライバIC1は、DIN端子から入力される
データをCLK端子より入力されるクロックパルスに応じ
て取り込むシフトレジスタ2、このシフトレジスタ2に
取り込まれたデータをラッチ信号LAの入力で一斉にラッ
チするラッチ回路3、VDD端子より加えられる電源電圧V
DDが規定値以下に低下したことを検出する電圧低下検出
回路4、通常は所定のハイ信号を出力し、電圧低下が検
出されると、一定の遅延時間txをおいてロー信号を出力
する遅延回路(タイマ)5、ラッチ回路3の出力、スト
ローブ信号STR、及び遅延回路5の出力を入力に受ける
ゲート回路6、ゲート回路6の出力に応答して、発熱抵
抗素子8に駆動出力を与える駆動回路7を備えている。
なお、この実施例では、発熱抵抗素子8は、8-1、8-2
…、8-64のドットからなり、これに対応してシフトレジ
スタ2、ラッチ回路3、ゲート回路6、駆動回路7も、
それぞれ同数設けられている。もっとも、実際のサーマ
ルヘッドのドット数は、さらに多数であり、ドライバIC
も複数個並設される。
(E) Embodiment FIG. 1 is a block diagram showing an internal circuit configuration of a driver IC of a thermal head showing an embodiment of the present invention.
In FIG. 1, a driver IC 1 is provided with a shift register 2 for taking in data inputted from a DIN terminal in accordance with a clock pulse inputted from a CLK terminal, and simultaneously taking in the data taken in the shift register 2 by the input of a latch signal LA. Latch circuit 3 for latching, power supply voltage V applied from VDD terminal
DD is the specified value the voltage drop detection circuit 4 for detecting that drops below typically outputs a predetermined high signal, when a voltage drop is detected, outputs a low signal at a predetermined delay time t x A delay circuit (timer) 5, a gate circuit 6 that receives the output of the latch circuit 3, the strobe signal STR, and the output of the delay circuit 5 as inputs, and a drive output to the heating resistor element 8 in response to the output of the gate circuit 6. A drive circuit 7 is provided.
In this embodiment, the heating resistance element 8 includes 8 −1 , 8 −2 ,
.., 8 to 64 dots, and the shift register 2, the latch circuit 3, the gate circuit 6, and the drive circuit 7
The same number is provided for each. However, the actual number of dots of the thermal head is even larger, and the driver IC
Are also juxtaposed.

この実施例回路において、電源電圧VDDが規定値以上
供給されていると、遅延回路5からゲート回路6にハイ
の信号が入力されている。この状態で印字データが入力
されると、シリアルにシフトレジスタ2に取り込まれ、
ラッチ信号LAでシフトレジスタ2の各セル2-1、2-2、2
-3、…、2-64の“1"“0"のビットデータがラッチ回路3
の各セル3-1、3-2、3-3、…、3-64に一斉にラッチされ
る。そして、ストローブ信号STRが入力されると、“1"
を記憶するラッチ回路3のセルに対応したゲート回路6
の個別ゲートの入力が“1"で揃い、対応する駆動回路7
が動作し、対応する発熱抵抗素子を通電駆動する。この
発熱抵抗素子8への平常通電時における電圧低下時間を
t1とすると、t1<txに設定してあり、したがって通電に
よって電源電圧が規定値以下(第3図参照)に低下して
も遅延回路5はロー信号を出力せず、したがって駆動出
力が停止されることはない。
In the circuit of this embodiment, when the power supply voltage V DD is supplied to a specified value or more, a high signal is input from the delay circuit 5 to the gate circuit 6. When print data is input in this state, the print data is serially taken into the shift register 2, and
Each cell 2 −1 , 2 −2 , 2 of the shift register 2 is output by the latch signal LA.
-3 ,..., 2-64 "1""0" bit data
Each cell 3 -1, 3 -2, 3 -3, ..., are simultaneously latched in the 3 -64. When the strobe signal STR is input, “1”
Circuit 6 corresponding to the cell of the latch circuit 3 that stores
The inputs of the individual gates are aligned at “1”, and the corresponding drive circuit 7
Operates to energize and drive the corresponding heating resistor element. The voltage drop time during normal energization of the heating resistor 8 is
When t 1, Yes is set to t 1 <t x, hence the delay circuit 5 also decreases the power supply voltage is below the specified value (see FIG. 3) by energization does not output a low signal, thus driving the output Will not be stopped.

次に、回路に異常が生じ、例えば第3図に示すよう
に、tx<t2の関係にあるt2時間だけ、電源電圧VDDが規
定値よりも低下すると、遅延回路5は、電圧低下検出回
路4で電圧低下を検出した後、時間txの経過でローとな
る。そのため、ゲート回路6への1つの入力がローとな
り、駆動回路7は全てONされず、発熱抵抗素子8への駆
動出力が停止される。
Next, abnormality occurs in the circuit, for example, as shown in FIG. 3, only t 2 hours in a relationship of t x <t 2, when the power supply voltage V DD falls below a specified value, the delay circuit 5, the voltage after detecting a voltage drop in the drop detection circuit 4, a low over time t x. Therefore, one input to the gate circuit 6 becomes low, the drive circuit 7 is not all turned on, and the drive output to the heating resistor 8 is stopped.

なお、他の実施例として、第1図の電圧低下検出回路
4、及び遅延回路5の代わりに電源電圧VDDを取り込
み、比較機能、計時機能を有するCPUあるいはゲートア
レイ等で第2図に示すフローの処理を実行させてもよ
い。この処理は、先ず取り込んだ電源電圧VDDと規定値V
Tを比較し(ステップST1)、VDD>VTであるなら、ステ
ップST1の判定NOで、そのまま動作を継続する(ステッ
プST2)。しかし、VDD≦VTなら、タイマtxをスタートさ
せ(ステップST3)、以後“VDD≦VTか”の判定を続けな
がら、電圧低下が続いている場合は、そのままタイマtx
の計時がなされるので、ステップST5で、タイマtxがタ
イムアップか判定し、タイムアップするまで、ステップ
ST4、ST5の処理を繰り返す。第3図のt1のように、通電
時における電圧低下の場合には、タイマtxがタイムアッ
プするまでに、電源電圧VDDが規定値VTよりも大となる
ので、ステップST4の判定がNOとなり、ステップST3に戻
り、タイマTxをリセットして再スタートさせる。そのた
め、この場合は出力が停止されることはない。
As another embodiment, a power supply voltage V DD is taken in instead of the voltage drop detection circuit 4 and the delay circuit 5 in FIG. 1, and a CPU or a gate array having a comparison function and a timekeeping function is shown in FIG. The process of the flow may be executed. In this process, first, the acquired power supply voltage V DD and the specified value V
T is compared (step ST1), and if V DD > V T , the operation continues as it is (NO in step ST1) (step ST2). However, V if DD ≦ V T, the timer is started t x (step ST3), while continuing the judgment of the subsequent "or V DD ≦ V T", if the voltage drop is followed is, as it is a timer t x
Since clocking of is made, at step ST5, the timer t x is determined whether the time is up, until the time is up, step
Steps ST4 and ST5 are repeated. As t 1 of FIG. 3, when the voltage drop at the time of energization, until the timer t x is the time is up, the power supply voltage V DD is larger than the prescribed value V T, the determination in step ST4 but becomes NO, returns to step ST3, the re-start and reset the timer T x. Therefore, in this case, the output is not stopped.

しかし、第3図の異常時の電圧低下の場合は、t2>tx
なので、タイマtxのタイムアップで出力をOFFする(ス
テップST6)。
However, in the case of the voltage drop at the time of abnormality in FIG. 3, t 2 > t x
So, to turn OFF the output at the time of the timer t x (step ST6).

今、例えばドライバICの検出規定値が3.5V±1Vの場合
で、サーマルヘッドでのVDD変動(GND変動)が5±0.6V
あった時に、ワーストケースではVDDが4.4Vとなるた
め、ICの規定値3.5+1=4.5V以下となり、出力がOFFす
る。そのために、従来であれば3.5+1Vを3.5±0.8とい
った様にバラツキ幅を抑える必要があったが、この発明
では、通電時の電圧低下で、たとえ規定値以下となって
も所定時間以上低下が続かないと、出力OFFされないか
ら、ICのバラツキ幅に神経を使う必要がない。
Now, for example, when the detection specified value of the driver IC is 3.5V ± 1V and the VDD fluctuation (GND fluctuation) in the thermal head is 5 ± 0.6V
When there is, in the worst case, VDD becomes 4.4V, so the specified value of the IC becomes 3.5 + 1 = 4.5V or less, and the output is turned off. For this reason, in the conventional case, it was necessary to suppress the variation width from 3.5 + 1 V to 3.5 ± 0.8. However, in the present invention, the voltage drops during energization, and even if the voltage falls below the specified value, the voltage drops for a predetermined time or more. If it does not continue, the output will not be turned off, so there is no need to use nerves for the variation width of the IC.

(ヘ)発明の効果 この発明によれば、電源電圧の低下を検出した際に、
所定時間以上、電圧低下が継続した場合に、出力をOFF
するようにしているので、通常印字における通電時に誤
って出力OFFすることによる印字異常を防止できる。ま
た、ICの検出電圧(規定値)のバラツキを厳しく抑える
必要がなくなり、その分、高価格なICを使用する必要が
なく、サーマルヘッドの価格低減を図ることができる。
(F) Effects of the Invention According to the present invention, when a decrease in the power supply voltage is detected,
Turns off the output when the voltage drops for more than a predetermined time
Therefore, it is possible to prevent a printing error caused by erroneously turning off the output during energization in normal printing. Further, it is not necessary to suppress the variation in the detection voltage (specified value) of the IC strictly, so that there is no need to use a high-priced IC and the cost of the thermal head can be reduced.

【図面の簡単な説明】[Brief description of the drawings]

第1図は、この発明の一実施例を示すサーマルヘッドの
ドライバICの内部回路機能を示すブロック図、第2図
は、他の実施例を説明するためのフロー図、第3図は、
上記実施例ドライバICの動作を説明するためのタイムチ
ャート、第4図は、従来のドライバICの動作を説明する
ためのタイムチャートである。 1:ドライバIC、4:電圧低下検出回路、 5:遅延回路、7:駆動回路、 8:発熱抵抗素子。
FIG. 1 is a block diagram showing an internal circuit function of a driver IC of a thermal head showing one embodiment of the present invention, FIG. 2 is a flowchart for explaining another embodiment, and FIG.
FIG. 4 is a time chart for explaining the operation of the conventional driver IC, and FIG. 4 is a time chart for explaining the operation of the conventional driver IC. 1: Driver IC, 4: Voltage drop detection circuit, 5: Delay circuit, 7: Drive circuit, 8: Heating resistance element.

フロントページの続き (58)調査した分野(Int.Cl.6,DB名) B41J 2/355 B41J 29/38 B41J 29/46 G06F 3/12Continuation of the front page (58) Field surveyed (Int.Cl. 6 , DB name) B41J 2/355 B41J 29/38 B41J 29/46 G06F 3/12

Claims (1)

(57)【特許請求の範囲】(57) [Claims] 【請求項1】サーマルヘッドに搭載され、複数個の発熱
素子を駆動する発熱素子駆動回路装置であって、 供給される電源電圧が所定値以下に低下したことを検出
する電圧低下検出手段と、電圧低下状態が所定時間継続
したことを計時するタイマ手段とを備え、発熱素子への
駆動出力を停止する基準となる所定時間を発熱素子への
平常通電時における電圧低下時間より大きく設定し、タ
イマ手段により計時された電圧低下状態が前記所定時間
継続したときに、発熱素子への駆動出力を停止するよう
にしたことを特徴とする発熱素子駆動回路装置。
1. A heating element drive circuit device mounted on a thermal head and driving a plurality of heating elements, comprising: a voltage drop detecting means for detecting that a supplied power supply voltage has dropped below a predetermined value; Timer means for measuring that the voltage drop state has continued for a predetermined time, and setting a predetermined time serving as a reference for stopping the drive output to the heating element to be longer than the voltage drop time when the heating element is normally energized, The heating element drive circuit device, wherein the drive output to the heating element is stopped when the voltage drop state measured by the means continues for the predetermined time.
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