JP2771731B2 - CNC interference check method - Google Patents

CNC interference check method

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JP2771731B2
JP2771731B2 JP14736092A JP14736092A JP2771731B2 JP 2771731 B2 JP2771731 B2 JP 2771731B2 JP 14736092 A JP14736092 A JP 14736092A JP 14736092 A JP14736092 A JP 14736092A JP 2771731 B2 JP2771731 B2 JP 2771731B2
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FUANATSUKU KK
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Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【産業上の利用分野】本発明は工具やワーク等の干渉を
チェックするCNC(数値制御装置)の図形干渉チェッ
ク方式に関し、特にシミュレーション表示によるCNC
の図形干渉チェック方式に関する。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a graphic interference check system of a CNC (Numerical Control Unit) for checking interference of a tool, a work, etc.
The present invention relates to a graphic interference check method.

【0002】[0002]

【従来の技術】従来、CNCにおいて工具やワーク等の
干渉をチェックする方式としては、第1に干渉チェック
の対象図形毎に表示メモリを有するものと、第2にカラ
ー表示する場合に表示色毎に表示メモリを有するものと
がある。
2. Description of the Related Art Conventionally, as a method for checking interference of a tool, a workpiece, or the like in a CNC, first, a display memory is provided for each graphic to be subjected to interference check, and second, a display color is used for color display. Some have a display memory.

【0003】図6は第1の従来技術を説明する図であ
る。ここでは、表示画面67に図形68と図形69をシ
ミュレーション表示させるため、それぞれ図形68用の
表示メモリ61と図形69用の表示メモリ62が設けら
れている。これら表示メモリ61および表示メモリ62
は、カラー表示の場合にはそれぞれRGB用に3個設け
られる。
FIG. 6 is a diagram for explaining a first prior art. Here, a display memory 61 for the figure 68 and a display memory 62 for the figure 69 are provided to display the figure 68 and the figure 69 on the display screen 67 by simulation. The display memory 61 and the display memory 62
Are provided for RGB respectively in the case of color display.

【0004】シフトレジスタ63は、表示メモリ61か
ら読み出されたパラレル信号の画像データをシリアル信
号に変換し、1ドット単位の画素データとしてOR回路
65および比較回路66に送る。シフトレジスタ64
は、表示メモリ62から読み出されたパラレル信号の画
像データをシリアル信号に変換し、1ドット単位の画素
データとしてOR回路65および比較回路66に送る。
The shift register 63 converts the image data of the parallel signal read from the display memory 61 into a serial signal, and sends the serial signal to the OR circuit 65 and the comparison circuit 66 as pixel data of one dot unit. Shift register 64
Converts the image data of the parallel signal read from the display memory 62 into a serial signal, and sends it to the OR circuit 65 and the comparison circuit 66 as pixel data of one dot unit.

【0005】OR回路65は、シフトレジスタ63およ
びシフトレジスタ64からの画素データを合成し、表示
画面67に表示させる。比較回路66では、シフトレジ
スタ63およびシフトレジスタ64からの画素データを
検出し、同一画素上で表示が重なった場合には、図形6
8と図形69とが干渉しているものと判断し、アラーム
を出力する。
[0005] The OR circuit 65 combines the pixel data from the shift register 63 and the shift register 64 and causes the display screen 67 to display it. The comparison circuit 66 detects pixel data from the shift register 63 and the shift register 64, and when the display overlaps on the same pixel,
It is determined that 8 and FIG. 69 are interfering, and an alarm is output.

【0006】図7は、第2の従来技術を説明する図であ
る。ここでは、表示画面76に図形77と図形78とを
色分け表示させるため、RGBの色別に設けられた表示
メモリ71に図形77および図形78を記憶させてお
く。シフトレジスタ72は、表示メモリ71から読み出
された画像データをシリアル信号に変換し、画素データ
として表示画面76に送る。また、シフトレジスタ72
は、画素データを比較回路75にも送る。
FIG. 7 is a diagram for explaining a second prior art. Here, in order to display the graphics 77 and the graphics 78 on the display screen 76 in different colors, the graphics 77 and the graphics 78 are stored in the display memory 71 provided for each of the RGB colors. The shift register 72 converts the image data read from the display memory 71 into a serial signal and sends it to the display screen 76 as pixel data. Also, the shift register 72
Sends pixel data to the comparison circuit 75 as well.

【0007】表示色設定レジスタ73は、図示されてい
ないプロセッサからの指令によって図形77の表示色を
示す信号を比較回路75に送る。同様に、表示色設定レ
ジスタ74は、図示されていないプロセッサからの指令
によって図形78の表示色を示す信号を比較回路75に
送る。
The display color setting register 73 sends a signal indicating the display color of the graphic 77 to the comparison circuit 75 in response to a command from a processor (not shown). Similarly, the display color setting register 74 sends a signal indicating the display color of the graphic 78 to the comparison circuit 75 according to a command from a processor (not shown).

【0008】比較回路75は、シフトレジスタ72から
画素データを読み込み、表示色設定レジスタ73および
表示色設定レジスタ74からの表示色信号と比べる。す
なわち、シフトレジスタ72からの画素データの色が表
示色設定レジスタ73の示す表示色と同じであれば、そ
の画素データが図形77の画像データの一部であること
を認識する。同様に、シフトレジスタ72からの画素デ
ータの色が表示色設定レジスタ74の示す表示色と同じ
であれば、その画素データが図形78の画像データの一
部であることを認識する。
The comparison circuit 75 reads pixel data from the shift register 72 and compares the pixel data with display color signals from the display color setting register 73 and the display color setting register 74. That is, if the color of the pixel data from the shift register 72 is the same as the display color indicated by the display color setting register 73, it is recognized that the pixel data is a part of the image data of the graphic 77. Similarly, if the color of the pixel data from the shift register 72 is the same as the display color indicated by the display color setting register 74, it is recognized that the pixel data is a part of the image data of the graphic 78.

【0009】こうして、比較回路75は、異なる色の画
素データが連続して送られた場合、すなわち、隣合っ
たドットに別の色の画素データが表示された場合には、
図形77と図形78とが表示画面76上で干渉している
ものと見なし、アラームを出力する。
[0009] Thus, the comparing circuit 75, when the different color pixel data is continuously transmitted, i.e., when the different color pixel data is displayed next Ri suits dots,
It is assumed that the figures 77 and 78 are interfering on the display screen 76, and an alarm is output.

【0010】[0010]

【発明が解決しようとする課題】しかし、これらの従来
技術には、次のような問題点がある。まず、第1の従来
技術は、同一の表示メモリに記憶された図形同士の干渉
をチェックすることができないので、干渉チェックする
図形の数だけ表示メモリを用意する必要があった。
However, these prior arts have the following problems. First, in the first prior art, since it is not possible to check for interference between figures stored in the same display memory, it is necessary to prepare display memories for the number of figures to be checked for interference.

【0011】一方、第2の従来技術では、比較回路75
では色同士を比較して干渉をチェックしているので、同
色の図形同士の干渉をチェックすることができない。こ
のため、干渉チェックする図形の数だけ表示色設定レジ
スタを用意する必要があった。また、表示装置によって
は表示色数に制限があるので、使用する表示装置によっ
ては、干渉チェックできる図形の数が限定されてしまう
という問題点があった。
On the other hand, in the second prior art, the comparison circuit 75
Since interference is checked by comparing colors, interference between figures of the same color cannot be checked. For this reason, it is necessary to prepare display color setting registers for the number of figures to be checked for interference. In addition, since the number of display colors is limited depending on the display device, there is a problem that the number of figures that can be checked for interference is limited depending on the display device used.

【0012】また、これら2つの従来技術とは別に、ソ
フトウェアによって干渉チェックを行う方法も考えられ
るが、プログラムが複雑になり、処理速度も遅くなるこ
とが予想されるため、実用は不可能である。
In addition to the above two conventional techniques, a method of performing an interference check by software is also conceivable. However, it is expected that the program will be complicated and the processing speed will be reduced, so that practical use is impossible. .

【0013】本発明はこのような点に鑑みてなされたも
のであり、表示メモリ等の回路を増大させることなく、
多数の図形の干渉チェックを高速に処理することのでき
るCNCの図形干渉チェック方式を提供することを目的
とする。
The present invention has been made in view of such a point, and without increasing circuits such as a display memory,
It is an object of the present invention to provide a CNC graphic interference check method capable of processing interference check of many graphics at high speed.

【0014】[0014]

【課題を解決するための手段】本発明では上記課題を解
決するために、シミュレーション表示によって工具やワ
ーク等の干渉をチェックするCNC(数値制御装置)
図形干渉チェック方式において、干渉チェックの対象図
形を区別するため各対象図形の画像データ毎に論理色コ
ードを割り付けて格納する表示メモリと、干渉チェック
を行う対象図形に対応する前記表示メモリの論理色コー
をシリアル信号に変換し、1ドット単位の画素データ
として出力するシフトレジスタと、前記シフトレジスタ
から前記画素データを受け取るとともに前記画素データ
の論理色コードを読み取り、異なる論理色コードを持つ
画素データが連続した場合には対象図形同士が干渉した
ものと見なし、アラームを出力する比較手段と、を有す
ることを特徴とするCNCの図形干渉チェック方式が提
供される。
According to the present invention, in order to solve the above-mentioned problems, in a graphic interference check system of a CNC (numerical control device) for checking interference of a tool, a work, or the like by simulation display, a graphic to be checked for interference. Logical color code for each image data of each target figure to distinguish
Display memory for allocating and storing code and interference check
The logical color code of the display memory corresponding to the target graphic
Converts the de into a serial signal, a shift register for outputting a pixel data of one dot unit, reads a logical color code of the pixel data along with receiving said pixel data from said shift register, the pixel data having different logical color code In the case where there is a continuation, it is considered that the target graphics have interfered with each other, and a comparison means for outputting an alarm is provided.

【0015】[0015]

【作用】表示メモリに論理色付けして格納された各対象
図形の論理色コードは、シフトレジスタにより1ドット
単位の画素データに変換され比較手段に送られる。比較
手段は、シフトレジスタから画素データを受け取るとと
もにその論理色コードを読み取り、異なる論理色コード
を持つ画素データが連続した場合には対象図形同士が干
渉したものと見なし、アラームを出力する。
The logical color code of each target graphic, which is stored in the display memory with a logical color, is converted into pixel data of one dot by the shift register and sent to the comparing means. The comparing means receives the pixel data from the shift register and reads the logical color code thereof. If pixel data having different logical color codes are consecutive, it is regarded that the target graphics have interfered with each other and an alarm is output. I do.

【0016】[0016]

【実施例】以下、本発明の一実施例を図面に基づいて説
明する。図2は本発明の図形干渉チェック方式を実施す
るための数値制御装置のハードウェアの概略構成図であ
る。プロセッサ11はROM12に格納されたシステム
プログラムに従って数値制御装置全体を制御する。RO
M12にはEPROMあるいはEEPROMが使用され
る。RAM13はDRAM等が使用され、各種のデータ
あるいは入出力信号が格納される。不揮発性メモリ14
にはバッテリバックアップされたCMOSが使用され、
電源切断後も保持すべきパラメータ、ピッチ誤差補正量
及び工具補正量等が格納されている。
An embodiment of the present invention will be described below with reference to the drawings. FIG. 2 is a schematic configuration diagram of hardware of a numerical control device for implementing the graphic interference check method of the present invention. The processor 11 controls the entire numerical controller according to a system program stored in the ROM 12. RO
EP12 or EEPROM is used for M12. The RAM 13 is a DRAM or the like, and stores various data or input / output signals. Non-volatile memory 14
The battery backed CMOS is used for
The parameters, the pitch error correction amount, the tool correction amount, and the like to be held even after the power is turned off are stored.

【0017】グラフィック制御回路15はディジタル信
号を表示用の信号に変換し、表示装置16に与える。表
示装置16はCRTあるいは液晶表示装置が使用され、
各軸の位置表示、入出力信号の状態、パラメータ等が表
示される。また、表示装置16ではワークの加工手順等
のシミュレーション表示が行われ、このとき、グラフィ
ック制御回路15では図形干渉チェックが行われる。操
作盤17はキーボード等から構成され、各種のデータの
入力あるいは工作機械19の操作に使用される。
The graphic control circuit 15 converts the digital signal into a signal for display and supplies the signal to the display device 16. As the display device 16, a CRT or a liquid crystal display device is used.
The position display of each axis, the state of input / output signals, parameters, and the like are displayed. In addition, the display device 16 performs a simulation display of a work processing procedure and the like, and at this time, the graphic control circuit 15 performs a graphic interference check. The operation panel 17 includes a keyboard and the like, and is used for inputting various data or operating the machine tool 19.

【0018】PMC(プログラマブル・マシン・コント
ローラ)18はバス20経由で出力信号を受けて、出力
信号をシーケンス・プログラムで処理して、工作機械1
9を制御する。また、機械側からの入力信号を受けて、
シーケンス・プログラムで処理を行い、バス20を経由
して、プロセッサ11に入力信号を転送する。
A PMC (programmable machine controller) 18 receives an output signal via a bus 20, processes the output signal by a sequence program, and
9 is controlled. Also, receiving the input signal from the machine side,
Processing is performed by a sequence program, and an input signal is transferred to the processor 11 via the bus 20.

【0019】これらの構成要素はバス20によって互い
に結合されている。なお、図2では軸制御回路、サーボ
アンプ、サーボモータ、スピンドルアンプ及びスピンド
ルモータ等の構成要素は省略してある。また、プロセッ
サを複数個にして、マルチプロセッサシステムとするこ
ともできる。
These components are connected to each other by a bus 20. In FIG. 2, components such as an axis control circuit, a servo amplifier, a servo motor, a spindle amplifier, and a spindle motor are omitted. Further, a multiprocessor system may be provided by using a plurality of processors.

【0020】図1はグラフィック制御回路15の構成を
示すブロック図である。プロセッサ(CPU)1には、
バス9を介して表示メモリ部2、論理色設定レジスタ
6、および論理色設定レジスタ7が結合されている。ま
た、バス9には、図示されていないバッファメモリが結
合されており、描画データをプロセッサ1に送る。
FIG. 1 is a block diagram showing the configuration of the graphic control circuit 15. The processor (CPU) 1 includes:
The display memory unit 2, the logical color setting register 6, and the logical color setting register 7 are connected via the bus 9. A buffer memory (not shown) is connected to the bus 9 and sends drawing data to the processor 1.

【0021】表示メモリ部2は、4個の表示メモリ2a
〜2dにより構成されている。これら表示メモリ2a〜
2dは、それぞれ後述の4桁の論理色コードの各桁と対
応しており、オペレータが設定した画像データが格納さ
れている。
The display memory unit 2 includes four display memories 2a.
To 2d. These display memories 2a to 2a
2d corresponds to each digit of a 4-digit logical color code described later, and stores image data set by the operator.

【0022】表示コントローラ3は、表示メモリ部2の
各表示メモリ2a〜2dに同時に表示指令を送り、表示
メモリ2a〜2dに格納された画像データをフレームの
先頭から順に読み出してレジスタ部4に送る。また、表
示コントローラ3は、1フレーム毎に垂直帰線信号を割
り込み信号としてプロセッサ1に送る。
The display controller 3 simultaneously sends display instructions to the respective display memories 2a to 2d of the display memory unit 2, reads out the image data stored in the display memories 2a to 2d sequentially from the top of the frame, and sends them to the register unit 4. . The display controller 3 sends a vertical retrace signal to the processor 1 as an interrupt signal for each frame.

【0023】レジスタ部4は、4個のシフトレジスタ4
a〜4dから構成されている。各シフトレジスタ4a〜
4dは、それぞれ表示メモリ2a〜2dから送られる画
像データをシリアル信号に変換し、1ドット単位の画素
データとしてカラーパレット5および比較回路8に送
る。
The register section 4 includes four shift registers 4
a to 4d. Each shift register 4a-
4d converts the image data sent from the display memories 2a to 2d into serial signals, and sends them to the color pallet 5 and the comparison circuit 8 as pixel data of one dot unit.

【0024】カラーパレット5は、レジスタ部4から出
力された各画素データを並列に受け取り、4桁の論理色
コードとして扱う。この論理色コードは、予め表示メモ
リ2a〜2dに画像データを格納するときに各画素デー
タ単位でその論理色を示すことができるように設定され
ている。カラーパレット5は、この論理色コードを読み
取って表示すべき色を判断し、対応するビデオ信号を表
示装置16に送る。
The color pallet 5 receives each pixel data output from the register section 4 in parallel, and handles it as a 4-digit logical color code. The logical color code is set in advance so that when storing image data in the display memories 2a to 2d, the logical color can be indicated for each pixel data unit. The color pallet 5 reads the logical color code, determines a color to be displayed, and sends a corresponding video signal to the display device 16.

【0025】プロセッサ1は、表示コントローラ3から
割り込み信号を受け取る度に、干渉チェックの対象とな
る図形を切り替え、それらの図形の論理色コードを論理
色設定レジスタ6および論理色設定レジスタ7に送る。
論理色設定レジスタ6および論理色設定レジスタ7は、
新しく論理色コードが切り替えられるまでその値を保持
し、比較回路8に送り続ける。
Each time the processor 1 receives an interrupt signal from the display controller 3, it switches the graphics to be checked for interference, and sends the logical color codes of those graphics to the logical color setting register 6 and the logical color setting register 7.
The logical color setting register 6 and the logical color setting register 7
The value is held until a new logical color code is switched, and sent to the comparison circuit 8.

【0026】比較回路8は、レジスタ部4から画素デー
タを読み込み、論理色設定レジスタ6および論理色設定
レジスタ7からの論理色コードと比べる。比較回路8
は、レジスタ部4からの画素データの論理色が、論理色
設定レジスタ6および論理色設定レジスタ7の何れかと
一致した場合に、表示画面に表示する画素データがどの
図形の部分であるかを判断する。比較回路8は、こうし
て1ドット毎に論理色を判定し、異なる論理色の画素デ
ータが連続して取り込まれた場合には、図形同士が干渉
しているものと判断し、アラームをプロセッサ1に送
る。
The comparing circuit 8 reads the pixel data from the register section 4 and compares the pixel data with the logical color codes from the logical color setting register 6 and the logical color setting register 7. Comparison circuit 8
When the logical color of the pixel data from the register unit 4 matches one of the logical color setting register 6 and the logical color setting register 7, it is determined which figure part the pixel data to be displayed on the display screen is. I do. The comparison circuit 8 determines the logical color for each dot in this way, and when pixel data of different logical colors are continuously captured, determines that the figures are interfering with each other, and issues an alarm to the processor 1. send.

【0027】次に、このような構成を有するグラフィッ
ク制御回路15の具体的な処理の例を示す。図3は、切
削シミュレーション描画の例を示す図である。表示装置
16の表示画面上には、チャック31、ワーク32、工
具33および工具34が描画されている。これらの図形
は、異なる色で表示されている。また、これらの図形
は、干渉チェックする部分毎に論理色コードが与えら
れ、その論理色コードに応じて表示メモリ部2の各表示
メモリ2a〜2dに格納される。ここでは、干渉チェッ
クの対象となる部分としては、チャック31、ワーク3
2、工具33の刃先33a、工具33の刃先以外の部分
33b、工具34の刃先34a、工具34の刃先以外の
部分34bが上げられる。
Next, an example of a specific process of the graphic control circuit 15 having such a configuration will be described. FIG. 3 is a diagram illustrating an example of cutting simulation drawing. The chuck 31, the work 32, the tool 33, and the tool 34 are drawn on the display screen of the display device 16. These figures are displayed in different colors. These figures are given a logical color code for each part to be checked for interference, and stored in each of the display memories 2a to 2d of the display memory unit 2 according to the logical color code. Here, the parts to be subjected to the interference check include the chuck 31 and the work 3
2. The cutting edge 33a of the tool 33, the portion 33b other than the cutting edge of the tool 33, the cutting edge 34a of the tool 34, and the portion 34b of the tool 34 other than the cutting edge are raised.

【0028】図4は、各チェック対象部分への表示色お
よび論理色コードの割り当ての一例を示す図である。図
からも分かるように、工具33および工具34の各部分
は、その表示色は同じ赤であるが、論理色コードは全て
異なるものが与えられている。これらチェック対象部分
は、それぞれ論理色コードに応じて、表示メモリ部2の
表示メモリ2a〜2dに画像データとして格納される。
FIG. 4 is a diagram showing an example of assignment of display colors and logical color codes to each check target portion. As can be seen from the figure, the display colors of the tool 33 and the tool 34 are the same red, but different logical color codes are given. These check target parts are stored as image data in the display memories 2a to 2d of the display memory unit 2 according to the respective logical color codes.

【0029】図5は表示メモリ部2への画像データの格
納方法の一例を示す図である。表示メモリ2a〜2d
は、それぞれ論理色コードの上位桁から順に一対一で対
応している。例えば、工具33の刃先以外の部分33b
は、その論理色コードが0011であるから、その画像
データは最下位桁に対応する表示メモリ2dと、下位2
番目の桁に対応する表示メモリ2cとに格納される。同
様に、他のチェック対象部分もそれぞれ表示メモリ2a
〜2dに格納される。
FIG. 5 is a diagram showing an example of a method of storing image data in the display memory unit 2. Display memories 2a to 2d
Are in a one-to-one correspondence from the upper digit of the logical color code. For example, a portion 33b other than the cutting edge of the tool 33
Since the logical color code is 0011, the image data is stored in the display memory 2d corresponding to the least significant digit,
It is stored in the display memory 2c corresponding to the third digit. Similarly, the other check target parts are also displayed in the display memory 2a.
To 2d.

【0030】このように各図形の画像データが格納され
た表示メモリ2a〜2dは、表示コントローラ3によっ
て画面のフレームの先頭から同時に画像データが読み出
され、レジスタ部4の各シフトレジスタ4a〜4dに送
られる。各シフトレジスタ4a〜4dでは、対応する表
示メモリ2a〜2dからの画像データをシリアルな画素
データに変換し、カラーパレット5および比較回路8に
送る。
In the display memories 2a to 2d in which the image data of each figure are stored as described above, the display controller 3 reads the image data from the top of the frame of the screen at the same time, and shift registers 4a to 4d of the register section 4. Sent to Each of the shift registers 4a to 4d converts the image data from the corresponding display memories 2a to 2d into serial pixel data, and sends it to the color palette 5 and the comparison circuit 8.

【0031】各シフトレジスタ4a〜4dから出力され
る画素データは、シフトレジスタ4aが最上位桁となる
ように順に並べると、図4に示した論理色コードが再生
される。カラーパレット5は、この論理色コードから表
示色を解読し、表示装置16に表示する。
If the pixel data output from each of the shift registers 4a to 4d is arranged in order so that the shift register 4a has the highest digit, the logical color code shown in FIG. 4 is reproduced. The color palette 5 decodes the display color from the logical color code and displays it on the display device 16.

【0032】このような方法により、表示装置16の表
示画面上では図3に示したようなシミュレーション描画
が行われる。その一方で、プロセッサ1は、干渉チェッ
クを行う。この干渉チェックは、1フレーム毎に2個の
チェック対象部分ずつ行われる。このため、プロセッサ
1は、表示コントローラ3から帰線信号が送られる度
に、2個のチェック対象部分の論理色コードをそれぞれ
論理色設定レジスタ6および論理色設定レジスタ7に送
る。
By such a method, a simulation drawing as shown in FIG. 3 is performed on the display screen of the display device 16. On the other hand, the processor 1 performs an interference check. This interference check is performed for two check target portions for each frame. Therefore, every time the retrace signal is sent from the display controller 3, the processor 1 sends the logical color codes of the two check target portions to the logical color setting register 6 and the logical color setting register 7, respectively.

【0033】図3で示したシミュレーション描画の場合
には、干渉チェックする組み合わせとして以下の10通
りがある。 (1) チャック31と工具33の刃先33a以外の部
分33b (2) チャック31と工具33の刃先33a (3) チャック31と工具34の刃先34a以外の部
分34b (4) チャック31と工具34の刃先34a (5) ワーク32と工具33の刃先33a以外の部分
33b (6) ワーク32と工具34の刃先34a以外の部分
34b (7) 工具33の刃先33a以外の部分33bと工具
34の刃先34a以外の部分34b (8) 工具33の刃先33a以外の部分33bと工具
34の刃先34a (9) 工具33の刃先33aと工具34の刃先34a
以外の部分34b (10) 工具33の刃先33aと工具34の刃先34
a 例えば(1)を実行するタイミングでは、プロセッサ1
は、チャック31の論理色コード(0001)を論理色
設定レジスタ6に、工具33の刃先33a以外の部分3
3bの論理色コード(0011)を論理色設定レジスタ
7に送る。これらの論理色コードは、1フレームの間比
較回路8に送られる。
In the case of the simulation drawing shown in FIG. 3, there are the following ten combinations for interference check. (1) Chuck 31 and a portion 33b other than the cutting edge 33a of the tool 33 (2) Chuck 31 and a cutting edge 33a of the tool 33 (3) Chuck 31 and a portion 34b other than the cutting edge 34a of the tool 34 (4) Chuck 31 and the tool 34 (5) A portion 33b of the work 32 and the tool 33 other than the cutting edge 33a (6) A portion 34b of the work 32 and the tool 34 other than the cutting edge 34a (7) A portion 33b of the tool 33 other than the cutting edge 33a and a cutting edge 34a of the tool 34. (8) A portion 33b other than the cutting edge 33a of the tool 33 and a cutting edge 34a of the tool 34 (9) A cutting edge 33a of the tool 33 and a cutting edge 34a of the tool 34
Other parts 34b (10) The cutting edge 33a of the tool 33 and the cutting edge 34 of the tool 34
a For example, at the timing of executing (1), the processor 1
Indicates that the logical color code (0001) of the chuck 31 is stored in the logical color setting register 6,
The logical color code (0011) of 3b is sent to the logical color setting register 7. These logical color codes are sent to the comparison circuit 8 for one frame.

【0034】比較回路8は、レジスタ部4から送られる
論理コード化された画素データを、論理色コード(00
01)および論理色コード(0011)と比較する。画
素データは、1ドット単位で変化するので、比較回路8
はその都度チェックを行い、画素データが例えば論理色
コード(0001)と一致すれば、画素データの表示色
はチャック31の色、すなわち青であることを認識す
る。一方、画素データが例えば論理色コード(001
1)と一致すれば、画素データの表示色は工具33の刃
先33a以外の部分33bの色、すなわち赤であること
を認識する。
The comparison circuit 8 converts the logically coded pixel data sent from the register section 4 into a logical color code (00
01) and the logical color code (0011). Since the pixel data changes in units of one dot, the comparison circuit 8
Performs a check each time, and if the pixel data matches the logical color code (0001), for example, it recognizes that the display color of the pixel data is the color of the chuck 31, that is, blue. On the other hand, if the pixel data is, for example, a logical color code (001)
If it matches 1), it is recognized that the display color of the pixel data is the color of the portion 33b other than the cutting edge 33a of the tool 33, that is, red.

【0035】こうして、比較回路8は、随時画素データ
の表示色をチェックして行く途中で表示色の異なるドッ
トが連続した場合には、2つの図形が干渉していると判
断する。(1)の例で言えば、表示色が青である画素デ
ータの次に表示色が赤の画素データが送られたとする
と、チャック31と工具33の刃先33a以外の部分3
3bとが干渉していると判断する。比較回路8は、干渉
を検出すると直ちにアラームをプロセッサ1に送る。同
様に、(2)〜(10)のチェックも繰り返し行われ
る。
In this way, the comparison circuit 8 determines that two figures are interfering if dots having different display colors continue in the middle of checking the display color of the pixel data as needed. In the example of (1), if pixel data having a display color of red is transmitted next to pixel data having a display color of blue, a portion 3 other than the chuck 31 and the cutting edge 33a of the tool 33 will be described.
3b is determined to be interfering. The comparison circuit 8 sends an alarm to the processor 1 immediately after detecting the interference. Similarly, the checks (2) to (10) are repeatedly performed.

【0036】このように、本実施例では、論理色コード
を用いて図形の干渉チェックを行うようにしたので、表
示色が同一の図形であっても部分別に干渉チェックする
ことができる。
As described above, in the present embodiment, the interference check of the graphic is performed using the logical color code. Therefore, even if the graphic has the same display color, the interference check can be performed for each part.

【0037】また、画像データを表示メモリ2a〜2d
に格納する段階で論理色コードを持たせるようにしたの
で、少ない表示メモリ数で多数の表示色を使用すること
ができる。
The image data is stored in the display memories 2a to 2d.
Since a logical color code is provided at the stage of storing a large number of display colors, a large number of display colors can be used with a small number of display memories.

【0038】さらに、本実施例では、1フレーム毎に2
個ずつの図形部分を干渉チェックするようにしたので、
論理色設定レジスタ6等を2個用意するだけでよい。さ
らに、本実施例では、カラーパレット5を用いたので、
論理色コードで表された画素データから容易に正しい表
示色に再現することができる。
Further, in this embodiment, 2
Since each piece was checked for interference,
It is only necessary to prepare two logical color setting registers 6 and the like. Further, in this embodiment, since the color palette 5 is used,
A correct display color can be easily reproduced from the pixel data represented by the logical color code.

【0039】[0039]

【発明の効果】以上説明したように本発明では、画像デ
ータを論理色付けし、論理色コードにより図形の干渉チ
ェックを行うようにしたので、表示色が同一の図形であ
っても部分別に干渉チェックすることができる。したが
って、表示メモリ等の回路を増大させることなく、多数
の図形の干渉チェックを高速に処理することができる。
As described above, according to the present invention, the image data is logically colored and the interference of the graphic is checked by the logical color code. can do. Therefore, it is possible to perform a high-speed interference check for a large number of figures without increasing the number of circuits such as a display memory.

【図面の簡単な説明】[Brief description of the drawings]

【図1】グラフィック制御回路の構成を示すブロック図
である。
FIG. 1 is a block diagram illustrating a configuration of a graphic control circuit.

【図2】本発明の図形干渉チェック方式を実施するため
の数値制御装置のハードウェアの概略構成図である。
FIG. 2 is a schematic configuration diagram of hardware of a numerical control device for implementing the graphic interference check method of the present invention.

【図3】切削シミュレーション描画の例を示す図であ
る。
FIG. 3 is a diagram showing an example of cutting simulation drawing.

【図4】各チェック対象部分への表示色および論理色コ
ードの割り当ての一例を示す図である。
FIG. 4 is a diagram illustrating an example of assignment of a display color and a logical color code to each check target portion.

【図5】表示メモリ部への画像データの格納方法の一例
を示す図である。
FIG. 5 is a diagram illustrating an example of a method of storing image data in a display memory unit.

【図6】第1の従来技術を説明する図である。FIG. 6 is a diagram illustrating a first related art.

【図7】第2の従来技術を説明する図である。FIG. 7 is a diagram illustrating a second conventional technique.

【符号の説明】[Explanation of symbols]

1 プロセッサ(CPU) 2 表示メモリ部 3 表示コントローラ 4 レジスタ部 5 カラーパレット 6,7 論理色設定レジスタ 8 比較回路 9 バス DESCRIPTION OF SYMBOLS 1 Processor (CPU) 2 Display memory part 3 Display controller 4 Register part 5 Color palette 6, 7 Logical color setting register 8 Comparison circuit 9 Bus

───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.6,DB名) G05B 19/4068 G05B 19/4061──────────────────────────────────────────────────続 き Continued on front page (58) Field surveyed (Int.Cl. 6 , DB name) G05B 19/4068 G05B 19/4061

Claims (1)

(57)【特許請求の範囲】(57) [Claims] 【請求項1】 シミュレーション表示によって工具やワ
ーク等の干渉をチェックするCNC(数値制御装置)の
図形干渉チェック方式において、 干渉チェックの対象図形を区別するため各対象図形の画
像データ毎に論理色コードを割り付けて格納する表示メ
モリと、干渉チェックを行う対象図形に対応する 前記表示メモリ
論理色コードをシリアル信号に変換し、1ドット単位
の画素データとして出力するシフトレジスタと、 前記シフトレジスタから前記画素データを受け取るとと
もに前記画素データの論理色コードを読み取り、異なる
論理色コードを持つ画素データが連続した場合には対象
図形同士が干渉したものと見なし、アラームを出力する
比較手段と、 を有することを特徴とするCNCの図形干渉チェック方
式。
In a graphic interference check method of a CNC (numerical control device) for checking interference of a tool or a workpiece by simulation display , a logical color code for each image data of each target graphic for distinguishing the target graphic of the interference check. a display memory for storing by assigning the logical color code of said display memory corresponding to the target figure to perform the interference check into serial signals, a shift register for outputting a pixel data of one dot unit, from said said shift register reads the logical color code of the pixel data with receive pixel data, when the pixel data having different logical color code is consecutively assumes that the subject graphic to each other is interference, it has a comparing means for outputting an alarm A CNC graphic interference check method characterized by the following.
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