JP2687462B2 - Power supply voltage detection circuit - Google Patents
Power supply voltage detection circuitInfo
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Description
【発明の詳細な説明】 Ａ 産業上の利用分野 本発明は、各種電子機器の電源電圧の低下を検出する
電源電圧検出回路に関する。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a power supply voltage detection circuit that detects a decrease in power supply voltage of various electronic devices.
Ｂ 発明の概要 本発明は、第１の電源ラインに与えられる第１の電源
電圧にて作動する基準電圧発生手段による基準出力電圧
との比較により、第２の電源ラインに与えられる第２の
電源電圧にて作動する比較検出手段にて上記第１の電源
電圧および／または第２の電源電圧の低下を検出するに
あたり、上記基準電圧発生手段が動作を停止した場合
に、上記第２の電源ラインに与えられる第２の電源電圧
にて作動するクランプ手段にて、上記基準電圧発生手段
の出力電圧を所定値にクランプすることによって、電源
電圧の異なる２種類の電源ラインの電源電圧低下を確実
に検出できるようにしたものである。B Summary of the Invention The present invention provides a second power supply applied to a second power supply line by comparison with a reference output voltage generated by a reference voltage generating means operating at a first power supply voltage applied to a first power supply line. The second power supply line is operated when the reference voltage generating means stops its operation in detecting a decrease in the first power supply voltage and / or the second power supply voltage by the comparison detection means operating by voltage. By clamping the output voltage of the reference voltage generating means to a predetermined value by the clamp means that operates at the second power supply voltage applied to the It can be detected.
Ｃ 従来の技術 一般に、各種機能の回路基板を組み合わせて構成され
る電子機器では、各機能ブロック別に駆動に適した複数
の電源電圧を必要とし、例えば、ハードディスク装置の
記録回路における記録コイルに記録電流を流す駆動回路
の終段回路は、その初段側回路よりも低い電源電圧で大
きな駆動電流を流すことができるように構成される。こ
のようなハードディスク装置の記録回路では、上記初段
側回路および終段回路の何れの電源ラインの電源電圧が
低下した場合にも、正常な記録動作を行うことができな
くなり、場合によっては重要な情報が不用意に書き換え
られてしまう虞れがあるので、電源電圧検出回路を設け
て各電源ラインの電源電圧の異常低下を検出するように
している。上記電源電圧検出回路は、被検出電圧を基準
電圧と比較して、上記被検出電圧が基準電圧よりも低く
なったことを検出する構成となっている。C Conventional Technology In general, an electronic device configured by combining circuit boards of various functions requires a plurality of power supply voltages suitable for driving for each functional block. For example, a recording current is applied to a recording coil in a recording circuit of a hard disk device. The final-stage circuit of the drive circuit that supplies the current is configured to allow a large drive current to flow with a power supply voltage lower than that of the circuit on the initial stage side. In the recording circuit of such a hard disk device, a normal recording operation cannot be performed even when the power supply voltage of any of the power supply lines of the first-stage circuit and the last-stage circuit is lowered, and important information may be required in some cases. Therefore, a power supply voltage detection circuit is provided to detect an abnormal drop in the power supply voltage of each power supply line. The power supply voltage detection circuit is configured to compare the detected voltage with a reference voltage and detect that the detected voltage becomes lower than the reference voltage.
Ｄ 発明が解決しようとする課題 ところで、複数の電源ラインの電源電圧を検出する電
源電圧検出回路では、その回路自体が電子回路であるか
ら、駆動電源電圧の低下により、例えば、検出基準電圧
を与える基準電圧発生手段が正常に動作できなくなっ
て、所定の基準電圧を与えることができなくなり、誤動
作する虞れが大きく、この誤動作を防止のために複雑な
回路構成になってしまうという問題点がある。D Problem to be Solved by the Invention By the way, in a power supply voltage detection circuit for detecting the power supply voltage of a plurality of power supply lines, since the circuit itself is an electronic circuit, for example, a detection reference voltage is given when the drive power supply voltage decreases. There is a problem in that the reference voltage generating means cannot operate normally, a predetermined reference voltage cannot be applied, and there is a high possibility of malfunction, and a complicated circuit configuration is provided to prevent this malfunction. .
そこで、本発明は、上述の如き従来の実情に鑑み、各
種電源電圧の低下による電子機器の誤動作を確実に防止
できるようにすることを目的とし、複数の電源ラインの
電源電圧の低下を簡単な回路構成にて確実に検出できる
ようにした新規な構成の電源電圧検出回路を提供するも
のである。Therefore, in view of the conventional situation as described above, the present invention aims to surely prevent malfunction of an electronic device due to a decrease in various power supply voltages, and to easily reduce the power supply voltage of a plurality of power supply lines. The present invention provides a power supply voltage detection circuit having a novel structure that can be surely detected by the circuit structure.
Ｆ 課題を解決するための手段 本発明に係る電源電圧検出回路は、上述の目的を達成
するために、第１の電源ラインに与えられる第１の電源
電圧にて作動する基準電圧発生手段と、第２の電源ライ
ンに与えられる第２の電源電圧にて作動し、上記基準電
圧発生手段が動作を停止した場合に該基準電圧発生手段
の出力電圧を所定値にクランプするクランプ手段と上記
第２の電源ラインに与えられる第２の電源電圧にて作動
し、上記基準電圧発生手段の出力電圧との比較により上
記第１の電源電圧および／または第２の電源電圧の低下
を検出する比較検出手段とを備えて成ることを特徴とす
る。F In order to achieve the above-mentioned object, a power supply voltage detection circuit according to the present invention includes a reference voltage generation means that operates at a first power supply voltage applied to a first power supply line, The second power supply voltage is applied to the second power supply line, and when the reference voltage generating means stops operating, the output voltage of the reference voltage generating means is clamped to a predetermined value and the second means. Comparing and detecting means for operating at the second power supply voltage applied to the power supply line of the above, and detecting a decrease in the first power supply voltage and / or the second power supply voltage by comparison with the output voltage of the reference voltage generating means. It is characterized by comprising and.
Ｆ 作用 本発明に係る電源電圧検出回路において、基準電圧発
生手段は、第１の電源ラインに与えられる第１の電源電
圧にて作動するとともに、その出力電圧が所定電圧以下
に低下したときに第２の電源ラインに与えられる第２の
電源電圧にて作動するクランプ手段にて所定値にクラン
プされる。そして、比較検出手段は、上記低圧側の第２
の電源ラインに与えられる第２の電源電圧にて作動し
て、上記第１の電源電圧および／または第２の電源電圧
の低下を検出する。In the power supply voltage detection circuit according to the present invention, the reference voltage generation means operates at the first power supply voltage applied to the first power supply line, and when the output voltage drops below a predetermined voltage, It is clamped to a predetermined value by the clamp means that operates at the second power supply voltage applied to the two power supply lines. And the comparison detection means is the second low-voltage side.
It operates at the second power supply voltage applied to the power supply line to detect the decrease in the first power supply voltage and / or the second power supply voltage.
Ｇ 実施例 以下、本発明に係る電源電圧検出回路の一実施例につ
いて、図面に従い詳細に説明する。G Embodiment Hereinafter, an embodiment of the power supply voltage detection circuit according to the present invention will be described in detail with reference to the drawings.
本発明の一実施例の構成を示す第１図の回路図におい
て、（１）は高圧側の第１の電源ラインの電源入力端子
であり、（２）は低圧側の第２の電源ラインの電源入力
端子である。この実施例において、上記電源入力端子
（１）には第１の電源ラインの電源電圧（VCC1）として
例えば12Vの電源電圧が与えられ、また、上記電源入力
端子（２）には第２の電源ラインの電源電圧（VCC2）と
して例えば5Vの電源電圧が与えられている。In the circuit diagram of FIG. 1 showing the configuration of an embodiment of the present invention, (1) is a power supply input terminal of a high-voltage side first power supply line, and (2) is a low-voltage side second power supply line. This is the power input terminal. In this embodiment, the power supply input terminal (1) is supplied with a power supply voltage (V CC1 ) of the first power supply line, for example, 12 V, and the power supply input terminal (2) is supplied with a second power supply voltage. For example, a power supply voltage of 5V is applied as the power supply voltage (V CC2 ) of the power supply line.
この実施例の電源電圧検出回路は、上記電源入力端子
（１）に与えられる第１の電源ラインの電源電圧
（VCC1）にて作動する基準電圧発生部（10）と、上記電
源入力端子（２）に与えられる第２の電源ラインの電源
電圧（VCC2）にて作動するクランプ部（20）および比較
検出部（30）にて構成されている。The power supply voltage detection circuit of this embodiment includes a reference voltage generator (10) that operates at the power supply voltage (V CC1 ) of the first power supply line applied to the power supply input terminal (1) and the power supply input terminal ( It is composed of a clamp part (20) and a comparison detection part (30) which operate at the power supply voltage (V CC2 ) of the second power supply line given to 2).
上記基準電圧発生部（10）は、上記電源入力端子
（１）に抵抗（R11），（R12）を介して各エミッタが接
続され、一方のコレクタに各ベースが共通接続されたPN
Pトランジスタ（Q11），（Q12）と、上記PNPトランジス
タ（Q11），（Q12）の各コレクタに各エミッタが接続さ
れ、他方のコレクタに各ベースが共通接続されたPNPト
ランジスタ（Q13），（Q14）と、上記PNPトランジスタ
（Q13），（Q14）の各コレクタに各コレクタが接続さ
れ、接地ラインに抵抗に（R13）を介して各ベースが接
続された電流駆動能力の異なるNPNトランジスタ
（Q15），（Q16）と、上記電源入力端子（１）にコレク
タが接続され、上記PNPトランジスタ（Q13）のコレクタ
と上記NPNトランジスタ（Q15）のコレクタとにベースが
接続され、接地ラインに上記抵抗（R13）を介してエミ
ッタが接続されたNPNトランジスタ（Q17）とを備え、電
流駆動能力の大きな上記NPNトランジスタ（Q16）のエミ
ッタが直列抵抗（R14），（R15）を介して接地ラインに
接続され、電流駆動能力の小さな上記NPNトランジスタ
（Q15）のエミッタが上記抵抗（R15）を介して接地ライ
ンに接続された構成となっている。The reference voltage generator (10) is a PN in which each emitter is connected to the power input terminal (1) through resistors (R 11 ) and (R 12 ), and one collector is commonly connected to each base.
The P-transistor (Q 11 ) and (Q 12 ) and the PNP transistor (Q 11 ) and (Q 12 ) each collector is connected to each emitter, and the other collector is commonly connected to each base. 13 ), (Q 14 ) and the collectors of the PNP transistors (Q 13 ), (Q 14 ) connected to each collector, and the base connected to the ground line via a resistor (R 13 ). NPN transistors (Q 15 ) and (Q 16 ) with different driving ability and collector are connected to the power supply input terminal (1). The collector of the PNP transistor (Q 13 ) and the collector of the NPN transistor (Q 15 ) are connected. the base is connected, and a NPN transistor whose emitter is connected via the resistor (R 13) to the ground line (Q 17), the emitter of the large the NPN transistor of the current drive capability (Q 16) is a series resistor (R 14 ) and (R 15 ) The NPN transistor (Q 15 ) having a small current driving capability is connected to the ground line via the resistor (R 15 ).
この基準電圧発生部（10）は、上記電源入力端子
（１）に与えられる第１の電源ラインの電源電圧
（VCC1）にて、所謂バンドギャップリファレンス構造の
基準電圧発生回路として作動し、上記NPNトランジスタ
（Q17）のエミッタから所定の基準電圧（VREF）を上記
比較検出部（30）に与える。The reference voltage generation section (10) operates as a reference voltage generation circuit of a so-called bandgap reference structure at the power supply voltage (V CC1 ) of the first power supply line applied to the power supply input terminal (1), A predetermined reference voltage (V REF ) is applied to the comparison detection section (30) from the emitter of the NPN transistor (Q 17 ).
また、上記クランプ部（20）は、上記電源入力端子
（２）にコレクタが接続されたNPNトランジスタ（Q21）
と、それぞれダイオード接続され直列接続されたNPNト
ランジスタ（Q22），（Q23）を備え、上記NPNトランジ
スタ（Q21）のベースが抵抗（R21）を介して上記電源入
力端子（２）に接続されるとともに上記ダイオード接続
されたNPNトランジスタ（Q22），（Q23）の直列回路を
介して接地ラインに接続され、さらに、上記NPNトラン
ジスタ（Q21）のエミッタが上記基準電圧発生部（10）
の出力端すなわち上記NPNトランジスタ（Q17）のエミッ
タに接続された構成となっている。The clamp part (20) has an NPN transistor (Q 21 ) whose collector is connected to the power input terminal (2).
And NPN transistors (Q 22 ) and (Q 23 ) which are diode-connected and connected in series, respectively, and the base of the NPN transistor (Q 21 ) is connected to the power input terminal (2) via the resistor (R 21 ). The NPN transistor (Q 21 ) is connected to the ground line through a series circuit of the diode-connected NPN transistors (Q 22 ) and (Q 23 ), and the emitter of the NPN transistor (Q 21 ) is connected to the reference voltage generating section ( Ten)
The output end that is a connected to each to the emitter of the NPN transistor (Q 17).
このクランプ回路（20）は、上記電源入力端子（２）
に与えられる第２の電源ラインの電源電圧（VCC2）に
て、所謂バンドギャップリファレンスのスタータとして
作動し、上記第１の電源ラインの電源電圧（VCC1）の低
下により上記基準電圧発生部（10）の出力電圧すなわち
基準電圧（VREF）が第２図に示すように所定電圧以下に
低下したときに、上記ダイオード接続されたNPNトラン
ジスタ（Q22），（Q23）の順方向電圧（2Vf）を上記NPN
トランジスタ（Q21）を介して上記基準電圧発生部（1
0）の出力端に与えて、上記基準電圧発生部（10）の出
力電圧を所定電圧（Vf）にクランプする。This clamp circuit (20) has the above power input terminal (2)
With the power supply voltage (V CC2 ) of the second power supply line applied to the device, it operates as a so-called bandgap reference starter, and the reference voltage generating unit (V CC1 ) decreases due to the decrease of the power supply voltage (V CC1 ) of the first power supply line. When the output voltage of 10), that is, the reference voltage (V REF ) drops below a predetermined voltage as shown in FIG. 2, the forward voltage () of the diode-connected NPN transistors (Q 22 ) and (Q 23 ) 2V f ) above NPN
The reference voltage generator via a transistor (Q 21) (1
0) and clamps the output voltage of the reference voltage generator (10) to a predetermined voltage (V f ).
さらに、上記比較検出部（30）は、上記基準電圧発生
部（10）の出力端すなわち上記上記NPNトランジスタ（Q
17）のエミッタにベースが接続されたPNPトランジスタ
（Q31）と、上記第１の電源ラインの電源電圧（VCC1）
の与えられる上記電源入力端子（１）と接地ラインとの
間に直列接続された分割抵抗（R31），（32）の接続中
点にベースが接続されたPNPトランジスタ（Q32）と、上
記第２の電源ラインの電源電圧（VCC2）の与えられる上
記電源入力端子（２）と接地ラインとの間に直列接続さ
れた分割抵抗（R33），（34）の接続中点にベースが接
続されたPNPトランジスタ（Q33）とを備え、上記PNPト
ランジスタ（Q31），（Q32），（Q33）の各エミッタがP
NPトランジスタ（Q34）とPNPトランジスタ（Q35）にて
構成した電流源を介して上記電源入力端子（２）に共通
接続され、上記PNPトランジスタ（Q31）に対して上記各
PNPトランジスタ（Q32），（Q33）がそれぞれ差動対を
構成するようになっている。Further, the comparison detection section (30) is configured to output the output terminal of the reference voltage generation section (10), that is, the NPN transistor (Q
17 ) PNP transistor (Q 31 ) whose base is connected to the emitter and the power supply voltage (V CC1 ) of the first power supply line
The PNP transistor (Q 32 ) whose base is connected to the connection midpoint of the dividing resistors (R 31 ) and ( 32 ) connected in series between the power input terminal (1) and the ground line The base is located at the connection midpoint of the dividing resistors (R 33 ) and ( 34 ) connected in series between the power supply input terminal (2) to which the power supply voltage (V CC2 ) of the second power supply line is applied and the ground line. A connected PNP transistor (Q 33 ), and the emitters of the PNP transistors (Q 31 ), (Q 32 ), and (Q 33 ) are P
Via the NP transistor (Q 34) and a current source constituted by a PNP transistor (Q 35) connected in common to said power input terminal (2), each with respect to the PNP transistor (Q 31)
The PNP transistors (Q 32 ) and (Q 33 ) each form a differential pair.
上記PNPトランジスタ（Q31）のコレクタは、検出出力
段を構成するPNPトランジスタ（Q35）のベースに接続さ
れているとともに抵抗（R35）を介して接地ラインに接
続されている。The collector of the PNP transistor (Q 31 ) is connected to the base of the PNP transistor (Q 35 ) forming the detection output stage and also connected to the ground line via the resistor (R 35 ).
上記PNPトランジスタ（Q35）は、そのエミッタが接地
ラインに接続され、そのコレクタがNPNトランジスタ（Q
37）のベースに接続されているとともに抵抗（R36）を
介して上記電源入力端子（２）に接続されている。ま
た、上記NPNトランジスタ（Q37）は、そのエミッタが接
地ラインに接続され、そのコレクタが検出出力端子
（３）に接続されている。The PNP transistor (Q 35 ) has its emitter connected to the ground line and its collector connected to the NPN transistor (Q 35 ).
37 ) and the resistor (R 36 ) to the power input terminal (2). The NPN transistor (Q 37 ) has its emitter connected to the ground line and its collector connected to the detection output terminal (3).
また、上記PNPトランジスタ（Q31）に対して差動対を
なす上記各PNPトランジスタ（Q32），（Q33）は、各コ
レクタがそれぞれシュミット回路を構成する各NPNトラ
ンジスタ（Q38），（Q39）の各ベースに接続されている
とともに、それぞれ抵抗（R37），（R38）を介して接地
ランイに接続されている。The PNP transistors (Q 32 ) and (Q 33 ) forming a differential pair with respect to the PNP transistor (Q 31 ) include NPN transistors (Q 38 ), (Q 38 ) and (Q 38 ), respectively, each collector of which constitutes a Schmitt circuit. Q 39 ) and the resistors (R 37 ) and (R 38 ) to the ground run.
この比較検出部（30）は、上記電源入力端子（２）に
与えられる上記第２の電源ラインの電源電圧（VCC2）に
て作動し、上記電源入力端子（１）に与えられる上記第
１の電源ラインの電源電圧（VCC1）を上記分割抵抗（R
31），（R32）にて分圧した電圧（V1）と上記基準電圧
（VREF）とを上記各PNPトランジスタ（Q31），（Q32）
による差動対にて常に比較し、また、上記電源入力端子
（２）に与えられる上記第２の電源ラインの電源電圧
（VCC2）を上記分割抵抗（R33），（R34）にて分圧した
電圧（V2）と上記基準電圧（VREF）とを上記各PNPトラ
ンジスタ（Q31），（Q33）による差動対にて常に比較し
ており、上記第１の電源ラインの電源電圧（VCC1）また
は上記第２の電源ラインの電源電圧（VCC2）が低下して
上記各PNPトランジスタ（Q32），（Q33）の各ベースに
与えられる上記各電圧（V1），（V2）の少なくとも一方
が上記PNPトランジスタ（Q31）のベースに与えられる上
記基準電圧（VREF）よりも低くなると、上記検出出力段
のNPNトランジスタ（Q37）がオンとなる比較検出動作を
行う。The comparison / detection unit (30) operates at the power supply voltage (V CC2 ) of the second power supply line applied to the power supply input terminal (2) and the first power supply terminal (1) receives the first power supply voltage. The power supply voltage (V CC1 ) of the power supply line of
31 ), (R 32 ) divided voltage (V 1 ) and the reference voltage (V REF ) above each PNP transistor (Q 31 ), (Q 32 ).
Are always compared by a differential pair of the above, and the power supply voltage (V CC2 ) of the second power supply line given to the power supply input terminal (2) is divided by the dividing resistors (R 33 ) and (R 34 ). The divided voltage (V 2 ) and the reference voltage (V REF ) are constantly compared by the differential pair of the PNP transistors (Q 31 ), (Q 33 ). The power supply voltage (V CC1 ) or the power supply voltage (V CC2 ) of the second power supply line drops, and the above voltage (V 1 ) applied to the bases of the PNP transistors (Q 32 ) and (Q 33 ). , (V 2 ) becomes lower than the reference voltage (V REF ) applied to the base of the PNP transistor (Q 31 ), the NPN transistor (Q 37 ) in the detection output stage turns on. Take action.
このような構成の電源電圧検出回路では、上記基準電
圧発生部（10）が高圧側の上記第１の電源ラインの電源
電圧（VCC1）にて作動して所望の基準電圧（VREF）を発
生するので、上記第２の電源ラインの電源電圧（VCC2）
が非常に低くなっても、上記基準電圧発生部（10）の出
力電圧力すなわち上記基準電圧（VREF）が上記電源電圧
（VCC2）を上記分割抵抗（R33），（R34）にて分圧した
電圧（V2）よりも低くなることはない。In the power supply voltage detection circuit having such a configuration, the reference voltage generator (10) operates at the power supply voltage (V CC1 ) of the first power supply line on the high voltage side to generate a desired reference voltage (V REF ). Occurs, so the power supply voltage of the second power supply line (V CC2 )
Is very low, the output voltage of the reference voltage generator (10), that is, the reference voltage (V REF ) transfers the power supply voltage (V CC2 ) to the dividing resistors (R 33 ) and (R 34 ). It is never lower than the divided voltage (V 2 ).
また、上記第１の電源ラインの電源電圧（VCC1）の低
下により上記基準電圧発生部（10）の出力電圧すなわち
上記基準電圧（VREF）が所定電圧以下に低下すると、上
記クランプ部（20）によって上記基準電圧発生部（10）
の出力電圧が所定電圧（Vf）にクランプされるので、上
記第１の電源ラインの電源電圧（VCC1）が非常に低くな
っても、上記基準電圧発生部（10）の出力電圧すなわち
上記基準電圧（VREF）が上記電源電圧（VCC1）を上記分
割抵抗（R31），（R32）にて分圧した電圧（V1）よりも
低くなることはない。When the output voltage of the reference voltage generator (10), that is, the reference voltage (V REF ) decreases to a predetermined voltage or less due to the decrease of the power supply voltage (V CC1 ) of the first power supply line, the clamp unit (20 ) By the reference voltage generator (10)
Since the output voltage of the above is clamped to a predetermined voltage (V f ), even if the power supply voltage (V CC1 ) of the first power supply line becomes extremely low, the output voltage of the reference voltage generating section (10), that is, the above The reference voltage (V REF ) never becomes lower than the voltage (V 1 ) obtained by dividing the power supply voltage (V CC1 ) by the dividing resistors (R 31 ) and (R 32 ).
従って、この実施例の電源電圧検出回路では、上記第
１の電源ラインの電源電圧（VCC1）および／または第２
の電源ラインの電源電圧（VCC2）の低下により誤った検
出動作を行うことがなく、上記電源電圧（VCC1），（V
CC2）の低下を確実に検出することができる。Therefore, in the power supply voltage detection circuit of this embodiment, the power supply voltage (V CC1 ) of the first power supply line and / or the second
There is no erroneous detection operation due to the drop in the power supply voltage (V CC2 ) of the power supply line, and the power supply voltage (V CC1 ), (V
A decrease in CC2 ) can be reliably detected.
なお、上記クランプ部（20）を省略した場合には、第
２図中に破線にて示すように、上記第１の電源ラインの
電源電圧（VCC1）の低下により、上記基準電圧発生部
（10）による上記基準電圧（VREF）が上記電圧（V1）よ
りも低くなってしまい、同図中に斜線を施して示す領域
で誤動作することになる。When the clamp part (20) is omitted, as shown by the broken line in FIG. 2, the reference voltage generating part (V CC1 ) decreases due to the decrease in the power supply voltage (V CC1 ) of the first power supply line. The above reference voltage (V REF ) due to 10) becomes lower than the above voltage (V 1 ), and malfunction occurs in the shaded area in the figure.
Ｈ 発明の効果 本発明では、第１の電源ラインに与えられる第１の電
源電圧にて作動するとともに、その出力電圧が所定電圧
以下に低下したときに第２の電源ラインに与えられる第
２の電源電圧にて作動するクランプ手段にて所定値にク
ランプされる基準電圧発生手段の出力電圧との比較によ
り、上記第１の電源電圧および／または第２の電源電圧
の低下を上記第２の電源ラインに与えられる第２の電源
電圧にて作動する比較検出手段にて検出する極めて簡単
な回路構成の電圧検出回路にて、上記第１の電源電圧お
よび／または第２の電源電圧の低下を確実に検出するこ
とができる。従って、本発明に係る電源電圧検出回路を
用いることにより、ハードディスク装置等の各種電子装
置の誤動作を防止することが可能になる。H Effect of the Invention According to the present invention, the second power supply line operates when the first power supply voltage is applied to the first power supply line, and when the output voltage drops below a predetermined voltage. The decrease of the first power supply voltage and / or the second power supply voltage is compared with the output voltage of the reference voltage generation means clamped to a predetermined value by the clamp means operating at the power supply voltage, and the second power supply is reduced. A voltage detection circuit having an extremely simple circuit configuration, which is detected by comparison detection means that operates at the second power supply voltage applied to the line, ensures a decrease in the first power supply voltage and / or the second power supply voltage. Can be detected. Therefore, by using the power supply voltage detection circuit according to the present invention, it is possible to prevent malfunction of various electronic devices such as a hard disk device.
第１図は本発明に係る電源電圧検出回路の一実施例の構
成を示す回路図、第２図は上記実施例の動作を説明する
ための特性線図である。 （１），（２）……電源入力端子 （３）……検出出力端子 （10）……基準電圧発生部 （20）……クランプ部 （30）……比較検出部FIG. 1 is a circuit diagram showing the configuration of an embodiment of a power supply voltage detection circuit according to the present invention, and FIG. 2 is a characteristic diagram for explaining the operation of the above embodiment. (1), (2) …… Power input terminal (3) …… Detection output terminal (10) …… Reference voltage generator (20) …… Clamp (30) …… Comparison detector
Claims (1)
電圧にて作動する基準電圧発生手段と、 第２の電源ラインに与えられる第２の電源電圧にて作動
し、上記基準電圧発生手段が動作を停止した場合に該基
準電圧発生手段の出力電圧を所定値にクランプするクラ
ンプ手段と、 上記第２の電源ラインに与えられる第２の電源電圧にて
作動し、上記基準電圧発生手段の出力電圧との比較によ
り上記第１の電源電圧および／または第２の電源電圧の
低下を検出する比較検出手段とを備えて成る電源電圧検
出回路。1. A reference voltage generating means that operates at a first power supply voltage applied to a first power supply line, and a reference voltage generation means that operates at a second power supply voltage applied to a second power supply line. Clamping means for clamping the output voltage of the reference voltage generating means to a predetermined value when the means stops operating, and the second power source voltage applied to the second power source line to operate the reference voltage generating means. A power supply voltage detection circuit comprising: a comparison detection means for detecting a decrease in the first power supply voltage and / or the second power supply voltage by comparison with the output voltage of.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19146488A JP2687462B2 (en) | 1988-07-30 | 1988-07-30 | Power supply voltage detection circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19146488A JP2687462B2 (en) | 1988-07-30 | 1988-07-30 | Power supply voltage detection circuit |
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| Publication Number | Publication Date |
|---|---|
| JPH0240568A JPH0240568A (en) | 1990-02-09 |
| JP2687462B2 true JP2687462B2 (en) | 1997-12-08 |
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Family Applications (1)
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|---|---|---|---|
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| JP (1) | JP2687462B2 (en) |
-
1988
- 1988-07-30 JP JP19146488A patent/JP2687462B2/en not_active Expired - Fee Related
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|---|---|
| JPH0240568A (en) | 1990-02-09 |
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