JP2658031B2 - Color image reading method - Google Patents

Color image reading method

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JP2658031B2
JP2658031B2 JP62021583A JP2158387A JP2658031B2 JP 2658031 B2 JP2658031 B2 JP 2658031B2 JP 62021583 A JP62021583 A JP 62021583A JP 2158387 A JP2158387 A JP 2158387A JP 2658031 B2 JP2658031 B2 JP 2658031B2
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【発明の詳細な説明】 (産業上の利用分野) 本発明は、3色(たとえば、R,G,B)を読み取るため
の画素を順次隣接して配置したカラーセンサを用いたカ
ラー画像の読取方式に関する。
DETAILED DESCRIPTION OF THE INVENTION (Industrial application field) The present invention reads a color image using a color sensor in which pixels for reading three colors (for example, R, G, B) are sequentially arranged adjacently. About the method.

(従来の技術) カラー画像入力装置において用いるカラーセンサに
は、3色(たとえばR,G,B)を読み取るための画素を順
次配列したものがある。たとえば、1次元の密着型CCD
カラーセンサでは、1画素内にR,G,Bの各フィルタが順
次蒸着されており、基本的にはR→G→Bの順にシリア
ルにデータが出力される。そして、この1組のデータか
ら印刷に用いる3色に変換する色演算処理を行う。
(Prior Art) There is a color sensor used in a color image input device in which pixels for reading three colors (for example, R, G, B) are sequentially arranged. For example, one-dimensional contact type CCD
In the color sensor, R, G, and B filters are sequentially deposited in one pixel, and data is basically output serially in the order of R → G → B. Then, color calculation processing for converting the set of data into three colors used for printing is performed.

(発明が解決しようとする問題点) この色演算処理方法では、画像読取の密度がセンサの
画素の密度に等しい。したがって、読取密度は、利用で
きるセンサの画素密度(たとえば16本/mm)より高くす
ることができない。
(Problems to be Solved by the Invention) In this color operation processing method, the density of image reading is equal to the density of pixels of the sensor. Therefore, the reading density cannot be higher than the pixel density of the available sensor (for example, 16 lines / mm).

画素の密度を高めるため、従来は読み取った画像デー
タを電気的に処理する方法が用いられていた。
Conventionally, a method of electrically processing read image data has been used to increase the density of pixels.

本発明の目的は、センサの画像の密度より高い読取密
度で画像読取を行う新しいカラー画像読取方式を提供す
ることである。
An object of the present invention is to provide a new color image reading method for reading an image at a reading density higher than the density of an image of a sensor.

(問題点を解決するための手段) 本発明者は、隣接画素間でも、この計算を行うことに
よって密度を3倍に上げることが可能であると考え、本
発明に到ったものである。
(Means for Solving the Problems) The present inventor has considered that it is possible to increase the density three times by performing this calculation even between adjacent pixels, and has arrived at the present invention.

本発明に係るカラー画像読取方式は、3色をそれぞれ
検出する3種の素子の組を所定の順序配列し、かつ、複
数組の素子を1次元に配列した1次元カラーセンサを用
いてカラー画素を検出する検出手段と、この1次元カラ
ーセンサにより検出された1組の3色の画像データを印
刷用の1画素の3色の印刷データに1次変換する色演算
処理装置とからなるカラー画像読取方式において、 色演算処理装置において、1画素の印刷データに変換
すべき画像データを検出する3色の素子の組Si(i=1,
2,…)として1次元カラーセンサを構成する複数の素子
Cj(j=0,1,…)から(Cj,Cj+1,Cj+2)の組Pj(j=0,
1,…)を用いて、各Cj,Cj+1,Cj+2ごとに印字に必要な印
刷データを、入力されたカラーデータの搬送速度より高
速に演算し、順序出力することを特徴とする。
In the color image reading method according to the present invention, a set of three types of elements for detecting three colors is arranged in a predetermined order, and a plurality of sets of elements are arranged one-dimensionally. And a color arithmetic processing unit that performs a primary conversion of a set of three-color image data detected by the one-dimensional color sensor into three-color print data of one pixel for printing. In the reading method, in a color operation processing device, a set S i (i = 1, 3) of three color elements for detecting image data to be converted into print data of one pixel.
Multiple elements that constitute a one-dimensional color sensor as (2, ...)
A set P j (j = 0, 0) of C j (j = 0, 1,...) To (C j , C j + 1 , C j + 2 )
1, ...) to calculate the print data required for printing for each of C j , C j + 1 , C j + 2 at a speed higher than the transport speed of the input color data, and output them sequentially. Features.

(作 用) 1次元カラーセンサの3色の素子の組を互に重複して
設定することによりカラー画像の画素密度を3倍に増加
する。
(Operation) The pixel density of a color image is tripled by setting a set of three color elements of a one-dimensional color sensor so as to overlap each other.

(実施例) 以下、添付の図面を参照して本発明の実施例を説明す
る。
Hereinafter, an embodiment of the present invention will be described with reference to the accompanying drawings.

第2図に画像読取回路のブロック図を示す。原稿は図
示しない光源(蛍光灯)により照射され、その反射光の
画像情報が1次元の密着型カラーCCDセンサ(1)によ
って検出され、電気量に変換される。このセンサ(1)
は、CCDセンサ4個を千鳥状に一列に配置して結合した
ものであり、各センサには1画素内にR(レッド)、G
(グリーン)、B(ブルー)のフィルタがスキャン方向
に順次蒸着されている。(なお、画素の形状は、モアレ
パターンの発生を防ぐため、正方形ではなく、平行四辺
形である。)したがって、各CCDセンサは、R,G,Bの信号
を順次アナログマルチプレクサ(2)に送る。アナログ
マルチプレクサ(2)は、4個のセンサから出力される
信号を選択し、一本の信号バスに変換してサンプルホー
ルド回路(3)に送る。サンプルホールド回路(3)は
R,G,Bの各信号に色分解を行う。次の信号増幅回路
(4)は、各信号R,G,Bの感度補正を行いながら、黒レ
ベルとの差動増幅を行う。増幅された各信号は、それぞ
れ、AD変換器5において8ビットのディジタル値に変換
され、次にシェーディング補正回路(6)においてシェ
ーディング補正が施され、色演算回路(7)に送られ
る。
FIG. 2 shows a block diagram of the image reading circuit. The original is illuminated by a light source (fluorescent lamp) (not shown), and the image information of the reflected light is detected by a one-dimensional contact type color CCD sensor (1) and converted into an electric quantity. This sensor (1)
Is a CCD in which four CCD sensors are arranged in a staggered line and connected, and each sensor has R (red), G
(Green) and B (blue) filters are sequentially deposited in the scanning direction. (The shape of the pixel is not a square but a parallelogram in order to prevent the occurrence of a moiré pattern.) Therefore, each CCD sensor sequentially sends R, G, B signals to the analog multiplexer (2). . The analog multiplexer (2) selects signals output from the four sensors, converts the signals into one signal bus, and sends the signal bus to the sample and hold circuit (3). The sample and hold circuit (3)
Color separation is performed on each of the R, G, and B signals. The next signal amplifying circuit (4) performs differential amplification with respect to the black level while correcting the sensitivity of each of the signals R, G, and B. Each of the amplified signals is converted into an 8-bit digital value by the AD converter 5, then subjected to shading correction by the shading correction circuit (6), and sent to the color operation circuit (7).

色演算回路(7)は、シェーディング補正された読取
り画像信号R,G,Bの各データを印字画像データであるC
(シアン),M(マゼンタ),Y(イエロー)に変換する。
色変換処理では、 印字データ=r・R+g・G+b・B …… なる変換を行う。r,g,bはある所定の定数であり、C,M,Y
の各データによって異なることから、式は、次の式
のように書き直せる。
The color operation circuit (7) converts each data of the read image signals R, G, and B that have been subjected to shading correction to C, which is print image data.
(Cyan), M (Magenta), and Y (Yellow).
In the color conversion processing, the following conversion is performed: print data = r · R + g · G + b · B. r, g, b are predetermined constants, and C, M, Y
Can be rewritten as follows:

ただしr1〜3,g1〜3,b1〜3は定数である。した
がって、色演算処理のおいては、各定数r,g,bと読取り
画像データR,G,Bを乗算した後、r・R,g・G,b・Bなる
データを加算していく。
However, r 1-3 , g 1-3 , and b 1-3 are constants. Therefore, in the color calculation process, after multiplying each of the constants r, g, b by the read image data R, G, B, data r · R, g · G, b · B are added.

本発明に係る色演算処理では、次に説明するように、
カラーの画像密度を隣接画素間の和もとることにより3
倍まで上げる。第1図に示すように、センサのi番目の
画素は、Ri,Gi,Biの順に配列されている。いま、3i番目
のCの値(C3i)を次の式でi番目の画素データ(Ri,
Gi,Bi)から演算したとする。
In the color calculation processing according to the present invention, as described below,
By calculating the color image density between the adjacent pixels, 3
Up to double. As shown in FIG. 1, the i-th pixel of the sensor is arranged in the order of R i , G i , and B i . Now, the 3i-th C value (C 3i ) is calculated by the following equation using the i-th pixel data (R i ,
G i , B i ).

C3i=r1・Ri+g1・Gi+b1・Bi …… このとき、3i+1番目のCの値(C3i+1)は隣の画素
のデータを利用して求める。
C 3i = r 1 · R i + g 1 · G i + b 1 · B i ... At this time, the 3i + 1th C value (C 3i + 1 ) is obtained by using the data of the adjacent pixel.

C3i+1=r1・Ri+1+g1・Gi+b1・Bi …… さらに、3i+2番目のCの値(C3i+2)は、さらに隣
の画素のデータを利用して求める。
C 3i + 1 = r 1 · R i + 1 + g 1 · G i + b 1 · B i Further, the 3i + 2nd C value (C 3i + 2 ) is obtained by using the data of the next pixel. Ask.

C3i+2=r1・Ri+1+g1・Gi+1+b1・Bi …… M,Yについても同様の色演算処理を行う。C 3i + 2 = r 1 · R i + 1 + g 1 · G i + 1 + b 1 · B i ... Similar color calculation processing is performed for M and Y.

このように、隣接画素のデータを用いて色演算処理を
行うことにより、読取密度の3倍の画素密度を得ること
ができる。
As described above, by performing the color calculation processing using the data of the adjacent pixels, it is possible to obtain a pixel density three times the reading density.

第3図は、色演算回路(7)のブロック図である。乗
算ブロック(11)は、r.R等の乗算を行うブロックであ
り、その値は、並列に接続されているC,M,Y用の3個の
加算ブロック(12,13,14)へ順次送られ、各加算値は、
順次データ合成回路(15)に送られる。この回路の動作
は、後にタイミングチャート(第5図)を用いて説明さ
れる。
FIG. 3 is a block diagram of the color operation circuit (7). The multiplication block (11) is a block for performing multiplication such as rR, and its value is sequentially sent to three addition blocks (12, 13, 14) for C, M, and Y connected in parallel. , Each added value is
The data are sequentially sent to the data synthesis circuit (15). The operation of this circuit will be described later using a timing chart (FIG. 5).

第4図は、乗算ブロック(11)と1個の加算ブロック
(たとえば12)の回路図である。他の2個の加算ブロッ
クは簡単のため図示を省略している。
FIG. 4 is a circuit diagram of a multiplication block (11) and one addition block (for example, 12). The other two addition blocks are not shown for simplicity.

第5図のフローチャートに示すように乗算ブロック
(11)においては、CCDセンサ(1)によって読み取ら
れた入力画素データR,G,Bの各データ(8ビットのディ
ジタルデータ)は、パラレルにパラレル−シリアル変換
回路(21)に入力され、そして、ドットクロックを3倍
したクロックCK1の立ち上がりに同期して、R,G,Bの順
に、シリアルに乗算器(22)にデータDAとして転送され
る。一方、セレクタ回路(23)は、r,g,bの3定数(た
とえばCの演算の場合は、r1,g1,b1)の内の1つを選択
し、乗算器(22)に送る。この選択は、セレクトクロッ
ク発生回路(24)において発生される定数セレクトクロ
ックCK2,CK3の立ち上がりに同期して行われる。こうし
て、rとRデータ,gとGデータ,bとBデータがそれぞれ
同期して乗算器(22)に入力される。したがって、乗算
器(22)は、r・Rデータ,g・Gデータ,b・Bデータな
る乗算を順に行い、ラッチ回路(2)を介して、クロッ
ク▲▼に同期して、加算ブロックに乗算値を送
る。
As shown in the flowchart of FIG. 5, in the multiplication block (11), each data (8-bit digital data) of the input pixel data R, G, B read by the CCD sensor (1) is converted into parallel data. The data is input to the serial conversion circuit (21), and is serially transferred as data DA to the multiplier (22) in the order of R, G, and B in synchronization with the rise of the clock CK1 that is three times the dot clock. On the other hand, the selector circuit (23) selects one of the three constants r, g, and b (for example, r 1 , g 1 , and b 1 in the case of the calculation of C), and outputs the result to the multiplier (22). send. This selection is performed in synchronization with the rise of the constant select clocks CK2 and CK3 generated in the select clock generation circuit (24). Thus, r and R data, g and G data, and b and B data are input to the multiplier (22) in synchronization with each other. Therefore, the multiplier (22) sequentially performs multiplication of r · R data, g · G data, and b · B data, and multiplies the addition block by the latch circuit (2) in synchronization with the clock ▲. Send value.

加算ブロックにおいて、セレクタ回路(34)は、加算
器(31)によって、加算されたデータDCを定期的に(3
回に一度)“φ”にクリアしている。そして、ラッチ
(25)からの出力DBと同期をとるため、ラッチ回路(3
5)によってラッチし、加算器(31)にデータDC′をフ
ィード・バックしている。加算器(31)は、乗算ブロッ
クからの入力データDBとフィードバックされたDC′との
加算を行い、ラッチ回路(32,33)を通じてデータDCを
出力している。
In the addition block, the selector circuit (34) periodically adds the data DC added by the adder (31) to (3).
(Once each time) It clears to “φ”. Then, in order to synchronize with the output DB from the latch (25), the latch circuit (3
5), and the data DC 'is fed back to the adder (31). The adder (31) adds the input data DB from the multiplication block and the DC 'fed back, and outputs data DC through the latch circuits (32, 33).

ラッチ回路(32)の出力DCは、セレクタ(34)によっ
て定期的にクリアされるが、そのクリアされるタイミン
グと同期して、ラッチ回路(33)でラッチされ、式の
演算を実現している。すなわち、加算ブロックは、r・
R+0,r・R+g・G,r・R+g・G+b・Bなる加算を
行いながら、r・R+g・G+b・Bなるデータのみを
次の処理ブロックに出力している。
The output DC of the latch circuit (32) is periodically cleared by the selector (34). The output DC is latched by the latch circuit (33) in synchronization with the timing of the clear, thereby realizing the operation of the expression. . That is, the addition block is r ·
While performing the addition of R + 0, r · R + g · G, r · R + g · G + b · B, only the data of r · R + g · G + b · B is output to the next processing block.

第3図に示すように、第4図右側に示す加算ブロック
が実際には並列に接続されるが、各加算ブロックの動作
の相違は、セレクタ34の“φ”の選択とそれと同時に行
われるラッチ34のラッチのタイミングだけである。すな
わち、第5図のタイミングチャートに示すように、加算
ブロックI〜III内におけるセレクタ回路34は、加算器3
1からの出力データDCを定期的に“φ”にクリアする
が、I〜IIIの各ブロックは、“φ”にクリアするタイ
ミングが異なり(DC′参照)、そして、各ブロックのラ
ッチ回路33は、セレクタ34において“φ”にクリアする
タイミングに同期してDCをラッチする(第5図のDD参
照)。したがって、乗算ブロックより出力される画像デ
ータr・Rn,g・Gn,b・Bnを簡単のためRn′,Gn′,Bn′で
表わすと、加算ブロックIではRn′+Gn′+Bn′を、II
ではRn+1′+Gn′+Bn′を、IIIではRn+1′+Gn+1′+B
n′を出力することなになり、画素密度を3倍にあげる
ことが可能になるのである。いま、各ブロックI,II,III
の出力をDEn,DFn,DGnとすれば、第3図のデータ合成回
路(15)において、DEn,DFn,DGnの順にブロックの出力
をパラレル−シリアル変換を行い、プリンタに送る。こ
うして、色演算処理回路(7)において、印字データC,
MまたはYに変換する際、読み取り画素密度の3倍のデ
ータを出力する。
As shown in FIG. 3, the addition blocks shown on the right side of FIG. 4 are actually connected in parallel. However, the difference between the operation of each addition block is that the selection of “φ” by the selector 34 and the latch performed simultaneously therewith. Only 34 latch timings. That is, as shown in the timing chart of FIG. 5, the selector circuit 34 in the addition blocks I to III
The output data DC from 1 is periodically cleared to “φ”, but the timing of clearing each block of I to III to “φ” is different (see DC ′), and the latch circuit 33 of each block is Then, the DC is latched in synchronization with the timing of the selector 34 clearing to "φ" (see DD in FIG. 5). Therefore, if the image data r · R n , g · G n , b · B n output from the multiplication block is represented by R n ′, G n ′, B n ′ for simplicity, the addition block I has R n ′ + G n ′ + B n ′, II
In Rn + 1 '+ Gn ' + Bn ', in III, Rn + 1 ' + Gn + 1 '+ B
This means that n 'is not output, and the pixel density can be tripled. Now, each block I, II, III
Are output as DE n , DF n , and DG n , the output of the block is subjected to parallel-serial conversion in the order of DE n , DF n , and DG n in the data synthesis circuit (15) in FIG. send. Thus, in the color operation processing circuit (7), the print data C,
When converting to M or Y, data is output three times the read pixel density.

印字データに変換するため、原稿の色情報を得る画像
入力装置は、各印字データC,M,Yごとに走査をくり返
し、3回スキャンさせる。
In order to convert the print data into print data, the image input device that obtains the color information of the original repeats scanning for each of the print data C, M, and Y, and performs three scans.

色演算回路(7)の出力データ(DH)は、次に、画像
密度変換回路(8)において、出力側すなわちプリンタ
側の印字ドット密度に対応した画素密度に変換された
後、プリンタに送られる。第7図は、画像密度変換回路
(8)のブロック図であり、第8図は、その動作のタイ
ミングチャートである。この回路(8)は、主走査の画
素密度を変換するのに使用され、副走査方向において
は、光学系の走査速度を変化させる(おそくすれば、密
度は向上)ことで対応できる。いま、CCD(1)の読取
り画素密度を16本/mmとすれば、データ合成回路の出力
(DH)は、48本/mmの密度をもつことになる。このDHの
変化に同期したドット・クロックCK4より、画像密度変
換クロック発生回路(41)によりラッチ回路(42)にお
けるラッチクロックを発生させる。画像密度変換データ
信号は、通常、出力側の印字ドット密度に応じて設定さ
れる値で、いま、24本/mmとする。画像密度変換クロッ
ク発生回路(41)は、この画像密度変換データ信号によ
り指定された周期のクロック(RCK)を▲▼から
発生し、ANDゲート(42)に送る。画像密度変換指示信
号は、負論理の信号であり、この信号が“L"の時、画像
密度変換クロック発生回路(41)から出力されるクロッ
クRCKをラッチクロックとして、ANDゲート(42)とORゲ
ート(43)を介ししてラッチ回路(44)に送る。一方、
画像密度変換信号が“H"の時は、▲▼/3をラッチ
クロックとしてANDゲート(42)とORゲート(43)を介
してラッチ回路に送る。したがって、ラッチ回路(44)
は、画像密度変換指示信号が“L"の時には、出力側の印
字ドット数に応じて48本/mm以下の画素のデータを出力
し、“H"の時には、読取り画素密度の16本/mmのデータ
を出力する。
Next, the output data (DH) of the color operation circuit (7) is converted to a pixel density corresponding to the print dot density on the output side, that is, the printer side, by the image density conversion circuit (8), and then sent to the printer. . FIG. 7 is a block diagram of the image density conversion circuit (8), and FIG. 8 is a timing chart of the operation. This circuit (8) is used for converting the pixel density in the main scanning, and can be dealt with by changing the scanning speed of the optical system in the sub-scanning direction (the density is improved if the scanning is slowed down). Now, assuming that the reading pixel density of the CCD (1) is 16 lines / mm, the output (DH) of the data synthesizing circuit has a density of 48 lines / mm. The latch clock in the latch circuit (42) is generated by the image density conversion clock generation circuit (41) from the dot clock CK4 synchronized with the change of DH. The image density conversion data signal is normally set according to the print dot density on the output side, and is 24 lines / mm. The image density conversion clock generation circuit (41) generates a clock (RCK) having a cycle designated by the image density conversion data signal from ▼ and sends it to the AND gate (42). The image density conversion instruction signal is a signal of negative logic, and when this signal is "L", the clock RCK output from the image density conversion clock generation circuit (41) is used as a latch clock to OR with the AND gate (42). The signal is sent to the latch circuit (44) via the gate (43). on the other hand,
When the image density conversion signal is "H", the signal is sent to the latch circuit via the AND gate (42) and the OR gate (43) using ▼ / 3 as a latch clock. Therefore, the latch circuit (44)
Outputs the pixel data of 48 lines / mm or less according to the number of print dots on the output side when the image density conversion instruction signal is “L” and 16 pixels / mm of the read pixel density when “H”. Output data.

なお、色演算処理回路としては、第9図に示す従来か
ら用いられてきた方式を用いてもよい。すなわち、色演
算回路(7)は、3個の乗算器(51,52,53)と1個の加
算器(57)で構成される。
As the color operation processing circuit, a conventionally used system shown in FIG. 9 may be used. That is, the color operation circuit (7) is composed of three multipliers (51, 52, 53) and one adder (57).

第10図は、この回路のタイミングチャートを示す。こ
の色演算処理回路において、R,G,B各データごとに乗算
器を置き、その結果をそれぞれラッチ回路(54,55,56)
によって同期をとる。そして、加算器(57)によって3
個のデータa・R,b・G,c・Bを並列に加算し、ラッチ回
路(58)で最初のラッチ回路(54,55,56)のラッチクロ
ックを反転したクロックで加算結果をラッチして印字デ
ータC,MまたはYを得る。ラッチ回路(58)のラッチの
タイミングチャートを間引くと変倍(電気的縮小)が可
能になる。3回の走査でC,M,Yのデータを得る。この回
路は、第3図に示す方式と比べると、かなり高価な乗算
器を3個も使用しているので高価である。
FIG. 10 shows a timing chart of this circuit. In this color operation processing circuit, a multiplier is provided for each of R, G, and B data, and the results are respectively latched (54, 55, 56)
Synchronize by. Then, 3 is added by the adder (57).
Data a, R, b, G, c and B are added in parallel, and the result of the addition is latched by a latch circuit (58) using a clock obtained by inverting the latch clock of the first latch circuit (54, 55, 56). To obtain print data C, M or Y. If the timing chart of the latch of the latch circuit (58) is thinned out, zooming (electrical reduction) becomes possible. C, M, and Y data are obtained by three scans. This circuit is more expensive than the scheme shown in FIG. 3 because it uses three rather expensive multipliers.

(発明の効果) 1次元カラーセンサの素子の密度を変更せずに読取密
度を3倍に増加できる。
(Effect of the Invention) The reading density can be tripled without changing the element density of the one-dimensional color sensor.

【図面の簡単な説明】[Brief description of the drawings]

第1図は、1次元カラーセンサの素子と印刷の画素との
対応を示す図である。 第2図は、カラー画像読取装置のブロック図である。 第3図は、色演算回路のブロック図である。 第4図は、色演算回路の一部の回路図である。 第5図は、乗算ブロックのタイミングチャートである。 第6図は、加算ブロックのタイミングチャートである。 第7図は、ラッチ合成回路の回路図である。 第8図は、ラッチ合成回路のタイミングチャートであ
る。 第9図は、色演算回路の変形実施例のブロック図であ
る。 第10図は、第9図の回路のタイミングチャートである。 Rn,Bn,Gn……1次元カラーセンサの画像データ、 Cn……シアンの印刷データ、 1……カラーCCDセンサ、 7……色演算回路。
FIG. 1 is a diagram showing the correspondence between elements of a one-dimensional color sensor and printing pixels. FIG. 2 is a block diagram of the color image reading apparatus. FIG. 3 is a block diagram of a color operation circuit. FIG. 4 is a circuit diagram of a part of the color operation circuit. FIG. 5 is a timing chart of the multiplication block. FIG. 6 is a timing chart of the addition block. FIG. 7 is a circuit diagram of the latch synthesis circuit. FIG. 8 is a timing chart of the latch synthesis circuit. FIG. 9 is a block diagram of a modified embodiment of the color operation circuit. FIG. 10 is a timing chart of the circuit of FIG. R n , B n , G n ... Image data of one-dimensional color sensor, C n ... Print data of cyan, 1... Color CCD sensor, 7.

Claims (2)

(57)【特許請求の範囲】(57) [Claims] 【請求項1】3色をそれぞれ検出する3種の素子の組を
所定の順序配列し、かつ、複数組の素子を1次元に配列
した1次元カラーセンサを用いてカラー画素を検出する
検出手段と、この1次元カラーセンサにより検出された
1組の3色の画像データを印刷用の1画素の3色の印刷
データに1次変換する色演算処理装置とからなるカラー
画像読取方式において、 色演算処理装置において、1画素の印刷データに変換す
べき画像データを検出する3色の素子の組Si(i=1,2,
…)として1次元カラーセンサを構成する複数の素子Cj
(j=0,1,…)から(Cj,Cj+1,Cj+2)の組Pj(j=0,1,
…)を用いて、各Cj,Cj+1,Cj+2ごとに印字に必要な印刷
データを、入力されたカラーデータの搬送速度より高速
に演算し、順序出力することを特徴とするカラー画像読
取方式。
1. A detecting means for detecting a color pixel using a one-dimensional color sensor in which a set of three kinds of elements for detecting three colors is arranged in a predetermined order and a plurality of sets of elements are arranged one-dimensionally. And a color operation processing device that performs a primary conversion of a set of three-color image data detected by the one-dimensional color sensor into three-color print data of one pixel for printing. In the arithmetic processing unit, a set S i (i = 1,2,2,3) of three color elements for detecting image data to be converted into print data of one pixel.
..) As a plurality of elements C j constituting a one-dimensional color sensor
(J = 0,1,...) To (C j , C j + 1 , C j + 2 ) Pj (j = 0,1,
…)), Print data required for printing for each of C j , C j + 1 , C j + 2 is calculated at a speed higher than the transport speed of the input color data, and is sequentially output. Color image reading system.
【請求項2】特許請求の範囲第1項に記載されたカラー
画像読取方式において、 上記の色演算処理装置は、素子により検出された1組の
画像データ(R,G,B)を変換係数(r,g,b)を用いて印刷
データの1色Dに D=r・R+g・G+b・B の変換式により変換するために、 検出手段からシリアルに送られる画像データ(R,Gまた
はB)を対応する変換係数(r,gまたはb)と乗算する
乗算手段と、 乗算手段から送られる乗算値を順次加算する、乗算手段
に並列に接続される3個の加算手段と、 乗算手段からシリアルに乗算データが送られる際に、前
記の加算手段に、加算手段ごとに異なるタイミングで、
3個の乗算データごとに0を加算させ、その値をその前
の加算結果の代わりに乗算手段から送られてくる乗算値
に加算させる加算制御手段と、 加算手段により演算された印刷データを保持し、出力装
置に送る出力手段とからなることを特徴とするカラー画
像読取方式。
2. A color image reading system according to claim 1, wherein said color arithmetic processing device converts a set of image data (R, G, B) detected by the element into a conversion coefficient. The image data (R, G, or B) serially sent from the detection means to convert the print data into one color D by using (r, g, b) according to the conversion formula of D = r, R, g, G, b, B ) Is multiplied by the corresponding transform coefficient (r, g or b); three adding means connected in parallel to the multiplying means for sequentially adding the multiplied values sent from the multiplying means; When the multiplication data is sent serially, the adding means is provided with different timing for each adding means,
Addition control means for adding 0 to each of the three multiplication data and adding the value to the multiplication value sent from the multiplication means instead of the previous addition result, and holding the print data calculated by the addition means And an output means for sending the image to an output device.
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