JP2591411B2 - Optical disk sector mark detection device - Google Patents

Optical disk sector mark detection device

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JP2591411B2
JP2591411B2 JP30259992A JP30259992A JP2591411B2 JP 2591411 B2 JP2591411 B2 JP 2591411B2 JP 30259992 A JP30259992 A JP 30259992A JP 30259992 A JP30259992 A JP 30259992A JP 2591411 B2 JP2591411 B2 JP 2591411B2
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Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【産業上の利用分野】本発明は、光ディスクに記録され
ているセクタマークを検出する光ディスクのセクタマー
ク検出装置に関する。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to an optical disk sector mark detecting apparatus for detecting sector marks recorded on an optical disk.

【0002】[0002]

【従来の技術】従来、記録再生可能な光ディスク等の記
録媒体では、トラック上のアドレスを示すアドレス情報
が、該トラック上にセクタと呼ばれる所定間隔で所定長
さに形成される領域に記録される。そして、このセクタ
の先頭にはセクタマークが付され、該セクタマークを検
出することで、所望のセクタの立ち上げが行われるもの
である。
2. Description of the Related Art Conventionally, in a recording medium such as an optical disk capable of recording and reproduction, address information indicating an address on a track is recorded in an area formed on a track at a predetermined interval called a sector at a predetermined interval. . A sector mark is attached to the head of this sector, and a desired sector is started by detecting the sector mark.

【0003】そこで、図5に、従来のセクタマーク検出
回路を説明するための図を示す。
FIG. 5 is a diagram for explaining a conventional sector mark detection circuit.

【0004】図5(A)において、入力信号(IN)に
おける所定数の各パターンの信号がパターン検出器1
1,12によりそれぞれ検出され、それぞれの検出信号
が遅延回路13,14に入力される。遅延回路13,1
4では、設定された時間後にしきい値回路15に遅延信
号を出力する。このしきい値回路15は、遅延回路1
3,14からの遅延信号とパターン検出器11からの信
号の一致数がしきい値を越えたときに、セクタマークを
検出した旨の信号を出力するものである。
In FIG. 5A, a predetermined number of signals of each pattern in an input signal (IN) are applied to a pattern detector 1.
1 and 12 respectively, and respective detection signals are input to delay circuits 13 and 14. Delay circuit 13, 1
In 4, the delay signal is output to the threshold circuit 15 after a set time. The threshold circuit 15 is a delay circuit 1
When the number of coincidences between the delay signals from the patterns 3 and 14 and the signal from the pattern detector 11 exceeds a threshold value, a signal indicating that a sector mark has been detected is output.

【0005】また、図5(B)のセクタマーク検出回路
は、図5(A)の遅延回路等を簡略化したもので、入力
信号(IN)を一旦シフトレジスタ16に入力し、十分
な分解能が得られるクロックCLKでサンプリングして
その出力信号aをマッチング回路17に並列出力する。
マッチング回路17ではそれぞれのサンプリング値と予
め設定したパターンとマッチングを行い、その結果の信
号b1 〜b5 をしきい値回路18に出力する。そして、
しきい値回路18では、信号b1 〜b5 の一致した信号
の多数決がしきい値以上のときに、セクタマークを検出
した旨の信号を出力するものである。
The sector mark detection circuit shown in FIG. 5B is a simplified version of the delay circuit shown in FIG. 5A and the like. Is sampled with the clock CLK obtained, and the output signal a is output to the matching circuit 17 in parallel.
The matching circuit 17 matches each sampling value with a preset pattern and outputs the resulting signals b 1 to b 5 to the threshold circuit 18. And
The threshold circuit 18 outputs a signal indicating that a sector mark has been detected when the majority of the signals that match the signals b 1 to b 5 is equal to or greater than the threshold.

【0006】[0006]

【発明が解決しようとする課題】しかし、光ディスク上
の各ゾーンによって記録再生の基準クロックが異なり外
周ほど周波数が高くなるMCAV(Modified Constant
Angular Velocity) 方式で記録されたセクタのセクタマ
ークを、図5(A),(B)に示すセクタマーク検出回
路により検出するにあたり、データレート不明の未知の
ゾーンのセクタマークを同一周波数でサンプリングして
検出すると、図5(A)ではゾーン数のマッチングパタ
ーンと各遅延回路の遅延量を具備する必要があり、図5
(B)では各セクタマークに対応するマッチング値をゾ
ーン数具備する必要がある。
However, the reference clock for recording / reproduction differs depending on each zone on the optical disk, and the MCAV (Modified Constant) whose frequency becomes higher toward the outer periphery.
When detecting the sector mark of the sector recorded by the (Angular Velocity) method by the sector mark detection circuit shown in FIGS. 5A and 5B, the sector mark of the unknown zone whose data rate is unknown is sampled at the same frequency. 5A, it is necessary to provide a matching pattern of the number of zones and the delay amount of each delay circuit in FIG.
In (B), it is necessary to provide a matching value corresponding to each sector mark in the number of zones.

【0007】そのため、回路が複雑になると共に、何れ
かのゾーンであるかをマッチング値で判別するために
は、サンプリング周波数を非常に高くしなければならな
いという問題がある。
Therefore, there is a problem that the circuit becomes complicated and that the sampling frequency must be extremely high in order to determine which zone the zone is based on a matching value.

【0008】そこで、本発明は上記課題に鑑みなされた
もので、簡易かつ低周波数による高分解能なセクタマー
ク検出を行う光ディスクのセクタマーク検出装置を提供
することを目的とする。
SUMMARY OF THE INVENTION The present invention has been made in consideration of the above problems, and has as its object to provide an optical disk sector mark detecting apparatus that can easily detect a high-resolution sector mark at a low frequency.

【0009】[0009]

【課題を解決するための手段】上課題は、所定の記録フ
ォーマットにより所定数のセクタの配置がされた光ディ
スクにおける所定のセクタにシークするにあたり、該セ
クタに付されるセクタマークを検出する光ディスクのセ
クタマーク検出装置において、前記光ディスクから読み
取られたパルス信号間のタイミング信号を順次生成し、
該タイミング信号から所定間隔で所定数のゲート信号を
生成するゲート信号生成部と、該タイミング信号より前
記セクタマークのマーク長データを生成するマーク長生
成部と、各該ゲート信号の幅を所定周波数で計数する計
数部と、該計数値と適宜変更されて設定されるマッチデ
ータとのマッチングを行うマッチング部と、該マッチン
グの結果及び前記セクタマークのマーク長のデータより
該セクタマークの判別を行う判定部と、で構成されるこ
とにより解決される。
An object of the present invention is to seek for a predetermined sector on an optical disk on which a predetermined number of sectors are arranged according to a predetermined recording format, and to detect a sector mark attached to the sector. In the sector mark detection device, sequentially generates a timing signal between pulse signals read from the optical disk,
A gate signal generation unit that generates a predetermined number of gate signals at predetermined intervals from the timing signal; a mark length generation unit that generates mark length data of the sector mark from the timing signal; And a matching unit that matches the count value with match data that is appropriately changed and set, and determines the sector mark based on the result of the matching and the mark length data of the sector mark. And a determination unit.

【0010】[0010]

【作用】上述のように、光ディスクから読み取られたパ
ルス信号より生成したタイミング信号より、さらにゲー
ト信号を生成し、このゲート信号の幅をそれぞれ所定周
波数で計数して適宜変更されて設定されるマッチデータ
とのマッチングを行う。このマッチング値とセクタマー
クのマーク長データより異なるビットレートのセクタマ
ークを排除して当該セクタマークを判別して検出するも
のである。
As described above, a gate signal is further generated from the timing signal generated from the pulse signal read from the optical disk, and the width of the gate signal is counted at a predetermined frequency, and a match is set by appropriately changing the width. Perform matching with data. A sector mark having a bit rate different from the matching value and the mark length data of the sector mark is excluded, and the sector mark is determined and detected.

【0011】これにより、光ディスクがMCAV方式の
記録フォーマットであっても、マッチデータはゲート信
号の幅における計数値の簡易なパターンで適宜変更して
設定すればよく、また、サンプリング周波数は当該光デ
ィスクのビットレートの2倍のクロック周波数で十分で
ある。
Thus, even if the optical disk has a recording format of the MCAV system, the match data may be set by appropriately changing the simple pattern of the count value in the width of the gate signal, and the sampling frequency of the optical disk is set. A clock frequency twice the bit rate is sufficient.

【0012】すなわち、簡易かつ低周波数による高分解
能なセクタマーク検出を行うことが可能になるものであ
る。
That is, it is possible to easily detect a high-resolution sector mark at a low frequency.

【0013】[0013]

【実施例】図1に、本発明の一実施例の構成図を示す。
図1においてセクタマーク検出装置21では、対象とな
る記録媒体がMCAV方式の光ディスクであって、複数
ゾーンにセクタマークが付されたセクタの数を異ならせ
て記録されているものである。
FIG. 1 is a block diagram showing an embodiment of the present invention.
In FIG. 1, in the sector mark detection device 21, the target recording medium is an MCAV optical disk, which is recorded with different numbers of sectors having sector marks in a plurality of zones.

【0014】図1のセクタマーク検出装置21は、ゲー
ト信号生成部を構成するリングカウンタ22及びゲート
信号発生回路23と、マーク長生成部であるマーク長生
成回路24と、計数部であるカウンタ回路25と、マッ
チング部を構成するパターンマッチング回路26及びマ
ッチデータ生成回路27と、判定部である判定回路28
とにより構成される。
1 includes a ring counter 22 and a gate signal generation circuit 23 constituting a gate signal generation section, a mark length generation circuit 24 as a mark length generation section, and a counter circuit as a counting section. 25, a pattern matching circuit 26 and a match data generation circuit 27 that constitute a matching unit, and a determination circuit 28 that is a determination unit
It is composed of

【0015】ここで、マーク長生成回路24は、入力信
号IN及びリングカウンタ22からの出力をクロックC
LKによりサンプリングしてセクタマーク全体の長さの
マーク長データを生成して判定回路28に出力する。カ
ウンタ回路25はクロックCLKにより、ゲート信号発
生回路23からの出力信号をサンプリングする。また、
マッチデータ生成回路27は各ゾーンごとにセクタマー
クに対応する計数パターンのマッチデータを生成してパ
ターンマッチング回路26に出力するものである。
Here, the mark length generation circuit 24 outputs the input signal IN and the output from the ring counter 22 to a clock C.
The data is sampled by the LK to generate mark length data of the entire length of the sector mark and output to the determination circuit. The counter circuit 25 samples the output signal from the gate signal generation circuit 23 according to the clock CLK. Also,
The match data generation circuit 27 generates match data of a count pattern corresponding to a sector mark for each zone, and outputs it to the pattern matching circuit 26.

【0016】そこで、図2に、図1の動作タイムチャー
トを示す。まず、光ディスクより読み取られた入力信号
(パルス信号)INがリングカウンタ22により例えば
6進でパルス信号間のタイミング信号を順次生成し、ゲ
ート信号発生回路23で、ゲート信号a,bを含む所定
数のゲート信号が生成される。
FIG. 2 shows an operation time chart of FIG. First, the input signal (pulse signal) IN read from the optical disk is sequentially generated, for example, in hexadecimal, by a ring counter 22 in timing signals between pulse signals. Is generated.

【0017】ゲート信号は、セクタマーク信号の特徴で
あるマーク長全体又はそれに近い区間における信号であ
り、入力信号INの立ち上り間で生成される。例えば、
ゲート信号aは6つ(6進)のパルス間の信号(75チ
ャンネルビット)であり、ゲート信号bは3つのパルス
間の信号として生成される。
The gate signal is a signal in the entire mark length or a section close to the mark length, which is a characteristic of the sector mark signal, and is generated between rising edges of the input signal IN. For example,
The gate signal a is a signal (75 channel bits) between six (hex) pulses, and the gate signal b is generated as a signal between three pulses.

【0018】一方、入力信号IN及び6進のタイミング
信号が、マーク長生成回路24によりクロックCLKで
マーク長が検出され、マーク長データcとして判定回路
28に出力される。このマーク長データcは、判定回路
28において、ビットデータの異なるセクタマークを排
除するためのデータである。
On the other hand, the mark length of the input signal IN and the hexadecimal timing signal are detected by the mark length generation circuit 24 using the clock CLK, and are output to the determination circuit 28 as mark length data c. The mark length data c is data for eliminating a sector mark having different bit data in the determination circuit 28.

【0019】また、ゲート信号a,bはカウンタ回路2
5において、一定周波数(必要にしてかつ十分なクロッ
クの周波数)のクロックCLKにより開区間が計数さ
れ、その計数値がパターンマッチング回路26で、マッ
チデータ生成回路27で設定された計数パターンのマッ
チデータとによりマッチングがされる。そして、そのマ
ッチング値d,eが判定回路28に出力される。
The gate signals a and b are supplied to the counter circuit 2
In 5, the open section is counted by a clock CLK having a constant frequency (necessary and sufficient clock frequency), and the counted value is used by a pattern matching circuit 26 to match data of a count pattern set by a match data generating circuit 27. Are matched by. Then, the matching values d and e are output to the determination circuit 28.

【0020】判定回路28では、マッチング値d,eの
データがセクタマークのデータであり、かつマーク長デ
ータcにおけるビットレートが一致したときに、セクタ
マーク検出信号fを出力するものである。
The determination circuit 28 outputs a sector mark detection signal f when the data of the matching values d and e are sector mark data and the bit rates of the mark length data c match.

【0021】これにより、MCAV方式における光ディ
スクの最低2倍のクロック周波数で、2倍のビットレー
トのゾーンを2%以下の分解能でセクタマークを検出す
ることができるものである。
This makes it possible to detect a sector mark in a zone having a double bit rate with a resolution of 2% or less at least twice the clock frequency of the optical disc in the MCAV system.

【0022】次に、図3に、本発明の一適用例の回路図
を示す。図3のセクタマーク検出回路21において、入
力信号IN(6進ではIN1 〜IN6 の繰り返しとす
る)に基づいて6進のリングカウンタ22がタイミング
信号T1 〜T6 を生成し、このタイミング信号T1 〜T
6 をゲート信号発生回路23及びマーク長生成回路24
に出力する。ここでは、タイミング信号T1 ,T3 ,T
6 がゲート信号発生回路23のゲート回路231 に入力
され、以下順次タイミング信号T2 ,T4 ,T1がゲー
ト回路232 に、タイミング信号T3 ,T5 ,T2 がゲ
ート回路233 に、タイミング信号T4 ,T6 ,T3
ゲート回路234 に、タイミング信号T5,T1 ,T4
がゲート回路235 に、タイミング信号T6 ,T2 ,T
5 がゲート回路236 にそれぞれ入力される。なお、セ
クタマークの弁別ができる特徴的な箇所であれば、ゲー
ト本数やゲート位置は何れでもよい。
Next, FIG. 3 shows a circuit diagram of one application example of the present invention. In the sector mark detection circuit 21 shown in FIG. 3, a hexadecimal ring counter 22 generates timing signals T 1 to T 6 based on an input signal IN (in hexadecimal, IN 1 to IN 6 are repeated). Signals T 1 to T
6 to the gate signal generation circuit 23 and the mark length generation circuit 24
Output to Here, the timing signals T 1 , T 3 , T
6 is input to the gate circuit 23 1 of the gate signal generating circuit 23, the following sequence timing signals T 2, T 4, T 1 is the gate circuit 23 2, the timing signal T 3, T 5, T 2 gate circuit 23 3 to, the timing signal T 4, T 6, T 3 is a gate circuit 23 4, the timing signal T 5, T 1, T 4
In but the gate circuit 23 5, a timing signal T 6, T 2, T
5 are input to the gate circuit 23 6. Note that the number of gates and the gate positions may be any as long as they are characteristic places where sector marks can be discriminated.

【0023】ゲート回路231 から出力されるゲート信
号G1 ,G2 はカウンタ回路25のカウンタ251 に入
力され、以下ゲート回路232 〜236 からのゲート信
号G 3 〜G12がカウンタ252 〜256 にそれぞれ2信
号ずつ入力される。また、カウンタ251 〜256 には
クロック(最低ビットレートの2倍のクロック周波数)
CLKが入力される。
Gate circuit 231Gate signal output from
No.G1, GTwoIs the counter 25 of the counter circuit 251Enter
The gate circuit 23Two~ 236Gate letter from
No.G Three~ G12Is counter 25Two~ 256Two letters each
Are entered one by one. Also, the counter 251~ 256To
Clock (clock frequency twice the minimum bit rate)
CLK is input.

【0024】各カウンタ251 〜256 から出力される
計数値の信号は、それぞれ、パターンマッチング回路2
6の比較器261 〜266 に入力される。また、マッチ
ング器261 〜266 にはマッチデータ生成回路27で
適宜変更されたマッチデータ信号(計数値信号に対応)
が入力される。このマッチデータ生成回路27は、MC
AV方式の光ディスク等のために、自由にマッチングデ
ータを変更するものである。
The signal of the count value output from the counter 25 to 253 6, respectively, the pattern matching circuit 2
6 comparators 26 1 to 26 6 . Further, appropriately modified match data signals in the match data generating circuit 27 to the matching device 26 1 to 26 6 (corresponding to the count value signal)
Is entered. This match data generation circuit 27
The matching data is freely changed for an AV type optical disk or the like.

【0025】各マッチング器261 〜266 から出力さ
れるマッチング値の信号M1 〜M12は判定回路28のア
ンドゲート回路281 〜286 にそれぞれ入力される。
また、アンドゲート回路281 〜286 の入力端にはマ
ーク長生成回路24において入力信号IN及びタイミン
グ信号T1 〜T6 をクロックCLKでサンプリングして
生成されたマーク長データの信号E1 〜E6 がそれぞれ
入力される。
The signals M 1 ~M 12 matching values outputted from the matcher 26 1-26 6 are input to the AND gate circuits 28 1 to 28 6 of the decision circuit 28.
Further, the AND gate circuit 28 1 to 28 6 the input signal IN and the timing signal T 1 through T 6 the signals E 1 ~ mark length data generated by sampling the clock CLK to the input terminal in the mark length generating circuit 24 of E 6 are respectively input.

【0026】各アンドゲート回路281 〜286 からの
出力は、判定回路28におけるオアゲート回路288
入力され、該オアゲート回路288 よりセクタマーク検
出信号fが出力される。
The output from the AND gate circuit 28 1 to 28 6 is input to the OR gate circuit 28 8 in the judging circuit 28, the sector mark detection signal f from the gate circuit 28 8 is output.

【0027】そこで、図4に、図3の動作タイムチャー
トを示す。図4では、判定回路28のアンドゲート回路
283 でセクタマークが検出されるものとして説明す
る。
FIG. 4 shows an operation time chart of FIG. In Figure 4, the sector mark at the AND gate circuit 28 3 of the decision circuit 28 is described as being detected.

【0028】図4において、まず、光ディスクからの入
力信号INがクロックとして6進のリングカウンタ22
に入力されると、1クロックずつ位相のずれた全位相の
タイミングでタイミング信号T1 〜T6 が出力される。
このタイミング信号T1 〜T 6 をゲート信号発生回路2
3でゲート信号G1 〜G12を発生させる。
In FIG. 4, first, input from an optical disc is performed.
Hexadecimal ring counter 22 using force signal IN as a clock
When the clock is input to
Timing signal T1~ T6Is output.
This timing signal T1~ T 6To the gate signal generation circuit 2
3 for gate signal G1~ G12Generate.

【0029】ここで、ゲート回路233 ではタイミング
信号T3 ,T5 ,T2 を用いてゲート信号G5 ,G6
発生させる。ゲート信号G5 は、タイミング信号T3
立ち上りで立ち上り、次のタイミング信号T2 の立ち上
りで立ち下る。また、ゲート信号G6 は、タイミング信
号T3 の立ち上りで立ち上り、タイミング信号T5 の立
ち上りで立ち下る。
[0029] Here, the gate circuit 23 3, the timing signal T 3, T 5, with T 2 generates the gate signals G 5, G 6. Gate signal G 5 is rising at a rising timing signal T 3, down falling at the next rising timing signal T 2. Further, the gate signal G 6 is rising at a rising timing signal T 3, down standing in the rise of the timing signal T 5.

【0030】これらゲート信号T1 〜T6 のゲート開の
区間をカウンタ回路25においてクロックCLKでカウ
ントしたカウント値が、パターンマッチング回路26で
マッチデータ生成回路27で生成されたマッチデータの
値と一致すれば、マッチング信号M1 〜M12としてマッ
チング出力する。マッチング器263 においてマッチン
グしていれば、マッチング信号M5 ,M6 は、次段のタ
イミング信号T2 の段階でハイ状態となる。
The count value obtained by counting the section of the gate signals T 1 to T 6 in which the gates are open by the clock CLK in the counter circuit 25 matches the value of the match data generated by the match data generation circuit 27 by the pattern matching circuit 26. if, matching output as the matching signal M 1 ~M 12. If matching in the matching unit 26 3, matching signal M 5, M 6 is at the high state at the next stage of the timing signal T 2.

【0031】一方、マーク長生成回路24では、入力信
号IN(IN1 〜)が入力信号IN 1 のパルス幅Tを基
準とする場合、3T以上のハイ状態のパルス信号を2個
以上検出したタイミングでマーク長データE1 〜E6
出力する。なお、このしきい値はMCAV方式データレ
ートのダイナミックレンジによって自由に設定される。
この場合、入力信号IN4 でマーク長データE3 が立ち
上り、次段の入力信号IN2 の立ち下りで立ち下る。
On the other hand, in the mark length generation circuit 24, the input signal
No. IN (IN1~) Is the input signal IN 1Based on the pulse width T of
In case of standard, two high-level pulse signals of 3T or more
At the timing detected above, the mark length data E1~ E6To
Output. Note that this threshold is the data
It can be set freely according to the dynamic range of the port.
In this case, the input signal INFourAnd mark length data EThreeStanding
Up, next stage input signal INTwoFall at the fall.

【0032】従って、判定回路28では、マッチング信
号M1 〜M12とマーク長データE1〜E6 とが共にハイ
状態のときにオアゲート回路288 よりセクタマーク検
出信号D1 が出力される。この場合、アンドゲート回路
283 のみの出力がハイ状態となり、他のアンドゲート
回路の出力がロー状態となる。すなわち、マッチング信
号M1 〜M12とマーク長データE1 〜E6 の総ての条件
が揃えば、入力信号のどの位相でも検出出力がなされる
ものである。
[0032] Therefore, the decision circuit 28, the sector mark detection signal D 1 is outputted from the matching signal M 1 ~M 12 and the mark length data E 1 to E 6 and the OR gate circuit 28 8 at the high state together. In this case, the output of only the AND gate circuit 28 3 is at a high state, the output of the other AND gate is low. That is, if all the conditions of the matching signals M 1 to M 12 and the mark length data E 1 to E 6 are aligned, the detection output is made at any phase of the input signal.

【0033】このように、例えば、1トラック当りのセ
クタ数が25〜48のMCAV方式の光ディスクに適用
した場合、25セクタ/トラックのデータレート14.
5MHz/3000rpmの2倍のクロック29MHz
にて全ゾーンのセクタマーク検出とマッチングデータに
よるゾーン弁別が可能となる。すなわち、MCAV方式
の光ディスクの最低ビットレートの2倍のクロック周波
数で、2倍のビットレートのゾーンを2%以下の分解能
で検出することができるものである。
Thus, for example, when the present invention is applied to an MCAV optical disk having 25 to 48 sectors per track, a data rate of 25 sectors / track is used.
5MHz / 3000rpm double clock 29MHz
, It becomes possible to detect sector marks of all zones and discriminate zones by matching data. That is, a zone having a double bit rate can be detected with a resolution of 2% or less at a clock frequency twice the minimum bit rate of the MCAV optical disk.

【0034】なお、上記実施例では、MCAV方式の光
ディスクについて説明したが、MCLV(Modified Con
stant Linear Velocity)方式等の光ディスクにおいても
適用することができるものである。
In the above embodiment, the optical disk of the MCAV system has been described.
The present invention can be applied to an optical disk of a stant linear velocity (Stant Linear Velocity) method or the like.

【0035】[0035]

【発明の効果】以上のように本発明によれば、光ディス
クからの入力信号より生成したゲート信号の幅を所定周
波数で計数し、この計数値とマッチデータとのマッチン
グを行ってセクタマークの判別を行うことにより、簡易
かつ低周波数による高分解能なセクタマーク検出を行う
ことができるものである。
As described above, according to the present invention, the width of the gate signal generated from the input signal from the optical disk is counted at a predetermined frequency, and the counted value is matched with the match data to determine the sector mark. , Simple and high-resolution sector mark detection at a low frequency can be performed.

【図面の簡単な説明】[Brief description of the drawings]

【図1】本発明の一実施例の構成図である。FIG. 1 is a configuration diagram of an embodiment of the present invention.

【図2】図1の動作タイムチャートである。FIG. 2 is an operation time chart of FIG.

【図3】本発明の一適用例の回路図である。FIG. 3 is a circuit diagram of one application example of the present invention.

【図4】図3の動作タイムチャートである。FIG. 4 is an operation time chart of FIG. 3;

【図5】従来のセクタマーク検出回路を説明するための
図である。
FIG. 5 is a diagram for explaining a conventional sector mark detection circuit.

【符号の説明】[Explanation of symbols]

21 セクタマーク検出装置 22 リングカウンタ 23 ゲート信号発生回路 24 マーク長生成回路 25 カウンタ回路 26 パターンマッチング回路 27 マッチデータ生成回路 28 判定回路 Reference Signs List 21 Sector mark detection device 22 Ring counter 23 Gate signal generation circuit 24 Mark length generation circuit 25 Counter circuit 26 Pattern matching circuit 27 Match data generation circuit 28 Judgment circuit

Claims (1)

(57)【特許請求の範囲】(57) [Claims] 【請求項1】 所定の記録フォーマットにより所定数の
セクタの配置がされた光ディスクにおける所定のセクタ
にシークするにあたり、該セクタに付されるセクタマー
クを検出する光ディスクのセクタマーク検出装置におい
て、 前記光ディスクから読み取られたパルス信号間のタイミ
ング信号を順次生成し、該タイミング信号から所定間隔
で所定数のゲート信号を生成するゲート信号生成部と、 該タイミング信号より前記セクタマークのマーク長デー
タを生成するマーク長生成部と、 各該ゲート信号の幅を所定周波数で計数する計数部と、 該計数値と適宜変更されて設定されるマッチデータとの
マッチングを行うマッチング部と、 該マッチングの結果及び前記セクタマークのマーク長の
データより該セクタマークの判別を行う判定部と、 を有することを特徴とする光ディスクのセクタマーク検
出装置。
1. An apparatus for detecting a sector mark attached to a predetermined sector on an optical disk on which a predetermined number of sectors are arranged according to a predetermined recording format, wherein the sector mark is detected. A gate signal generator for sequentially generating a timing signal between pulse signals read from the memory, and generating a predetermined number of gate signals at predetermined intervals from the timing signal; and generating mark length data of the sector mark from the timing signal. A mark length generation unit, a counting unit that counts the width of each of the gate signals at a predetermined frequency, a matching unit that matches the count value with match data that is appropriately changed and set, and a result of the matching and the matching A determination unit for determining the sector mark from the data of the mark length of the sector mark; An optical disk sector mark detection device, comprising:
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