JP2021166609A5 - - Google Patents
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Description
ところで、この種の遊技機では、各種の演出を複雑化かつ豊富化したいところ、特に、液晶ディスプレイを使用する画像演出については、その要請が高い。そこで、出願人は、各種の提案をしているが（引用文献１～引用文献４）、画像演出の更なる高度化や、画像演出制御を中心とした各種の演出制御動作の更なる改善が望まれるところである。 By the way, in this type of game machine, there is a desire to make various effects complicated and rich, and in particular, there is a high demand for image effects using a liquid crystal display. Therefore, the applicant has made various proposals (cited documents 1 to 4), but further enhancement of image effects and further improvement of various effect control operations centering on image effect control are needed. This is desired.
上記の目的を達成するため、本発明は、表示装置に表示すべき表示内容を特定するディスプレイリストを発行する画像制御手段と、前記ディスプレイリストに基づく所定の画像データを、所定のＲＷメモリに完成させる画像生成手段と、前記画像データの基礎データとなる各種の圧縮データを記憶するＣＧメモリと、を有して構成され、前記ＲＷメモリには、所定ビット位置以下の下位ビットが０となる基点アドレスに基づいて、動画用の圧縮データを展開する展開空間が確保されている。 In order to achieve the above object, the present invention provides image control means for issuing a display list specifying display contents to be displayed on a display device , and predetermined image data based on the display list to be completed in a predetermined RW memory. and a CG memory for storing various compressed data as basic data of the image data . An expansion space is reserved for expanding the compressed data for moving images based on the address .
上記した本発明によれば、画像制御動作が改善される。 According to the invention described above, the image control operation is improved.
Claims (1)
前記ディスプレイリストに基づく所定の画像データを、所定のＲＷメモリに完成させる画像生成手段と、
前記画像データの基礎データとなる各種の圧縮データを記憶するＣＧメモリと、を有して構成され、
前記ＲＷメモリには、所定ビット位置以下の下位ビットが０となる基点アドレスに基づいて、動画用の圧縮データを展開する展開空間が確保されている遊技機。 image control means for issuing a display list specifying display contents to be displayed on a display device;
image generation means for completing predetermined image data based on the display list in a predetermined RW memory ;
a CG memory for storing various compressed data as basic data of the image data;
In the game machine, a development space for developing compressed data for moving images is secured in the RW memory based on a base address in which lower bits below a predetermined bit position are 0.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2020070875A JP2021166609A (en) | 2020-04-10 | 2020-04-10 | Game machine |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2020070875A JP2021166609A (en) | 2020-04-10 | 2020-04-10 | Game machine |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2021166609A JP2021166609A (en) | 2021-10-21 |
| JP2021166609A5 true JP2021166609A5 (en) | 2023-04-17 |
Family
ID=78079337
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2020070875A Pending JP2021166609A (en) | 2020-04-10 | 2020-04-10 | Game machine |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2021166609A (en) |
-
2020
- 2020-04-10 JP JP2020070875A patent/JP2021166609A/en active Pending
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