JP2014099970A - Power factor improvement circuit - Google Patents
Power factor improvement circuit Download PDFInfo
- Publication number
- JP2014099970A JP2014099970A JP2012249722A JP2012249722A JP2014099970A JP 2014099970 A JP2014099970 A JP 2014099970A JP 2012249722 A JP2012249722 A JP 2012249722A JP 2012249722 A JP2012249722 A JP 2012249722A JP 2014099970 A JP2014099970 A JP 2014099970A
- Authority
- JP
- Japan
- Prior art keywords
- power factor
- voltage
- factor correction
- phase compensation
- correction circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Withdrawn
Links
Images
Classifications
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02P—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN THE PRODUCTION OR PROCESSING OF GOODS
- Y02P80/00—Climate change mitigation technologies for sector-wide applications
- Y02P80/10—Efficient use of energy, e.g. using compressed air or pressurized fluid as energy carrier
Landscapes
- Rectifiers (AREA)
- Dc-Dc Converters (AREA)
Abstract
Description
本発明は、負荷急変時でも出力電圧の脈動を低減させる昇圧型力率改善回路等に関する。 The present invention relates to a boost type power factor correction circuit that reduces pulsation of an output voltage even when a load suddenly changes.
下記特許文献1には、スイッチング電源装置の制御回路に関する発明であって、交流入力の電圧と電流の整流波形を比較増幅する第1の増幅器、第1の増幅器の出力を三角波形と比較して第1のPWM信号に変換する第1のコンパレータ、DC/DCコンバーターの出力電圧を基準電圧と比較増幅する第2の増幅器、第2の増幅器の出力を第1のPWM信号でチョッピングするスイッチ素子、及び、そのチョッピング出力の平滑出力と三角波形を比較して第2のPWM信号に変換する第2のコンパレータを設け、第2のPWM信号により、前記DC/DCコンバーターを制御するスイッチング電源装置の制御回路が記載されている。 The following Patent Document 1 is an invention relating to a control circuit for a switching power supply apparatus, which compares a voltage of an AC input and a rectified waveform of a current with a first amplifier, and compares the output of the first amplifier with a triangular waveform. A first comparator for converting to a first PWM signal, a second amplifier for comparing and amplifying the output voltage of the DC / DC converter with a reference voltage, a switch element for chopping the output of the second amplifier with the first PWM signal, And a second comparator for comparing the smoothed output of the chopping output with the triangular waveform and converting it to a second PWM signal, and controlling the DC / DC converter by the second PWM signal. A circuit is described.
さらに具体的には、図12に示すように、コンパレータM5、スイッチ素子Q2、ダイオードD2、抵抗R6,R7、コンデンサC3で構成される掛算回路を備える回路構成とすることが提案されている。図12は、従来のスイッチング電源装置の制御回路を説明する図である。 More specifically, as shown in FIG. 12, it is proposed to have a circuit configuration including a multiplication circuit including a comparator M5, a switching element Q2, a diode D2, resistors R6 and R7, and a capacitor C3. FIG. 12 is a diagram for explaining a control circuit of a conventional switching power supply device.
また、整流器RF1の出力電圧のR1とR2分圧値と入力電流検出電流の全波整流後の電圧変換値の差分を増幅する第1の増幅器M1の出力VBが第1のコンパレータM5で三角波と比較され第1のPWM信号となりスイッチ素子Q2を駆動する。また、出力電圧のR4、R5の分圧値と基準電圧Vrの差分を増幅する第2の増幅器M2の出力VcはQ2でチョッピングされ、D2、C3、R7で平滑化される。また、その平滑出力は第2のコンパレータM3で三角波と比較され第2のPWM信号に変換され、スイッチング素子Q1を制御する技術思想が開示されている。 In addition, the output VB of the first amplifier M1 that amplifies the difference between the R1 and R2 divided values of the output voltage of the rectifier RF1 and the voltage conversion value after full-wave rectification of the input current detection current is converted into a triangular wave by the first comparator M5. The comparison results in a first PWM signal that drives the switch element Q2. The output Vc of the second amplifier M2 that amplifies the difference between the divided values of the output voltages R4 and R5 and the reference voltage Vr is chopped by Q2 and smoothed by D2, C3, and R7. Further, the technical idea is disclosed in which the smooth output is compared with a triangular wave by the second comparator M3 and converted into a second PWM signal to control the switching element Q1.
特許文献1の発明によれば、入力力率改善用のスイッチング電源装置の制御回路を安価な部品で、簡単な構成により実現できる為、コンピュータやその端末装置、通信機等に使用される高力率のスイッチング装置に適用して、その産業上の利用効果が極めて大なるものであることが示されている。 According to the invention of Patent Document 1, since the control circuit of the switching power supply device for improving the input power factor can be realized with a simple configuration with an inexpensive component, high power used for a computer, its terminal device, a communication device, etc. When applied to a rate switching device, its industrial utilization effect is shown to be extremely large.
昇圧型力率改善回路(PFC:Power Factor Correction)では、負荷急変時に、出力電圧に脈動が生じることがある。脈動した出力電圧は正常時の出力電圧よりも大きな電圧値を含むため、脈動した大きな電圧値が負荷や回路素子等に印加されて耐圧オーバー等により損傷が生じることが懸念される。 In the step-up power factor correction circuit (PFC), pulsation may occur in the output voltage when the load suddenly changes. Since the pulsating output voltage includes a voltage value larger than the normal output voltage, there is a concern that the pulsating large voltage value may be applied to a load, a circuit element, or the like and damage may occur due to overvoltage or the like.
本発明は、上述した問題点に鑑み為された発明であって、負荷急変時においても、電圧エラーアンプの応答速度を一時的に増大させることにより、ブースト回路の出力電圧の脈動を低減させる昇圧型力率改善回路等を実現することを目的とする。 The present invention has been made in view of the above-described problems, and is a booster that reduces the pulsation of the output voltage of the boost circuit by temporarily increasing the response speed of the voltage error amplifier even during a sudden load change. The purpose is to realize a mold power factor correction circuit.
本発明の昇圧型力率改善回路は、力率を改善する昇圧型力率改善回路であって、ブースト回路の出力電圧が所定の範囲外になった場合に、電圧エラーアンプの位相補償インピーダンスを増大させて電圧エラーアンプの応答速度を速くする位相補償部を備えることを特徴とする。 The boost type power factor correction circuit of the present invention is a boost type power factor correction circuit for improving the power factor, and when the output voltage of the boost circuit is out of a predetermined range, the phase compensation impedance of the voltage error amplifier is set. A phase compensator that increases the response speed of the voltage error amplifier by increasing the voltage error amplifier is provided.
また、本発明の昇圧型力率改善回路は、ブースト回路の出力電圧が所定の範囲外になった場合に、電圧エラーアンプの出力端子−マイナス端子間の負荷に並列に追加されたコンデンサの接続を解除し、電圧エラーアンプの応答速度を速くする位相補償部を備えることを特徴とする。 In addition, the boost type power factor correction circuit of the present invention connects a capacitor added in parallel to the load between the output terminal and the negative terminal of the voltage error amplifier when the output voltage of the boost circuit is out of a predetermined range. And a phase compensator for increasing the response speed of the voltage error amplifier.
負荷急変時においても、電圧エラーアンプの応答速度を一時的に増大させることにより、ブースト回路の出力電圧の脈動を低減させる昇圧型力率改善回路等を実現できる。 Even during a sudden load change, it is possible to realize a boost type power factor correction circuit that reduces the pulsation of the output voltage of the boost circuit by temporarily increasing the response speed of the voltage error amplifier.
本実施形態で説明する昇圧型力率改善回路は、負荷急変時において発生するブースト回路の出力電圧の変動(典型的にはオーバーシュート)を抑制する機能を有する位相補償部を備える。 The step-up power factor correction circuit described in the present embodiment includes a phase compensator having a function of suppressing fluctuation (typically overshoot) of the output voltage of the boost circuit that occurs during a sudden load change.
負荷急変時において発生する出力電圧の変動を検知すると、本実施形態の位相補償部は、電圧エラーアンプの位相補償インピーダンスを一時的に増大させることにより、時定数を一時的に低減させて、電圧エラーアンプの応答速度を一時的に増大させる。 When a change in the output voltage that occurs during a sudden load change is detected, the phase compensation unit of the present embodiment temporarily decreases the time constant by temporarily increasing the phase compensation impedance of the voltage error amplifier, thereby reducing the voltage. Temporarily increase the response speed of the error amplifier.
従って、負荷急変時において発生する出力電圧の変動は、電圧エラーアンプが有する応答速度が増大された出力電圧安定化作用により迅速に終息し、出力電圧の脈動やリップルに伴うオーバーシュート等が速やかに低減される昇圧型力率改善回路とできる。 Therefore, the fluctuation of the output voltage that occurs at the time of sudden change of load is quickly terminated by the output voltage stabilization action that the response speed of the voltage error amplifier is increased, and the overshoot accompanying the pulsation of the output voltage and the ripple etc. The boosted power factor correction circuit can be reduced.
昇圧型力率改善回路(PFC回路)の出力電圧には入力周波数の高調波を含まれることが知られており、特にACラインの通常周波数である50または60ヘルツの2倍の周波数である100または120ヘルツのリップルを多く含む。 It is known that the output voltage of the step-up power factor correction circuit (PFC circuit) includes harmonics of the input frequency, and in particular, the frequency is 100 times that of 50 or 60 hertz which is the normal frequency of the AC line. Or it contains a lot of ripples of 120 Hz.
電圧エラーアンプには当該出力電圧が分圧入力されるが、電圧エラーアンプの出力に上述した高調波のリップル成分が多く含まれると入力電流が歪むこととなり、力率の悪化を招来する。このため、電圧エラーアンプにおける100または120ヘルツのゲインを可能な限り低減させることが好ましい。 Although the output voltage is divided and input to the voltage error amplifier, if the output of the voltage error amplifier contains a large amount of the above-described harmonic ripple component, the input current will be distorted, leading to deterioration of the power factor. For this reason, it is preferable to reduce the gain of 100 or 120 hertz in the voltage error amplifier as much as possible.
一般に昇圧型力率改善回路は、力率の改善を優先する観点から、応答速度を極めて遅く設定している。このため、仮に急激かつ変化量の大きな負荷変動が生じた場合には、昇圧型力率改善回路の出力電圧に、オーバーシュートまたはアンダーシュートが顕著に生じることとなる。具体的には、重負荷から軽負荷に負荷急変した場合にはオーバーシュートが発生し、軽負荷から重負荷に負荷急変した場合にはアンダーシュートが発生する。 In general, the boost type power factor correction circuit sets the response speed very slow from the viewpoint of giving priority to the improvement of the power factor. For this reason, if a sudden and large change in load occurs, an overshoot or undershoot is noticeably generated in the output voltage of the boost type power factor correction circuit. Specifically, overshoot occurs when the load suddenly changes from heavy load to light load, and undershoot occurs when the load suddenly changes from light load to heavy load.
オーバーシュートやアンダーシュートを含む出力電圧の脈動やリップルは好ましいものではないところ、特にオーバーシュートは、負荷を含めた回路素子の耐圧オーバーによる素子破壊や回路破壊を招来し、回路寿命を著しく低減させることが懸念される。 Output voltage pulsations and ripples, including overshoot and undershoot, are not desirable. In particular, overshoot leads to element breakdown and circuit breakdown due to overvoltage resistance of circuit elements including loads, and significantly reduces circuit life. There is concern.
本実施形態においては、負荷急変があった場合に生じる出力電圧の変動を迅速に検出して、一時的に電圧エラーアンプの応答速度を速くすることで、当該負荷変動に起因するオーバーシュートやアンダーシュートを低減させる技術思想を提案する。 In this embodiment, the output voltage fluctuation that occurs when there is a sudden load change is detected quickly, and the response speed of the voltage error amplifier is temporarily increased, so that overshoot or undershoot caused by the load fluctuation occurs. A technical idea to reduce the chute is proposed.
電圧エラーアンプの応答速度を速くするのは一時的でありオーバーシュート等の低減に伴い速やかに電圧エラーアンプの応答速度を元に戻すことから、昇圧型力率改善回路が本来有する力率への悪影響は、全体としては考慮に値しない程度とできる。 Increasing the response speed of the voltage error amplifier is temporary, and since the response speed of the voltage error amplifier is quickly restored with the reduction of overshoot, etc., the boost type power factor correction circuit has the original power factor. Adverse effects can be considered to be unacceptable as a whole.
より具体的には、実施形態の昇圧型力率改善回路は、出力電圧の変動に対応して位相補償インピーダンスをスイッチ操作により一時的に増大させることが可能な位相補償部を、出力電圧のフィードバックループ内に設ける。 More specifically, the step-up power factor correction circuit according to the embodiment includes a phase compensation unit capable of temporarily increasing the phase compensation impedance by a switch operation in response to a change in the output voltage, and provides feedback of the output voltage. Provide in the loop.
スイッチ素子はMOSFETで構成することができ、電圧エラーアンプ出力の位相補償インピーダンスを増大させることで、電圧エラーアンプに迅速な応答作用を生起させて、オーバーシュート等を速やかに終息させる。 The switch element can be composed of a MOSFET, and by increasing the phase compensation impedance of the voltage error amplifier output, a rapid response action is caused in the voltage error amplifier and an overshoot or the like is quickly terminated.
さらに具体的には、容量素子とスイッチ素子とを並列接続し、通常時にはスイッチ素子の導通によりスルーパスされていた容量素子を、出力電圧変動時にはスイッチ素子を遮断することができる。 More specifically, the capacitor element and the switch element can be connected in parallel, and the capacitor element that is normally passed through by the conduction of the switch element can be shut off when the output voltage varies.
これにより、当該容量素子と他の容量素子との直列接続が形成されるので、結合容量が低減されて、位相補償インピーダンスが増大して電圧エラーアンプの応答速度が速くなる。従って、オーバーシュートが迅速に低減される。 As a result, a series connection is formed between the capacitive element and another capacitive element, so that the coupling capacitance is reduced, the phase compensation impedance is increased, and the response speed of the voltage error amplifier is increased. Therefore, overshoot is quickly reduced.
また、負荷急変がない通常時においては、当該容量素子は直列挿入されずにスルーされるので、電圧エラーアンプの位相補償インピーダンスは増大されず、昇圧型力率改善回路の動作全体として力率の悪化を招くことはない。 Further, in normal times when there is no sudden load change, the capacitive element is passed through without being inserted in series, so the phase compensation impedance of the voltage error amplifier is not increased, and the power factor of the boost type power factor correction circuit as a whole is increased. There is no deterioration.
(第一の実施形態)
図1は、第一の実施形態にかかる昇圧型力率改善回路1000の構成概要を説明するブロック図である。図1に示すように、昇圧型力率改善回路1000は、交流電源1010からのAC入力を全波整流する全波整流回路1020と、全波整流回路1020からの入力を昇圧するブースト回路1030とを備える。
(First embodiment)
FIG. 1 is a block diagram illustrating an outline of the configuration of a boost type power
また、昇圧型力率改善回路1000は、ブースト回路1030への入力電圧を検出する入力検出回路1050と、ブースト回路1030からの出力電圧がフィードバック入力される電圧エラーアンプ(誤差増幅器)1080とを備える。また、昇圧型力率改善回路1000は、ブースト回路1030からの出力電圧に対応して、電圧エラーアンプ1080の位相を所定の適切な位相補償インピーダンスで補償する位相補償部1090を備える。
The step-up power
また、入力検出回路1050の出力と電圧エラーアンプ1080の出力とは乗算器1060で掛け合わされ、コンパレータ1070において三角波と比較されてPWM信号に変換される。また、ブースト回路1030のスイッチ素子1031は、当該PWM信号で駆動される。
Further, the output of the
また、ブースト回路1030は、スイッチング素子(Q1)1031とインダクタ(L1)1032と整流ダイオード(D1)1033と平滑コンデンサ1034(C1)とを備え、DC−DCコンバーターーと称される場合もある。また、ブースト回路1030の高圧側出力端Vo+と低圧側出力端Vo−との間には、不図示の負荷が接続される。
The
図2は、第一の実施形態にかかる昇圧型力率改善回路1000の位相補償部1090による位相補償インピーダンスの増大処理を説明するタイムチャートである。図2(a)がブースト回路1030の出力電流Ioutを説明する図であり、(b)がブースト回路1030の出力電圧Voutを説明する図であり、(c)が位相補償インピーダンスの負荷変動時の増大処理を説明する図である。
FIG. 2 is a time chart for explaining the process of increasing the phase compensation impedance by the
図2から理解できるように、ブースト回路1030の高圧側出力端Vo+と低圧側出力端Vo−との間に接続される負荷には、負荷の変動がなければ一定の出力電圧Voutが印加される。また、この場合の出力電流Ioutは一定である。
As can be understood from FIG. 2, a constant output voltage Vout is applied to the load connected between the high-voltage side output terminal Vo + and the low-voltage side output terminal Vo− of the
ここで、図2に示すように重負荷から軽負荷への負荷急変が生じると、出力電流Ioutが一気に低減するとともに、出力電圧Voutが破線で示すように脈動し、大きなオーバーシュートが生じる。 Here, when a sudden load change from a heavy load to a light load occurs as shown in FIG. 2, the output current Iout is reduced at once, and the output voltage Vout pulsates as indicated by a broken line, resulting in a large overshoot.
位相補償部1090は、出力電圧Voutのオーバーシュートを予め設定された上限電圧にて早い段階で検出し、位相補償インピーダンスを一時的に増大させる。すなわち、位相補償部1090は、所定の上限電圧を超える出力電圧Voutとなった場合には、位相補償インピーダンスを増大させて、所定の上限電圧以下の出力電圧Voutとなった場合には、位相補償インピーダンスの増大処理を解除して元に戻す。
The
上述の動作処理により、電圧エラーアンプ1080が一時的に迅速な応答速度で機能することとなり、ブースト回路1030の出力電圧Voutは、オーバーシュートが図2に実線で示すように低減されることとなる。
With the above-described operation processing, the
上述の第一の実施形態においては、オーバーシュートの場合すなわち重負荷から軽負荷に負荷変動した場合を典型例として説明したが、アンダーシュートの場合すなわち軽負荷から重負荷に負荷変動した場合においても、同様に処理可能である。 In the first embodiment described above, the case of overshoot, that is, a load change from a heavy load to a light load has been described as a typical example, but even in the case of an undershoot, that is, a load change from a light load to a heavy load. Can be processed in the same manner.
アンダーシュートを低減させる場合には、図2に示す上限電圧に換えてまたはこれと共に、負側に下限電圧を設定することにより、これを超えて低い出力電圧Voutとなった場合に、位相補償部1090の位相補償インピーダンスを増大させる処理とできる。 When reducing the undershoot, the phase compensator is used when the lower output voltage Vout is exceeded by setting the lower limit voltage on the negative side instead of or together with the upper limit voltage shown in FIG. 1090 phase compensation impedance can be increased.
第一の実施形態で示した昇圧型力率改善回路1000においては、位相補償部1090の位相補償インピーダンスを増大させる具体的な回路構成と、出力電圧Voutを検出する具体的な回路構成とは明示していないが、周知の各種回路素子や各種ICを用いて構成できることは自明である。
In the step-up power
(第二の実施形態)
図3は、第二の実施形態にかかる昇圧型力率改善回路3000の構成概要を説明する概念図である。図3においては、昇圧型力率改善回路3000の関連箇所のみを示しており、その他の箇所については記載を省略している。
(Second embodiment)
FIG. 3 is a conceptual diagram illustrating an outline of the configuration of the boost type power
図3から理解できるように、昇圧型力率改善回路3000は、ブースト回路3030を備える。ブースト回路3030の構成および動作は、図1で示した第一の実施形態のブースト回路1030と同一であるのでここでは説明を省略する。
As can be understood from FIG. 3, the boost type power
また、昇圧型力率改善回路3000は、電圧エラーアンプ3080を含んでパルス駆動スイッチング信号を出力する制御IC3100を備える。すなわち、図3においては図示していないが、図1で示した第一の実施形態の乗算器1060とコンパレータ1070との機能は、制御IC3100内に納められているものとする。
The step-up type power
図3において、電圧エラーアンプ3080のマイナス側入力端子には、ブースト回路3030の出力電圧Voutが、抵抗(R1)と抵抗(R2)とにより分圧検出されて入力される。また、電圧エラーアンプ3080のプラス側入力端子には、リファレンス電圧VREFが入力される。
In FIG. 3, the output voltage Vout of the
また、図3に示すように、昇圧型力率改善回路3000は、ブースト回路3030の出力電圧Voutを検出する電圧検出部3200を備える。また、昇圧型力率改善回路3000は、電圧検出部3200による出力電圧Voutの検出結果に対応して位相補償インピーダンスを適切に変更処理する位相補償部3090を備える。
As shown in FIG. 3, the boost power
なお、図3においては、説明の便宜上、電圧検出部3200と位相補償部3090とを分離して説明しているが、電圧検出部3200の回路構成等を位相補償部3090に一体的に含め、位相補償部3090で電圧を検出する回路構成等としても良い。
In FIG. 3, for convenience of explanation, the
また、位相補償部3090は、電圧エラーアンプ3080の出力端子と接地との間に直列接続されたキャパシタ(C5)3500及びキャパシタ(C3)3400と、キャパシタ(C3)3400と並列に接続されたスイッチ素子(SW)3300とを備える。
The
また、位相補償部3090は、電圧エラーアンプ3080の出力端子と接地との間に、直列接続されたキャパシタ(C2)と抵抗(R3)とを、備える。
The
第二の実施形態にかかる昇圧型力率改善回路3000は、負荷急変がない場合、すなわち出力電圧Voutが上限電圧及び下限電圧の範囲内であって所定の変動範囲内である通常時には、位相補償部3090がスイッチ素子(SW)3300を導通させる。
The step-up type power
スイッチ素子(SW)3300が導通されることにより、スイッチ素子(SW)3300と並列に接続されたキャパシタ(C3)3400は電気的にスルーされることとなり電気的には無視できるものとなる。 When the switch element (SW) 3300 is turned on, the capacitor (C3) 3400 connected in parallel with the switch element (SW) 3300 is electrically passed through and becomes electrically negligible.
これにより、電圧エラーアンプ3080の位相補償インピーダンスは、直列接続されたキャパシタ(C2)及び抵抗(R3)と、キャパシタ(C5)3500と、の並列接続により形成されるインピーダンスとなる。また、直列接続されたキャパシタ(C2)及び抵抗(R3)と、キャパシタ(C5)3500と、の並列接続により形成されるインピーダンスは、昇圧型力率改善回路3000の力率を所望の値に改善するのに十分満足な設定値である。この場合の電圧エラーアンプ3080の応答速度は、一般的には比較的遅いものとなる。
Thereby, the phase compensation impedance of the
一方、昇圧型力率改善回路3000は、負荷急変があった場合、すなわち出力電圧Voutが上限電圧及び下限電圧の範囲外となり所定の変動範囲外であることが電圧検出部3200で検出されると、位相補償部3090がスイッチ素子(SW)3300を遮断させる。
On the other hand, when the load type power
スイッチ素子(SW)3300が遮断されることにより、スイッチ素子(SW)3300と並列に接続されたキャパシタ(C3)3400は電気的に活性化されることとなり、直列接続されたキャパシタ(C5)3500及びキャパシタ(C3)3400が、直列接続されたキャパシタ(C2)及び抵抗(R3)と、並列に接続されることとなる。 When the switch element (SW) 3300 is cut off, the capacitor (C3) 3400 connected in parallel with the switch element (SW) 3300 is electrically activated, and the capacitor (C5) 3500 connected in series is activated. The capacitor (C3) 3400 is connected in parallel with the capacitor (C2) and the resistor (R3) connected in series.
これにより、電圧エラーアンプ3080の位相補償インピーダンスは、直列接続されたキャパシタ(C2)と抵抗(R3)と、直列接続されたキャパシタ(C5)3500及びキャパシタ(C3)3400と、の並列接続により形成されるインピーダンスとなる。
Thereby, the phase compensation impedance of the
また、直列接続されたキャパシタ(C2)と抵抗(R3)と、直列接続されたキャパシタ(C5)3500及びキャパシタ(C3)3400と、の並列接続により形成されるインピーダンスは、直列接続されたキャパシタ(C2)と抵抗(R3)と、キャパシタ(C5)3500と、の並列接続により形成されるインピーダンスに比較して大きい。従って、時定数が小さくなって、電圧エラーアンプ3080の応答速度が一時的に増大する。このため、出力電圧Voutに生じたオーバーシュートやアンダーシュートは速やかに低減されるものとなる。この場合においても、電圧エラーアンプ3080の応答速度が増大するのは一時的であるので、全体としての力率の効率悪化を招来することはない。
In addition, the impedance formed by the parallel connection of the capacitor (C2) and the resistor (R3) connected in series, and the capacitor (C5) 3500 and the capacitor (C3) 3400 connected in series is the capacitor (C It is larger than the impedance formed by the parallel connection of C2), resistor (R3), and capacitor (C5) 3500. Accordingly, the time constant becomes small, and the response speed of the
(第三の実施形態)
図4は、第三の実施形態にかかる昇圧型力率改善回路4000の構成概要を説明する概念図である。図4においては、昇圧型力率改善回路4000の関連箇所のみを示しており、その他の箇所については記載を省略している。また、図3に示した第二の実施形態と同一の箇所には同一の符号を付している。
(Third embodiment)
FIG. 4 is a conceptual diagram illustrating an outline of the configuration of the step-up power
図4から理解できるように、昇圧型力率改善回路4000は、ブースト回路3030を備える。ブースト回路3030の構成および動作は、図1で示した第一の実施形態のブースト回路1030と同一であるのでここでは説明を省略する。
As can be understood from FIG. 4, the boost type power
また、昇圧型力率改善回路4000は、電圧エラーアンプ3080を含んでパルス駆動スイッチング信号を出力する制御IC3100を備える。すなわち、図4においては図示していないが、図1で示した第一の実施形態の乗算器1060とコンパレータ1070との機能は、制御IC3100内に納められているものとする。
The step-up type power
図4において、電圧エラーアンプ3080のマイナス側入力端子には、ブースト回路3030の出力電圧Voutが、抵抗(R1)と抵抗(R2)とにより分圧検出されて入力される。また、電圧エラーアンプ3080のプラス側入力端子には、リファレンス電圧VREFが入力される。
In FIG. 4, the output voltage Vout of the
また、図4に示すように、昇圧型力率改善回路4000は、ブースト回路3030の出力電圧Voutを検出する電圧検出部3200を備える。また、昇圧型力率改善回路4000は、電圧検出部3200による出力電圧Voutの検出結果に対応して位相補償インピーダンスを適切に変更処理する位相補償部3090を備える。
Also, as shown in FIG. 4, the boost type power
なお、図4においては、説明の便宜上、電圧検出部3200と位相補償部3090とを分離して示したが、電圧検出部3200の回路構成等を位相補償部3090に例えばワンチップ化等により一体的に含め、位相補償部3090で電圧を検出する回路構成等としても良い。
In FIG. 4, for convenience of explanation, the
また、位相補償部3090は、電圧エラーアンプ3080の出力端子と接地との間に直列に接続されたキャパシタ(C5)3500とスイッチ素子(SW)3300とを備える。
The
また、位相補償部3090は、直列接続されたキャパシタ(C2)と抵抗(R3)とを、電圧エラーアンプ3080の出力端子と接地との間に備え、また、直列接続されたキャパシタ(C5)3500及びスイッチ素子(SW)3300と、並列に接続される。
The
第三の実施形態にかかる昇圧型力率改善回路4000は、負荷急変がない場合、すなわち出力電圧Voutが上限電圧及び下限電圧の範囲内であって所定の変動範囲内である通常時には、位相補償部3090がスイッチ素子(SW)3300を導通させる。
The step-up power
スイッチ素子(SW)3300が導通されることにより、スイッチ素子(SW)3300と直列に接続されたキャパシタ(C5)3500は、直列接続されたキャパシタ(C2)及び抵抗(R3)と並列に電気的に接続形成される。 When the switch element (SW) 3300 is turned on, the capacitor (C5) 3500 connected in series with the switch element (SW) 3300 is electrically connected in parallel with the capacitor (C2) and resistor (R3) connected in series. Connected to.
これにより、電圧エラーアンプ3080の位相補償インピーダンスは、直列接続されたキャパシタ(C2)と抵抗(R3)と、キャパシタ(C5)3500と、の並列接続により形成されるインピーダンスとなる。また、直列接続されたキャパシタ(C2)及び抵抗(R3)と、キャパシタ(C5)3500と、の並列接続により形成されるインピーダンスは、昇圧型力率改善回路3000の力率を所望の値に改善するのに十分満足な設定値である。この場合の電圧エラーアンプ3080の応答速度は、一般的には比較的遅いものとなる。
As a result, the phase compensation impedance of the
一方、昇圧型力率改善回路4000は、負荷急変があった場合、すなわち出力電圧Voutが上限電圧及び下限電圧の範囲外となり所定の変動範囲外であることが電圧検出部3200で検出されると、位相補償部3090がスイッチ素子(SW)3300を遮断させる。
On the other hand, the boost type power
スイッチ素子(SW)3300が遮断されることにより、スイッチ素子(SW)3300と直列に接続されたキャパシタ(C5)3500は電気的に接続が遮断されることとなり、いわば電気的に非活性化され、直列接続されたキャパシタ(C2)及び抵抗(R3)のみが位相補償インピーダンスを形成することとなる。 When the switch element (SW) 3300 is cut off, the capacitor (C5) 3500 connected in series with the switch element (SW) 3300 is cut off electrically, so to speak, it is electrically deactivated. Only the capacitor (C2) and the resistor (R3) connected in series form a phase compensation impedance.
すなわち、電圧エラーアンプ3080の位相補償インピーダンスは、電圧エラーアンプ3080の出力端子と接地との間に直列接続されたキャパシタ(C2)及び抵抗(R3)のみにより形成されるインピーダンスとなる。
That is, the phase compensation impedance of the
また、直列接続されたキャパシタ(C2)及び抵抗(R3)のみにより形成されるインピーダンスは、直列接続されたキャパシタ(C2)及び抵抗(R3)と、キャパシタ(C5)3500と、の並列接続により形成されるインピーダンスに比較して大きい。従って、時定数が小さくなって、電圧エラーアンプ3080の応答速度が一時的に増大する。このため、出力電圧Voutに生じたオーバーシュートやアンダーシュートは速やかに低減されるものとなる。
The impedance formed only by the capacitor (C2) and the resistor (R3) connected in series is formed by parallel connection of the capacitor (C2) and resistor (R3) connected in series and the capacitor (C5) 3500. Greater than the impedance to be done. Accordingly, the time constant becomes small, and the response speed of the
図5は、第三の実施形態にかかる昇圧型力率改善回路4000が、位相補償インピーダンスを変更して電圧エラーアンプの応答速度を一時的に増大させる動作を順次説明するフロー図である。
FIG. 5 is a flowchart for sequentially explaining the operation of the step-up power
そこで、第三の実施形態にかかる昇圧型力率改善回路4000が、位相補償インピーダンスを変更して電圧エラーアンプの応答速度を一時的に増大させる動作について、図5に示す各ステップに基づいて順次以下に説明する。なお、図5に示した動作フローのスイッチ処理については、第二の実施形態で説明した昇圧型力率改善回路3000においてもそのまま適用することができる。また、以下の説明においては上限電圧を超えるオーバーシュートが生じた具体例について説明する。
Therefore, the step-up power
(ステップS500)
昇圧型力率改善回路の動作を開始するか否かをオペレータが判断する。動作を開始する場合にはステップS510へと進み、動作を開始しない場合にはステップS500で待機する。
(Step S500)
The operator determines whether to start the operation of the boost type power factor correction circuit. When the operation is started, the process proceeds to step S510, and when the operation is not started, the process waits in step S500.
(ステップS510)
昇圧型力率改善回路4000の電圧検出部3200が、ブースト回路3030の出力が予め設定された上限電圧以上であるか否かを判断する。電圧検出部3200が、ブースト回路3030の出力が予め設定された上限電圧以上であると判断した場合は、ステップS520へと進む。また、電圧検出部3200が、ブースト回路3030の出力が予め設定された上限電圧以上ではないと判断した場合は、ステップS560へと進む。
(Step S510)
(ステップS520)
昇圧型力率改善回路4000の位相補償部3090は、スイッチ素子(SW)3300を遮断する。スイッチ素子(SW)3300を遮断すると、位相補償インピーダンスは、直列接続されたキャパシタ(C2)及び抵抗(R3)のみにより形成されることとなり、直列接続されたキャパシタ(C2)及び抵抗(R3)と、キャパシタ(C5)3500と、の並列接続により形成される位相補償インピーダンスよりも増大する。従って、電圧エラーアンプ3080の応答速度が一時的に速くなり、出力電圧Voutのオーバーシュートが速やかに低減されて安定化されるような補償処理が迅速に遂行される。
(Step S520)
The
(ステップS530)
昇圧型力率改善回路4000の電圧検出部3200が、ブースト回路3030の出力が予め設定された上限電圧以下であるか否かを判断する。電圧検出部3200が、ブースト回路3030の出力が予め設定された上限電圧以下であると判断した場合は、ステップS540へと進む。また、電圧検出部3200が、ブースト回路3030の出力が予め設定された上限電圧以下ではないと判断した場合は、ステップS520に戻る。
(Step S530)
(ステップS540)
昇圧型力率改善回路4000の位相補償部3090は、スイッチ素子(SW)3300を導通させる。スイッチ素子(SW)3300を導通させると、位相補償インピーダンスは、直列接続されたキャパシタ(C2)及び抵抗(R3)と、キャパシタ(C5)3500と、の並列接続により形成されることとなり、直列接続されたキャパシタ(C2)及び抵抗(R3)のみにより形成される位相補償インピーダンスよりも低減される。従って、電圧エラーアンプ3080の応答速度が通常時に戻って遅くなり、昇圧型力率改善回路4000の力率が所望の高い効率に維持される。
(Step S540)
The
(ステップS550)
昇圧型力率改善回路4000の動作を終了する場合には、このフローを終了する。また、昇圧型力率改善回路4000の動作を終了しない場合には、ステップS510へと戻る。
(Step S550)
When the operation of the boost type power
(ステップS560)
昇圧型力率改善回路は、公知の通常動作を遂行する。
(Step S560)
The boost type power factor correction circuit performs a known normal operation.
上述の説明においては、オーバーフローを低減させる動作について典型例として説明したが、これに限定されるものではなく、アンダーフローを低減させる構成としてもよいことは自明である。また、オーバーフローとアンダーフローとを共に低減させる回路構成としてもよい。 In the above description, the operation for reducing overflow has been described as a typical example. However, the present invention is not limited to this, and it is obvious that a configuration for reducing underflow may be used. Moreover, it is good also as a circuit structure which reduces both overflow and underflow.
(第四の実施形態)
図6は、第四の実施形態にかかる昇圧型力率改善回路6000の構成概要を説明する概念図である。図6においては、昇圧型力率改善回路6000の関連箇所のみを示しており、その他の箇所については記載を省略している。
(Fourth embodiment)
FIG. 6 is a conceptual diagram illustrating an outline of the configuration of the boost type power
図6から理解できるように、昇圧型力率改善回路6000は、ブースト回路6030を備える。ブースト回路6030の構成および動作は、図1で示した第一の実施形態のブースト回路1030と同一であるのでここでは説明を省略する。
As can be understood from FIG. 6, the boost type power
また、昇圧型力率改善回路6000は、電圧エラーアンプ6080を含んでパルス駆動スイッチング信号を出力する制御IC6100を備える。すなわち、図6においては示していないが、図1で示した第一の実施形態の乗算器1060とコンパレータ1070との機能は、制御IC6100内に納められているものとする。
The step-up power
図6において、電圧エラーアンプ6080のマイナス側入力端子には、ブースト回路6030の出力電圧Voutが、抵抗(R1)と抵抗(R2)とにより分圧検出されて入力される。また、電圧エラーアンプ6080のプラス側入力端子には、リファレンス電圧VREFが入力される。
In FIG. 6, the output voltage Vout of the
また、図6に示すように、昇圧型力率改善回路6000は、ブースト回路6030の出力電圧Voutを検出する電圧検出部6200を備える。また、昇圧型力率改善回路6000は、電圧検出部6200による出力電圧Voutの検出結果に対応して位相補償インピーダンスを適切に変更処理する位相補償部6090を備える。
As shown in FIG. 6, the boost type power
なお、図6においては、説明の便宜上、電圧検出部6200と位相補償部6090とを分離して示したが、電圧検出部6200の回路構成等を位相補償部6090に例えばワンチップ化等により一体的に含め、位相補償部6090で電圧を検出する回路構成等としても良い。
In FIG. 6, for convenience of explanation, the
電圧検出部6200は、ブースト回路6030の出力電圧Voutを抵抗(R6)6210と抵抗(R7)6220とで分圧検出した電圧値がリファレンスに入力されるシャントレギュレータ(M1)6230を備える。シャントレギュレータ(M1)6230は、アノードが接地されておりカソードが抵抗(R5)6240を介して基準電圧12Vに接続されている。
The
また、電圧検出部6200の抵抗(R5)6240とシャントレギュレータ(M1)6230のカソードとの接続点が、位相補償部6090のMOSFET6300のゲートに接続されている。また、抵抗(R5)6240とシャントレギュレータ(M1)6230のカソードとの接続点は、抵抗(R4)6250を介して接地されている。
In addition, a connection point between the resistor (R5) 6240 of the
また、位相補償部6090は、電圧エラーアンプ6080の出力端子と接地との間に直列に接続されたキャパシタ(C5)6500とMOSFET6300とを備える。MOSFET6300のドレインはキャパシタ(C5)6500に接続され、MOSFET6300のソースは接地される。
The
また、位相補償部6090は、電圧エラーアンプ6080の出力端子と接地との間に、直列接続されたキャパシタ(C2)と抵抗(R3)とを備え、またこれらは、直列接続されたキャパシタ(C5)6500及びMOSFET6300と並列に接続される。また、位相補償部6090は、MOSFET6300に並列に接続されたコンデンサ(C3)を備える。
The
第四の実施形態にかかる昇圧型力率改善回路6000は、負荷急変がない場合、すなわち出力電圧Voutが上限電圧及び下限電圧の範囲内であって所定の変動範囲内である通常時には、位相補償部6090がMOSFET6300を導通させる。
The step-up power
MOSFET6300が導通されることにより、MOSFET6300と並列に接続されたキャパシタ(C3)は、電気的にスルーされて、直列接続されたキャパシタ(C2)及び抵抗(R3)と、コンデンサ(C5)6500と、の並列接続が電気的に形成される。
When the
これにより、電圧エラーアンプ6080の位相補償インピーダンスは、直列接続されたキャパシタ(C2)及び抵抗(R3)と、キャパシタ(C5)と、の並列接続により形成されるインピーダンスとなる。
Thereby, the phase compensation impedance of the
また、直列接続されたキャパシタ(C2)及び抵抗(R3)と、キャパシタ(C5)と、の並列接続により形成されるインピーダンスは、昇圧型力率改善回路6000の力率を所望の値に改善するのに十分満足な設定値である。この場合の電圧エラーアンプ6080の応答速度は、力率を稼ぐために一般的には比較的遅いものとなる。
Further, the impedance formed by the parallel connection of the capacitor (C2) and resistor (R3) connected in series and the capacitor (C5) improves the power factor of the boost type power
一方、昇圧型力率改善回路6000は、負荷急変があった場合、すなわち出力電圧Voutが上限電圧及び下限電圧の範囲外となり所定の変動範囲外であることが電圧検出部6200で検出されると、位相補償部6090がMOSFET6300を遮断させる。
On the other hand, the boost type power
MOSFET6300が遮断されることにより、MOSFET6300と並列に接続されたキャパシタ(C3)は電気的に経路が形成されることとなり、いわば電気的に活性化される。従って、直列接続されたキャパシタ(C2)及び抵抗(R3)と、直列接続されたキャパシタ(C5)6500及びキャパシタ(C3)と、の並列接続により位相補償インピーダンスが形成されることとなる。
When the
すなわち、電圧エラーアンプ6080の位相補償インピーダンスは、電圧エラーアンプ6080の出力端子と接地との間に直列接続されたキャパシタ(C2)及び抵抗(R3)と、直列接続されたキャパシタ(C5)6500及びキャパシタ(C3)と、の並列接続により形成されるインピーダンスとなる。
That is, the phase compensation impedance of the
また、直列接続されたキャパシタ(C2)及び抵抗(R3)と、直列接続されたキャパシタ(C5)6500及びキャパシタ(C3)と、の並列接続により形成されるインピーダンスは、直列接続されたキャパシタ(C2)及び抵抗(R3)と、キャパシタ(C5)6500と、の並列接続により形成されるインピーダンスに比較して大きい。 Further, the impedance formed by the parallel connection of the capacitor (C2) and the resistor (R3) connected in series with the capacitor (C5) 6500 and the capacitor (C3) connected in series is the capacitor (C2 connected in series). ) And the resistor (R3) and the capacitor (C5) 6500, the impedance is larger than that formed by parallel connection.
従って、時定数が小さくなって、電圧エラーアンプ6080の応答速度が一時的に増大する。このため、出力電圧Voutに生じたオーバーシュートやアンダーシュートは速やかに低減されるものとなる。
Accordingly, the time constant becomes small, and the response speed of the
図7は、第四の実施形態にかかる昇圧型力率改善回路6000が、位相補償インピーダンスを変更して電圧エラーアンプの応答速度を一時的に増大させる動作を順次説明するフロー図である。
FIG. 7 is a flowchart for sequentially explaining the operation of the step-up power
そこで、第四の実施形態にかかる昇圧型力率改善回路6000が、位相補償インピーダンスを変更して電圧エラーアンプの応答速度を一時的に増大させる動作について、図7に示す各ステップに基づいて順次以下に説明する。
Accordingly, the step-up power
(ステップS700)
昇圧型力率改善回路の動作を開始するか否かをオペレータが判断する。動作を開始する場合にはステップS710へと進み、動作を開始しない場合にはステップS700で待機する。
(Step S700)
The operator determines whether to start the operation of the boost type power factor correction circuit. If the operation is started, the process proceeds to step S710. If the operation is not started, the process waits in step S700.
(ステップS710)
昇圧型力率改善回路6000の電圧検出部6200が、ブースト回路6030の検出分圧出力が予め設定されたシャントレギュレータ(M1)6230のリファレンス値以上であるか否かを判断する。電圧検出部6200が、ブースト回路6030の検出分圧出力が予め設定されたシャントレギュレータ(M1)6230のリファレンス値以上であると判断した場合は、ステップS720へと進む。また、電圧検出部7200が、ブースト回路6030の検出分圧出力が予め設定されたシャントレギュレータ(M1)6230のリファレンス値以上ではないと判断した場合は、ステップS780へと進む。
(Step S710)
(ステップS720)
ブースト回路6030の出力電圧Voutを抵抗(R6)6210と抵抗(R7)6220とにより分圧検出した値がリファレンスに入力されるシャントレギュレータ(M1)6230は、リファレンス入力が所定の設定値を超えると、アノードとカソードとを短絡する。これにより、シャントレギュレータ(M1)6230のカソード及びカソードに接続されるMOSFET(Q2)6300のゲートは、接地電圧となり、ゲートオフとされる。
(Step S720)
The shunt regulator (M1) 6230 in which the value obtained by dividing the output voltage Vout of the
(ステップS730)
昇圧型力率改善回路6000の位相補償部6090は、MOSFET(Q2)6300のソース−ドレイン間を遮断する。MOSFET(Q2)6300を遮断すると、位相補償インピーダンスは、直列接続されたキャパシタ(C2)及び抵抗(R3)と、直列接続されたキャパシタ(C5)6500及びキャパシタ(C3)と、の並列接続により形成されることとなる。
(Step S730)
The
(ステップS740)
このインピーダンスは、直列接続されたキャパシタ(C2)及び抵抗(R3)と、キャパシタ(C5)6500と、の並列接続により形成される位相補償インピーダンスよりも増大する。従って、電圧エラーアンプ6080の応答速度が一時的に速くなり、出力電圧Voutのオーバーシュートが速やかに低減されて安定化されるような補償処理が迅速に遂行される。
(Step S740)
This impedance is higher than the phase compensation impedance formed by the parallel connection of the capacitor (C2) and the resistor (R3) connected in series with the capacitor (C5) 6500. Therefore, the response speed of the
(ステップS750)
昇圧型力率改善回路6000の電圧検出部6200が、ブースト回路6030の検出分圧出力が予め設定されたシャントレギュレータ(M1)6230のリファレンス値以下であるか否かを判断する。電圧検出部6200が、ブースト回路6030の検出分圧出力が予め設定されたシャントレギュレータ(M1)6230のリファレンス値以下であると判断した場合は、ステップS760へと進む。また、電圧検出部6200が、ブースト回路6030の検出分圧出力が予め設定されたシャントレギュレータ(M1)6230のリファレンス値以下ではないと判断した場合は、ステップ720に戻る。
(Step S750)
(ステップS760)
昇圧型力率改善回路6000の位相補償部6090は、MOSFET(Q2)6300のソース−ドレイン間を導通させる。MOSFET(Q2)6300のソース−ドレイン間を導通させると、位相補償インピーダンスは、直列接続されたキャパシタ(C2)及び抵抗(R3)と、キャパシタ(C5)6500のみと、の並列接続により形成されることとなる。
(Step S760)
The
このため、直列接続されたキャパシタ(C2)及び抵抗(R3)と、直列接続されたキャパシタ(C5)6500及びキャパシタ(C3)と、の並列接続により形成される位相補償インピーダンスよりも低減される。従って、電圧エラーアンプ6080の応答速度が通常時に戻って遅くなり、昇圧型力率改善回路6000の力率が所望の高い効率に維持される。
For this reason, it is reduced from the phase compensation impedance formed by the parallel connection of the capacitor (C2) and the resistor (R3) connected in series, and the capacitor (C5) 6500 and the capacitor (C3) connected in series. Therefore, the response speed of the
より具体的には、ブースト回路6030の出力電圧Voutを抵抗(R6)6210と抵抗(R7)6220とにより分圧検出した値がリファレンスに入力されるシャントレギュレータ(M1)6230は、リファレンス入力が所定の設定値を超えなければ、アノードとカソードとの間を遮断する。これにより、シャントレギュレータ(M1)6230のカソード及び当該カソードに接続されるMOSFET(Q2)6300のゲートは、ゲートオン電圧となる。
More specifically, the shunt regulator (M1) 6230 in which the value obtained by detecting the voltage division of the output voltage Vout of the
(ステップS770)
昇圧型力率改善回路6000の動作を終了する場合には、このフローを終了する。また、昇圧型力率改善回路6000の動作を終了しない場合には、ステップS710へと戻る。
(Step S770)
When the operation of the boost type power
(ステップS780)
昇圧型力率改善回路は、公知の通常動作を遂行する。
(Step S780)
The boost type power factor correction circuit performs a known normal operation.
上述の説明においては、オーバーフローを低減させる動作について典型例として説明したが、これに限定されるものではなく、アンダーフローを低減させる構成としてもよいことは自明である。また、オーバーフローとアンダーフローとを共に低減させる回路構成としてもよい。 In the above description, the operation for reducing overflow has been described as a typical example. However, the present invention is not limited to this, and it is obvious that a configuration for reducing underflow may be used. Moreover, it is good also as a circuit structure which reduces both overflow and underflow.
図8は、第四の実施形態にかかる昇圧型力率改善回路6000の出力電流と出力電圧の波形及び位相補償インピーダンスを増大させる動作処理のタイムチャートを説明する図である。
FIG. 8 is a diagram illustrating a time chart of an operation process for increasing the output current and output voltage waveforms and the phase compensation impedance of the boost type power
図8(a)がブースト回路6030の出力電流Ioutを説明する図であり、(b)がブースト回路6030の出力電圧Voutを説明する図であり、(c)が位相補償インピーダンスの負荷変動時の増大処理を説明する図である。
FIG. 8A is a diagram for explaining the output current Iout of the
また、図8(d)がシャントレギュレータ(M1)6230の動作を説明する図であり、図8(e)がMOSFET(Q2)6300の動作を説明する図である。 FIG. 8D is a diagram for explaining the operation of the shunt regulator (M1) 6230, and FIG. 8E is a diagram for explaining the operation of the MOSFET (Q2) 6300.
図8から理解できるように、ブースト回路6030の高圧側出力端Vo+と低圧側出力端Vo−との間に接続される負荷には、負荷の変動がなければ一定の出力電圧Voutが印加される。また、この場合の出力電流Ioutは一定である。
As can be understood from FIG. 8, a constant output voltage Vout is applied to the load connected between the high-voltage side output terminal Vo + and the low-voltage side output terminal Vo− of the
ここで、図8に示すように重負荷から軽負荷への負荷急変が生じると、出力電流Ioutが一気に低減するとともに、出力電圧Voutが破線で示すように脈動し、大きなオーバーシュートが生じる。 Here, when a sudden load change from a heavy load to a light load occurs as shown in FIG. 8, the output current Iout is reduced at once, and the output voltage Vout pulsates as indicated by a broken line, resulting in a large overshoot.
電圧検出部6200は、出力電圧Voutのオーバーシュートを予め設定された上限電圧にて早い段階で検出し、位相補償部6090が位相補償インピーダンスを一時的に増大させる。すなわち、位相補償部6090は、所定の上限電圧を超える出力電圧Voutとなった場合には、位相補償インピーダンスを増大させて、所定の上限電圧以下の出力電圧Voutとなった場合には、位相補償インピーダンスの増大処理を解除して元に戻す。
The
より詳細には、ブースト回路6030の出力電圧Voutを抵抗(R6)6210と抵抗(R7)6220とにより分圧検出した値がリファレンスに入力されるシャントレギュレータ(M1)6230が、検出分圧出力が所定電圧値を超えるとオンとなりアノード−カソード間を短絡する。
More specifically, the shunt regulator (M1) 6230 in which the value obtained by dividing the output voltage Vout of the
これにより、MOSFET(Q2)6300のゲート電圧は接地電圧となり、MOSFET(Q2)6300がオフされる。従って、MOSFET(Q2)6300のソース−ドレイン間が遮断されて、キャパシタ(C5)6500及びキャパシタ(C3)が電気的に直列に接続される。 Thereby, the gate voltage of MOSFET (Q2) 6300 becomes the ground voltage, and MOSFET (Q2) 6300 is turned off. Therefore, the source-drain of the MOSFET (Q2) 6300 is cut off, and the capacitor (C5) 6500 and the capacitor (C3) are electrically connected in series.
一方、ブースト回路6030の出力電圧Voutを抵抗(R6)6210と抵抗(R7)6220とにより分圧検出した値がリファレンスに入力されるシャントレギュレータ(M1)6230が、検出分圧出力が所定電圧値を超えない場合にはオフとなりアノード−カソード間を遮断する。
On the other hand, the shunt regulator (M1) 6230 in which the value obtained by dividing the output voltage Vout of the
これにより、MOSFET(Q2)6300のゲート電圧は例えば12Vとなり、MOSFET(Q2)6300がオンされる。従って、MOSFET(Q2)6300のソース−ドレイン間が短絡されて、キャパシタ(C3)が電気的に無視されるものとなる。 Thereby, the gate voltage of the MOSFET (Q2) 6300 becomes, for example, 12V, and the MOSFET (Q2) 6300 is turned on. Accordingly, the source and drain of the MOSFET (Q2) 6300 are short-circuited, and the capacitor (C3) is electrically ignored.
上述の動作処理により、電圧エラーアンプ6080が一時的に迅速な応答速度で機能することとなり、ブースト回路6030の出力電圧Voutは、オーバーシュートが図8に実線で示すように低減されることとなる。
With the above-described operation processing, the
上述の第四の実施形態においては、オーバーシュートの場合すなわち重負荷から軽負荷に負荷変動した場合を典型例として説明したが、アンダーシュートの場合すなわち軽負荷から重負荷に負荷変動した場合においても、同様に処理可能である。 In the fourth embodiment described above, the case of overshoot, that is, a load change from heavy load to light load has been described as a typical example. Can be processed in the same manner.
アンダーシュートを低減させる場合には、図8に示す上限電圧に換えてまたはこれと共に、負側に下限電圧を設定することにより、これを超えて低い出力電圧Voutとなった場合に、位相補償部6090の位相補償インピーダンスを増大させる処理とできる。 In the case of reducing the undershoot, the phase compensator is used when the lower output voltage Vout is exceeded by setting the lower limit voltage on the negative side instead of or together with the upper limit voltage shown in FIG. 6090 phase compensation impedance can be increased.
第四の実施形態で示した昇圧型力率改善回路6000においては、位相補償部6090の位相補償インピーダンスを増大させる具体的な回路構成と、出力電圧Voutを検出する具体的な回路構成とは明示しているが、周知の各種回路素子や各種ICを用いた他の構成とできることは自明である。
In the step-up power
(第五の実施形態)
図9は、第五の実施形態にかかる一定時間のみ位相補償インピーダンスを増大させる昇圧型力率改善回路9000の構成概要を説明する概念図である。図9においては、昇圧型力率改善回路9000の関連箇所のみを示しており、その他の箇所については記載を省略している。
(Fifth embodiment)
FIG. 9 is a conceptual diagram for explaining the outline of the configuration of the boost type power
図9から理解できるように、昇圧型力率改善回路9000は、ブースト回路9030を備える。ブースト回路9030の構成および動作は、図1で示した第一の実施形態のブースト回路1030と同一であるのでここでは説明を省略する。
As can be understood from FIG. 9, the boost type power
また、昇圧型力率改善回路9000は、電圧エラーアンプ9080を含んでパルス駆動スイッチング信号を出力する制御IC9100を備える。すなわち、図9においては示していないが、図1で示した第一の実施形態の乗算器1060とコンパレータ1070との機能は、制御IC9100内に納められているものとする。
The step-up power
図9において、電圧エラーアンプ9080のマイナス側入力端子には、ブースト回路9030の出力電圧Voutが、抵抗(R1)と抵抗(R2)とにより分圧検出されて入力される。また、電圧エラーアンプ9080のプラス側入力端子には、リファレンス電圧VREFが入力される。
In FIG. 9, the output voltage Vout of the
また、図9に示すように、昇圧型力率改善回路9000は、ブースト回路9030の出力電圧Voutを検出する電圧検出部9200を備える。また、昇圧型力率改善回路9000は、電圧検出部9200による出力電圧Voutの検出結果に対応して位相補償インピーダンスを一定時間だけ適切に変更処理するようにゲート信号を出力するタイマー部9400と、位相補償部9090を備える。
As shown in FIG. 9, the boost type power
なお、図9においては、説明の便宜上、電圧検出部9200とタイマー部9400と位相補償部9090とを分離して示したが、電圧検出部9200及びタイマー部9400の回路構成等を位相補償部9090に例えばワンチップ化等により一体的に含め、位相補償部9090で電圧を検出する回路構成等としても良い。
In FIG. 9, for convenience of description, the
電圧検出部9200は、ブースト回路9030の出力電圧Voutを抵抗(R6)9210と抵抗(R7)9220とで分圧検出した電圧値がリファレンスに入力されるシャントレギュレータ(M1)9230を備える。シャントレギュレータ(M1)9230は、アノードが接地されておりカソードが抵抗(R5)9240を介して基準電圧12Vに接続されている。
The
また、電圧検出部9200の抵抗(R5)9240とシャントレギュレータ(M1)9230のカソードとの接続点が、タイマー部9400のタイマーIC9410を介して位相補償部9090のMOSFET9300のゲートに接続されている。また、抵抗(R5)9240とシャントレギュレータ(M1)9230のカソードとの接続点は、抵抗(R4)9250を介して接地されている。
A connection point between the resistor (R5) 9240 of the
タイマー部9400のタイマーIC9410は、入力端子(IN)に、電圧検出部9200の抵抗(R5)9240とシャントレギュレータ(M1)9230のカソードとの接続点が接続される。また、タイマー部9400のタイマーIC9410は、出力端子(OUT)に、MOSFET9300のゲートが接続される。
In the
タイマーIC9410の(RX/CX)端子には抵抗を介して基準電圧が入力され、(CX)端子は接地される。また、タイマーIC9410の(RX/CX)端子はコンデンサを介して接地及び(CX)端子に接続される。
A reference voltage is input to the (RX / CX) terminal of the
タイマー部9400のタイマーIC9410は、その入力端子(IN)に信号入力があると、(RX/CX)端子に接続される抵抗及びコンデンサで決定される所定の期間だけ、出力信号(OUT)に継続して信号出力が維持される。すなわち、MOSFET9300が一旦オフされると、出力電圧Voutの値に関係なく、予め定められた所定の期間だけ継続してオフ状態が継続されることとなる。
When there is a signal input to its input terminal (IN), the
また、位相補償部9090は、電圧エラーアンプ9080の出力端子と接地との間に直列に接続されたキャパシタ(C5)9500とMOSFET9300とを備える。MOSFET9300のドレインはキャパシタ(C5)9500に接続され、MOSFET9300のソースは接地される。
The
また、位相補償部9090は、電圧エラーアンプ9080の出力端子と接地との間に、直列接続されたキャパシタ(C2)と抵抗(R3)とを備え、またこれらは、直列接続されたキャパシタ(C5)9500及びMOSFET9300と並列に接続される。また、位相補償部9090は、MOSFET9300に並列に接続されたコンデンサ(C3)を備える。
The
第五の実施形態にかかる昇圧型力率改善回路9000は、負荷急変がない場合、すなわち出力電圧Voutが上限電圧及び下限電圧の範囲内であって所定の変動範囲内である通常時には、位相補償部9090がMOSFET9300を導通させる。
The step-up power
MOSFET9300が導通されることにより、MOSFET9300と並列に接続されたキャパシタ(C3)は、電気的にスルーされて、直列接続されたキャパシタ(C2)及び抵抗(R3)と、コンデンサ(C5)9500と、の並列接続が電気的に形成される。
When the
これにより、電圧エラーアンプ9080の位相補償インピーダンスは、直列接続されたキャパシタ(C2)及び抵抗(R3)と、キャパシタ(C5)と、の並列接続により形成されるインピーダンスとなる。
Thereby, the phase compensation impedance of the
また、直列接続されたキャパシタ(C2)及び抵抗(R3)と、キャパシタ(C5)と、の並列接続により形成されるインピーダンスは、昇圧型力率改善回路9000の力率を所望の値に改善するのに十分満足な設定値である。この場合の電圧エラーアンプ9080の応答速度は、力率を稼ぐために一般的には比較的遅いものとなる。
Further, the impedance formed by the parallel connection of the capacitor (C2) and resistor (R3) connected in series and the capacitor (C5) improves the power factor of the boost type power
一方、昇圧型力率改善回路9000は、負荷急変があった場合、すなわち出力電圧Voutが上限電圧及び下限電圧の範囲外となり所定の変動範囲外であることが電圧検出部9200で検出されると、位相補償部9090がMOSFET9300をタイマー部9400で予め定められる所定期間だけ遮断させる。
On the other hand, the boost type power
MOSFET9300がタイマー部9400で予め定められる所定期間だけ遮断されることにより、MOSFET9300と並列に接続されたキャパシタ(C3)は、タイマー部9400で予め定められる所定期間だけ、電気的に経路が形成されることとなり、いわば電気的に活性化される。従って、直列接続されたキャパシタ(C2)及び抵抗(R3)と、直列接続されたキャパシタ(C5)9500及びキャパシタ(C3)と、の並列接続により、タイマー部9400で予め定められる所定期間だけ位相補償インピーダンスが形成されることとなる。
When the
すなわち、電圧エラーアンプ9080の位相補償インピーダンスは、タイマー部9400で予め定められる所定期間だけ、電圧エラーアンプ9080の出力端子と接地との間に直列接続されたキャパシタ(C2)及び抵抗(R3)と、直列接続されたキャパシタ(C5)9500及びキャパシタ(C3)と、の並列接続により形成されるインピーダンスとなる。
That is, the phase compensation impedance of the
また、直列接続されたキャパシタ(C2)及び抵抗(R3)と、直列接続されたキャパシタ(C5)9500及びキャパシタ(C3)と、の並列接続により形成されるインピーダンスは、直列接続されたキャパシタ(C2)及び抵抗(R3)と、キャパシタ(C5)9500と、の並列接続により形成されるインピーダンスに比較して大きい。 Further, the impedance formed by the parallel connection of the capacitor (C2) and the resistor (R3) connected in series and the capacitor (C5) 9500 and the capacitor (C3) connected in series is the capacitor (C2 connected in series). ) And the resistor (R3) and the capacitor (C5) 9500, the impedance is larger than that formed by parallel connection.
従って、タイマー部9400で予め定められる所定期間だけ、時定数が小さくなって、電圧エラーアンプ9080の応答速度が一時的に増大する。このため、出力電圧Voutに生じたオーバーシュートやアンダーシュートは速やかに低減されるものとなる。
Therefore, the time constant decreases for a predetermined period predetermined by the
図10は、第五の実施形態にかかる昇圧型力率改善回路9000の出力電流と出力電圧の波形及び位相補償インピーダンスを増大させる動作処理のタイムチャートを説明する図である。
FIG. 10 is a diagram illustrating a time chart of an operation process for increasing the output current and output voltage waveforms and the phase compensation impedance of the boost type power
図10(a)がブースト回路9030の出力電流Ioutを説明する図であり、(b)がブースト回路9030の出力電圧Voutを説明する図であり、(c)が位相補償インピーダンスの負荷変動時の増大処理を説明する図である。
FIG. 10A is a diagram illustrating the output current Iout of the
また、図10(d)がシャントレギュレータ(M1)9230の動作を説明する図であり、図10(e)がタイマーIC9410の動作を説明する図であり、図10(f)がMOSFET(Q2)9300の動作を説明する図である。
10D is a diagram for explaining the operation of the shunt regulator (M1) 9230, FIG. 10E is a diagram for explaining the operation of the
図10から理解できるように、ブースト回路9030の高圧側出力端Vo+と低圧側出力端Vo−との間に接続される負荷には、負荷の変動がなければ一定の出力電圧Voutが印加される。また、この場合の出力電流Ioutは一定である。
As can be understood from FIG. 10, a constant output voltage Vout is applied to the load connected between the high-voltage side output terminal Vo + and the low-voltage side output terminal Vo− of the
ここで、図10に示すように重負荷から軽負荷への負荷急変が生じると、出力電流Ioutが一気に低減するとともに、出力電圧Voutが破線で示すように脈動し、大きなオーバーシュートが生じる。 Here, when a sudden load change from a heavy load to a light load occurs as shown in FIG. 10, the output current Iout is reduced at once, and the output voltage Vout pulsates as indicated by a broken line, resulting in a large overshoot.
電圧検出部9200は、出力電圧Voutのオーバーシュートを予め設定された上限電圧にて早い段階で検出し、位相補償部9090が位相補償インピーダンスを、タイマーIC9410で定められた所定期間(T)だけ、一時的に増大させる。すなわち、位相補償部9090は、所定の上限電圧を超える出力電圧Voutとなった場合には、位相補償インピーダンスを所定期間(T)だけ増大させて、期間経過後位相補償インピーダンスの増大処理を解除して元に戻す。
The
より詳細には、ブースト回路9030の出力電圧Voutを抵抗(R6)9210と抵抗(R7)9220とにより分圧検出した値がリファレンスに入力されるシャントレギュレータ(M1)9230が、検出分圧出力が所定電圧値を超えるとオンとなりアノード−カソード間を短絡する。
More specifically, the shunt regulator (M1) 9230 in which the value obtained by dividing the output voltage Vout of the
シャントレギュレータ(M1)9230のアノード−カソード間が短絡されると、タイマーIC9410の入力端子(IN)が接地電圧(OFF)となる。タイマーIC9410は、(RX/CX)端子及び(CX)端子に接続される抵抗とコンデンサとの回路定数に基づいて定められた所定期間(T)のみ、接地出力(オフ信号)を出力端子(OUT)から出力する。
When the anode-cathode of the shunt regulator (M1) 9230 is short-circuited, the input terminal (IN) of the
これにより、MOSFET(Q2)9300のゲート電圧は、出力電圧Voutの変動に拘わらず所定期間(T)だけ接地電圧となり、MOSFET(Q2)9300がオフされる。従って、MOSFET(Q2)9300のソース−ドレイン間が遮断されて、キャパシタ(C5)9500及びキャパシタ(C3)が電気的に直列に接続される。 Thereby, the gate voltage of the MOSFET (Q2) 9300 becomes the ground voltage for a predetermined period (T) regardless of the fluctuation of the output voltage Vout, and the MOSFET (Q2) 9300 is turned off. Therefore, the source-drain of the MOSFET (Q2) 9300 is cut off, and the capacitor (C5) 9500 and the capacitor (C3) are electrically connected in series.
一方、ブースト回路9030の出力電圧Voutを抵抗(R6)9210と抵抗(R7)9220とにより分圧検出した値がリファレンスに入力されるシャントレギュレータ(M1)9230が、検出分圧出力が所定電圧値を超えない場合にはオフとなりアノード−カソード間を遮断する。
On the other hand, the shunt regulator (M1) 9230, in which a value obtained by dividing the output voltage Vout of the
これにより、MOSFET(Q2)9300のゲート電圧は例えば12Vとなり、MOSFET(Q2)9300がオンされる。従って、MOSFET(Q2)9300のソース−ドレイン間が短絡されて、キャパシタ(C3)が電気的に無視されるものとなる。 Thereby, the gate voltage of the MOSFET (Q2) 9300 becomes, for example, 12V, and the MOSFET (Q2) 9300 is turned on. Accordingly, the source and drain of the MOSFET (Q2) 9300 are short-circuited, and the capacitor (C3) is electrically ignored.
上述の動作処理により、電圧エラーアンプ9080が一時的に迅速な応答速度で機能することとなり、ブースト回路9030の出力電圧Voutは、オーバーシュートが図10に実線で示すように低減されることとなる。
Through the above-described operation process, the
上述の第五の実施形態においては、オーバーシュートの場合すなわち重負荷から軽負荷に負荷変動した場合を典型例として説明したが、アンダーシュートの場合すなわち軽負荷から重負荷に負荷変動した場合においても、同様に処理可能である。 In the fifth embodiment described above, the case of overshoot, that is, the case where the load fluctuates from a heavy load to a light load has been described as a typical example. Can be processed in the same manner.
アンダーシュートを低減させる場合には、図10に示す上限電圧に換えてまたはこれと共に、負側に下限電圧を設定することにより、これを超えて低い出力電圧Voutとなった場合に、位相補償部9090の位相補償インピーダンスを増大させる処理とできる。 In the case of reducing the undershoot, the phase compensator is used when the lower output voltage Vout is exceeded by setting the lower limit voltage on the negative side instead of or together with the upper limit voltage shown in FIG. 9090 phase compensation impedance can be increased.
第五の実施形態で示した昇圧型力率改善回路9000においては、位相補償部9090の位相補償インピーダンスを増大させる具体的な回路構成と、タイマー部9400の構成出力電圧Voutを検出する具体的な回路構成とを明示しているが、周知の各種回路素子や各種ICを用いた他の構成とできることは自明である。
In the boost type power
図11は、第五の実施形態にかかる昇圧型力率改善回路9000が、位相補償インピーダンスを変更して電圧エラーアンプの応答速度を所定期間(T)だけ一時的に増大させる動作を順次説明するフロー図である。
FIG. 11 sequentially illustrates the operation of the step-up power
そこで、第五の実施形態にかかる昇圧型力率改善回路9000が、位相補償インピーダンスを変更して電圧エラーアンプの応答速度を一時的に増大させる動作について、図11に示す各ステップに基づいて順次以下に説明する。
Therefore, the step-up power
(ステップS1000)
昇圧型力率改善回路の動作を開始するか否かをオペレータが判断する。動作を開始する場合にはステップS1100へと進み、動作を開始しない場合にはステップS1000で待機する。
(Step S1000)
The operator determines whether to start the operation of the boost type power factor correction circuit. If the operation is started, the process proceeds to step S1100. If the operation is not started, the process waits in step S1000.
(ステップS1100)
昇圧型力率改善回路9000の電圧検出部9200が、ブースト回路9030の検出分圧出力が予め設定されたシャントレギュレータ(M1)9230のリファレンス値以上であるか否かを判断する。
(Step S1100)
電圧検出部9200が、ブースト回路9030の検出分圧出力が予め設定されたシャントレギュレータ(M1)9230のリファレンス値以上であると判断した場合は、ステップS1110へと進む。また、電圧検出部9200が、ブースト回路9030の検出分圧出力が予め設定されたシャントレギュレータ(M1)9230のリファレンス値以上ではないと判断した場合は、ステップS1180へと進む。
When the
(ステップS1110)
ブースト回路9030の出力電圧Voutを抵抗(R6)9210と抵抗(R7)9220とにより分圧検出した値がリファレンスに入力されるシャントレギュレータ(M1)9230は、リファレンス入力が所定の設定値を超えると、アノードとカソードとを短絡する。これにより、シャントレギュレータ(M1)9230のカソードは、接地電圧となり、タイマーIC9410が作動する。
(ステップS1120)
タイマーIC9410が作動するとともに、タイマーIC9410の出力(OUT)からオフ信号(接地電圧)が出力されて、すなわちMOSFET9300のゲートが接地電圧となりオフとなる。
(Step S1110)
The shunt regulator (M1) 9230 in which the value obtained by dividing the output voltage Vout of the
(Step S1120)
The
(ステップS1130)
昇圧型力率改善回路9000の位相補償部9090は、MOSFET(Q2)9300のソース−ドレイン間を遮断する。MOSFET(Q2)9300を遮断すると、位相補償インピーダンスは、直列接続されたキャパシタ(C2)及び抵抗(R3)と、直列接続されたキャパシタ(C5)9500及びキャパシタ(C3)と、の並列接続により形成されることとなる。
(Step S1130)
The
(ステップS1140)
この位相補償インピーダンスは、直列接続されたキャパシタ(C2)及び抵抗(R3)と、キャパシタ(C5)9500と、の並列接続により形成される位相補償インピーダンスよりも増大する。従って、電圧エラーアンプ9080の応答速度が一時的に速くなり、出力電圧Voutのオーバーシュートが速やかに低減されて安定化されるような補償処理が迅速に遂行される。
(Step S1140)
This phase compensation impedance is larger than the phase compensation impedance formed by the parallel connection of the capacitor (C2) and the resistor (R3) connected in series with the capacitor (C5) 9500. Accordingly, the response speed of the
(ステップS1150)
昇圧型力率改善回路9000のタイマー部9400において、タイマーIC9410が作動した後、所定の一定期間(T)が経過したか否かを判断する。所定の一定期間(T)は、タイマーIC9410の(RX/CX)端子及び(CX)端子に接続される抵抗とコンデンサとの回路定数に基づいて予め定められる。
(Step S1150)
In the
タイマーIC9410が作動開始した後、所定の一定期間(T)が経過した場合にはステップS1160へと進み、タイマーIC9410が作動した後、所定の一定期間(T)が経過した場合でなければステップS1150で待機する。
If the predetermined period (T) has elapsed after the
第五の実施形態においては、一旦タイマーIC9410が作動開始した後は、仮に、電圧検出部9200がブースト回路9030の検出分圧出力が予め設定されたシャントレギュレータ(M1)9230のリファレンス値以下であると検出した場合であっても、所定の期間(T)が経過するまでの間は、MOSFET9300のゲートオフを継続させる動作となる。
In the fifth embodiment, once the
(ステップS1160)
タイマーIC9410が作動終了するとともに、タイマーIC9410の出力(OUT)からオン信号(ゲートオン電圧)が出力され、すなわちMOSFET9300のゲートがオンとなる。
昇圧型力率改善回路9000の位相補償部9090は、MOSFET(Q2)9300のソース−ドレイン間を導通させる。MOSFET(Q2)9300のソース−ドレイン間を導通させると、位相補償インピーダンスは、直列接続されたキャパシタ(C2)及び抵抗(R3)と、キャパシタ(C5)9500のみと、の並列接続により形成されることとなる。
(Step S1160)
When the
The
このため、直列接続されたキャパシタ(C2)及び抵抗(R3)と、直列接続されたキャパシタ(C5)9500及びキャパシタ(C3)と、の並列接続により形成される位相補償インピーダンスよりも低減される。従って、電圧エラーアンプ9080の応答速度が通常時に戻って遅くなり、昇圧型力率改善回路9000の力率が所望の高い効率に維持される。
For this reason, it is reduced from the phase compensation impedance formed by the parallel connection of the capacitor (C2) and the resistor (R3) connected in series, and the capacitor (C5) 9500 and the capacitor (C3) connected in series. Therefore, the response speed of the
より具体的には、ブースト回路9030の出力電圧Voutを抵抗(R6)9210と抵抗(R7)9220とにより分圧検出した値がリファレンスに入力されるシャントレギュレータ(M1)9230は、リファレンス入力が所定の設定値を超えなければ、アノードとカソードとの間を遮断する。これにより、シャントレギュレータ(M1)6230のカソードが接地電圧(オフ)となり、当該カソードに接続されるタイマーIC9410が作動停止した状態に維持されて出力(OUT)からオン信号が出力されるので、MOSFET(Q2)9300のゲートは、オン状態を維持する。
More specifically, the shunt regulator (M1) 9230, in which the value obtained by dividing the output voltage Vout of the
(ステップS1170)
昇圧型力率改善回路9000の動作を終了する場合には、このフローを終了する。また、昇圧型力率改善回路9000の動作を終了しない場合には、ステップS1100へと戻る。
(Step S1170)
When the operation of the boost type power
(ステップS1180)
昇圧型力率改善回路は、公知の通常動作を遂行する。
(Step S1180)
The boost type power factor correction circuit performs a known normal operation.
上述の説明においては、オーバーフローを低減させる動作について典型例として説明したが、これに限定されるものではなく、アンダーフローを低減させる構成としてもよいことは自明である。また、オーバーフローとアンダーフローとを共に低減させる回路構成としてもよい。 In the above description, the operation for reducing overflow has been described as a typical example. However, the present invention is not limited to this, and it is obvious that a configuration for reducing underflow may be used. Moreover, it is good also as a circuit structure which reduces both overflow and underflow.
第五の実施形態の昇圧型力率改善回路9000は、オーバーシュートが発生した後、所定の一定期間(T)が経過するまでの間は、継続して位相補償インピーダンスを増大させることにより応答速度を高く維持する。従って、所定の一定期間(T)を確実に脈動電圧が消滅する期間に設定しておくことにより、その間の脈動電圧の状況如何に何ら影響されることなく、安定して迅速な脈動電圧低減効果を得ることが可能となるので好ましい。
The step-up power
(第六の実施形態)
図13は、第六の実施形態にかかる昇圧型力率改善回路13000を説明する概念図である。図13においては、第三の実施形態にかかる昇圧型力率改善回路4000の構成と同一の部位には同一の符号を付してその説明を省略する。
(Sixth embodiment)
FIG. 13 is a conceptual diagram illustrating a step-up power
図13に示すように、昇圧型力率改善回路13000は、電圧エラーアンプ3080のフィードバックループに入る位相補償回路を切り替えて応答速度を制御することができる。
As shown in FIG. 13, the step-up power
すなわち、図13に示すスイッチ素子(SW)13100をオンにするかオフにするかにより、電圧エラーアンプ3080の負荷(位相補償インピーダンス)が異なるものとなり、これに対応して電圧エラーアンプ3080の応答速度が相違なるものとできる。
That is, the load (phase compensation impedance) of the
昇圧型力率改善回路13000は、電圧検出部3200における脈動成分による過大な電圧または過小な負電圧の検出有無に対応して、スイッチ素子(SW)13100を適宜オンまたは適宜オフとすることにより、電圧エラーアンプ3080の負荷を変更する。
The step-up power
例えば電圧検出部3200が脈動成分による過大な電圧を検出した場合には、スイッチ素子(SW)13100をオフとして電圧エラーアンプ3080の応答速度を向上(速く)させる。また、例えば電圧検出部3200が脈動成分による過小な負電圧を検出した場合には、スイッチ素子(SW)13100をオフとして電圧エラーアンプ3080の応答速度を向上(速く)させる。
For example, when the
一方、昇圧型力率改善回路13000は、電圧検出部3200において脈動成分による過大な電圧または過小な負電圧のいずれも検出しない場合には、スイッチ素子(SW)13100をオンとして電圧エラーアンプ3080の応答速度を通常状態のように遅くする。これにより、通常状態においては力率の悪化を招くことはない。
On the other hand, when the
(第七の実施形態)
図14は、第七の実施形態にかかる昇圧型力率改善回路14000を説明する概念図である。図14においては、第四の実施形態にかかる昇圧型力率改善回路6000の構成と同一の部位には同一の符号を付してその説明を省略する。
(Seventh embodiment)
FIG. 14 is a conceptual diagram for explaining a boost type power
図14に示すように、昇圧型力率改善回路14000は、電圧エラーアンプ6080のフィードバックループに入る位相補償回路を切り替えて応答速度を制御することができる。
As shown in FIG. 14, the step-up power
すなわち、図14に示すフォトモスリレー14100をオンにするかオフにするかにより、電圧エラーアンプ6080の負荷(位相補償インピーダンス)が異なるものとなり、これに対応して電圧エラーアンプ6080の応答速度が相違なるものとできる。
That is, the load (phase compensation impedance) of the
昇圧型力率改善回路14000は、電圧検出部6200における脈動成分による過大な電圧または過小な負電圧の検出有無に対応して、フォトモスリレー14100を適宜オンまたは適宜オフとすることにより、電圧エラーアンプ6080の負荷を変更する。
The step-up power
例えば電圧検出部6200が脈動成分による過大な電圧を検出した場合には、フォトモスリレー14100をオフとして電圧エラーアンプ6080の応答速度を向上(速く)させる。また、例えば電圧検出部6200が脈動成分による過小な負電圧を検出した場合には、フォトモスリレー14100をオフとして電圧エラーアンプ6080の応答速度を向上(速く)させる。
For example, when the
一方、昇圧型力率改善回路14000は、電圧検出部6200において脈動成分による過大な電圧または過小な負電圧のいずれも検出しない場合(すなわち検出電圧が所定の範囲内の場合)には、フォトモスリレー14100をオンとして電圧エラーアンプ6080の応答速度を通常状態のように遅くする。これにより、通常状態においては力率の悪化を招くことはない。
On the other hand, when the
上述の各実施形態で例示した昇圧型力率改善回路1000,3000,4000,6000,9000等は、各実施形態での説明に限定されるものではなく、各実施形態で説明する技術思想の範囲内かつ自明な範囲内で、適宜その構成や動作及び動作方法等を変更することができる。また、説明の便宜上各実施形態ごとに個別に説明しているが、各実施形態の構成を適宜組み合わせて適用し、またその動作も適宜組み合わせてアレンジしてもよい。
The boost type power
本発明の昇圧型力率改善回路は、各種の電源装置として広く適用できる。 The boost type power factor correction circuit of the present invention can be widely applied as various power supply devices.
1000・・昇圧型力率改善回路、1010・・交流電源、1020・・全波整流回路、1030・・ブースト回路、1031・・スイッチ素子、1032・・インダクタ(L1)、1033・・整流ダイオード(D1)、1034・・平滑コンデンサ(C1)、1050・・入力検出回路、1060・・乗算器、1070・・コンパレータ、1080・・電圧エラーアンプ(誤差増幅器)、1090・・位相補償部。
1000 ... Boost power
Claims (8)
ブースト回路の出力電圧が所定の範囲外になった場合に、電圧エラーアンプの位相補償インピーダンスを増大させて前記電圧エラーアンプの応答速度を速くする位相補償部を備える
ことを特徴とする昇圧型力率改善回路。 In the boost type power factor correction circuit that improves the power factor,
A step-up type force characterized by comprising a phase compensator that increases the phase compensation impedance of the voltage error amplifier to increase the response speed of the voltage error amplifier when the output voltage of the boost circuit falls outside a predetermined range. Rate improvement circuit.
前記位相補償部は、前記電圧エラーアンプの出力とグランドとの間に配置されたスイッチ素子を備え、前記出力電圧が所定の範囲外になった場合に、前記スイッチ素子を切り替えて前記位相補償インピーダンスを増大させる
ことを特徴とする昇圧型力率改善回路。 The step-up power factor correction circuit according to claim 1,
The phase compensation unit includes a switch element disposed between the output of the voltage error amplifier and the ground, and switches the switch element when the output voltage is out of a predetermined range to switch the phase compensation impedance. Boost type power factor correction circuit characterized by increasing
前記位相補償部は、前記スイッチ素子に直列に接続されたコンデンサを備え、前記出力電圧が所定の範囲内である場合に前記スイッチ素子を導通させ、前記出力電圧が所定の範囲外になった場合に前記スイッチ素子を遮断して、前記位相補償インピーダンスを増大させる
ことを特徴とする昇圧型力率改善回路。 The step-up power factor correction circuit according to claim 2,
The phase compensation unit includes a capacitor connected in series to the switch element, and conducts the switch element when the output voltage is within a predetermined range, and the output voltage is out of the predetermined range. The step-up power factor correction circuit is characterized in that the phase compensation impedance is increased by shutting off the switch element.
前記位相補償部は、前記スイッチ素子に並列に接続されたコンデンサを備え、前記出力電圧が所定の範囲内である場合に前記スイッチ素子を導通させ、前記出力電圧が所定の範囲外になった場合に前記スイッチ素子を遮断して、前記位相補償インピーダンスを増大させる
ことを特徴とする昇圧型力率改善回路。 The step-up power factor correction circuit according to claim 3,
The phase compensation unit includes a capacitor connected in parallel to the switch element, and conducts the switch element when the output voltage is within a predetermined range, and the output voltage is out of the predetermined range. The step-up power factor correction circuit is characterized in that the phase compensation impedance is increased by shutting off the switch element.
前記ブースト回路の出力電圧が所定の範囲外になった場合に、電圧エラーアンプの位相補償インピーダンスを所定の一定時間だけ増大させて、前記電圧エラーアンプの応答速度を前記所定の一定時間だけ速くするように時間計測するタイマー部を備える
ことを特徴とする昇圧型力率改善回路。 The step-up power factor correction circuit according to any one of claims 1 to 4,
When the output voltage of the boost circuit is outside a predetermined range, the phase compensation impedance of the voltage error amplifier is increased by a predetermined constant time, and the response speed of the voltage error amplifier is increased by the predetermined constant time. A booster type power factor correction circuit comprising a timer unit for measuring time as described above.
ブースト回路の出力電圧が所定の範囲外となった場合に、電圧エラーアンプの出力端子−マイナス端子間の負荷に並列に追加されているコンデンサの接続を解除し、前記電圧エラーアンプの応答速度を速くする位相補償部を備える
ことを特徴とする昇圧型力率改善回路。 In the boost type power factor correction circuit that improves the power factor,
When the output voltage of the boost circuit is outside the specified range, disconnect the capacitor added in parallel to the load between the output terminal and the negative terminal of the voltage error amplifier, and the response speed of the voltage error amplifier A step-up type power factor correction circuit comprising a phase compensation unit for speeding up.
前記位相補償部は、
前記コンデンサに直列接続されて、前記ブースト回路の出力電圧が所定の範囲外になった場合にオフ動作して前記コンデンサの並列接続を解除することで前記電圧エラーアンプの応答速度を速くし、前記ブースト回路の出力電圧が所定の範囲内である場合にオン動作して前記コンデンサの並列接続を確立することで前記電圧エラーアンプの応答速度を遅くするフォトモスリレーを備える
ことを特徴とする昇圧型力率改善回路。 The step-up power factor correction circuit according to claim 6,
The phase compensation unit includes:
When the output voltage of the boost circuit is out of a predetermined range when connected in series with the capacitor, the response speed of the voltage error amplifier is increased by releasing the parallel connection of the capacitor by turning off the capacitor. A step-up type comprising a photo MOS relay that turns on when the output voltage of the boost circuit is within a predetermined range and establishes parallel connection of the capacitors to slow down the response speed of the voltage error amplifier. Power factor correction circuit.
前記ブースト回路の出力電圧が所定の範囲外となった場合に、電圧エラーアンプの出力端子−マイナス端子間の負荷に並列に追加されているコンデンサの接続を所定の一定時間だけ解除させるタイマー部を備える
ことを特徴とする昇圧型力率改善回路。 In the boost type power factor correction circuit according to any one of claims 6 and 7,
A timer unit for releasing the connection of the capacitor added in parallel to the load between the output terminal and the minus terminal of the voltage error amplifier for a predetermined fixed time when the output voltage of the boost circuit is out of the predetermined range; A boost type power factor correction circuit comprising:
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2012249722A JP2014099970A (en) | 2012-11-13 | 2012-11-13 | Power factor improvement circuit |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2012249722A JP2014099970A (en) | 2012-11-13 | 2012-11-13 | Power factor improvement circuit |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2014099970A true JP2014099970A (en) | 2014-05-29 |
Family
ID=50941533
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2012249722A Withdrawn JP2014099970A (en) | 2012-11-13 | 2012-11-13 | Power factor improvement circuit |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2014099970A (en) |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR101773111B1 (en) | 2016-12-09 | 2017-08-31 | 주식회사 현대에너지 | Device for controlling automatic power factor |
JP2017175893A (en) * | 2016-03-25 | 2017-09-28 | 東芝ライテック株式会社 | Power supply device and lighting system including power supply device |
JP2018067986A (en) * | 2016-10-17 | 2018-04-26 | コーセル株式会社 | Switching power supply device |
KR20190095806A (en) * | 2018-02-07 | 2019-08-16 | 삼성전자주식회사 | Apparatus for Power Conversion and AC to DC Conversion |
EP3594774A1 (en) * | 2018-07-12 | 2020-01-15 | Infineon Technologies Austria AG | Pole-zero tracking compensation network for voltage regulators |
-
2012
- 2012-11-13 JP JP2012249722A patent/JP2014099970A/en not_active Withdrawn
Cited By (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2017175893A (en) * | 2016-03-25 | 2017-09-28 | 東芝ライテック株式会社 | Power supply device and lighting system including power supply device |
JP2018067986A (en) * | 2016-10-17 | 2018-04-26 | コーセル株式会社 | Switching power supply device |
KR101773111B1 (en) | 2016-12-09 | 2017-08-31 | 주식회사 현대에너지 | Device for controlling automatic power factor |
KR20190095806A (en) * | 2018-02-07 | 2019-08-16 | 삼성전자주식회사 | Apparatus for Power Conversion and AC to DC Conversion |
KR102579291B1 (en) | 2018-02-07 | 2023-09-18 | 삼성전자주식회사 | Apparatus for Power Conversion and AC to DC Conversion |
EP3594774A1 (en) * | 2018-07-12 | 2020-01-15 | Infineon Technologies Austria AG | Pole-zero tracking compensation network for voltage regulators |
CN110716602A (en) * | 2018-07-12 | 2020-01-21 | 英飞凌科技奥地利有限公司 | Pole-zero tracking compensation network for voltage regulators |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP6528561B2 (en) | High efficiency power factor correction circuit and switching power supply | |
US9716426B2 (en) | Switching power supply circuit | |
US8248040B2 (en) | Time-limiting mode (TLM) for an interleaved power factor correction (PFC) converter | |
JP4774987B2 (en) | Switching power supply | |
US9543839B2 (en) | Voltage stabilizing circuit | |
US8248041B2 (en) | Frequency compression for an interleaved power factor correction (PFC) converter | |
US20080049452A1 (en) | Ultralow Power stan-By Supply | |
US9362832B2 (en) | Intermediate bus architecture power supply | |
US10050517B1 (en) | Power supply apparatus converting input voltage to predetermined output voltage and controlling output voltage based on feedback signal corresponding to output voltage | |
WO2012027719A1 (en) | Power converter with boost-buck-buck configuration | |
KR20160061907A (en) | Power factor improvement circuit | |
JP2014099970A (en) | Power factor improvement circuit | |
JPH07322602A (en) | Power supply device | |
KR101851930B1 (en) | Ac-dc converter | |
KR20150067510A (en) | Apparatus and Method for controlling charge for battery | |
JP2011109788A (en) | Rush current limiting circuit | |
JP4806455B2 (en) | Switching power supply and switching method | |
US20110210710A1 (en) | Step-up dc-dc converter and semiconductor integrated circuit device | |
JP2013063003A (en) | Boost circuit, dc-dc converter having the same, power supply device, and operation method of boost circuit | |
US9337733B2 (en) | Adaptive pre-charge voltage converter | |
KR101804773B1 (en) | Ac-dc converter circuit with ripple eliminating function | |
WO2021027675A1 (en) | Switching power supply device | |
US20140092644A1 (en) | Switching power supply device and method for circuit design of the switching power supply device | |
JP2008099395A (en) | Dc-dc converter | |
JP6692168B2 (en) | Power storage device having UPS function and method of controlling power storage device having UPS function |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20140909 |
|
RD02 | Notification of acceptance of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7422 Effective date: 20150302 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A821 Effective date: 20150303 |
|
RD04 | Notification of resignation of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7424 Effective date: 20150303 |
|
A761 | Written withdrawal of application |
Free format text: JAPANESE INTERMEDIATE CODE: A761 Effective date: 20150710 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20150722 |