JP2013219724A - Power amplifier module - Google Patents

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Kenji Mukai
謙治 向井
Kenichi Horiguchi
健一 堀口
Morishige Hieda
護重 檜枝
Naoko Nitta
直子 新田
Katsuya Kato
勝也 嘉藤
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Abstract

PROBLEM TO BE SOLVED: To provide a power amplifier module capable of reducing a chip area formed on a gallium arsenide substrate without degrading high frequency characteristics.SOLUTION: A reference voltage circuit 4, a control circuit 5 and a regulator circuit 6 are formed on a silicon substrate 8, and an amplifier 1 and a bias circuit 7 are formed on a gallium arsenide substrate 9. Thus, a chip area formed on the gallium arsenide substrate 9 can be reduced without degrading high frequency characteristics.

Description

この発明は、RF信号を増幅する多段増幅器を実装している電力増幅器モジュールに関するものである。   The present invention relates to a power amplifier module in which a multistage amplifier for amplifying an RF signal is mounted.

図15は以下の非特許文献1に開示されている電力増幅器モジュールを示す構成図である。
図15において、増幅部101は1〜N段の増幅器から構成されており、RF入力端子102から入力されたRF信号を増幅し、増幅後のRF信号をRF出力端子103に出力する。
基準電圧回路104はイネーブル電圧が印加されると、基準電圧を生成する回路である。
レギュレータ回路105は基準電圧回路104により生成された基準電圧を用いて、駆動用の定電圧を生成する回路である。
FIG. 15 is a configuration diagram showing a power amplifier module disclosed in Non-Patent Document 1 below.
In FIG. 15, the amplifying unit 101 includes 1 to N stage amplifiers, amplifies the RF signal input from the RF input terminal 102, and outputs the amplified RF signal to the RF output terminal 103.
The reference voltage circuit 104 is a circuit that generates a reference voltage when an enable voltage is applied.
The regulator circuit 105 is a circuit that generates a driving constant voltage using the reference voltage generated by the reference voltage circuit 104.

制御回路106は所定の閾値より高い制御電圧が印加されると、起動を指示する制御信号を出力する回路である。
バイアス回路107は制御回路106から制御信号が出力されている場合、レギュレータ回路105により生成された定電圧を用いて、増幅部101を構成している1〜N段の増幅器にバイアスをかける回路である。
The control circuit 106 is a circuit that outputs a control signal instructing activation when a control voltage higher than a predetermined threshold is applied.
When a control signal is output from the control circuit 106, the bias circuit 107 is a circuit that biases the 1 to N-stage amplifiers constituting the amplification unit 101 using the constant voltage generated by the regulator circuit 105. is there.

この電力増幅器モジュールでは、基準電圧回路104とレギュレータ回路105がシリコン基板108上に形成され、増幅部101、制御回路106及びバイアス回路107が、高周波特性に優れる化合物半導体であるガリウム砒素(GaAs)基板109上に形成されている。
なお、増幅部101は、電力増幅器モジュールの高周波特性を維持するために、ガリウム砒素基板109上に形成されている。また、増幅部101と、制御回路106及びバイアス回路107とが異なる基板に形成されると、双方の基板の温度などが相違してしまうために、適正なバイアスを1〜N段の増幅器にかけられなくなることがあることを考慮して、同一のガリウム砒素基板109上に形成されるのが一般的である。
In this power amplifier module, a reference voltage circuit 104 and a regulator circuit 105 are formed on a silicon substrate 108, and an amplifying unit 101, a control circuit 106, and a bias circuit 107 are gallium arsenide (GaAs) substrates that are compound semiconductors having excellent high frequency characteristics. 109 is formed.
The amplifying unit 101 is formed on the gallium arsenide substrate 109 in order to maintain the high frequency characteristics of the power amplifier module. In addition, if the amplification unit 101, the control circuit 106, and the bias circuit 107 are formed on different substrates, the temperatures of the two substrates are different, so that an appropriate bias can be applied to the 1-N stage amplifier. In consideration of the fact that it may disappear, it is generally formed on the same gallium arsenide substrate 109.

G.Hau et al., “A 3x3mm2 Embedded-Wafer-Level Packaged WCDMA GaAs HBT Power Amplifier Module with Integrated Si DC Power Management IC,” IEEE RFIC Symposium Dig.,pp.409-412,June 2008G.Hau et al., “A 3x3mm2 Embedded-Wafer-Level Packaged WCDMA GaAs HBT Power Amplifier Module with Integrated Si DC Power Management IC,” IEEE RFIC Symposium Dig., Pp.409-412, June 2008

従来の電力増幅器モジュールは以上のように構成されているので、増幅部101、制御回路106及びバイアス回路107が同一のガリウム砒素基板109上に形成され、チップ単価が高いガリウム砒素基板109に形成されるチップ面積が大きくなる。このため、
製造コストが高価になるなどの課題があった。
Since the conventional power amplifier module is configured as described above, the amplifier 101, the control circuit 106, and the bias circuit 107 are formed on the same gallium arsenide substrate 109, and are formed on the gallium arsenide substrate 109 having a high unit cost. This increases the chip area. For this reason,
There were problems such as high manufacturing costs.

この発明は上記のような課題を解決するためになされたもので、高周波特性を損なうことなく、ガリウム砒素基板に形成されるチップ面積を削減することができる電力増幅器モジュールを得ることを目的とする。   The present invention has been made to solve the above-described problems, and an object thereof is to obtain a power amplifier module capable of reducing the chip area formed on the gallium arsenide substrate without impairing the high frequency characteristics. .

この発明に係る電力増幅器モジュールは、複数段の増幅器から構成されており、入力信号を増幅して出力する増幅部と、基準電圧を生成する基準電圧回路と、印加される制御電圧にしたがって起動を指示する制御信号を出力する制御回路と、制御回路から制御信号が出力されている場合、基準電圧回路により生成された基準電圧を用いて、駆動用の定電圧を生成するレギュレータ回路と、制御回路から制御信号が出力されている場合、レギュレータ回路により生成された定電圧を用いて、増幅部を構成している増幅器にバイアスをかけるバイアス回路とを備え、基準電圧回路、制御回路及びレギュレータ回路がシリコン基板上に形成され、増幅部及びバイアス回路がガリウム砒素基板上に形成されているようにしたものである。   The power amplifier module according to the present invention includes a plurality of stages of amplifiers, and amplifies an input signal and outputs it, a reference voltage circuit that generates a reference voltage, and starts up according to an applied control voltage. A control circuit that outputs a control signal to be instructed; a regulator circuit that generates a constant voltage for driving using a reference voltage generated by a reference voltage circuit when the control signal is output from the control circuit; and a control circuit When a control signal is output from, a bias circuit that biases an amplifier that constitutes an amplifying unit using a constant voltage generated by a regulator circuit is provided, and a reference voltage circuit, a control circuit, and a regulator circuit are provided. The amplifying part and the bias circuit are formed on a gallium arsenide substrate, which is formed on a silicon substrate.

この発明によれば、基準電圧回路、制御回路及びレギュレータ回路がシリコン基板上に形成され、増幅部及びバイアス回路がガリウム砒素基板上に形成されているように構成したので、高周波特性を損なうことなく、ガリウム砒素基板に形成されるチップ面積を削減することができる効果がある。   According to the present invention, the reference voltage circuit, the control circuit, and the regulator circuit are formed on the silicon substrate, and the amplifier unit and the bias circuit are formed on the gallium arsenide substrate, so that the high frequency characteristics are not impaired. The chip area formed on the gallium arsenide substrate can be reduced.

この発明の実施の形態1による電力増幅器モジュールを示す構成図である。It is a block diagram which shows the power amplifier module by Embodiment 1 of this invention. この発明の実施の形態2による電力増幅器モジュールを示す構成図である。It is a block diagram which shows the power amplifier module by Embodiment 2 of this invention. この発明の実施の形態2による他の電力増幅器モジュールを示す構成図である。It is a block diagram which shows the other power amplifier module by Embodiment 2 of this invention. この発明の実施の形態2による他の電力増幅器モジュールを示す構成図である。It is a block diagram which shows the other power amplifier module by Embodiment 2 of this invention. この発明の実施の形態3による電力増幅器モジュールを示す構成図である。It is a block diagram which shows the power amplifier module by Embodiment 3 of this invention. この発明の実施の形態4による電力増幅器モジュールを示す構成図である。It is a block diagram which shows the power amplifier module by Embodiment 4 of this invention. この発明の実施の形態5による電力増幅器モジュールを示す構成図である。It is a block diagram which shows the power amplifier module by Embodiment 5 of this invention. この発明の実施の形態6による電力増幅器モジュールを示す構成図である。It is a block diagram which shows the power amplifier module by Embodiment 6 of this invention. この発明の実施の形態7による電力増幅器モジュールを示す構成図である。It is a block diagram which shows the power amplifier module by Embodiment 7 of this invention. この発明の実施の形態8による電力増幅器モジュールを示す構成図である。It is a block diagram which shows the power amplifier module by Embodiment 8 of this invention. この発明の実施の形態9による電力増幅器モジュールを示す構成図である。It is a block diagram which shows the power amplifier module by Embodiment 9 of this invention. この発明の実施の形態10による電力増幅器モジュールを示す構成図である。It is a block diagram which shows the power amplifier module by Embodiment 10 of this invention. この発明の実施の形態11による電力増幅器モジュールを示す構成図である。It is a block diagram which shows the power amplifier module by Embodiment 11 of this invention. この発明の実施の形態12による電力増幅器モジュールを示す構成図である。It is a block diagram which shows the power amplifier module by Embodiment 12 of this invention. 非特許文献1に開示されている電力増幅器モジュールを示す構成図である。1 is a configuration diagram illustrating a power amplifier module disclosed in Non-Patent Document 1. FIG.

実施の形態1.
図1はこの発明の実施の形態1による電力増幅器モジュールを示す構成図である。
図1において、増幅部1は1〜N段の増幅器1aから構成されており、RF入力端子2から入力されたRF信号を増幅し、増幅後のRF信号をRF出力端子3に出力する処理を実施する。
なお、増幅部1は図示していない入力整合回路、段間整合回路及び出力整合回路を実装している場合がある。また、入力整合回路、段間整合回路及び出力整合回路の一部もしくは全部を実装していない場合もある。
Embodiment 1 FIG.
1 is a block diagram showing a power amplifier module according to Embodiment 1 of the present invention.
In FIG. 1, the amplifying unit 1 includes 1 to N stage amplifiers 1 a, and a process of amplifying an RF signal input from the RF input terminal 2 and outputting the amplified RF signal to the RF output terminal 3. carry out.
The amplifying unit 1 may include an input matching circuit, an interstage matching circuit, and an output matching circuit that are not shown. In some cases, some or all of the input matching circuit, the interstage matching circuit, and the output matching circuit are not mounted.

基準電圧回路4はイネーブル電圧が印加されると、基準電圧を生成する回路である。
制御回路5は印加される制御電圧にしたがって起動を指示する制御信号を出力する回路である。即ち、制御回路5は、例えば、所定の閾値より高い制御電圧が印加されると、起動を指示する制御信号を出力する回路である。
レギュレータ回路6は制御回路5から制御信号が出力されている場合、基準電圧回路4により生成された基準電圧を用いて、駆動用の定電圧を生成する回路である。
バイアス回路7は制御回路5から制御信号が出力されている場合、レギュレータ回路6により生成された定電圧を用いて、増幅部1を構成している1〜N段の増幅器1aにバイアスをかける回路である。
The reference voltage circuit 4 is a circuit that generates a reference voltage when an enable voltage is applied.
The control circuit 5 is a circuit that outputs a control signal instructing activation in accordance with an applied control voltage. That is, for example, the control circuit 5 is a circuit that outputs a control signal instructing activation when a control voltage higher than a predetermined threshold is applied.
The regulator circuit 6 is a circuit that generates a constant voltage for driving using the reference voltage generated by the reference voltage circuit 4 when a control signal is output from the control circuit 5.
The bias circuit 7 is a circuit that biases the 1 to N-stage amplifiers 1 a constituting the amplification unit 1 using the constant voltage generated by the regulator circuit 6 when a control signal is output from the control circuit 5. It is.

図1の電力増幅器モジュールでは、基準電圧回路4、制御回路5及びレギュレータ回路6がシリコン基板8上に形成され、増幅部1及びバイアス回路7が、高周波特性に優れる化合物半導体であるガリウム砒素基板9上に形成されている。
なお、増幅部1は、電力増幅器モジュールの高周波特性を維持するために、ガリウム砒素基板9上に形成されている。
増幅部1とバイアス回路7が異なる基板に形成されると、双方の基板の温度などが相違してしまうために、適正なバイアスを1〜N段の増幅器1aにかけられなくなることがあることを考慮して、同一のガリウム砒素基板9上に形成しているが、制御回路5は増幅部1と異なる基板上に形成されても、レギュレータ回路6及びバイアス回路7の起動を制御する上で、大きな支障がないため、増幅部1が形成されているガリウム砒素基板9と異なるシリコン基板8上に形成している。
In the power amplifier module of FIG. 1, a reference voltage circuit 4, a control circuit 5 and a regulator circuit 6 are formed on a silicon substrate 8, and an amplifying unit 1 and a bias circuit 7 are gallium arsenide substrates 9 which are compound semiconductors having excellent high frequency characteristics. Formed on top.
The amplifier 1 is formed on the gallium arsenide substrate 9 in order to maintain the high frequency characteristics of the power amplifier module.
Considering that if the amplifying unit 1 and the bias circuit 7 are formed on different substrates, the temperatures of the two substrates are different, so that an appropriate bias may not be applied to the 1-N stage amplifier 1a. Although the control circuit 5 is formed on the same substrate as the gallium arsenide substrate 9, the control circuit 5 is large in controlling the activation of the regulator circuit 6 and the bias circuit 7 even if formed on a substrate different from the amplifier 1. Since there is no hindrance, it is formed on a silicon substrate 8 different from the gallium arsenide substrate 9 on which the amplification section 1 is formed.

次に動作について説明する。
基準電圧回路4は、イネーブル電圧が印加されると、基準電圧を生成して、その基準電圧をレギュレータ回路6に印加する。
制御回路5は、所定の閾値より高い制御電圧が印加されると、起動を指示する制御信号をレギュレータ回路6及びバイアス回路7に出力する。
Next, the operation will be described.
When the enable voltage is applied, the reference voltage circuit 4 generates a reference voltage and applies the reference voltage to the regulator circuit 6.
When a control voltage higher than a predetermined threshold is applied, the control circuit 5 outputs a control signal instructing activation to the regulator circuit 6 and the bias circuit 7.

レギュレータ回路6は、制御回路5から制御信号が出力されている場合、基準電圧回路4により生成された基準電圧を用いて、駆動用の定電圧を生成し、その定電圧をバイアス回路7に印加する。
バイアス回路7は、制御回路5から制御信号が出力されている場合、レギュレータ回路6により生成された定電圧を用いて、増幅部1を構成している1〜N段の増幅器1aにバイアスをかける。
When a control signal is output from the control circuit 5, the regulator circuit 6 generates a driving constant voltage using the reference voltage generated by the reference voltage circuit 4, and applies the constant voltage to the bias circuit 7. To do.
When a control signal is output from the control circuit 5, the bias circuit 7 applies a bias to the 1 to N-stage amplifier 1 a constituting the amplification unit 1 using the constant voltage generated by the regulator circuit 6. .

ここで、増幅部1を構成している1〜N段の増幅器1aであるトランジスタのコレクタ(または、ドレイン)にはVcc電圧が印加されており、Vcc電圧が印加されることで、トランジスタのコレクタ(または、ドレイン)の電圧・電流が設定されている。
また、1〜N段の増幅器1aであるトランジスタのベース(または、ゲート)には、バイアス回路7によりバイアス電圧が印加されており、そのバイアス電圧が印加されることで、トランジスタのベース(または、ゲート)の電圧・電流が設定されている。
このように、トランジスタのコレクタ(または、ドレイン)及びベース(または、ゲート)の電圧・電流が設定されることで、増幅部1が駆動する。これにより、RF入力端子2から入力されたRF信号が増幅部1で増幅され、増幅後のRF信号がRF出力端子3から出力される。
なお、電力増幅器モジュールには電源電圧が印加されており、その電源電圧が電力増幅器モジュールの各構成要素に供給されている。
Here, the Vcc voltage is applied to the collector (or drain) of the transistor which is the 1 to N stage amplifier 1a constituting the amplifying unit 1, and the collector of the transistor is applied by applying the Vcc voltage. (Or drain) voltage / current is set.
Further, a bias voltage is applied by a bias circuit 7 to the base (or gate) of the transistor which is the 1-N stage amplifier 1a, and by applying the bias voltage, the base of the transistor (or Gate) voltage and current are set.
Thus, the amplifier 1 is driven by setting the voltage / current of the collector (or drain) and base (or gate) of the transistor. As a result, the RF signal input from the RF input terminal 2 is amplified by the amplifier 1, and the amplified RF signal is output from the RF output terminal 3.
A power supply voltage is applied to the power amplifier module, and the power supply voltage is supplied to each component of the power amplifier module.

以上で明らかなように、この実施の形態1によれば、基準電圧回路4、制御回路5及びレギュレータ回路6がシリコン基板8上に形成され、増幅部1及びバイアス回路7がガリウム砒素基板9上に形成されているように構成したので、高周波特性を損なうことなく、非特許文献1に開示されている電力増幅器モジュールと比べて、ガリウム砒素基板9に形成されるチップ面積を削減することができる効果を奏する。   As is apparent from the above, according to the first embodiment, the reference voltage circuit 4, the control circuit 5, and the regulator circuit 6 are formed on the silicon substrate 8, and the amplifier 1 and the bias circuit 7 are formed on the gallium arsenide substrate 9. Therefore, the chip area formed on the gallium arsenide substrate 9 can be reduced as compared with the power amplifier module disclosed in Non-Patent Document 1 without impairing the high-frequency characteristics. There is an effect.

実施の形態2.
図2はこの発明の実施の形態2による電力増幅器モジュールを示す構成図であり、図において、図1と同一符号は同一または相当部分を示すので説明を省略する。
上記実施の形態1では、基準電圧回路4、制御回路5及びレギュレータ回路6がシリコン基板8上に形成され、増幅部1及びバイアス回路7がガリウム砒素基板9上に形成されているものを示したが、図2に示すように、基準電圧回路4、制御回路5、レギュレータ回路6及びバイアス回路7がシリコン基板8上に形成され、増幅部1がガリウム砒素基板9上に形成されているようにしてもよい。
Embodiment 2. FIG.
FIG. 2 is a block diagram showing a power amplifier module according to Embodiment 2 of the present invention. In the figure, the same reference numerals as those in FIG.
In the first embodiment, the reference voltage circuit 4, the control circuit 5, and the regulator circuit 6 are formed on the silicon substrate 8, and the amplifier 1 and the bias circuit 7 are formed on the gallium arsenide substrate 9. However, as shown in FIG. 2, the reference voltage circuit 4, the control circuit 5, the regulator circuit 6 and the bias circuit 7 are formed on the silicon substrate 8, and the amplifier 1 is formed on the gallium arsenide substrate 9. May be.

この場合、上記実施の形態1よりも更にガリウム砒素基板9に形成されるチップ面積を削減することができる。
ただし、増幅部1とバイアス回路7が異なる基板に形成されており、双方の基板の温度などが相違してしまうために、適正なバイアスを1〜N段の増幅器1aにかけられなくなることがある。
双方の基板の温度などが相違する可能性が極めて低い状況下で使用される場合には、図2の電力増幅器モジュールを利用することが可能であるが、双方の基板の温度などが相違する可能性が高い状況下で使用される場合には、図3に示すように、温度を検知する温度検知回路10をガリウム砒素基板9上に形成するようにすればよい。
In this case, the chip area formed on the gallium arsenide substrate 9 can be further reduced as compared with the first embodiment.
However, since the amplifying unit 1 and the bias circuit 7 are formed on different substrates and the temperatures of the two substrates are different, an appropriate bias may not be applied to the 1-N stage amplifier 1a.
The power amplifier module of FIG. 2 can be used when used in a situation where the possibility that the temperatures of both substrates are different is very low, but the temperature of both substrates may be different. In the case where the device is used in a situation with high performance, a temperature detection circuit 10 for detecting temperature may be formed on the gallium arsenide substrate 9 as shown in FIG.

温度検知回路10がガリウム砒素基板9上に形成されている場合、レギュレータ回路6は、基準電圧回路4により生成された基準電圧を用いて、駆動用の定電圧を生成する際、温度検知回路10により検知された温度が上昇していれば、駆動用の定電圧の電圧値を小さくし、温度検知回路10により検知された温度が低下していれば、駆動用の定電圧の電圧値を大きくする。   When the temperature detection circuit 10 is formed on the gallium arsenide substrate 9, the regulator circuit 6 uses the reference voltage generated by the reference voltage circuit 4 to generate a driving constant voltage. If the temperature detected by the temperature detection circuit 10 is increased, the voltage value of the driving constant voltage is decreased. If the temperature detected by the temperature detection circuit 10 is decreased, the voltage value of the driving constant voltage is increased. To do.

バイアス回路7は、レギュレータ回路6により生成された定電圧を用いて、増幅部1を構成している1〜N段の増幅器1aに与えるバイアス電圧を生成するが、温度検知回路10により検知された温度が上昇していれば、電圧値が小さい定電圧を受けるため、1〜N段の増幅器1aに与えるバイアス電圧も小さくなる。
また、温度検知回路10により検知された温度が低下していれば、電圧値が大きい定電圧を受けるため、1〜N段の増幅器1aに与えるバイアス電圧も大きくなる。
これにより、温度検知回路10により検知された温度に応じて、1〜N段の増幅器1aにかけるバイアスが調整されるため、バイアス回路7とガリウム砒素基板9の温度が相違する可能性が高い状況下で使用される場合でも、電力増幅器モジュールを利用することができる。
The bias circuit 7 uses the constant voltage generated by the regulator circuit 6 to generate a bias voltage to be applied to the 1 to N-stage amplifiers 1 a constituting the amplifier unit 1, but is detected by the temperature detection circuit 10. If the temperature rises, a constant voltage having a small voltage value is received, so that the bias voltage applied to the 1-N stage amplifier 1a is also reduced.
Further, if the temperature detected by the temperature detection circuit 10 is lowered, a constant voltage having a large voltage value is received, so that the bias voltage applied to the 1 to N-stage amplifier 1a also increases.
Accordingly, since the bias applied to the 1-N stage amplifier 1a is adjusted according to the temperature detected by the temperature detection circuit 10, there is a high possibility that the temperatures of the bias circuit 7 and the gallium arsenide substrate 9 are different. Even when used below, a power amplifier module can be utilized.

ここでは、図2の電力増幅器モジュールに対して温度検知回路10を実装している例を示したが、図4に示すように、図1の電力増幅器モジュールに対して温度検知回路10を実装するようにしてもよい。   Here, the example in which the temperature detection circuit 10 is mounted on the power amplifier module of FIG. 2 has been shown. However, as shown in FIG. 4, the temperature detection circuit 10 is mounted on the power amplifier module of FIG. You may do it.

実施の形態3.
図5はこの発明の実施の形態3による電力増幅器モジュールを示す構成図であり、図において、図1と同一符号は同一または相当部分を示すので説明を省略する。
図5の電力増幅器モジュールは、図1の電力増幅器モジュールと比べて、増幅部1の内部構成が相違している。
図5の例では、温度検知回路10の記載を省略しているが、図4と同様に、温度検知回路10が実装されていてもよい。
Embodiment 3 FIG.
FIG. 5 is a block diagram showing a power amplifier module according to Embodiment 3 of the present invention. In the figure, the same reference numerals as those in FIG.
The power amplifier module of FIG. 5 differs from the power amplifier module of FIG. 1 in the internal configuration of the amplifying unit 1.
Although the description of the temperature detection circuit 10 is omitted in the example of FIG. 5, the temperature detection circuit 10 may be mounted as in FIG.

増幅部1は増幅経路11とバイパス経路15とが並列に接続されて構成されており、増幅経路11は1〜N段のドライバ段増幅器12、経路切替用スイッチ13及び最終段増幅器14の直列回路であり、バイパス経路15は経路切替用スイッチ16、バイパス増幅器17及び経路切替用スイッチ18の直列回路である。
なお、増幅部1は、図示していない入力整合回路、段間整合回路及び出力整合回路を実装している場合がある。また、入力整合回路、段間整合回路及び出力整合回路の一部もしくは全部を実装していない場合もある。
The amplifying unit 1 is configured by connecting an amplifying path 11 and a bypass path 15 in parallel, and the amplifying path 11 is a series circuit of 1 to N stage driver stage amplifiers 12, a path switching switch 13, and a final stage amplifier 14. The bypass path 15 is a series circuit of a path switch 16, a bypass amplifier 17 and a path switch 18.
The amplifying unit 1 may include an input matching circuit, an interstage matching circuit, and an output matching circuit that are not shown. In some cases, some or all of the input matching circuit, the interstage matching circuit, and the output matching circuit are not mounted.

制御回路5は増幅経路11の経路切替用スイッチ13及びバイパス経路15の経路切替用スイッチ16,18を制御する。
即ち、制御回路5は、RF出力端子3から高い電力のRF信号を出力させる場合、増幅経路11の経路切替用スイッチ13をオンに制御して、バイパス経路15の経路切替用スイッチ16,18をオフに制御し、RF出力端子3から低い電力のRF信号を出力させる場合、増幅経路11の経路切替用スイッチ13をオフに制御して、バイパス経路15の経路切替用スイッチ16,18をオンに制御する。
The control circuit 5 controls the path switching switch 13 of the amplification path 11 and the path switching switches 16 and 18 of the bypass path 15.
That is, when outputting a high power RF signal from the RF output terminal 3, the control circuit 5 controls the path switching switch 13 of the amplification path 11 to be turned on, and sets the path switching switches 16 and 18 of the bypass path 15. When the RF output terminal 3 is controlled to be turned off and a low power RF signal is output, the path switching switch 13 of the amplification path 11 is controlled to be turned off and the path switching switches 16 and 18 of the bypass path 15 are turned on. Control.

次に動作について説明する。
増幅部1及び制御回路5以外の処理内容は上記実施の形態1と同様であるため、主に増幅部1及び制御回路5の処理内容を説明する。
Next, the operation will be described.
Since the processing contents other than the amplifying unit 1 and the control circuit 5 are the same as those in the first embodiment, the processing contents of the amplifying unit 1 and the control circuit 5 will be mainly described.

制御回路5は、例えば、閾値Th1と閾値Th2が設定されており(Th1>Th2>0)、RF出力端子3から高い電力のRF信号を出力させるために、閾値Th1より高い制御電圧が印加されると、増幅経路11の経路切替用スイッチ13をオンに制御して、バイパス経路15の経路切替用スイッチ16,18をオフに制御する。これにより、RF入力端子2とRF出力端子3の間で、増幅経路11が導通状態になる。   In the control circuit 5, for example, a threshold Th1 and a threshold Th2 are set (Th1> Th2> 0), and a control voltage higher than the threshold Th1 is applied in order to output a high-power RF signal from the RF output terminal 3. Then, the path switching switch 13 of the amplification path 11 is controlled to be turned on, and the path switching switches 16 and 18 of the bypass path 15 are controlled to be turned off. As a result, the amplification path 11 becomes conductive between the RF input terminal 2 and the RF output terminal 3.

制御回路5は、経路切替用スイッチ13,16,18の制御が完了すると、起動を指示する制御信号をレギュレータ回路6及びバイアス回路7に出力する。
これにより、増幅経路11を構成しているドライバ段増幅器12及び最終段増幅器14にバイアスがかけられる。
即ち、バイアス回路7によって、トランジスタであるドライバ段増幅器12及び最終段増幅器14のベース(または、ゲート)にバイアス電圧が印加されることで、トランジスタのベース(または、ゲート)の電圧・電流が設定される。
また、トランジスタであるドライバ段増幅器12及び最終段増幅器14のコレクタ(または、ドレイン)にはVcc電圧が印加されており、Vcc電圧が印加されることで、トランジスタのコレクタ(または、ドレイン)の電圧・電流が設定されている。
なお、経路切替用スイッチ13,16,18の制御が完了してから、起動を指示する制御信号をレギュレータ回路6及びバイアス回路7に出力している理由は、回路内に不要なループ経路が発生することなく、安定な動作を可能にするためである。
When the control of the path switching switches 13, 16, 18 is completed, the control circuit 5 outputs a control signal instructing activation to the regulator circuit 6 and the bias circuit 7.
As a result, the driver stage amplifier 12 and the final stage amplifier 14 constituting the amplification path 11 are biased.
In other words, the bias circuit 7 applies a bias voltage to the base (or gate) of the driver stage amplifier 12 and the final stage amplifier 14 which are transistors, thereby setting the voltage / current of the base (or gate) of the transistor. Is done.
Further, the Vcc voltage is applied to the collector (or drain) of the driver stage amplifier 12 and the final stage amplifier 14 which are transistors, and the voltage of the collector (or drain) of the transistor is applied by applying the Vcc voltage.・ Current is set.
The reason why the control signal for instructing activation is output to the regulator circuit 6 and the bias circuit 7 after the control of the path switching switches 13, 16, 18 is completed is that an unnecessary loop path is generated in the circuit. This is to enable a stable operation without having to do so.

RF入力端子2から入力されたRF信号は、増幅経路11を構成しているドライバ段増幅器12及び最終段増幅器14で増幅され、増幅後のRF信号(高出力電力のRF信号)がRF出力端子3に出力される。   The RF signal input from the RF input terminal 2 is amplified by the driver stage amplifier 12 and the final stage amplifier 14 constituting the amplification path 11, and the amplified RF signal (RF signal having high output power) is amplified by the RF output terminal. 3 is output.

制御回路5は、RF出力端子3から低い電力のRF信号を出力させるために、閾値Th2より高く、閾値Th1より低い制御電圧が印加されると、増幅経路11の経路切替用スイッチ13をオフに制御して、バイパス経路15の経路切替用スイッチ16,18をオンに制御する。これにより、RF入力端子2とRF出力端子3の間で、バイパス経路15が導通状態になる。   When a control voltage higher than the threshold Th2 and lower than the threshold Th1 is applied to output a low-power RF signal from the RF output terminal 3, the control circuit 5 turns off the path switching switch 13 of the amplification path 11. And the path switching switches 16 and 18 of the bypass path 15 are turned on. As a result, the bypass path 15 becomes conductive between the RF input terminal 2 and the RF output terminal 3.

制御回路5は、経路切替用スイッチ13,16,18の制御が完了すると、起動を指示する制御信号をレギュレータ回路6及びバイアス回路7に出力する。
これにより、バイパス経路15を構成しているバイパス増幅器17にバイアスがかけられる。
即ち、バイアス回路7によって、トランジスタであるバイパス増幅器17のベース(または、ゲート)にバイアス電圧が印加されることで、トランジスタのベース(または、ゲート)の電圧・電流が設定される。
また、トランジスタであるバイパス増幅器17のコレクタ(または、ドレイン)にはVcc電圧が印加されており、Vcc電圧が印加されることで、トランジスタのコレクタ(または、ドレイン)の電圧・電流が設定されている。
なお、経路切替用スイッチ13,16,18の制御が完了してから、起動を指示する制御信号をレギュレータ回路6及びバイアス回路7に出力している理由は、回路内に不要なループ経路が発生することなく、安定な動作を可能にするためである。
When the control of the path switching switches 13, 16, 18 is completed, the control circuit 5 outputs a control signal instructing activation to the regulator circuit 6 and the bias circuit 7.
As a result, the bypass amplifier 17 constituting the bypass path 15 is biased.
That is, the bias circuit 7 applies a bias voltage to the base (or gate) of the bypass amplifier 17 that is a transistor, thereby setting the voltage / current of the base (or gate) of the transistor.
Further, the Vcc voltage is applied to the collector (or drain) of the bypass amplifier 17 that is a transistor, and the voltage / current of the collector (or drain) of the transistor is set by applying the Vcc voltage. Yes.
The reason why the control signal for instructing activation is output to the regulator circuit 6 and the bias circuit 7 after the control of the path switching switches 13, 16, 18 is completed is that an unnecessary loop path is generated in the circuit. This is to enable a stable operation without having to do so.

RF入力端子2から入力されたRF信号は、バイパス経路15を構成しているバイパス増幅器17で増幅され、増幅後のRF信号(低出力電力のRF信号)がRF出力端子3に出力される。   The RF signal input from the RF input terminal 2 is amplified by the bypass amplifier 17 constituting the bypass path 15, and the amplified RF signal (RF signal with low output power) is output to the RF output terminal 3.

なお、制御回路5は、閾値Th2より低い制御電圧が印加されると、起動を指示する制御信号をレギュレータ回路6及びバイアス回路7に出力しない。   Note that when a control voltage lower than the threshold Th2 is applied, the control circuit 5 does not output a control signal instructing activation to the regulator circuit 6 and the bias circuit 7.

この実施の形態3の場合も、上記実施の形態1と同様に、基準電圧回路4、制御回路5及びレギュレータ回路6がシリコン基板8上に形成され、増幅部1及びバイアス回路7がガリウム砒素基板9上に形成されているように構成したので、高周波特性を損なうことなく、非特許文献1に開示されている電力増幅器モジュールと比べて、ガリウム砒素基板9に形成されるチップ面積を削減することができる効果を奏する。   Also in the case of the third embodiment, as in the first embodiment, the reference voltage circuit 4, the control circuit 5, and the regulator circuit 6 are formed on the silicon substrate 8, and the amplifying unit 1 and the bias circuit 7 are formed on the gallium arsenide substrate. 9 is formed on the gallium arsenide substrate 9 as compared with the power amplifier module disclosed in Non-Patent Document 1 without impairing the high frequency characteristics. There is an effect that can.

実施の形態4.
図6はこの発明の実施の形態4による電力増幅器モジュールを示す構成図であり、図において、図2及び図5と同一符号は同一または相当部分を示すので説明を省略する。
上記実施の形態3では、基準電圧回路4、制御回路5及びレギュレータ回路6がシリコン基板8上に形成され、増幅部1及びバイアス回路7がガリウム砒素基板9上に形成されているものを示したが、図6に示すように、基準電圧回路4、制御回路5、レギュレータ回路6及びバイアス回路7がシリコン基板8上に形成され、増幅部1がガリウム砒素基板9上に形成されているようにしてもよい。
図6の例では、温度検知回路10の記載を省略しているが、図3と同様に、温度検知回路10が実装されていてもよい。
基本的な動作は上記実施の形態2,3と同様であるため詳細な説明を省略するが、この場合も、高周波特性を損なうことなく、非特許文献1に開示されている電力増幅器モジュールと比べて、ガリウム砒素基板9に形成されるチップ面積を削減することができる効果を奏する。
Embodiment 4 FIG.
6 is a block diagram showing a power amplifier module according to Embodiment 4 of the present invention. In the figure, the same reference numerals as those in FIGS.
In the third embodiment, the reference voltage circuit 4, the control circuit 5, and the regulator circuit 6 are formed on the silicon substrate 8, and the amplifier 1 and the bias circuit 7 are formed on the gallium arsenide substrate 9. However, as shown in FIG. 6, the reference voltage circuit 4, the control circuit 5, the regulator circuit 6 and the bias circuit 7 are formed on the silicon substrate 8, and the amplifier 1 is formed on the gallium arsenide substrate 9. May be.
Although the description of the temperature detection circuit 10 is omitted in the example of FIG. 6, the temperature detection circuit 10 may be mounted as in FIG.
Since the basic operation is the same as in the second and third embodiments, detailed description thereof is omitted, but in this case as well, compared with the power amplifier module disclosed in Non-Patent Document 1 without impairing the high frequency characteristics. As a result, the chip area formed on the gallium arsenide substrate 9 can be reduced.

実施の形態5.
図7はこの発明の実施の形態5による電力増幅器モジュールを示す構成図であり、図において、図1及び図5と同一符号は同一または相当部分を示すので説明を省略する。
図7の電力増幅器モジュールは、図1の電力増幅器モジュールと比べて、増幅部1の内部構成が相違している。
図7の例では、温度検知回路10の記載を省略しているが、図4と同様に、温度検知回路10が実装されていてもよい。
Embodiment 5 FIG.
FIG. 7 is a block diagram showing a power amplifier module according to Embodiment 5 of the present invention. In the figure, the same reference numerals as those in FIGS.
The power amplifier module of FIG. 7 differs from the power amplifier module of FIG. 1 in the internal configuration of the amplifying unit 1.
Although the description of the temperature detection circuit 10 is omitted in the example of FIG. 7, the temperature detection circuit 10 may be mounted as in FIG.

増幅部1は増幅経路11とバイパス経路19を備え、増幅経路11における経路切替用スイッチ13及び最終段増幅器14の直列回路と、バイパス経路19とが並列に接続されて構成されており、バイパス経路19は経路切替用スイッチ20、バイパス増幅器21及び経路切替用スイッチ22の直列回路である。
ただし、最終段増幅器14のサイズが、バイパス増幅器21のサイズより大きいサイズで構成されている。
なお、増幅部1は、図示していない入力整合回路、段間整合回路及び出力整合回路を実装している場合がある。また、入力整合回路、段間整合回路及び出力整合回路の一部もしくは全部を実装していない場合もある。
The amplification unit 1 includes an amplification path 11 and a bypass path 19, and is configured by connecting a series circuit of the path switching switch 13 and the final stage amplifier 14 in the amplification path 11 and the bypass path 19 in parallel. Reference numeral 19 denotes a series circuit of a path switching switch 20, a bypass amplifier 21 and a path switching switch 22.
However, the size of the final stage amplifier 14 is configured to be larger than the size of the bypass amplifier 21.
The amplifying unit 1 may include an input matching circuit, an interstage matching circuit, and an output matching circuit that are not shown. In some cases, some or all of the input matching circuit, the interstage matching circuit, and the output matching circuit are not mounted.

制御回路5は増幅経路11の経路切替用スイッチ13及びバイパス経路19の経路切替用スイッチ20,22を制御する。
即ち、制御回路5は、RF出力端子3から高い電力のRF信号を出力させる場合、増幅経路11の経路切替用スイッチ13をオンに制御して、バイパス経路19の経路切替用スイッチ20,22をオフに制御し、RF出力端子3から低い電力のRF信号を出力させる場合、増幅経路11の経路切替用スイッチ13をオフに制御して、バイパス経路19の経路切替用スイッチ20,22をオンに制御する。
The control circuit 5 controls the path switching switch 13 of the amplification path 11 and the path switching switches 20 and 22 of the bypass path 19.
That is, when the control circuit 5 outputs a high-power RF signal from the RF output terminal 3, the control circuit 5 controls the path switching switch 13 of the amplification path 11 to be on, and sets the path switching switches 20 and 22 of the bypass path 19. When the RF output terminal 3 is controlled to be turned off and a low-power RF signal is output from the RF output terminal 3, the path switching switch 13 of the amplification path 11 is controlled to be turned off and the path switching switches 20 and 22 of the bypass path 19 are turned on. Control.

次に動作について説明する。
増幅部1及び制御回路5以外の処理内容は上記実施の形態1と同様であるため、主に増幅部1及び制御回路5の処理内容を説明する。
Next, the operation will be described.
Since the processing contents other than the amplifying unit 1 and the control circuit 5 are the same as those in the first embodiment, the processing contents of the amplifying unit 1 and the control circuit 5 will be mainly described.

制御回路5は、例えば、閾値Th1と閾値Th2が設定されており(Th1>Th2>0)、RF出力端子3から高い電力のRF信号を出力させるために、閾値Th1より高い制御電圧が印加されると、増幅経路11の経路切替用スイッチ13をオンに制御して、バイパス経路19の経路切替用スイッチ20,22をオフに制御する。これにより、RF入力端子2とRF出力端子3の間で、増幅経路11が導通状態になる。   In the control circuit 5, for example, a threshold Th1 and a threshold Th2 are set (Th1> Th2> 0), and a control voltage higher than the threshold Th1 is applied in order to output a high-power RF signal from the RF output terminal 3. Then, the path switching switch 13 of the amplification path 11 is controlled to be turned on, and the path switching switches 20 and 22 of the bypass path 19 are controlled to be turned off. As a result, the amplification path 11 becomes conductive between the RF input terminal 2 and the RF output terminal 3.

制御回路5は、経路切替用スイッチ13,20,22の制御が完了すると、起動を指示する制御信号をレギュレータ回路6及びバイアス回路7に出力する。
これにより、増幅経路11を構成しているドライバ段増幅器12及び最終段増幅器14にバイアスがかけられる。
即ち、バイアス回路7によって、トランジスタであるドライバ段増幅器12及び最終段増幅器14のベース(または、ゲート)にバイアス電圧が印加されることで、トランジスタのベース(または、ゲート)の電圧・電流が設定される。
また、トランジスタであるドライバ段増幅器12及び最終段増幅器14のコレクタ(または、ドレイン)にはVcc電圧が印加されており、Vcc電圧が印加されることで、トランジスタのコレクタ(または、ドレイン)の電圧・電流が設定されている。
なお、経路切替用スイッチ13,20,22の制御が完了してから、起動を指示する制御信号をレギュレータ回路6及びバイアス回路7に出力している理由は、回路内に不要なループ経路が発生することなく、安定な動作を可能にするためである。
When the control of the path switching switches 13, 20, and 22 is completed, the control circuit 5 outputs a control signal instructing activation to the regulator circuit 6 and the bias circuit 7.
As a result, the driver stage amplifier 12 and the final stage amplifier 14 constituting the amplification path 11 are biased.
In other words, the bias circuit 7 applies a bias voltage to the base (or gate) of the driver stage amplifier 12 and the final stage amplifier 14 which are transistors, thereby setting the voltage / current of the base (or gate) of the transistor. Is done.
Further, the Vcc voltage is applied to the collector (or drain) of the driver stage amplifier 12 and the final stage amplifier 14 which are transistors, and the voltage of the collector (or drain) of the transistor is applied by applying the Vcc voltage.・ Current is set.
The reason why the control signal for instructing activation is output to the regulator circuit 6 and the bias circuit 7 after the control of the path switching switches 13, 20, and 22 is completed is that an unnecessary loop path is generated in the circuit. This is to enable a stable operation without having to do so.

RF入力端子2から入力されたRF信号は、増幅経路11を構成しているドライバ段増幅器12及び最終段増幅器14で増幅され、増幅後のRF信号(高出力電力のRF信号)がRF出力端子3に出力される。   The RF signal input from the RF input terminal 2 is amplified by the driver stage amplifier 12 and the final stage amplifier 14 constituting the amplification path 11, and the amplified RF signal (RF signal having high output power) is amplified by the RF output terminal. 3 is output.

制御回路5は、RF出力端子3から低い電力のRF信号を出力させるために、閾値Th2より高く、閾値Th1より低い制御電圧が印加されると、増幅経路11の経路切替用スイッチ13をオフに制御して、バイパス経路19の経路切替用スイッチ20,22をオンに制御する。これにより、RF入力端子2とRF出力端子3の間で、ドライバ段増幅器12及びバイパス経路19が導通状態になる。   When a control voltage higher than the threshold Th2 and lower than the threshold Th1 is applied to output a low-power RF signal from the RF output terminal 3, the control circuit 5 turns off the path switching switch 13 of the amplification path 11. And the path switching switches 20 and 22 of the bypass path 19 are turned on. As a result, the driver stage amplifier 12 and the bypass path 19 become conductive between the RF input terminal 2 and the RF output terminal 3.

制御回路5は、経路切替用スイッチ13,20,22の制御が完了すると、起動を指示する制御信号をレギュレータ回路6及びバイアス回路7に出力する。
これにより、ドライバ段増幅器12及びバイパス増幅器21にバイアスがかけられる。
即ち、バイアス回路7によって、トランジスタであるドライバ段増幅器12及びバイパス増幅器21のベース(または、ゲート)にバイアス電圧が印加されることで、トランジスタのベース(または、ゲート)の電圧・電流が設定される。
また、トランジスタであるドライバ段増幅器12及びバイパス増幅器21のコレクタ(または、ドレイン)にはVcc電圧が印加されており、Vcc電圧が印加されることで、トランジスタのコレクタ(または、ドレイン)の電圧・電流が設定されている。
なお、経路切替用スイッチ13,20,22の制御が完了してから、起動を指示する制御信号をレギュレータ回路6及びバイアス回路7に出力している理由は、回路内に不要なループ経路が発生することなく、安定な動作を可能にするためである。
When the control of the path switching switches 13, 20, and 22 is completed, the control circuit 5 outputs a control signal instructing activation to the regulator circuit 6 and the bias circuit 7.
As a result, the driver stage amplifier 12 and the bypass amplifier 21 are biased.
That is, the bias circuit 7 applies a bias voltage to the base (or gate) of the driver stage amplifier 12 and the bypass amplifier 21 that are transistors, thereby setting the voltage / current of the base (or gate) of the transistor. The
Further, the Vcc voltage is applied to the collector (or drain) of the driver stage amplifier 12 and the bypass amplifier 21 which are transistors, and by applying the Vcc voltage, the voltage of the collector (or drain) of the transistor Current is set.
The reason why the control signal for instructing activation is output to the regulator circuit 6 and the bias circuit 7 after the control of the path switching switches 13, 20, and 22 is completed is that an unnecessary loop path is generated in the circuit. This is to enable a stable operation without having to do so.

RF入力端子2から入力されたRF信号は、ドライバ段増幅器12及びバイパス増幅器21で増幅され、増幅後のRF信号(低出力電力のRF信号)がRF出力端子3に出力される。   The RF signal input from the RF input terminal 2 is amplified by the driver stage amplifier 12 and the bypass amplifier 21, and the amplified RF signal (low output power RF signal) is output to the RF output terminal 3.

なお、制御回路5は、閾値Th2より低い制御電圧が印加されると、起動を指示する制御信号をレギュレータ回路6及びバイアス回路7に出力しない。   Note that when a control voltage lower than the threshold Th2 is applied, the control circuit 5 does not output a control signal instructing activation to the regulator circuit 6 and the bias circuit 7.

この実施の形態5の場合も、上記実施の形態1と同様に、基準電圧回路4、制御回路5及びレギュレータ回路6がシリコン基板8上に形成され、増幅部1及びバイアス回路7がガリウム砒素基板9上に形成されているように構成したので、高周波特性を損なうことなく、非特許文献1に開示されている電力増幅器モジュールと比べて、ガリウム砒素基板9に形成されるチップ面積を削減することができる効果を奏する。   Also in the fifth embodiment, as in the first embodiment, the reference voltage circuit 4, the control circuit 5, and the regulator circuit 6 are formed on the silicon substrate 8, and the amplification unit 1 and the bias circuit 7 are formed on the gallium arsenide substrate. 9 is formed on the gallium arsenide substrate 9 as compared with the power amplifier module disclosed in Non-Patent Document 1 without impairing the high frequency characteristics. There is an effect that can.

実施の形態6.
図8はこの発明の実施の形態6による電力増幅器モジュールを示す構成図であり、図において、図2及び図7と同一符号は同一または相当部分を示すので説明を省略する。
上記実施の形態5では、基準電圧回路4、制御回路5及びレギュレータ回路6がシリコン基板8上に形成され、増幅部1及びバイアス回路7がガリウム砒素基板9上に形成されているものを示したが、図8に示すように、基準電圧回路4、制御回路5、レギュレータ回路6及びバイアス回路7がシリコン基板8上に形成され、増幅部1がガリウム砒素基板9上に形成されているようにしてもよい。
図8の例では、温度検知回路10の記載を省略しているが、図3と同様に、温度検知回路10が実装されていてもよい。
基本的な動作は上記実施の形態2,5と同様であるため詳細な説明を省略するが、この場合も、高周波特性を損なうことなく、非特許文献1に開示されている電力増幅器モジュールと比べて、ガリウム砒素基板9に形成されるチップ面積を削減することができる効果を奏する。
Embodiment 6 FIG.
FIG. 8 is a block diagram showing a power amplifier module according to Embodiment 6 of the present invention. In the figure, the same reference numerals as those in FIGS.
In the fifth embodiment, the reference voltage circuit 4, the control circuit 5, and the regulator circuit 6 are formed on the silicon substrate 8, and the amplifier 1 and the bias circuit 7 are formed on the gallium arsenide substrate 9. However, as shown in FIG. 8, the reference voltage circuit 4, the control circuit 5, the regulator circuit 6 and the bias circuit 7 are formed on the silicon substrate 8, and the amplifier 1 is formed on the gallium arsenide substrate 9. May be.
Although the description of the temperature detection circuit 10 is omitted in the example of FIG. 8, the temperature detection circuit 10 may be mounted as in FIG.
Since the basic operation is the same as in Embodiments 2 and 5 described above, detailed description is omitted, but in this case as well, compared with the power amplifier module disclosed in Non-Patent Document 1 without impairing the high-frequency characteristics. As a result, the chip area formed on the gallium arsenide substrate 9 can be reduced.

実施の形態7.
図9はこの発明の実施の形態7による電力増幅器モジュールを示す構成図であり、図において、図1及び図5と同一符号は同一または相当部分を示すので説明を省略する。
図9の電力増幅器モジュールは、図1の電力増幅器モジュールと比べて、増幅部1の内部構成が相違している。
図9の例では、温度検知回路10の記載を省略しているが、図4と同様に、温度検知回路10が実装されていてもよい。
Embodiment 7 FIG.
FIG. 9 is a block diagram showing a power amplifier module according to Embodiment 7 of the present invention. In the figure, the same reference numerals as those in FIGS.
The power amplifier module of FIG. 9 is different from the power amplifier module of FIG. 1 in the internal configuration of the amplification unit 1.
Although the description of the temperature detection circuit 10 is omitted in the example of FIG. 9, the temperature detection circuit 10 may be mounted as in FIG.

増幅部1は増幅経路11とバイパス経路23とが並列に接続されて構成されており、増幅経路11は1〜N段のドライバ段増幅器12、経路切替用スイッチ13及び最終段増幅器14の直列回路であり、バイパス経路23は経路切替用スイッチ24、バイパスドライバ段増幅器25、経路切替用スイッチ26及びバイパス最終段増幅器27の直列回路である。
ただし、最終段増幅器14のサイズが、バイパス最終段増幅器27のサイズより大きいサイズで構成されている。
なお、増幅部1は、図示していない入力整合回路、段間整合回路及び出力整合回路を実装している場合がある。また、入力整合回路、段間整合回路及び出力整合回路の一部もしくは全部を実装していない場合もある。
The amplifying unit 1 is configured by connecting an amplifying path 11 and a bypass path 23 in parallel, and the amplifying path 11 is a series circuit of 1 to N stage driver stage amplifiers 12, a path switching switch 13, and a final stage amplifier 14. The bypass path 23 is a series circuit of a path switching switch 24, a bypass driver stage amplifier 25, a path switching switch 26, and a bypass final stage amplifier 27.
However, the size of the final stage amplifier 14 is configured to be larger than the size of the bypass final stage amplifier 27.
The amplifying unit 1 may include an input matching circuit, an interstage matching circuit, and an output matching circuit that are not shown. In some cases, some or all of the input matching circuit, the interstage matching circuit, and the output matching circuit are not mounted.

制御回路5は増幅経路11の経路切替用スイッチ13及びバイパス経路23の経路切替用スイッチ24,26を制御する。
即ち、制御回路5は、RF出力端子3から高い電力のRF信号を出力させる場合、増幅経路11の経路切替用スイッチ13をオンに制御して、バイパス経路23の経路切替用スイッチ24,26をオフに制御し、RF出力端子3から低い電力のRF信号を出力させる場合、増幅経路11の経路切替用スイッチ13をオフに制御して、バイパス経路23の経路切替用スイッチ24,26をオンに制御する。
The control circuit 5 controls the path switching switch 13 of the amplification path 11 and the path switching switches 24 and 26 of the bypass path 23.
That is, when outputting a high-power RF signal from the RF output terminal 3, the control circuit 5 controls the path switching switch 13 of the amplification path 11 to be on, and sets the path switching switches 24 and 26 of the bypass path 23. When the RF output terminal 3 is controlled to be turned off and a low-power RF signal is output from the RF output terminal 3, the path switching switch 13 of the amplification path 11 is controlled to be turned off and the path switching switches 24 and 26 of the bypass path 23 are turned on. Control.

次に動作について説明する。
増幅部1及び制御回路5以外の処理内容は上記実施の形態1と同様であるため、主に増幅部1及び制御回路5の処理内容を説明する。
Next, the operation will be described.
Since the processing contents other than the amplifying unit 1 and the control circuit 5 are the same as those in the first embodiment, the processing contents of the amplifying unit 1 and the control circuit 5 will be mainly described.

制御回路5は、例えば、閾値Th1と閾値Th2が設定されており(Th1>Th2>0)、RF出力端子3から高い電力のRF信号を出力させるために、閾値Th1より高い制御電圧が印加されると、増幅経路11の経路切替用スイッチ13をオンに制御して、バイパス経路23の経路切替用スイッチ24,26をオフに制御する。これにより、RF入力端子2とRF出力端子3の間で、増幅経路11が導通状態になる。   In the control circuit 5, for example, a threshold Th1 and a threshold Th2 are set (Th1> Th2> 0), and a control voltage higher than the threshold Th1 is applied in order to output a high-power RF signal from the RF output terminal 3. Then, the path switching switch 13 of the amplification path 11 is controlled to be turned on, and the path switching switches 24 and 26 of the bypass path 23 are controlled to be turned off. As a result, the amplification path 11 becomes conductive between the RF input terminal 2 and the RF output terminal 3.

制御回路5は、経路切替用スイッチ13,24,26の制御が完了すると、起動を指示する制御信号をレギュレータ回路6及びバイアス回路7に出力する。
これにより、増幅経路11を構成しているドライバ段増幅器12及び最終段増幅器14にバイアスがかけられる。
即ち、バイアス回路7によって、トランジスタであるドライバ段増幅器12及び最終段増幅器14のベース(または、ゲート)にバイアス電圧が印加されることで、トランジスタのベース(または、ゲート)の電圧・電流が設定される。
また、トランジスタであるドライバ段増幅器12及び最終段増幅器14のコレクタ(または、ドレイン)にはVcc電圧が印加されており、Vcc電圧が印加されることで、トランジスタのコレクタ(または、ドレイン)の電圧・電流が設定されている。
なお、経路切替用スイッチ13,24,26の制御が完了してから、起動を指示する制御信号をレギュレータ回路6及びバイアス回路7に出力している理由は、回路内に不要なループ経路が発生することなく、安定な動作を可能にするためである。
When the control of the path switching switches 13, 24, 26 is completed, the control circuit 5 outputs a control signal instructing activation to the regulator circuit 6 and the bias circuit 7.
As a result, the driver stage amplifier 12 and the final stage amplifier 14 constituting the amplification path 11 are biased.
In other words, the bias circuit 7 applies a bias voltage to the base (or gate) of the driver stage amplifier 12 and the final stage amplifier 14 which are transistors, thereby setting the voltage / current of the base (or gate) of the transistor. Is done.
Further, the Vcc voltage is applied to the collector (or drain) of the driver stage amplifier 12 and the final stage amplifier 14 which are transistors, and the voltage of the collector (or drain) of the transistor is applied by applying the Vcc voltage.・ Current is set.
The reason why the control signal instructing activation is output to the regulator circuit 6 and the bias circuit 7 after the control of the path switching switches 13, 24, 26 is completed is that an unnecessary loop path is generated in the circuit. This is to enable a stable operation without having to do so.

RF入力端子2から入力されたRF信号は、増幅経路11を構成しているドライバ段増幅器12及び最終段増幅器14で増幅され、増幅後のRF信号(高出力電力のRF信号)がRF出力端子3に出力される。   The RF signal input from the RF input terminal 2 is amplified by the driver stage amplifier 12 and the final stage amplifier 14 constituting the amplification path 11, and the amplified RF signal (RF signal having high output power) is amplified by the RF output terminal. 3 is output.

制御回路5は、RF出力端子3から低い電力のRF信号を出力させるために、閾値Th2より高く、閾値Th1より低い制御電圧が印加されると、増幅経路11の経路切替用スイッチ13をオフに制御して、バイパス経路23の経路切替用スイッチ24,26をオンに制御する。これにより、RF入力端子2とRF出力端子3の間で、バイパス経路23が導通状態になる。   When a control voltage higher than the threshold Th2 and lower than the threshold Th1 is applied to output a low-power RF signal from the RF output terminal 3, the control circuit 5 turns off the path switching switch 13 of the amplification path 11. And the path switching switches 24 and 26 of the bypass path 23 are turned on. As a result, the bypass path 23 becomes conductive between the RF input terminal 2 and the RF output terminal 3.

制御回路5は、経路切替用スイッチ13,24,26の制御が完了すると、起動を指示する制御信号をレギュレータ回路6及びバイアス回路7に出力する。
これにより、バイパス経路23を構成しているバイパスドライバ段増幅器25及びバイパス最終段増幅器27にバイアスがかけられる。
即ち、バイアス回路7によって、トランジスタであるバイパスドライバ段増幅器25及びバイパス最終段増幅器27のベース(または、ゲート)にバイアス電圧が印加されることで、トランジスタのベース(または、ゲート)の電圧・電流が設定される。
また、トランジスタであるバイパスドライバ段増幅器25及びバイパス最終段増幅器27のコレクタ(または、ドレイン)にはVcc電圧が印加されており、Vcc電圧が印加されることで、トランジスタのコレクタ(または、ドレイン)の電圧・電流が設定されている。
なお、経路切替用スイッチ13,24,26の制御が完了してから、起動を指示する制御信号をレギュレータ回路6及びバイアス回路7に出力している理由は、回路内に不要なループ経路が発生することなく、安定な動作を可能にするためである。
When the control of the path switching switches 13, 24, 26 is completed, the control circuit 5 outputs a control signal instructing activation to the regulator circuit 6 and the bias circuit 7.
As a result, the bypass driver stage amplifier 25 and the bypass final stage amplifier 27 constituting the bypass path 23 are biased.
That is, the bias circuit 7 applies a bias voltage to the base (or gate) of the bypass driver stage amplifier 25 and the bypass final stage amplifier 27, which are transistors, so that the voltage and current of the base (or gate) of the transistor are applied. Is set.
Further, the Vcc voltage is applied to the collectors (or drains) of the bypass driver stage amplifier 25 and the bypass final stage amplifier 27, which are transistors. By applying the Vcc voltage, the collector (or drain) of the transistor. The voltage and current are set.
The reason why the control signal instructing activation is output to the regulator circuit 6 and the bias circuit 7 after the control of the path switching switches 13, 24, 26 is completed is that an unnecessary loop path is generated in the circuit. This is to enable a stable operation without having to do so.

RF入力端子2から入力されたRF信号は、バイパス経路23を構成しているバイパスドライバ段増幅器25及びバイパス最終段増幅器27で増幅され、増幅後のRF信号(低出力電力のRF信号)がRF出力端子3に出力される。   The RF signal input from the RF input terminal 2 is amplified by the bypass driver stage amplifier 25 and the bypass final stage amplifier 27 constituting the bypass path 23, and the amplified RF signal (RF signal with low output power) is RF. Output to the output terminal 3.

なお、制御回路5は、閾値Th2より低い制御電圧が印加されると、起動を指示する制御信号をレギュレータ回路6及びバイアス回路7に出力しない。   Note that when a control voltage lower than the threshold Th2 is applied, the control circuit 5 does not output a control signal instructing activation to the regulator circuit 6 and the bias circuit 7.

この実施の形態7の場合も、上記実施の形態1と同様に、基準電圧回路4、制御回路5及びレギュレータ回路6がシリコン基板8上に形成され、増幅部1及びバイアス回路7がガリウム砒素基板9上に形成されているように構成したので、高周波特性を損なうことなく、非特許文献1に開示されている電力増幅器モジュールと比べて、ガリウム砒素基板9に形成されるチップ面積を削減することができる効果を奏する。   In the case of the seventh embodiment, as in the first embodiment, the reference voltage circuit 4, the control circuit 5, and the regulator circuit 6 are formed on the silicon substrate 8, and the amplifying unit 1 and the bias circuit 7 are formed on the gallium arsenide substrate. 9 is formed on the gallium arsenide substrate 9 as compared with the power amplifier module disclosed in Non-Patent Document 1 without impairing the high frequency characteristics. There is an effect that can.

実施の形態8.
図10はこの発明の実施の形態8による電力増幅器モジュールを示す構成図であり、図において、図2及び図9と同一符号は同一または相当部分を示すので説明を省略する。
上記実施の形態7では、基準電圧回路4、制御回路5及びレギュレータ回路6がシリコン基板8上に形成され、増幅部1及びバイアス回路7がガリウム砒素基板9上に形成されているものを示したが、図10に示すように、基準電圧回路4、制御回路5、レギュレータ回路6及びバイアス回路7がシリコン基板8上に形成され、増幅部1がガリウム砒素基板9上に形成されているようにしてもよい。
図10の例では、温度検知回路10の記載を省略しているが、図3と同様に、温度検知回路10が実装されていてもよい。
基本的な動作は上記実施の形態2,7と同様であるため詳細な説明を省略するが、この場合も、高周波特性を損なうことなく、非特許文献1に開示されている電力増幅器モジュールと比べて、ガリウム砒素基板9に形成されるチップ面積を削減することができる効果を奏する。
Embodiment 8 FIG.
10 is a block diagram showing a power amplifier module according to an eighth embodiment of the present invention. In the figure, the same reference numerals as those in FIGS.
In the seventh embodiment, the reference voltage circuit 4, the control circuit 5, and the regulator circuit 6 are formed on the silicon substrate 8, and the amplifier 1 and the bias circuit 7 are formed on the gallium arsenide substrate 9. However, as shown in FIG. 10, the reference voltage circuit 4, the control circuit 5, the regulator circuit 6 and the bias circuit 7 are formed on the silicon substrate 8, and the amplifier 1 is formed on the gallium arsenide substrate 9. May be.
Although the description of the temperature detection circuit 10 is omitted in the example of FIG. 10, the temperature detection circuit 10 may be mounted as in FIG.
Since the basic operation is the same as in the second and seventh embodiments, detailed description is omitted, but in this case as well, compared with the power amplifier module disclosed in Non-Patent Document 1, without impairing the high frequency characteristics. As a result, the chip area formed on the gallium arsenide substrate 9 can be reduced.

実施の形態9.
図11はこの発明の実施の形態9による電力増幅器モジュールを示す構成図であり、図において、図1及び図5と同一符号は同一または相当部分を示すので説明を省略する。
図11の電力増幅器モジュールは、図1の電力増幅器モジュールと比べて、増幅部1の内部構成が相違している。
図11の例では、温度検知回路10の記載を省略しているが、図4と同様に、温度検知回路10が実装されていてもよい。
Embodiment 9 FIG.
FIG. 11 is a block diagram showing a power amplifier module according to Embodiment 9 of the present invention. In the figure, the same reference numerals as those in FIGS.
The power amplifier module in FIG. 11 is different from the power amplifier module in FIG. 1 in the internal configuration of the amplifying unit 1.
Although the description of the temperature detection circuit 10 is omitted in the example of FIG. 11, the temperature detection circuit 10 may be mounted as in FIG.

増幅部1は増幅経路11と、バイパス経路28(第1のバイパス回路)と、バイパス経路31(第2のバイパス回路)とを備え、増幅経路11におけるドライバ段増幅器12とバイパス経路28が並列に接続され、増幅経路11における経路切替用スイッチ13及び最終段増幅器14の直列回路とバイパス経路31とが並列に接続されて構成されている。
バイパス経路28はバイパス増幅器29及び経路切替用スイッチ30の直列回路であり、バイパス経路31は経路切替用スイッチ32からなる。
なお、増幅部1は、図示していない入力整合回路、段間整合回路及び出力整合回路を実装している場合がある。また、入力整合回路、段間整合回路及び出力整合回路の一部もしくは全部を実装していない場合もある。
The amplification unit 1 includes an amplification path 11, a bypass path 28 (first bypass circuit), and a bypass path 31 (second bypass circuit), and the driver stage amplifier 12 and the bypass path 28 in the amplification path 11 are in parallel. A series circuit of the path switching switch 13 and the final stage amplifier 14 in the amplification path 11 and the bypass path 31 are connected in parallel.
The bypass path 28 is a series circuit of a bypass amplifier 29 and a path switching switch 30, and the bypass path 31 includes a path switching switch 32.
The amplifying unit 1 may include an input matching circuit, an interstage matching circuit, and an output matching circuit that are not shown. In some cases, some or all of the input matching circuit, the interstage matching circuit, and the output matching circuit are not mounted.

制御回路5は増幅経路11の経路切替用スイッチ13、バイパス経路28の経路切替用スイッチ30及びバイパス経路31の経路切替用スイッチ32を制御する。
即ち、制御回路5は、RF出力端子3から高い電力のRF信号を出力させる場合、増幅経路11の経路切替用スイッチ13をオンに制御して、バイパス経路28,31の経路切替用スイッチ30,32をオフに制御し、RF出力端子3から低い電力のRF信号を出力させる場合、増幅経路11の経路切替用スイッチ13をオフに制御して、バイパス経路28,31の経路切替用スイッチ30,32をオンに制御する。
The control circuit 5 controls the path switching switch 13 of the amplification path 11, the path switching switch 30 of the bypass path 28, and the path switching switch 32 of the bypass path 31.
That is, when the control circuit 5 outputs an RF signal of high power from the RF output terminal 3, the control circuit 5 controls the path switching switch 13 of the amplification path 11 to be turned on, and the path switching switch 30 of the bypass paths 28, 31 32, when the RF signal of low power is output from the RF output terminal 3, the path switching switch 13 of the amplification path 11 is controlled to be off, and the path switching switch 30 of the bypass paths 28, 31 is 32 is turned on.

次に動作について説明する。
増幅部1及び制御回路5以外の処理内容は上記実施の形態1と同様であるため、主に増幅部1及び制御回路5の処理内容を説明する。
Next, the operation will be described.
Since the processing contents other than the amplifying unit 1 and the control circuit 5 are the same as those in the first embodiment, the processing contents of the amplifying unit 1 and the control circuit 5 will be mainly described.

制御回路5は、例えば、閾値Th1と閾値Th2と閾値Th3が設定されており(Th1>Th2>Th3>0)、RF出力端子3から高い電力のRF信号を出力させるために、閾値Th1より高い制御電圧が印加されると、増幅経路11の経路切替用スイッチ13をオンに制御して、バイパス経路28,31の経路切替用スイッチ30,32をオフに制御する。これにより、RF入力端子2とRF出力端子3の間で、増幅経路11が導通状態になる。   In the control circuit 5, for example, a threshold value Th1, a threshold value Th2, and a threshold value Th3 are set (Th1> Th2> Th3> 0), and in order to output a high-power RF signal from the RF output terminal 3, the control circuit 5 is higher than the threshold value Th1. When the control voltage is applied, the path switching switch 13 of the amplification path 11 is controlled to be turned on, and the path switching switches 30 and 32 of the bypass paths 28 and 31 are controlled to be turned off. As a result, the amplification path 11 becomes conductive between the RF input terminal 2 and the RF output terminal 3.

制御回路5は、経路切替用スイッチ13,30,32の制御が完了すると、起動を指示する制御信号をレギュレータ回路6及びバイアス回路7に出力する。
これにより、増幅経路11を構成しているドライバ段増幅器12及び最終段増幅器14にバイアスがかけられる。
即ち、バイアス回路7によって、トランジスタであるドライバ段増幅器12及び最終段増幅器14のベース(または、ゲート)にバイアス電圧が印加されることで、トランジスタのベース(または、ゲート)の電圧・電流が設定される。
また、トランジスタであるドライバ段増幅器12及び最終段増幅器14のコレクタ(または、ドレイン)にはVcc電圧が印加されており、Vcc電圧が印加されることで、トランジスタのコレクタ(または、ドレイン)の電圧・電流が設定されている。
なお、経路切替用スイッチ13,30,32の制御が完了してから、起動を指示する制御信号をレギュレータ回路6及びバイアス回路7に出力している理由は、回路内に不要なループ経路が発生することなく、安定な動作を可能にするためである。
When the control of the path switching switches 13, 30 and 32 is completed, the control circuit 5 outputs a control signal instructing activation to the regulator circuit 6 and the bias circuit 7.
As a result, the driver stage amplifier 12 and the final stage amplifier 14 constituting the amplification path 11 are biased.
In other words, the bias circuit 7 applies a bias voltage to the base (or gate) of the driver stage amplifier 12 and the final stage amplifier 14 which are transistors, thereby setting the voltage / current of the base (or gate) of the transistor. Is done.
Further, the Vcc voltage is applied to the collector (or drain) of the driver stage amplifier 12 and the final stage amplifier 14 which are transistors, and the voltage of the collector (or drain) of the transistor is applied by applying the Vcc voltage.・ Current is set.
The reason why the control signal for instructing activation is output to the regulator circuit 6 and the bias circuit 7 after the control of the path switching switches 13, 30, 32 is completed is that an unnecessary loop path is generated in the circuit. This is to enable a stable operation without having to do so.

RF入力端子2から入力されたRF信号は、増幅経路11を構成しているドライバ段増幅器12及び最終段増幅器14で増幅され、増幅後のRF信号(高出力電力のRF信号)がRF出力端子3に出力される。   The RF signal input from the RF input terminal 2 is amplified by the driver stage amplifier 12 and the final stage amplifier 14 constituting the amplification path 11, and the amplified RF signal (RF signal having high output power) is amplified by the RF output terminal. 3 is output.

制御回路5は、RF出力端子3から中程度の電力のRF信号を出力させるために、閾値Th2より高く、閾値Th1より低い制御電圧が印加されると、増幅経路11の経路切替用スイッチ13及びバイパス経路28の経路切替用スイッチ30をオフに制御して、バイパス経路31の経路切替用スイッチ32をオンに制御する。これにより、RF入力端子2とRF出力端子3の間で、ドライバ段増幅器12及びバイパス経路31が導通状態になる。   When a control voltage higher than the threshold value Th2 and lower than the threshold value Th1 is applied to output an RF signal with medium power from the RF output terminal 3, the control circuit 5 and the path switching switch 13 of the amplification path 11 and The path switching switch 30 of the bypass path 28 is controlled to be turned off, and the path switching switch 32 of the bypass path 31 is controlled to be turned on. As a result, the driver stage amplifier 12 and the bypass path 31 are brought into conduction between the RF input terminal 2 and the RF output terminal 3.

制御回路5は、経路切替用スイッチ13,30,32の制御が完了すると、起動を指示する制御信号をレギュレータ回路6及びバイアス回路7に出力する。
これにより、増幅経路11を構成しているドライバ段増幅器12にバイアスがかけられる。
即ち、バイアス回路7によって、トランジスタであるドライバ段増幅器12のベース(または、ゲート)にバイアス電圧が印加されることで、トランジスタのベース(または、ゲート)の電圧・電流が設定される。
また、トランジスタであるドライバ段増幅器12のコレクタ(または、ドレイン)にはVcc電圧が印加されており、Vcc電圧が印加されることで、トランジスタのコレクタ(または、ドレイン)の電圧・電流が設定されている。
なお、経路切替用スイッチ13,30,32の制御が完了してから、起動を指示する制御信号をレギュレータ回路6及びバイアス回路7に出力している理由は、回路内に不要なループ経路が発生することなく、安定な動作を可能にするためである。
When the control of the path switching switches 13, 30 and 32 is completed, the control circuit 5 outputs a control signal instructing activation to the regulator circuit 6 and the bias circuit 7.
As a result, the driver stage amplifier 12 constituting the amplification path 11 is biased.
That is, the bias circuit 7 applies a bias voltage to the base (or gate) of the driver stage amplifier 12 which is a transistor, thereby setting the voltage / current of the base (or gate) of the transistor.
Further, the Vcc voltage is applied to the collector (or drain) of the driver stage amplifier 12 which is a transistor, and the voltage / current of the collector (or drain) of the transistor is set by applying the Vcc voltage. ing.
The reason why the control signal for instructing activation is output to the regulator circuit 6 and the bias circuit 7 after the control of the path switching switches 13, 30, 32 is completed is that an unnecessary loop path is generated in the circuit. This is to enable a stable operation without having to do so.

RF入力端子2から入力されたRF信号は、増幅経路11を構成しているドライバ段増幅器12で増幅され、増幅後のRF信号(中出力電力のRF信号)がRF出力端子3に出力される。   The RF signal input from the RF input terminal 2 is amplified by the driver stage amplifier 12 constituting the amplification path 11, and the amplified RF signal (RF signal of medium output power) is output to the RF output terminal 3. .

制御回路5は、RF出力端子3から低い電力のRF信号を出力させるために、閾値Th3より高く、閾値Th2より低い制御電圧が印加されると、増幅経路11の経路切替用スイッチ13をオフに制御して、バイパス経路28,31の経路切替用スイッチ30,32をオンに制御する。これにより、RF入力端子2とRF出力端子3の間で、バイパス経路28,31が導通状態になる。   When a control voltage higher than the threshold Th3 and lower than the threshold Th2 is applied to output a low-power RF signal from the RF output terminal 3, the control circuit 5 turns off the path switching switch 13 of the amplification path 11. And the path switching switches 30 and 32 of the bypass paths 28 and 31 are controlled to be turned on. As a result, the bypass paths 28 and 31 become conductive between the RF input terminal 2 and the RF output terminal 3.

制御回路5は、経路切替用スイッチ13,30,32の制御が完了すると、起動を指示する制御信号をレギュレータ回路6及びバイアス回路7に出力する。
これにより、バイパス経路28を構成しているバイパス段増幅器29にバイアスがかけられる。
即ち、バイアス回路7によって、トランジスタであるバイパス段増幅器29のベース(または、ゲート)にバイアス電圧が印加されることで、トランジスタのベース(または、ゲート)の電圧・電流が設定される。
また、トランジスタであるバイパス段増幅器29のコレクタ(または、ドレイン)にはVcc電圧が印加されており、Vcc電圧が印加されることで、トランジスタのコレクタ(または、ドレイン)の電圧・電流が設定されている。
なお、経路切替用スイッチ13,30,32の制御が完了してから、起動を指示する制御信号をレギュレータ回路6及びバイアス回路7に出力している理由は、回路内に不要なループ経路が発生することなく、安定な動作を可能にするためである。
When the control of the path switching switches 13, 30 and 32 is completed, the control circuit 5 outputs a control signal instructing activation to the regulator circuit 6 and the bias circuit 7.
As a result, a bias is applied to the bypass stage amplifier 29 constituting the bypass path 28.
That is, the bias circuit 7 applies a bias voltage to the base (or gate) of the bypass stage amplifier 29, which is a transistor, to set the voltage / current of the base (or gate) of the transistor.
Further, the Vcc voltage is applied to the collector (or drain) of the bypass stage amplifier 29 which is a transistor, and the voltage / current of the collector (or drain) of the transistor is set by applying the Vcc voltage. ing.
The reason why the control signal for instructing activation is output to the regulator circuit 6 and the bias circuit 7 after the control of the path switching switches 13, 30, 32 is completed is that an unnecessary loop path is generated in the circuit. This is to enable a stable operation without having to do so.

RF入力端子2から入力されたRF信号は、バイパス経路28を構成しているバイパス増幅器29で増幅され、増幅後のRF信号(低出力電力のRF信号)がRF出力端子3に出力される。   The RF signal input from the RF input terminal 2 is amplified by the bypass amplifier 29 constituting the bypass path 28, and the amplified RF signal (RF signal with low output power) is output to the RF output terminal 3.

なお、制御回路5は、閾値Th3より低い制御電圧が印加されると、起動を指示する制御信号をレギュレータ回路6及びバイアス回路7に出力しない。   The control circuit 5 does not output a control signal instructing activation to the regulator circuit 6 and the bias circuit 7 when a control voltage lower than the threshold Th3 is applied.

この実施の形態9の場合も、上記実施の形態1と同様に、基準電圧回路4、制御回路5及びレギュレータ回路6がシリコン基板8上に形成され、増幅部1及びバイアス回路7がガリウム砒素基板9上に形成されているように構成したので、高周波特性を損なうことなく、非特許文献1に開示されている電力増幅器モジュールと比べて、ガリウム砒素基板9に形成されるチップ面積を削減することができる効果を奏する。   Also in the case of the ninth embodiment, as in the first embodiment, the reference voltage circuit 4, the control circuit 5, and the regulator circuit 6 are formed on the silicon substrate 8, and the amplifying unit 1 and the bias circuit 7 are formed on the gallium arsenide substrate. 9 is formed on the gallium arsenide substrate 9 as compared with the power amplifier module disclosed in Non-Patent Document 1 without impairing the high frequency characteristics. There is an effect that can.

実施の形態10.
図12はこの発明の実施の形態10による電力増幅器モジュールを示す構成図であり、図において、図2及び図11と同一符号は同一または相当部分を示すので説明を省略する。
上記実施の形態9では、基準電圧回路4、制御回路5及びレギュレータ回路6がシリコン基板8上に形成され、増幅部1及びバイアス回路7がガリウム砒素基板9上に形成されているものを示したが、図12に示すように、基準電圧回路4、制御回路5、レギュレータ回路6及びバイアス回路7がシリコン基板8上に形成され、増幅部1がガリウム砒素基板9上に形成されているようにしてもよい。
図12の例では、温度検知回路10の記載を省略しているが、図3と同様に、温度検知回路10が実装されていてもよい。
基本的な動作は上記実施の形態2,9と同様であるため詳細な説明を省略するが、この場合も、高周波特性を損なうことなく、非特許文献1に開示されている電力増幅器モジュールと比べて、ガリウム砒素基板9に形成されるチップ面積を削減することができる効果を奏する。
Embodiment 10 FIG.
12 is a block diagram showing a power amplifier module according to Embodiment 10 of the present invention. In the figure, the same reference numerals as those in FIGS.
In the ninth embodiment, the reference voltage circuit 4, the control circuit 5, and the regulator circuit 6 are formed on the silicon substrate 8, and the amplifier 1 and the bias circuit 7 are formed on the gallium arsenide substrate 9. However, as shown in FIG. 12, the reference voltage circuit 4, the control circuit 5, the regulator circuit 6 and the bias circuit 7 are formed on the silicon substrate 8, and the amplifier 1 is formed on the gallium arsenide substrate 9. May be.
In the example of FIG. 12, the description of the temperature detection circuit 10 is omitted, but the temperature detection circuit 10 may be mounted as in FIG.
Since the basic operation is the same as in Embodiments 2 and 9 described above, detailed description is omitted, but in this case as well, compared with the power amplifier module disclosed in Non-Patent Document 1 without impairing the high-frequency characteristics. As a result, the chip area formed on the gallium arsenide substrate 9 can be reduced.

実施の形態11.
図13はこの発明の実施の形態11による電力増幅器モジュールを示す構成図であり、図において、図1と同一符号は同一または相当部分を示すので説明を省略する。
上記実施の形態1〜10では、増幅部1が1つだけ実装されているものを示したが、図13に示すように、複数の増幅部1が実装されていてもよい。
例えば、複数の増幅部1を構成している増幅器1aのサイズが異なる場合、各増幅部1におけるRF信号の増幅率が異なるものとなる。
Embodiment 11 FIG.
13 is a block diagram showing a power amplifier module according to Embodiment 11 of the present invention. In the figure, the same reference numerals as those in FIG.
In the first to tenth embodiments, only one amplification unit 1 is mounted. However, as shown in FIG. 13, a plurality of amplification units 1 may be mounted.
For example, when the sizes of the amplifiers 1a constituting the plurality of amplification units 1 are different, the amplification factors of the RF signals in the amplification units 1 are different.

制御回路5、複数の増幅部1が実装されている場合、印加される制御電圧に応じて、いずれかの増幅部1を動作させる制御信号を出力する。
基本的には、いずれか1つの増幅部1を動作させるが、2以上の増幅部1を動作させるようにしてもよい。
When the control circuit 5 and the plurality of amplifying units 1 are mounted, a control signal for operating any one of the amplifying units 1 is output according to the applied control voltage.
Basically, any one amplifying unit 1 is operated, but two or more amplifying units 1 may be operated.

この実施の形態11の場合も、上記実施の形態1と同様に、基準電圧回路4、制御回路5及びレギュレータ回路6がシリコン基板8上に形成され、増幅部1及びバイアス回路7がガリウム砒素基板9上に形成されているように構成したので、高周波特性を損なうことなく、非特許文献1に開示されている電力増幅器モジュールと比べて、ガリウム砒素基板9に形成されるチップ面積を削減することができる効果を奏する。   Also in the case of the eleventh embodiment, as in the first embodiment, the reference voltage circuit 4, the control circuit 5 and the regulator circuit 6 are formed on the silicon substrate 8, and the amplifying unit 1 and the bias circuit 7 are formed on the gallium arsenide substrate. 9 is formed on the gallium arsenide substrate 9 as compared with the power amplifier module disclosed in Non-Patent Document 1 without impairing the high frequency characteristics. There is an effect that can.

実施の形態12.
図14はこの発明の実施の形態12による電力増幅器モジュールを示す構成図であり、図において、図2及び図13と同一符号は同一または相当部分を示すので説明を省略する。
上記実施の形態11では、基準電圧回路4、制御回路5及びレギュレータ回路6がシリコン基板8上に形成され、増幅部1及びバイアス回路7がガリウム砒素基板9上に形成されているものを示したが、図14に示すように、基準電圧回路4、制御回路5、レギュレータ回路6及びバイアス回路7がシリコン基板8上に形成され、増幅部1がガリウム砒素基板9上に形成されているようにしてもよい。
図14の例では、温度検知回路10の記載を省略しているが、図3と同様に、温度検知回路10が実装されていてもよい。
基本的な動作は上記実施の形態2,11と同様であるため詳細な説明を省略するが、この場合も、高周波特性を損なうことなく、非特許文献1に開示されている電力増幅器モジュールと比べて、ガリウム砒素基板9に形成されるチップ面積を削減することができる効果を奏する。
Embodiment 12 FIG.
FIG. 14 is a block diagram showing a power amplifier module according to Embodiment 12 of the present invention. In the figure, the same reference numerals as those in FIGS.
In the eleventh embodiment, the reference voltage circuit 4, the control circuit 5, and the regulator circuit 6 are formed on the silicon substrate 8, and the amplifier 1 and the bias circuit 7 are formed on the gallium arsenide substrate 9. However, as shown in FIG. 14, the reference voltage circuit 4, the control circuit 5, the regulator circuit 6 and the bias circuit 7 are formed on the silicon substrate 8, and the amplifier 1 is formed on the gallium arsenide substrate 9. May be.
In the example of FIG. 14, the description of the temperature detection circuit 10 is omitted, but the temperature detection circuit 10 may be mounted as in FIG.
Since the basic operation is the same as in the second and eleventh embodiments, detailed description is omitted, but in this case as well, compared with the power amplifier module disclosed in Non-Patent Document 1, without impairing the high frequency characteristics. As a result, the chip area formed on the gallium arsenide substrate 9 can be reduced.

なお、本願発明はその発明の範囲内において、各実施の形態の自由な組み合わせ、あるいは各実施の形態の任意の構成要素の変形、もしくは各実施の形態において任意の構成要素の省略が可能である。   In the present invention, within the scope of the invention, any combination of the embodiments, or any modification of any component in each embodiment, or omission of any component in each embodiment is possible. .

1 増幅部、1a 1〜N段の増幅器、2 RF入力端子、3 RF出力端子、4 基準電圧回路、5 制御回路、6 レギュレータ回路、7 バイアス回路、8 シリコン基板、9 ガリウム砒素基板、10 温度検知回路、11 増幅経路、12 ドライバ段増幅器、13 経路切替用スイッチ、14 最終段増幅器、15 バイパス経路、16,18 経路切替用スイッチ、17 バイパス増幅器、19 バイパス経路、20,22 経路切替用スイッチ、21 バイパス増幅器、23 バイパス経路、24,26 経路切替用スイッチ、25 バイパスドライバ段増幅器、27 バイパス最終段増幅器、28 バイパス経路(第1のバイパス回路)、29 バイパス増幅器、30 経路切替用スイッチ、31 バイパス経路(第2のバイパス回路)、32 経路切替用スイッチ、101 増幅部、102 RF入力端子、103 RF出力端子、104 基準電圧回路、105 レギュレータ回路、106 制御回路、107 バイアス回路、108 シリコン基板、109 ガリウム砒素基板。   DESCRIPTION OF SYMBOLS 1 Amplification part, 1a 1-N stage amplifier, 2 RF input terminal, 3 RF output terminal, 4 Reference voltage circuit, 5 Control circuit, 6 Regulator circuit, 7 Bias circuit, 8 Silicon substrate, 9 Gallium arsenide substrate, 10 Temperature Detection circuit, 11 Amplification path, 12 Driver stage amplifier, 13 Path switching switch, 14 Final stage amplifier, 15 Bypass path, 16, 18 Path switching switch, 17 Bypass amplifier, 19 Bypass path, 20, 22 Path switching switch , 21 Bypass amplifier, 23 Bypass path, 24, 26 Path switching switch, 25 Bypass driver stage amplifier, 27 Bypass final stage amplifier, 28 Bypass path (first bypass circuit), 29 Bypass amplifier, 30 Path switching switch, 31 Bypass path (second bypass circuit), 32 Switch for path switching, 101 amplifier, 102 RF input terminal, 103 RF output terminal, 104 reference voltage circuit, 105 regulator circuit, 106 control circuit, 107 bias circuit, 108 silicon substrate, 109 gallium arsenide substrate.

Claims (8)

複数段の増幅器から構成されており、入力信号を増幅して出力する増幅部と、
基準電圧を生成する基準電圧回路と、
印加される制御電圧にしたがって起動を指示する制御信号を出力する制御回路と、
上記制御回路から制御信号が出力されている場合、上記基準電圧回路により生成された基準電圧を用いて、駆動用の定電圧を生成するレギュレータ回路と、
上記制御回路から制御信号が出力されている場合、上記レギュレータ回路により生成された定電圧を用いて、上記増幅部を構成している増幅器にバイアスをかけるバイアス回路とを備え、
上記基準電圧回路、上記制御回路及び上記レギュレータ回路がシリコン基板上に形成され、上記増幅部及び上記バイアス回路がガリウム砒素基板上に形成されていることを特徴とする電力増幅器モジュール。
An amplifier that is composed of a plurality of amplifiers, amplifies an input signal, and outputs the amplified signal
A reference voltage circuit for generating a reference voltage;
A control circuit that outputs a control signal instructing start-up according to an applied control voltage;
When a control signal is output from the control circuit, a regulator circuit that generates a constant voltage for driving using the reference voltage generated by the reference voltage circuit;
When the control signal is output from the control circuit, using a constant voltage generated by the regulator circuit, comprising a bias circuit for biasing the amplifier constituting the amplification unit,
The power amplifier module, wherein the reference voltage circuit, the control circuit, and the regulator circuit are formed on a silicon substrate, and the amplifying unit and the bias circuit are formed on a gallium arsenide substrate.
複数段の増幅器から構成されており、入力信号を増幅して出力する増幅部と、
基準電圧を生成する基準電圧回路と、
印加される制御電圧にしたがって起動を指示する制御信号を出力する制御回路と、
上記制御回路から制御信号が出力されている場合、上記基準電圧回路により生成された基準電圧を用いて、駆動用の定電圧を生成するレギュレータ回路と、
上記制御回路から制御信号が出力されている場合、上記レギュレータ回路により生成された定電圧を用いて、上記増幅部を構成している増幅器にバイアスをかけるバイアス回路とを備え、
上記基準電圧回路、上記制御回路、上記レギュレータ回路及び上記バイアス回路がシリコン基板上に形成され、上記増幅部がガリウム砒素基板上に形成されていることを特徴とする電力増幅器モジュール。
An amplifier that is composed of a plurality of amplifiers, amplifies an input signal, and outputs the amplified signal.
A reference voltage circuit for generating a reference voltage;
A control circuit that outputs a control signal instructing start-up according to an applied control voltage;
When a control signal is output from the control circuit, a regulator circuit that generates a constant voltage for driving using the reference voltage generated by the reference voltage circuit;
When the control signal is output from the control circuit, using a constant voltage generated by the regulator circuit, comprising a bias circuit for biasing the amplifier constituting the amplification unit,
The power amplifier module, wherein the reference voltage circuit, the control circuit, the regulator circuit, and the bias circuit are formed on a silicon substrate, and the amplifying unit is formed on a gallium arsenide substrate.
増幅部は、複数段のドライバ段増幅器、スイッチ及び最終段増幅器が直列に接続されている増幅経路と、スイッチ及びバイパス増幅器が直列に接続されているバイパス経路とが並列に接続されて構成されており、
制御回路は、上記増幅経路及び上記バイパス経路におけるスイッチを制御することを特徴とする請求項1または請求項2記載の電力増幅器モジュール。
The amplification unit is configured by connecting in parallel an amplification path in which a plurality of driver stage amplifiers, a switch and a final stage amplifier are connected in series, and a bypass path in which a switch and a bypass amplifier are connected in series. And
3. The power amplifier module according to claim 1, wherein the control circuit controls switches in the amplification path and the bypass path.
増幅部は、複数段のドライバ段増幅器、スイッチ及び最終段増幅器が直列に接続されている増幅経路と、スイッチ及びバイパス増幅器が直列に接続されているバイパス経路とを備え、上記バイパス経路が上記増幅経路におけるスイッチ及び最終段増幅器の直列回路と並列に接続されて構成されており、
制御回路は、上記増幅経路及び上記バイパス経路におけるスイッチを制御することを特徴とする請求項1または請求項2記載の電力増幅器モジュール。
The amplifying unit includes an amplification path in which a plurality of driver stage amplifiers, a switch and a final stage amplifier are connected in series, and a bypass path in which a switch and a bypass amplifier are connected in series, and the bypass path is the amplification It is configured to be connected in parallel with the series circuit of the switch in the path and the final stage amplifier,
3. The power amplifier module according to claim 1, wherein the control circuit controls switches in the amplification path and the bypass path.
増幅部は、複数段のドライバ段増幅器、スイッチ及び最終段増幅器が直列に接続されている増幅経路と、複数段のドライバ段増幅器、スイッチ及び最終段増幅器が直列に接続されているバイパス経路とが並列に接続されて構成されており、
制御回路は、上記増幅経路及び上記バイパス経路におけるスイッチを制御することを特徴とする請求項1または請求項2記載の電力増幅器モジュール。
The amplification unit includes an amplification path in which a plurality of driver stage amplifiers, a switch, and a final stage amplifier are connected in series, and a bypass path in which a plurality of driver stage amplifiers, a switch, and a final stage amplifier are connected in series. Configured in parallel,
3. The power amplifier module according to claim 1, wherein the control circuit controls switches in the amplification path and the bypass path.
増幅部は、複数段のドライバ段増幅器、スイッチ及び最終段増幅器が直列に接続されている増幅経路と、バイパス増幅器及びスイッチが直列に接続されている第1のバイパス経路と、スイッチからなる第2のバイパス経路とを備え、上記第1のバイパス経路が上記増幅経路におけるドライバ段増幅器と並列に接続されて、上記第2のバイパス経路が上記増幅経路におけるスイッチ及び最終段増幅器の直列回路と並列に接続されて構成されており、
制御回路は、上記増幅経路及び上記第1及び第2のバイパス経路におけるスイッチを制御することを特徴とする請求項1または請求項2記載の電力増幅器モジュール。
The amplifying unit includes a plurality of driver stage amplifiers, an amplification path in which a switch and a final stage amplifier are connected in series, a first bypass path in which a bypass amplifier and a switch are connected in series, and a second that includes a switch. Bypass path, the first bypass path is connected in parallel with the driver stage amplifier in the amplification path, and the second bypass path is in parallel with the series circuit of the switch and final stage amplifier in the amplification path. Connected and configured,
3. The power amplifier module according to claim 1, wherein the control circuit controls switches in the amplification path and the first and second bypass paths.
複数の増幅部が実装されていることを特徴とする請求項1から請求項6のうちのいずれか1項記載の電力増幅器モジュール。   The power amplifier module according to any one of claims 1 to 6, wherein a plurality of amplifying units are mounted. 温度を検知する温度検知回路がガリウム砒素基板上に形成されており、
バイアス回路は、上記温度検知回路により検知された温度に応じて、増幅器にかけるバイアスを調整することを特徴とする請求項1から請求項7のうちのいずれか1項記載の電力増幅器モジュール。
A temperature detection circuit for detecting the temperature is formed on the gallium arsenide substrate,
The power amplifier module according to any one of claims 1 to 7, wherein the bias circuit adjusts a bias applied to the amplifier in accordance with the temperature detected by the temperature detection circuit.
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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US10425113B2 (en) 2017-05-16 2019-09-24 Samsung Electro-Mechanics Co., Ltd. Multiband radio frequency transmitter with receiving band variable filtering function

Citations (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002027104A (en) * 2000-04-28 2002-01-25 Internatl Business Mach Corp <Ibm> Radio frequency power amplifier for battery-driven handset unit of radio communication system
JP2003347851A (en) * 2002-05-28 2003-12-05 Matsushita Electric Ind Co Ltd High-frequency power amplifier and radio communication apparatus
JP2003347870A (en) * 2002-05-22 2003-12-05 Mitsubishi Electric Corp Power amplifier
JP2005124128A (en) * 2003-09-24 2005-05-12 Matsushita Electric Ind Co Ltd Method for estimating fundamental wave and ternary intermodulation wave of output of multi-stage cascade connection nonlinear circuit, and switching type multi-stage cascade connection nonlinear circuit utilizing the estimation method
JP2009100197A (en) * 2007-10-16 2009-05-07 Renesas Technology Corp Rf power amplifier apparatus, and power supply circuit to control power supply voltage of rf power amplifier
JP2010041634A (en) * 2008-08-08 2010-02-18 Hitachi Metals Ltd High frequency power amplifier, and high frequency transmission module and transceiving module using it
JP2012060550A (en) * 2010-09-13 2012-03-22 Mitsubishi Electric Corp Power amplifier

Patent Citations (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002027104A (en) * 2000-04-28 2002-01-25 Internatl Business Mach Corp <Ibm> Radio frequency power amplifier for battery-driven handset unit of radio communication system
JP2003347870A (en) * 2002-05-22 2003-12-05 Mitsubishi Electric Corp Power amplifier
JP2003347851A (en) * 2002-05-28 2003-12-05 Matsushita Electric Ind Co Ltd High-frequency power amplifier and radio communication apparatus
JP2005124128A (en) * 2003-09-24 2005-05-12 Matsushita Electric Ind Co Ltd Method for estimating fundamental wave and ternary intermodulation wave of output of multi-stage cascade connection nonlinear circuit, and switching type multi-stage cascade connection nonlinear circuit utilizing the estimation method
JP2009100197A (en) * 2007-10-16 2009-05-07 Renesas Technology Corp Rf power amplifier apparatus, and power supply circuit to control power supply voltage of rf power amplifier
JP2010041634A (en) * 2008-08-08 2010-02-18 Hitachi Metals Ltd High frequency power amplifier, and high frequency transmission module and transceiving module using it
JP2012060550A (en) * 2010-09-13 2012-03-22 Mitsubishi Electric Corp Power amplifier

Non-Patent Citations (1)

* Cited by examiner, † Cited by third party
Title
JPN6015021320; Gray Hau: 'A 3x3mm2 Embedded-Wafer-Level Packaged WCDMA GaAs HBT Power Amplifier Module with Integrated Si DC P' Radio Frequency Integrated Circuits Symposium, 2008. RFIC 2008. IEEE , 20080617, p. 409-412 *

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US10425113B2 (en) 2017-05-16 2019-09-24 Samsung Electro-Mechanics Co., Ltd. Multiband radio frequency transmitter with receiving band variable filtering function

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