JP2008235628A - Semiconductor device - Google Patents
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Abstract
Description
本発明は、基板の表面にマイクロマシンやIC等の半導体素子が形成された半導体装置に関する。特に、半導体素子に塵等の異物が付着することで、半導体装置の性能が低下することを防止する技術に関する。 The present invention relates to a semiconductor device in which a semiconductor element such as a micromachine or an IC is formed on a surface of a substrate. In particular, the present invention relates to a technique for preventing the performance of a semiconductor device from being deteriorated due to foreign matters such as dust adhering to a semiconductor element.
半導体装置は、ウエハ上に形成された後、ダイシングされて切り出される。ダイシングにより切り出された半導体装置は、ハンドリング装置に保持されて、所定の位置まで運搬される。ハンドリング装置には、例えば、半導体装置を吸着して保持するもの(例えば、特許文献1)や、半導体装置の表面に接合されて保持するもの(例えば、特許文献2)が用いられている。
特許文献1のハンドリング装置では、ハンドリング装置に略円錐状の曲面(吸着面)が形成される。半導体装置は、その上面の4つの角部が略円錐状の曲面に当接した状態で吸着され、ハンドリング装置に保持される。
特許文献2のハンドリング装置は、半導体装置に接合される突起を備えており、その突起が半導体装置の表面に接合されて、ハンドリング装置に保持される。
After the semiconductor device is formed on the wafer, it is diced and cut out. The semiconductor device cut out by dicing is held by a handling device and transported to a predetermined position. As the handling device, for example, a device that adsorbs and holds a semiconductor device (for example, Patent Document 1) and a device that is bonded to the surface of the semiconductor device (for example, Patent Document 2) are used.
In the handling device of Patent Document 1, a substantially conical curved surface (suction surface) is formed in the handling device. The semiconductor device is adsorbed in a state where the four corners on the upper surface thereof are in contact with the substantially conical curved surface, and is held by the handling device.
The handling device of Patent Document 2 includes a protrusion that is bonded to the semiconductor device, and the protrusion is bonded to the surface of the semiconductor device and is held by the handling device.
半導体装置には、半導体素子に異物が付着することで、その性能が大幅に低下するものがある。例えば、MEMSセンサのように半導体素子に可動部が形成されているものがある。MEMSセンサの可動部は、設置された装置の角速度や加速度が作用して変形する。可動部が変形すると可動部の静電容量が変化する。この静電容量の変化を測定し、装置の角速度や加速度を検出する。この種の半導体装置では、可動部に塵等の異物が付着するとセンシング性能が低下してしまう。
半導体装置は、洗浄され、ダイシングされた後、ハンドリング装置で搬送される。そのため、半導体装置の搬送中に、半導体素子に異物が付着しないようにする必要がある。特許文献1のハンドリング装置では、半導体装置がハンドリング装置に吸着されている間、半導体装置の角部がハンドリング装置の曲面に点接触している。このため、半導体装置は、ハンドリング装置の吸着力を4つの角部で支持しなければならない。したがって、半導体装置の角部に付与される応力が高くなり、半導体装置の角部が破損することがある。半導体装置が破損すると、破損により発生した塵が半導体素子に付着し、半導体装置の性能が低下してしまう。また、特許文献2のハンドリング装置では、運搬後に、ハンドリング装置の突起と半導体装置とを剥離しなければならない。特許文献2のハンドリング装置では、半導体装置を固定してハンドリング装置を回転させることで、接合部をせん断破壊して両者を剥離する。このため、せん断破壊時に半導体装置が破損することがあり、上述した特許文献1の技術と同様の問題が生じる。
Some semiconductor devices have a significant decrease in performance due to foreign matters adhering to the semiconductor elements. For example, there is a semiconductor element in which a movable part is formed, such as a MEMS sensor. The movable part of the MEMS sensor is deformed by the angular velocity or acceleration of the installed device. When the movable part is deformed, the capacitance of the movable part changes. This change in capacitance is measured, and the angular velocity and acceleration of the device are detected. In this kind of semiconductor device, sensing performance deteriorates when foreign matter such as dust adheres to the movable part.
The semiconductor device is cleaned and diced, and then conveyed by a handling device. Therefore, it is necessary to prevent foreign matters from adhering to the semiconductor element during the transport of the semiconductor device. In the handling device of Patent Document 1, the corner of the semiconductor device is in point contact with the curved surface of the handling device while the semiconductor device is attracted to the handling device. For this reason, the semiconductor device must support the adsorption force of the handling device at four corners. Therefore, the stress applied to the corner portion of the semiconductor device increases, and the corner portion of the semiconductor device may be damaged. When the semiconductor device is damaged, dust generated by the damage adheres to the semiconductor element, and the performance of the semiconductor device is degraded. Moreover, in the handling apparatus of patent document 2, you have to peel the protrusion and semiconductor device of a handling apparatus after conveyance. In the handling device of Patent Document 2, the semiconductor device is fixed and the handling device is rotated, whereby the joint is sheared and peeled off. For this reason, a semiconductor device may be damaged at the time of a shear failure, and the same problem as the technique of patent document 1 mentioned above will arise.
本発明は上述した事情を鑑みてなされたものであり、その目的は、半導体素子への異物の付着を低減することができる半導体装置を提供することである。 The present invention has been made in view of the above-described circumstances, and an object thereof is to provide a semiconductor device capable of reducing the adhesion of foreign matter to a semiconductor element.
上記課題を解決するために、本発明の半導体装置は、基板と、基板の表面に形成された半導体素子と、基板の表面から立設され、半導体素子の外側を一巡する外壁を有している。
この半導体装置では、半導体素子が、外壁によって囲まれている。この外壁は、外壁の外側から半導体素子側に侵入しようとする異物の防壁となる。これにより、半導体素子側に異物が侵入することが低減され、半導体素子に異物が付着することを低減できる。また、この外壁をハンドリング装置のガイドとして利用することができ、ハンドリング装置が半導体素子に接触することを防止することができる。
In order to solve the above problems, a semiconductor device of the present invention has a substrate, a semiconductor element formed on the surface of the substrate, and an outer wall that stands up from the surface of the substrate and goes around the outside of the semiconductor element. .
In this semiconductor device, the semiconductor element is surrounded by the outer wall. This outer wall serves as a barrier for foreign substances that try to enter the semiconductor element side from the outside of the outer wall. As a result, the entry of foreign matter into the semiconductor element side is reduced, and the attachment of foreign matter to the semiconductor element can be reduced. Further, the outer wall can be used as a guide for the handling device, and the handling device can be prevented from coming into contact with the semiconductor element.
この半導体装置では、外壁の一部は、厚みが厚くされていることが好ましい。外壁の一部を厚くすることにより、外壁の強度を高くすることができる。また、外壁の一部を厚くして強度を高くすることにより、外壁の他の部分を薄くすることができる。そのため、外壁を薄くした部分にハンドリング装置が当接するようにすることができる。これによって、基板を小さくしても、ハンドリング装置と半導体装置とが当接する領域を確保することができる。 In this semiconductor device, it is preferable that a part of the outer wall has a large thickness. By thickening a part of the outer wall, the strength of the outer wall can be increased. Moreover, the other part of an outer wall can be made thin by thickening a part of outer wall and making intensity | strength high. Therefore, the handling device can be brought into contact with the thinned outer wall. As a result, even if the substrate is made smaller, it is possible to secure a region where the handling device and the semiconductor device come into contact with each other.
この半導体装置では、外壁の一部には、外周面から外側に伸びる突起が1又は複数形成されていることが好ましい。半導体装置を使用するとき、半導体装置はパッケージに収容される。そのため、パッケージ内の気体中の水蒸気が結露して、半導体素子に水分が付着することを防止しなければいけない。特に、MEMSセンサ等では、半導体素子に可動部を有している。水分が可動部に付着すると、半導体装置の性能が低下してしまう。この半導体装置では、半導体装置の作動により、半導体素子の温度が上昇する。そのため、パッケージ内の気体中の水蒸気が結露する場合、まず、外壁に結露する。外壁に突起を設けることにより、外壁の表面積を大きくして、外壁に結露しやすくすることができる。また、複数の突起を外壁に形成する場合は、これら複数の突起を並べて設けることで、外壁の外側から半導体素子に侵入しようとする異物を突起間に挟んで捕獲することができる。 In this semiconductor device, it is preferable that one or more protrusions extending outward from the outer peripheral surface are formed on a part of the outer wall. When using a semiconductor device, the semiconductor device is housed in a package. For this reason, it is necessary to prevent moisture in the gas in the package from being condensed and moisture from adhering to the semiconductor element. In particular, a MEMS sensor or the like has a movable part in a semiconductor element. If moisture adheres to the movable part, the performance of the semiconductor device is degraded. In this semiconductor device, the temperature of the semiconductor element rises due to the operation of the semiconductor device. Therefore, when water vapor in the gas in the package condenses, first, it condenses on the outer wall. By providing protrusions on the outer wall, the surface area of the outer wall can be increased, and condensation can easily occur on the outer wall. In addition, when a plurality of protrusions are formed on the outer wall, the plurality of protrusions are provided side by side so that a foreign substance that enters the semiconductor element from the outside of the outer wall can be caught between the protrusions and captured.
この突起は基板の表面から離間した位置に形成されており、突起と基板の表面との間には隙間が形成されていることが好ましい。この構成では、外壁の外側から半導体素子側に侵入しようとする異物を突起と基板の表面との隙間で挟んで捕獲することができる。これにより、半導体素子側に異物が侵入することをさらに抑制することができる。 This protrusion is preferably formed at a position spaced from the surface of the substrate, and a gap is preferably formed between the protrusion and the surface of the substrate. In this configuration, a foreign substance that is about to enter the semiconductor element side from the outside of the outer wall can be captured by being sandwiched by a gap between the protrusion and the surface of the substrate. Thereby, it can further suppress that a foreign material penetrate | invades into the semiconductor element side.
外壁には、内側から外側に貫通する貫通孔が形成されていることが好ましい。この貫通孔は、半導体装置を洗浄する際の洗浄液を外壁の外部に速やかに流出させることができる。なお、この貫通孔は、外壁の外側から侵入しようとする異物よりも小さくすることが好ましい。 It is preferable that a through hole penetrating from the inside to the outside is formed in the outer wall. This through-hole can quickly flow out the cleaning liquid for cleaning the semiconductor device to the outside of the outer wall. In addition, it is preferable to make this through-hole smaller than the foreign material which tries to penetrate | invade from the outer side of an outer wall.
本発明によれば、異物により半導体装置の性能が低下することを防止することができる。 According to the present invention, it is possible to prevent the performance of the semiconductor device from being deteriorated due to foreign matter.
下記の実施例に記載の技術の主要な特徴について列記する。
(形態1) 半導体装置は、シリコン単結晶の基板の表面にシリコン酸化膜を被膜し、シリコン酸化膜の表面にシリコン単結晶の活性層を積層したウエハから作製される。
(形態2) 外壁は、平面視で矩形状とされている。外壁の4つのコーナー部の厚みは、直線部よりも厚くされている。
(形態3) 外壁で囲まれた領域には、半導体素子のほかに、半導体素子と外部との接続を中継する電極が形成されている。
(形態4) 外壁の突起は、所定の間隔を空けて複数形成されている。
The main features of the techniques described in the following examples are listed.
(Mode 1) A semiconductor device is manufactured from a wafer in which a silicon oxide film is coated on the surface of a silicon single crystal substrate, and an active layer of silicon single crystal is stacked on the surface of the silicon oxide film.
(Mode 2) The outer wall is rectangular in plan view. The four corner portions of the outer wall are thicker than the straight portion.
(Mode 3) In addition to the semiconductor element, an electrode that relays the connection between the semiconductor element and the outside is formed in a region surrounded by the outer wall.
(Mode 4) A plurality of protrusions on the outer wall are formed at a predetermined interval.
本発明を具現化した実施例に係る半導体装置を図面を参照して説明する。図1は、半導体装置10の平面図である。図2は図1のII−II断面図であり、図3は図1のIII−III断面図であり、図4は図1のIV−IV断面図である。
図1に示すように、半導体装置10は、基板24と、基板24の表面に形成された半導体素子12と、基板24の表面に形成された半導体素子12の外周を囲む外壁16を備えている。半導体装置10は、半導体装置10が取り付けられた装置(図示省略)の加速度や角速度を検出する半導体センサである。
図2によく示されるように、半導体素子12には可動部12aが形成されている。可動部12aは格子状に形成されている。可動部12aは、基板24と離間して設けられている。可動部12aの一部は、シリコン酸化膜28を介して基板24に固定されている。可動部12aは、半導体装置10が取り付けられた装置の加速度等により変位する。可動部12aの変位により、半導体素子12の静電容量が変化する。半導体素子12は、パッド14を介して外部回路(図示省略)に接続されており、外部回路が静電容量の変化を検出して装置の加速度等を検出する。半導体素子12は、公知の加速度センサや角速度センサ等に用いられているマイクロマシン(MEMS)とすることができる。また、半導体素子12は、塵等の異物の付着により性能の低下が著しいICや半導体デバイス等とすることができる。
A semiconductor device according to an embodiment embodying the present invention will be described with reference to the drawings. FIG. 1 is a plan view of the
As shown in FIG. 1, the
As well shown in FIG. 2, the
図1に示すように、半導体素子12の左右方向(図1の左右方向)の外側には、複数のパッド14が配置されている。パッド14は、外壁16の内側に位置している。図2に示すように、パッド14は、シリコン酸化膜28を挟んで基板24の表面に載置されている。パッド14の上面は、可動部12aの上面と同一平面上に位置している。パッド14の上面には、アルミニウム製のパッド電極14aが載置されている。パッド電極14aは、ワイヤ(図示省略)を介して外部回路と接続されている。また、パッド電極14aは、基板24に配設された配線(図示省略)を介して半導体素子12と接続されている。
As shown in FIG. 1, a plurality of
図1に示すように、外壁16は、半導体素子12とパッド14の外側に配置されている。外壁16は、可動部12aよりも厚くされている。外壁16の上面は、可動部12a及びパッド14の上面と同一平面上に位置している。外壁16の4つのコーナー部18は、外壁16の直線部16aよりもその厚みが厚くされている。外壁16の4つの直線部16aには、凹凸部20が形成されている。凹凸部20には、外壁16の外周面から外側に向かって突設された突起20aが等間隔で複数並んで配置されている。突起20aの幅は、外壁16の直線部16aの厚さよりも小さくされている。凹凸部20は、コーナー部18から所定の距離だけ離間した位置に配置されている。また、外壁16の直線部16aの長辺(図1の上下側の辺)には、それぞれの凹凸部20とコーナー部18との間に薄肉部16bが形成されている。すなわち、薄肉部16bは、外壁16の直線部16aの上側の長辺に2つ形成されており、外壁16の直線部16aの下側の長辺に2つ形成されている。薄肉部16bは、直線部16aの他の部分よりも厚さが薄くされている。薄肉部16bは、可動部12aよりも厚くてもよいし薄くてもよい。
図2に示すように、突起20aの上面は、外壁16の上面と同一平面上に位置している。突起20aの下面は、基板24と離間している。突起20aと基板24との距離は、可動部12aと基板24との距離と略同一となっている。突起20aが形成されている外壁16は、シリコン酸化膜28を介して基板24上に載置されている。図3に示すように、突起20aが形成されていない外壁16も、シリコン酸化膜28を介して基板24上に載置されている。コーナー部18も、シリコン酸化膜28を介して基板24上に載置されている。一方、図4に示すように、薄肉部16bと基板24の表面との間には、隙間25が形成されている。すなわち、外壁16には、内側と外側を貫通する貫通孔25が、薄肉部16bと基板24の表面との間に形成されている。半導体装置10の4つの薄肉部16bには、薄肉部16bと基板24の表面との間に貫通孔25が形成されている。貫通孔25は、薄肉部16bの全長に亘って形成されている。
As shown in FIG. 1, the
As shown in FIG. 2, the upper surface of the
次に、半導体装置10の製造方法について図面を参照して説明する。図5,6は、ウエハ32から半導体装置10が作製される途中の状態を示す断面図である。図5,6は、図3で示す断面と同一の断面を示している。
図5に示すように、半導体装置10は、シリコンのウエハ32を用いて作製される。ウエハ32は、単結晶のシリコン層である基板24の上面に、シリコン酸化膜28が被膜され、シリコン酸化膜28の上面に単結晶のシリコン層である活性層30が積層されている。
Next, a method for manufacturing the
As shown in FIG. 5, the
図5に示すように、ウエハ32の活性層30の上面には、レジストが塗布され、イオン注入された後、イオン注入された箇所にアルミニウムをスパッタリングして、パッド電極14aが形成される。次に、可動部12a、パッド14、外壁16及び突起20aを形成する活性層30の表面にレジストを塗布して、活性層30をドライエッチングする。図6には、図5の状態から、活性層30がエッチングされ、レジストが除去された状態を示している。
次に、図6で示すシリコン酸化膜28をウェットエッチングして除去する。ウェットエッチングは、可動部12a及び薄肉部16bと基板24の表面との間のシリコン酸化膜28が除去されるまで行われる。ウェットエッチングのような等方性のエッチングでは、薄肉部16bの下方に位置するシリコン酸化膜28の方が、外壁16の他の部分(直線部16aの薄肉部16b以外の部分)の下方に位置するシリコン酸化膜28より早くエッチングされ除去される。これにより、外壁16の直線部16aでは、薄肉部16bの下方のシリコン酸化膜28のみを除去することができる。同時に、薄肉部16b以外の外壁16の下方のシリコン酸化膜28を残しつつ、可動部12aと突起20aの下方のシリコン酸化膜28をエッチングにより除去することができる。エッチングされたウエハ32は、洗浄され、ダイシングされて半導体装置10が作製される。ダイシングされた半導体装置10は、吸着コレット等のハンドリング装置に保持されて所定の位置に運搬される。
As shown in FIG. 5, a resist is applied to the upper surface of the
Next, the
半導体装置10をハンドリング装置に吸着して運搬する場合、ハンドリング装置と半導体装置10が当接することで半導体装置10に力が作用し、半導体装置10が欠けてしまう場合がある。また、特許文献2のハンドリング装置のように、半導体装置10をハンドリング装置に接合して運搬する場合は、運搬後のせん断破壊による半導体装置10とハンドリング装置との分離(剥離)のときに、半導体装置10が破損してしまう場合ある。本実施例の半導体装置10では、半導体素子12を外壁16が囲っている。そのため、破損により発生した破片が、半導体素子12に接触することを防止することができる。
また、突起20aは、半導体素子12側に侵入しようとする外壁16の外側の異物を引っ掛かけて、半導体素子12側に異物が侵入することを抑制することができる。なお、この突起20aは、半導体装置10の大きさや用途に応じて、適宜その位置や個数等を変えることができる。
外壁16は、コーナー部18が直線部16よりも厚くなっている。これにより、外壁16の強度を高くすることができる。言い換えれば、コーナー部18を厚くすることで、外壁16の直線部16aを薄くすることができる。ハンドリング装置には、基板24の表面に当接することで、半導体装置を保持するものがある。係る場合、基板24にハンドリング装置が当接する領域を確保する必要がある。外壁16を薄くすることにより、ハンドリング装置が当接する領域を確保しつつ、基板24の大きさを小さくすることができる。
半導体装置は、そのウエハ製造工程の最終工程で洗浄される。半導体装置10では、洗浄工程で使用される洗浄液は、薄肉部16bと基板24との隙間(貫通孔25)から外壁16の外側に流出する。したがって、半導体素子12に洗浄液が残留することを防止することができる。
When the
Further, the
The
The semiconductor device is cleaned in the final process of the wafer manufacturing process. In the
半導体装置10は、パッケージに封入されて装置に取り付けられる。これにより、半導体素子12は、大気中の水蒸気等が付着(結露)しないようにされている。しかしながら、パッケージ内には、半導体装置10を封入するとともに気体も封入される。パッケージに封入される気体の水蒸気を除去することは難しい。また、気体の水蒸気を除去するには、製造コストが高くなってしまう。すなわち、パッケージ内に水蒸気が存在してしまう。半導体素子12は、半導体装置10が使用されている間は、電圧が印加されているため、外壁16よりも高温となっている。そのため、パッケージ内で結露が生じる場合、その結露は、外壁16に付着する。外壁16は、突起20aによって、その表面積が大きくなっている。これにより、より多くの結露を外壁16に付着させることができる。そのため、パッケージ内の湿度を低下させ、半導体素子12に結露が付着することを抑制することができる。
The
以上、本発明の具体例を詳細に説明したが、これらは例示に過ぎず、特許請求の範囲を限定するものではない。特許請求の範囲に記載の技術には、以上に例示した具体例を様々に変形、変更したものが含まれる。
本明細書または図面に説明した技術要素は、単独であるいは各種の組合せによって技術的有用性を発揮するものであり、出願時請求項記載の組合せに限定されるものではない。また、本明細書または図面に例示した技術は複数目的を同時に達成し得るものであり、そのうちの一つの目的を達成すること自体で技術的有用性を持つものである。
Specific examples of the present invention have been described above in detail, but these are merely examples and do not limit the scope of the claims. The technology described in the claims includes various modifications and changes of the specific examples illustrated above.
The technical elements described in this specification or the drawings exhibit technical usefulness alone or in various combinations, and are not limited to the combinations described in the claims at the time of filing. In addition, the technology exemplified in this specification or the drawings can achieve a plurality of objects at the same time, and has technical usefulness by achieving one of the objects.
10:半導体装置
12:半導体素子
14:パッド
16:外壁
16a:直線部
16b:薄肉部
18:コーナー部
20:凹凸部
20a:突起部
24:基板
25:貫通孔
10: Semiconductor device 12: Semiconductor element 14: Pad 16:
Claims (5)
基板の表面に形成された半導体素子と、
基板の表面から立設され、半導体素子の外側を一巡する外壁と、
を有する半導体装置。 A substrate,
A semiconductor element formed on the surface of the substrate;
An outer wall that stands up from the surface of the substrate and goes around the outside of the semiconductor element;
A semiconductor device.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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Country Status (1)
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JP (1) | JP4985011B2 (en) |
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Legal Events
Date | Code | Title | Description |
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A621 | Written request for application examination |
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|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20120117 |
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A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20120224 |
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TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
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A01 | Written decision to grant a patent or to grant a registration (utility model) |
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A61 | First payment of annual fees (during grant procedure) |
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FPAY | Renewal fee payment (prs date is renewal date of database) |
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LAPS | Cancellation because of no payment of annual fees |