JP2008033347A - Electronic circuit, its driving method, electrooptical device, and electronic equipment - Google Patents

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Abstract

<P>PROBLEM TO BE SOLVED: To shorten the time for writing a voltage to a gate of a drive transistor. <P>SOLUTION: In an initialization period, a node B is fixed at an initial voltage V<SB>INI</SB>and transistors 211 and 214 are turned on to flow a current to an OLED element 230 and to hold the voltage in accordance with the current at a node A. Transistors 214 and 211 are thereafter sequentially turned off to hold the threshold voltage of the drive transistor 210 at the node A. In a write period, a transistor 213 is turned on and a data signal X-j is supplied and the voltage of a node B is changed by the value equivalent to the current flowing to the OLED element 230. The node A changes from the threshold voltage as the voltage change is distributed at a capacity ratio. In a light emission period, a transistor 214 is turned on and the current in accordance with the voltage of the node A flows to the OLED element 230. <P>COPYRIGHT: (C)2008,JPO&INPIT

Description

本発明は、有機発光ダイオード素子のような電流駆動型素子を駆動する電子回路、電子回路の駆動方法、電気光学装置および電子機器に関する。   The present invention relates to an electronic circuit for driving a current-driven element such as an organic light-emitting diode element, a driving method for the electronic circuit, an electro-optical device, and an electronic apparatus.

近年、液晶素子に代わる次世代の発光デバイスとして、有機エレクトロルミネッセンス素子や発光ポリマー素子などと呼ばれる有機発光ダイオード(Organic Light Emitting Diode、以下適宜「OLED素子」と略称する)素子が注目されている。このOLED素子は、自発光型であるために視野角依存性が少なく、また、バックライトや反射光が不要であるために低消費電力化や薄型化に向いているなど、表示パネルとして優れた特性を有している。
ここで、OLED素子は、液晶素子のように電圧保持性を有さず、電流が途絶えると、発光状態が維持できなくなる電流型の被駆動素子である。このため、OLED素子をアクティブ・マトリクス方式で駆動する場合、書込期間(選択期間)において、画素の階調に応じた電圧を駆動トランジスタのゲートに書き込んで、当該電圧をゲート容量などにより保持し、当該ゲート電圧に応じた電流を駆動トランジスタがOLED素子に流し続ける構成が一般的となっている。
In recent years, organic light emitting diodes (hereinafter referred to as “OLED elements”) elements called organic electroluminescence elements and light emitting polymer elements have attracted attention as next-generation light-emitting devices that replace liquid crystal elements. Since this OLED element is a self-luminous type, it has less viewing angle dependence, and since it does not require a backlight or reflected light, it is suitable for low power consumption and thinning. It has characteristics.
Here, the OLED element is a current-type driven element that does not have voltage holdability like a liquid crystal element and cannot maintain a light emitting state when current is interrupted. Therefore, when an OLED element is driven by an active matrix method, a voltage corresponding to the gradation of the pixel is written to the gate of the driving transistor in the writing period (selection period), and the voltage is held by a gate capacitance or the like. In general, the driving transistor keeps a current corresponding to the gate voltage flowing through the OLED element.

ところで、この構成では、駆動トランジスタのしきい値電圧特性がばらつくことによって、画素毎に、OLED素子の明るさが相違して表示品位が低下する、という問題が指摘されている。このため、近年では、書込期間において、当該駆動トランジスタをダイオード接続させるとともに、駆動トランジスタからデータ線に定電流を流し、これによって、当該駆動トランジスタのゲートに、OLED素子に流すべき電流に応じた電圧を書き込むようにプログラミングして、駆動トランジスタのしきい値電圧特性のばらつきを補償する技術が提案されている(例えば、特許文献1および2参照)。
米国特許第6229506号公報(FIG.2参照) 特開2003−177709号公報(図3参照)
By the way, in this configuration, there is a problem that the display voltage is deteriorated because the brightness of the OLED element is different for each pixel due to the variation of the threshold voltage characteristics of the driving transistor. Therefore, in recent years, during the writing period, the drive transistor is diode-connected, and a constant current is passed from the drive transistor to the data line, so that the current corresponding to the current to be passed to the OLED element is passed to the gate of the drive transistor. There has been proposed a technique that compensates for variations in threshold voltage characteristics of drive transistors by programming to write a voltage (see, for example, Patent Documents 1 and 2).
US Pat. No. 6,229,506 (see FIG. 2) Japanese Patent Laying-Open No. 2003-177709 (see FIG. 3)

しかしながら、この技術では、例えば駆動トランジスタがnチャネル型である場合に、OLED素子に流すべき電流が小さくなるように設定するとき、書込期間では、当該駆動トランジスタのゲート電圧が低く、当該駆動トランジスタのソース・ドレイン間の電流が流れにくい状態となるので、書込期間内に、当該駆動トランジスタのゲートに目的とする電圧を書き込むことができない、といった問題が新たに指摘された。
本発明は、上述した事情に鑑みてなされたもので、その目的とするところは、駆動トランジスタのゲートに、被駆動素子に流すべき電流に応じた電圧を迅速に書き込むことが可能な電子回路、その駆動方法、当該電子回路を用いた電気光学装置、および、電子機器を提供することにある。
However, in this technique, for example, when the driving transistor is an n-channel type, when the current to be passed through the OLED element is set to be small, the gate voltage of the driving transistor is low during the writing period, and the driving transistor As a result, it has been pointed out that the current voltage cannot be written to the gate of the driving transistor within the writing period.
The present invention has been made in view of the above-described circumstances, and an object thereof is an electronic circuit capable of quickly writing a voltage corresponding to a current to be supplied to a driven element to a gate of a driving transistor, An object is to provide a driving method thereof, an electro-optical device using the electronic circuit, and an electronic apparatus.

上記目的を達成するために本発明に係る電子回路の駆動方法は、被駆動素子に流れる電流を制御する駆動トランジスタと、前記駆動トランジスタのゲートとドレインとの間をオンまたはオフする第1のスイッチング素子と、一端が前記駆動トランジスタのゲートに接続された容量素子とを備える電子回路の駆動方法であって、前記容量素子の他端に初期電圧を印加するとともに、前記第1のスイッチング素子をオンさせた状態にて、前記被駆動素子に電流を流し、この後、前記電流を遮断するとともに、前記容量素子の他端に対する初期電圧の印加を解除し、前記第1のスイッチング素子をオフさせる第1のステップと、前記容量素子の他端に対し、前記被駆動素子に流すべき電流に応じた電圧を印加する第2のステップと、保持されたゲート電圧にしたがった電流を、前記駆動トランジスタが前記被駆動素子に流す第3のステップとを備えることを特徴とする。この方法によれば、第1のステップにおける第1のスイッチング素子のオンオフによって、容量素子の一端および駆動トランジスタのゲート(ノードA)には、当該駆動トランジスタのしきい値に応じた電圧が保持される。次に、第2のステップにおいて、容量素子の他端は、被駆動素子に流すべき電流に応じた電圧の印加によって初期電圧から変化し、この電圧変化に応じた分だけ、ノードAの電圧も変化して保持される。第3のステップにおいては、変化後におけるノードAの電圧に応じた電流が被駆動素子に流れるが、このとき流れる電流は、駆動トランジスタのしきい値特性がキャンセルされている。また、第1のステップにおける容量素子の保持は、被駆動素子に電流を強制的に流すことによって行われるので、時間を要しない。さらに、第2のステップでは、被駆動素子に流すべき電流に応じた電圧を容量素子の他端に印加するのであって、駆動トランジスタのゲートに直接印加しないので、当該電圧の書き込みに要する時間を短縮化することができる。   In order to achieve the above object, a driving method of an electronic circuit according to the present invention includes a driving transistor that controls a current flowing through a driven element, and a first switching that turns on or off between a gate and a drain of the driving transistor. An electronic circuit driving method comprising: an element; and a capacitive element having one end connected to the gate of the driving transistor, wherein an initial voltage is applied to the other end of the capacitive element and the first switching element is turned on. In this state, a current is passed through the driven element, and then the current is interrupted, and the application of the initial voltage to the other end of the capacitive element is released, and the first switching element is turned off. A second step of applying a voltage corresponding to a current to be passed through the driven element to the other end of the capacitive element; The current according to the voltage, the driving transistor is characterized in that it comprises a third step of flowing the driven element. According to this method, the voltage corresponding to the threshold value of the driving transistor is held at one end of the capacitive element and the gate (node A) of the driving transistor by turning on and off the first switching element in the first step. The Next, in the second step, the other end of the capacitive element is changed from the initial voltage by application of a voltage corresponding to the current to be supplied to the driven element, and the voltage of the node A is also increased by the amount corresponding to this voltage change. Change and hold. In the third step, a current corresponding to the voltage of the node A after the change flows to the driven element, and the threshold current characteristic of the driving transistor is canceled for the current flowing at this time. In addition, since the holding of the capacitor element in the first step is performed by forcing a current to flow through the driven element, no time is required. Furthermore, in the second step, a voltage corresponding to the current to be passed through the driven element is applied to the other end of the capacitive element, and is not applied directly to the gate of the driving transistor. It can be shortened.

この駆動方法では、前記第1のステップにおいて、前記第1のスイッチング素子をオンさせるとともに前記被駆動素子に電流を流して、当該電流に応じた電圧を、前記容量素子の一端および前記駆動トランジスタのゲートに保持させる一方、前記電流を遮断させた後に、前記第1のスイッチング素子をオフさせて、前記容量素子の一端および前記駆動トランジスタのゲートに保持された電圧を、前記駆動トランジスタのしきい値電圧に応じた電圧に移行させても良い。この方法によれば、第1のスイッチング素子のオンにより駆動トランジスタがダイオード接続される一方、ノードAは、当該接続状態において被駆動素子に流れた電流に応じた電圧となる。この後、ノードAは、ダイオード接続の解除によって、駆動トランジスタのしきい値電圧に応じた電圧に移行する。
また、前記第1のステップにおいて、前記第1のスイッチング素子をオンさせるとともに前記被駆動素子に電流を流して、当該電流および前記駆動トランジスタのしきい値電圧に応じた電圧を、前記容量素子の一端および前記駆動トランジスタのゲートに保持させても良い。この方法によれば、第1のスイッチング素子のオンにより駆動トランジスタがダイオード接続される一方、ノードAは、当該接続状態において被駆動素子に流れた電流に応じた電圧となる。このため、ノードAの保持電圧は、当該電流および駆動トランジスタのしきい値電圧に応じた電圧となる。
一方、前記第1のステップにおいて、前記第1のスイッチング素子をオンさせるとともに前記被駆動素子に電流を流した後、前記電流の遮断とともに前記第1のスイッチング素子をオフさせて、前記駆動トランジスタのしきい値電圧に応じた電圧を、前記容量素子の一端および前記駆動トランジスタのゲートに保持させても良い。この方法において、第1のスイッチング素子をオンさせたときに、被駆動素子に比較的小さい電流を流すことにより、ノードAに、駆動トランジスタのしきい値電圧に応じた電圧を保持させることができる。
いずれの方法においても、第1のステップは、被駆動素子に流すべき電流に応じた電圧を容量素子の他端に印加する第2のステップの前に、第2のステップとは独立して、第2のステップ以上の時間で実行することが可能である。
In this driving method, in the first step, the first switching element is turned on and a current is passed through the driven element, and a voltage corresponding to the current is applied to one end of the capacitive element and the driving transistor. The first switching element is turned off after the current is cut off while the gate is held, and the voltage held at one end of the capacitive element and the gate of the driving transistor is set to the threshold value of the driving transistor. You may make it transfer to the voltage according to a voltage. According to this method, the driving transistor is diode-connected when the first switching element is turned on, while the node A has a voltage corresponding to the current flowing through the driven element in the connected state. Thereafter, the node A shifts to a voltage corresponding to the threshold voltage of the driving transistor by releasing the diode connection.
In the first step, the first switching element is turned on and a current is passed through the driven element, and a voltage corresponding to the current and the threshold voltage of the driving transistor is set to the capacitance element. One end and the gate of the driving transistor may be held. According to this method, the driving transistor is diode-connected when the first switching element is turned on, while the node A has a voltage corresponding to the current flowing through the driven element in the connected state. For this reason, the holding voltage of the node A is a voltage according to the current and the threshold voltage of the driving transistor.
On the other hand, in the first step, after the first switching element is turned on and a current is passed through the driven element, the current is interrupted and the first switching element is turned off. A voltage corresponding to the threshold voltage may be held at one end of the capacitive element and the gate of the driving transistor. In this method, when the first switching element is turned on, a voltage corresponding to the threshold voltage of the driving transistor can be held at the node A by flowing a relatively small current through the driven element. .
In either method, the first step is independent of the second step before the second step of applying a voltage corresponding to the current to be passed to the driven element to the other end of the capacitive element. It can be executed in a time longer than the second step.

上記目的を達成するために本発明に係る電子回路は、被駆動素子に流れる電流を制御する駆動トランジスタと、前記駆動トランジスタのゲートとドレインとの間にて第1の期間においてオンし、前記第1の期間後の第2の期間の開始タイミングまでにオフする第1のスイッチング素子と、一端が前記駆動トランジスタのゲートに接続された容量素子と、前記第1の期間においてオンして、初期電圧を前記容量素子の他端に印加する一方、前記第2の期間、および、この第2の期間後の第3の期間においてオフする第2のスイッチング素子と、前記被駆動素子に流すべき電流に応じた電圧が印加される信号線と前記容量素子の他端との間にて、前記第2の期間においてオンする第3のスイッチング素子とを備えることを特徴とする。この電子回路によれば、駆動トランジスタのしきい値特性に依存させないで被駆動素子に電流を流すことができるとともに、当該電流に応じた電圧の書き込みに要する時間を短縮化することができる。   In order to achieve the above object, an electronic circuit according to the present invention is turned on in a first period between a drive transistor for controlling a current flowing in a driven element and a gate and a drain of the drive transistor, A first switching element that is turned off by the start timing of the second period after the first period, a capacitive element having one end connected to the gate of the driving transistor, and turned on in the first period to generate an initial voltage Is applied to the other end of the capacitor element, while the second switching element is turned off in the second period and a third period after the second period, and the current to be supplied to the driven element. A third switching element that is turned on in the second period is provided between a signal line to which a corresponding voltage is applied and the other end of the capacitor element. According to this electronic circuit, a current can be passed through the driven element without depending on the threshold characteristics of the driving transistor, and the time required for writing a voltage corresponding to the current can be shortened.

この電子回路において、前記被駆動素子に流れる電流の経路に挿入されて、オフすると、前記駆動トランジスタのゲート電圧にかかわらず、前記被駆動素子に流れる電流を遮断する第4のスイッチング素子であって、前記第1の期間の一部または全部の期間にオンするとともに、前記第3の期間にオンする第4のスイッチング素子を有する構成としても良い。この構成によれば、駆動トランジスタによって制御された電流が被駆動素子に流れる時間を、第4のスイッチング素子のオンオフによって調整することができる。
第4のスイッチング素子を有する場合、前記第1および第4のスイッチング素子は、互いに異なる導電型のトランジスタであって、それらのゲートが共通の制御線に接続される第1の構成、または、前記第1および第2のスイッチング素子は、同一導電型のトランジスタであって、それらのゲートが共通の制御線に接続される第2の構成が好ましい。いずれの構成でも、電子回路への配線数を削減することができる。
In this electronic circuit, a fourth switching element that cuts off a current flowing through the driven element regardless of a gate voltage of the driving transistor when inserted into a path of a current flowing through the driven element and turned off. A fourth switching element which is turned on during part or all of the first period and turned on during the third period may be used. According to this configuration, the time during which the current controlled by the driving transistor flows through the driven element can be adjusted by turning on and off the fourth switching element.
In the case of having a fourth switching element, the first and fourth switching elements are transistors having different conductivity types, the first configuration in which their gates are connected to a common control line, or The first and second switching elements are transistors of the same conductivity type, and preferably have a second configuration in which their gates are connected to a common control line. In any configuration, the number of wirings to the electronic circuit can be reduced.

また、上記第2の構成は、第4のスイッチング素子を有しない場合においても適用可能である。第4のスイッチング素子を有しない場合に第2の構成を適用するとき、前記被駆動素子および前記駆動トランジスタは、第1および第2の電源線の間の電流経路に挿入され、前記第1および第2の電源線の間の電圧は、前記第1の期間では、前記初期電圧であり、前記第3の期間では、所定の電源電圧となる構成としても良い。この構成では、前記第2のスイッチング素子を、前記容量素子の他端と前記駆動トランジスタのドレインとの間にてオンまたはオフさせて、電源線を介し、初期電圧を容量素子の他端に印加しても良いし、それ以外の構成であれば、前記第2のスイッチング素子を、前記容量素子の他端と前記初期電圧が印加された給電線との間においてオンまたはオフさせて、給電線を介し、初期電圧を容量素子の他端に印加しても良い。
なお、上記電子回路において、前記被駆動素子は電気光学素子であることが好ましく、特に、有機発光ダイオード素子であることが望ましい。
Further, the second configuration can be applied even when the fourth switching element is not provided. When the second configuration is applied when the fourth switching element is not provided, the driven element and the driving transistor are inserted into a current path between the first and second power supply lines, and The voltage between the second power supply lines may be the initial voltage in the first period and a predetermined power supply voltage in the third period. In this configuration, the second switching element is turned on or off between the other end of the capacitive element and the drain of the driving transistor, and an initial voltage is applied to the other end of the capacitive element via the power line. In other configurations, the second switching element is turned on or off between the other end of the capacitive element and the power supply line to which the initial voltage is applied. The initial voltage may be applied to the other end of the capacitive element via
In the electronic circuit, the driven element is preferably an electro-optical element, and particularly preferably an organic light emitting diode element.

上記目的を達成するために本発明に係る電気光学装置は、順次選択されると走査線と、電気光学素子に流すべき電流に応じた電圧が印加されるデータ線との交差に対応して画素回路を有する電気光学装置であって、前記画素回路は、前記電気光学素子に流れる電流を制御する駆動トランジスタと、前記駆動トランジスタのゲートとドレインとの間にて第1の期間においてオンし、前記第1の期間後の第2の期間の開始タイミングまでにオフする第1のスイッチング素子と、一端が前記駆動トランジスタのゲートに接続された容量素子と、前記第1の期間においてオンして、初期電圧を前記容量素子の他端に印加する一方、前記第2の期間、および、この第2の期間後の第3の期間においてオフする第2のスイッチング素子と、前記データ線と前記容量素子の他端との間にて、前記第2の期間においてオンする第3のスイッチング素子とを備えることを特徴とする。この電気光学装置によれば、駆動トランジスタのしきい値特性に依存しない電流を電気光学素子に流すことができるとともに、当該電流に応じた電圧の書き込みに要する時間を短縮化することができる。
また、本発明に係る電子機器としては、この電気光学装置を有することが望ましい。
In order to achieve the above object, the electro-optical device according to the present invention includes a pixel corresponding to an intersection of a scanning line and a data line to which a voltage corresponding to a current to be passed through the electro-optical element is applied when sequentially selected. An electro-optical device having a circuit, wherein the pixel circuit is turned on in a first period between a driving transistor that controls a current flowing in the electro-optical element and a gate and a drain of the driving transistor, A first switching element that is turned off by the start timing of the second period after the first period, a capacitor element having one end connected to the gate of the driving transistor, and turned on in the first period to A second switching element that applies a voltage to the other end of the capacitor element and is turned off in the second period and a third period after the second period; and the data line; At between the other end of the serial capacitance element, characterized in that it comprises a third switching element to turn on in the second period. According to this electro-optical device, a current that does not depend on the threshold characteristics of the driving transistor can flow through the electro-optical element, and the time required to write a voltage corresponding to the current can be shortened.
In addition, it is desirable that the electronic apparatus according to the present invention includes this electro-optical device.

以下、本発明の実施形態について図面を参照して説明する。   Embodiments of the present invention will be described below with reference to the drawings.

<第1実施形態>
図1は、本発明の第1実施形態に係る電気光学装置の構成を示すブロック図である。また、図2は、同電気光学装置の画素回路の構成を示す図である。
まず、図1に示されるように、電気光学装置10では、複数本の走査線102が横方向(X方向)に延接される一方、複数本のデータ線(信号線)112が図において縦方向(Y方向)に延設されている。そして、これらの走査線102とデータ線112との交差の各々に対応するように画素回路(電子回路)200がそれぞれ設けられている。
ここで説明の便宜上、本実施形態では、走査線102の本数(行数)を「360」とし、データ線の本数(列数)を「480」として、画素回路200が、縦360行×横480列のマトリクス状に配列する構成を想定する。ただし、本発明をこの配列に限定する趣旨ではない。
なお、画素回路200には、後述するOLED素子が含まれ、このOLED素子への電流を画素回路200毎に制御することによって、所定の画像が階調表示される。
<First Embodiment>
FIG. 1 is a block diagram showing the configuration of the electro-optical device according to the first embodiment of the invention. FIG. 2 is a diagram illustrating a configuration of a pixel circuit of the electro-optical device.
First, as shown in FIG. 1, in the electro-optical device 10, a plurality of scanning lines 102 are extended in the horizontal direction (X direction), while a plurality of data lines (signal lines) 112 are vertically arranged in the drawing. It extends in the direction (Y direction). A pixel circuit (electronic circuit) 200 is provided so as to correspond to each intersection of the scanning line 102 and the data line 112.
Here, for convenience of explanation, in the present embodiment, the number of scanning lines 102 (number of rows) is “360”, the number of data lines (number of columns) is “480”, and the pixel circuit 200 is 360 rows × horizontal. Assume a configuration in which the matrix is arranged in a matrix of 480 columns. However, the present invention is not intended to be limited to this arrangement.
Note that the pixel circuit 200 includes an OLED element to be described later, and a predetermined image is displayed in gradation by controlling the current to the OLED element for each pixel circuit 200.

また、図1においては、X方向に延設されるのは走査線102のみであるが、本実施形態では、走査線102のほかにも、図2に示されるように、制御線104、106および108がそれぞれ行毎にX方向に延設されている。このため、走査線102、制御線104、106および108が1組となって、1行分の画素回路200に兼用されている。   In FIG. 1, only the scanning line 102 is extended in the X direction. However, in the present embodiment, in addition to the scanning line 102, as shown in FIG. And 108 extend in the X direction for each row. For this reason, the scanning line 102 and the control lines 104, 106, and 108 are combined into one set and used as the pixel circuit 200 for one row.

Yドライバ14は、1水平走査期間毎に1行ずつ走査線102を選択するとともに、選択した走査線102に対して、Hレベルの走査信号を供給するとともに、この選択に同期した各種制御信号を、制御線104、106および108に、それぞれ供給するものである。すなわち、Yドライバ14は、走査線102、制御線104、106および108に対し、行毎に、走査信号や制御信号をそれぞれ供給するものである。
ここで、説明の便宜上、i行目(iは、1≦i≦360を満たす整数であり、行を一般化して説明するためのもの)の走査線102に供給される走査信号をGWRT−iと表記する。同様に、i行目の制御線104、106および108に供給される制御信号をGSET−i、GINI−iおよびGEL−iと、それぞれ表記する。
The Y driver 14 selects the scanning line 102 row by row for each horizontal scanning period, supplies an H level scanning signal to the selected scanning line 102, and outputs various control signals synchronized with the selection. , Are supplied to the control lines 104, 106 and 108, respectively. That is, the Y driver 14 supplies a scanning signal and a control signal to the scanning line 102 and the control lines 104, 106, and 108 for each row.
Here, for convenience of explanation, a scanning signal supplied to the scanning line 102 of the i-th row (i is an integer satisfying 1 ≦ i ≦ 360 and is used for generalizing the row) is represented by GWRT−. Indicated as i . Similarly, control signals supplied to the i-th control lines 104, 106, and 108 are denoted as G SET-i , G INI-i, and G EL-i , respectively.

一方、Xドライバ16は、Yドライバ14によって選択された走査線102に対応する1行分の画素回路、すなわち、選択された行に位置する1〜480列の画素回路200の各々に、当該画素回路200のOLED素子に流すべき電流(すなわち、画素の階調)に応じた電圧のデータ信号を、1〜480列目のデータ線112を介して、それぞれ供給するものである。ここで、データ信号は、電圧が高いほど、画素が明るくなるように指定し、反対に、電圧が低いほど、画素が暗くなるように指定する。
なお、説明の便宜上、j列目(jは、1≦j≦480を満たす整数であり、列を一般化して説明するためのもの)のデータ線112に供給されるデータ信号をX−jと表記する。
On the other hand, the X driver 16 applies the pixel circuit for one row corresponding to the scanning line 102 selected by the Y driver 14, that is, to each of the pixel circuits 200 of 1 to 480 columns located in the selected row. A data signal having a voltage corresponding to a current (that is, pixel gradation) to be passed through the OLED element of the circuit 200 is supplied via the data lines 112 in the 1st to 480th columns. Here, the data signal specifies that the pixel is brighter as the voltage is higher, and conversely, the pixel is specified as darker as the voltage is lower.
For convenience of explanation, a data signal supplied to the data line 112 in the j-th column (j is an integer satisfying 1 ≦ j ≦ 480 and generalizing the column) is represented by X−j. write.

すべての画素回路200には、OLED素子の電源となる高位側電圧VELが電源線114を介してそれぞれ供給される。また、すべての画素回路200は、本実施形態において電圧基準の電位Gndに共通接地されている。
なお、画素の最低階調である黒色を指定するデータ信号X−jの電圧はGndよりも高く、画素の最高階調である白色を指定するデータ信号X−jの電圧はVELよりも低く設定される。換言すれば、データ信号X−jの電圧範囲は、電源電圧の内に収まるように設定されている。
一方、本実施形態において、画素回路200には、初期電圧VINIが給電線116を介してそれぞれ供給される。ここで、初期電圧VINIとは、本実施形態では、データ信号X−jがとりうる電圧範囲の最低値、すなわち、画素の最低階調を指定するデータ信号電圧に略一致する。
制御回路12は、Yドライバ14およびXドライバ16に、それぞれクロック信号(図示省略)などを供給して両ドライバを制御するとともに、Xドライバ16に、階調を画素毎に規定する画像データを供給する。
All the pixel circuits 200 are respectively supplied with the high voltage V EL serving as the power source of the OLED element via the power line 114. In addition, all the pixel circuits 200 are commonly grounded to the voltage reference potential Gnd in the present embodiment.
The voltage of the data signal X-j that specifies the black is the lowest gradation of the pixel higher than Gnd, the voltage of the data signal X-j that specifies the white is the highest gray level of the pixel is lower than V EL Is set. In other words, the voltage range of the data signal Xj is set to be within the power supply voltage.
On the other hand, in this embodiment, the pixel circuit 200 is supplied with the initial voltage V INI via the feeder line 116. Here, in this embodiment, the initial voltage V INI substantially coincides with the lowest value of the voltage range that the data signal X-j can take, that is, the data signal voltage that specifies the lowest gradation of the pixel.
The control circuit 12 supplies the Y driver 14 and the X driver 16 with clock signals (not shown), respectively, to control both drivers, and supplies the X driver 16 with image data that defines the gradation for each pixel. To do.

本実施形態において、マトリクス状に配列する画素回路200は、すべて共通の構成である。そこで、画素回路200の構成を、i行j列に位置するもので代表して説明する。 図2に示されるように、画素回路200は、nチャネル型の駆動トランジスタ210と、第1〜第4のスイッチング素子として機能するnチャネル型のトランジスタ211、212、213、214と、容量素子として機能する容量220と、電気光学素子たるOLED素子230とを有する。
このうち、トランジスタ214の一端(ドレイン)は、電源線114に接続される一方、トランジスタ214の他端(ソース)は、駆動トランジスタ210のドレイン、および、トランジスタ211の一端(ドレイン)に、それぞれ接続されている。ここで、トランジスタ214のゲートは、i行目の制御線108に接続されている。このため、トランジスタ214は、制御信号GEL−iがHレベルであればオンし、Lレベルであればオフすることになる。
In the present embodiment, the pixel circuits 200 arranged in a matrix form all have a common configuration. Therefore, the configuration of the pixel circuit 200 will be described as a representative example of the pixel circuit located in i rows and j columns. As illustrated in FIG. 2, the pixel circuit 200 includes an n-channel driving transistor 210, n-channel transistors 211, 212, 213, and 214 that function as first to fourth switching elements, and capacitive elements. It has a functioning capacitor 220 and an OLED element 230 which is an electro-optic element.
Among these, one end (drain) of the transistor 214 is connected to the power supply line 114, and the other end (source) of the transistor 214 is connected to the drain of the driving transistor 210 and one end (drain) of the transistor 211, respectively. Has been. Here, the gate of the transistor 214 is connected to the control line 108 in the i-th row. Therefore, the transistor 214 is turned on when the control signal G EL-i is at the H level, and is turned off when the control signal G EL-i is at the L level.

駆動トランジスタ210のソースは、OLED素子230の陽極に接続される一方、当該OLED素子230の陰極は、電源の低位側電圧Gndに接地されている。このため、OLED素子230は、電源の高位側電圧VELおよび低位側電圧Gndの間の経路に、駆動トランジスタ210およびトランジスタ214とともに電気的に介挿された構成となっている。
駆動トランジスタ210のゲートは、容量220の一端およびトランジスタ211のソースにそれぞれ接続されている。なお、説明の便宜上、容量220の一端(駆動トランジスタ210のゲート)をノードAとする。このノードAには、図2において破線で示されるように、容量が寄生する。この容量はノードAとOLED素子230の陰極の間に寄生する容量であり、駆動トランジスタのゲート容量、OLED素子230の容量、ノードAと陰極の間にある配線の寄生容量などに起因する容量を含んでいる。
The source of the driving transistor 210 is connected to the anode of the OLED element 230, while the cathode of the OLED element 230 is grounded to the lower voltage Gnd of the power source. Therefore, OLED device 230, the path between the high side voltage V EL and low voltage Gnd of the power supply, has an electric intervention inserted configuration together with the driving transistor 210 and the transistor 214.
The gate of the driving transistor 210 is connected to one end of the capacitor 220 and the source of the transistor 211. For convenience of explanation, one end of the capacitor 220 (the gate of the driving transistor 210) is a node A. As shown by a broken line in FIG. 2, a capacitance is parasitic on this node A. This capacitance is a parasitic capacitance between the node A and the cathode of the OLED element 230, and the capacitance caused by the gate capacitance of the driving transistor, the capacitance of the OLED element 230, the parasitic capacitance of the wiring between the node A and the cathode, and the like. Contains.

トランジスタ211は、駆動トランジスタ210のドレインおよびゲート間に電気的に介挿されるとともに、トランジスタ211のゲートは、i行目の制御線104に接続されている。このため、トランジスタ211は、制御信号GSET−iがHレベルとなったときにオンして、駆動トランジスタ210をダイオードとして機能させる。
一方、トランジスタ212の一端(ドレイン)は、給電線116に接続される一方、その他端(ソース)は、トランジスタ213の一端(ドレイン)および容量220の他端にそれぞれ接続されている。このトランジスタ212のゲートは、i行目の制御線106に接続されている。このため、トランジスタ212は、制御信号GINI−iがHレベルとなったときにオンすることになる。
さらに、トランジスタ213の他端(ソース)は、j列目のデータ線112に接続され、そのゲートは、i行目の走査線102に接続されている。このため、トランジスタ213は、走査信号GWRT−iがHレベルとなったときにオンして、j列目のデータ線112に供給されるデータ信号X−j(の電圧)を容量220の他端に印加することになる。
ここで、説明の便宜上、容量の他端(トランジスタ212のソース、トランジスタ213のドレイン)をノードBとする。
The transistor 211 is electrically inserted between the drain and gate of the driving transistor 210, and the gate of the transistor 211 is connected to the control line 104 in the i-th row. Therefore, the transistor 211 is turned on when the control signal G SET-i becomes the H level, and causes the driving transistor 210 to function as a diode.
On the other hand, one end (drain) of the transistor 212 is connected to the power supply line 116, while the other end (source) is connected to one end (drain) of the transistor 213 and the other end of the capacitor 220. The gate of the transistor 212 is connected to the i-th control line 106. Therefore, the transistor 212 is turned on when the control signal G INI-i becomes H level.
Further, the other end (source) of the transistor 213 is connected to the data line 112 in the j-th column, and the gate thereof is connected to the scanning line 102 in the i-th row. Therefore, the transistor 213 is turned on when the scanning signal GWRT-i becomes the H level, and the data signal Xj (voltage) supplied to the data line 112 in the j-th column is supplied to the capacitor 220. It will be applied to the edge.
Here, for convenience of explanation, the other end of the capacitor (the source of the transistor 212 and the drain of the transistor 213) is referred to as a node B.

なお、マトリクス型に配列する画素回路200は、ガラス等の透明基板に、走査線102やデータ線112とともに形成されている。このため、駆動トランジスタ210や、トランジスタ211、212、213、214は、ポリシリコンプロセスによるTFT(薄膜トランジスタ)によって構成される。また、OLED素子230は、基板上において、ITO(酸化錫インジウム)などの透明電極膜を陽極(個別電極)とし、アルミニウムやリチウムなどの単体金属膜またはこれらの積層膜を陰極(共通電極)として、発光層を挟持した構成となっている。   Note that the pixel circuits 200 arranged in a matrix type are formed together with the scanning lines 102 and the data lines 112 on a transparent substrate such as glass. For this reason, the driving transistor 210 and the transistors 211, 212, 213, and 214 are configured by TFTs (thin film transistors) using a polysilicon process. The OLED element 230 has a transparent electrode film such as ITO (indium tin oxide) as an anode (individual electrode) and a single metal film such as aluminum or lithium or a laminated film thereof as a cathode (common electrode) on the substrate. The light emitting layer is sandwiched.

次に、電気光学装置10の動作について説明する。図3は、電気光学装置10の動作を説明するためのタイミングチャートである。
まず、Yドライバ14は、図3に示されるように、1垂直走査期間(1F)の開始時から、1行目、2行目、3行目、…、360行目の走査線102を、順番に1本ずつ1水平走査期間(1H)毎に選択して、選択した走査線102の走査信号のみをHレベルとし、他の走査線への走査信号をLレベルとする。
ここで、i行目の走査線102が選択されて、走査信号GWRT−iがHレベルとなる1水平走査期間(1H)に着目して、当該水平走査期間およびその前後の動作について、図3とともに、図4〜図8を参照して説明する。
Next, the operation of the electro-optical device 10 will be described. FIG. 3 is a timing chart for explaining the operation of the electro-optical device 10.
First, as shown in FIG. 3, the Y driver 14 scans the scanning lines 102 in the first row, the second row, the third row,..., The 360th row from the start of one vertical scanning period (1F). One line at a time is selected for each horizontal scanning period (1H), and only the scanning signal of the selected scanning line 102 is set to H level, and the scanning signal to other scanning lines is set to L level.
Here, focusing on one horizontal scanning period (1H) in which the i-th scanning line 102 is selected and the scanning signal GWRT-i is at the H level, the horizontal scanning period and operations before and after the horizontal scanning period are shown in FIG. 3 and FIG. 4 will be described with reference to FIGS.

図3に示されるように、走査信号GWRT−iがHレベルに変化するタイミングよりも期間Tiだけ先行したタイミングt1から、i行j列における画素回路200の書込動作の事前準備が開始する。一方、走査信号GWRT−iがHレベルから再びLレベルに変化すると、書き込んだ電圧に基づく発光が開始する。
このため、i行j列の画素回路200の動作については、大別すると、タイミングt1から走査信号GWRT−iがHレベルに変化するまでの第1の期間(1)、走査信号GWRT−iがHレベルとなる第2の期間、および、走査信号GWRT−iがLレベルに変化した後の第3の期間、の3つにわけることができる。
これらの第1〜第3の期間については、その動作内容に着目して、それぞれ初期化期間(1)、書込期間(2)および発光期間(3)と称することにする。このうち、初期化期間(1)については、本実施形態では、さらに3つの期間(1a)、(1b)および(1c)とに分けることができる。
以下、これらの期間の動作について順を追って説明することにする。
As shown in FIG. 3, the preparation for the writing operation of the pixel circuit 200 in the i-th row and the j-th column starts from the timing t1 preceding the timing at which the scanning signal G WRT-i changes to the H level by the period Ti. . On the other hand, when the scanning signal G WRT-i changes from the H level to the L level again, light emission based on the written voltage starts.
For this reason, the operation of the pixel circuit 200 in the i row and j column is roughly divided into the first period (1) from the timing t1 until the scanning signal G WRT-i changes to the H level, and the scanning signal G WRT−. It can be divided into a second period in which i is at the H level and a third period after the scanning signal G WRT-i is changed to the L level.
These first to third periods are referred to as an initialization period (1), a writing period (2), and a light emission period (3), respectively, paying attention to the operation contents. Of these, the initialization period (1) can be further divided into three periods (1a), (1b), and (1c) in the present embodiment.
Hereinafter, the operation during these periods will be described in order.

まず、タイミングt1の前において、走査信号GWRT−i、制御信号GSET−i、GINI−iおよびGEL−iいずれもLレベルである。そして、タイミングt1に至ると、初期化期間(1)のうち、最初の期間(1a)となり、Yドライバ14は、制御信号GSET−i、GINI−iおよびGEL−iをいずれもHレベルとする。このため、画素回路200では、図4に示されるように、Hレベルの制御信号GSET−iによりトランジスタ211がオンするので、駆動トランジスタ210がダイオードとして機能する。また、Hレベルの制御信号GEL−iによりトランジスタ214もオンする。
したがって、期間(1a)において、画素回路200では、電流が電源線114→トランジスタ214→駆動トランジスタ210→OLED素子230→接地Gndという経路にて流れるので、ノードAは、この電流に応じた電圧、詳細には、当該電流を流す駆動トランジスタ210のゲート電圧となる。
一方、制御信号GINI−iは、初期化期間(1)の全域にわたってHレベルとなって、トランジスタ212をオンさせる。このため、ノードBは、初期化期間(1)にわたって初期電圧VINIに固定されるので、容量220からみてノードBの反対側に位置するノードAでは、その電圧状態が保持されることになる。したがって、期間(1a)においてノードAは、OLED素子230に流れた電流に応じた電圧に保持されることになる。
First, before the timing t1, the scanning signal G WRT-i , the control signals G SET-i , G INI-i, and G EL-i are all at the L level. When the timing t1 is reached, the first period (1a) of the initialization period (1) is reached, and the Y driver 14 sets the control signals G SET-i , G INI-i and G EL-i to H. Level. Therefore, in the pixel circuit 200, as shown in FIG. 4, the transistor 211 is turned on by the control signal G SET-i at the H level, so that the driving transistor 210 functions as a diode. Further, the transistor 214 is also turned on by the control signal G EL-i at the H level.
Therefore, in the period (1a), in the pixel circuit 200, the current flows through the path of the power supply line 114 → the transistor 214 → the driving transistor 210 → the OLED element 230 → the ground Gnd, so that the node A has a voltage corresponding to the current, Specifically, this is the gate voltage of the driving transistor 210 through which the current flows.
On the other hand, the control signal G INI-i becomes H level over the entire initialization period (1) and turns on the transistor 212. For this reason, since the node B is fixed to the initial voltage V INI over the initialization period (1), the voltage state is maintained in the node A located on the opposite side of the node B as viewed from the capacitor 220. . Therefore, the node A is held at a voltage corresponding to the current flowing through the OLED element 230 in the period (1a).

なお、この期間(1a)では、OLED素子230に電流が流れるので、当該OLED素子230が発光する。ただし、この期間(1a)は、表示の単位期間である1垂直走査期間(1F)と比較して、無視できる程度に短く設定されるので、期間(1a)での発光は、後述する発光期間(3)における発光、すなわち、OLED素子230に目的とする電流が流れることによる発光に影響を与えることはない。   In this period (1a), since a current flows through the OLED element 230, the OLED element 230 emits light. However, since this period (1a) is set to be negligibly short as compared with one vertical scanning period (1F) which is a unit period of display, light emission in the period (1a) is a light emission period described later. The light emission in (3), that is, the light emission due to the flow of the target current to the OLED element 230 is not affected.

次に、初期化期間(1)の期間(1b)開始タイミングに至ると、Yドライバ14は、制御信号GEL−iをLレベルに復帰させる一方、制御信号GSET−i、GINI−iをともにHレベルに維持する。このため、画素回路200では、図5に示されるように、トランジスタ214がオフするので、OLED素子230の電流経路は遮断される。ただし、トランジスタ211のオンが継続するので、駆動トランジスタ210が引き続きダイオードとして機能する。このため、ノードAは、駆動トランジスタ210のしきい値電圧Vthnに向かって自己補償的に徐々に移行する。
そして、期間(1b)の終了タイミングでは、ノードAは、しきい値電圧Vthnにほぼ一致することになる。
Next, when the period (1b) start timing of the initialization period (1) is reached, the Y driver 14 returns the control signal G EL-i to L level, while the control signals G SET-i and G INI-i Are both kept at the H level. For this reason, in the pixel circuit 200, as shown in FIG. 5, since the transistor 214 is turned off, the current path of the OLED element 230 is cut off. However, since the transistor 211 is kept on, the driving transistor 210 continues to function as a diode. Therefore, the node A gradually shifts in a self-compensating manner toward the threshold voltage V thn of the driving transistor 210.
Then, at the end timing of the period (1b), the node A substantially coincides with the threshold voltage V thn .

続いて、初期化期間(1)の期間(1c)の開始タイミングにおいて、Yドライバ14は、制御信号GSET−iをLレベルに復帰させる。このため、画素回路200では、図6に示されるように、駆動トランジスタ210のダイオード接続が解除されるので、ノードAの電圧がVthnに確定することになる。 Subsequently, at the start timing of the period (1c) of the initialization period (1), the Y driver 14 returns the control signal G SET-i to the L level. For this reason, in the pixel circuit 200, as shown in FIG. 6, the diode connection of the driving transistor 210 is released, so that the voltage of the node A is determined to be V thn .

次に、書込期間(2)において、Yドライバ14は、制御信号GINI−iをLレベルに復帰させる一方、走査信号GWRT−iをHレベルとする。このため、図7に示されるように、トランジスタ212がオフし、トランジスタ213がオンする。
また、書込期間(2)において、Xドライバ16は、i行j列の画素の階調に応じた電圧のデータ信号X−jをj列目のデータ線112に供給する。上述したように、画素の最低階調を指定するデータ信号X−jの電圧がVINIであり、画素が明るく指定するにつれて、データ信号X−jの電圧が高くなるので、データ信号X−jの電圧は(VINI+ΔV)として表すことができる。
なお、ΔVは、初期電圧VINIからの電圧変化(上昇)分であって、画素を最低階調の黒色に指定する場合にはゼロであり、明るい階調を指定するにつれて次第に高くなる。したがって、ノードBは、初期化期間(1)から書込期間(2)にかけて、ΔVだけ変動する。
Next, in the writing period (2), the Y driver 14 returns the control signal G INI-i to the L level, and sets the scanning signal G WRT-i to the H level. Therefore, as shown in FIG. 7, the transistor 212 is turned off and the transistor 213 is turned on.
In the writing period (2), the X driver 16 supplies the data signal Xj having a voltage corresponding to the gradation of the pixel in the i row and the j column to the data line 112 in the j column. As described above, the voltage of the data signal X-j that specifies the lowest gradation of the pixel is V INI , and the voltage of the data signal X-j increases as the pixel specifies brighter. Can be expressed as (V INI + ΔV).
Note that ΔV is a voltage change (rise) from the initial voltage V INI , and is zero when the pixel is designated as the lowest gradation black, and gradually increases as the bright gradation is designated. Therefore, the node B varies by ΔV from the initialization period (1) to the writing period (2).

一方、書込期間(2)において、画素回路200では、トランジスタ211がオフであるので、ノードAは、駆動トランジスタ210のゲート容量のみによって保持されることになる。このため、ノードAは、ノードBにおける電圧変化分ΔVを容量220と駆動トランジスタ210のゲート容量との容量比で配分した分だけ、初期化期間(1)の電圧Vthnから上昇することになる。
詳細には、容量220のサイズをCaとし、駆動トランジスタ210のゲート容量をCbとしたときに、ノードAは、電圧Vthnから、{ΔV・Ca /(Ca+Cb)}だけ上昇するので、結果的に、ノードAの電圧Vgは、次式のように表すことができる。
Vg=Vthn+ΔV・Ca /(Ca+Cb)……(a)
On the other hand, in the writing period (2), since the transistor 211 is off in the pixel circuit 200, the node A is held only by the gate capacitance of the driving transistor 210. For this reason, the node A rises from the voltage V thn in the initialization period (1) by the amount of the voltage change ΔV at the node B distributed by the capacitance ratio between the capacitor 220 and the gate capacitance of the driving transistor 210. .
Specifically, when the size of the capacitor 220 is Ca and the gate capacitance of the driving transistor 210 is Cb, the node A rises from the voltage V thn by {ΔV · Ca / (Ca + Cb)}. In addition, the voltage Vg at the node A can be expressed as follows.
Vg = V thn + ΔV · Ca / (Ca + Cb) (a)

そして、発光期間(3)に至ると、Yドライバ14は、走査信号GWRT−iをLレベルとする一方、制御信号GEL−iをHレベルとする。
このため、画素回路200では、図8に示されるように、トランジスタ213がオフするが、容量220における電圧保持状態は変化しないので、ノードAは、電圧Vgに維持される。一方、トランジスタ214がオンするので、OLED素子230には、電圧Vgに応じた電流IELが、上記電流経路にて流れることになる。これにより、OLED素子230は、当該電流IELに応じた明るさで発光し続けることになる。
In the light emission period (3), the Y driver 14 sets the scanning signal G WRT-i to the L level and sets the control signal G EL-i to the H level.
For this reason, in the pixel circuit 200, as shown in FIG. 8, the transistor 213 is turned off, but the voltage holding state in the capacitor 220 does not change, so the node A is maintained at the voltage Vg. On the other hand, since the transistor 214 is turned on, the current I EL corresponding to the voltage Vg flows through the OLED element 230 through the current path. As a result, the OLED element 230 continues to emit light with brightness according to the current I EL .

発光期間(3)において、OLED素子230に流れる電流IELは、駆動トランジスタ210のソース・ドレイン間の導通状態によって定まり、当該導通状態は、ノードAの電圧で設定される。ここで、駆動トランジスタ210のソースからみたゲートの電圧は、ノードAの電圧Vgそのものであるので、電流IELは、次のように示される。
EL=(β/2)(Vg−Vthn ……(b)
なお、この式においてβは、駆動トランジスタ210の利得係数である。
In the light emission period (3), the current I EL flowing through the OLED element 230 is determined by the conduction state between the source and drain of the driving transistor 210, and the conduction state is set by the voltage of the node A. Here, since the voltage of the gate viewed from the source of the driving transistor 210 is the voltage Vg of the node A itself, the current I EL is expressed as follows.
I EL = (β / 2) (Vg−V thn ) 2 (b)
In this equation, β is a gain coefficient of the driving transistor 210.

ここで、式(b)に式(a)を代入して整理すると、
EL=(β/2){ΔV・Ca /(Ca+Cb)} ……(c)
となる。この式(c)に示されるように、OLED素子230に流れる電流IELは、駆動トランジスタ210のしきい値Vthnに依存することなく、初期電圧VINIからの変化分ΔVのみによって定まることになる(容量Ca、Cbおよび利得係数βは、固定値である)。
Here, by substituting equation (a) into equation (b),
I EL = (β / 2) {ΔV · Ca / (Ca + Cb)} 2 (c)
It becomes. As shown in the equation (c), the current I EL flowing through the OLED element 230 is determined only by the change ΔV from the initial voltage V INI without depending on the threshold value V thn of the driving transistor 210. (Capacitances Ca and Cb and gain coefficient β are fixed values).

発光期間(3)が予め指定された期間だけ継続すると、Yドライバ14は、制御信号GEL−iをLレベルにする。これにより、トランジスタ214がオフするので、電流経路が遮断される結果、OLED素子230は消灯することになる。
ここで、Yドライバ14は、1行目から360行目までに対応する制御信号GEL−1〜GEL−360のHレベル期間が同一となるように制御する。換言すれば、すべてのOLED素子230に対して、1垂直走査期間において発光期間(3)の占める割合が一定になるように制御する。このため、発光期間(3)が長くすると、画面全体が明るくなる一方、短くすると、画面全体が暗くすることができる。
なお、発光期間(3)の最長は、1垂直走査期間(1F)のうち、初期化期間(1)および書込期間(2)を除いた期間の全域である。このため、i行目でいえば、制御信号GEL−iは、走査信号GWRT−iがHレベルからLレベルに変化するタイミングから、1垂直走査期間(1F)経過して、再びi行目の走査線102が選択されるタイミングより期間Tiだけ先行したタイミングt1までの期間でHレベルをとることができる。
When the light emission period (3) continues for a predetermined period, the Y driver 14 sets the control signal G EL-i to the L level. As a result, the transistor 214 is turned off. As a result, the current path is interrupted, so that the OLED element 230 is turned off.
Here, the Y driver 14 performs control such that the H level periods of the control signals G EL-1 to G EL-360 corresponding to the first to 360th rows are the same. In other words, control is performed so that the proportion of the light emission period (3) is constant in one vertical scanning period for all the OLED elements 230. For this reason, when the light emission period (3) is lengthened, the entire screen is brightened, while when it is shortened, the whole screen can be darkened.
The longest light emission period (3) is the entire period excluding the initialization period (1) and the writing period (2) in one vertical scanning period (1F). Therefore, in the i-th row, the control signal G EL-i is returned to the i-th row after one vertical scanning period (1F) has elapsed from the timing when the scanning signal G WRT-i changes from the H level to the L level. The H level can be taken in a period up to timing t1 preceding the timing at which the eye scanning line 102 is selected by a period Ti.

ここでは、i行j列の画素回路200の動作について説明したが、i行の他の画素についてもすべて初期化期間(1)、書込期間(2)および発光期間(3)の動作が同時並列的に実行される。
また、i行目について着目して説明したが、1行目から360行目までについては、1水平走査期間(1H)毎に順番に走査線102が選択されて、当該選択期間において書込期間(2)の動作が実行される。そして、書込期間(2)の前には初期化期間(1)が、書込期間(2)の後には発光期間(3)が、それぞれ実行される。例えば、i行目に続く(i+1)行目については、図3に示されるように、走査信号GWRT-(i+1)がHレベルになるタイミングより期間Tiだけ先行したタイミングt2から、初期化期間(1)となり、この後、走査信号GWRT−(i+1)がHレベルになる期間で書込期間(2)となる。(i+1)行目の書込期間において、j列目のデータ線112には、(i+1)行j列の画素の階調に応じた電圧のデータ信号X−jが供給されて、その電圧変化分がノードAに書き込まれ、この後、発光期間(3)となる。
したがって、初期化期間(1)が隣接する2行以上にわたって並行して実行される場合もあり得る。同様に、発光期間(3)も隣接する2行以上にわたって並行して実行される。
Here, the operation of the pixel circuit 200 in the i row and j column has been described. However, the operations of the initialization period (1), the writing period (2), and the light emission period (3) are simultaneously performed for all the other pixels in the i row. Run in parallel.
Further, the i-th row has been described, but for the first to 360-th rows, the scanning line 102 is selected in order for each horizontal scanning period (1H), and the writing period in the selected period. The operation (2) is executed. The initialization period (1) is executed before the writing period (2), and the light emission period (3) is executed after the writing period (2). For example, for the (i + 1) -th row following the i-th row, as shown in FIG. 3, the initialization period starts from the timing t2 preceding the timing when the scanning signal G WRT- (i + 1) becomes H level by the period Ti. After that, the writing period (2) is reached in a period in which the scanning signal G WRT- (i + 1) is at the H level. In the writing period of the (i + 1) th row, the data signal X-j having a voltage corresponding to the gradation of the pixel in the (i + 1) th row j column is supplied to the data line 112 in the jth column, and the voltage change thereof Minutes are written in the node A, and thereafter, the light emission period (3) is entered.
Therefore, the initialization period (1) may be executed in parallel over two or more adjacent rows. Similarly, the light emission period (3) is also executed in parallel over two or more adjacent rows.

この第1実施形態によれば、初期化期間(1)のうち期間(1a)において、駆動トランジスタ210をダイオード接続し、OLED素子230に電流を強制的に流すことによって、ノードAを、当該電流に応じた電圧とさせる一方、ノードBを初期電圧VINIに固定させる。このため、ノードAは、なんらかの電圧に直ちに達して保持されることになる。この後、ダイオード接続を維持した状態で、トランジスタ214をオフさせることにより、期間(1b)の終了タイミングまでに、ノードAの電圧をVthnにシフトさせる。そして、期間(1c)において、ノードAの電圧をVthnに確定させる。この初期化期間(1)は、行が選択される書込期間(2)とは無関係な期間であって、時間的に手前の期間で実行されるので、1垂直走査期間(1F)において、十分に長い期間を確保することができる。
次に、書込期間(2)では、データ信号X−jをノードBに印加して容量220の他端を電圧変化させ、この電圧変化による電荷の再分配によって、駆動トランジスタ210のゲートに、OLED素子230に流すべき電流に応じた電圧を書き込んでいる。このため、初期化期間(1)の確保とあいまって、駆動トランジスタ210のゲートに、OLED素子230に流すべき電流に応じた電圧を直接書き込む方式と比較して、電圧の書き込みに要する時間を短縮化することが可能となる。
さらに、発光期間(3)において、OLED素子230に流れる電流は、駆動トランジスタ210のしきい値電圧Vthnに依存しない。このため、画素回路200毎に、駆動トランジスタ210のしきい値電圧Vthnがバラついても、OLED素子230に流す電流を均一に揃えることができる。
したがって、第1実施形態に係る電気光学装置によれば、高解像度化に伴って画素数が増加しても、データ信号の書き込み時間が短くて済むとともに、OLED素子230に流れる電流の均一性を確保することが可能となる。
According to the first embodiment, in the period (1a) of the initialization period (1), the drive transistor 210 is diode-connected, and a current is forced to flow through the OLED element 230, whereby the node A is connected to the current A. On the other hand, the node B is fixed to the initial voltage V INI . Therefore, the node A immediately reaches some voltage and is held. After that, the transistor 214 is turned off while the diode connection is maintained, so that the voltage of the node A is shifted to V thn by the end timing of the period (1b). Then, in the period (1c), the voltage of the node A is fixed to V thn . This initialization period (1) is a period unrelated to the writing period (2) in which a row is selected, and is executed in a period before this time. Therefore, in one vertical scanning period (1F), A sufficiently long period can be secured.
Next, in the writing period (2), the data signal X-j is applied to the node B to change the voltage of the other end of the capacitor 220, and the charge is redistributed due to this voltage change. A voltage corresponding to the current to be passed through the OLED element 230 is written. For this reason, coupled with the securing of the initialization period (1), the time required for voltage writing is shortened compared to the method of directly writing the voltage corresponding to the current to be passed through the OLED element 230 to the gate of the driving transistor 210. Can be realized.
Further, in the light emission period (3), the current flowing through the OLED element 230 does not depend on the threshold voltage V thn of the drive transistor 210. For this reason, even if the threshold voltage V thn of the drive transistor 210 varies for each pixel circuit 200, the current flowing through the OLED element 230 can be made uniform.
Therefore, according to the electro-optical device according to the first embodiment, even when the number of pixels increases as the resolution increases, the writing time of the data signal can be shortened, and the uniformity of the current flowing through the OLED element 230 can be reduced. It can be secured.

なお、第1実施形態に係る画素回路200において、トランジスタ211は、オンすることにより駆動トランジスタ210をダイオード接続する機能を有するのに対し、トランジスタ214は、オフすることによって駆動トランジスタ210およびOLED素子230の電流経路を遮断する機能を有するものであり、両者の機能は全く異なる。このため、第1実施形態では、図2に示されるように、トランジスタ211については制御線104によって、トランジスタ214については制御線108によって、それぞれ独立にオンオフ制御する構成とした。
しかしながら、図9に示されるように、例えばトランジスタ214の導電型をpチャネル型に変更することによって、両トランジスタ211、214のチャネル型を互いに異ならせるとともに、共通の制御線108によってオンオフ制御する構成としても良い。このような構成を採用すると、図2の構成と比較して、制御線104が不要となるので、制御線が1行当たり1本削減される結果、歩留まり向上や、ボトムエミッション型の場合に開口率を高めた明るい表示が可能となる。
また、トランジスタ211、212をともに同一のチャネル型にすると、トランジスタ211、212のしきい値電圧が同等となるため、異なるチャネル型で構成した場合と比して同一の制御信号GINI−iにより動作を確実に制御することができる。例えば、同一の制御信号GINI−iに対して、一方のトランジスタがオンして、他方のトランジスタがオフするなどの誤動作を防止することができる。また、同一のチャネル型とすることにより、トランジスタに不純物を注入する際のマージンを設ける必要がなく、トランジスタ211とトランジスタ212とをより近接して配置することが可能である。したがって、画素領域におけるトランジスタ占有領域を最小限とできると共に、トランジスタ211とトランジスタ212とのトランジスタ特性をばらつきなく製造することが可能である。 さらに、駆動トランジスタ210がトランジスタ211とトランジスタ212と同一のチャネル型であれば、同様の効果が得られる。また、同一のチャネル型のみにて構成することにより、画素回路に供給する信号に対する電源の電圧範囲を最低限とすることができるため、信頼性の高い電子回路を実現することができる。
In the pixel circuit 200 according to the first embodiment, the transistor 211 has a function of diode-connecting the driving transistor 210 when turned on, whereas the transistor 214 is turned off and the driving transistor 210 and the OLED element 230 are turned off. These functions are completely different from each other. Therefore, in the first embodiment, as shown in FIG. 2, the transistor 211 is controlled to be turned on and off independently by the control line 104 and the transistor 214 by the control line 108.
However, as shown in FIG. 9, for example, by changing the conductivity type of the transistor 214 to the p-channel type, the channel types of the transistors 211 and 214 are made different from each other, and the on / off control is performed by the common control line 108. It is also good. When such a configuration is adopted, the control line 104 is not necessary as compared with the configuration of FIG. 2, and as a result, one control line is reduced per row, resulting in an improvement in yield and an opening in the case of the bottom emission type. Bright display with an increased rate is possible.
Further, if the transistors 211 and 212 are both of the same channel type, the threshold voltages of the transistors 211 and 212 are equal, so that the same control signal G INI-i is used as compared with the case of different channel types. The operation can be reliably controlled. For example, malfunctions such as one transistor turning on and the other transistor turning off with respect to the same control signal G INI-i can be prevented. In addition, by using the same channel type, it is not necessary to provide a margin for injecting impurities into the transistor, and the transistor 211 and the transistor 212 can be arranged closer to each other. Therefore, the transistor occupation region in the pixel region can be minimized, and the transistor characteristics of the transistor 211 and the transistor 212 can be manufactured without variation. Further, if the driving transistor 210 is the same channel type as the transistors 211 and 212, the same effect can be obtained. Further, by using only the same channel type, the voltage range of the power supply with respect to the signal supplied to the pixel circuit can be minimized, so that a highly reliable electronic circuit can be realized.

<第2実施形態>
次に、本発明の第2実施形態に係る電気光学装置について説明する。この第2実施形態に係る電気光学装置は、第1実施形態における画素回路を図10に示される画素回路200に置換したものである。
図2に示される画素回路200は、トランジスタ211、212のオンオフを、それぞれ別々の制御信号GSET−i、GINI−iによって独立に制御する構成であったが、図10に示される画素回路は、制御線106に供給される制御信号GINI−iによって共通に制御する構成としたものである。
<Second Embodiment>
Next, an electro-optical device according to a second embodiment of the invention will be described. The electro-optical device according to the second embodiment is obtained by replacing the pixel circuit in the first embodiment with a pixel circuit 200 shown in FIG.
The pixel circuit 200 shown in FIG. 2 has a configuration in which the transistors 211 and 212 are controlled to be turned on and off independently by separate control signals G SET-i and G INI-i , but the pixel circuit shown in FIG. Is configured to be commonly controlled by a control signal G INI-i supplied to the control line 106.

図11は、第2実施形態に係る電気光学装置の動作を説明するためのタイミングチャートである。
この図に示されるように、第2実施形態では、制御信号GINI−iにしたがってトランジスタ211、212のオンオフが共通に制御されるので、初期化期間(1)には、期間(1c)が含まれない。ただし、図10に示される画素回路200では、期間(1b)の終了時に、トランジスタ211、212が同時にオフするので、ノードAの電圧は、初期化期間(1b)の終了と同時に確定することになる。
なお、他の動作については、第1実施形態と同様であるので、その説明を省略する。この第2実施形態に係る電気光学装置によれば、図9に示される画素回路と同様に、制御線104が不要となり、制御線が1行当たり1本削減されるので、歩留まりや開口率を向上させることができる。
FIG. 11 is a timing chart for explaining the operation of the electro-optical device according to the second embodiment.
As shown in this figure, in the second embodiment, the transistors 211 and 212 are commonly controlled to be turned on and off in accordance with the control signal G INI-i, so that the period (1c) is included in the initialization period (1). Not included. However, in the pixel circuit 200 shown in FIG. 10, the transistors 211 and 212 are simultaneously turned off at the end of the period (1b), so that the voltage at the node A is determined simultaneously with the end of the initialization period (1b). Become.
Since other operations are the same as those in the first embodiment, description thereof is omitted. According to the electro-optical device according to the second embodiment, similarly to the pixel circuit shown in FIG. 9, the control line 104 is not necessary, and one control line is reduced per row, so that the yield and the aperture ratio are reduced. Can be improved.

<第3実施形態>
次に、本発明の第3実施形態に係る電気光学装置について説明する。この第3実施形態に係る電気光学装置は、第1実施形態における画素回路を図12に示される画素回路200に置換したものである。
図12に示される画素回路200は、図10に示した画素回路からトランジスタ214を取り除いた構成としたものである。したがって、図12に示される画素回路200において、制御線108は不要となる。
<Third Embodiment>
Next, an electro-optical device according to a third embodiment of the invention will be described. The electro-optical device according to the third embodiment is obtained by replacing the pixel circuit in the first embodiment with a pixel circuit 200 shown in FIG.
The pixel circuit 200 shown in FIG. 12 has a configuration in which the transistor 214 is removed from the pixel circuit shown in FIG. Therefore, the control line 108 is not necessary in the pixel circuit 200 shown in FIG.

図13は、第2実施形態に係る電気光学装置の動作を説明するためのタイミングチャートである。
この図に示されるように、第3実施形態では、i行目でいえば、走査信号GWRT−iがHレベルとなる書込期間(2)よりも手前において、期間Tiだけ制御信号GINI−iがHレベルとなる初期化期間(1)が設けられている。
この初期化期間(1)では、トランジスタ211、212が同時にオンするので、電流が(ダイオード接続された)駆動トランジスタ210とOLED素子230とに流れることになる。そして、初期化期間(1)の終了タイミングにおいて、制御信号GINI−iがLレベルとなり、トランジスタ211、212が同時にオフするので、第1および第2実施形態のように、駆動トランジスタ210のダイオード接続を継続することによる自己補償的なノードAの電圧シフトが発生しない。
FIG. 13 is a timing chart for explaining the operation of the electro-optical device according to the second embodiment.
As shown in this figure, in the third embodiment, in the i-th row, the control signal G INI is supplied only during the period Ti before the writing period (2) in which the scanning signal G WRT-i is at the H level. An initialization period (1) in which −i is at the H level is provided.
In this initialization period (1), the transistors 211 and 212 are simultaneously turned on, so that a current flows through the drive transistor 210 and the OLED element 230 (diode-connected). Then, at the end timing of the initialization period (1), the control signal G INI-i becomes L level and the transistors 211 and 212 are turned off at the same time. Thus, as in the first and second embodiments, the diode of the drive transistor 210 Self-compensating node A voltage shift due to continued connection does not occur.

このため、初期化期間(1)の終了時においてノードAには、OLED素子230に流れた電流に応じた電圧であって、駆動トランジスタ210のしきい値電圧Vthnを反映した電圧となり、第1および第2実施形態と比較して高くなる。そこで、第3実施形態では、ノードAの電圧が高くなることに対応して、給電線116を介して供給される初期電圧VINIも高く設定される。
詳細には、初期電圧VINIは、初期化期間(1)から書込期間(2)にかけてノードBが電圧変化する際の基準電圧であり、この電圧変化に応じた電圧が書込期間(2)においてノードAに書き込まれる点は、第1、第2実施形態と同様である。ただし、第3実施形態では、初期化期間(1)におけるノードAの電圧ポイントが高いので、第1、第2実施形態と同様に初期化電圧VINIを低く設定しまうと、書込期間(2)においてノードAは、高い電圧ポイントから上昇するだけとなり、ノードBに低い電圧を書き込んで、低階調(暗階調)に相当する電流をOLED素子230に流すことができなくなってしまう。そこで、第3実施形態では、初期電圧VINIを第1、第2実施形態よりも高く設定し、初期化期間(1)から書込期間(2)にかけてノードBが電圧上昇するのみならず、下降する場合もありえる構成としているのである。
そして、この構成において、低階調(暗階調)に相当する電流をOLED素子230に流す場合には、初期化期間(1)から書込期間(2)にかけてノードBが電圧下降(放電)し、その下降分に応じた電圧がノードAに書き込まれるので、ノードBの電圧を低くして、低階調(暗階調)に相当する電流をOLED素子230に流すことが可能となるのである。
なお、第3実施形態における初期電圧VINIは、画素の最低階調(黒色)と最高階調(白色)との間における中間階調(灰色)を指定するデータ信号の電圧に相当することになる。
Therefore, at the end of the initialization period (1), the voltage at the node A is a voltage corresponding to the current flowing through the OLED element 230, which reflects the threshold voltage V thn of the driving transistor 210, and Compared to the first and second embodiments. Therefore, in the third embodiment, the initial voltage V INI supplied via the feeder line 116 is also set high in response to the increase in the voltage at the node A.
Specifically, the initial voltage V INI is a reference voltage when the voltage of the node B changes from the initialization period (1) to the writing period (2), and the voltage corresponding to this voltage change is the writing period (2 ) Is the same as in the first and second embodiments. However, in the third embodiment, since the voltage point of the node A in the initialization period (1) is high, if the initialization voltage V INI is set low as in the first and second embodiments, the writing period (2 ), The node A only rises from a high voltage point, and a low voltage is written to the node B, so that a current corresponding to a low gradation (dark gradation) cannot flow through the OLED element 230. Therefore, in the third embodiment, the initial voltage V INI is set higher than those in the first and second embodiments, and not only the node B increases in voltage from the initialization period (1) to the writing period (2), The structure may be lowered.
In this configuration, when a current corresponding to a low gradation (dark gradation) is supplied to the OLED element 230, the node B is lowered (discharged) from the initialization period (1) to the writing period (2). Since the voltage corresponding to the decrease is written into the node A, the voltage at the node B can be lowered and a current corresponding to a low gradation (dark gradation) can be supplied to the OLED element 230. is there.
Note that the initial voltage V INI in the third embodiment corresponds to the voltage of a data signal that specifies an intermediate gradation (gray) between the lowest gradation (black) and the highest gradation (white) of the pixel. Become.

この第3実施形態に係る電気光学装置によれば、図9や図10に示される画素回路と比較して、制御線104も不要となるので、制御線が1行当たり1本(図2の画素回路と比較すると2本)削減されるとともに、画素回路1個当たりのトランジスタ数も1個削減されるので、歩留まりや開口率を、より高めることが可能となる。
ただし、第3実施形態では、トランジスタ214が存在しないので、発光期間(3)を調整することによる画面全体の輝度調整ができない。また、書込期間(2)においても、ノードAの電圧に応じた電流がOLED素子230に流れる。
According to the electro-optical device according to the third embodiment, the control line 104 is not necessary as compared with the pixel circuit shown in FIG. 9 or FIG. Compared to the pixel circuit, the number of transistors is reduced by two), and the number of transistors per pixel circuit is also reduced by one, so that the yield and the aperture ratio can be further increased.
However, in the third embodiment, since the transistor 214 does not exist, the brightness of the entire screen cannot be adjusted by adjusting the light emission period (3). Also in the writing period (2), a current corresponding to the voltage at the node A flows through the OLED element 230.

<第4実施形態>
次に、本発明の第4実施形態に係る電気光学装置について説明する。この第4実施形態に係る電気光学装置は、第1実施形態における画素回路を図14に示される画素回路200に置換したものである。
図14に示される画素回路200は、図12に示した画素回路において、電源線114を1行毎にX方向に延設するとともに、その電圧を、時間的に変化させた構成としたものである。すなわち、第4実施形態における電源線114は、走査線102、制御線106とともに1組となって、1行分の画素回路200に兼用されている。
このような電源線114は、例えばYドライバ14によって駆動される。また、第4実施形態において、給電線116に印加される初期電圧VINIは、第1、第2実施形態と同様に、画素の最低階調を指定するデータ信号と一致する電圧である。
<Fourth embodiment>
Next, an electro-optical device according to a fourth embodiment of the invention will be described. The electro-optical device according to the fourth embodiment is obtained by replacing the pixel circuit in the first embodiment with a pixel circuit 200 shown in FIG.
The pixel circuit 200 shown in FIG. 14 has a configuration in which, in the pixel circuit shown in FIG. 12, the power supply line 114 is extended in the X direction for each row, and the voltage is changed with time. is there. In other words, the power supply line 114 in the fourth embodiment is combined with the scanning line 102 and the control line 106 to be used as a set for the pixel circuit 200 for one row.
Such a power supply line 114 is driven by, for example, a Y driver 14. In the fourth embodiment, the initial voltage V INI applied to the power supply line 116 is a voltage that matches the data signal designating the lowest gradation of the pixel, as in the first and second embodiments.

図15は、第4実施形態に係る電気光学装置の動作を説明するためのタイミングチャートである。
この図に示されるように、第4実施形態では、第3実施形態と同様に、i行目でいえば、走査信号GWRT−iがHレベルとなる書込期間(2)よりも手前の初期化期間(1)において、制御信号GINI−iが期間TiだけHレベルとなる。
ただし、第4実施形態では、初期化期間において、Yドライバ14は、i行目の電源線114の電圧VEL−iを初期電圧Viniとする。この初期電圧Viniは、駆動トランジスタ210のしきい値電圧VthnおよびOLED素子230のしきい値電圧との和よりも若干高い程度の電圧である。詳細には、トランジスタ211のオンによってダイオード接続された駆動トランジスタ210のドレインに、この初期電圧Viniが印加された場合に、当該駆動トランジスタ210およびOLED素子230に電流がごくわずかに流れる程度の電圧である。
FIG. 15 is a timing chart for explaining the operation of the electro-optical device according to the fourth embodiment.
As shown in this figure, in the fourth embodiment, as in the third embodiment, in the i-th row, the scanning signal G WRT-i is before the writing period (2) in which the scanning signal G WRT-i is at the H level. In the initialization period (1), the control signal GINI-i is at the H level for the period Ti.
However, in the fourth embodiment, during the initialization period, the Y driver 14 sets the voltage V EL-i of the i-th power line 114 to the initial voltage Vini. This initial voltage Vini is a voltage that is slightly higher than the sum of the threshold voltage V thn of the driving transistor 210 and the threshold voltage of the OLED element 230. Specifically, when the initial voltage Vini is applied to the drain of the drive transistor 210 that is diode-connected when the transistor 211 is turned on, the voltage is such that a very small current flows through the drive transistor 210 and the OLED element 230. is there.

一方、第4実施形態においても、初期化期間(1)では、ノードBは、トランジスタ212のオンにより初期電圧VINIに固定されるので、ノードAには、当該電流に応じた電圧が保持されることになる。
ここで、初期化期間(1)においてOLED素子230に流れる電流は、第3実施形態とは異なり、ごくわずかであるので、ノードAに保持される電圧を、ほぼ駆動トランジスタのしきい値Vthnとさせることができる。
On the other hand, also in the fourth embodiment, in the initialization period (1), the node B is fixed to the initial voltage V INI by turning on the transistor 212, so that the voltage corresponding to the current is held in the node A. Will be.
Here, unlike the third embodiment, the current flowing through the OLED element 230 in the initialization period (1) is very small, so that the voltage held at the node A is approximately equal to the threshold V thn of the driving transistor. It can be made.

次に、書込期間(2)に至ると、Yドライバ14は、電圧VEL−iをGndに落とすとともに、制御信号GWRT−iをHレベルとする。これにより、トランジスタ213がオンするので、ノードBは、ΔVだけ電圧変化し、この変化分を容量比で配分した分だけ、ノードAの電圧が上昇するので、第1実施形態等と同様にして、ノードAにOLED素子230に電流を流すためゲート電圧を書き込むことができる。
続いて、発光期間(3)に至ると、Yドライバ14は、電圧VEL−iを電源電圧VELにする一方、制御信号GWRT−iをLレベルとする。これにより、第1実施形態等と同様に、OLED素子230には、ノードAの電圧に応じた電流が流れて、当該電流に応じた明るさで発光し続けることになる。
そして、発光期間(3)が終了すると、Yドライバ14は、電圧VEL−iをGndに落とす。これにより、OLED素子230は消灯して、発光期間(3)が調整されることなる。
Next, when the writing period (2) is reached, the Y driver 14 drops the voltage V EL-i to Gnd and sets the control signal G WRT-i to the H level. As a result, the transistor 213 is turned on, so that the voltage at the node B changes by ΔV, and the voltage at the node A rises by the amount corresponding to the change by the capacitance ratio. The gate voltage can be written to the node A in order to pass a current through the OLED element 230.
Subsequently, when the light emission period (3) is reached, the Y driver 14 sets the voltage V EL-i to the power supply voltage V EL while setting the control signal G WRT-i to the L level. As a result, as in the first embodiment and the like, a current corresponding to the voltage of the node A flows through the OLED element 230, and light emission continues at a brightness corresponding to the current.
When the light emission period (3) ends, the Y driver 14 drops the voltage V EL-i to Gnd. Thereby, the OLED element 230 is turned off, and the light emission period (3) is adjusted.

この第4実施形態に係る電気光学装置によれば、第3実施形態と同様に、図9や図10に示される画素回路と比較して、制御線108が不要となるので、制御線が1行当たり1本(図2の画素回路と比較すると2本)削減されるとともに、画素回路1個当たりのトランジスタ数も1個削減されるので、歩留まりや開口率を、より高めることが可能となる。さらに、第4実施形態によれば、第3実施形態とは異なり、発光期間(3)を調整して、表示画面全体の明るさを変化させることができる。
なお、第4実施形態では、電源線114を走査線102の1行毎にX方向に延設するとしたが、隣接する複数行毎に1本延設して、複数行の画素回路200にわたって兼用する構成としても良い。このような構成とすると、配線数が削減することができるので、特に、開口率の点で有利となる。
According to the electro-optical device according to the fourth embodiment, as in the third embodiment, the control line 108 becomes unnecessary as compared with the pixel circuit shown in FIGS. The number of transistors per row (2 compared with the pixel circuit in FIG. 2) is reduced, and the number of transistors per pixel circuit is also reduced by 1. Therefore, the yield and the aperture ratio can be further increased. . Furthermore, according to the fourth embodiment, unlike the third embodiment, the brightness of the entire display screen can be changed by adjusting the light emission period (3).
In the fourth embodiment, the power supply line 114 is extended in the X direction for each row of the scanning line 102. However, one power supply line 114 is extended for each adjacent row and used across the pixel circuits 200 in the plurality of rows. It is good also as composition to do. Such a configuration is advantageous in terms of the aperture ratio because the number of wirings can be reduced.

<第5実施形態>
次に、本発明の第5実施形態に係る電気光学装置について説明する。この第5実施形態に係る電気光学装置は、第1実施形態における画素回路を図16に示される画素回路200に置換したものである。
図16に示されるように、第5実施形態における画素回路200は、図14に示した画素回路において、トランジスタ212の一端(ドレイン)の接続先を、給電線116から、行毎の電源線114へと変更したものである。
なお、この第5実施形態に係る電気光学装置の動作は、初期化期間(1)において、ノードBが電源線114の初期電圧Viniで固定される点以外、第4実施形態と同様であるので、その説明については省略する。
この第5実施形態によれば、給電線116が不要となるので、第4実施形態と比較して、歩留まりや開口率の点で有利となる。
<Fifth Embodiment>
Next, an electro-optical device according to a fifth embodiment of the invention will be described. The electro-optical device according to the fifth embodiment is obtained by replacing the pixel circuit in the first embodiment with a pixel circuit 200 shown in FIG.
As illustrated in FIG. 16, the pixel circuit 200 according to the fifth embodiment is different from the pixel circuit illustrated in FIG. 14 in that the connection destination of one end (drain) of the transistor 212 is connected from the power supply line 116 to the power supply line 114 for each row. It has been changed to.
The operation of the electro-optical device according to the fifth embodiment is the same as that of the fourth embodiment except that the node B is fixed at the initial voltage Vini of the power supply line 114 in the initialization period (1). The description is omitted.
According to the fifth embodiment, the feeder line 116 is unnecessary, which is advantageous in terms of yield and aperture ratio compared to the fourth embodiment.

本発明は、上述した第1〜第5実施形態に限られず、種々の変形が可能である。
例えば、各実施形態では、単色の画素について階調表示をする構成になっていたが、例えば図17に示されるように、R(赤)、G(緑)、B(青)に対応させて画素回路200R、200G、200Bを配列させるとともに、これらの3画素により1ドットを構成して、カラー表示を行うとしても良い。そして、カラー表示させる場合、OLED素子230R、230G、230Bは、それぞれ赤、緑、青にて発光するように発光層が選択される。
このようにカラー表示させる構成において、OLED素子230R、230G、230Bの発光効率が互いに異なる場合には、電源電圧VELおよび初期電圧VINIを色毎に異ならせる必要もある。
ただし、図17に示されるように、走査線102、制御線104、106および108については共用することができる。
なお、図17は、第1実施形態(図2参照)を用いてカラー表示とする場合の構成例を示す図である。図9や、第2実施形態(図10参照)、第3実施形態(図12参照)、第4実施形態(図14参照)、第5実施形態(図16参照)を用いてカラー表示する構成として良いのはもちろんである。
The present invention is not limited to the first to fifth embodiments described above, and various modifications are possible.
For example, in each embodiment, the gradation display is performed for a single pixel, but for example, as shown in FIG. 17, corresponding to R (red), G (green), and B (blue). The pixel circuits 200R, 200G, and 200B may be arranged, and one dot may be configured by these three pixels to perform color display. When color display is performed, the light emitting layer is selected so that the OLED elements 230R, 230G, and 230B emit light in red, green, and blue, respectively.
In such a color display configuration, when the light emitting efficiencies of the OLED elements 230R, 230G, and 230B are different from each other, the power supply voltage V EL and the initial voltage V INI need to be different for each color.
However, as shown in FIG. 17, the scanning line 102 and the control lines 104, 106 and 108 can be shared.
FIG. 17 is a diagram showing a configuration example when color display is performed using the first embodiment (see FIG. 2). Color display using FIG. 9, the second embodiment (see FIG. 10), the third embodiment (see FIG. 12), the fourth embodiment (see FIG. 14), and the fifth embodiment (see FIG. 16). Of course it is good.

また、上述した各実施形態においては、図3、図11、図13、図15に示されるように初期化期間(1)と書込期間(2)とを時間的に連続させているが、両者期間を時間的に隔絶させても構わない。同様に、書込期間(2)と発光期間(2)とを両者期間を時間的に隔絶させても良い。
さらに、図2、図9、図10、図14および図16の構成においては、発光期間(3)だけでなく、書込期間(2)においても、制御信号GEL−iをHレベル、または、電圧VEL−iを電圧VELとすることによって、ノードAの電圧に応じた電流をOLED素子230に流す構成としても良い。
In each of the embodiments described above, the initialization period (1) and the writing period (2) are temporally continuous as shown in FIG. 3, FIG. 11, FIG. 13, and FIG. Both periods may be separated in time. Similarly, the writing period (2) and the light emission period (2) may be separated in time.
Further, in the configurations of FIGS. 2, 9, 10, 14, and 16, the control signal G EL-i is set to the H level not only in the light emission period (3) but also in the writing period (2). The voltage V EL-i may be set to the voltage V EL so that a current corresponding to the voltage at the node A flows through the OLED element 230.

各実施形態では、駆動トランジスタ210をnチャネル型としたが、pチャネル型としても良い。また、トランジスタ211、212、213、214のチャネル型についても同様である。ただし、図9に示される構成とする場合には、トランジスタ211、214のチャネル型については、上述したように一方をpチャネル型、他方をnチャネル型とする必要がある。また、図10、図12、図14または図16に示される構成とする場合には、トランジスタ211、212ついては、共通の制御線106によってオンまたはオフを同時制御するため、nまたはpの一方のチャネル型に統一する必要がある。
また、これら各トランジスタを、pチャネル型およびnチャネル型を相補型に組み合わせたトランスミッションゲートで構成して、電圧降下をほぼ無視できる程度に抑えても良い。
くわえて、トランジスタ214のソース側にOLED素子230を接続するのではなく、トランジスタ214のドレイン側にOLED素子230を接続しても良い。
In each embodiment, the driving transistor 210 is an n-channel type, but may be a p-channel type. The same applies to the channel types of the transistors 211, 212, 213, and 214. However, in the case of the configuration shown in FIG. 9, as described above, one of the transistors 211 and 214 needs to be a p-channel type and the other an n-channel type. In the case of the configuration shown in FIG. 10, FIG. 12, FIG. 14 or FIG. 16, the transistors 211 and 212 are simultaneously controlled to be turned on or off by the common control line 106. It is necessary to unify the channel type.
Further, each of these transistors may be constituted by a transmission gate in which a p-channel type and an n-channel type are combined in a complementary manner, and the voltage drop may be suppressed to a level that can be almost ignored.
In addition, the OLED element 230 may be connected to the drain side of the transistor 214 instead of connecting the OLED element 230 to the source side of the transistor 214.

また、OLED素子230は、電流駆動型素子の一例であり、これに代えて、無機EL素子や、フィールド・エミッション(FE)素子、LEDなどの他の発光素子、さらには、電気泳動素子、エレクトロ・クロミック素子などを用いても良い。   The OLED element 230 is an example of a current-driven element. Instead, an inorganic EL element, a field emission (FE) element, another light emitting element such as an LED, an electrophoretic element, an electrophoretic element, or the like. -You may use a chromic element etc.

次に、上述した実施形態に係る電気光学装置を電子機器に用いた例について説明する。
まず、上述した電気光学装置10を、表示部に適用した携帯電話について説明する。図18は、この携帯電話の構成を示す斜視図である。
この図において、携帯電話1100は、複数の操作ボタン1102のほか、受話口1104、送話口1106とともに、表示部として、上述した電気光学装置10を備えるものである。
Next, an example in which the electro-optical device according to the above-described embodiment is used in an electronic device will be described.
First, a mobile phone in which the above-described electro-optical device 10 is applied to a display unit will be described. FIG. 18 is a perspective view showing the configuration of this mobile phone.
In this figure, a cellular phone 1100 includes the above-described electro-optical device 10 as a display unit, in addition to a plurality of operation buttons 1102, as well as an earpiece 1104 and a mouthpiece 1106.

次に、上述した電気光学装置10を、ファインダに用いたデジタルスチルカメラについて説明する。
図19は、このデジタルスチルカメラの背面を示す斜視図である。銀塩カメラは、被写体の光像によってフィルムを感光させるのに対し、デジタルスチルカメラ1200は、被写体の光像をCCD(Charge Coupled Device)などの撮像素子により光電変換して撮像信号を生成・記憶するものである。ここで、デジタルスチルカメラ1200におけるケース1202の背面には、上述した電気光学装置10の表示面が設けられる。この電気光学装置10は、撮像信号に基づいて表示を行うので、被写体を表示するファインダとして機能することになる。また、ケース1202の前面側(図19においては裏面側)には、光学レンズやCCDなどを含んだ受光ユニット1204が設けられている。
Next, a digital still camera using the above-described electro-optical device 10 as a finder will be described.
FIG. 19 is a perspective view showing the back surface of the digital still camera. The silver salt camera sensitizes the film with the optical image of the subject, whereas the digital still camera 1200 generates and stores an imaging signal by photoelectrically converting the optical image of the subject with an imaging device such as a CCD (Charge Coupled Device). To do. Here, the display surface of the electro-optical device 10 described above is provided on the back surface of the case 1202 in the digital still camera 1200. Since the electro-optical device 10 performs display based on the imaging signal, it functions as a finder that displays the subject. A light receiving unit 1204 including an optical lens and a CCD is provided on the front side of the case 1202 (the back side in FIG. 19).

撮影者が電気光学装置10によって表示された被写体像を確認して、シャッタボタン1206を押下すると、その時点におけるCCDの撮像信号が、回路基板1208のメモリに転送・記憶される。また、このデジタルスチルカメラ1200にあって、ケース1202の側面には、外部表示を行うためのビデオ信号出力端子1212と、データ通信用の入出力端子1214とが設けられている。   When the photographer confirms the subject image displayed by the electro-optical device 10 and presses the shutter button 1206, the CCD image pickup signal at that time is transferred and stored in the memory of the circuit board 1208. In the digital still camera 1200, a video signal output terminal 1212 for external display and an input / output terminal 1214 for data communication are provided on the side surface of the case 1202.

なお、電子機器としては、図18の携帯電話や、図19のデジタルスチルカメラの他にも、テレビや、ビューファインダ型、モニタ直視型のビデオテープレコーダ、カーナビゲーション装置、ページャ、電子手帳、電卓、ワードプロセッサ、ワークステーション、テレビ電話、POS端末、タッチパネルを備えた機器等などが挙げられる。そして、これらの各種電子機器の表示部として、上述した電気光学装置が適用可能なのは言うまでもない。また、直接画像や文字などを表示する電子機器の表示部に限られず、被感光体に光を照射することにより間接的に画像もしくは文字を形成するために用いられる印刷機器の光源として適用してもよい。   In addition to the mobile phone shown in FIG. 18 and the digital still camera shown in FIG. 19, the electronic devices include a TV, a viewfinder type and a monitor direct view type video tape recorder, a car navigation device, a pager, an electronic notebook, and a calculator. , Word processors, workstations, videophones, POS terminals, devices with touch panels, and the like. And it cannot be overemphasized that the electro-optical apparatus mentioned above is applicable as a display part of these various electronic devices. In addition, it is not limited to a display unit of an electronic device that directly displays an image or a character, but is applied as a light source of a printing device that is used to indirectly form an image or a character by irradiating light to the photosensitive member. Also good.

本発明の第1実施形態に係る電気光学装置の構成を示すブロック図である。1 is a block diagram illustrating a configuration of an electro-optical device according to a first embodiment of the invention. FIG. 同電気光学装置の画素回路を示す図である。It is a figure which shows the pixel circuit of the same electro-optical apparatus. 同電気光学装置の動作を示すタイミングチャートである。6 is a timing chart showing the operation of the electro-optical device. 同画素回路の動作説明図である。It is operation | movement explanatory drawing of the pixel circuit. 同画素回路の動作説明図である。It is operation | movement explanatory drawing of the pixel circuit. 同画素回路の動作説明図である。It is operation | movement explanatory drawing of the pixel circuit. 同画素回路の動作説明図である。It is operation | movement explanatory drawing of the pixel circuit. 同画素回路の動作説明図である。It is operation | movement explanatory drawing of the pixel circuit. 同画素回路の別の構成を示す図である。It is a figure which shows another structure of the pixel circuit. 本発明の第2実施形態に係る電気光学装置の画素回路を示す図である。FIG. 6 is a diagram illustrating a pixel circuit of an electro-optical device according to a second embodiment of the invention. 同電気光学装置の動作を示すタイミングチャートである。6 is a timing chart showing the operation of the electro-optical device. 本発明の第3実施形態に係る電気光学装置の画素回路を示す図である。FIG. 10 is a diagram illustrating a pixel circuit of an electro-optical device according to a third embodiment of the invention. 同電気光学装置の動作を示すタイミングチャートである。6 is a timing chart showing the operation of the electro-optical device. 本発明の第4実施形態に係る電気光学装置の画素回路を示す図である。FIG. 10 is a diagram illustrating a pixel circuit of an electro-optical device according to a fourth embodiment of the invention. 同電気光学装置の動作を示すタイミングチャートである。6 is a timing chart showing the operation of the electro-optical device. 本発明の第5実施形態に係る電気光学装置の画素回路を示す図である。FIG. 10 is a diagram illustrating a pixel circuit of an electro-optical device according to a fifth embodiment of the invention. 実施形態に係る電気光学装置をカラー化した構成を示す図である。1 is a diagram illustrating a configuration in which an electro-optical device according to an embodiment is colored. FIG. 同電気光学装置を用いた携帯電話を示す図である。It is a figure which shows the mobile telephone using the same electro-optical apparatus. 同電気光学装置を用いたデジタルスチルカメラを示す図である。It is a figure which shows the digital still camera using the same electro-optical apparatus.

符号の説明Explanation of symbols

10…電気光学装置、12…制御回路、14…Yドライバ、16…Xドライバ、102
…走査線、104、106、108…制御線、112…データ線、114…電源線、116…給電線、200…画素回路、210…駆動トランジスタ、211、212、213、214…トランジスタ(それぞれ第1、第2、第3、第4のスイッチング素子)、220…容量(容量素子)、230…OLED素子(被駆動素子)、1100…携帯電話機、1200…デジタルスチルカメラ
DESCRIPTION OF SYMBOLS 10 ... Electro-optical apparatus, 12 ... Control circuit, 14 ... Y driver, 16 ... X driver, 102
... scanning lines 104, 106, 108 ... control lines, 112 ... data lines, 114 ... power supply lines, 116 ... feed lines, 200 ... pixel circuits, 210 ... driving transistors, 211, 212, 213, 214 ... transistors (respectively 1, 2nd, 3rd, 4th switching element), 220 ... capacitance (capacitance element), 230 ... OLED element (driven element), 1100 ... mobile phone, 1200 ... digital still camera

Claims (16)

被駆動素子に流れる電流を制御する駆動トランジスタと、
前記駆動トランジスタのゲートとドレインとの間をオンまたはオフする第1のスイッチング素子と、
一端が前記駆動トランジスタのゲートに接続された容量素子と
を備える電子回路の駆動方法であって、
前記容量素子の他端に初期電圧を印加するとともに、前記第1のスイッチング素子をオンさせた状態にて、前記被駆動素子に電流を流し、この後、
前記電流を遮断するとともに、前記容量素子の他端に対する初期電圧の印加を解除し、前記第1のスイッチング素子をオフさせる第1のステップと、
前記容量素子の他端に対し、前記被駆動素子に流すべき電流に応じた電圧を印加する第2のステップと、
保持されたゲート電圧にしたがった電流を、前記駆動トランジスタが前記被駆動素子に流す第3のステップと
を備えることを特徴とする電子回路の駆動方法。
A drive transistor for controlling the current flowing through the driven element;
A first switching element that turns on or off between the gate and drain of the driving transistor;
A driving method of an electronic circuit comprising: a capacitor element having one end connected to a gate of the driving transistor,
While applying an initial voltage to the other end of the capacitive element and turning on the first switching element, a current is passed through the driven element, and then
A first step of cutting off the current, releasing application of an initial voltage to the other end of the capacitive element, and turning off the first switching element;
A second step of applying a voltage corresponding to a current to be passed through the driven element to the other end of the capacitive element;
A third step of driving an electronic circuit, comprising: a third step of causing the driving transistor to flow a current according to the held gate voltage to the driven element.
前記第1のステップにおいて、
前記第1のスイッチング素子をオンさせるとともに前記被駆動素子に電流を流して、当該電流に応じた電圧を、前記容量素子の一端および前記駆動トランジスタのゲートに保持させる一方、
前記電流を遮断させた後に、前記第1のスイッチング素子をオフさせて、前記容量素子の一端および前記駆動トランジスタのゲートに保持された電圧を、前記駆動トランジスタのしきい値電圧に応じた電圧に移行させる
請求項1に記載の電子回路の駆動方法。
In the first step,
While turning on the first switching element and passing a current through the driven element, the voltage corresponding to the current is held at one end of the capacitive element and the gate of the driving transistor,
After the current is cut off, the first switching element is turned off, and the voltage held at one end of the capacitive element and the gate of the driving transistor is changed to a voltage corresponding to the threshold voltage of the driving transistor. The electronic circuit driving method according to claim 1, wherein the electronic circuit is driven.
前記第1のステップにおいて、
前記第1のスイッチング素子をオンさせるとともに前記被駆動素子に電流を流して、当該電流および前記駆動トランジスタのしきい値電圧に応じた電圧を、前記容量素子の一端および前記駆動トランジスタのゲートに保持させる
請求項1に記載の電子回路の駆動方法。
In the first step,
The first switching element is turned on and a current is passed through the driven element, and the voltage corresponding to the current and the threshold voltage of the driving transistor is held at one end of the capacitive element and the gate of the driving transistor The electronic circuit driving method according to claim 1.
前記第1のステップにおいて、
前記第1のスイッチング素子をオンさせるとともに前記被駆動素子に電流を流した後、前記電流の遮断とともに前記第1のスイッチング素子をオフさせて、前記駆動トランジスタのしきい値電圧に応じた電圧を、前記容量素子の一端および前記駆動トランジスタのゲートに保持させる
請求項1に記載の電子回路の駆動方法。
In the first step,
After turning on the first switching element and passing a current through the driven element, the first switching element is turned off along with the interruption of the current, and a voltage corresponding to the threshold voltage of the driving transistor is set. The electronic circuit driving method according to claim 1, wherein the electronic circuit is held at one end of the capacitive element and a gate of the driving transistor.
被駆動素子に流れる電流を制御する駆動トランジスタと、
前記駆動トランジスタのゲートとドレインとの間にて第1の期間においてオンし、前記第1の期間後の第2の期間の開始タイミングまでにオフする第1のスイッチング素子と、
一端が前記駆動トランジスタのゲートに接続された容量素子と、
前記第1の期間においてオンして、初期電圧を前記容量素子の他端に印加する一方、前記第2の期間、および、この第2の期間後の第3の期間においてオフする第2のスイッチング素子と、
前記被駆動素子に流すべき電流に応じた電圧が印加される信号線と前記容量素子の他端との間にて、前記第2の期間においてオンする第3のスイッチング素子と
を備えることを特徴とする電子回路。
A drive transistor for controlling the current flowing through the driven element;
A first switching element that is turned on in a first period between the gate and drain of the driving transistor and turned off by a start timing of a second period after the first period;
A capacitive element having one end connected to the gate of the driving transistor;
Second switching that turns on in the first period and applies an initial voltage to the other end of the capacitive element, and turns off in the second period and a third period after the second period. Elements,
And a third switching element that is turned on in the second period between a signal line to which a voltage according to a current to be supplied to the driven element is applied and the other end of the capacitor element. An electronic circuit.
前記被駆動素子に流れる電流の経路に挿入されて、オフすると、前記駆動トランジスタのゲート電圧にかかわらず、前記被駆動素子に流れる電流を遮断する第4のスイッチング素子であって、
前記第1の期間の一部または全部の期間にオンするとともに、前記第3の期間にオンする第4のスイッチング素子を有する
請求項5に記載の電子回路。
A fourth switching element that, when inserted into a path of a current flowing through the driven element and turned off, interrupts a current flowing through the driven element regardless of a gate voltage of the driving transistor;
The electronic circuit according to claim 5, further comprising a fourth switching element that is turned on during a part or all of the first period and turned on during the third period.
前記第1および第4のスイッチング素子は、互いに異なる導電型のトランジスタであって、それらのゲートが共通の制御線に接続される
請求項6に記載の電子回路。
The electronic circuit according to claim 6, wherein the first and fourth switching elements are transistors of different conductivity types, and their gates are connected to a common control line.
前記第1および第2のスイッチング素子は、同一導電型のトランジスタであって、それらのゲートが共通の制御線に接続される
請求項6に記載の電子回路。
The electronic circuit according to claim 6, wherein the first and second switching elements are transistors of the same conductivity type, and their gates are connected to a common control line.
前記第1および第2のスイッチング素子は、同一導電型のトランジスタであって、それらのゲートが共通の制御線に接続される
請求項5に記載の電子回路。
The electronic circuit according to claim 5, wherein the first and second switching elements are transistors of the same conductivity type, and their gates are connected to a common control line.
前記被駆動素子および前記駆動トランジスタは、第1および第2の電源線の間の電流経路に挿入され、
前記第1および第2の電源線の間の電圧は、
前記第1の期間では、前記初期電圧であり、
前記第3の期間では、所定の電源電圧となる
請求項9に記載の電子回路。
The driven element and the driving transistor are inserted into a current path between the first and second power supply lines,
The voltage between the first and second power lines is:
In the first period, the initial voltage is,
The electronic circuit according to claim 9, wherein a predetermined power supply voltage is obtained in the third period.
前記第2のスイッチング素子は、前記容量素子の他端と前記駆動トランジスタのドレインとの間にてオンまたはオフする
請求項10に記載の電子回路。
The electronic circuit according to claim 10, wherein the second switching element is turned on or off between the other end of the capacitive element and a drain of the driving transistor.
前記第2のスイッチング素子は、前記容量素子の他端と前記初期電圧が印加された給電線との間においてオンまたはオフする
請求項6、7、8、9または10に記載の電子回路。
The electronic circuit according to claim 6, 7, 8, 9 or 10, wherein the second switching element is turned on or off between the other end of the capacitive element and a power supply line to which the initial voltage is applied.
前記被駆動素子は電気光学素子である
請求項5乃至12のいずれかに記載の電子回路。
The electronic circuit according to claim 5, wherein the driven element is an electro-optical element.
前記電気光学素子は有機発光ダイオード素子である
請求項13に記載の電子回路。
The electronic circuit according to claim 13, wherein the electro-optical element is an organic light-emitting diode element.
順次選択されると走査線と、電気光学素子に流すべき電流に応じた電圧が印加されるデータ線との交差に対応して画素回路を有する電気光学装置であって、
前記画素回路は、
前記電気光学素子に流れる電流を制御する駆動トランジスタと、
前記駆動トランジスタのゲートとドレインとの間にて第1の期間においてオンし、前記第1の期間後の第2の期間の開始タイミングまでにオフする第1のスイッチング素子と、
一端が前記駆動トランジスタのゲートに接続された容量素子と、
前記第1の期間においてオンして、初期電圧を前記容量素子の他端に印加する一方、前記第2の期間、および、この第2の期間後の第3の期間においてオフする第2のスイッチング素子と、
前記データ線と前記容量素子の他端との間にて、前記第2の期間においてオンする第3のスイッチング素子と
を備えることを特徴とする電気光学装置。
An electro-optical device having a pixel circuit corresponding to the intersection of a scanning line and a data line to which a voltage corresponding to a current to be passed through the electro-optical element is applied when sequentially selected,
The pixel circuit includes:
A drive transistor for controlling a current flowing through the electro-optic element;
A first switching element that is turned on in a first period between the gate and drain of the driving transistor and turned off by a start timing of a second period after the first period;
A capacitive element having one end connected to the gate of the driving transistor;
Second switching that turns on in the first period and applies an initial voltage to the other end of the capacitive element, and turns off in the second period and a third period after the second period. Elements,
An electro-optical device comprising: a third switching element that is turned on in the second period between the data line and the other end of the capacitor.
請求項15に記載の電気光学装置を有する電子機器。   An electronic apparatus comprising the electro-optical device according to claim 15.
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Cited By (9)

* Cited by examiner, † Cited by third party
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KR101282996B1 (en) 2008-11-15 2013-07-04 엘지디스플레이 주식회사 Organic electro-luminescent display device and driving method thereof
US8564531B2 (en) 2010-05-26 2013-10-22 Seiko Epson Corporation Electronic apparatus and method of driving the same
US8581835B2 (en) 2010-05-26 2013-11-12 Seiko Epson Corporation Electro-optical device, method for driving electro-optical device, control circuit and electronic apparatus
US8587513B2 (en) 2010-05-26 2013-11-19 Seiko Epson Corporation Electro-optical device, method for driving electro-optical device, control circuit and electronic device
JP2014142489A (en) * 2013-01-24 2014-08-07 Panasonic Corp Display device
KR101458373B1 (en) 2008-10-24 2014-11-06 엘지디스플레이 주식회사 Organic electroluminescent display device
KR101495359B1 (en) 2008-12-22 2015-02-24 엘지디스플레이 주식회사 Organic Light Emitting Display Device and Driving Method of the same
CN115862531A (en) * 2023-03-03 2023-03-28 北京数字光芯集成电路设计有限公司 Voltage input type pixel driving circuit applied to micro display panel

Cited By (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2013101373A (en) * 2008-09-10 2013-05-23 Sharp Corp Display device and driving method thereof
KR101458373B1 (en) 2008-10-24 2014-11-06 엘지디스플레이 주식회사 Organic electroluminescent display device
KR101282996B1 (en) 2008-11-15 2013-07-04 엘지디스플레이 주식회사 Organic electro-luminescent display device and driving method thereof
KR101495359B1 (en) 2008-12-22 2015-02-24 엘지디스플레이 주식회사 Organic Light Emitting Display Device and Driving Method of the same
US8564531B2 (en) 2010-05-26 2013-10-22 Seiko Epson Corporation Electronic apparatus and method of driving the same
US8581835B2 (en) 2010-05-26 2013-11-12 Seiko Epson Corporation Electro-optical device, method for driving electro-optical device, control circuit and electronic apparatus
US8587513B2 (en) 2010-05-26 2013-11-19 Seiko Epson Corporation Electro-optical device, method for driving electro-optical device, control circuit and electronic device
JP2014142489A (en) * 2013-01-24 2014-08-07 Panasonic Corp Display device
CN115862531A (en) * 2023-03-03 2023-03-28 北京数字光芯集成电路设计有限公司 Voltage input type pixel driving circuit applied to micro display panel
CN115862531B (en) * 2023-03-03 2023-04-18 北京数字光芯集成电路设计有限公司 Voltage input type pixel driving circuit applied to micro display panel

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