JP2007259439A - Micromachining type combinational composition element and its manufacturing method - Google Patents

Micromachining type combinational composition element and its manufacturing method Download PDF

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Abstract

<P>PROBLEM TO BE SOLVED: To provide a micromachining type combinational composition element which is protected by one time common package sealing in such a way that an inertia sensor structure, a diaphragm sensor structure, and especially a microphone are incorporated in one common silicon substrate. <P>SOLUTION: The micromachining type combinational composition element comprises: a substrate 1 provided with a front surface VS and a rear surface RS; first inertia type sensor devices 46a-46d provided with at least one bending beam equally loaded transmitters 46a-46d formed on the front surface VS; at least one diaphragm 25 formed on the front surface VS of the substrate 1; and a second diaphragm type sensor devices 25, 47a, 47b provided with at least one back pole 47a, 47b. The first sensor devices 46a-46d and the second sensor devices 25, 47a, 47b are sealed by a common capping device laminated on the front surface VS of the substrate 1. <P>COPYRIGHT: (C)2008,JPO&INPIT

Description

本発明はマイクロマシニング型のコンビ構成素子に関する。本発明は同じく、当該コンビ構成素子のための製造方法に関する。   The present invention relates to a micromachining type combination component. The invention also relates to a manufacturing method for the combination component.

本発明は原理的には多種のマイクロマシニング型のコンビ構成素子に対して使用可能でもあるが、以下においては容量型のシリコンマイクロホンもしくは容量型の圧力センサにつき本発明ならびに本発明の根底を成す問題点を説明する。   In principle, the present invention can be used for various types of micromachining type combination components, but in the following, the present invention and the problems underlying the present invention are related to capacitive silicon microphones or capacitive pressure sensors. Explain the point.

米国特許出願公告第6522762号明細書およびUS6088463号明細書から、マイクロマシニングのプロセスによってシリコン基板に製造され得る容量型のマイクロホンが公知である。このような容量型のマイクロホンの音響的な機能のためにはバックチャンバが必要である。このバックチャンバは構造化された付加的なウェーハのボンディングにより実現することができる。一般的にマイクロホンは、たとえば携帯電話、ハイファイ装置等のような家電の領域、およびたとえば言語入力のための自動車領域においても極めて大きな個数(13億〜15億個/年)でますます必要とされている。   From US Pat. Nos. 6,522,762 and US 6088463, capacitive microphones are known which can be produced on a silicon substrate by a micromachining process. A back chamber is necessary for the acoustic function of such a capacitive microphone. This back chamber can be realized by structured additional wafer bonding. In general, microphones are increasingly required in extremely large numbers (1.3 to 1.5 billion / year), for example, in the field of consumer electronics such as mobile phones and hi-fi devices, and in the automobile field for example for language input. ing.

これまで公知であった、このような固体マイクロホンのための製造プロセスは、ただし非常に手間がかかる。固体マイクロホンの原則的な構造は、ウェーハ裏面のパーフォレーションを、ウェーハ表面のカンチレバ形のダイヤフラムの下側に備えている。この場合、ひとつにはパーフォレーションはガス緩衝機構のために提供されている。もうひとつにはパーフォレーションにより、たとえばフリップチップ接合技術による回路基板またはハイブリッド回路に対するフェイスダウン取付け時に、ウェーハ裏面からの音波反響時の音波貫通も可能になる。   The manufacturing processes for such solid-state microphones known so far, however, are very laborious. The basic structure of a solid-state microphone has perforations on the backside of the wafer on the underside of the cantilever-shaped diaphragm on the wafer surface. In this case, for example, perforation is provided for the gas buffer mechanism. For example, perforation enables sound penetration from the backside of the wafer when the face is mounted face-down on a circuit board or hybrid circuit using flip chip bonding technology, for example.

容量型のマイクロホンの場合には、ダイヤフラムもしくはバルクウェーハの下側の対向板が、ダイヤフラムに対する電気的な背極として働く、すなわち、容量の変化はダイヤフラムと背極とから形成されているエアギャップコンデンサを介して適切に検出され、ダイヤフラム変位ひいては取り込んだ騒音レベルを再現する電気信号に変換される。   In the case of a capacitive microphone, the counter plate on the lower side of the diaphragm or bulk wafer serves as an electrical back electrode for the diaphragm, that is, the change in capacitance is an air gap capacitor formed by the diaphragm and the back electrode. And is converted into an electrical signal that reproduces the displacement of the diaphragm and thus the captured noise level.

ドイツ連邦共和国特許出願公開第19938206号明細書および同第19719061号明細書から、マイクロマシニング型の加速度センサもしくは回転加速度センサが公知である。これらのセンサは表面マイクロマシニングのプロセスによってシリコン基板に製造される。文献ではこのような構造体は慣性センサとも呼称される。このような構造体の脆弱な構成要素、特に基板の表面に対して水平に変位可能な容量型の測定フィンガは、一般的には構造化されたキャップウェーハのシールガラスボンディングにより損壊および汚染から保護されている。
米国特許出願公告第6522762号明細書 US6088463号明細書 ドイツ連邦共和国特許出願公開第19938206号明細書 ドイツ連邦共和国特許出願公開第19719061号明細書 ドイツ連邦共和国特許出願公開第19847455号明細書 ドイツ連邦共和国特許出願公開第10065013号明細書
From German Offenlegungsschrift 199 38 206 and 19971611, micromachining type acceleration sensors or rotational acceleration sensors are known. These sensors are manufactured on a silicon substrate by a surface micromachining process. In the literature such structures are also called inertial sensors. Such fragile components of the structure, especially capacitive measuring fingers that can be displaced horizontally with respect to the surface of the substrate, are generally protected from damage and contamination by sealing glass bonding of structured cap wafers. Has been.
US Patent Application Publication No. 6522762 US 6088463 Specification German Patent Application Publication No. 19938206 German Patent Application Publication No. 19719061 German Patent Application Publication No. 198474555 German Patent Application Publication No. 10065013

したがって、本発明の課題は、冒頭で述べた形式のマイクロマシニング型のコンビ構成素子を改良して、慣性センサ構造体とダイヤフラムセンサ構造体、特にマイクロホンとが、1つの共通のシリコン基板に組み込まれていて、1回の共通のパッケージ封止により保護されているようなマイクロマシニング型のコンビ構成素子を提供することである。   Accordingly, an object of the present invention is to improve the micromachining type combination component of the type described at the beginning, and to integrate the inertial sensor structure and the diaphragm sensor structure, particularly the microphone, into one common silicon substrate. It is another object of the present invention to provide a micromachining type combination component which is protected by a single common package sealing.

さらに本発明の課題は、このようなマイクロマシニング型のコンビ構成素子を製造するために適した、相応の製造方法を提供することである。   A further object of the present invention is to provide a corresponding manufacturing method suitable for manufacturing such a micromachining combination component.

この課題を解決するために本発明の構成では、表面と裏面とを備えた基板と、この基板の表面に形成されている、少なくとも1つの曲げビームを備えている慣性型の第1のセンサ装置と、基板の表面に形成されている、少なくとも1つのダイヤフラムと少なくとも1つの背極とを備えているダイヤフラム型の第2のセンサ装置とが設けられていて、第1のセンサ装置と第2のセンサ装置とが、基板の表面に被着される共通のキャップ装置によりキャップ封止されているようにした。   In order to solve this problem, in the configuration of the present invention, a first sensor device of inertia type having a substrate having a front surface and a back surface and at least one bending beam formed on the surface of the substrate. And a diaphragm-type second sensor device that is formed on the surface of the substrate and includes at least one diaphragm and at least one back electrode, wherein the first sensor device and the second sensor device The sensor device is sealed with a common cap device that is attached to the surface of the substrate.

さらに上記課題を解決するために本発明の方法では、以下のステップ:
表面と裏面とを備えた基板を準備し;
少なくとも1つの曲げビームを備えている慣性型の第1のセンサ装置を、基板の表面に形成し;
少なくとも1つのダイヤフラムと少なくとも1つの背極とを備えているダイヤフラム型の第2のセンサ装置を、基板の表面に形成し;
第1のセンサ装置と第2のセンサ装置とを、基板の表面に共通のキャップ装置を被着することによりキャップ封止する;
を実施するようにした。
Further, in order to solve the above problems, the method of the present invention includes the following steps:
Preparing a substrate with a front side and a back side;
Forming an inertial-type first sensor device comprising at least one bending beam on the surface of the substrate;
Forming a diaphragm type second sensor device comprising at least one diaphragm and at least one back electrode on a surface of the substrate;
Capping the first sensor device and the second sensor device by attaching a common cap device to the surface of the substrate;
Was to be implemented.

請求項1の特徴を備えた本発明によるマイクロマシニング型のコンビ構成素子もしくは請求項10記載の製造方法は、本発明によるマイクロマシニング型のコンビ構成素子によって、多数の物理量、特に音波、圧力、3方向の加速度、回転度等を同時に測定することができるという利点を有している。   The micromachining type combination component according to the present invention having the characteristics of claim 1 or the manufacturing method according to claim 10 can be applied to a large number of physical quantities, in particular, sound waves, pressures, 3 by the micromachining type combination component according to the present invention. It has the advantage that direction acceleration, degree of rotation, etc. can be measured simultaneously.

これにより、僅かな所要面積および容易なプロセッシングと結び付いた有利な多機能性がもたらされる。僅かな構成高さおよびこの構成高さと結び付いたパッケージング利点、もしくは取付け利点は背部研削により達成される。チップスケールパッケージングにより追加パッケージングは必要ない。種々異なる機能性の実現のために、既に確立された同一のプロセスシーケンスを複数回にわたって繰り返すことができる。導電性の基板と、導電性のキャップとこれらに接合されているASICは、組み込まれたEMV保護をもたらす。加速度センサおよびマイクロホン用の単体のキャップ、有利にはキャップウェーハの使用により、面積利点および拡大されたバックチャンバの可能性がもたらされる。   This provides an advantageous multi-functionality coupled with a small required area and easy processing. The slight construction height and the packaging or mounting advantages associated with this construction height are achieved by back grinding. With chip scale packaging, no additional packaging is required. The same process sequence already established can be repeated multiple times to achieve different functionality. The conductive substrate, the conductive cap, and the ASIC bonded to them provide built-in EMV protection. The use of a single cap, preferably a cap wafer, for the acceleration sensor and microphone provides an area advantage and the possibility of an expanded back chamber.

本発明の根底にある思想は、慣性センサ構造体とダイヤフラムセンサ構造体、特にマイクロホンとが、1つの共通のシリコン基板に組み込まれていて、1回の共通のパッケージ封止により保護されているようなマイクロマシニング型のコンビ構成素子を提供することにある。   The idea underlying the present invention is that the inertial sensor structure and the diaphragm sensor structure, in particular the microphone, are built into one common silicon substrate and protected by a single common package seal. Another object of the present invention is to provide a combination component of micromachining type.

有利には、本発明によるマイクロマシニング型の構成素子は、一方の面でキャップ封止されており、他方の面でフリップチップ取付けによりASICに接合されている。電気的なコンタクト形成は、有利にはラテラルな導体路によってセンサ領域/ASICから導出されるか、またはセンサ基板を通じて鉛直に行われる。このようなマイクロマシニング型の構成素子の特に有利な使用は、移動電話にあり、移動電話の空間位置に関連したディスプレイ表示の自動的な調整にある。   Advantageously, the micromachining type component according to the invention is capped on one side and joined to the ASIC by flip chip attachment on the other side. The electrical contact formation is preferably derived from the sensor area / ASIC by a lateral conductor track or carried out vertically through the sensor substrate. A particularly advantageous use of such micromachined components is in mobile telephones and in the automatic adjustment of the display display in relation to the spatial position of the mobile telephone.

請求項2から請求項9もしくは請求項11から請求項17には、それぞれ本発明の対象の有利な改良形および改善形が記載されている。   Claims 2 to 9 or claims 11 to 17 describe advantageous refinements and refinements of the subject of the invention, respectively.

有利な構成によれば、第2のセンサ装置は、基板の裏面から空洞を通じて圧力によって負荷可能である。   According to an advantageous configuration, the second sensor device can be loaded by pressure through the cavity from the back side of the substrate.

別の有利な構成によれば、第2のセンサ装置は、基板の表面からキャップ装置にある貫通開口を通じて圧力によって負荷可能である。   According to another advantageous configuration, the second sensor device can be loaded by pressure from the surface of the substrate through a through opening in the cap device.

さらに別の有利な構成によれば、キャップ装置は第1のセンサ装置の上側に位置する第1の空洞と、第2のセンサ装置の上側に位置する第2の空洞とを有している。この場合、第1の空洞と第2の空洞とは流体接続されてはいない。   According to yet another advantageous configuration, the cap device has a first cavity located above the first sensor device and a second cavity located above the second sensor device. In this case, the first cavity and the second cavity are not fluidly connected.

さらに別の有利な構成によれば、基板には構造化された非導電性の第1の犠牲層と、この第1の犠牲層の上に位置する構造化された導電性の第1の層と、この第1の層の上に位置する構造化された非導電性の第2の犠牲層と、この第2の犠牲層の上に位置する構造化された導電性の第2の層とが設けられている。この場合、曲げビームは導電性の第2の層から構造化されていて、この場合、ダイヤフラムは導電性の第1の層から構造化されている。   According to yet another advantageous configuration, the substrate comprises a structured non-conductive first sacrificial layer and a structured conductive first layer located on the first sacrificial layer. A structured non-conductive second sacrificial layer overlying the first layer; and a structured conductive second layer overlying the second sacrificial layer; Is provided. In this case, the bending beam is structured from a conductive second layer, in which case the diaphragm is structured from a conductive first layer.

さらに別の有利な構成によれば、非導電性の第1の犠牲層の内部に、導電性の接触接続領域が形成されていて、この接触接続領域を介して、構造化された導電性の第1の層の各領域を基板に接続し、この場合、基板は分離溝により絶縁されたコンタクトプラグを有している。これらのコンタクトプラグを介して、導電性の接触接続領域を基板の裏面に電気的に接続している。   According to yet another advantageous configuration, a conductive contact connection region is formed inside the non-conductive first sacrificial layer, through which the structured conductive conductive material is formed. Each region of the first layer is connected to a substrate, in which case the substrate has a contact plug insulated by a separation groove. The conductive contact connection region is electrically connected to the back surface of the substrate through these contact plugs.

さらに別の有利な構成によれば、評価ICが、接触接続面を介してコンタクトプラグにボンディングされている。   According to yet another advantageous configuration, the evaluation IC is bonded to the contact plug via the contact connection surface.

さらに別の有利な構成によれば、背極が基板から構造化されている。   According to yet another advantageous configuration, the back electrode is structured from the substrate.

さらに別の有利な構成によれば、背極が導電性の第2の層から構造化されている。   According to yet another advantageous configuration, the back electrode is structured from a conductive second layer.

以下に、本発明を実施するための最良の形態を図面につき詳しく説明する。   In the following, the best mode for carrying out the present invention will be described in detail with reference to the drawings.

図面には同一の構成要素または同一の機能を有する構成要素には同じ符号が付与されている。   In the drawings, the same reference numerals are given to the same components or components having the same function.

図1a、図1b、図1c、図1dおよび図1eには、本発明の第1の実施例によるマイクロマシニング型のコンビ構成素子の主要製造ステップの概略的な縦断面図が示してある。   FIGS. 1a, 1b, 1c, 1d and 1e show schematic longitudinal sectional views of the main manufacturing steps of a micromachining combination component according to a first embodiment of the invention.

図1aには表面VSと裏面RSとを有するシリコンウェーハ基板が符号1で示してある。シリコンウェーハ基板1の表面VSには、シリコン酸化物から成る犠牲層21が被着されていて、この犠牲層21は本例では4μmの厚さを有している。犠牲層21の上側には、厚さ5μmの導電性の層31が被着され構造化される。この導電性の層31は、後の慣性センサ構造体に対応配置されている第1の領域31aと、後のダイヤフラムセンサ構造体(ここでは容量型マイクロホン)に対応配置されている第2の領域31bとを有している。図1aから分かるように、導電性の層31の第2の領域31bは貫通孔36を有していて、この貫通孔36は後のマイクロホンのダイヤフラムにおいて圧力補償をもたらす。導電性の層31として、ドーピングされたポリシリコンが特に有利である。   In FIG. 1 a, a silicon wafer substrate having a front surface VS and a back surface RS is indicated by reference numeral 1. A sacrificial layer 21 made of silicon oxide is deposited on the surface VS of the silicon wafer substrate 1, and this sacrificial layer 21 has a thickness of 4 μm in this example. On top of the sacrificial layer 21, a conductive layer 31 having a thickness of 5 μm is deposited and structured. The conductive layer 31 includes a first region 31a disposed corresponding to a later inertial sensor structure, and a second region disposed corresponding to a later diaphragm sensor structure (capacitive microphone in this case). 31b. As can be seen from FIG. 1a, the second region 31b of the conductive layer 31 has a through hole 36, which provides pressure compensation in the later microphone diaphragm. As the conductive layer 31, doped polysilicon is particularly advantageous.

別の実施例(図示せず)では導電性の層31が、たとえば誘電性の別の層にポリシリコンが埋め込まれている層スタックから成っていてよく、これにより層スタック内部の応力は有利には僅かな引張応力に調整することができるようになる。たとえばドイツ連邦共和国特許出願公開第19847455号明細書および同第10065013号明細書から公知のように、択一的には犠牲層をたとえばSiGeから実現するか、または保護酸化物によって取り囲まれたシリコン層を導電性の単層もしくは導電性の複層として使用することができる。   In another embodiment (not shown), the conductive layer 31 may consist of a layer stack, for example with polysilicon embedded in another dielectric layer, so that the stress inside the layer stack is advantageously Can be adjusted to a slight tensile stress. As is known, for example, from DE 198 47 455 and DE 10065013, a sacrificial layer is alternatively realized, for example, from SiGe, or a silicon layer surrounded by a protective oxide. Can be used as a conductive single layer or a conductive multiple layer.

さらに図1bに示したように、シリコン酸化物から成る別の犠牲層22が、第1の犠牲層21および構造化された導電性の層31の上側に堆積され同様に構造化される。本例では、第2の犠牲層22は10μmの厚さを有している。第2の犠牲層22は、導電性の層31の第1の領域31aの上側に3つの貫通孔37a,37b,37cを有していて、導電性の層31の第2の領域31bの上側にさらに1つの貫通孔37dを有している。次のプロセス経過では、ポリシリコンから成る別の導電性の層4が、構造体にわたって堆積されドーピングされる。本例では、別の導電性の層4は10μm以上、たとえば30μmの厚さを有している。この別の導電性の層4は、貫通孔37a,37b,37c,37dを介して機械的および電気的に導電性の層31の第1の領域31aもしくは第2の領域31bに接続されている。さらに次のプロセスステップでは、金属製のボンディング面5a,5bの被着および構造化が行われる。これらのボンディング面5a,5bは後にボンディングランドとしてワイヤボンディングに適するか、またはアンダバンプメタライジング部としてキャップウェーハであるキャップの共晶ボンディングに適する。これに相応して金属製のボンディング面5a,5bは、アンダバンプメタライジングのために、有利にはアルミニウムまたはプラチナもしくはたとえばAl/Ti/Ni/Au等の他の標準金属層列から成っている。   Further, as shown in FIG. 1b, another sacrificial layer 22 of silicon oxide is deposited on top of the first sacrificial layer 21 and the structured conductive layer 31 and is similarly structured. In this example, the second sacrificial layer 22 has a thickness of 10 μm. The second sacrificial layer 22 has three through holes 37 a, 37 b, and 37 c above the first region 31 a of the conductive layer 31, and above the second region 31 b of the conductive layer 31. In addition, one through hole 37d is provided. In the next process course, another conductive layer 4 of polysilicon is deposited and doped over the structure. In this example, the another conductive layer 4 has a thickness of 10 μm or more, for example, 30 μm. The other conductive layer 4 is connected to the first region 31a or the second region 31b of the mechanically and electrically conductive layer 31 through the through holes 37a, 37b, 37c, and 37d. . In the next process step, the metal bonding surfaces 5a, 5b are deposited and structured. These bonding surfaces 5a and 5b are suitable for wire bonding later as bonding lands, or suitable for eutectic bonding of a cap as a cap wafer as an under bump metallizing portion. Correspondingly, the metal bonding surfaces 5a, 5b are preferably made of aluminum or platinum or another standard metal layer sequence such as Al / Ti / Ni / Au for underbump metallization. .

次いで、さらに図1cに示したように、導電性の層4のいわゆるトレンチエッチング(または簡単にトレンチング)が、標準リソグラフィ技術を使って行われる。トレンチングにより金属製のボンディング面5a,5bを絶縁するための分離溝43と、ボンディング面5a,5bの下側に位置する相応のコンタクトプラグ45a;45bとがもたらされる。これらのコンタクトプラグ45a,45bを介して金属製のボンディング面5a;5bは、その下側に位置する、導電性の層31の相応の領域31a;31bに電気的に接続される。   Then, as further illustrated in FIG. 1c, a so-called trench etching (or simply trenching) of the conductive layer 4 is performed using standard lithographic techniques. Trenching provides separation grooves 43 for insulating the metal bonding surfaces 5a, 5b and corresponding contact plugs 45a; 45b located below the bonding surfaces 5a, 5b. Via these contact plugs 45a, 45b, the metal bonding surfaces 5a; 5b are electrically connected to the corresponding regions 31a; 31b of the conductive layer 31 located below.

さらに、後の慣性センサ構造体のビーム46a,46b,46c,46dを位置規定する分離溝41がもたらされる。この場合、ビーム46a,46dは、慣性センサ構造体の定置のビームであって、これに対してビーム46b,46cは、基板1の表面VSに対して平行に変位可能な、慣性センサ構造体のビームである。さらに、後のダイヤフラムセンサ構造体の背極47a,47b、すなわちマイクロホン緩衝、ひいてはダイヤフラムセンサ構造体の音響的な機能を規定する分離溝42がもたらされる。最終的にはその次に、シリコンウェーハ基板1は、空洞10がダイヤフラムセンサ構造体の裏面にもたらされるように裏面RSから構造化される。   In addition, a separation groove 41 is provided for positioning the beams 46a, 46b, 46c, 46d of the subsequent inertial sensor structure. In this case, the beams 46 a and 46 d are stationary beams of the inertial sensor structure, whereas the beams 46 b and 46 c are displaceable parallel to the surface VS of the substrate 1. It is a beam. In addition, back electrodes 47a, 47b of the subsequent diaphragm sensor structure, i.e. microphone buffering, and thus a separation groove 42 that defines the acoustic function of the diaphragm sensor structure are provided. Eventually, then, the silicon wafer substrate 1 is structured from the back surface RS so that the cavity 10 is brought to the back surface of the diaphragm sensor structure.

これに続いて、図1dに示したように、犠牲層21,22は、有利にはSiGeおよびSiに関して、たとえばClF,XeF等を使ったガスによるHFエッチングプロセスによりエッチングされる。このHFエッチングプロセスにより、慣性センサ構造体はサイドエッチングされ、表面VSに対して水平に変位可能なビーム46b,46cが形成される。これらのビーム46b,46cは、定置のビーム46a,46dと一緒にコンデンサとして作用する。このコンデンサの容量は状況もしくは加速度に関連して可変である。ダイヤフラムセンサ構造体の領域では、エッチングプロセスによりカンチレバ形のダイヤフラム25が形成される。このダイヤフラム25は、表面VSに対して垂直に変位可能で、音波信号を検出することを可能にする。既述したように、この場合、貫通孔36は空洞圧と周囲圧との間の圧力補償のために働く。この貫通孔36が設けられない場合、ダイヤフラムセンサ構造体は容量型圧力センサとして働くことができる。 Following this, as shown in FIG. 1d, the sacrificial layers 21, 22 are preferably etched with respect to SiGe and Si by a gas HF etching process using, for example, ClF 3 , XeF 2 or the like. By this HF etching process, the inertial sensor structure is side-etched to form beams 46b and 46c that can be displaced horizontally relative to the surface VS. These beams 46b and 46c act as capacitors together with stationary beams 46a and 46d. The capacitance of this capacitor is variable in relation to the situation or acceleration. In the area of the diaphragm sensor structure, a cantilever diaphragm 25 is formed by an etching process. The diaphragm 25 can be displaced perpendicularly to the surface VS, and can detect a sound wave signal. As described above, in this case, the through hole 36 serves for pressure compensation between the cavity pressure and the ambient pressure. If this through hole 36 is not provided, the diaphragm sensor structure can act as a capacitive pressure sensor.

次いで、図1eに示したように、慣性センサ構造体とダイヤフラムセンサ構造体を保護するために、第1の空洞71と第2の空洞72とを備えた予め構造化されたキャップウェーハ7が、シールガラス領域6によって導電性の層4にボンディングされる。この場合、キャップウェーハ7の構造化およびボンディングは、第1の空洞71が気密に閉じられていて、この第1の空洞71内で基準室(負)圧が調整されるように行われる。ダイヤフラムセンサ構造体の領域では、空洞72がマイクロホンのバックチャンバ(Rueckvolumen)として働く。汚染、湿分等から保護するために、シリコンウェーハ基板1の裏面RSにシート19を被着することができる。このシート19は、必要な場合には構造化することもできる。   Then, as shown in FIG. 1e, a prestructured cap wafer 7 with a first cavity 71 and a second cavity 72 to protect the inertial sensor structure and the diaphragm sensor structure is Bonded to the conductive layer 4 by the sealing glass region 6. In this case, the cap wafer 7 is structured and bonded so that the first cavity 71 is hermetically closed and the reference chamber (negative) pressure is adjusted in the first cavity 71. In the area of the diaphragm sensor structure, the cavity 72 serves as a microphone back chamber. In order to protect from contamination, moisture, etc., a sheet 19 can be applied to the back surface RS of the silicon wafer substrate 1. The sheet 19 can be structured if necessary.

別の実施例(図示せず)の場合、空洞71,72を単に1つの空洞に形成することができる。そのために、キャップウェーハ7は先行技術から公知であるz形ストッパ(z−Anschlaegen)(図示せず)を備えて設計されていてよい。このように製造されたマイクロマシニング型の構成素子は、音響的な開口を備えたプレートに位置固定され、金属製のボンディング面5a,5bを介して電気的に接触接続することができる。   In another embodiment (not shown), the cavities 71, 72 can be simply formed in one cavity. For this purpose, the cap wafer 7 may be designed with a z-Anchlagen (not shown) known from the prior art. The micromachining type component manufactured in this way is fixed in position to a plate having an acoustic opening, and can be electrically contact-connected through metal bonding surfaces 5a and 5b.

図2a、図2b、図2cおよび図2dには、本発明の第2の実施例によるマイクロマシニング型のコンビ構成素子の主要製造ステップの概略的な縦断面図が示してある。   2a, 2b, 2c and 2d show schematic longitudinal sectional views of the main manufacturing steps of a micromachined combination component according to a second embodiment of the invention.

図2aによれば、導電性の層31の領域31a,31bは、シリコンウェーハ基板1に対して導電性の領域31′a,31′bを介して電気的および機械的に接触接続している。これらの導電性の領域31′a,31′bは、別の導電性の層31′から構造化されていて、第1の犠牲層21内に埋め込まれている。さらに導電性の層4′が、第2の犠牲層22を抜けて延び、導電性の層31′の別の導電性の領域31′cに当たるコンタクトプラグ45cを有することにより、導電性の層4′は、半導体基板1に対して電気的および機械的に接触接続する。犠牲層22は、ここでは犠牲層21の前で表面VSからエッチングされ、その後、キャップ封止が行われる。キャップウェーハ7′は、この第2の実施例ではシリコンウェーハ基板1とのより大きな面オーバラップ(図示の場合には完全なオーバラップ)を有している。   According to FIG. 2a, the regions 31a, 31b of the conductive layer 31 are in electrical and mechanical contact with the silicon wafer substrate 1 via the conductive regions 31'a, 31'b. . These conductive regions 31 ′ a, 31 ′ b are structured from another conductive layer 31 ′ and are embedded in the first sacrificial layer 21. Furthermore, the conductive layer 4 ′ has a contact plug 45 c extending through the second sacrificial layer 22 and hitting another conductive region 31 ′ c of the conductive layer 31 ′. 'Is in electrical and mechanical contact connection with the semiconductor substrate 1. Here, the sacrificial layer 22 is etched from the surface VS in front of the sacrificial layer 21, and then cap sealing is performed. In this second embodiment, the cap wafer 7 'has a larger surface overlap with the silicon wafer substrate 1 (complete overlap in the case shown).

さらに図2bに示したように、シリコンウェーハ基板1の裏面RSが薄肉化されるので、シリコンウェーハ基板1の最終的な厚さは200μm以下、有利には100μm以下である。続いて、このようにしてもたらされた薄肉化された裏面RS′に、金属製のボンディング面5′a,5′b,5′c,5′dが裏面RS′に堆積され構造化される。   Further, as shown in FIG. 2b, since the back surface RS of the silicon wafer substrate 1 is thinned, the final thickness of the silicon wafer substrate 1 is 200 μm or less, preferably 100 μm or less. Subsequently, metal bonding surfaces 5'a, 5'b, 5'c and 5'd are deposited on the back surface RS 'and structured on the thinned back surface RS' thus obtained. The

次いで、さらに図2cに示したように、裏面のトレンチエッチングが、慣例のリソグラフ技術によって行われ、これにより空洞10′と分離溝43′とが、シリコンウェーハ基板1の裏面RS′から構造化される。これに続いて、犠牲層21のエッチングが裏面から行われ、これによりダイヤフラム25が露出する。分離溝43′は、コンタクトプラグ45a,45e,45fを規定し、これらのコンタクトプラグ45a,45e,45fは、金属製のボンディング面5′a,5′b,5′cを導電性の領域31′a,31′b,31′cに接続する。   Then, as further shown in FIG. 2c, the backside trench etching is performed by conventional lithographic techniques, whereby the cavity 10 'and the isolation groove 43' are structured from the backside RS 'of the silicon wafer substrate 1. The Following this, etching of the sacrificial layer 21 is performed from the back surface, thereby exposing the diaphragm 25. The isolation groove 43 ′ defines contact plugs 45 a, 45 e, 45 f, and these contact plugs 45 a, 45 e, 45 f connect the metal bonding surfaces 5 ′ a, 5 ′ b, 5 ′ c to the conductive region 31. 'A, 31'b, 31'c.

次いで、図2dに示したように、反転された状態においてフリップチップ技術で評価IC(ASIC)8が、シリコンウェーハ基板1の裏面RS′に被着され、この場合、電気的および機械的な接触接続は、金属製のボンディング面5′a,5′b,5′cを介して実現化される。金属製のボンディング面5′dは、全構成素子の電気的な接触接続(詳しく説明せず)のために働く。   Next, as shown in FIG. 2d, an evaluation IC (ASIC) 8 is applied to the back surface RS ′ of the silicon wafer substrate 1 by flip chip technology in the inverted state, in this case electrical and mechanical contact. The connection is realized via metal bonding surfaces 5'a, 5'b, 5'c. The metal bonding surface 5'd serves for electrical contact connection (not described in detail) of all components.

本例では、3つのチップスタックの全高は、個々の高さ、すなわちキャップウェーハ7′の厚さ約380μmと、裏面を薄肉化されたシリコンウェーハ基板1の厚さ約120μmと、評価ICチップ8(はんだ面を含む)の厚さ500μm以下とから構成される。これにより、1000μm以下の全厚さが実現可能であることが明らかになる。   In this example, the total height of the three chip stacks is the individual height, that is, the thickness of the cap wafer 7 ′ is about 380 μm, the thickness of the silicon wafer substrate 1 whose back surface is thinned is about 120 μm, and the evaluation IC chip 8 The thickness (including the solder surface) is 500 μm or less. This makes it clear that a total thickness of 1000 μm or less can be realized.

図3には、本発明の第3の実施例によるマイクロマシニング型のコンビ構成素子の主要製造ステップの概略的な縦断面図が示してある。   FIG. 3 shows a schematic longitudinal sectional view of main manufacturing steps of a micromachining combination component according to a third embodiment of the present invention.

図3の実施例では、評価IC8′のコンタクト形成を、裏面を薄肉化されたシリコンウェーハ基板1に対して側方にずらして行う。これによりラテラルな突出Dがもたらされる。評価IC8′の、シリコンウェーハ基板1に向いている側には、金属製の別のボンディング面5′eがあり、このボンディング面5′eはワイヤボンディングによる接続のために働くことができる。   In the embodiment of FIG. 3, the contact formation of the evaluation IC 8 ′ is performed by shifting the back surface laterally with respect to the thinned silicon wafer substrate 1. This results in a lateral protrusion D. On the side of the evaluation IC 8 'facing the silicon wafer substrate 1, there is another metallic bonding surface 5'e, which can serve for connection by wire bonding.

図4には、本発明の第4の実施例によるマイクロマシニング型のコンビ構成素子の主要製造ステップの概略的な縦断面図が示してある。   FIG. 4 shows a schematic longitudinal sectional view of the main manufacturing steps of a micromachining combination component according to a fourth embodiment of the present invention.

図4の第4の実施例では、評価IC8″は、薄肉化されたシリコンウェーハ基板1の裏面RS′を全体的に覆っている。キャップウェーハ7″には貫通開口73が備え付けられていて、この貫通開口73はダイヤフラムセンサ構造体用の音響的な開口として働く。キャップウェーハ7″の別の開口74により、金属製のボンディング面5aの導電性の層4におけるコンタクト形成が可能になる。   In the fourth embodiment of FIG. 4, the evaluation IC 8 ″ entirely covers the back surface RS ′ of the thinned silicon wafer substrate 1. The cap wafer 7 ″ is provided with a through opening 73, This through opening 73 serves as an acoustic opening for the diaphragm sensor structure. Another opening 74 in the cap wafer 7 ″ enables contact formation in the conductive layer 4 of the metal bonding surface 5a.

図5には、本発明の第5の実施例によるマイクロマシニング型のコンビ構成素子の主要製造ステップの概略的な縦断面図が示してある。   FIG. 5 shows a schematic longitudinal sectional view of main manufacturing steps of a micromachining combination component according to a fifth embodiment of the present invention.

図5の第5の実施例の記述は図1dの記述に相応する。図1dとは異なり図5では、電極47′a,47′bが導電性の層4に設けられているのではなく、シリコンウェーハ基板1から構造化されている。このことは、空洞10のエッチングの際の相応なマスキングにより可能になる。   The description of the fifth embodiment of FIG. 5 corresponds to the description of FIG. Unlike FIG. 1 d, in FIG. 5, the electrodes 47 ′ a, 47 ′ b are not provided on the conductive layer 4 but are structured from the silicon wafer substrate 1. This is made possible by a corresponding masking during the etching of the cavity 10.

本発明の第6の実施例によるマイクロマシニング型のコンビ構成素子の主要製造ステップの概略的な縦断面図が示してある。   A schematic longitudinal section of the main manufacturing steps of a micromachining combination component according to a sixth embodiment of the invention is shown.

図6の第6の実施例は、図1dの第1の実施例と図5の第5の実施例との組合せとして解することができる。なぜならば第6の実施例は、ダイヤフラム25と、電極47a,47bと、電極47′a,47′bとを既に有しているからである。したがって、ダイヤフラム変位の差分評価が可能である。   The sixth embodiment of FIG. 6 can be understood as a combination of the first embodiment of FIG. 1d and the fifth embodiment of FIG. This is because the sixth embodiment already has the diaphragm 25, the electrodes 47a and 47b, and the electrodes 47'a and 47'b. Therefore, the difference evaluation of the diaphragm displacement is possible.

以上、本発明を有利な実施例につき説明したが、本発明はこれらの実施例に制限されるものではなく、種々多様に改良可能である。   Although the present invention has been described with reference to the preferred embodiments, the present invention is not limited to these embodiments and can be variously improved.

発明の対象から逸脱せず、特に、個々のプロセスステップの順序を互いに入れ替えることもできる。すなわち、たとえばウェーハ裏面処理をウェーハ表面処理の前に行うか、またはウェーハ表面プロセッシングの前に完了しておくか、あるいはウェーハ表面プロセッシングを最初に行うか、または最初に完了しておき、その後にウェーハ裏面処理を行うことができる。しかし、ウェーハ表面およびウェーハ裏面における個々の方法ステップを全プロセス経過中に順次に互いに交互に行うことができ、すなわちまず一度ウェーハ表面を処理し、次いで再びウェーハ裏面を処理し、引き続きウェーハ表面とウェーハ裏面とが、それぞれ1つまたは複数のステップを経て処理されてゆく。上述したプロセス経過は、多くの点で有利であるとみなすことができるが、しかし本発明の意図において唯一の可能なプロセス経過ではない。特に、種々異なる実施例のプロセス部分もしくは構造体部分を互いに入れ替えることができる。   In particular, the order of the individual process steps can be interchanged without departing from the subject of the invention. This means, for example, whether the wafer backside treatment is performed before the wafer surface treatment or is completed before the wafer surface processing, or the wafer surface processing is performed first or is completed first, and then the wafer is processed. Backside processing can be performed. However, the individual method steps on the wafer surface and the wafer back surface can be alternately performed one after the other during the entire process, i.e. the wafer surface is first processed and then the wafer back surface is processed again, followed by the wafer surface and the wafer. Each back side is processed through one or more steps. The process process described above can be considered advantageous in many respects, but is not the only possible process process for the purposes of the present invention. In particular, the process parts or structure parts of the different embodiments can be interchanged with one another.

本発明の第1実施例によるマイクロマシニング型のコンビ構成素子の主な製造ステップのうちの第1の製造ステップを示す概略的な縦断面図である。It is a schematic longitudinal cross-sectional view which shows the 1st manufacturing step of the main manufacturing steps of the micromachining type | mold combination component by 1st Example of this invention. 第1実施例における第2の製造ステップを示す概略的な縦断面図である。It is a schematic longitudinal cross-sectional view which shows the 2nd manufacturing step in 1st Example. 第1実施例における第3の製造ステップを示す概略的な縦断面図である。It is a schematic longitudinal cross-sectional view which shows the 3rd manufacturing step in 1st Example. 第1実施例における第4の製造ステップを示す概略的な縦断面図である。It is a schematic longitudinal cross-sectional view which shows the 4th manufacturing step in 1st Example. 第1実施例における第5の製造ステップを示す概略的な縦断面図である。It is a schematic longitudinal cross-sectional view which shows the 5th manufacturing step in 1st Example. 本発明の第2実施例によるマイクロマシニング型のコンビ構成素子の主な製造ステップのうちの第1の製造ステップを示す概略的な縦断面図である。It is a schematic longitudinal cross-sectional view which shows the 1st manufacturing step of the main manufacturing steps of the micromachining type | mold combination component element by 2nd Example of this invention. 第2実施例における第2の製造ステップを示す概略的な縦断面図である。It is a schematic longitudinal cross-sectional view which shows the 2nd manufacturing step in 2nd Example. 第2実施例における第3の製造ステップを示す概略的な縦断面図である。It is a schematic longitudinal cross-sectional view which shows the 3rd manufacturing step in 2nd Example. 第2実施例における第4の製造ステップを示す概略的な縦断面図である。It is a schematic longitudinal cross-sectional view which shows the 4th manufacturing step in 2nd Example. 本発明の第3実施例によるマイクロマシニング型のコンビ構成素子の概略的な縦断面図である。It is a schematic longitudinal cross-sectional view of the micromachining type | mold combination component by 3rd Example of this invention. 本発明の第4実施例によるマイクロマシニング型のコンビ構成素子の概略的な縦断面図である。It is a schematic longitudinal cross-sectional view of the micromachining type | mold combination component by 4th Example of this invention. 本発明の第5実施例によるマイクロマシニング型のコンビ構成素子の概略的な縦断面図である。FIG. 9 is a schematic longitudinal sectional view of a micro-machining combination component according to a fifth embodiment of the present invention. 本発明の第6実施例によるマイクロマシニング型のコンビ構成素子の概略的な縦断面図である。It is a schematic longitudinal cross-sectional view of the micromachining type | mold combination component by 6th Example of this invention.

符号の説明Explanation of symbols

1 シリコンウェーハ基板、 VS 表面、 RS 裏面、 21 第1の犠牲層、 22 第2の犠牲層、 31 第1の導電性の層、 31a 31の第1の領域、 31b 31の第2の領域、 4 導電性のポリシリコン層、 36 貫通孔、 37a〜37b 貫通孔、 5a,5b,5a′ 金属製のボンディング面、 41,42,43 分離溝、 10,10′ 空洞、 46a,46b,46c,46d 慣性センサ構造体のビーム、 47a,47b,47′a,47′b ダイヤフラムセンサ構造体の電極、 25 ダイヤフラム、 45a,45b コンタクトプラグ、 7,7′,7″ キャップウェーハ、 71,72 空洞、 6 シールガラス領域、 19 シート、 71′,72′ 空洞、 73,74 貫通開口、 31′ 導電性の層、 31′a 31′の第1の領域、 31′b 31′の第2の領域、 31′c 31′の第3の領域、 5′a,5′b,5′c,5′d 金属製のボンディング面、 RS′ 薄肉化された裏面、 45 DEFコンタクトプラグ、 45c コンタクトプラグ、 8,8′ 評価IC、 43′ 分離溝、 45d,45g コンタクトプラグ、 31′d 31′の第4の領域   DESCRIPTION OF SYMBOLS 1 Silicon wafer substrate, VS surface, RS back surface, 21 1st sacrificial layer, 22 2nd sacrificial layer, 31 1st electroconductive layer, 31a 31 1st area | region, 31b 31 2nd area | region, 4 conductive polysilicon layer, 36 through-hole, 37a-37b through-hole, 5a, 5b, 5a ′ metal bonding surface, 41, 42, 43 separation groove, 10, 10 ′ cavity, 46a, 46b, 46c, 46d inertial sensor structure beam, 47a, 47b, 47'a, 47'b diaphragm sensor structure electrode, 25 diaphragm, 45a, 45b contact plug, 7, 7 ', 7 "cap wafer, 71, 72 cavity, 6 seal glass area, 19 sheet, 71 ', 72' cavity, 73, 74 through opening, 31 'conductive 31'a 31 'first region, 31'b 31' second region, 31'c 31 'third region, 5'a, 5'b, 5'c, 5'd metal Bonding surface, RS 'thinned back surface, 45 DEF contact plug, 45c contact plug, 8,8' evaluation IC, 43 'separation groove, 45d, 45g contact plug, fourth region of 31'd 31'

Claims (17)

マイクロマシニング型のコンビ構成素子において、
表面(VS)と裏面(RS;RS′)とを備えた基板(1)と;
基板(1)の表面(VS)に形成されている、少なくとも1つの曲げビーム(46a〜46d)を備えている慣性型の第1のセンサ装置(46a〜46d)と;
基板(1)の表面(VS)に形成されている、少なくとも1つのダイヤフラム(25)と、少なくとも1つの背極(47a,47b;47′a,47′b;47a,47b,47′a,47′b)とを備えているダイヤフラム型の第2のセンサ装置(25,47a,47b;25,47′a,47′b;25,47a,47b,47′a,47′b)とが設けられており;
第1のセンサ装置(46a〜46d)と第2のセンサ装置(25,47a,47b;25,47′a,47′b;25,47a,47b,47′a,47′b)とが、基板(1)の表面(VS)に被着される共通のキャップ装置(7;7′;7″)によりキャップ封止されていることを特徴とする、マイクロマシニング型のコンビ構成素子。
In micromachining type combination components,
A substrate (1) comprising a front surface (VS) and a back surface (RS; RS ′);
An inertial-type first sensor device (46a-46d) comprising at least one bending beam (46a-46d) formed on the surface (VS) of the substrate (1);
At least one diaphragm (25) formed on the surface (VS) of the substrate (1) and at least one back electrode (47a, 47b; 47'a, 47'b; 47a, 47b, 47'a, A second sensor device (25, 47a, 47b; 25, 47'a, 47'b; 25, 47a, 47b, 47'a, 47'b) provided with Provided;
The first sensor device (46a-46d) and the second sensor device (25, 47a, 47b; 25, 47'a, 47'b; 25, 47a, 47b, 47'a, 47'b) A micromachining type combination component characterized by being capped with a common cap device (7; 7 '; 7 ") applied to the surface (VS) of the substrate (1).
第2のセンサ装置(25,47a,47b;25,47′a,47′b;25,47a,47b,47′a,47′b)が、基板(1)の裏面(RS;RS′)から空洞(10;10′)を通じて圧力によって負荷可能になっている、請求項1記載のマイクロマシニング型のコンビ構成素子。   The second sensor device (25, 47a, 47b; 25, 47'a, 47'b; 25, 47a, 47b, 47'a, 47'b) is the back surface (RS; RS ') of the substrate (1). 2. A combination component of micromachining type according to claim 1, which can be loaded by pressure through the cavity (10; 10 '). 第2のセンサ装置(25,47a,47b;25,47′a,47′b;25,47a,47b,47′a,47′b)が、基板(1)の表面(VS)からキャップ装置(7;7′;7″)における貫通開口(73)を通じて圧力によって負荷可能になっている、請求項1記載のマイクロマシニング型のコンビ構成素子。   The second sensor device (25, 47a, 47b; 25, 47'a, 47'b; 25, 47a, 47b, 47'a, 47'b) is a cap device from the surface (VS) of the substrate (1). The combination component of the micromachining type according to claim 1, which can be loaded by pressure through a through opening (73) in (7; 7 '; 7 "). キャップ装置(7;7′;7″)が、第1のセンサ装置(46a〜46d)の上側に位置する第1の空洞(71;71′)と、第2のセンサ装置(25,47a,47b;25,47′a,47′b;25,47a,47b,47′a,47′b)の上側に位置する第2の空洞(72;72′)とを有しており、第1の空洞(71;71′)と第2の空洞(72;72′)とが、互いに流体接続していない、請求項1記載のマイクロマシニング型のコンビ構成素子。   A cap device (7; 7 '; 7 ") has a first cavity (71; 71') located above the first sensor device (46a-46d) and a second sensor device (25, 47a, 47b; 25, 47'a, 47'b; 25, 47a, 47b, 47'a, 47'b) and a second cavity (72; 72 '), The micromachining combination component of claim 1, wherein the cavity (71; 71 ') and the second cavity (72; 72') are not fluidly connected to each other. 基板(1)に、構造化された非導電性の第1の犠牲層(21)と、該第1の犠牲層(21)の上に位置する構造化された導電性の第1の層(31)と、該第1の層(31)の上に位置する構造化された非導電性の第2の犠牲層(22)と、該第2の犠牲層(22)の上に位置する構造化された導電性の第2の層(4)とが設けられており、曲げビーム(46a〜46d)が、導電性の第2の層(4)から構造化されており、ダイヤフラム(25)が、導電性の第1の層(31)から構造化されている、請求項1から4までのいずれか1項記載のマイクロマシニング型のコンビ構成素子。   A substrate (1) has a structured non-conductive first sacrificial layer (21) and a structured conductive first layer located on the first sacrificial layer (21) ( 31), a structured non-conductive second sacrificial layer (22) located on the first layer (31), and a structure located on the second sacrificial layer (22) A conductive second layer (4), and a bending beam (46a-46d) is structured from the conductive second layer (4), and the diaphragm (25) A micromachining type combination component according to any one of claims 1 to 4, characterized in that is structured from a conductive first layer (31). 非導電性の第1の犠牲層(21)の内部に導電性の接触接続領域(31′a〜31′c;31′a〜31′d)が形成されており、該接触接続領域(31′a〜31′c;31′a〜31′d)が、構造化された導電性の第1の層(31)の各領域(31a,31b)を基板(1)に接続するようになっていて、基板(1)が、分離溝(43′)により絶縁されたコンタクトプラグ(45d〜45f;45d〜45g)を有しており、該コンタクトプラグ(45d〜45f;45d〜45g)が、導電性の接触接続領域(31′a〜31′c;31′a〜31′d)を基板(1)の裏面(RS′)に電気的に接続するようになっている、請求項5記載のマイクロマシニング型のコンビ構成素子。   Conductive contact connection regions (31'a to 31'c; 31'a to 31'd) are formed inside the non-conductive first sacrificial layer (21), and the contact connection regions (31 'A-31'c; 31'a-31'd) connect each region (31a, 31b) of the structured conductive first layer (31) to the substrate (1). The substrate (1) has contact plugs (45d to 45f; 45d to 45g) insulated by a separation groove (43 '), and the contact plugs (45d to 45f; 45d to 45g) are The electrically conductive contact connection region (31'a-31'c; 31'a-31'd) is electrically connected to the back surface (RS ') of the substrate (1). Micromachining type combination component. 評価ICが、接触接続面(5′a〜5′c)を介してコンタクトプラグ(45d〜45f;45d〜45g)にボンディングされている、請求項6記載のマイクロマシニング型のコンビ構成素子。   The micromachining type combination component according to claim 6, wherein the evaluation IC is bonded to the contact plug (45d to 45f; 45d to 45g) via the contact connection surface (5'a to 5'c). 背極(47a,47b;47′a,47′b;47a,47b,47′a,47′b)が、基板(1)から構造化されている、請求項1から7までのいずれか1項記載のマイクロマシニング型のコンビ構成素子。   The back electrode (47a, 47b; 47'a, 47'b; 47a, 47b, 47'a, 47'b) is any one of claims 1 to 7, structured from a substrate (1). The micromachining type combination component described in the item. 背極(47a,47b;47′a,47′b;47a,47b,47′a,47′b)が、導電性の第2の層(4)から構造化されている、請求項8記載のマイクロマシニング型のコンビ構成素子。   The back electrode (47a, 47b; 47'a, 47'b; 47a, 47b, 47'a, 47'b) is structured from a conductive second layer (4). Micromachining type combination component. マイクロマシニング型のコンビ構成素子のための製造方法において、以下のステップ:
表面(VS)と裏面(RS;RS′)とを備えた基板(1)を準備し;
少なくとも1つの曲げビーム(46a〜46d)を備えている慣性型の第1のセンサ装置(46a〜46d)を、基板(1)の表面(VS)に形成し;
少なくとも1つのダイヤフラム(25)と、少なくとも1つの背極(47a,47b;47′a,47′b;47a,47b,47′a,47′b)とを備えたダイヤフラム型の第2のセンサ装置(25,47a,47b;25,47′a,47′b;25,47a,47b,47′a,47′b)を、基板(1)の表面(VS)に形成し;
第1のセンサ装置(46a〜46d)と第2のセンサ装置(25,47a,47b;25,47′a,47′b;25,47a,47b,47′a,47′b)とを、基板(1)の表面(VS)に共通のキャップ装置(7;7′;7″)を被着することにより、キャップ封止する;
を実施することを特徴とする、マイクロマシニング型のコンビ構成素子のための製造方法。
In a manufacturing method for a micromachining type combination component, the following steps:
Providing a substrate (1) having a front surface (VS) and a back surface (RS; RS ′);
An inertial type first sensor device (46a-46d) comprising at least one bending beam (46a-46d) is formed on the surface (VS) of the substrate (1);
Diaphragm type second sensor comprising at least one diaphragm (25) and at least one back pole (47a, 47b; 47'a, 47'b; 47a, 47b, 47'a, 47'b) Forming devices (25, 47a, 47b; 25, 47'a, 47'b; 25, 47a, 47b, 47'a, 47'b) on the surface (VS) of the substrate (1);
A first sensor device (46a-46d) and a second sensor device (25, 47a, 47b; 25, 47'a, 47'b; 25, 47a, 47b, 47'a, 47'b), Cap sealing by applying a common cap device (7; 7 '; 7 ") to the surface (VS) of the substrate (1);
A manufacturing method for a micromachining type combination component, characterized in that:
基板(1)に、構造化された非導電性の第1の犠牲層(21)と、該第1の犠牲層(21)の上に位置する構造化された導電性の第1の層(31)と、該第1の層(31)の上に位置する構造化された非導電性の第2の犠牲層(22)と、該第2の犠牲層(22)の上に位置する構造化された導電性の第2の層(4)とを設け、曲げビーム(46a〜46d)を、導電性の第2の層(4)の溝エッチングおよび非導電性の第2の犠牲層(22)の犠牲層エッチングにより導電性の第2の層(4)から構造化し、ダイヤフラム(25)を、導電性の第2の層(4)の溝エッチングおよび非導電性の第1の犠牲層(21)と非導電性の第2の犠牲層(22)との犠牲層エッチングにより導電性の第1の層(31)から構造化する、請求項10記載の方法。   A substrate (1) has a structured non-conductive first sacrificial layer (21) and a structured conductive first layer located on the first sacrificial layer (21) ( 31), a structured non-conductive second sacrificial layer (22) located on the first layer (31), and a structure located on the second sacrificial layer (22) Conductive second layer (4), and bending beam (46a-46d) is used for groove etching of conductive second layer (4) and non-conductive second sacrificial layer ( 22) is structured from the conductive second layer (4) by sacrificial layer etching, and the diaphragm (25) is grooved in the conductive second layer (4) and non-conductive first sacrificial layer. 11. Structured from a conductive first layer (31) by sacrificial layer etching of (21) and a non-conductive second sacrificial layer (22). Method. 非導電性の第1の犠牲層(21)の内部に導電性の接触接続領域(31′a〜31′c;31′a〜31′d)を形成し、該接触接続領域(31′a〜31′c;31′a〜31′d)を介して、構造化された導電性の第1の層(31)の各領域(31a,31b)を基板(1)に接続し、基板(1)に、分離溝(43′)により絶縁されたコンタクトプラグ(45d〜45f;45d〜45g)を溝エッチングにより形成し、該コンタクトプラグ(45d〜45f;45d〜45g)を介して、導電性の接触接続領域(31′a〜31′c;31′a〜31′d)を基板(1)の裏面(RS′)に電気的に接続する、請求項10または11記載の方法。   Conductive contact connection regions (31'a to 31'c; 31'a to 31'd) are formed inside the non-conductive first sacrificial layer (21), and the contact connection regions (31'a ˜31′c; 31′a to 31′d), each region (31a, 31b) of the structured conductive first layer (31) is connected to the substrate (1), and the substrate ( 1) Contact plugs (45d to 45f; 45d to 45g) insulated by the separation grooves (43 ') are formed by groove etching, and the conductive properties are obtained through the contact plugs (45d to 45f; 45d to 45g). 12. The method according to claim 10 or 11, wherein the contact connection areas (31'a-31'c; 31'a-31'd) are electrically connected to the back surface (RS ') of the substrate (1). 評価ICを、接触接続面(5′a〜5′c)を介してコンタクトプラグ(45d〜45f;45d〜45g)にボンディングする、請求項12記載の方法。   13. The method according to claim 12, wherein the evaluation IC is bonded to the contact plug (45d to 45f; 45d to 45g) via the contact connection surface (5'a to 5'c). 背極(47a,47b;47′a,47′b;47a,47b,47′a,47′b)を、基板(1)から構造化する、請求項10から13までのいずれか1項記載の方法。   14. The back electrode (47a, 47b; 47'a, 47'b; 47a, 47b, 47'a, 47'b) is structured from the substrate (1). the method of. 背極(47a,47b;47′a,47′b;47a,47b,47′a,47′b)を、導電性の第2の層(4)から構造化する、請求項8記載の方法。   9. The method according to claim 8, wherein the back electrode (47a, 47b; 47'a, 47'b; 47a, 47b, 47'a, 47'b) is structured from a conductive second layer (4). . 基板(1)がウェーハであり、該ウェーハを裏面(RS)から薄肉化する、請求項10から15までのいずれか1項記載の方法。   16. A method according to any one of claims 10 to 15, wherein the substrate (1) is a wafer and the wafer is thinned from the back surface (RS). 請求項1から9までのいずれか1項記載のマイクロマシニング型の構成素子を、移動式電話において位置に関連して表示制御するために使用する。   The micromachining type component according to any one of claims 1 to 9 is used for display control in relation to a position in a mobile phone.
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