JP2004063891A - Method for manufacturing ferroelectric memory - Google Patents
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Abstract
Description
【0001】
【発明の属する技術分野】
本発明は、一般に半導体メモリの技術分野に関し、特に強誘電体メモリ(FeRAM: Ferro−electric Random Access Memory)の製造方法に関する。
【0002】
【従来の技術】
この種の技術分野における不揮発性メモリとして、フラッシュ・メモリやFeRAMが知られている。フラッシュ・メモリは、絶縁ゲート型電界効果トランジスタ(IGFET: Insulated Gate Field Effect Transistor)のゲート絶縁膜中に埋め込まれたフローティング・ゲートを有し、このフローティング・ゲートに電荷を蓄積することによって、情報を記憶する。フラッシュ・メモリは、ダイナミック・ランダム・アクセス・メモリ(DRAM)と同様なセル構成を有するので、大規模の集積化に有利である。
【0003】
FeRAMは、強誘電体の分極ヒステリシス特性を利用して情報を記憶する。FeRAMのキャパシタ電極間に設けられる強誘電体膜は、電極間の印加電圧に応じて分極を生じ、印加電圧を取り去っても自発分極を維持する。印加電圧の極性を反転させると、自発分極の極性も反転する。この自発分極の方向を検出することにより、情報の読み書きを行うことが可能になる。FeRAMは、フラッシュ・メモリに比べて低電圧および省電力で動作し、高速で書き込みをすることが可能である。
【0004】
FeRAMの強誘電体膜は、チタン酸ジルコン酸鉛(PZT),LaドープPZT(PLZT)等のPZT系材料や、SrBi2Ta2O9(SBT,Y1)、SrBi2(Ta,Nb)2O9(SBTN,YZ)のようなBi層状構造化合物等で形成される。従来は、FeRAMのキャパシタ下部電極にアモルファス相の強誘電体膜を、例えばスパッタ法やゾルゲル法により形成し、その後に熱処理を行ってペロブスカイト構造に結晶化させていた。この強誘電体膜は、水素により還元しやすい性質を有し、還元されると分極特性が劣化する(すなわち、分極しなくなる又はしにくくなる)。キャパシタ構造形成後には、層間絶縁膜を成長させる工程のように水素が発生する工程があるので、水素バリアとして機能する保護膜をキャパシタ構造(特に強誘電体膜に)に作成する必要がある。保護膜としては、アルミナ膜が使用されている。アルミナ膜は、誘電率が高いこと、熱的および化学的に安定であること、界面準位密度が低いことのような望ましい様々な性質を有するからである。
【0005】
特開2001−44357号公報は、スパッタ法を利用して、階段状に形成されたキャパシタ構造全体を被覆するように、所定の膜密度を有するアルミナ膜を成膜する技術を開示している。このような手法は、0.35μmFeRAM程度のデバイスには比較的有効である。階段状に形成されたキャパシタ構造は、例えば、図1(A)に示すようなものであり、トランジスタ部(図示せず)はキャパシタ構造と並んで下地基板上に配置される。
【0006】
しかしながら、更に微細化の進んだ0.18μmFeRAMのような次世代FeRAMでは、もはや通常のスパッタ法によりアルミナ膜を成膜することは適切ではなくなる。というのは、この程度の微細な寸法になると、キャパシタ構造は、上記の階段状構造とは異なり、例えばキャパシタ構造が一括してエッチングされ、更にスタック・キャパシタ構造(キャパシタ構造がトランジスタ部(図示せず)の上部に位置し、両者がプラグ電極により垂直方向に接続される構造)が採用され得る(図1(B))。このため、アスペクト比が従来より大きくなり、通常のスパッタ法によるアルミナ膜では、充分なカバレッジが得られなくなることが懸念されるからである。例えば、キャパシタ構造の側面に、充分な厚みの保護膜が形成されないことが懸念される。
【0007】
スパッタ法ではなく、CVD法によりアルミナ膜を成膜することも考えられる。CVD法で行う場合は、有機金属を用いたCVDにより、トリメチル・アルミニウム(TMA: Tri−Methyl Aluminum, Al(CH3)3)と水(H2O)を利用するのが一般的である。この手法は、基板表面に水(水蒸気)を吸着させ、真空排気して余分な水を除去する(パージ)。そして、TMAを導入し、基板に吸着している水酸基(OH)群とTMAを反応させ、余分なTMAを除去する。この一連の工程を繰り返すことにより、所望の厚さのアルミナ膜が得られる。この手法によれば、原子層堆積法(ALD: Atomic Layer Deposition)と呼ばれる方法により原子層レベルで堆積するので、スパッタ法で問題となるカバレッジの問題点を克服することが可能である。
【発明が解決しようとする課題】
しかしながら、本願発明者は、FeRAMのアルミナ保護膜を成膜するためにTMAおよび水を利用すると、強誘電体膜の特性(特に、分極特性)が劣化し得ることを発見した。その理由としては、アルミナ保護膜を成膜する際に、大量の水を使用することから、PZTのような強誘電体膜へ水素(H)が吸着され、または、アルミナ保護膜中に水素が残留し、以後に行われる熱処理工程等によって強誘電体膜の還元作用を引き起こすことが考えられる。また、TMAの発火性は非常に高いので、周囲の空気に僅かでも触れると爆発的な燃焼を起こしてしまう。このような危険なTMAは、安全性が求められる量産性の観点からは不利である。したがって、TMAを利用してアルミナ保護膜を成膜するのは必ずしも適切ではない。
【0008】
本願の一般的課題は、微細化の進んだFeRAM構造に対しても良好なアルミナ保護膜を形成することが可能な強誘電体メモリの製造方法を提供することである。
【0009】
本願の具体的課題は、FeRAM用の強誘電体の分極特性を劣化させない成膜を可能にするアルミナ保護膜の成膜方法を提供することである。
【0010】
本願の具体的課題は、安全な成膜を可能にするアルミナ保護膜の成膜方法を提供することである。
【0011】
【課題を解決するための手段】
本発明による解決手段によれば、
強誘電体メモリの製造方法であって、前記強誘電体メモリ用のキャパシタ構造を作成する工程と、前記保護膜を成膜する工程より成り、
前記キャパシタ構造を作成する工程が、半導体基板に下部電極膜を形成する工程と、前記下部電極に強誘電体膜を形成する工程と、前記強誘電体膜に上部電極膜を形成する工程より成り、
前記保護膜を成膜する工程が、
プラズマCVDを行うための反応炉に、前記キャパシタ構造を含む成膜対象物を導入し、所定の温度に加熱する昇温工程と、
低出力のプラズマ電力条件の下に、アルミニウム・アルコキシドより成るアルミナ原料と酸素とを前記反応炉に導入する堆積工程と、
高出力のプラズマ電力条件の下に、前記反応炉に前記アルミナ原料を導入することなしに、酸素を導入する酸化工程
より成り、前記堆積工程および前記酸化工程を複数回繰り返すことによって、所望の厚さの保護膜が前記成膜対象物に形成されることを特徴とする強誘電体メモリの製造方法が提供される。
【0012】
【発明の実施の形態】
(FeRAMの製造)
図2は、強誘電体メモリを形成するための製造工程の一部を示す。図2(A)に示されるように、半導体基板10にMOSトランジスタ20を作成する。MOSトランジスタ20は、既存の半導体プロセスを利用して作成される。一例を概説すると、半導体基板10にフィールド酸化膜により素子形成領域を規定する。この素子形成領域にゲート電極を形成し、ゲート電極をマスクとしてソースおよびドレイン領域を形成し、全面を酸化膜で被覆する。更に、層間絶縁膜22を堆積してその上面をエッチングして平坦化する。電極を取り出す箇所には、コンタクト・ホールが形成される。コンタクト・ホールの内側には密着層として機能するグルー膜(TiN(50nm)/Ti(30nm))が形成される。その後にタングステン(W)をCVDにより充填することによって、第1プラグ30を形成する。
【0013】
図2(B)に示す段階では、層間絶縁膜22および第1プラグ30上に下部電極膜40、強誘電体膜50および上部電極膜60が順に堆積される。
【0014】
下部電極膜40は、例えばイリジウム(Ir)より成り、スパッタ法により以下の条件で成膜され得る:
膜厚: 200nm
アルゴン・ガス圧: 0.11Pa
DC電力: 0.5kW
成膜時間: 335秒
成膜温度: 500℃
強誘電体膜50は、例えばPZTより成り、MOCVD法により以下の条件で成膜され得る:
膜厚: 120nm
成膜圧力: 5Torr
成膜時間: 420秒
成膜温度: 580℃
MOCVD法では、気相成長により成膜を行うので、強誘電体膜を形成する鉛(Pb),ジルコニウム(Zr),チタニウム(Ti)等の固体原料は、有機溶媒中に溶解させられており、この溶液を気化させることにより原料ガスを形成する。原料ガスは、反応炉に導入されて例えばPZT膜が形成される。原料や供給量は例えば次のような条件で供給することが可能である:
有機溶媒: THF(TetraHydroFuran: C4H8O)
有機溶媒の流量: 0.474ml/min
Pb(DPM)2: 0.326ml/min
Zr(dmhd)4: 0.200ml/min
Ti(O−iPr)2(DPM)2: 0.200ml/min
(いずれもTHF中に濃度0.3mol/lで溶解している)
上部電極60は、例えば酸化イリジウム(IrO2)より、スパッタ法により以下の条件で成膜され得る:
膜厚: 200nm
アルゴン・ガス流量: 100sccm
酸素ガス流量: 100sccm
DC電力: 0.5kW
成膜時間: 79秒
ここで、上部電極としてプラチナ(Pt)を使用せずに、酸化イリジウム(IrO2)を使用したのは、主に水素劣化耐性を向上させるためである。Pt電極の場合、これは、水素分子に対して触媒作用があるため、水素ラジカルを発生し、PZT膜を還元しやすい(分極特性を劣化させやすい)。これに対して、IrO2電極にはそのような触媒作用はないので、Pt電極の場合よりもPZT膜50の水素劣化耐性が向上する。
【0015】
上部電極60をスパッタ法で成膜した後に、スパッタリングにより強誘電体膜50に与えたダメージ(特に、酸素の抜け落ち)を回復するための回復アニールを行う。これは、例えば、ファーネス(電気炉)で650℃の下に酸素を60分間供給することにより行われる。
【0016】
図2(C)に示す段階では、パターニングおよびエッチングにより、スタック構造の強誘電体キャパシタ構造を形成する。ここでは、プラズマTEOS/TiNをハードマスクとして、上部電極膜60,強誘電体膜50および下部電極膜40の3層を一括してエッチングしている。
【0017】
図3(A)に示す段階では、キャパシタ構造にアルミナ保護膜70が50nmの厚さに成膜される。成膜方法については後述する。アルミナ保護膜70を堆積した後に、酸素を供給しつつ650℃のファーネス・アニールを60分間行う。そして、層間絶縁膜80を堆積して、化学機械研磨(CMP: Chemical Mechanical Polishing)により平坦化を行う。研磨後の残し膜厚は、例えば強誘電体キャパシタの上部電極膜60上300nmである。
【0018】
図3(B)に示す段階では、層間絶縁膜80をパターニングおよびエッチングして、タングステンより成る第1プラグ30に接続するためのコンタクト・ホールを形成する。コンタクト・ホールの内側には、例えば50nmの窒化チタニウム(TiN)より成るグルー膜が形成され、タングステンが充填されて、上面を化学機械研磨(CMP)により研磨することにより、第2プラグ90が形成される。研磨後には、350℃で120秒間窒素プラズマと反応させる。
【0019】
図3(C)に示す段階では、例えばSION(100nm)のタングステンの酸化防止膜を成膜する。層間絶縁膜80に対してパターニングおよびエッチングを行って強誘電体キャパシタ構造の上部電極膜60に対するコンタクト・ホール94を形成する。そして、550℃で酸素を導入しつつファーネス・アニールを60分間行うことによって、回復アニールを行う。その後に、タングステンの酸化防止膜をエッチバックする。
【0020】
次に、上部電極膜60および第2プラグ90に対するメタル配線92を形成する。本実施例では、メタル配線92は、TiN(70nm)/Ti(5nm)/Al−Cu(400nm)/TiN(30nm)/Ti(60nm)より成る。また、反射防止膜としてSION(30nm)を使用する。以後、図示してはいないが、2層目以降のメタル配線と配線間のコンタクト・プラグを形成し、最後にTEOSとSINにより成るカバー膜を形成する。こうして、強誘電体キャパシタ構造を有するFeRAMが形成される。
【0021】
メタル配線92から基板への電気的接続は、第2プラグ90と以前に形成した第1プラグ30とを結合することにより、ビア・トゥ・ビア(via−to−via)コンタクトで実現することが可能になる。通常の半導体デバイスと比較して、FeRAMは強誘電体キャパシタ構造の分だけ余分に段差を有するので、メタル配線92から基板へのコンタクトのアスペクトが大きくなる。この大きなアスペクトに対して1回のエッチングでコンタクトを形成しようとすると、エッチング自体が困難であることに加えて、グルー膜の埋め込みも困難になり得る。本実施例のようにビア・トゥ・ビア・コンタクトを形成すると、そのような問題を回避することが可能になる。
【0022】
(アルミナ保護膜の成膜)
以下、図3(A)で言及したアルミナ保護膜70を形成する手法について説明する。アルミナ保護膜70は、ヘリコン波プラズマを利用するCVD装置を利用して成膜される。
【0023】
図4は、そのようなCVD装置100の概略断面図を示す。CVD装置100は、ベルジャ102より成るヘリコン波プラズマ発生源104と、ヘリコン波プラズマ発生源104に結合された反応炉106と、反応炉106に成膜原料を供給する原料供給部108を有する。
【0024】
ヘリコン波プラズマ発生源104は、例えば石英より成るドーム状のベルジャ102を有し、ベルジャ102の周りには、ヘリコン波プラズマ電源109に結合されたヘリコン波アンテナ110が設けられる。更に、ベルジャ102は、ソレノイド・コイル113により包囲され、このソレノイド・コイル113は、ヘリコン波の伝搬に寄与する内周コイルと、生成したプラズマの輸送に寄与する外周コイルより成る。ヘリコン波プラズマ発生源104には、ベルジャ102内でプラズマを生成するための電気的条件を調整するマッチング・ボックス116が設けられる。
【0025】
反応炉106内には、ベルジャ102と同軸状に位置付けられた基板ステージ118が設けられる。基板ステージ118には、半導体ウエハのような被処理基板(成膜対象物)が配置される。基板ステージ118には、成膜対象物を昇温させるためのヒータ、温度検出器も設けられている(図示せず)。成膜対象物は、ゲート・バルブ122を通じてロード・ロック室124から搬入され又はそこへ搬出される。更に、反応炉106には、ゲート・バルブ126を通じて内部のガスを排気するためのターボ分子ポンプ128が結合される。
【0026】
原料供給部108には、アルミニウム・アルコキシドのような成膜原料の入ったボトル容器130が設けられている。ボトル容器130は、恒温槽132内に配置され、一定の温度や蒸気圧が得られるように加温される。ボトル容器130内の原料は、気化された後に、原料ガス導入ライン134および第1ガス導入部136を通じて反応炉106に導入される。この場合において、原料ガス導入ライン134は、ガスの搬送途中でガスが液化しないようにヒータ138により加温される。ボトル容器130には、一部分のみが図示されているキャリア・ガス導入ライン140も設けられており、必要に応じてボトル容器130内の圧力を調整する。キャリア・ガスとしては例えばアルゴン・ガスが使用される。
【0027】
原料ガス導入ライン134により搬送される原料ガスは、ベント・ライン機構(図示せず)により、第1ガス導入部136を通じて反応炉に導入されるか、又は反応炉106に導入されずに排気系へ破棄される。破棄する場合にも原料ガスを供給し続けるのは、原料ガスの流量を安定化させるためである。酸素ボンベ142からの酸素は、酸素導入ライン144および第2ガス導入部146を通じて反応炉106に導入される。
【0028】
このように構成されたCVD装置のヘリコン波プラズマ発生源104は、ヘリコン波アンテナ110とソレノイド・コイル113によりヘリコン波(ホイスラー波)を発生し、1011〜1013/cm3もの高密度プラズマを生成することが可能である。しかも、広範囲なRF電力(印可する電力)にわたって高密度プラズマを生成することが可能である。一般的なプラズマ発生源である平行平板型プラズマ装置のプラズマ密度は109/cm3程度であり、CVD装置100は、2〜4桁も大きなプラズマ密度を得ることが可能である。この高密度プラズマはソレノイド・コイル113の作る磁場に沿って伝播し、被処理基板120上に高密度の反応種をイオン衝撃を伴って供給する。このため、被処理基板では、高温CVDに比較して、有機成分が高効率に分解除去される。
【0029】
図5は、本願第1実施例により、図4に示すCVD装置100を利用して、アルミナ膜(Al2O3)を成膜するためのフローチャート200を示す。工程202において、ロード・ロック室124から搬入されたシリコン基板(被処理基板)120を基板ステージ118に設置する。成膜原料としては、常温で液体であるアルミニウム・トリ・セカンダリ・ブトキシド(Al(O−sec−C4H9)3)を使用する。本実施例では、以下の諸条件で成膜を行う。
【0030】
(共通条件)
成膜原料:アルミニウム・トリ・セカンダリ・ブトキシド
ボトル容器130の温度:摂氏145度
ガス圧力:5mTorr
基板温度:摂氏320度
繰り返し回数:40回
(堆積条件)
キャリア・ガス流量:0sccm
ヘリコン波プラズマ電源出力:60W(13.56MHz)
処理時間:8秒
酸素流量:80sccm
(酸化条件)
ヘリコン波プラズマ電源出力:2000W(13.56MHz)
処理時間:15秒
酸素流量:100sccm
ここで、共通条件とは全行程に共通する条件であり、堆積条件は堆積工程に、酸化条件は酸化工程に関連する条件である。
【0031】
昇温工程204において、シリコン基板を摂氏320度のような所定の温度に加熱する。この温度は、熱CVDで使用されるような温度(例えば摂氏700度)に比べて非常に低い温度である点に留意を要する。本実施例では、約2分間かけて320℃に昇温させている。
【0032】
堆積工程206では、上記の共通条件および堆積条件に示す条件でアルミナ膜を堆積する。この工程では、プラズマ電源出力を60Wのように非常に低く設定する。第1ガス導入部136から導入したアルミニウム・トリ・セカンダリ・ブトキシドは、分子状のままシリコン基板120に降り注がれる、又は一部が縮合した2量体や3量体のような前駆体を形成して堆積種となってシリコン基板120に降り注がれる。なお、キャリア・ガス流量が0sccmとなっているが、これは、本実施例では、ボトル容器130の温度が恒温槽132により摂氏145度に設定されており、1Torr程度の蒸気圧が得られ、反応炉との差圧によって原料を供給することができるからである(原料ガス導入ライン134は、ヒータ138により摂氏170度に加熱されている。)。したがって、温度条件を変更したり、反応炉との差圧が充分でない場合は、例えば5sccm流量のアルゴン・ガスのようなキャリア・ガスが導入され得る。
【0033】
一方、第2ガス導入部146から導入される酸素は、ベルジャ102内で生成される高密度プラズマにより解離して例えば酸素ラジカルのような活性種となる。この活性種は、ソレノイド・コイル113の作る磁場に起因してシリコン基板120上に搬送される。シリコン基板120上では、この活性種と成膜原料により酸化アルミニウムが堆積されてゆく。アルミニウム・トリ・セカンダリ・ブトキシドが気相中で分解し、パーティクル(汚染粒子)となってシリコン基板に落ちてくるのを抑制する等の観点からは、例えば200W以下のようにプラズマ電力は低くすべきであり、特に60W程度にすることが望ましい。ただし、堆積膜中には、アルミナの他に、活性種と成膜原料の反応により発生した水素や炭素のような余分な成分も残存している。206の堆積工程は8秒間行われる。
【0034】
酸化工程208では、第1ガス導入部136からの原料の供給を止めるために反応炉106のバルブを閉じる一方、ベント・ライン機構により原料ガス導入ライン134からのガスを排気する。酸化工程208では、プラズマ電力は2000Wの高出力に設定される。酸素は、引き続き第2ガス導入部146から導入され、高密度プラズマにより解離して例えば酸素ラジカルのような活性種となる。供給する酸素の流量は、堆積工程における流量と同一であっても異なっていてもよく、適宜調整することが可能な値である。この活性種は、ソレノイド・コイル113の作る磁場に起因してシリコン基板120上に搬送される。プラズマ電力は高出力なので、生成される活性種の量も多くなり、堆積したアルミナ膜中の水素や炭素と反応して、CO2やH2Oを形成して気化させ、アルミナ膜の緻密化を促進する。このように、酸化による緻密化を促進する観点からは、酸化工程におけるプラズマ電力は、例えば1000W以上の高出力にすべきであり、特に2000W程度であることが望ましい。酸化工程208は15秒間行われる。
【0035】
堆積工程206および酸化工程208は、所定の回数だけ繰り返され、所望の厚さのアルミナ膜を形成する。本実施例では、これらの工程を40回繰り返すことによって50nmのアルミナ膜を成膜している。したがって、1回当たりの成膜量は、約1.25nmとなる。このような非常に薄い膜を40回作成することによって、低温かつ安全に成膜が行われることに加えて、非常に緻密なカバレッジに優れた膜を形成することが可能になる。その後に、成膜処理の施されたシリコン基板120がロード・ロック室124から取り出されて成膜処理が終了する(210)。
【0036】
図6は、本願第2実施例により、図4に示すCVD装置100を利用して、アルミナ膜(Al2O3)を成膜するためのフローチャート300を示す。工程302におけるシリコン基板120の導入およびシリコン基板の昇温工程304については、図5で説明した工程202および昇温工程204と同様である。しかし、堆積工程306および酸化工程308における諸条件は異なる。本実施例では、以下の諸条件で成膜を行う。
【0037】
(共通条件)
成膜原料:アルミニウム・トリ・イソ・プロキシド
ボトル容器130の温度:摂氏115度
ガス圧力:5mTorr
基板温度:摂氏320度
繰り返し回数:5回
(堆積条件)
キャリア・ガス流量:5sccm
ヘリコン波プラズマ電源出力:200W(13.56MHz)
処理時間:60秒
酸素流量:100sccm
(酸化条件)
ヘリコン波プラズマ電源出力:2000W(13.56MHz)
処理時間:60秒
酸素流量:100sccm
第1実施例とは異なり、第2実施例では、成膜原料として、常温で固体のアルミニウム・トリ・イソ・プロキシド(Al(O−i−C3H7)3)を使用する。すなわち、この原料をボトル容器130内で昇華させることによって、原料ガスを形成する。この原料を利用すると、第1実施例で使用した原料よりも水素や炭素が少なくなるので(Al当たりのC,H数がより小さい)、アルミナ膜中の水酸基(OH)が減少傾向になる点で有利である。また、固体原料は、液体原料よりも多くの原料ガスを供給することが可能である。例えば、ボトル容器130の温度が同一ならば、液体原料よりも固体原料の方が多くの流量の原料ガスを供給することが可能である。したがって、成膜工程を速やかに行う観点からは、固体原料を使用することが好ましい。これに対して、液体原料は、固体原料に比べて流量や残量の制御が容易であるという利点がある。
【0038】
第1実施例も第2実施例も形成するアルミナ膜の厚さは50nmである。第2実施例では、堆積工程および酸化工程の繰り返し数は5回に過ぎないが、堆積時間は60秒と長く、1回当たりの成膜量も10nmとなり、第1実施例に比べて一度に厚く形成している。このように一度に厚く形成しても安全にかつ低温で成膜することも可能であるが、膜の緻密さを向上させる観点からは第1実施例のように薄く形成するサイクルを多数回行うことが好ましい。
【0039】
(評価)
本願発明者は、本発明の基礎となる研究において、アルミナ保護膜に含まれる水素の強誘電体膜への影響を評価した。強誘電体キャパシタ構造を作成し、図7に列挙する各種の条件で50nmのアルミナ保護膜を形成する。そして、650℃の熱処理を60分間行い、アルミナ保護膜中の水素(H)を保護膜外へ拡散させた。Hは、気相中にも拡散するが、強誘電体膜中へも拡散するので、水素に起因する還元作用により分極の劣化が生じる。その後に、全面的にエッチングを行って、強誘電体特性がどのように変化しているかを評価した。キャパシタ構造は、具体的には、175nm/20nmの膜厚でPt/Tiの下部電極を、200nmの膜厚でPLZTの強誘電体膜を、200nmの膜厚でIrO2の上部電極を順にスパッタ法で堆積することにより形成される。そして、上部電極を50×50μm角に加工し、PLZT膜にもエッチングを行った。
【0040】
図7は、最左列に示すようなAないしJの10種類のテスト・サンプルについての成膜条件を示す。この図表の左から2列目は、スパッタにより成膜されることを示し、この条件に従うのは、サンプルJのみである(このサンプルは、従来の手法による保護膜に相当する。)。他のサンプルは、本願実施例のようにヘリコン波プラズマを用いたCVDにより成膜される。3列目および4列目は、堆積工程における基板温度およびキャリア・ガス流量を示す。左から5列目および6列目(最右列)は、酸化工程における酸化時間およびプラズマ電力を示す。他の成膜条件については、サンプルIを除く全テスト・サンプルA〜Jに共通し、それは例えば、最終的な成膜厚さが50nmであること、堆積及び酸化の繰り返し数が5回であること、堆積工程でのプラズマ電力が200Wであること、成膜原料が常温で固体のアルミニウム・トリ・イソ・プロキシドであること等である。
【0041】
図8は、これらのテスト・サンプルA〜Jについて、キャパシタ電極間に3ボルトの電圧を印加する場合のスイッチング電荷量(μC/cm2)を箱ヒゲ図で示したものである。このスイッチング電荷量は、分極の大きさ(ヒステリシスの高さ)を示す。すなわち、650℃の熱処理で拡散した水素に起因して、強誘電体が還元されて劣化すると、測定されるスイッチング電荷量も小さくなる。望ましいことは、中央値が大きく、ばらつきは小さいことである。図から明らかなように、サンプルBの中央値は、他のサンプルに比較して低い。したがって、酸化時間は30秒では足りず、それ以上(例えば60秒)必要であることが判明する。また、サンプルDは、最大値と最小値との間のばらつきが大きい点で好ましくないので、1000Wより大きい(例えば、2000Wの)プラズマ電力とすべきことが判明する。このように、各種の成膜条件を変更することによって最適化を図ることが可能である。この例では、堆積および酸化工程の繰り返し数が5回であるが、繰り返し数を変更して評価することも可能である。
【0042】
次に、本願発明者によりなされたアルミナ膜の評価について説明する。まず、アルミナ膜の緻密さを評価するため、XRR(X線反射率膜厚測定)法を利用して、アルミナ膜の密度を測定した。アルミナ膜は、上記のヘリコン波プラズマCVD装置を用いてシリコン基板上に50nm成膜されたものを使用する。
【0043】
図9は、堆積工程におけるプラズマ電力に対するアルミナ膜密度の関係を示す。グラフ402は、堆積工程と酸化工程を5回繰り返すことによって50nmのアルミナ膜を成膜した場合に対応する。図示されるように、プラズマ電力とアルミナ膜密度は比例関係にある。したがって、プラズマ電力の大小に応じて膜密度も大きくなったり小さくなったりする。堆積工程におけるパーティクル粒子を抑制する観点からは、プラズマ電力は低いことが好ましい。ただし、プラズマの安定化の観点からはある程度の大きさのプラズマ電力を要する。一方、プラズマ電力を固定して、繰り返し数を変化させると、15回の場合は座標404に、30回の場合は座標406に示されるような値の膜密度が得られる。すなわち、繰り返し数を増やすと膜密度も増加する。以上の結果から、パーティクルの発生を抑制しつつ緻密さを向上させるには、例えば200以下のような低いプラズマ電力(特に60W程度)で繰り返し数を増加させることが有効であることが分かる。
【0044】
図10は、酸化工程における酸化時間と膜密度の関係を示す。この関係を調べることにより、酸化に要する最小時間を見出すことが可能になる。評価の対象は、シリコン基板上に50nmの厚さに成膜されたアルミナ膜である。また、酸化に先立つ堆積工程におけるプラズマ電力は60Wである。15秒以上の酸化に対する膜密度が変化していないことから、15秒程度で飽和していることが分かる。また、繰り返し数を30回としても35回としてもグラフに変化がないので、繰り返し数も30回程度で飽和していることがわかる。このような飽和を考慮すると、1回当たりの成膜量は、50/30=1.67nmとなり、およそ2nm以下であるといえる。
【0045】
以上本願実施例によれば、微細化の進んだFeRAM構造に対しても、ステップ・カバレッジの良好なアルミナ保護膜を形成することが可能になる。具体的には、FeRAM用の強誘電体の分極特性の劣化を抑制した成膜を行うことが可能になる。すなわち、高いスイッチング電荷量を維持しつつアルミナ保護膜を成膜することが可能になる。また、TMAのような危険な原料を使用せずに、安全なアルミニウム・アルコキシドを使用するので、安全に成膜することが可能になる。
【0046】
本願実施例によれば、成膜されるアルミナ保護膜の良好なカバレッジ特性に起因して、一括エッチングされたキャパシタ構造にも良好に成膜することが可能になる。
【0047】
本願実施例によれば、ヘリコン波プラズマを利用するので、高出力および低出力のプラズマを良好に生成することが可能になる。
【0048】
本願実施例によれば、アルミニウム・トリ・セカンダリ・ブトキシド(Al(O−sec−C4H9)3)のような液体原料を利用するので、例えば原料の供給量を正確に制御することが可能になる。
【0049】
本願実施例によれば、アルミニウム・トリ・イソ・プロキシド(Al(O−i−C3H7)3)のような固体材料を利用するとので、例えば速やかに原料を供給することにより成膜速度を向上させることが可能になる。
【0050】
以上本発明を特定の実施例に関連して説明してきたが、本発明はそれらに限定されない。例えば、下部電極としてIrの代わりにPt/Ti積層構造を利用することも可能である。また、強誘電体材料としてPZT,PLZTの代わりに、SBT,SBTNを使用することも可能である。更に、強誘電体膜をMOCVDで成膜する代わりに、ゾルゲル法、スパッタ法を使用することも可能である。
【0051】
以下、本発明により教示される手段を列挙する。
【0052】
(付記1) 強誘電体メモリの製造方法であって、前記強誘電体メモリ用のキャパシタ構造を作成する工程と、前記保護膜を成膜する工程より成り、
前記キャパシタ構造を作成する工程が、半導体基板に下部電極膜を形成する工程と、前記下部電極に強誘電体膜を形成する工程と、前記強誘電体膜に上部電極膜を形成する工程より成り、
前記保護膜を成膜する工程が、
プラズマCVDを行うための反応炉に、前記キャパシタ構造を含む成膜対象物を導入し、所定の温度に加熱する昇温工程と、
低出力のプラズマ電力条件の下に、アルミニウム・アルコキシドより成るアルミナ原料と酸素とを前記反応炉に導入する堆積工程と、
高出力のプラズマ電力条件の下に、前記反応炉に前記アルミナ原料を導入することなしに、酸素を導入する酸化工程
より成り、前記堆積工程および前記酸化工程を複数回繰り返すことによって、所望の厚さの保護膜が前記成膜対象物に形成されることを特徴とする強誘電体メモリの製造方法。
【0053】
(付記2) 付記1記載の製造方法において、前記キャパシタ構造を作成する工程が、更に、前記上部電極膜、前記強誘電体膜および前記下部電極膜を一括してエッチングする工程より成ることを特徴とする製造方法。
【0054】
(付記3) 付記1記載の製造方法において、複数回繰り返す前記堆積工程および前記酸化工程の1回当たりの成膜量が、2nm以下であることを特徴とする製造方法。
【0055】
(付記4) 付記1記載の製造方法において、使用するプラズマが、ヘリコン波プラズマであることを特徴とする製造方法。
【0056】
(付記5) 付記1記載の製造方法において、前記アルミナ原料が、アルミニウム・トリ・セカンダリ・ブトキシド(Al(O−sec−C4H9)3)より成ることを特徴とする製造方法。
【0057】
(付記6) 付記1記載の製造方法において、前記アルミナ原料が、アルミニウム・トリ・イソ・プロキシド(Al(O−i−C3H7)3)より成ることを特徴とする製造方法。
【0058】
(付記7) 付記1記載の製造方法において、前記強誘電体膜が、PZT,PLZT,SBTおよびSBTNより成る群から選択された物質より成るより成ることを特徴とする製造方法。
【0059】
(付記8) 付記1記載の製造方法において、前記下部電極が、Pt/Ti積層構造より成ることを特徴とする製造方法。
【0060】
【発明の効果】
以上のように本発明によれば、微細化の進んだFeRAM構造に対しても良好なアルミナ保護膜を形成することが可能になる。
【0061】
【図面の簡単な説明】
【図1】図1は、強誘電体キャパシタ構造の概略図を示す。
【図2】図2は、強誘電体メモリの製造工程を示す図(その1)である。
【図3】図3は、強誘電体メモリの製造工程を示す図(その2)である。
【図4】図4は、本願実施例で使用するヘリコン波プラズマCVD装置の概略図を示す。
【図5】図5は、本願実施例によるアルミナ保護膜の成膜を行うためのフローチャートを示す。
【図6】図6は、本願実施例によるアルミナ保護膜の成膜を行うための他のフローチャートを示す。
【図7】図7は、アルミナ保護膜の成膜条件を示す図表である。
【図8】図8は、各サンプルに対するスイッチング電荷量を示す図である。
【図9】図9は、堆積工程におけるプラズマ電力とアルミナ膜密度の関係を表すグラフを示す。
【図10】図10は、酸化時間とアルミナ膜密度の関係を表すグラフを示す。
【符号の説明】
10 半導体基板
20 MOSトランジスタ
22 層間絶縁膜
30 第1プラグ
40 下部電極
50 強誘電体
60 上部電極
70 アルミナ保護膜
80 層間絶縁膜
90 第2プラグ
92 メタル配線
94 コンタクト・ホール
100 CVD装置
102 ベルジャ
104 ヘリコン波プラズマ発生源
106 反応炉
108 原料供給部
110 ヘリコン波アンテナ
113 ソレノイド・コイル
116 マッチング・ボックス
118 基板ステージ
120 被処理基板
122 ゲート・バルブ
124 ロード・ロック室
126 ゲート・バルブ
128 ターボ分子ポンプ
130 ボトル容器
132 恒温槽
134 原料ガス導入ライン
136 第1ガス導入部
138 ヒータ
140 キャリア・ガス導入ライン
142 酸素ボンベ
144 酸素導入ライン
146 第2ガス導入部[0001]
TECHNICAL FIELD OF THE INVENTION
The present invention generally relates to the technical field of semiconductor memories, and more particularly, to a method of manufacturing a ferroelectric memory (Ferro-Electrical Random Access Memory).
[0002]
[Prior art]
As nonvolatile memories in this type of technical field, flash memories and FeRAMs are known. A flash memory has a floating gate embedded in a gate insulating film of an insulated gate field effect transistor (IGFET: Insulated Gate Field Effect Transistor), and stores information by accumulating charges in the floating gate. Remember. A flash memory has a cell configuration similar to that of a dynamic random access memory (DRAM), and thus is advantageous for large-scale integration.
[0003]
The FeRAM stores information using the polarization hysteresis characteristics of a ferroelectric. The ferroelectric film provided between the capacitor electrodes of the FeRAM generates polarization according to the voltage applied between the electrodes, and maintains spontaneous polarization even when the applied voltage is removed. When the polarity of the applied voltage is reversed, the polarity of the spontaneous polarization is also reversed. By detecting the direction of the spontaneous polarization, it becomes possible to read and write information. FeRAM operates at a lower voltage and consumes less power than a flash memory, and can write at high speed.
[0004]
The ferroelectric film of FeRAM is made of a PZT-based material such as lead zirconate titanate (PZT), La-doped PZT (PLZT), or SrBi. 2 Ta 2 O 9 (SBT, Y1), SrBi 2 (Ta, Nb) 2 O 9 It is formed of a Bi layer structure compound such as (SBTN, YZ). Conventionally, an amorphous ferroelectric film was formed on the lower electrode of a capacitor of FeRAM by, for example, a sputtering method or a sol-gel method, and then heat-treated to crystallize into a perovskite structure. This ferroelectric film has a property of being easily reduced by hydrogen, and when it is reduced, its polarization characteristics are deteriorated (that is, it is difficult or difficult to polarize). After the formation of the capacitor structure, there is a step of generating hydrogen as in the step of growing the interlayer insulating film. Therefore, it is necessary to form a protective film functioning as a hydrogen barrier on the capacitor structure (particularly on the ferroelectric film). An alumina film is used as the protective film. This is because the alumina film has various desirable properties such as a high dielectric constant, thermal and chemical stability, and a low interface state density.
[0005]
Japanese Patent Application Laid-Open No. 2001-44357 discloses a technique of forming an alumina film having a predetermined film density by using a sputtering method so as to cover the entire capacitor structure formed stepwise. Such a method is relatively effective for a device of about 0.35 μm FeRAM. The capacitor structure formed in a step shape is, for example, as shown in FIG. 1A, and a transistor portion (not shown) is arranged on a base substrate along with the capacitor structure.
[0006]
However, in a next-generation FeRAM such as a 0.18 μm FeRAM with further miniaturization, it is no longer appropriate to form an alumina film by a normal sputtering method. This is because, at such a fine dimension, the capacitor structure is different from the above-mentioned step-like structure, for example, the capacitor structure is etched at a time, and the stacked capacitor structure (the capacitor structure is replaced with a transistor portion (shown in FIG. 1)). (FIG. 1B), which is located at the upper part of FIG. For this reason, the aspect ratio becomes larger than before, and there is a concern that sufficient coverage cannot be obtained with an alumina film formed by a normal sputtering method. For example, there is a concern that a protective film having a sufficient thickness is not formed on the side surface of the capacitor structure.
[0007]
An alumina film may be formed by a CVD method instead of the sputtering method. In the case of performing the CVD method, trimethyl aluminum (TMA: Tri-methyl aluminum, Al (CH) is formed by CVD using an organic metal. 3 ) 3 ) And water (H 2 O) is generally used. In this method, water (steam) is adsorbed on the substrate surface, and vacuum evacuation is performed to remove excess water (purge). Then, TMA is introduced, and a hydroxyl group (OH) group adsorbed on the substrate is reacted with TMA to remove excess TMA. By repeating this series of steps, an alumina film having a desired thickness can be obtained. According to this method, since the deposition is performed at an atomic layer level by a method called an atomic layer deposition method (ALD: Atomic Layer Deposition), it is possible to overcome the problem of the coverage which is a problem in the sputtering method.
[Problems to be solved by the invention]
However, the present inventor has discovered that the use of TMA and water to form an alumina protective film of FeRAM can degrade the characteristics (particularly, polarization characteristics) of the ferroelectric film. The reason is that a large amount of water is used when forming the alumina protective film, so that hydrogen (H) is adsorbed on a ferroelectric film such as PZT, or hydrogen is contained in the alumina protective film. It is conceivable that the ferroelectric film remains and causes a reducing action of the ferroelectric film by a heat treatment step or the like performed later. Further, since the ignitability of TMA is very high, even slight contact with the surrounding air causes explosive combustion. Such dangerous TMA is disadvantageous from the viewpoint of mass productivity where safety is required. Therefore, it is not always appropriate to form an alumina protective film using TMA.
[0008]
A general object of the present application is to provide a method of manufacturing a ferroelectric memory capable of forming a good alumina protective film even on an FeRAM structure with a finer structure.
[0009]
A specific object of the present application is to provide a method for forming an alumina protective film that enables film formation without deteriorating the polarization characteristics of a ferroelectric substance for FeRAM.
[0010]
A specific object of the present application is to provide a method for forming an alumina protective film that enables safe film formation.
[0011]
[Means for Solving the Problems]
According to the solution according to the invention,
A method of manufacturing a ferroelectric memory, comprising: a step of forming a capacitor structure for the ferroelectric memory; and a step of forming the protective film,
The step of forming the capacitor structure includes a step of forming a lower electrode film on a semiconductor substrate, a step of forming a ferroelectric film on the lower electrode, and a step of forming an upper electrode film on the ferroelectric film. ,
The step of forming the protective film,
A temperature increasing step of introducing a film formation target including the capacitor structure into a reaction furnace for performing plasma CVD, and heating the film formation target to a predetermined temperature;
A deposition step of introducing an alumina raw material comprising aluminum alkoxide and oxygen into the reactor under low-power plasma power conditions;
An oxidation step of introducing oxygen under high-power plasma power conditions without introducing the alumina raw material into the reactor;
A protective film having a desired thickness is formed on the object to be formed by repeating the deposition step and the oxidation step a plurality of times. .
[0012]
BEST MODE FOR CARRYING OUT THE INVENTION
(Manufacture of FeRAM)
FIG. 2 shows a part of a manufacturing process for forming a ferroelectric memory. As shown in FIG. 2A, a
[0013]
At the stage shown in FIG. 2B, a
[0014]
The
Film thickness: 200 nm
Argon gas pressure: 0.11 Pa
DC power: 0.5kW
Film formation time: 335 seconds
Film formation temperature: 500 ° C
The
Film thickness: 120 nm
Film formation pressure: 5 Torr
Film formation time: 420 seconds
Film formation temperature: 580 ° C
In the MOCVD method, since a film is formed by vapor phase growth, solid materials such as lead (Pb), zirconium (Zr), and titanium (Ti) for forming a ferroelectric film are dissolved in an organic solvent. This solution is vaporized to form a source gas. The source gas is introduced into a reaction furnace to form, for example, a PZT film. The raw materials and the supply amount can be supplied, for example, under the following conditions:
Organic solvent: THF (Tetra HydroFuran: C 4 H 8 O)
Flow rate of organic solvent: 0.474 ml / min
Pb (DPM) 2 : 0.326ml / min
Zr (dmhd) 4 : 0.200ml / min
Ti (O-iPr) 2 (DPM) 2 : 0.200ml / min
(All are dissolved in THF at a concentration of 0.3 mol / l)
The
Film thickness: 200 nm
Argon gas flow rate: 100 sccm
Oxygen gas flow rate: 100sccm
DC power: 0.5kW
Film formation time: 79 seconds
Here, iridium oxide (IrO) was used without using platinum (Pt) as the upper electrode. 2 ) Is mainly used to improve the resistance to hydrogen degradation. In the case of a Pt electrode, since this has a catalytic action on hydrogen molecules, hydrogen radicals are generated, and the PZT film is easily reduced (polarization characteristics are easily deteriorated). In contrast, IrO 2 Since the electrode does not have such a catalytic action, the hydrogen deterioration resistance of the
[0015]
After the
[0016]
At the stage shown in FIG. 2C, a ferroelectric capacitor structure having a stack structure is formed by patterning and etching. Here, three layers of the
[0017]
At the stage shown in FIG. 3A, a 50 nm-thick alumina
[0018]
In the step shown in FIG. 3B, the
[0019]
At the stage shown in FIG. 3C, for example, a tungsten antioxidant film of SION (100 nm) is formed. By patterning and etching the
[0020]
Next, a
[0021]
Electrical connection from the
[0022]
(Formation of alumina protective film)
Hereinafter, a method of forming the alumina
[0023]
FIG. 4 is a schematic sectional view of such a
[0024]
The helicon
[0025]
A
[0026]
The raw
[0027]
The source gas conveyed by the source
[0028]
The helicon
[0029]
FIG. 5 shows an alumina film (Al film) using the
[0030]
(Common conditions)
Film forming material: aluminum tri-secondary butoxide
Temperature of bottle container 130: 145 degrees Celsius
Gas pressure: 5 mTorr
Substrate temperature: 320 degrees Celsius
Number of repetitions: 40
(Deposition conditions)
Carrier gas flow rate: 0 sccm
Helicon wave plasma power output: 60W (13.56MHz)
Processing time: 8 seconds
Oxygen flow rate: 80 sccm
(Oxidation conditions)
Helicon wave plasma power supply output: 2000W (13.56MHz)
Processing time: 15 seconds
Oxygen flow rate: 100 sccm
Here, the common condition is a condition common to all processes, the deposition condition is a condition relating to the deposition process, and the oxidation condition is a condition relating to the oxidation process.
[0031]
In the
[0032]
In the
[0033]
On the other hand, oxygen introduced from the second gas introduction unit 146 is dissociated by high-density plasma generated in the bell jar 102 and becomes an active species such as an oxygen radical. This active species is transferred onto the
[0034]
In the
[0035]
The
[0036]
FIG. 6 shows an alumina film (Al) using the
[0037]
(Common conditions)
Material for film formation: aluminum, tri, iso, proxide
Temperature of bottle container 130: 115 degrees Celsius
Gas pressure: 5 mTorr
Substrate temperature: 320 degrees Celsius
Number of repetitions: 5 times
(Deposition conditions)
Carrier gas flow rate: 5 sccm
Helicon wave plasma power output: 200W (13.56MHz)
Processing time: 60 seconds
Oxygen flow rate: 100 sccm
(Oxidation conditions)
Helicon wave plasma power supply output: 2000W (13.56MHz)
Processing time: 60 seconds
Oxygen flow rate: 100 sccm
Unlike the first embodiment, in the second embodiment, aluminum tri-isoproxide (Al (O-i-C) 3 H 7 ) 3 ). That is, the raw material gas is formed by sublimating the raw material in the
[0038]
The thickness of the alumina film formed in both the first embodiment and the second embodiment is 50 nm. In the second embodiment, the number of repetitions of the deposition step and the oxidation step is only five times, but the deposition time is as long as 60 seconds, and the film formation amount per time is 10 nm. It is formed thick. Although it is possible to form the film safely and at a low temperature even if the film is formed thick at a time in this way, from the viewpoint of improving the film density, a cycle of forming the film thin as in the first embodiment is performed many times. Is preferred.
[0039]
(Evaluation)
The inventor of the present application evaluated the effect of hydrogen contained in the alumina protective film on the ferroelectric film in the research that forms the basis of the present invention. A ferroelectric capacitor structure is formed, and a 50 nm alumina protective film is formed under various conditions listed in FIG. Then, a heat treatment at 650 ° C. was performed for 60 minutes to diffuse hydrogen (H) in the alumina protective film out of the protective film. Although H also diffuses into the gas phase, it also diffuses into the ferroelectric film, so that the reduction action caused by hydrogen causes deterioration of polarization. Thereafter, the entire surface was etched to evaluate how the ferroelectric characteristics changed. Specifically, the capacitor structure includes a Pt / Ti lower electrode with a thickness of 175 nm / 20 nm, a ferroelectric film of PLZT with a thickness of 200 nm, and an IrO film with a thickness of 200 nm. 2 Are formed in order by sequentially depositing the upper electrodes by a sputtering method. Then, the upper electrode was processed into a 50 × 50 μm square, and the PLZT film was also etched.
[0040]
FIG. 7 shows film forming conditions for ten types of test samples A to J as shown in the leftmost column. The second column from the left of this chart indicates that the film is formed by sputtering, and only the sample J complies with this condition (this sample corresponds to a protective film by a conventional method). Other samples are formed by CVD using helicon wave plasma as in the present embodiment. The third and fourth columns show the substrate temperature and the carrier gas flow rate in the deposition process. The fifth and sixth columns (rightmost column) from the left show the oxidation time and plasma power in the oxidation step. Other film forming conditions are common to all test samples A to J except sample I. For example, the final film thickness is 50 nm, and the number of times of deposition and oxidation is 5 times. That is, the plasma power in the deposition step is 200 W, and the film forming material is aluminum tri-iso-proxyd which is solid at room temperature.
[0041]
FIG. 8 shows the switching charge (μC / cm) when a voltage of 3 volts is applied between the capacitor electrodes for these test samples A to J. 2 ) Is shown in a box-whisker diagram. This switching charge amount indicates the magnitude of the polarization (the height of the hysteresis). That is, when the ferroelectric is reduced and deteriorated due to the hydrogen diffused by the heat treatment at 650 ° C., the measured switching charge is also reduced. Desirably, the median is large and the variation is small. As is clear from the figure, the median value of sample B is lower than the other samples. Therefore, it turns out that an oxidation time of 30 seconds is not enough, and a longer time (for example, 60 seconds) is required. In addition, since the sample D is not preferable because the variation between the maximum value and the minimum value is large, it is found that the plasma power should be larger than 1000 W (for example, 2000 W). Thus, optimization can be achieved by changing various film forming conditions. In this example, the number of repetitions of the deposition and oxidation steps is five, but it is also possible to change and evaluate the number of repetitions.
[0042]
Next, the evaluation of the alumina film made by the present inventors will be described. First, in order to evaluate the denseness of the alumina film, the density of the alumina film was measured by using the XRR (X-ray reflectivity film thickness measurement) method. An alumina film having a thickness of 50 nm formed on a silicon substrate by using the helicon wave plasma CVD apparatus described above is used.
[0043]
FIG. 9 shows the relationship between the plasma power and the alumina film density in the deposition process. A
[0044]
FIG. 10 shows the relationship between the oxidation time and the film density in the oxidation step. By examining this relationship, it is possible to find the minimum time required for oxidation. The evaluation target is an alumina film formed to a thickness of 50 nm on a silicon substrate. The plasma power in the deposition step prior to oxidation is 60W. Since the film density for oxidation for 15 seconds or more has not changed, it can be seen that the film is saturated in about 15 seconds. In addition, since there is no change in the graph when the number of repetitions is set to 30 or 35, it can be seen that the number of repetitions is saturated at about 30. In consideration of such saturation, the film formation amount per one time is 50/30 = 1.67 nm, which can be said to be about 2 nm or less.
[0045]
As described above, according to the embodiment of the present invention, it is possible to form an alumina protective film having good step coverage even for a finer FeRAM structure. Specifically, it is possible to perform film formation while suppressing deterioration of the polarization characteristics of the ferroelectric substance for FeRAM. That is, the alumina protective film can be formed while maintaining a high switching charge amount. Further, since a safe aluminum alkoxide is used without using a dangerous raw material such as TMA, it is possible to form a film safely.
[0046]
According to the embodiment of the present application, due to the good coverage characteristics of the alumina protective film to be formed, it is possible to form a good film even on the capacitor structure which is etched at once.
[0047]
According to the embodiment of the present application, since helicon wave plasma is used, high-output and low-output plasma can be satisfactorily generated.
[0048]
According to the embodiment of the present application, aluminum tri-secondary butoxide (Al (O-sec-C 4 H 9 ) 3 Since a liquid material such as that described in (1) is used, for example, the supply amount of the material can be accurately controlled.
[0049]
According to the embodiment of the present application, aluminum tri-isoproxide (Al (OiC) 3 H 7 ) 3 Since a solid material such as that described in (1) is used, it is possible to improve the film formation rate by, for example, quickly supplying the raw material.
[0050]
Although the present invention has been described with reference to particular embodiments, the invention is not limited thereto. For example, it is possible to use a Pt / Ti laminated structure instead of Ir as the lower electrode. Further, instead of PZT and PLZT, SBT and SBTN can be used as the ferroelectric material. Furthermore, instead of forming the ferroelectric film by MOCVD, a sol-gel method or a sputtering method can be used.
[0051]
Hereinafter, means taught by the present invention will be listed.
[0052]
(Supplementary Note 1) A method for manufacturing a ferroelectric memory, comprising: a step of forming a capacitor structure for the ferroelectric memory; and a step of forming the protective film.
The step of forming the capacitor structure includes a step of forming a lower electrode film on a semiconductor substrate, a step of forming a ferroelectric film on the lower electrode, and a step of forming an upper electrode film on the ferroelectric film. ,
The step of forming the protective film,
A temperature increasing step of introducing a film formation target including the capacitor structure into a reaction furnace for performing plasma CVD, and heating the film formation target to a predetermined temperature;
A deposition step of introducing an alumina raw material comprising aluminum alkoxide and oxygen into the reactor under low-power plasma power conditions;
An oxidation step of introducing oxygen under high-power plasma power conditions without introducing the alumina raw material into the reactor;
A method of manufacturing a ferroelectric memory, wherein a protective film having a desired thickness is formed on the object to be formed by repeating the deposition step and the oxidation step a plurality of times.
[0053]
(Supplementary Note 2) In the manufacturing method according to Supplementary Note 1, the step of forming the capacitor structure further includes a step of collectively etching the upper electrode film, the ferroelectric film, and the lower electrode film. Manufacturing method.
[0054]
(Supplementary Note 3) The method according to Supplementary Note 1, wherein a film formation amount per one time of the deposition step and the oxidation step, which is repeated a plurality of times, is 2 nm or less.
[0055]
(Supplementary Note 4) The method according to Supplementary Note 1, wherein the plasma used is helicon wave plasma.
[0056]
(Supplementary Note 5) In the production method according to Supplementary Note 1, the alumina raw material may be aluminum tri-secondary butoxide (Al (O-sec-C 4 H 9 ) 3 ).
[0057]
(Supplementary Note 6) In the production method according to Supplementary Note 1, the alumina raw material may be aluminum tri-isoproxide (Al (OiC). 3 H 7 ) 3 ).
[0058]
(Supplementary note 7) The method according to supplementary note 1, wherein the ferroelectric film is made of a material selected from the group consisting of PZT, PLZT, SBT, and SBTN.
[0059]
(Supplementary Note 8) The method according to supplementary note 1, wherein the lower electrode has a Pt / Ti laminated structure.
[0060]
【The invention's effect】
As described above, according to the present invention, it is possible to form an excellent alumina protective film even on a FeRAM structure with a finer structure.
[0061]
[Brief description of the drawings]
FIG. 1 shows a schematic diagram of a ferroelectric capacitor structure.
FIG. 2 is a diagram (part 1) illustrating a manufacturing process of the ferroelectric memory;
FIG. 3 is a diagram (part 2) illustrating a step of manufacturing the ferroelectric memory;
FIG. 4 is a schematic view of a helicon wave plasma CVD apparatus used in the embodiment of the present invention.
FIG. 5 is a flowchart for forming an alumina protective film according to the embodiment of the present invention.
FIG. 6 shows another flowchart for forming an alumina protective film according to the embodiment of the present invention.
FIG. 7 is a chart showing conditions for forming an alumina protective film.
FIG. 8 is a diagram showing a switching charge amount for each sample.
FIG. 9 is a graph showing the relationship between plasma power and alumina film density in a deposition step.
FIG. 10 is a graph showing a relationship between an oxidation time and an alumina film density.
[Explanation of symbols]
10 Semiconductor substrate
20 MOS transistors
22 Interlayer insulating film
30 first plug
40 lower electrode
50 Ferroelectric
60 upper electrode
70 Alumina protective film
80 Interlayer insulation film
90 Second plug
92 metal wiring
94 Contact Hole
100 CVD equipment
102 Belja
104 Helicon Wave Plasma Source
106 reactor
108 Raw material supply unit
110 Helicon wave antenna
113 solenoid coil
116 Matching Box
118 Substrate stage
120 Substrate to be processed
122 Gate valve
124 Road Lock Room
126 Gate valve
128 turbo molecular pump
130 bottle container
132 constant temperature bath
134 Source gas introduction line
136 First gas inlet
138 heater
140 Carrier gas introduction line
142 oxygen cylinder
144 Oxygen introduction line
146 Second gas inlet
Claims (5)
前記キャパシタ構造を作成する工程が、半導体基板に下部電極膜を形成する工程と、前記下部電極に強誘電体膜を形成する工程と、前記強誘電体膜に上部電極膜を形成する工程より成り、
前記保護膜を成膜する工程が、
プラズマCVDを行うための反応炉に、前記キャパシタ構造を含む成膜対象物を導入し、所定の温度に加熱する昇温工程と、
低出力のプラズマ電力条件の下に、アルミニウム・アルコキシドより成るアルミナ原料と酸素とを前記反応炉に導入する堆積工程と、
高出力のプラズマ電力条件の下に、前記反応炉に前記アルミナ原料を導入することなしに、酸素を導入する酸化工程
より成り、前記堆積工程および前記酸化工程を複数回繰り返すことによって、所望の厚さの保護膜が前記成膜対象物に形成されることを特徴とする強誘電体メモリの製造方法。A method of manufacturing a ferroelectric memory, comprising: a step of forming a capacitor structure for the ferroelectric memory; and a step of forming the protective film,
The step of forming the capacitor structure includes a step of forming a lower electrode film on a semiconductor substrate, a step of forming a ferroelectric film on the lower electrode, and a step of forming an upper electrode film on the ferroelectric film. ,
The step of forming the protective film,
A temperature increasing step of introducing a film formation target including the capacitor structure into a reaction furnace for performing plasma CVD, and heating the film formation target to a predetermined temperature;
A deposition step of introducing an alumina raw material comprising aluminum alkoxide and oxygen into the reactor under low-power plasma power conditions;
Under high-power plasma power conditions, without introducing the alumina raw material into the reactor, comprises an oxidation step of introducing oxygen, and by repeating the deposition step and the oxidation step a plurality of times, a desired thickness is obtained. A method of manufacturing a ferroelectric memory, characterized in that a protective film is formed on the object to be formed.
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JP2009064821A (en) * | 2007-09-04 | 2009-03-26 | Hokkaido Univ | Method and apparatus for forming insulating film on surface of semiconductor substrate |
JP2009129965A (en) * | 2007-11-20 | 2009-06-11 | Fujitsu Microelectronics Ltd | Film formation method and method for manufacturing semiconductor device |
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2002
- 2002-07-30 JP JP2002221722A patent/JP2004063891A/en not_active Withdrawn
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