FR2709007A1 - Dispositif électronique de calcul d'une transformée de Fourier et procédé pour minimiser la taille des chemins de données internes d'un tel dispositif. - Google Patents
Dispositif électronique de calcul d'une transformée de Fourier et procédé pour minimiser la taille des chemins de données internes d'un tel dispositif.Info
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Abstract
Afin de minimiser la taille des chemins de données internes d'un dispositif de calcul d'une transformée de Fourier de taille initiale prédéterminée, à architecture dite série ou "pipelinée" dans lequel on effectue au sein du dispositif une succession de traitements élémentaires de transformée de Fourier de tailles élémentaires prédéterminé, de plus petites que la taille initiale, sur des blocs de données de taille successivement réduite d'un traitement élémentaire au suivant, on détermine une valeur de dynamique globale (E1... E20) pour chaque bloc de données issu d'un traitement élémentaire courant (ET1), à partir des valeurs de dynamique de toutes les données du bloc, et on recadre (DL2) les données du bloc, compte tenu de ladite valeur de dynamique globale, avant d'effectuer complètement le traitement élémentaire suivant (ET2) sur ces données.
Priority Applications (5)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
FR9309865A FR2709007B1 (fr) | 1993-08-11 | 1993-08-11 | Dispositif électronique de calcul d'une transformée de Fourier et procédé pour minimiser la taille des chemins de données internes d'un tel dispositif. |
PCT/FR1994/000996 WO1995004963A1 (fr) | 1993-08-11 | 1994-08-10 | Dispositif electronique de calcul d'une transformee de fourier et procede pour minimiser la taille des chemins de donnees internes d'un tel dispositif |
US08/416,907 US5774388A (en) | 1993-08-11 | 1994-08-10 | Device for electronically calculating a fourier transform and method of minimizing the size of internal data paths within such a device |
EP94924344A EP0667969A1 (fr) | 1993-08-11 | 1994-08-10 | Dispositif electronique de calcul d'une transformee de fourier et procede pour minimiser la taille des chemins de donnees internes d'un tel dispositif |
JP7506262A JPH08503322A (ja) | 1993-08-11 | 1994-08-10 | フーリエ変換を電子工学的に計算するデバイスおよびそのようなデバイス内の内部データパスのサイズを最小化する方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
FR9309865A FR2709007B1 (fr) | 1993-08-11 | 1993-08-11 | Dispositif électronique de calcul d'une transformée de Fourier et procédé pour minimiser la taille des chemins de données internes d'un tel dispositif. |
Publications (2)
Publication Number | Publication Date |
---|---|
FR2709007A1 true FR2709007A1 (fr) | 1995-02-17 |
FR2709007B1 FR2709007B1 (fr) | 1995-09-29 |
Family
ID=9450119
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
FR9309865A Expired - Fee Related FR2709007B1 (fr) | 1993-08-11 | 1993-08-11 | Dispositif électronique de calcul d'une transformée de Fourier et procédé pour minimiser la taille des chemins de données internes d'un tel dispositif. |
Country Status (5)
Country | Link |
---|---|
US (1) | US5774388A (fr) |
EP (1) | EP0667969A1 (fr) |
JP (1) | JPH08503322A (fr) |
FR (1) | FR2709007B1 (fr) |
WO (1) | WO1995004963A1 (fr) |
Families Citing this family (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3665423B2 (ja) * | 1995-08-28 | 2005-06-29 | セイコーエプソン株式会社 | 高速フーリエ変換演算器及び高速フーリエ変換演算装置 |
JP3938238B2 (ja) | 1997-02-04 | 2007-06-27 | 沖電気工業株式会社 | 高速フーリエ変換処理装置 |
DE10062759A1 (de) * | 2000-12-13 | 2002-08-29 | Ihp Gmbh | Verfahren und Schaltungsanordnung zur Durchführung einer Fast Fourier Transformation sowie Anwendung derselben |
WO2003009081A2 (fr) * | 2001-07-17 | 2003-01-30 | Koninklijke Philips Electronics N.V. | Demodulateur numerique pour recepteur terrestre |
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CA2377623C (fr) | 2002-03-20 | 2008-04-22 | Dongxing Jin | Methode et appareil de reduction par calcul en vue de la detection de tonalites |
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Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
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US3783258A (en) * | 1971-11-03 | 1974-01-01 | Us Navy | Fft processor utilizing variable length shift registers |
US3892956A (en) * | 1971-12-27 | 1975-07-01 | Bell Telephone Labor Inc | Cascade digital fast fourier analyzer |
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-
1993
- 1993-08-11 FR FR9309865A patent/FR2709007B1/fr not_active Expired - Fee Related
-
1994
- 1994-08-10 US US08/416,907 patent/US5774388A/en not_active Expired - Fee Related
- 1994-08-10 JP JP7506262A patent/JPH08503322A/ja active Pending
- 1994-08-10 EP EP94924344A patent/EP0667969A1/fr not_active Withdrawn
- 1994-08-10 WO PCT/FR1994/000996 patent/WO1995004963A1/fr not_active Application Discontinuation
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3746848A (en) * | 1971-12-27 | 1973-07-17 | Bell Telephone Labor Inc | Fft process and apparatus having equal delay at each stage or iteration |
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Also Published As
Publication number | Publication date |
---|---|
WO1995004963A1 (fr) | 1995-02-16 |
EP0667969A1 (fr) | 1995-08-23 |
JPH08503322A (ja) | 1996-04-09 |
US5774388A (en) | 1998-06-30 |
FR2709007B1 (fr) | 1995-09-29 |
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Date | Code | Title | Description |
---|---|---|---|
ST | Notification of lapse |