DE4409672A1 - Converter to change video graphic array signals to television signals - Google Patents
Converter to change video graphic array signals to television signalsInfo
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- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
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- H04N9/64—Circuits for processing colour signals
- H04N9/641—Multi-purpose receivers, e.g. for auxiliary information
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- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
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Abstract
Description
Es ist bereits ein VGA/PAL-Converter bekannt, der digitalisierte PC-Bilder in Videobilder im PAL-Format umsetzt. Sie werden von der Anmelderin unter dem Produktnamen MULTIVISION vertrieben. Damit können digitale Computerbilder auf dem PC bearbeitet, also verändert, ergänzt etc. und danach auf einem TV-Monitor oder einem Videorecorder in Fernsehnorm wiedergegeben werden. Auf diese Weise kann ein Computerbild gleichzeitig auch auf einem oder mehreren Fernsehschirmen wiedergegeben werden.A VGA / PAL converter that digitizes is already known PC images converted into video images in PAL format. They are from marketed by the applicant under the product name MULTIVISION. It can be used to edit digital computer images on the PC changed, supplemented etc. and then on a TV monitor or one Video recorders can be played in television standard. In this way can be a computer image on one or more at the same time TV screens are played.
Das Computerbild kann man entweder vom PC direkt ableiten (WINDOWS) oder als Video-Overlaybild über eine Umwandlung von PAL in VGA erhalten. Hierzu setzt man beispielsweise eine eigene Karte ein.The computer image can either be derived directly from the PC (WINDOWS) or as a video overlay image using a conversion from PAL to VGA received. To do this, you set your own card, for example a.
Aufgabe der Erfindung ist es, einen VGA/PAL-Converter zu schaffen, der möglichst einfach und kompakt aufgebaut ist und der ohne Datenverlust bei der Umwandlung von VGA in PAL bzw. eine andere Fernsehnorm arbeitet.The object of the invention is to create a VGA / PAL converter, that is as simple and compact as possible and that without Data loss when converting from VGA to PAL or another TV standard works.
Zur Lösung dieser Aufgabe dient ein VGA/PAL-Converter mit den Merkmalen des Patentanspruchs 1.A VGA / PAL converter with the Features of claim 1.
Dadurch wird erreicht, daß ein VGA-Bild an einen Fernsehmonitor ausgegeben und von diesem angezeigt werden kann. Das vom Fernseh monitor angezeigte Bild kann auch ein ursprüngliches Fernsehbild sein, das mit einer an sich bekannten Schaltung auf einer soge nannten "Multimedia-Karte" in ein VGA-Bild konvertiert und wieder in ein Fernsehbild rückgewandelt wurde. Dabei kann das VGA-Bild auf dem PC bearbeitet, also verändert worden sein, beispielsweise durch Hinzufügen von Schriften, Schatten, Farben, Vergrößerungen, Überlagerung von und mit anderen Bildern, etc. Es wird darauf hingewiesen, daß das erfindungsgemäß erhaltene Fernsehbild auch gleichzeitig an mehrere Fernsehmonitore übertragen und von diesen angezeigt werden kann.This ensures that a VGA image is sent to a television monitor output and displayed by this. That from television monitor displayed image can also be an original television picture be that with a known circuit on a so-called called "multimedia card" converted to a VGA image and again was converted back into a television picture. The VGA image can edited on the PC, i.e. have been changed, for example by adding fonts, shadows, colors, magnifications, Superimposition of and with other images, etc. It is on it noted that the television picture obtained according to the invention also simultaneously transmitted to and from several television monitors can be displayed.
Vorteilhafte Ausgestaltungen der Erfindung sind Gegenstand der Unteransprüche.Advantageous embodiments of the invention are the subject of Subclaims.
Die Erfindung wird im folgenden anhand einer Zeichnung näher erläutert:The invention is described in more detail below with the aid of a drawing explains:
Ein VGA-Bildsignal, wie es in einem Personal Computer oder einem ähnlichem Rechner zum Aufbau des Comuputerbildes herangezogen wird, wird an den Eingang IN der erfindungsgemäßen Schaltung gelegt. Dabei wird jede Zeile des VGA-Bildsignals beispielsweise durch 16 Bit dargestellt. Das VGA-Bildsignal wird an die Eingänge von zwei Zeilenpuffern Z0 und Z1 übertragen, die von einem Con troller 1 gesteuert werden. Die beiden Zeilenpfuffer Z0 und Z1 sind an sich bekannte Zwischenspeicher, beispielsweise Eimerket tenspeicher, Schieberegister oder Video-RAMs. Es kommt lediglich darauf an, daß sie die digitalisierte Bildinformation einer VGA-Bildzeile entsprechend der VGA-Taktsequenz von 56 Hz, 60 Hz oder 70 Hz aufnehmen und mit der Frequenz des gewünschten Videobildes, beispielsweise 50 Hz im PAL-Verfahren, ausgeben. Für NTSC wären es 60 Hz, für SECAM 50 Hz. Der Zeilenpuffer Z0 nimmt dabei - ange steuert vom Controller 1 - das VGA-Bildsignal einer ersten Zeile und der Zeilenpuffer Z1 das VGA-Bildsignal einer übernächsten Zeile auf. Damit werden zunächst nacheinander die Bildsignale für die ungeraden Zeilen in die Zeilenpuffer Z0 und Z1 geschrieben und anschließend, nach einem neuen Bildaufbau, werden die Signale für die geraden Zeilen an die Zeilenpuffer gelegt. Auf diese Weise erscheinen zwei Halbbilder, wie dies für Fernsehbilder üblich ist.A VGA image signal, as it is used in a personal computer or a similar computer to build up the computer image, is applied to the input IN of the circuit according to the invention. Each line of the VGA image signal is represented by 16 bits, for example. The VGA image signal is transmitted to the inputs of two line buffers Z0 and Z1, which are controlled by a controller 1 . The two line buffers Z0 and Z1 are buffers known per se, for example bucket string memories, shift registers or video RAMs. The only thing that matters is that they record the digitized picture information of a VGA picture line in accordance with the VGA clock sequence of 56 Hz, 60 Hz or 70 Hz and output it with the frequency of the desired video picture, for example 50 Hz in the PAL process. For NTSC it would be 60 Hz, for SECAM it would be 50 Hz. The line buffer Z0 - controlled by controller 1 - receives the VGA image signal of a first line and the line buffer Z1 the VGA image signal of a line after next. The image signals for the odd lines are first written to the line buffers Z0 and Z1 one after the other and then, after a new image structure, the signals for the even lines are applied to the line buffers. In this way, two fields appear, as is usual for television pictures.
Im einzelnen wird das VGA-Bildsignal zunächst für die erste Zeile in den Zeilenpuffer Z0 eingeschrieben und fast gleichzeitig ausgelesen, und zwar gesteuert durch Signale Enable 0 und Out 0 vom Controller 1. Mit Enable 0 wird das Einschreiben in den Zeilenpuffer Z0 gestartet, mit Out 0 das Auslesen aus dem Zeilen puffer Z0. Das vom Zeilenpuffer Z0 ausgegebenen Zeilensignal wird an einen Digital/Analog-Wandler 2 gelegt, der es in drei analoge Farbsignale RGB umwandelt und diese an eine Schaltung 3 legt, die daraus unter Steuerung von einem Timing-Generator 4 ein FBAS und zwei Y/C-Signale erzeugt.In detail, the VGA image signal is first written into line buffer Z0 for the first line and read out almost simultaneously, controlled by signals Enable 0 and Out 0 from controller 1 . With Enable 0 the writing into the line buffer Z0 is started, with Out 0 the reading out of the line buffer Z0. The line signal output by the line buffer Z0 is applied to a digital / analog converter 2 , which converts it into three analog color signals RGB and applies this to a circuit 3 , which, under the control of a timing generator 4 , generates one CVBS and two Y / C Signals generated.
Gegen Ende des Auslesens der 1. Zeile aus dem ersten Zeilenpuffer Z0 wird die 3. Zeile des VGA-Bildsignals in den zweiten Zeilenpuf fer Z1 geschrieben und beim Auftreten eines Signals Out 1 vom Controller 1 ebenfalls in den Digital/Analog-Wandler 2 ausgelesen. Gegen Ende des Auslesens der 3. Zeile wird bereits das Bildsignal für die 5. Zeile des VGA-Bildes in den ersten Zeilenpuffer Z0 eingeschrieben und anschließend gleich ausgelesen, wobei dann in den zweiten Zeilenpuffer Z1 das Zeilensignal für die 7. Zeile eingelesen wird. Der Vorgang wird bis zur letzten Zeile des VGA-Bildes fortgesetzt. Anschließend wird das VGA-Bildsignal eines neuen Bildaufbaus in ähnlicher Weise zeilenweise abgearbeitet, aber jetzt nicht als Folge der ungeraden Zeilen, sondern als Folge der geraden Zeilen zwei, vier, sechs, acht etc. Das Einschreiben in die Zeilenpuffer Z0 bzw. Z1 erfolgt jeweils durch Anlegen eines Enable-Signals 0 oder 1 vom Controller 1. Der Controller 1 wird mit einem Vertikal-Synchronsignal des VGA-Bildes angesteuert, um auf diese Weise die Enable-Signale für das zeilenweise Einlesen der VGA-Bildzeilen zeitlich zu steuern. Der Timing-Generator 4 wird ebenfalls mit dem VGA-Vertikal-Synchronsignal VSYNC angesteu ert und treibt einen Taktgeber (CLOCK), der ein Reset-Bit für die Schaltung 3 erzeugt. Diese wird außerdem mit vertikalen und horizontalen Synchronisationsimpulsen für das Fernsehbild, bei spielsweise im PAL-Standard, versorgt.Towards the end of the reading of the 1st line from the first line buffer Z0 is written the 3rd row of the VGA-image signal in the second Zeilenpuf fer Z1 and read out at the occurrence of a signal Out 1 by the controller 1 is also in the digital / analog converter. 2 Towards the end of reading out the 3rd line, the image signal for the 5th line of the VGA image is already written into the first line buffer Z0 and then read out immediately, the line signal for the 7th line then being read into the second line buffer Z1. The process continues until the last line of the VGA image. The VGA image signal of a new image structure is then processed line-by-line in a similar manner, but now not as a result of the odd lines, but rather as a result of the even lines two, four, six, eight, etc. The line buffers Z0 and Z1 are each written by applying an enable signal 0 or 1 from controller 1 . The controller 1 is actuated with a vertical synchronizing signal of the VGA picture in order in this way to time-control the enable signals for the line-by-line reading of the VGA picture lines. The timing generator 4 is also controlled with the VGA vertical synchronizing signal VSYNC and drives a clock generator (CLOCK), which generates a reset bit for the circuit 3 . This is also supplied with vertical and horizontal synchronization pulses for the television picture, for example in the PAL standard.
Als Controller 1 kommt eine programmierbare Halbleiterschaltung, beispielsweise des Typ PA7024 der Firma IDT zum Einsatz. Geeignete programmierbare Bausteine sind sogenannte Peel-Arrays, PALs, GALs oder ASICs. Dem Fachmann sind derartige Bausteine geläufig.A programmable semiconductor circuit, for example of the type PA7024 from IDT, is used as controller 1 . Suitable programmable components are so-called peel arrays, PALs, GALs or ASICs. Such modules are familiar to the person skilled in the art.
Die Programmierung des Controllers 1 hat so zu erfolgen, daß zunächst alle ungeradzahligen Zeilen (1.Z, 3.Z, 5.Z, . . .) eines VGA-Bildes nacheinander eingeschrieben und mit der Frequenz des Fernsehbildes ausgelesen werden, worauf das Einschreiben der geradzahligen Zeilensignale (2.Z, 4.Z, 6.Z, . . .) erfolgt.The programming of the controller 1 has to be carried out in such a way that first all odd-numbered lines (1.Z, 3.Z, 5.Z,...) Of a VGA picture are written in succession and read out at the frequency of the television picture, followed by the writing of the even-numbered line signals (2.Z, 4.Z, 6.Z,...).
Claims (9)
- - einen Signaleingang (IN) für ein digitales Bildinforma tionssignal;
- - mindestens einen Zeilenpuffer (Z0, Z1) für das Bild informationssignal;
- - einen an den mindestens einen Zeilenpuffer (Z0, Z1) angeschlossenen Controller (1) für die Synchronisation des VGA-Signals mit dem PAL-Signal; und durch
- - einen D/A-Wandler (2), der dem mindestens einen Zeilen puffer (Z0, Z1) nachgeschaltet ist und zur Ausgabe des Fernsehbildsignales dient.
- - A signal input (IN) for a digital image information signal;
- - At least one line buffer (Z0, Z1) for the image information signal;
- - A controller ( 1 ) connected to the at least one line buffer (Z0, Z1) for the synchronization of the VGA signal with the PAL signal; and through
- - A D / A converter ( 2 ) which is connected to the at least one line buffer (Z0, Z1) and is used to output the television picture signal.
- - daß die Bildwiederholfrequenz der VGA-Karte (normaler weise 56 Hz, auch 60 und 70 Hz üblich) auf die Bild wiederholfrequenz der gewünschten Fernsehnorm gebracht wird (z. B. 56 Hz → 50 Hz);
- - daß das digitalisierte VGA-Signal zeilenweise an einen oder mehrere Zeilenpuffer gelegt wird, und zwar zuerst die ungeraden Zeilen und beim nächsten Bildaufbau die geraden Zeilen;
- - und daß eine Zeile in den Zeilenpuffer eingeschrieben und fast gleichzeitig mit niedriger Frequenz ausgegeben wird, wobei gegen Ende der Ausgabe bereits die nächste gerade oder ungerade Zeile in den Zeilenpuffer einge schrieben wird.
- - That the refresh rate of the VGA card (normally 56 Hz, also 60 and 70 Hz usual) is brought to the refresh rate of the desired television standard (e.g. 56 Hz → 50 Hz);
- - That the digitized VGA signal is applied line by line to one or more line buffers, first the odd lines and the next lines the even lines;
- - And that a line is written into the line buffer and is output almost simultaneously with a low frequency, with the next even or odd line being written into the line buffer towards the end of the output.
Priority Applications (1)
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Applications Claiming Priority (1)
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DE19944409672 DE4409672A1 (en) | 1994-03-15 | 1994-03-15 | Converter to change video graphic array signals to television signals |
Publications (1)
Publication Number | Publication Date |
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DE4409672A1 true DE4409672A1 (en) | 1995-09-21 |
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ID=6513401
Family Applications (1)
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DE19944409672 Withdrawn DE4409672A1 (en) | 1994-03-15 | 1994-03-15 | Converter to change video graphic array signals to television signals |
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Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0774744A2 (en) * | 1995-11-09 | 1997-05-21 | Siemens Nixdorf Informationssysteme AG | Personal computer with the possibility to selectively output images to a monitor or to a television apparatus |
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DE20001953U1 (en) | 2000-02-03 | 2000-04-27 | Grundig AG, 90762 Fürth | Device for displaying analog graphics signals generated in a graphics processor on a display |
US10235952B2 (en) | 2016-07-18 | 2019-03-19 | Samsung Display Co., Ltd. | Display panel having self-refresh capability |
-
1994
- 1994-03-15 DE DE19944409672 patent/DE4409672A1/en not_active Withdrawn
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Publication number | Priority date | Publication date | Assignee | Title |
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EP0774744A3 (en) * | 1995-11-09 | 1997-11-12 | Siemens Nixdorf Informationssysteme AG | Personal computer with the possibility to selectively output images to a monitor or to a television apparatus |
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