DE3332384A1 - Circuit arrangement for conditioning signals - Google Patents

Circuit arrangement for conditioning signals

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DE3332384A1 DE19833332384 DE3332384A DE3332384A1 DE 3332384 A1 DE3332384 A1 DE 3332384A1 DE 19833332384 DE19833332384 DE 19833332384 DE 3332384 A DE3332384 A DE 3332384A DE 3332384 A1 DE3332384 A1 DE 3332384A1
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Ulrich Dipl.-Ing. 6370 Oberursel Brüggemann
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Abstract

In a circuit arrangement for conditioning signals which are fed into a microcomputer for measurement or acquisition purposes, especially with a combination instrument of a motor vehicle, a non-retriggerable monostable multivibrator is provided to which the signals are applied. This monostable multivibrator is used to suppress the interference process which occur during its monostable period. If necessary, a Schmitt Trigger (3) is connected upstream of the monostable multivibrator, by means of which Schmitt Trigger (3) the signals are converted into a form which is suitable for processing using the monostable multivibrator. Under specific operating preconditions, which are present especially in a motor vehicle, the non-retriggerable monostable multivibrator is advantageously replaced by a NAND Schmitt Trigger (7) having a capacitor (9) which can be recharged by means of the NAND Schmitt Trigger via a charging resistor. A negative-feedback resistor (11) is fed back from the capacitor (9) to a first input of the NAND Schmitt Trigger in such a manner that the NAND Schmitt Trigger cannot be triggered by means of a pulse on its second input (6) for so long as its switching threshold is not exceeded while the capacitor (9) is being charged. <IMAGE>

Description

Schaltungsanordnung zur Aufbereitung von SignalenCircuit arrangement for processing signals

Die Erfindung betrifft eine Schaltungsanordnung zur Aufbereitung von Signalen nach dem Oberbegriff des Anspruchs 1.The invention relates to a circuit arrangement for processing Signals according to the preamble of claim 1.

Derartige bekannte Schaltungsanordnungen sind insbesondere zur Aufbereitung von Signalen bekannt, die als Drehzahlimpulse in Kraftfahrzeugen zur Anzeige der Drehzahl oder zur Bildung einer drehzahlabhängigen Grösse verarbeitet werden.Such known circuit arrangements are in particular for processing of signals known as speed pulses in motor vehicles to display the Speed or to form a speed-dependent variable.

Die Drehzahlimpulse können von verschiedenen Gebern abgenommen werden, beispielsweise der sogenannten Klemme 1 der Zündspule bei Ottomotoren. Von der Klemme 1 kann pro Zylinder nach je zwei Kurbelwellenumdrehungen ein Drehzahl impuls abgenommen werden. - Die Drehzahl eines Dieselmotors wird hingegen am einfachsten durch ein Signal an der soqcnannten Klemme W der Lichtmaschine erfasst. Zur Bildung der Motordrehzahl sind die Polpaarzahl der Lichtmaschine und das Übersetzungsverhältnis zwischen Kurbelwelle und Lichtmaschine zu berücksichtigen.The speed pulses can be taken from various encoders, for example the so-called terminal 1 of the ignition coil in gasoline engines. From the clamp 1, a speed pulse can be picked up per cylinder after every two crankshaft revolutions will. - The speed of a diesel engine, on the other hand, is most easily determined by a Signal detected at the soqcn so-called terminal W of the alternator. To form the engine speed are the number of pole pairs of the alternator and the transmission ratio between the crankshaft and alternator to consider.

Die genannten Drehzahlsignale bzw. Drehzahlimpulse werden mit bekannten integrierten Schaltkreisen verarbeitet, um ein Zeigerinstrument zu speisen oder zur Bildung von Grössen, die aus der Drehzahl abgeleitet sind, beispielsweise der Anzeige von Service-Intervallen, verarbeitet zu werden.The mentioned speed signals or speed pulses are known with Integrated circuits processed to power a pointer instrument or for the formation of variables that are derived from the speed, for example the Display of service intervals to be processed.

Diese Schaltungsanordnungen der eingangs genannten Gattung sind insbesondere als nicht retriggerbares Monoflop aufgebaut. Mit diesem nicht retriggerbaren Monoflop sollen im Fall der Drehzahlmessung nur die Drehzahlimpulse, nicht aber Störimpulse zwischen diesen, zu definierten Ausgangsimpulsen verarbeitet werden, mit denen beispielsweise ein Mikroprozessor beaufschlagt werden kann. Impulse, die in die sogenannte Monoflopzeit fallen, die nach Auftreten eines Drehzahlimpulses beginnt, können so die weitere Auswertung nicht verfälschen.These circuit arrangements of the type mentioned at the beginning are especially constructed as a non-retriggerable monoflop. With this non-retriggerable In the case of speed measurement, only the speed pulses should be monoflop, but not Interference pulses between these are processed into defined output pulses, with which, for example, a microprocessor can be applied. Impulses that fall into the so-called monoflop time, which occurs after a speed pulse begins, can thus not falsify the further evaluation.

Übliche integrierte Schaltkreise, die zur Drehzahlmessung in Kraftfahrzeugen verwendet werden, benötigen jedoch eine verhältnismässig hohe Betriebsspannung, die jedoch in Kraftfahrzeugen nicht immer ohne weiteres und zuverlässig gegeben ist. Darüber hinaus sind die zur Drehzahlmessung bisher in Kraftfahrzeugen verwendeten integrierten Schaltkreise verhältnismässig aufwendig.Common integrated circuits used for speed measurement in motor vehicles are used, but require a relatively high operating voltage, which, however, are not always readily and reliably given in motor vehicles is. In addition, they have been used to date for speed measurement in motor vehicles integrated circuits relatively expensive.

-Der Erfindung liegt aaher die Aufgabe zu Grunde, eine Schaltungsanordnung so weiterzubilden, dass sie einen geringeren Aufwand an integrierten Bauelementen erfordert und mit niedrigerer stabilisierter Betriebsspannung betrieben werden kann.The invention is also based on the object of a circuit arrangement further training in such a way that they reduce the cost of integrated components requires and can be operated with a lower stabilized operating voltage.

Diese Aufgabe wird durch die in dem kennzeichnenden Teil des Anspruchs 1 angegebene Erfindung gelöst.This task is indicated in the characterizing part of the claim 1 specified invention solved.

Diese Schaltungsanordnung eignet sich besonders für Kraftfahrzeuge, in die ein Mikroprozessor mit zugehörigen integrierten Schaltkreisen, beispielsweise zur Bildung der Anzeigewerte von Kombinationsinstrumenten, eingebaut werden.This circuit arrangement is particularly suitable for motor vehicles, in which a microprocessor with associated integrated circuits, for example to form the display values of combination instruments.

In diesen integrierten Schaltkreisen unbelegte Gatter können zur Bildung der Schaltungsanordnung in besonders wirtschaftlicher Weise herangezogen werden.In these integrated circuits, unused gates can lead to the formation the circuit arrangement can be used in a particularly economical manner.

Die Schaltungsanordnung nach Anspruch 1 wird im wesentlichen durch ein NAND-Schmitt-Trigger gebildet, welches in der angegebenen Art und Weise mit weiteren Schaltelementen verbunden ist. Dadurch wird der NAND-Schmitt-Trigger immer nur dann durch einen Impuls oder ein anderes Eingangssignal ausgelöst, wenn die durch die Dimensionierung der Schaltelemente bestimmte Monozeit,die bei einem vorangehenden Impuls begann, abgeschlossen ist. Störimpulse, die zwischen zwei zu nutzende Drehzahl impulse fallen, erzeugen also keinen Ausgangsimpuls.The circuit arrangement according to claim 1 is essentially carried out by a NAND Schmitt trigger is formed, which in the specified manner with further switching elements is connected. This will always make the NAND Schmitt trigger only triggered by a pulse or other input signal if the Mono time determined by the dimensioning of the switching elements, which in a preceding Impulse began, is complete. Interference pulses, the speed to be used between two pulses fall, so do not generate an output pulse.

Der Kondensator, der in Verbindung mit dem Ladewiderstand die Zeit bestimmt, in der eine Schaltschwelle des NAND-Schmitt-Triggers erreicht wird und eine Monozeit beendet wird, ist besonders geeignet nach Anspruch 2 an den NANLl-Schmitt-Trigger angeschlossen.The capacitor, which in connection with the charging resistor, the time determines in which a switching threshold of the NAND Schmitt trigger is reached and a mono time is ended is particularly suitable according to claim 2 to the NANL1-Schmitt trigger connected.

Der NAND-Schmitt-Trigger wird vorteilhaft über einen Sondensator dynamisch besteuert, der an dem Ausgang eines dem NAND-Schmitt-Trigger vorgeschalteten Schmitt-nriggers angeordnet ist.The NAND Schmitt trigger is advantageously dynamic via a probe taxed at the output of a Schmitt trigger connected upstream of the NAND Schmitt trigger is arranged.

Besonders vorteilhaft werden der NAND-Schmitt-Trigger und der ihm vorgeschaltete Schmitt-Trigger durch CMOS-Bausteine realisiert, die andernfalls durch Eingangsschaltungen zu Mikroprozessoren in Kraftfahrzeugen nicht ausgenutzt sind.The NAND Schmitt trigger and him are particularly advantageous upstream Schmitt trigger implemented by CMOS components, which otherwise not used by input circuits to microprocessors in motor vehicles are.

Der gleiche vorteilhafte Einsatz dieser CMOS-Bausteine oder CMOS-Gatter gilt für die nachfolgenden Schaltungsanordnungen: In den Fällen, in denen nicht für jeden Eingangsimpuls b.u.The same advantageous use of these CMOS modules or CMOS gates applies to the following circuit arrangements: In those cases in which not for each input pulse b.u.

Drehzahlimpuls ein definierter Ausgangsimpuls erzeugt wsrelcrn soll, sondern ein solcher Ausgangsimpuls nur für eine Anzahl V(.lIi Eingangsimpulsen zu el-zeugen ist, wird die Schalt uns- anordnung nach Anspruch 4 vorgesehen. Diese ergibt eine Frequenzteilung um den Quotienten 2 und weist ausserdem die Störimpuls-unterdrückenden Eigenschaften eines nicht retriggerbaren Monoflop auf. Solche Schaltungsanordnungen sind besonders vorteilhaft zur Frequenzteilung von Signalen, die von der Klemme W einer Lichtmaschine abgenommen werden.Speed pulse a defined output pulse is generated wsrelcrn, but such an output pulse only for a number of V (.lIi input pulses el-witness, the switch will us- arrangement according to claim 4 provided. This results in a frequency division by the quotient 2 and also shows the interference pulse-suppressing Properties of a non-retriggerable monoflop. Such circuit arrangements are particularly advantageous for frequency division of signals from the terminal W can be removed from an alternator.

Mit dieser Schaltungsanordnung können Ausgangs impulse genügender Länge gebildet werden, der Pulsfrequenz der Frequenz der Eingangssignale zuverlässig zugeordnet ist. - Hierzu werden im wesentlichen zwei NAND-Schmitt-Trigger verwendet, von denen je ein erster Eingang zur Gegenkopplung von einem Ausgang des jeweils anderen NAND-Schmitt-Triggers herangezogen wird, während jeweils der zweite Eingang zum Anschluss je eines Kondensators vorgesehen ist, der über einen Entladen.' widerstand zum jeweils ersten Eingang entladen wird und damit die Monozeit bestimmt.With this circuit arrangement, output pulses can be more sufficient Length are formed, the pulse frequency of the frequency of the input signals reliable assigned. - Essentially two NAND Schmitt triggers are used for this purpose, each of which has a first input for negative feedback from an output of each other NAND Schmitt trigger is used, while the second input for the connection of one capacitor each, which is discharged via a discharge. ' resistance is discharged to the first input and thus determines the mono time.

Besonders vorteilhaft sind beide Kondensatoren über je eine entkoppelnde Diode mit dem Ausgang des vorgeschalteten Schmitt-Triggers verbunden, dessen Eingang wiederum mit den Drehzahlimpulsen oder Signalen beaufschlagt wird.Both capacitors are particularly advantageous via one decoupling each Diode connected to the output of the upstream Schmitt trigger, its input in turn, the speed pulses or signals are applied.

Die Erfindung wird im folgenden anhand einer Zeichnung mit zwei Figuren erläutert. Es zeigt: Figur 1 eine Schaltungsanordnung zur Drehzahlimpulsaufbereitung mit den Eigenschaften eines nicht retriggerbaren Flip-Flop und Figur 2 eine Schaltungsanordnung zur Untersetzung von Pulsfrequenzen oder Signalfrequenzen der Drehzahl bei gleichzeitiger Störimpulsunterdrückung durch die Eigenschaften eines nicht retriggerbaren Flip-Flop.The invention is explained below with reference to a drawing with two figures explained. It shows: FIG. 1 a circuit arrangement for speed pulse processing with the properties of a non-retriggerable flip-flop and FIG. 2 shows a circuit arrangement for the reduction of pulse frequencies or signal frequencies of the speed with simultaneous Interference suppression through the properties of a non-retriggerable flip-flop.

In beiden Figuren sind übereinstimmende Elemente mit aleichen Bezugszeichen versehen.In both figures, identical elements have been given the same reference symbols Mistake.

In Figur 1 ist als Klemme 1 oder Klemme W eine Klemme bezeiht net, die an die entsprechende Klemme eines Kraftfahrzeugmotors anschliessbar ist. Der Anschluss führt zu einem abgeschirmten Siebglied 2, dessen Ausgang mit dem Eingang eines invertierenden Schmitt-Triggers 3 verbunden ist. Der Schmitt-Trigger kann beispielsweise aus einem Sechstel des CMOS-Bausteins 40106 bestehen.In Figure 1, a terminal is denoted as terminal 1 or terminal W, which can be connected to the corresponding terminal of a motor vehicle engine. Of the Connection leads to a shielded filter element 2, its output with the input an inverting Schmitt trigger 3 is connected. The Schmitt trigger can for example, consist of one sixth of the CMOS component 40106.

Über einen Koppelkondensator 4 und einen Vorwiderstand 5 1 ist ein Eingang 6 eines NAND-Schmitt-Triggers 7 anqeschlosstnX Der Eingang 6 wird im folgenden auch als zweiter Eingang bezeichnet.A coupling capacitor 4 and a series resistor 5 1 is a Input 6 of a NAND Schmitt trigger 7 anqeschlosstnX The input 6 is in the following also known as the second entrance.

Von dem Ausgang des NAND-Schmitt-Triggers 7 führt eine Leitung zu einem Anschluss A, von dem die Ausgangsimpulse abgenommen werden können. Von dem Ausgang ist ferner eine Verbindung über einen Inverter 8 zu einem Kondensator 9 geführt, der über einen Ladewiderstand 10 durch die Betriebsspannungsquelle an der Klemme 5 Volt aufladbar ist. Die Anschlußstelle des Ladewiderstands mit dem Kondensator ist über einen Gegenkopplungswiderstand 11 zu einem ersten Eingang des NAND-Schmitt-Triggers zurückgeführt.A line leads from the output of the NAND Schmitt trigger 7 a connection A, from which the output pulses can be picked up. Of the The output is also a connection via an inverter 8 to a capacitor 9 out, the via a charging resistor 10 by the operating voltage source to the Terminal 5 volts is chargeable. The connection point of the charging resistor with the capacitor is via a negative feedback resistor 11 to a first input of the NAND Schmitt trigger returned.

Ein Vorwiderstand 12 dient in Verbindung mit dem Vorwidestand 5 zur Erzeugung einer positiven Vorspannung an dem zweiten Eingang des NAND-Schmitt-Triggers.A series resistor 12 is used in conjunction with the series resistor 5 to Generation of a positive bias voltage at the second input of the NAND-Schmitt trigger.

Die Drehzahlimpulse bzw. Drehzahlsignale der Klemme 1 werden in dem Siebglied 2 insoweit geglättet, dass störende Spannungsspitzen abgeleitet werden. Anschliessend wird das Signal dem Schmitt-Trigger 3 zugeführt, welcher Impulse vorgegebener Flankensteilheit und Pulshöhe erzeugt.The speed pulses or speed signals of terminal 1 are in the Sieve element 2 smoothed to the extent that disruptive voltage peaks are diverted. The signal is then fed to the Schmitt trigger 3, which pulses given Edge steepness and pulse height generated.

Eine negative Flanke am invertierenden Ausgang des Schmitt-Triggers 3 wird über den Kondensator 4 in den unter positiver Vorspannung stehenden Eingang 6 des NAND-Schmitt-Triggers 7 eingekoppelt. Damit wird das Ausgangspotential dieses NAND-Schmitt-Triggers positiv: Demzufolge nimmt der Ausgang des Inverters 8 ein negatives Potential an,und der Kondensator 9 wird über den Ladewiderstand 10 aufgeladen. Während dieses Ladevorgangs liegt an dem ersten Schmitt-Trigger-Eingang über den Gegenkopplungswiderstand 11 ein niedriges Signal (Low), welches den Ausgangszustand des NAND-Schmitt-Triggers so lange beibehält, bis mit abnehmendem Ladestrom und steigendem Potential an dem gemeinsamen Punkt des Ladewiderstands 10 mit dem Kondensator 9 eine obere Triggerschwelle des NAND-Schmitt-Triggers 7 erreicht wird. Bis dahin könenn also weitere in den zweiten Eingang eingespeiste Impulse den Schaltungszustand nicht beeinflussen. Der Ladewiderstand 10 und der Kondensator 9 haben solche Zeitkonstante, dass aber die grösste vorgegebene Pulsfrequenz der Drehzahlimpulse oder der Drehzahlsignale ordnungsgemäss verarbeitet wird.A negative edge at the inverting output of the Schmitt trigger 3 is fed via the capacitor 4 to the input which is under positive bias 6 of the NAND Schmitt trigger 7 coupled. So the output potential becomes this NAND Schmitt trigger positive: As a result, the output of inverter 8 assumes negative potential, and the capacitor 9 is charged via the charging resistor 10. During this loading process, the first Schmitt trigger input is connected to the Negative feedback resistor 11 a low signal (Low), which the output state of the NAND Schmitt trigger is maintained until with decreasing charging current and increasing potential at the common point of the charging resistor 10 with the capacitor 9 an upper trigger threshold of the NAND Schmitt trigger 7 is reached. Until then So further pulses fed into the second input can change the circuit status not affect. The charging resistor 10 and the capacitor 9 have such a time constant but that the highest specified pulse frequency of the speed pulses or the speed signals is properly processed.

Nach Erreichen der oberen Triggerschwelle wird das Ausgangspotential des NAND-Schmitt-Triggers 7 abgesenkt (Low),und der Kondensator 9 enlädt sich sehr rasch über den Gegenkopplungswiderstand 11 und den Eingangswiderstand (Schutzdiode) des ersten Eingangs des NAND-Schmitt-Triggers.After reaching the upper trigger threshold, the output potential is of the NAND Schmitt trigger 7 is lowered (low), and the capacitor 9 is very discharged quickly via the negative feedback resistor 11 and the input resistor (protective diode) of the first input of the NAND Schmitt trigger.

Die Zeitdauer zwischen dem ersten Umschalten des NAND-Schmitt-Triggers bei Einspeisung eines Impulses in den zweiten Eingang und dem Zurückkehren in den zuletzt beschriebenen Zustand wird als Monozeit bezeichnet.The length of time between the first switching of the NAND Schmitt trigger when a pulse is fed into the second input and when it returns to the the last state described is called mono time.

In der Monozeit können weitere negative Impulse an dem zweiten Eingang 6 des NAND-Schmitt-Triggers keine Umschaltung bewirken, da an dem zweiten Eingang negatives Potential anliegt.In the mono time, further negative impulses can be applied to the second input 6 of the NAND Schmitt trigger do not cause a switchover, since at the second input negative potential is present.

Die Schaltungsanordnung nach Figur 1 hat also das Verhalten eines nicht retriggerbaren oder nicht nachtriggerbaren tlonoflop.The circuit arrangement according to FIG. 1 thus has the behavior of a non-retriggerable or non-retriggerable tlonoflop.

Die Schaltungsanordnung nach Figur 2 bewirkt zusätzlich eine Untersetzung der Pulsfrequenz bzw. Signalfrecuenz um den Quotienten 2. Die Schaltungsanordnung nach Figur 2 entspricht in dem Siebglied 2 und dem invertierenden Schmitt-Triggr 3 vollständig derjenigen nach Figur 1.The circuit arrangement according to FIG. 2 also causes a reduction the pulse frequency or signal frequency by the quotient 2. The circuit arrangement according to Figure 2 corresponds in the filter element 2 and the inverting Schmitt-Triggr 3 completely that of FIG. 1.

Es wird zu Figur 1 noch nachgetragen, dass der NAND-Schmitt-Trigger durch ein Viertel des CMOS-Bausteines 4093 vorteilhaft realisiert ist.It is added to Figure 1 that the NAND Schmitt trigger is advantageously implemented by a quarter of the CMOS module 4093.

In Figur 2 sind als weitere aktive Elemente zwei NAND-Schmitt-Trigger 13 und 14 vorgesehen, deren Ausgänge 15, 16 mit je einem ersten Eingang 17, 18 des jeweils anderen NAND-Schmitt-Triggers in konventioneller Weise zur Bildung eines NAND-Flip-Flop gekoppelt sind.In FIG. 2, there are two NAND Schmitt triggers as further active elements 13 and 14 are provided, the outputs 15, 16 of which each have a first input 17, 18 of the each other NAND Schmitt trigger in a conventional manner to form a NAND flip-flops are coupled.

Jeweils ein zweiter Eingang 18' bzw. 19 ist über je einen Vorwiderstand 20 bzw. 21 mit dem positiven Pol +5 Volt der Betriebsspannungsquelle verbunden. Ausserdem ist jeder der beiden zweiten Eingänge 18' bzw. 19 über einen Kondensator 22 bzw. 23 in Reihe mit einer Diode 24 bzw. 25 an den Ausgang des Schmitt-Triggers 3 angekoppelt.A second input 18 'or 19 is in each case via a series resistor 20 or 21 connected to the positive pole +5 volts of the operating voltage source. In addition, each of the two second inputs 18 'and 19 is via a capacitor 22 or 23 in series with a diode 24 or 25 at the output of the Schmitt trigger 3 coupled.

Die Schaltungsanordnung ist vervollständigt durch je einen Entladewiderstand 26 bzw. 27, der einen Entladestromkre.is für den zugehörigen Kondensator herstellt.The circuit arrangement is completed by a discharge resistor each 26 or 27, which has a discharge circuit for the associated capacitor manufactures.

Im Betrieb der Schaltungsanordnung kann davon ausgegangen werden, dass zunächst einer der beiden Kondensatoren 22, 23 durch einen vorangehenden Impuls von dem Schmitt-Trigger 3 geladen ist, während der jeweils andere Kondensator entladen ist. Nur über den entladenen Kondensator kann bei einem weiteren Impuls am Ausgang des Schmitt-Triggers 3 ein Ladestrom fliessen, der das Potential an dem an ihn angeschlossenen zweiten Eingang eines NAND-Schmitt-Triggers abesenkt, so dass dieser Trigger die untere Triggerschwelle erreicht und der Ausgang eines NAND-Schmitt-Triggers positiv ist.In the operation of the circuit arrangement it can be assumed that that first one of the two capacitors 22, 23 by a previous pulse is charged by the Schmitt trigger 3, while the other capacitor is discharged is. A further pulse at the output can only be achieved via the discharged capacitor of the Schmitt trigger 3, a charging current will flow that has the potential of the one connected to it second input of a NAND Schmitt trigger is lowered, so that this trigger the lower trigger threshold reached and the output of a NAND-Schmitt trigger positive is.

Dies gilt beispielsweise bei einem Ladestrom durch den Konaensator 23 für den NAND-Schmitt-Trigger 14. Der NAND Schmitt-Trigger 14 wird in diesem Zustand mit positivem Ausgangspotential über den invertierenden NAND-Schmitt-Trigger 13 an seinem ersten Eingang 18 gehalten.This applies, for example, to a charging current through the capacitor 23 for the NAND Schmitt trigger 14. The NAND Schmitt trigger 14 is in this state with a positive output potential via the inverting NAND Schmitt trigger 13 held at its first entrance 18.

Während dieser Zeit kann sich der zuvor durch einen Impuls von dem invertierenden Schmitt-Trigger 3 geladenen HDndensator 22 über den Entladewiderstand 26 entladen.During this time, the previous may be affected by an impulse from the inverting Schmitt trigger 3 charged HDndensator 22 via the discharge resistor 26 unloaded.

Die Schaltungsanordnung ist erst dann wieder zum erneuten Triggern durch einen Impuls am Ausgang des Schmitt-Triggers 3 bereit, wenn der Kondensator 22 entladen ist, so dass der nächste Impuls von dem Schmitt-Trigger 3 das Potential an dem zweiten Eingang 18' des NAND-Schmitt-Triggers 13 absenken kann. Damit stellen sich die analog umgekehrten Verhältnisse wie voranstehend beschrieben ein.The circuit arrangement is only then ready to be triggered again by a pulse at the output of the Schmitt trigger 3 ready when the capacitor 22 is discharged, so that the next pulse from the Schmitt trigger 3 has the potential at the second input 18 'of the NAND-Schmitt trigger 13 can decrease. So ask the analogously reversed conditions as described above arise.

Es wird also stets einer der beiden Kondensatoren 22, 23 über einen der Entladewiderstände 26, 27 entladen,und die Schaltungsanordnung lässt sich erst dann wieder in einen neuen Zustand zur Erzeugung eines Ausgangsimpulses an der Klemme A durch einen Impuls von dem Schmitt-Trigger 3 einstellen, wenn einer der beiden Kondensatoren 22, 23 ent--laden ist.So it is always one of the two capacitors 22, 23 via one the discharge resistors 26, 27 are discharged, and the circuit arrangement can only be then back into one new state for generating an output pulse at terminal A by a pulse from the Schmitt trigger 3, if one of the two capacitors 22, 23 is discharged.

Daraus ergibt sich, dass nur bei jedem zweiten Impuls von dem Schmitt-Trigger 3 ein Ausgangsimpuls an der Klemme A auftritt und auch nur dann, wenn zwischen je zwei Impulsen von dem Schmitt-Trigger 3 eine genügend lange der Monozeit entsprechende Zeit aufgetreten ist, in der sich einer der Kondensatoren 22, 23 entladen konnte.It follows that only every second pulse from the Schmitt trigger 3 an output pulse occurs at terminal A and only if between each two pulses from the Schmitt trigger 3 a sufficiently long corresponding to the mono time Time has occurred in which one of the capacitors 22, 23 could discharge.

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Claims (6)

Patentansprüche 1. Schaltungsanordnung zur Aufbereitung von Signalen, die für Meß- oder Erfassungszwecke insbesondere mit einem Kombinationsinstrument eines Kraftfahrzeugs in einen Mikrocomputer eingespeist werden, mit einem mit den Signalen beaufschlagten, nicht retriggerbaren Monoflop, dem gegebenenfalls ein Schmitt-Trigger vorgeschaltet ist, dadurch gekennzeichnet, dass das nicht retriggerbare Monoflop durch ein NAND-Schmitt-Trigger (7) mit einem mit dessen Ausgang in Verbindung stehenden, über einen Ladewiderstand (10) aufladbaren Kondensator (9) ersetzt ist, von dem ein Geaenkopplungswiderstand (11) zu einem ersten Eingang des NAND-Schmitt-Triggers zurückgeführt ist, derart, dass der NAND-Schmitt-Trigger so lange nicht durch einen Impuls an seinem zweiten Eingang (6) triggerbar ist (Monozeit), wie seine Schaltschwelle während des Ladtns des Kondensators (9) nicht überschritten ist. Claims 1. Circuit arrangement for processing signals, those for measuring or recording purposes, in particular with a combination instrument of a motor vehicle are fed into a microcomputer, with one with the Signals applied, non-retriggerable monoflop, to which a Schmitt trigger if necessary is connected upstream, characterized in that the non-retriggerable monoflop by a NAND-Schmitt trigger (7) with one of its output connected, A capacitor (9) that can be charged via a charging resistor (10) is replaced by the a coupling resistor (11) to a first input of the NAND Schmitt trigger is fed back in such a way that the NAND Schmitt trigger is not triggered by a Pulse at its second input (6) can be triggered (mono time), like its switching threshold is not exceeded while the capacitor (9) is being charged. 2. Schaltungsanordnung nach Anspruch 1, dadurch gekennzeichnet, dass der Kondensator über einen Inverter an den Ausgang des NAND-Schmitt-Triggers angeschlossen ist.2. Circuit arrangement according to claim 1, characterized in that the capacitor is connected to the output of the NAND Schmitt trigger via an inverter is. 3. Schaltungsanordnung nach Anspruch 1 oder 2, dadurch gekennzeichnet, dass der als nicht retriggerbares Monoflop geschaltete NAND-Schmitt-Trigger (7) an den Ausgang des vorgeschalteten Schmitt-Triggers (3) über einen Koppelkondensator (4) gekoppelt ist.3. Circuit arrangement according to claim 1 or 2, characterized in that that the NAND Schmitt trigger (7) switched as a non-retriggerable monoflop to the output of the upstream Schmitt trigger (3) via a coupling capacitor (4) is coupled. 4. Schaltungsanordnung zur Aufbereitung von Signalen, die für Meß- oder Erfassungszwecke insbesondere für die Erfassung von Geschwindigkeit und zurückgelegte Wegstrecke in einen Mikrocomputer eingespeist werden, mit einem mit den Signalen beaufschlagten, nicht retriggerbaren Monoflop, dem gegebenenfalls ein Schmitt-Trigger vorgeschaltet ist, sowie mit einem Frequenzteiler, dadurch gekennzeichnet, dass zwei NAND-Schmitt-Trigger (13, 14) mit je einem ersten Eingang (17, 18) und einem Ausgang (15, 16) in der Art von Flip-Flops gegengekoppelt sind, dass je ein zweiter Eingang (18', 19) über je einen Widerstand (20, 21) mit einer Vorspannungsquelle verbunden ist und über je einen Kondensator (22,23) mit den aufzubereitenden und/üntersetzenden Signalen beaufschlagbar ist und dass jeder Kondensator (22, 23) über je einen Entladewiderstand (26, 27) an den ersten Eingang (18', 19) des zugehörigen NAND-Schmitt-Triggers (13, 14) angeschlossen ist.4.Circuit arrangement for processing signals that are used for measuring or acquisition purposes, in particular for the acquisition of speed and distance traveled Distance fed into a microcomputer, with one with the signals applied, non-retriggerable monoflop to which a Schmitt trigger may be added is connected upstream, as well as with a frequency divider, characterized in that two NAND Schmitt triggers (13, 14) each with a first input (17, 18) and one Output (15, 16) are fed back in the manner of flip-flops that a second each Input (18 ', 19) each via a resistor (20, 21) with a bias voltage source is connected and each with a capacitor (22,23) to the processed and / Üntersetzenden Signals can be acted upon and that each capacitor (22, 23) has a respective discharge resistor (26, 27) to the first input (18 ', 19) of the associated NAND Schmitt trigger (13, 14) is connected. 5. Schaltungsanordnung nach Anspruch 4, d a d u r c h g e k e n n z e i c h n e t dass jeder Kondensator (22, 23) über eine entkoppelnde Diode ( 24, 25) an den Ausgang des vorgeschalteten Schmitt-Triggers (3) angeschlossen ist, der mit den aufzubereitenden und zu untersetzenden Impulsen gespeist wird.5. Circuit arrangement according to claim 4, d a d u r c h g e k e n n shows that each capacitor (22, 23) has a decoupling diode (24, 25) is connected to the output of the upstream Schmitt trigger (3), the is fed with the pulses to be processed and reduced. 6. Schaltungsanordnung nach einem der Ansprüche 1 bis 5, dadurch gekennzeichnet, dass die NAND-Schmitt-Trigger (7, 13, 14) und der vorgeschaltete Schmitt-Trigger (3) als CMOS-Gatter ausgebildet sind.6. Circuit arrangement according to one of claims 1 to 5, characterized in that that the NAND Schmitt trigger (7, 13, 14) and the upstream Schmitt trigger (3) are designed as CMOS gates.
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Cited By (2)

* Cited by examiner, † Cited by third party
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DE3913901A1 (en) * 1989-04-27 1990-10-31 Kloeckner Humboldt Deutz Ag IC engine measurand transmission and digitising method - converting measured value to pulse density signal for transmission
DE4319383C1 (en) * 1993-06-11 1994-09-08 Apag Elektronik Ag Duebendorf Input circuit for a pulse counter

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