DE2737166C2 - Method and circuit arrangement in a television picture receiver for suppressing the interline position, which can be switched off - Google Patents
Method and circuit arrangement in a television picture receiver for suppressing the interline position, which can be switched offInfo
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- H04N5/00—Details of television systems
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- H04N5/12—Devices in which the synchronising signals are only operative if a phase difference occurs between synchronising and synchronised scanning devices, e.g. flywheel synchronising
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Description
ratoren zur Erzeugung der Sychronisationsimpulse noch über andere Schaltungsanordnungen wie z. B. Zeilenzählanordnungen zur Ableitung dieser Impulse verfügtRators to generate the synchronization pulses via other circuit arrangements such. B. Line counting arrangements for deriving these pulses has
Aufgabe der Erfindung ist es daher, ein übliches Fernsehheüngerät sowohl für den Empfang von Fernsehsendungen als auch zur Darstellung alphanumerischer Zeichen und Grafiken, wobei zur Unterdrückung des Flackerns die beiden Fernsehhalbbilder aufeinander geschrieben werden, zu nutzen. Diese wahlweise Verwendung soll mit einfachen Mitteln durchführbar und schnell umschaltbar sein.The object of the invention is therefore to provide a conventional television set for both receiving TV broadcasts and for the display of alphanumeric characters and graphics, whereby for suppression of the flickering the two television fields are written on top of each other. This optional Use should be feasible with simple means and quickly switchable.
Die Lösung erfolgt mit den in den Ansprüchen angegebenen Mitteln.The solution takes place with the means specified in the claims.
Die Erfindung wii-d nun anhand der Figuren näher beschrieben.The invention will now be described in more detail with reference to the figures described.
F i g. 1 zeigt ausschnittsweise einige Horizontal- und Vertikalsynchronisationsimpulse über der Zeit aufgetragen. In denF i g. FIG. 1 shows a few excerpts of some horizontal and vertical synchronization pulses plotted against time. In the
Fig.2 und 3 sind erfindungsgemäße Echaltungsan-Ordnungen dargstellLFIGS. 2 and 3 are switching arrangements according to the invention shown
In F i g. J a werden einige digitalisierte Horizontalsynchroniöationsimpulse Z625 (vom letzten Bild), Zl- Z6(vom neuen ersten Halbbild)und Z313—Z317 (vom zweiten neuen Halbbild) wiedergegeben. Darunter sind in Fig. Ib ebenfalls digitalisierte, den Binärpegel »0« oder »1« annehmende Vertikalsynchronisationsimpulse Vl und V 2 dargestellt. Die Vertikalsynchronisationsimpulse sind 2V2 Zeilen lang und beginnen in Zeile 1 bzw. Mitte der Zeile 313. Die Darstellungsweise der Synchronisationsimpulse in F i g. 1 a und 1 b ist idealisiert, d. h. die Impulse können in der dargestellten Form nur bei Verwendung digitalisierter Schaltkreise im Heimbildempfangsgerät aus dem empfangenen Videosignal gewonnen werden. Bei Verwendung üblicher Schaltkreise treten an den Ausgängen der Impulsabtrennstufe IA Vertikalsynchronisationsimpulse nach Fig. 1 d bzw. Horizontalsynchronisationsimpulse nach Fig. Ie auf. Die Fig. Ic und Ig stellen Zeitachsen t mit einigen markanten Zeitpunkten dar. Die idealen Bildsynchronisationszeitpunkte, wie sie bei Verwendung digitaler Schaltkreise ermöglicht werden, sind die Zeitpunkte 11 für das erste Halbbild und tm (Mitte der Zeile Z313) für das zweite Halbbild. Bildsynchronisationszeitpunkte gemäß der Erfindung sind 11 für das erste Halbbild und ^, ί 314 für das zweite Halbbild, wodurch das 312 Zeilen umfassende zweite Halbbild auf das 313 Zeeilen umfassende erste Halbbild derart geschrieben wird, daß die erste bzw. die letzte Zeile des ersten Halbbildes frei bleibt.In Fig. Yes, some digitized horizontal synchronization pulses Z625 (from the last picture), Z1-Z6 (from the new first field) and Z313-Z317 (from the second new field) are reproduced. Underneath, digitized vertical synchronization pulses V1 and V2 that assume the binary level “0” or “1” are shown in FIG. 1b. The vertical synchronization pulses are 2V2 lines long and begin in line 1 or in the middle of line 313. The representation of the synchronization pulses in FIG. 1 a and 1 b is idealized, ie the pulses can only be obtained from the received video signal in the form shown when using digitized circuits in the home image receiving device. When conventional circuits are used, vertical synchronization pulses according to FIG. 1d or horizontal synchronization pulses according to FIG. 1e occur at the outputs of the pulse separation stage IA. FIGS. Ic and Ig provide time axis t with some prominent points in time. The ideal image synchronization times as they are made possible with the use of digital circuits, the time points 1 1 for the first field and tm (middle of the line Z313) are for the second field. Image synchronization times according to the invention are 1 1 for the first field and , ί 314 for the second field, whereby the 312 line second field is written on the 313 line first field in such a way that the first and the last line of the first field remains free.
In der Praxis haben die Vertikalsychronisationsimpulse die Form nach F i g. Id, und der Synchronisationszeitpunkt wird durch das Überschreiten der Triggerschwel· le TS bestimmt. Die Synchronisation nach dem Zeilensprungverfahren erfolgt dadurch ers1 zu den Zeitpunkten t Γ und t W. In practice, the vertical synchronization pulses have the form according to FIG. Id, and the synchronization time is determined by exceeding the trigger threshold TS . The interlaced synchronization takes place ers 1 at times t Γ and t W.
Nach der Erfindung werden Vertikal- und Horizontalsynchronisationsimpulse überlagert, diese Überlagerung ist der Fig. If zu entnehmen. Bildsynchronisationszeitpunkte sind die Zeitpunkte r I für das erste Halbbild bo und Ml für das zweite Halbbild. In beiden Fällen wird die Triggerschwelle TS durch die Spitze der die Vertikalsynchronisationsimpulse überlagernden Horizontalsynchronisationsirnpulse überschritten, wodurch die beiden Halbbilder aufeinander geschrieben werden. h r, According to the invention, vertical and horizontal synchronization pulses are superimposed; this superimposition can be seen from FIG. If. Image synchronization times are times r I for the first field b o and Ml for the second field. In both cases, the trigger threshold TS is exceeded by the peak of the horizontal synchronization pulse superimposed on the vertical synchronization pulses, as a result of which the two fields are written on top of one another. h r ,
Die F i g. 2 zeigt die erfindungsgemäße Schaltungsanordnung für ein Bildempfangsgerät, das digitale SvnchronisationsimDulse liefert. Das (F)BAS-\f\deosignal durchläuft ein Amplituden^leb AS und gelangt in eine Impulsabtrennstufe IA, die am Ausgang AHS digitale Horizontalsynchronisationsimpulse an den Horizontaltreiber HT und am Ausgang A VS digitale Veritkalsynchronisationsimpulse abgibt Die Überlagerung der beiden Synchronisationsimpulse erfolgt nun über ein Oderglied O, das über den einen Eingang die Horizontalsynchronisationsimpulse wirksam durchläßt, wenn am anderen Eingang über einen Schalter S ein Binärsignal »0« angelegt ist, und ein Undglied U, das an seinem Ausgang ein Binärsignal »1« liefert, wenn an seinen beiden Eingängen beide Synchronisationsimpulse den Binärpegel »1« aufweisen. Das Undglied U stößt eine monostabile Kippstufe Λ/Fan, die einen Vertikaloszillator VO, der eine Vertikalablenkschaltung VA speist, an seinem Triggereingang E synchronisiert Wird der Schalter S auf das Binärsignal »1« umgeschaltet, so werden die Horizontalsynchronisationsimpulse am Ausgang des Odergliedes O unwirksam und es wird somit nur auf den Vertikalsynchronisationsimpuls d. h. nach dem üblichen Zeilensprungverfahren synchronisiert. The F i g. 2 shows the circuit arrangement according to the invention for an image receiving device which supplies digital synchronization in pulses. The (F) BAS- \ f \ deo signal passes through an amplitude ^ leb AS and arrives at a pulse separator IA, which sends digital horizontal synchronization pulses to the horizontal driver HT at output AHS and digital vertical synchronization pulses at output A VS.The two synchronization pulses are now superimposed via an OR element O, which effectively allows the horizontal synchronization pulses to pass through one input when a binary signal "0" is applied to the other input via a switch S, and an AND element U, which supplies a binary signal "1" at its output if both of them Inputs both synchronization pulses have the binary level "1". The AND element U pushes a monostable multivibrator Λ / Fan, which synchronizes a vertical oscillator VO, which feeds a vertical deflection circuit VA , at its trigger input E. If the switch S is switched to the binary signal "1", the horizontal synchronization pulses at the output of the OR element O become ineffective and it is therefore only synchronized to the vertical synchronization pulse, ie using the usual interlace method.
Die F i g. 3 schließlich zeigt eine erfindungsgemäße Schaltungsanordnung für heute gebräuchliche Fernsehbildempfänger. Das (F)BAS-V\aeos\%na\ durchläuft ein Amplitudensieb A und wird anschließend in einer Impulsabtrennstufe IA in die Synchronisationsimpule der Form nach Fig. Id bzw. Ie zerlegt. Der am Ausgang A VS' anstehende Vertikalsynchronisationsimpuls wird über einen Widerstand R 1 auf den Triggereingang E eines Vertikaloszillators VO geleitet, der eine Vertikalablenkstufe VA speist Am Ausgang AHS'der Impulsabtrennstufe IA anstehende Horizontalsynchronisationsimpulse gelangen einerseits in eine Horizontaltreiberstufe HTund andererseits erfindungsgemäß über einen Widerstand R 2 und einen Koppelkondensator C ebenfalls auf den Eingang fdes Vertikaloszillators VO, sofern der npn-Transistor Ts, der mit seinem Kollektor am gemeinsamen Punkt von Widerstand R 2 und Kondensator C, mit seinem Emitter an Massepotential und mit seiner Basis über den Widerstand R 3 ebenfalls an Massepotential liegt, sperrend gesteuert ist. Das ist der Fall, wenn am Punkt P, der über einen Widerstand /?4 mit der Basis des Transistors 7s verbunden ist, Massepotential angelegt wird. Dann werden die Horizontalsynchronisationsimpulse bei entsprechender, den Bildempfängertypen angepaßten Dimensionierung der Widerstände Ri, R 2 und des Kondensators C erfindungsgemäß so den Vertikalsychronisationsimpulsen überlagert, daß eine Bildsynchronisation zu den Zeitpunkten fl bzw. rll erfolgt, wodurch die beiden Halbbilder aufeinander geschrieben werden. Wird dagegen an dem Punkt P ein positives Potential angelegt, so daß der Transistor fs leitend gesteuert wird, so werden die Horizontalsynchronisationsimpulse über den Widerstand R 2 und den Transistor 7s nach Erde abgeleitet, und es erfolgt eine Bildsynchronisation allein durch den Vertikalsynchronisationsimpulr zum Zeitpunkt f Γ bzw. t ΙΓ, d.h. die beiden Halbbilder werden mit Zeilensprung ineinander geschrieben.The F i g. Finally, FIG. 3 shows a circuit arrangement according to the invention for television picture receivers in use today. The (F) BAS-V \ aeos \% na \ passes through an amplitude sieve A and is then broken down in a pulse separation stage IA into the synchronization pulses of the form according to Fig. Id or Ie. The 'present at the output A VS vertical synchronization pulse is fed via a resistor R 1 to the trigger input E of a vertical oscillator VO, a vertical deflection VA supplied at the output AHS'der Impulsabtrennstufe IA pending horizontal synchronizing pulses pass on the one hand to a horizontal driver stage HTund other hand, according to the invention via a resistor R 2 and a coupling capacitor C also to the input f of the vertical oscillator VO, provided that the npn transistor Ts, which has its collector at the common point of resistor R 2 and capacitor C, its emitter to ground potential and its base via resistor R 3 also to Ground potential is, is controlled blocking. This is the case when ground potential is applied to point P, which is connected to the base of transistor 7s via a resistor /? 4. Then, according to the invention, the horizontal synchronization pulses are superimposed on the vertical synchronization pulses with appropriate dimensioning of the resistors Ri, R 2 and the capacitor C adapted to the types of image receivers so that an image synchronization takes place at the times fl and rll, whereby the two fields are written on top of each other. If, on the other hand, a positive potential is applied to the point P so that the transistor fs is made conductive, the horizontal synchronization pulses are diverted to earth via the resistor R 2 and the transistor 7s, and the image is synchronized solely by the vertical synchronization pulse at time f Γ or t ΙΓ, ie the two fields are interlaced with one another.
Der Vorteil der Erfindung ist darin zu sehen, daß mit einfachen Mitteln und ohne aufwendige zusätzliche Schaltungsanordnungen wie Horizontal- und Vertikalsynchronisationsirnpulsgeneratoren oder Zeilenzählanoro.iungen mit einem üblichen Heimfernsehempfangsgerät sowohl nochmals Fengrnsehsendungen nach dem genormten Bildsynchronisationsverfahren empfanget! als auch alphanumerische Texte oder Grafiken, dieThe advantage of the invention is to be seen in the fact that with simple means and without expensive additional Circuit arrangements such as horizontal and vertical synchronization pulse generators or line counting with a standard home television receiver both again TV broadcasts received according to the standardized picture synchronization process! as well as alphanumeric text or graphics that
durch neue Telekommunikationsdienste wie Videotext (CEEFAX, ORACLE, NBS, HRI, IDR) und Bildschirmtext (Viewdate, TV-Phone) angeboten werden, nach dem erfindungsgemäßen Bildsynchronisationsverfahren flackerfrei dargestellt werden können und daß eine einfache, schnelle Umschaltmöglichkeit vorliegt, die letztlich auch automatisch bei Beginn bzw. bei Ende der Textsendung genutzt werden kann.through new telecommunications services such as teletext (CEEFAX, ORACLE, NBS, HRI, IDR) and teletext (Viewdate, TV-Phone) are offered according to the image synchronization method according to the invention can be displayed flicker-free and that there is a simple, quick switchover option, the can ultimately also be used automatically at the beginning or at the end of the text transmission.
Hierzu 2 Blatt Zeichnungen For this purpose 2 sheets of drawings
Claims (5)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE19772737166 DE2737166C2 (en) | 1977-08-18 | 1977-08-18 | Method and circuit arrangement in a television picture receiver for suppressing the interline position, which can be switched off |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE19772737166 DE2737166C2 (en) | 1977-08-18 | 1977-08-18 | Method and circuit arrangement in a television picture receiver for suppressing the interline position, which can be switched off |
Publications (2)
Publication Number | Publication Date |
---|---|
DE2737166A1 DE2737166A1 (en) | 1979-02-22 |
DE2737166C2 true DE2737166C2 (en) | 1982-06-03 |
Family
ID=6016662
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE19772737166 Expired DE2737166C2 (en) | 1977-08-18 | 1977-08-18 | Method and circuit arrangement in a television picture receiver for suppressing the interline position, which can be switched off |
Country Status (1)
Country | Link |
---|---|
DE (1) | DE2737166C2 (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE3312097A1 (en) * | 1983-04-02 | 1984-10-11 | Deutsche Thomson-Brandt Gmbh, 7730 Villingen-Schwenningen | IMAGE DISPLAY ARRANGEMENT FOR TEXT FADING IN, IN PARTICULAR MIX AND BOX OPERATION |
-
1977
- 1977-08-18 DE DE19772737166 patent/DE2737166C2/en not_active Expired
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE3312097A1 (en) * | 1983-04-02 | 1984-10-11 | Deutsche Thomson-Brandt Gmbh, 7730 Villingen-Schwenningen | IMAGE DISPLAY ARRANGEMENT FOR TEXT FADING IN, IN PARTICULAR MIX AND BOX OPERATION |
Also Published As
Publication number | Publication date |
---|---|
DE2737166A1 (en) | 1979-02-22 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
8110 | Request for examination paragraph 44 | ||
D2 | Grant after examination | ||
8363 | Opposition against the patent | ||
8327 | Change in the person/name/address of the patent owner |
Owner name: AEG-TELEFUNKEN NACHRICHTENTECHNIK GMBH, 7150 BACKN |
|
8327 | Change in the person/name/address of the patent owner |
Owner name: ANT NACHRICHTENTECHNIK GMBH, 7150 BACKNANG, DE |
|
8320 | Willingness to grant licences declared (paragraph 23) | ||
8331 | Complete revocation |