DE19935131B4 - Method for eliminating redepositions from a wafer - Google Patents
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Abstract
Die Erfindung betrifft ein Verfahren zur Beseitigung von Redepositionen auf einem Wafer sowie einen Wafer, der frei von Redepositionen ist. Die Entfernung der Redepositionen am Wafer findet nach Aufbringung einer Schutzschicht auf der Topelektrode und den Grenzflächen der Topelektrode mit dem Dielektrikum statt, so daß diese Bereiche durch die naßchemischen Mittel, durch die die Redepositionen einzig wirkungsvoll beseitigt werden können, nicht beschädigt werden.The invention relates to a method for eliminating speech positions on a wafer as well as a wafer that is free of speech positions. The removal of the redepositions on the wafer takes place after application of a protective layer on the top electrode and the interfaces of the top electrode with the dielectric, so that these areas are not damaged by the wet chemical means by which the redepositions can only be effectively removed.
Description
Die Erfindung betrifft ein Verfahren zur Beseitigung von Redepositionen auf einem Wafer.The The invention relates to a method for eliminating speech positions on a wafer.
Bei der plasmachemischen Ätzung einer Schicht eines (ferroelektrischen) Speicherkondensators mit einer Lackmaske und reaktiven Gasen bilden sich in der Regel Redepositionen. So werden Seitenwandpolymere aus Bestandteilen der zu ätzenden Schichten, dem Lack und den Ätzgasen bezeichnet. Diese Verunreinigungen können die Höhe der Lackmaske erreichen. Werden sie auf der geätzten Struktur belassen, so können folgende Probleme auftauchen:
- – Kontamination des Speicherdielektrikums durch Diffusion
- – Kurzschluß bei leitfähigen Redepositionen
- – Veränderung der Topologie des Bauelements.
- - Contamination of the storage dielectric by diffusion
- - Short circuit in conductive redepositions
- - Change the topology of the device.
Redepositionen, die sich nach dem plasmachemischen Ätzen der Bottomelektrode gebildet haben, werden naßchemisch entfernt. Dies ist möglich, da der Schichtaufbau Träger, Barriereschicht und Bottomelektrode so stabil ist, daß er den naßchemischen Reinigungsschritt verträgt.Redepositions, which formed after the plasma-chemical etching of the bottom electrode have become wet chemical away. This is possible because the layer structure carrier, Barrier layer and bottom electrode is so stable that he wet chemical Cleansing step tolerates.
Die Entfernung von Redepositionen, die sich nach dem Plasmaätzen des Dielektrikums gebildet haben, wäre naßchemisch, d.h. durch Einwirkung von hydroxylhaltigen Strippern (wie EKC-265®), organischen Lösungsmitteln (wie NMP (N-methyl pyrrolidon) und/oder Säuren (wie HF, Flußsäure, BHF, Ammoniumfluorid, gepufferte HF oder Caro'sche Säure, H2SO4 und H2O2) oder Entwickler (z.B. 5% Tetramethylammoniumhydroxid in H2O) entfern- oder reduzierbar, jedoch ist diese Behandlung nicht empfehlenswert, weil es dabei zur Ablösung der Topelektrode und/oder des ganzen Waferaufbaus kommen kann.The removal of redpositions formed after the plasma etch of the dielectric would be wet-chemical, ie by the action of hydroxyl-containing strippers (such as EKC- 265® ), organic solvents (such as NMP (N-methyl pyrrolidone) and / or acids (such as HF , Hydrofluoric acid, BHF, ammonium fluoride, buffered HF or Caro's acid, H 2 SO 4 and H 2 O 2 ) or developer (eg 5% tetramethylammonium hydroxide in H 2 O) can be removed or reduced, but this treatment is not recommended because it can come to the replacement of the top electrode and / or the entire wafer structure.
Im übrigen ist
aus
Aufgabe der vorliegenden Erfindung ist es, ein Verfahren zur Beseitigung von Redepositionen, insbesondere auf einer dielektrischen Schicht, zu schaffen, bei dem der Schichtaufbau am Wafer unbeschädigt bleibt.task The present invention is a method for elimination of speech positions, in particular on a dielectric layer, to create, in which the layer structure on the wafer remains undamaged.
Diese Aufgabe wird erfindungsgemäß gelöst durch ein Verfahren zur Beseitigung von Redepositionen, die aus der Trockenätzung eines oxidkeramischen Ferro- oder Dielektrikums mit einer Lackmaske stammen, von einem Wafer, auf dem ein Speicherkondensator mit einer Bottomelektrode, mit einem Ferro- oder Dielektrikum und mit einer strukturierten Topelektrode angeordnet ist,
- – wobei eine Trockenätzung und ein nasschemischer Reinigungsschritt, der zur Beseitigung der Redepositionen führt, durchgeführt werden und
- – wobei nach dem Ätzen des Ferro- oder Dielektrikums die Lackmaske entfernt wird,
- - wherein a dry etching and a wet chemical cleaning step, which leads to the elimination of the Redepositionen, are performed, and
- Wherein after the etching of the ferro- or dielectric the lacquer mask is removed,
Bei einer bevorzugten Ausgestaltung des Verfahrens ist die Schutzschicht aus Siliziumnitrid. Bevorzugt wird das wasserstoffarme LPCVD-Nitrid verwendet. Geeignet sind aber auch andere Nitride, wie z.B. ein Plasmanitrid, das mit einer P5000 abgeschieden wird. Die Höhe der aufgebrachten Schicht kann variieren, jedoch wird generell an eine Höhe zwischen 10 und 100nm, bevorzugt zwischen 15 und 80 nm und insbesondere bevorzugt zwischen 30 und 50 nm gedacht. Die Höhe sollte so bemessen sein, daß die Topelektrode und die Grenzflächen zum Dielektrikum zwar optimal geschützt sind, aber Gesamtstärke und Streß des Wafers im Falle der Beibehaltung der Schutzschicht nicht zu stark beeinflußt werden. Andererseits soll die Schicht leicht wieder entfernbar bleiben für den Fall, daß die Schutzschicht nach der Entfernung der Redepositionen auch entfernt wird. Im Grunde wird also immer eine möglichst dünne Schutzschicht angestrebt.at A preferred embodiment of the method is the protective layer made of silicon nitride. Preferably, the low-hydrogen LPCVD nitride is used. However, other nitrides, such as e.g. a plasma nitride, which is deposited with a P5000. The height of the applied layer can vary, but is generally preferred at a height between 10 and 100nm between 15 and 80 nm, and more preferably between 30 and 50 nm thought. The height should be such that the Top electrode and the interfaces Although the dielectric are optimally protected, but total strength and Stress of Wafers in case of retention of the protective layer is not too strong affected become. On the other hand, the layer should remain easily removable again for the Case, that the Protective layer also removed after the removal of the redepositions becomes. Basically, therefore, the goal is always to have the thinnest possible protective layer.
Nach einer Ausgestaltung wird die Schutzschicht vor dem Ätzen, bei dem die Redepositionen entstehen, aufgebracht. In diesem Fall wird die Schutzschicht zusammen mit dem Ferro- oder Dielektrikum auch mitgeätzt.To In one embodiment, the protective layer before the etching, at the speech positions arise. In this case will the protective layer also etched together with the ferro- or dielectric.
Bevorzugt wird die Entfernung der Redepositionen mit EKC-265 oder einem ähnlichem Stripper vollzogen. Die Behandlungszeit kann variieren, beträgt jedoch in der Regel weniger als eine Stunde, insbesondere weniger als 30 Minuten. Die Temperatur kann ebenfalls variieren, jedoch beträgt sie normalerweise weniger als 80°C und ist höher als Raumtemperatur.Prefers will be the removal of the redepositions with EKC-265 or a similar one Stripper completed. The treatment time may vary, but is usually less than an hour, especially less than 30 Minutes. The temperature can also vary, but it is usually less than 80 ° C and is higher as room temperature.
Nach einer Ausgestaltung des Verfahrens wird die Schutzschicht nach dem Entfernen der Redepositionen zur Siliziumoxidschicht aufoxidiert und/oder entfernt. Zum Entfernen eignet sich ein Plasmaprozeß, bevorzugt wird hierbei ein isotro per Downstream-Reaktor vom Typ Strata eingesetzt, der mit einer Sauerstoff-Tetrafluormethan-Chemie betrieben wird. Alternativ kann auch eine Plasmaätzkammer, z.B. eine MxP metal etch kammer an einem P5000 Mainframe, verwendet werden. Beispielhafte Plasmaätzbedingungen sind dann 20 Pa, 6 mT, 350 W, 45 sccm Tetrafluormethan-Fluss, 90 sccm Sauerstoff-Fluss; Ätzzeit für 50 nm Siliziumnitrid beträgt etwa 50 sec.According to one embodiment of the method, the protective layer is oxidized and / or removed after the removal of the redepositions to the silicon oxide layer. A plasma process is suitable for removal, preferably an isotropic downstream type Strata reactor which operates with an oxygen-tetrafluoromethane chemistry ben will. Alternatively, it is also possible to use a plasma etching chamber, for example an MxP metal etch chamber on a P5000 mainframe. Exemplary plasma etching conditions are then 20 Pa, 6 mT, 350 W, 45 sccm tetrafluoromethane flow, 90 sccm oxygen flow; Etching time for 50 nm silicon nitride is about 50 sec.
Nach einer anderen Ausgestaltung des Verfahrens wird die Schutzschicht auf dem Wafer belassen. Dort kann sie dann unter Umständen als Wasserstoffbarriere über dem Kondensator in späteren Prozessen dienen.To Another embodiment of the method becomes the protective layer left on the wafer. There she may then as Hydrogen barrier over the capacitor in later processes serve.
Nach einer Ausgestaltung des Verfahrens wird die Schutzschicht zusammen mit dem Dielektrikum geätzt. Dazu werden zunächst mit einer Lackmaske Strukturen definiert. Bei dieser gemeinsamen Ätzung kann eine MxP Metal Ätzkammer an einem P5000 mainframe verwendet werden. Beispielhafte Plasmaätzbedingungen sind 1,3 Pa, 8 mT, 750 W, 50 sccm Bromwasserstoff-Fluss, Ätzzeit für 50nm Nitrid und 180nm SBT etwa 150 sec.To In one embodiment of the method, the protective layer is combined etched with the dielectric. To do this first Defined with a resist mask structures. In this common etching can a MxP metal etching chamber to be used on a P5000 mainframe. Exemplary plasma etching conditions are 1.3 Pa, 8 mT, 750 W, 50 sccm of hydrogen bromide flux, etch time for 50nm nitride and 180nm SBT about 150 sec.
Nach einer anderen Ausgestaltung des Verfahrens wird die Schutzschicht getrennt von dem Ätzschritt des Dielektrikums geätzt, so dass zwischen den beiden Ätzschritten die Gase und/oder andere Plasmabedingungen geändert werden können.To Another embodiment of the method becomes the protective layer separated from the etching step etched of the dielectric, so that between the two etching steps the gases and / or other plasma conditions can be changed.
Bevorzugt handelt es sich bei dem durch das erfindungsgemäße Verfahrend behandelten Substrat um einen Wafer mit ferroelektrischen Speicherkondensatoren. Dabei ist bevorzugt SBT (SrBi2Ta2O9) das enthaltene Dielektrikum, das durch die Schutzschicht vor Schäden durch die nasschemische Reinigung geschützt werden soll. Anstelle des SBT können auch andere Oxidkeramiken wie beispielsweise BST [(Ba,Sr)TiO3) oder PZT [Pb(Zr,Ti)O3], die dem SBT ähnlich sind und auch durch den nasschemischen Reinigungsschritt gefährdet sind, mit einer Schutzschicht gemäß der Erfindung überzogen werden.Preferably, the substrate treated by the method according to the invention is a wafer with ferroelectric storage capacitors. In this case, SBT (SrBi 2 Ta 2 O 9 ) is preferably the dielectric that is to be protected by the protective layer against damage by wet-chemical cleaning. Instead of the SBT, other oxide ceramics such as BST [(Ba, Sr) TiO 3 ) or PZT [Pb (Zr, Ti) O 3 ], which are similar to the SBT and also endangered by the wet-chemical cleaning step, may be provided with a protective layer according to coated the invention.
Da die Redepositionen aus der Trockenätzung einer Oxidkeramik stammen, ähneln sie dieser in ihrer chemischen Zusammensetzung. Ein Reinigungsmedium, das die Redepositionen entfernt, kann deshalb die Oxidkeramik auch angreifen oder zumindest schädigen.There The redepositions come from the dry etching of an oxide ceramic, they resemble this in its chemical composition. A cleaning medium, that removes the redepositions, therefore, the oxide ceramics can also attack or at least harm.
Die Schutzschicht gemäß der Erfindung schützt deshalb auch das Dielektrikum vor einem Angriff von der Oberseite.The Protective layer according to the invention therefore protects also the dielectric from attack from the top.
Im folgenden wird eine Ausführungsform anhand von Figuren näher erläutert:in the The following will be an embodiment on the basis of figures closer explains:
In
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Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6457479B1 (en) * | 2001-09-26 | 2002-10-01 | Sharp Laboratories Of America, Inc. | Method of metal oxide thin film cleaning |
Citations (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0250611B1 (en) * | 1986-06-21 | 1990-12-19 | Deutsche ITT Industries GmbH | Process for eliminating a patterned masking layer |
DE4034868C2 (en) * | 1990-11-02 | 1995-02-16 | Itt Ind Gmbh Deutsche | Process for selective metal deposition in the production of semiconductor components |
EP0786805A2 (en) * | 1996-01-26 | 1997-07-30 | Matsushita Electronics Corporation | Method of plasma etching a film made of one of a ferroelectric material, high dielectric constant material or platinum |
EP0865079A2 (en) * | 1997-03-13 | 1998-09-16 | Applied Materials, Inc. | A method for removing redeposited veils from etched platinum surfaces |
US5849639A (en) * | 1997-11-26 | 1998-12-15 | Lucent Technologies Inc. | Method for removing etching residues and contaminants |
DE19728474A1 (en) * | 1997-07-03 | 1999-01-07 | Siemens Ag | Electrode arrangement |
Family Cites Families (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5443688A (en) * | 1993-12-02 | 1995-08-22 | Raytheon Company | Method of manufacturing a ferroelectric device using a plasma etching process |
-
1999
- 1999-07-27 DE DE1999135131 patent/DE19935131B4/en not_active Expired - Fee Related
-
2000
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Patent Citations (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0250611B1 (en) * | 1986-06-21 | 1990-12-19 | Deutsche ITT Industries GmbH | Process for eliminating a patterned masking layer |
DE4034868C2 (en) * | 1990-11-02 | 1995-02-16 | Itt Ind Gmbh Deutsche | Process for selective metal deposition in the production of semiconductor components |
EP0786805A2 (en) * | 1996-01-26 | 1997-07-30 | Matsushita Electronics Corporation | Method of plasma etching a film made of one of a ferroelectric material, high dielectric constant material or platinum |
EP0865079A2 (en) * | 1997-03-13 | 1998-09-16 | Applied Materials, Inc. | A method for removing redeposited veils from etched platinum surfaces |
DE19728474A1 (en) * | 1997-07-03 | 1999-01-07 | Siemens Ag | Electrode arrangement |
US5849639A (en) * | 1997-11-26 | 1998-12-15 | Lucent Technologies Inc. | Method for removing etching residues and contaminants |
Non-Patent Citations (4)
Title |
---|
JP 11012682 A. In: Patent Abstracts of Japan * |
JP 11-12682 A. In: Patent Abstracts of Japan |
YOO, W.J. et.al.: Control of Etch Slope during etching of Pt in Ar/Cl¶2¶/O¶2¶ Plasmas. In: Jpn.J.Appl.Phys., Vol. 35, Part 1, No. 4B, April 1996, pp. 2501-4 * |
YOO, W.J. et.al.: Control of Etch Slope during etching of Pt in Ar/Cl2/O2 Plasmas. In: Jpn.J. Appl.Phys., Vol. 35, Part 1, No. 4B, April 1996, pp. 2501-4 |
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