DE19532989C1 - Multiplicative mixer with three or four-pole compensation stage - Google Patents
Multiplicative mixer with three or four-pole compensation stageInfo
- Publication number
- DE19532989C1 DE19532989C1 DE19532989A DE19532989A DE19532989C1 DE 19532989 C1 DE19532989 C1 DE 19532989C1 DE 19532989 A DE19532989 A DE 19532989A DE 19532989 A DE19532989 A DE 19532989A DE 19532989 C1 DE19532989 C1 DE 19532989C1
- Authority
- DE
- Germany
- Prior art keywords
- stage
- switching
- input
- compensation
- output
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B1/00—Details of transmission systems, not covered by a single one of groups H04B3/00 - H04B13/00; Details of transmission systems not characterised by the medium used for transmission
- H04B1/06—Receivers
- H04B1/16—Circuits
- H04B1/26—Circuits for superheterodyne receivers
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03D—DEMODULATION OR TRANSFERENCE OF MODULATION FROM ONE CARRIER TO ANOTHER
- H03D7/00—Transference of modulation from one carrier to another, e.g. frequency-changing
- H03D7/14—Balanced arrangements
- H03D7/1408—Balanced arrangements with diodes
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03D—DEMODULATION OR TRANSFERENCE OF MODULATION FROM ONE CARRIER TO ANOTHER
- H03D7/00—Transference of modulation from one carrier to another, e.g. frequency-changing
- H03D7/14—Balanced arrangements
- H03D7/1425—Balanced arrangements with transistors
- H03D7/1433—Balanced arrangements with transistors using bipolar transistors
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03D—DEMODULATION OR TRANSFERENCE OF MODULATION FROM ONE CARRIER TO ANOTHER
- H03D7/00—Transference of modulation from one carrier to another, e.g. frequency-changing
- H03D7/14—Balanced arrangements
- H03D7/1425—Balanced arrangements with transistors
- H03D7/1441—Balanced arrangements with transistors using field-effect transistors
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03D—DEMODULATION OR TRANSFERENCE OF MODULATION FROM ONE CARRIER TO ANOTHER
- H03D7/00—Transference of modulation from one carrier to another, e.g. frequency-changing
- H03D7/14—Balanced arrangements
- H03D7/1425—Balanced arrangements with transistors
- H03D7/1458—Double balanced arrangements, i.e. where both input signals are differential
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Superheterodyne Receivers (AREA)
Abstract
Description
Mischstufen werden in der Schaltungstechnik häufig eingesetzt, insbesondere zur Umsetzung der Frequenz eines Eingangssignals in einen anderen Frequenzbe reich; ein Hauptanwendungsfall hierzu ist in der Rundfunktechnik die Erzeugung der Zwischenfrequenz (die beispielsweise in superheterodynamischen Empfän gerstufen benötigt wird) aus dem HF-Eingangssignal. Mischstufen werden entwe der als einfach realisierbare additive Mischstufen ausgebildet - hier wird das Ein gangssignal zusammen mit einem Oszillatorsignal (LO-Signal) einer Schaltungs komponente mit nicht-linearer Kennlinie zugeführt und durch deren Nicht-Linea rität eine Vielzahl von Mischprodukten erzeugt - oder als multiplikative Misch stufen realisiert - hier wird durch eine kombinierte Schaltungsanordnung aus einer Verstärkerstufe (in der Regel Verstärkertransistoren) und einer Schaltstufe (in der Regel Schalttransistoren) eine echte Signalmultiplikation mit einem Oszillatorsi gnal vorgenommen. Da bei additiven Mischstufen eine Vielzahl unerwünschter Mischprodukte entstehen (insbesondere tritt die Oszillatorfrequenz am Schal tungsausgang auf), werden in einigen Frequenzbereichen bevorzugt multiplikative Mischstufen eingesetzt; die Standard-Konfiguration einer multiplikativen Misch stufe basiert auf der sogenannten Gilbert-Zelle, wie sie beispielsweise in der Lite raturstelle P. Gray, R. Meyer: "Analysis and Design of Analog Integrated Cir cuits", 3. Auflage, John Wiley & Sons, 1993, S. 670, beschrieben ist. Weiterhin wird in der DE 35 02 294 A1 ein Frequenzumsetzer mit einer Mischstufe und in der DE 26 08 939 A1 ein Mischer beschrieben, die jeweils eine Verstärkerstufe, eine Schaltstufe und einen Lokaloszillator aufweisen. Mixing stages are often used in circuit technology, especially for converting the frequency of an input signal into another frequency range; A main application of this in broadcast technology is the generation of the intermediate frequency (which is required, for example, in superheterodynamic receiver stages) from the RF input signal. Mixing stages are either designed as easy-to-implement additive mixing stages - here the input signal is fed together with an oscillator signal (LO signal) to a circuit component with a non-linear characteristic, and a variety of mixed products are generated through their non-linearity - or as multiplicative ones Mixing stages realized - here a real signal multiplication with an oscillator signal is carried out by a combined circuit arrangement of an amplifier stage (usually amplifier transistors) and a switching stage (usually switching transistors). Since additive mixer stages produce a large number of undesired mixing products (in particular the oscillator frequency occurs at the circuit output), multiplicative mixer stages are preferably used in some frequency ranges; the standard configuration of a multiplicative mixing stage is based on the so-called Gilbert cell, as described, for example, in the literature reference P. Gray, R. Meyer: "Analysis and Design of Analog Integrated Cuits", 3 . Edition, John Wiley & Sons, 1993, p. 670. Furthermore, DE 35 02 294 A1 describes a frequency converter with a mixer stage and DE 26 08 939 A1 a mixer, each of which has an amplifier stage, a switching stage and a local oscillator.
Ein generelles Problem bei Mischstufen ist die üblicherweise mit ZF/2-Störung bezeichnete Tatsache, daß infolge des Mischvorgangs die doppelte Oszillatorfre quenz gebildet und zum Eingang der Mischstufe rückgeführt wird; am Eingang der Mischstufe liegen neben dem erwünschten Eingangssignal (Nutzsignal) auch eine Reihe unerwünschter Signale (Störsignale) an - falls eines der Störsignale eine um die halbe Zwischenfrequenz vom Nutzsignal beabstandete Frequenz und eine ausreichende Amplitude aufweist, wird durch Intermodulation zweiter Ord nung dieses Störsignals mit dem Signal der doppelten Oszillatorfrequenz ein uner wünschtes Mischprodukt mit der Frequenz des Nutzsignals erzeugt, das das ge wünschte Nutzsignal am Eingang der Mischstufe überdecken kann.A general problem with mixing stages is that with ZF / 2 interference designated fact that due to the mixing process, the double oscillator fre quenz is formed and returned to the input of the mixer; at the entrance the mixer is next to the desired input signal (useful signal) a series of unwanted signals (interference signals) - if one of the interference signals a frequency spaced from the useful signal by half the intermediate frequency and has a sufficient amplitude, is by second order intermodulation voltage of this interference signal with the signal of twice the oscillator frequency Desired mixed product with the frequency of the useful signal that the ge can cover the desired useful signal at the input of the mixer.
Meistens werden die Auswirkungen der ZF/2-Störung mittels hochselektiver Ein gangsfilter lediglich gedämpft (jedoch nicht unterdrückt), wobei die Eingangsfilter zudem das Rauschverhalten negativ beeinflussen.Most of the time, the effects of the ZF / 2 disturbance are caused by highly selective on gangsfilter only attenuated (but not suppressed), the input filter also negatively influence the noise behavior.
Der Erfindung liegt die Aufgabe zugrunde, eine einfache multiplikative Mischstu fe anzugeben, bei der die negativen Auswirkungen der doppelten Oszillatorfre quenz ohne störende Effekte unterdrückt werden.The invention has for its object a simple multiplicative mixing stage fe to indicate where the negative effects of the double oscillator fre quenz be suppressed without disturbing effects.
Diese Aufgabe wird erfindungsgemäß durch die Merkmale im Kennzeichen des Patentanspruchs 1 gelöst.This object is achieved by the features in the characteristic of Claim 1 solved.
Vorteilhafte Weiterbildungen und Ausgestaltungen der Erfindung ergeben sich aus den Unteransprüchen.Advantageous further developments and refinements of the invention result from the subclaims.
Der Erfindung liegt die Erkenntnis zugrunde, daß das Eingangssignal am Eingang der Schaltstufe und das Ausgangssignal am Ausgang der Schaltstufe in differen tieller Form, d. h. als Gegentaktsignale vorliegen, während das Oszillatorsignal als Gleichtaktsignal vorliegt; daher müssen zur Kompensation der doppelten Oszilla torfrequenz Gleichtaktsignale beeinflußt werden - Gegentaktsignale sollten dage gen nicht beeinträchtigt werden. Bei der vorgestellten multiplikativen Mischstufe wird mittels einer als Dreipol oder Vierpol ausgebildeten und zwischen dem Ein gang und dem Ausgang der Schaltstufe angeordneten Kompensationsstufe das am Eingang und Ausgang der Schaltstufe mit gegensätzlicher Phasenlage anliegende Signal der doppelten Oszillatorfrequenz innerhalb der Mischstufe "kurzgeschlos sen" und somit am Schaltungseingang der Mischstufe in seiner Amplitude wesent lich reduziert bzw. unterdrückt, ohne daß die Mischstufe in ihrer eigentlichen Funktion der Signalmischung beeinflußt wird. Hierzu wird durch die Kompensa tionsstufe zunächst in einem ersten Additionsschritt das Signal der doppelten Os zillatorfrequenz sowohl am Eingang der Schaltstufe als auch am Ausgang der Schaltstufe in jeweils einer Phasenlage getrennt summiert, anschließend werden in einer zweiten Additionsschritt die beiden Summen als Summanden mit jeweils ge gensätzlicher Phasenlage addiert. Aufgrund der gegensätzlichen Phasenlage der beiden Summanden wird vorteilhafterweise eine Kompensation des Signals der doppelten Oszillatorfrequenz erreicht (Gleichtaktsignal), ohne daß bei dieser "ZF/2-Unterdrückung" das zur Mischung erforderliche Gegentaktsignal beeinflußt wird.The invention is based on the knowledge that the input signal at the input the switching stage and the output signal at the output of the switching stage in differen tial form, d. H. as push-pull signals, while the oscillator signal as Common mode signal is present; therefore, to compensate for the double oszilla Gate frequency common mode signals are affected - push-pull signals should be there conditions are not affected. At the multiplicative mixing stage presented is formed by means of a three-pole or four-pole and between the one gear and the output of the switching stage arranged compensation stage on Input and output of the switching stage with opposite phase position Signal of twice the oscillator frequency within the mixer "short-circuited sen "and thus essential at the circuit input of the mixer in its amplitude Lich reduced or suppressed without the mixing stage in its actual Function of the signal mixing is affected. For this, the Kompensa tion stage first in a first addition step the signal of double Os zillator frequency both at the input of the switching stage and at the output of the Switching stage in each phase position added separately, then in a second addition step, the two sums as summands, each with ge added phase position. Due to the opposite phase of the Both summands are advantageously compensated for the signal of the double oscillator frequency reached (common mode signal) without this "IF / 2 suppression" affects the push-pull signal required for mixing becomes.
Die Kompensationsstufe kann als als Dreipol oder Vierpol mit drei oder vier An schlußpins ausgebildet werden, wobei die Kompensationsstufe über zwei An schlußpins mit dem Eingang (mit den beiden Eingangsanschlüssen) der Schaltstu fe und über einen Anschlußpin bzw. über zwei Anschlußpins mit dem Ausgang (mit einem Ausgangsanschluß bzw. mit den beiden Ausgangsanschlüssen) der Schaltstufe verbunden ist. Die Kompensationsstufe weist eine zur Anzahl ihrer Anschlußpins korrespondierende Zahl an Schaltungskomponenten auf (d. h. 3 oder 4 Schaltungskomponenten): jeweils ein Anschluß der Schaltungskomponen ten ist mit einem der Anschlußpins der Kompensationsstufe verbunden, der jeweils andere Anschluß der Schaltungskomponenten ist an einem gemeinsamen Knotenpunkt zusammengeführt. Die Schaltungskomponenten der Kompensa tionsstufe sind sowohl eingangsseitig als auch ausgangsseitig jeweils untere inander symmetrisch ausgebildet: als Vierpol weist die Kompensationsstufe sowohl eingangsseitig als auch ausgangsseitig jeweils zwei identisch ausgebildete Schaltungskomponenten auf; als Dreipol weist die Kompensationsstufe eingang sseitig zwei identisch ausgebildete Schaltungskomponenten und ausgangsseitig eine Schaltungskomponente auf. Durch diese Anordnung der Schaltungskompo nenten der Kompensationsstufe werden die oben beschriebenen beiden Addi tionsschritte des Signals der doppelten Oszillatorfrequenz in geeigneter Weise phasenrichtig durchgeführt: da die eingangsseitig verbundenen Schaltungskompo nenten identisch sind, heben sich am gemeinsamen Knotenpunkt der Kompensa tionsstufe Eingangs-Gegentaktsignale auf; Gleichtaktsignale dagegen bilden sich ab, werden aber durch den ausgangsseitig identischen Mechanismus kompensiert. Die Additionen der beiden Additionsschritte können mittels beliebiger, für Gleich spannung sperrender Schaltungskomponenten vorgenommen werden, vorzugswei se mittels Schaltungskomponenten mit proportional zur Frequenz zunehmender Admittanz (d. h. Schaltungskomponenten, deren Impedanz mit steigender Fre quenz abnimmt); bsp. können die Additionen über kapazitive Kopplung mittels Kondensatoren als Schaltungskomponenten der Kompensationsstufe durchgeführt werden (dies hat den Vorteil, daß durch die kapazitive Überbrückung der Schaltstufe auch die interne Stromquelle mit der doppelten Oszillatorfrequenz kurzgeschlossen wird).The compensation level can be as a three-pole or four-pole with three or four inputs final pins are formed, the compensation level over two An final pins with the input (with the two input connections) of the switchgear fe and via a connection pin or via two connection pins with the output (with one output connection or with the two output connections) the Switching stage is connected. The compensation level has one to the number of them Pins corresponding number of circuit components (i.e. 3rd or 4 circuit components): one connection each of the circuit components ten is connected to one of the connection pins of the compensation stage, the each other connection of the circuit components is on a common Node merged. The circuit components of the Kompensa tion level are lower on both the input and the output side designed symmetrically in each other: the four-pole has the compensation stage on the input side as well as on the output side, two identically designed ones Circuit components on; the compensation stage has the three-pole input On the side two identically designed circuit components and on the output side a circuit component. This arrangement of the circuit compo Components of the compensation stage are the two addi described above tion steps of the signal of twice the oscillator frequency in a suitable manner carried out in phase: because the circuit compo connected on the input side identical, rise at the common node of the Kompensa tion level input push-pull signals on; Common mode signals, however, are formed ab, but are compensated by the identical mechanism on the output side. The additions of the two addition steps can be made using any, for equals voltage blocking circuit components are made, preferably se by means of circuit components with increasing proportionally to the frequency Admittance (i.e. circuit components whose impedance increases with increasing Fre sequence decreases); E.g. can do the additions via capacitive coupling Capacitors implemented as circuit components of the compensation stage (this has the advantage that the capacitive bridging of the Switching stage also the internal current source with twice the oscillator frequency is short-circuited).
Die Kompensationsstufe zur ZF/2-Unterdrückung kann bei allen multiplikativen Mischstufen mit Verstärkerstufe und Schaltstufe eingesetzt werden: bsp. bei einer als sog. "Gilbert-Zelle" ausgebildeten multiplikativen Mischstufe, bei der die Ver stärkerstufe zwei in Emitterschaltung betriebene Verstärkertransistoren und die Schaltstufe vier Schalttransistoren aufweist, oder bei einer multiplikativen Misch stufe, bei der die Verstärkerstufe zwei in Basisschaltung betriebene Verstär kertransistoren aufweist, oder bei einer multiplikativen Mischstufe, bei der die Schaltstufe mittels eines Dioden-Ringmischers realisiert wird, oder bei einer mit tels MOS-Transistoren realisierten multiplikativen Mischstufe. Die multiplikative Mischstufe kann insbesondere wegen ihrer geringen Oszillatorstörstrahlung in Empfangssystemen mit beschränkter Oszillatorstörstrahlung (d. h. bsp. in Emp fangssystemen für. Breitbandkabelnetze) oder aufgrund der reduzierten Ne benempfangsstellen in Empfangssystemen mit beschränktem Nebenempfang (d. h. bsp. in Autoradios) eingesetzt werden.The compensation level for IF / 2 suppression can be multiplied for all Mixing stages with amplifier stage and switching stage are used: e.g. at a as a so-called "Gilbert cell" trained multiplicative mixing stage, in which the Ver amplifier stage two operated in emitter circuit and the transistor Switching stage has four switching transistors, or in a multiplicative mixing stage in which the amplifier stage two amplifiers operated in the basic circuit has kertransistors, or in a multiplicative mixing stage, in which the Switching stage is realized by means of a diode ring mixer, or with one multiplicative mixing stage realized by means of MOS transistors. The multiplicative Mixing stage can in particular because of their low oscillator interference Reception systems with limited oscillator interference (e.g. in Emp catching systems for. Broadband cable networks) or due to the reduced Ne reception points in reception systems with limited secondary reception (i.e. E.g. in car radios).
Anhand der Zeichnung mit den Fig. 1 und 2 soll die multiplikative Mischstufe näher beschrieben werden; hierbei zeigt die Fig. 1 ein prinzipielles Blockschalt bild der multiplikativen Mischstufe und die Fig. 2 ein mittels Bipolartransistoren realisiertes Ausführungsbeispiel der multiplikativen Mischstufe für HF-Anwen dungen in Rundfunkempfängerschaltungen.The multiplicative mixing stage will be described in more detail with reference to the drawing with FIGS. 1 and 2; Here, the Fig. 1 shows a basic block diagram of the multiplicative mixer stage and Fig. 2 a realized by means of bipolar transistors embodiment of the multiplicative mixer stage for RF appli cations in radio receiver circuits.
Gemäß dem Prinzipschaltbild der Fig. 1 besteht die multiplikative Mischstufe l aus der Verstärkerstufe 10, der Schaltstufe 20, der Kompensationsstufe 30 und dem Lokaloszillator 40.According to the principle diagram of Fig. 1 is the multiplicative mixer stage l from the amplifier stage 10, the switching circuit 20, the compensation stage 30 and the local oscillator 40th
Die zur Verstärkung des Eingangssignals UIN mit der Frequenz fIN dienende Ver stärkerstufe 10 ist eingangsseitig an die beiden Schaltungseingänge IN1, IN2 der multiplikativen Mischstufe 1 angeschlossen, an denen das Eingangssignal UIN in differentieller Form (als Gegentaktsignal) anliegt (zur Erzeugung des Gegentakt- Eingangssignals kann bsp. ein Symmetrierüberträger Verwendung finden); aus gangsseitig ist die Verstärkerstufe 10 mit den beiden Eingangsanschlüssen E1, E2 der Schaltstufe 20 verbunden. Die zur Umpolung des Eingangssignals UIN di enende Schaltstufe 20 besteht aus den vier Schaltelementen S1, S2, S3, S4, die von dem an die beiden Steueranschlüsse SE1, SE2 der Schaltstufe 20 angeschlos senen Lokaloszillator 40 mit dem Oszillatorsignal ULO der Oszillatorfrequenz fLO angesteuert werden; die beiden Ausgangsanschlüsse A1, A2 der Schaltstufe 20 sind mit den beiden Schaltungsausgängen OUT1, OUT2 der multiplikativen Mischstufe 1 verbunden, an denen das Ausgangssignal UOUT in differentieller Form (als Gegentaktsignal) mit der Frequenz fOUT als Mischprodukt aus dem Ein gangssignal UIN mit der Frequenz fIN und dem Oszillatorsignal ULO des Loka loszillators 40 mit der Frequenz fLO ansteht. Die als Vierpol mit den vier An schlußpins P1, P2, P3, P4 ausgebildete Kompensationsstufe 30 ist zwischen dem Eingang der Schaltstufe 20 und dem Ausgang der Schaltstufe 20 angeordnet, wobei die beiden Anschlußpins P1, P2 jeweils mit einem Eingangsanschluß E1, E2 der Schaltstufe 20 und die beiden Anschlußpins P3, P4 jeweils mit einem Aus gangsanschluß A1, A2 der Schaltstufe 20 verbunden sind; die Kompensationsstufe 30 weist vier für Gleichspannung sperrende Schaltungskomponenten 31, 32, 33, 34 auf, deren jeweils erster Anschluß mit einem der Anschlußpins P1, P2, P3, P4 und deren jeweils zweiter Anschluß mit einem gemeinsamen Knotenpunkt K ver bunden ist. Die beiden eingangsseitig an den Anschlußpins P1 und P2 angeschlos senen Schaltungskomponenten 31 und 32 sind gleichartig (identisch zueinander) ausgebildet, ebenso die beiden an den Anschlußpins P3 und P4 angeschlossenen Schaltungskomponenten 33 und 34. Durch die Anordnung der Schaltungs komponenten 31, 32, 33, 34 und deren Wirkungsweise für Gleichtaktsignale und Gegentaktsignale (Gleichtaktanteile des an den Eingangsanschlüssen E1 und E2 anliegenden Signals werden unterdrückt, Gegentaktanteile des an den Eingangsan schlüssen E1 und E2 anliegenden Signals dagegen ungestört belassen) wird das an den Eingangsanschlüssen E1, E2 der Schaltstufe 20 bzw. an den Ausgangsan schlüssen A1, A2 der Schaltstufe 20 anstehende Signal der doppelten Os zillatorfrequenz fLO mittels zweier Additionsschritte (zumindest weitgehend) kom pensiert.The amplifier stage 10 used to amplify the input signal U IN with the frequency f IN is connected on the input side to the two circuit inputs IN1, IN2 of the multiplicative mixing stage 1 , at which the input signal U IN is present in a differential form (as a push-pull signal) (for generating the push-pull - An input signal can be used, for example, a balun); on the output side, the amplifier stage 10 is connected to the two input connections E1, E2 of the switching stage 20 . The switching stage 20 for polarity reversal of the input signal U IN consists of the four switching elements S1, S2, S3, S4, the local oscillator 40 connected to the two control connections SE1, SE2 of the switching stage 20 with the oscillator signal U LO of the oscillator frequency f LO be controlled; the two output connections A1, A2 of the switching stage 20 are connected to the two circuit outputs OUT1, OUT2 of the multiplicative mixing stage 1 , at which the output signal U OUT in differential form (as a push-pull signal) with the frequency f OUT as a mixed product from the input signal U IN the frequency f IN and the oscillator signal U LO of the local oscillator 40 is present at the frequency f LO . The designed as a four-pole with the four connection pins P1, P2, P3, P4 compensation stage 30 is arranged between the input of the switching stage 20 and the output of the switching stage 20 , the two connecting pins P1, P2 each having an input terminal E1, E2 of the switching stage 20th and the two connection pins P3, P4 are each connected to an output connection A1, A2 from the switching stage 20 ; the compensation stage 30 has four DC voltage blocking circuit components 31 , 32 , 33 , 34 , the first connection of which is connected to one of the connection pins P1, P2, P3, P4 and the second connection of which is connected to a common node K. The two circuit components 31 and 32 connected on the input side to the connection pins P1 and P2 are of identical design (identical to one another), as are the two circuit components 33 and 34 connected to the connection pins P3 and P4. The arrangement of the circuit components 31 , 32 , 33 , 34 and their mode of operation for common-mode signals and push-pull signals (common-mode components of the signal present at the input connections E1 and E2 are suppressed, but push-pull components of the signal applied to the input connections E1 and E2 are left undisturbed) the signal present at the input connections E1, E2 of the switching stage 20 or at the output connections A1, A2 of the switching stage 20 of the double oscillator frequency f LO is compensated (at least largely) by means of two addition steps.
Gemäß der Fig. 2 ist die multiplikative Mischstufe 1 als sog. "Gilbert-Zelle" rea lisiert: sie besitzt einen symmetrischen Aufbau aus einer als Differenzverstärker stufe ausgebildeten Verstärkerstufe 10 mit den beiden NPN-Verstärkertransistoren T1, T2, der das Eingangssignal UIN zugeführt wird, und einer darauf aufgesetzten Schaltstufe 20 mit vier NPN-Schalttransistoren T3, T4, T5, T6 (der Transistor T3 bildet das Schaltelement S1 der Fig. 1, der Transistor T4 bildet das Schaltele ment S2, der Transistor T5 das Schaltelement S3 und der Transistor T6 das Schaltelement S4). Durch die Schalttransistoren T3, T4, T5, T6 wird das an den beiden Eingangsanschlüssen E1, E2 der Schaltstufe 20 anliegende Ausgangssignal der Differenzverstärkerstufe 10 im Rhythmus des vom Lokaloszillator 40 generi erten und an den Steueranschlüssen SEI, SE2 der Schaltstufe 20 anstehenden Oszillatorsignals ULO mit der Frequenz fLO im Gegentakt umgepolt und das gewünschte Mischprodukt an den Ausgangsanschlüssen A1, A2 der Schaltstufe 20 ausgegeben. An den beiden Schaltungsausgängen OUT1, OUT2 der multiplika tiven Mischstufe 1 ist bsp. ein ZF-Filter angeschlossen, das das Ausgangssignal UOUT auf die gewünschte Zwischenfrequenz (bsp. 10,7 MHz) filtert. . Referring to Fig 2, the multiplicative mixer stage 1 is structured as a "Gilbert cell" rea lisiert:. It has a symmetrical structure of a stage as a differential amplifier constructed amplifier stage 10 with the two NPN amplifying transistors T1, T2, which is supplied with the input signal U IN is, and a switching stage 20 placed thereon with four NPN switching transistors T3, T4, T5, T6 (the transistor T3 forms the switching element S1 of FIG. 1, the transistor T4 forms the switching element S2, the transistor T5 the switching element S3 and Transistor T6, the switching element S4). Through the switching transistors T3, T4, T5, T6, the output signal of the differential amplifier stage 10 present at the two input terminals E1, E2 of the switching stage 20 is generated in rhythm with the oscillator signal U LO generated by the local oscillator 40 and pending at the control terminals SEI, SE2 of the switching stage 20 the polarity of the frequency f LO is reversed and the desired mixed product is output at the output connections A1, A2 of the switching stage 20 . At the two circuit outputs OUT1, OUT2 of the multiplicative mixer stage 1 , for example. an IF filter is connected, which filters the output signal U OUT to the desired intermediate frequency (e.g. 10.7 MHz).
Da die Schaltstufe 20 zwei Paare von Schalttransistoren T3, T6 bzw. T4, T5 ent hält, die jeweils nach der halben Periode des Oszillatorsignals ULO vom leitenden in den nicht-leitenden Zustand bzw. umgekehrt übergehen, entsteht an den Kollek toren der Schalttransistoren T3, T4, T5, T6 (d. h. an den Ausgangsanschlüssen AI, A2) und an den Emittern der Schalttransistoren T3, T4, T5, T6 (d. h. an den Ein gangsanschlüssen E1, E2) ein Signal mit jeweils entgegengesetzter Phasenlage, das als wesentliche Frequenzkomponente die doppelte Oszillatorfrequenz 2·fLO enthält. Zur Unterdrückung dieses auf die Schaltungseingänge IN1, IN2 der mul tiplikativen Mischstufe 1 rückwirkenden störenden Signals der doppelten Oszilla torfrequenz 2·fLO wird mittels der aus vier Kondensatoren C1, C2, C3, C4 beste henden und die Anschlußpins P1, P2, P3, P4 aufweisenden Kompensationsstufe 30 das Signal von den Emittern der Schalttransistoren T3, T4, T5, T6 (bzw. von den Kollektoren der Verstärkertransistoren T1 und T2) kapazitiv an den Schal tungsausgang OUT1, OUT2 der multiplikativen Mischstufe I gekoppelt. Hierzu summieren die beiden mit einem Anschluß an den Anschlußpin P3 bzw. P4 und mit dem anderen Anschluß am gemeinsamen Knotenpunkt K angeschlossenen identischen Kondensatoren C3 bzw. C4 in einem ersten Additionsschritt das an den Ausgangsanschlüssen A1, A2 der Schaltstufe 20 (den Kollektoren der Schalt transistoren T3, T5 bzw. T4, T6) anliegende Gleichtaktsignal, durch die beiden mit einem Anschluß an den Anschlußpin P1 bzw. P2 und mit dem anderen An schluß am gemeinsamen Knotenpunkt K angeschlossenen identischen Kondensa toren C1 bzw. C2 wird dieses Summensignal an die Eingangsanschlüsse E1, E2 der Schaltstufe 20 (die Emitter der Schalttransistoren T3, T5 bzw. T4, T6) geleitet und in einem zweiten Additionsschritt mit dem dort ebenfalls anstehenden (aber eine entgegengesetzte Phasenlage aufweisenden) Signal der doppelten Oszillator frequenz 2·fLO summiert; somit werden die störenden Anteile des Signals der doppelten Oszillatorfrequenz 2·fLO weitgehend unterdrückt bzw. kompensiert, wobei aufgrund der Vorgabe jeweils identischer Kapazitätswerte für die Kon densatoren C3 und C4 bzw. C1 und C2 Gegentaktsignale und damit die Misch eigenschaften der multiplikativen Mischstufe 1 nicht beeinflußt werden.Since the switching stage 20 contains two pairs of switching transistors T3, T6 and T4, T5 ent, each of which changes from the conductive to the non-conductive state or vice versa after half the period of the oscillator signal U LO , arises at the collectors of the switching transistors T3 , T4, T5, T6 (ie at the output connections AI, A2) and at the emitters of the switching transistors T3, T4, T5, T6 (ie at the input connections E1, E2) a signal with the opposite phase position, which is the essential frequency component contains twice the oscillator frequency 2 · f LO . To suppress this on the circuit inputs IN1, IN2 of the multiplicative mixer stage 1 disturbing signal of the double oscillator frequency 2 · f LO is by means of four capacitors C1, C2, C3, C4 existing and the connecting pins P1, P2, P3, P4 having compensation stage 30, the signal from the emitters of the switching transistors T3, T4, T5, T6 (or from the collectors of the amplifier transistors T1 and T2) capacitively coupled to the circuit output OUT1, OUT2 of the multiplicative mixer stage I. For this purpose, the two identical capacitors C3 and C4 connected with a connection to the connection pin P3 and P4 and with the other connection at the common node K in a first addition step that to the output connections A1, A2 of the switching stage 20 (the collectors of the switching transistors T3, T5 or T4, T6) applied common mode signal, through the two with a connection to the connection pin P1 or P2 and with the other connection connected to the common node K identical capacitors C1 and C2, this sum signal is sent to the input connections E1 , E2 of the switching stage 20 (the emitters of the switching transistors T3, T5 or T4, T6) are passed and in a second addition step with the signal which is also present (but has an opposite phase position), the signal of the double oscillator frequency 2 · f LO is summed; Thus, the interfering components of the signal of the double oscillator frequency 2 · f LO are largely suppressed or compensated, whereby due to the specification of identical capacitance values for the capacitors C3 and C4 or C1 and C2 push-pull signals and thus the mixing properties of the multiplicative mixer stage 1 are not to be influenced.
Bsp. wird von der multiplikativen Mischstufe I eine Mischfrequenz als ZF- Frequenz von 10,7 MHz generiert, wobei zur Unterdrückung der ZF/2-Störstelle bei der Frequenz fLO ± 5,35 MHz für die Kondensatoren C1 und C2 der Kapazi tätswert 3 pF und für die Kondensatoren C3 und C4 ebenfalls der Kapazitätswert 3 pF gewählt wird.For example, the multiplicative mixer stage I generates a mixed frequency as the IF frequency of 10.7 MHz, with the capacitance value 3 for the capacitors C1 and C2 to suppress the IF / 2 impurity at the frequency f LO ± 5.35 MHz pF and the capacitance value 3 pF is also selected for the capacitors C3 and C4.
Claims (9)
- - einer Verstärkerstufe (10) zur Verstärkung eines am Schaltungseingang (IN1, IN2) der multiplikativen Mischstufe (1) in differentieller Form anlie genden Eingangssignals (UIN) mit einer bestimmten Eingangsfrequenz (fIN),
- - einer am Ausgang der Verstärkerstufe (10) angeschlossenen Schaltstufe (20) zur Generierung eines am Schaltungsausgang (OUT1, OUT2) der multiplikativen Mischstufe (1) in differentieller Form ausgegebenen Aus gangssignals (UOUT) der gewünschten Mischfrequenz (fOUT), die vier Schaltelemente (S1, S2, S3, S4), zwei Eingangsanschlüsse (E1, E2), zwei Ausgangsanschlüsse (A1, A2) und zwei Steueranschlüsse (SE1, SE2) auf weist,
- - und einem mit den beiden Steueranschlüssen (SE1, SE2) der Schaltstufe
(20) verbundenen Lokaloszillator (40) zur Erzeugung eines Oszillator
signals (ULO) mit bestimmter Oszillatorfrequenz (fLO),
dadurch gekennzeichnet: - - zwischen den Eingangsanschlüssen (E1, E2) und den Ausgangsan schlüssen (A1, A2) der Schaltstufe (20) ist eine als Dreipol oder Vierpol ausgebildete Kompensationsstufe (30) mit einer ihrer Polzahl entspre chenden Anzahl von Anschlußpins (P1, P2, P3, P4) und von Schaltungs komponenten (31, 32, 33, 34) angeordnet,
- - zwei Anschlußpins (P1, P2) der Kompensationsstufe (30) sind jeweils mit einem Eingangsanschluß (E1, E2) der Schaltstufe (20) und der mindestens eine weitere Anschlußpin (P3, P4) der Kompensationsstufe (30) ist mit ei nem Ausgangsanschluß (A1, A2) der Schaltstufe (20) verbunden,
- - ein Anschluß der Schaltungskomponenten (31, 32, 33, 34) der Kompensa tionsstufe (30) ist jeweils mit einem Anschlußpin (P1, P2, P3, P4) der Kompensationsstufe (30) und der andere Anschluß der Schaltungskompo nenten (31, 32, 33, 34) der Kompensationsstufe (30) mit einem gemeinsa men Knotenpunkt (K) verbunden,
- - die für Gleichspannung sperrenden Schaltungskomponenten (31, 32, 33, 34) der Kompensationsstufe (30) sind sowohl eingangsseitig als auch aus gangsseitig untereinander derart symmetrisch ausgebildet, daß die an den Eingangsanschlüssen (E1, E2) der Schaltstufe (20) und die an den Aus gangsanschlüssen (A1, A2) der Schaltstufe (20) anstehenden Gleichtaktsi gnale phasenrichtig zunächst sowohl an den Eingangsanschlüssen (E1, E2) der Schaltstufe (20) als auch an den Ausgangsanschlüssen (A1, A2) der Schaltstufe (20) summiert werden und anschließend die beiden Summen am gemeinsamen Knotenpunkt (K) der Kompensationsstufe (30) addiert werden.
- - an amplifier stage ( 10 ) for amplifying an input signal (U IN ) present in differential form at the circuit input (IN1, IN2) of the multiplicative mixer stage ( 1 ) with a specific input frequency (f IN ),
- - A switching stage ( 20 ) connected to the output of the amplifier stage ( 10 ) for generating an output signal (U OUT ) of the desired mixing frequency (f OUT ) output in differential form at the circuit output (OUT1, OUT2) of the multiplicative mixing stage ( 1 ), the four Switching elements (S1, S2, S3, S4), two input connections (E1, E2), two output connections (A1, A2) and two control connections (SE1, SE2),
- - And with the two control connections (SE1, SE2) of the switching stage ( 20 ) connected local oscillator ( 40 ) for generating an oscillator signal (U LO ) with a certain oscillator frequency (f LO ),
characterized by : - - Between the input connections (E1, E2) and the output connections (A1, A2) of the switching stage ( 20 ) is a three-pole or four-pole compensation stage ( 30 ) with a number of corresponding pins corresponding to their number of poles (P1, P2, P3, P4) and circuit components ( 31 , 32 , 33 , 34 ),
- - Two connection pins (P1, P2) of the compensation stage ( 30 ) are each with an input connection (E1, E2) of the switching stage ( 20 ) and the at least one further connection pin (P3, P4) of the compensation stage ( 30 ) is with an output connection ( A1, A2) of the switching stage ( 20 ) connected,
- - A connection of the circuit components ( 31 , 32 , 33 , 34 ) of the compensation stage ( 30 ) is each with a connection pin (P1, P2, P3, P4) of the compensation stage ( 30 ) and the other connection of the circuit components ( 31 , 32nd , 33 , 34 ) of the compensation stage ( 30 ) connected to a common node (K),
- - The blocking for DC voltage circuit components ( 31 , 32 , 33 , 34 ) of the compensation stage ( 30 ) are designed symmetrically both on the input side and from the output side with one another in such a way that at the input connections (E1, E2) of the switching stage ( 20 ) and the From the output connections (A1, A2) of the switching stage ( 20 ), pending common-mode signals are first summed in phase, both at the input connections (E1, E2) of the switching stage ( 20 ) and at the output connections (A1, A2) of the switching stage ( 20 ) and then the two sums at the common node (K) of the compensation stage ( 30 ) are added.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE19532989A DE19532989C1 (en) | 1995-09-07 | 1995-09-07 | Multiplicative mixer with three or four-pole compensation stage |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE19532989A DE19532989C1 (en) | 1995-09-07 | 1995-09-07 | Multiplicative mixer with three or four-pole compensation stage |
Publications (1)
Publication Number | Publication Date |
---|---|
DE19532989C1 true DE19532989C1 (en) | 1996-11-07 |
Family
ID=7771463
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE19532989A Expired - Fee Related DE19532989C1 (en) | 1995-09-07 | 1995-09-07 | Multiplicative mixer with three or four-pole compensation stage |
Country Status (1)
Country | Link |
---|---|
DE (1) | DE19532989C1 (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE102005004084A1 (en) * | 2005-01-24 | 2006-08-03 | Atmel Germany Gmbh | Mixing stage and method for mixing two signals having different frequencies |
Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3624513A (en) * | 1970-01-29 | 1971-11-30 | Gen Electric | Image frequency suppression circuit |
DE1913158B2 (en) * | 1969-03-14 | 1976-09-23 | Siemens AG, 1000 Berlin und 8000 München | Microwave receiver with compensated backward mixing - includes local oscillator supplying IF mixer diode and parametric step-up mixer |
DE2608939A1 (en) * | 1976-03-04 | 1977-09-08 | Licentia Gmbh | Stripline mixer with two diode mixing circuits - has two antiparallel diodes in each circuit connected to short and open circuited quarter wave lines |
US4264981A (en) * | 1977-04-19 | 1981-04-28 | Texas Instruments Deutschland Gmbh | Circuit arrangement for compensating the change in input capacitance at a first gate electrode of a dual-gate MOS field-effect transistor |
US4590616A (en) * | 1983-07-12 | 1986-05-20 | U.S. Philips Corporation | Re-tuning device comprising a switching mixer stage and a tuning oscillator |
DE3502294A1 (en) * | 1985-01-24 | 1986-07-24 | ANT Nachrichtentechnik GmbH, 7150 Backnang | FREQUENCY CONVERTER |
DE3613536A1 (en) * | 1986-04-22 | 1987-10-29 | Ant Nachrichtentech | METHOD FOR CONTROLLING A SINGLE-BAND LEVEL UP MIXER AND ARRANGEMENT THEREFOR |
-
1995
- 1995-09-07 DE DE19532989A patent/DE19532989C1/en not_active Expired - Fee Related
Patent Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE1913158B2 (en) * | 1969-03-14 | 1976-09-23 | Siemens AG, 1000 Berlin und 8000 München | Microwave receiver with compensated backward mixing - includes local oscillator supplying IF mixer diode and parametric step-up mixer |
US3624513A (en) * | 1970-01-29 | 1971-11-30 | Gen Electric | Image frequency suppression circuit |
DE2608939A1 (en) * | 1976-03-04 | 1977-09-08 | Licentia Gmbh | Stripline mixer with two diode mixing circuits - has two antiparallel diodes in each circuit connected to short and open circuited quarter wave lines |
US4264981A (en) * | 1977-04-19 | 1981-04-28 | Texas Instruments Deutschland Gmbh | Circuit arrangement for compensating the change in input capacitance at a first gate electrode of a dual-gate MOS field-effect transistor |
US4590616A (en) * | 1983-07-12 | 1986-05-20 | U.S. Philips Corporation | Re-tuning device comprising a switching mixer stage and a tuning oscillator |
DE3502294A1 (en) * | 1985-01-24 | 1986-07-24 | ANT Nachrichtentechnik GmbH, 7150 Backnang | FREQUENCY CONVERTER |
DE3613536A1 (en) * | 1986-04-22 | 1987-10-29 | Ant Nachrichtentech | METHOD FOR CONTROLLING A SINGLE-BAND LEVEL UP MIXER AND ARRANGEMENT THEREFOR |
Non-Patent Citations (1)
Title |
---|
US-Fachbuch: GRAY, P., MEYER, R.: "Analysis and Design of Analog Integratet Circuits", 3.Aufl., John Wiley & Sons, New York, 1993, S.670 * |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE102005004084A1 (en) * | 2005-01-24 | 2006-08-03 | Atmel Germany Gmbh | Mixing stage and method for mixing two signals having different frequencies |
DE102005004084B4 (en) * | 2005-01-24 | 2009-11-26 | Atmel Automotive Gmbh | Mixing stage and method for mixing two signals having different frequencies |
US7633328B2 (en) | 2005-01-24 | 2009-12-15 | Atmel Automotive Gmbh | Mixer stage and method for mixing two signals having different frequencies |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
DE69706953T2 (en) | Mixer with suppression of the image frequency | |
DE4410030C2 (en) | Low noise, active mixer | |
DE69424407T2 (en) | RECEIVER WITH ADJUSTABLE BAND PASS FILTER | |
DE69009773T2 (en) | FULLY DIFFERENTIAL CMOS POWER AMPLIFIER. | |
DE4114943C2 (en) | Mixing circuit | |
DE69812540T2 (en) | Mixer arrangements with image frequency suppression | |
DE3687923T2 (en) | DISTRIBUTED MONOLITHIC MIXER. | |
DE19942810A1 (en) | Image reject mixer circuit for radio receivers, uses capacitor connected across the current signal source output to reduce noise | |
DE69422010T2 (en) | Phase shift amplifier and its use in a merge circuit | |
DE69903702T2 (en) | Matched complementary mixer | |
DE2648455A1 (en) | FREQUENCY CONVERTER | |
DE3140417A1 (en) | "TRANSISTORIZED SYMMETRIC MIXER" | |
DE69616201T2 (en) | IMPROVEMENTS TO OR WITH REGARD TO COMMUNICATION RECEIVERS | |
DE69322737T2 (en) | amplifier | |
DE2941328A1 (en) | PRODUCT SWITCHING | |
DE69414525T2 (en) | Differential amplifier stage for use in standard ECL bipolar processes | |
DE10015177A1 (en) | High gain mixer circuit has impedance elements provided between respective differential transistor pairs | |
DE60008030T2 (en) | frequency converter | |
DE60313621T2 (en) | SYSTEM AND METHOD FOR CONSTRUCTING THE INPUT SIMPEDANCE OF A STACKED AMPLIFIER ASSEMBLY | |
DE10344876B3 (en) | Signal processing device, in particular for mobile communications | |
EP0698964B1 (en) | RF mixer stage | |
DE19844970A1 (en) | Circuit arrangement for mixing an input signal and an oscillator signal with one another | |
DE19532989C1 (en) | Multiplicative mixer with three or four-pole compensation stage | |
DE3409555A1 (en) | Balanced mixer with a hybrid transformer | |
DE69721898T2 (en) | Variable gain amplifier with low DC voltage deviation at the output and low distortion |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
8100 | Publication of patent without earlier publication of application | ||
D1 | Grant (no unexamined application published) patent law 81 | ||
8364 | No opposition during term of opposition | ||
8327 | Change in the person/name/address of the patent owner |
Owner name: TEMIC SEMICONDUCTOR GMBH, 74072 HEILBRONN, DE |
|
8320 | Willingness to grant licences declared (paragraph 23) | ||
8327 | Change in the person/name/address of the patent owner |
Owner name: ATMEL GERMANY GMBH, 74072 HEILBRONN, DE |
|
8327 | Change in the person/name/address of the patent owner |
Owner name: ATMEL AUTOMOTIVE GMBH, 74072 HEILBRONN, DE |
|
8339 | Ceased/non-payment of the annual fee |