CS209742B1 - Operační blok přenosového procesoru - Google Patents

Description

Vynález se týká operačního bloku přenosového procesoru samočinného počítače řešeného jednotným způsobem pro několik modulů procesorů, počítače, z nichž každý je určen k řízení určité skupiny přídavných zařízení, jako je například skupina diskových pamětí, skupina páskových pamětí, skupina dálkových telekomunikačních zařízení, skupina vstupních a výstupních zařízení a podobně, nebo je určen jako základní obvod speciálních procesorů, jako například servisního procesoru, modulu, počítače.

V dosud známých řešeních nebývá použito stejného jádra přenosového procesoru pro všechny tyto účely, například speciální procesory bývají řešeny jiným způsobem. Je to mimo jiné dáno tím, že dosud známa řešení neumožňují plnění řídicí paměti přenosového procesoru jak z jeho vnějšího adaptéru, tak ze zařízení pro mezimodulový styk. Dosud známá řešení často používají zvláštní pamět pro záznam dat, mívají omezené možnosti aritmetických operací, nebot používají zápisníkovou pamět připojenou jen na jeden ze vstupů ari trneticko-logické jednotky, mívají značně omezenu hloubku podprogramů, většinou nepoužívají překrytí přípravy mikrooperace s jejím dokončením, mnohé z nich nepoužívají potlačení signálu přerušení podle potřeb externího adaptéru a při tom jsou vzhledem k výslednému výkonu velice složité.

Výše uvedené nevýhody dosavadních řešení odstraňuje operační blok přenosového procesoru sestávající z bloku řídicí paměti, z přepínače adresy mikroinstrukce, řídicího adresového obvodu, registru adresy mikroinstrukce, registru ukazovátka, registru adre2 sy pro přesun dat, prvního výstupního registru paměti, druhého výstupního registru paměti, přepínače vstupních dat zápisníku, hlavní zápisníkové paměti, pomocné zápisníkové paměti, vstupního dekodéru aritmetiky, ar i trneticko-1ogického obvodu, výstupního registru aritmetiky, registru podmínkového kódu, registru adresy mezimodulového styku a řídících obvodů operačního bloku, podle vynálezu, jehož podstatou je, že mezimodulový adresový vstup z mezimodulového adaptéru je spojen s prvním vstupem přepínače adresy mikroinstrukce, mezimodulový datový Vstup z mezimodulového adaptoru je spojen s třetím vstupem bloku řídicí paměti a.se sedmým vstupem přepínače vstupních dat zápisníku, příznakový vstup z mezimodulového adaptoru je spojen s osmým vstupem přepínače vstupních dat zápisníku, vstup ovládacích signálů z mezimodulového adaptoru je spojen s prvním vstupem řídicích obvodů operačního bloku, vstup chybových signálů mezimodulového adaptoru je spojen s druhým vstupem řídicích obvodů operačního bloku, datový vstup z vnějšího adaptoru je spojen s devátým vstupem přepínače vstupních dat zápisníku, adresový vstup z vnějšího adaptoru je spojen s druhým vstupem přepínače adresy mikroinstrukce, se čtvrtým vstupem bloku řídicí paměti, vstup řídicích signálů z vnějšího adaptoru je spojen s pátým vstupem řídicích obvodů operačního bloku, vstup podmínkového signálu z vnějšího adaptoru je spojen s pátým vstupem řídicího adresového obvodu, dále první výstup bloku řídicí paměti je spojen s prvním vstupem prvního výstupního registru . paměti , výstup prvního výstupního registru paměti je spojen se čtvrtým vstupem řídicích obvodu operačního bloku, se druhým vstupem registru adresy mezimodulového styku, s prvním vstupem druhého výstupního registru paměti, s šestým vstupem přepínače vstupních dat zápisníku a s druhým vstupem řídicího adresového obvodu, dále první výstup druhého výstupního registru paměti je spojen s třetím vstupem řídicích obvodů operačního bloku,s třetím vstupem vstupního dekodéru aritmetiky, se čtvrtým vstupem přepínače vstupních dat zápisníku, s druhým vstupem registru adresy pro přesun dat a s řídicím výstupem operačního bloku, výstup přepínače adresy mikroinstrukce je spojen se šestým vstupem bloku řídicí paměti a s prvním vstupem registru adresy mikroinstrukce, výstup řídicího adresového obvodu je spojen se třetím vstupem přepínače adresy mikroinstrukce a s pátým vstupem bloku řídicí pamětí, první výstup registru adresy mikroinstrukce je spojen s prvním vstupem řídicího adresového obvodu a s adresovým výstupem operačního bloku, první výstup registru ukazovátka je spojen se čtvrtým vstupem přepínače adresy mikroinstrukce a s druhým vstupem přepínače vstupních dat zápisníku, první výstup registru adresy pro přesun dat je spojen s pátým vstupem přepínače adresy mikroinstrukce a se třetím vstupem přepínače vstupních dat zápisníku, výstup přepínače vstupních dat zápisníku je spojen s prvním vstupem hlavní zápisníkové pamětí a s prvním vstupem pomocné zápisníkové paměti, první výstup hlavní zápisníkové paměti je spojen s druhým vstupem aritmeticko-logického obvodu, s prvním vstupem registru adresy mezimodiTLového styku, s druhým vstupem bloku řídicí paměti, s prvním vstupem registru ukazovátka, s prvním vstupem registru adresy pro.přesun dat a s datovým výstupem operačního bloku, výstup pomocné zápisníkové paměti je spojen s prvním vstupem vstupního dekodéru aritmetiky, výstup vstupního dekodéru aritmetiky je spojen s třetím vstupem ari trneticko-logického obvodu, první výstup aritmeticko-logického obvodu je spojen s prvním vstupem výstupního registru aritmetiky, druhý výstup aritmeticko-logického obvodu je spojen s prvním vstupem registru podmínkového kódu, výstup výstupního registru aritmetiky je spojen s pátým vstupem přepínače vstupních dat zápisníku a se čtvrtým vstupem řídicího adresového obvodu, výstup registru podmínkového kódu je spojen se třetím vstupem řídicího adresového obvodu, první výstup registru adresy mezimodulového styku je spojen s mezimodul(9vým adresovým výstupem, druhý výstup registru adresy mezimodulového styku je spojen s prvním vstupem přepínače vstupních dat zápisníku, první výstup řídicích obvodů operačního bloku je spojen se třetím vstupem registru adresy pro přesun dat, s druhým vstupem registru ukazovátka, s šestým vstupem řídicího adresového obvodu, s druhým vstupem registru adresy mikroinstrukce, s šestým vstupem přepínače adresy mikroinstrukce, s prvním vstupem bloku řídicí paměti, s druhým vstupem prvního výstupního registru paměti, s třetím vstupem registru adresy mezimodulového styku, s druhým vstupem druhého výstupního registru paměti, s druhým vstupem výstupního registru aritmetiky, s druhým vstupem registru podmínkového kódu, s prvním vstupem aritmeticko-logického obvodu, s druhým vstupem vstupního dekodéru aritmetiky, s druhým vstupem hlavní zápisníkové paměti, s druhým vstupem pomocné zápisníkové pamětí a s desátým vstupem přepínače vstupních dat zápisníku, druhý výstup řídících obvodů operačního bloku je spojen s výstupem ovládacích signálů vnějšího adaptoru, třetí výstup řídicích obvodů operačního bloku je spojen s výstupem stavových a řídicích signálů operačního bloku, dále jsou spolu propojeny.druhý výstup bloku řídicí paměti, druhý výstup rigistru adresy mikroinstrukce, druhý výstup registru ukazovátka, druhý výstup registru adresy pro přesun dat, druhý výstup druhého výstupního registru paměti, druhý výstup hlavní zápisníkové paměti, třetí výstup registru adresy mezimodulového styku a mezimodulový datový výstup operačního bloku.

Operační blok podle vynálezu má tyto hlavní vlastnosti:

Na obou vstupech aritmeticko-logického obvodu jsou připojeny zápisníkové paměti, operační pamět se používá jak pro záznam mikroprogramů, tak pro záznam dat, a její vstup pro zápis dat lze připojit jak k mezimodulové sběrnici, tak k vnějšímu adaptéru, součástí operačního bloku přenosového procesoru jsou dva řídicí registry, kterými postupně prochází tatáž mikroinstrukce, aby bylo umožněno časové překrytí jejího provádění a dále má operační blok možnost vybavení obvody pro přerušení a jiné.

Jedno z možných provedení vynálezu je znázorněno na výkresu.

Operační blok přenosového procesoru se skládá z bloku řídicí paměti 1, přepínače £ adresý mikroinstrukce, řídicího adresového obvodu £_?registru £ adresy mikroinstrukce, registru 5 ukazovátka, registru £ adresy pro přesun dat, prvního výstupního registru 7 paměti, druhého výstupního registru £ paměti, přepínače £ vstupních dat zápisníku, hlavní zápisníkové paměti 10, pomocné zápisníkové paměti 1 1 , vstupního dekodéru 12 aritmetiky, aritmeticko-logického obvodu 13, výstupního registru 14 aritmetiky, registru 15 podmínkového kódu, registru 16 adresy mezimodulového styku a řídicích obvodů operačního bloku 17. Mezimodulový adresový vstup 110 z mezimodulového adaptoru je spojen s prvním vstupem přepínače £ adresy mikroinstrukce, mezimodulový datový vstup 111 z mezimodulového adaptoru je spojen jednak s třetím vstupem bloku řídicí paměti £ a jednak se sedmým vstupem přepínače 9 vstupních dat zápisníku, příznakový vstup 112 z mezimodulového adaptoru je spojen s osmým vstupem přepínače £ vstupních dat zápisníku, vstup 113 ovládacích signálů z mezimodulového adaptoru je spojen s prvním vstupem řídících obvodů operačního bloku 17, vstup 114 chybových signálů mezimodulového adaptoru je spojen s druhým vstupem řídicích obvodů operačního bloku 1 7 , datový vstup 210 z vnějšího adaptoru je spojen s devátým vstupem přepínače vstupních £ dat zápisníku, adresový vstup 211 z vnějšího adaptoru je spojen jednak s druhým vstupem přepínače 2 adresy mikroinstrukce, jednak se čtvrtým vstupem bloku řídicí paměti £, vstup 212 řídících signálů z vnějšího adaptoru je spojen s pátým vstupem řídicích obvodů operačního bloku 17, vstup 213 podmínkového signálu z vnějšího adaptoru je spojen s pátým vstupem řídicího adresového obvodu £, dále první výstup bloku řídicí paměti £ je spojen s prvním vstupem prvního výstupního registru 7 paměti, výstup prvního výstupního registru T paměti je spojen se čtvrtým vstupem řídicích obvodů operačního bloku 17, se druhým vstupem registru 16 adresy mezimodulového styku, s prvním vstupem druhého výstupního registru 8 paměti, s šestým vstupem přepínače £ vstupních dat zápisníku a s druhým vstupem řídicího adresového obvodu £, dále první výstup druhého výstupního registru £ paměti je spojen s třetím vstupem řídicích obvodů operačního bloku 17 , s třetím vstupem vstupního dekodéru 12 aritmetiky, se čtvrtým vstupem přepínače 9 vstupních dat zápisníku s druhým vstupem registru 6 adresy pro přesun dat 6 a s řídicím výstupem 221 operačního bloku, výstup přepínače £ adresy mikroinstrukce je spojen jednak se šestým vstupem bloku řídicí paměti J_, jednak s prvním vstupem registru £ adresy mikroinstrukce, výstup řídicího adresového obvodu £ je spojen jednak se třetím vstupem přepínače £ adresy mikroinstrukce, jednak s pátým vstupem bloku řídicí paměti J_, první výstup registru £ adresy mikroinstrukce je spojen jednak s prvním vstupem řídicího adresového obvodu 3, jednak s adresovým výstupem 222 operačního bloku, první výstup registru 5_ ukazovátka, je spojen jednak se čtvrtým vstupem přepínače £ adresy mikroinstrukce, jednak s druhým vstupem přepínače _9 vstupních dat zápisníku, první výstup registru 6_ adresy pro přesun dat je spojen jednak s pátým vstupem přepínače £ adresy mikroinstrukce, jednak se třetím vstupem přepínače £ vstupních dat zápisníku, výstup přepínače £ vstupních dat zápisníku je spojen jednak s prvním vstupem hlavní zápisníkové paměti 10, jednak s prvním vstupem pomocné zápTsníkové paměti 11, první výstup hlavní zápisníkové paměti 10 je spojen s druhým vstupem aritmeticko-Togického obvodu 13, s prvním vstupem registru 16 adresy meziraodulového styku 16, s druhým vstupem bloku řídicí paměti _1_, s prvním vstupem registru £ ukazovátka, s prvním vstupem registru 6 adresy pro přesun dat a s datovým výstupem 220 operačního bloku, výstup pomocné zápisníkové paměti 11 je spojen s prvním vstupem vstupního dekodéru 12 aritmetiky, výstup vstupního dekodéru 12 aritmetiky je spojen s třetím vstupem ar i trneticko-1ogického obvodu 1 3 , první výstup aritmeticko-1ogíckého obvodu 13 je spojen s » prvním vstupem výstupního registru 1 4 aritmetiky, druhý výstup aritmeticko-logíckého obvodu j_3 je spojen s prvním vstupem registru 15 podmínkového kódu, výstup výstupního registru 14 aritmetiky je spojen jednak s pátým vstupem přepínače £ vstupních dat zápisníku, jednak se čtvrtým vstupem řídicího adresového obvodu £, výstup registru 1 5 podmínkového kódu je spojen se třetím vstupem řídicího adresového obvodu £, první výstup registru 16 adresy meziraodulového styku je spojen s mezimodulovým adresovým výstupem 120, druhý výstup registru 16 adresy mezimodulového styku je spojen s prvním vstupem přepínače £ vstupních dat zápisníku, první výstup řídicích obvodů operačního bloku 1 7 je spojen se třetím vstupem registru £ adresy pro přesun dat, s druhým vstupem registru £ ukazovátka, s šestým vstupem řídicího adresového obvodu £, s druhým vstupem registru £ adresy mikroinstrukce, s šestým vstupem přepínače £ adresy mikroinstrukce, s prvním vstupem bloku řídicí paměti £, s druhým vstupem prvního výstupního registru 7 pamětí, s třetím vstupem registru 16 adresy mezimodulového styku, s druhým vstupem druhého výstupního registru £ paměti, s druhým vstupem výstupního registru 14 aritmetiky, s druhým vstupem registru 15 podmínkového kódu, s prvním vstupem arítmeticko-logického obvodu 13, s druhým vstupem vstupního dekodéru 12 aritmetiky, s druhým vstupem hlavní zápisníkové paměti 1Q , s druhým vstupem pomocné zápisníkové paměti 11 a s desátým vstupem přepínače £ vstupních dat zápisníku 9, druhý výstup řídicích obvodů operačního bloku 17 je spojen s výstupem 223 ovládacích signáTu vnějšího adaptoru, třetí výstup řídicích obvodů operačního bloku 17 je spojen s výstupem 122 stavových a řídicích signálů operačního bloku, dále jsou spolu propojeny druhý výstup bloku řídicí paměti 1, druhý výstup registru 4 adresy mikroinstrukce, druhý výstup registru 5 ukazovátka, druhý výstup registru £ adresy pro přesun dat, druhý výstup druhého výstupního registru £ paměti, druhý výstup hlavní zápisníkové paměti 10, třetí výstup registru 16 adresy mezimodulového styku a mezimodulový datový výstup 121 operačního bloku.

Operační blok přenosového procesoru provádí zejména zpracování informací převzatých z ostatních modulů počítače a vnějšího adaptoru a spolupracuje při řízení styku s těmito moduly.

Jeho činnost je řízena mikroprogramem uloženým v bloku řídicí paměti 1.

Mikroinstrukce přečtená v bloku řídicí paměti £ se ukládá do prvního a druhého výstupního registuu £, £ paměti.

Adresa, ze které je mikroinstrukce čtena, se do bloku řídicí paměti 1 přivádí přes přepínač £ adresy,a to bučí z řídicího adresového obvodu £,nebo z adresového vstupu 211 z vnějšího adaptoru.

Řídicí adresový obvod £ adresu vytváří tak, že buů k obsahu registru £ adresy mikroinstrukce přičte konstantu, jejíž hodnota závisí na typu mikroinstrukce a stavu operačního bloku nebo adresu převezme z prvního výstupního registru 7_ paměti.

Obsah mikroinstrukce zapamatovaný ve výstupních registrech 7, 8 paměti určuje činnost ostatních obvodů operačního bloku_;a to jednak pomocí řídicích informací vysílaných po vedení přímo do jednotlivých bloků, jednak prostřednictvím řídících obvodů operačního bloku 17.

Tyto obvody provádějí dekódování příkazů obražených v mikroinstrukci a vytvářejí potřebné signály jak pro vlastní řízení operačního bloku, tak pro spolupráci na řízení komunikace s mezimodulovým adaptorem a vnějším adaptorem.

Mikroinstrukce lze rozdělit do několika skup in.

Přenosové mikroinstrukce řídí přesun dat mezi hlavní zápisníkovou pamětí 10 a ostatními registry operačního bloku, blokem řídicí paměti, případně okolím.

Adresa řídicí pamětí, se kterou se má přesun uskutečnit, je v registru 6 adresy pro přesun dat.

Přitom výběr dat přesouvaných do hlavní zápisníkové paměti 10 je řízen prostřednictvím přepínače _9_ vstupních dat zápisníku.

Řídicí informace pro komunikaci s ostatními moduly počítače jsou obraženy v registru 16 adresy mezimodulového styku.

Aritmetícko-logické mikroinstrukce řídí zpracování operandů z hlavní a pomocné zápisníkové paměti 1 0 , 11 v aritmeticko-logickém obvodu 13 a uložení výsledku zpět do některé ze zápisníkových pamětí.

Výsledek zůstává zapamatován také ve výstupním registru 14 aritmetiky a do registru 15 podmínkového kódu se ukládá znak charakterizující typ výsledku: nulovost, přeteč ení.

Mikroinstrukce s přímým operandem, který lze uložit do hlavní zápisníkové paměti 10, do registru £ adresy pro přesun dat nebo lze provést logickou operaci mezi ním a slabikou z hlavní zápisníkové paměti 10.

Zvláštním typem mikroinstrukce je možno změnit obsah zvoleného bitu ve slabíce uložené v hlavní zápisníkové paměti 10 nebo v registrech mezimodulového či vnějšího adaptoru.

Operační blok přenosového procesoru komunikuje s okolím prostřednictvím několika vstupů a výstupů.

Tuto komunikací lze rozdělit na dvě části.

S ostatními moduly počítače komunikuje prostřednictvím zařízení pro styk mezi modu209742 ly podle autorského osvědčení č, 209 739 /PV 653-80/, do kterého vys ílá mezimodulovým adresovým výstupem 120 řídicí informace pro vlastní meziraodulovou komunikací, výstupem 122 stavových a řídicích signálů informace potřebné pro činnost mezimodulového adaptoru a mezimodulovým datovým výstupem 121 data určená pro přenos do jiného modulu počítače.

Z mezimodulového adaptoru přijímá mezimodulovým adresovým vstupem 110 adresu řídicí paměti, má-li se přenos dat uskutečnit s touto pamětí, mezimodulovým datovým vstupem 111 data, která mají být do operačního bloku převzata a příznakovým stupem 112 informace indikující případnou neúspěšnost komunikace s jiným modulem,eventuálně její příčiny.

Dále přijímá vstupem 113 ovládacích signálů a vstupem 114 chybových signálů informace potřebné pro spolupráci operačního bloku s mezimodulovým adaptorem.

S vnějším adaptorem přenosového procesoru komunikuje přímo.

Claims (1)

1. Operační blok přenosového procesoru sestávající z bloku řídicí paměti, přepínače adresy mikroinstrukce, řídicího adresového obvodu, registru adresy mikroinstrukce, registru ukazovátka, registru adresy pro přesun dat, prvního výstupního registru paměti, druhého výstupního registru paměti, přepínače vstupních dat zápisníku, hlavní zápisníkové paměti, pomocné zápisníkové paměti, vstupního dekodéru aritmetiky, aritme ticko-logického obvodu, výstupního registru aritmetiky, registru podmínkového kódu, registru adresy mezimodulového styku a řídicích obvodů operačního bloku, vyznačují se tím, že mezimodulový adresový vstup /110/ z mezimodulového adaptoru je spojen s prvním vstupem přepínače /2/ adresy mikroinstrukce, mezimodulový datový vstup /111/ z mezimodulového adaptoru je spojen s třetím vstupem bloku řídící paměti /1/ a se sedmým vstupem přepínače /9/ vstupních dat zápisníku, příznakový vstup /112/ z mezimodulového adaptoru je spojen s .osmým vstupem přepínače /9/ vstupních dat zápisníku, vstup /113/ ovládacích signálů z mezimodulového adaptoru je spojen s prvním vstupem řídících obvodů operačního bloku /17/, vstup /114/ chybových signálů mezimodulového adaptoru je spojen s druhým vstupem řídících obvodů operačního bloku / 17/, datový vstup ,210/ z vnějšího adaptoru je spojen s devátým vstupem přepínače /9/ vstupních dat zápisníku, adresový vstup /211/ z vnějšího adaptoru je spojen s druhým vstupem přepínače /2/ adresy mikroinstrukce a se čtvrtým vstupem bloku řídicí paměti /1/, vstup /212/ řídících signálů z vnějšího adaptoru je spojen s pátým vstupem řídicích obvodů operačního bloku /17/, vstup /213/ podmínkového signálu z vnějšího adaptoru je spojen s pátým vstupem řídicího adresového obvodu /3/, dále první výstup bloku řídicí paměti /1/ je spojen s prvním vstupem prvního výstupního registru /7/ paměti, výstup prvního výstupního registru /7/ paměti je spojen se čtvrtým vstupem řídících obvodů operačního bloku /17/, se druhým vstupem registru /16/ adresy mezimodulového styku, s prvním vstupem druhého výstupního registru /8/ paměti, s šestým vstupem přepínače /9/ vstupních dat zápisníku a s druhým vstupem řídicího adresového obvodu /3/, dále první výstup druhého výstupního registru /8/ paměti je spojen s třetím vstupem řídicích obvodů operačního bloku /17/, s třetím vstupem vstupního dekodéru /12/ aritmeDatovým vstupem 210 přijímá data, která mají být uložena do hlavní zápisníkové paměti, adresovým vstupem 211 jednak adresu řídicí paměti pro mikro přerušení, jednak data pro plnění řídicí paměti J_ a vstupem 2j2 řídicích signálů a vstupem 213 podmínkových signálů informace potřebné pro spolupráci operačního bloku s vnějším adaptorem.

   Datovým výstupem 220 předává vnějšímu adaptoru data z hlavní zápisníkové paměti 10,řídicím výstupem 221 informace z druhého výstupního registru £ paměti, adresovým výstupem 222 adresu mikroinstrukce při mikro přerušení a výstupem 223 ovládacích signálů řídící a časovači signály potřebné pro správnou činnost vnějšího adaptoru.

   Operační blok přenosového procesoru dle tohoto vynálezu je použitelný s výhodou při výrobě počítačů třetí a tři a půlté generace, případně i dalších generací.

   VYNÁLEZU tiky, se čtvrtým vstupem přepínače /9/ vstupních dat zápisníku, s druhým vstupem registru /6/ adresy pro přesun dat a s řídicím výstupem /221 / operačního bloku, výstup přepínače /2/ adresy mikroinstrukce je spojen se šestým vstupem bloku řídicí paměti /1/ a s prvním vstupem registru /4/ adresy mikroinstrukce, výstup řídicího adresového .obvodu /3/ je spojen se třetím vstupem přepínače /2/ adresy mikroinstrukce a 8 pátým vstupem bloku řídící paměti /1/, první výstup registru /4/ adresy mikroinstrukce je spojen s prvním vstupem řídicího adresového obvodu /3/ a s adresovým výstupem /222/ operačního bloku, první výstup registru /5/ ukazovátka je spojen se Čtvrtým vstupem přepínače /2/ adresy mikroinstrukce a s druhým vstupem přepínače /9/ vstupních dat zápisníku, první výstup registru /6/ adresy pro přesun dat je spojen s pátým vstupem přepínače /2/ adresy mikroinstrukce a se třetím vstupem přepínače /9/ vstupních dat zápisníku, výstup přepínače /9/ vstupních dat zápisníku je spojen s prvním vstupem hlavní zápisníkové paměti /10/ a s prvním vstupem pomocné zápisníkové paměti /11/, první výstup hlavní zápisníkové paměti /10/ je spojen s druhým vstup'em aritmetícko-logického obvodu /13/ s prvním vstupem registru /16/ adresy mezimodulového styku, s druhým vstupem bloku řídicí paměti /1/, s prvním vstupem registru /5/ ukazovátka, s prvním vstupem registru /6/ adresy pro přesun dat a s datovým výstupem /220/ operačního bloku, výstup pomocné zápisníkové paměti /11/ je spojen s prvním vstupem vstupního dekodéru /12/ aritmetiky, výstup vstupního dekodéru /12/ aritmetiky je spojen s třetím vstupem aritmetícko-logického obvodu /13/, první výstup aritmetícko-logického obvodu /13/ je spojen s prvním vstupem výstupního registru /14/ aritmetiky, druhý výstup ari tmět icko-logického obvodu /13/ je spojen s prvním vstupem registru /15/ podmínkového kódu, výstup výstupního registru /14/ aritmetiky je spojen s pátým vstupem přepínače /9/ vstupních dat zápisníku a se čtvrtým vstupem řídícího adresového obvodu /3/, výstup registru /15/ podmínkového kódu je spojen se třetím vstupem řídicího adresového obvodu /3/, první výstup registru /16/ adresy mezimodulového styku je spojen s mezimodulovým adresovým výstupem /120/, druhý výstup registru /16/ adresy mezimodulového styku je spojen s prvním vstupem přepínače /9/. vstupních dat zápisníku, první výstup řídících obvodů operačního bloku /17/ je spojen se třetím vstupem registru /6/ adresy pro přesun dat, s druhým vstupem registru /5/ ukazovátka, s šestým vstupem řídicího adresového obvodu /3/, s druhým vstupem registru /4/ adresy mikroínstrukce, s šestým vstupem přepínače /2/ adresy mikroinstrukce, s prvním vstupem bloku řídicí paměti /1/, s druhým vstupem prvního výstupního registru /7/ pamětí, s třetím vstupem registru /16/ adresy mezímodulového styku, s druhým vstupem druhého výstupního registru /8/ paměti, s druhým vstupem výstupního registru /14/ aritmetiky, s druhým vstupem registru /15/ podmínkového kódu, s prvním vstupem aritmeticko-logického obvodu /13/, s druhým vstupem vstupního dekodéru /12/ aritmetiky, s druhým vstupem hlavní zápisníkové paměti /10/, s druhým vstupem pomocné zápisníkové paměti /11/ a s desátým vstupem přepínače /9/ vtuupních dat zápisníku, druhý výstup řídících obvodů operačního bloku /17/ je spojen s výstupem /223/ ovládacích signálů vnějšího adaptoru, třetí výstup řídících obvodů operačního bloku /17/ je spojen s výstupem /122/ stavových a řídicích signálů operačního bloku, dále jsou spolu propojeny druhý výstup bloku řídicí paměti /1/, druhý výstup registru /4/ adresy mikroinstrukce, druhý výstup registru /5/ ukazovátka, druhý výstup registru /6/ adresy pro přesun dat, druhý výstup druhého výstupního re.gist ru paměti /8/, druhý výstup hlavní zápisníkové paměti /10/, třetí výstup registru /16/ adresy mezí modulového styku a mezimodulový datový výstup /121/ operačního bloku.