CN217689385U - 一种雷达干扰信号模拟器系统 - Google Patents
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Abstract
本实用新型公开了一种雷达干扰信号模拟器系统，包括FPGA单元装置、DSP控制单元装置、PCI总线接口模块、上位机、第一存储单元装置、第二存储单元装置、调制单元装置、信号发生单元装置、射频单元装置、功放单元装置和辐射天线单元装置；FPGA单元装置的第一输入输出端与PCI总线接口模块连接，DSP控制单元装置的输入输出端与PCI总线接口模块连接，PCI总线接口模块的输入输出端与上位机连接，且FPGA单元装置与DSP控制单元装置通讯连接等；本实用新型在可实现远程控制的同时，提高了实时性，提高了上位机的数据交互效率，且通用性强，能够更加贴近真实电磁环境。
Description
技术领域
本实用新型涉及雷达干扰信号模拟技术领域，具体涉及一种雷达干扰信号模拟器系统。
背景技术
随着雷达应用的发展，各种雷达系统进入到各个领域。其中，雷达系统在军事上的应用主要以破坏和扰乱对方雷达监测目标为目的。在雷达系统研制过程中，为了测试雷达系统的性能指标，需对其应用场景进行试验，需要构建出能够模拟真实电磁环境的雷达干扰信号。
现有技术中，雷达干扰信号模拟器可以根据预先设置的雷达数据，自动生成模拟的雷达信号，根据电磁环境输出雷达信号，形成空间辐射，对被测雷达系统进行检测。但是存在如下问题：现有雷达射频模拟器实时性较差，尤其是在远程遥控时存在信号收发时延的问题，另外，存在信号体制较为单一，通用性和扩展性较差，且与上位机的数据交互效率较低等问题。
实用新型内容
本实用新型的目的在于克服现有技术的不足，提供一种雷达干扰信号模拟器系统，在可实现远程控制的同时，提高了实时性和数据交互效率，且通用性强，能够更加贴近真实电磁环境；
本实用新型的目的是通过以下技术方案来实现的：
一种雷达干扰信号模拟器系统，包括FPGA单元装置、DSP控制单元装置、PCI总线接口模块、上位机、第一存储单元装置、第二存储单元装置、调制单元装置、信号发生单元装置、射频单元装置、功放单元装置和辐射天线单元装置；所述FPGA单元装置的第一输入输出端与PCI总线接口模块连接，所述DSP控制单元装置的输入输出端与PCI总线接口模块连接，所述PCI总线接口模块的输入输出端与上位机连接，且FPGA单元装置与DSP控制单元装置通讯连接；所述FPGA单元装置的第二输入输出端与第一存储单元装置连接，所述FPGA单元装置的第三输入输出端与第二存储单元装置连接；所述DSP控制单元装置的控制输出端与调制单元装置的输入端连接，所述调制单元装置的第一输出端与射频单元装置的第一输入端连接，所述调制单元装置的第二输出端与信号发生单元装置的输入端连接，所述信号发生单元装置的输出端与射频单元装置的第二输入端连接，所述射频单元装置的输出端与功放单元装置的输入端连接，所述功放单元装置的输出端与辐射天线单元装置的输入端连接，通过辐射天线单元装置辐射雷达干扰模拟信号。
进一步地，包括显示单元装置和交换机，所述显示单元装置和交换机分别与上位机通信连接。
进一步地，包括路由器和服务器，所述上位机的输入输出端与路由器的输入输出端连接，所述路由器的输入输出端与服务器的输入输出端连接。
进一步地，所述PCI总线接口模块包括PCI9054总线接口模块。
进一步地，所述第一存储单元装置为RAM单元装置，第二存储单元装置为Flash单元装置。
进一步地，所述信号发生单元装置包括DDS信号发生器。
本实用新型的有益效果是：
(1)本实用新型在可实现远程控制的同时，提高了实时性，提高了上位机的数据交互效率，且通用性强，能够更加贴近真实电磁环境；具体的，采用FPGA单元装置、DSP控制单元装置、PCI总线接口模块等，利用FPGA单元装置与DSP控制单元装置处理不同的数据流程，提高了数据处理的效率和实时性，利用不同存储装置来存储转发容量较大的雷达干扰信号模拟数据，提高数据输出速度，同时可结合利用交换机、路由器连接其他设备和远程服务器等，实现高速远程控制。
附图说明
为了更清楚地说明本实用新型实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本实用新型的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动性的前提下，还可以根据这些附图获得其他的附图。
图1为本实用新型的结构示意图。
具体实施方式
下面结合附图进一步详细描述本实用新型的技术方案，但本实用新型的保护范围不局限于以下所述。本说明书(包括任何附加权利要求、摘要和附图)中公开的任一特征，除非特别叙述，均可被其他等效或具有类似目的的替代特征加以替换。即，除非特别叙述，每个特征只是一系列等效或类似特征中的一个例子而已。
如图1所示，一种雷达干扰信号模拟器系统，包括FPGA单元装置、DSP控制单元装置、PCI总线接口模块、上位机、第一存储单元装置、第二存储单元装置、调制单元装置、信号发生单元装置、射频单元装置、功放单元装置和辐射天线单元装置；所述FPGA单元装置的第一输入输出端与PCI总线接口模块连接，所述DSP控制单元装置的输入输出端与PCI总线接口模块连接，所述PCI总线接口模块的输入输出端与上位机连接，且FPGA单元装置与DSP控制单元装置通讯连接；所述FPGA单元装置的第二输入输出端与第一存储单元装置连接，所述FPGA单元装置的第三输入输出端与第二存储单元装置连接；所述DSP控制单元装置的控制输出端与调制单元装置的输入端连接，所述调制单元装置的第一输出端与射频单元装置的第一输入端连接，所述调制单元装置的第二输出端与信号发生单元装置的输入端连接，所述信号发生单元装置的输出端与射频单元装置的第二输入端连接，所述射频单元装置的输出端与功放单元装置的输入端连接，所述功放单元装置的输出端与辐射天线单元装置的输入端连接，通过辐射天线单元装置辐射雷达干扰模拟信号。
进一步地，包括显示单元装置和交换机，所述显示单元装置和交换机分别与上位机通信连接。
进一步地，包括路由器和服务器，所述上位机的输入输出端与路由器的输入输出端连接，所述路由器的输入输出端与服务器的输入输出端连接。
进一步地，所述PCI总线接口模块包括PCI9054总线接口模块。
进一步地，所述第一存储单元装置为RAM单元装置，第二存储单元装置为Flash单元装置。
进一步地，所述信号发生单元装置包括DDS信号发生器。
实施例1
如图1所示，本领域技术人员可将本实用新型作为一种雷达干扰信号模拟器系统，包括FPGA单元装置、DSP控制单元装置、PCI总线接口模块、上位机、第一存储单元装置、第二存储单元装置、调制单元装置、信号发生单元装置、射频单元装置、功放单元装置和辐射天线单元装置；FPGA单元装置的第一输入输出端与PCI总线接口模块连接，DSP控制单元装置的输入输出端与PCI总线接口模块连接，PCI总线接口模块的输入输出端与上位机连接，且FPGA单元装置与DSP控制单元装置通讯连接；FPGA单元装置的第二输入输出端与第一存储单元装置连接，FPGA单元装置的第三输入输出端与第二存储单元装置连接；DSP控制单元装置的控制输出端与调制单元装置的输入端连接，调制单元装置的第一输出端与射频单元装置的第一输入端连接，调制单元装置的第二输出端与信号发生单元装置的输入端连接，信号发生单元装置的输出端与射频单元装置的第二输入端连接，射频单元装置的输出端与功放单元装置的输入端连接，功放单元装置的输出端与辐射天线单元装置的输入端连接，通过辐射天线单元装置辐射雷达干扰模拟信号。
在本实用新型的实施例中，通过设置和加载不同体制的雷达参数，采用灵活的数字波形产生方式形成数字信号，控制DDS产生多种体制的雷达信号，丰富了信号样式，提高了实时性，产生复杂逼真的电磁模拟训练环境，可以用于综合诊断测试系统等。
本领域人员所进行的改动和变化不脱离本实用新型的精神和范围，则都应在本实用新型所附权利要求的保护范围内。在以上描述中，为了提供对本实用新型的透彻理解，阐述了大量特定细节。然而，对于本领域普通技术人员显而易见的是：不必采用这些特定细节来实行本实用新型。在其他实例中，为了避免混淆本实用新型，未具体描述公知的技术，例如具体的细节，基本工作条件和其他的技术条件等。
Claims (6)
1.一种雷达干扰信号模拟器系统，其特征在于，包括FPGA单元装置、DSP控制单元装置、PCI总线接口模块、上位机、第一存储单元装置、第二存储单元装置、调制单元装置、信号发生单元装置、射频单元装置、功放单元装置和辐射天线单元装置；所述FPGA单元装置的第一输入输出端与PCI总线接口模块连接，所述DSP控制单元装置的输入输出端与PCI总线接口模块连接，所述PCI总线接口模块的输入输出端与上位机连接，且FPGA单元装置与DSP控制单元装置通讯连接；所述FPGA单元装置的第二输入输出端与第一存储单元装置连接，所述FPGA单元装置的第三输入输出端与第二存储单元装置连接；所述DSP控制单元装置的控制输出端与调制单元装置的输入端连接，所述调制单元装置的第一输出端与射频单元装置的第一输入端连接，所述调制单元装置的第二输出端与信号发生单元装置的输入端连接，所述信号发生单元装置的输出端与射频单元装置的第二输入端连接，所述射频单元装置的输出端与功放单元装置的输入端连接，所述功放单元装置的输出端与辐射天线单元装置的输入端连接，通过辐射天线单元装置辐射雷达干扰模拟信号。
2.根据权利要求1所述的雷达干扰信号模拟器系统，其特征在于，包括显示单元装置和交换机，所述显示单元装置和交换机分别与上位机通信连接。
3.根据权利要求2所述的雷达干扰信号模拟器系统，其特征在于，包括路由器和服务器，所述上位机的输入输出端与路由器的输入输出端连接，所述路由器的输入输出端与服务器的输入输出端连接。
4.根据权利要求1所述的雷达干扰信号模拟器系统，其特征在于，所述PCI总线接口模块包括PCI9054总线接口模块。
5.根据权利要求1所述的雷达干扰信号模拟器系统，其特征在于，所述第一存储单元装置为RAM单元装置，第二存储单元装置为Flash单元装置。
6.根据权利要求1所述的雷达干扰信号模拟器系统，其特征在于，所述信号发生单元装置包括DDS信号发生器。
Priority Applications (1)
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| CN202120981399.1U CN217689385U (zh) | 2021-05-08 | 2021-05-08 | 一种雷达干扰信号模拟器系统 |
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Publications (1)
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| CN217689385U true CN217689385U (zh) | 2022-10-28 |
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Family Applications (1)
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Country Status (1)
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2021
- 2021-05-08 CN CN202120981399.1U patent/CN217689385U/zh active Active
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