CN217283150U - 一种降低sdi输出信号抖动的电路 - Google Patents
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Abstract
本实用新型提供一种降低SDI输出信号抖动的电路，SDI输出信号抖动低，符合SDI规范要求。本实用新型包括视频处理输出电路和SDI发送电路，视频处理输出电路与SDI发送电路连接；其特征在于：还包括时钟分配芯片、时钟产生电路、第一匹配电阻、第二匹配电阻和第三匹配电阻；时钟产生电路的输出端通过第一匹配电阻与时钟分配芯片的输入端连接；时钟分配芯片的输出端通过第二匹配电阻与SDI发送电路的输入端连接，通过第三匹配电阻与视频处理输出电路的输入端连接。
Description
技术领域
本实用新型涉及一种降低SDI输出信号抖动的电路。
背景技术
SDI接口是一种串行数字视频传输接口，SDI接口分为：SDI、HD-SDI、3G-SDI，而HD-SDI接口是一种广播级的高清数字输入和输出端口，其中HD表示高清信号。由于SDI接口不能直接传送压缩数字信号，数字录像机、硬盘等设备记录的压缩信号重放后，必须经解压并经SDI接口输出才能进入SDI系统。如果反复解压和压缩，必将引起图像质量下降和延时增加，为此各种不同格式的数字录像机和，规定了自己的用于直接传输压缩数字信号的接口。
在广播电台、教育录播、视频会议等领域，HD-SDI和3G-SDI应用较为广泛，其是根据SMPTE292M和SMPTE424M，在1.485Gb/s或1.485/1.001Gb/s、2.97Gb/s或2.97/1.001Gb/s的信号速率条件下传输的接口规格。该规格规定了数据格式、信道编码方式、同轴电缆接口的信号规格、连接器及电缆类型与光纤接口等。SDI接口采用同轴电缆，以作为线缆标准，有效距离为100M。
传统方式SDI发送电路，受到视频处理输出电路输出的时钟信号质量影响较大，当视频处理输出电路输出的时钟信号质量较差、抖动较大时，SDI输出的信号抖动超标严重，无法满足SDI规范的要求，使其在系统中出现传输距离短、兼容性差的问题。
实用新型内容
本实用新型的目的在于克服现有技术中存在的上述不足，而提供一种结构设计合理的降低SDI输出信号抖动的电路，SDI输出信号抖动低，符合SDI规范要求。
本实用新型解决上述问题所采用的技术方案是：一种降低SDI输出信号抖动的电路，包括视频处理输出电路和SDI发送电路，视频处理输出电路与SDI发送电路连接；其特征在于：还包括时钟分配芯片、时钟产生电路、第一匹配电阻、第二匹配电阻和第三匹配电阻；时钟产生电路的输出端通过第一匹配电阻与时钟分配芯片的输入端连接；时钟分配芯片的输出端通过第二匹配电阻与SDI发送电路的输入端连接，通过第三匹配电阻与视频处理输出电路的输入端连接。
本实用新型所述的视频处理输出电路的视频信号输出接口与SDI发送电路的视频信号接收接口连接。
本实用新型所述的视频处理输出电路的时钟信号输出接口与SDI发送电路的时钟信号输入接口连接。
本实用新型还包括第四匹配电阻，所述的视频处理输出电路的时钟信号输出接口通过第四匹配电阻与SDI发送电路的时钟信号输入接口连接。
本实用新型所述的时钟分配芯片的型号为SI51210。
本实用新型所述的时钟产生电路中设置有时钟振荡器。
本实用新型与现有技术相比，具有以下优点和效果：视频处理输出电路输出需要的视频信号和时钟信号，视频信号和时钟信号送给SDI发送电路，它们的信号相位抖动相同，时钟产生电路产生的时钟信号通过时钟分配芯片送给SDI发送电路和视频处理输出电路；本实用新型具有适应性强、sdi输出信号抖动低符合SDI规范要求、对比其他电路成本低的优点，在视频处理输出电路输出的时钟信号质量较差的情况下也能输出符合标准的SDI信号。
附图说明
图1为本实用新型实施例的电路原理图。
图2为现有技术的SDI输出信号的眼图抖动图。
图3为本实用新型实施例的SDI输出信号的眼图抖动图。
具体实施方式
下面结合附图并通过实施例对本实用新型作进一步的详细说明，以下实施例是对本实用新型的解释而本实用新型并不局限于以下实施例。
本实用新型实施例包括视频处理输出电路1、SDI发送电路2、时钟分配芯片3和时钟产生电路4。
视频处理输出电路1用于输出摄像机采集到的视频信号和时钟信号。
SDI发送电路2接收来自视频处理器输出的视频信号和时钟信号，输出符合SDI标准的SDI信号。
视频处理输出电路1的视频信号输出接口与SDI发送电路2的视频信号接收接口连接。
时钟产生电路4的输出端通过第一匹配电阻R1与时钟分配芯片3的输入端连接，时钟产生电路4用于产生一个基础时钟送给时钟分配芯片3，第一匹配电阻R1的作用是减小时钟产生电路4输出时钟信号的反射，满足信号完整性要求。时钟产生电路4中设置有时钟振荡器。
时钟分配芯片3的输出端通过第二匹配电阻R2与SDI发送电路2的输入端连接，时钟分配芯片3产生的时钟信号送给SDI发送电路2，第二匹配电阻R2的作用是减小时钟分配芯片3输出时钟信号的反射，满足信号完整性要求。
时钟分配芯片3的输出端通过第三匹配电阻R3与视频处理输出电路1的输入端连接，时钟分配芯片3产生的时钟信号送给视频处理输出电路1，第三匹配电阻R3的作用是减小时钟分配芯片3输出时钟信号的反射，满足信号完整性要求。
视频处理输出电路1的时钟信号输出接口通过第四匹配电阻R4与SDI发送电路2的时钟信号输入接口连接， 视频处理输出电路1产生的时钟信号送给SDI发送电路2，第四匹配电阻R4的作用是减小视频处理输出电路1输出时钟信号的反射，满足信号完整性要求。
时钟分配芯片3的型号为SI51210。时钟分配芯片3主要用于产生SDI发送电路2和视频处理输出电路1所需的时钟，由于时钟分配芯片3产生的时钟是时钟产生电路4提供的基准，产生的时钟相位和抖动都是同相位的，SDI发送电路2以时钟分配芯片3为基准，内部产生一个SDI输出信号，视频处理器产生的时钟和相位会根据时钟分配芯片3产生时钟的相位抖动方向一致，使视频处理输出电路1实际输出的时钟信号抖动要求很低，从而实现SDI输出信号符合相关规范。
下表为现有技术和本实用新型的测试比对表。
此外，需要说明的是，本说明书中所描述的具体实施例，其零、部件的形状、所取名称等可以不同，本说明书中所描述的以上内容仅仅是对本实用新型结构所作的举例说明。凡依据本实用新型专利构思所述的构造、特征及原理所做的等效变化或者简单变化，均包括于本实用新型专利的保护范围内。本实用新型所属技术领域的技术人员可以对所描述的具体实施例做各种各样的修改或补充或采用类似的方式替代，只要不偏离本实用新型的结构或者超越本权利要求书所定义的范围，均应属于本实用新型的保护范围。
Claims (6)
1.一种降低SDI输出信号抖动的电路，包括视频处理输出电路和SDI发送电路，视频处理输出电路与SDI发送电路连接；其特征在于：还包括时钟分配芯片、时钟产生电路、第一匹配电阻、第二匹配电阻和第三匹配电阻；时钟产生电路的输出端通过第一匹配电阻与时钟分配芯片的输入端连接；时钟分配芯片的输出端通过第二匹配电阻与SDI发送电路的输入端连接，通过第三匹配电阻与视频处理输出电路的输入端连接。
2.根据权利要求1所述的降低SDI输出信号抖动的电路，其特征在于：所述的视频处理输出电路的视频信号输出接口与SDI发送电路的视频信号接收接口连接。
3.根据权利要求1所述的降低SDI输出信号抖动的电路，其特征在于：所述的视频处理输出电路的时钟信号输出接口与SDI发送电路的时钟信号输入接口连接。
4.根据权利要求3所述的降低SDI输出信号抖动的电路，其特征在于：还包括第四匹配电阻，所述的视频处理输出电路的时钟信号输出接口通过第四匹配电阻与SDI发送电路的时钟信号输入接口连接。
5.根据权利要求1所述的降低SDI输出信号抖动的电路，其特征在于：所述的时钟分配芯片的型号为SI51210。
6.根据权利要求1所述的降低SDI输出信号抖动的电路，其特征在于：所述的时钟产生电路中设置有时钟振荡器。
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| CN202220904894.7U CN217283150U (zh) | 2022-04-19 | 2022-04-19 | 一种降低sdi输出信号抖动的电路 |
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Publications (1)
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| CN217283150U true CN217283150U (zh) | 2022-08-23 |
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Family Applications (1)
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2022
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