CN215773352U - 一种支持去隔行处理的编码器 - Google Patents
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Abstract
本实用新型涉及视频影像处理的技术领域，尤其涉及一种支持去隔行处理的编码器。包括接口芯片、编码芯片和FPGA；FPGA与编码芯片信号连接，FPGA通过该信号连接接收编码后的数据并进行转化输出；FPGA包括有去隔行模块和信号模拟模块，FPGA的输入端与接口芯片的输出端连接，并通过去隔行模块对接口芯片的输入信号进行去隔行操作；信号模拟模块的输入端与去隔行模块连接，输出端与编码芯片信号输入端连接，信号模拟模块用于将去隔行后数据模拟成编码芯片所需的接收信号。本实用新型通过FPGA来进行去隔行处理，只需采用普通的接口芯片、编码芯片，能够极大的解决当前4K编码器成本高的问题，且该编码器结构可靠性高、应用广泛，能够有效满足当前4K视频编码的需求。
Description
技术领域
本实用新型涉及视频影像处理的技术领域，尤其涉及一种支持去隔行处理的编码器。
背景技术
近年来，随着计算机科学技术的迅猛发展，人们对图像实时性处理的要求也越来越高，对图像的分辨率的要求也逐渐增高，1080P的视频已经基本普及，4K/8K技术成为视频影像行业的下一风口。无论是广播电视台、电信运营商、新媒体运营商及任何有使用视听影音系统的服务型企业等，都势必会迎合当前的发展趋势，更新目前的音视频传输系统，目前终端用户在4K的设备升级上走的相当快，但是在整个产业前端，从内容制作，传输，处理均存在巨大挑战。
当前，在选用MIPI协议的HEVC 4K编码器中，通常采用接口芯片输出MIPI信号，编码芯片收到MIPI信号进行编码，编码后的数据给到FPGA再转成IP流传送给用户的方式进行。但目前MIPI接口芯片、MIPI编码芯片大都不支持去隔行处理，即使支持去隔行的芯片很多也受去隔行后的视频输出格式、芯片成本昂贵等原因制约。
发明内容
本实用新型解决当前4K编码器成本高、局限性大的技术问题，提供一种支持去隔行处理的编码器。
为解决上述技术问题，本实用新型的技术方案如下：
一种支持去隔行处理的编码器，包括接口芯片、编码芯片和FPGA；所述FPGA与所述编码芯片信号连接，所述FPGA通过该信号连接接收编码后的数据并进行转化输出；所述FPGA包括有去隔行模块和信号模拟模块，所述FPGA的输入端与所述接口芯片的输出端连接，并通过去隔行模块对接口芯片的输入信号进行去隔行操作；所述信号模拟模块的输入端与所述去隔行模块连接，输出端与所述编码芯片信号输入端连接，所述信号模拟模块用于将去隔行后数据模拟成编码芯片所需的接收信号。
进一步的，所述信号模拟模块转化后的信号为MIPI信号。
进一步的，所述接口芯片向FPGA输出BT1120格式的视频信号数据。
进一步的，所述FPGA与所述编码芯片之间通过MAC TO MAC方式信号连接。
进一步的，所述FPGA接收编码芯片编码后的数据并合成IP流输出。
进一步的，还包括主板交换芯片，所述主板交换芯片用于与所述FPGA输出端连接，接收FPGA的数据并传输至外部网络。
进一步的，所述FPGA采用XC7Z035-3FFG676E芯片。
进一步的，所述接口芯片采用IT6801FN芯片。
进一步的，还包括HDMI接口，所述接口芯片的输入端与HDMI接口连接，接收HDMI接口输入的视频流信号。
进一步的，所述编码器为选用MIPI协议的HEVC 4K编码器。
本实用新型通过FPGA来进行去隔行处理，只需采用普通的接口芯片、编码芯片，能够极大的解决当前4K编码器成本高的问题，且该编码器结构操作简单、可靠性高，应用广泛，能够有效满足当前4K视频编码的需求。
附图说明
图1为本实用新型中支持去隔行处理的编码器的结构框图。
图2为本实用新型中支持去隔行处理的编码器的电路图。
其中：
接口芯片为10，编码芯片为20，FPGA为30。
具体实施方式
为了使本实用新型的目的、技术方案及优点更加清楚明白，以下结合附图及实施例，对本实用新型进行进一步详细说明。应当理解，此处所描述的具体实施例仅仅用以解释本实用新型，并不用于限定本实用新型。
本申请实施例的附图中相同或相似的标号对应相同或相似的部件；在本申请的描述中，需要理解的是，若有术语“上”、“下”、“左”、“右”、“顶”、“底”、“内”、“外”等指示的方位或位置关系为基于附图所示的方位或位置关系，仅是为了便于描述本申请和简化描述，而不是指示或暗示所指的装置或元件必须具有特定的方位、以特定的方位构造和操作，因此附图中描述位置关系的用语仅用于示例性说明，不能理解为对本专利的限制。
此外，若有“第一”、“第二”等术语仅用于描述目的，主要是用于区分不同的装置、元件或组成部分(具体的种类和构造可能相同也可能不同)，并非用于表明或暗示所指示装置、元件或组成部分的相对重要性和数量，而不能理解为指示或者暗示相对重要性。
图1示出了本实用新型中支持去隔行处理的编码器的结构框图。
如图1所示，本实施例提供一种支持去隔行处理的编码器，该编码器包括接口芯片10、编码芯片20、FPGA30(Field Programmable Gate Array，现场可编程逻辑门阵列)和HDMI(High Definition Multimedia Interface，高清多媒体接口)接口，其中，请参阅图1-2，HDMI接口用于接收外部的视频流数据，接口芯片10用于根据预定的接口协议对接入的视频流数据转化为对应的输入信号，并输出至FPGA30中，编码芯片20则用于对输入信号进行编码操作。主要的，FPGA30用于接收接口芯片10的输入信号，对该输出信号进行去隔行处理后，模拟输出至编码芯片20进行编码，后续在通过与编码芯片20的信号连接，接收编码后的视频数据并进行封装、合成为IP流，并发送至下一节点。其中，本实施例的编码器为选用MIPI协议的HEVC(High Efficiency Video Coding，高效率视频编码)4K编码器，在具体的编译流程中，本实施例通过FPGA30来进行去隔行处理，使视频编码过程中，不需在接口芯片10、编码芯片20中增加去隔行功能，进而能够有效的减低编码器的成本。
在具体连接方面，FPGA30与编码芯片20信号连接，FPGA30通过该信号连接接收编码后的数据并进行转化输出，优选的，FPGA30与编码芯片20之间通过MAC TO MAC(一种信号连接方式)方式信号连接，FPGA30接收编码芯片20编码后的数据，并合成IP流后输出。
在编码芯片20进行编码前，接口芯片10的输入信号先通过FPGA30进行去隔行处理，具体的，FPGA30内包括有去隔行模块和信号模拟模块，FPGA30的输入端与接口芯片10的输出端连接，并通过去隔行模块对接口芯片10的输入信号进行去隔行操作；信号模拟模块的输入端与去隔行模块连接，输出端与编码芯片20信号输入端连接，信号模拟模块用于将去隔行后数据模拟成编码芯片20所需的接收信号，优选的，信号模拟模块转化后的信号为MIPI信号。在此步骤中，FPGA30内部将接口芯片10送过来的数据变成AXI4-Stream(一种总线协议)的形式，送入Video Process Subsystem(视频处理子系统)模块进行去隔行操作，Video Process Subsystem模块处理完之后就会进入MIPI TX(Mobile IndustryProcessor Interface，移动行业处理器接口)模块变成MIPI数据送出去。
请一并参阅图1-2，以下提供本实施例中的一些具体实施方式。
具体的，在一些实施例中，接口芯片10向FPGA30输出BT1120格式的视频信号数据。本实施例的编码器还包括主板交换芯片，主板交换芯片即是网口PHY芯片，该芯片主要用于将FPGA30的数据封装好通过网线将数据传输到外部网络。
在硬件的选择上，FPGA30采用XC7Z035-3FFG676E芯片。接口芯片10采用IT6801FN芯片。
为了更好的操作体验，提供本实施例中编码器内部信号传输步骤，具体的，接口芯片10接收HDMI信号，对信号进行处理后输出BT1120数据至FPGA30，FPGA30对数据进行去隔行处理后将数据模拟成MIPI信号并将数据送给编码芯片20，编码芯片20将数据进行编码后发回给FPGA30；FPGA30接收到编码后的数据后，将编码芯片20发回的数据合成为IP流，并通过主板交换芯片或者直接经RJ45芯片输出上传到网络中。
本实施例的好处在于，本实施例中的编码器利用FPGA30来接收接口芯片10的输入信号，对该信号进行去隔行处理后，再模拟成MIPI信号发送至编码芯片20进行编码，该编码器通过FPGA30来进行去隔行处理，只需采用普通的接口芯片10、编码芯片20，能够极大的解决当前4K编码器成本高的问题，且该编码器结构操作简单、可靠性高，应用广泛，能够有效满足当前4K视频编码的需求。
显然，本实用新型的上述实施例仅是为清楚地说明本实用新型所作的举例，而并非是对本实用新型的实施方式的限定。对于所属领域的普通技术人员来说，在上述说明的基础上还可以做出其它不同形式的变化或变动。这里无需也无法对所有的实施方式予以穷举。凡在本实用新型的精神和原则之内所作的任何修改、等同替换和改进等，均应包含在本实用新型权利要求的保护范围之内。
Claims (10)
1.一种支持去隔行处理的编码器，其特征在于，包括接口芯片(10)、编码芯片(20)和FPGA(30)；所述FPGA(30)与所述编码芯片(20)信号连接，所述FPGA(30)通过该信号连接接收编码后的数据并进行转化输出；所述FPGA(30)包括有去隔行模块和信号模拟模块，所述FPGA(30)的输入端与所述接口芯片(10)的输出端连接，并通过去隔行模块对接口芯片(10)的输入信号进行去隔行操作；所述信号模拟模块的输入端与所述去隔行模块连接，输出端与所述编码芯片(20)信号输入端连接，所述信号模拟模块用于将去隔行后数据模拟成编码芯片(20)所需的接收信号。
2.根据权利要求1所述的支持去隔行处理的编码器，其特征在于，所述信号模拟模块转化后的信号为MIPI信号。
3.根据权利要求1所述的支持去隔行处理的编码器，其特征在于，所述接口芯片(10)向FPGA(30)输出BT1120格式的视频信号数据。
4.根据权利要求1所述的支持去隔行处理的编码器，其特征在于，所述FPGA(30)与所述编码芯片(20)之间通过MAC TO MAC方式信号连接。
5.根据权利要求1所述的支持去隔行处理的编码器，其特征在于，所述FPGA(30)接收编码芯片(20)编码后的数据并合成IP流输出。
6.根据权利要求1所述的支持去隔行处理的编码器，其特征在于，还包括主板交换芯片，所述主板交换芯片用于与所述FPGA(30)输出端连接，接收FPGA(30)的数据并传输至外部网络。
7.根据权利要求1所述的支持去隔行处理的编码器，其特征在于，所述FPGA(30)采用XC7Z035-3FFG676E芯片。
8.根据权利要求1所述的支持去隔行处理的编码器，其特征在于，所述接口芯片(10)采用IT6801FN芯片。
9.根据权利要求1所述的支持去隔行处理的编码器，其特征在于，还包括HDMI接口，所述接口芯片(10)的输入端与HDMI接口连接，接收HDMI接口输入的视频流信号。
10.根据权利要求1所述的支持去隔行处理的编码器，其特征在于，所述编码器为选用MIPI协议的HEVC 4K编码器。
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Country Status (1)
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| CN (1) | CN215773352U (zh) |
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2021
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