CN209200928U - 一种具有缓启动的电流板 - Google Patents
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Abstract
本实用新型公开了一种具有缓启动的电流板,电源正输入端与第二电阻一端连接,第二电阻另一端分别与第四电阻一端、第三电阻一端连接,第四电阻另一端通过第二电容与电源负输入端连接,第三电阻另一端与NMOS管栅极连接,NMOS管漏极与电源负输入端连接,NMOS源极作为电源负输出端,电源正输入端还与第一电阻一端连接,第一电阻另一端通过第一电容与NMOS管源极连接,第二电阻与第三电阻的公共端与所述二极管的正极连接,二极管的负极与第一电阻、第一电容公共端连接。实用新型的有益效果是元器件少且成本低,通过NMOS管控制冲击电流达到电源缓启动的目的,即通过第一电阻、第一电容及二极管控制NMOS管的导通时间,抑制电源输入刚上电时的尖峰电流。
Description
技术领域
本实用新型属于电源启动领域,具体涉及一种具有缓启动的电流板。
背景技术
电源是向电子设备提供功率的装置,也称电源供应器,它提供计算机中所有部件所需要的电能,广泛用于电信工业等各个领域中,一个稳定提供电能的电源是支持电子设备正常工作的基本条件之一。
由于在电源接通的瞬间,会产生很大的冲击电流,冲击电流过大会造成电路板内部其他部件的损坏,因此,开关电源需要设计缓启动电路用于消除冲击电流。
实用新型内容
为克服现有技术存在的技术缺陷,本实用新型公开了一种具有缓启动的电流板,通过NMOS管控制冲击电流达到电源缓启动的目的。
本实用新型解决其技术问题所采用的技术方案是一种具有缓启动的电流板,包括缓启动电路,所述缓启动电路包括第一电阻、第二电阻、第三电阻、第四电阻、第一电容、第二电容、NMOS管及二极管;
电源正输入端与第二电阻一端连接,第二电阻另一端分别与第四电阻一端、第三电阻一端连接,第四电阻另一端通过第二电容与电源负输入端连接,第三电阻另一端与NMOS管栅极连接,NMOS管漏极与电源负输入端连接,NMOS管源极作为电源负输出端,电源正输入端还与第一电阻一端连接,第一电阻另一端通过第一电容与NMOS管源极连接,第二电阻与第三电阻的公共端与所述二极管的正极连接,二极管的负极与第一电阻、第一电容公共端连接。
优选地,所述缓启动电路还包括第三电容,第三电容一端与电源正输入端连接,其另一端与电源负输入端连接。
优选地,所述缓启动电路还包括第四电容,第四电容一端与电源正输出端连接,其另一端与电源负输出端连接。
优选地,所述缓启动电路还包括击穿管,击穿管的负极与二极管的正极连接,击穿管的正极与所述NMOS管源极连接。
优选地,所述缓启动电路还包括保险丝,保险丝一端与电源正输入端连接,其另一端与电源正输出端连接。
本实用新型的有益效果是:元器件少且成本低,通过NMOS管控制冲击电流达到电源缓启动的目的,即通过第一电阻、第一电容及二极管控制NMOS管的导通时间,抑制电源输入刚上电时的尖峰电流;第三电容和第四电容使电源输入和电源输出更稳定,消除电源输入和电源输出时的暂态响应。
附图说明
图1是本实用新型所述缓启动电路的一种具体实施方式原理示意图。
图2是本实用新型所述缓启动电路的另一种具体实施方式原理示意图。
附图标记:VIN+-电源正输入端,VIN--电源负输入端,OUT+-电源正输出端,OUT--电源负输出端,Q-NMOS管,R1-第一电阻,R2-第二电阻,R3-第三电阻,R4-第四电阻,D-二极管,ZD-击穿管,C1-第一电容,C2-第二电容,C3-第三电容,C4-第四电容,F-保险丝。
具体实施方式
以下结合附图及附图标记对本实用新型的实施方式做更详细的说明,使熟悉本领域的技术人在研读本说明书后能据以实施。应当理解,此处所描述的具体实施例仅用以解释本实用新型,并不用于限定本实用新型。
在本实用新型的描述中,需要说明的是,术语“上”、“水平”、“内”等指示的方位或位置关系为基于附图所示的方位或位置关系,仅是为了便于描述本实用新型和简化描述,而不是指示或暗示所指的装置或元件必须具有特定的方位、以特定的方位构造和操作,因此不能理解为对本实用新型的限制。
在本实用新型的描述中,需要说明的是,除非另有明确的规定和限定,术语“安装”、“连接”应做广义理解,例如,可以是固定连接,也可以是可拆卸连接,或一体地连接;可以是机械连接,也可以是电连接;可以是直接相连,也可以通过中间媒介间接相连,可以是两个元件内部的连通。对于本领域的普通技术人员而言,可以具体情况理解上述术语在本实用新型中的具体含义。
实施例:参见附图1,附图2所示的一种具有缓启动的电流板,包括缓启动电路,所述缓启动电路包括第一电阻R1、第二电阻R2、第三电阻R3、第四电阻R4、第一电容C1、第二电容C2、NMOS管Q及二极管D;
电源正输入端VIN+与第二电阻R2一端连接,第二电阻R2另一端分别与第四电阻R4一端、第三电阻R3一端连接,第四电阻R4另一端通过第二电容C2与电源负输入端VIN-连接,第三电阻R3另一端与NMOS管Q栅极连接,NMOS管Q漏极与电源负输入端VIN-连接,NMOS管Q源极作为电源负输出端OUT-,电源正输入端VIN+还与第一电阻R1一端连接,第一电阻R1另一端通过第一电容C1与NMOS管Q源极连接,第二电阻R2与第三电阻R3的公共端与所述二极管D的正极连接,二极管D的负极与第一电阻R1、第一电容C1公共端连接。
本实施例中,即通过第一电阻R1、第一电容C1及二极管D控制NMOS管Q的导通时间,抑制电源输入刚上电时的尖峰电流。
具体的,电源输入分为电源正输入端VIN+和电源负输入端VIN-,电源输出分为电源正输出端OUT+和电源负输出端OUT-,在电源输入和电源输出之间设置缓启动电路用于消除电源刚上电瞬间产生的尖峰电流,电源上电后,NMOS管Q栅极电压缓慢上升,当NMOS管Q栅极及其源极两端的电压高到一定值时,二极管D导通,电源输入通过第一电阻R1为第一电容C1充电,此时,NMOS管Q栅极及其源极两端的电压继续上升,直到NMOS管Q导通,电源输入与电源输出连通。第二电容C2被用作积分器对NMOS管Q的开关特性进行精确的控制。
其中,缓启动电路还包括第三电容C3,第三电容C3一端与电源正输入端VIN+连接,其另一端与电源负输入端VIN-连接。第三电容C3对电源输入做滤波处理,提高整个稳定电路的稳定性。
缓启动电路还包括第四电容C4,第四电容C4一端与电源正输出端OUT+连接,其另一端与电源负输出端OUT-连接。第四电容C4可以改变电源输入的暂态响应,以用于获得一个稳定的电源输出,进一步提高整个电路的稳定性。
优选地,所述缓启动电路还包括击穿管ZD,击穿管ZD的负极与二极管D的正极连接,击穿管ZD的正极与所述NMOS管Q源极连接。
在另一种实施方式中,二极管D用于限制NMOS管Q栅极及其源极之间的电压,用于保护NMOS管Q不被大电压击穿损坏。
优选地,所述缓启动电路还包括保险丝F,保险丝F一端与电源正输入端VIN+连接,其另一端与电源正输出端OUT+连接。
在另一种实施方式中,保险丝F设置在电源输出端,保险丝F也被称为电流保险丝,其主要是起过载保护作用。缓启动电路中正确安置保险丝F,保险丝F就会在电流异常升高到一定的高度和热度的时候,自身熔断切断电流,保护了缓启动电路安全运行。
以上内容是结合具体的优选实施方式对本实用新型作的进一步详细说明,不能认定本实用新型的具体实施方式只局限于这些说明。对于本实用新型所属技术领域的普通技术人员来说,在不脱离本实用新型的技术方案下得出的其他实施方式,均应包含在本实用新型的保护范围内。
Claims (5)
1.一种具有缓启动的电流板,其特征在于:包括缓启动电路,所述缓启动电路包括第一电阻(R1)、第二电阻(R2)、第三电阻(R3)、第四电阻(R4)、第一电容(C1)、第二电容(C2)、NMOS管(Q)及二极管(D);
电源正输入端(VIN+)与第二电阻(R2)一端连接,第二电阻(R2)另一端分别与第四电阻(R4)一端、第三电阻(R3)一端连接,第四电阻(R4)另一端通过第二电容(C2)与电源负输入端(VIN-)连接,第三电阻(R3)另一端与NMOS管(Q)栅极连接,NMOS管(Q)漏极与电源负输入端(VIN-)连接,NMOS管(Q)源极作为电源负输出端(OUT-),电源正输入端(VIN+)还与第一电阻(R1)一端连接,第一电阻(R1)另一端通过第一电容(C1)与NMOS管(Q)源极连接,第二电阻(R2)与第三电阻(R3)的公共端与所述二极管(D)的正极连接,二极管(D)的负极与第一电阻(R1)、第一电容(C1)公共端连接。
2.如权利要求1所述的具有缓启动的电流板,其特征在于:所述缓启动电路还包括第三电容(C3),第三电容(C3)一端与电源正输入端(VIN+)连接,其另一端与电源负输入端(VIN-)连接。
3.如权利要求1所述的具有缓启动的电流板,其特征在于:所述缓启动电路还包括第四电容(C4),第四电容(C4)一端与电源正输出端(OUT+)连接,其另一端与电源负输出端(OUT-)连接。
4.如权利要求1所述的具有缓启动的电流板,其特征在于:所述缓启动电路还包括击穿管(ZD),击穿管(ZD)的负极与二极管(D)的正极连接,击穿管(ZD)的正极与所述NMOS管(Q)源极连接。
5.如权利要求1所述的具有缓启动的电流板,其特征在于:所述缓启动电路还包括保险丝(F),保险丝(F)一端与电源正输入端(VIN+)连接,其另一端与电源正输出端(OUT+)连接。
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CN201822191733.4U CN209200928U (zh) | 2018-12-26 | 2018-12-26 | 一种具有缓启动的电流板 |
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CN111092546A (zh) * | 2019-12-26 | 2020-05-01 | 杭州电子科技大学 | 一种用于支持热拔插的浪涌抑制缓启动电路 |
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2018
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