CN208654223U - 一种带迟滞的欠压脉冲输出电路 - Google Patents
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Abstract
本实用新型涉及一种带迟滞的欠压脉冲输出电路，包括迟滞比较电路，所述迟滞比较电路的输入端连接有电压VIN，其特征在于：还包括脉冲输出电路，所述迟滞比较电路的输出端连接脉冲输出电路的输入端，所述脉冲输出电路包括定时器IC1，所述定时器IC1的第3引脚为脉冲输出电路的输出端。与现有技术相比，本实用新型的优点在于：通过将迟滞比较电路连接有脉冲输出电路，脉冲信号的频率和占空比可调，使欠压情况更加精准，并且结构简单，通过纯硬件的方式实现输入电压的欠压检测，并通过输出端的脉冲信号更加方便的了解到输入电压的欠压情况，系统可靠性更强。
Description
技术领域
本实用新型涉及欠压电路，特别涉及一种基于迟滞检测的欠压脉冲输出电路。
背景技术
电池作为现代化新能源技术的重要组成部分，它的电压状态一直是我们需要关注的，当电池输出电压出现异常时将会影响电池供电系统的安全性，当电池电压降低至临界电压时，即为欠压情况，不及时处理的话将会很难保证供电系统的正常使用。
在现有技术中，电池电压常采用芯片的电源电压与基准电压通过比较器进行比较来判断是否欠压，有申请号为CN200610024574.8(公布号为CN101034114A)的中国发明专利公开了一种过欠电压检测电路，包括在地与电源之间串联连接的三个电阻R1、R2和R3，一过欠压选择电路模块、两个比较器、一个过欠电压判断电路模块和一个参考电压，过欠压选择电路模块的两个电压采集端分别接在R1和R2中部，电压输出端与比较器2的一个输入端相连接；比较器2的输出端与过欠压选择电路模块的反馈信号输入端相连接；另一比较器1的一个输入端与R1不接地的一端相连接，过欠电压判断电路模块的两个信号输入端分别与两个比较器的输出端相连接。当两个比较器的输出都是0的时候，接有非门的与门会有信号输出，这就是欠电压信号；当两个比较器的输出都是1的时候，另外一个与门会有信号输出，这就是过电压信号；当两个比较器的输出不同的时候，两个与门都不会有信号输出，这表示电源电压正常。该发明只采用了一串电阻，减小了芯片的面积，并且对于比较器2的精度没有太高的要求，因此大大的降低了技术难度，以及生产的成本。但该发明中结构复杂，未考虑到电压的迟滞现象，且直接通过比较器的对比结果表示欠压信号，存在不稳定的情况，因此需要进一步改进。
实用新型内容
本实用新型所要解决的技术问题是针对现有技术的现状，提供一种结构简单且系统可靠性强的带迟滞的欠压脉冲输出电路。
本实用新型解决上述技术问题所采用的技术方案为：一种带迟滞的欠压脉冲输出电路，包括迟滞比较电路，所述迟滞比较电路的输入端连接有电压VIN，其特征在于：所述迟滞比较电路的输出端连接有脉冲输出电路，所述脉冲输出电路包括定时器IC1，所述定时器IC1的第3引脚为脉冲输出电路的输出端。
在本方案中，作为优选，所述迟滞比较电路包括比较器A1、第一电阻R1、第二电阻R2、第三电阻R3、第四电阻R4和第一电容C1，所述第一电阻R1和第二电阻R2串联，所述第一电阻R1另一端连接有第一电压VCC，所述第二电阻R2另一端接地，所述第二电阻R2与第一电容C1并联，所述比较器A1的正极连接在第一电阻R1和第二电阻R2之间，并与第三电阻R3相连接，所述第三电阻R3另一端连接第四电阻R4一端，所述第四电阻R4另一端连接第一电压VCC，所述比较器A1的负极为迟滞比较电路的输入端，所述比较器A1的输出端连接在第三电阻R3和第四电阻R4之间，所述比较器A1的输出端为迟滞比较电路的输出端。
进一步的，所述比较器A1的输出端与定时器IC1的第4引脚相连接。
为了调整脉冲输出电路的输出脉冲的频率和脉宽，所述脉冲输出电路还包括第四电容C4、第五电阻R5和第六电阻R6，所述第五电阻R5、第六电阻R6和第四电容C4依次串联，所述第五电阻R5另一端连接有第一电压VCC，所述第四电容C4另一端接地，所述定时器IC1的第7引脚连接在第五电阻R5和第六电阻R6之间，所述定时器IC1的第6引脚连接在第六电阻R6和第四电容C4之间并与第2引脚相连接。
所述脉冲输出电路还包括第三电容C3，所述第三电容C3两端分别连接有第一电压VCC和接地，所述定时器IC1的第8引脚连接在第三电容C3和第一电压VCC之间，所述定时器IC1的第1引脚接地。
所述脉冲输出电路还包括第二电容C2，所述第二电容C2一端连接在定时器IC1的第5引脚，另一端接地。
作为优选，所述定时器IC1为ICM7555芯片。
具体的，所述比较器A1为反向比较器。
与现有技术相比，本实用新型的优点在于：通过将迟滞比较电路连接有脉冲输出电路，脉冲信号的频率和占空比可调，使欠压情况更加精准，并且结构简单，通过纯硬件的方式实现输入电压的欠压检测，并通过输出端的脉冲信号更加方便的了解到输入电压的欠压情况，系统可靠性更强。
附图说明
图1为本实用新型实施例的带迟滞的欠压脉冲输出电路图。
具体实施方式
以下结合附图实施例对本实用新型作进一步详细描述。
如图1所示，一种带迟滞的欠压脉冲输出电路包括迟滞比较电路1和脉冲输出电路2，迟滞比较电路1的输入端为电压VIN，迟滞比较电路1的输出端连接脉冲输出电路2的输入端。
在本实施例中，迟滞比较电路1包括比较器A1、第一电阻R1、第二电阻R2、第三电阻R3、第四电阻R4和第一电容C1，第一电阻R1和第二电阻R2串联，第一电阻R1另一端连接有第一电压VCC，第二电阻R2另一端接地，第二电阻R2与第一电容C1并联，比较器A1的正极连接在第一电阻R1和第二电阻R2之间，并与第三电阻R3相连接，第三电阻R3另一端连接第四电阻R4一端，第四电阻R4另一端连接第一电压VCC，比较器A1的负极为迟滞比较电路1的输入端，比较器A1的输出端连接在第三电阻R3和第四电阻R4之间，比较器A1的输出端为迟滞比较电路1的输出端。本实施例中，比较器A1为反向比较器，当输入电压值VIN大于参考电压VREF时，输出端为低电平，当输入电压值VIN小于参考电压VREF时，输出端为高电平。
具体的，脉冲输出电路2包括定时器IC1、第二电容C2、第三电容C3、第四电容C4、第五电阻R5和第六电阻R6，第五电阻R5、第六电阻R6和第四电容C4依次串联，第五电阻R5另一端连接有第一电压VCC，第四电容C4另一端接地，定时器IC1的第7引脚连接在第五电阻R5和第六电阻R6之间，定时器IC1的第6引脚连接在第六电阻R6和第四电容C4之间并与第2引脚相连接；第三电容C3两端分别连接有第一电压VCC和接地，定时器IC1的第8引脚连接在第三电容C3和第一电压VCC之间，定时器IC1的第1引脚接地；第二电容C2一端连接在定时器IC1的第5引脚，另一端接地；比较器A1的输出端与定时器IC1的第4引脚相连接；定时器IC1的第3引脚为脉冲输出电路2的输出端OUTPUT。在本实施例中，定时器IC1为ICM7555芯片。
在使用该电路时，比较器A1的正极为参考电压VREF，通过第一电阻R1、第二电阻R2、第三电阻R3和第四电阻R4的大小来调整比较器A1的参考电压VREF的迟滞范围，电压迟滞的下限为:电压迟滞的上限为:当迟滞比较电路1的输入端(即比较器A1的负极输入)的电压VIN值大于比较器A1的参考电压VREFmax时，则迟滞比较电路1的输出端输出为低电平，该低电平信号输入到脉冲输出电路2的定时器IC1的第4引脚内，因此定时器IC1的第3引脚的输出信号OUTPUT为低电平，则无脉冲信号输出，表示输入的电压VIN未出现欠压；当迟滞比较电路1的输入端(即比较器A1的负极输入)的电压VIN值小于比较器A1的参考电压VREFmin时，则迟滞比较电路1的输出端输出为高电平，该高电平信号输入到脉冲输出电路2的定时器IC1的第4引脚内，则定时器IC1的第3引脚的输出信号OUTPUT为高电平，并相应输出脉冲信号，脉冲频率为：脉冲宽占空比为：表示输入的电压VIN出现欠压。
因此当将该电路应用于检测欠压时，通过将比较器的参考电压设置一定的迟滞范围，增加了系统的可靠性，并且根据电路的输出信号OUTPUT是否输出脉冲信号，脉冲信号的频率和占空比可调，更加方便判断出输入电压值在一定迟滞范围内是否出现欠压情况，而直接通过比较器输出信号的高、低电平来判断欠压情况时只出现高电平时表示欠压，易出现结果不稳定的情况，因此该电路的输出结果更加精准，系统可靠性更强。
以上所述仅是本实用新型的优选实施方式，应当指出，对于本技术领域的普通技术人员来说，在不脱离本实用新型技术原理的前提下，还可以做出若干改进和润饰，这些改进和润饰也应视为本实用新型的保护范围。
Claims (8)
1.一种带迟滞的欠压脉冲输出电路，包括迟滞比较电路，所述迟滞比较电路的输入端连接有电压VIN，其特征在于：还包括脉冲输出电路，所述迟滞比较电路的输出端连接脉冲输出电路的输入端，所述脉冲输出电路包括定时器IC1，所述定时器IC1的第3引脚为脉冲输出电路的输出端。
2.根据权利要求1所述的带迟滞的欠压脉冲输出电路，其特征在于：所述迟滞比较电路包括比较器A1、第一电阻R1、第二电阻R2、第三电阻R3、第四电阻R4和第一电容C1，所述第一电阻R1和第二电阻R2串联，所述第一电阻R1另一端连接有第一电压VCC，所述第二电阻R2另一端接地，所述第二电阻R2与第一电容C1并联，所述比较器A1的正极连接在第一电阻R1和第二电阻R2之间，并与第三电阻R3相连接，所述第三电阻R3另一端连接第四电阻R4一端，所述第四电阻R4另一端连接第一电压VCC，所述比较器A1的负极为迟滞比较电路的输入端，所述比较器A1的输出端连接在第三电阻R3和第四电阻R4之间，所述比较器A1的输出端为迟滞比较电路的输出端。
3.根据权利要求2所述的带迟滞的欠压脉冲输出电路，其特征在于：所述比较器A1的输出端与定时器IC1的第4引脚相连接。
4.根据权利要求1所述的带迟滞的欠压脉冲输出电路，其特征在于：所述脉冲输出电路还包括第四电容C4、第五电阻R5和第六电阻R6，所述第五电阻R5、第六电阻R6和第四电容C4依次串联，所述第五电阻R5另一端连接有第一电压VCC，所述第四电容C4另一端接地，所述定时器IC1的第7引脚连接在第五电阻R5和第六电阻R6之间，所述定时器IC1的第6引脚连接在第六电阻R6和第四电容C4之间并与第2引脚相连接。
5.根据权利要求4所述的带迟滞的欠压脉冲输出电路，其特征在于：所述脉冲输出电路还包括第三电容C3，所述第三电容C3两端分别连接有第一电压VCC和接地，所述定时器IC1的第8引脚连接在第三电容C3和第一电压VCC之间，所述定时器IC1的第1引脚接地。
6.根据权利要求5所述的带迟滞的欠压脉冲输出电路，其特征在于：所述脉冲输出电路还包括第二电容C2，所述第二电容C2一端连接在定时器IC1的第5引脚，另一端接地。
7.根据权利要求1或3或4或5或6任一项所述的带迟滞的欠压脉冲输出电路，其特征在于：所述定时器IC1为ICM7555芯片。
8.根据权利要求2或3所述的带迟滞的欠压脉冲输出电路，其特征在于：所述比较器A1为反向比较器。
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| Publication number | Priority date | Publication date | Assignee | Title |
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| CN117706178A (zh) * | 2024-02-05 | 2024-03-15 | 深圳市芯茂微电子有限公司 | 一种电压监测电路 |
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2018
- 2018-07-12 CN CN201821105745.4U patent/CN208654223U/zh active Active
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