CN208580376U - 一种d波电台用微处理器复位电路 - Google Patents
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Abstract
本实用新型提供一种D波电台用微处理器看门狗电路，旨在提高D波电台用微处理器的可靠性并降低成本，其用于连接微处理器，包括晶振电路和复位电路，本实用新型以无源晶振Y2溢出周期固定输出的定时脉冲作为计数器的基本时钟定时单元，由微处理器控制对所述计数器进行看门狗清零，通过预设所述计数器的清零参考溢出值，从而实现灵活配置定时复位时间，本实用新型整体结构简单、成本低、可靠性高。
Description
技术领域
本实用新型涉及一种复位电路，具体涉及一种D波电台用微处理器复位电路。
背景技术
电子设备的可靠性一直以来是工程师追求的目标，尤其是在矿难发生时，常规信号无法穿透地面，故D波矿难营救系统应运而生，而D波信号在传输时，常常由于信号弱、电压不稳等原因造成微处理器程序跑飞或死机等问题，导致了设备工作异常。为了保证微处理器在受到干扰后能够自动恢复正常，一般在电路中会增加看门狗电路或在程序中增加看门狗软件，以期检测到系统工作异常时，对微处理器执行复位，使其能够尽快恢复，对无人值守的设备尤为重要。
实用新型内容
本实用新型的目的是提供一种D波电台用微处理器复位电路，旨在提高D波电台用微处理器的可靠性并降低成本。
为了达到上述目的，本实用新型所采用的技术方案是：一种D波电台用微处理器复位电路，用于连接微处理器，包括晶振电路和复位电路，
所述晶振电路包括：与所述微处理器的OSC_IN接口和OSC_OUT接口连接的无源晶振Y2，并联在无源晶振Y2两侧的电阻R7，连接在所述微处理器的OSC_IN接口和接地端之间的电容C4，连接在所述微处理器的OSC_OUT接口和接地端之间的电容C3；
所述复位电路包括监控芯片U3和充电插座J3，所述充电插座J3的引脚1与所述监控芯片U3的MR接口相连，所述充电插座J3的引脚2与所述监控芯片U3的WDO接口相连，所述监控芯片U3的VDD接口与+3.3V电源相连，+3.3V电源与所述监控芯片U3的PFI接口之间连接有电容C2，所述监控芯片U3的PFI接口与所述监控芯片U3的GND接口相连后共同接地，所述监控芯片U3的RESET接口与所述微处理器的NRST接口相连，所述监控芯片U3的WDI接口与所述微处理器的引脚100相连。
进一步的，所述监控芯片U3的RESET接口与电阻R6的一端相连，电阻R6的另一端分别与+3.3V电源和电阻R5的一端相连，电阻R5的另一端与所述监控芯片U3的WDI接口相连。
进一步的，所述无源晶振Y2的晶振频率为8MHz。
进一步的，所述微处理器的型号为STM32F103ZET6。
与现有技术相比，本实用新型的有益效果是：本实用新型以无源晶振Y2溢出周期固定输出的定时脉冲作为计数器的基本时钟定时单元，由微处理器控制对所述计数器进行看门狗清零，通过预设所述计数器的清零参考溢出值，从而实现灵活配置定时复位时间，本实用新型整体结构简单、成本低、可靠性高。
附图说明
图1是本实用新型的原理框图；
图2是本实用新型中晶振电路的电路图；
图3是本实用新型中复位电路的电路图；
图中标记：1、微处理器，2、晶振电路，3、复位电路。
具体实施方式
为使本实用新型实施例的目的、技术方案和优点更加清楚，下面将结合本实用新型中的附图，对本实用新型实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例是本实用新型一部分实施例，而不是全部的实施例，基于本实用新型中的实施例，本领域普通技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本实用新型保护的范围。
一种D波电台用微处理器复位电路，用于连接微处理器1，如图1所示，包括晶振电路2和复位电路3，所述微处理器1的型号为STM32F103ZET6。
如图2所示，所述晶振电路2包括：与所述微处理器1的OSC_IN接口和OSC_OUT接口连接的无源晶振Y2，并联在无源晶振Y2两侧的电阻R7，连接在所述微处理器1的OSC_IN接口和接地端之间的电容C4，连接在所述微处理器1的OSC_OUT接口和接地端之间的电容C3；
如图3所示，所述复位电路3包括监控芯片U3和充电插座J3，所述充电插座J3的引脚1与所述监控芯片U3的MR接口相连，所述充电插座J3的引脚2与所述监控芯片U3的WDO接口相连，所述监控芯片U3的VDD接口与+3.3V电源相连，+3.3V电源与所述监控芯片U3的PFI接口之间连接有电容C2，所述监控芯片U3的PFI接口与所述监控芯片U3的GND接口相连后共同接地，所述监控芯片U3的RESET接口与所述微处理器1的NRST接口相连，所述监控芯片U3的WDI接口与所述微处理器1的引脚100，
即PA/8USART1_CK/TIM1_CH1/MCO接口相连。所述监控芯片U3的RESET接口与电阻R6的一端相连，电阻R6的另一端分别与+3.3V电源和电阻R5的一端相连，电阻R5的另一端与所述监控芯片U3的WDI接口相连。
所述无源晶振Y2的晶振频率为8MHz。
本实用新型以无源晶振Y2溢出周期固定输出的定时脉冲作为计数器的基本时钟定时单元，由微处理器控制对所述计数器进行看门狗清零，通过预设所述计数器的清零参考溢出值，从而实现灵活配置定时复位时间，本实用新型整体结构简单、成本低、可靠性高。
对所公开的实施例的上述说明，使本领域专业技术人员能够实现或使用本实用新型。对这些实施例的多种修改对本领域的专业技术人员来说将是显而易见的，本文中所定义的一般原理可以在不脱离本实用新型的精神或范围的情况下，在其它实施例中实现。因此，本实用新型将不会被限制于本文所示的这些实施例，而是要符合与本文所公开的原理和新颖特点相一致的最宽的范围。
Claims (4)
1.一种D波电台用微处理器复位电路，用于连接微处理器（1），包括晶振电路（2）和复位电路（3），其特征在于：
所述晶振电路（2）包括：与所述微处理器（1）的OSC_IN接口和OSC_OUT接口连接的无源晶振Y2，并联在无源晶振Y2两侧的电阻R7，连接在所述微处理器（1）的OSC_IN接口和接地端之间的电容C4，连接在所述微处理器（1）的OSC_OUT接口和接地端之间的电容C3；
所述复位电路（3）包括监控芯片U3和充电插座J3，所述充电插座J3的引脚1与所述监控芯片U3的MR接口相连，所述充电插座J3的引脚2与所述监控芯片U3的WDO接口相连，所述监控芯片U3的VDD接口与+3.3V电源相连，+3.3V电源与所述监控芯片U3的PFI接口之间连接有电容C2，所述监控芯片U3的PFI接口与所述监控芯片U3的GND接口相连后共同接地，所述监控芯片U3的RESET接口与所述微处理器（1）的NRST接口相连，所述监控芯片U3的WDI接口与所述微处理器（1）的引脚100相连。
2.根据权利要求1所述的一种D波电台用微处理器复位电路，其特征在于：所述监控芯片U3的RESET接口与电阻R6的一端相连，电阻R6的另一端分别与+3.3V电源和电阻R5的一端相连，电阻R5的另一端与所述监控芯片U3的WDI接口相连。
3.根据权利要求1所述的一种D波电台用微处理器复位电路，其特征在于：所述无源晶振Y2的晶振频率为8MHz。
4.根据权利要求1所述的一种D波电台用微处理器复位电路，其特征在于：所述微处理器（1）的型号为STM32F103ZET6。
Priority Applications (1)
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|---|---|---|---|
| CN201821022581.9U CN208580376U (zh) | 2018-06-29 | 2018-06-29 | 一种d波电台用微处理器复位电路 |
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Publications (1)
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| CN208580376U true CN208580376U (zh) | 2019-03-05 |
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|---|---|
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2018
- 2018-06-29 CN CN201821022581.9U patent/CN208580376U/zh active Active
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