CN205645207U - 一种数码管驱动电路 - Google Patents
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Abstract
本实用新型涉及数码管驱动技术领域，尤其涉及一种数码管驱动电路，本实用新型采用如下技术方案：包括处理器、PNP三极管、驱动电阻、限流电阻、数码管，处理器的IO1电连接PNP三极管的基极，在位于处理器的IO1与PNP三极管的基极之间串接驱动电阻，电源电路电连接PNP三极管的发射极，PNP三极管的集电极电连接数码管的控制端，在位于PNP三极管的集电极与数码管的控制端之间还串接有限流电阻，数码管的发光二极管分别与处理器的通用IO2口相连接，本实用新型的优点在于：采用单一限流电阻的方式，可以有效的节省电路板设计占用的空间,以及减少故障的几率。
Description
技术领域：
本实用新型涉及数码管驱动领域，尤其涉及一种数码管驱动电路。
背景技术：
现有的数码管驱动电路，基本的半导体数码管是由7个条状的发光二极管组成，然而每段发光二极管均要设置限流电阻，一方面增大了电路板占用的位置，相应的增大了成品的体积，故障率也相应的提高，不适合现有技术中推广及应用。
发明内容：
本实用新型的目的在于提供一种数码管驱动电路，具体目的在于提供一种结构简单且点亮效果更佳的数码管驱动电路。
为达到上述目的，本实用新型采用如下技术方案：一种数码管驱动电路，包括处理器、PNP三极管、驱动电阻、限流电阻、数码管，其特征在于：处理器的IO1电连接PNP三极管的基极，在位于处理器的IO1与PNP三极管的基极之间串接驱动电阻，电源电路电连接PNP三极管的发射极，PNP三极管的集电极电连接数码管的控制端，在位于PNP三极管的集电极与数码管的控制端之间还串接有限流电阻，数码管的发光二极管分别与处理器的通用IO2口相连接。
进一步的，所述的处理器内设置有显示控制模块，显示控制模块驱动连接控制处理器的通用IO2口输出时间。
进一步的，所述的处理器内设置有显示控制模块，显示控制模块驱动连接控制处理器的通用IO1口输出时间。
进一步的，所述的限流电阻阻值为47Ω-100Ω，驱动电阻阻值为4700Ω-5100Ω。
优选的，所述的处理器为译码器或单片机。
优选的，所述的处理器为单片机且型号为：HT46R065B。
本实用新型的优点在于：采用单一限流电阻的方式，可以有效的节省电路板设计占用的空间，有效的减少故障发生的几率。
附图说明：
附图1为实施例1的一种数码管驱动电路的连接结构图。
具体实施方式：
实施例1：参照图1，一种数码管驱动电路，包括处理器MCU、PNP三极管、驱动电阻R1、限流电阻R2、数码管L1，处理器MCU的IO1电连接PNP三极管的基极，在位于处理器MCU的IO1与PNP三极管的基极之间串接驱动电阻R1，电源电路电连接PNP三极管的发射极，PNP三极管的集电极电连接数码管L1的控制端，在位于PNP三极管的集电极与数码管L1的控制端之间还串接有限流电阻R2，数码管L1的发光二极管分别与处理器的通用IO2口相连接。
上述实施例中，通用IO2口设置有IO2.1、IO2.2.、IO2.3、IO2.4、IO2.5、IO2.6、IO2.7为7组接口，并分别与数码管L1的a、b、c、d、e、f、g连接，PNP三极管的集电极电连接数码管L1的控制端COM，数码管L1可以采用共阳极数码管，当通用IO2的IO2.1、IO2.2.、IO2.3、IO2.4、IO2.5、IO2.6、IO2.7输出低电平时则可以点亮数码管L1内相应接点的发光二极管，由此可以显示出需要的数字。
上述实施例中，限流电阻R2同样可以起到保护数码管L1的作用，相对于传统的电路，有效的减小的电路板的面积，减少了故障的发生率。
上述的处理器MCU内设置有显示控制模块，显示控制模块驱动连接控制处理器MCU的通用IO2口输出时间或显示控制模块驱动连接控制处理器MCU的通用IO1口输出时间，由此可以达到动态显示的目的，具体的可以相应的设置输出显示的时间为1-10ms，由于灯的余辉效应，其显示效果与静态显示效果也是一致的。
优选的，限流电阻R2阻值为47Ω-100Ω，驱动电阻R1阻值为4700Ω-5100Ω。
优选的，上述的处理器MCU为译码器或单片机。
优选的，上述的处理器为单片机MCU且型号为：HT46R065B。
当然，以上仅为本实用新型较佳实施方式，并非以此限定本实用新型的使用范围，故，凡是在本实用新型原理上做等效改变均应包含在本实用新型的保护范围内。
Claims (6)
1.一种数码管驱动电路，包括处理器、PNP三极管、驱动电阻、限流电阻、数码管，其特征在于：处理器的IO1电连接PNP三极管的基极，在位于处理器的IO1与PNP三极管的基极之间串接驱动电阻，电源电路电连接PNP三极管的发射极，PNP三极管的集电极电连接数码管的控制端，在位于PNP三极管的集电极与数码管的控制端之间还串接有限流电阻，数码管的发光二极管分别与处理器的通用IO2口相连接。
2.根据权利要求1所述的一种数码管驱动电路，其特征在于：所述的处理器内设置有显示控制模块，显示控制模块驱动连接控制处理器的通用IO2口输出时间2。
3.根据权利要求1所述的一种数码管驱动电路，其特征在于：所述的处理器内设置有显示控制模块，显示控制模块驱动连接控制处理器的通用IO1口输出时间。
4.根据权利要求1或2或3所述的一种数码管驱动电路，其特征在于：所述的限流电阻阻值为47Ω-100Ω，驱动电阻阻值为4700Ω-5100Ω。
5.根据权利要求1或2或3所述的一种数码管驱动电路，其特征在于：所述的处理器为译码器或单片机。
6.根据权利要求5所述的一种数码管驱动电路，其特征在于：所述的处理器为单片机且型号为：HT46R065B。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| CN201620104030.1U CN205645207U (zh) | 2016-02-02 | 2016-02-02 | 一种数码管驱动电路 |
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| CN201620104030.1U CN205645207U (zh) | 2016-02-02 | 2016-02-02 | 一种数码管驱动电路 |
Publications (1)
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| CN205645207U true CN205645207U (zh) | 2016-10-12 |
Family
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Family Applications (1)
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| CN201620104030.1U Active CN205645207U (zh) | 2016-02-02 | 2016-02-02 | 一种数码管驱动电路 |
Country Status (1)
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| CN (1) | CN205645207U (zh) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN106920497A (zh) * | 2017-05-17 | 2017-07-04 | 安徽久能信息科技有限公司 | 一种数码管显示电路 |
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2016
- 2016-02-02 CN CN201620104030.1U patent/CN205645207U/zh active Active
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| TR01 | Transfer of patent right |