CN204925258U - 缺相检测电路 - Google Patents
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Abstract
本实用新型属于缺相检测技术领域，尤其是涉及一种缺相检测电路。包括第一相线、第二相线和第三相线，第一相线、第二相线和第三相线与第一电阻输入端相连，第一电阻输出端与第二电阻输入端相连，第二电阻输出端接地，第一电阻输出端还与第三电阻输入端相连，第二电阻输出端还与第一电容输入端相连，第三电阻输出端和第一电容输出端与缺相检测芯片相连，缺相检测芯片包括第一芯片和第二芯片。与现有的技术相比，本缺相检测电路的优点在于：设计合理，结构简单，检测精确，检测灵敏度高，能快速的发现缺项，可把危害降到最低，防止电机烧坏。
Description
技术领域
本实用新型属于缺相检测技术领域，尤其是涉及一种缺相检测电路。
背景技术
现有技术中，很多设备都是三相供电的，如果发生缺相的话可能会导致设备不能正常工作甚至烧坏设备等危害，如果产生高的悬浮电压甚至会对人身造成伤害，故及早发现缺相可把危害降到最低。现有的检测电路在使用中检测精确度较低，检测灵敏性差。
实用新型内容
本实用新型的目的是针对上述问题，提供一种设计合理，结构简单，检测精确的缺相检测电路。
为达到上述目的，本实用新型采用了下列技术方案：本缺相检测电路，其特征在于，包括第一相线、第二相线和第三相线，所述的第一相线、第二相线和第三相线与第一电阻输入端相连，所述的第一电阻输出端与第二电阻输入端相连，所述的第二电阻输出端接地，所述的第一电阻输出端还与第三电阻输入端相连，所述的第二电阻输出端还与第一电容输入端相连，所述的第三电阻输出端和第一电容输出端与缺相检测芯片相连，所述的缺相检测芯片包括第一芯片和第二芯片，所述的第三电阻输出端和第一电容输出端与第一芯片的第一低触发端引脚以及第一高触发端引脚相连，所述的第一芯片上的第一清零端引脚和第一芯片上的外接电源引脚相连后与第二芯片上的第二低触发端引脚相连，所述的第一芯片上的第一输出端与第二芯片上的第二高触发端引脚相连。
在上述的缺相检测电路中，所述的第一相线、第二相线和第三相线与第一电阻输入端之间分别通过第一二极管、第二二极管、第三二极管相连。
在上述的缺相检测电路中，所述的第一输出端与第二高触发端引脚之间连接有第四电阻，所述的第四电阻上并联有第四二极管，所述的第四二极管和第四二极管的输出端与第二高触发端引脚之间设有第二电容，所述的第二电容一端连接在第四二极管和第四二极管的输出端与第二高触发端引脚之间，所述的第二电容另一端接地。
在上述的缺相检测电路中，所述的第一清零端引脚与第二低触发端引脚之间连接有第五电阻，所述的第五电阻上并联有第五二极管，所述的第五二极管和第五二极管的输出端与第二低触发端引脚之间设有第三电容，所述的第三电容一端连接在第五二极管和第五二极管的输出端与第二低触发端引脚之间，所述的第三电容另一端接地。
在上述的缺相检测电路中，所述的第一芯片上还设有第一电压控制端引脚、第一放电端引脚、第一接地引脚，在第一芯片上还设有第二电压控制端引脚、第二放电端引脚、第二输出端引脚、第二清零端引脚，所述的第二清零端引脚接地。
与现有的技术相比，本缺相检测电路的优点在于：设计合理，结构简单，检测精确，检测灵敏度高，能快速的发现缺项，可把危害降到最低，防止电机烧坏。
附图说明
图1是本实用新型提供的结构示意图。
图中，第一相线R、第二相线S、第三相线T、第一电阻R1、第二电阻R2、第三电阻R3、第一电容C1、第一芯片556A、第二芯片556B、第一高触发端引脚TRIG1、第一低触发端引脚THR1、第二低触发端引脚THR2、第二高触发端引脚TRIG2、第一输出端OUT1、外接电源引脚VCC1、第一二极管D1、第二二极管D2、第三二极管D3、第四电阻R4、第四二极管D4、第二电容C2、第五电阻R5、第五二极管D5、第三电容C3、第一电压控制端引脚VC1、第一放电端引脚DIS1、第一接地引脚GND1、第二电压控制端引脚VC2、第二放电端引脚DIS2、第二清零端引脚RST2。
具体实施方式
如图1所示，本缺相检测电路，包括第一相线R、第二相线S和第三相线T，第一相线R、第二相线S和第三相线T与第一电阻R1输入端相连，第一电阻R1输出端与第二电阻R2输入端相连，第二电阻R2输出端接地，第一电阻R1输出端还与第三电阻R3输入端相连，第二电阻R2输出端还与第一电容C1输入端相连，第三电阻R3输出端和第一电容C1输出端与缺相检测芯片相连，缺相检测芯片包括第一芯片556A和第二芯片556B，第三电阻R3输出端和第一电容C1输出端与第一芯片556A的第一低触发端引脚THR1以及第一高触发端引脚TRIG1相连，第一芯片556A上的第一清零端引脚RST1和第一芯片556A上的外接电源引脚VCC1相连后与第二芯片556B上的第二低触发端引脚THR2相连，第一芯片556A上的第一输出端OUT1与第二芯片556B上的第二高触发端引脚TRIG2相连。
第一相线R、第二相线S和第三相线T与第一电阻R1输入端之间分别通过第一二极管D1、第二二极管D2、第三二极管D3相连，第一输出端OUT1与第二高触发端引脚TRIG2之间连接有第四电阻R4，第四电阻R4上并联有第四二极管D4，第四二极管D4和第四二极管D4的输出端与第二高触发端引脚TRIG2之间设有第二电容C2，第二电容C2一端连接在第四二极管D4和第四二极管D4的输出端与第二高触发端引脚TRIG2之间，第二电容C2另一端接地；第一清零端引脚RST1与第二低触发端引脚THR2之间连接有第五电阻R5，第五电阻R5上并联有第五二极管D5，第五二极管D5和第五二极管D5的输出端与第二低触发端引脚THR2之间设有第三电容C3，第三电容C3一端连接在第五二极管D5和第五二极管D5的输出端与第二低触发端引脚THR2之间，第三电容C3另一端接地；第一芯片556A上还设有第一电压控制端引脚VC1、第一放电端引脚DIS1、第一接地引脚GND1，在第一芯片556A上还设有第二电压控制端引脚VC2、第二放电端引脚DIS2、第二清零端引脚RST2，第二清零端引脚RST2接地。
本文中所描述的具体实施例仅仅是对本实用新型精神作举例说明。本实用新型所属技术领域的技术人员可以对所描述的具体实施例做各种各样的修改或补充或采用类似的方式替代，但并不会偏离本实用新型的精神或者超越所附权利要求书所定义的范围。
尽管本文较多地使用第一相线R、第二相线S、第三相线T、第一电阻R1、第二电阻R2、第三电阻R3、第一电容C1、第一芯片556A、第二芯片556B、第一高触发端引脚TRIG1、第一低触发端引脚THR1、第二低触发端引脚THR2、第二高触发端引脚TRIG2、第一输出端OUT1、外接电源引脚VCC1、第一二极管D1、第二二极管D2、第三二极管D3、第四电阻R4、第四二极管D4、第二电容C2、第五电阻R5、第五二极管D5、第三电容C3、第一电压控制端引脚VC1、第一放电端引脚DIS1、第一接地引脚GND1、第二电压控制端引脚VC2、第二放电端引脚DIS2、第二清零端引脚RST2等术语，但并不排除使用其它术语的可能性。使用这些术语仅仅是为了更方便地描述和解释本实用新型的本质；把它们解释成任何一种附加的限制都是与本实用新型精神相违背的。
Claims (5)
1.一种缺相检测电路，其特征在于，包括第一相线(R)、第二相线(S)和第三相线(T)，所述的第一相线(R)、第二相线(S)和第三相线(T)与第一电阻(R1)输入端相连，所述的第一电阻(R1)输出端与第二电阻(R2)输入端相连，所述的第二电阻(R2)输出端接地，所述的第一电阻(R1)输出端还与第三电阻(R3)输入端相连，所述的第二电阻(R2)输出端还与第一电容(C1)输入端相连，所述的第三电阻(R3)输出端和第一电容(C1)输出端与缺相检测芯片相连，所述的缺相检测芯片包括第一芯片(556A)和第二芯片(556B)，所述的第三电阻(R3)输出端和第一电容(C1)输出端与第一芯片(556A)的第一低触发端引脚(THR1)以及第一高触发端引脚(TRIG1)相连，所述的第一芯片(556A)上的第一清零端引脚(RST1)和第一芯片(556A)上的外接电源引脚(VCC1)相连后与第二芯片(556B)上的第二低触发端引脚(THR2)相连，所述的第一芯片(556A)上的第一输出端(OUT1)与第二芯片(556B)上的第二高触发端引脚(TRIG2)相连。
2.根据权利要求1所述的缺相检测电路，其特征在于，所述的第一相线(R)、第二相线(S)和第三相线(T)与第一电阻(R1)输入端之间分别通过第一二极管(D1)、第二二极管(D2)、第三二极管(D3)相连。
3.根据权利要求2所述的缺相检测电路，其特征在于，所述的第一输出端(OUT1)与第二高触发端引脚(TRIG2)之间连接有第四电阻(R4)，所述的第四电阻(R4)上并联有第四二极管(D4)，所述的第四二极管(D4)和第四二极管(D4)的输出端与第二高触发端引脚(TRIG2)之间设有第二电容(C2)，所述的第二电容(C2)一端连接在第四二极管(D4)和第四二极管(D4)的输出端与第二高触发端引脚(TRIG2)之间，所述的第二电容(C2)另一端接地。
4.根据权利要求3所述的缺相检测电路，其特征在于，所述的第一清零端引脚(RST1)与第二低触发端引脚(THR2)之间连接有第五电阻(R5)，所述的第五电阻(R5)上并联有第五二极管(D5)，所述的第五二极管(D5)和第五二极管(D5)的输出端与第二低触发端引脚(THR2)之间设有第三电容(C3)，所述的第三电容(C3)一端连接在第五二极管(D5)和第五二极管(D5)的输出端与第二低触发端引脚(THR2)之间，所述的第三电容(C3)另一端接地。
5.根据权利要求4所述的缺相检测电路，其特征在于，所述的第一芯片(556A)上还设有第一电压控制端引脚(VC1)、第一放电端引脚(DIS1)、第一接地引脚(GND1)，在第一芯片(556A)上还设有第二电压控制端引脚(VC2)、第二放电端引脚(DIS2)、第二清零端引脚(RST2)，所述的第二清零端引脚(RST2)接地。
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