CN204904017U - 一种基于cpld技术的网安主板 - Google Patents
一种基于cpld技术的网安主板 Download PDFInfo
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Abstract
本实用新型涉及主板领域，具体涉及一种基于CPLD技术的网安主板，包括：主板以及位于主板上的：主控单元，CPLD单元，第一网卡单元，第二网卡单元，第一开关和第二开关；主控单元和CPLD单元通过第一开关与第一网卡单元连接，主控单元和CPLD单元通过第二开关与第二网卡单元连接，具有独立于主板上的主芯片，不受主芯片的限制，可以根据需要灵活的修改bypass的状态，并且可以保存Bypass状态，不受电源状态控制的优点。
Description
技术领域
本实用新型涉及主板领域，具体涉及一种基于CPLD技术的网安主板。
背景技术
网络安全设备一般都是应用在两个或更多的网络之间，比如内网和外网之间，网络安全设备内的应用程序会对通过他的网络封包来进行分析，以判断是否有威胁存在，处理完后再按照一定的路由规则将封包转发出去，而如果这台网络安全设备出现了故障，比如断电或死机后，那连接在这台设备上的所有网段也就彼此失去了联系，这个时候如果要求各个网络彼此还需要处于连通状态，那么就必须具有Bypass功能。目前实现Bypass功能主要有以下几种方法：1、通过电源触发。这种方式下，一般是在设备没有通电的情况下，Bypass功能打开，如果设备一旦通电后，Bypass立即调整为关闭状态，其缺点是：不灵活，无法通过软件控制。2、由GPIO来控制。在进入OS后，可以通过GPIO来对特定的端口操作，从而实现对Bypass开关的控制，其缺点是：GPIO的状态，关机后无法保存。3、由Watchdog来控制。这种情况实际是对方式2的一种延伸应用，可以通过Watchdog来控制GPIOBypass程序的启用与关闭，从而实现对Bypass状态的控制。使用这种方式后，平台如果死机就可以由Watchdog来打开Bypass，其缺点是：关机后，无法控制。
实用新型内容
本实用新型的目的在于解决上述问题，提供一种基于CPLD技术的网安主板，具有独立于主板上的主芯片，不受主芯片的限制，可以根据需要灵活的修改bypass的状态，并且可以保存Bypass状态，不受电源状态控制的优点。
为实现上述目的，本实用新型采用的技术方案是：
一种基于CPLD技术的网安主板，包括：主板以及位于主板上的：主控单元，CPLD单元，第一网卡单元，第二网卡单元，第一开关和第二开关；主控单元和CPLD单元通过第一开关与第一网卡单元连接，主控单元和CPLD单元通过第二开关与第二网卡单元连接。
进一步地，所述第一开关具有1位和2位，所述第二开关具有1位和2位；当所述第一开关处于1位时，主控单元与第一网卡单元相连接，当所述第二开关处于1位时，主控单元与第二网卡单元相连接；当所述第一开关和所述第二开关同时处于2位时，所述第一网卡单元与所述第二网卡单元相连接。
进一步地，所述CPLD单元用于控制所述第一开关和/或所述第二开关的位置。
进一步地，所述CPLD单元通过GPIO控制所述第一开关和/或所述第二开关的位置。
采用上述结构后，本实用新型有益效果为：本实用新型的一种基于CPLD技术的网安主板，具有独立于主板上的主芯片，不受主芯片的限制，可以根据需要灵活的修改bypass的状态，并且可以保存Bypass状态，不受电源状态控制的优点。
附图说明
图1为本实用新型的基于CPLD技术的网安主板的结构示意图一；
图2为本实用新型的基于CPLD技术的网安主板的结构示意图二；
图3为本实用新型的基于CPLD技术的网安主板的结构示意图三。
附图标记说明：
1、主板；2、主控单元；3、CPLD单元；4、第一网卡单元；
5、第二网卡单元；6、第一开关；7、第二开关；8、1位；9、2位。
具体实施方式
下面结合附图对本实用新型作进一步的说明。
如图1至图3所示，本实用新型的一种基于CPLD技术的网安主板，包括：主板1以及位于主板1上的：主控单元2，CPLD单元3，第一网卡单元4，第二网卡单元5，第一开关6和第二开关7；主控单元2和CPLD单元3通过第一开关6与第一网卡单元4连接，主控单元2和CPLD单元3通过第二开关7与第二网卡单元5连接。
第一开关6具有1位8和2位9，第二开关7具有1位8和2位9；当第一开关6处于1位8时，主控单元2与第一网卡单元4相连接，此时第一网卡单元4工作在独立模式。当第二开关7处于1位8时，主控单元2与第二网卡单元5相连接，此时第二网卡单元5工作在独立模式。当第一开关6和第二开关7同时处于2位9时，第一网卡单元4与第二网卡单元5相连接，此时第一网卡单元4和第二网卡单元5工作在bypass模式。
CPLD单元3用于控制第一开关6和/或第二开关7的位置。
CPLD单元3通过GPIO控制第一开关6和/或第二开关7的位置。
CPLD逻辑控制原理与真值如下表所示：
1）Power信号：
此信号用于CPLD判断系统的状态：关机状态=0，开机状态=1；
2）GPIO0，GPIO1用来控制Bypass的状态，如Power=1，GPIO0=0,GPIO1=0,表示在开机状态下（Power=1）,网卡工作在独立模式（Bypass=0）；Power=0,GPIO0=0,GPIO1=1,表示在关机状态下（Power=0）,网卡工作在Bypass模式（Bypass=1）。
3）Bypass:CPLD的输出信号，根据Power,GPIO0,GPIO1三个输入信号的状态，输出对应的状态，从而控制网卡的工作模式。
以上所述仅是本实用新型的较佳实施方式，故凡依本实用新型专利申请范围所述的构造、特征及原理所做的等效变化或修饰，均包括于本实用新型专利申请范围内。
Claims (4)
1.一种基于CPLD技术的网安主板，其特征在于，包括：主板以及位于主板上的：主控单元，CPLD单元，第一网卡单元，第二网卡单元，第一开关和第二开关；主控单元和CPLD单元通过第一开关与第一网卡单元连接，主控单元和CPLD单元通过第二开关与第二网卡单元连接。
2.根据权利要求1所述的主板，其特征在于，所述第一开关具有1位和2位，所述第二开关具有1位和2位；当所述第一开关处于1位时，主控单元与第一网卡单元相连接，当所述第二开关处于1位时，主控单元与第二网卡单元相连接；当所述第一开关和所述第二开关同时处于2位时，所述第一网卡单元与所述第二网卡单元相连接。
3.根据权利要求2所述的主板，其特征在于，所述CPLD单元用于控制所述第一开关和/或所述第二开关的位置。
4.根据权利要求3所述的主板，其特征在于，所述CPLD单元通过GPIO控制所述第一开关和/或所述第二开关的位置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| CN201520534422.7U CN204904017U (zh) | 2015-07-22 | 2015-07-22 | 一种基于cpld技术的网安主板 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| CN201520534422.7U CN204904017U (zh) | 2015-07-22 | 2015-07-22 | 一种基于cpld技术的网安主板 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| CN204904017U true CN204904017U (zh) | 2015-12-23 |
Family
ID=54926180
Family Applications (1)
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| CN201520534422.7U Expired - Fee Related CN204904017U (zh) | 2015-07-22 | 2015-07-22 | 一种基于cpld技术的网安主板 |
Country Status (1)
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|---|---|
| CN (1) | CN204904017U (zh) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN113630281A (zh) * | 2021-10-14 | 2021-11-09 | 深圳华北工控股份有限公司 | 一种bypass控制方法、装置、终端及存储介质 |
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2015
- 2015-07-22 CN CN201520534422.7U patent/CN204904017U/zh not_active Expired - Fee Related
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| CN113630281A (zh) * | 2021-10-14 | 2021-11-09 | 深圳华北工控股份有限公司 | 一种bypass控制方法、装置、终端及存储介质 |
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| CF01 | Termination of patent right due to non-payment of annual fee |
Granted publication date: 20151223 Termination date: 20180722 |