CN203069643U - 多可变带宽数字存储示波器 - Google Patents

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Inventor
李志海
王量
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Uni Trend Technology China Co Ltd
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Uni Trend Technology Chengdu Co Ltd
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Abstract

本实用新型公开了一种多可变带宽数字存储示波器,其特征在于:由两个相互独立的信号调理通道1和信号调理通道2、FPGA芯片、MVB嵌入式运算芯片、DSP芯片、LED液晶显示触摸屏以及USB接口组成;所述DSP芯片分别与MVB嵌入式运算芯片、LED液晶显示触摸屏连接,所述FPGA芯片分别与MVB嵌入式运算芯片、信号调理通道1、信号调理通道2连接,所述MVB嵌入式运算芯片内置有系统注册模块、TCP/IP网络通信模块以及USB设备通信模块,所述USB设备通信模块与USB接口连接。本实用新型可以根据客户的需求,客户自行选择购买的数字存储示波器的带宽,也可以在使用一段时间后,改变数字存储示波器的带宽,以满足当前工作的需要。

Description

多可变带宽数字存储示波器
技术领域
本实用新型涉及一种示波器,特别涉及一种可以随时改变带宽,以便更好的满足当前工作需要的多可变带宽数字存储示波器。
背景技术
DSO(数字存储示波器)作为测量电信号波形的仪器,它能形象显示电压随时间变化的波形并可测量频率和相位等参数,同时可经过各种转换器对光、声、热、磁和电流等信号进行间接的测量,是一种综合的信号特性测试仪器。数字存储示波器是观察电路实验现象、分析实验中的问题、测量实验结果必不可少的重要仪器,在电工、电子和电气测量领域具有广泛应用。
但是,现有的数字存储示波器,其为固定的带宽,客户不能根据生产的需要实时改变数字存储示波器的带宽,以便更好的满足当前工作的需要。
实用新型内容
针对现有技术的不足,本实用新型提供了一种可以实时改变带宽的多可变带宽数字存储示波器。
本实用新型为实现上述目的采用的技术方案为:
一种多可变带宽数字存储示波器,由两个相互独立的信号调理通道1和信号调理通道2、FPGA(现场可编程门阵列)芯片、MVB(多可变带宽)嵌入式运算芯片、DSP(数字信号处理)芯片、LED液晶显示触摸屏以及USB接口组成;所述DSP芯片分别与MVB嵌入式运算芯片、LED液晶显示触摸屏连接,所述FPGA芯片分别与MVB嵌入式运算芯片、信号调理通道1、信号调理通道2连接,所述MVB嵌入式运算芯片内置有系统注册模块、TCP/IP网络通信模块以及USB设备通信模块,所述USB设备通信模块与USB接口连接。
所述信号调整通道1由输入阻抗匹配、前级信号调理、高速ADC(模数转换器)、触发电路、高速比较器组成,所述输入阻抗匹配与前级信号调理连接,所述前级信号调理分别与高速ADC、触发电路连接,所述高速比较器与触发电路连接,所述高速ADC与触发电路分别与FPGA芯片连接。
所述信号调整通道2由输入阻抗匹配、前级信号调理、高速ADC、触发电路、高速比较器组成,所述输入阻抗匹配与前级信号调理连接,所述前级信号调理分别与高速ADC、触发电路连接,所述高速比较器与触发电路连接,所述高速ADC与触发电路分别与FPGA芯片连接。
所述FPGA芯片内置ADC时钟控制模块、串/并转换模块、正常采样/峰值检测模块、触发电路控制模块、时基电路控制模块、数据总线通信模块、硬件频率计以及硬件电路控制模块。
所述DSP芯片,其内置有初始化模块、键盘处理模块、波形数据采集模块、信号测量处理模块、运算与处理模块以及显示模块,所述显示模块与LED液晶显示触摸屏连接。
所述FPGA芯片还内置有信号电压采集单元、硬件工作模式调整单元。
作为本实用新型的进一步改进,本实用新型还包括一根据当前实时所调时基档位自动调节采样率的采样率调整模块,一信号变换处理模块以及一在信号的正确点处同步水平扫描的触发功能模块,所述信号电压采集单元、硬件工作模式调整单元分别与采样率调整模块、信号变换处理模块、触发功能模块连接。
本实用新型可以根据客户的需求,客户自行选择购买的数字存储示波器的带宽,也可以在使用一段时间后,改变数字存储示波器的带宽,以满足当前工作的需要。
下面结合附图与具体实施方式,对本实用新型进一步说明。
附图说明
图1为本实用新型的结构原理图;
图2为图1的信号调理通道的结构框架图;
具体实施方式
参见图1~图2,本实用新型公开了一种多可变带宽数字存储示波器,由两个相互独立的信号调理通道1和信号调理通道2、FPGA(现场可编程门阵列)芯片、MVB(多可变带宽)嵌入式运算芯片、DSP(数字信号处理)芯片、LED液晶显示触摸屏以及USB接口组成;所述DSP芯片分别与MVB嵌入式运算芯片、LED液晶显示触摸屏连接,所述FPGA芯片分别与MVB嵌入式运算芯片、信号调理通道1、信号调理通道2连接,所述MVB嵌入式运算芯片内置有系统注册模块、TCP/IP网络通信模块以及USB设备通信模块,所述USB设备通信模块与USB接口连接。
所述信号调整通道1由输入阻抗匹配、前级信号调理、高速ADC(模数转换器)、触发电路、高速比较器组成,所述输入阻抗匹配与前级信号调理连接,所述前级信号调理分别与高速ADC、触发电路连接,所述高速比较器与触发电路连接,所述高速ADC与触发电路分别与FPGA芯片连接。
所述信号调整通道2由输入阻抗匹配、前级信号调理、高速ADC、触发电路、高速比较器组成,所述输入阻抗匹配与前级信号调理连接,所述前级信号调理分别与高速ADC、触发电路连接,所述高速比较器与触发电路连接,所述高速ADC与触发电路分别与FPGA芯片连接。
所述FPGA芯片内置ADC时钟控制模块、串/并转换模块、正常采样/峰值检测模块、触发电路控制模块、时基电路控制模块、数据总线通信模块、硬件频率计以及硬件电路控制模块。
所述DSP芯片,其内置有初始化模块、键盘处理模块、波形数据采集模块、信号测量处理模块、运算与处理模块以及显示模块,所述显示模块与LED液晶显示触摸屏连接。
所述FPGA芯片还内置有信号电压采集单元、硬件工作模式调整单元。
作为本实用新型的进一步改进,本实用新型还包括一根据当前实时所调时基档位自动调节采样率的采样率调整模块,一信号变换处理模块以及一在信号的正确点处同步水平扫描的触发功能模块,所述信号电压采集单元、硬件工作模式调整单元分别与采样率调整模块、信号变换处理模块、触发功能模块连接。
本实用新型的工作原理:
1、首先,用标配的USB线缆将DSO(数字存数示波器)中USB接口与电脑连接起来,电脑再通过以太网线与Internet网连接起来。
2、打开DSO(数字存数示波器)电源,MVB(多可变带宽)嵌入式运算芯片上的系统注册模块首先检测DSO是否已注册过,如果DSO已经注册,则运行DSP芯片上的模块,如果DSO还未进行注册,MVB嵌入式运算芯片首先初始化USB设备模块,初始化完成后等待注册程序发送注册指令。
3、当用户启动注册程序并输入SerialID(激活码)后,系统注册模块检测输入SerialID是否有效,如无效则提示用户;如果有效系统注册模块将从SerialID(激活码)中解析出带宽数据,并调用TCP/IP网络通信模块进行远程注册,如果远程注册成功,系统注册模块调用USB设备通信模块并发出注册指令和带宽指令。
4、在DSO接收到注册和带宽指令后,将注册的带宽信息以一定数据结构写入DSO特定的存储空间。
5、注册成功后,用户需要关掉DSO电源后再打开DSO电源重新启动,在启动过程中MVB嵌入式运算芯片发现该DSO已经注册完成,则启动DSP芯片上模块,初始化时会根据注册的带宽信息,激活/禁止软件部份功能,使得DSO处于当前带宽的工作状态。
6、若客户需要根据当前的工作状态,更换当前DSO的带宽,只需要重复步骤1~5便可以达到改变带宽的目的。
本实用新型可以根据客户的需要实时的更换带宽,只需要重新获取一个注册码就可以得到不同带宽的数字存储示波器,而不需要重新购买一个新的不同带宽的数字存储示波器,由于本实用新型的出现,增强了数字存储示波器的通用性能,使得相同功能,不同带宽的数字存储示波器可以集于一体,减小了制造不同带宽的数字存储示波器的制造成本。
本实用新型并不限于上述实施方式,采用与本实用新型上述实施例相同或近似的结构,均在本实用新型的保护范围之内。

Claims (7)

1.一种多可变带宽数字存储示波器,其特征在于:由两个相互独立的信号调理通道1和信号调理通道2、FPGA芯片、MVB嵌入式运算芯片、DSP芯片、LED液晶显示触摸屏以及USB接口组成;所述DSP芯片分别与MVB嵌入式运算芯片、LED液晶显示触摸屏连接,所述FPGA芯片分别与MVB嵌入式运算芯片、信号调理通道1、信号调理通道2连接,所述MVB嵌入式运算芯片内置有系统注册模块、TCP/IP网络通信模块以及USB设备通信模块,所述USB设备通信模块与USB接口连接。
2.根据权利要求1所述的多可变带宽数字存储示波器,其特征在于:所述信号调整通道1由输入阻抗匹配、前级信号调理、高速ADC、触发电路、高速比较器组成,所述输入阻抗匹配与前级信号调理连接,所述前级信号调理分别与高速ADC、触发电路连接,所述高速比较器与触发电路连接,所述高速ADC与触发电路分别与FPGA芯片连接。
3.根据权利要求1所述的多可变带宽数字存储示波器,其特征在于:所述信号调整通道2由输入阻抗匹配、前级信号调理、高速ADC、触发电路、高速比较器组成,所述输入阻抗匹配与前级信号调理连接,所述前级信号调理分别与高速ADC、触发电路连接,所述高速比较器与触发电路连接,所述高速ADC与触发电路分别与FPGA芯片连接。
4.根据权利要求1所述的多可变带宽数字存储示波器,其特征在于:所述FPGA芯片内置ADC时钟控制模块、串/并转换模块、正常采样/峰值检测模块、触发电路控制模块、时基电路控制模块、数据总线通信模块、硬件频率计以及硬件电路控制模块。
5.根据权利要求1所述的多可变带宽数字存储示波器,其特征在于:所述DSP芯片,其内置有初始化模块、键盘处理模块、波形数据采集模块、信号测量处理模块、运算与处理模块以及显示模块,所述显示模块与LED液晶显示触摸屏连接。
6.根据权利要求1所述的多可变带宽数字存储示波器,其特征在于:所述FPGA芯片还内置有信号电压采集单元、硬件工作模式调整单元。
7.根据权利要求6所述的多可变带宽数字存储示波器,其特征在于:其还包括一根据当前实时所调时基档位自动调节采样率的采样率调整模块,一信号变换处理模块以及一在信号的正确点处同步水平扫描的触发功能模块,所述信号电压采集单元、硬件工作模式调整单元分别与采样率调整模块、信号变换处理模块、触发功能模块连接。
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