CN202649916U - 用于计算机主板+3.3v以及+5v的时序控制电路 - Google Patents

用于计算机主板+3.3v以及+5v的时序控制电路 Download PDF

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王维
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Abstract

本实用新型公开了一种用于计算机主板+3.3V以及+5V的时序控制电路,包括主板、设于主板上的电源转换芯片以及南桥芯片上的时序控制模块,电源转换芯片的输入端与+12V直流电源相连,电源转换芯片的+3.3VSB待机电源输出端与+3.3V发生电路相连,电源转换芯片的+5VSB待机电源输出端与+5V发生电路相连,还包括放电控制电路,放电控制电路的输入端与南桥芯片上的时序控制模块相连,放电控制电路的输出端与+3.3V发生电路的输入端相连;放电控制电路还分别与+5VSB待机电源以及+12V直流电源相连。通过放电控制电路可以很好的保证上电时+5V系统主电源早于+3.3V系统主电源有效,在掉电时则需+3.3V系统主电源早于+5V系统主电源失效,从而保证导芯片组正常工作,更保证计算机主板的稳定性。

Description

用于计算机主板+3. 3V以及+5V的时序控制电路
技术领域
[0001] 本实用新型涉及计算机主板的时序控制技术,更具体地说,是涉及一种用于计算机主板+3. 3V以及+5V的时序控制电路。
背景技术
[0002] 在计算机的使用过程中,很多计算机主板上通常会使用直流+12V或+19V的单电源模块供电,因此,在计算机主板的电源设计上需要针对系统电源+3. 3V/+5V做专门的设计,请参见图I所示,其中直流+12V电源经过电源转换芯片转换为+3. 3VSB以及+5VSB的待机所需电源后,分别通过与其相对应的电阻以及电容的充放电特性控制N沟道场效应管的开启时间,最终产生+3. 3V以及+5V的系统主电源。而+3. 3V/+5V作为芯片组上重要逻辑电路的电源,往往对它们的开机和关机时序会有严格的要求,以芯片组厂商英特尔产品 为例计算机芯片组对于+3. 3V和+5V的时序要求在上电时+5V早于+3. 3V有效,在掉电时则需+3. 3V早于+5V失效。由此可知,如果时序控制电路设计不当,则很容易导致芯片组工作异常,大大影响计算机主板的稳定性,对产品质量会造成不良影响。
实用新型内容
[0003] 针对现有技术中存在的缺陷,本实用新型的目的是提供一种用于计算机主板+3. 3V以及+5V的时序控制电路,能够很好的控制+3. 3V和+5V的时序。
[0004] 为达到上述目的,本实用新型采用如下的技术方案:
[0005] 一种用于计算机主板+3. 3V以及+5V的时序控制电路,包括主板、设于主板上的电源转换芯片以及南桥芯片上的时序控制模块,所述电源转换芯片的输入端与+12V直流电源相连,电源转换芯片的+3. 3VSB待机电源输出端与+3. 3V发生电路相连,电源转换芯片的+5VSB待机电源输出端与+5V发生电路相连,还包括放电控制电路,所述放电控制电路的输入端与南桥芯片上的时序控制模块相连,放电控制电路的输出端与+3. 3V发生电路的输入端相连;放电控制电路还分别与+5VSB待机电源以及+12V直流电源相连。
[0006] 所述放电控制电路包括第二电阻、第四电阻、二极管、第一场效应管以及第二场效应管,所述第四电阻的一端与+5VSB待机电源相连,另一端与第二场效应管的D极相连;所述第二场效应管的G极与南桥芯片上的时序控制模块的SLP S3控制脚相连,第二场效应管的S极接地;所述第二电阻的一端与+12V直流电源相连,另一端与第一场效应管的D极相连;所述第一场效应管的G极与第二场效应管的D极相连,第一场效应管的S极接地;所述二极管的正极与+3. 3V发生电路相连,二极管的负极与第一场效应管的D极相连。
[0007] 所述+3. 3V发生电路包括第三电阻、第一电容以及第一大功率场效应管,所述第三电阻的一端与+12V直流电源相连,另一端与第一大功率场效应管的G极相连;所述第一电容的一端与第一大功率场效应管的G极相连,另一端接地;所述第一大功率场效应管的D极与+3. 3VSB待机电源相连,第一大功率场效应管的S极产生+3. 3V系统主电源。
[0008] 所述+5V发生电路包括第一电阻、第二电容以及第二大功率场效应管,所述第一电阻的一端与+12V直流电源相连,另一端与第二大功率场效应管的G极相连;所述第二电容的一端与第二大功率场效应管的G极相连,另一端接地;所述第二大功率场效应管的D极与+5VSB待机电源相连,第二大功率场效应管的S极产生+5V系统主电源。
[0009] 与现有技术相比,采用本实用新型的一种用于计算机主板+3. 3V以及+5V的时序控制电路,包括主板、设于主板上的电源转换芯片以及南桥芯片上的时序控制模块,所述电源转换芯片的输入端与+12V直流电源相连,电源转换芯片的+3. 3VSB待机电源输出端与+3. 3V发生电路相连,电源转换芯片的+5VSB待机电源输出端与+5V发生电路相连,还包括放电控制电路,所述放电控制电路的输入端与南桥芯片上的时序控制模块相连,放电控制电路的输出端与+3. 3V发生电路的输入端相连;放电控制电路还分别与+5VSB待机电源以及+12V直流电源相连。通过放电控制电路可以很好的保证上电时+5V系统主电源早于+3. 3V系统主电源有效,在掉电时则需+3. 3V系统主电源早于+5V系统主电源失效,从而保证导芯片组正常工作,更保证计算机主板的稳定性。
附图说明
[0010] 图I为现有计算机主板的+3. 3V以及+5V系统主电源的原理示意图;
[0011] 图2为本实用新型的+3. 3V发生电路与放电控制电路的电路示意图;
[0012] 图3为本实用新型的+5V发生电路的电路示意图。
具体实施方式
[0013] 下面结合附图和实施例进一步说明本实用新型的技术方案。
[0014] 请参阅图2所示的一种用于计算机主板+3. 3V以及+5V的时序控制电路包括主板(图中未示出)、设于主板上的电源转换芯片(图中未示出)以及南桥芯片上的时序控制模块(图中未示出),电源转换芯片的输入端与+12V直流电源相连,电源转换芯片的+3. 3VSB待机电源输出端与+3. 3V发生电路11相连,电源转换芯片的+5VSB待机电源输出端与+5V发生电路12相连,还包括放电控制电路13,放电控制电路13的输入端与南桥芯片上的时序控制模块相连,放电控制电路13的输出端与+3. 3V发生电路11的输入端相连;放电控制电路13还分别与+5VSB待机电源以及+12V直流电源相连。
[0015] 放电控制电路13包括第二电阻R2、第四电阻R4、二极管D I、第一场效应管Ql以及第二场效应管Q2,第四电阻R4的一端与+5VSB待机电源相连,另一端与第二场效应管Q2的D极相连;第二场效应管Q2的G极与南桥芯片上的时序控制模块的SLP S3控制脚相连,第二场效应管Q2的S极接地;第二电阻R2的一端与+12V直流电源相连,另一端与第一场效应管Ql的D极相连;第一场效应管Ql的G极与第二场效应管Q2的D极相连,第一场效应管Ql的S极接地;二极管Dl的正极与+3. 3V发生电路相连,二极管Dl的负极与第一场效应管Ql的D极相连。
[0016] +3. 3V发生电路11包括第三电阻R3、第一电容Cl以及第一大功率场效应管PQ1,第三电阻R3的一端与+12V直流电源相连,另一端与第一大功率场效应管PQl的G极相连;第一电容Cl的一端与第一大功率场效应管PQl的G极相连,另一端接地;第一大功率场效应管PQl的D极与+3. 3VSB待机电源相连,第一大功率场效应管PQl的S极产生+3. 3V系统主电源。[0017] +5V发生电路12包括第一电阻R1、第二电容C2以及第二大功率场效应管PQ2,第一电阻Rl的一端与+12V直流电源相连,另一端与第二大功率场效应管PQ2的G极相连;第二电容C2的一端与第二大功率场效应管PQ2的G极相连,另一端接地;第二大功率场效应管PQ2的D极与+5VSB待机电源相连,第二大功率场效应管PQ2的S极产生+5V系统主电源。
[0018] 本实用新型的工作原理如下:
[0019] I)在开机上电时:
[0020] 当接入直流+12V电源后,此时系统为after_G3状态,南桥芯片上的时序控制模块的SLP S3控制脚为低电平,而+5VSB已经有效,将第一场效应管Ql打开,第一场效应管Ql的D极与S极(接地端)导通,二极管Dl的负极被拉低,二极管Dl导通,从而使它的正极也被拉低,第一大功率场效应管PQl的G极零电压,第一大功率场效应管PQl此时被关闭,+3. 3V无电压输出,当按下开机键后,南桥芯片上的时序控制模块的SLP S3控制脚随即变 的G端被拉为低电平,第一场效应管Ql截止,由于二极管Dl的两端均为+12V,二极管Dl不导通,此时放电控制电路13相当于被断开,第一大功率场效应管PQl的G极的电压根据第三电阻R3和第一电容Cl的时间常数缓慢升高,第一大功率场效应管PQl逐步导通,+3. 3V有效;同理第二大功率场效应管PQ2的G极也根据第一电阻Rl和第二电容C2的时间常数被逐步打开,+5V有效。而我们也可以通过调节第一电阻R1,第三电阻R3和第一电容Cl,第二电容C2的值就可以控制+3. 3V和+5V的上升时序了。
[0021] 2)在关机掉电时:
[0022] 第二大功率场效应管PQ2的G极由于有第二电容C2的存在,放电缓慢,导致第二大功率场效应管PQ2的D极以及S极的关断时间被延迟,+5V下降缓慢,而放电控制电路13中,由于南桥芯片上的时序控制模块首先将它的SLP S3控制脚快速拉低,使第二场效应管Q2也会很快截止,第一场效应管Ql导通,二极管Dl的负极被拉低,从而将第一大功率场效应管PQl的G极也被拉低,第一大功率场效应管PQl截止,+3. 3V迅速下降,因此也可以满足+3. 3V在+5V之前失效的时序要求。
[0023] 本实用新型中,第一电阻Rl的阻值为10ΚΩ,第二电阻R2、第三电阻R3以及第四电阻R4的阻值均为47ΚΩ,第一电容Cl、第二电容C2均为O. I μ F,二极管Dl的型号为FM120,第一场效应管Ql以及第二场效应管Q2的型号均为2Ν7002,第一大功率场效应管PQl以及第二大功率场效应管PQ2的型号均为I RFH7914。
[0024] 本实用新型的设计优点如下:
[0025] I)电路简单,使用分立元件实现,成本低。
[0026] 2)时序控制灵活,便于调试,可有效解决主板单电源供电时由于此处时序设计不当所引起的种种问题。
[0027] 本技术领域中的普通技术人员应当认识到,以上的实施例仅是用来说明本实用新型的目的,而并非用作对本实用新型的限定,只要在本实用新型的实质范围内,对以上所述实施例的变化、变型都将落在本实用新型的权利要求的范围内。

Claims (4)

1. 一种用于计算机主板+3. 3V以及+5V的时序控制电路,包括主板、设于主板上的电源转换芯片以及南桥芯片上的时序控制模块,所述电源转换芯片的输入端与+12V直流电源相连,电源转换芯片的+3. 3VSB待机电源输出端与+3. 3V发生电路相连,电源转换芯片的+5VSB待机电源输出端与+5V发生电路相连,其特征在于: 还包括放电控制电路,所述放电控制电路的输入端与南桥芯片上的时序控制模块相连,放电控制电路的输出端与+3. 3V发生电路的输入端相连;放电控制电路还分别与+5VSB待机电源以及+12V直流电源相连。
2.根据权利要求I所述的时序控制电路,其特征在于: 所述放电控制电路包括第二电阻、第四电阻、二极管、第一场效应管以及第二场效应管,所述第四电阻的一端与+5VSB待机电源相连,另一端与第二场效应管的D极相连;所述第二场效应管的G极与南桥芯片上的时序控制模块的SLP_S3控制脚相连,第二场效应管的S极接地;所述第二电阻的一端与+12V直流电源相连,另一端与第一场效应管的D极相连;所述第一场效应管的G极与第二场效应管的D极相连,第一场效应管的S极接地;所述二极管的正极与+3. 3V发生电路相连,二极管的负极与第一场效应管的D极相连。
3.根据权利要求I所述的时序控制电路,其特征在于: 所述+3. 3V发生电路包括第三电阻、第一电容以及第一大功率场效应管,所述第三电阻的一端与+12V直流电源相连,另一端与第一大功率场效应管的G极相连;所述第一电容的一端与第一大功率场效应管的G极相连,另一端接地;所述第一大功率场效应管的D极与+3. 3VSB待机电源相连,第一大功率场效应管的S极产生+3. 3V系统主电源。
4.根据权利要求I所述的时序控制电路,其特征在于: 所述+5V发生电路包括第一电阻、第二电容以及第二大功率场效应管,所述第一电阻的一端与+12V直流电源相连,另一端与第二大功率场效应管的G极相连;所述第二电容的一端与第二大功率场效应管的G极相连,另一端接地;所述第二大功率场效应管的D极与+5VSB待机电源相连,第二大功率场效应管的S极产生+5V系统主电源。
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