CN202471970U - Gps芯片用信号捕获模块 - Google Patents

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Abstract

一种GPS芯片用信号捕获模块,包括集成在芯片上顺序工作处理的下变频电路Ⅰ、信号解扩电路Ⅱ、分段累加电路Ⅲ和门限判别电路Ⅶ,在分段累加电路Ⅲ和门限判别电路Ⅶ之间顺序设有并行扫频积分电路Ⅳ、并串转换电路Ⅴ和求模电路Ⅵ。本实用新型的捕获处理流程合理,对信号的码相位和多普勒频点可以进行非常迅速的计算判别,大大提高了信号捕获的速度,并且灵敏性高,可以明显改善GPS产品的使用性能。

Description

GPS芯片用信号捕获模块
 技术领域:本实用新型涉及一种接收使用GPS卫星定位导航信号的芯片,特别是其中的GPS信号捕获模块。
背景技术:GPS芯片在接收GPS卫星定位导航信号时必须尽快捕获,才能够及时计算确定出定位、授时等信息。GPS芯片产品一般集成有信号捕获模块,作为基带处理的一部分,但是现有的信号捕获模块的处理流程电路不够合理,捕获速度不够理想,灵敏度不高,对产品使用造成一定的影响,性能有待提高。
发明内容:针对现有技术的不足,本实用新型提供一种捕获迅速灵敏的GPS芯片用信号捕获模块。
本实用新型包括集成在芯片上顺序工作处理的下变频电路Ⅰ、信号解扩电路Ⅱ、分段累加电路Ⅲ和门限判别电路Ⅶ,在分段累加电路Ⅲ和门限判别电路Ⅶ之间顺序设有并行扫频积分电路Ⅳ、并串转换电路Ⅴ和求模电路Ⅵ。
本实用新型的捕获处理流程合理,对信号的码相位和多普勒频点可以进行非常迅速的计算判别,大大提高了信号捕获的速度,并且灵敏性高,可以明显改善GPS产品的使用性能。
下面结合附图和实施例进一步说明本实用新型。
附图说明:图1是实施例的流程原理框图。
                 图2是图1的电路示意图。
实施例:如图所示,芯片上集成顺序工作处理的下变频电路Ⅰ、信号解扩电路Ⅱ、分段累加电路Ⅲ、并行扫频积分电路Ⅳ、并串转换电路Ⅴ、求模电路Ⅵ和门限判别电路Ⅶ。为了提高捕获灵敏度和速度,可加入非相干累加运算,即两路并行码相位和多普勒频点搜索方式,本实施例的信号解扩电路Ⅱ、分段累加电路Ⅲ、并行扫频积分电路Ⅳ、并串转换电路Ⅴ和求模电路Ⅵ均有二路,在下变频电路Ⅰ和门限判别电路Ⅶ之间并行工作。下变频电路Ⅰ还可含有低通滤波和二次采样部分,提高输出的信号质量。
在工作时,输入信号D(n)首先进行下变频得到A、B两路信号,然后与本地码C(n)进行信号解扩后分成62或124段,再进行分段累加,然后将累加结果进行并行扫频积分,即可以进行多个扫频点的频率补偿并再次累加求和,之后进行并串转换再求模,然后将得到的模值进行门限判别,如果此时码相位和多普勒频点正确就会得到较大的相关值,可以根据门限判别出捕获是否成功,计算判别效率高,灵敏性强。

Claims (3)

1.一种GPS芯片用信号捕获模块,包括集成在芯片上顺序工作处理的下变频电路Ⅰ、信号解扩电路Ⅱ、分段累加电路Ⅲ和门限判别电路Ⅶ,其特征为:在分段累加电路Ⅲ和门限判别电路Ⅶ之间顺序设有并行扫频积分电路Ⅳ、并串转换电路Ⅴ和求模电路Ⅵ。
2.根据权利要求1所述的GPS芯片用信号捕获模块,其特征为:上述的信号解扩电路Ⅱ、分段累加电路Ⅲ、并行扫频积分电路Ⅳ、并串转换电路Ⅴ和求模电路Ⅵ均有二路,在下变频电路Ⅰ和门限判别电路Ⅶ之间并行工作。
3.根据权利要求1或2所述的GPS芯片用信号捕获模块,其特征为:下变频电路Ⅰ还含有低通滤波和二次采样部分。
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP2746812A1 (de) * 2012-12-22 2014-06-25 Diehl BGT Defence GmbH & Co.KG Verfahren und Empfänger zum Verarbeiten eines Navigationssatelliten-Signals

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