CN201134097Y - 集成raid和sas控制ip核的soc芯片 - Google Patents

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Abstract

本实用新型涉及微电子技术领域，具体提供集成RAID和SAS控制IP核的SOC芯片。其结构包括芯片体，其特点是，在芯片体上设置有共享数据cache、32位RISC处理器、公钥算法加速器、DES/3DES算法加速器、随机数发生器、RAID加速器、SAS/SATA控制器、USB主从控制器、PCI－E控制器、DDRSDRAM控制器及千兆Ethernet控制器。与现有技术相比，本实用新型的集成RAID和SAS控制IP核的SOC芯片，具有结构简单、体积小、有效降低嵌入式系统的功耗、提高嵌入式系统的可靠性等特点。

Description

集成RAID和SAS控制IP核的SOC芯片
技术领域
本实用新型涉及微电子技术领域，具体提供一种集成RAID和SAS控制IP核的SOC芯片。
背景技术
随着人们对智能设备的要求不断地提高，仅仅将越来越复杂的大规模集成电路集成到一块单晶片上制成的功能性集成电路，然后由功能性集成电路组装成电路板，再用主板作为设备的主要部件已经不能满足人们对体积更小、智能化程度更高和更节约材料和能耗的更智能化集成设备的要求。
发明内容
本实用新型是针对上述现有技术的不足，提供一种依据SOC(片上系统)技术设计的集成RAID和SAS控制IP核的SOC芯片，尤其适用于高性能、高密度、大功率、长时间工作的存储产品应用领域。
本实用新型解决其技术问题所采用的技术方案是：集成RAID和SAS控制IP核的SOC芯片，包括芯片体，其特点是，在芯片体上设置有共享数据cache、32位RISC处理器、公钥算法加速器、DES/3DES算法加速器、随机数发生器、RAID加速器、SAS/SATA控制器、USB主从控制器、PCI-E控制器、DDRSDRAM控制器及千兆Ethernet控制器，共享数据cache通过高速cache总线与32位RISC处理器相连；公钥算法加速器、DES/3DES算法加速器、随机数发生器、RAID加速器、SAS/SATA控制器、USB主从控制器、PCI-E控制器、DDR SDRAM控制器、千兆Ethernet控制器分别通过数据线与32位RISC处理器相连接。
本实用新型的集成RAID和SAS控制IP核的SOC芯片主要针对高性能多接口双控网络存储产品需求进行量身定制，与现有技术相比具有以下突出的有益效果：
(1)采用90nm设计和制造工艺，功耗很低，集成大量IP核，大幅度降少了外围芯片；
(2)集成SRAM、智能卡驱动等IP核，简化了嵌入式系统的复杂度，从而提高了可靠性；
(3)由于SOC集成大量IP核，可使嵌入式系统的成本大大降低。
附图说明
附图1是本实用新型集成RAID和SAS控制IP核的SOC芯片的电路结构示意图。
具体实施方式
下面结合附图和具体实施例对本实用新型作进一步说明，但不作为对本实用新型的限定。
下面给出一个最佳实施例：
集成RAID和SAS控制IP核的SOC芯片，由芯片体1、共享数据cache 2、32位RISC主处理器4、从处理器3、5、6、公钥算法加速器7、DES/3DES算法加速器8、随机数发生器9、RAID加速器10、SAS/SATA控制器11、USB主从控制器12、PCI-E控制器13、DDR SDRAM控制器14及千兆Ethernet控制器15～18。
共享数据cache2、32位RISC主处理器4、从处理器3、5、6、公钥算法加速器7、DES/3DES算法加速器8、随机数发生器9、RAID加速器10、SAS/SATA控制器11、USB主从控制器12、PCI-E控制器13、DDR SDRAM控制器14及千兆Ethernet控制器15～18均固定在芯片体1上。
共享数据cache 2通过高速cache总线与32位RISC主处理器4、从处理器3、5、6相连；公钥算法加速器7、DES/3DES算法加速器8、随机数发生器9、RAID加速器10、SAS/SATA控制器11、USB主从控制器12、PCI-E控制器13、DDR SDRAM控制器14及千兆Ethernet控制器15～18分别通过数据线与32位RISC主处理器4相连接。
共享数据cache 2、32位RISC主处理器4、从处理器3、5、6、公钥算法加速器7、DES/3DES算法加速器8、随机数发生器9、RAID加速器10、SAS/SATA控制器11、USB主从控制器12、PCI-E控制器13、DDR SDRAM控制器14及千兆Ethernet控制器15～18均为计算机技术领域的通用技术和部件。
以上所述的实施例，只是本实用新型较优选的具体实施方式的一种，本领域的技术人员在本实用新型技术方案范围内进行的通常变化和替换都应包含在本实用新型的保护范围内。

Claims (1)

1、集成RAID和SAS控制IP核的SOC芯片，包括芯片体，其特征在于，在芯片体上设置有共享数据cache、32位RISC处理器、公钥算法加速器、DES/3DES算法加速器、随机数发生器、RAID加速器、SAS/SATA控制器、USB主从控制器、PCI-E控制器、DDR SDRAM控制器及千兆Ethernet控制器，共享数据cache通过高速cache总线与32位RISC处理器相连；公钥算法加速器、DES/3DES算法加速器、随机数发生器、RAID加速器、SAS/SATA控制器、USB主从控制器、PCI-E控制器、DDR SDRAM控制器、千兆Ethernet控制器分别通过数据线与32位RISC处理器相连接。
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