CN116364031A - 像素驱动电路、驱动电路和驱动方法 - Google Patents

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Abstract

本申请公开了一种像素驱动电路、显示面板的驱动电路和驱动方法，沿数据线方向上，多个像素被划分为多个像素区，沿扫描线上方向上，将每个像素区划分为多个像素子区，每个像素子区包括呈2*2排列的四个像素，每个像素包括三个不同颜色的子像素，在两行像素之间的两行扫描线上连接的多个子像素中，同一数据线上的两个子像素的颜色相同。本申请提供一种新型的像素驱动电路，倍频显示时，两行扫描线同时打开，两行扫描线所控制的两行像素数据线驱动的为同一颜色像素，显示同一灰阶，避免在倍频模式下两不同颜色像素显示同一灰阶，无法显示单色画面，导致显示面板无法正常进行颜色显示，同时节省了覆晶薄膜数量，降低的显示面板的制备成本。

Description

像素驱动电路、驱动电路和驱动方法
技术领域
本申请涉及显示技术领域，尤其涉及一种像素驱动电路、驱动电路和驱动方法。
背景技术
液晶显示器(Liquid Crystal Display，LCD)具有机身薄、省电、无辐射等众多优点，得到了广泛的应用；在大尺寸和高刷新率的显示面板开发过程中，双线栅极技术(DualLine Gate，DLG)受到关注，DLG技术又称为倍频刷新技术，其原理为面板GDL电路同时打开两行扫描线，两行输入同一扫描信号，此模式下，相当于竖向显示的像素数减少一半，在不改变原有硬件和芯片算力的前提下，可达到刷新率翻倍的效果。
LCD显示行业中，DRD(Double Row Driving)设计目前受到越来越多的应用，因为其可以节省覆晶薄膜(Chip On Film，COF)数量，降低成本，DRD显示面板由于相邻行同一数据线连接的是不同颜色像素，而DLG模式两不同颜色像素显示同一灰阶，无法显示RGB单色画面，显示面板无法正常进行颜色显示，如何DRD像素架构下使用DLG技术成为亟待解决的问题。
发明内容
本申请的目的是提供一种像像素驱动电路、驱动电路和驱动方法，旨在解决现有DRD像素架构下使用DLG技术无法显示RGB单色画面的问题。
本申请公开了一种像素驱动电路，所述像素驱动电路包括多条扫描线和多条数据线，以及由多条所述扫描线和多条所述数据线分别进行驱动的多个像素，沿所述数据线方向上，多个像素被划分为多个像素区，沿所述扫描线上方向上，将每个像素区划分为多个像素子区，每个像素子区包括呈2*2排列的四个像素，每个所述像素包括三个不同颜色的子像素，四个像素分别为第一像素、第二像素、第三像素和第四像素；
所述第一像素中的一个子像素连接第n-1行扫描线，另外两个子像素连接第n行扫描线；第二像素中的一个子像素连接第n行扫描线，另外两个子像素连接第n-1行扫描线；所述第n-1行扫描线连接的三个子像素的颜色不同，所述第n行扫描线连接的三个子像素的颜色也不同；
所述第三像素中的一个子像素连接第n+2行扫描线，另外两个子像素连接第n+1行扫描线；所述第四像素中的一个子像素连接第n+1行扫描线，另外两个子像素连接第n+2行扫描线；所述第n+1行扫描线连接的三个子像素的颜色不同，所述第n+2行扫描线连接的三个子像素的颜色也不同；
其中，n为大于等于2的自然数，所述像素区进行倍频显示时，所述第n行扫描线和所述第n+1行扫描线接收相同的扫描信号，所述第一像素和所述第三像素中的相同颜色的子像素接收相同的数据信号，所述第二像素和所述第四像素中的相同颜色的子像素接收相同的数据信号。
可选的，相邻的两个像素区分别为第一像素区和第二像素区，所述第一像素区和所述第二像素区以第一像素区和第二像素区之间的中心线相互对称，所述第一像素区对应的扫描线为第n-1行扫描线、第n行扫描线、第n+1行扫描线和第n+2行扫描线，所述第二像素区对应的扫描线为第n+3行扫描线、第n+4行扫描线、第n+5行扫描线和第n+6行扫描线；
其中，所述像素区进行倍频显示时，所述第n行扫描线和所述第n+1行扫描线接收相同的扫描信号，所述第n+2行扫描线和所述第n+3行扫描线接收相同的扫描信号，所述第n+4行扫描线和所述第n+5行扫描线接收相同的扫描信号，所述第n行扫描线和所述第n+1行扫描线对应进行充电的子像素与所述第n+2行扫描线和所述第n+3行扫描线对应进行充电的子像素的颜色不同。
可选的，所述第一像素至第四像素均包括红色子像素、绿色子像素和蓝色子像素等三个不同颜色的子像素；
对应每个红色子像素连接的薄膜晶体管的阈值大于每个绿色子像素连接的薄膜晶体管的阈值以及每个蓝色子像素连接的薄膜晶体管的阈值。
可选的，所述第n行扫描线和所述第n+1行扫描线连接的子像素中，所述第一像素和所述第三像素中的相同颜色的子像素对应的薄膜晶体管的阈值不同，所述第二像素和所述第四像素中相同颜色的子像素对应的薄膜晶体管的阈值不同。
本申请还公开了一种显示面板的驱动电路，所述驱动电路包括倍频控制电路、栅极驱动电路以及如上任一所述的像素驱动电路，所述倍频控制电路通过所述栅极驱动电路与所述像素驱动电路连接；所述栅极驱动电路包括多个栅极驱动单元，多个栅极驱动单元分别与所述像素驱动电路中的扫描线一一对应连接；其中，当所述显示面板进入倍频模式显示时，所述倍频控制电路控制对应两行像素之间的两条扫描线连接的两个栅极驱动单元生成相同的扫描信号至对应的两行扫描线。
可选的，除第一行扫描线和最后一行扫描线外，所有的扫描线与所述栅极驱动单元之间设置有一个下拉电路，在倍频模式下，所述下拉电路开启，相同扫描信号的两条扫描线对应的两个下拉电路下拉的电压不同。
可选的，所有的扫描线与所述栅极驱动单元之间设置有一个上拉电路，在倍频模式下，所述上拉电路开启，相同扫描信号的两条扫描线对应的两个上拉电路上拉的电压不同。
可选的，靠近数据信号输入端的扫描线对应的上拉电路的上拉电压小于远离数据信号输入端的扫描线对应的上拉电路的上拉电压。
本申请还公开一种驱动方法，用于驱动如上任一所述的显示面板的驱动电路，所述驱动方法包括步骤：
检测下一帧的刷新率；
根据下一帧的刷新率和当前帧的刷新率，判断下一帧是否进入倍频显示模式，若是，则控制对应两行像素之间的两条扫描线连接的两个栅极驱动单元生成相同的扫描信号至对应的两行扫描线，依次输入级联的扫描信号至对应的每两行扫描线；若否，则依次输入级联的扫描信号至对应的每一行扫描线。
可选的，所述根据下一帧的刷新率和当前帧的刷新率，判断下一帧是否进入倍频显示模式，若是，则控制对应两行像素之间的两条扫描线连接的两个栅极驱动单元生成相同的扫描信号至对应的两行扫描线，依次输入级联的扫描信号至对应的每两行扫描线；若否，则依次输入级联的扫描信号至对应的每一行扫描线的步骤包括：
在生成相同扫描信号输入至对应的两行扫描线时，开启下拉电路对扫描信号进行不同程度的下拉以生成新的不同的扫描信号至对应的两行扫描线。
相对于原来的DRD像素架构来说，本申请提供了一种新型的DRD像素架构，相邻行(如Gn和Gn+1行)的同一数据线设计连接驱动上下相邻行同一颜色像素，采用本设计方案情况下，启动DLG高频技术时，Gn和Gn+1行两行扫描线同时打开，所控制的两行像素数据线驱动的为同一颜色像素，显示同一灰阶，可以实现DLG高频显示，避免在DLG模式下两不同颜色像素显示同一灰阶，无法显示RGB单色画面，导致显示面板无法正常进行颜色显示，同时节省了COF数量，降低的显示面板的制备成本。
附图说明
所包括的附图用来提供对本申请实施例的进一步的理解，其构成了说明书的一部分，用于例示本申请的实施方式，并与文字描述一起来阐释本申请的原理。显而易见地，下面描述中的附图仅仅是本申请的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动性的前提下，还可以根据这些附图获得其他的附图。在附图中：
图1是本申请的第一实施例的一种像素驱动电路的结构示意图；
图2是本申请的第二实施例的驱动电路的结构示意图；
图3是本申请的第三实施例的驱动电路的结构示意图；
图4是本申请的第四实施例的驱动电路的结构示意图；
图5是本申请的第五实施例的驱动方法流程示意图。
其中，100、像素驱动电路；110、扫描线；120、数据线；130、像素区；131、第一像素区；132、第二像素区；140、像素子区；141、第一像素；142、第二像素；143、第三像素；144、第四像素；200、驱动电路；210、栅极驱动电路；211、栅极驱动单元；220、倍频控制电路；230、下拉电路；240、上拉电路。
具体实施方式
需要理解的是，这里所使用的术语、公开的具体结构和功能细节，仅仅是为了描述具体实施例，是代表性的，但是本申请可以通过许多替换形式来具体实现，不应被解释成仅受限于这里所阐述的实施例。
在本申请的描述中，术语“第一”、“第二”仅用于描述目的，而不能理解为指示相对重要性，或者隐含指明所指示的技术特征的数量。由此，除非另有说明，限定有“第一”、“第二”的特征可以明示或者隐含地包括一个或者更多个该特征；“多个”的含义是两个或两个以上。术语“包括”及其任何变形，意为不排他的包含，可能存在或添加一个或更多其他特征、整数、步骤、操作、单元、组件和/或其组合。
另外，“中心”、“横向”、“上”、“下”、“左”、“右”、“竖直”、“水平”、“顶”、“底”、“内”、“外”等指示的方位或位置关系的术语，是基于附图所示的方位或相对位置关系描述的，仅是为了便于描述本申请的简化描述，而不是指示所指的装置或元件必须具有特定的方位、以特定的方位构造和操作，因此不能理解为对本申请的限制。
此外，除非另有明确的规定和限定，术语“安装”、“相连”、“连接”应做广义理解，例如可以是固定连接，也可以是可拆卸连接，或一体地连接；可以是机械连接，也可以是电连接；可以是直接相连，也可以通过中间媒介间接相连，或是两个元件内部的连通。对于本领域的普通技术人员而言，可以根据具体情况理解上述术语在本申请中的具体含义。
下面参考附图和可选的实施例对本申请作详细说明。
如图1所示，作为本申请的第一实施例，公开了一种像素驱动电路100，所述像素驱动电路100包括多条扫描线110和多条数据线120，以及由多条所述扫描线110和多条所述数据线120分别进行驱动的多个像素，沿所述数据线120方向上，多个像素被划分为多个像素区130，沿所述扫描线110上方向上，将每个像素区130划分为多个像素子区140，每个像素子区140包括呈2*2排列的四个像素，每个所述像素包括三个不同颜色的子像素，三个不同颜色的子像素分别为红色子像素R、绿色子像素G和蓝色子像素B，四个像素分别为第一像素141、第二像素142、第三像素143和第四像素144。
所述第一像素141中的一个子像素连接第n-1行扫描线Gn-1，另外两个子像素连接第n行扫描线Gn；第二像素142中的一个子像素连接第n行扫描线Gn，另外两个子像素连接第n-1行扫描线Gn-1；所述第n-1行扫描线Gn-1连接的三个子像素的颜色不同，所述第n行扫描线Gn连接的三个子像素的颜色也不同；所述第三像素143中的一个子像素连接第n+2行扫描线Gn+2，另外两个子像素连接第n+1行扫描线Gn+1；所述第四像素144中的一个子像素连接第n+1行扫描线Gn+1，另外两个子像素连接第n+2行扫描线Gn+2；所述第n+1行扫描线Gn+1连接的三个子像素的颜色不同，所述第n+2行扫描线Gn+2连接的三个子像素的颜色也不同。
其中，n为大于等于2的自然数，所述像素区130进行倍频显示时，所述第n行扫描线110和所述第n+1行扫描线110接收相同的扫描信号，所述第一像素141和所述第三像素143中的相同颜色的子像素接收相同的数据信号，所述第二像素142和所述第四像素144中的相同颜色的子像素接收相同的数据信号。
本申请提供开了一种新型的DRD像素架构，接收相同的扫描信号和的两条扫描线110上连接的像素，如果接收相同数据信号，则将所述两条扫描线110对应的两个子像素设置成相同颜色的子像素，在进行倍频显示时，即开启DLG模式时，所述第n行扫描线Gn和所述第n+1行扫描线Gn+1接收相同的扫描信号，所述第一像素141和所述第三像素143中的相同颜色的子像素接收相同的数据信号，所述第二像素142和所述第四像素144中的相同颜色的子像素接收相同的数据信号，避免显示面板由于相邻行同一数据线120连接的是不同颜色像素，DLG模式下，两不同颜色像素显示同一灰阶，无法显示RGB单色画面，显示面板无法正常进行颜色显示的情况发生。
进一步的，相邻的两个像素区130分别为第一像素区131和第二像素区132，所述第一像素区131和所述第二像素区132以第一像素区131和第二像素区132之间的中心线相互对称，所述第一像素区131对应的扫描线110为第n-1行扫描线Gn-1、第n行扫描线Gn、第n+1行扫描线Gn+1和第n+2行扫描线Gn+2，所述第二像素区132对应的扫描线110为第n+3行扫描线Gn+3、第n+4行扫描线Gn+4、第n+5行扫描线Gn+5和第n+6行扫描线Gn+6；后续还有像素区130对应的第n+m-3行扫描线Gn+m-3、第n+m-2行扫描线Gn+m-2、第n+m-1行扫描线Gn+m-1和第n+m行扫描线Gn+m。
其中，所述像素区130进行倍频显示时，所述第n行扫描线Gn和所述第n+1行扫描线Gn+1接收相同的扫描信号，所述第n+2行扫描线Gn+2和所述第n+3行扫描线Gn+3接收相同的扫描信号，所述第n+4行扫描线Gn+4和所述第n+5行扫描线Gn+5接收相同的扫描信号，所述第n行扫描线Gn和所述第n+1行扫描线Gn+1对应进行充电的子像素与所述第n+2行扫描线Gn+2和所述第n+3行扫描线Gn+3对应进行充电的子像素的颜色不同，如此整个显示面板来说都可以实现DLG模式的显示。
所述第一像素141至第四像素144均包括红色子像素、绿色子像素和蓝色子像素等三个不同颜色的子像素；考虑到在DLG模式下，由于扫描线110的扫描时间减半，导致像素的充电量下降，而由于不同颜色的子像素的透光率不同，需要的充电量如果不变的话，导致充电结束后子像素之间的亮暗差异大，RGB混出的光与理想的光存在偏差，对应每个红色子像素连接的薄膜晶体管的阈值大于每个绿色子像素连接的薄膜晶体管的阈值以及每个蓝色子像素连接的薄膜晶体管的阈值，且绿色子像素连接的薄膜晶体管的阈值大于蓝色子像素连接的薄膜晶体管的阈值。
另外，DLG模式的弊端在于，竖向的分辨率减半后，显示原分辨率的图案时，画面清晰度下降，曲线边缘处的锯齿感较为明显，显示效果不理想，所述第n行扫描线110和所述第n+1行扫描线110连接的子像素中，所述第一像素141和所述第三像素143中的相同颜色的子像素对应的薄膜晶体管的阈值不同，所述第二像素142和所述第四像素144中相同颜色的子像素对应的薄膜晶体管的阈值不同，从而使相邻两行的栅极打开程度不同，使同时打开的两行像素存在不同的充电率，进而产生不同的显示效果，相对于原来的相同充电率的像素来说，可以优化画面边缘的锯齿感，避免画面边缘锯齿感明显而强烈，以此来弥补DLG模式的显示效果。
如图2所示，公开了一种显示面板的驱动电路200，所述驱动电路200包括倍频控制电路220、栅极驱动电路210以及如上任一所述的像素驱动电路100，所述倍频控制电路220通过所述栅极驱动电路210与所述像素驱动电路100连接；所述栅极驱动电路210包括多个栅极驱动单元211，多个栅极驱动单元211分别与所述像素驱动电路100中的扫描线110一一对应连接；其中，当所述显示面板进入倍频模式显示时，所述倍频控制电路220控制对应两行像素之间的两条扫描线110连接的两个栅极驱动单元211生成相同的扫描信号至对应的两行扫描线110。
驱动电路200可用于正常模式下的驱动，也可以用于倍频模式下的驱动，正常模式下时，倍频控制电路220控制栅极驱动电路210对应每一行扫描线110生成不同的扫描信号以输入至扫描线110进行驱动；而在倍频模式下，两行像素之间的两行扫描线110接收相同的扫描信号，该相同的扫描信号也是有倍频控制模块控制所述栅极驱动电路210生成的，所述第n行扫描线Gn和所述第n+1行扫描线Gn+1接收相同的扫描信号，所述第n+2行扫描线Gn+2和所述第n+3行扫描线Gn+3接收相同的扫描信号，所述第n+4行扫描线Gn+4和所述第n+5行扫描线Gn+5接收相同的扫描信号，所述第n行扫描线Gn和所述第n+1行扫描线Gn+1对应进行充电的子像素与所述第n+2行扫描线Gn+2和所述第n+3行扫描线Gn+3对应进行充电的子像素的颜色不同，而所述第n行扫描线Gn和所述第n+1行扫描线Gn+1接收相同的扫描信号，所述第n+2行扫描线Gn+2和所述第n+3行扫描线Gn+3接收相同的扫描信号，所述第n+4行扫描线Gn+4和所述第n+5行扫描线Gn+5接收相同的扫描信号不同，分别为级联的扫描信号，且由于像素驱动电路100中的像素排布连接方式的改进，可以DLG模式下两相同颜色像素显示同一灰阶，显示RGB单色画面，同时节省了COF数量，降低的显示面板的制备成本。
如图3所示，作为本申请的第三实施例，是对上述第二实施例的进一步完善，目前DLG模式的弊端在于，竖向的分辨率减半后，显示原分辨率的图案时，画面清晰度下降，曲线边缘处的锯齿感较为明显，显示效果不理想；除第一行扫描线110和最后一行扫描线110外，所有的扫描线110与所述栅极驱动单元211之间设置有一个下拉电路230，在倍频模式下，所述下拉电路230开启，相同扫描信号的两条扫描线110对应的两个下拉电路230下拉的电压不同，通过设置下拉电路230，从而生成不同的扫描信号输出至扫描线110上的波形，两行扫描信号波形不同，子像素的薄膜晶体的开启电压不同，从而使相邻两行像素对应的薄膜晶体管的栅极打开程度不同，使同时打开的两行像素存在不同的充电率，进而产生不同的显示效果，以优化画面边缘的锯齿感，避免画面边缘锯齿感明显而强烈，以此来弥补DLG模式的显示效果。
如图4所示，作为本申请的第四实施例，也是针对第二实施例进行的改进，考虑到倍频后每行像素的充电时间减半，在进入到DLG模式时，可能会导致子像素充电不足的情况发生，故增加上拉电路240将扫描信号的电压拉高，避免充电不足，具体的，所有的扫描线110与所述栅极驱动单元211之间设置有一个上拉电路240，以提高每一行像素对应的薄膜晶体管的打开程度，以增加充电效率；在倍频模式下，所述上拉电路240开启，相同扫描信号的两条扫描线110对应的两个上拉电路240上拉的电压不同，从而使相邻两行的栅极打开程度不同，使同时打开的两行像素存在不同的充电率，进而产生不同的显示效果，如此也可以避免DLG模式下，接收相同扫描信号的两行扫描线110充电量相同导致画面清晰度下降，曲线边缘处的锯齿感较为明显，显示效果不理想的情况发生；另外需要说明的是，上拉电路240也可以设置扫描信号生成之前，即对时钟信号进行上拉，从而直接使得栅极驱动电路210生成的扫描信号的电压大于没有上拉电路240之前生成的扫描信号的电压。
进一步的，考虑到数据信号在数据线120上会存在一定的损耗，或者在数据线120输入电压进行充电因为线阻产生寄生电容的情况，靠近数据信号输入端的扫描线110对应的上拉电路240的上拉电压VGH1小于远离数据信号输入端的扫描线110对应的上拉电路240的上拉电压VGH2，从而减少寄生电容的影响，从而提高显示效果。
作为本申请的第五实施例，公开了一种驱动方法，所述驱动方法可用于如上任一实施例所述的驱动电路，所述驱动方法包括步骤：
S1：检测下一帧的刷新率；
S2：根据下一帧的刷新率和当前帧的刷新率，判断下一帧是否进入倍频显示模式，若是，则控制对应两行像素之间的两条扫描线连接的两个栅极驱动单元生成相同的扫描信号至对应的两行扫描线，依次输入级联的扫描信号至对应的每两行扫描线；若否，则依次输入级联的扫描信号至对应的每一行扫描线。
在没有开启DLG模式之前，会对下一帧的刷新率进行检测，当下一帧的刷新率发生改变或者说翻倍时，则此时判断下一帧进入倍频模式，那么开始每一行扫描信号逐步输入扫描信号变换为每两行扫描线逐步输入扫描信号至两行像素之间的两行扫描线上，从而实现倍频显示，且在该中像素驱动电路下，不用担心DLG模式两不同色像素显示同一灰阶，无法显示RGB单色画面，面板无法正常进行颜色显示，所以目前DRD架构显示面板无法使用DLG技术的问题发生。
一般的，所述步骤S2还包括：
S21：在生成相同扫描信号输入至对应的两行扫描线时，开启下拉电路对扫描信号进行不同程度的下拉以生成新的不同的扫描信号至对应的两行扫描线。
通过启动下拉电路来控制栅极驱动信号输出至扫描线上的波形，开启下拉电路时，两行扫描线的扫描信号的波形不同，电压不同，从而使相邻两行的栅极打开程度不同，使同时打开的两行像素存在不同的充电率，进而产生不同的显示效果，相对于原来的相同充电率的像素来说，可以优化画面边缘的锯齿感，避免画面边缘锯齿感明显而强烈，以此来弥补DLG模式的显示效果；另外，虽然可以对应输入相同扫描信号的两个栅极驱动单元都设有一个下拉电路，但是其中一个下拉电路工作进行下拉，另外一个下拉电路不工作，不进行下拉也可以的。
考虑到刷新率切换存在多种可能性，比如有60Hz切换到120Hz的，有120Hz切换到240Hz，考虑到刷新率的差值不同，可能造成的锯齿状效果不同，刷新率相差越大的，锯齿状越明显，则需要更大力度的下拉，以改善画面边缘的锯齿感，提高双线栅极模式的显示效果，故将下拉电路可以设置两个下拉电压，从而可以用于不同刷新率的切换。
需要说明的是，本方案中涉及到的各步骤的限定，在不影响具体方案实施的前提下，并不认定为对步骤先后顺序做出限定，写在前面的步骤可以是在先执行的，也可以是在后执行的，甚至也可以是同时执行的，只要能实施本方案，都应当视为属于本申请的保护范围。
需要说明的是,本申请的发明构思可以形成非常多的实施例，但是申请文件的篇幅有限，无法一一列出，因而，在不相冲突的前提下,以上描述的各实施例之间或各技术特征之间可以任意组合形成新的实施例，各实施例或技术特征组合之后，将会增强原有的技术效果。
本申请的技术方案可以广泛用于各种显示面板的驱动电路，如TN(TwistedNematic，扭曲向列型)显示面板的驱动电路、IPS(In-Plane Switching，平面转换型)显示面板的驱动电路、VA(Vertical Alignment，垂直配向型)显示面板的驱动电路、MVA(Multi-Domain Vertical Alignment，多象限垂直配向型)显示面板的驱动电路，当然，也可以是其他类型的显示面板的驱动电路，如OLED(Organic Light-Emitting Diode，有机发光二极管)显示面板的驱动电路，均可适用上述方案。
以上内容是结合具体的可选实施方式对本申请所作的进一步详细说明，不能认定本申请的具体实施只局限于这些说明。对于本申请所属技术领域的普通技术人员来说，在不脱离本申请构思的前提下，还可以做出若干简单推演或替换，都应当视为属于本申请的保护范围。

Claims (10)

1.一种像素驱动电路，包括多条扫描线和多条数据线，以及由多条所述扫描线和多条所述数据线分别进行驱动的多个像素，其特征在于，沿所述数据线方向上，多个像素被划分为多个像素区，沿所述扫描线上方向上，将每个像素区划分为多个像素子区，每个像素子区包括呈2*2排列的四个像素，每个所述像素包括三个不同颜色的子像素，四个像素分别为第一像素、第二像素、第三像素和第四像素；
所述第一像素中的一个子像素连接第n-1行扫描线，另外两个子像素连接第n行扫描线；第二像素中的一个子像素连接第n行扫描线，另外两个子像素连接第n-1行扫描线；所述第n-1行扫描线连接的三个子像素的颜色不同，所述第n行扫描线连接的三个子像素的颜色也不同；
所述第三像素中的一个子像素连接第n+2行扫描线，另外两个子像素连接第n+1行扫描线；所述第四像素中的一个子像素连接第n+1行扫描线，另外两个子像素连接第n+2行扫描线；所述第n+1行扫描线连接的三个子像素的颜色不同，所述第n+2行扫描线连接的三个子像素的颜色也不同；
其中，n为大于等于2的自然数，所述像素区进行倍频显示时，所述第n行扫描线和所述第n+1行扫描线接收相同的扫描信号，所述第一像素和所述第三像素中的相同颜色的子像素接收相同的数据信号，所述第二像素和所述第四像素中的相同颜色的子像素接收相同的数据信号。
2.如权利要求1所述的像素驱动电路，其特征在于，相邻的两个像素区分别为第一像素区和第二像素区，所述第一像素区和所述第二像素区以第一像素区和第二像素区之间的中心线相互对称，所述第一像素区对应的扫描线为第n-1行扫描线、第n行扫描线、第n+1行扫描线和第n+2行扫描线，所述第二像素区对应的扫描线为第n+3行扫描线、第n+4行扫描线、第n+5行扫描线和第n+6行扫描线；
其中，所述像素区进行倍频显示时，所述第n行扫描线和所述第n+1行扫描线接收相同的扫描信号，所述第n+2行扫描线和所述第n+3行扫描线接收相同的扫描信号，所述第n+4行扫描线和所述第n+5行扫描线接收相同的扫描信号，所述第n行扫描线和所述第n+1行扫描线对应进行充电的子像素与所述第n+2行扫描线和所述第n+3行扫描线对应进行充电的子像素的颜色不同。
3.如权利要求1所述的像素驱动电路，其特征在于，所述第一像素至第四像素均包括红色子像素、绿色子像素和蓝色子像素等三个不同颜色的子像素；
对应每个红色子像素连接的薄膜晶体管的阈值大于每个绿色子像素连接的薄膜晶体管的阈值以及每个蓝色子像素连接的薄膜晶体管的阈值。
4.如权利要求1所述的像素驱动电路，其特征在于，所述第n行扫描线和所述第n+1行扫描线连接的子像素中，所述第一像素和所述第三像素中的相同颜色的子像素对应的薄膜晶体管的阈值不同，所述第二像素和所述第四像素中相同颜色的子像素对应的薄膜晶体管的阈值不同。
5.一种显示面板的驱动电路，其特征在于，包括倍频控制电路、栅极驱动电路以及如权利要求1-4任意一项所述的像素驱动电路，所述倍频控制电路通过所述栅极驱动电路与所述像素驱动电路连接；所述栅极驱动电路包括多个栅极驱动单元，多个栅极驱动单元分别与所述像素驱动电路中的扫描线一一对应连接；
其中，当所述显示面板进入倍频模式显示时，所述倍频控制电路控制对应两行像素之间的两条扫描线连接的两个栅极驱动单元生成相同的扫描信号至对应的两行扫描线。
6.如权利要求5所述的显示面板的驱动电路，其特征在于，除第一行扫描线和最后一行扫描线外，所有的扫描线与所述栅极驱动单元之间设置有一个下拉电路，在倍频模式下，所述下拉电路开启，相同扫描信号的两条扫描线对应的两个下拉电路下拉的电压不同。
7.如权利要求5所述的显示面板的驱动电路，其特征在于，所有的扫描线与所述栅极驱动单元之间设置有一个上拉电路，在倍频模式下，所述上拉电路开启，相同扫描信号的两条扫描线对应的两个上拉电路上拉的电压不同。
8.如权利要求7所述的显示面板的驱动电路，其特征在于，靠近数据信号输入端的扫描线对应的上拉电路的上拉电压小于远离数据信号输入端的扫描线对应的上拉电路的上拉电压。
9.一种驱动方法，用于驱动如权利要求5-8任意一项所述的显示面板的驱动电路，其特征在于，所述驱动方法包括步骤：
检测下一帧的刷新率；
根据下一帧的刷新率和当前帧的刷新率，判断下一帧是否进入倍频显示模式，若是，则控制对应两行像素之间的两条扫描线连接的两个栅极驱动单元生成相同的扫描信号至对应的两行扫描线，依次输入级联的扫描信号至对应的每两行扫描线；若否，则依次输入级联的扫描信号至对应的每一行扫描线。
10.如权利要求7所述的驱动方法，其特征在于，所述根据下一帧的刷新率和当前帧的刷新率，判断下一帧是否进入倍频显示模式，若是，则控制对应两行像素之间的两条扫描线连接的两个栅极驱动单元生成相同的扫描信号至对应的两行扫描线，依次输入级联的扫描信号至对应的每两行扫描线；若否，则依次输入级联的扫描信号至对应的每一行扫描线的步骤包括：
在生成相同扫描信号输入至对应的两行扫描线时，开启下拉电路对扫描信号进行不同程度的下拉以生成新的不同的扫描信号至对应的两行扫描线。
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