CN116074570A - 一种发送端芯片、接收端芯片、显示控制系统及显示设备 - Google Patents

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CN116074570A CN202111291570.7A CN202111291570A CN116074570A CN 116074570 A CN116074570 A CN 116074570A CN 202111291570 A CN202111291570 A CN 202111291570A CN 116074570 A CN116074570 A CN 116074570A
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Abstract

本申请实施例提供了一种发送端芯片、接收端芯片、显示控制系统及显示设备，其中发送端芯片包括：第一存储器及与第一存储器分别连接的视频输入接口及多个SERDES接口，各SERDES接口与对应的一接收端芯片连接；视频输入接口，用于获取视频数据，将视频数据写入第一存储器；第一存储器，用于存储显示器件的配置参数、及将视频数据划分为多个子视频数据；各SERDES接口，用于从第一存储器读取对应的子视频数据及配置参数，将读取的子视频数据及配置参数分配至对应的一接收端芯片。通过所提供的发送端芯片、接收端芯片分别集成多个SERDES接口，减小芯片体积，解决LED灯间距无法减小的问题，增加带载LED点数。

Description

一种发送端芯片、接收端芯片、显示控制系统及显示设备
技术领域
本发明涉及显示技术领域，尤其涉及一种发送端芯片、接收端芯片、显示控制系统及显示设备。
背景技术
随着显示屏技术的不断发展，市场上存在多种类型的显示屏，其中，发光二极管(Light-Emitting Diode，LED)显示屏具有亮度高、寿命长、使用和维护简便、显示效果丰富等特点。采用LED显示屏的多类大型显示设备，可广泛应用于车站、港口、户外广告、大型文体会馆、政府公告等场所。此外，采用LED显示屏的中小型显示设备，例如会议屏幕、家用电视机、车载屏幕等，也有较为广泛的应用。传统的LED显示屏的架构包括视频处理、控制器、发送端芯片、接收芯片，这种带来体积过大，成本过高等问题，且现有LED灯的发送端芯片及接收芯片体积较大。现有LED显示控制系统存在驱动芯片体积过大导致LED灯间距无法减小的问题。
发明内容
为了解决上述技术问题，本发明实施例提供了一种发送端芯片、接收端芯片、显示控制系统及显示设备。
第一方面，本发明实施例提供了一种发送端芯片，包括第一存储器及与所述第一存储器分别连接的视频输入接口、配置接口及多个SERDES接口，各SERDES接口与对应的一接收端芯片连接；
所述视频输入接口，用于获取视频数据，将所述视频数据写入所述第一存储器；
配置接口，用于获取存储显示器件的配置参数，将所述配置参数写入所述第一存储器；
所述第一存储器，用于将所述视频数据划分为多个子视频数据；
各SERDES接口，用于从所述第一存储器读取对应的子视频数据及所述配置参数，将读取的子视频数据及所述配置参数分配至对应的一接收端芯片。
可选的，各SERDES接口包含均衡模块及时钟恢复模块；
所述均衡模块，用于在低速并行数据通过通信协议层后，对所述低速并行数据进行加扰及比特位转换编码处理，得到转换后的并行数据，并将转换后的并行数据写入先入先出队列，通过串行器将转换后的并行数据转换为串行差分信号，通过均衡器对所述串行差分信号进行均衡化处理，得到均衡化串行差分信号；
所述时钟恢复模块，用于通过均衡器对所述均衡化串行差分信号进行补偿，得到修正串行差分信号，对所述修正串行差分信号进行数据时钟恢复，得到时钟信号，将所述时钟信号输入解串器，通过所述解串器根据所述时钟信号对所述修正串行差分信号进行转换处理，得到并行数据，对所述并行数据进行解扰及比特位转换解码处理，得到解码后的并行数据。
第二方面，本发明实施例提供接收端芯片，包括主SERDES接口、第二存储器、低压差分信号接口及与所述第二存储器连接的视频输出接口，所述视频输出接口，还用于与显示器件连接；
所述主SERDES接口分别与所述第二储存器、及权利要求1或2所述发送端芯片对应的一SERDES接口连接；
所述主SERDES接口，用于从所述发送端芯片获取对应的子视频数据及配置参数，并将所述子视频数据及所述配置参数写入所述第二存储器；
所述视频输出接口，用于从所述第二存储器读取对应的子视频数据及配置参数，向低压差分信号接口输入所述子视频数据及所述配置参数；
所述低压差分信号接口，用于将所述子视频数据及所述配置参数输入显示驱动芯片，以通过所述显示驱动芯片产生所述目标电流，所述目标电流用于驱动所述显示器件显示所述子视频数据。
可选的，所述接收端芯片包括多个辅SERDES接口，各辅SERDES接口分别与所述主SERDES接口及对应的一其他接收端芯片连接。
第三方面，本发明实施例提供了一种显示控制系统，包括：
显示器件、第一方面提供的发送端芯片、及多个第二方面提供的接收端芯片；
所述发送端芯片的各SERDES接口对应连接于一接收端芯片的主SERDES接口；
多个所述接收端芯片与所述显示器件连接。
可选的，各所述接收端芯片的辅SERDES接口对应连接于一其他接收端芯片，多个所述接收端芯片构成级联连接。
可选的，处于同一级联层的相邻接收端芯片的上一接收端芯片的一辅SERDES接口与下一接收端芯片的一辅SERDES接口相连接；
在多个所述接收端芯片存在从所述发送端芯片或上一级联层对应的接收端芯片获取子视频数据及配置参数失败的目标接收端芯片时，所述目标接收端芯片，用于从与其相连接的接收端芯片获取对应的子视频数据及配置参数。
可选的，所述第一存储器和/或所述第二存储器为DDR或SDRAM。
可选的，所述视频输入接口包括HDMI接口、DP接口、DVI接口、SDI接口、VGA接口；所述视频输出接口包括LVDS接口及HUB接口。
可选的，所述显示器件包括：LED灯板和/或LED屏幕。
第四方面，本发明实施例提供了一种显示控制方法，应用于第三方面提供的显示控制系统，所述方法包括：
发送端芯片的视频输入接口获取视频数据，将所述视频数据写入所述发送端芯片的第一存储器；
所述发送端芯片的配置接口获取存储显示器件的配置参数，将所述配置参数写入所述第一存储器；
所述发送端芯片的第一存储器将所述视频数据划分为多个子视频数据；
所述发送端芯片的各SERDES接口从所述第一存储器读取对应的子视频数据及所述配置参数，将读取的子视频数据及配置参数分配至对应的一接收端芯片；
接收端芯片的主SERDES接口从所述发送端芯片获取对应的子视频数据及配置参数，并将所述子视频数据及所述配置参数写入所述第二存储器；
所述接收端芯片的视频输出接口从所述第二存储器读取对应的子视频数据及配置参数，向低压差分信号接口输入所述子视频数据及所述配置参数；
所述接收端芯片的低压差分信号接口，用于将所述子视频数据及所述配置参数输入显示驱动芯片，以通过所述显示驱动芯片产生所述目标电流，所述目标电流用于驱动所述显示器件显示所述子视频数据。
可选的，所述方法还包括：
在多个所述接收端芯片存在从所述发送端芯片或上一级联层对应的接收端芯片获取子视频数据及配置参数失败的目标接收端芯片时，所述目标接收端芯片从与其相连接的接收端芯片获取对应的子视频数据及配置参数。
第五方面，本发明实施例提供了一种显示设备，包括第三方面提供的显示控制系统。
上述本申请提供的发送端芯片、接收端芯片、显示控制系统及显示设备，发送端芯片、接收端芯片通过集成多个SERDES接口，提高通信速率，增加通信带宽，减小发送端芯片接口数量，从而减小发送端芯片体积，解决LED灯间距无法减小的问题，增加带载LED点数。
附图说明
为了更清楚地说明本发明的技术方案，下面将对实施例中所需要使用的附图作简单地介绍，应当理解，以下附图仅示出了本发明的某些实施例，因此不应被看作是对本发明保护范围的限定。在各个附图中，类似的构成部分采用类似的编号。
图1示出了本申请实施例提供的发送端芯片的一结构示意图；
图2示出了本申请实施例提供的接收端芯片的一结构示意图；
图3示出了本申请实施例提供的接收端芯片的另一结构示意图；
图4示出了本申请实施例提供的显示控制系统的一结构示意图；
图5示出了本申请实施例提供的显示控制系统的另一结构示意图。
具体实施方式
下面将结合本发明实施例中附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。
通常在此处附图中描述和示出的本发明实施例的组件可以以各种不同的配置来布置和设计。因此，以下对在附图中提供的本发明的实施例的详细描述并非旨在限制要求保护的本发明的范围，而是仅仅表示本发明的选定实施例。基于本发明的实施例，本领域技术人员在没有做出创造性劳动的前提下所获得的所有其他实施例，都属于本发明保护的范围。
在下文中，可在本发明的各种实施例中使用的术语“包括”、“具有”及其同源词仅意在表示特定特征、数字、步骤、操作、元件、组件或前述项的组合，并且不应被理解为首先排除一个或更多个其它特征、数字、步骤、操作、元件、组件或前述项的组合的存在或增加一个或更多个特征、数字、步骤、操作、元件、组件或前述项的组合的可能性。
此外，术语“第一”、“第二”、“第三”等仅用于区分描述，而不能理解为指示或暗示相对重要性。
除非另有限定，否则在这里使用的所有术语(包括技术术语和科学术语)具有与本发明的各种实施例所属领域普通技术人员通常理解的含义相同的含义。所述术语(诸如在一般使用的词典中限定的术语)将被解释为具有与在相关技术领域中的语境含义相同的含义并且将不被解释为具有理想化的含义或过于正式的含义，除非在本发明的各种实施例中被清楚地限定。
实施例1
本公开实施例提供了一种发送端芯片。
请参阅图1，发送端芯片100包括第一存储器103及与所述第一存储器103分别连接的视频输入接口101、配置接口102及多个SERDES接口104，各SERDES接口104用于与对应的一接收端芯片连接；
所述视频输入接口101，用于获取视频数据，将所述视频数据写入所述第一存储器103；
配置接口，用于获取存储显示器件的配置参数，将所述配置参数写入所述第一存储器；
所述第一存储器，用于将所述视频数据划分为多个子视频数据；
各SERDES接口104，用于从所述第一存储器103读取对应的子视频数据及所述配置参数，将读取的子视频数据及所述配置参数分配至对应的一接收端芯片。
在本实施例中，所述第一存储器103为DDR或SDRAM。
可选的，所述配置接口102，用于获取所述配置参数，将所述配置参数写入所述第一存储器103。
在本实施例中，配置接口102可以从上位机获取配置参数。需要说明的是，上位机可以为终端设备，例如电脑和/或手机，通过电脑和/或手机上安装的软件向配置接口下发配置参数。进一步说明的是，对于一个LED屏幕，若该LED屏幕是固定的，则该LED频率的长度、宽度、驱动型号等配置参数是固定的。若该LED屏幕是变化的，例如该LED屏幕长度、宽度及驱动芯片型号等因素不同，则需要上位机将该LED屏幕的长度、宽度及驱动芯片型号等配置参数下发至配置接口，根据配置参数将LED屏幕正常点亮。
在本实施例中，第一存储器可以为双倍速率存储器(Double Data Rate，DDR)、同步动态随机存储器(Synchronous Dynamic Random Access Memory，SDRAM)，DDR在SDRAM内存基础上发展而来的，仍然沿用SDRAM生产体系，因此对于存储器厂商而言，只需对制造普通SDRAM的设备稍加改进，即可实现DDR内存的生产，可有效的降低成本。
在本实施例中，所述视频输入接口包括HDMI接口、DP接口、DVI接口、SDI接口及VGA接口。
需要说明的是，高清多媒体接口(High Definition Multimedia Interface，HDMI)，提供一种全数字化视频和声音发送接口，可以发送未压缩视频信号。显示接口(DisplayPort，DP)主要用于视频源与显示器等设备的连接。数字视频接口(DigitalVisual Interface，DVI)在传输数字信号时又分为单连接(Single Link)和双连接(DualLink)两种方式，在此不做限制。数字分量串行接口(serial digital interface，SDI)不能直接传送压缩数字信号，数字录像机、硬盘等设备记录的压缩信号重放后，必须经解压并经SDI接口输出才能进入SDI系统。视频图形阵列接口(Video Graphics Array，VGA)是采用模拟信号的电脑显示标准接口，VGA接口即电脑采用VGA标准输出数据的专用接口。
SERDES接口是串行器(SERializer)/解串器(DESerializer)的简称。SERDES接口是时分多路复用(Time-Division Multiplexing，TDM)、点对点(peer-to-peer，P2P)的串行通信技术。即在发送端芯片多路低速并行信号被转换成高速串行信号，经过传输媒体，例如，光缆或铜线的传输，最后在接收端芯片将高速串行信号重新转换成低速并行信号。此种传输方式，充分利用传输媒体的信道容量，减少所需的传输信道和器件引脚数目，提升信号的传输速度，从而大大降低通信成本。
在本实施例中，各SERDES接口包含均衡模块及时钟恢复模块；
所述均衡模块，用于在低速并行数据通过通信协议层后，对所述低速并行数据进行加扰及比特位转换编码处理，得到转换后的并行数据，并将转换后的并行数据写入先入先出队列，通过串行器将转换后的并行数据转换为串行差分信号，通过均衡器对所述串行差分信号进行均衡化处理，得到均衡化串行差分信号；
所述时钟恢复模块，用于通过均衡器对所述均衡化串行差分信号进行补偿，得到修正串行差分信号，对所述修正串行差分信号进行数据时钟恢复，得到时钟信号，将所述时钟信号输入解串器，通过所述解串器根据所述时钟信号对所述修正串行差分信号进行转换处理，得到并行数据，对所述并行数据进行解扰及比特位转换解码处理，得到解码后的并行数据。
发送端芯片可以做成BGA封装，使用SERDES接口，提高通信速率，增加通信带宽，减小发送端芯片接口数量，从而减小发送端芯片体积，增加带载LED点数。
在本实施例中，比特位转换编码处理可以为8B/10B转换编码处理，8B/10B转换编码处理是指将一组连续的8位数据分解成两组数据，一组3位，一组5位，经过编码后分别成为一组4位的代码和一组6位的代码，从而组成一组10位的数据。比特位转换解码处理可以为10B/8B转换转换处理，10B/8B转换转换处理即将1组10位的输入数据经过变换得到8位数据位。发送端芯片100设置有1～8个速率最高达到12.5G的SERDES接口，举例来说，图1所示的发送端芯片100的SERDES接口104的个数为3个。
在本实施例中，配置接口可以为USB接口，与上位机连接，从上位机获取配置参数。上位机可以为终端设备，例如电脑和/或手机，通过电脑和/或手机上安装的软件向配置接口下发LED屏幕的长度、宽度及驱动芯片型号等配置参数。进一步补充说明的是，配置参数可以包括屏宽、屏高、模组宽、模组高、打折数、抽点数、扫数、子帧数、刷新率、走点表、gama表、行序表、灰度表等。所有配置参数配合使用，使得LED屏幕正常点亮，否则可能造成LED屏幕显示异常。
本公开实施例提供的发送端芯片，通过集成多个SERDES接口，提高通信速率，增加通信带宽，减小发送端芯片接口数量，从而减小发送端芯片体积，解决LED灯间距无法减小的问题，增加带载LED点数。
实施例2
本公开实施例提供了一种接收端芯片。
请参阅图2，接收端芯片200包括主SERDES接口201、第二存储器203、低压差分信号接口及与所述第二存储器203连接的视频输出接口204，所述视频输出接口204，还用于与显示器件连接；
所述主SERDES接口201分别所述第二储存器203、及实施例1所提供的发送端芯片对应的一SERDES接口连接；
所述主SERDES接口201，用于从所述发送端芯片获取对应的子视频数据及配置参数，并将所述子视频数据及所述配置参数写入所述第二存储器203；
所述视频输出接口204，用于从所述第二存储器203读取对应的子视频数据及配置参数，向低压差分信号接口输入所述子视频数据及所述配置参数；
所述低压差分信号接口，用于将所述子视频数据及所述配置参数输入显示驱动芯片，以通过所述显示驱动芯片产生所述目标电流，所述目标电流用于驱动所述显示器件显示所述子视频数据。
可选的，所述接收端芯片200包括多个辅SERDES接口，各辅SERDES接口分别与所述主SERDES接口及对应的一其他接收端芯片连接。
请再次参阅图2，所述接收端芯片200包括两个辅SERDES接口202，各辅SERDES接口202分别与所述主SERDES接口201及对应的一其他接收端芯片连接。
在本实施例中，所述第二存储器203为DDR或SDRAM，所述视频输出204接口包括LVDS接口及HUB接口。
在本实施例中，低压差分信号(Low Voltage Differential Signaling，LVDS)接口又称RS-644总线接口，是一种数字视频信号传输方式。HUB接口即“通用串行总线”，也称通用串联接口。
可选的，请参阅图3，所述视频输出接口204包括LVDS接口2041及HUB接口2042。
在本实施例中，视频输出接口可以包括多种类型的视频输出接口，可以提高视频数据处理的灵活度，满足用户需求。
本实施例中，接收端芯片使用SERDES接口，充分利用传输媒体的信道容量，减少所需的传输信道和器件引脚数目，提升信号的传输速度，从而大大降低通信成本。
发送端芯片可以做成BGA封装，通过集成多个提高通信速率，增加通信带宽，减小发送端芯片接口数量，从而减小发送端芯片体积，增加带载LED点数。
在本实施例中，接收端芯片只需要做外围接口和电源即可，大大简化产品接收端布局布线问题。
在本实施例中，接收端芯片100设置有1～8个速率最高达到12.5G的SERDES接口，举例来说，图1所示的发送端芯片100的SERDES接口104的个数为3个。
本公开实施例提供的接收端芯片，通过集成多个SERDES接口，提高通信速率，增加通信带宽，减小发送端芯片接口数量，从而减小发送端芯片体积，解决LED灯间距无法减小的问题，增加带载LED点数。
实施例3
本公开实施例提供了一种显示控制系统。
在本实施例中，显示控制系统包括：
显示器件、实施例1所述的发送端芯片、及多个实施例2所述的接收端芯片；
所述发送端芯片的各SERDES接口对应连接于一接收端芯片的主SERDES接口；
多个所述接收端芯片与所述显示器件连接。
在本实施例中，显示控制系统数据传输速率高、带载能力强，不因通信备份而降低带载。
本实施例中，发送端芯片具有实施例1提供的发送端芯片的结构及连接关系、能实现相应的功能，为避免重复，在此不做赘述。
本实施例中，接收端芯片具有实施例2提供的接收端芯片的结构及连接关系、能实现相应的功能，为避免重复，在此不做赘述。
在本实施例中，所述发送端芯片的第一存储器和/或所述接收端芯片的第二存储器为DDR或SDRAM。所述发送端芯片的视频输入接口包括HDMI接口、DP接口、DVI接口、SDI接口、VGA接口。所述接收端芯片的视频输出接口包括：LVDS接口及HUB接口。
在本实施例中，DDR、SDRAM、HDMI接口、DP接口、DVI接口、SDI接口、VGA接口、LVDS接口及HUB接口的相关解释可以参阅实施例1-2中的相应内容，为避免重复，在此不做赘述。
在一具体实施方式中，接收端芯片设置有1～32组视频输出接口，例如，接收端芯片设置32组视频输出接口。每一组视频输出接口对应与LED灯板/或屏幕上的视频接口连接。接收端芯片设置的视频输出接口的数量，根据LED灯板/或屏幕上的视频接口的数量确定。
需要说明的是，RGB接口设置数量是根据LED灯板上的rgb接口数(模组)而定，RGB接口是驱动LED屏幕的接口，即视频输出接口。
在另一实施方式中，接收端芯片设置控制卡2设置有1～32组HUB接口或LVDS接口。
需要说明的是，LVDS接口为驱动LED屏幕的接口。HUB接口为LED灯板接口的接口。
在本实施例中，所述显示器件包括：LED灯板和/或LED屏幕。
在本实施例中，通过LED灯板和/或LED屏幕可以显示对应视频图像。
可选的，各所述接收端芯片的辅SERDES接口对应连接于一其他接收端芯片，多个所述接收端芯片构成级联连接。
请参阅图4，显示控制系统包括发送端芯片100、第一接收端芯片2、第二接收端芯片20及第三接收端芯片200。
发送端芯片100包括第一存储器103及与所述第一存储器103分别连接的视频输入接口101、配置接口102及多个SERDES接口104，各SERDES接口104分别与第一接收端芯片2、第二接收端芯片20、第三接收端芯片200连接。
第一接收端芯片2包括第一主SERDES接口21及第一辅SERDES接口22及第二辅SERDES接口25、第二存储器23及与所述第二存储器23连接的第一视频输出接口24，所述第一视频输出接口24，还用于与显示器件连接。
第二接收端芯片20包括第二主SERDES接口201及第三辅SERDES接口202及第四辅SERDES接口205、第三存储器203及与所述第三存储器203连接的第二视频输出接口204，所述第二视频输出接口204，还用于与显示器件连接。
第三接收端芯片200包括第三主SERDES接口2001及第五辅SERDES接口2002及第六辅SERDES接口2005、第四存储器2003及与所述第四存储器2003连接的第三视频输出接口2004，所述第三视频输出接口2004，还用于与显示器件连接。
在本实施例中，第一接收端芯片2、第二接收端芯片20及第三接收端芯片200处于同一级联层。
需要说明的是，第一接收端芯片2、第二接收端芯片20及第三接收端芯片200的结构、连接关系与实施例2中的接收端芯片相同，引入第一、第二、第三、第四、第五、第六等序号，仅仅为了进行区分说明多个接收端芯片，对应在图4中个单元序号与图2中有所区分，也是为了方便对多个接收端芯片进行说明。
可选的，处于同一级联层的相邻接收端芯片的上一接收端芯片的一辅SERDES接口与下一接收端芯片的一辅SERDES接口相连接；
在多个所述接收端芯片存在从所述发送端芯片或上一级联层对应的接收端芯片获取对应的子视频数据及配置参数失败的目标接收端芯片时，所述目标接收端芯片，用于从与其相连接的接收端芯片获取对应的子视频数据及配置参数。
请再次参阅图4，第一接收端芯片2的第二辅SERDES接口与第二接收端芯片20的第三辅SERDES接口连接，第二接收端芯片20的第四辅SERDES接口205与第三接收端芯片200的第五辅SERDES接口连接。
在正常情况下，接收端芯片的所有serdes接口104分别与第一接收端芯片2、第二接收端芯片20及第三接收端芯片200能进行正常的视频数据及配置参数的传输。在异常情况下，例如，接收端芯片的serdes接口104与第二接收端芯片20之间的传输出现异常，例如，serdes接口104或传输线损坏，第二接收端芯片20的第三辅SERDES接口202从第一接收端芯片2获取子视频数据及配置参数，确保屏幕不会因为某个或某几个接口或者传输线损坏而影响屏幕的正常显示，也不会导致带载减小。
请参阅图5，与图4的区别之处在于，显示控制系统还包括第四接收端芯片3、第五接收端芯片30及第六接收端芯片300。
第三接收端芯片3包括第四主SERDES接口31及第七辅SERDES接口32及第八辅SERDES接口35、第五存储器33及与所述第五存储器33连接的第四视频输出接口34，所述第四视频输出接口34，还用于与显示器件连接。
第五接收端芯片30包括第五主SERDES接口301及第九辅SERDES接口302及第十辅SERDES接口305、第六存储器303及与所述第六存储器303连接的第五视频输出接口304，所述第五视频输出接口304，还用于与显示器件连接。
第六接收端芯片300包括第六主SERDES接口3001及第十一辅SERDES接口3002及第第十二辅SERDES接口3005、第七存储器3003及与所述第七存储器3003连接的第六视频输出接口3004，所述第六视频输出接口3004，还用于与显示器件连接。
在本实施例中，第一接收端芯片2、第二接收端芯片20及第三接收端芯片200处于同一级联层，第四接收端芯片3、第五接收端芯片30及第六接收端芯片600处于同一级联层。
需要说明的是，第一接收端芯片2、第二接收端芯片20及第三接收端芯片200的结构、连接关系与实施例2中的接收端芯片相同，引入第一、第二、第三、第四、第五、第六等序号，仅仅为了进行区分说明多个接收端芯片，对应在图4中个单元序号与图2中有所区分，也是为了方便对多个接收端芯片进行说明。
与图4不同的是，在图5中第一接收端芯片2、第二接收端芯片20及第三接收端芯片200之间没有连接。第四接收端芯片3的第八辅SERDES接口35与第五接收端芯片30的第就辅SERDES接口302连接，五接收端芯片30的第就辅SERDES接口305与第六接收端芯片300的第十一辅SERDES接口3005连接。
需要说明的是，第一接收端芯片2、第二接收端芯片20及第三接收端芯片200、第四接收端芯片3、第五接收端芯片30及第六接收端芯片300的结构、连接关系与实施例2中的接收端芯片相同，引入第一、第二、第三、第四、第五、第六、......、第十二等序号，仅仅为了对不同接收端芯片的器件进行区分，方便对多个接收端芯片进行说明。
这样，通过处于同一级联层的相邻接收端芯片的辅SERDES接口进行连接，实现多条获取子视频数据及配置参数的路径，在出现异常情况时，能从相邻接收端芯片读取子视频数据及配置参数，确保屏幕不会因为某个或某几个接口或者传输线损坏而影响屏幕的正常显示，也不会导致带载减小。
本公开实施例提供的显示控制系统由发送端芯片、接收端芯片及显示器件连接组成，发送端芯片、接收端芯片通过集成多个SERDES接口，提高通信速率，增加通信带宽，减小发送端芯片接口数量，从而减小发送端芯片体积，解决LED灯间距无法减小的问题，增加带载LED点数。
实施例4
本公开实施例提供了一种显示控制方法。
具体的，本实施例中，显示控制方法应用于实施例3提供的显示控制系统，方法包括：
发送端芯片的视频输入接口获取视频数据，将所述视频数据写入所述发送端芯片的第一存储器；
所述发送端芯片的配置接口获取存储显示器件的配置参数，将所述配置参数写入所述第一存储器；
所述发送端芯片的第一存储器将所述视频数据划分为多个子视频数据；
所述发送端芯片的各SERDES接口从所述第一存储器读取对应的子视频数据及所述配置参数，将读取的子视频数据及配置参数分配至对应的一接收端芯片；
接收端芯片的主SERDES接口从所述发送端芯片获取对应的子视频数据及配置参数，并将所述子视频数据及所述配置参数写入所述第二存储器；
所述接收端芯片的视频输出接口从所述第二存储器读取对应的子视频数据及配置参数，向低压差分信号接口输入所述子视频数据及所述配置参数；
所述接收端芯片的低压差分信号接口，用于将所述子视频数据及所述配置参数输入显示驱动芯片，以通过所述显示驱动芯片产生所述目标电流，所述目标电流用于驱动所述显示器件显示所述子视频数据。
可选的，所述方法还包括：
在多个所述接收端芯片存在从所述发送端芯片或上一级联层对应的接收端芯片获取子视频数据及配置参数失败的目标接收端芯片时，所述目标接收端芯片从与其相连接的接收端芯片获取对应的子视频数据及配置参数。
实施例提供的显示控制方法可以实现实施例3对应实现显示控制系统的控制过程，为避免重复，在此不做赘述
实施例5
此外，本公开实施例提供了一种显示设备，包括实施例3提供的显示控制系统。
实施例提供的显示设备可以实现实施例3提供的显示控制系统的功能，为避免重复，在此不做赘述。
在本申请所提供的几个实施例中，应该理解到，所揭露的装置和方法，也可以通过其它的方式实现。以上所描述的装置实施例仅仅是示意性的，例如，附图中的流程图和结构图显示了根据本发明的多个实施例的装置、方法和计算机程序产品的可能实现的体系架构、功能和操作。在这点上，流程图或框图中的每个方框可以代表一个模块、程序段或代码的一部分，所述模块、程序段或代码的一部分包含一个或多个用于实现规定的逻辑功能的可执行指令。也应当注意，在作为替换的实现方式中，方框中所标注的功能也可以以不同于附图中所标注的顺序发生。例如，两个连续的方框实际上可以基本并行地执行，它们有时也可以按相反的顺序执行，这依所涉及的功能而定。也要注意的是，结构图和/或流程图中的每个方框、以及结构图和/或流程图中的方框的组合，可以用执行规定的功能或动作的专用的基于硬件的系统来实现，或者可以用专用硬件与计算机指令的组合来实现。
另外，在本发明各个实施例中的各功能模块或单元可以集成在一起形成一个独立的部分，也可以是各个模块单独存在，也可以两个或更多个模块集成形成一个独立的部分。
所述功能如果以软件功能模块的形式实现并作为独立的产品销售或使用时，可以存储在一个计算机可读取存储介质中。基于这样的理解，本发明的技术方案本质上或者说对现有技术做出贡献的部分或者该技术方案的部分可以以软件产品的形式体现出来，该计算机软件产品存储在一个存储介质中，包括若干指令用以使得一台计算机设备(可以是智能手机、个人计算机、服务器、或者网络设备等)执行本发明各个实施例所述方法的全部或部分步骤。而前述的存储介质包括：U盘、移动硬盘、只读存储器(ROM，Read-Only Memory)、随机存取存储器(RAM，Random Access Memory)、磁碟或者光盘等各种可以存储程序代码的介质。
以上所述，仅为本发明的具体实施方式，但本发明的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本发明揭露的技术范围内，可轻易想到变化或替换，都应涵盖在本发明的保护范围之内。

Claims (13)

1.一种发送端芯片，其特征在于，包括第一存储器及与所述第一存储器分别连接的视频输入接口、配置接口及多个SERDES接口，各SERDES接口与对应的一接收端芯片连接；
所述视频输入接口，用于获取视频数据，将所述视频数据写入所述第一存储器；
配置接口，用于获取存储显示器件的配置参数，将所述配置参数写入所述第一存储器；
所述第一存储器，用于将所述视频数据划分为多个子视频数据；
各SERDES接口，用于从所述第一存储器读取对应的子视频数据及所述配置参数，将读取的子视频数据及所述配置参数分配至对应的一接收端芯片。
2.根据权利要求1所述的发送端芯片，其特征在于，各SERDES接口包含均衡模块及时钟恢复模块；
所述均衡模块，用于在低速并行数据通过通信协议层后，对所述低速并行数据进行加扰及比特位转换编码处理，得到转换后的并行数据，并将转换后的并行数据写入先入先出队列，通过串行器将转换后的并行数据转换为串行差分信号，通过均衡器对所述串行差分信号进行均衡化处理，得到均衡化串行差分信号；
所述时钟恢复模块，用于通过均衡器对所述均衡化串行差分信号进行补偿，得到修正串行差分信号，对所述修正串行差分信号进行数据时钟恢复，得到时钟信号，将所述时钟信号输入解串器，通过所述解串器根据所述时钟信号对所述修正串行差分信号进行转换处理，得到并行数据，对所述并行数据进行解扰及比特位转换解码处理，得到解码后的并行数据。
3.一种接收端芯片，其特征在于，包括主SERDES接口、第二存储器、低压差分信号接口及与所述第二存储器连接的视频输出接口，所述视频输出接口，还用于与显示器件连接；
所述主SERDES接口分别与所述第二储存器、及权利要求1或2所述发送端芯片对应的一SERDES接口连接；
所述主SERDES接口，用于从所述发送端芯片获取对应的子视频数据及配置参数，并将所述子视频数据及所述配置参数写入所述第二存储器；
所述视频输出接口，用于从所述第二存储器读取对应的子视频数据及配置参数，向低压差分信号接口输入所述子视频数据及所述配置参数；
所述低压差分信号接口，用于将所述子视频数据及所述配置参数输入显示驱动芯片，以通过所述显示驱动芯片产生所述目标电流，所述目标电流用于驱动所述显示器件显示所述子视频数据。
4.根据权利要求3所述的显示控制系统，其特征在于，所述接收端芯片包括多个辅SERDES接口，各辅SERDES接口分别与所述主SERDES接口及对应的一其他接收端芯片连接。
5.一种显示控制系统，其特征在于，包括：
显示器件、如权利要求1或2所述的发送端芯片、及多个如权利要求3或4所述的接收端芯片；
所述发送端芯片的各SERDES接口对应连接于一接收端芯片的主SERDES接口；
多个所述接收端芯片与所述显示器件连接。
6.根据权利要求5所述的显示控制系统，其特征在于，各所述接收端芯片的辅SERDES接口对应连接于一其他接收端芯片，多个所述接收端芯片构成级联连接。
7.根据权利要求6所述的显示控制系统，其特征在于，处于同一级联层的相邻接收端芯片的上一接收端芯片的一辅SERDES接口与下一接收端芯片的一辅SERDES接口相连接；
在多个所述接收端芯片存在从所述发送端芯片或上一级联层对应的接收端芯片获取子视频数据及配置参数失败的目标接收端芯片时，所述目标接收端芯片，用于从与其相连接的接收端芯片获取对应的子视频数据及配置参数。
8.根据权利要求5所述的显示控制系统，其特征在于，所述第一存储器和/或所述第二存储器为DDR或SDRAM。
9.根据权利要求5所述的显示控制系统，其特征在于，所述视频输入接口包括HDMI接口、DP接口、DVI接口、SDI接口、VGA接口；所述视频输出接口包括LVDS接口及HUB接口。
10.根据权利要求5所述的显示控制系统，其特征在于，所述显示器件包括：LED灯板和/或LED屏幕。
11.一种显示控制方法，其特征在于，应用于如权利要求5-10任一项所述的显示控制系统，所述方法包括：
发送端芯片的视频输入接口获取视频数据，将所述视频数据写入所述发送端芯片的第一存储器；
所述发送端芯片的配置接口获取存储显示器件的配置参数，将所述配置参数写入所述第一存储器；
所述发送端芯片的第一存储器将所述视频数据划分为多个子视频数据；
所述发送端芯片的各SERDES接口从所述第一存储器读取对应的子视频数据及所述配置参数，将读取的子视频数据及配置参数分配至对应的一接收端芯片；
接收端芯片的主SERDES接口从所述发送端芯片获取对应的子视频数据及配置参数，并将所述子视频数据及所述配置参数写入所述第二存储器；
所述接收端芯片的视频输出接口从所述第二存储器读取对应的子视频数据及配置参数，向低压差分信号接口输入所述子视频数据及所述配置参数；
所述接收端芯片的低压差分信号接口，用于将所述子视频数据及所述配置参数输入显示驱动芯片，以通过所述显示驱动芯片产生所述目标电流，所述目标电流用于驱动所述显示器件显示所述子视频数据。
12.根据权利要求11所述的方法，其特征在于，所述方法还包括：
在多个所述接收端芯片存在从所述发送端芯片或上一级联层对应的接收端芯片获取子视频数据及配置参数失败的目标接收端芯片时，所述目标接收端芯片从与其相连接的接收端芯片获取对应的子视频数据及配置参数。
13.一种显示设备，其特征在于，包括如权利要求5-10任一项所述的显示控制系统。
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