CN116062677A - 一种抗干扰的mems压力传感器芯片及其制备方法 - Google Patents
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Abstract
本发明提供一种抗干扰的MEMS压力传感器芯片及其制备方法,应用于敏感元件与传感器技术领域,包括P型基体和压敏电阻、N型层、第一重掺杂区、N型外延层、第二重掺杂区、N+层、介质层、金属层和玻璃层,N型层位于P型基体的上方,压敏电阻包埋于N型层中;第一重掺杂区注入于N型层内;N型外延层与N型层连接;第二重掺杂区位于N型外延层的内部;N+层位于N型外延层的内部;介质层位于N型外延层的上方;金属层位于介质层内,与N型外延层、第二重掺杂区连接;玻璃层,嵌入介质层中,与N+层连接。能够提高芯片的抗干扰性能,能够控制刻蚀深度,具有良好的隔膜厚度可控性,且能够减小因介质层造成的内应力,降低工艺难度。
Description
技术领域
本发明属于敏感元件与传感器技术领域,具体涉及一种抗干扰的MEMS压力传感器芯片及其制备方法。
背景技术
压力传感器是一种能够将外界压力载荷转换为电信号的装置,根据其结构和工作原理,可以细分为MEMS压力传感器、陶瓷压力传感器、玻璃微熔压力传感器、溅射薄膜压力传感器、注油芯体压力传感器等。
其中,MEMS压力传感器是基于微机电系统工艺制备得到的,而MEMS技术,是一种在硅集成电路(IC)基础上发展而来的技术,可以兼容部分IC工艺的优点。因此,MEMS压力传感器具有小型化、批量化、低成本等优势,被广泛应用于工业控制、航空航天、汽车船舶等领域。
常规MEMS压力传感器芯片,在实际使用过程中,会受到外界环境,如封装、水汽、介质等的影响,而出现输出信号不稳定的现象。具体表现形式包括:上电漂移,即上电后1分钟内存在输出尖峰、信号不稳定等现象;长期零位输出漂移,即传感器零位输出信号会随着时间单方向大幅度变化等。
为了解决这些问题,专利号为US5231301A,名称为:具有压敏电阻和改进静电结构的半导体传感器的美国专利,提出了一种方案:在MEMS芯片隔膜上方引入金属铬,形成铬硅合金,作为电荷掩蔽层,同时通过N型掺杂,将硅基体、电源正极、掩蔽层相连接,使得压敏电阻周边等电势,从而保证压敏电阻在工作时不受外界环境的影响。
不过,这种方案同样具备缺陷:一方面,该方案需要在MEMS芯片应变区域上方新增金属层,会额外引入内应力,因此需要同时优化金属层、介质层的厚度,以规避内应力的影响,工艺难度大,需要较长的时间来调整工艺;另一方面,该方案额外增加了一个需要与电源正连接的输入/输出端子,这会增加芯片的复杂度,降低芯片的通用性。
发明内容
鉴于现有技术中存在上述问题,本发明的目的是提供一种抗干扰的MEMS压力传感器芯片及其制备方法,能够提高芯片的抗干扰性能,便于控制刻蚀深度,具有良好的隔膜厚度可控性,且能够减小因介质层造成的内应力,降低工艺难度。
一种抗干扰的MEMS压力传感器芯片,包括P型基体和压敏电阻,还包括:
N型层,位于P型基体的上方,所述压敏电阻包埋于所述N型层中;
第一重掺杂区,注入于所述N型层内,用于将压敏电阻与第二重掺杂区连接;
N型外延层,位于N型层的上方,用于包埋所述压敏电阻,使压敏电阻周围的电势相等;
第二重掺杂区,位于所述N型外延层的内部;
N+层,位于所述N型外延层的内部;
介质层,位于所述N型外延层的上方,用于保护N型外延层、第二重掺杂区;
金属层,位于所述介质层内,与所述N型外延层、第二重掺杂区连接,所述金属层用于在外部形成信号输入端和信号输出端;
带有空腔的玻璃层,嵌入所述介质层中,与所述N+层连接,用于实现阳极键合。
所述P型基体的电阻率为1-20Ω·cm,晶面为(100),厚度范围为200-1000μm。
所述N型层的电阻率为1-20Ω·cm,所述N型层掺杂有磷离子,掺杂深度范围为5-20μm。
所述第一重掺杂区掺杂有硼离子。
所述N型外延层、N+层均掺杂有磷离子,所述N型外延层的厚度为1-10μm。
所述第二重掺杂区掺杂有硼离子,掺杂深度大于所述N型外延层厚度至少3μm。
所述介质层的材料为氧化硅,厚度为100-1000nm。
本发明的另一个目的在于,提出一种抗干扰的MEMS压力传感器芯片的制备方法,具体包括如下步骤:
步骤1、在P型基体上通过离子注入法掺杂磷离子以形成N型层,掺杂类型为轻掺杂,电阻率为1-20Ω·cm,掺杂深度为5-20μm,具体包括掩膜层制备、高能离子注入、热退火、掩膜层去除工序;
步骤2、在N型层内通过离子注入法掺杂硼离子形成第一重掺杂区并将压敏电阻包埋于N型层、第一重掺杂区中;其中,第一重掺杂区的形成过程包括轻掺杂过程和重掺杂过程,所述轻掺杂过程为P-型掺杂,掺杂深度为0.5-2μm,方阻范围为100-1000Ω/□:所述重掺杂过程为P+型掺杂,掺杂厚度为0.5-2μm,方阻范围为10-100Ω/□:
步骤3、将N型层外延形成N型外延层,外延过程中通过轻掺杂方式掺杂磷离子,其中,N型外延层的厚度为1-10μm;
步骤4、通过P+型掺杂方式在N型外延层中掺杂硼离子以形成第二重掺杂区,其中,掺杂类型为重掺杂,掺杂厚度大于步骤三中N型外延层的厚度至少3μm,方阻范围为10-100Ω/□;
步骤5、在N型外延层中通过离子注入法掺杂磷离子形成N+层,掺杂类型为重掺杂;
步骤6、在N型外延层、第二重掺杂区、N+层上方通过热氧化物法制备介质层,其中,介质层的材料为氧化硅,介质层的厚度为100-1000nm;
步骤7、在介质层上通过干法刻蚀制备第一引线孔将介质层打通;
步骤8、在介质层上通过物理气相沉积制备金属层;
步骤9、通过湿法腐蚀的方式进行背腔刻蚀;
步骤10、在介质层上通过干法刻蚀制备第二引线孔将介质层打通;
步骤11、通过阳极键合的方法将玻璃层与经过步骤10处理后的芯片键合,其中,阳极键合施加外部偏压为200-1000V、温度为200-400℃;
步骤12、通过激光划片或机械划片将对玻璃层进行切割,使作为信号输入端、信号输出端的金属层露出。
本发明的有益效果是:该抗干扰的MEMS压力传感器芯片及其制备方法,将压敏电阻包埋于上下均为等电势的N型硅材料,保证了压敏电阻处于外界电荷屏蔽区域,从而具有良好的抗干扰性能,且由于压敏电阻采用包埋结构,位于芯片顶部的介质层厚度可设置得非常薄,且不需要额外沉积电荷掩蔽层进行保护,从而能够显著减小因介质层、电荷掩蔽层等造成的内应力,降低工艺难度;此外,可通过控制离子注入的深度控制刻蚀深度,防止刻蚀不足或过度刻蚀的情况发生,具有良好的隔膜厚度可控性,能够有效提高产品的一致性;另外,通过在芯片表面键合玻璃层作为密封,可以避免该芯片在应用过程中受到外界环境侵蚀,能够保证该传感器芯片的长期环境稳定性。
附图说明
附图用来提供对本发明的进一步理解,并且构成说明书的一部分,与本发明的实施例一起用于解释本发明,并不构成对本发明的限制。在附图中:
图1是本发明的结构示意图;
图2是本发明芯片制备的工艺流程步骤1-3的结构示意图;
图3是本发明芯片制备的工艺流程步骤4-7的结构示意图;
图4是本发明芯片制备的工艺流程步骤8-10的结构示意图;
图5是本发明芯片制备的工艺流程步骤11-12的结构示意图。
图中标记为:1、P型基体;2、N型层;3、压敏电阻;4、第一重掺杂区;5、N型外延层;6、第二重掺杂区;7、N+层;8、介质层;9、金属层;10、玻璃层。
具体实施方式
实施例一
如图1所示,一种抗干扰的MEMS压力传感器芯片,包括P型基体1和压敏电阻3,还包括:N型层2、第一重掺杂区4、N型外延层5、第二重掺杂区6、N+层7、介质层8、金属层9和带有空腔的玻璃层10。
具体的,P型基体1的电阻率为1-20Ω·cm,晶面为(100),厚度范围为200-1000μm,常用为380μm、400μm或625μm。
N型层2位于P型基体1的上方,压敏电阻3包埋于所述N型层2中,N型层2的电阻率为1-20Ω·cm,N型层2掺杂有磷离子,掺杂深度范围为5-20μm。
第一重掺杂区4位于N型层2内,用于将压敏电阻3与第二重掺杂区6连接,其中,第一重掺杂区4掺杂有硼离子。
N型外延层5位于N型层2的上方,用于包埋所述压敏电阻3,使压敏电阻3周围的电势相等,N型外延层5掺杂有磷离子,N型外延层5的厚度为1-10μm。
第二重掺杂区6贯穿所述N型外延层5的内部并且与第一重掺杂区4连接,第二重掺杂区6掺杂有硼离子,掺杂深度大于所述N型外延层5厚度至少3μm。
N+层7掺杂有磷离子,位于所述N型外延层5的内部。
介质层8位于N型外延层5的上方,用于保护N型外延层5、第二重掺杂区6,介质层8的材料为氧化硅,厚度为100-1000nm。
金属层9位于介质层8内,与N型外延层5、第二重掺杂区6连接,所述金属层9用于在外部形成信号输入端和信号输出端。
带有空腔的玻璃层10嵌入介质层8中,与所述N+层7连接,用于实现阳极键合。
实施例二
如图2所示,本发明的第二方面,提出一种抗干扰的MEMS压力传感器芯片的制备方法,具体包括如下步骤:
步骤1、在P型基体1上通过离子注入法掺杂磷离子以形成N型层2,掺杂类型为轻掺杂,电阻率为1-20Ω·cm,掺杂深度为5-20μm,具体包括掩膜层制备、高能离子注入、热退火、掩膜层去除工序;
步骤2、在N型层2内通过离子注入法掺杂硼离子形成第一重掺杂区4并将压敏电阻3包埋于N型层2、第一重掺杂区4中;其中,第一重掺杂区4的形成过程包括轻掺杂过程和重掺杂过程,所述轻掺杂过程为P-型掺杂,掺杂深度为0.5-2μm,方阻范围为100-1000Ω/□:经过轻掺杂过程,可以得到包埋的压敏电阻3,所述重掺杂过程为P+型掺杂,掺杂厚度为0.5-2μm,方阻范围为10-100Ω/□:
步骤3、将N型层2外延形成N型外延层5,外延过程中通过轻掺杂方式掺杂磷离子,其中,N型外延层5的厚度为1-10μm;用于将由步骤二形成的包埋式压敏电阻3进一步包埋,使压敏电阻3的周围处于等电势状态,保证了其处于外界电荷屏蔽区域,从而具有良好的抗干扰性能。
步骤4、通过P+型掺杂方式在N型外延层5中掺杂硼离子以形成第二重掺杂区6,其中,掺杂类型为重掺杂,掺杂厚度大于步骤三中N型外延层5的厚度至少3μm,方阻范围为10-100Ω/□;
步骤5、在N型外延层5中通过离子注入法掺杂磷离子形成N+层7,掺杂类型为重掺杂;用于保障后续的阳极键合成功进行。
步骤6、在N型外延层5、第二重掺杂区6、N+层7上方通过热氧化物法制备介质层8,其中,介质层8的材料为氧化硅,介质层8的厚度为100-1000nm;介质层8用于保护内部的压敏电阻3、第一重掺杂区4和第二重掺杂区6等结构。由于介质层8未使用常规的氧化硅或氮化硅的结构,而是仅采用一层氧化硅薄层的结构,因此内应力较小,能够大幅降低工艺难度。
步骤7、在介质层8上通过干法刻蚀制备第一引线孔将介质层8打通;用于确保后续金属层9可以与包埋的第二重掺杂区6连接。
步骤8、在介质层8上通过物理气相沉积制备金属层9,金属材料可为铝、金、铂、钛铂金等,通常选择铝。
步骤9、通过湿法腐蚀的方式进行背腔刻蚀;其中,将N型层2所在的一面称为正面,其对应的一面称为反面,刻蚀材料可选择KOH或TMAH刻蚀液,通常选择KOH刻蚀液;湿法腐蚀过程中需要在芯片上施加偏置,以保证刻蚀至N型层2时刻蚀自动停止,可以防止刻蚀不足或过度刻蚀的情况发生,具有良好的隔膜厚度可控性,能够有效提升产品的一致性,其中,刻蚀的深度由N型层2的厚度决定。
步骤10、在介质层8上通过干法刻蚀制备第二引线孔将介质层8打通;用于确保后续玻璃层10可以与N+层连接,实现阳极键合。
步骤11、通过阳极键合的方法将玻璃层10与经过步骤10处理后的芯片键合,其中,阳极键合施加外部偏压为200-1000V、温度为200-400℃;
步骤12、通过激光划片或机械划片将对玻璃层10进行切割,使作为信号输入端、信号输出端的金属层9露出。
以上所述仅为本发明的优选实施例而已,并不用于限制本发明,尽管参照前述实施例对本发明进行了详细的说明,对于本领域的技术人员来说,其依然可以对前述各实施例所记载的技术方案进行修改,或者对其中部分技术特征进行等同替换。凡在本发明的精神和原则之内,所作的任何修改、等同替换、改进等,均应包含在本发明的保护范围之内。
Claims (8)
1.一种抗干扰的MEMS压力传感器芯片,包括P型基体(1)和压敏电阻(3),其特征在于,还包括:
N型层(2),位于P型基体(1)的上方,所述压敏电阻(3)包埋于所述N型层(2)中;
第一重掺杂区(4),注入于所述N型层(2)内,用于将压敏电阻(3)与第二重掺杂区(6)连接;
N型外延层(5),位于N型层(2)的上方,用于包埋所述压敏电阻(3),使压敏电阻(3)周围的电势相等;
第二重掺杂区(6),位于所述N型外延层(5)的内部;
N+层(7),位于所述N型外延层(5)的内部;
介质层(8),位于所述N型外延层(5)的上方,用于保护N型外延层(5)、第二重掺杂区(6),所述介质层(8)的厚度为100-1000nm;
金属层(9),位于所述介质层(8)内,与所述N型外延层(5)、第二重掺杂区(6)连接,所述金属层(9)用于在外部形成信号输入端和信号输出端;
带有空腔的玻璃层(10),嵌入所述介质层(8)中,与所述N+层(7)连接,用于实现阳极键合。
2.根据权利要求1所述的抗干扰的MEMS压力传感器芯片,其特征在于,所述P型基体(1)的电阻率为1-20Ω·cm,晶面为(100),厚度范围为200-1000μm。
3.根据权利要求1所述的抗干扰的MEMS压力传感器芯片,其特征在于,所述N型层(2)的电阻率为1-20Ω·cm,所述N型层(2)掺杂有磷离子,掺杂深度范围为5-20μm。
4.根据权利要求1所述的抗干扰的MEMS压力传感器芯片,其特征在于,所述第一重掺杂区(4)掺杂有硼离子。
5.根据权利要求1所述的抗干扰的MEMS压力传感器芯片,其特征在于,所述N型外延层(5)、N+层(7)均掺杂有磷离子,所述N型外延层(5)的厚度为1-10μm。
6.根据权利要求1所述的抗干扰的MEMS压力传感器芯片,其特征在于,所述第二重掺杂区(6)掺杂有硼离子,掺杂深度大于所述N型外延层(5)厚度至少3μm。
7.根据权利要求1所述的抗干扰的MEMS压力传感器芯片,其特征在于,所述介质层(8)的材料为氧化硅。
8.一种制备如权利要求1-7中任一项所述的抗干扰的MEMS压力传感器芯片的方法,其特征在于,具体包括如下步骤:
步骤1、在P型基体(1)上掺杂磷离子以形成N型层(2);
步骤2、在N型层(2)内掺杂硼离子形成第一重掺杂区(4)并将压敏电阻(3)包埋于N型层(2)、第一重掺杂区(4)中;其中,第一重掺杂区(4)的形成过程包括轻掺杂过程和重掺杂过程;
步骤3、将N型层(2)外延形成N型外延层(5),外延过程中通过轻掺杂方式掺杂磷离子;
步骤4、在N型外延层(5)中掺杂硼离子以形成第二重掺杂区(6);
步骤5、在N型外延层(5)中掺杂磷离子形成N+层(7);
步骤6、在N型外延层(5)、第二重掺杂区(6)、N+层(7)上方制备介质层(8);
步骤7、在介质层(8)上制备第一引线孔将介质层(8)打通;
步骤8、在介质层(8)上制备金属层(9);
步骤9、进行背腔刻蚀;
步骤10、在介质层(8)上制备第二引线孔将介质层(8)打通;
步骤11、将玻璃层(10)与经过步骤10处理后的芯片键合;
步骤12、对玻璃层(10)进行切割,使作为信号输入端、信号输出端的金属层(9)露出。
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